【課題】安定した電気特性を有する薄膜トランジスタを有する、信頼性のよい半導体装置
を作製し、提供することを課題の一とする。
【解決手段】チャネル形成領域を含む半導体層を酸化物半導体膜とする薄膜トランジスタ
を有する半導体装置の作製方法において、酸化物半導体膜の純度を高め、不純物である水
分などを低減する加熱処理（脱水化または脱水素化のための加熱処理）を行う。また、酸
化物半導体膜中だけでなく、ゲート絶縁層内に存在する水分などの不純物を低減し、上下
に接して設けられる膜と酸化物半導体膜の界面に存在する水分などの不純物を低減する。

【発明の詳細な説明】
【技術分野】
【０００１】
酸化物半導体を用いる半導体装置及びその作製方法に関する。
【０００２】
なお、本明細書中において半導体装置とは、半導体特性を利用することで機能しうる装
置全般を指し、電気光学装置、半導体回路および電子機器は全て半導体装置である。
【背景技術】
【０００３】
近年、絶縁表面を有する基板上に形成された半導体薄膜（厚さ数〜数百ｎｍ程度）を用
いて薄膜トランジスタ（ＴＦＴ）を構成する技術が注目されている。薄膜トランジスタは
ＩＣや電気光学装置のような電子デバイスに広く応用され、特に画像表示装置のスイッチ
ング素子として開発が急がれている。金属酸化物は多様に存在しさまざまな用途に用いら
れている。酸化インジウムはよく知られた材料であり、液晶ディスプレイなどで必要とさ
れる透明電極材料として用いられている。
【０００４】
金属酸化物の中には半導体特性を示すものがある。半導体特性を示す金属酸化物としては
、例えば、酸化タングステン、酸化錫、酸化インジウム、酸化亜鉛などがあり、このよう
な半導体特性を示す金属酸化物をチャネル形成領域とする薄膜トランジスタが既に知られ
ている（特許文献１乃至４、非特許文献１）。
【０００５】
ところで、金属酸化物は一元系酸化物のみでなく多元系酸化物も知られている。例えば、
ホモロガス相を有するＩｎＧａＯ_３（ＺｎＯ）_ｍ（ｍ：自然数）は、Ｉｎ、Ｇａ及びＺｎ
を有する多元系酸化物半導体として知られている（非特許文献２乃至４）。
【０００６】
そして、上記のようなＩｎ−Ｇａ−Ｚｎ系酸化物で構成される酸化物半導体を薄膜トラン
ジスタのチャネル層として適用可能であることが確認されている（特許文献５、非特許文
献５及び６）。
【先行技術文献】
【特許文献】
【０００７】
【特許文献１】特開昭６０−１９８８６１号公報
【特許文献２】特開平８−２６４７９４号公報
【特許文献３】特表平１１−５０５３７７号公報
【特許文献４】特開２０００−１５０９００号公報
【特許文献５】特開２００４−１０３９５７号公報
【非特許文献】
【０００８】
【非特許文献１】Ｍ． Ｗ． Ｐｒｉｎｓ， Ｋ． Ｏ． Ｇｒｏｓｓｅ−Ｈｏｌｚ， Ｇ． Ｍｕｌｌｅｒ， Ｊ． Ｆ． Ｍ． Ｃｉｌｌｅｓｓｅｎ， Ｊ． Ｂ． Ｇｉｅｓｂｅｒｓ， Ｒ． Ｐ． Ｗｅｅｎｉｎｇ， ａｎｄ Ｒ． Ｍ． Ｗｏｌｆ、「Ａ ｆｅｒｒｏｅｌｅｃｔｒｉｃ ｔｒａｎｓｐａｒｅｎｔ ｔｈｉｎ−ｆｉｌｍ ｔｒａｎｓｉｓｔｏｒ」、 Ａｐｐｌ． Ｐｈｙｓ． Ｌｅｔｔ．、１７ Ｊｕｎｅ １９９６、 Ｖｏｌ．６８ ｐ．３６５０−３６５２
【非特許文献２】Ｍ． Ｎａｋａｍｕｒａ， Ｎ． Ｋｉｍｉｚｕｋａ， ａｎｄ Ｔ． Ｍｏｈｒｉ、「Ｔｈｅ Ｐｈａｓｅ Ｒｅｌａｔｉｏｎｓ ｉｎ ｔｈｅ Ｉｎ２Ｏ３−Ｇａ２ＺｎＯ４−ＺｎＯ Ｓｙｓｔｅｍ ａｔ １３５０℃」、Ｊ． Ｓｏｌｉｄ Ｓｔａｔｅ Ｃｈｅｍ．、１９９１、Ｖｏｌ．９３， ｐ．２９８−３１５
【非特許文献３】Ｎ． Ｋｉｍｉｚｕｋａ， Ｍ． Ｉｓｏｂｅ， ａｎｄ Ｍ． Ｎａｋａｍｕｒａ、「Ｓｙｎｔｈｅｓｅｓ ａｎｄ Ｓｉｎｇｌｅ−Ｃｒｙｓｔａｌ Ｄａｔａ ｏｆ Ｈｏｍｏｌｏｇｏｕｓ Ｃｏｍｐｏｕｎｄｓ， Ｉｎ２Ｏ３（ＺｎＯ）ｍ（ｍ＝３，４， ａｎｄ ５）， ＩｎＧａＯ３（ＺｎＯ）３， ａｎｄ Ｇａ２Ｏ３（ＺｎＯ）ｍ（ｍ＝７，８，９， ａｎｄ １６） ｉｎ ｔｈｅ Ｉｎ２Ｏ３−ＺｎＧａ２Ｏ４−ＺｎＯ Ｓｙｓｔｅｍ」、 Ｊ． Ｓｏｌｉｄ Ｓｔａｔｅ Ｃｈｅｍ．、１９９５、Ｖｏｌ．１１６， ｐ．１７０−１７８
【非特許文献４】中村真佐樹、君塚昇、毛利尚彦、磯部光正、「ホモロガス相、ＩｎＦｅＯ３（ＺｎＯ）ｍ（ｍ：自然数）とその同型化合物の合成および結晶構造」、固体物理、１９９３年、Ｖｏｌ．２８、Ｎｏ．５、ｐ．３１７−３２７
【非特許文献５】Ｋ． Ｎｏｍｕｒａ， Ｈ． Ｏｈｔａ， Ｋ． Ｕｅｄａ， Ｔ． Ｋａｍｉｙａ， Ｍ． Ｈｉｒａｎｏ， ａｎｄ Ｈ． Ｈｏｓｏｎｏ、「Ｔｈｉｎ−ｆｉｌｍ ｔｒａｎｓｉｓｔｏｒ ｆａｂｒｉｃａｔｅｄ ｉｎ ｓｉｎｇｌｅ−ｃｒｙｓｔａｌｌｉｎｅ ｔｒａｎｓｐａｒｅｎｔ ｏｘｉｄｅ ｓｅｍｉｃｏｎｄｕｃｔｏｒ」、ＳＣＩＥＮＣＥ、２００３、Ｖｏｌ．３００、ｐ．１２６９−１２７２
【非特許文献６】Ｋ． Ｎｏｍｕｒａ， Ｈ． Ｏｈｔａ， Ａ． Ｔａｋａｇｉ， Ｔ． Ｋａｍｉｙａ， Ｍ． Ｈｉｒａｎｏ， ａｎｄ Ｈ． Ｈｏｓｏｎｏ、「Ｒｏｏｍ−ｔｅｍｐｅｒａｔｕｒｅ ｆａｂｒｉｃａｔｉｏｎ ｏｆ ｔｒａｎｓｐａｒｅｎｔ ｆｌｅｘｉｂｌｅ ｔｈｉｎ−ｆｉｌｍ ｔｒａｎｓｉｓｔｏｒｓ ｕｓｉｎｇ ａｍｏｒｐｈｏｕｓ ｏｘｉｄｅ ｓｅｍｉｃｏｎｄｕｃｔｏｒｓ」、ＮＡＴＵＲＥ、２００４、Ｖｏｌ．４３２ ｐ．４８８−４９２
【発明の概要】
【発明が解決しようとする課題】
【０００９】
安定した電気特性を有する薄膜トランジスタを有する、信頼性のよい半導体装置を作製し
、提供することを課題の一とする。
【課題を解決するための手段】
【００１０】
チャネル形成領域を含む半導体層を酸化物半導体膜とする薄膜トランジスタを有する半導
体装置の作製方法において、酸化物半導体膜の純度を高め、不純物である水分などを低減
する加熱処理（脱水化または脱水素化のための加熱処理）を行う。また、酸化物半導体膜
中だけでなく、ゲート絶縁層内に存在する水分などの不純物を低減し、上下に接して設け
られる膜と酸化物半導体膜の界面に存在する水分などの不純物を低減する。
【００１１】
水分などの不純物を低減するため、酸化物半導体膜を形成後、酸化物半導体膜が露出した
状態で窒素、または希ガス（アルゴン、ヘリウムなど）の不活性気体雰囲気下、或いは減
圧下での２００℃以上、好ましくは４００℃以上６００℃以下の加熱処理を行い、酸化物
半導体膜の含有水分を低減する。加熱後は不活性気体雰囲気下で室温以上１００℃未満の
範囲まで徐冷する。
【００１２】
窒素、またはアルゴンなどの不活性気体雰囲気下、或いは減圧下での加熱処理によって膜
中の含有水分を低減させた酸化物半導体膜を用いて、薄膜トランジスタの電気特性を向上
させるとともに、量産性と高性能の両方を備えた薄膜トランジスタを実現する。
【００１３】
加熱温度の条件を振り、窒素雰囲気下で加熱処理を行った複数の試料を昇温脱離分析ＴＤ
Ｓ（Ｔｈｅｒｍａｌ Ｄｅｓｏｒｐｔｉｏｎ Ｓｐｅｃｔｒｏｓｃｏｐｙ）測定で測定し
た結果を図２、図３、及び図４に示す。
【００１４】
昇温脱離分析装置は、試料を高真空中で加熱・昇温中に試料から脱離、発生するガス成分
を四重極質 量分析計で検出、同定する装置であり、試料表面、内部から脱離するガス及
び分子が観察できる。電子科学株式会社製の昇温脱離分析装置（製品名：ＥＭＤ−ＷＡ１
０００Ｓ）を用い、測定条件は、昇温約１０℃／分とし、測定中は約１×１０^−７（Ｐａ
）の真空度である。また、ＳＥＭ電圧は１５００Ｖとし、Ｄｗｅｌｌ Ｔｉｍｅは、０．
２［ｓｅｃ］とし、使用チャネル数は２３個とする。なお、Ｈ_２Ｏのイオン化係数を１．
０、Ｈ_２Ｏのフラグメンテーション係数を０．８０５、Ｈ_２Ｏのスルーパス係数を１．５
６、Ｈ_２Ｏのポンピングレートを１．０とする。
【００１５】
図２は、ガラス基板のみの試料（比較試料）と、ガラス基板上に設定膜厚５０ｎｍ（実際
にはエッチング後の膜厚約３０ｎｍ）のＩｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜を成膜した試
料（サンプル１）とを比較したＴＤＳの結果を示すグラフである。図２はＨ_２Ｏについて
測定した結果を示し、３００℃付近にピークが見られることからＩｎ−Ｇａ−Ｚｎ−Ｏ系
非単結晶膜から水分（Ｈ_２Ｏ）などの不純物が脱離されていることが確認できる。
【００１６】
また、図３は、ガラス基板上に設定膜厚５０ｎｍのＩｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜を
成膜した試料（サンプル１）と、ガラス基板上に設定膜厚５０ｎｍのＩｎ−Ｇａ−Ｚｎ−
Ｏ系非単結晶膜を成膜した後、大気雰囲気下で加熱温度３５０℃とし１時間の加熱処理を
行った試料（サンプル２）と、窒素雰囲気で加熱温度３５０℃とし１時間の加熱処理を行
った試料（サンプル３）とを比較したものであり、Ｈ_２ＯについてのＴＤＳ測定結果を示
すグラフである。図３の結果から、サンプル３において、３００℃付近のピークがサンプ
ル２よりも低減されていることから窒素雰囲気での加熱処理により水分（Ｈ_２Ｏ）などの
不純物が脱離されていることが確認できる。従って、大気雰囲気よりも窒素雰囲気での加
熱のほうが膜中の水分（Ｈ_２Ｏ）などの不純物が低減されていることがわかる。
【００１７】
また、図４は、ガラス基板上に設定膜厚５０ｎｍのＩｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜を
成膜した試料（サンプル１）と、窒素雰囲気下での加熱温度を２５０℃とし１時間の加熱
処理を行った試料（サンプル４）と、窒素雰囲気下での加熱温度を３５０℃とし１時間の
加熱処理を行った試料（サンプル３）と、窒素雰囲気下での加熱温度を４５０℃とし１時
間の加熱処理を行った試料（サンプル５）と、窒素雰囲気下での加熱温度を３５０℃とし
１０時間の加熱処理を行った試料（サンプル６）を比較したものであり、Ｈ_２Ｏについて
のＴＤＳ測定結果を示すグラフである。図４の結果から、窒素雰囲気での加熱温度が高け
れば高いほど、Ｉｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜中から脱離する水分（Ｈ_２Ｏ）などの
不純物が低減されていることがわかる。
【００１８】
また、図３及び図４のグラフから、２００℃〜２５０℃付近で確認できる水分（Ｈ_２Ｏ）
などの不純物が脱離したことを示す第１のピークと、３００℃以上で水分（Ｈ_２Ｏ）など
の不純物が脱離したことを示す第２のピークとが確認できる。
【００１９】
なお、窒素雰囲気中で４５０℃の加熱処理を行った試料は、その後、室温で大気中に１週
間程度放置しても２００℃以上で脱離する水分は観測されず、加熱処理によって、Ｉｎ−
Ｇａ−Ｚｎ−Ｏ系非単結晶膜が安定化することが判明している。
【００２０】
また、窒素雰囲気下での加熱温度条件を１５０℃、１７５℃、２００℃、２２５℃、２５
０℃、２７５℃、３００℃、３２５℃、３５０℃、３７５℃、４００℃、４２５℃、４５
０℃と振り、それぞれキャリア濃度を測定した結果を図１に示す。
【００２１】
図５（Ａ）に酸化物半導体膜（Ｉｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜）の物性（キャリア濃
度とＨａｌｌ移動度）を評価するための物性評価用試料５１０の立体視図を示す。物性評
価用試料５１０を作製して室温にてＨａｌｌ効果測定を行い、酸化物半導体膜のキャリア
濃度とＨａｌｌ移動度（ホール移動度）を評価した。物性評価用試料５１０は、基板５０
０上に酸窒化珪素からなる絶縁膜５０１を形成し、その上に評価対象となる１０ｍｍ×１
０ｍｍの酸化物半導体膜５０２を形成し、その上にそれぞれ直径１ｍｍの電極５０３乃至
５０６を形成して作製した。Ｈａｌｌ効果測定から求めた酸化物半導体膜のキャリア濃度
は図１に示し、Ｈａｌｌ移動度は図５（Ｂ）に示し、導電率を図５（Ｃ）に示す。
【００２２】
図１、図２、図３、図４の結果から、ＴＤＳ測定の２５０℃以上において、Ｉｎ−Ｇａ−
Ｚｎ−Ｏ系非単結晶膜中から水分（Ｈ_２Ｏ）などの不純物が脱離することと、キャリア濃
度の変動との間に関係があることがわかる。Ｉｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜中から水
分（Ｈ_２Ｏ）などの不純物が脱離することによってキャリア濃度が増加する。
【００２３】
また、ＴＤＳ測定により、Ｈ_２Ｏの他にＨ、Ｏ、ＯＨ、Ｈ_２、Ｏ_２、Ｎ、Ｎ_２、及びＡｒ
のそれぞれについて測定を行ったところ、Ｈ_２Ｏ、Ｈ、Ｏ、及びＯＨは、はっきりとピー
クが観測できたが、Ｈ_２、Ｏ_２、Ｎ、Ｎ_２、及びＡｒはピークが観測できなかった。試料
は、ガラス基板に設定膜厚５０ｎｍのＩｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜を成膜したもの
を用いており、加熱条件は、窒素雰囲気下２５０℃１時間、窒素雰囲気下３５０℃１時間
、窒素雰囲気下３５０℃１０時間、４５０℃１時間とし、比較例として加熱処理なしのＩ
ｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜と、ガラス基板のみとをそれぞれ測定した。図３７にＨ
のＴＤＳ結果を示し、図３８はＯのＴＤＳ結果を示し、図３９はＯＨのＴＤＳ結果を示し
、図４０はＨ_２のＴＤＳ結果を示す。なお、上記加熱条件での窒素雰囲気の酸素濃度は、
２０ｐｐｍ以下である。
【００２４】
以上の結果より、Ｉｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜の加熱処理を行うことにより、主と
して水分（Ｈ_２Ｏ）が放出されることがわかる。すなわち、加熱処理によりＩｎ−Ｇａ−
Ｚｎ−Ｏ系非単結晶膜から水分（Ｈ_２Ｏ）の脱離が主として起こり、図３７で示すＨ、図
３８で示すＯ及び図３９で示すＯＨのＴＤＳの測定値は、水分子が分解して生成されたも
のが影響している。なお、Ｉｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜には水素、ＯＨも含まれる
と考えられることから、これらも熱処理により付随して放出されている。
【００２５】
本明細書では、窒素、または希ガス（アルゴン、ヘリウムなど）の不活性気体雰囲気下、
或いは減圧下での加熱処理を脱水化または脱水素化のための加熱処理と呼ぶ。本明細書で
は、この加熱処理によってＨ_２として脱離させていることのみを脱水素化と呼んでいるわ
けではなく、Ｈ、ＯＨなどを脱離することを含めて脱水化または脱水素化と便宜上呼ぶこ
ととする。
【００２６】
不活性気体下で加熱処理を行うことによって酸化物半導体層に含まれる不純物（Ｈ_２Ｏ）
を低減してキャリア濃度を増加させた後、徐冷を行う。徐冷させた後、酸化物半導体層に
接して酸化物絶縁膜の形成などを行って酸化物半導体層のキャリア濃度を低減することが
、信頼性の向上に繋がる。
【００２７】
酸化物半導体層は窒素雰囲気下における加熱処理によって、低抵抗化（キャリア濃度が高
まる、好ましくは１×１０^１８／ｃｍ^３以上）し、低抵抗化した酸化物半導体層とするこ
とができる。その後、低抵抗化した酸化物半導体層に接して酸化物絶縁膜を形成すると、
低抵抗化した酸化物半導体層において少なくとも酸化物絶縁膜と接する領域を高抵抗化（
キャリア濃度が低まる、好ましくは１×１０^１８／ｃｍ^３未満、さらに好ましくは１×１
０^１４／ｃｍ^３以下）し、高抵抗化酸化物半導体領域とすることができる。半導体装置の
プロセス中、不活性気体雰囲気下（或いは減圧下）での加熱、徐冷及び酸化物絶縁膜の形
成などによって酸化物半導体層のキャリア濃度を増減させることが重要である。また、酸
化物半導体層に脱水化または脱水素化の加熱処理を行うことにより酸化物半導体層は酸素
欠乏型となってＮ型化（Ｎ⁻、Ｎ^＋など）させ、その後、酸化物絶縁膜の形成を行うこと
により酸化物半導体層を酸素過剰な状態とすることでＩ型化させているとも言える。また
、Ｉｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜上に酸化物絶縁膜を形成すると、図１中点線１０に
示すキャリア濃度（１×１０^１４／ｃｍ^３以下）以下となる。これにより、電気特性が良
好で信頼性のよい薄膜トランジスタを有する半導体装置を作製し、提供することが可能と
なる。
【００２８】
なお、低抵抗化した酸化物半導体層に接して形成する酸化物絶縁膜は、水分や、水素イオ
ンや、ＯＨ⁻などの不純物をブロックする無機絶縁膜を用い、具体的には酸化珪素膜、ま
たは窒化酸化珪素膜を用いる。
【００２９】
さらに、低抵抗化した酸化物半導体層上に接して保護膜となる酸化物絶縁膜を形成した後
に、２回目の加熱を行ってもよい。酸化物半導体層上に接して保護膜となる酸化物絶縁膜
を形成した後、２回目の加熱を行うと、薄膜トランジスタの電気的特性のばらつきを軽減
することができる。
【００３０】
本明細書で開示する本発明の一態様は、ゲート電極層と、該ゲート電極層上にゲート絶縁
層と、該ゲート絶縁層上に酸化物半導体層と、酸化物半導体層上に絶縁層とを有し、前記
ゲート絶縁層、前記酸化物半導体層、及び前記絶縁層の層内、前記ゲート絶縁層と前記酸
化物半導体層の界面、及び前記酸化物半導体層と前記絶縁層の界面における水素濃度は、
３×１０^２０ｃｍ^−３以下である半導体装置である。
【００３１】
酸化物半導体層は、層内に含まれる水素だけでなく、水（Ｈ_２Ｏ）、Ｍ−ＯＨ、Ｍ−Ｈな
ど色々な形態を含み得るが、絶対量である水素濃度の平均値またはピーク値は、３×１０
^２０ｃｍ^−３以下、好ましくは、１×１０^２０ｃｍ^−３以下である。
【００３２】
これらの濃度範囲は、２次イオン質量分析法（ＳＩＭＳ）で得られたもの、またはそのデ
ータに基づいて得られる。
【００３３】
上記構成は、上記課題の少なくとも一つを解決する。
【００３４】
また、上記構造を実現するための本発明の一態様は、ゲート電極層を形成し、ゲート電
極層上にゲート絶縁層を形成し、ゲート絶縁層上に酸化物半導体層を形成し、酸化物半導
体層を脱水化または脱水素化し、脱水化または脱水素化させた酸化物半導体層上にソース
電極層及びドレイン電極層を形成し、ゲート絶縁層、酸化物半導体層、ソース電極層、及
びドレイン電極層上に酸化物半導体層の一部と接する酸化物絶縁膜を形成することを特徴
とする半導体装置の作製方法である。なお、脱水化または脱水素化は窒素雰囲気、または
希ガス雰囲気、或いは減圧下の加熱である。
【００３５】
また、上記構造を実現するための本発明の他の一態様は、ゲート電極層を形成し、ゲート
電極層上にゲート絶縁層を形成し、ゲート絶縁層上に酸化物半導体層を形成し、酸化物半
導体層を不活性雰囲気下で加熱してキャリア濃度を増加させた後、キャリア濃度を増加し
た酸化物半導体層上にソース電極層及びドレイン電極層を形成し、ゲート絶縁層、加熱し
た酸化物半導体層、ソース電極層、及びドレイン電極層上に前記加熱した酸化物半導体層
の一部と接する酸化物絶縁膜を形成してキャリア濃度を低減することを特徴とする半導体
装置の作製方法である。なお、酸化物半導体層を不活性雰囲気下、かつ温度４００℃以上
で加熱した後、室温以上１００℃未満まで徐冷を行うことを特徴とする。
【００３６】
また、上記構造を実現するための本発明の他の一態様は、ゲート電極層を形成し、ゲート
電極層上にゲート絶縁層を形成し、ゲート絶縁層上に酸化物半導体層を形成し、酸化物半
導体層を減圧下で加熱してキャリア濃度を増加させた後、キャリア濃度を増加した酸化物
半導体層上にソース電極層及びドレイン電極層を形成し、ゲート絶縁層、加熱した酸化物
半導体層、ソース電極層、及びドレイン電極層上に加熱した酸化物半導体層の一部と接す
る酸化物絶縁膜を形成してキャリア濃度を低減することを特徴とする半導体装置の作製方
法である。
【００３７】
上記各作製方法の構成において、キャリア濃度を増加した酸化物半導体層のキャリア濃度
は、１×１０^１８／ｃｍ^３以上である。また、酸化物絶縁膜を形成してキャリア濃度を低
減した酸化物半導体層のキャリア濃度は、１×１０^１８／ｃｍ^３未満、好ましくは１×１
０^１４／ｃｍ^３以下である。
【００３８】
本明細書中で用いる酸化物半導体は、例えば、ＩｎＭＯ_３（ＺｎＯ）_ｍ（ｍ＞０）で表記
される薄膜を形成し、その薄膜を半導体層として用いた薄膜トランジスタを作製する。な
お、Ｍは、Ｇａ、Ｆｅ、Ｎｉ、Ｍｎ及びＣｏから選ばれた一の金属元素又は複数の金属元
素を示す。例えばＭとして、Ｇａの場合があることの他、ＧａとＮｉ又はＧａとＦｅなど
、Ｇａ以外の上記金属元素が含まれる場合がある。また、上記酸化物半導体において、Ｍ
として含まれる金属元素の他に、不純物元素としてＦｅ、Ｎｉその他の遷移金属元素、又
は該遷移金属の酸化物が含まれているものがある。本明細書においては、ＩｎＭＯ_３（Ｚ
ｎＯ）_ｍ（ｍ＞０）で表記される構造の酸化物半導体層のうち、ＭとしてＧａを含む構造
の酸化物半導体をＩｎ−Ｇａ−Ｚｎ−Ｏ系酸化物半導体とよび、その薄膜をＩｎ−Ｇａ−
Ｚｎ−Ｏ系非単結晶膜とも呼ぶ。
【００３９】
また、酸化物半導体層に適用する酸化物半導体として上記の他にも、Ｉｎ−Ｓｎ−Ｚｎ−
Ｏ系、Ｉｎ−Ａｌ−Ｚｎ−Ｏ系、Ｓｎ−Ｇａ−Ｚｎ−Ｏ系、Ａｌ−Ｇａ−Ｚｎ−Ｏ系、Ｓ
ｎ−Ａｌ−Ｚｎ−Ｏ系、Ｉｎ−Ｚｎ−Ｏ系、Ｉｎ−Ｇａ−Ｏ系、Ｓｎ−Ｚｎ−Ｏ系、Ａｌ
−Ｚｎ−Ｏ系、Ｉｎ−Ｏ系、Ｓｎ−Ｏ系、Ｚｎ−Ｏ系の酸化物半導体を適用することがで
きる。また上記酸化物半導体層に酸化珪素を含ませてもよい。酸化物半導体層に結晶化を
阻害する酸化珪素（ＳｉＯｘ（Ｘ＞０））を含ませることで、製造プロセス中において酸
化物半導体層の形成後に加熱処理した場合に、結晶化してしまうのを抑制することができ
る。なお、酸化物半導体層は非晶質な状態であることが好ましく、一部結晶化していても
よい。
【００４０】
酸化物半導体は、好ましくはＩｎを含有する酸化物半導体、さらに好ましくは、Ｉｎ，及
びＧａを含有する酸化物半導体である。酸化物半導体層をＩ型（真性）とするため、脱水
化または脱水素化の工程を経ることは有効である。
【００４１】
また、薄膜トランジスタは静電気などにより破壊されやすいため、ゲート線またはソース
線に対して、駆動回路保護用の保護回路を同一基板上に設けることが好ましい。保護回路
は、酸化物半導体を用いた非線形素子を用いて構成することが好ましい。
【００４２】
また、ゲート絶縁層、及び酸化物半導体膜を大気に触れさせることなく連続的に処理（連
続処理、インサイチュ（ｉｎｓｉｔｕ）工程、連続成膜とも呼ぶ）してもよい。大気に触
れさせることなく連続処理することで、ゲート絶縁層と酸化物半導体膜の界面が、水やハ
イドロカーボンなどの、大気成分や大気中に浮遊する不純物元素に汚染されることなく各
積層界面を形成することができるので、薄膜トランジスタ特性のばらつきを低減すること
ができる。
【００４３】
本明細書中で連続処理とは、ＰＣＶＤ法またはスパッタ法で行う第１の処理工程からＰＣ
ＶＤ法またはスパッタ法で行う第２の処理工程までの一連のプロセス中、被処理基板の置
かれている雰囲気が大気等の汚染雰囲気に触れることなく、常に真空中または不活性ガス
雰囲気（窒素雰囲気または希ガス雰囲気）で制御されていることを言う。連続処理を行う
ことにより、清浄化された被処理基板の水分等の再付着を回避して成膜などの処理を行う
ことができる。
【００４４】
同一チャンバー内で第１の処理工程から第２の処理工程までの一連のプロセスを行うこと
は本明細書における連続処理の範囲にあるとする。また、異なるチャンバーで第１の処理
工程から第２の処理工程までの一連のプロセスを行う場合、第１の処理工程を終えた後、
大気にふれることなくチャンバー間を基板搬送して第２の処理を施すことも本明細書にお
ける連続処理の範囲にあるとする。
【００４５】
なお、第１の処理工程と第２の処理工程の間に、基板搬送工程、アライメント工程、徐冷
工程、または第２の工程に必要な温度とするため基板を加熱または冷却する工程等を有し
ても、本明細書における連続処理の範囲にあるとする。
【００４６】
ただし、洗浄工程、ウエットエッチング、レジスト形成といった液体を用いる工程が第１
の処理工程と第２の処理工程の間にある場合、本明細書でいう連続処理の範囲には当ては
まらないとする。
【発明の効果】
【００４７】
安定した電気特性を有する薄膜トランジスタを作製し、提供することができる。また、電
気特性が良好で信頼性のよい薄膜トランジスタを有する半導体装置を提供することができ
る。
【図面の簡単な説明】
【００４８】
【図１】加熱温度に対する酸化物半導体層のキャリア濃度を示すグラフである。
【図２】ＴＤＳ測定結果を示すグラフである。
【図３】ＴＤＳ測定結果を示すグラフである。
【図４】ＴＤＳ測定結果を示すグラフである。
【図５】（Ａ）は物性評価用試料の立体視図であり、（Ｂ）は酸化物半導体層のＨａｌｌ効果測定結果を示し、（Ｃ）は導電率を示すグラフである。
【図６】本発明の一態様を示す作製工程の断面図である。
【図７】本発明の一態様を示す半導体装置を説明する図である。
【図８】本発明の一態様を示す作製工程の断面図である。
【図９】本発明の一態様を示す半導体装置を説明する図である。
【図１０】本発明の一態様を示す作製工程の断面図である。
【図１１】本発明の一態様を示す作製工程の断面図である。
【図１２】本発明の一態様を示す半導体装置を説明する図である。
【図１３】本発明の一態様を示す半導体装置を説明する図である。
【図１４】電気炉の断面図
【図１５】半導体装置を説明する図。
【図１６】半導体装置を説明する図。
【図１７】半導体装置を説明する図。
【図１８】半導体装置の画素等価回路を説明する図。
【図１９】半導体装置を説明する図。
【図２０】半導体装置のブロック図を説明する図。
【図２１】信号線駆動回路の構成を説明する図。
【図２２】信号線駆動回路の動作を説明するタイミングチャート。
【図２３】信号線駆動回路の動作を説明するタイミングチャート。
【図２４】シフトレジスタの構成を説明する図。
【図２５】図２４に示すフリップフロップの接続構成を説明する図。
【図２６】半導体装置を説明する図。
【図２７】電子書籍の一例を示す外観図。
【図２８】テレビジョン装置およびデジタルフォトフレームの例を示す外観図。
【図２９】遊技機の例を示す外観図。
【図３０】携帯型のコンピュータおよび携帯電話機の一例を示す外観図。
【図３１】半導体装置の作製方法を説明する図。
【図３２】本発明の一態様を示す半導体装置を説明する図。
【図３３】本発明の一態様を示す半導体装置を説明する図。
【図３４】本発明の一態様を示す半導体装置を説明する図。
【図３５】本発明の一態様を示す半導体装置を説明する図。
【図３６】本発明の一態様を示す半導体装置を説明する図。
【図３７】ＨのＴＤＳ結果を示すグラフである。
【図３８】ＯのＴＤＳ結果を示すグラフである。
【図３９】ＯＨのＴＤＳ結果を示すグラフである。
【図４０】Ｈ_２のＴＤＳ結果を示すグラフである。
【図４１】ＢＴ試験前後における薄膜トランジスタのＶｇ−Ｉｄ特性を示すグラフである。
【図４２】計算で用いた酸化物半導体層の構造を説明する図である。
【図４３】酸化物半導体層の酸素密度の計算結果を説明する図である。
【発明を実施するための形態】
【００４９】
以下では、本発明の実施の形態について図面を用いて詳細に説明する。ただし、本発明は
以下の説明に限定されず、その形態および詳細を様々に変更し得ることは、当業者であれ
ば容易に理解される。また、本発明は以下に示す実施の形態の記載内容に限定して解釈さ
れるものではない。
【００５０】
（実施の形態１）
半導体装置及び半導体装置の作製方法を図６及び図７を用いて説明する。
【００５１】
図７（Ａ）は半導体装置の有する薄膜トランジスタ４７０の平面図であり、図７（Ｂ）は
図７（Ａ）の線Ｃ１−Ｃ２における断面図である。薄膜トランジスタ４７０はボトムゲー
ト型の薄膜トランジスタであり、絶縁表面を有する基板である基板４００上に、ゲート電
極層４０１、ゲート絶縁層４０２、半導体層４０３、ソース電極層又はドレイン電極層４
０５ａ、４０５ｂを含む。また、薄膜トランジスタ４７０を覆い、半導体層４０３に接す
る酸化物絶縁膜４０７が設けられている。
【００５２】
酸化物半導体からなる半導体層４０３は、少なくとも酸化物半導体膜の成膜後に不純物で
ある水分などを低減する加熱処理（脱水化または脱水素化のための加熱処理）が行われ、
低抵抗化（キャリア濃度が高まる、好ましくは１×１０^１８／ｃｍ^３以上）させた後、酸
化物絶縁膜４０７を接して形成することにより、高抵抗化（キャリア濃度が低まる、好ま
しくは１×１０^１８／ｃｍ^３未満、さらに好ましくは１×１０^１４／ｃｍ^３以下）させて
酸化物半導体膜をチャネル形成領域として用いることができる。
【００５３】
さらに、脱水化または脱水素化のための加熱処理によって水分（Ｈ_２Ｏ）などの不純物を
脱離させる過程を経た後、不活性雰囲気下で徐冷を行うことが好ましい。脱水化または脱
水素化のための加熱処理及び徐冷させた後、酸化物半導体層に接して酸化物絶縁膜の形成
などを行って酸化物半導体層のキャリア濃度を低減することが、薄膜トランジスタ４７０
の信頼性の向上に繋がる。
【００５４】
また、半導体層４０３内だけでなく、ゲート絶縁層４０２内、及び上下に接して設けられ
る膜と酸化物半導体である半導体層４０３の界面、具体的にはゲート絶縁層４０２と半導
体層４０３の界面、及び酸化物絶縁膜４０７と半導体層４０３の界面に存在する水分など
の不純物を低減する。
【００５５】
ここで薄膜トランジスタ４７０の信頼性試験の結果を示す一例を図４１を用いて説明する
。
【００５６】
薄膜トランジスタの信頼性を調べるための手法の一つに、バイアス−熱ストレス試験（以
下、ＢＴ試験という）がある。ＢＴ試験は加速試験の一種であり、長期間の使用によって
起こる薄膜トランジスタの特性変化を、短時間で評価することができる。特に、ＢＴ試験
前後における薄膜トランジスタのしきい値電圧の変化量は、信頼性を調べるための重要な
指標となる。ＢＴ試験前後において、しきい値電圧の変化量が少ないほど信頼性が高い。
【００５７】
具体的には、薄膜トランジスタが形成されている基板の温度（基板温度）を一定に維持し
、薄膜トランジスタのソースおよびドレインを同電位とし、ゲートにソースおよびドレイ
ンとは異なる電位を一定時間印加する。基板温度は、試験目的に応じて適宜設定すればよ
い。また、ゲートに印加する電位がソースおよびドレインの同電位よりも高い場合を＋Ｂ
Ｔ試験といい、ゲートに印加する電位がソースおよびドレインの同電位よりも低い場合を
−ＢＴ試験という。
【００５８】
ＢＴ試験の試験強度は、基板温度、ゲート絶縁膜に加えられる電界強度、電界印加時間に
より決定することができる。ゲート絶縁膜に加えられる電界強度は、ゲート、ソースおよ
びドレイン間の電位差をゲート絶縁膜の膜厚で除して決定される。例えば、膜厚が１００
ｎｍのゲート絶縁膜に印加する電界強度を２ＭＶ／ｃｍとしたい場合は、電位差を２０Ｖ
とすればよい。
【００５９】
本実施の形態では、薄膜トランジスタ作製時におけるソースおよびドレイン形成前に行う
熱処理を、窒素雰囲気中で２５０℃、３５０℃、４５０℃とした３種類の試料それぞれに
ついてＢＴ試験を行った結果を説明する。
【００６０】
なお、一般的に電圧とは、２点間における電位差のことをいい、電位とは、ある一点に
おける静電場の中にある単位電荷が持つ静電エネルギー（電気的な位置エネルギー）のこ
とをいうが、電子回路において、ある一点における電位と基準となる電位（例えば接地電
位）との電位差のことを該ある一点における電位として示すことが多いため、本明細書で
は、ある一点における電位と基準となる電位（例えば接地電位）との差を該ある一点にお
ける電位として示した場合において、特に指定する場合を除き、該ある一点における電位
を電圧ともいう。
【００６１】
ＢＴ試験は、基板温度を１５０℃、ゲート絶縁膜に印加する電界強度を２ＭＶ／ｃｍ、印
加時間を１時間とし、＋ＢＴ試験および−ＢＴ試験それぞれについて行った。
【００６２】
まず、＋ＢＴ試験について説明する。ＢＴ試験対象となる薄膜トランジスタの初期特性を
測定するため、基板温度を４０℃とし、ソース−ドレイン間電圧（以下、ドレイン電圧と
いう）を１０Ｖとし、ソース−ゲート間電圧（以下、ゲート電圧という）を−２０Ｖ〜＋
２０Ｖまで変化させたときのソース−ドレイン電流（以下、ドレイン電流という）の変化
特性、すなわちＶｇ−Ｉｄ特性を測定した。ここでは基板温度を試料表面への吸湿対策と
して４０℃としているが、特に問題がなければ、室温（２５℃）下で測定してもかまわな
い。
【００６３】
次に、基板温度を１５０℃まで上昇させた後、薄膜トランジスタのソースおよびドレイン
の電位を０Ｖとした。続いて、ゲート絶縁膜へ印加される電界強度が２ＭＶ／ｃｍとなる
ように、ゲートに電圧を印加した。ここでは、薄膜トランジスタのゲート絶縁膜の厚さが
１００ｎｍであったため、ゲートに＋２０Ｖを印加し、そのまま１時間保持した。ここで
は印加時間を１時間としたが、目的に応じて適宜時間を変更してもよい。
【００６４】
次に、ソース、ドレインおよびゲートへ電圧を印加したまま、基板温度を４０℃まで下げ
た。この時、基板温度が下がりきる前に電圧の印加をやめてしまうと、余熱の影響により
ＢＴ試験で薄膜トランジスタに与えられたダメージが回復されてしまうため、電圧は印加
したままで基板温度を下げる必要がある。基板温度が４０℃になった後、電圧の印加を終
了させた。
【００６５】
次に、初期特性の測定と同じ条件でＶｇ−Ｉｄ特性を測定し、＋ＢＴ試験後のＶｇ−Ｉｄ
特性を得た。
【００６６】
続いて、―ＢＴ試験について説明する。―ＢＴ試験も＋ＢＴ試験と同様の手順で行うが、
基板温度を１５０℃まで上昇させた後にゲートに印加する電圧を−２０Ｖとする点が異な
る。
【００６７】
なお、ＢＴ試験に際しては、まだ一度もＢＴ試験を行っていない薄膜トランジスタを用い
て試験を行うことが重要である。例えば、一度＋ＢＴ試験を行った薄膜トランジスタを用
いて―ＢＴ試験を行うと、先に行った＋ＢＴ試験の影響により、―ＢＴ試験結果を正しく
評価することができない。一度＋ＢＴ試験を行った薄膜トランジスタを用いて、再度＋Ｂ
Ｔ試験を行った場合等も同様である。ただし、これらの影響を踏まえて、あえてＢＴ試験
を繰り返す場合はこの限りではない。
【００６８】
図４１（Ａ）乃至図４１（Ｃ）に、ＢＴ試験前後における薄膜トランジスタのＶｇ−Ｉｄ
特性を示す。図４１（Ａ）は、ソースおよびドレイン形成前に行う熱処理を、窒素雰囲気
中で２５０℃として作製した薄膜トランジスタのＢＴ試験結果である。図４１（Ｂ）はソ
ースおよびドレイン形成前に行う熱処理を、窒素雰囲気中で３５０℃として作製した薄膜
トランジスタのＢＴ試験結果であり、図４１（Ｃ）はソースおよびドレイン形成前に行う
熱処理を、窒素雰囲気中で４５０℃として作製した薄膜トランジスタのＢＴ試験結果であ
る。
【００６９】
各図とも、横軸はゲート電圧（Ｖｇ）で、縦軸はゲート電圧に対するドレイン電流（Ｉｄ
）を対数目盛で示している。また、初期特性７１１、７２１、７３１は＋ＢＴ試験前の薄
膜トランジスタのＶｇ−Ｉｄ特性を、＋ＢＴ７１２、７２２、７３２は＋ＢＴ試験後の薄
膜トランジスタのＶｇ−Ｉｄ特性を、−ＢＴ７１３、７２３、７３３は−ＢＴ試験後の薄
膜トランジスタのＶｇ−Ｉｄ特性を示している。なお、−ＢＴ試験前の薄膜トランジスタ
のＶｇ−Ｉｄ特性は、＋ＢＴ試験前のＶｇ−Ｉｄ特性とほぼ同じであったため、図中には
記載していない。
【００７０】
図４１（Ａ）乃至図４１（Ｃ）によると、初期特性７１１、７２１、７３１に比べて、＋
ＢＴ７１２、７２２、７３２はしきい値電圧がプラス方向へ、−ＢＴ７１３、７２３、７
３３はしきい値電圧がマイナス方向へ変化していることがわかる。また、図４１（Ａ）よ
り図４１（Ｂ）、図４１（Ｂ）より図４１（Ｃ）という様に、ソースおよびドレイン形成
前に行う熱処理の温度を２５０℃、３５０℃、４５０℃と上昇させるに伴い、＋ＢＴ試験
後のしきい値電圧の変化量が小さくなっていることがわかる。
【００７１】
熱処理の温度を４５０℃以上とすることで、少なくとも＋ＢＴ試験での信頼性を向上させ
ることができる。Ｉｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜中から水分（Ｈ_２Ｏ）などの不純物
が脱離することと、ＢＴストレス試験の結果との間に関係があることがわかる。
【００７２】
また、酸化物半導体層である半導体層４０３と接するソース電極層又はドレイン電極層４
０５ａ、４０５ｂとして、チタン、アルミニウム、マンガン、マグネシウム、ジルコニウ
ム、ベリリウムのいずれか一または複数から選択された材料とする。また、上述した元素
を組み合わせた合金膜などを積層してもよい。
【００７３】
チャネル形成領域を含む半導体層４０３としては、半導体特性を有する酸化物材料を用い
ればよく、代表的には、Ｉｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜を用いる。
【００７４】
図６（Ａ）乃至（Ｄ）に薄膜トランジスタ４７０の作製工程の断面図を示す。
【００７５】
図６（Ａ）において、絶縁表面を有する基板である基板４００上にゲート電極層４０１を
設ける。下地膜となる絶縁膜を基板４００とゲート電極層４０１の間に設けてもよい。下
地膜は、基板４００からの不純物元素の拡散を防止する機能があり、窒化珪素膜、酸化珪
素膜、窒化酸化珪素膜、又は酸化窒化珪素膜から選ばれた一又は複数の膜による積層構造
により形成することができる。ゲート電極層４０１の材料は、モリブデン、チタン、クロ
ム、タンタル、タングステン、アルミニウム、銅、ネオジム、スカンジウム等の金属材料
又はこれらを主成分とする合金材料を用いて、単層で又は積層して形成することができる
。
【００７６】
例えば、ゲート電極層４０１の２層の積層構造としては、アルミニウム層上にモリブデン
層が積層された２層の積層構造、または銅層上にモリブデン層を積層した二層構造、また
は銅層上に窒化チタン層若しくは窒化タンタルを積層した二層構造、窒化チタン層とモリ
ブデン層とを積層した二層構造とすることが好ましい。３層の積層構造としては、タング
ステン層または窒化タングステンと、アルミニウムと珪素の合金またはアルミニウムとチ
タンの合金と、窒化チタンまたはチタン層とを積層した積層とすることが好ましい。
【００７７】
次いで、ゲート電極層４０１上にゲート絶縁層４０２を形成する。
【００７８】
ゲート絶縁層４０２は、プラズマＣＶＤ法又はスパッタリング法等を用いて、酸化珪素層
、窒化珪素層、酸化窒化珪素層又は窒化酸化珪素層を単層で又は積層して形成することが
できる。例えば、成膜ガスとして、ＳｉＨ_４、酸素及び窒素を用いてプラズマＣＶＤ法に
より酸化窒化珪素層を形成すればよい。
【００７９】
次いで、ゲート絶縁層４０２上に、酸化物半導体膜を形成する。
【００８０】
なお、酸化物半導体膜をスパッタ法により成膜する前に、アルゴンガスを導入してプラズ
マを発生させる逆スパッタを行い、ゲート絶縁層４０２の表面に付着しているゴミを除去
することが好ましい。逆スパッタとは、ターゲット側に電圧を印加せずに、アルゴン雰囲
気下で基板側にＲＦ電源を用いて電圧を印加して基板近傍にプラズマを形成して表面を改
質する方法である。なお、アルゴン雰囲気に代えて窒素、ヘリウムなどを用いてもよい。
また、アルゴン雰囲気に酸素、Ｎ_２Ｏなどを加えた雰囲気で行ってもよい。また、アルゴ
ン雰囲気にＣｌ_２、ＣＦ_４などを加えた雰囲気で行ってもよい。
【００８１】
酸化物半導体膜は、Ｉｎ−Ｇａ−Ｚｎ−Ｏ系酸化物半導体ターゲットを用いてスパッタ法
により成膜する。また、酸化物半導体膜は、希ガス（代表的にはアルゴン）雰囲気下、酸
素雰囲気下、又は希ガス（代表的にはアルゴン）及び酸素の混合雰囲気下においてスパッ
タ法により形成することができる。
【００８２】
ゲート絶縁層４０２、及び酸化物半導体膜を大気に触れさせることなく連続的に形成して
もよい。大気に触れさせることなく連続成膜することで、界面が、水やハイドロカーボン
などの、大気成分や大気中に浮遊する不純物元素に汚染されることなく各積層界面を形成
することができるので、薄膜トランジスタ特性のばらつきを低減することができる。
【００８３】
酸化物半導体膜をフォトリソグラフィ工程により島状の酸化物半導体層である酸化物半導
体層４３０（第１の酸化物半導体層）に加工する（図６（Ａ）参照。）。
【００８４】
酸化物半導体層に不活性ガス雰囲気（窒素、またはヘリウム、ネオン、アルゴン等）下或
いは減圧下において加熱処理を行った後、不活性雰囲気下で徐冷を行う（図６（Ｂ）参照
。）。酸化物半導体層４３０を上記雰囲気下で加熱処理することで、酸化物半導体層４３
０に含まれる水素及び水などの不純物を除去することができる。
【００８５】
なお、加熱処理においては、窒素、またはヘリウム、ネオン、アルゴン等の希ガスに、水
、水素などが含まれないことが好ましい。または、加熱処理装置に導入する窒素、または
ヘリウム、ネオン、アルゴン等の希ガスの純度を、６Ｎ（９９．９９９９％）以上、好ま
しくは７Ｎ（９９．９９９９９％）以上、（即ち不純物濃度を１ｐｐｍ以下、好ましくは
０．１ｐｐｍ以下）とすることが好ましい。
【００８６】
また、加熱処理は、電気炉を用いた加熱方法、加熱した気体を用いるＧＲＴＡ（Ｇａｓ
Ｒａｐｉｄ Ｔｈｅｒｍａｌ Ａｎｎｅａｌ）法またはランプ光を用いるＬＲＴＡ（Ｌａ
ｍｐ Ｒａｐｉｄ Ｔｈｅｒｍａｌ Ａｎｎｅａｌ）法などの瞬間加熱方法などを用いる
ことができる。
【００８７】
ここで、酸化物半導体層４３０の加熱処理の一形態として、電気炉６０１を用いた加熱方
法について、図１４を用いて説明する。
【００８８】
図１４は、電気炉６０１の概略図である。チャンバー６０２の外側にはヒーター６０３が
設けられており、チャンバー６０２を加熱する。また、チャンバー６０２内には、基板６
０４を搭載するサセプター６０５が設けられており、チャンバー６０２内に基板６０４を
搬入または搬出する。また、チャンバー６０２にはガス供給手段６０６及び排気手段６０
７が設けられている。ガス供給手段６０６により、チャンバー６０２にガスを導入する。
また、排気手段６０７により、チャンバー６０２内を排気する、またはチャンバー６０２
内を減圧にする。なお、電気炉６０１の昇温特性を０．１℃／ｍｉｎ以上２０℃／ｍｉｎ
以下とすることが好ましい。また、電気炉６０１の降温特性を０．１℃／ｍｉｎ以上１５
℃／ｍｉｎ以下とすることが好ましい。
【００８９】
ガス供給手段６０６は、ガス供給源６１１、圧力調整弁６１２、精製器６１３、マスフロ
ーコントローラ６１４、ストップバルブ６１５を有する。本実施の形態では、ガス供給源
６１１とチャンバー６０２の間に精製器６１３を設けることが好ましい。精製器６１３を
設けることで、ガス供給源６１１からチャンバー６０２内に導入されるガスの、水、水素
などの不純物を、当該精製器６１３によって除去することが可能であり、チャンバー６０
２内への水、水素などの侵入を低減することができる。
【００９０】
本実施の形態では、ガス供給源６１１から、窒素または希ガスをチャンバー６０２に導入
し、チャンバー内を窒素または希ガス雰囲気とし、２００℃以上６００℃以下、好ましく
は４００℃以上４５０℃以下に加熱されたチャンバー６０２において、基板６０４上に形
成された酸化物半導体層４３０を加熱することで、酸化物半導体層４３０の脱水化または
脱水素化を行うことができる。
【００９１】
または、排気手段によって減圧下で、２００℃以上６００℃以下、好ましくは４００℃以
上４５０℃以下に加熱されたチャンバー６０２において、基板６０４上に形成された酸化
物半導体層４３０を加熱することで、酸化物半導体層４３０の脱水化または脱水素化を行
うことができる。
【００９２】
次に、ヒーターをオフ状態にし、加熱装置のチャンバー６０２を徐々に冷却する。酸化物
半導体層は不活性ガス雰囲気下或いは減圧下における加熱処理及び徐冷によって、低抵抗
化（キャリア濃度が高まる、好ましくは１×１０^１８／ｃｍ^３以上）し、低抵抗化した酸
化物半導体層４３１（第２の酸化物半導体層）とすることができる。
【００９３】
この結果、後に形成される薄膜トランジスタの信頼性を高めることができる。
【００９４】
なお、減圧下で加熱処理を行った場合は、加熱後に不活性ガスを流して大気圧に戻して冷
却すればよい。
【００９５】
また、加熱装置のチャンバー６０２内の基板６０４を３００℃まで冷却した後、基板６０
４を室温の雰囲気に移動してもよい。この結果、基板６０４の冷却時間を短縮することが
できる。
【００９６】
また、加熱装置がマルチチャンバーの場合、加熱処理と冷却処理を異なるチャンバーで行
うことができる。代表的には、窒素または希ガスが充填され、且つ２００℃以上６００℃
以下、好ましくは４００℃以上４５０℃以下に加熱された第１のチャンバーにおいて、基
板上の酸化物半導体層を加熱する。次に、窒素または希ガスが導入された搬送室を経て、
窒素または希ガスが充填され、且つ１００℃以下、好ましくは室温である第２のチャンバ
ーに、上記加熱処理された基板を移動し、冷却処理を行う。以上の工程により、スループ
ットを向上させることができる
【００９７】
また、不活性ガス雰囲気下或いは減圧下における酸化物半導体層の加熱処理は、島状の酸
化物半導体層に加工する前の酸化物半導体膜に行うこともできる。その場合には、不活性
ガス雰囲気下或いは減圧下における酸化物半導体膜の加熱処理後に室温以上１００℃未満
まで徐冷を行い、加熱装置から基板を取り出し、フォトリソグラフィ工程を行う。
【００９８】
また、不活性ガス雰囲気下或いは減圧下の加熱処理後の酸化物半導体膜の状態は、非晶質
な状態であることが好ましいが、一部結晶化してもよい。
【００９９】
次いで、ゲート絶縁層４０２、及び酸化物半導体層４３１上に導電膜を形成する。
【０１００】
導電膜の材料としては、Ａｌ、Ｃｒ、Ｔａ、Ｔｉ、Ｍｏ、Ｗから選ばれた元素、または上
述した元素を成分とする合金か、上述した元素を組み合わせた合金膜等が挙げられる。
【０１０１】
また、導電膜の形成後に加熱処理を行う場合には、この加熱処理に耐える耐熱性を導電膜
に持たせることが好ましい。Ａｌ単体では耐熱性が劣り、また腐蝕しやすい等の問題点が
あるので耐熱性導電性材料と組み合わせて形成する。Ａｌと組み合わせる耐熱性導電性材
料としては、チタン（Ｔｉ）、タンタル（Ｔａ）、タングステン（Ｗ）、モリブデン（Ｍ
ｏ）、クロム（Ｃｒ）、Ｎｄ（ネオジム）、Ｓｃ（スカンジウム）から選ばれた元素、ま
たは上述した元素を成分とする合金か、上述した元素を組み合わせた合金膜、または上述
した元素を成分とする窒化物で形成する。
【０１０２】
酸化物半導体層４３１、導電膜をエッチング工程によりエッチングし、酸化物半導体層４
３２、及びソース電極層又はドレイン電極層４０５ａ、４０５ｂを形成する（図６（Ｃ）
参照。）。なお、酸化物半導体層４３２は一部のみがエッチングされ、溝部（凹部）を有
する酸化物半導体層４３２となる。
【０１０３】
酸化物半導体層４３２に接してスパッタ法による酸化物絶縁膜４０７を形成する。低抵抗
化した酸化物半導体層に接して形成する酸化物絶縁膜４０７は、水分や、水素イオンや、
ＯＨ⁻などの不純物を含まず、これらが外部から侵入することをブロックする無機絶縁膜
を用い、具体的には酸化珪素膜、または窒化酸化珪素膜を用いる。
【０１０４】
本実施の形態では、酸化物絶縁膜４０７として膜厚３００ｎｍの酸化珪素膜を成膜する。
成膜時の基板温度は、室温以上３００℃以下とすればよく、本実施の形態では１００℃と
する。酸化珪素膜のスパッタ法による成膜は、希ガス（代表的にはアルゴン）雰囲気下、
酸素雰囲気下、又は希ガス（代表的にはアルゴン）及び酸素雰囲気下において行うことが
できる。また、ターゲットとして酸化珪素ターゲットを用いても珪素ターゲットを用いて
もよい。例えば珪素ターゲットを用いて、酸素、及び窒素雰囲気下でスパッタ法により酸
化珪素を形成することができる。
【０１０５】
低抵抗化した酸化物半導体層４３２に接してスパッタ法またはＰＣＶＤ法などにより酸化
物絶縁膜４０７を形成すると、低抵抗化した酸化物半導体層４３２において少なくとも酸
化物絶縁膜４０７と接する領域を高抵抗化（キャリア濃度が低まる、好ましくは１×１０
^１８／ｃｍ^３未満）し、高抵抗化酸化物半導体領域とすることができる。半導体装置の作
製プロセス中、不活性気体雰囲気下（或いは減圧下）での加熱、徐冷及び酸化物絶縁膜の
形成などによって酸化物半導体層のキャリア濃度を増減させることが重要である。酸化物
半導体層４３２は、高抵抗化酸化物半導体領域を有する半導体層４０３（第３の酸化物半
導体層）となり、薄膜トランジスタ４７０を作製することができる（図６（Ｄ）参照。）
。
【０１０６】
上記脱水処理または脱水素処理のための加熱処理を行うことによって酸化物半導体層に含
まれる不純物（Ｈ_２Ｏ、Ｈ、ＯＨなど）を低減してキャリア濃度を増加させた後、徐冷を
行う。徐冷させた後、酸化物半導体層に接して酸化物絶縁膜の形成などを行って酸化物半
導体層のキャリア濃度を低減し、薄膜トランジスタ４７０の信頼性を向上することができ
る。
【０１０７】
また、酸化物絶縁膜４０７を形成後、窒素雰囲気下、又は大気雰囲気下（大気中）におい
て薄膜トランジスタ４７０に加熱処理（好ましくは１５０℃以上３５０℃未満）を行って
もよい。例えば、窒素雰囲気下で２５０℃、１時間の加熱処理を行う。該加熱処理を行う
と、酸化物半導体層４３２が酸化物絶縁膜４０７と接した状態で加熱されることになり、
薄膜トランジスタ４７０の電気的特性のばらつきを軽減することができる。この加熱処理
（好ましくは１５０℃以上３５０℃未満）は、酸化物絶縁膜４０７の形成後であれば特に
限定されず、他の工程、例えば樹脂膜形成時の加熱処理や、透明導電膜を低抵抗化させる
ための加熱処理と兼ねることで、工程数を増やすことなく行うことができる。
【０１０８】
（実施の形態２）
半導体装置及び半導体装置の作製方法を図８及び図９を用いて説明する。実施の形態１と
同一部分又は同様な機能を有する部分、及び工程は、実施の形態１と同様に行うことがで
き、繰り返しの説明は省略する。
【０１０９】
図９（Ａ）は半導体装置の有する薄膜トランジスタ４６０の平面図であり、図９（Ｂ）は
図９（Ａ）の線Ｄ１−Ｄ２における断面図である。薄膜トランジスタ４６０はボトムゲー
ト型の薄膜トランジスタであり、絶縁表面を有する基板である基板４５０上に、ゲート電
極層４５１、ゲート絶縁層４５２、ソース電極層又はドレイン電極層４５５ａ、４５５ｂ
、及び半導体層４５３を含む。また、薄膜トランジスタ４６０を覆い、半導体層４５３に
接する酸化物絶縁膜４５７が設けられている。半導体層４５３は、Ｉｎ−Ｇａ−Ｚｎ−Ｏ
系非単結晶膜を用いる。
【０１１０】
薄膜トランジスタ４６０は、薄膜トランジスタ４６０を含む領域全てにおいてゲート絶縁
層４５２が存在し、ゲート絶縁層４５２と絶縁表面を有する基板である基板４５０の間に
ゲート電極層４５１が設けられている。ゲート絶縁層４５２上にはソース電極層又はドレ
イン電極層４５５ａ、４５５ｂが設けられている。そして、ゲート絶縁層４５２、及びソ
ース電極層又はドレイン電極層４５５ａ、４５５ｂ上に半導体層４５３が設けられている
。また、図示しないが、ゲート絶縁層４５２上にはソース電極層又はドレイン電極層４５
５ａ、４５５ｂに加えて配線層を有し、該配線層は半導体層４５３の外周部より外側に延
在している。
【０１１１】
酸化物半導体からなる半導体層４５３は、少なくとも酸化物半導体膜の成膜後に不純物で
ある水分などを低減する加熱処理（脱水化または脱水素化のための加熱処理）が行われ、
低抵抗化（キャリア濃度が高まる、好ましくは１×１０^１８／ｃｍ^３以上）させた後、酸
化物絶縁膜４５７を接して形成することにより、高抵抗化（キャリア濃度が低まる、好ま
しくは１×１０^１８／ｃｍ^３未満）させて酸化物半導体膜をチャネル形成領域として用い
ることができる。
【０１１２】
さらに、脱水化または脱水素化のための加熱処理によって水分（Ｈ_２Ｏ）などの不純物を
脱離させる過程を経た後、不活性雰囲気下で徐冷を行うことが好ましい。脱水化または脱
水素化のための加熱処理及び徐冷させた後、酸化物半導体層に接して酸化物絶縁膜の形成
などを行って酸化物半導体層のキャリア濃度を低減することが、薄膜トランジスタ４６０
の信頼性の向上に繋がる。
【０１１３】
また、酸化物半導体層である半導体層４５３と接するソース電極層又はドレイン電極層４
５５ａ、４５５ｂとして、チタン、アルミニウム、マンガン、マグネシウム、ジルコニウ
ム、ベリリウムのいずれか一または複数から選択された材料とする。
【０１１４】
図８（Ａ）乃至（Ｄ）に薄膜トランジスタ４６０の作製工程の断面図を示す。
【０１１５】
絶縁表面を有する基板である基板４５０上にゲート電極層４５１を設ける。下地膜となる
絶縁膜を基板４５０とゲート電極層４５１の間に設けてもよい。下地膜は、基板４５０か
らの不純物元素の拡散を防止する機能があり、窒化珪素膜、酸化珪素膜、窒化酸化珪素膜
、又は酸化窒化珪素膜から選ばれた一又は複数の膜による積層構造により形成することが
できる。ゲート電極層４５１の材料は、モリブデン、チタン、クロム、タンタル、タング
ステン、アルミニウム、銅、ネオジム、スカンジウム等の金属材料又はこれらを主成分と
する合金材料を用いて、単層で又は積層して形成することができる。
【０１１６】
ゲート電極層４５１上にゲート絶縁層４５２を形成する。
【０１１７】
ゲート絶縁層４５２は、プラズマＣＶＤ法又はスパッタリング法等を用いて、酸化珪素層
、窒化珪素層、酸化窒化珪素層又は窒化酸化珪素層を単層で又は積層して形成することが
できる。
【０１１８】
ゲート絶縁層４５２上に、導電膜を形成し、フォトリソグラフィ工程により島状のソース
電極層又はドレイン電極層４５５ａ、４５５ｂに加工する（図８（Ａ）参照。）。
【０１１９】
ソース電極層又はドレイン電極層４５５ａ、４５５ｂの材料としては、Ａｌ、Ｃｒ、Ｔａ
、Ｔｉ、Ｍｏ、Ｗから選ばれた元素、または上述した元素を成分とする合金か、上述した
元素を組み合わせた合金膜等が挙げられる。また、上述した元素を組み合わせた合金膜な
どを積層してもよい。
【０１２０】
また、ソース電極層又はドレイン電極層４５５ａ、４５５ｂの材料としては、後に行われ
る脱水化または脱水素化のための加熱処理に耐えることのできる耐熱性の高いモリブデン
膜を用いると好ましい。また、モリブデン膜上に上記Ａｌ、Ｃｒ、Ｔａ、Ｔｉ、Ｗから選
ばれた元素、または上述した元素を成分とする合金か、上述した元素を組み合わせた合金
膜などを積層してもよい。
【０１２１】
次に、ゲート絶縁層４５２、及びソース電極層又はドレイン電極層４５５ａ、４５５ｂ上
に酸化物半導体膜を形成し、フォトリソグラフィ工程により島状の酸化物半導体層４８３
（第１の酸化物半導体層）に加工する（図８（Ｂ）参照。）。
【０１２２】
酸化物半導体層４８３は、チャネル形成領域となるため、実施の形態１の酸化物半導体膜
と同様に形成する。
【０１２３】
なお、酸化物半導体層４８３をスパッタ法により成膜する前に、アルゴンガスを導入して
プラズマを発生させる逆スパッタを行い、ゲート絶縁層４５２の表面に付着しているゴミ
を除去することが好ましい。
【０１２４】
酸化物半導体層４８３に脱水化または脱水素化のための加熱処理を行った後、不活性雰囲
気下で徐冷を行う。脱水化または脱水素化のための加熱処理としては、不活性ガス雰囲気
（窒素、またはヘリウム、ネオン、アルゴン等）下或いは減圧下において、２００℃以上
６００℃以下、好ましくは４００℃以上４５０℃以下の加熱処理を行う。酸化物半導体層
４８３は上記雰囲気下における加熱処理によって、低抵抗化（キャリア濃度が高まる、好
ましくは１×１０^１８／ｃｍ^３以上）し、低抵抗化した酸化物半導体層４８４（第２の酸
化物半導体層）とすることができる（図８（Ｃ）参照。）。
【０１２５】
脱水化または脱水素化のための加熱処理においては、窒素、またはヘリウム、ネオン、ア
ルゴン等の希ガスに、水、水素などが含まれないことが好ましい。または、加熱処理装置
に導入する窒素、またはヘリウム、ネオン、アルゴン等の希ガスの純度を、６Ｎ（９９．
９９９９％）以上、好ましくは７Ｎ（９９．９９９９９％）以上、（即ち不純物濃度を１
ｐｐｍ以下、好ましくは０．１ｐｐｍ以下）とすることが好ましい。
【０１２６】
また、不活性ガス雰囲気下或いは減圧下における酸化物半導体層の加熱処理は、島状の酸
化物半導体層に加工する前の酸化物半導体膜に行うこともできる。その場合には、不活性
ガス雰囲気下或いは減圧下における酸化物半導体膜の加熱処理後に室温以上１００℃未満
まで徐冷を行い、加熱装置から基板を取り出し、フォトリソグラフィ工程を行う。
【０１２７】
次いで、酸化物半導体層４８４に接してスパッタ法またはＰＣＶＤ法による酸化物絶縁膜
４５７として形成する。本実施の形態では、酸化物絶縁膜４５７として膜厚３００ｎｍの
酸化珪素膜を成膜する。成膜時の基板温度は、室温以上３００℃以下とすればよく、本実
施の形態では１００℃とする。低抵抗化した酸化物半導体層４８４に接してスパッタ法に
より酸化珪素膜である酸化物絶縁膜４５７を形成すると、低抵抗化した酸化物半導体層４
８４において少なくとも酸化珪素膜である酸化物絶縁膜４５７と接する領域を高抵抗化（
キャリア濃度が低まる、好ましくは１×１０^１８／ｃｍ^３未満）し、高抵抗化酸化物半導
体領域とすることができる。半導体装置の作製プロセス中、不活性気体雰囲気下（或いは
減圧下）での加熱、徐冷及び酸化物絶縁膜の形成などによって酸化物半導体層のキャリア
濃度を増減させることが重要である。酸化物半導体層４８４は、高抵抗化酸化物半導体領
域を有する半導体層４５３（第３の酸化物半導体層）となり、薄膜トランジスタ４６０を
作製することができる（図８（Ｄ）参照。）。
【０１２８】
脱水処理または脱水素処理のための加熱処理を行うことによって酸化物半導体層に含まれ
る不純物（Ｈ_２Ｏ、Ｈ、ＯＨなど）を低減してキャリア濃度を増加させた後、徐冷を行う
。徐冷させた後、酸化物半導体層に接して酸化物絶縁膜の形成などを行って酸化物半導体
層のキャリア濃度を低減し、薄膜トランジスタ４６０の信頼性を向上することができる。
【０１２９】
また、酸化物絶縁膜４５７となる酸化珪素膜を形成後、窒素雰囲気下、又は大気雰囲気下
（大気中）において薄膜トランジスタ４６０に加熱処理（好ましくは１５０℃以上３５０
℃未満）を行ってもよい。例えば、窒素雰囲気下で２５０℃、１時間の加熱処理を行う。
半導体層４５３が酸化物絶縁膜４５７と接した状態で加熱されることになり、該加熱処理
を行うと薄膜トランジスタ４６０の電気的特性のばらつきを軽減することができる。この
加熱処理（好ましくは１５０℃以上３５０℃未満）は、酸化物絶縁膜４５７の形成後であ
れば特に限定されず、他の工程、例えば樹脂膜形成時の加熱処理や、透明導電膜を低抵抗
化させるための加熱処理と兼ねることで、工程数を増やすことなく行うことができる。
【０１３０】
また、本実施の形態は実施の形態１と自由に組み合わせることができる。
【０１３１】
（実施の形態３）
薄膜トランジスタを含む半導体装置の作製工程について、図１０乃至図１３を用いて説明
する。
【０１３２】
図１０（Ａ）において、透光性を有する基板１００にはバリウムホウケイ酸ガラスやアル
ミノホウケイ酸ガラスなどのガラス基板を用いることができる。
【０１３３】
次いで、導電層を基板１００全面に形成した後、第１のフォトリソグラフィ工程を行い、
レジストマスクを形成し、エッチングにより不要な部分を除去して配線及び電極（ゲート
電極層１０１を含むゲート配線、容量配線１０８、及び第１の端子１２１）を形成する。
このとき少なくともゲート電極層１０１の端部にテーパー形状が形成されるようにエッチ
ングする。
【０１３４】
ゲート電極層１０１を含むゲート配線と容量配線１０８、端子部の第１の端子１２１は、
耐熱性導電性材料としては、チタン（Ｔｉ）、タンタル（Ｔａ）、タングステン（Ｗ）、
モリブデン（Ｍｏ）、クロム（Ｃｒ）、Ｎｄ（ネオジム）、スカンジウム（Ｓｃ）から選
ばれた元素、または上述した元素を成分とする合金か、上述した元素を組み合わせた合金
膜、または上述した元素を成分とする窒化物で形成する。
【０１３５】
次いで、ゲート電極層１０１上にゲート絶縁層１０２を全面に成膜する。ゲート絶縁層１
０２はスパッタ法、ＰＣＶＤ法などを用い、膜厚を５０〜２５０ｎｍとする。
【０１３６】
例えば、ゲート絶縁層１０２としてスパッタ法により酸化珪素膜を用い、１００ｎｍの厚
さで形成する。勿論、ゲート絶縁層１０２はこのような酸化珪素膜に限定されるものでな
く、酸化窒化珪素膜、窒化珪素膜、酸化アルミニウム、酸化タンタル膜などの他の絶縁膜
を用い、これらの材料から成る単層または積層構造として形成しても良い。
【０１３７】
次に、ゲート絶縁層１０２上に、酸化物半導体膜（Ｉｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜）
を成膜する。プラズマ処理後、大気に曝すことなくＩｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜を
成膜することは、ゲート絶縁層と半導体膜の界面にゴミや水分を付着させない点で有用で
ある。ここでは、直径８インチのＩｎ、Ｇａ、及びＺｎを含む酸化物半導体ターゲット（
Ｉｎ−Ｇａ−Ｚｎ−Ｏ系酸化物半導体ターゲット（Ｉｎ_２Ｏ_３：Ｇａ_２Ｏ_３：ＺｎＯ＝１
：１：１））を用いて、基板とターゲットの間との距離を１７０ｍｍ、圧力０．４Ｐａ、
直流（ＤＣ）電源０．５ｋＷ、酸素のみ、アルゴンのみ、又はアルゴン及び酸素雰囲気下
で成膜する。なお、パルス直流（ＤＣ）電源を用いると、ごみが軽減でき、膜厚分布も均
一となるために好ましい。Ｉｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜の膜厚は、５ｎｍ〜２００
ｎｍとする。酸化物半導体膜として、Ｉｎ−Ｇａ−Ｚｎ−Ｏ系酸化物半導体ターゲットを
用いてスパッタ法により膜厚５０ｎｍのＩｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜を成膜する。
【０１３８】
スパッタ法にはスパッタ用電源に高周波電源を用いるＲＦスパッタ法と、ＤＣスパッタ法
があり、さらにパルス的にバイアスを与えるパルスＤＣスパッタ法もある。ＲＦスパッタ
法は主に絶縁膜を成膜する場合に用いられ、ＤＣスパッタ法は主に金属膜を成膜する場合
に用いられる。
【０１３９】
また、材料の異なるターゲットを複数設置できる多元スパッタ装置もある。多元スパッタ
装置は、同一チャンバーで異なる材料膜を積層成膜することも、同一チャンバーで複数種
類の材料を同時に放電させて成膜することもできる。
【０１４０】
また、チャンバー内部に磁石機構を備えたマグネトロンスパッタ法を用いるスパッタ装置
や、グロー放電を使わずマイクロ波を用いて発生させたプラズマを用いるＥＣＲスパッタ
法を用いるスパッタ装置がある。
【０１４１】
また、スパッタ法を用いる成膜方法として、成膜中にターゲット物質とスパッタガス成分
とを化学反応させてそれらの化合物薄膜を形成するリアクティブスパッタ法や、成膜中に
基板にも電圧をかけるバイアススパッタ法もある。
【０１４２】
次に、第２のフォトリソグラフィ工程を行い、レジストマスクを形成し、酸化物半導体膜
をエッチングする。例えば燐酸と酢酸と硝酸を混ぜた溶液を用いたウェットエッチングに
より、不要な部分を除去して酸化物半導体層１３３を形成する（図１０（Ａ）参照）。な
お、ここでのエッチングは、ウェットエッチングに限定されずドライエッチングを用いて
もよい。
【０１４３】
ドライエッチングに用いるエッチングガスとしては、塩素を含むガス（塩素系ガス、例え
ば塩素（Ｃｌ_２）、塩化硼素（ＢＣｌ_３）、塩化珪素（ＳｉＣｌ_４）、四塩化炭素（ＣＣ
ｌ_４）など）が好ましい。
【０１４４】
また、フッ素を含むガス（フッ素系ガス、例えば四弗化炭素（ＣＦ_４）、弗化硫黄（ＳＦ
_６）、弗化窒素（ＮＦ_３）、トリフルオロメタン（ＣＨＦ_３）など）、臭化水素（ＨＢｒ
）、酸素（Ｏ_２）、これらのガスにヘリウム（Ｈｅ）やアルゴン（Ａｒ）などの希ガスを
添加したガス、などを用いることができる。
【０１４５】
ドライエッチング法としては、平行平板型ＲＩＥ（Ｒｅａｃｔｉｖｅ Ｉｏｎ Ｅｔｃｈ
ｉｎｇ）法や、ＩＣＰ（Ｉｎｄｕｃｔｉｖｅｌｙ Ｃｏｕｐｌｅｄ Ｐｌａｓｍａ：誘導
結合型プラズマ）エッチング法を用いることができる。所望の加工形状にエッチングでき
るように、エッチング条件（コイル型の電極に印加される電力量、基板側の電極に印加さ
れる電力量、基板側の電極温度等）を適宜調節する。
【０１４６】
ウエットエッチングに用いるエッチング液としては、燐酸と酢酸と硝酸を混ぜた溶液など
を用いることができる。また、ＩＴＯ０７Ｎ（関東化学社製）を用いてもよい。
【０１４７】
また、ウエットエッチング後のエッチング液はエッチングされた材料とともに洗浄によっ
て除去される。その除去された材料を含むエッチング液の廃液を精製し、含まれる材料を
再利用してもよい。当該エッチング後の廃液から酸化物半導体層に含まれるインジウム等
の材料を回収して再利用することにより、資源を有効活用し低コスト化することができる
。
【０１４８】
所望の加工形状にエッチングできるように、材料に合わせてエッチング条件（エッチング
液、エッチング時間、温度等）を適宜調節する。
【０１４９】
次に、酸化物半導体層１３３に脱水化または脱水素化のための加熱処理を行う。酸化物半
導体層１３３に不活性ガス雰囲気（窒素、またはヘリウム、ネオン、アルゴン等）下或い
は減圧下において加熱処理を行った後、不活性雰囲気下で徐冷を行う。
【０１５０】
加熱処理は、２００℃以上で行うと良い。例えば、窒素雰囲気下で４５０℃、１時間の加
熱処理を行う。この窒素雰囲気下の加熱処理により、酸化物半導体層１３３は、低抵抗化
（キャリア濃度が高まる、好ましくは１×１０^１８／ｃｍ^３以上）し、導電率が高まる。
よって低抵抗化した酸化物半導体層１３４が形成される（図１０（Ｂ）参照。）。酸化物
半導体層１３４の電気伝導率は１×１０^−１Ｓ／ｃｍ以上１×１０^２Ｓ／ｃｍ以下が好ま
しい。
【０１５１】
次に、酸化物半導体層１３４上に金属材料からなる導電膜１３２をスパッタ法や真空蒸着
法で形成する（図１０（Ｃ）参照。）。
【０１５２】
導電膜１３２の材料としては、Ａｌ、Ｃｒ、Ｔａ、Ｔｉ、Ｍｏ、Ｗから選ばれた元素、ま
たは上述した元素を成分とする合金か、上述した元素を組み合わせた合金膜等が挙げられ
る。
【０１５３】
導電膜１３２の形成後に加熱処理を行う場合には、この加熱処理に耐える耐熱性を導電膜
に持たせることが好ましい。
【０１５４】
次に、第３のフォトリソグラフィ工程を行い、レジストマスクを形成し、エッチングによ
り不要な部分を除去してソース電極層又はドレイン電極層１０５ａ、１０５ｂ、及び第２
の端子１２２を形成する（図１０（Ｄ）参照。）。この際のエッチング方法としてウェッ
トエッチングまたはドライエッチングを用いる。例えば導電膜１３２としてアルミニウム
膜、又はアルミニウム合金膜を用いる場合は、燐酸と酢酸と硝酸を混ぜた溶液を用いたウ
ェットエッチングを行うことができる。また、アンモニア過水（過酸化水素：アンモニア
：水＝５：２：２）を用いたウェットエッチングにより、導電膜１３２をエッチングして
ソース電極層又はドレイン電極層１０５ａ、１０５ｂを形成してもよい。このエッチング
工程において、酸化物半導体層１３４の露出領域も一部エッチングされ、半導体層１３５
となる。よってソース電極層又はドレイン電極層１０５ａ、１０５ｂの間の半導体層１３
５は膜厚の薄い領域となる。図１０（Ｄ）においては、ソース電極層又はドレイン電極層
１０５ａ、１０５ｂ、半導体層１３５のエッチングをドライエッチングによって一度に行
うため、ソース電極層又はドレイン電極層１０５ａ、１０５ｂ及び半導体層１３５の端部
は一致し、連続的な構造となっている。
【０１５５】
また、この第３のフォトリソグラフィ工程において、ソース電極層又はドレイン電極層１
０５ａ、１０５ｂと同じ材料である第２の端子１２２を端子部に残す。なお、第２の端子
１２２はソース配線（ソース電極層又はドレイン電極層１０５ａ、１０５ｂを含むソース
配線）と電気的に接続されている。
【０１５６】
また、多階調マスクにより形成した複数（代表的には二種類）の厚さの領域を有するレジ
ストマスクを用いると、レジストマスクの数を減らすことができるため、工程簡略化、低
コスト化が図れる。
【０１５７】
次に、レジストマスクを除去し、ゲート絶縁層１０２、酸化物半導体層１３５、ソース電
極層又はドレイン電極層１０５ａ、１０５ｂを覆う保護絶縁層１０７を形成する。保護絶
縁層１０７はＰＣＶＤ法により形成する酸化窒化珪素膜を用いる。ソース電極層又はドレ
イン電極層１０５ａ、１０５ｂの間に設けられた酸化物半導体層１３５の露出領域と保護
絶縁層１０７である酸化窒化珪素膜が接して設けられることによって、保護絶縁層１０７
と接する酸化物半導体層１３５の領域が高抵抗化（キャリア濃度が低まる、好ましくは１
×１０^１８／ｃｍ^３未満）し、高抵抗化したチャネル形成領域を有する半導体層１０３を
形成することができる（図１１（Ａ）参照。）。
【０１５８】
次いで、保護絶縁層１０７を形成する前に、酸素雰囲気下での加熱処理を行ってもよい。
加熱処理は酸素を含む雰囲気下において、１５０℃以上３５０℃未満で行えばよい。
【０１５９】
次いで、保護絶縁層１０７を形成した後、加熱処理を行ってもよい。加熱処理は大気雰囲
気下、又は窒素雰囲気下において、１５０℃以上３５０℃未満で行えばよい。該加熱処理
を行うと、半導体層１０３が保護絶縁層１０７と接した状態で加熱されることになり、さ
らに半導体層１０３を高抵抗化させてトランジスタの電気特性の向上および、電気特性の
ばらつきを軽減することができる。この加熱処理（好ましくは１５０℃以上３５０℃未満
）は、保護絶縁層１０７の形成後であれば特に限定されず、他の工程、例えば樹脂膜形成
時の加熱処理や、透明導電膜を低抵抗化させるための加熱処理と兼ねることで、工程数を
増やすことなく行うことができる。
【０１６０】
以上の工程で薄膜トランジスタ１７０が作製できる。
【０１６１】
次に、第４のフォトリソグラフィ工程を行い、レジストマスクを形成し、保護絶縁層１０
７及びゲート絶縁層１０２のエッチングによりドレイン電極層１０５ｂに達するコンタク
トホール１２５を形成する。また、ここでのエッチングにより第２の端子１２２に達する
コンタクトホール１２７、第１の端子１２１に達するコンタクトホール１２６も形成する
。この段階での断面図を図１１（Ｂ）に示す。
【０１６２】
次いで、レジストマスクを除去した後、透明導電膜を成膜する。透明導電膜の材料として
は、酸化インジウム（Ｉｎ_２Ｏ_３）や酸化インジウム酸化スズ合金（Ｉｎ_２Ｏ_３―ＳｎＯ
_２、ＩＴＯと略記する）などをスパッタ法や真空蒸着法などを用いて形成する。このよう
な材料のエッチング処理は塩酸系の溶液により行う。しかし、特にＩＴＯのエッチングは
残渣が発生しやすいので、エッチング加工性を改善するために酸化インジウム酸化亜鉛合
金（Ｉｎ_２Ｏ_３―ＺｎＯ）を用いても良い。また、透明導電膜を低抵抗化させるための加
熱処理を行う場合、半導体層１０３を高抵抗化させてトランジスタの電気特性の向上およ
び、電気特性のばらつきを軽減する熱処理と兼ねることができる。
【０１６３】
次に、第５のフォトリソグラフィ工程を行い、レジストマスクを形成し、エッチングによ
り不要な部分を除去して画素電極層１１０を形成する。
【０１６４】
また、この第５のフォトリソグラフィ工程において、容量部におけるゲート絶縁層１０２
及び保護絶縁層１０７を誘電体として、容量配線１０８と画素電極層１１０とで保持容量
が形成される。
【０１６５】
また、この第５のフォトリソグラフィ工程において、第１の端子１２１及び第２の端子１
２２をレジストマスクで覆い端子部に形成された透明導電膜１２８、１２９を残す。透明
導電膜１２８、１２９はＦＰＣとの接続に用いられる電極または配線となる。第１の端子
１２１上に形成された透明導電膜１２８は、ゲート配線の入力端子として機能する接続用
の端子電極となる。第２の端子１２２上に形成された透明導電膜１２９は、ソース配線の
入力端子として機能する接続用の端子電極である。
【０１６６】
次いで、レジストマスクを除去し、この段階での断面図を図１１（Ｃ）に示す。なお、こ
の段階での平面図が図１２に相当する。
【０１６７】
また、図１３（Ａ１）、図１３（Ａ２）は、この段階でのゲート配線端子部の平面図及び
断面図をそれぞれ図示している。図１３（Ａ１）は図１３（Ａ２）中のＣ１−Ｃ２線に沿
った断面図に相当する。図１３（Ａ１）において、保護絶縁層１５４上に形成される透明
導電膜１５５は、入力端子として機能する接続用の端子電極である。また、図１３（Ａ１
）において、端子部では、ゲート配線と同じ材料で形成される第１の端子１５１と、ソー
ス配線と同じ材料で形成される接続電極層１５３とがゲート絶縁層１５２を介して重なり
、透明導電膜１５５で導通させている。なお、図１１（Ｃ）に図示した透明導電膜１２８
と第１の端子１２１とが接触している部分が、図１３（Ａ１）の透明導電膜１５５と第１
の端子１５１が接触している部分に対応している。
【０１６８】
また、図１３（Ｂ１）、及び図１３（Ｂ２）は、図１１（Ｃ）に示すソース配線端子部と
は異なるソース配線端子部の平面図及び断面図をそれぞれ図示している。また、図１３（
Ｂ１）は図１３（Ｂ２）中のＦ１−Ｆ２線に沿った断面図に相当する。図１３（Ｂ１）に
おいて、保護絶縁層１５４上に形成される透明導電膜１５５は、入力端子として機能する
接続用の端子電極である。また、図１３（Ｂ１）において、端子部では、ゲート配線と同
じ材料で形成される電極層１５６が、ソース配線と電気的に接続される第２の端子１５０
の下方にゲート絶縁層１５２を介して重なる。電極層１５６は第２の端子１５０とは電気
的に接続しておらず、電極層１５６を第２の端子１５０と異なる電位、例えばフローティ
ング、ＧＮＤ、０Ｖなどに設定すれば、ノイズ対策のための容量または静電気対策のため
の容量を形成することができる。また、第２の端子１５０は、保護絶縁層１５４を介して
透明導電膜１５５と電気的に接続している。
【０１６９】
ゲート配線、ソース配線、及び容量配線は画素密度に応じて複数本設けられるものである
。また、端子部においては、ゲート配線と同電位の第１の端子、ソース配線と同電位の第
２の端子、容量配線と同電位の第３の端子などが複数並べられて配置される。それぞれの
端子の数は、それぞれ任意な数で設ければ良いものとし、実施者が適宣決定すれば良い。
【０１７０】
こうして５回のフォトリソグラフィ工程により、５枚のフォトマスクを使用して、ボトム
ゲート型のスタガ構造の薄膜トランジスタである薄膜トランジスタ１７０を有する画素薄
膜トランジスタ部、保持容量を完成させることができる。そして、これらを個々の画素に
対応してマトリクス状に配置して画素部を構成することによりアクティブマトリクス型の
表示装置を作製するための一方の基板とすることができる。本明細書では便宜上このよう
な基板をアクティブマトリクス基板と呼ぶ。
【０１７１】
アクティブマトリクス型の液晶表示装置を作製する場合には、アクティブマトリクス基板
と、対向電極が設けられた対向基板との間に液晶層を設け、アクティブマトリクス基板と
対向基板とを固定する。なお、対向基板に設けられた対向電極と電気的に接続する共通電
極をアクティブマトリクス基板上に設け、共通電極と電気的に接続する第４の端子を端子
部に設ける。この第４の端子は、共通電極を固定電位、例えばＧＮＤ、０Ｖなどに設定す
るための端子である。
【０１７２】
また、容量配線を設けず、画素電極を隣り合う画素のゲート配線と保護絶縁層及びゲート
絶縁層を介して重ねて保持容量を形成してもよい。
【０１７３】
アクティブマトリクス型の液晶表示装置においては、マトリクス状に配置された画素電極
を駆動することによって、画面上に表示パターンが形成される。詳しくは選択された画素
電極と該画素電極に対応する対向電極との間に電圧が印加されることによって、画素電極
と対向電極との間に配置された液晶層の光学変調が行われ、この光学変調が表示パターン
として観察者に認識される。
【０１７４】
液晶表示装置の動画表示において、液晶分子自体の応答が遅いため、残像が生じる、また
は動画のぼけが生じるという問題がある。液晶表示装置の動画特性を改善するため、全面
黒表示を１フレームおきに行う、所謂、黒挿入と呼ばれる駆動技術がある。
【０１７５】
また、通常の垂直同期周波数を１．５倍好ましくは２倍以上にすることで動画特性を改善
する、所謂、倍速駆動と呼ばれる駆動技術を用いてもよい。
【０１７６】
また、液晶表示装置の動画特性を改善するため、バックライトとして複数のＬＥＤ（発光
ダイオード）光源または複数のＥＬ光源などを用いて面光源を構成し、面光源を構成して
いる各光源を独立して１フレーム期間内で間欠点灯駆動する駆動技術もある。面光源とし
て、３種類以上のＬＥＤを用いてもよいし、白色発光のＬＥＤを用いてもよい。独立して
複数のＬＥＤを制御できるため、液晶層の光学変調の切り替えタイミングに合わせてＬＥ
Ｄの発光タイミングを同期させることもできる。この駆動技術は、ＬＥＤを部分的に消灯
することができるため、特に一画面を占める黒い表示領域の割合が多い映像表示の場合に
は、消費電力の低減効果が図れる。
【０１７７】
これらの駆動技術を組み合わせることによって、液晶表示装置の動画特性などの表示特性
を従来よりも改善することができる。
【０１７８】
本明細書に開示するｎチャネル型のトランジスタは、酸化物半導体膜をチャネル形成領域
に用いており、良好な動特性を有するため、これらの駆動技術を組み合わせることができ
る。
【０１７９】
また、発光表示装置を作製する場合、有機発光素子の一方の電極（カソードとも呼ぶ）は
、低電源電位、例えばＧＮＤ、０Ｖなどに設定するため、端子部に、カソードを低電源電
位、例えばＧＮＤ、０Ｖなどに設定するための第４の端子が設けられる。また、発光表示
装置を作製する場合には、ソース配線、及びゲート配線に加えて電源供給線を設ける。従
って、端子部には、電源供給線と電気的に接続する第５の端子を設ける。
【０１８０】
また、発光表示装置を作製する際、各有機発光素子の間に有機樹脂層を用いた隔壁を設け
る場合がある。その場合には、有機樹脂層を加熱処理するため、半導体層１０３を高抵抗
化させてトランジスタの電気特性の向上および、電気特性のばらつきを軽減する熱処理と
兼ねることができる。
【０１８１】
酸化物半導体を用いた薄膜トランジスタで形成することにより、製造コストを低減するこ
とができる。特に、脱水化または脱水素化のための加熱処理によって、不純物である水分
などを低減して酸化物半導体膜の純度を高めるため、成膜チャンバー内の露点を下げた特
殊なスパッタ装置や超高純度の酸化物半導体ターゲットを用いなくとも、電気特性が良好
で信頼性のよい薄膜トランジスタを有する半導体装置を作製することができる。
【０１８２】
チャネル形成領域の半導体層は高抵抗化領域であるので、薄膜トランジスタの電気特性は
安定化し、オフ電流の増加などを防止することができる。よって、電気特性が良好で信頼
性のよい薄膜トランジスタを有する半導体装置とすることが可能となる。
【０１８３】
本実施の形態は、他の実施の形態に記載した構成と適宜組み合わせて実施することが可能
である。
【０１８４】
（実施の形態４）
半導体装置の一例である表示装置において、同一基板上に少なくとも駆動回路の一部と、
画素部に配置する薄膜トランジスタを作製する例について以下に説明する。
【０１８５】
画素部に配置する薄膜トランジスタは、実施の形態１乃至３に従って形成する。また、実
施の形態１乃至３に示す薄膜トランジスタはｎチャネル型ＴＦＴであるため、駆動回路の
うち、ｎチャネル型ＴＦＴで構成することができる駆動回路の一部を画素部の薄膜トラン
ジスタと同一基板上に形成する。
【０１８６】
半導体装置の一例であるアクティブマトリクス型液晶表示装置のブロック図の一例を図２
０（Ａ）に示す。図２０（Ａ）に示す表示装置は、基板５３００上に表示素子を備えた画
素を複数有する画素部５３０１と、各画素を選択する走査線駆動回路５３０２と、選択さ
れた画素へのビデオ信号の入力を制御する信号線駆動回路５３０３とを有する。
【０１８７】
画素部５３０１は、信号線駆動回路５３０３から列方向に伸張して配置された複数の信号
線Ｓ１〜Ｓｍ（図示せず。）により信号線駆動回路５３０３と接続され、走査線駆動回路
５３０２から行方向に伸張して配置された複数の走査線Ｇ１〜Ｇｎ（図示せず。）により
走査線駆動回路５３０２と接続され、信号線Ｓ１〜Ｓｍ並びに走査線Ｇ１〜Ｇｎに対応し
てマトリクス状に配置された複数の画素（図示せず。）を有する。そして、各画素は、信
号線Ｓｊ（信号線Ｓ１〜Ｓｍのうちいずれか一）、走査線Ｇｉ（走査線Ｇ１〜Ｇｎのうち
いずれか一）と接続される。
【０１８８】
また、実施の形態１乃至３に示す薄膜トランジスタは、ｎチャネル型ＴＦＴであり、ｎチ
ャネル型ＴＦＴで構成する信号線駆動回路について図２１を用いて説明する。
【０１８９】
図２１に示す信号線駆動回路は、ドライバＩＣ５６０１、スイッチ群５６０２＿１〜５６
０２＿Ｍ、第１の配線５６１１、第２の配線５６１２、第３の配線５６１３及び配線５６
２１＿１〜５６２１＿Ｍを有する。スイッチ群５６０２＿１〜５６０２＿Ｍそれぞれは、
第１の薄膜トランジスタ５６０３ａ、第２の薄膜トランジスタ５６０３ｂ及び第３の薄膜
トランジスタ５６０３ｃを有する。
【０１９０】
ドライバＩＣ５６０１は第１の配線５６１１、第２の配線５６１２、第３の配線５６１３
及び配線５６２１＿１〜５６２１＿Ｍに接続される。そして、スイッチ群５６０２＿１〜
５６０２＿Ｍそれぞれは、第１の配線５６１１、第２の配線５６１２、第３の配線５６１
３及びスイッチ群５６０２＿１〜５６０２＿Ｍそれぞれに対応した配線５６２１＿１〜５
６２１＿Ｍに接続される。そして、配線５６２１＿１〜５６２１＿Ｍそれぞれは、第１の
薄膜トランジスタ５６０３ａ、第２の薄膜トランジスタ５６０３ｂ及び第３の薄膜トラン
ジスタ５６０３ｃを介して、３つの信号線に接続される。例えば、Ｊ列目の配線５６２１
＿Ｊ（配線５６２１＿１〜配線５６２１＿Ｍのうちいずれか一）は、スイッチ群５６０２
＿Ｊが有する第１の薄膜トランジスタ５６０３ａ、第２の薄膜トランジスタ５６０３ｂ及
び第３の薄膜トランジスタ５６０３ｃを介して、信号線Ｓｊ−１、信号線Ｓｊ、信号線Ｓ
ｊ＋１に接続される。
【０１９１】
なお、第１の配線５６１１、第２の配線５６１２、第３の配線５６１３には、それぞれ信
号が入力される。
【０１９２】
なお、ドライバＩＣ５６０１は、単結晶基板上に形成されていることが望ましい。さらに
、スイッチ群５６０２＿１〜５６０２＿Ｍは、画素部と同一基板上に形成されていること
が望ましい。したがって、ドライバＩＣ５６０１とスイッチ群５６０２＿１〜５６０２＿
ＭとはＦＰＣなどを介して接続するとよい。
【０１９３】
次に、図２１に示した信号線駆動回路の動作について、図２２のタイミングチャートを参
照して説明する。なお、図２２のタイミングチャートは、ｉ行目の走査線Ｇｉが選択され
ている場合のタイミングチャートを示している。さらに、ｉ行目の走査線Ｇｉの選択期間
は、第１のサブ選択期間Ｔ１、第２のサブ選択期間Ｔ２及び第３のサブ選択期間Ｔ３に分
割されている。さらに、図２１の信号線駆動回路は、他の行の走査線が選択されている場
合でも図２２と同様の動作をする。
【０１９４】
なお、図２２のタイミングチャートは、Ｊ列目の配線５６２１＿Ｊが第１の薄膜トランジ
スタ５６０３ａ、第２の薄膜トランジスタ５６０３ｂ及び第３の薄膜トランジスタ５６０
３ｃを介して、信号線Ｓｊ−１、信号線Ｓｊ、信号線Ｓｊ＋１に接続される場合について
示している。
【０１９５】
なお、図２２のタイミングチャートは、ｉ行目の走査線Ｇｉが選択されるタイミング、第
１の薄膜トランジスタ５６０３ａのオン・オフのタイミング５７０３ａ、第２の薄膜トラ
ンジスタ５６０３ｂのオン・オフのタイミング５７０３ｂ、第３の薄膜トランジスタ５６
０３ｃのオン・オフのタイミング５７０３ｃ及びＪ列目の配線５６２１＿Ｊに入力される
信号５７２１＿Ｊを示している。
【０１９６】
なお、配線５６２１＿１〜配線５６２１＿Ｍには第１のサブ選択期間Ｔ１、第２のサブ選
択期間Ｔ２及び第３のサブ選択期間Ｔ３において、それぞれ別のビデオ信号が入力される
。例えば、第１のサブ選択期間Ｔ１において配線５６２１＿Ｊに入力されるビデオ信号は
信号線Ｓｊ−１に入力され、第２のサブ選択期間Ｔ２において配線５６２１＿Ｊに入力さ
れるビデオ信号は信号線Ｓｊに入力され、第３のサブ選択期間Ｔ３において配線５６２１
＿Ｊに入力されるビデオ信号は信号線Ｓｊ＋１に入力される。さらに、第１のサブ選択期
間Ｔ１、第２のサブ選択期間Ｔ２及び第３のサブ選択期間Ｔ３において、配線５６２１＿
Ｊに入力されるビデオ信号をそれぞれＤａｔａ＿ｊ−１、Ｄａｔａ＿ｊ、Ｄａｔａ＿ｊ＋
１とする。
【０１９７】
図２２に示すように、第１のサブ選択期間Ｔ１において第１の薄膜トランジスタ５６０３
ａがオンし、第２の薄膜トランジスタ５６０３ｂ及び第３の薄膜トランジスタ５６０３ｃ
がオフする。このとき、配線５６２１＿Ｊに入力されるＤａｔａ＿ｊ−１が、第１の薄膜
トランジスタ５６０３ａを介して信号線Ｓｊ−１に入力される。第２のサブ選択期間Ｔ２
では、第２の薄膜トランジスタ５６０３ｂがオンし、第１の薄膜トランジスタ５６０３ａ
及び第３の薄膜トランジスタ５６０３ｃがオフする。このとき、配線５６２１＿Ｊに入力
されるＤａｔａ＿ｊが、第２の薄膜トランジスタ５６０３ｂを介して信号線Ｓｊに入力さ
れる。第３のサブ選択期間Ｔ３では、第３の薄膜トランジスタ５６０３ｃがオンし、第１
の薄膜トランジスタ５６０３ａ及び第２の薄膜トランジスタ５６０３ｂがオフする。この
とき、配線５６２１＿Ｊに入力されるＤａｔａ＿ｊ＋１が、第３の薄膜トランジスタ５６
０３ｃを介して信号線Ｓｊ＋１に入力される。
【０１９８】
以上のことから、図２１の信号線駆動回路は、１ゲート選択期間を３つに分割することで
、１ゲート選択期間中に１つの配線５６２１から３つの信号線にビデオ信号を入力するこ
とができる。したがって、図２１の信号線駆動回路は、ドライバＩＣ５６０１が形成され
る基板と、画素部が形成されている基板との接続数を信号線の数に比べて約１／３にする
ことができる。接続数が約１／３になることによって、図２１の信号線駆動回路は、信頼
性、歩留まりなどを向上できる。
【０１９９】
なお、図２１のように、１ゲート選択期間を複数のサブ選択期間に分割し、複数のサブ選
択期間それぞれにおいて、ある１つの配線から複数の信号線それぞれにビデオ信号を入力
することができれば、薄膜トランジスタの配置や数、駆動方法などは限定されない。
【０２００】
例えば、３つ以上のサブ選択期間それぞれにおいて１つの配線から３つ以上の信号線それ
ぞれにビデオ信号を入力する場合は、薄膜トランジスタ及び薄膜トランジスタを制御する
ための配線を追加すればよい。ただし、１ゲート選択期間を４つ以上のサブ選択期間に分
割すると、１つのサブ選択期間が短くなる。したがって、１ゲート選択期間は、２つ又は
３つのサブ選択期間に分割されることが望ましい。
【０２０１】
別の例として、図２３のタイミングチャートに示すように、１つの選択期間をプリチャー
ジ期間Ｔｐ、第１のサブ選択期間Ｔ１、第２のサブ選択期間Ｔ２、第３のサブ選択期間Ｔ
３に分割してもよい。さらに、図２３のタイミングチャートは、ｉ行目の走査線Ｇｉが選
択されるタイミング、第１の薄膜トランジスタ５６０３ａのオン・オフのタイミング５８
０３ａ、第２の薄膜トランジスタ５６０３ｂのオン・オフのタイミング５８０３ｂ、第３
の薄膜トランジスタ５６０３ｃのオン・オフのタイミング５８０３ｃ及びＪ列目の配線５
６２１＿Ｊに入力される信号５８２１＿Ｊを示している。図２３に示すように、プリチャ
ージ期間Ｔｐにおいて第１の薄膜トランジスタ５６０３ａ、第２の薄膜トランジスタ５６
０３ｂ及び第３の薄膜トランジスタ５６０３ｃがオンする。このとき、配線５６２１＿Ｊ
に入力されるプリチャージ電圧Ｖｐが第１の薄膜トランジスタ５６０３ａ、第２の薄膜ト
ランジスタ５６０３ｂ及び第３の薄膜トランジスタ５６０３ｃを介してそれぞれ信号線Ｓ
ｊ−１、信号線Ｓｊ、信号線Ｓｊ＋１に入力される。第１のサブ選択期間Ｔ１において第
１の薄膜トランジスタ５６０３ａがオンし、第２の薄膜トランジスタ５６０３ｂ及び第３
の薄膜トランジスタ５６０３ｃがオフする。このとき、配線５６２１＿Ｊに入力されるＤ
ａｔａ＿ｊ−１が、第１の薄膜トランジスタ５６０３ａを介して信号線Ｓｊ−１に入力さ
れる。第２のサブ選択期間Ｔ２では、第２の薄膜トランジスタ５６０３ｂがオンし、第１
の薄膜トランジスタ５６０３ａ及び第３の薄膜トランジスタ５６０３ｃがオフする。この
とき、配線５６２１＿Ｊに入力されるＤａｔａ＿ｊが、第２の薄膜トランジスタ５６０３
ｂを介して信号線Ｓｊに入力される。第３のサブ選択期間Ｔ３では、第３の薄膜トランジ
スタ５６０３ｃがオンし、第１の薄膜トランジスタ５６０３ａ及び第２の薄膜トランジス
タ５６０３ｂがオフする。このとき、配線５６２１＿Ｊに入力されるＤａｔａ＿ｊ＋１が
、第３の薄膜トランジスタ５６０３ｃを介して信号線Ｓｊ＋１に入力される。
【０２０２】
以上のことから、図２３のタイミングチャートを適用した図２１の信号線駆動回路は、サ
ブ選択期間の前にプリチャージ期間を設けることによって、信号線をプリチャージできる
ため、画素へのビデオ信号の書き込みを高速に行うことができる。なお、図２３において
、図２２と同様なものに関しては共通の符号を用いて示し、同一部分又は同様な機能を有
する部分の詳細な説明は省略する。
【０２０３】
また、走査線駆動回路の構成について説明する。走査線駆動回路は、シフトレジスタを有
している。必要に応じて走査線駆動回路にレベルシフタ、バッファ、スイッチ等を有して
も良いし、シフトレジスタのみの構成としても良い。走査線駆動回路において、シフトレ
ジスタにクロック信号（ＣＬＫ）及びスタートパルス信号（ＳＰ）が入力されることによ
って、選択信号が生成される。生成された選択信号はバッファにおいて緩衝増幅され、対
応する走査線に供給される。走査線には、１ライン分の画素のトランジスタのゲート電極
が接続されている。そして、１ライン分の画素のトランジスタを一斉にＯＮにしなくては
ならないので、バッファは大きな電流を流すことが可能なものが用いられる。
【０２０４】
走査線駆動回路の一部に用いるシフトレジスタの一形態について図２４及び図２５を用い
て説明する。
【０２０５】
図２４にシフトレジスタの回路構成を示す。図２４に示すシフトレジスタは、フリップフ
ロップ５７０１＿１〜５７０１＿ｎという複数のフリップフロップで構成される。また、
第１のクロック信号、第２のクロック信号、スタートパルス信号、リセット信号が入力さ
れて動作する。
【０２０６】
図２４のシフトレジスタの接続関係について説明する。図２４のシフトレジスタは、ｉ段
目のフリップフロップ５７０１＿ｉ（フリップフロップ５７０１＿１〜５７０１＿ｎのう
ちいずれか一）は、図２５に示した第１の配線５５０１が第７の配線５７１７＿ｉ−１に
接続され、図２５に示した第２の配線５５０２が第７の配線５７１７＿ｉ＋１に接続され
、図２５に示した第３の配線５５０３が第７の配線５７１７＿ｉに接続され、図２５に示
した第６の配線５５０６が第５の配線５７１５に接続される。
【０２０７】
また、図２５に示した第４の配線５５０４が奇数段目のフリップフロップでは第２の配線
５７１２に接続され、偶数段目のフリップフロップでは第３の配線５７１３に接続され、
図２５に示した第５の配線５５０５が第４の配線５７１４に接続される。
【０２０８】
ただし、１段目のフリップフロップ５７０１＿１の図２５に示す第１の配線５５０１は第
１の配線５７１１に接続され、ｎ段目のフリップフロップ５７０１＿ｎの図２５に示す第
２の配線５５０２は第６の配線５７１６に接続される。
【０２０９】
なお、第１の配線５７１１、第２の配線５７１２、第３の配線５７１３、第６の配線５７
１６を、それぞれ第１の信号線、第２の信号線、第３の信号線、第４の信号線と呼んでも
よい。さらに、第４の配線５７１４、第５の配線５７１５を、それぞれ第１の電源線、第
２の電源線と呼んでもよい。
【０２１０】
次に、図２４に示すフリップフロップの詳細について、図２５に示す。図２５に示すフリ
ップフロップは、第１の薄膜トランジスタ５５７１、第２の薄膜トランジスタ５５７２、
第３の薄膜トランジスタ５５７３、第４の薄膜トランジスタ５５７４、第５の薄膜トラン
ジスタ５５７５、第６の薄膜トランジスタ５５７６、第７の薄膜トランジスタ５５７７及
び第８の薄膜トランジスタ５５７８を有する。なお、第１の薄膜トランジスタ５５７１、
第２の薄膜トランジスタ５５７２、第３の薄膜トランジスタ５５７３、第４の薄膜トラン
ジスタ５５７４、第５の薄膜トランジスタ５５７５、第６の薄膜トランジスタ５５７６、
第７の薄膜トランジスタ５５７７及び第８の薄膜トランジスタ５５７８は、ｎチャネル型
トランジスタであり、ゲート・ソース間電圧（Ｖｇｓ）がしきい値電圧（Ｖｔｈ）を上回
ったとき導通状態になるものとする。
【０２１１】
次に、図２４に示すフリップフロップの接続構成について、以下に示す。
【０２１２】
第１の薄膜トランジスタ５５７１の第１の電極（ソース電極またはドレイン電極の一方）
が第４の配線５５０４に接続され、第１の薄膜トランジスタ５５７１の第２の電極（ソー
ス電極またはドレイン電極の他方）が第３の配線５５０３に接続される。
【０２１３】
第２の薄膜トランジスタ５５７２の第１の電極が第６の配線５５０６に接続され、第２の
薄膜トランジスタ５５７２第２の電極が第３の配線５５０３に接続される。
【０２１４】
第３の薄膜トランジスタ５５７３の第１の電極が第５の配線５５０５に接続され、第３の
薄膜トランジスタ５５７３の第２の電極が第２の薄膜トランジスタ５５７２のゲート電極
に接続され、第３の薄膜トランジスタ５５７３のゲート電極が第５の配線５５０５に接続
される。
【０２１５】
第４の薄膜トランジスタ５５７４の第１の電極が第６の配線５５０６に接続され、第４の
薄膜トランジスタ５５７４の第２の電極が第２の薄膜トランジスタ５５７２のゲート電極
に接続され、第４の薄膜トランジスタ５５７４のゲート電極が第１の薄膜トランジスタ５
５７１のゲート電極に接続される。
【０２１６】
第５の薄膜トランジスタ５５７５の第１の電極が第５の配線５５０５に接続され、第５の
薄膜トランジスタ５５７５の第２の電極が第１の薄膜トランジスタ５５７１のゲート電極
に接続され、第５の薄膜トランジスタ５５７５のゲート電極が第１の配線５５０１に接続
される。
【０２１７】
第６の薄膜トランジスタ５５７６の第１の電極が第６の配線５５０６に接続され、第６の
薄膜トランジスタ５５７６の第２の電極が第１の薄膜トランジスタ５５７１のゲート電極
に接続され、第６の薄膜トランジスタ５５７６のゲート電極が第２の薄膜トランジスタ５
５７２のゲート電極に接続される。
【０２１８】
第７の薄膜トランジスタ５５７７の第１の電極が第６の配線５５０６に接続され、第７の
薄膜トランジスタ５５７７の第２の電極が第１の薄膜トランジスタ５５７１のゲート電極
に接続され、第７の薄膜トランジスタ５５７７のゲート電極が第２の配線５５０２に接続
される。第８の薄膜トランジスタ５５７８の第１の電極が第６の配線５５０６に接続され
、第８の薄膜トランジスタ５５７８の第２の電極が第２の薄膜トランジスタ５５７２のゲ
ート電極に接続され、第８の薄膜トランジスタ５５７８のゲート電極が第１の配線５５０
１に接続される。
【０２１９】
なお、第１の薄膜トランジスタ５５７１のゲート電極、第４の薄膜トランジスタ５５７４
のゲート電極、第５の薄膜トランジスタ５５７５の第２の電極、第６の薄膜トランジスタ
５５７６の第２の電極及び第７の薄膜トランジスタ５５７７の第２の電極の接続箇所をノ
ード５５４３とする。さらに、第２の薄膜トランジスタ５５７２のゲート電極、第３の薄
膜トランジスタ５５７３の第２の電極、第４の薄膜トランジスタ５５７４の第２の電極、
第６の薄膜トランジスタ５５７６のゲート電極及び第８の薄膜トランジスタ５５７８の第
２の電極の接続箇所をノード５５４４とする。
【０２２０】
なお、第１の配線５５０１、第２の配線５５０２、第３の配線５５０３及び第４の配線５
５０４を、それぞれ第１の信号線、第２の信号線、第３の信号線、第４の信号線と呼んで
もよい。さらに、第５の配線５５０５を第１の電源線、第６の配線５５０６を第２の電源
線と呼んでもよい。
【０２２１】
また、信号線駆動回路及び走査線駆動回路を実施の形態１乃至３に示すｎチャネル型ＴＦ
Ｔのみで作製することも可能である。実施の形態１乃至３に示すｎチャネル型ＴＦＴはト
ランジスタの移動度が大きいため、駆動回路の駆動周波数を高くすることが可能となる。
また、実施の形態１乃至３に示すｎチャネル型ＴＦＴは寄生容量が低減されるため、周波
数特性（ｆ特性と呼ばれる）が高い。例えば、実施の形態１乃至３に示すｎチャネル型Ｔ
ＦＴを用いた走査線駆動回路は、高速に動作させることができるため、フレーム周波数を
高くすること、または、黒画面挿入を実現することなども実現することができる。
【０２２２】
さらに、走査線駆動回路のトランジスタのチャネル幅を大きくすることや、複数の走査線
駆動回路を配置することなどによって、さらに高いフレーム周波数を実現することができ
る。複数の走査線駆動回路を配置する場合は、偶数行の走査線を駆動する為の走査線駆動
回路を片側に配置し、奇数行の走査線を駆動するための走査線駆動回路をその反対側に配
置することにより、フレーム周波数を高くすることを実現することができる。また、複数
の走査線駆動回路により、同じ走査線に信号を出力すると、表示装置の大型化に有利であ
る。
【０２２３】
また、半導体装置の一例であるアクティブマトリクス型発光表示装置を作製する場合、少
なくとも一つの画素に複数の薄膜トランジスタを配置するため、走査線駆動回路を複数配
置することが好ましい。アクティブマトリクス型発光表示装置のブロック図の一例を図２
０（Ｂ）に示す。
【０２２４】
図２０（Ｂ）に示す発光表示装置は、基板５４００上に表示素子を備えた画素を複数有す
る画素部５４０１と、各画素を選択する第１の走査線駆動回路５４０２及び第２の走査線
駆動回路５４０４と、選択された画素へのビデオ信号の入力を制御する信号線駆動回路５
４０３とを有する。
【０２２５】
図２０（Ｂ）に示す発光表示装置の画素に入力されるビデオ信号をデジタル形式とする場
合、画素はトランジスタのオンとオフの切り替えによって、発光もしくは非発光の状態と
なる。よって、面積階調法または時間階調法を用いて階調の表示を行うことができる。面
積階調法は、１画素を複数の副画素に分割し、各副画素を独立にビデオ信号に基づいて駆
動させることによって、階調表示を行う駆動法である。また時間階調法は、画素が発光す
る期間を制御することによって、階調表示を行う駆動法である。
【０２２６】
発光素子は、液晶素子などに比べて応答速度が高いので、液晶素子よりも時間階調法に適
している。具体的に時間階調法で表示を行なう場合、１フレーム期間を複数のサブフレー
ム期間に分割する。そしてビデオ信号に従い、各サブフレーム期間において画素の発光素
子を発光または非発光の状態にする。複数のサブフレーム期間に分割することによって、
１フレーム期間中に画素が実際に発光する期間のトータルの長さを、ビデオ信号により制
御することができ、階調を表示することができる。
【０２２７】
なお、図２０（Ｂ）に示す発光表示装置では、一つの画素に２つのスイッチング用ＴＦＴ
を配置する場合、一方のスイッチング用ＴＦＴのゲート配線である第１の走査線に入力さ
れる信号を第１の走査線駆動回路５４０２で生成し、他方のスイッチング用ＴＦＴのゲー
ト配線である第２の走査線に入力される信号を第２の走査線駆動回路５４０４で生成して
いる例を示しているが、第１の走査線に入力される信号と、第２の走査線に入力される信
号とを、共に１つの走査線駆動回路で生成するようにしても良い。また、例えば、１つの
画素が有するスイッチング用ＴＦＴの数によって、スイッチング素子の動作を制御するの
に用いられる走査線が、各画素に複数設けられることもあり得る。この場合、複数の走査
線に入力される信号を、全て１つの走査線駆動回路で生成しても良いし、複数の各走査線
駆動回路で生成しても良い。
【０２２８】
また、発光表示装置においても、駆動回路のうち、ｎチャネル型ＴＦＴで構成することが
できる駆動回路の一部を画素部の薄膜トランジスタと同一基板上に形成することができる
。また、信号線駆動回路及び走査線駆動回路を実施の形態１乃至３に示すｎチャネル型Ｔ
ＦＴのみで作製することも可能である。
【０２２９】
また、上述した駆動回路は、液晶表示装置や発光表示装置に限らず、スイッチング素子と
電気的に接続する素子を利用して電子インクを駆動させる電子ペーパーに用いてもよい。
電子ペーパーは、電気泳動表示装置（電気泳動ディスプレイ）とも呼ばれており、紙と同
じ読みやすさ、他の表示装置に比べ低消費電力、薄くて軽い形状とすることが可能という
利点を有している。
【０２３０】
電気泳動ディスプレイは、様々な形態が考えられ得るが、プラスの電荷を有する第１の粒
子と、マイナスの電荷を有する第２の粒子とを含むマイクロカプセルが溶媒または溶質に
複数分散されたものであり、マイクロカプセルに電界を印加することによって、マイクロ
カプセル中の粒子を互いに反対方向に移動させて一方側に集合した粒子の色のみを表示す
るものである。なお、第１の粒子または第２の粒子は染料を含み、電界がない場合におい
て移動しないものである。また、第１の粒子の色と第２の粒子の色は異なるもの（無色を
含む）とする。
【０２３１】
このように、電気泳動ディスプレイは、誘電定数の高い物質が高い電界領域に移動する、
いわゆる誘電泳動的効果を利用したディスプレイである。電気泳動ディスプレイは、液晶
表示装置には必要な偏光板は必要なく、重さが低減する。
【０２３２】
上記マイクロカプセルを溶媒中に分散させたものが電子インクと呼ばれるものであり、こ
の電子インクはガラス、プラスチック、布、紙などの表面に印刷することができる。また
、カラーフィルタや色素を有する粒子を用いることによってカラー表示も可能である。
【０２３３】
また、アクティブマトリクス基板上に適宜、二つの電極の間に挟まれるように上記マイク
ロカプセルを複数配置すればアクティブマトリクス型の表示装置が完成し、マイクロカプ
セルに電界を印加すれば表示を行うことができる。例えば、実施の形態１乃至３の薄膜ト
ランジスタによって得られるアクティブマトリクス基板を用いることができる。
【０２３４】
なお、マイクロカプセル中の第１の粒子および第２の粒子は、導電体材料、絶縁体材料、
半導体材料、磁性材料、液晶材料、強誘電性材料、エレクトロルミネセント材料、エレク
トロクロミック材料、磁気泳動材料から選ばれた一種の材料、またはこれらの複合材料を
用いればよい。
【０２３５】
以上の工程により、半導体装置として信頼性の高い表示装置を作製することができる。
【０２３６】
本実施の形態は、他の実施の形態に記載した構成と適宜組み合わせて実施することが可能
である。
【０２３７】
（実施の形態５）
薄膜トランジスタを作製し、該薄膜トランジスタを画素部、さらには駆動回路に用いて表
示機能を有する半導体装置（表示装置ともいう）を作製することができる。また、薄膜ト
ランジスタを駆動回路の一部または全体を、画素部と同じ基板上に一体形成し、システム
オンパネルを形成することができる。
【０２３８】
表示装置は表示素子を含む。表示素子としては液晶素子（液晶表示素子ともいう）、発光
素子（発光表示素子ともいう）を用いることができる。発光素子は、電流または電圧によ
って輝度が制御される素子をその範疇に含んでおり、具体的には無機ＥＬ（Ｅｌｅｃｔｒ
ｏ Ｌｕｍｉｎｅｓｃｅｎｃｅ）、有機ＥＬ等が含まれる。また、電子インクなど、電気
的作用によりコントラストが変化する表示媒体も適用することができる。
【０２３９】
また、表示装置は、表示素子が封止された状態にあるパネルと、該パネルにコントローラ
を含むＩＣ等を実装した状態にあるモジュールとを含む。さらに、該表示装置を作製する
過程における、表示素子が完成する前の一形態に相当する素子基板に関し、該素子基板は
、電流を表示素子に供給するための手段を複数の各画素に備える。素子基板は、具体的に
は、表示素子の画素電極のみが形成された状態であっても良いし、画素電極となる導電膜
を成膜した後であって、エッチングして画素電極を形成する前の状態であっても良いし、
あらゆる形態があてはまる。
【０２４０】
なお、本明細書中における表示装置とは、画像表示デバイス、表示デバイス、もしくは光
源（照明装置含む）を指す。また、コネクター、例えばＦＰＣ（Ｆｌｅｘｉｂｌｅ ｐｒ
ｉｎｔｅｄ ｃｉｒｃｕｉｔ）もしくはＴＡＢ（Ｔａｐｅ Ａｕｔｏｍａｔｅｄ Ｂｏｎ
ｄｉｎｇ）テープもしくはＴＣＰ（Ｔａｐｅ Ｃａｒｒｉｅｒ Ｐａｃｋａｇｅ）が取り
付けられたモジュール、ＴＡＢテープやＴＣＰの先にプリント配線板が設けられたモジュ
ール、または表示素子にＣＯＧ（Ｃｈｉｐ Ｏｎ Ｇｌａｓｓ）方式によりＩＣ（集積回
路）が直接実装されたモジュールも全て表示装置に含むものとする。
【０２４１】
半導体装置の一形態に相当する液晶表示パネルの外観及び断面について、図１６を用いて
説明する。図１６（Ａ１）（Ａ２）は、第１の基板４００１上に形成された実施の形態３
で示した酸化物半導体層を含む信頼性の高い薄膜トランジスタ４０１０、４０１１、及び
液晶素子４０１３を、第１の基板４００１と第２の基板４００６との間にシール材４００
５によって封止した、パネルの平面図であり、図１６（Ｂ）は、図１６（Ａ１）（Ａ２）
のＭ−Ｎにおける断面図に相当する。
【０２４２】
第１の基板４００１上に設けられた画素部４００２と、走査線駆動回路４００４とを囲む
ようにして、シール材４００５が設けられている。また画素部４００２と、走査線駆動回
路４００４の上に第２の基板４００６が設けられている。よって画素部４００２と、走査
線駆動回路４００４とは、第１の基板４００１とシール材４００５と第２の基板４００６
とによって、液晶層４００８と共に封止されている。また第１の基板４００１上のシール
材４００５によって囲まれている領域とは異なる領域に、別途用意された基板上に単結晶
半導体膜又は多結晶半導体膜で形成された信号線駆動回路４００３が実装されている。
【０２４３】
なお、別途形成した駆動回路の接続方法は、特に限定されるものではなく、ＣＯＧ方法、
ワイヤボンディング方法、或いはＴＡＢ方法などを用いることができる。図１６（Ａ１）
は、ＣＯＧ方法により信号線駆動回路４００３を実装する例であり、図１６（Ａ２）は、
ＴＡＢ方法により信号線駆動回路４００３を実装する例である。
【０２４４】
また第１の基板４００１上に設けられた画素部４００２と、走査線駆動回路４００４は、
薄膜トランジスタを複数有しており、図１６（Ｂ）では、画素部４００２に含まれる薄膜
トランジスタ４０１０と、走査線駆動回路４００４に含まれる薄膜トランジスタ４０１１
とを例示している。薄膜トランジスタ４０１０、４０１１上には絶縁層４０２０、４０２
１が設けられている。
【０２４５】
薄膜トランジスタ４０１０、４０１１は、実施の形態３で示した酸化物半導体層を含む信
頼性の高い薄膜トランジスタを適用することができる。また実施の形態１又は実施の形態
２に示す薄膜トランジスタを適用してもよい。本実施の形態において、薄膜トランジスタ
４０１０、４０１１はｎチャネル型薄膜トランジスタである。
【０２４６】
また、液晶素子４０１３が有する画素電極層４０３０は、薄膜トランジスタ４０１０と電
気的に接続されている。そして液晶素子４０１３の対向電極層４０３１は第２の基板４０
０６上に形成されている。画素電極層４０３０と対向電極層４０３１と液晶層４００８と
が重なっている部分が、液晶素子４０１３に相当する。なお、画素電極層４０３０、対向
電極層４０３１はそれぞれ配向膜として機能する絶縁層４０３２、４０３３が設けられ、
絶縁層４０３２、４０３３を介して液晶層４００８を挟持している。
【０２４７】
なお、第１の基板４００１、第２の基板４００６としては、ガラス、金属（代表的にはス
テンレス）、セラミックス、プラスチックを用いることができる。プラスチックとしては
、ＦＲＰ（Ｆｉｂｅｒｇｌａｓｓ−Ｒｅｉｎｆｏｒｃｅｄ Ｐｌａｓｔｉｃｓ）板、ＰＶ
Ｆ（ポリビニルフルオライド）フィルム、ポリエステルフィルムまたはアクリル樹脂フィ
ルムを用いることができる。また、アルミニウムホイルをＰＶＦフィルムやポリエステル
フィルムで挟んだ構造のシートを用いることもできる。
【０２４８】
また４０３５は絶縁膜を選択的にエッチングすることで得られる柱状のスペーサであり、
画素電極層４０３０と対向電極層４０３１との間の距離（セルギャップ）を制御するため
に設けられている。なお球状のスペーサを用いていても良い。また、対向電極層４０３１
は、薄膜トランジスタ４０１０と同一基板上に設けられる共通電位線と電気的に接続され
る。共通接続部を用いて、一対の基板間に配置される導電性粒子を介して対向電極層４０
３１と共通電位線とを電気的に接続することができる。なお、導電性粒子はシール材４０
０５に含有させる。
【０２４９】
また、配向膜を用いないブルー相を示す液晶を用いてもよい。ブルー相は液晶相の一つで
あり、コレステリック液晶を昇温していくと、コレステリック相から等方相へ転移する直
前に発現する相である。ブルー相は狭い温度範囲でしか発現しないため、温度範囲を改善
するために５重量％以上のカイラル剤を混合させた液晶組成物を用いて液晶層４００８に
用いる。ブルー相を示す液晶とカイラル剤とを含む液晶組成物は、応答速度が１ｍｓｅｃ
以下と短く、光学的等方性であるため配向処理が不要であり、視野角依存性が小さい。
【０２５０】
なお透過型液晶表示装置の他に、反射型液晶表示装置でも半透過型液晶表示装置でも適用
できる。
【０２５１】
また、液晶表示装置では、基板の外側（視認側）に偏光板を設け、内側に着色層、表示素
子に用いる電極層という順に設ける例を示すが、偏光板は基板の内側に設けてもよい。ま
た、偏光板と着色層の積層構造も本実施の形態に限定されず、偏光板及び着色層の材料や
作製工程条件によって適宜設定すればよい。また、ブラックマトリクスとして機能する遮
光膜を設けてもよい。
【０２５２】
また、薄膜トランジスタの表面凹凸を低減するため、及び薄膜トランジスタの信頼性を向
上させるため、上記実施の形態で得られた薄膜トランジスタを保護膜や平坦化絶縁膜とし
て機能する絶縁層（絶縁層４０２０、絶縁層４０２１）で覆う構成となっている。なお、
保護膜は、大気中に浮遊する有機物や金属物、水蒸気などの汚染不純物の侵入を防ぐため
のものであり、緻密な膜が好ましい。保護膜は、スパッタ法を用いて、酸化珪素膜、窒化
珪素膜、酸化窒化珪素膜、窒化酸化珪素膜、酸化アルミニウム膜、窒化アルミニウム膜、
酸化窒化アルミニウム膜、又は窒化酸化アルミニウム膜の単層、又は積層で形成すればよ
い。保護膜をスパッタ法で形成する例を示すが、特に限定されず種々の方法で形成すれば
よい。
【０２５３】
ここでは、保護膜として積層構造の絶縁層４０２０を形成する。ここでは、絶縁層４０２
０の一層目として、スパッタ法を用いて酸化珪素膜を形成する。保護膜として酸化珪素膜
を用いると、ソース電極層及びドレイン電極層として用いるアルミニウム膜のヒロック防
止に効果がある。
【０２５４】
また、保護膜の二層目として絶縁層を形成する。ここでは、ここでは、絶縁層４０２０の
二層目として、スパッタ法を用いて窒化珪素膜を形成する。保護膜として窒化珪素膜を用
いると、ナトリウム等の可動イオンが半導体領域中に侵入して、ＴＦＴの電気特性を変化
させることを抑制することができる。
【０２５５】
また、保護膜を形成した後に、窒素雰囲気下、又は大気雰囲気下で加熱処理（３００℃以
下）を行ってもよい。
【０２５６】
また、平坦化絶縁膜として絶縁層４０２１を形成する。絶縁層４０２１としては、ポリイ
ミド、アクリル、ベンゾシクロブテン、ポリアミド、エポキシ等の、耐熱性を有する有機
材料を用いることができる。また上記有機材料の他に、低誘電率材料（ｌｏｗ−ｋ材料）
、シロキサン系樹脂、ＰＳＧ（リンガラス）、ＢＰＳＧ（リンボロンガラス）等を用いる
ことができる。なお、これらの材料で形成される絶縁膜を複数積層させることで、絶縁層
４０２１を形成してもよい。
【０２５７】
なおシロキサン系樹脂とは、シロキサン系材料を出発材料として形成されたＳｉ−Ｏ−Ｓ
ｉ結合を含む樹脂に相当する。シロキサン系樹脂は置換基としては有機基（例えばアルキ
ル基やアリール基）やフルオロ基を用いても良い。また、有機基はフルオロ基を有してい
ても良い。
【０２５８】
絶縁層４０２１の形成法は、特に限定されず、その材料に応じて、スパッタ法、ＳＯＧ法
、スピンコート、ディップ、スプレー塗布、液滴吐出法（インクジェット法、スクリーン
印刷、オフセット印刷等）、ドクターナイフ、ロールコーター、カーテンコーター、ナイ
フコーター等を用いることができる。絶縁層４０２１の焼成工程と半導体層のアニールを
兼ねることで効率よく半導体装置を作製することが可能となる。
【０２５９】
画素電極層４０３０、対向電極層４０３１は、酸化タングステンを含むインジウム酸化物
、酸化タングステンを含むインジウム亜鉛酸化物、酸化チタンを含むインジウム酸化物、
酸化チタンを含むインジウム錫酸化物、インジウム錫酸化物（以下、ＩＴＯと示す。）、
インジウム亜鉛酸化物、酸化ケイ素を添加したインジウム錫酸化物などの透光性を有する
導電性材料を用いることができる。
【０２６０】
また、画素電極層４０３０、対向電極層４０３１として、導電性高分子（導電性ポリマー
ともいう）を含む導電性組成物を用いて形成することができる。導電性組成物を用いて形
成した画素電極は、シート抵抗が１００００Ω／□以下、波長５５０ｎｍにおける透光率
が７０％以上であることが好ましい。また、導電性組成物に含まれる導電性高分子の抵抗
率が０．１Ω・ｃｍ以下であることが好ましい。
【０２６１】
導電性高分子としては、いわゆるπ電子共役系導電性高分子が用いることができる。例え
ば、ポリアニリンまたはその誘導体、ポリピロールまたはその誘導体、ポリチオフェンま
たはその誘導体、若しくはこれらの２種以上の共重合体などがあげられる。
【０２６２】
また別途形成された信号線駆動回路４００３と、走査線駆動回路４００４または画素部４
００２に与えられる各種信号及び電位は、ＦＰＣ４０１８から供給されている。
【０２６３】
接続端子電極４０１５が、液晶素子４０１３が有する画素電極層４０３０と同じ導電膜か
ら形成され、端子電極４０１６は、薄膜トランジスタ４０１０、４０１１のソース電極層
及びドレイン電極層と同じ導電膜で形成されている。
【０２６４】
接続端子電極４０１５は、ＦＰＣ４０１８が有する端子と、異方性導電膜４０１９を介し
て電気的に接続されている。
【０２６５】
また図１６においては、信号線駆動回路４００３を別途形成し、第１の基板４００１に実
装している例を示しているがこの構成に限定されない。走査線駆動回路を別途形成して実
装しても良いし、信号線駆動回路の一部または走査線駆動回路の一部のみを別途形成して
実装しても良い。
【０２６６】
図２６は、本明細書に開示する作製方法により作製されるＴＦＴ基板２６００を用いて半
導体装置として液晶表示モジュールを構成する一例を示している。
【０２６７】
図２６は液晶表示モジュールの一例であり、ＴＦＴ基板２６００と対向基板２６０１がシ
ール材２６０２により固着され、その間にＴＦＴ等を含む画素部２６０３、液晶層を含む
表示素子２６０４、着色層２６０５が設けられ表示領域を形成している。着色層２６０５
はカラー表示を行う場合に必要であり、ＲＧＢ方式の場合は、赤、緑、青の各色に対応し
た着色層が各画素に対応して設けられている。ＴＦＴ基板２６００と対向基板２６０１の
外側には偏光板２６０６、偏光板２６０７、拡散板２６１３が配設されている。光源は冷
陰極管２６１０と反射板２６１１により構成され、回路基板２６１２は、フレキシブル配
線基板２６０９によりＴＦＴ基板２６００の配線回路部２６０８と接続され、コントロー
ル回路や電源回路などの外部回路が組みこまれている。また偏光板と、液晶層との間に位
相差板を有した状態で積層してもよい。
【０２６８】
液晶表示モジュールには、ＴＮ（Ｔｗｉｓｔｅｄ Ｎｅｍａｔｉｃ）モード、ＩＰＳ（Ｉ
ｎ−Ｐｌａｎｅ−Ｓｗｉｔｃｈｉｎｇ）モード、ＦＦＳ（Ｆｒｉｎｇｅ Ｆｉｅｌｄ Ｓ
ｗｉｔｃｈｉｎｇ）モード、ＭＶＡ（Ｍｕｌｔｉ−ｄｏｍａｉｎ Ｖｅｒｔｉｃａｌ Ａ
ｌｉｇｎｍｅｎｔ）モード、ＰＶＡ（Ｐａｔｔｅｒｎｅｄ Ｖｅｒｔｉｃａｌ Ａｌｉｇ
ｎｍｅｎｔ）モード、ＡＳＭ（Ａｘｉａｌｌｙ Ｓｙｍｍｅｔｒｉｃ ａｌｉｇｎｅｄ
Ｍｉｃｒｏ−ｃｅｌｌ）モード、ＯＣＢ（Ｏｐｔｉｃａｌ Ｃｏｍｐｅｎｓａｔｅｄ Ｂ
ｉｒｅｆｒｉｎｇｅｎｃｅ）モード、ＦＬＣ（Ｆｅｒｒｏｅｌｅｃｔｒｉｃ Ｌｉｑｕｉ
ｄ Ｃｒｙｓｔａｌ）モード、ＡＦＬＣ（ＡｎｔｉＦｅｒｒｏｅｌｅｃｔｒｉｃ Ｌｉｑ
ｕｉｄ Ｃｒｙｓｔａｌ）モードなどを用いることができる。
【０２６９】
以上の工程により、半導体装置として信頼性の高い液晶表示パネルを作製することができ
る。
【０２７０】
本実施の形態は、他の実施の形態に記載した構成と適宜組み合わせて実施することが可能
である。
【０２７１】
（実施の形態６）
半導体装置として電子ペーパーの例を示す。
【０２７２】
スイッチング素子と電気的に接続する素子を利用して電子インクを駆動させる電子ペーパ
ーに用いてもよい。
【０２７３】
電子ペーパーは、電気泳動表示装置（電気泳動ディスプレイ）も呼ばれており、紙と同じ
読みやすさ、他の表示装置に比べ低消費電力、薄くて軽い形状とすることが可能という利
点を有している。
【０２７４】
電気泳動ディスプレイは、様々な形態が考えられ得るが、プラスの電荷を有する第１の粒
子と、マイナスの電荷を有する第２の粒子とを含むマイクロカプセルが溶媒または溶質に
複数分散されたものであり、マイクロカプセルに電界を印加することによって、マイクロ
カプセル中の粒子を互いに反対方向に移動させて一方側に集合した粒子の色のみを表示す
るものである。なお、第１の粒子または第２の粒子は染料を含み、電界がない場合におい
て移動しないものである。また、第１の粒子の色と第２の粒子の色は異なるもの（無色を
含む）とする。
【０２７５】
このように、電気泳動ディスプレイは、誘電定数の高い物質が高い電界領域に移動する、
いわゆる誘電泳動的効果を利用したディスプレイである。
【０２７６】
上記マイクロカプセルを溶媒中に分散させたものが電子インクと呼ばれるものであり、こ
の電子インクはガラス、プラスチック、布、紙などの表面に印刷することができる。また
、カラーフィルタや色素を有する粒子を用いることによってカラー表示も可能である。
【０２７７】
また、アクティブマトリクス基板上に適宜、二つの電極の間に挟まれるように上記マイク
ロカプセルを複数配置すればアクティブマトリクス型の表示装置が完成し、マイクロカプ
セルに電界を印加すれば表示を行うことができる。例えば、実施の形態１乃至３の薄膜ト
ランジスタによって得られるアクティブマトリクス基板を用いることができる。
【０２７８】
なお、マイクロカプセル中の第１の粒子および第２の粒子は、導電体材料、絶縁体材料、
半導体材料、磁性材料、液晶材料、強誘電性材料、エレクトロルミネセント材料、エレク
トロクロミック材料、磁気泳動材料から選ばれた一種の材料、またはこれらの複合材料を
用いればよい。
【０２７９】
図１５は、半導体装置の例としてアクティブマトリクス型の電子ペーパーを示す。半導体
装置に用いられる薄膜トランジスタ５８１としては、実施の形態１で示す薄膜トランジス
タと同様に作製でき、酸化物半導体層を含む信頼性の高い薄膜トランジスタである。また
、実施の形態２又は実施の形態３で示す薄膜トランジスタも本実施の薄膜トランジスタ５
８１として適用することもできる。
【０２８０】
図１５の電子ペーパーは、ツイストボール表示方式を用いた表示装置の例である。ツイス
トボール表示方式とは、白と黒に塗り分けられた球形粒子を表示素子に用いる電極層であ
る第１の電極層及び第２の電極層の間に配置し、第１の電極層及び第２の電極層に電位差
を生じさせての球形粒子の向きを制御することにより、表示を行う方法である。
【０２８１】
薄膜トランジスタ５８１はボトムゲート構造の薄膜トランジスタであり、半導体層と接す
る絶縁膜５８３に覆われている。薄膜トランジスタ５８１のソース電極層又はドレイン電
極層は、第１の電極層５８７と、絶縁膜５８３及び絶縁層５８５に形成する開口で接して
おり電気的に接続している。第１の電極層５８７と第２の電極層５８８との間には黒色領
域５９０ａ及び白色領域５９０ｂを有し、周りに液体で満たされているキャビティ５９４
を含む球形粒子５８９が設けられており、球形粒子５８９の周囲は樹脂等の充填材５９５
で充填されている（図１５参照。）。第１の電極層５８７が画素電極に相当し、第２の電
極層５８８が共通電極に相当する。第２の電極層５８８は、薄膜トランジスタ５８１と同
一の基板５８０上に設けられる共通電位線と電気的に接続される。共通接続部を用いて、
基板５８０と基板５９６の間に配置される導電性粒子を介して第２の電極層５８８と共通
電位線とを電気的に接続することができる。
【０２８２】
また、ツイストボールの代わりに、電気泳動素子を用いることも可能である。透明な液体
と、正に帯電した白い微粒子と負に帯電した黒い微粒子とを封入した直径１０μｍ〜２０
０μｍ程度のマイクロカプセルを用いる。第１の電極層と第２の電極層との間に設けられ
るマイクロカプセルは、第１の電極層と第２の電極層によって、電場が与えられると、白
い微粒子と、黒い微粒子が逆の方向に移動し、白または黒を表示することができる。この
原理を応用した表示素子が電気泳動表示素子であり、一般的に電子ペーパーとよばれてい
る。電気泳動表示素子は、液晶表示素子に比べて反射率が高いため、補助ライトは不要で
あり、また消費電力が小さく、薄暗い場所でも表示部を認識することが可能である。また
、表示部に電源が供給されない場合であっても、一度表示した像を保持することが可能で
あるため、電波発信源から表示機能付き半導体装置（単に表示装置、又は表示装置を具備
する半導体装置ともいう）を遠ざけた場合であっても、表示された像を保存しておくこと
が可能となる。
【０２８３】
以上の工程により、半導体装置として信頼性の高い電子ペーパーを作製することができる
。
【０２８４】
本実施の形態は、他の実施の形態に記載した構成と適宜組み合わせて実施することが可能
である。
【０２８５】
（実施の形態７）
半導体装置として発光表示装置の例を示す。表示装置の有する表示素子としては、ここで
はエレクトロルミネッセンスを利用する発光素子を用いて示す。エレクトロルミネッセン
スを利用する発光素子は、発光材料が有機化合物であるか、無機化合物であるかによって
区別され、一般的に、前者は有機ＥＬ素子、後者は無機ＥＬ素子と呼ばれている。
【０２８６】
有機ＥＬ素子は、発光素子に電圧を印加することにより、一対の電極から電子および正孔
がそれぞれ発光性の有機化合物を含む層に注入され、電流が流れる。そして、それらキャ
リア（電子および正孔）が再結合することにより、発光性の有機化合物が励起状態を形成
し、その励起状態が基底状態に戻る際に発光する。このようなメカニズムから、このよう
な発光素子は、電流励起型の発光素子と呼ばれる。
【０２８７】
無機ＥＬ素子は、その素子構成により、分散型無機ＥＬ素子と薄膜型無機ＥＬ素子とに分
類される。分散型無機ＥＬ素子は、発光材料の粒子をバインダ中に分散させた発光層を有
するものであり、発光メカニズムはドナー準位とアクセプター準位を利用するドナー−ア
クセプター再結合型発光である。薄膜型無機ＥＬ素子は、発光層を誘電体層で挟み込み、
さらにそれを電極で挟んだ構造であり、発光メカニズムは金属イオンの内殻電子遷移を利
用する局在型発光である。なお、ここでは、発光素子として有機ＥＬ素子を用いて説明す
る。
【０２８８】
図１８は、半導体装置の例としてデジタル時間階調駆動を適用可能な画素構成の一例を示
す図である。
【０２８９】
デジタル時間階調駆動を適用可能な画素の構成及び画素の動作について説明する。ここで
は酸化物半導体層をチャネル形成領域に用いるｎチャネル型のトランジスタを１つの画素
に２つ用いる例を示す。
【０２９０】
画素６４００は、スイッチング用トランジスタ６４０１、駆動用トランジスタ６４０２、
発光素子６４０４及び容量素子６４０３を有している。スイッチング用トランジスタ６４
０１はゲートが走査線６４０６に接続され、第１電極（ソース電極及びドレイン電極の一
方）が信号線６４０５に接続され、第２電極（ソース電極及びドレイン電極の他方）が駆
動用トランジスタ６４０２のゲートに接続されている。駆動用トランジスタ６４０２は、
ゲートが容量素子６４０３を介して電源線６４０７に接続され、第１電極が電源線６４０
７に接続され、第２電極が発光素子６４０４の第１電極（画素電極）に接続されている。
発光素子６４０４の第２電極は共通電極６４０８に相当する。共通電極６４０８は、同一
基板上に形成される共通電位線と電気的に接続される。
【０２９１】
なお、発光素子６４０４の第２電極（共通電極６４０８）には低電源電位が設定されてい
る。なお、低電源電位とは、電源線６４０７に設定される高電源電位を基準にして低電源
電位＜高電源電位を満たす電位であり、低電源電位としては例えばＧＮＤ、０Ｖなどが設
定されていても良い。この高電源電位と低電源電位との電位差を発光素子６４０４に印加
して、発光素子６４０４に電流を流して発光素子６４０４を発光させるため、高電源電位
と低電源電位との電位差が発光素子６４０４の順方向しきい値電圧以上となるようにそれ
ぞれの電位を設定する。
【０２９２】
なお、容量素子６４０３は駆動用トランジスタ６４０２のゲート容量を代用して省略する
ことも可能である。駆動用トランジスタ６４０２のゲート容量については、チャネル領域
とゲート電極との間で容量が形成されていてもよい。
【０２９３】
ここで、電圧入力電圧駆動方式の場合には、駆動用トランジスタ６４０２のゲートには、
駆動用トランジスタ６４０２が十分にオンするか、オフするかの二つの状態となるような
ビデオ信号を入力する。つまり、駆動用トランジスタ６４０２は線形領域で動作させる。
駆動用トランジスタ６４０２は線形領域で動作させるため、電源線６４０７の電圧よりも
高い電圧を駆動用トランジスタ６４０２のゲートにかける。なお、信号線６４０５には、
（電源線電圧＋駆動用トランジスタ６４０２のＶｔｈ）以上の電圧をかける。
【０２９４】
また、デジタル時間階調駆動に代えて、アナログ階調駆動を行う場合、信号の入力を異な
らせることで、図１８と同じ画素構成を用いることができる。
【０２９５】
アナログ階調駆動を行う場合、駆動用トランジスタ６４０２のゲートに発光素子６４０４
の順方向電圧＋駆動用トランジスタ６４０２のＶｔｈ以上の電圧をかける。発光素子６４
０４の順方向電圧とは、所望の輝度とする場合の電圧を指しており、少なくとも順方向し
きい値電圧を含む。なお、駆動用トランジスタ６４０２が飽和領域で動作するようなビデ
オ信号を入力することで、発光素子６４０４に電流を流すことができる。駆動用トランジ
スタ６４０２を飽和領域で動作させるため、電源線６４０７の電位は、駆動用トランジス
タ６４０２のゲート電位よりも高くする。ビデオ信号をアナログとすることで、発光素子
６４０４にビデオ信号に応じた電流を流し、アナログ階調駆動を行うことができる。
【０２９６】
なお、図１８に示す画素構成は、これに限定されない。例えば、図１８に示す画素に新た
にスイッチ、抵抗素子、容量素子、トランジスタ又は論理回路などを追加してもよい。
【０２９７】
次に、発光素子の構成について、図１９を用いて説明する。ここでは、駆動用ＴＦＴがｎ
型の場合を例に挙げて、画素の断面構造について説明する。図１９（Ａ）（Ｂ）（Ｃ）の
半導体装置に用いられる駆動用ＴＦＴであるＴＦＴ７００１、７０１１、７０２１は、実
施の形態１で示す薄膜トランジスタと同様に作製でき、酸化物半導体層を含む信頼性の高
い薄膜トランジスタである。また、実施の形態２又は実施の形態３で示す薄膜トランジス
タをＴＦＴ７００１、７０１１、７０２１として適用することもできる。
【０２９８】
発光素子は発光を取り出すために少なくとも陽極又は陰極の一方が透明であればよい。そ
して、基板上に薄膜トランジスタ及び発光素子を形成し、基板とは逆側の面から発光を取
り出す上面射出や、基板側の面から発光を取り出す下面射出や、基板側及び基板とは反対
側の面から発光を取り出す両面射出構造の発光素子があり、画素構成はどの射出構造の発
光素子にも適用することができる。
【０２９９】
上面射出構造の発光素子について図１９（Ａ）を用いて説明する。
【０３００】
図１９（Ａ）に、駆動用ＴＦＴであるＴＦＴ７００１がｎ型で、発光素子７００２から発
せられる光が陽極７００５側に抜ける場合の、画素の断面図を示す。図１９（Ａ）では、
発光素子７００２の陰極７００３と駆動用ＴＦＴであるＴＦＴ７００１が電気的に接続さ
れており、陰極７００３上に発光層７００４、陽極７００５が順に積層されている。陰極
７００３は仕事関数が小さく、なおかつ光を反射する導電膜であれば様々の材料を用いる
ことができる。例えば、Ｃａ、Ａｌ、ＭｇＡｇ、ＡｌＬｉ等が望ましい。そして発光層７
００４は、単数の層で構成されていても、複数の層が積層されるように構成されていても
どちらでも良い。複数の層で構成されている場合、陰極７００３上に電子注入層、電子輸
送層、発光層、ホール輸送層、ホール注入層の順に積層する。なおこれらの層を全て設け
る必要はない。陽極７００５は光を透過する透光性を有する導電性材料を用いて形成し、
例えば酸化タングステンを含むインジウム酸化物、酸化タングステンを含むインジウム亜
鉛酸化物、酸化チタンを含むインジウム酸化物、酸化チタンを含むインジウム錫酸化物、
インジウム錫酸化物（以下、ＩＴＯと示す。）、インジウム亜鉛酸化物、酸化ケイ素を添
加したインジウム錫酸化物などの透光性を有する導電膜を用いても良い。
【０３０１】
陰極７００３及び陽極７００５で発光層７００４を挟んでいる領域が発光素子７００２に
相当する。図１９（Ａ）に示した画素の場合、発光素子７００２から発せられる光は、矢
印で示すように陽極７００５側に射出する。
【０３０２】
次に、下面射出構造の発光素子について図１９（Ｂ）を用いて説明する。駆動用ＴＦＴ７
０１１がｎ型で、発光素子７０１２から発せられる光が陰極７０１３側に射出する場合の
、画素の断面図を示す。図１９（Ｂ）では、駆動用ＴＦＴ７０１１と電気的に接続された
透光性を有する導電膜７０１７上に、発光素子７０１２の陰極７０１３が成膜されており
、陰極７０１３上に発光層７０１４、陽極７０１５が順に積層されている。なお、陽極７
０１５が透光性を有する場合、陽極上を覆うように、光を反射または遮蔽するための遮蔽
膜７０１６が成膜されていてもよい。陰極７０１３は、図１９（Ａ）の場合と同様に、仕
事関数が小さい導電性材料であれば様々な材料を用いることができる。ただしその膜厚は
、光を透過する程度（好ましくは、５ｎｍ〜３０ｎｍ程度）とする。例えば２０ｎｍの膜
厚を有するアルミニウム膜を、陰極７０１３として用いることができる。そして発光層７
０１４は、図１９（Ａ）と同様に、単数の層で構成されていても、複数の層が積層される
ように構成されていてもどちらでも良い。陽極７０１５は光を透過する必要はないが、図
１９（Ａ）と同様に、透光性を有する導電性材料を用いて形成することができる。そして
遮蔽膜７０１６は、例えば光を反射する金属等を用いることができるが、金属膜に限定さ
れない。例えば黒の顔料を添加した樹脂等を用いることもできる。
【０３０３】
陰極７０１３及び陽極７０１５で、発光層７０１４を挟んでいる領域が発光素子７０１２
に相当する。図１９（Ｂ）に示した画素の場合、発光素子７０１２から発せられる光は、
矢印で示すように陰極７０１３側に射出する。
【０３０４】
次に、両面射出構造の発光素子について、図１９（Ｃ）を用いて説明する。図１９（Ｃ）
では、駆動用ＴＦＴ７０２１と電気的に接続された透光性を有する導電膜７０２７上に、
発光素子７０２２の陰極７０２３が成膜されており、陰極７０２３上に発光層７０２４、
陽極７０２５が順に積層されている。陰極７０２３は、図１９（Ａ）の場合と同様に、仕
事関数が小さい導電性材料であれば様々な材料を用いることができる。ただしその膜厚は
、光を透過する程度とする。例えば２０ｎｍの膜厚を有するＡｌを、陰極７０２３として
用いることができる。そして発光層７０２４は、図１９（Ａ）と同様に、単数の層で構成
されていても、複数の層が積層されるように構成されていてもどちらでも良い。陽極７０
２５は、図１９（Ａ）と同様に、光を透過する透光性を有する導電性材料を用いて形成す
ることができる。
【０３０５】
陰極７０２３と、発光層７０２４と、陽極７０２５とが重なっている部分が発光素子７０
２２に相当する。図１９（Ｃ）に示した画素の場合、発光素子７０２２から発せられる光
は、矢印で示すように陽極７０２５側と陰極７０２３側の両方に射出する。
【０３０６】
なお、ここでは、発光素子として有機ＥＬ素子について述べたが、発光素子として無機Ｅ
Ｌ素子を設けることも可能である。
【０３０７】
なお、発光素子の駆動を制御する薄膜トランジスタ（駆動用ＴＦＴ）と発光素子が電気的
に接続されている例を示したが、駆動用ＴＦＴと発光素子との間に電流制御用ＴＦＴが接
続されている構成であってもよい。
【０３０８】
なお半導体装置は、図１９に示した構成に限定されるものではなく、本明細書に開示する
技術的思想に基づく各種の変形が可能である。
【０３０９】
次に、半導体装置の一形態に相当する発光表示パネル（発光パネルともいう）の外観及び
断面について、図１７（Ａ）を用いて説明する。図１７は、第１の基板上に形成された薄
膜トランジスタ及び発光素子を、第２の基板との間にシール材によって封止した、パネル
の平面図であり、図１７（Ｂ）は、図１７（Ａ）のＨ−Ｉにおける断面図に相当する。
【０３１０】
第１の基板４５０１上に設けられた画素部４５０２、信号線駆動回路４５０３ａ、４５０
３ｂ、及び走査線駆動回路４５０４ａ、４５０４ｂを囲むようにして、シール材４５０５
が設けられている。また画素部４５０２、信号線駆動回路４５０３ａ、４５０３ｂ、及び
走査線駆動回路４５０４ａ、４５０４ｂの上に第２の基板４５０６が設けられている。よ
って画素部４５０２、信号線駆動回路４５０３ａ、４５０３ｂ、及び走査線駆動回路４５
０４ａ、４５０４ｂは、第１の基板４５０１とシール材４５０５と第２の基板４５０６と
によって、充填材４５０７と共に密封されている。このように外気に曝されないように気
密性が高く、脱ガスの少ない保護フィルム（貼り合わせフィルム、紫外線硬化樹脂フィル
ム等）やカバー材でパッケージング（封入）することが好ましい。
【０３１１】
また第１の基板４５０１上に設けられた画素部４５０２、信号線駆動回路４５０３ａ、４
５０３ｂ、及び走査線駆動回路４５０４ａ、４５０４ｂは、薄膜トランジスタを複数有し
ており、図１７（Ｂ）では、画素部４５０２に含まれる薄膜トランジスタ４５１０と、信
号線駆動回路４５０３ａに含まれる薄膜トランジスタ４５０９とを例示している。
【０３１２】
薄膜トランジスタ４５０９、４５１０は、実施の形態３で示した酸化物半導体層を含む信
頼性の高い薄膜トランジスタを適用することができる。また実施の形態１又は実施の形態
２に示す薄膜トランジスタを適用してもよい。薄膜トランジスタ４５０９、４５１０はｎ
チャネル型薄膜トランジスタである。
【０３１３】
また４５１１は発光素子に相当し、発光素子４５１１が有する画素電極である第１の電極
層４５１７は、薄膜トランジスタ４５１０のソース電極層またはドレイン電極層と電気的
に接続されている。なお発光素子４５１１の構成は、第１の電極層４５１７、電界発光層
４５１２、第２の電極層４５１３の積層構造であるが、示した構成に限定されない。発光
素子４５１１から取り出す光の方向などに合わせて、発光素子４５１１の構成は適宜変え
ることができる。
【０３１４】
隔壁４５２０は、有機樹脂膜、無機絶縁膜または有機ポリシロキサンを用いて形成する。
特に感光性の材料を用い、第１の電極層４５１７上に開口部を形成し、その開口部の側壁
が連続した曲率を持って形成される傾斜面となるように形成することが好ましい。
【０３１５】
電界発光層４５１２は、単数の層で構成されていても、複数の層が積層されるように構成
されていてもどちらでも良い。
【０３１６】
発光素子４５１１に酸素、水素、水分、二酸化炭素等が侵入しないように、第２の電極層
４５１３及び隔壁４５２０上に保護膜を形成してもよい。保護膜としては、窒化珪素膜、
窒化酸化珪素膜、ＤＬＣ膜等を形成することができる。
【０３１７】
また、信号線駆動回路４５０３ａ、４５０３ｂ、走査線駆動回路４５０４ａ、４５０４ｂ
、または画素部４５０２に与えられる各種信号及び電位は、ＦＰＣ４５１８ａ、４５１８
ｂから供給されている。
【０３１８】
接続端子電極４５１５が、発光素子４５１１が有する第１の電極層４５１７と同じ導電膜
から形成され、端子電極４５１６は、薄膜トランジスタ４５０９、４５１０が有するソー
ス電極層及びドレイン電極層と同じ導電膜から形成されている。
【０３１９】
接続端子電極４５１５は、ＦＰＣ４５１８ａが有する端子と、異方性導電膜４５１９を介
して電気的に接続されている。
【０３２０】
発光素子４５１１からの光の取り出し方向に位置する第２の基板４５０６は透光性でなけ
ればならない。その場合には、ガラス板、プラスチック板、ポリエステルフィルムまたは
アクリルフィルムのような透光性を有する材料を用いる。
【０３２１】
また、充填材４５０７としては窒素やアルゴンなどの不活性な気体の他に、紫外線硬化樹
脂または熱硬化樹脂を用いることができ、ＰＶＣ（ポリビニルクロライド）、アクリル、
ポリイミド、エポキシ樹脂、シリコーン樹脂、ＰＶＢ（ポリビニルブチラル）またはＥＶ
Ａ（エチレンビニルアセテート）を用いることができる。例えば充填材として窒素を用い
ればよい。
【０３２２】
また、必要であれば、発光素子の射出面に偏光板、又は円偏光板（楕円偏光板を含む）、
位相差板（λ／４板、λ／２板）、カラーフィルタなどの光学フィルムを適宜設けてもよ
い。また、偏光板又は円偏光板に反射防止膜を設けてもよい。例えば、表面の凹凸により
反射光を拡散し、映り込みを低減できるアンチグレア処理を施すことができる。
【０３２３】
信号線駆動回路４５０３ａ、４５０３ｂ、及び走査線駆動回路４５０４ａ、４５０４ｂは
、別途用意された基板上に単結晶半導体膜又は多結晶半導体膜によって形成された駆動回
路で実装されていてもよい。また、信号線駆動回路のみ、或いは一部、又は走査線駆動回
路のみ、或いは一部のみを別途形成して実装しても良く、図１７の構成に限定されない。
【０３２４】
以上の工程により、半導体装置として信頼性の高い発光表示装置（表示パネル）を作製す
ることができる。
【０３２５】
本実施の形態は、他の実施の形態に記載した構成と適宜組み合わせて実施することが可能
である。
【０３２６】
（実施の形態８）
本明細書に開示する半導体装置は、電子ペーパーとして適用することができる。電子ペー
パーは、情報を表示するものであればあらゆる分野の電子機器に用いることが可能である
。例えば、電子ペーパーを用いて、電子書籍（電子ブック）、ポスター、電車などの乗り
物の車内広告、クレジットカード等の各種カードにおける表示等に適用することができる
。電子機器の一例を図２７に示す。
【０３２７】
図２７は、電子書籍２７００の一例を示している。例えば、電子書籍２７００は、筐体２
７０１および筐体２７０３の２つの筐体で構成されている。筐体２７０１および筐体２７
０３は、軸部２７１１により一体とされており、該軸部２７１１を軸として開閉動作を行
うことができる。このような構成により、紙の書籍のような動作を行うことが可能となる
。
【０３２８】
筐体２７０１には表示部２７０５が組み込まれ、筐体２７０３には表示部２７０７が組み
込まれている。表示部２７０５および表示部２７０７は、続き画面を表示する構成として
もよいし、異なる画面を表示する構成としてもよい。異なる画面を表示する構成とするこ
とで、例えば右側の表示部（図２７では表示部２７０５）に文章を表示し、左側の表示部
（図２７では表示部２７０７）に画像を表示することができる。
【０３２９】
また、図２７では、筐体２７０１に操作部などを備えた例を示している。例えば、筐体２
７０１において、電源２７２１、操作キー２７２３、スピーカ２７２５などを備えている
。操作キー２７２３により、頁を送ることができる。なお、筐体の表示部と同一面にキー
ボードやポインティングデバイスなどを備える構成としてもよい。また、筐体の裏面や側
面に、外部接続用端子（イヤホン端子、ＵＳＢ端子、またはＡＣアダプタおよびＵＳＢケ
ーブルなどの各種ケーブルと接続可能な端子など）、記録媒体挿入部などを備える構成と
してもよい。さらに、電子書籍２７００は、電子辞書としての機能を持たせた構成として
もよい。
【０３３０】
また、電子書籍２７００は、無線で情報を送受信できる構成としてもよい。無線により、
電子書籍サーバから、所望の書籍データなどを購入し、ダウンロードする構成とすること
も可能である。
【０３３１】
（実施の形態９）
本明細書に開示する半導体装置は、さまざまな電子機器（遊技機も含む）に適用すること
ができる。電子機器としては、例えば、テレビジョン装置（テレビ、またはテレビジョン
受信機ともいう）、コンピュータ用などのモニタ、デジタルカメラ、デジタルビデオカメ
ラ、デジタルフォトフレーム、携帯電話機（携帯電話、携帯電話装置ともいう）、携帯型
ゲーム機、携帯情報端末、音響再生装置、パチンコ機などの大型ゲーム機などが挙げられ
る。
【０３３２】
図２８（Ａ）は、テレビジョン装置９６００の一例を示している。テレビジョン装置９６
００は、筐体９６０１に表示部９６０３が組み込まれている。表示部９６０３により、映
像を表示することが可能である。また、ここでは、スタンド９６０５により筐体９６０１
を支持した構成を示している。
【０３３３】
テレビジョン装置９６００の操作は、筐体９６０１が備える操作スイッチや、別体のリモ
コン操作機９６１０により行うことができる。リモコン操作機９６１０が備える操作キー
９６０９により、チャンネルや音量の操作を行うことができ、表示部９６０３に表示され
る映像を操作することができる。また、リモコン操作機９６１０に、当該リモコン操作機
９６１０から出力する情報を表示する表示部９６０７を設ける構成としてもよい。
【０３３４】
なお、テレビジョン装置９６００は、受信機やモデムなどを備えた構成とする。受信機に
より一般のテレビ放送の受信を行うことができ、さらにモデムを介して有線または無線に
よる通信ネットワークに接続することにより、一方向（送信者から受信者）または双方向
（送信者と受信者間、あるいは受信者間同士など）の情報通信を行うことも可能である。
【０３３５】
図２８（Ｂ）は、デジタルフォトフレーム９７００の一例を示している。例えば、デジタ
ルフォトフレーム９７００は、筐体９７０１に表示部９７０３が組み込まれている。表示
部９７０３は、各種画像を表示することが可能であり、例えばデジタルカメラなどで撮影
した画像データを表示させることで、通常の写真立てと同様に機能させることができる。
【０３３６】
なお、デジタルフォトフレーム９７００は、操作部、外部接続用端子（ＵＳＢ端子、ＵＳ
Ｂケーブルなどの各種ケーブルと接続可能な端子など）、記録媒体挿入部などを備える構
成とする。これらの構成は、表示部と同一面に組み込まれていてもよいが、側面や裏面に
備えるとデザイン性が向上するため好ましい。例えば、デジタルフォトフレームの記録媒
体挿入部に、デジタルカメラで撮影した画像データを記憶したメモリを挿入して画像デー
タを取り込み、取り込んだ画像データを表示部９７０３に表示させることができる。
【０３３７】
また、デジタルフォトフレーム９７００は、無線で情報を送受信できる構成としてもよい
。無線により、所望の画像データを取り込み、表示させる構成とすることもできる。
【０３３８】
図２９（Ａ）は携帯型遊技機であり、筐体９８８１と筐体９８９１の２つの筐体で構成さ
れており、連結部９８９３により、開閉可能に連結されている。筐体９８８１には表示部
９８８２が組み込まれ、筐体９８９１には表示部９８８３が組み込まれている。また、図
２９（Ａ）に示す携帯型遊技機は、その他、スピーカ部９８８４、記録媒体挿入部９８８
６、ＬＥＤランプ９８９０、入力手段（操作キー９８８５、接続端子９８８７、センサ９
８８８（力、変位、位置、速度、加速度、角速度、回転数、距離、光、液、磁気、温度、
化学物質、音声、時間、硬度、電場、電流、電圧、電力、放射線、流量、湿度、傾度、振
動、におい又は赤外線を測定する機能を含むもの）、マイクロフォン９８８９）等を備え
ている。もちろん、携帯型遊技機の構成は上述のものに限定されず、少なくとも本明細書
に開示する半導体装置を備えた構成であればよく、その他付属設備が適宜設けられた構成
とすることができる。図２９（Ａ）に示す携帯型遊技機は、記録媒体に記録されているプ
ログラム又はデータを読み出して表示部に表示する機能や、他の携帯型遊技機と無線通信
を行って情報を共有する機能を有する。なお、図２９（Ａ）に示す携帯型遊技機が有する
機能はこれに限定されず、様々な機能を有することができる。
【０３３９】
図２９（Ｂ）は大型遊技機であるスロットマシン９９００の一例を示している。スロット
マシン９９００は、筐体９９０１に表示部９９０３が組み込まれている。また、スロット
マシン９９００は、その他、スタートレバーやストップスイッチなどの操作手段、コイン
投入口、スピーカなどを備えている。もちろん、スロットマシン９９００の構成は上述の
ものに限定されず、少なくとも本明細書に開示する半導体装置を備えた構成であればよく
、その他付属設備が適宜設けられた構成とすることができる。
【０３４０】
図３０（Ａ）は携帯型のコンピュータの一例を示す斜視図である。
【０３４１】
図３０（Ａ）の携帯型のコンピュータは、上部筐体９３０１と下部筐体９３０２とを接続
するヒンジユニットを閉状態として表示部９３０３を有する上部筐体９３０１と、キーボ
ード９３０４を有する下部筐体９３０２とを重ねた状態とすることができ、持ち運ぶこと
が便利であるとともに、使用者がキーボード入力する場合には、ヒンジユニットを開状態
として、表示部９３０３を見て入力操作を行うことができる。
【０３４２】
また、下部筐体９３０２はキーボード９３０４の他に入力操作を行うポインティングデバ
イス９３０６を有する。また、表示部９３０３をタッチ入力パネルとすれば、表示部の一
部に触れることで入力操作を行うこともできる。また、下部筐体９３０２はＣＰＵやハー
ドディスク等の演算機能部を有している。また、下部筐体９３０２は他の機器、例えばＵ
ＳＢの通信規格に準拠した通信ケーブルが差し込まれる外部接続ポート９３０５を有して
いる。
【０３４３】
上部筐体９３０１には更に上部筐体９３０１内部にスライドさせて収納可能な表示部９３
０７を有しており、広い表示画面を実現することができる。また、収納可能な表示部９３
０７の画面の向きを使用者は調節できる。また、収納可能な表示部９３０７をタッチ入力
パネルとすれば、収納可能な表示部の一部に触れることで入力操作を行うこともできる。
【０３４４】
表示部９３０３または収納可能な表示部９３０７は、液晶表示パネル、有機発光素子また
は無機発光素子などの発光表示パネルなどの映像表示装置を用いる。
【０３４５】
また、図３０（Ａ）の携帯型のコンピュータは、受信機などを備えた構成として、テレビ
放送を受信して映像を表示部または表示部に表示することができる。また、上部筐体９３
０１と下部筐体９３０２とを接続するヒンジユニットを閉状態としたまま、表示部９３０
７をスライドさせて画面全面を露出させ、画面角度を調節して使用者がテレビ放送を見る
こともできる。この場合には、ヒンジユニットを開状態として表示部９３０３を表示させ
ず、さらにテレビ放送を表示するだけの回路の起動のみを行うため、最小限の消費電力と
することができ、バッテリー容量の限られている携帯型のコンピュータにおいて有用であ
る。
【０３４６】
また、図３０（Ｂ）は、腕時計のように使用者の腕に装着可能な形態を有している携帯電
話の一例を示す斜視図である。
【０３４７】
この携帯電話は、少なくとも電話機能を有する通信装置及びバッテリーを有する本体、本
体を腕に装着するためのバンド部、腕に対するバンド部の固定状態を調節する調節部９２
０５、表示部９２０１、スピーカ９２０７、及びマイク９２０８から構成されている。
【０３４８】
また、本体は、操作スイッチ９２０３を有し、電源入力スイッチや、表示切り替えスイッ
チや、撮像開始指示スイッチの他、例えば押すとインタネット用のプログラムが起動され
るスイッチなど、各ファンクションを対応づけることができる。
【０３４９】
この携帯電話の入力操作は、表示部９２０１に指や入力ペンなどで触れること、又は操作
スイッチ９２０３の操作、またはマイク９２０８への音声入力により行われる。なお、図
３０（Ｂ）では、表示部９２０１に表示された表示ボタン９２０２を図示しており、指な
どで触れることにより入力を行うことができる。
【０３５０】
また、本体は、撮影レンズを通して結像される被写体像を電子画像信号に変換する撮像手
段を有するカメラ部９２０６を有する。なお、特にカメラ部は設けなくともよい。
【０３５１】
また、図３０（Ｂ）に示す携帯電話は、テレビ放送の受信機などを備えた構成として、テ
レビ放送を受信して映像を表示部９２０１に表示することができ、さらにメモリーなどの
記憶装置などを備えた構成として、テレビ放送をメモリーに録画できる。また、図３０（
Ｂ）に示す携帯電話は、ＧＰＳなどの位置情報を収集できる機能を有していてもよい。
【０３５２】
表示部９２０１は、液晶表示パネル、有機発光素子または無機発光素子などの発光表示パ
ネルなどの映像表示装置を用いる。図３０（Ｂ）に示す携帯電話は、小型、且つ、軽量で
あるため、バッテリー容量の限られており、表示部９２０１に用いる表示装置は低消費電
力で駆動できるパネルを用いることが好ましい。
【０３５３】
なお、図３０（Ｂ）では”腕”に装着するタイプの電子機器を図示したが、特に限定され
ず、携行できる形状を有しているものであればよい。
【０３５４】
（実施の形態１０）
本実施の形態では、実施の形態１と一部工程が異なる一例を示す。本実施の形態は、ソー
ス電極層又はドレイン電極層４０５ａ、４０５ｂの形成後に脱水化または脱水素化の加熱
処理を行う例を図３１に示す。なお、図６と同一の部分には同じ符号を用いて説明する。
【０３５５】
実施の形態１と同様に、絶縁表面を有する基板４００上にゲート電極層４０１、ゲート絶
縁層４０２、酸化物半導体層４３０を形成する（図３１（Ａ）参照。）。
【０３５６】
酸化物半導体層４３０上にソース電極層又はドレイン電極層４０５ａ、４０５ｂを形成し
、酸化物半導体層４３０の一部エッチングして酸化物半導体層４４１を形成する（図３１
（Ｂ）参照。）。
【０３５７】
次に酸化物半導体層４４１、及びソース電極層又はドレイン電極層４０５ａ、４０５ｂに
対して不活性ガス雰囲気（窒素、またはヘリウム、ネオン、アルゴン等）下或いは減圧下
において加熱処理及び徐冷を行う。この加熱処理によって酸化物半導体層４４１は脱水処
理または脱水素処理が行われて低抵抗化され、低抵抗化した酸化物半導体層４３２とする
ことができる（図３１（Ｃ）参照。）。なお、ソース電極層又はドレイン電極層４０５ａ
、４０５ｂの材料は、ここでの加熱処理に耐える材料、例えばタングステン、モリブデン
などを用いることが好ましい。
【０３５８】
次いで、上記加熱処理及び徐冷後に大気に触れることなく、酸化物半導体層４３２に接し
てスパッタ法またはＰＣＶＤ法による酸化物絶縁膜４０７として形成する。低抵抗化した
酸化物半導体層４３２に接してスパッタ法またはＰＣＶＤ法により酸化物絶縁膜４０７を
形成すると、低抵抗化した酸化物半導体層４３２において少なくとも酸化物絶縁膜４０７
と接する領域を高抵抗化（キャリア濃度が低まる、好ましくは１×１０^１８／ｃｍ^３未満
、さらに好ましくは１×１０^１４／ｃｍ^３以下）し、高抵抗化酸化物半導体領域とするこ
とができる。よって酸化物半導体層４３２は、高抵抗化酸化物半導体領域を有する半導体
層４０３（第３の酸化物半導体層）となり、薄膜トランジスタ４７０を作製することがで
きる（図３１（Ｄ）参照。）。
【０３５９】
上記脱水処理または脱水素処理のための加熱処理を行うことによって酸化物半導体層に含
まれる不純物（Ｈ_２Ｏ、Ｈ、ＯＨなど）を低減してキャリア濃度を増加させた後、徐冷を
行う。徐冷させた後、酸化物半導体層に接して酸化物絶縁膜の形成などを行って酸化物半
導体層のキャリア濃度を低減し、薄膜トランジスタ４７０の信頼性を向上することができ
る。
【０３６０】
また、本実施の形態は、実施の形態１と自由に組み合わせることができる。
【０３６１】
（実施の形態１１）
半導体装置及び半導体装置の作製方法を、図３２を用いて説明する。実施の形態１と同一
部分又は同様な機能を有する部分、及び工程は、実施の形態１と同様に行うことができ、
繰り返しの説明は省略する。
【０３６２】
図３２に示す薄膜トランジスタ４７１はゲート電極層４０１及び半導体層４０３のチャネ
ル領域に重なるように絶縁膜を介して導電層４０９を設ける例である。
【０３６３】
図３２は半導体装置の有する薄膜トランジスタ４７１の断面図である。薄膜トランジスタ
４７１はボトムゲート型の薄膜トランジスタであり、絶縁表面を有する基板である基板４
００上に、ゲート電極層４０１、ゲート絶縁層４０２、半導体層４０３、及びソース電極
層又はドレイン電極層４０５ａ、４０５ｂ、導電層４０９を含む。導電層４０９は、ゲー
ト電極層４０１と重なるように、酸化物絶縁膜４０７上に設けられている。
【０３６４】
導電層４０９は、ゲート電極層４０１、ソース電極層又はドレイン電極層４０５ａ、４０
５ｂと同様な材料、方法を用いて形成することができる。画素電極層を設ける場合は、画
素電極層と同様な材料、方法を用いて形成してもよい。本実施の形態では、導電層４０９
としてチタン膜、アルミニウム膜、及びチタン膜の積層を用いる。
【０３６５】
導電層４０９は、電位がゲート電極層４０１と同じでもよいし、異なっていても良く、第
２のゲート電極層として機能させることもできる。また、導電層４０９がフローティング
状態であってもよい。
【０３６６】
導電層４０９を半導体層４０３と重なる位置に設けることによって、薄膜トランジスタの
信頼性を調べるためのバイアス−熱ストレス試験（以下、ＢＴ試験という）において、Ｂ
Ｔ試験前後における薄膜トランジスタ４７１のしきい値電圧の変化量を低減することがで
きる。特に、基板温度を１５０℃まで上昇させた後にゲートに印加する電圧を−２０Ｖと
する−ＢＴ試験においてしきい値電圧の変動を抑えることができる。
【０３６７】
本実施の形態は、実施の形態１と自由に組み合わせることができる。
【０３６８】
（実施の形態１２）
半導体装置及び半導体装置の作製方法を、図３３を用いて説明する。実施の形態１と同一
部分又は同様な機能を有する部分、及び工程は、実施の形態１と同様に行うことができ、
繰り返しの説明は省略する。
【０３６９】
図３３に示す薄膜トランジスタ４７２はゲート電極層４０１及び半導体層４０３のチャネ
ル領域に重なるように酸化物絶縁膜４０７及び絶縁層４１０を介して導電層４１９を設け
る例である。
【０３７０】
図３３は半導体装置の有する薄膜トランジスタ４７２の断面図である。薄膜トランジスタ
４７２はボトムゲート型の薄膜トランジスタであり、絶縁表面を有する基板である基板４
００上に、ゲート電極層４０１、ゲート絶縁層４０２、半導体層４０３、ソース領域また
はドレイン領域４０４ａ、４０４ｂ、及びソース電極層又はドレイン電極層４０５ａ、４
０５ｂ、導電層４１９を含む。導電層４１９は、ゲート電極層４０１と重なるように、酸
化物絶縁膜４０７及び絶縁層４１０上に設けられている。
【０３７１】
本実施の形態では、酸化物絶縁膜４０７上に平坦化膜として機能する絶縁層４１０を積層
し、酸化物絶縁膜４０７及び絶縁層４１０にソース電極層又はドレイン電極層４０５ｂに
達する開口を形成する。絶縁層４１０、酸化物絶縁膜４０７及び絶縁層４１０に形成され
た開口に導電膜を形成し、所望の形状にエッチングして導電層４１９及び画素電極層４１
１を形成する。このように画素電極層４１１を形成する工程で、同様の材料及び方法を用
いて導電層４１９を形成することができる。本実施の形態では、画素電極層４１１、導電
層４１９として酸化珪素を含む酸化インジウム酸化スズ合金（酸化珪素を含むＩｎ−Ｓｎ
−Ｏ系酸化物）を用いる。
【０３７２】
また、導電層４１９は、ゲート電極層４０１、ソース電極層又はドレイン電極層４０５ａ
、４０５ｂと同様な材料、方法を用いて形成してもよい。
【０３７３】
導電層４１９は、電位がゲート電極層４０１と同じでもよいし、異なっていても良く、第
２のゲート電極層として機能させることもできる。また、導電層４１９がフローティング
状態であってもよい。
【０３７４】
導電層４１９を半導体層４０３と重なる位置に設けることによって、薄膜トランジスタの
信頼性を調べるためのバイアス−熱ストレス試験（以下、ＢＴ試験という）において、Ｂ
Ｔ試験前後における薄膜トランジスタ４７２のしきい値電圧の変化量を低減することがで
きる。
【０３７５】
本実施の形態は、実施の形態１と自由に組み合わせることができる。
【０３７６】
（実施の形態１３）
本実施の形態では、チャネルストップ型の薄膜トランジスタ１４３０の一例について図３
４（Ａ）、図３４（Ｂ）及び図３４（Ｃ）に説明する。また、図３４（Ｃ）は薄膜トラン
ジスタの上面図の一例であり、図中Ｚ１―Ｚ２の鎖線で切断した断面図が図３４（Ｂ）に
相当する。また、薄膜トランジスタ１４３０の酸化物半導体層にガリウムを含まない酸化
物半導体材料を用いる例を示す。
【０３７７】
図３４（Ａ）において、基板１４００上にゲート電極層１４０１を設ける。次いで、ゲー
ト電極層１４０１を覆うゲート絶縁層１４０２上には、酸化物半導体層を形成する。
【０３７８】
本実施の形態では、酸化物半導体層としてスパッタ法を用いたＳｎ−Ｚｎ−Ｏ系の酸化物
半導体を用いる。酸化物半導体層にガリウムを用いないことによって、価格の高いターゲ
ットを用いずに済むためコストを低減できる。
【０３７９】
酸化物半導体膜の成膜直後、または酸化物半導体層のパターニング後に脱水化または脱水
素化を行う。
【０３８０】
脱水化または脱水素化するため、不活性ガス雰囲気（窒素、またはヘリウム、ネオン、ア
ルゴン等）下、或いは減圧下において加熱処理を行った後、不活性雰囲気下で徐冷を行う
。加熱処理は、２００℃以上６００℃以下、好ましくは４００℃以上４５０℃以下とする
。酸化物半導体層は不活性ガス雰囲気下或いは減圧下における加熱処理及び徐冷によって
、低抵抗化（キャリア濃度が高まる、好ましくは１×１０^１８／ｃｍ^３以上）し、低抵抗
化した酸化物半導体層１４０３とすることができる（図３４（Ａ）参照）。
【０３８１】
次いで、酸化物半導体層１４０３上にはチャネル保護層１４１８を接して設ける。チャネ
ル保護層１４１８を設けることによって、酸化物半導体層１４０３のチャネル形成領域に
対する工程時におけるダメージ（エッチング時のプラズマやエッチング剤による膜減りな
ど）を防ぐことができる。従って薄膜トランジスタ１４３０の信頼性を向上させることが
できる。
【０３８２】
また、脱水化または脱水素化の後、大気に触れることなく連続的にチャネル保護層１４１
８を形成することもできる。大気に触れさせることなく連続的に処理することで、界面が
、水やハイドロカーボンなどの、大気成分や大気中に浮遊する不純物元素に汚染されるこ
となく各積層界面を形成することができるので、薄膜トランジスタ特性のばらつきを低減
することができる。
【０３８３】
また、低抵抗化した酸化物半導体層１４０３に接してスパッタ法またはＰＣＶＤ法などに
より酸化物絶縁膜であるチャネル保護層１４１８を形成すると、低抵抗化した酸化物半導
体層１４０３において少なくともチャネル保護層１４１８と接する領域を高抵抗化（キャ
リア濃度が低まる、好ましくは１×１０^１８／ｃｍ^３未満、さらに好ましくは１×１０^１
４／ｃｍ^３以下）し、高抵抗化酸化物半導体領域とすることができる。半導体装置の作製
プロセス中、不活性気体雰囲気下（或いは減圧下）での加熱、徐冷及び酸化物絶縁膜の形
成などによって酸化物半導体層のキャリア濃度を増減させることが重要である。
【０３８４】
チャネル保護層１４１８としては、酸素を含む無機材料（酸化珪素、酸化窒化珪素、窒化
酸化珪素など）を用いることができる。作製法としては、プラズマＣＶＤ法や熱ＣＶＤ法
などの気相成長法やスパッタリング法を用いることができる。チャネル保護層１４１８は
成膜後にエッチングにより形状を加工してする。ここでは、スパッタ法により酸化珪素膜
を形成し、フォトリソグラフィーによるマスクを用いてエッチング加工することでチャネ
ル保護層１４１８を形成する。
【０３８５】
次いで、チャネル保護層１４１８及び酸化物半導体層１４０３上にｎ^＋層１４０６ａ、１
４０６ｂを形成する。本実施の形態では、ソース領域又はドレイン領域として機能するｎ
^＋層１４０６ａ、１４０６ｂは、Ａｌ−Ｚｎ−Ｏ系非単結晶膜であり、酸化物半導体層１
４０３の成膜条件とは異なる成膜条件で形成され、より低抵抗な酸化物半導体層である。
また、ｎ^＋層１４０６ａ、１４０６ｂは、窒素を含ませたＡｌ−Ｚｎ−Ｏ系非単結晶膜、
即ちＡｌ−Ｚｎ−Ｏ−Ｎ系非単結晶膜（ＡＺＯＮ膜とも呼ぶ）を用いてもよい。
【０３８６】
次いで、ｎ^＋層１４０６ａ上にソース電極層１４０５ａ、ｎ^＋層１４０６ｂ上にドレイン
電極層１４０５ｂをそれぞれ形成して薄膜トランジスタ１４３０を作製する（図３４（Ｂ
）参照）。ソース電極層１４０５ａ及びドレイン電極層１４０５ｂは、Ａｌ、Ｃｒ、Ｔａ
、Ｔｉ、Ｍｏ、Ｗから選ばれた元素、または上述した元素を成分とする合金か、上述した
元素を組み合わせた合金膜等を用いる。また、ソース電極層１４０５ａ及びドレイン電極
層１４０５ｂは、これらの積層を用いてもよい。
【０３８７】
ｎ^＋層１４０６ａ、１４０６ｂを設けることにより、金属層であるソース電極層１４０５
ａ、ドレイン電極層１４０５ｂと、酸化物半導体層１４０３との間を良好な接合としてシ
ョットキー接合に比べて熱的にも安定動作を有せしめる。また、チャネルのキャリアを供
給する（ソース側）、またはチャネルのキャリアを安定して吸収する（ドレイン側）、ま
たは抵抗成分を配線との界面に作らないためにも積極的にｎ^＋層を設けると効果的である
。また低抵抗化により、高いドレイン電圧でも良好な移動度を保持することができる。
【０３８８】
また、上述したｎ^＋層１４０６ａ、１４０６ｂを有する構造に限定されず、例えば、ｎ^＋
層を設けない構造としてもよい。
【０３８９】
また、チャネル保護層１４１８を形成後、窒素雰囲気下、又は大気雰囲気下（大気中）に
おいて薄膜トランジスタ１４３０に加熱処理（好ましくは１５０℃以上３５０℃未満）を
行う。例えば、窒素雰囲気下で２５０℃、１時間の加熱処理を行う。該加熱処理を行うと
、酸化物半導体層１４０３がチャネル保護層１４１８と接した状態で加熱されることにな
り、薄膜トランジスタ１４７０の電気的特性のばらつきを軽減することができる。この加
熱処理（好ましくは１５０℃以上３５０℃未満）は、チャネル保護層１４１８の形成後で
あれば特に限定されず、他の工程、例えば樹脂膜形成時の加熱処理や、透明導電膜を低抵
抗化させるための加熱処理と兼ねることで、工程数を増やすことなく行うことができる。
【０３９０】
本実施の形態は、他の実施の形態に記載した構成と適宜組み合わせて実施することが可能
である。
【０３９１】
（実施の形態１４）
半導体装置及び半導体装置の作製方法を、図３５（Ａ）及び図３５（Ｂ）を用いて説明す
る。実施の形態１３と同一部分又は同様な機能を有する部分、及び工程は、実施の形態１
３と同様に行うことができ、繰り返しの説明は省略する。
【０３９２】
図３５（Ａ）に示す薄膜トランジスタ１４３１はゲート電極層１４０１及び酸化物半導体
層１４０３のチャネル領域に重なるようにチャネル保護層１４１８及び絶縁層１４０７を
介して導電層１４０９を設ける例である。
【０３９３】
図３５（Ａ）は半導体装置の有する薄膜トランジスタ１４３１の断面図である。薄膜トラ
ンジスタ１４３１はボトムゲート型の薄膜トランジスタであり、絶縁表面を有する基板で
ある基板１４００上に、ゲート電極層１４０１、ゲート絶縁層１４０２、酸化物半導体層
１４０３、ソース領域又はドレイン領域１４０４ａ、１４０４ｂ、及びソース電極層又は
ドレイン電極層１４０５ａ、１４０５ｂ、導電層１４０９を含む。導電層１４０９は、ゲ
ート電極層１４０１と重なるように、絶縁層１４０７上に設けられている。
【０３９４】
導電層１４０９は、ゲート電極層１４０１、ソース電極層又はドレイン電極層１４０５ａ
、１４０５ｂと同様な材料、方法を用いて形成することができる。画素電極層を設ける場
合は、画素電極層と同様な材料、方法を用いて形成してもよい。本実施の形態では、導電
層１４０９としてチタン膜、アルミニウム膜、及びチタン膜の積層を用いる。
【０３９５】
導電層１４０９は、電位がゲート電極層１４０１と同じでもよいし、異なっていても良く
、第２のゲート電極層として機能させることもできる。また、導電層１４０９がフローテ
ィング状態であってもよい。
【０３９６】
導電層１４０９を酸化物半導体層１４０３と重なる位置に設けることによって、薄膜トラ
ンジスタの信頼性を調べるためのバイアス−熱ストレス試験（以下、ＢＴ試験という）に
おいて、ＢＴ試験前後における薄膜トランジスタ１４３１のしきい値電圧の変化量を低減
することができる。
【０３９７】
また、図３５（Ｂ）に図３５（Ａ）と一部異なる例を示す。図３５（Ａ）と同一部分又は
同様な機能を有する部分、及び工程は、図３５（Ａ）と同様に行うことができ、繰り返し
の説明は省略する。
【０３９８】
図３５（Ｂ）に示す薄膜トランジスタ１４３２はゲート電極層１４０１及び酸化物半導体
層１４０３のチャネル領域に重なるようにチャネル保護層１４１８、絶縁層１４０７及び
絶縁層１４０８を介して導電層１４０９を設ける例である。
【０３９９】
図３５（Ｂ）では、絶縁層１４０７上に平坦化膜として機能する絶縁層１４０８を積層す
る。
【０４００】
また、図３５（Ｂ）では、ソース領域またはドレイン領域を設けず、酸化物半導体層１４
０３とソース電極層又はドレイン電極層１４０５ａ、１４０５ｂが直接接する構造となっ
ている。
【０４０１】
図３５（Ｂ）の構造においても、導電層１４０９を酸化物半導体層１４０３と重なる位置
に設けることによって、薄膜トランジスタの信頼性を調べるためのＢＴ試験において、Ｂ
Ｔ試験前後における薄膜トランジスタ１４３２のしきい値電圧の変化量を低減することが
できる。
【０４０２】
本実施の形態は、他の実施の形態に記載した構成と適宜組み合わせて実施することが可能
である。
【０４０３】
（実施の形態１５）
本実施の形態では、実施の形態１と構造が一部異なる例を図３６に示す。実施の形態１と
同一部分又は同様な機能を有する部分、及び工程は、実施の形態１と同様に行うことがで
き、繰り返しの説明は省略する。
【０４０４】
本実施の形態では、第１の酸化物半導体層のパターニングの後に、不活性ガス雰囲気（窒
素、またはヘリウム、ネオン、アルゴン等）下或いは減圧下において加熱処理を行った後
、不活性雰囲気下で徐冷を行う。第１の酸化物半導体層を上記雰囲気下で加熱処理するこ
とで、酸化物半導体層４０３に含まれる水素及び水などの不純物を除去することができる
。
【０４０５】
次いで、第１の酸化物半導体層上に、薄膜トランジスタのソース領域及びドレイン領域（
ｎ^＋層、バッファ層ともいう）として用いる第２の酸化物半導体膜を形成した後、導電膜
を形成する。
【０４０６】
次いで、第１の酸化物半導体層、及び第２の酸化物半導体膜、導電膜をエッチング工程に
より選択的にエッチングし、酸化物半導体層４０３、及びソース領域又はドレイン領域（
ｎ^＋層、バッファ層ともいう）４０４ａ、４０４ｂ、及びソース電極層又はドレイン電極
層４０５ａ、４０５ｂを形成する。なお、酸化物半導体層４０３は一部のみがエッチング
され、溝部（凹部）を有する酸化物半導体層となる。
【０４０７】
次いで、酸化物半導体層４０３に接してスパッタ法またはＰＣＶＤ法による酸化珪素膜を
酸化物絶縁膜４０７として形成する。低抵抗化した酸化物半導体層に接して形成する酸化
物絶縁膜４０７は、水分や、水素イオンや、ＯＨ⁻などの不純物を含まず、これらが外部
から侵入することをブロックする無機絶縁膜を用い、具体的には酸化珪素膜、または窒化
酸化珪素膜を用いる。
【０４０８】
低抵抗化した酸化物半導体層４０３に接してスパッタ法またはＰＣＶＤ法などにより酸化
物絶縁膜４０７を形成すると、低抵抗化した酸化物半導体層４０３において少なくとも酸
化物絶縁膜４０７と接する領域を高抵抗化（キャリア濃度が低まる、好ましくは１×１０
^１８／ｃｍ^３未満、より好ましくは１×１０^１４／ｃｍ^３以下）し、高抵抗化酸化物半導
体領域とすることができる。酸化物絶縁膜４０７を接して形成することによって高抵抗化
酸化物半導体領域を有する半導体層４０３となり、薄膜トランジスタ４７３を作製するこ
とができる（図３６参照。）。
【０４０９】
図３６における構造において、ソース領域又はドレイン領域（ｎ^＋層、バッファ層ともい
う）４０４ａ、４０４ｂとしてＩｎ−Ｇａ−Ｚｎ−Ｏ系非単結晶膜を用いる。
【０４１０】
また、半導体層４０３とソース電極層の間にソース領域を、半導体層とドレイン電極層と
の間にドレイン領域を有する。ソース領域及びドレイン領域に、ｎ型の導電型を示す酸化
物半導体層を用いる。
【０４１１】
また、薄膜トランジスタ４７３のソース領域又はドレイン領域４０４ａ、４０４ｂとして
用いる第２の酸化物半導体膜は、チャネル形成領域として用いる第１の酸化物半導体層の
膜厚よりも薄く、且つ、より高い導電率（電気伝導度）を有するのが好ましい。
【０４１２】
またチャネル形成領域として用いる第１の酸化物半導層は非晶質構造を有し、ソース領域
及びドレイン領域として用いる第２の酸化物半導体膜は非晶質構造の中に結晶粒（ナノク
リスタル）を含む場合がある。このソース領域及びドレイン領域として用いる第２の酸化
物半導体膜中の結晶粒（ナノクリスタル）は直径１ｎｍ〜１０ｎｍ、代表的には２ｎｍ〜
４ｎｍ程度である。
【０４１３】
また、酸化物絶縁膜４０７を形成後、窒素雰囲気下、又は大気雰囲気下（大気中）におい
て薄膜トランジスタ４７３に加熱処理（好ましくは１５０℃以上３５０℃未満）を行って
もよい。例えば、窒素雰囲気下で２５０℃、１時間の加熱処理を行う。該加熱処理を行う
と、酸化物半導体層４０３が酸化物絶縁膜４０７と接した状態で加熱されることになり、
薄膜トランジスタ４７３の電気的特性のばらつきを軽減することができる。
【０４１４】
本実施の形態は、他の実施の形態に記載した構成と適宜組み合わせて実施することが可能
である。
【０４１５】
以上の構成でなる本発明について、以下に示す実施例でもってさらに詳細な説明を行う
こととする。
【実施例１】
【０４１６】
ここで、酸素密度の高い領域及び酸素密度の低い領域を有する酸化物半導体層において、
加熱処理前後における酸素密度の変化について計算した結果を、図４２及び図４３を用い
て説明する。ここでは、計算用のソフトウェアとしては、富士通株式会社製のＭａｔｅｒ
ｉａｌｓ Ｅｘｐｌｏｒｅｒ５．０を用いた。
【０４１７】
図４２に、計算に用いた酸化物半導体層のモデルを示す。ここでは、酸化物半導体層１２
０１を、酸素密度の低い層１２０３及び酸素密度の高い層１２０５が積層される構造とし
た。
【０４１８】
ここでは、酸素密度の低い層１２０３として、１５個のＩｎ原子、１５個のＧａ原子、１
５個のＺｎ原子、及び５４個のＯ原子からなるアモルファス構造とした。
【０４１９】
また、酸素密度の高い層１２０５として、１５個のＩｎ原子、１５個のＧａ原子、１５個
のＺｎ原子、及び６６個のＯ原子からなるアモルファス構造とした。
【０４２０】
また、酸化物半導体層１２０１の密度を５．９ｇ／ｃｍ^３とした。
【０４２１】
次に、酸化物半導体層１２０１に対して、ＮＶＴアンサンブル、温度２５０℃の条件で、
古典ＭＤ（分子動力学）計算を行った。時間刻み幅を０．２ｆｓとし、総計算時間を２０
０ｐｓと設定した。また。ポテンシャルは、金属−酸素結合、及び酸素−酸素結合にＢｏ
ｒｎ−Ｍａｙｅｒ−Ｈｕｇｇｉｎｓ型を適用した。また、酸化物半導体層１２０１の上端
及び下端の原子の動きを固定した。
【０４２２】
次に、計算結果を図４３に示す。ｚ軸座標の０ｎｍから１．１５ｎｍが酸素密素の低い層
１２０３であり、ｚ軸座標の１．１５ｎｍから２．３ｎｍが酸素密度の高い層１２０５で
ある。ＭＤ計算前の酸素の密度分布を実線１２０７で示し、ＭＤ計算後の酸素密度の分布
を破線１２０９で示す。
【０４２３】
実線１２０７においては、酸素密素の低い層１２０３と酸素密度の高い層１２０５との界
面より、酸素密度の高い層１２０５において、酸素の密度が高い。一方、破線１２０９に
おいては、酸素密素の低い層１２０３及び酸素密度の高い層１２０５において、酸素密度
が均質であることが分かる。
【０４２４】
以上のことから、酸素密素の低い層１２０３と酸素密度の高い層１２０５の積層状態のよ
うに、酸素密度の分布に偏りが有る場合、加熱処理により酸素密度が高い方から低い方へ
拡散し、酸素密度が均質になることが分かる。
【０４２５】
即ち、実施の形態１に示すように、酸化物半導体層４３２上に酸化物絶縁膜４０７を形成
することで、酸化物半導体層４０３及び酸化物絶縁膜４０７の界面において酸素密度が高
まるため、当該酸素が酸化物半導体層４０３の酸素密度の低い方へ拡散し、酸化物半導体
層４０３が高抵抗化する。以上のことから、薄膜トランジスタの信頼性を向上させること
ができる。
【符号の説明】
【０４２６】
１０ 点線
１００ 基板
１０１ ゲート電極層
１０２ ゲート絶縁層
１０３ 半導体層
１０５ａ ソース電極層
１０５ｂ ドレイン電極層
１０７ 保護絶縁層
１０８ 容量配線
１０９ 酸化物半導体膜
１１０ 画素電極層
１２１ 端子
１２２ 端子
１２５ コンタクトホール
１２６ コンタクトホール
１２７ コンタクトホール
１２８ 透明導電膜
１２９ 透明導電膜
１３２ 導電膜
１３３ 酸化物半導体層
１３４ 酸化物半導体層
１３５ 半導体層
１５０ 端子
１５１ 端子
１５２ ゲート絶縁層
１５３ 接続電極層
１５４ 保護絶縁層
１５５ 透明導電膜
１５６ 電極層
１７０ 薄膜トランジスタ
４００ 基板
４０１ ゲート電極層
４０２ ゲート絶縁層
４０３ 半導体層
４０４ａ、４０４ｂ ソース電極層またはドレイン電極層
４０５ａ、４０５ｂ ソース電極層またはドレイン電極層
４０７ 酸化物絶縁膜
４０９ 導電層
４１０ 絶縁層
４１１ 画素電極層
４１９ 導電層
４３０ 酸化物半導体層
４３１ 酸化物半導体層
４３２ 酸化物半導体層
４４１ 酸化物半導体層
４５０ 基板
４５１ ゲート電極層
４５２ ゲート絶縁層
４５３ 半導体層
４５５ａ ドレイン電極層
４５７ 酸化物絶縁膜
４６０ 薄膜トランジスタ
４７０ 薄膜トランジスタ
４７１ 薄膜トランジスタ
４７２ 薄膜トランジスタ
４７３ 薄膜トランジスタ
４８３ 酸化物半導体層
４８４ 酸化物半導体層
５００ 基板
５０１ 絶縁膜
５０２ 酸化物半導体膜
５０３ 電極
５１０ 物性評価用試料
５８０ 基板
５８１ 薄膜トランジスタ
５８３ 絶縁膜
５８５ 絶縁層
５８７ 電極層
５８８ 電極層
５８９ 球形粒子
５９０ａ 黒色領域
５９０ｂ 白色領域
５９４ キャビティ
５９５ 充填材
５９６ 基板
６０１ 電気炉
６０２ チャンバー
６０３ ヒーター
６０４ 基板
６０５ サセプター
６０６ ガス供給手段
６０７ 排気手段
６１１ ガス供給源
６１２ 圧力調整弁
６１３ 精製器
６１４ マスフローコントローラ
６１５ ストップバルブ
７０１ 酸化物半導体層
７１１ 初期特性
７１２ ＋ＢＴ
７１３ −ＢＴ
７２１ 初期特性
７２２ ＋ＢＴ
７２３ −ＢＴ
７３１ 初期特性
７３２ ＋ＢＴ
７３３ −ＢＴ
１２０１ 酸化物半導体層
１２０３ 酸素密度の低い層
１２０５ 酸素密度の高い層
１２０７ 実線
１２０９ 破線
１４００ 基板
１４０１ ゲート電極層
１４０２ ゲート絶縁層
１４０３ 酸化物半導体層
１４０４ａ、１４０４ｂ ソース領域またはドレイン領域
１４０５ａ、１４０５ｂ ソース電極層またはドレイン電極層
１４０６ａ、１４０６ｂ ｎ＋層
１４０７ 絶縁層
１４０８ 絶縁層
１４０９ 導電層
１４１８ チャネル保護層
１４３０ 薄膜トランジスタ
１４３１ 薄膜トランジスタ
１４３２ 薄膜トランジスタ
１４７０ 薄膜トランジスタ
２６００ ＴＦＴ基板
２６０１ 対向基板
２６０２ シール材
２６０３ 画素部
２６０４ 表示素子
２６０５ 着色層
２６０６ 偏光板
２６０７ 偏光板
２６０８ 配線回路部
２６０９ フレキシブル配線基板
２６１０ 冷陰極管
２６１１ 反射板
２６１２ 回路基板
２６１３ 拡散板
２７００ 電子書籍
２７０１ 筐体
２７０３ 筐体
２７０５ 表示部
２７０７ 表示部
２７１１ 軸部
２７２１ 電源
２７２３ 操作キー
２７２５ スピーカ
４００１ 基板
４００２ 画素部
４００３ 信号線駆動回路
４００４ 走査線駆動回路
４００５ シール材
４００６ 基板
４００８ 液晶層
４０１０ 薄膜トランジスタ
４０１１ 薄膜トランジスタ
４０１３ 液晶素子
４０１５ 接続端子電極
４０１６ 端子電極
４０１８ ＦＰＣ
４０１９ 異方性導電膜
４０２０ 絶縁層
４０２１ 絶縁層
４０３０ 画素電極層
４０３１ 対向電極層
４０３２ 絶縁層
４５０１ 基板
４５０２ 画素部
４５０３ａ、４５０３ｂ 信号線駆動回路
４５０４ａ、４５０４ｂ 走査線駆動回路
４５０５ シール材
４５０６ 基板
４５０７ 充填材
４５０９ 薄膜トランジスタ
４５１０ 薄膜トランジスタ
４５１１ 発光素子
４５１２ 電界発光層
４５１３ 電極層
４５１５ 接続端子電極
４５１６ 端子電極
４５１７ 電極層
４５１８ａ、４５１８ｂ ＦＰＣ
４５１９ 異方性導電膜
４５２０ 隔壁
５３００ 基板
５３０１ 画素部
５３０２ 走査線駆動回路
５３０３ 信号線駆動回路
５４００ 基板
５４０１ 画素部
５４０２ 走査線駆動回路
５４０３ 信号線駆動回路
５４０４ 走査線駆動回路
５５０１ 配線
５５０２ 配線
５５０３ 配線
５５０４ 配線
５５０５ 配線
５５０６ 配線
５５４３ ノード
５５４４ ノード
５５７１ 薄膜トランジスタ
５５７２ 薄膜トランジスタ
５５７３ 薄膜トランジスタ
５５７４ 薄膜トランジスタ
５５７５ 薄膜トランジスタ
５５７６ 薄膜トランジスタ
５５７７ 薄膜トランジスタ
５５７８ 薄膜トランジスタ
５６０１ ドライバＩＣ
５６０２ スイッチ群
５６０３ａ 薄膜トランジスタ
５６０３ｂ 薄膜トランジスタ
５６０３ｃ 薄膜トランジスタ
５６１１ 配線
５６１２ 配線
５６１３ 配線
５６２１ 配線
５７０１ フリップフロップ
５７１１ 配線
５７１２ 配線
５７１３ 配線
５７１４ 配線
５７１５ 配線
５７１６ 配線
５７１７ 配線
５７２１ 信号
５８２１ 信号
６４００ 画素
６４０１ スイッチング用トランジスタ
６４０２ 駆動用トランジスタ
６４０３ 容量素子
６４０４ 発光素子
６４０５ 信号線
６４０６ 走査線
６４０７ 電源線
６４０８ 共通電極
７００１ ＴＦＴ
７００２ 発光素子
７００３ 陰極
７００４ 発光層
７００５ 陽極
７０１１ 駆動用ＴＦＴ
７０１２ 発光素子
７０１３ 陰極
７０１４ 発光層
７０１５ 陽極
７０１６ 遮蔽膜
７０１７ 導電膜
７０２１ 駆動用ＴＦＴ
７０２２ 発光素子
７０２３ 陰極
７０２４ 発光層
７０２５ 陽極
７０２７ 導電膜
９２０１ 表示部
９２０２ 表示ボタン
９２０３ 操作スイッチ
９２０５ 調節部
９２０６ カメラ部
９２０７ スピーカ
９２０８ マイク
９３０１ 上部筐体
９３０２ 下部筐体
９３０３ 表示部
９３０４ キーボード
９３０５ 外部接続ポート
９３０６ ポインティングデバイス
９３０７ 表示部
９６００ テレビジョン装置
９６０１ 筐体
９６０３ 表示部
９６０５ スタンド
９６０７ 表示部
９６０９ 操作キー
９６１０ リモコン操作機
９７００ デジタルフォトフレーム
９７０１ 筐体
９７０３ 表示部
９８８１ 筐体
９８８２ 表示部
９８８３ 表示部
９８８４ スピーカ部
９８８５ 入力手段（操作キー
９８８６ 記録媒体挿入部
９８８７ 接続端子
９８８８ センサ
９８８９ マイクロフォン
９８９０ ＬＥＤランプ
９８９１ 筐体
９８９３ 連結部
９９００ スロットマシン
９９０１ 筐体
９９０３ 表示部

【特許請求の範囲】
【請求項１】
トランジスタと、酸化物絶縁層と、を有し、
前記トランジスタは、酸化物半導体層と、ゲート電極と、ゲート絶縁層と、ソース電極と、ドレイン電極と、を有し、
前記酸化物半導体層は、第１の領域と、第２の領域と、第３の領域とを有し、
前記第１の領域は、前記ソース電極と重なり、
前記第２の領域は、前記ドレイン電極と重なり、
前記第３の領域は、前記トランジスタのチャネルが形成される領域を含み、
前記酸化物絶縁層は、前記第３の領域と重なり、
前記第３の領域のキャリア濃度は、前記第１の領域及び前記第２の領域のキャリア濃度よりも低く、
前記酸化物半導体層中の水素濃度は、３×１０^２０ｃｍ^−３以下であることを特徴とする半導体装置。
【請求項２】
トランジスタと、酸化物絶縁層と、を有し、
前記トランジスタは、酸化物半導体層と、ゲート電極と、ゲート絶縁層と、ソース電極と、ドレイン電極と、を有し、
前記酸化物半導体層は、非単結晶であり、
前記酸化物半導体層は、第１の領域と、第２の領域と、第３の領域とを有し、
前記第１の領域は、前記ソース電極と重なり、
前記第２の領域は、前記ドレイン電極と重なり、
前記第３の領域は、前記トランジスタのチャネルが形成される領域を含み、
前記酸化物絶縁層は、前記第３の領域と重なり、
前記第３の領域のキャリア濃度は、前記第１の領域及び前記第２の領域のキャリア濃度よりも低く、
前記酸化物半導体層中の水素濃度は、３×１０^２０ｃｍ^−３以下であることを特徴とする半導体装置。
【請求項３】
トランジスタと、酸化物絶縁層と、を有し、
前記トランジスタは、酸化物半導体層と、ゲート電極と、ゲート絶縁層と、ソース電極と、ドレイン電極と、を有し、
前記酸化物半導体層は、第１の領域と、第２の領域と、第３の領域とを有し、
前記第１の領域は、前記ソース電極と重なり、
前記第２の領域は、前記ドレイン電極と重なり、
前記第３の領域は、前記トランジスタのチャネルが形成される領域を含み、
前記酸化物絶縁層は、前記第３の領域と重なり、
前記第３の領域のキャリア濃度は、前記第１の領域及び前記第２の領域のキャリア濃度よりも低く、
前記第３の領域のキャリア濃度は、１×１０^１４ｃｍ^−３以下であることを特徴とする半導体装置。
【請求項４】
トランジスタと、酸化物絶縁層と、を有し、
前記トランジスタは、酸化物半導体層と、ゲート電極と、ゲート絶縁層と、ソース電極と、ドレイン電極と、を有し、
前記酸化物半導体層は、非単結晶であり、
前記酸化物半導体層は、第１の領域と、第２の領域と、第３の領域とを有し、
前記第１の領域は、前記ソース電極と重なり、
前記第２の領域は、前記ドレイン電極と重なり、
前記第３の領域は、前記トランジスタのチャネルが形成される領域を含み、
前記酸化物絶縁層は、前記第３の領域と重なり、
前記第３の領域のキャリア濃度は、前記第１の領域及び前記第２の領域のキャリア濃度よりも低く、
前記第３の領域のキャリア濃度は、１×１０^１４ｃｍ^−３以下であることを特徴とする半導体装置。
【請求項５】
トランジスタと、酸化物絶縁層と、を有し、
前記トランジスタは、酸化物半導体層と、ゲート電極と、ゲート絶縁層と、ソース電極と、ドレイン電極と、を有し、
前記酸化物半導体層は、第１の領域と、第２の領域と、第３の領域とを有し、
前記第１の領域は、前記ソース電極と重なり、
前記第２の領域は、前記ドレイン電極と重なり、
前記第３の領域は、前記トランジスタのチャネルが形成される領域を含み、
前記酸化物絶縁層は、前記第３の領域と重なり、
前記第３の領域のキャリア濃度は、前記第１の領域及び前記第２の領域のキャリア濃度よりも低く、
前記第３の領域のキャリア濃度は、１×１０^１４ｃｍ^−３以下であり、
前記酸化物半導体層中の水素濃度は、３×１０^２０ｃｍ^−３以下であることを特徴とする半導体装置。
【請求項６】
トランジスタと、酸化物絶縁層と、を有し、
前記トランジスタは、酸化物半導体層と、ゲート電極と、ゲート絶縁層と、ソース電極と、ドレイン電極と、を有し、
前記酸化物半導体層は、非単結晶であり、
前記酸化物半導体層は、第１の領域と、第２の領域と、第３の領域とを有し、
前記第１の領域は、前記ソース電極と重なり、
前記第２の領域は、前記ドレイン電極と重なり、
前記第３の領域は、前記トランジスタのチャネルが形成される領域を含み、
前記酸化物絶縁層は、前記第３の領域と重なり、
前記第３の領域のキャリア濃度は、前記第１の領域及び前記第２の領域のキャリア濃度よりも低く、
前記第３の領域のキャリア濃度は、１×１０^１４ｃｍ^−３以下であり、
前記酸化物半導体層中の水素濃度は、３×１０^２０ｃｍ^−３以下であることを特徴とする半導体装置。
【請求項７】
トランジスタと、酸化物絶縁層と、を有し、
前記トランジスタは、酸化物半導体層と、ゲート電極と、ゲート絶縁層と、ソース電極と、ドレイン電極と、を有し、
前記酸化物半導体層は、第１の領域と、第２の領域と、第３の領域とを有し、
前記第１の領域は、前記ソース電極と重なり、
前記第２の領域は、前記ドレイン電極と重なり、
前記第３の領域は、前記トランジスタのチャネルが形成される領域を含み、
前記酸化物絶縁層は、前記第３の領域と重なり、
前記第３の領域のキャリア濃度は、前記第１の領域及び前記第２の領域のキャリア濃度よりも低いことを特徴とする半導体装置。
【請求項８】
第１の酸化物半導体層を形成し、
前記第１の酸化物半導体層を脱水素化して第２の酸化物半導体層を形成し、
前記第２の酸化物半導体層の第１の領域と重なるソース電極と、前記第２の酸化物半導体層の第２の領域と重なるドレイン電極と、前記第２の酸化物半導体層の第３の領域と重なる酸化物絶縁層と、を形成し、
前記第２の酸化物半導体層に酸素を供給して、前記第３の領域のキャリア濃度を前記第１の領域及び前記第２の領域のキャリア濃度よりも低減することを特徴とする半導体装置の作製方法。

【図１】

【図３】

【図４】

【図５】

【図６】

【図７】

【図８】

【図９】

【図１０】

【図１１】

【図１２】

【図１３】

【図１４】

【図１５】

【図１６】

【図１７】

【図１８】

【図１９】

【図２０】

【図２１】

【図２２】

【図２３】

【図２４】

【図２５】

【図２６】

【図２７】

【図２８】

【図２９】

【図３０】

【図３１】

【図３２】

【図３３】

【図３４】

【図３５】

【図３６】

【図３７】

【図３９】

【図４１】

【図４２】

【図４３】

【図２】

【図３８】

【図４０】

【公開番号】特開２０１３−１０２２０８（Ｐ２０１３−１０２２０８Ａ）
【公開日】平成２５年５月２３日（２０１３．５．２３）
【国際特許分類】
【出願番号】特願２０１３−１１９６５（Ｐ２０１３−１１９６５）
【出願日】平成２５年１月２５日（２０１３．１．２５）
【分割の表示】特願２０１０−１４８１８５（Ｐ２０１０−１４８１８５）の分割
【原出願日】平成２２年６月２９日（２０１０．６．２９）
【出願人】（０００１５３８７８）株式会社半導体エネルギー研究所 (5,264)
【Ｆターム（参考）】