半導体装置
【課題】半導体パッケージの実装抵抗を低減する。
【解決手段】第１の金属部材（リード端子５，６）が、第１の貴金属を含む第１の金属体（Ａｕバンプ８）を介して、半導体素子（半導体チップ１）の第１の電極（ソース電極２）と接続され、かつ、第２の金属部材（ダイ端子７）が、第２の貴金属を含む第２の金属体（貴金属メッキ１４及びＡｇメッキ１５）を介して、第２の電極（裏面電極４）と接続される。裏面電極に接続される金属部材を有し、配線基板との半導体装置の実装面が回路形成面側であり、金属部材が折り曲げ加工されている。
【解決手段】第１の金属部材（リード端子５，６）が、第１の貴金属を含む第１の金属体（Ａｕバンプ８）を介して、半導体素子（半導体チップ１）の第１の電極（ソース電極２）と接続され、かつ、第２の金属部材（ダイ端子７）が、第２の貴金属を含む第２の金属体（貴金属メッキ１４及びＡｇメッキ１５）を介して、第２の電極（裏面電極４）と接続される。裏面電極に接続される金属部材を有し、配線基板との半導体装置の実装面が回路形成面側であり、金属部材が折り曲げ加工されている。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、半導体装置に係り、特に実装抵抗の低減に好適な半導体パッケージ構造に関する。
【背景技術】
【０００２】
従来のトランジスタパッケージの一例として、特開平8−64634号公報に開示されているものがある。熱放散用のヘッダに電子回路が形成された半導体チップが裏面電極側で半田により接合されている。チップの回路形成面側のＡｌ電極には、バンプが形成され、インナーリードが電気的及び機械的に接続されている。また、ヘッダにもインナーリードが接続され、チップ及びヘッダとリードの一部を覆うように樹脂で封止されている。このとき、バンプが半田の場合はリード側に錫（Ｓｎ），金（Ａｕ），半田等をめっきしてバンプの半田を溶融して接合し、バンプがＡｕの場合にはリード側に錫をめっきしてＡｕ−Ｓｎ共晶反応によって接合している。インナーリードは、ソース電極，ドレイン電極，ゲート電極用の３本で構成され、ソース電極用リードは櫛歯形状に加工されている。ヘッダには、樹脂まで貫通する開口部が形成されている。
【０００３】
他の従来例として、特開平5−121615号公報に開示されているワイヤレス構造の表面実装型半導体パッケージがある。３つの外部接続端子が半導体チップの電極端子に接続されている。チップ上面の２つの電極と外部接続端子はＡｕボールを熱圧着することにより接続されている。配線基板への実装は、チップ搭載部から前後に導出されたリード端子の先端領域を基板の端子に半田付けして行われる。
【０００４】
また、従来の標準的な表面実装型半導体パッケージにおいては、ドレイン用リードのヘッダに半導体チップが半田により接着され、半導体チップのソース及びゲート電極と外部接続端子のソース及びゲート用リード間がＡｌワイヤのボンディングにより結線されている。チップ及び各リードとヘッダの一部が樹脂でモールドされている。樹脂パッケージの底面にヘッダが露出して配線基板に接続可能な構造となっており、その大きさは樹脂モールドのサイズより大きく設定されている。
【０００５】
また、半導体チップの従来のチップ・ダイ接続構造においては、Ｃｕ基合金の部材にチップを固着したときチップに高い応力を発生させないために、降伏強度の低いＰｂリッチな半田やＡｇ粒子を混入した導電性樹脂による接着構造が採用されていた。
【先行技術文献】
【特許文献】
【０００６】
【特許文献１】特開平８−６４６３４号公報
【特許文献２】特開平５−１２１６１５号公報
【発明の概要】
【発明が解決しようとする課題】
【０００７】
従来の縦型半導体素子の表面実装型プラスチックパッケージにおけるパッケージの実装抵抗は、ワイヤボンディング構造で数十〜十数ｍΩであった。半導体技術の進歩により、素子のオン抵抗が年々減少し、現状は数十〜数ｍΩ／cm2のデバイスが開発されつつあり、将来はさらに低抵抗化が進められると予測される。
【０００８】
その場合、実装抵抗がデバイス抵抗より大きくなるため、半導体パッケージの性能向上を図るためには、実装抵抗の低減が不可欠となる。この半導体パッケージのオン抵抗に着眼した公知例が上記特開平8−64634号公報に開示されているが、この公知例は挿入実装型パッケージで提案されている。挿入実装型は、パッケージサイズに制約がなく、しかも基板とリードの接合が構造的に強固であるため、厚肉で大型サイズのヘッダを使用でき、リードも厚肉のものを使用できる。このため、実装抵抗の低減は比較的容易である。しかし、表面実装型パッケージは、樹脂匡体の両サイドから導出されたリードが、その先端部で基板の端子と小さい面積の面同士で半田接続される構造であるため、挿入実装型に比べて接合部の疲労強度が弱いという性質がある。このため、チップの発熱に伴うパッケージと基板間の熱歪みを柔軟なリードの変形によって吸収することが必要であり、リードの形状を薄肉で細長い形状とすることが必要である。この場合には、リード部分の電気抵抗が大きくなるため、実装抵抗の低減は困難である。
【０００９】
表面実装型の場合、チップを搭載したヘッダを直接配線基板に半田付けする構造にすれば、この問題はなくなる。しかし、チップ上面の電極に接続されるリードを樹脂匡体からの導出する位置と、ヘッダを導出する位置が高さの点で異なる場合、樹脂をモールドする上下金型の合わせ面が３次元構造となり、金型の加工が難しくなるという問題がある。この問題は、特にリードフレームが、パッケージの多数個取りを目的としたマトリックスフレーム（Ｘ，Ｙ方向に配置）の場合に顕著となる。ヘッダを小さくして樹脂匡体内に納めればこの問題はなくなるが、そうすると、ヘッダを樹脂匡体の下面に露出させるためにヘッダをモールド金型の底面に押し付けるための加圧場所をモールド内部に設ける必要がある。ヘッダが大きい場合はヘッダの開口部を利用して押し付けることが可能だが、ヘッダがチップと同等サイズの場合にはヘッダ部に押し付ける場所がなく、ヘッダを下面に露出させてモールドすることが難しくなるという問題がある。このため、ヘッダがチップと同等サイズの小型の半導体パッケージの場合には、裏面電極の外部接続端子を兼ねるヘッダを樹脂匡体内に納めた構造で組み立てることが技術的に困難である。
【００１０】
一方、従来において、チップ裏面とヘッダやダイ等の外部接続端子との接続は、半田接続かあるいは導電性樹脂による接着構造が採用されてきた。半田接続は、電気抵抗や熱抵抗及び耐熱信頼性に優れた接続構造であるが、近年の環境問題の観点からＰｂレス化が要求されており、従来のＰｂ入半田から新たなＰｂレス接合材料に変える必要が生じている。しかし、固相温度が２５０℃以下のＰｂレス半田材料は種々あるものの、パッケージの基板への搭載に耐えるような固相温度２７０℃以上を持つ適当なＰｂレス半田材料はないのが実情である。唯一、固相温度３７０℃のＡｕ−Ｓｉ半田があるが、この半田は、コストが高いこと、降伏強度が高いためチップサイズが大きい場合は半田付け後の冷却過程でチップが割れてしまうという２つの理由によってチップ裏面電極用半田材として採用困難である。すなわち、現状、Ｐｂレスの代替半田材がないという問題がある。一方、導電性樹脂による接着は、耐熱的には短時間であれば実装に必要な２７０℃に耐えることができるが、接着強度が樹脂で保たれているため強度的に弱く、モールド樹脂の硬化収縮力で密着を補強しているものの、大面積のチップや高温で使用されるパッケージでは、経年変化や温度サイクルによる樹脂の劣化によって接合部の電気抵抗や熱抵抗が増加するという問題がある。特に、ヘッダやダイ（外部接続端子）が樹脂匡体の表面に露出している片面モールド構造では、チップ裏面にモールド樹脂による押し付け力が得られない構造となるため、導電性樹脂接着部の長期信頼性がさらに低くなるという問題がある。
【００１１】
本発明は、上記の問題点を考慮してなされたものであり、実装抵抗の低減が可能なパッケージ構造を有する半導体装置を提供する。
【課題を解決するための手段】
【００１２】
本発明による半導体装置は、半導体基板と、前記半導体基板の表面に設けられる第１の電極と、前記半導体基板の裏面に設けられる第２の電極とを有する半導体素子と、前記第１の電極に接続される第１の金属部材と、前記第２の電極に接続される第２の金属部材と、前記半導体素子を被覆する絶縁体と、を有し、前記第１の金属部材は、前記第１の電極との接合面の裏面側に露出部分を有し、前記第２の金属部材は、前記第２の電極との接合面の裏面側に露出部分を有している。
【００１３】
また、本発明による半導体装置は、まず、半導体基板と、半導体基板の表面に設けられる第１の電極と、半導体基板の裏面に設けられる第２の電極とを有する半導体素子を備える。さらに、第１の金属部材が、第１の貴金属を含む第１の金属体を介して、半導体素子の第１の電極と接続され、かつ、第２の金属部材が、第２の貴金属を含む第２の金属体を介して、第２の電極と接続される。
【００１４】
本発明によれば、第１及び第２の金属部材が、それぞれ貴金属を含む金属体を介して半導体素子の電極と接続されるので、半導体パッケージの実装抵抗を低減することができる。
【００１５】
上記の構成において、好ましくは、外部配線と接続するための第１の金属部材の表面部分及び第２の金属部材の表面部分を略同じ平面内に位置させる。ここで、略同じ平面とは、例えば、各種電子装置における配線基板や回路基板の電子部品取り付け面である。これにより、半導体装置を、配線基板や回路基板などに、面実装することができる。
【００１６】
第１の金属体としては、半導体素子の第１の電極または第１の金属部材から突出する突起状電極がある。突起状電極としては、金（Ａｕ）または銀（Ａｇ）などの貴金属のバンプ電極やボール状電極などが適用できる。さらに、実装抵抗を低減するために好ましくは、複数の突起状電極を、第１の電極と前記第１の金属部材との接合界面の略全面において、略等間隔に配列する。
【００１７】
第２の金属体としては、第２の電極と第２の金属部材との接合界面に位置する金属層がある。好ましくは、金属層を、第２の電極の接合表面側及び第２の金属部材の接合表面側に位置する各貴金属層が互いに接合したものとする。貴金属層の材料としては、金（Ａｕ），銀（Ａｇ），白金（Ｐｔ），パラジウム（Ｐｄ）などから選択される貴金属、あるいはそれを最も多く含む主成分とする合金が適用できる。また、複数種の貴金属層あるいは合金層が多層化されていても良い。
【００１８】
さらに、第２の電極側に位置する貴金属層と、第２の金属部材側に位置する貴金属層との間に、金（Ａｕ）または銀（Ａｇ）などの貴金属のバンプ電極やボール状電極，樹脂と混合された銀（Ａｇ）粒子，板状またはシート状あるいは網目状の銀(Ａｇ)部材，凹凸あるいは空隙部を有する板状あるいはシート状の銀部材のいずれかが介在しても良い。好ましい他の金属層としては、貴金属を主成分とする固相温度４００℃以上の合金層がある。このような合金層としては、銀(Ａｇ)を主成分とする銀（Ａｇ）と錫（Ｓｎ）との合金を適用できる。
【００１９】
半導体素子の第１及び第２の電極、並びに第１及び第２の金属部材においては、これらの接合表面に貴金属層を設けても良い。この貴金属層の材料としては、金（Ａｕ），銀（Ａｇ），白金（Ｐｔ），パラジウム（Ｐｄ）などから選択される貴金属、あるいはそれを最も多く含む主成分とする合金が適用できる。半導体素子における第１及び第２の電極の材料としては、アルミニウム、またはアルミシリコンのようなアルミニウム合金が適用できる。
【００２０】
また、第１及び第２の金属部材は、半導体素子の第１及び第２の電極を外部の電極，配線基板，回路基板などと電気的に接続する。例えば、第１及び第２の金属部材は、半導体パッケージの一部であるリード線，リード電極、またはダイ端子など、あるいはこれらの一部である。そして、実装抵抗を低減するために好ましくは、第１の金属部材が、第１の電極との接合部を有する部分から延びる複数の部分を有し、この複数の部分の各々が、外部配線と接続するための表面部分を有する構成とする。このような半導体装置が接続される回路基板または配線基板においては、第１の金属部材における上記のような各表面部分毎に、電気的接続のための導体部（例えば銅箔）が設けられ、かつこれらの導体部は、回路基板上または配線基板上で電気的に接続されている。例えば、このような導体部としては、プリント基板における、連続した導体（例えば銅）パターンが適用できる。
【００２１】
上述したような、本発明による半導体装置の構成は、いわゆる樹脂封止型または樹脂モールド型の半導体装置のように、半導体素子と第１及び第２の金属部材とが絶縁体によって被覆される半導体装置にも実施できる。この場合、第１の金属部材における第１の電極との接合面の裏面が、外部配線と接続するための露出部分を有することが好ましい。このような構成に加え、半導体素子の接合面側を回路形成面（たとえば縦型半導体スイッチング素子の一方の主電流電極と制御電極が形成されている面）とし、第１の電極を主電流電極とすると良い。なお、半導体素子と第１及び第２の金属部材とが絶縁体によって被覆される半導体装置においては、第２の金属部材における第２の電極との接合面の裏面が、外部配線と接続するための露出部分を有していても良い。なお、絶縁体の材料としては、各種樹脂の他、セラミックスなどの他の絶縁性材料も適用できる。
【００２２】
上述した各構成は、適宜併用することができる。また、次に述べる本発明による他の半導体装置のように、単独でも実装抵抗を低減する作用・効果を有する構成もある。
【００２３】
すなわち、本発明による他の半導体装置としては、半導体基板の表面及び裏面にそれぞれ第１の電極及び第２の電極とを有する半導体素子が収納される半導体パッケージにおいて、上述したような、１）第２の電極と第２の金属部材とが、第２の電極の接合表面及び前記第２の金属部材の接合表面に設けられる貴金属層が互いに接合した金属層を介して接合される構成、２）第２の電極と前記第２の金属部材とが、貴金属を主成分とする固相温度４００℃以上の合金層を介して接合される構成、３）第１の金属部材が、第１の電極との接合部から延びる複数の部分を有し、複数の部分の各々が、外部配線と接続するための表面部分を有する構成、のいずれかを実施したものがある。また、１）または２）の構成と、３）の構成を併せて実施しても良い。
【００２４】
上述した本発明による各半導体装置は、ＭＯＳ（Metal Oxide Semiconductor)電界効果トランジスタ，ＭＩＳ(Metal Insulator Semiconductor）電界効果トランジスタ，バイポーラトランジスタ，絶縁ゲートバイポーラトランジスタ，ダイオード、あるいは集積回路などの各種の半導体素子に適用できる。また、本発明による各半導体装置の構成は、第１及び第２の電極を一対の主電流電極とする半導体素子、並びに第１及び第２の電極を主電流電極とし、主電流が、表面側の第１の電極から裏面側の第２の電極へ向かう方向あるいはその逆方向に向かって、半導体基板中を縦方向に流れる、パワーＭＯＳＦＥＴやパワートランジスタのような縦型半導体素子に好適である。この場合、半導体素子の低オン抵抗特性とあいまって、パッケージを含めた端子間のオン抵抗またはオン電圧を低減できる。
【発明の効果】
【００２５】
本発明によれば、パッケージの実装抵抗を低減することができる。
【図面の簡単な説明】
【００２６】
【図１】本発明による半導体パッケージの一実施例を示す図である。
【図２】本発明による半導体パッケージの他の一実施例を示す図である。
【図３】本発明による半導体パッケージの他の一実施例を示す図である。
【図４】本発明による半導体パッケージの他の一実施例を示す図である。
【図５】本発明による半導体パッケージに用いるリードフレームの一実施例を示す図である。
【図６】本発明による半導体パッケージの組み立て構造及び方法の一実施例を示す図である。
【図７】本発明による半導体パッケージの組み立て途中のリードフレーム構造を示す図である。
【図８】本発明による半導体パッケージの樹脂モールド方法の一実施例を示す図である。
【図９】本発明による半導体パッケージの組み立てフローの一実施例を示す図である。
【図１０】本発明によるＰｂレス半導体パッケージの組み立て構造の一実施例を示す図である。
【図１１】本発明によるＰｂレス半導体パッケージの一実施例を示す図である。
【図１２】本発明によるチップ裏面電極のＰｂレス接合部材の一実施例を示す図である。
【図１３】本発明によるチップ裏面電極のＰｂレス接合部材の他の一実施例を示す図である。
【図１４】本発明によるチップ裏面電極のＰｂレス接合部材の他の一実施例を示す図である。
【図１５】本発明による半導体パッケージの他の一実施例を示す図である。
【図１６】本発明による半導体パッケージの他の一実施例を示す図である。
【図１７】本発明による半導体パッケージの他の一実施例を示す図である。
【図１８】本発明による半導体パッケージを搭載する配線基板の一実施例を示す図である。
【図１９】本発明による半導体パッケージを搭載した電子装置の一実施例を示す図である。
【図２０】半導体パッケージの電流経路モデルを示す図である。
【図２１】本発明の半導体パッケージの基本構造の一例を示す図である。
【発明を実施するための形態】
【００２７】
第１の一実施形態は、トランジスタチップのゲート電極及びソース電極と外部接続用金属部材（リード）間の接続を最適に配置した複数のＡｕバンプを介して直接接合し、チップ裏面のドレイン電極と外部接続用金属部材（ダイ）を電気的及び熱的に結合し、ソース電極及びゲート電極用金属部材（リード）またはドレイン電極用金属部材（ダイ）のいずれか一方が多面体のパッケージの内部に納まる構造とし、パッケージ内に納めた金属部材の面を配線基板の端子面に半田接合できる構造としたものである。
【００２８】
さらに好ましくは、パッケージから導出するリードまたはダイの導出部をパッケージの側面２面からとる構造とし、パッケージ内部に納めた金属部材をモールド金型の底面に押し付ける方法を、パッケージから導出した金属部材を介して行える構造とする。
【００２９】
また、第２の実施形態は、ドレイン電極と貴金属めっきを施した金属部材（ダイ）とを貴金属バンプあるいは貴金属のメッシュシートあるいは貴金属粒子あるいは硬さ３５Ｈｖ以下の厚い貴金属めっきを介して直接あるいは貴金属を主成分とする固相温度４００℃以上の合金層を介して接合した構造である。この接合部は、加熱と超音波振動を用いた圧接で得ることができる。さらに好ましくは、チップサイズが大きい場合に、チップ上回路形成面のソース電極とゲート電極にＡｕバンプを形成し、貴金属めっきを施したリードとを直接接合する構造とし、さらにソース電極側のリードとチップ裏面のダイの大きさを同等としてチップに曲げ応力がかからないように部材を対称形に配置した構造とする。
【００３０】
また、第３の実施形態は、チップ上面のソース及びゲートＡｌ電極上に予めＡｕバンプを多数形成し、貴金属めっきした各リードに位置合わせしてチップを搭載し、その上にＡｕバンプより硬さの小さい貴金属部材、さらにその上に貴金属めっきしたダイを搭載し、ダイの上に加圧と超音波振動を加える接合ツールを配置して、加熱と荷重と超音波により各接合界面を一括して接合する構造及び方法とした。
【００３１】
まず、第１の実施形態について、詳細に説明する。図２０に、半導体パッケージの電流経路モデルを示す。図において、１８４：ドレイン用外部接続端子、１８６：接合部、１８２：チップ裏面電極、１８０：チップ、１８１：Ａｌ電極、１８５：金属バンプ、１８３：ソース用外部接続端子（リード）である。ソース／ドレイン用外部接続端子間の電気抵抗Ｒは（１）式で表わされる。
【００３２】
Ｒ＝Ｒ１＋Ｒ２＋Ｒ３＋Ｒ４＋Ｒ５＋Ｒ６＋Ｒ７ …（１）
（１）式でチップの内部抵抗Ｒ４を除いた部分が実装抵抗となる。バンプの抵抗Ｒ６は、
Ｒ６＝（ρ×ｈ／Ｓ）／ｎ …（２）
(ここでρ：バンプの固有抵抗，ｈ：バンプ高さ，Ｓ：断面積，ｎ：バンプ数)で表わされる。Ａｕバンプの寸法は、Ａｌパッド上にバンプを低コストで直接形成できるワイヤのボールボンディングで作るとすると、直径：１５０μｍ，厚さ：２０μｍが標準的な寸法になる。この場合のバンプの抵抗は（０.０２６／ｎ)ｍΩとなり、十分小さくできる。次にＡｌ電極膜の抵抗Ｒ５は、
Ｒ５≒（ρ／４πｔ）ｌｎ（ｒ２／ｒ１） …（３）
（ここで、ρ：電極膜の固有抵抗，ｔ：電極膜厚，ｒ２：電極外径，ｒ１：バンプ径）で表わされる。電極外径ｒ２は、バンプを均等にｎ個配置した場合ほぼ１／(ｎ1/2）に比例するためｎ数を増せばｒ２／ｒ１は１に近づき、電極膜厚を厚くしてバンプ数を多くすれば、Ｒ５は十分に小さくできる。外部接続端子の抵抗（Ｒ１＋Ｒ７）は、単純に、
（Ｒ１＋Ｒ７）＝ρ×Ｌ／Ｓ …（４）
（ここでρ：リードの固有抵抗，Ｌ：リードの通電長さ，Ｓ：通電断面積）で表わされ、前述したように標準的な表面実装用のＳＯＰパッケージの場合（厚さ：０.１６mm／幅：０.３mm／長さ：２mm×２)で１.４ｍΩ程度になる。すなわち、実装抵抗が１ｍΩ以下のレベルでは、単にバンプ構造を採用するだけでは実装抵抗を下げられず、外部接続端子の抵抗を下げる構造を採用しなければならない。そこで、本発明による半導体装置においては、外部接続端子の抵抗を下げると同時に、外部接続端子と配線基板の接続部の信頼性を確保し得る構造とした。
【００３３】
図２１に、本発明による半導体装置１の基本構造を示す。外部接続端子の抵抗を下げるには、単純に通路断面を増して流路を短縮する以外に方法がないため、外部接続端子の一方は端子の板厚方向に電流経路を取る構造する。この場合、通電距離（０.１〜０.２mm）に比べて通電断面が数〜数十mm2と十分大きいため、この第１外部接続端子部１９４の抵抗は１μΩ以下にできる。他方の第２外部接続端子１９３は、チップの側面から降ろして配線基板の端子と接続する構造となるため通電距離が数mmとなるが、パッケージの両側から導通をとることで、２倍の通電断面積を確保できる。また本構造では、後で述べる理由によって、第２外部接続端子に幅広で厚肉の部材を使うことができるため、さらに数倍の通電断面積を確保することができ、従来に比べて十数分の１程度まで電気抵抗を下げることが可能となる。
【００３４】
従来のパッケージ構造では、第２接続端子の剛性が高くなると配線基板との接続部の長期信頼性が低下するという問題があるが、本発明の構造においては、樹脂匡体の腹部の第１外部接続端子面積が十分大きく熱源のチップと配線基板が近接した構造であるため基板との温度差が小さく、また接続端子の材質がＣｕ合金であるため基板と熱膨張率が近くて熱歪みが小さいことにより、第１及び第２接続端子と基板との接合部に発生する熱歪みの絶対値が小さくなり、第２接続端子の剛性が高くても温度サイクル信頼性を確保できるのである。また、第２接続端子と基板との接続部には、チップを内蔵する樹脂匡体と折曲げた足に相当するＣｕ部材の高さ方向の熱膨張の差によって温度上昇時に押し付け力が働き、この効果によっても従来のパッケージに比べて温度サイクル信頼性が向上し、第２接続端子の剛性を高くできる。
【００３５】
また、図２１のパッケージを組み立てるためのモールド工程において、第２接続端子１９３を上金型の側壁で押し下げることにより、貴金属バンプ１９５を介して第１接続端子部材１９４をモールド金型の底面に押し付けることが可能となり、金型に特別な工夫を加えることなく樹脂匡体の腹部に接続端子が確実に露出したパッケージを組み立てることが可能となるのである。この場合、特に重要なポイントとなるのは、バンプを介して接続された第２接続端子部材を樹脂匡体の両側から出していることである。第２端子部材の両側から押し下げることにより、第１端子部材の傾きの発生やバンプの剥がれを防いで、確実で歩留りの高い樹脂モールドが可能となっている。もし片側で押し下げる構造では、押し下げた第２端子部材の金型接触部と第１端子部材の下金型接触部間でモーメントが発生し、一部のバンプ接合部に引張力が発生して接合部剥がれが発生したり、第１端子部材の片側が浮いて接合面に樹脂が回り込む不良を発生したりするため、確実で歩留りの高い樹脂モールドができない。
【００３６】
次に、第２の実施形態について詳細に説明する。チップ裏面の接合に要求される特性は、１）電気的導通が取れて外部接続端子（ダイ）への熱伝導性が高いこと、２）温度サイクル寿命が高いこと、３）パッケージを基板に搭載するときの半田付け温度に耐えることと、４）チップ裏面の広い領域の接合が量産ラインの短いタクトで可能であり、チップへの悪影響がないことの４点である。Ｐｂレスの適当な高融点半田材料がないため、半田以外の材料を使って上記特性を満たす接合を行う必要がある。貴金属材料を接合材料に用いた場合、材料の熱伝導率が従来半田の１０倍程度あるため、同一接合厚さにした場合でも接合箇所がチップ裏面に均等に分散していれば１／１０の接合面積で同じ伝熱特性が得られる。つまり熱放散性において、非常に有利である。温度サイクル寿命に関しては、チップの熱膨張と外部接続端子（ダイ）の熱膨張差に伴う熱歪みをどこの変形で吸収するかが大きく影響する。従来の半田では、半田の降伏強度が低かったため、歪みのほとんどを半田の変形で吸収し、半田部で破壊していた。この場合、チップに歪みがほとんど加わらないためチップ特性の安定性や信頼性が高いという利点はあった。これに対して貴金属部材で接合した場合は、降伏強度が半田よりは高く、ＳｉやＣｕよりは小さいため、チップやダイの歪みは増すが接合部の寿命は長くなる。チップに加わる歪みの大きさは、貴金属層の中に放熱性が問題とならない程度に空洞を設けることで調整することができる。具体的に空洞を設ける手段としては、接合部材にメッシュシートや粒子や凹凸のあるシートやめっき膜を用いることで空洞が得られる。
【００３７】
耐熱性に関しては問題ない。最も重要なのは接合組み立て性である。貴金属同士を従来の熱圧着法で接合する場合には、短時間で接合するために加熱温度を４００〜５００℃にする必要があった。この方法では、室温との温度差が大きいため冷却過程の熱歪み量が大きくなりチップサイズがそれほど大きくない場合でも破損する危険が大きいという問題があった。本発明においては、その問題を解決するために接合温度を２５０℃以下とし、その温度で確実な接合を達成するために超音波振動を利用する方法を採用した。しかしチップをダイに超音波接合する場合には、ダイとチップを硬質のヒートステージと硬質の接合ツールで挟んで加圧しつつ超音波振動を加えるため、チップの回路形成面と硬質の接合治具が接触した部分でチップが破損するという問題が生じる。この問題に対して、本発明ではチップの回路形成側の電極にＡｕバンプを形成し、回路形成側にもダイと同等サイズの外部接続端子部材（リード）を合わせて配置し、チップと硬質の接合治具が直接接触しない構造としてチップの破損を防いだ。チップの上下２ヵ所に接合箇所がある場合、接合の程度にばらつき（片側がよく接合されて、片側が接合されない状態）が生じることが懸念されるが、超音波接合において接合箇所が接合治具に対して直列に配置されている場合には、片側の接合が進行するとその部分の相対振動が押えられ、接合されていない部分の相対振動が大きくなってそこの接合が進行するという自己調整機能が働くため、２ヵ所とも同程度の強度の接合部が得られるのである。ただし、接合面積を放熱の点からチップ裏面側で広くしたい場合は、チップ上下の接合材料を変えてチップの回路形成面側を降伏強度が高くチップ裏面側を降伏強度が低い材料にして接合することで、接合面積に差をつけることが可能である。以上の接合構造と接合方法を採用することにより、Ｐｂレスで高性能・高信頼性のチップ裏面接合が可能となる。
【００３８】
なお、第３の実施形能の作用・効果については、第２の実施形態に記述した通りである。実際の接合時間は、ワークの移動や位置決めの時間を除くと数百ｍｓ程度で、現行の複数本のワイヤボンディングに要している時間より短い時間である。予めＡｕバンプをチップのＡｌ電極に形成しておく必要があるが、生産タクトの点で影響がなく、チップ・ダイ接続とボンディングを同時に行える点で従来より生産タクトの短縮が可能となる。
【００３９】
（実施例）
以下、上記の実施形態の具体的構造を示す本発明の実施例を図面を用いて詳細に説明する。
【００４０】
図１は、本発明による半導体パッケージの一実施例を示す。（ａ）は樹脂部を除去し外部接続端子を透視した上面図、（ｂ）は断面図、（ｃ）は下面図である。図において、半導体チップ１は４×２mmの大きさの縦型ＭＯＳトランジスタであり、ソース及びゲート用Ａｌ電極２，３の膜厚は約４μｍ、ドレン電極となる裏面電極４の最表面にはＡｕが蒸着されている。チップのソース及びゲート電極には多数または複数Ａｕバンプ８が、ボールボンディング法によって、均等にすなわち各電極の全面にほぼ等間隔に配置されて形成されている。ソース及びゲート用リード端子５，６は、Ｃｕコア１１にＰｄ／Ａｕの貴金属めっき１２が施された構造で、板厚０.２mm である。ソース用リード端子５の幅は、ソース電極２とほぼ同じ大きさである。すなわち、ソース用リード端子５はソース電極２のほぼ全面を覆う。チップ上のＡｕバンプと各リード端子のＰｄ／Ａｕ面は２３０℃の加熱温度でダイレクトに超音波圧着されている。圧着されたＡｕバンプの大きさは、ほぼ１５０μｍΦ×２０μｍである。外部接続用ダイ端子７は、Ｃｕコア１３にＰｄ／Ａｕの貴金属めっき１４が施された構造で、片面にはさらに約１０μｍのＡｇめっき１５が施されている。チップ裏面電極のＡｕ面とダイ端子のＡｇめっき面はＡｕバンプ／リード端子の場合と同様に２３０℃の加熱温度でダイレクトに超音波接合されている。ソース用リード端子は、モールドされた樹脂匡体１６の左右の側壁から外に導出され、かつ折り曲げ加工が施されており、左右に取り出された幅広のリード端子にはスリット１０が設けられ、また、チップ上に位置する部分にはいくつかの開口部９が設けられている。ゲート用リード端子も樹脂匡体１６の左右の側壁から外に導出されている。ドレイン用ダイ端子は樹脂匡体の底面に露出している。ダイ端子の下面（配線基板上接続端子との接続面）と曲げ加工されたソース及びゲート用リード端子の下面（同接続面）は同じ高さすなわち同一平面になるように加工されている。
【００４１】
本実施例によれば、ソース電極とソース用リード端子が、均等配置された多数のＡｕバンプによって接続され、幅広のリード端子が左右から導出された構造であること、ダイ端子が裏面電極とＡｇめっき膜によって直接接合され、配線基板までの流路断面が大きくかつ通電距離が非常に短い（板厚分）構造であることから、パッケージの実装抵抗を大幅に下げることができる。これにより、実装抵抗１ｍΩ以下という従来にはない低実装抵抗の半導体パッケージを備える新規な半導体装置が得られる。また、チップとＣｕ端子との接合部には回路面側は厚さ２０μｍのＡｕバンプ、チップ裏面側は厚さ１０μｍのＡｇめっきが介在しており、それらがＣｕ端子材に比べて柔らかい（降伏強度が低い）材料であるためクッション材の役割を果たし、チップに大きな力が加わることを防ぐ効果があること、ＡｕやＡｇは半田に比べて温度サイクル寿命が長いことのために、半導体パッケージとしての長期信頼性に優れるという利点がある。また、配線基板に搭載した場合には、ダイ端子の広い面積で基板と接合され、発熱体のチップと最短距離で良好な熱伝導状態で接続されるため基板とパッケージの温度差が小さく、基板の熱膨張率とＣｕ端子の熱膨張率は近いため両者の間に発生する熱歪みは小さい。このため、半導体パッケージと配線基板間の接合部は温度サイクル寿命が長く、長期信頼性に優れる利点がある。さらには、チップ上に位置するソース用リード端子に開口部を設けているため、Ａｕバンプが潰れてリード端子とチップの間隙が小さくなった場合でも、開口部から樹脂の侵入が生じること、開口部からガス抜きが行われることの２つの効果で樹脂モールド工程におけるボイドの発生を防ぐことが可能となり、パッケージの信頼性を損なうことがない。
【００４２】
また、チップの裏面電極とダイ端子との接続構造として、Ａｇめっき膜を介してＡｕ／Ａｇの超音波接合を行っており、半田レス接合としているため、耐熱性が高く温度サイクル信頼性の高い接続構造を持つ半導体パッケージを提供できる。
【００４３】
なお、ここではＡｕバンプのサイズとして１５０μｍΦとしたが、バンプの形成が可能であれば数百μｍΦと大きくする方がよい。バンプサイズを大型化すると、さらに低抵抗化が図れ、また接合強度を向上できるためパッケージ組み立て時の外力によるバンプ接合部の剥がれ発生を防止するのに有効となり、製造歩留りを向上できるという効果がある。
【００４４】
図２は、本発明による半導体パッケージにおいて、Ａｇバンプ圧着方式をチップ・ダイ接続に採用した場合の一実施例を示す。図において半導体チップ２１のＡｌ電極２２と貴金属めっき２５を施されたリード端子２６はＡｕバンプ３０によって強固に接合されている。チップの裏面電極２３と貴金属めっきを施されたダイ端子２９はＡｇバンプ３１によって接合されている。リード端子は片側が樹脂匡体３２の側壁近傍で切断され、片側は配線基板の端子と接続するために曲げ加工が施されてダイと同じ高さに揃えられている。
【００４５】
本実施例によれば、チップとダイ端子間がＡｇバンプで接続されているため構造的に変位を吸収可能でる。このため、ダイ端子／チップ間の接合部の温度サイクル寿命が格段に長く、Ｐｂレスで環境にやさしく信頼性の高い半導体パッケージを提供できる。また、配線基板の接続端子との半田接合部には、熱歪みがほとんど加わらないため、実装信頼性を大幅に向上できる。また、パッケージをチップと同等なサイズにまで小型化でき、パッケージの厚みも１mm程度に薄型化することができ、高密度実装に適した小型の表面実装用半導体パッケージを提供できる。
【００４６】
図３は、本発明による半導体パッケージにおいて、Ａｇペースト接着方式をチップ・ダイ接続に用いた場合の一実施例を示す。図において半導体チップ３５のＡｌ電極３６と貴金属めっき３９されたリード端子４０はＡｕバンプ４５によって強固に接合されている。チップの裏面電極３７とダイ端子４３はＡｇペースト４６によって接着されている。ダイ端子はＣｕコア４１にＰｄ／Ａｕめっき４２された構造で、周囲にはモールド樹脂へのアンカー効果が働くように端面のザグリ加工処理が施されている。リード端子は樹脂匡体４７の両サイドから取り出されている。
【００４７】
本実施例によれば、図１の実施例と同様の効果が得られる。また、ダイ端子の端面に樹脂に食い込む形状の加工を施したため、モールド樹脂の収縮力でダイ端子をチップ裏面に押し付けることができ、組み立てが簡便に行えるＡｇペーストによるチップ・ダイ接続方式を採用しても信頼性のある半導体パッケージを提供できる。
【００４８】
図４は、本発明による半導体パッケージにおいて、回路形成面を配線基板に向けた実装が可能なパッケージ構造の一実施例を示す。図において、半導体チップ５０の回路形成面側の主電流用及び制御用Ａｌ電極５１，５２には、図１の実施例と同様に各々複数のＡｕバンプ５７が形成され、各電極サイズと同等で樹脂匡体５９面内に納まる大きさの主電流用外部接続端子５５と制御用外部接続端子５６が超音波熱圧着されている。各外部接続端子表面にはＰｄ／Ａｕフラッシュめっきが施されている。チップ裏面には最表面がＡｕまたはＡｇ蒸着膜で構成された裏面電極５３が形成され、Ｃｕ表面にＰｄ／Ａｕフラッシュめっきが施された裏面電極用外部接続端子５４が表面に０.１〜５μｍ 厚さのＳｎめっきが施されたＡｇメッシュシート５８を挟んで超音波熱圧着されている。主電流用及び制御用外部接続端子は樹脂匡体表面に露出した状態でモールドされ、裏面電極用外部接続端子は樹脂匡体の左右側面から導出されて片側が切断除去され他方が折曲げ加工されている。
【００４９】
本実施例によれば、図１と同様の効果が得られる。さらに、チップの発熱面である回路形成面側から配線基板に最も効率的に放熱できる構造であるため、パッケージの冷却が最も効率的に行われてＡｌ電極部の温度上昇が小さく抑えられ、その結果、外部接続端子とチップ間に発生する熱歪みを小さくできかつＡｌ電極膜とＡｕボール間の化合物の成長を抑制できるため、実使用環境下での製品寿命を大幅に改善できるのである。
【００５０】
図５は、本発明による半導体パッケージを組み立てるのに用いるソース及びゲート電極用マトリックスリードフレームの一実施例、図６は、図５のＡ−Ａ′断面から見たパッケージ組み立て時の接合方法、図７は、接合後のマトリックスリードフレームの外観、図８は、樹脂モールド方法を示す図である。図５において、ソース用リード６１とゲート用リード６２が対となったユニットがＸ−Ｙ方向に配置されている。次の図６において、マトリックスリードフレームのソース用及びゲート用リード６１，６２上に、半導体チップ６５のＡｌ電極６６，６７上に予め形成されたＡｕバンプ７１が位置合わせされて搭載され、さらにチップ裏面電極６８上には、予めＡｇバンプ７０が形成されたドレイン用ダイ端子６９が搭載されている。マトリックスリードフレームを載せるヒートステージ７４を２００℃に加熱し、ダイ端子の上から超音波振動７６を加える接合ツール７３で１バンプ当り５０〜５００ｇの力で加圧し、チップ上下の接合部を同時に接合している。超音波接合では、バンプの潰れ量を制御して接合し、リードとダイ端子の高さを所定の範囲内の精度に抑えている。超音波の振動方向は、リードの剛性が高い長手方向（図５の上下方向）に加え、リードの共振による接合不良の発生を防いでいる。ダイ端子は、個別に切り離して組み立てるので、貴金属めっきした大きなＣｕ板から打抜き加工して製作している。接合を完了したマトリックスリードフレーム（図７）を、モールド金型にセットした状態が図８である。図８は、図７のＡ−Ａ′断面方向から見た場合の断面構造である。図８において、モールド金型８０，８１のキャビティ８２は、マトリックスリードフレームの配置に合わせて、Ｘ−Ｙ方向に配列して形成されている。また、リード吊が納まる逃げ空間８３も設けられている。下金型８１のキャビティに半導体チップ６５が納まるように位置合わせしてマトリックスリードフレームをセットし、その上から上金型を載せて押し付ける。キャビティから外に出るソース及びゲートリードの高さは、下金型のキャビティの深さと同等かわずかに高くしてあり、上金型のキャビティ側壁部分でリードを挟んだときに、ダイ端子がビャビティ底面に押し付けられる構造としている。リードはチップ部を中心として左右で押し下げられることになるが、押し込み量が大きいとリードが曲げ変形を受け、チップ中央のＡｕバンプ接合部に引張り力が発生する。このため、上金型のリード抑え部はナイフ状に加工し、下金型は内側が低くて外側が高い段差を持たせ、リードをＷ形状に変形させてチップ中央の凸状の曲げ変形が小さくなるように工夫している。モールド樹脂は、熱膨張を下げるシリカ粒子のサイズを細かくし、バンプ接合部の隙間１０〜２０μｍの空隙への充填性を上げ、圧入プロセスで樹脂ボイドの発生を防止している。
【００５１】
本実施例のリードフレーム及び製法によれば、組み立て用のリードフレームにＩＣユニットをマトリックス状に配置し、１リードフレームから取れるパッケージの個数を増して生産性を上げることができること、金型はリード抑え部を除いて平面研削加工により合わせ面の加工精度を出せるためコストを上げないで金型を製造できること、チップ・ダイ接続と回路形成面側の接続を一回の接合工程で行えるため生産工程の短縮が可能となること、等の効果により低コスト半導体パッケージを提供できる。同時に構造的な特徴として、チップサイズに近い大きさの小型かつ薄型の半導体パッケージを提供できる。
【００５２】
図９は、本発明による半導体パッケージの組み立てフローに関する一実施例である。図において、組み立てには４つ部品が用いられる。半導体チップは、ウェーハレベルでＡｕバンプが形成され、それからダイシングにより個片に切断される。Ａｕバンプの形成は、ボールボンディング法，めっき法，Ａｕボール転写法のいずれでもよい。ソース及びゲート用外部接続端子は、Ｃｕ合金板からマトリックスリードフレーム状に打抜き法あるいはエッチング法により加工整形され、表面にＮｉ下地めっきを施した後、Ｐｄを０.０２〜１μｍ程度めっきし、最表面にＡｕを０.００１〜１μｍ程度めっきして仕上げられる。ドレイン用外部接続端子は、Ｃｕ条テープにＮｉ下地めっきを施した後、Ｐｄを０.０２〜１μｍ程度めっきしてさらに最表面にＡｕを０.００１〜１μｍ程度めっきし、最後にチップと同等サイズの個片に切断加工される。チップ・ダイ接続用のＡｇシートは、厚さ１０〜１００μｍのＡｇテープにプレス加工を加えて片面あるいは両面に凹凸を形成し、その表面にＳｎを０.１〜５μｍ厚さ程度めっきする。このときの厚さは、Ａｇとの重量比が２０ｗｔ％以下となる厚さにしている。最後に、ドレイン用外部接続端子やチップと同等サイズの個片に切断している。各部品は、マトリックスリードフレームをボンディングステージに載せてから、半導体チップ，Ａｇシート，ドレイン用外部接続端子の順に位置合わせして積層し、加熱と荷重と超音波振動を加えて、１ＩＣ単位で一括接合を行う。マトリックス全てを接合完了したら、樹脂モールド工程に入り、図８と同様の要領で樹脂モールドを行う。最後に、マトリックス状に繋がった半導体パッケージを個別に切断分離し、リードの折曲げ整形加工を施して完成する。
【００５３】
本実施例によれば、部品加工工程が並列ラインで多数個の一括生産が可能であり、また組み立てラインに入ってからの工程が（１）部品セット＋接合、（２）樹脂モールド、（３）リードの切断整形の３工程であり、従来のチップ・ダイ接続とワイヤボンディングのプロセスに比べて１工程短縮でき、さらに組み立てのタクトも（１）の工程がワイヤボンディングと同等のタクト以下で接合できるため、トータルの生産タクトの短縮が可能で、生産性の大幅な向上が図れる。
【００５４】
図１０は、本発明によるチップ裏面電極接合構造の一実施例を示す。リードフレームはソース・ゲート用リードフレームとドレイン用リードフレームの２種類のリードフレームを用いて組み立てる。図において、ソース用リード９１とゲート用リード９２を形成したＣｕ合金のリードフレーム、及びドレイン用ダイ９５を形成したリードフレームは、全面にＰｄ／Ａｕめっきが施されている。ドレイン用ダイの上には、Ａｇボールバンプ１０１がボールボンディング法により形成されている。この２種のリードフレームの間に、Ａｌ電極９８に予めＡｕボールバンプ１００を形成した裏面電極１０２付きの半導体チップ９７を挟み、チップの上下２ヵ所を同時に接合できる構造である。図１１は、この接合体を樹脂モールドしてリードを整形加工した半導体パッケージ構造の一例を示す。図において、樹脂匡体１０３の側壁の片側からソース及びゲートリード９１，９２が導出され、対向する他方の側壁からドレイン用リード１０４が導出され、折曲げ加工されている。樹脂匡体内のリードには局部的に細くなったネック部９３を設けており、リードの折曲げ加工時に発生する応力がバンプ接合部に伝わり難い構造としている。リードの導出位置の高さは、左右で異なっている。従って、上下モールド金型の合わせ面も段違いに加工されている。チップ裏面はＡｕ蒸着膜／Ａｇバンプ１０１／Ｐｄ／Ａｕめっきダイ９５の圧着構造、チップ上面はＡｌ電極９８，９９／Ａｕバンプ１００／Ｐｄ／Ａｕめっきリード９１，９２の圧着構造となっている。
【００５５】
本実施例において、チップ・ダイ接続構造がＡｇバンプを介した貴金属同士の直接接合となっているので、耐熱性が高く、チップ／ダイ間の熱歪みをＡｇバンプが緩和してくれるため温度サイクル信頼性が高く、Ｐｂレスで環境にやさしい半導体パッケージを提供できる。また、リードは貴金属めっきが施されているため半田の濡れ性がよく、その結果、パッケージ組み立て後の半田めっきが不要となるため、パッケージ組み立て工程が短縮されて生産性が向上する。また、チップサイズぎりぎりに樹脂をモールドすることが可能となるため、小型で薄型の半導体パッケージを提供できるという効果もある。
【００５６】
図１２は、チップとダイを接合するための接合シートの一実施例である。図において、シート１１０は厚さ２０μｍの純Ａｇ製で、片面に深さ１０μｍの溝１１１を形成している。溝の形成は、プレス加工あるいはダイシングブレードによるハーフカット加工により行っている。Ａｇシートの硬さは、圧延加工→溝加工を終えた後、３５Ｈｖ以下になるように焼鈍処理している。
【００５７】
本実施例の接合シートを用いてチップ／ダイの超音波圧接を行えば、接合中のＡｇシートの組成変形が溝空間の存在と材料の柔らかさによって低い応力で容易に進行し、Ｓｉチップに加わる応力が小さい条件で接合界面での新生面の形成が行われて接合が進むため、チップに損傷を与えないで強固で耐熱性の高い接合を達成することが可能となる。また、パッケージの使用時には、チップの発熱に伴うチップ／ダイ間の熱歪みを、柔らかくて溝空間のあるＡｇシートが吸収してくれるため、温度サイクル信頼性の高い半導体パッケージを提供できる。
【００５８】
図１３は、チップとダイを接合するための接合シートの他の一実施例である。図において、接合シートのコア部１１２は、図１２と同じ加工処理を施したＡｇシートである。その表面に、厚さ０.３〜２.０μｍのＳｎめっき１１３を施している。
【００５９】
本実施例の接合シートを用いてチップ／ダイの超音波加熱圧接を行えば、加熱温度２２０℃以上の条件下でＡｇ−Ｓｎ反応によって液相が形成されるためシート表面が薄い膜の液体で覆われ、ダイあるいはチップ裏面電極に押し付けられた領域は液体が外に排出されて高融点部材同士の接合が容易に進行するため、低い加圧条件で確実かつ強固な接合が容易に行えるという利点がある。また接合界面から排出された低融点のＡｇ−Ｓｎ層には、加熱時にコアから次々に溶解や拡散によってＡｇが供給されるため、最終的なＡｇ−Ｓｎ層の融点は４７０℃以上に高めることができ、耐熱性の高い接合部とすることができるのである。半導体パッケージとしての信頼性に関しては、図１２と同様の効果が得られる。
【００６０】
図１４は、チップとダイを接合するための接合シートの他の一実施例である。図において、接合シートはＡｇワイヤ１１４，１１５を縦横に編んだメッシュ状シートである。
【００６１】
本実施例によれば、ワイヤが重なった部分の厚みは厚くてそれ以外の部分は薄いという凹凸のあるシートであるため、厚い部分の組成変形が容易に進行して図１２と同様の効果が得られるのである。
【００６２】
図１５は、本発明による半導体パッケージにおいて、チップ・ダイ間の接合にＡｇ粒子を用いた場合の一実施例を示す。図において、半導体チップ１２０の回路形成面側にはＡｌ電極１２１が形成され、その上には複数のＡｇバンプ１２５が形成されている。チップの裏面には、最表面がＡｇめっき膜の裏面電極１２２が形成されている。回路形成面側の貴金属めっきされたリード１２３とＡｇバンプは直接、超音波熱圧着されている。チップ裏面電極と貴金属めっきされたダイ端子１２４は、樹脂１２７と９０vol％ 以上の比率で混合されたＡｇ粒子１２６を挟んで、超音波熱圧着されている。樹脂の量は、圧着時に押し出された樹脂がダイ端子の側面から圧着ステージに流れ落ちない程度に少ない量とし、混合体を粘性流体として扱える程度に多い量としている。樹脂の性質は熱硬化性で、接合時の加熱により硬化する種類の樹脂としている。Ａｇ粒子とチップ裏面のＡｇ蒸着膜、およびＡｇ粒子とダイ端子、Ａｇ粒子同士は接触部分の領域で部分的に金属接合が達成されている。ダイ端子の寸法は、樹脂匡体１２８の底面の中に納まる大きさであり、チップと同等である。チップより、わずかに大きくても小さくてもよい。
【００６３】
本実施例によれば、低実装抵抗，小型・薄型，Ｐｂレスの半導体パッケージを提供できる。また、Ａｇ粒子が樹脂と混合されているので、樹脂の粘着性によってＡｇ粒子の飛散がなくなり、接合部へのＡｇ粒子の供給が容易となって生産性が向上できる。また、接合後のＡｇ粒子間の狭い隙間を混合された樹脂が埋めるため、モールド樹脂で隙間を埋める必要がなくなり、樹脂ボイドの発生を大幅に低減できて歩留りを向上できるという効果もある。さらに、接合材が樹脂とＡｇ粒子の混合体ではあるが、超音波を併用した加熱圧着を行っているため、金属同士の接合界面から樹脂が排出され、接合部では金属同士の強固な接合が達成されるため、接合信頼性はＡｇペーストの接着に比べて格段に向上できるという効果もある。
【００６４】
図１６は、本発明による半導体パッケージにおいて、チップ／ダイ間の接合に溝を形成したＡｇシートを用いた場合の一実施例を示す。図において、チップ１３０のＡｌ電極１３１にはＡｕボール１３９が形成され、裏面電極１３２の最表面にはＡｇ蒸着膜が形成されている。リード端子１３５とダイ端子１３８の表面にはＰｄめっきが施されている。チップ裏面とダイ端子間には溝１４１を形成したＡｇシート１４０が挿入されている。各接合部は、超音波併用の加熱圧着によりダイレクトに接合されている。リード端子は、樹脂匡体の１側面から導出され、曲げ加工されている。
【００６５】
本実施例によれば、図２と同様の効果が得られる他に、リード端子が片側からのみ出ているので、リード端子の上下の樹脂連結面積が大きく取れ、樹脂の硬化収縮力によるリード／チップ間への圧縮力を高めることができるため、Ａｌ電極／Ａｕボール／リード端子の各接合部の熱歪み等による破損を低減することができ、半導体パッケージの信頼性を向上することができる。
【００６６】
図１７は、本発明による半導体パッケージにおいて、リード端子の一部が樹脂匡体の上面に露出している場合の一実施例を示す。図において、チップ１４５のＡｌ電極１４６にはＡｕボール１５４が形成され、裏面電極１４７の最表面にはＡｇ蒸着膜が形成されている。リード端子１５０とダイ端子１５３の表面にはＰｄ／Ａｕめっき１４９，１５２が施されている。チップ裏面とダイ端子間には溝１５６を形成したＡｇシート１５５が挿入されている。各接合部は、超音波併用の加熱圧着によりダイレクトに接合されている。リード端子は、樹脂匡体の１側面から導出されて曲げ加工されており、上面はリード端子が露出している。
【００６７】
本実施例によれば、図２と同様の効果が得られる他に、パッケージ上面に露出した広い面積のリード端子から効率よく熱が放散されるため、半導体パッケージの熱抵抗を大幅に低減することができる。
【００６８】
図１８は、本発明による半導体パッケージを搭載するための配線基板の一実施例を示す。図において、配線基板１６０はガラスエポキシシートにＣｕ箔パターンが形成された基板を積層した多層有機基板である。基板表面には、各種半導体パッケージや受動素子の接続端子１６５，１６９，１７０，１７１が形成されている。本発明の半導体パッケージを搭載するための接続端子は、パッケージの腹部に納まる大きさのドレイン用接続端子１６１，１６８，ソース用接続端子１６４,１６７，ゲート用接続端子１６２，１６３，１６６から構成される。図１９は、図１８の配線基板に、本発明の半導体パッケージやＬＳＩパッケージや素子を搭載した電子装置の一実施例を示す。図において、配線基板１６０には信号処理用のＬＳＩパッケージ１７６，１７７，１７８と縦型半導体パッケージ１７２，１７５と抵抗及びコンデンサの受動素子１７３，１７４が半田接続により搭載されている。
【００６９】
本実施例によれば、パワー半導体パッケージと基板間の接続面積が大きく、発熱体であるチップと基板間が最短距離で接続されるため、基板とパッケージの温度差が小さくなり、半田接続部に発生する応力が低減されて信頼性の高い電子装置を提供することができる。また、パッケージの発熱を低減しているため、特別な放熱機構を設けなくてもデバイス温度が正常な動作温度領域を超えて温度上昇することがなく、電子装置の構造を簡略化できてコストを抑えられ、温度上昇が低くなることから電子装置の寿命を向上できるという効果もある。
【符号の説明】
【００７０】
１，２１，３５，５０，６５，９７，１２０，１３０，１４５，１９０…半導体チップ、２…ソース用Ａｌ電極、３…ゲート用Ａｌ電極、４，３７，５３，６８，１０２，１２２，１３２，１４７，１９２…裏面電極、５…ソース用リード端子、６…ゲート用リード端子、７，６９…ドレイン用ダイ端子、８，３０，４５，５７，７１，１３９，１５４…Ａｕバンプ、９…開口部、１０…スリット、１１，１３，２４，２７，３８，４１，１３４，１３７，１４８，１５１…Ｃｕコア、１２，１４，４２，１４９，１５２…Ｐｄ／Ａｕめっき、１５…Ａｇめっき、１６，３２，４７，５９，１０３，１２８，１４２，１５７，１９７…樹脂匡体、２２，３６，６６，６７，９８，９９，１２１，１３１，１４６，１８１，１９１…Ａｌ電極、２５，２８，３９…貴金属めっき、２６，４０，１３５，１５０…リード端子、２９，４３，１２４，１３８，１５３…ダイ端子、３１，７０，１２５…Ａｇバンプ、４４…ザグリ加工部、４６…Ａｇペースト、５１…主電流用Ａｌ電極、５２…制御用Ａｌ電極、５４…裏面電極用外部接続端子、５５…主電流用外部接続端子、５６…制御用外部接続端子、５８…Ａｇメッシュシート、６１，９１…ソース用リード、６２，９２…ゲート用リード、６３…リード吊、６４，９４，９６…リード枠、７３…接合ツール、７４…ヒートステージ、７５…ヒータ、７６…超音波振動、８０…モールド上金型、８１…モールド下金型、８２…キャビティ、８３…逃げ空間、９３…ネック部、９５…ドレイン用ダイ、１００…Ａｕボールバンプ、１０１…Ａｇボールバンプ、１０４…ドレイン用リード、１１０，１４０，１５５…Ａｇシート、１１１，１４１，１５６…溝、１１２…Ａｇコア、１１３…Ｓｎめっき、１１４，１１５…Ａｇワイヤ、１２３…リード、１２６…Ａｇ粒子、１２７…樹脂、１３３，１３６…Ｐｄめっき、１６０…多層有機基板、１６１，１６８…ドレイン用接続端子、１６２、１６３，１６６…ゲート用接続端子、１６４，１６７…ソース用接続端子、１６５…受動素子用接続端子、１６９，１７０，１７１…ＬＳＩパッケージ用接続端子、１７２，１７５…縦型半導体パッケージ、１７３…抵抗素子、１７４…コンデンサ素子、１７６,１７７,１７８…ＬＳＩパッケージ、１８０…チップ、１８２…チップ裏面電極、１８３…ソース用外部接続端子、１８４…ドレイン用外部接続端子、１８５…金属バンプ、１８６…接合部、１９３…第２外部接続端子、１９４…第１外部接続端子、１９５…貴金属バンプ、１９６…貴金属接合部材、１９８…第３外部接続端子。
【技術分野】
【０００１】
本発明は、半導体装置に係り、特に実装抵抗の低減に好適な半導体パッケージ構造に関する。
【背景技術】
【０００２】
従来のトランジスタパッケージの一例として、特開平8−64634号公報に開示されているものがある。熱放散用のヘッダに電子回路が形成された半導体チップが裏面電極側で半田により接合されている。チップの回路形成面側のＡｌ電極には、バンプが形成され、インナーリードが電気的及び機械的に接続されている。また、ヘッダにもインナーリードが接続され、チップ及びヘッダとリードの一部を覆うように樹脂で封止されている。このとき、バンプが半田の場合はリード側に錫（Ｓｎ），金（Ａｕ），半田等をめっきしてバンプの半田を溶融して接合し、バンプがＡｕの場合にはリード側に錫をめっきしてＡｕ−Ｓｎ共晶反応によって接合している。インナーリードは、ソース電極，ドレイン電極，ゲート電極用の３本で構成され、ソース電極用リードは櫛歯形状に加工されている。ヘッダには、樹脂まで貫通する開口部が形成されている。
【０００３】
他の従来例として、特開平5−121615号公報に開示されているワイヤレス構造の表面実装型半導体パッケージがある。３つの外部接続端子が半導体チップの電極端子に接続されている。チップ上面の２つの電極と外部接続端子はＡｕボールを熱圧着することにより接続されている。配線基板への実装は、チップ搭載部から前後に導出されたリード端子の先端領域を基板の端子に半田付けして行われる。
【０００４】
また、従来の標準的な表面実装型半導体パッケージにおいては、ドレイン用リードのヘッダに半導体チップが半田により接着され、半導体チップのソース及びゲート電極と外部接続端子のソース及びゲート用リード間がＡｌワイヤのボンディングにより結線されている。チップ及び各リードとヘッダの一部が樹脂でモールドされている。樹脂パッケージの底面にヘッダが露出して配線基板に接続可能な構造となっており、その大きさは樹脂モールドのサイズより大きく設定されている。
【０００５】
また、半導体チップの従来のチップ・ダイ接続構造においては、Ｃｕ基合金の部材にチップを固着したときチップに高い応力を発生させないために、降伏強度の低いＰｂリッチな半田やＡｇ粒子を混入した導電性樹脂による接着構造が採用されていた。
【先行技術文献】
【特許文献】
【０００６】
【特許文献１】特開平８−６４６３４号公報
【特許文献２】特開平５−１２１６１５号公報
【発明の概要】
【発明が解決しようとする課題】
【０００７】
従来の縦型半導体素子の表面実装型プラスチックパッケージにおけるパッケージの実装抵抗は、ワイヤボンディング構造で数十〜十数ｍΩであった。半導体技術の進歩により、素子のオン抵抗が年々減少し、現状は数十〜数ｍΩ／cm2のデバイスが開発されつつあり、将来はさらに低抵抗化が進められると予測される。
【０００８】
その場合、実装抵抗がデバイス抵抗より大きくなるため、半導体パッケージの性能向上を図るためには、実装抵抗の低減が不可欠となる。この半導体パッケージのオン抵抗に着眼した公知例が上記特開平8−64634号公報に開示されているが、この公知例は挿入実装型パッケージで提案されている。挿入実装型は、パッケージサイズに制約がなく、しかも基板とリードの接合が構造的に強固であるため、厚肉で大型サイズのヘッダを使用でき、リードも厚肉のものを使用できる。このため、実装抵抗の低減は比較的容易である。しかし、表面実装型パッケージは、樹脂匡体の両サイドから導出されたリードが、その先端部で基板の端子と小さい面積の面同士で半田接続される構造であるため、挿入実装型に比べて接合部の疲労強度が弱いという性質がある。このため、チップの発熱に伴うパッケージと基板間の熱歪みを柔軟なリードの変形によって吸収することが必要であり、リードの形状を薄肉で細長い形状とすることが必要である。この場合には、リード部分の電気抵抗が大きくなるため、実装抵抗の低減は困難である。
【０００９】
表面実装型の場合、チップを搭載したヘッダを直接配線基板に半田付けする構造にすれば、この問題はなくなる。しかし、チップ上面の電極に接続されるリードを樹脂匡体からの導出する位置と、ヘッダを導出する位置が高さの点で異なる場合、樹脂をモールドする上下金型の合わせ面が３次元構造となり、金型の加工が難しくなるという問題がある。この問題は、特にリードフレームが、パッケージの多数個取りを目的としたマトリックスフレーム（Ｘ，Ｙ方向に配置）の場合に顕著となる。ヘッダを小さくして樹脂匡体内に納めればこの問題はなくなるが、そうすると、ヘッダを樹脂匡体の下面に露出させるためにヘッダをモールド金型の底面に押し付けるための加圧場所をモールド内部に設ける必要がある。ヘッダが大きい場合はヘッダの開口部を利用して押し付けることが可能だが、ヘッダがチップと同等サイズの場合にはヘッダ部に押し付ける場所がなく、ヘッダを下面に露出させてモールドすることが難しくなるという問題がある。このため、ヘッダがチップと同等サイズの小型の半導体パッケージの場合には、裏面電極の外部接続端子を兼ねるヘッダを樹脂匡体内に納めた構造で組み立てることが技術的に困難である。
【００１０】
一方、従来において、チップ裏面とヘッダやダイ等の外部接続端子との接続は、半田接続かあるいは導電性樹脂による接着構造が採用されてきた。半田接続は、電気抵抗や熱抵抗及び耐熱信頼性に優れた接続構造であるが、近年の環境問題の観点からＰｂレス化が要求されており、従来のＰｂ入半田から新たなＰｂレス接合材料に変える必要が生じている。しかし、固相温度が２５０℃以下のＰｂレス半田材料は種々あるものの、パッケージの基板への搭載に耐えるような固相温度２７０℃以上を持つ適当なＰｂレス半田材料はないのが実情である。唯一、固相温度３７０℃のＡｕ−Ｓｉ半田があるが、この半田は、コストが高いこと、降伏強度が高いためチップサイズが大きい場合は半田付け後の冷却過程でチップが割れてしまうという２つの理由によってチップ裏面電極用半田材として採用困難である。すなわち、現状、Ｐｂレスの代替半田材がないという問題がある。一方、導電性樹脂による接着は、耐熱的には短時間であれば実装に必要な２７０℃に耐えることができるが、接着強度が樹脂で保たれているため強度的に弱く、モールド樹脂の硬化収縮力で密着を補強しているものの、大面積のチップや高温で使用されるパッケージでは、経年変化や温度サイクルによる樹脂の劣化によって接合部の電気抵抗や熱抵抗が増加するという問題がある。特に、ヘッダやダイ（外部接続端子）が樹脂匡体の表面に露出している片面モールド構造では、チップ裏面にモールド樹脂による押し付け力が得られない構造となるため、導電性樹脂接着部の長期信頼性がさらに低くなるという問題がある。
【００１１】
本発明は、上記の問題点を考慮してなされたものであり、実装抵抗の低減が可能なパッケージ構造を有する半導体装置を提供する。
【課題を解決するための手段】
【００１２】
本発明による半導体装置は、半導体基板と、前記半導体基板の表面に設けられる第１の電極と、前記半導体基板の裏面に設けられる第２の電極とを有する半導体素子と、前記第１の電極に接続される第１の金属部材と、前記第２の電極に接続される第２の金属部材と、前記半導体素子を被覆する絶縁体と、を有し、前記第１の金属部材は、前記第１の電極との接合面の裏面側に露出部分を有し、前記第２の金属部材は、前記第２の電極との接合面の裏面側に露出部分を有している。
【００１３】
また、本発明による半導体装置は、まず、半導体基板と、半導体基板の表面に設けられる第１の電極と、半導体基板の裏面に設けられる第２の電極とを有する半導体素子を備える。さらに、第１の金属部材が、第１の貴金属を含む第１の金属体を介して、半導体素子の第１の電極と接続され、かつ、第２の金属部材が、第２の貴金属を含む第２の金属体を介して、第２の電極と接続される。
【００１４】
本発明によれば、第１及び第２の金属部材が、それぞれ貴金属を含む金属体を介して半導体素子の電極と接続されるので、半導体パッケージの実装抵抗を低減することができる。
【００１５】
上記の構成において、好ましくは、外部配線と接続するための第１の金属部材の表面部分及び第２の金属部材の表面部分を略同じ平面内に位置させる。ここで、略同じ平面とは、例えば、各種電子装置における配線基板や回路基板の電子部品取り付け面である。これにより、半導体装置を、配線基板や回路基板などに、面実装することができる。
【００１６】
第１の金属体としては、半導体素子の第１の電極または第１の金属部材から突出する突起状電極がある。突起状電極としては、金（Ａｕ）または銀（Ａｇ）などの貴金属のバンプ電極やボール状電極などが適用できる。さらに、実装抵抗を低減するために好ましくは、複数の突起状電極を、第１の電極と前記第１の金属部材との接合界面の略全面において、略等間隔に配列する。
【００１７】
第２の金属体としては、第２の電極と第２の金属部材との接合界面に位置する金属層がある。好ましくは、金属層を、第２の電極の接合表面側及び第２の金属部材の接合表面側に位置する各貴金属層が互いに接合したものとする。貴金属層の材料としては、金（Ａｕ），銀（Ａｇ），白金（Ｐｔ），パラジウム（Ｐｄ）などから選択される貴金属、あるいはそれを最も多く含む主成分とする合金が適用できる。また、複数種の貴金属層あるいは合金層が多層化されていても良い。
【００１８】
さらに、第２の電極側に位置する貴金属層と、第２の金属部材側に位置する貴金属層との間に、金（Ａｕ）または銀（Ａｇ）などの貴金属のバンプ電極やボール状電極，樹脂と混合された銀（Ａｇ）粒子，板状またはシート状あるいは網目状の銀(Ａｇ)部材，凹凸あるいは空隙部を有する板状あるいはシート状の銀部材のいずれかが介在しても良い。好ましい他の金属層としては、貴金属を主成分とする固相温度４００℃以上の合金層がある。このような合金層としては、銀(Ａｇ)を主成分とする銀（Ａｇ）と錫（Ｓｎ）との合金を適用できる。
【００１９】
半導体素子の第１及び第２の電極、並びに第１及び第２の金属部材においては、これらの接合表面に貴金属層を設けても良い。この貴金属層の材料としては、金（Ａｕ），銀（Ａｇ），白金（Ｐｔ），パラジウム（Ｐｄ）などから選択される貴金属、あるいはそれを最も多く含む主成分とする合金が適用できる。半導体素子における第１及び第２の電極の材料としては、アルミニウム、またはアルミシリコンのようなアルミニウム合金が適用できる。
【００２０】
また、第１及び第２の金属部材は、半導体素子の第１及び第２の電極を外部の電極，配線基板，回路基板などと電気的に接続する。例えば、第１及び第２の金属部材は、半導体パッケージの一部であるリード線，リード電極、またはダイ端子など、あるいはこれらの一部である。そして、実装抵抗を低減するために好ましくは、第１の金属部材が、第１の電極との接合部を有する部分から延びる複数の部分を有し、この複数の部分の各々が、外部配線と接続するための表面部分を有する構成とする。このような半導体装置が接続される回路基板または配線基板においては、第１の金属部材における上記のような各表面部分毎に、電気的接続のための導体部（例えば銅箔）が設けられ、かつこれらの導体部は、回路基板上または配線基板上で電気的に接続されている。例えば、このような導体部としては、プリント基板における、連続した導体（例えば銅）パターンが適用できる。
【００２１】
上述したような、本発明による半導体装置の構成は、いわゆる樹脂封止型または樹脂モールド型の半導体装置のように、半導体素子と第１及び第２の金属部材とが絶縁体によって被覆される半導体装置にも実施できる。この場合、第１の金属部材における第１の電極との接合面の裏面が、外部配線と接続するための露出部分を有することが好ましい。このような構成に加え、半導体素子の接合面側を回路形成面（たとえば縦型半導体スイッチング素子の一方の主電流電極と制御電極が形成されている面）とし、第１の電極を主電流電極とすると良い。なお、半導体素子と第１及び第２の金属部材とが絶縁体によって被覆される半導体装置においては、第２の金属部材における第２の電極との接合面の裏面が、外部配線と接続するための露出部分を有していても良い。なお、絶縁体の材料としては、各種樹脂の他、セラミックスなどの他の絶縁性材料も適用できる。
【００２２】
上述した各構成は、適宜併用することができる。また、次に述べる本発明による他の半導体装置のように、単独でも実装抵抗を低減する作用・効果を有する構成もある。
【００２３】
すなわち、本発明による他の半導体装置としては、半導体基板の表面及び裏面にそれぞれ第１の電極及び第２の電極とを有する半導体素子が収納される半導体パッケージにおいて、上述したような、１）第２の電極と第２の金属部材とが、第２の電極の接合表面及び前記第２の金属部材の接合表面に設けられる貴金属層が互いに接合した金属層を介して接合される構成、２）第２の電極と前記第２の金属部材とが、貴金属を主成分とする固相温度４００℃以上の合金層を介して接合される構成、３）第１の金属部材が、第１の電極との接合部から延びる複数の部分を有し、複数の部分の各々が、外部配線と接続するための表面部分を有する構成、のいずれかを実施したものがある。また、１）または２）の構成と、３）の構成を併せて実施しても良い。
【００２４】
上述した本発明による各半導体装置は、ＭＯＳ（Metal Oxide Semiconductor)電界効果トランジスタ，ＭＩＳ(Metal Insulator Semiconductor）電界効果トランジスタ，バイポーラトランジスタ，絶縁ゲートバイポーラトランジスタ，ダイオード、あるいは集積回路などの各種の半導体素子に適用できる。また、本発明による各半導体装置の構成は、第１及び第２の電極を一対の主電流電極とする半導体素子、並びに第１及び第２の電極を主電流電極とし、主電流が、表面側の第１の電極から裏面側の第２の電極へ向かう方向あるいはその逆方向に向かって、半導体基板中を縦方向に流れる、パワーＭＯＳＦＥＴやパワートランジスタのような縦型半導体素子に好適である。この場合、半導体素子の低オン抵抗特性とあいまって、パッケージを含めた端子間のオン抵抗またはオン電圧を低減できる。
【発明の効果】
【００２５】
本発明によれば、パッケージの実装抵抗を低減することができる。
【図面の簡単な説明】
【００２６】
【図１】本発明による半導体パッケージの一実施例を示す図である。
【図２】本発明による半導体パッケージの他の一実施例を示す図である。
【図３】本発明による半導体パッケージの他の一実施例を示す図である。
【図４】本発明による半導体パッケージの他の一実施例を示す図である。
【図５】本発明による半導体パッケージに用いるリードフレームの一実施例を示す図である。
【図６】本発明による半導体パッケージの組み立て構造及び方法の一実施例を示す図である。
【図７】本発明による半導体パッケージの組み立て途中のリードフレーム構造を示す図である。
【図８】本発明による半導体パッケージの樹脂モールド方法の一実施例を示す図である。
【図９】本発明による半導体パッケージの組み立てフローの一実施例を示す図である。
【図１０】本発明によるＰｂレス半導体パッケージの組み立て構造の一実施例を示す図である。
【図１１】本発明によるＰｂレス半導体パッケージの一実施例を示す図である。
【図１２】本発明によるチップ裏面電極のＰｂレス接合部材の一実施例を示す図である。
【図１３】本発明によるチップ裏面電極のＰｂレス接合部材の他の一実施例を示す図である。
【図１４】本発明によるチップ裏面電極のＰｂレス接合部材の他の一実施例を示す図である。
【図１５】本発明による半導体パッケージの他の一実施例を示す図である。
【図１６】本発明による半導体パッケージの他の一実施例を示す図である。
【図１７】本発明による半導体パッケージの他の一実施例を示す図である。
【図１８】本発明による半導体パッケージを搭載する配線基板の一実施例を示す図である。
【図１９】本発明による半導体パッケージを搭載した電子装置の一実施例を示す図である。
【図２０】半導体パッケージの電流経路モデルを示す図である。
【図２１】本発明の半導体パッケージの基本構造の一例を示す図である。
【発明を実施するための形態】
【００２７】
第１の一実施形態は、トランジスタチップのゲート電極及びソース電極と外部接続用金属部材（リード）間の接続を最適に配置した複数のＡｕバンプを介して直接接合し、チップ裏面のドレイン電極と外部接続用金属部材（ダイ）を電気的及び熱的に結合し、ソース電極及びゲート電極用金属部材（リード）またはドレイン電極用金属部材（ダイ）のいずれか一方が多面体のパッケージの内部に納まる構造とし、パッケージ内に納めた金属部材の面を配線基板の端子面に半田接合できる構造としたものである。
【００２８】
さらに好ましくは、パッケージから導出するリードまたはダイの導出部をパッケージの側面２面からとる構造とし、パッケージ内部に納めた金属部材をモールド金型の底面に押し付ける方法を、パッケージから導出した金属部材を介して行える構造とする。
【００２９】
また、第２の実施形態は、ドレイン電極と貴金属めっきを施した金属部材（ダイ）とを貴金属バンプあるいは貴金属のメッシュシートあるいは貴金属粒子あるいは硬さ３５Ｈｖ以下の厚い貴金属めっきを介して直接あるいは貴金属を主成分とする固相温度４００℃以上の合金層を介して接合した構造である。この接合部は、加熱と超音波振動を用いた圧接で得ることができる。さらに好ましくは、チップサイズが大きい場合に、チップ上回路形成面のソース電極とゲート電極にＡｕバンプを形成し、貴金属めっきを施したリードとを直接接合する構造とし、さらにソース電極側のリードとチップ裏面のダイの大きさを同等としてチップに曲げ応力がかからないように部材を対称形に配置した構造とする。
【００３０】
また、第３の実施形態は、チップ上面のソース及びゲートＡｌ電極上に予めＡｕバンプを多数形成し、貴金属めっきした各リードに位置合わせしてチップを搭載し、その上にＡｕバンプより硬さの小さい貴金属部材、さらにその上に貴金属めっきしたダイを搭載し、ダイの上に加圧と超音波振動を加える接合ツールを配置して、加熱と荷重と超音波により各接合界面を一括して接合する構造及び方法とした。
【００３１】
まず、第１の実施形態について、詳細に説明する。図２０に、半導体パッケージの電流経路モデルを示す。図において、１８４：ドレイン用外部接続端子、１８６：接合部、１８２：チップ裏面電極、１８０：チップ、１８１：Ａｌ電極、１８５：金属バンプ、１８３：ソース用外部接続端子（リード）である。ソース／ドレイン用外部接続端子間の電気抵抗Ｒは（１）式で表わされる。
【００３２】
Ｒ＝Ｒ１＋Ｒ２＋Ｒ３＋Ｒ４＋Ｒ５＋Ｒ６＋Ｒ７ …（１）
（１）式でチップの内部抵抗Ｒ４を除いた部分が実装抵抗となる。バンプの抵抗Ｒ６は、
Ｒ６＝（ρ×ｈ／Ｓ）／ｎ …（２）
(ここでρ：バンプの固有抵抗，ｈ：バンプ高さ，Ｓ：断面積，ｎ：バンプ数)で表わされる。Ａｕバンプの寸法は、Ａｌパッド上にバンプを低コストで直接形成できるワイヤのボールボンディングで作るとすると、直径：１５０μｍ，厚さ：２０μｍが標準的な寸法になる。この場合のバンプの抵抗は（０.０２６／ｎ)ｍΩとなり、十分小さくできる。次にＡｌ電極膜の抵抗Ｒ５は、
Ｒ５≒（ρ／４πｔ）ｌｎ（ｒ２／ｒ１） …（３）
（ここで、ρ：電極膜の固有抵抗，ｔ：電極膜厚，ｒ２：電極外径，ｒ１：バンプ径）で表わされる。電極外径ｒ２は、バンプを均等にｎ個配置した場合ほぼ１／(ｎ1/2）に比例するためｎ数を増せばｒ２／ｒ１は１に近づき、電極膜厚を厚くしてバンプ数を多くすれば、Ｒ５は十分に小さくできる。外部接続端子の抵抗（Ｒ１＋Ｒ７）は、単純に、
（Ｒ１＋Ｒ７）＝ρ×Ｌ／Ｓ …（４）
（ここでρ：リードの固有抵抗，Ｌ：リードの通電長さ，Ｓ：通電断面積）で表わされ、前述したように標準的な表面実装用のＳＯＰパッケージの場合（厚さ：０.１６mm／幅：０.３mm／長さ：２mm×２)で１.４ｍΩ程度になる。すなわち、実装抵抗が１ｍΩ以下のレベルでは、単にバンプ構造を採用するだけでは実装抵抗を下げられず、外部接続端子の抵抗を下げる構造を採用しなければならない。そこで、本発明による半導体装置においては、外部接続端子の抵抗を下げると同時に、外部接続端子と配線基板の接続部の信頼性を確保し得る構造とした。
【００３３】
図２１に、本発明による半導体装置１の基本構造を示す。外部接続端子の抵抗を下げるには、単純に通路断面を増して流路を短縮する以外に方法がないため、外部接続端子の一方は端子の板厚方向に電流経路を取る構造する。この場合、通電距離（０.１〜０.２mm）に比べて通電断面が数〜数十mm2と十分大きいため、この第１外部接続端子部１９４の抵抗は１μΩ以下にできる。他方の第２外部接続端子１９３は、チップの側面から降ろして配線基板の端子と接続する構造となるため通電距離が数mmとなるが、パッケージの両側から導通をとることで、２倍の通電断面積を確保できる。また本構造では、後で述べる理由によって、第２外部接続端子に幅広で厚肉の部材を使うことができるため、さらに数倍の通電断面積を確保することができ、従来に比べて十数分の１程度まで電気抵抗を下げることが可能となる。
【００３４】
従来のパッケージ構造では、第２接続端子の剛性が高くなると配線基板との接続部の長期信頼性が低下するという問題があるが、本発明の構造においては、樹脂匡体の腹部の第１外部接続端子面積が十分大きく熱源のチップと配線基板が近接した構造であるため基板との温度差が小さく、また接続端子の材質がＣｕ合金であるため基板と熱膨張率が近くて熱歪みが小さいことにより、第１及び第２接続端子と基板との接合部に発生する熱歪みの絶対値が小さくなり、第２接続端子の剛性が高くても温度サイクル信頼性を確保できるのである。また、第２接続端子と基板との接続部には、チップを内蔵する樹脂匡体と折曲げた足に相当するＣｕ部材の高さ方向の熱膨張の差によって温度上昇時に押し付け力が働き、この効果によっても従来のパッケージに比べて温度サイクル信頼性が向上し、第２接続端子の剛性を高くできる。
【００３５】
また、図２１のパッケージを組み立てるためのモールド工程において、第２接続端子１９３を上金型の側壁で押し下げることにより、貴金属バンプ１９５を介して第１接続端子部材１９４をモールド金型の底面に押し付けることが可能となり、金型に特別な工夫を加えることなく樹脂匡体の腹部に接続端子が確実に露出したパッケージを組み立てることが可能となるのである。この場合、特に重要なポイントとなるのは、バンプを介して接続された第２接続端子部材を樹脂匡体の両側から出していることである。第２端子部材の両側から押し下げることにより、第１端子部材の傾きの発生やバンプの剥がれを防いで、確実で歩留りの高い樹脂モールドが可能となっている。もし片側で押し下げる構造では、押し下げた第２端子部材の金型接触部と第１端子部材の下金型接触部間でモーメントが発生し、一部のバンプ接合部に引張力が発生して接合部剥がれが発生したり、第１端子部材の片側が浮いて接合面に樹脂が回り込む不良を発生したりするため、確実で歩留りの高い樹脂モールドができない。
【００３６】
次に、第２の実施形態について詳細に説明する。チップ裏面の接合に要求される特性は、１）電気的導通が取れて外部接続端子（ダイ）への熱伝導性が高いこと、２）温度サイクル寿命が高いこと、３）パッケージを基板に搭載するときの半田付け温度に耐えることと、４）チップ裏面の広い領域の接合が量産ラインの短いタクトで可能であり、チップへの悪影響がないことの４点である。Ｐｂレスの適当な高融点半田材料がないため、半田以外の材料を使って上記特性を満たす接合を行う必要がある。貴金属材料を接合材料に用いた場合、材料の熱伝導率が従来半田の１０倍程度あるため、同一接合厚さにした場合でも接合箇所がチップ裏面に均等に分散していれば１／１０の接合面積で同じ伝熱特性が得られる。つまり熱放散性において、非常に有利である。温度サイクル寿命に関しては、チップの熱膨張と外部接続端子（ダイ）の熱膨張差に伴う熱歪みをどこの変形で吸収するかが大きく影響する。従来の半田では、半田の降伏強度が低かったため、歪みのほとんどを半田の変形で吸収し、半田部で破壊していた。この場合、チップに歪みがほとんど加わらないためチップ特性の安定性や信頼性が高いという利点はあった。これに対して貴金属部材で接合した場合は、降伏強度が半田よりは高く、ＳｉやＣｕよりは小さいため、チップやダイの歪みは増すが接合部の寿命は長くなる。チップに加わる歪みの大きさは、貴金属層の中に放熱性が問題とならない程度に空洞を設けることで調整することができる。具体的に空洞を設ける手段としては、接合部材にメッシュシートや粒子や凹凸のあるシートやめっき膜を用いることで空洞が得られる。
【００３７】
耐熱性に関しては問題ない。最も重要なのは接合組み立て性である。貴金属同士を従来の熱圧着法で接合する場合には、短時間で接合するために加熱温度を４００〜５００℃にする必要があった。この方法では、室温との温度差が大きいため冷却過程の熱歪み量が大きくなりチップサイズがそれほど大きくない場合でも破損する危険が大きいという問題があった。本発明においては、その問題を解決するために接合温度を２５０℃以下とし、その温度で確実な接合を達成するために超音波振動を利用する方法を採用した。しかしチップをダイに超音波接合する場合には、ダイとチップを硬質のヒートステージと硬質の接合ツールで挟んで加圧しつつ超音波振動を加えるため、チップの回路形成面と硬質の接合治具が接触した部分でチップが破損するという問題が生じる。この問題に対して、本発明ではチップの回路形成側の電極にＡｕバンプを形成し、回路形成側にもダイと同等サイズの外部接続端子部材（リード）を合わせて配置し、チップと硬質の接合治具が直接接触しない構造としてチップの破損を防いだ。チップの上下２ヵ所に接合箇所がある場合、接合の程度にばらつき（片側がよく接合されて、片側が接合されない状態）が生じることが懸念されるが、超音波接合において接合箇所が接合治具に対して直列に配置されている場合には、片側の接合が進行するとその部分の相対振動が押えられ、接合されていない部分の相対振動が大きくなってそこの接合が進行するという自己調整機能が働くため、２ヵ所とも同程度の強度の接合部が得られるのである。ただし、接合面積を放熱の点からチップ裏面側で広くしたい場合は、チップ上下の接合材料を変えてチップの回路形成面側を降伏強度が高くチップ裏面側を降伏強度が低い材料にして接合することで、接合面積に差をつけることが可能である。以上の接合構造と接合方法を採用することにより、Ｐｂレスで高性能・高信頼性のチップ裏面接合が可能となる。
【００３８】
なお、第３の実施形能の作用・効果については、第２の実施形態に記述した通りである。実際の接合時間は、ワークの移動や位置決めの時間を除くと数百ｍｓ程度で、現行の複数本のワイヤボンディングに要している時間より短い時間である。予めＡｕバンプをチップのＡｌ電極に形成しておく必要があるが、生産タクトの点で影響がなく、チップ・ダイ接続とボンディングを同時に行える点で従来より生産タクトの短縮が可能となる。
【００３９】
（実施例）
以下、上記の実施形態の具体的構造を示す本発明の実施例を図面を用いて詳細に説明する。
【００４０】
図１は、本発明による半導体パッケージの一実施例を示す。（ａ）は樹脂部を除去し外部接続端子を透視した上面図、（ｂ）は断面図、（ｃ）は下面図である。図において、半導体チップ１は４×２mmの大きさの縦型ＭＯＳトランジスタであり、ソース及びゲート用Ａｌ電極２，３の膜厚は約４μｍ、ドレン電極となる裏面電極４の最表面にはＡｕが蒸着されている。チップのソース及びゲート電極には多数または複数Ａｕバンプ８が、ボールボンディング法によって、均等にすなわち各電極の全面にほぼ等間隔に配置されて形成されている。ソース及びゲート用リード端子５，６は、Ｃｕコア１１にＰｄ／Ａｕの貴金属めっき１２が施された構造で、板厚０.２mm である。ソース用リード端子５の幅は、ソース電極２とほぼ同じ大きさである。すなわち、ソース用リード端子５はソース電極２のほぼ全面を覆う。チップ上のＡｕバンプと各リード端子のＰｄ／Ａｕ面は２３０℃の加熱温度でダイレクトに超音波圧着されている。圧着されたＡｕバンプの大きさは、ほぼ１５０μｍΦ×２０μｍである。外部接続用ダイ端子７は、Ｃｕコア１３にＰｄ／Ａｕの貴金属めっき１４が施された構造で、片面にはさらに約１０μｍのＡｇめっき１５が施されている。チップ裏面電極のＡｕ面とダイ端子のＡｇめっき面はＡｕバンプ／リード端子の場合と同様に２３０℃の加熱温度でダイレクトに超音波接合されている。ソース用リード端子は、モールドされた樹脂匡体１６の左右の側壁から外に導出され、かつ折り曲げ加工が施されており、左右に取り出された幅広のリード端子にはスリット１０が設けられ、また、チップ上に位置する部分にはいくつかの開口部９が設けられている。ゲート用リード端子も樹脂匡体１６の左右の側壁から外に導出されている。ドレイン用ダイ端子は樹脂匡体の底面に露出している。ダイ端子の下面（配線基板上接続端子との接続面）と曲げ加工されたソース及びゲート用リード端子の下面（同接続面）は同じ高さすなわち同一平面になるように加工されている。
【００４１】
本実施例によれば、ソース電極とソース用リード端子が、均等配置された多数のＡｕバンプによって接続され、幅広のリード端子が左右から導出された構造であること、ダイ端子が裏面電極とＡｇめっき膜によって直接接合され、配線基板までの流路断面が大きくかつ通電距離が非常に短い（板厚分）構造であることから、パッケージの実装抵抗を大幅に下げることができる。これにより、実装抵抗１ｍΩ以下という従来にはない低実装抵抗の半導体パッケージを備える新規な半導体装置が得られる。また、チップとＣｕ端子との接合部には回路面側は厚さ２０μｍのＡｕバンプ、チップ裏面側は厚さ１０μｍのＡｇめっきが介在しており、それらがＣｕ端子材に比べて柔らかい（降伏強度が低い）材料であるためクッション材の役割を果たし、チップに大きな力が加わることを防ぐ効果があること、ＡｕやＡｇは半田に比べて温度サイクル寿命が長いことのために、半導体パッケージとしての長期信頼性に優れるという利点がある。また、配線基板に搭載した場合には、ダイ端子の広い面積で基板と接合され、発熱体のチップと最短距離で良好な熱伝導状態で接続されるため基板とパッケージの温度差が小さく、基板の熱膨張率とＣｕ端子の熱膨張率は近いため両者の間に発生する熱歪みは小さい。このため、半導体パッケージと配線基板間の接合部は温度サイクル寿命が長く、長期信頼性に優れる利点がある。さらには、チップ上に位置するソース用リード端子に開口部を設けているため、Ａｕバンプが潰れてリード端子とチップの間隙が小さくなった場合でも、開口部から樹脂の侵入が生じること、開口部からガス抜きが行われることの２つの効果で樹脂モールド工程におけるボイドの発生を防ぐことが可能となり、パッケージの信頼性を損なうことがない。
【００４２】
また、チップの裏面電極とダイ端子との接続構造として、Ａｇめっき膜を介してＡｕ／Ａｇの超音波接合を行っており、半田レス接合としているため、耐熱性が高く温度サイクル信頼性の高い接続構造を持つ半導体パッケージを提供できる。
【００４３】
なお、ここではＡｕバンプのサイズとして１５０μｍΦとしたが、バンプの形成が可能であれば数百μｍΦと大きくする方がよい。バンプサイズを大型化すると、さらに低抵抗化が図れ、また接合強度を向上できるためパッケージ組み立て時の外力によるバンプ接合部の剥がれ発生を防止するのに有効となり、製造歩留りを向上できるという効果がある。
【００４４】
図２は、本発明による半導体パッケージにおいて、Ａｇバンプ圧着方式をチップ・ダイ接続に採用した場合の一実施例を示す。図において半導体チップ２１のＡｌ電極２２と貴金属めっき２５を施されたリード端子２６はＡｕバンプ３０によって強固に接合されている。チップの裏面電極２３と貴金属めっきを施されたダイ端子２９はＡｇバンプ３１によって接合されている。リード端子は片側が樹脂匡体３２の側壁近傍で切断され、片側は配線基板の端子と接続するために曲げ加工が施されてダイと同じ高さに揃えられている。
【００４５】
本実施例によれば、チップとダイ端子間がＡｇバンプで接続されているため構造的に変位を吸収可能でる。このため、ダイ端子／チップ間の接合部の温度サイクル寿命が格段に長く、Ｐｂレスで環境にやさしく信頼性の高い半導体パッケージを提供できる。また、配線基板の接続端子との半田接合部には、熱歪みがほとんど加わらないため、実装信頼性を大幅に向上できる。また、パッケージをチップと同等なサイズにまで小型化でき、パッケージの厚みも１mm程度に薄型化することができ、高密度実装に適した小型の表面実装用半導体パッケージを提供できる。
【００４６】
図３は、本発明による半導体パッケージにおいて、Ａｇペースト接着方式をチップ・ダイ接続に用いた場合の一実施例を示す。図において半導体チップ３５のＡｌ電極３６と貴金属めっき３９されたリード端子４０はＡｕバンプ４５によって強固に接合されている。チップの裏面電極３７とダイ端子４３はＡｇペースト４６によって接着されている。ダイ端子はＣｕコア４１にＰｄ／Ａｕめっき４２された構造で、周囲にはモールド樹脂へのアンカー効果が働くように端面のザグリ加工処理が施されている。リード端子は樹脂匡体４７の両サイドから取り出されている。
【００４７】
本実施例によれば、図１の実施例と同様の効果が得られる。また、ダイ端子の端面に樹脂に食い込む形状の加工を施したため、モールド樹脂の収縮力でダイ端子をチップ裏面に押し付けることができ、組み立てが簡便に行えるＡｇペーストによるチップ・ダイ接続方式を採用しても信頼性のある半導体パッケージを提供できる。
【００４８】
図４は、本発明による半導体パッケージにおいて、回路形成面を配線基板に向けた実装が可能なパッケージ構造の一実施例を示す。図において、半導体チップ５０の回路形成面側の主電流用及び制御用Ａｌ電極５１，５２には、図１の実施例と同様に各々複数のＡｕバンプ５７が形成され、各電極サイズと同等で樹脂匡体５９面内に納まる大きさの主電流用外部接続端子５５と制御用外部接続端子５６が超音波熱圧着されている。各外部接続端子表面にはＰｄ／Ａｕフラッシュめっきが施されている。チップ裏面には最表面がＡｕまたはＡｇ蒸着膜で構成された裏面電極５３が形成され、Ｃｕ表面にＰｄ／Ａｕフラッシュめっきが施された裏面電極用外部接続端子５４が表面に０.１〜５μｍ 厚さのＳｎめっきが施されたＡｇメッシュシート５８を挟んで超音波熱圧着されている。主電流用及び制御用外部接続端子は樹脂匡体表面に露出した状態でモールドされ、裏面電極用外部接続端子は樹脂匡体の左右側面から導出されて片側が切断除去され他方が折曲げ加工されている。
【００４９】
本実施例によれば、図１と同様の効果が得られる。さらに、チップの発熱面である回路形成面側から配線基板に最も効率的に放熱できる構造であるため、パッケージの冷却が最も効率的に行われてＡｌ電極部の温度上昇が小さく抑えられ、その結果、外部接続端子とチップ間に発生する熱歪みを小さくできかつＡｌ電極膜とＡｕボール間の化合物の成長を抑制できるため、実使用環境下での製品寿命を大幅に改善できるのである。
【００５０】
図５は、本発明による半導体パッケージを組み立てるのに用いるソース及びゲート電極用マトリックスリードフレームの一実施例、図６は、図５のＡ−Ａ′断面から見たパッケージ組み立て時の接合方法、図７は、接合後のマトリックスリードフレームの外観、図８は、樹脂モールド方法を示す図である。図５において、ソース用リード６１とゲート用リード６２が対となったユニットがＸ−Ｙ方向に配置されている。次の図６において、マトリックスリードフレームのソース用及びゲート用リード６１，６２上に、半導体チップ６５のＡｌ電極６６，６７上に予め形成されたＡｕバンプ７１が位置合わせされて搭載され、さらにチップ裏面電極６８上には、予めＡｇバンプ７０が形成されたドレイン用ダイ端子６９が搭載されている。マトリックスリードフレームを載せるヒートステージ７４を２００℃に加熱し、ダイ端子の上から超音波振動７６を加える接合ツール７３で１バンプ当り５０〜５００ｇの力で加圧し、チップ上下の接合部を同時に接合している。超音波接合では、バンプの潰れ量を制御して接合し、リードとダイ端子の高さを所定の範囲内の精度に抑えている。超音波の振動方向は、リードの剛性が高い長手方向（図５の上下方向）に加え、リードの共振による接合不良の発生を防いでいる。ダイ端子は、個別に切り離して組み立てるので、貴金属めっきした大きなＣｕ板から打抜き加工して製作している。接合を完了したマトリックスリードフレーム（図７）を、モールド金型にセットした状態が図８である。図８は、図７のＡ−Ａ′断面方向から見た場合の断面構造である。図８において、モールド金型８０，８１のキャビティ８２は、マトリックスリードフレームの配置に合わせて、Ｘ−Ｙ方向に配列して形成されている。また、リード吊が納まる逃げ空間８３も設けられている。下金型８１のキャビティに半導体チップ６５が納まるように位置合わせしてマトリックスリードフレームをセットし、その上から上金型を載せて押し付ける。キャビティから外に出るソース及びゲートリードの高さは、下金型のキャビティの深さと同等かわずかに高くしてあり、上金型のキャビティ側壁部分でリードを挟んだときに、ダイ端子がビャビティ底面に押し付けられる構造としている。リードはチップ部を中心として左右で押し下げられることになるが、押し込み量が大きいとリードが曲げ変形を受け、チップ中央のＡｕバンプ接合部に引張り力が発生する。このため、上金型のリード抑え部はナイフ状に加工し、下金型は内側が低くて外側が高い段差を持たせ、リードをＷ形状に変形させてチップ中央の凸状の曲げ変形が小さくなるように工夫している。モールド樹脂は、熱膨張を下げるシリカ粒子のサイズを細かくし、バンプ接合部の隙間１０〜２０μｍの空隙への充填性を上げ、圧入プロセスで樹脂ボイドの発生を防止している。
【００５１】
本実施例のリードフレーム及び製法によれば、組み立て用のリードフレームにＩＣユニットをマトリックス状に配置し、１リードフレームから取れるパッケージの個数を増して生産性を上げることができること、金型はリード抑え部を除いて平面研削加工により合わせ面の加工精度を出せるためコストを上げないで金型を製造できること、チップ・ダイ接続と回路形成面側の接続を一回の接合工程で行えるため生産工程の短縮が可能となること、等の効果により低コスト半導体パッケージを提供できる。同時に構造的な特徴として、チップサイズに近い大きさの小型かつ薄型の半導体パッケージを提供できる。
【００５２】
図９は、本発明による半導体パッケージの組み立てフローに関する一実施例である。図において、組み立てには４つ部品が用いられる。半導体チップは、ウェーハレベルでＡｕバンプが形成され、それからダイシングにより個片に切断される。Ａｕバンプの形成は、ボールボンディング法，めっき法，Ａｕボール転写法のいずれでもよい。ソース及びゲート用外部接続端子は、Ｃｕ合金板からマトリックスリードフレーム状に打抜き法あるいはエッチング法により加工整形され、表面にＮｉ下地めっきを施した後、Ｐｄを０.０２〜１μｍ程度めっきし、最表面にＡｕを０.００１〜１μｍ程度めっきして仕上げられる。ドレイン用外部接続端子は、Ｃｕ条テープにＮｉ下地めっきを施した後、Ｐｄを０.０２〜１μｍ程度めっきしてさらに最表面にＡｕを０.００１〜１μｍ程度めっきし、最後にチップと同等サイズの個片に切断加工される。チップ・ダイ接続用のＡｇシートは、厚さ１０〜１００μｍのＡｇテープにプレス加工を加えて片面あるいは両面に凹凸を形成し、その表面にＳｎを０.１〜５μｍ厚さ程度めっきする。このときの厚さは、Ａｇとの重量比が２０ｗｔ％以下となる厚さにしている。最後に、ドレイン用外部接続端子やチップと同等サイズの個片に切断している。各部品は、マトリックスリードフレームをボンディングステージに載せてから、半導体チップ，Ａｇシート，ドレイン用外部接続端子の順に位置合わせして積層し、加熱と荷重と超音波振動を加えて、１ＩＣ単位で一括接合を行う。マトリックス全てを接合完了したら、樹脂モールド工程に入り、図８と同様の要領で樹脂モールドを行う。最後に、マトリックス状に繋がった半導体パッケージを個別に切断分離し、リードの折曲げ整形加工を施して完成する。
【００５３】
本実施例によれば、部品加工工程が並列ラインで多数個の一括生産が可能であり、また組み立てラインに入ってからの工程が（１）部品セット＋接合、（２）樹脂モールド、（３）リードの切断整形の３工程であり、従来のチップ・ダイ接続とワイヤボンディングのプロセスに比べて１工程短縮でき、さらに組み立てのタクトも（１）の工程がワイヤボンディングと同等のタクト以下で接合できるため、トータルの生産タクトの短縮が可能で、生産性の大幅な向上が図れる。
【００５４】
図１０は、本発明によるチップ裏面電極接合構造の一実施例を示す。リードフレームはソース・ゲート用リードフレームとドレイン用リードフレームの２種類のリードフレームを用いて組み立てる。図において、ソース用リード９１とゲート用リード９２を形成したＣｕ合金のリードフレーム、及びドレイン用ダイ９５を形成したリードフレームは、全面にＰｄ／Ａｕめっきが施されている。ドレイン用ダイの上には、Ａｇボールバンプ１０１がボールボンディング法により形成されている。この２種のリードフレームの間に、Ａｌ電極９８に予めＡｕボールバンプ１００を形成した裏面電極１０２付きの半導体チップ９７を挟み、チップの上下２ヵ所を同時に接合できる構造である。図１１は、この接合体を樹脂モールドしてリードを整形加工した半導体パッケージ構造の一例を示す。図において、樹脂匡体１０３の側壁の片側からソース及びゲートリード９１，９２が導出され、対向する他方の側壁からドレイン用リード１０４が導出され、折曲げ加工されている。樹脂匡体内のリードには局部的に細くなったネック部９３を設けており、リードの折曲げ加工時に発生する応力がバンプ接合部に伝わり難い構造としている。リードの導出位置の高さは、左右で異なっている。従って、上下モールド金型の合わせ面も段違いに加工されている。チップ裏面はＡｕ蒸着膜／Ａｇバンプ１０１／Ｐｄ／Ａｕめっきダイ９５の圧着構造、チップ上面はＡｌ電極９８，９９／Ａｕバンプ１００／Ｐｄ／Ａｕめっきリード９１，９２の圧着構造となっている。
【００５５】
本実施例において、チップ・ダイ接続構造がＡｇバンプを介した貴金属同士の直接接合となっているので、耐熱性が高く、チップ／ダイ間の熱歪みをＡｇバンプが緩和してくれるため温度サイクル信頼性が高く、Ｐｂレスで環境にやさしい半導体パッケージを提供できる。また、リードは貴金属めっきが施されているため半田の濡れ性がよく、その結果、パッケージ組み立て後の半田めっきが不要となるため、パッケージ組み立て工程が短縮されて生産性が向上する。また、チップサイズぎりぎりに樹脂をモールドすることが可能となるため、小型で薄型の半導体パッケージを提供できるという効果もある。
【００５６】
図１２は、チップとダイを接合するための接合シートの一実施例である。図において、シート１１０は厚さ２０μｍの純Ａｇ製で、片面に深さ１０μｍの溝１１１を形成している。溝の形成は、プレス加工あるいはダイシングブレードによるハーフカット加工により行っている。Ａｇシートの硬さは、圧延加工→溝加工を終えた後、３５Ｈｖ以下になるように焼鈍処理している。
【００５７】
本実施例の接合シートを用いてチップ／ダイの超音波圧接を行えば、接合中のＡｇシートの組成変形が溝空間の存在と材料の柔らかさによって低い応力で容易に進行し、Ｓｉチップに加わる応力が小さい条件で接合界面での新生面の形成が行われて接合が進むため、チップに損傷を与えないで強固で耐熱性の高い接合を達成することが可能となる。また、パッケージの使用時には、チップの発熱に伴うチップ／ダイ間の熱歪みを、柔らかくて溝空間のあるＡｇシートが吸収してくれるため、温度サイクル信頼性の高い半導体パッケージを提供できる。
【００５８】
図１３は、チップとダイを接合するための接合シートの他の一実施例である。図において、接合シートのコア部１１２は、図１２と同じ加工処理を施したＡｇシートである。その表面に、厚さ０.３〜２.０μｍのＳｎめっき１１３を施している。
【００５９】
本実施例の接合シートを用いてチップ／ダイの超音波加熱圧接を行えば、加熱温度２２０℃以上の条件下でＡｇ−Ｓｎ反応によって液相が形成されるためシート表面が薄い膜の液体で覆われ、ダイあるいはチップ裏面電極に押し付けられた領域は液体が外に排出されて高融点部材同士の接合が容易に進行するため、低い加圧条件で確実かつ強固な接合が容易に行えるという利点がある。また接合界面から排出された低融点のＡｇ−Ｓｎ層には、加熱時にコアから次々に溶解や拡散によってＡｇが供給されるため、最終的なＡｇ−Ｓｎ層の融点は４７０℃以上に高めることができ、耐熱性の高い接合部とすることができるのである。半導体パッケージとしての信頼性に関しては、図１２と同様の効果が得られる。
【００６０】
図１４は、チップとダイを接合するための接合シートの他の一実施例である。図において、接合シートはＡｇワイヤ１１４，１１５を縦横に編んだメッシュ状シートである。
【００６１】
本実施例によれば、ワイヤが重なった部分の厚みは厚くてそれ以外の部分は薄いという凹凸のあるシートであるため、厚い部分の組成変形が容易に進行して図１２と同様の効果が得られるのである。
【００６２】
図１５は、本発明による半導体パッケージにおいて、チップ・ダイ間の接合にＡｇ粒子を用いた場合の一実施例を示す。図において、半導体チップ１２０の回路形成面側にはＡｌ電極１２１が形成され、その上には複数のＡｇバンプ１２５が形成されている。チップの裏面には、最表面がＡｇめっき膜の裏面電極１２２が形成されている。回路形成面側の貴金属めっきされたリード１２３とＡｇバンプは直接、超音波熱圧着されている。チップ裏面電極と貴金属めっきされたダイ端子１２４は、樹脂１２７と９０vol％ 以上の比率で混合されたＡｇ粒子１２６を挟んで、超音波熱圧着されている。樹脂の量は、圧着時に押し出された樹脂がダイ端子の側面から圧着ステージに流れ落ちない程度に少ない量とし、混合体を粘性流体として扱える程度に多い量としている。樹脂の性質は熱硬化性で、接合時の加熱により硬化する種類の樹脂としている。Ａｇ粒子とチップ裏面のＡｇ蒸着膜、およびＡｇ粒子とダイ端子、Ａｇ粒子同士は接触部分の領域で部分的に金属接合が達成されている。ダイ端子の寸法は、樹脂匡体１２８の底面の中に納まる大きさであり、チップと同等である。チップより、わずかに大きくても小さくてもよい。
【００６３】
本実施例によれば、低実装抵抗，小型・薄型，Ｐｂレスの半導体パッケージを提供できる。また、Ａｇ粒子が樹脂と混合されているので、樹脂の粘着性によってＡｇ粒子の飛散がなくなり、接合部へのＡｇ粒子の供給が容易となって生産性が向上できる。また、接合後のＡｇ粒子間の狭い隙間を混合された樹脂が埋めるため、モールド樹脂で隙間を埋める必要がなくなり、樹脂ボイドの発生を大幅に低減できて歩留りを向上できるという効果もある。さらに、接合材が樹脂とＡｇ粒子の混合体ではあるが、超音波を併用した加熱圧着を行っているため、金属同士の接合界面から樹脂が排出され、接合部では金属同士の強固な接合が達成されるため、接合信頼性はＡｇペーストの接着に比べて格段に向上できるという効果もある。
【００６４】
図１６は、本発明による半導体パッケージにおいて、チップ／ダイ間の接合に溝を形成したＡｇシートを用いた場合の一実施例を示す。図において、チップ１３０のＡｌ電極１３１にはＡｕボール１３９が形成され、裏面電極１３２の最表面にはＡｇ蒸着膜が形成されている。リード端子１３５とダイ端子１３８の表面にはＰｄめっきが施されている。チップ裏面とダイ端子間には溝１４１を形成したＡｇシート１４０が挿入されている。各接合部は、超音波併用の加熱圧着によりダイレクトに接合されている。リード端子は、樹脂匡体の１側面から導出され、曲げ加工されている。
【００６５】
本実施例によれば、図２と同様の効果が得られる他に、リード端子が片側からのみ出ているので、リード端子の上下の樹脂連結面積が大きく取れ、樹脂の硬化収縮力によるリード／チップ間への圧縮力を高めることができるため、Ａｌ電極／Ａｕボール／リード端子の各接合部の熱歪み等による破損を低減することができ、半導体パッケージの信頼性を向上することができる。
【００６６】
図１７は、本発明による半導体パッケージにおいて、リード端子の一部が樹脂匡体の上面に露出している場合の一実施例を示す。図において、チップ１４５のＡｌ電極１４６にはＡｕボール１５４が形成され、裏面電極１４７の最表面にはＡｇ蒸着膜が形成されている。リード端子１５０とダイ端子１５３の表面にはＰｄ／Ａｕめっき１４９，１５２が施されている。チップ裏面とダイ端子間には溝１５６を形成したＡｇシート１５５が挿入されている。各接合部は、超音波併用の加熱圧着によりダイレクトに接合されている。リード端子は、樹脂匡体の１側面から導出されて曲げ加工されており、上面はリード端子が露出している。
【００６７】
本実施例によれば、図２と同様の効果が得られる他に、パッケージ上面に露出した広い面積のリード端子から効率よく熱が放散されるため、半導体パッケージの熱抵抗を大幅に低減することができる。
【００６８】
図１８は、本発明による半導体パッケージを搭載するための配線基板の一実施例を示す。図において、配線基板１６０はガラスエポキシシートにＣｕ箔パターンが形成された基板を積層した多層有機基板である。基板表面には、各種半導体パッケージや受動素子の接続端子１６５，１６９，１７０，１７１が形成されている。本発明の半導体パッケージを搭載するための接続端子は、パッケージの腹部に納まる大きさのドレイン用接続端子１６１，１６８，ソース用接続端子１６４,１６７，ゲート用接続端子１６２，１６３，１６６から構成される。図１９は、図１８の配線基板に、本発明の半導体パッケージやＬＳＩパッケージや素子を搭載した電子装置の一実施例を示す。図において、配線基板１６０には信号処理用のＬＳＩパッケージ１７６，１７７，１７８と縦型半導体パッケージ１７２，１７５と抵抗及びコンデンサの受動素子１７３，１７４が半田接続により搭載されている。
【００６９】
本実施例によれば、パワー半導体パッケージと基板間の接続面積が大きく、発熱体であるチップと基板間が最短距離で接続されるため、基板とパッケージの温度差が小さくなり、半田接続部に発生する応力が低減されて信頼性の高い電子装置を提供することができる。また、パッケージの発熱を低減しているため、特別な放熱機構を設けなくてもデバイス温度が正常な動作温度領域を超えて温度上昇することがなく、電子装置の構造を簡略化できてコストを抑えられ、温度上昇が低くなることから電子装置の寿命を向上できるという効果もある。
【符号の説明】
【００７０】
１，２１，３５，５０，６５，９７，１２０，１３０，１４５，１９０…半導体チップ、２…ソース用Ａｌ電極、３…ゲート用Ａｌ電極、４，３７，５３，６８，１０２，１２２，１３２，１４７，１９２…裏面電極、５…ソース用リード端子、６…ゲート用リード端子、７，６９…ドレイン用ダイ端子、８，３０，４５，５７，７１，１３９，１５４…Ａｕバンプ、９…開口部、１０…スリット、１１，１３，２４，２７，３８，４１，１３４，１３７，１４８，１５１…Ｃｕコア、１２，１４，４２，１４９，１５２…Ｐｄ／Ａｕめっき、１５…Ａｇめっき、１６，３２，４７，５９，１０３，１２８，１４２，１５７，１９７…樹脂匡体、２２，３６，６６，６７，９８，９９，１２１，１３１，１４６，１８１，１９１…Ａｌ電極、２５，２８，３９…貴金属めっき、２６，４０，１３５，１５０…リード端子、２９，４３，１２４，１３８，１５３…ダイ端子、３１，７０，１２５…Ａｇバンプ、４４…ザグリ加工部、４６…Ａｇペースト、５１…主電流用Ａｌ電極、５２…制御用Ａｌ電極、５４…裏面電極用外部接続端子、５５…主電流用外部接続端子、５６…制御用外部接続端子、５８…Ａｇメッシュシート、６１，９１…ソース用リード、６２，９２…ゲート用リード、６３…リード吊、６４，９４，９６…リード枠、７３…接合ツール、７４…ヒートステージ、７５…ヒータ、７６…超音波振動、８０…モールド上金型、８１…モールド下金型、８２…キャビティ、８３…逃げ空間、９３…ネック部、９５…ドレイン用ダイ、１００…Ａｕボールバンプ、１０１…Ａｇボールバンプ、１０４…ドレイン用リード、１１０，１４０，１５５…Ａｇシート、１１１，１４１，１５６…溝、１１２…Ａｇコア、１１３…Ｓｎめっき、１１４，１１５…Ａｇワイヤ、１２３…リード、１２６…Ａｇ粒子、１２７…樹脂、１３３，１３６…Ｐｄめっき、１６０…多層有機基板、１６１，１６８…ドレイン用接続端子、１６２、１６３，１６６…ゲート用接続端子、１６４，１６７…ソース用接続端子、１６５…受動素子用接続端子、１６９，１７０，１７１…ＬＳＩパッケージ用接続端子、１７２，１７５…縦型半導体パッケージ、１７３…抵抗素子、１７４…コンデンサ素子、１７６,１７７,１７８…ＬＳＩパッケージ、１８０…チップ、１８２…チップ裏面電極、１８３…ソース用外部接続端子、１８４…ドレイン用外部接続端子、１８５…金属バンプ、１８６…接合部、１９３…第２外部接続端子、１９４…第１外部接続端子、１９５…貴金属バンプ、１９６…貴金属接合部材、１９８…第３外部接続端子。
【特許請求の範囲】
【請求項１】
ＭＯＳＦＥＴが形成され、前記ＭＯＳＦＥＴのソース電極およびゲート電極が形成された表面と、前記ＭＯＳＦＥＴのドレイン電極が形成され、前記表面とは反対側の裏面と、を有する半導体チップと、
前記半導体チップが搭載された第１表面と、前記第１表面とは反対側の第１裏面とを有し、前記半導体チップの前記ドレイン電極と電気的に接続されたドレイン用外部接続端子と、
第２表面と、前記第２表面とは反対側であって、前記半導体チップの前記ソース電極と電気的に接続された第２裏面とを有するソース用外部接続端子と、
第３表面と、前記第３表面とは反対側であって、前記半導体チップの前記ゲート電極と電気的に接続された第３裏面とを有するゲート用外部接続端子と、
上面、前記上面と対向する下面、前記上面と前記下面との間に位置する第１側面、前記第１側面に対向する第２側面、とを有し、前記半導体チップ、前記ドレイン用外部接続端子の一部、前記ソース用外部接続端子の一部、および前記ゲート用外部接続端子の一部を封止する樹脂筐体と、を有し、
前記ドレイン用外部接続端子の前記第１裏面は、前記樹脂筐体の前記下面より露出し、
前記ソース用外部接続端子は、第１部分、第２部分、第３部分、第４部分、および第５部分、を有し、
前記ソース用外部接続端子の前記第１部分は、前記半導体チップの前記ソース電極と第１接続部材を介して電気的に接続されており、
前記ソース用外部接続端子の前記第３部分は、前記樹脂筐体の前記第１側面側に位置し、かつ前記第１部分よりも下方に位置し、
前記ソース用外部接続端子の前記第５部分は、前記樹脂筐体の前記第２側面側に位置し、かつ前記第１部分よりも下方に位置し、
前記ソース用外部接続端子の前記第２部分は、前記第１部分と前記第３部分との間に位置し、
前記ソース用外部接続端子の前記第４部分は、前記第１部分と前記第５部分との間に位置することを特徴とする半導体装置。
【請求項２】
請求項１に記載の半導体装置において、
前記ドレイン用外部接続端子の前記第１裏面、前記ソース用外部接続端子の前記第３部分の裏面、および前記ソース用外部接続端子の前記第５部分の裏面は、同一平面内にあることを特徴とする半導体装置。
【請求項３】
請求項１に記載の半導体装置において、
平面視において、前記ドレイン用外部接続端子は、前記ソース用外部接続端子の前記第３部分と前記第５部分との間に位置することを特徴とする半導体装置。
【請求項４】
請求項１に記載の半導体装置において、
前記ゲート用外部接続端子は、第６部分、第７部分、第８部分、第９部分、および第１０部分、を有し、
前記ゲート用外部接続端子の前記第６部分は、前記半導体チップの前記ゲート電極と第２接続部材を介して電気的に接続されており、
前記ゲート用外部接続端子の前記第８部分は、前記樹脂筐体の前記第１側面側に位置し、かつ前記第１部分よりも下方に位置し、
前記ゲート用外部接続端子の前記第１０部分は、前記樹脂筐体の前記第２側面側に位置し、かつ前記第１部分よりも下方に位置し、
前記ゲート用外部接続端子の前記第７部分は、前記第６部分と前記第８部分との間に位置し、
前記ゲート用外部接続端子の前記第９部分は、前記第６部分と前記第１０部分との間に位置することを特徴とする半導体装置。
【請求項５】
請求項４に記載の半導体装置において、
前記ドレイン用外部接続端子の前記第１裏面、前記ゲート用外部接続端子の前記第８部分の裏面、および前記ゲート用外部接続端子の前記第１０部分の裏面は、同一平面内にあることを特徴とする半導体装置。
【請求項６】
請求項４に記載の半導体装置において、
平面視において、前記ドレイン用外部接続端子は、前記ゲート用外部接続端子の前記第８部分と前記第１０部分との間に位置することを特徴とする半導体装置。
【請求項７】
請求項１に記載の半導体装置において、
前記ソース用外部接続端子の前記第１部分の一部は、前記樹脂筐体で封止されており、それ以外の部分は、前記樹脂筐体から露出していることを特徴とする半導体装置。
【請求項８】
請求項１に記載の半導体装置において、
前記ソース用外部接続端子の前記第１部分の一部は、前記樹脂筐体の前記第１および第２側面から突出していることを特徴とする半導体装置。
【請求項９】
請求項４に記載の半導体装置において、
前記ゲート用外部接続端子の前記第６部分の一部は、前記樹脂筐体で封止されており、それ以外の部分は、前記樹脂筐体から露出していることを特徴とする半導体装置。
【請求項１０】
請求項４に記載の半導体装置において、
前記ゲート用外部接続端子の前記第６部分の一部は、前記樹脂筐体の前記第１および第２側面から突出していることを特徴とする半導体装置。
【請求項１１】
請求項１に記載の半導体装置において、
前記第１接続部材は、複数の金属バンプであることを特徴とする半導体装置。
【請求項１２】
請求項４に記載の半導体装置において、
前記第２接続部材は、複数の金属バンプであることを特徴とする半導体装置。
【請求項１３】
ＭＯＳＦＥＴが形成され、前記ＭＯＳＦＥＴのソース電極およびゲート電極が形成された表面と、前記ＭＯＳＦＥＴのドレイン電極が形成され、前記表面とは反対側の裏面と、を有する半導体チップと、
前記半導体チップが搭載され、前記半導体チップの前記ドレイン電極と電気的に接続されたドレイン用外部接続端子と、
前記半導体チップの前記ソース電極と電気的に接続されたソース用外部接続端子と、
前記半導体チップの前記ゲート電極と電気的に接続されたゲート用外部接続端子と、
上面、前記上面と対向する下面、前記上面と前記下面との間に位置する第１側面、前記第１側面に対向する第２側面、とを有し、前記半導体チップ、前記ドレイン用外部接続端子の一部、前記ソース用外部接続端子の一部、および前記ゲート用外部接続端子の一部を封止する樹脂筐体と、を有し、
前記ソース用外部接続端子の一部は、前記樹脂筐体の前記第１および第２側面から突出していることを特徴とする半導体装置。
【請求項１】
ＭＯＳＦＥＴが形成され、前記ＭＯＳＦＥＴのソース電極およびゲート電極が形成された表面と、前記ＭＯＳＦＥＴのドレイン電極が形成され、前記表面とは反対側の裏面と、を有する半導体チップと、
前記半導体チップが搭載された第１表面と、前記第１表面とは反対側の第１裏面とを有し、前記半導体チップの前記ドレイン電極と電気的に接続されたドレイン用外部接続端子と、
第２表面と、前記第２表面とは反対側であって、前記半導体チップの前記ソース電極と電気的に接続された第２裏面とを有するソース用外部接続端子と、
第３表面と、前記第３表面とは反対側であって、前記半導体チップの前記ゲート電極と電気的に接続された第３裏面とを有するゲート用外部接続端子と、
上面、前記上面と対向する下面、前記上面と前記下面との間に位置する第１側面、前記第１側面に対向する第２側面、とを有し、前記半導体チップ、前記ドレイン用外部接続端子の一部、前記ソース用外部接続端子の一部、および前記ゲート用外部接続端子の一部を封止する樹脂筐体と、を有し、
前記ドレイン用外部接続端子の前記第１裏面は、前記樹脂筐体の前記下面より露出し、
前記ソース用外部接続端子は、第１部分、第２部分、第３部分、第４部分、および第５部分、を有し、
前記ソース用外部接続端子の前記第１部分は、前記半導体チップの前記ソース電極と第１接続部材を介して電気的に接続されており、
前記ソース用外部接続端子の前記第３部分は、前記樹脂筐体の前記第１側面側に位置し、かつ前記第１部分よりも下方に位置し、
前記ソース用外部接続端子の前記第５部分は、前記樹脂筐体の前記第２側面側に位置し、かつ前記第１部分よりも下方に位置し、
前記ソース用外部接続端子の前記第２部分は、前記第１部分と前記第３部分との間に位置し、
前記ソース用外部接続端子の前記第４部分は、前記第１部分と前記第５部分との間に位置することを特徴とする半導体装置。
【請求項２】
請求項１に記載の半導体装置において、
前記ドレイン用外部接続端子の前記第１裏面、前記ソース用外部接続端子の前記第３部分の裏面、および前記ソース用外部接続端子の前記第５部分の裏面は、同一平面内にあることを特徴とする半導体装置。
【請求項３】
請求項１に記載の半導体装置において、
平面視において、前記ドレイン用外部接続端子は、前記ソース用外部接続端子の前記第３部分と前記第５部分との間に位置することを特徴とする半導体装置。
【請求項４】
請求項１に記載の半導体装置において、
前記ゲート用外部接続端子は、第６部分、第７部分、第８部分、第９部分、および第１０部分、を有し、
前記ゲート用外部接続端子の前記第６部分は、前記半導体チップの前記ゲート電極と第２接続部材を介して電気的に接続されており、
前記ゲート用外部接続端子の前記第８部分は、前記樹脂筐体の前記第１側面側に位置し、かつ前記第１部分よりも下方に位置し、
前記ゲート用外部接続端子の前記第１０部分は、前記樹脂筐体の前記第２側面側に位置し、かつ前記第１部分よりも下方に位置し、
前記ゲート用外部接続端子の前記第７部分は、前記第６部分と前記第８部分との間に位置し、
前記ゲート用外部接続端子の前記第９部分は、前記第６部分と前記第１０部分との間に位置することを特徴とする半導体装置。
【請求項５】
請求項４に記載の半導体装置において、
前記ドレイン用外部接続端子の前記第１裏面、前記ゲート用外部接続端子の前記第８部分の裏面、および前記ゲート用外部接続端子の前記第１０部分の裏面は、同一平面内にあることを特徴とする半導体装置。
【請求項６】
請求項４に記載の半導体装置において、
平面視において、前記ドレイン用外部接続端子は、前記ゲート用外部接続端子の前記第８部分と前記第１０部分との間に位置することを特徴とする半導体装置。
【請求項７】
請求項１に記載の半導体装置において、
前記ソース用外部接続端子の前記第１部分の一部は、前記樹脂筐体で封止されており、それ以外の部分は、前記樹脂筐体から露出していることを特徴とする半導体装置。
【請求項８】
請求項１に記載の半導体装置において、
前記ソース用外部接続端子の前記第１部分の一部は、前記樹脂筐体の前記第１および第２側面から突出していることを特徴とする半導体装置。
【請求項９】
請求項４に記載の半導体装置において、
前記ゲート用外部接続端子の前記第６部分の一部は、前記樹脂筐体で封止されており、それ以外の部分は、前記樹脂筐体から露出していることを特徴とする半導体装置。
【請求項１０】
請求項４に記載の半導体装置において、
前記ゲート用外部接続端子の前記第６部分の一部は、前記樹脂筐体の前記第１および第２側面から突出していることを特徴とする半導体装置。
【請求項１１】
請求項１に記載の半導体装置において、
前記第１接続部材は、複数の金属バンプであることを特徴とする半導体装置。
【請求項１２】
請求項４に記載の半導体装置において、
前記第２接続部材は、複数の金属バンプであることを特徴とする半導体装置。
【請求項１３】
ＭＯＳＦＥＴが形成され、前記ＭＯＳＦＥＴのソース電極およびゲート電極が形成された表面と、前記ＭＯＳＦＥＴのドレイン電極が形成され、前記表面とは反対側の裏面と、を有する半導体チップと、
前記半導体チップが搭載され、前記半導体チップの前記ドレイン電極と電気的に接続されたドレイン用外部接続端子と、
前記半導体チップの前記ソース電極と電気的に接続されたソース用外部接続端子と、
前記半導体チップの前記ゲート電極と電気的に接続されたゲート用外部接続端子と、
上面、前記上面と対向する下面、前記上面と前記下面との間に位置する第１側面、前記第１側面に対向する第２側面、とを有し、前記半導体チップ、前記ドレイン用外部接続端子の一部、前記ソース用外部接続端子の一部、および前記ゲート用外部接続端子の一部を封止する樹脂筐体と、を有し、
前記ソース用外部接続端子の一部は、前記樹脂筐体の前記第１および第２側面から突出していることを特徴とする半導体装置。
【図１】
【図２】
【図３】
【図４】
【図５】
【図６】
【図７】
【図８】
【図９】
【図１０】
【図１１】
【図１２】
【図１３】
【図１４】
【図１５】
【図１６】
【図１７】
【図１８】
【図１９】
【図２０】
【図２１】
【図２】
【図３】
【図４】
【図５】
【図６】
【図７】
【図８】
【図９】
【図１０】
【図１１】
【図１２】
【図１３】
【図１４】
【図１５】
【図１６】
【図１７】
【図１８】
【図１９】
【図２０】
【図２１】
【公開番号】特開２０１２−４５９４（Ｐ２０１２−４５９４Ａ）
【公開日】平成２４年１月５日（２０１２．１．５）
【国際特許分類】
【出願番号】特願２０１１−１９１７６２（Ｐ２０１１−１９１７６２）
【出願日】平成２３年９月２日（２０１１．９．２）
【分割の表示】特願２００８−２５００５５（Ｐ２００８−２５００５５）の分割
【原出願日】平成１１年１月２８日（１９９９．１．２８）
【出願人】（３０２０６２９３１）ルネサスエレクトロニクス株式会社 (8,021)
【出願人】（０００２３３５２７）株式会社ルネサス東日本セミコンダクタ (40)
【Ｆターム（参考）】
【公開日】平成２４年１月５日（２０１２．１．５）
【国際特許分類】
【出願日】平成２３年９月２日（２０１１．９．２）
【分割の表示】特願２００８−２５００５５（Ｐ２００８−２５００５５）の分割
【原出願日】平成１１年１月２８日（１９９９．１．２８）
【出願人】（３０２０６２９３１）ルネサスエレクトロニクス株式会社 (8,021)
【出願人】（０００２３３５２７）株式会社ルネサス東日本セミコンダクタ (40)
【Ｆターム（参考）】
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