【課題】データの保持期間を長くする。
【解決手段】コンピュータシステムは、パーソナルコンピュータなどのホスト１０と、ホスト１０に接続されるＵＳＢメモリデバイス１００とを備える。ＵＳＢメモリデバイス１００は、ユーザ用データを格納するためのＮＡＮＤ型フラッシュメモリ１３０と、ＯＴＰメモリ１４０とを備える。ＮＡＮＤ型フラッシュメモリ１３０には、ユーザ用データ以外に、ユーザ用データに対応した第１次のエラー訂正用符号であるＥＣＣ＿Ａとが格納される。一方、ＯＴＰメモリ１４０には、ＥＣＣ＿Ａに対応した第２次のエラー訂正用符号であるＥＣＣ＿Ｂが格納される。 （もっと読む）

【課題】リペア可能な半導体メモリ装置を提供する。
【解決手段】半導体メモリ装置は、第１システムデータを保存する第１ブロックと第１システムデータと同一の第２システムデータを保存する第２ブロックとを有するメモリセルアレイを含む。コントローラは、ホストから出力されたリセット信号に応答して第１システムデータをメモリユニットに出力し、ＥＣＣ検出ブロックによって発生したフェイル検出信号に基づいて第２システムデータをメモリユニットに伝送する。ＥＣＣ検出ブロックは、第１システムデータが欠陥データであるか否かを判断する。半導体メモリ装置をリセットする間に第１システムデータで欠陷が発生する時、第１システムデータは、第２システムデータの提供によってリペアされる。 （もっと読む）

本発明は、携帯時計の不揮発性メモリをプログラムするアクセス方法に関し、該時計は、基準電源電圧に対応する電位差を定め且つ外部からアクセス可能な２つの電源端子と、予め定められた最大電源電圧をサポートするよう構成された不揮発性メモリ用制御回路とを備え、当該アクセス方法は、時計の電源端子を利用して、ａ）不揮発性メモリへのアクセスを許可するオープニングキーと、ｂ）不揮発性メモリへのアクセス命令とを不揮発性メモリの制御回路に送信する段階からなり、オープニングキーが予め定められた命令であって、基準電源電圧を変調することにより、予め定められた最大電源電圧を超えないようにして送信されることを特徴とする。
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【課題】重要データのより確実な保護ができ得るアクセス装置を提供する
【解決手段】メモリアクセス装置１０は、論理メモリ空間を管理するファイルシステム装置１４と、論理メモリ空間と物理メモリ空間との対応関係を記憶するとともに、当該対応関係に基づいてフラッシュメモリに物理的にアクセスするドライバ装置１２と、を備えている。フラッシュメモリは、複数のストリングに物理的に分割されている。ファイルシステム装置１２は、メモリ空間をＲＯまたはＲＷのいずれかに設定された複数のパーティションに分割して管理する。ドライバ装置１２は、各ストリングを単一の論理パーティションを対応させることで、一つのストリングに記憶されるデータの書込制限種類を統一させる。 （もっと読む）

【課題】処理する情報の機密性を保つことができる情報処理装置を提供する。
【解決手段】本発明の情報処理装置であるプリンタ装置１は、ＰＣ２から画像データ及びジョブ情報と共にパスワードを受け付けた後、画像データを暗号化して記憶部１０６に記憶し、ジョブ情報にパスワードを関連づけてジョブ管理テーブルとして管理部１０４に記憶して処理を待機する。セキュリティプログラムが動作している場合は、主電源１１０が停止したときに、管理部１０４へ通電するバックアップ部１０５の動作を禁止して、管理部１０４が記憶しているジョブ管理テーブルを消去させる。セキュリティプログラムが動作していない場合には、バックアップ部１０５により管理部１０４へ通電して、管理部１０４に記憶しているジョブ管理テーブルを維持する。 （もっと読む）

【課題】フラッシュメモリーの安定性、データの安全性、耐障害性の性能を向上できるフラッシュメモリーのデータ管理方法を提供する。
【解決手段】本発明のフラッシュメモリー内のデータ管理方法は、メモリブロックの操作過程で、ブロックのステータスフラグを末完了状態に設定し、操作完了後は、ステータスフラグを末完了状態から、完了状態に設定する。この方法を利用して、フラッシュメモリーにデータの書き込んでいるときに、突然の電源切れが発生した場合でも、フラッシュメモリー内にあった元のデータの消失を防ぐことが出来る。また、本発明は、上記のデータ管理方法を採用したフラッシュメモリーにデータを書き込む方法とデータリカバーの方法も提供する。
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【課題】 基板面積を削減し得る誤り訂正回路を提供する。
【解決手段】 誤り訂正回路部１４ｂでは、隣接するデータビットＤ0 〜Ｄn および検査ビットＰn,0 〜Ｐn-1,n に対し、誤り訂正回路３０が構成されている。これにより、メモリ回路部から読み出されたトリミングデータのうち、例えば、データビットＤ1 がデータ化けを起こしていても、「データビットＤ0 、検査ビットＰ0,1 およびデータビットＤ1 の排他的論理和の結果（Ｅ0,1 ）」および「データビットＤ1 、検査ビットＰ1,2 およびデータビットＤ2 の排他的論理和の結果（Ｅ1,2 ）」の論理積と、データビットＤ1 と、の排他的論理和をとるので、データビットＤ1 は反転、つまりデータビットの誤りを訂正しＤout1として出力することができる。したがって、誤り訂正回路部１４ｂの回路配線を簡素化できるとともに回路基板上の配線パターンの引き回しの錯綜を防止するので、基板面積を削減できる。 （もっと読む）