Fターム[5B033FA03]の内容
Fターム[5B033FA03]に分類される特許
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エラー処理方法及び情報処理装置
【課題】本発明は、エラー処理方法及び情報処理装置に関し、ハーバードアーキテキチャを有するCPUの命令バス又はデータバスで発生したバスエラーを適切に処理可能とすることを目的とする。
【解決手段】CPUのバスで発生したエラーを処理するエラー処理方法において、CPUの命令バス及びデータバスのうち少なくとも一方のバスで発生したバスエラーをバスエラー入力手段によりCPUに入力し、バスエラーをCPU内のバスエラーカウンタでカウントし、バスエラーカウンタの値に基づいてCPUに接続されたメモリ部の領域を指定するように構成する。
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携帯可能電子装置およびICカード
【課題】誤ったインストラクションあるいはデータを用いて間違った処理が行なわれることを防止することができる携帯可能電子装置およびICカードを提供する。
【解決手段】EEPROMと、このEEPROMに対するアクセスを行なうCPUと、このCPUの動作プログラムが格納されたROMと、インストラクションを格納するインストラクションバッファと、プログラムカウンタとを有するICカードにおいて、CPUがROM内のプログラムを実行する際に、現在プログラムカウンタに指定されているインストラクションの次に実行されるインストラクションをインストラクションバッファに格納しておき、プログラムカウンタが次のアドレスに進んだときに、インストラクションバッファ内のインストラクションと現在プログラムカウンタが指定しているインストラクションとを照合し、両インストラクションが一致した場合にCPUによる当該インストラクションの実行を許可する。
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