Fターム[5B077NN00]の内容
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Fターム[5B077NN00]に分類される特許
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同期化回路
【課題】 送信側装置からデータを取り込んで保持する受信レジスタと、この受信レジスタの保持データを内部クロックに同期してシフトする同期化シフトレジスタとを備えた同期化回路において、同期化シフトレジスタの無駄なスイッチング動作を回避し、消費電力を低減する。
【解決手段】 クロックゲーティング制御回路40は、同期化ブロックSB(j)(j=0〜15)のいずれかの受信レジスタ21がデータの取り込みを行った場合、内部クロックφを少なくとも2個通過させ、同期化クロックφs(j)として、該当する同期化ブロックSB(j)の同期化シフトレジスタ30に供給する。
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