【課題】、目的周波数の基準信号の異常を、確実且つ正確に検出することができる基準信号発生装置を実現する。
【解決手段】基準信号発生装置１は、位相比較器１１、ループフィルタ１２、電圧制御発振器１３、分周器１４からなるＰＬＬ回路を備える。基準信号発生装置１の波数計測部１５は、ＰＬＬ回路の調整用タイミング信号に基づく期間での復調用基準周波数信号の波数をカウントし、期間毎のカウント値を異常発振検出部１６へ出力する。異常発振検出部１６は、調整用タイミング信号の元となる基準信号と復調用基準周波数信号との仕様周波数範囲の関係に基づいて設定される正常発振カウント値範囲を予め記憶している。異常発振検出部１６は、波数計測部１５から取得したカウント値が正常発振カウント値範囲内に無ければ異常発振として検出し、外部へ通知する。 （もっと読む）

【課題】光情報の検出精度の劣化を抑えながら、ガスセルの温度制御を量子レベルで制御する原子発振器およびその制御方法を提供する。
【解決手段】本実施形態の原子発振器の光学系の要部である物理部５０は、ガス状の金属原子を封入したガスセル１０およびそれを保持するガスセル保持部材２１からなるセルユニット２０、ガスセル１０を所定の温度に加熱するヒータ１５、ガスセル１０中の金属原子を励起するコヒーレント光の光源である光源３０、ガスセル１０を透過した励起光を検出するフォトセンサ４０、フォトセンサ４０により検出された励起光の強度に基づいてヒータ１５を制御する温度制御手段、を有する。ガスセル１０は、円筒部１１と、該円筒部１１の両端の開口部をそれぞれ封鎖して励起光の光路の入射面および出射面を形成する窓部１２と、を有し、ヒータ１５が、窓部１２の前記光路と異なる領域に設けられている。 （もっと読む）

【課題】局部発振信号を生成する装置において、発生するスプリアスを低減させること。
【解決手段】局部発振信号生成装置であって、第一の基準クロックを生成する第一基準クロック生成部と、第一の基準クロックとは異なる周波数の第二の基準クロックを生成する第二基準クロック生成部と、局部発振信号の生成において用いられる基準クロックを、第一の基準クロックと第二の基準クロックのうち、発生するスプリアスがより小さくなる方を選択する選択部と、選択された基準クロックを用いて局部発振信号を生成する局部発振部と、を備える。 （もっと読む）

【課題】本発明は、基準発振部から出力される基準信号を用いて、演算部の設定で無線通信の送受信周波数を生成する無線通信機器において、基準発振部の温度特性を補正するためのデータを効率的かつ、高精度な補正を実現する構成を提供することを目的とする。
【解決手段】本発明の無線通信機器３００は、送信処理を行う際に、温度検出部３０５で基準発振部３０３の雰囲気温度を検出し、該当の温度に対する第１補正データを外部記憶部３０４より読み出した上で、演算設定部３１１で、内部記憶部３１２に記憶されている第２補正データ、基準チャネル設定データを用い送信周波数を演算し、高周波部３０１から、あらかじめ決められたデータを変調し送信をおこなう。 （もっと読む）

【課題】周波数変動の大きな基準発振器を用いて、周波数変動を抑制した局部発振信号及び分周逓倍信号を出力するシンセサイザを小型に実現すること。
【解決手段】本発明のシンセサイザ２は、基準発振器３から出力された基準発振信号を基に局部発振信号を生成して周波数変換部５に入力するとともに、周波数補償部７から出力された周波数補償信号を基に局部発振信号の周波数補償を行うシンセサイザ２であって、局部発振信号を分周又は逓倍した分周逓倍信号を、周波数変換部５の出力側に接続された後段回路部６に入力する分周逓倍部２ａを有する。この構成により、シンセサイザ２が周波数変動を補償した局部発振信号を出力するとともに、この局部発振信号を分周又は逓倍して分周逓倍信号を生成することにより、少なくとも１つのシンセサイザで、局部発振信号及び分周逓倍信号の周波数変動を補償することができる。 （もっと読む）

【課題】広帯域で量子化雑音及び発振器の位相雑音を除去し、小面積で構成可能な位相同期回路を提供する。
【解決手段】第１の制御信号及び第２の制御信号の組み合わせによって制御される共通の周波数及び互いに異なる位相を夫々持つ第１及び第２の発振信号を生成する制御発振器と；基準信号と第１の発振信号との間の周波数差及び位相差に応じた第１の検出信号を生成するデジタル位相周波数検出器と；第１の検出信号の高周波成分を除去して第１の制御信号を生成するデジタルフィルタと；第２の発振信号と基準信号との間の位相差に応じた第２の検出信号を生成するアナログ位相検出器と；第２の検出信号の高周波成分を除去して、第２の制御信号を出力するアナログフィルタと；アナログ位相検出器及びアナログフィルタを能動状態とするために、基準信号と第１の発振信号の同期を検出する同期検出部と；を具備する。 （もっと読む）

【課題】クロック信号生成部をディジタル制御するレジスタへの制御情報の格納ステップを削減すること。
【解決手段】半導体集積回路は、クロック信号ＣＬＫmを生成するディジタル制御信号生成部１０、ディジタル制御部２０を具備するクロック生成部を含む。クロック生成部は、位相周波数比較器３１、制御レジスタ２２を更に具備する。比較器３１には、基準信号ＣＬＫinとフィードバック信号Ｍoutが供給される。制御レジスタ２２に比較器３１の出力信号ＦＤoutが供給され、制御レジスタ２２は複数ビットのディジタル制御情報を格納する。クロック生成部は、複数のロック動作のための複数の初期設定データを予め格納する制御データ記憶回路２５を更に具備する。動作選択情報Ｍinに応答して制御データ記憶回路２５から初期設定データＳet1〜Ｓet5が、制御レジスタ２２の上位ビットに格納される。 （もっと読む）

固体原子クロックは、周波数標準を生成するために、超微細共振を示すことが可能な量子状態を利用する可能性がある。出力信号を生成するために自由走行発振器を超微細共振周波数に結合することが可能なデバイスが本明細書で述べられる。本発明のある態様では、原子クロックは、シリコン基材上で作製されてもよく、また、電子集積回路の一部として、チップスケールで集積化されてもよい。固体原子クロックを利用した動作原理、作製方法、およびシステムもまた開示される。 （もっと読む）

【課題】基準信号の周波数を逓倍又は分周したクロック信号を生成するクロック生成回路において、一つの基準信号から任意周波数のクロック信号を発生可能とする。
【解決手段】クロック生成回路１は、リング状に連結したｍ個の遅延素子ＤＵからなるパルス遅延回路１０と、各遅延素子ＤＵから順次出力される通過信号Ｐ１〜Ｐｍに基づき、基準信号ＣＫＩの周期を遅延素子ＤＵでの遅延時間を単位として表した周期データＤＴを生成する周期測定部２０と、除数又は乗数として使用される設定値ＭＮを格納する設定値レジスタ５０と、周期データＤＴに、設定値ＭＮを乗・除してクロック信号の出力周期を表す制御データＣＤを生成する制御部３０と、制御データＣＤと通過信号Ｐ１〜Ｐｍとに基づき、基準信号ＣＫＩを分周又は逓倍したクロック信号ＣＫＯを出力する出力部４０とを備え、実数で表された設定値ＭＮを用いる。 （もっと読む）

【課題】ＣＲ発振回路に温度変化や経年変化が生じても正確な周波数を持つクロック信号を生成する。
【解決手段】ＣＲ発振器１２の温度を示すＡ／Ｄ変換値とＣＲ発振回路８の逓倍数を決める逓倍数設定値ＦＭＵＬＲとを対応付けてＥＥＰＲＯＭ３に記憶し、Ａ／Ｄ変換値（検出温度Ｔ）に応じた逓倍数設定値ＦＭＵＬＲを読み出してＣＲ発振回路８のレジスタに設定する。通信回路７が同期信号を受信するごとにクロック信号ＣＬＫを計数して１ビット長を計測し、その計数値ＸＡと正規の１ビット時間に対する基準周期に基づく基準計数値ＸＢとに基づいて逓倍数設定値ＦＭＵＬＲを補正し、補正後の逓倍数設定値ＦＭＵＬＲを検出温度Ｔに対応させてＥＥＰＲＯＭ３に書き込む。 （もっと読む）

【課題】入力される水平同期信号に対して、サンプリングクロックの周期の値に制約されることなく、位相誤差量を低減することができるフェーズロックドループ回路を提供する。
【解決手段】入力される水平同期信号（H-sync）は、逓倍ＰＬＬ回路２から出力される、周期が等しく、１／４周期分づつずれた位相関係の４種の第１〜第４サンプリングクロックによりサンプリング回路でそれぞれサンプリングされ、各サンプリングクロックに位相同期した４種の水平同期出力データが生成され、これらはさらに加算回路６で加算されて加算水平同期出力データが生成された後、位相比較器１３に入力され、分周器１４で分周されたシステムクロック（第１サンプリングクロック）と位相比較される。 （もっと読む）

位相ロックループ（２００）は、サンプラー（２０２）、位相検出器（２１０）、ループフィルタ（２１２）、ＶＣＯ（２１４）を含む。ループは、ループのフィードバックパス中に分割器を必要とすることなく周波数逓倍を達成する。ＶＣＯ（２１４）は、サンプラーのナイキストレートより上で動作され、ループが偽信号化された信号上にロックすることを引き起こす。ＶＣＯ出力周波数中のあらゆる変動（即ち、ジッターまたは位相ノイズ）は、周波数分割器に通常関連付けられる減衰無しで、１対１で位相検出器（２１０）にフィードバックされる。ループゲインは従って、高い閉ループ周波数逓倍を提供するループにおいてでも、高く保つことができる。一変形によると、高調波発生器（５４０）がＶＣＯとサンプラーの間に置かれ、よってループがＶＣＯ周波数の高調波上にロックすることを引き起こす。開ループゲインと精度はよって更に向上される。
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【課題】 原子発振器の出力する安定な周波数の信号を使う場所が離れている場合に、その信号を長い同軸ケーブルで搬送していた。外部環境が同軸ケーブルに影響して発生する信号の周波数の揺らぎを削減する。
【解決手段】金属原子に対する励起光を出力する光源部１を設置する。その場所から離れて設置された原子共鳴部３０には、該光源部１からの出射光を伝播させる光ファイバ３３，３４から出射される励起光と共鳴マイクロ波とを入力する。原子共鳴部３０は、光マイクロ波二重共鳴を起し、その際に生じる共鳴周波数を出力する。 （もっと読む）

低コストで低位相ノイズのマイクロ波シンセサイザーは、ＤＤＳ変調回路と位相ロックループを含む。ＤＤＳ変調回路はＤＤＳの出力を高周波数に変調する。位相ロックループはＤＤＳ出力をダウンコンバートし、ダウンコンバート信号を比較的低周波数の固定されたリファレンスにロックする。
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【課題】所定のエージング期間から推定した周波数偏差が目標仕様に収まる製品数を増加
させることが可能となり、製品の歩留まりを向上したルビジウムランプを提供する。
【解決手段】洗浄した複数のランプ連結管１０を連結管本体５に取り付ける。その際、ラ
ンプ連結管１０には、不純物が付着している虞があるので、クリプトンガス等によりガス
洗浄を行なう。次に、ルビジウム金属を連結管本体５から供給して連結支管３とランプ本
体４に追い込んで付着させる。次に、発光の補助となる所定量のキャリアガス（クリプト
ンガス等）を供給し、連結支管３を連結管本体５から切り離す。そして、切り離した連結
管支管３からルビジウム金属をランプ本体４に追い込んでランプ本体４に付着させる。最
後に、連結管支管３からランプ本体４を切り離す。 （もっと読む）

【課題】 好適なタイミングでデータを読み込むことができるクロックを簡単に生成することができるタイミングクロック生成装置を提供する。
【解決手段】 基準となるシステムクロックをデータの入力タイミングに同期させる第１ＰＬＬ回路２１と、システムクロックの周波数を所定倍に逓倍した逓倍クロックを生成する第２ＰＬＬ回路２３及び２分周回路２４と、逓倍クロックの遷移タイミングのうち、データの取込みに使用するタイミングを選択する制御部５と、選択された遷移タイミングに同期し、システムクロックと同一周波数を有するデータ取込み用クロックを生成する位相調整・分周回路２６と、を有している。 （もっと読む）

【課題】安定した高速動作が可能なクロック再生装置を提供する。
【解決手段】クロック再生装置１は、受信データＤ１からデータ受信用の再生クロックＣＫ１を得るものであって、受信データＤ１のレベルが所定のレベルである場合に、受信データＤ１に同期した所定周波数の信号Ｓ１を出力する発振器２１と、発振器２１に直列に接続され、信号Ｓ１のレベルが所定のレベルである場合に、信号Ｓ１に同期した所定周波数の信号Ｓ１を再生クロックＣＫ１として出力する発振器２２とを備える。 （もっと読む）

【課題】 回路規模が大きくなるのを抑えることができ、動作中に周波数を切り替えたときにシステム誤動作が起きるのを防ぐことのできる周波数切替え装置を提供する。
【解決手段】 周波数切替え器５は、位相周波数比較器１０と、チャージポンプ回路１１と、ＬＰＦ回路１２と、ＶＣＯ回路１３と、カウンタ回路１４と、カウンタ回路１４の動作を制御する制御部８を備える。制御部８は、逓倍数変更部１６と、変更許可判定部１５を備える。変更許可判定部１５は、カウンタ回路１４のカウンタ値に基づいて、逓倍数を目標逓倍数に変更するのを許可するか否かを判定する。例えば、カウンタ値が目標逓倍数以下の基準値（例えば、カウンタ値０）になったときに、逓倍数の変更を許可する。 （もっと読む）

【課題】 回路規模が大きくなるのを抑えることができ、動作中に周波数を切り替えたときに異常動作が起きるのを防ぐことができる周波数切替え方法を提供する。
【解決手段】 出力信号の周波数を目標周波数に切り替えるときに、位相周波数比較器１０とチャージポンプ回路１１と逓倍設定回路１４をリセット状態にし（Ｓ２）、逓倍数を目標周波数に対応した逓倍数Ｃ１に変更し（Ｓ４）、分周数を目標周波数に対応した分周数より大きい仮分周数２Ｎに変更する（Ｓ５）。その後、位相周波数比較器１０とチャージポンプ回路１１と逓倍設定回路１４のリセット状態を解除して（Ｓ６）、分周数を目標周波数に対応した分周数Ｎに変更する（Ｓ８）。 （もっと読む）

【課題】スイープ電圧発生のための回路規模を小型化し、且つ非ロック時における周波数引き込み動作を自動的に行なうことが可能なルビジウム原子発振器を提供する。
【解決手段】このルビジウム原子発振器１００は、ＯＭＵ１と、増幅器２と、出力信号をデジタル信号に変換するＡ／Ｄ変換器３と、ロック状態又は非ロック状態を判定する状態判定部１１と、位相変調信号ｆｍの周波数成分を選択的に出力するＢＰＦ１３と、スイープ電圧データを生成するスイープ電圧データ生成手段１２と、タイマ１５と、第１のＢＰＦ１３の出力信号又はスイープ電圧データ生成手段１２の出力信号を選択するＳＷ−Ａ１４と、アナログ信号に変換するＤ／Ａ変換器５と、位相検波して周波数制御信号を生成する位相検波器６と、周波数制御信号を積分処理する積分回路７と、周波数制御信号に従い出力周波数が制御されるＶＣＸＯ８と、を備えて構成されている。 （もっと読む）