Fターム［5J106RR00］の内容
発信器の安定化、同期、周波数シンセサイザ (26,591) | 構成要素 (681)
Fターム［5J106RR00］の下位に属するFターム
入力回路（固定分周器以外） (47)
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逓倍器・高調波発生器（ループ内） (7)
逓倍器・高調波発生器（ループ外） (11)
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コード変換器 (5)
ＶＣＯの可変手段 (38)
プログラマブル分周器の分周比設定手段 (97)
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同期検出手段 (14)
表示手段
Fターム［5J106RR00］に分類される特許
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デュアルシンセサイザ装置及びこれを用いた無線装置
【課題】 簡単な構成で周波数干渉を防止できる小型なデュアルシンセサイザ装置を提供する。
【解決手段】 第１ＰＬＬシンセサイザ部104ａと、第２ＰＬＬシンセサイザ部104ｂと、第１または第２ＰＬＬシンセサイザ部の一方の出力信号を選択する選択スイッチ105とを備えるデュアルシンセサイザ装置において、第１及び第２ＰＬＬシンセサイザ部の出力信号の周波数を制御するためのデータ信号線106及びクロック信号線107を第１及び第２ＰＬＬシンセサイザ部で共用して装置を小型化する。このデータ信号線またはクロック信号線の分岐点と第１及び第２ＰＬＬシンセサイザ部との間に特定の周波数帯域を減衰する信号減衰手段を設けることにより、第１及び第２ＰＬＬシンセサイザ部の間のアイソレーションが向上し、周波数干渉を防止できる。
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