Fターム[5L106BB00]の内容
半導体メモリの信頼性技術 (9,959) | エラーの検出、訂正 (500)
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半導体記憶装置及び半導体記憶システム
【課題】メモリセルの性能劣化要因の影響を抑制した信頼性の高い半導体記憶装置を提供する。
【解決手段】半導体記憶装置は、ワード線WLとビット線BLとの各交差部に配置され、一端がワード線に他端がビット線に接続された複数のメモリセルMCを有するメモリセルアレイ1と、メモリセルMCに対するデータの読み出し/書き込みを行う読み出し/書き込み回路2と、メモリセルMCから読み出された所定長のデータと、メモリセルMCに書き込むべき所定長のデータとを比較及び判定し、その判定結果を表すフラグを作成する演算回路3とを備える。読み出し/書き込み回路2は、データ書き込み時には、メモリセルに書き込むべき所定長のデータの各ビットをフラグに応じて反転させ、所定長のデータ及びフラグのうち書き換えられるデータのみをメモリセルに書き込み、データ読み出し時には、所定長のデータと共に対応するフラグを読み出してフラグに応じて所定長のデータの各ビットを反転させて出力する。
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不揮発性半導体記憶装置
【課題】市場において不良セルが発生しても、装置自身がその不良を冗長セルに自動的に置き換えることができる不揮発性半導体記憶装置を提供する。
【解決手段】メモリセルアレイは、複数のメモリセルを有する本体セルアレイ11と、メモリセルと置き換え可能な複数の冗長セルを有するリダンダンシアレイ12とを有する。消去回路22は、メモリセル及び冗長セルのいずれかを含む対象セルに対して消去動作を行い、対象セルに対する消去動作の開始からの経過時間がタイマ14により計測される。制御回路13は、タイマ14による経過時間の計測により、消去動作の開始から所定時間が経過したことを認知したとき、消去動作を停止させ、対象セルを冗長セルへ置き換える。
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