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国際特許分類[H01L21/00]の内容

電気 (1,674,590) | 基本的電気素子 (808,144) | 半導体装置,他に属さない電気的固体装置 (445,984) | 半導体装置または固体装置またはそれらの部品の製造または処理に特に適用される方法または装置 (183,847)

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【課題】予め実験的に求めていたパラメーターにより結晶欠陥の密度やサイズを予測する手法を提供する。
【解決手段】シリコン単結晶中における結晶欠陥のサイズおよび密度を予測する結晶欠陥状態予測方法であって、
実験データを解析し関連する物理パラメーターを抽出し、その物理パラメーターについてデータベースを構築する工程と、
前記データベースのデータを用いて、結晶欠陥のサイズおよび密度を算出する工程と、
を有するとともに、
前記データベースが、結晶欠陥の密度およびサイズに大きく影響を与える独立要素と、
該独立要素に従属する従属要素としての結晶欠陥のサイズ分布中における最大サイズと最小サイズとを有してなる。 (もっと読む)


【課題】 電気的な性能判断に加えコスト面からも判断可能なFOMを新たに提案し、このFOMに基づいて、電気的な性能を満足することに加え低コスト化をも図った半導体チップの製造方法の製造方法を提供することを目的とする。
【解決手段】 基板2の電気的な性能を示す項と半導体チップコスト6を示す項の積として半導体チップのFOM7を定めて、この半導体チップのFOM7に基づいて種類の異なる基板(2a,2b)に対する半導体チップのFOM7を計算し、この計算結果の大小に基づいて、種類の異なる基板(2a,2b)から所望の基板を選択し、選択された所望の基板に半導体素子を形成して半導体チップを得るようにした。 (もっと読む)


【課題】ウエハごとの特性不良率と工程別の異物不良率を高精度に予測する予測方法とプログラム、および、この特性不良と工程別の異物不良の発生率の違いに基づいて原因を究明する半導体製造装置の管理方法とこれを用いた半導体装置の製造方法を提供する。
【解決手段】半導体製造装置の管理システムにおいて、特性不良・工程別異物不良率予測部121は、フェイルビットモードごとの実績不良率と工程ごとフェイルビットモードごとのクリティカルエリアとを取得し、任意のフェイルビットモードを除いたフェイルビットモードごとの実績不良率と工程ごとフェイルビットモードごとのクリティカルエリアとを用いて工程ごとの異物数を算出し、この異物数を用いて工程ごとの異物不良率ならびにフェイルビットモードごとの異物不良率を算出し、このフェイルビットモードごとの異物不良率と実績不良率とに基づいて任意のフェイルビットモードの特性不良率を算出する。 (もっと読む)


【課題】コンパクトな構造で用紙の向きを揃えてスタンプを押印する紙折り装置を提供する。
【解決手段】回路シミュレーションモデル記述のためのSPICEパラメータを格納する初期パラメータ記憶手段と、シミュレーション対象回路を構成する素子の接続情報を有するシミュレーション対象回路ネットリストを格納するネットリスト記憶手段と、SPICEパラメータを新規デバイスに対応するパラメータに最適化するための知識情報をデータベース化した最適化知識情報を格納する知識情報記憶手段と、ユーザの所望するデバイスの条件を受け付ける条件入力手段と、最適化知識情報を参照して、SPICEパラメータを調整してユーザの所望する新規パラメータを作成するパラメータ作成手段と、パラメータ作成手段にて作成した新規パラメータを基に、回路シミュレーションを行うシミュレーション実行手段と、を備える。 (もっと読む)


【課題】部分的に活性化されたドープ半導体領域の活性化の程度および活性ドーピングプロファイルを非破壊的手法で決定するための方法及び/又は手順を提供する。
【解決手段】ほぼ同じ既知の注入されたままの濃度および、既知の変化する接合深さを有する少なくとも2つの半導体領域のセットを用意する工程10、これらの領域のうち少なくとも1つについて、注入されたままの濃度の決定工程20、前記セットのうち少なくとも2つの半導体領域をPMOR技術により部分的に活性化させる工程30、反射プローブ信号の符号付き振幅を接合深さの関数として、少なくとも2つのレーザ間隔値について測定および/またはDCプローブ反射率を接合深さの関数として測定する工程40、これらの測定値から活性ドーピング濃度を抽出する工程80、全体の注入されたままの濃度および活性ドーピング濃度を用いて、不活性ドーピング濃度を計算する工程90を含む。 (もっと読む)


【課題】 イオン注入分布発生方法に関し、2次の拡張LSS理論における摂動計算のモデル式を近似して簡便なR、ΔR及びΔRptを求める。
【解決手段】 2次の拡張LSS理論における摂動計算のモデル式を求める際に、全阻止能(S+S)に対する核阻止能Sの比r=S/(S+S)を複数のエネルギー領域で区分し、前記区分した各エネルギー領域で前記rを定数rとして扱う。 (もっと読む)


【課題】
三次元構造を有する半導体基板の光アニール工程における実効吸収率分布を簡便に近似して実効吸収率分布を予測する工程を含む半導体装置の製造方法を提供する。
【解決手段】
半導体装置の製造方法は、(a)半導体基板に素子分離領域を形成することによって、素子分離領域に囲まれた活性領域を画定し、活性領域上方にゲート電極を形成すると共に素子分離領域上に配線を形成し、不純物をイオン注入し、光を照射してイオン注入した不純物を活性化することによって得られる半導体装置の設計データを準備する工程と、(b)半導体基板の平面内において厚さ方向の一次元構造を分類し、各一次元構造毎に入射光の反射率と面積密度とを加重平均した値と、異なる光学的特性の領域が形成する三次元構造の境界面の側面の面積と該三次元構造に依存する係数を加重平均した値とを用いて半導体基板の表面内における実効的光吸収率の二次元分布を求める工程と、を含む。 (もっと読む)


【課題】歩留りに基づく修正メリット関数を使用した光近接補正法を提供すること。
【解決手段】レイアウト・ジオメトリに関係した既知の故障メカニズムを使用して、エッジ・フィーチャなどのレイアウト・フィーチャ間の距離値に基づく歩留り関数を導き出す。予測レイアウト・パターン上のエッジ点と設計レイアウト・パターン上の対応点との比較では、まず最初に歩留りテストを実施し、その後に予測レイアウト・パターン上の点を歩留りがより高い位置へ移動させる。歩留りが許容しうる場合、それ以上の移動は実施しない。点を段々と移動させた結果、許容しうる歩留りに到達する前に許容される近接範囲内に入った場合には、他の考慮事項のためにその点にフラグを立てる。 (もっと読む)


【課題】 イオン注入分布発生方法及びシミュレータに関し、近似を効果的に用いることによって計算時間を大幅に短縮する。
【解決手段】 半導体に注入するイオンの飛程の射影Rp の2次の項まで考慮した射影〈Rp (E)〉(2) を、1次の項まで考慮した既知の射影を〈Rp (E)〉(1) とした時に、摂動項Δp (2) (E)を用いて、
〈Rp (E)〉(2) =〈Rp (E)〉(1) +Δp (2) (E)
とした近似式を用いた2次の摂動モデルを用いて求める。 (もっと読む)


【課題】 イオン注入分布発生方法に関し、モーメントパラメータの任意性をなくすとともに、適用種類及び適用範囲を拡大する。
【解決手段】 xを基板の深さ方向、Φを注入するイオンのドーズ量、Φchanをチャネルドーズ量、na (x)を非晶質パートの分布関数、nc (x)をチャンネリングパートの分布関数とすると、下記の式で表されるテール関数N(x)からイオン注入分布を発生させる際に、非晶質層中のイオン分布から抽出したモメントパラメータ、イオンの飛程の注入方向の射影を表すパラメータRp 、Rp の標準偏差ΔRp 、注入イオン分布の左右非対称性を表すパラメータγ、注入イオン分布のピークの鋭さを表すパラメータβを前記テール関数のRp 、ΔRp 、γ、βとして用いてイオン注入分布を発生させる。
N(x)=(Φ+Φchan)na (x)+Φchanc (x) (もっと読む)


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