Fターム[5E001AZ00]の内容
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素子間の配置接続 (46)
Fターム[5E001AZ00]に分類される特許
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積層型電子部品の製造方法
【課題】セラミック素体の端面と内部電極とのサイドギャップを正確に測定でき、極力小型化を図ることのできる積層型電子部品の製造方法を得る。
【解決手段】複数のセラミック層を積層してセラミック素体を形成するとともに、引出し部がセラミック素体の側面12a,12bに露出した内部電極21,22をセラミック素体の内部に形成し、側面12a,12bにめっきにより内部電極21,22の露出部と電気的に接続された帯状の外部端子電極25,26を形成する積層型電子部品の製造方法。端面13aに最も近い外部端子電極21から端面13aまでの距離G2を測定し、測定された距離G2が所定の基準値を満たさない場合、そのセラミック素体を不良品として選別除去する。
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