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Fターム[2H092MA19]の内容

液晶−電極、アクティブマトリックス (131,435) | 製造方法 (16,988) | 製法、工程 (14,676) | パターン形成 (6,228) | エッチング (2,565) | 物理的エッチング (431)

Fターム[2H092MA19]に分類される特許

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【課題】 ピクセル口径比(開口率)を増大し、静電容量性クロストークを減少させたTFTアレイ、およびそのTFTアレイを有するアクティブ・マトリックス方式の液晶ディスプレイ、および製造方法を提供すること。
【解決手段】 複数のコンタクト・バイアス35あるいは開口部を有するフォトイメージ形成型絶縁層をアドレス線5、7とピクセル電極3間に設け、両者を重複可能とする。この絶縁層により静電容量性クロストークを減少し、かつピクセル開口率を増加させる。望ましい一実施例では、クロストークを減少するために絶縁層の誘電率は約3.0未満である。 (もっと読む)


【課題】 薄膜トランジスタ表示板の製造工程を簡素化する。また、画素電極の断線を防止できる薄膜トランジスタ表示板の製造方法を提供する。
【解決手段】 本発明の一実施形態による薄膜トランジスタ表示板の製造方法は、基板上にゲート線を形成する段階と、前記ゲート線上にゲート絶縁膜を形成する段階と、前記ゲート絶縁膜上に半導体層を形成する段階と、前記半導体層上にオーミック接触部材を形成する段階と、前記オーミック接触部材上にデータ線及びドレイン電極を形成する段階と、前記データ線及び前記ドレイン電極上に保護膜を蒸着する段階と、前記保護膜上に第1感光膜を形成する段階と、前記第1感光膜をマスクとして前記ゲート絶縁膜及び前記保護膜をエッチングすることによって、前記ドレイン電極の少なくとも一部と前記基板の少なくとも一部を露出させる段階と、導電体膜を蒸着する段階と、並びに前記第1感光膜を除去し、前記ドレイン電極の露出した部分上に画素電極を形成する段階とを含む。 (もっと読む)


【課題】 スタックコンタクトにおける接触抵抗を抑制させる。
【解決手段】 基板と、基板上に設けられた薄膜トランジスタと、該薄膜トランジスタの上層側に設けられた配線と、該配線と薄膜トランジスタの少なくとも半導体層とを層間絶縁する層間絶縁層と、該層間絶縁層に掘られており且つ基板面上で平面的に見て長手状に延びる第1の穴、及び、夫々、第1の穴の底部から層間絶縁層を貫通して半導体層の表面に至り且つ第1の穴の長手方向に沿って配列された複数の第2の穴を含んでおり、配線と半導体層とを層間絶縁層を介して接続するコンタクトホールとを備える。 (もっと読む)


【課題】薄膜トランジスタ表示板の製造工程を単純化する。また、薄膜トランジスタ表示板の生産費用及び生産時間を節減する薄膜トランジスタ表示板の製造方法を提供する。
【解決手段】基板上に第1配線を形成する段階と、前記第1配線上に第1絶縁膜及び半導体層を順次積層する段階と、一回のフォトリソグラフィ工程で前記半導体層及び前記第1絶縁膜を異なる形状にパターニングする段階と、第2配線を形成する段階とを有する。 (もっと読む)


【課題】 ソース/ドレイン電極間の電気的疎通を円滑にすることが可能な,薄膜トランジスタ,その製造方法及び該薄膜トランジスタを備える平板ディスプレイ装置を提供する。
【解決手段】 本発明に係る薄膜トランジスタは,基板110と,基板110上に形成されたゲート電極120と,ゲート電極120上に形成されるゲート絶縁層130と,ゲート電極120と絶縁されるようにゲート絶縁層130上に形成されるソース/ドレイン電極140a,140bと,ソース/ドレイン電極140a,140bと接するとともに,ゲート電極120と絶縁される有機半導体層150と,を含み,ソース/ドレイン電極140a,140bの少なくとも有機半導体層150と接する部分には酸化部140´a,140´bが設けられ,酸化部140´a,140´bを構成する物質は,有機半導体層150のHOMOエネルギー準位より大きい仕事関数を有する物質を含む。 (もっと読む)


導電性層(5)を基板(1)の上に製造する方法は、絶縁体たとえば感光性絶縁体(2)のような材料を基板(1)の上に堆積させること、絶縁材料上に導電層のための溝(3)を画成すること、溝(3)を先駆体で埋めること、そして導電層を与えるための先駆体を処理することを有する。
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【課題】 本発明は薄膜トランジスタアレイ及びその製造方法と液晶表示装置及びその製造方法とエレクトロルミネッセンス表示装置及びその製造方法に関するものであり、均一性と性能に優れた薄膜トランジスタ及びその製造方法を生産性が高く低コストで提供することを目的とする。
【解決手段】 ゲート電極側面に側壁を形成することによって、自己整合的にLDDまたはオフセット領域を形成し、また、層間絶縁膜を複数の層で形成し、これら複数の層間絶縁膜上にソース・ドレイン電極とソースバス配線と画素電極を一括して形成する。 (もっと読む)


【課題】 IPS方式の液晶表示装置において、TFTを作製する工程数を削減して製造コストの低減および歩留まりの向上を実現する。
【解決手段】 本発明では、チャネル・エッチ型のボトムゲートTFT構造を採用し、ソース領域119及びドレイン領域120のパターニングとソース配線121及び画素電極122のパターニングを同じフォトマスクで行うことを特徴とする。 (もっと読む)


【課題】 優れた特性を有する多結晶シリコン膜を備えた半導体装置を高い歩留まりで製造することが可能な半導体装置の製造方法を提供する。
【解決手段】 石英ガラスや無アルカリガラスなどの基板1上に、非晶質シリコン膜2aを形成する。その非晶質シリコン膜2a上にWシリサイド膜(導電膜)4bを形成する。そして、Wシリサイド膜(導電膜)4bに対し、高周波やYAGレーザービームなどの電磁波を照射することにより、Wシリサイド膜(導電膜)4bを発熱させ、この熱を利用して、非晶質シリコン膜2aを多結晶シリコン膜2に変える。 (もっと読む)


【課題】斜めからの入射光110、及び入射光110が乱反射を起こすことにより間接的に入射する光についても、遮光可能な薄膜トランジスタの構造及びその構造を工程数を増やすことなく簡易なプロセスで製造可能な製造方法を提供する。
【解決手段】 活性層となるpoly−Si膜104の両側のそれぞれにおいて、ゲート絶縁SiO2膜105及び下地SiO2膜103を遮光WSi2膜102が露出するまで選択的異方性エッチングし、コンタクト開口部106を形成する。その後、ゲートWSi2層107をスパッタ成膜し、さらに、フォトレジスト108をマスクとしてドライエッチングを実施し、ゲートWSi2電極111とWSi2からなるサイドウォール109を同時に形成する。これにより、サイドウォール109の下端を遮光WSi2膜102に接触させ上端をゲート絶縁SiO2膜105上面とほぼ同一高さに位置させる。 (もっと読む)


【課題】 絶縁基板上にグラフォエピタキシャル成長させた単結晶シリコン層を能動領域に用いるトップゲート型の薄膜絶縁ゲート型電界効果トランジスタ(トップゲート型にはスタガー型とコプラナー型が含まれる。)と受動領域を有する液晶表示装置などに好適な構造及び方法を提供する。
【解決手段】 基板1に形成した段差4をシードにして、多結晶シリコン又はアモルファスシリコンを溶解した低融点金属層6(6A)からグラフォエピタキシャル成長により単結晶シリコン層7を形成し、これを表示部−周辺駆動回路一体型のLCDなどの電気光学装置のトップゲート型MOSTFTに用いる。 (もっと読む)


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