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Fターム[5E034DC01]の内容

Fターム[5E034DC01]に分類される特許

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多層素子は、少なくとも1つの第1内部電極1及び少なくとも1つの第2内部電極2が配置された本体5を有する。これらの内部電極1、2は、少なくとも1つの側面において、本体5の表面まで広がる重複領域12を有する。さらに、内部電極1、2は本体の角領域5に凹部7を有する。 (もっと読む)


【課題】低抵抗化を図りつつ酸化処理後のPTC特性が向上された積層型PTCサーミスタを提供する。
【解決手段】積層型サーミスタ1の半導体セラミック層2を、(Ba1−w−xSrREα(Ti1−yTM)O+βSiO+zMnOで示される化合物を含む空隙率が5〜25%の焼結体から構成し、REは、Y、La、Ce、Pr、Nd、Sm、Gd、Dy、Erからなる群から選択される少なくとも1種の元素、TMは、V、Nb、Taからなる群から選択される少なくとも1種の元素であり、w、x、y、z、β(いずれもmol)及びα(Baサイト/Tiサイトのmol比)は以下を満足する。
0≦w≦0.3
0.001≦x+y≦0.005
0.2≦y/(x+y)≦0.8
0≦z≦0.0015
1.02≦α≦1.1では、2.35α−2.39<β<2.35α−2.32
0.99≦α<1.02では、0≦β<2.35α−2.32 (もっと読む)


【課題】 熱を効率よく放散させることが可能なバリスタ素子を提供すること。
【解決手段】 積層型チップバリスタV1は、バリスタ素体10と、第1及び第2の内部電極12,14と、熱伝導体16と、絶縁膜17と、第1及び第2の外部電極18,20とを備える。バリスタ素体10は、第1及び第2の外表面22,24を有する。第1及び第2の内部電極12,14は、少なくともその一部同士が互いに対向すると共に一端面12a,14aが第1の外表面22に露出している。熱伝導体16は、その一端面16aが第1の外表面22に露出している。絶縁膜17は、第1及び第2の内部電極12,14の一端面12a,14aの所定領域及び熱伝導体16の一端面16aを覆うように第1の外表面22上に配置されている。第1の外部電極は第1の内部電極12に接続され、第2の外部電極は第2の内部電極14に接続されている。 (もっと読む)


【課題】 抵抗温度係数などの優れた特性を有し、抵抗体を形成するペーストと同時に焼成することができ、且つ鉛とビスマスを含まないサーミスタ形成用抵抗ペーストを提供する。
【解決手段】 導電性粒子とガラスフリットと有機ビヒクルとで実質的に構成され、導電性粒子がYRu、NdRu、SmRu、又はGdRuであり、且つガラスフリットがホウケイ酸ガラスやアルミノホウケイ酸ガラスなどの鉛及びビスマスを含まないガラスフリットである。 (もっと読む)


【課題】外部電極をメッキレスとした場合であっても、実装時のハンダ食われを抑止できる。
【解決手段】積層型チップバリスタ1では、外部電極51にAgを含有させることにより、外部電極51の低抵抗化及び低融点化が図られている。また、外部電極51の主成分をPtとすることにより、外部電極51にNiやSnなどのメッキ層を形成しなくても、ハンダバンプ53によるハンダ食われを好適に抑止できる。外部電極51にメッキ層を形成しないことは、積層型チップバリスタ1の製造時における工程数の削減を実現し、製造コストの低減化にも寄与する。さらに、内部電極対21の主成分をPdとすることで、内部電極対21と外部電極51との良好なコンタクトが得られ、高周波に対する積層型チップバリスタ1のESR特性が向上すると共に、個体ごとのESRばらつきも低減される。 (もっと読む)


【課題】ESD耐量を良好に維持しつつ、低静電容量化を図ることが可能な積層型チップバリスタを提供すること。
【解決手段】積層型チップバリスタ1の積層体3は、バリスタ部7と、当該バリスタ部7を挟むように配置される一対の外層部9とを有する。バリスタ部7は、バリスタ特性を発現するバリスタ層11と、当該バリスタ層11を挟むように配置される一対の内部電極13とを含む。内部電極13は、外部電極5に電気的に接続される。バリスタ層11における一対の内部電極13に重なる領域は、バリスタ特性を発現させるための希土類金属及びCoを含む複数の添加物を副成分として含有する第1の素体からなる領域を有する。外層部9は、ZnOを主成分とすると共に、Coを含まず且つ前記複数の添加物のうちCoを除くすべての添加物のみを副成分として含有する第2の素体からなる領域を有する。 (もっと読む)


【課題】ガラス層を形成することなく、めっき液によるセラミック素体の侵食を防ぐことができ、セラミック素体の素体強度が高く、優れた信頼性を有する表面実装型負特性サーミスタを提供する。
【課題を解決するための手段】Mn,Ni及びTiを含む半導体セラミック材料からなるセラミック素体と、セラミック素体の表面に形成される外部電極と、外部電極の表面に形成されるめっき膜と、を具備する表面実装型負特性サーミスタにおいて、半導体セラミック材料に含まれるMnのモル量をa、及びNiのモル量をbとしたとき、MnとNiとのモル比が55/45≦a/b≦90/10であり、かつ、半導体セラミック材料のうちMn及びNiの総モル量を100モル部としたとき、Tiが0.5モル部以上25モル部以下の範囲で含有され、セラミック素体の内部に少なくともAgを含む内部電極が埋設されるとともに、内部電極は、外部電極と導通してなることを特徴とする。 (もっと読む)


【課題】本発明は、簡単な構成により静電気対策部品の一対の端面電極の導通を確認でき、一対の裏面電極と一対の上面電極の電気的接続を保証することができる静電気対策部品の端面電極の導通確認方法を提供することを目的とするものである。
【解決手段】本発明の静電気対策部品の端面電極の導通確認方法は、第1の上面プローブ31を一方の上面電極22に、第2の上面プローブ32を他方の上面電極23に、第1の裏面プローブ33を一方の裏面電極27に、第2の裏面プローブ34を他方の裏面電極28にそれぞれ接触させ、さらに前記第1の裏面プローブ33と第2の裏面プローブ34との間を電気的に接続するように電流経路35を形成し、かつ前記第1の上面プローブ31と第2の上面プローブ32との間に電源装置36を接続したものである。 (もっと読む)


【課題】本発明は、隣接する信号端子間でのクロストークの影響が少なく、信頼性に優れている複数回路用多端子タイプの静電気対策部品を提供することを目的とするものである。
【解決手段】本発明の静電気対策部品は、絶縁基板11の上面の長辺側両端部に形成された複数の上面電極17と、絶縁基板11の上面の短辺側両端部から中央部にかけて形成された上面グランド電極16と、複数の上面電極17と上面グランド電極16との間に形成されたギャップと、このギャップを充填する過電圧保護材料層20と、この過電圧保護材料層20を完全に覆う上面保護樹脂層21とを備え、前記過電圧保護材料層20を複数の上面電極17毎に独立するように形成したものである。 (もっと読む)


【課題】電流−電圧非直線特性、寿命特性およびサージエネルギー耐量に優れると共に、高温下での熱安定性を向上させた、過電圧保護装置の小型化に寄与可能な電圧非直線抵抗体を提供する。
【解決手段】主成分としてZnOを95mol%以上含んだ焼結体1は、副成分としてBi、Sb、Co、Mn、Niを、それぞれBi、Sb、Co、MnOおよびNiOに換算して、Biを0.3〜1mol%、Sbを0.5〜2.5mol%、Coを0.3〜1.5mol%、MnOを0.2〜2mol%、NiOを0.5〜3mol%含んでいる。また、MnOに対するNiOの含有量の比は2.0〜6.0、MnOに対するSbの含有量の比は1.5〜4.0である。 (もっと読む)


本体(2)を備える電気コンポーネントにおいて、前記本体の表面は少なくとも1つの第1の導電性の材料層(3)を備えており、前記第1の材料層は前記本体と反対を向いているほうの表面で第2の導電性の材料層(4)によりコーティングされており、前記材料層は閉じた多孔性の外側の表面を有する外側接触部(6,6’)の少なくとも一部を形成している。
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【課題】リニア温度幅が広く、かつ消費電流が小さいサーミスタを提供。
【解決手段】絶縁性の基体11と、この基体11の表面に設けられた少なくとも一対の電極12a1,12a2と、この基体11の表面に形成され電極に接続されたサーミスタ膜13とを有し、サーミスタ膜はB定数が1500K以上2200K以下のサーミスタ組成物からなり、サーミスタ膜にはトリミングが施されてトリミング溝14が形成されているものである。従って、リニア温度幅が70℃以上と広く、かつ消費電流が100μAより小さい省電力仕様の温度制御回路に用いることが可能なサーミスタを提供することができる。 (もっと読む)


【課題】焼結体の融着防止材として使用するジルコニア粉末が、成形体に付着した後、その自重で成形体から離脱することを防止し、焼成後の焼結体同士の融着発生を抑えて外観不良をなくし、製品歩留を向上できるサーミスタ素子の焼成方法を提供する。
【解決手段】サーミスタ素子の焼成工程において、上記サーミスタ素子にジルコニア粉末とアルキルアセタール化ポリビニルアルコールを主成分とする粉末との混合物を散布して焼成することを特徴とし、上記の混合物がジルコニア粉末80.0〜99.0wt%と、アルキルアセタール化ポリビニルアルコール1.0〜20.0wt%からなることを特徴とする。 (もっと読む)


【課題】メッキ液及び半田フラックスに基づくセラミック素体の劣化が生じた。
【解決手段】 Pd内部電極2、3を有する積層セラミック素体1を形成する。セラミック素体1の全外周面にAlxOyから成る保護膜を形成する。Agペ−ストの塗布、焼付けによって外部電極用の導電体層14、15を形成する。Agペ−ストの焼付けによってPd内部電極2、3の体積膨張が生じ、内部電極2、3が保護膜6を破って外部電極4、5に電気的に接続される。保護膜6は外部電極4、5の下に残存する。保護膜6の上にシリコ−ン樹脂層7を設ける。Ag導体層14、15の上にはNiメッキ層16、17及びSnメッキ層18、19を順次に形成する。 (もっと読む)


【課題】薄いシートを複数層積層した構造の酸化亜鉛積層チップバリスタにおいて、制限電圧特性とインパルス耐量特性が共に優れた酸化亜鉛積層チップバリスタの製造方法を提供する。
【解決手段】酸化亜鉛(ZnO)100mol%と、酸化ビスマス(Bi2O3)を0.1〜1.5mol%と、酸化アンチモン(Sb2O3)を0.01〜2.0mol%と、酸化コバルト(CoO)および酸化マンガン(MnO2)の内一種類以上を0.1〜1.5mol%と、酸化クロム(Cr2O3)を0.01〜2mol%と、ホウ酸(H3BO3)を0.01〜2mol%と、酸化アルミニウム(Al2O3)濃度が10〜1000ppmになるように、原料を準備し、この原料のうち、酸化ビスマス(Bi2O3)および酸化アンチモン(Sb2O3)の全量と、酸化亜鉛(ZnO)0.1〜1.0mol%を含む仮焼原料に700〜1000℃の温度範囲で熱処理を行い、該仮焼原料とその他の原料とを加えてグリーンシートを形成し、該グリーンシートを積層し、切断してグリーンチップを形成後、焼成する。 (もっと読む)


【課題】Pbを使用することなく、常温比抵抗値が低く、正の温度係数や温度に対する比抵抗変化率が大きく、かつ、キュリー点が高温側にシフトしたPTCサーミスタ用半導体磁器組成物及び当該PTCサーミスタ用半導体磁器組成物を得ることができるPTCサーミスタ用配合材料を提供する。
【解決手段】PTCサーミスタ用半導体磁器組成物を、Ba、Ti、Bi、Oの各元素を必須元素として含むとともに、1価のアルカリ金属を一種類以上含むものとする。そして、Biに対する1価のアルカリ金属のモル比Xが0.65≦X≦1.59であり、Nbの含有量が480ppm以下であり、Sb、Ta、各希土類元素の含有量がそれぞれ10ppm以下である。 (もっと読む)


【課題】ガラス層を形成することなく、めっき液によるセラミック素体の侵食を防ぐことができ、セラミック素体の素体強度が高く、優れた信頼性を有する表面実装型負特性サーミスタを提供する。
【課題を解決するための手段】Mn,Ni及びTiの少なくともいずれかを含む半導体セラミック材料からなるセラミック素体4と、前記セラミック素体4の表面に形成される外部電極5と、前記外部電極5の表面に形成されるめっき膜6と、を具備する表面実装型負特性サーミスタ1であって、前記半導体セラミック材料に含まれるMnのモル量をa、Niのモル量をbとしたとき、MnとNiとのモル比が55/45≦a/b≦90/10であり、かつ、前記半導体セラミック材料のうちMn及びNiの総モル量を100モル部としたとき、Tiが0.5モル部以上25.0モル部以下の範囲で含有されていることを特徴とする。 (もっと読む)


【課題】過渡電圧抑制デバイスがより低いコストで且つより信頼性の高い生産で提供するという課題があった。
【解決手段】組込過渡電圧保護を有する回路基板。 (もっと読む)


【課題】熱を効率よく放散することが可能なバリスタ及び発光装置を提供すること。
【解決手段】バリスタ素体12における第1の主面12aの中央領域に相当する部分には、バリスタ素体12を貫通する貫通孔19が形成されている。バッファ部21は、第1の主面21aと第2の主面21bとを有しており、第1の主面21aがバリスタ素体12の第2の主面12bと接するように配置されている。バッファ部21における第1の主面21aの中央領域に相当する部分には、バリスタ素体12に形成された貫通孔19に連続して、バッファ部21を貫通する貫通孔23が形成されている。基体部31は、第1の主面31aと第2の主面31bとを有している。基体部31は、バリスタ素体12よりも熱伝導率及び光反射率が高い材料からなり、第1の主面31aがバッファ部21の第2の主面21bと接するように配置されている。 (もっと読む)


PTC特性を有するセラミック体抵抗素子(1)が提案される。セラミック体(1)の少なくとも1主面には窪み(21,22)が配置されている。
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