回路情報生成装置、機能実行システム、及びプログラム
【課題】要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮する。
【解決手段】機能を構成する基本機能に対応するソースプログラムを記憶したソースプログラム記憶領域３６と、回路情報を基本機能に対応させて記憶するための回路情報記憶領域３５とを備え、要求された機能を構成する該機能中の基本機能に対応する回路情報が回路情報記憶領域３５に記憶されている場合には、該記憶されている回路情報を用い、上記機能中の基本機能に対応する回路情報が回路情報記憶領域３５に記憶されていない場合には、ソースプログラム記憶領域３６に記憶されているソースプログラムを用いて上記機能中の基本機能に対応する回路情報を生成して回路情報記憶領域３５に記憶し、該生成した回路情報を用いて、要求された機能を実行する回路が再構成され、該回路により該機能が実行されるように制御する。
【解決手段】機能を構成する基本機能に対応するソースプログラムを記憶したソースプログラム記憶領域３６と、回路情報を基本機能に対応させて記憶するための回路情報記憶領域３５とを備え、要求された機能を構成する該機能中の基本機能に対応する回路情報が回路情報記憶領域３５に記憶されている場合には、該記憶されている回路情報を用い、上記機能中の基本機能に対応する回路情報が回路情報記憶領域３５に記憶されていない場合には、ソースプログラム記憶領域３６に記憶されているソースプログラムを用いて上記機能中の基本機能に対応する回路情報を生成して回路情報記憶領域３５に記憶し、該生成した回路情報を用いて、要求された機能を実行する回路が再構成され、該回路により該機能が実行されるように制御する。
【発明の詳細な説明】
【技術分野】
【０００１】
この発明は、回路情報生成装置、機能実行システム、及びプログラムに関するものである。
【背景技術】
【０００２】
特許文献１には、外部サーバーから画像処理用プログラムをダウンロードする受信手段と、前記プログラムを当該画像処理装置において実行する画像処理手段と、外部サーバーに画像データの処理を依頼する送信手段と、所定条件により、画像処理手段と外部サーバーのいずれで画像データの処理を行うかを切り換える切換手段とを備える画像処理装置が記載されている。
【０００３】
特許文献２には、ネットワーク上のマルチファンクションペリフェラルで使用する各種のプログラムをネットワーク上のファイルサーバに予め格納しておき、マルチファンクションペリフェラルは、ファイルサーバに格納されたプログラムをダウンロードして各種の機能に係る処理を実行するプログラム管理システムが記載されている。
【先行技術文献】
【特許文献】
【０００４】
【特許文献１】特開２００３−０３６４３５号公報
【特許文献２】特開２００１−２４３０７５号公報
【発明の概要】
【発明が解決しようとする課題】
【０００５】
本発明は、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮することができる回路情報生成装置、機能実行システム、及びプログラムを提供することを目的とする。
【課題を解決するための手段】
【０００６】
請求項１の発明の回路情報生成装置は、１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域と、要求された機能を構成する該機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能を実行する回路が再構成され、該再構成された回路により前記要求された機能が実行されるように制御する制御手段と、を有する。
【０００７】
請求項２の発明の回路情報生成装置は、１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域と、要求された機能を構成する該機能中の基本機能が、該要求された機能の実行に関する予め定められた条件に応じて、前記ソースプログラムを実行形式に変換したプログラムを用いて実行される特定の基本機能として定められた場合には、前記第１の記憶領域に記憶されているソースプログラムを実行形式に変換したプログラムを用いて該特定の基本機能が実行されるように制御する第１の制御と、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能中の基本機能を実行する回路が再構成され、該再構成された回路により前記特定の基本機能を除く基本機能が実行されるように制御する第２の制御とにより、前記要求された機能が実行されるように制御する制御手段と、を有する。
【０００８】
請求項３の発明の機能実行システムは、請求項１に記載の回路情報生成装置と、回路情報を用いて再構成され、前記要求された機能を実行する回路を備えた機能実行装置と、を備えている。
【０００９】
請求項４の発明の機能実行システムは、請求項２に記載の回路情報生成装置と、回路情報を用いて再構成され、前記要求された機能を実行する回路、及び前記ソースプログラムを実行形式に変換したプログラムを実行するコンピュータを有する前記機能実行装置と、を備えている。
【００１０】
請求項５の発明は、請求項３または請求項４に記載の機能実行システムにおいて、前記ソースプログラムを実行形式に変換したプログラムを実行するコンピュータを有する第２の機能実行装置を更に備え、前記回路情報生成装置に、前記第２の機能実行装置の負荷の状態を示す情報を取得し、該取得した負荷の状態を示す情報が予め定められた条件を満たす場合には、前記要求された機能が前記機能実行装置で実行されないよう前記制御手段の制御に代えて、前記第１の記憶領域に記憶されているソースプログラムを実行形式に変換したプログラムを用いて前記要求された機能が前記第２の機能実行装置で実行されるように制御する第２の制御手段を更に設けたものである。
【００１１】
請求項６の発明のプログラムは、１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域とに接続されたコンピュータを、要求された機能を構成する該機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能を実行する回路が再構成され、該再構成された回路により前記要求された機能が実行されるように制御する制御手段として機能させるためのプログラムである。
【００１２】
請求項７の発明のプログラムは、１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域とに接続されたコンピュータを、要求された機能を構成する該機能中の基本機能が、該要求された機能の実行に関する予め定められた条件に応じて、前記ソースプログラムを実行形式に変換したプログラムを用いて実行される特定の基本機能として定められた場合には、前記第１の記憶領域に記憶されているソースプログラムを実行形式に変換したプログラムを用いて該特定の基本機能が実行されるように制御する第１の制御と、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能中の基本機能を実行する回路が再構成され、該再構成された回路により前記特定の基本機能を除く基本機能が実行されるように制御する第２の制御とにより、前記要求された機能が実行されるように制御する制御手段として機能させるためのプログラムである。
【発明の効果】
【００１３】
請求項１の発明によれば、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮することができる。
【００１４】
請求項２の発明は、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮することができると共に、複数の機能を多重化して実行できる。
【００１５】
請求項３の発明は、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮でき、機能実行装置での機能の実行の開始を早めることができる。
【００１６】
請求項４の発明は、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮することができ、機能実行装置での機能の実行の開始を早めることができると共に、機能実行装置で複数の機能を多重化して実行できる。
【００１７】
請求項５の発明は、第２の機能実行装置の負荷を示す情報が予め定められた条件を満たす場合には、要求された機能を回路情報を生成せずに実行することができる。
【００１８】
請求項６の発明は、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮することができる。
【００１９】
請求項７の発明は、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮することができると共に、複数の機能を多重化して実行できる。
【図面の簡単な説明】
【００２０】
【図１】第１〜第３の実施の形態に係る機能実行システムの概略構成図である。
【図２】第１〜第３の実施の形態に係る回路情報生成装置の概略構成図である。
【図３】第１〜第３の実施の形態に係る情報処理装置の概略構成図である。
【図４】第１〜第３の実施の形態に係る主制御部の概略構成図である。
【図５】機能と基本機能との関係を説明する説明図である。
【図６Ａ】機能管理データ及び基本機能管理データの一例を示す図である。
【図６Ｂ】機能管理データ及び基本機能管理データの他の例を示す図である。
【図７】第１及び第２の実施の形態に係る情報処理装置の機能実行部のＣＰＵにより実行される機能実行処理の流れを示すフローチャートである。
【図８】第１の実施の形態に係る回路情報生成装置のＣＰＵにより実行される生成制御処理の流れを示すフローチャートである。
【図９】第２の実施の形態における基本機能管理データの一例を示す図である。
【図１０】第２の実施の形態に係る回路情報生成装置のＣＰＵにより実行される生成制御処理の流れを示すフローチャートである。
【図１１】図１０のステップ３０２で行われる回路情報生成ルーチンの流れを示すフローチャートである。
【図１２】機能Ｃと機能Ｄの各々を構成する各基本機能と、各基本機能毎のＳＷ実行時間及びＨＷ実行時間の一例を示した図である。
【図１３】機能Ｃ及び機能Ｄの各々の基本機能をハードウェア処理で行うパターン１と、機能Ｃの基本機能１をソフトウェア処理で行い、基本機能２をハードウェア処理で行い、機能Ｄの基本機能３をハードウェア処理で行うパターン２の各々のパターンにおけるハードウェア及びソフトウェア使用率の一例を示す図である。
【図１４】第２の実施の形態に係る回路情報生成装置のＣＰＵにより実行される生成制御処理の他の例を示すフローチャートである。
【図１５】図１４のステップ３１９で行われる回路情報生成ルーチンの流れを示すフローチャートである。
【図１６】機能Ｅを構成する各基本機能がソフトウェア処理される場合の各基本機能の負荷の割合の一例を示す図である。
【図１７】機能を構成する基本機能のうち、負荷の割合が最も高い基本機能を特定するための情報（負荷情報）を含む機能管理データと基本機能管理データの一例を示す図である。
【図１８】第３の実施の形態に係る情報処理装置の画像処理部のＣＰＵにより実行される機能実行処理の流れを示すフローチャートである。
【図１９】第３の実施の形態に係る回路情報生成装置のＣＰＵにより実行される生成制御処理の流れを示すフローチャートである。
【発明を実施するための形態】
【００２１】
［第１の実施の形態］
【００２２】
図１は、本実施の形態に係る機能実行システム１０の概略構成図である。機能実行システム１０は、回路情報生成装置１２及び情報処理装置１４を備えている。回路情報生成装置１２及び情報処理装置１４は、ネットワーク１６を介して相互に通信する。
【００２３】
図２は、回路情報生成装置１２の概略構成図である。回路情報生成装置１２は、ＣＰＵ（Central Processing Unit）２０、ＲＯＭ（Read Only Memory）２１、ＲＡＭ（Random Access Memory）２２、ＤＭＡ（Direct Memory Access）制御回路２３（以下、ＤＭＡＣ２３と呼称）、通信インタフェース（Ｉ／Ｆ）２４、第１記憶部２６、及び第２記憶部２７を含んで構成されており、それぞれバス２８を介して接続されている。
【００２４】
ＣＰＵ２０は、ＲＯＭ２１等に記憶されたプログラムを実行する。ＲＯＭ２１には、ＣＰＵ２０が実行するプログラムやプログラムの実行に必要な各種データ等が予め記憶されている。本実施の形態では、ＲＯＭ２１の生成制御プログラム記憶領域３０に、後述する回路５７を再構成するための回路情報の生成制御を行うための生成制御プログラムが記憶され、回路情報生成プログラム記憶領域３１に、回路情報を生成するための回路情報生成プログラムが記憶されている。
【００２５】
ＲＡＭ２２は、通信Ｉ／Ｆ２４を介して他の装置から受信したデータや新たに生成したデータ等を一時記憶するためのメモリとして利用される他、ＣＰＵ２０のプログラム実行時のワークメモリとしても利用される。
【００２６】
なお、ＣＰＵ２０が実行するプログラムが記憶される記憶媒体は、上記ＲＯＭ２１等に限定されず、例えば、図示は省略するが、ＣＤ−ＲＯＭ、ＤＶＤディスク、光磁気ディスク、ＩＣカードなどの可搬型記録媒体や回路情報生成装置１２の内部あるいは外部に備えられたＨＤＤ等の記憶装置等であってもよく、さらにまたネットワーク１６を介して接続されたデータベース、或いは他のコンピュータシステム並びにそのデータベースや、更に電気通信回線上の搬送波のような伝送媒体であってもよい。
【００２７】
ＤＭＡＣ２３は、ＣＰＵ２０を介さずにデータを転送（ＤＭＡ転送）する。具体的には、後述する第２記憶部２７のＤＭＡ転送リスト記憶領域３７に記憶されたＤＭＡ転送リストに基づいて、第１記憶部２６の回路情報記憶領域３５から回路情報を読み出して、通信Ｉ／Ｆ２４を介して情報処理装置１４に転送する。ＤＭＡ転送リストは、ＤＭＡ転送するときに用いられる転送情報が、転送順に登録されるリストである。転送情報には、ＤＭＡ転送する転送データの転送元アドレス、転送先アドレス（ここでは情報処理装置１４のアドレス）、及び転送サイズが含まれる。
【００２８】
第１記憶部２６は、機能管理データを記憶する機能管理データ記憶領域３３、基本機能管理データを記憶する基本機能管理データ記憶領域３４、及び生成した回路情報を記憶するための回路情報記憶領域３５、ＣＰＵを用いて基本機能を実行するためのプログラムのソースコード（ソースプログラムともいう）を記憶するソースプログラム記憶領域３６を有する。
【００２９】
機能管理データは、後述する情報処理装置１４の機能実行部４４で実行可能な機能を管理するためのデータである。ここで、本実施の形態における「機能」及び「基本機能」について説明する。機能実行部４４で実行される各種機能は１または複数の基本機能により構成される。一例を挙げると、複数ページを１枚の用紙にまとめて記録する場合の画像データの生成のために機能実行部４４で実行される機能は、画像縮小処理、画像回転処理、及びハーフトーン処理等々の基本機能から構成される。
【００３０】
ここで、機能及び基本機能について更に詳しく説明する。図５は、互いに異なる機能Ａと機能Ｂの構成を模式的に示す図である。機能Ａは、基本機能１、基本機能２、基本機能３、基本機能４の４つの基本機能を順に実行することにより実現される機能である。機能Ｂは、基本機能１、基本機能２、基本機能３、基本機能５の４つの基本機能を順に実行することにより実現される機能である。このように、互いに異なる機能には互いに共通する基本機能が含まれる場合もある。本実施の形態では、機能管理データにより、各機能に含まれる基本機能を特定し、該各基本機能の実行順序を規定する。
【００３１】
図６Ａの上段に機能管理データの一例を示す。この例では、機能管理データの各々は、各機能を識別するための識別情報８０と、機能を構成する基本機能の数を示す基本機能数８１と、機能を構成する各基本機能毎の基本機能管理データの記憶領域を示すアドレス８２（以下、管理データアドレス８２と呼称）とにより構成される。なお、管理データアドレス８２は、基本機能の実行順に配列されている。
【００３２】
基本機能管理データは、各機能を構成する基本機能の各々を管理するためのデータである。基本機能管理データの各々は、上記機能管理データの管理データアドレス８２が示す記憶領域の各々に記憶されている。図６Ａの中段に基本機能管理データの一例を示す。この例では、基本機能管理データの各々は、基本機能を識別する識別情報８３と、基本機能に対応する回路情報の記憶領域を示すアドレス８４（以下、回路情報アドレス８４と呼称）と、基本機能に対応するソースプログラムの記憶領域を示すアドレス８６（以下、プログラムアドレス８６と呼称）とにより構成される。
【００３３】
回路情報は必要に応じて、基本機能毎に、対応するソースプログラムに基づいて動的に生成されるが、生成前の段階では、回路情報アドレス８４には、ＮＵＬＬ値が設定されている。回路情報が生成され、図６Ａの下段に示すように、回路情報記憶領域３５に記憶されると、該記憶された領域を示すアドレスが、回路情報アドレス８４に設定される。
【００３４】
ソースプログラムは、回路情報と異なり、予めソースプログラム記憶領域３６に記憶されている。したがって、プログラムアドレス８６には、ソースプログラムが記憶されている記憶領域を示すアドレス値が予め設定されている。
【００３５】
なお、回路情報及びソースプログラムの管理方法は、上記に限定されず、例えば、図６Ｂに示すように、回路情報及びソースプログラムの各々に対して独立に、機能管理データ及び基本機能管理データを記憶して管理するようにしてもよい。
ただし、本実施の形態では、図６Ａに示すデータ管理を行うものとして説明する。
【００３６】
第２記憶部２７は、ＤＭＡ転送リスト記憶領域３７を備え、ＤＭＡ転送リスト記憶領域３７には、ＤＭＡＣ２３がＤＭＡ転送する際に参照するＤＭＡ転送リストが記憶される。
【００３７】
第１記憶部２６及び第２記憶部２７は、例えばハードディスクドライブ（ＨＤＤ）により構成されていてもよいし、ＥＥＰＲＯＭ（Electrically Erasable and Programmable Read Only Memory）等の書き換え可能なメモリ素子で構成されていてもよい。なお、ＣＰＵ２０が実行するプログラムが、第１記憶部２６や第２記憶部２７に記憶されていてもよい。また、第１記憶部２６及び第２記憶部２７は外付けの記憶装置であってもよい。
【００３８】
さらにまた、本実施の形態では、機能管理データ記憶領域３３、基本機能管理データ記憶領域３４、回路情報記憶領域３５、及びソースプログラム記憶領域３６を第１記憶部２６に、ＤＭＡ転送リスト記憶領域３７を第２記憶部２７に設けた例について説明したが、各記憶領域の場所はこれに限定されるものではない。例えば、ＤＭＡ転送リスト記憶領域３７を第１記憶部２６に設けても良いし、機能管理データ記憶領域３３、基本機能管理データ記憶領域３４、回路情報記憶領域３５、及びソースプログラム記憶領域３６を第２記憶部２７に設けても良い。また、機能管理データ記憶領域３３、基本機能管理データ記憶領域３４、回路情報記憶領域３５、及びソースプログラム記憶領域３６の各々を互いに異なる記憶媒体に設けてもよい。
【００３９】
通信Ｉ／Ｆ２４は、ネットワーク１６に接続されている。回路情報生成装置１２は、通信Ｉ／Ｆ２４を介して、ネットワーク１６に接続された情報処理装置１４と相互に情報をやりとりする。
【００４０】
図３は、情報処理装置１４の概略構成図である。本実施の形態では、情報処理装置１４として画像処理及び画像形成を行う装置を例に挙げて説明するが、これに限定されるものではない。
【００４１】
情報処理装置１４は、情報処理装置１４全体を制御する主制御部４０、与えられた画像データに基づいて画像を形成する画像形成部４２、各種機能を実行することにより画像データに対して画像処理を施す機能実行部４４、及び記憶部４６を含んで構成されており、それぞれバス４８を介して接続されている。
【００４２】
機能実行部４４は、再構成制御回路５０、ＤＭＡ制御回路５１（以下、ＤＭＡＣ５１）、ＣＰＵ（Central Processing Unit）５２、ＲＯＭ（Read Only Memory）５３、ＲＡＭ（Random Access Memory）５４、通信Ｉ／Ｆ５５、Ｉ／Ｆ５６、及び回路５７を備え、それぞれバス５８を介して接続されている。機能実行部４４は、Ｉ／Ｆ５６を介して記憶部４６と接続されている。また、Ｉ／Ｆ５６は、バス４８とも接続されている。
【００４３】
回路５７は、回路情報により再構成される回路である。回路５７は、回路情報を記憶するための回路情報メモリ６０Ａ及び回路情報メモリ６０Ｂと、複数の論理セル、配線領域、及び入出力端子を含んで構成された回路素子群６１とを備えている。
【００４４】
回路情報メモリ６０Ａ及び回路情報メモリ６０Ｂは、ＥＥＰＲＯＭ（Electrically Erasable and Programmable Read Only Memory）、ＳＲＡＭ（Static Random Access Memory）等の書き換え可能なメモリ素子で構成されている。回路素子群６１には、上記回路情報メモリ６０Ａ、６０Ｂの何れか一方が接続されるようになっている。回路情報には、各論理セルの接続関係の情報や入出力設定の情報等が含まれ、回路素子群６１に接続されている回路情報メモリ６０Ａまたは回路情報メモリ６０Ｂに展開された回路情報に基づいて、回路素子群６１の論理セル内の回路構成や、論理セルと入出力端子とを相互に接続する配線領域の接続状態等が再構成される。
【００４５】
再構成制御回路５０は、回路情報を用いて回路５７を再構成する。具体的には、Ｉ／Ｆ５６を介して回路情報を記憶部４６から読出して、回路情報メモリ６０Ａ、６０Ｂに展開することにより再構成する。このとき、回路素子群６１に接続する回路情報メモリ６０Ａ、６０Ｂを適時切り替えるバンク切り替えを実行することにより、回路素子群６１上に順次必要な機能を実行する回路構成を実現させる（再構成処理）。
【００４６】
ＤＭＡＣ５１は、ＣＰＵ５２を介さずに、回路情報生成装置１２のＤＭＡＣ２３との間でＤＭＡ転送を行う。具体的には、ＤＭＡＣ５１は、通信Ｉ／Ｆ５５を介して回路情報生成装置１２から受信した回路情報を順次記憶部４６に転送して記憶する。
【００４７】
ＣＰＵ５２は、ＲＯＭ５３に記憶されたプログラムを実行し、様々な処理（例えば、後述する機能実行処理）を行う。ＲＡＭ５４は、ワーキングメモリ等として用いられる。
【００４８】
なお、本実施の形態において、ＣＰＵ５２が実行するプログラムが記憶される記憶媒体は、上記ＲＯＭ５３等に限定されず、例えば記憶部４６であってもよい。
【００４９】
通信Ｉ／Ｆ５５は、ネットワーク１６を介して外部の装置と通信するためのインタフェースである。
【００５０】
機能実行部４４は、Ｉ／Ｆ５６を介して記憶部４６に接続されている。記憶部４６には、回路情報生成装置１２から受信した情報（本実施の形態では、回路情報）を記憶するための受信情報記憶領域６２と、機能実行部４４による画像処理の対象とされた画像データを一時的にバッファリングする画像データ記憶領域６３と、を備えている。なお、本実施の形態では、受信情報記憶領域６２には、回路情報生成装置１２から受信した各基本機能に対応する回路情報の各々が機能毎に記憶され管理される。したがって、複数の機能が互いに共通する基本機能を有する場合でも、該共通する基本機能に対応する回路情報を該複数の機能毎に別々に記憶するようにしている。
【００５１】
なお、記憶部４６は、ＥＥＰＲＯＭやＳＤＲＡＭ等の書換え可能なメモリ素子であってもよいし、ＨＤＤ等であってもよく、特に限定されない。
【００５２】
画像形成部４２は、電子写真方式の画像形成部であってもよいし、インクジェット方式の画像形成部であってもよく、その構成は特に限定されない。
【００５３】
次に、図４を参照しながら、主制御部４０の構成について説明する。
【００５４】
図４は、主制御部４０の概略構成図である。主制御部４０は、ＣＰＵ（Central Processing Unit）７０、ＲＯＭ（Read Only Memory）７１、ＲＡＭ（Random Access Memory）７２、入出力インタフェース（Ｉ／Ｆ）７３、通信Ｉ／Ｆ７５、及びＩ／Ｆ７６を備え、それぞれバス７７を介して接続されている。Ｉ／Ｆ７６は、バス４８とも接続されている。
【００５５】
ＣＰＵ７０は、ＲＯＭ７１に記憶されたプログラムを実行する。ＲＯＭ７１には、ＣＰＵ７０が実行するプログラムやプログラムの実行に必要な各種データ等が予め記憶されている。本実施の形態では、ＲＯＭ７１に、ＣＰＵ７０が実行する装置管理プログラムが記憶されており、ＣＰＵ７０の該装置管理プログラムの実行により、主制御部４０は、情報処理装置１４全体を管理し、制御する。
【００５６】
ＲＡＭ７２は、通信Ｉ／Ｆ７５を介して他の装置から受信した画像データ等の各種データや新たに生成した画像データ等々、様々なデータを一時記憶するためのフレームメモリとして利用される他、ＣＰＵ７０のプログラム実行時のワークメモリとしても利用される。
【００５７】
なお、ＣＰＵ７０が実行するプログラムが記憶される記憶媒体は、上記ＲＯＭ７１に限定されず、例えば、図示は省略するが、ＣＤ−ＲＯＭ、ＤＶＤディスク、光磁気ディスク、ＩＣカードなどの可搬型記録媒体や情報処理装置１４の内部または外部に備えられたＨＤＤ等の記憶装置等であってもよく、さらにまたネットワーク１６を介して接続されたデータベース、或いは他のコンピュータシステム並びにそのデータベースや、更に電気通信回線上の搬送波のような伝送媒体であってもよい。
【００５８】
入出力Ｉ／Ｆ７３は、液晶表示板からなる表示パネル上にタッチパネルが重ねられたユーザインタフェースとしてのタッチパネルディスプレイ７４に接続されている。タッチパネルディスプレイ７４は、ＣＰＵ７０の制御信号に応じて画像や各種メッセージ等の情報を表示する表示部としての機能と、該表示された画像上の任意の位置を利用者が指定することにより各種機能の実行要求や設定情報等を指示入力する指示部としての機能を兼ね備えている。なお、タッチパネルディスプレイに代えて、例えば、液晶ディスプレイ等の表示部と、操作者により操作される操作ボタン等の指示部とを個別に装備してもよい。
【００５９】
通信Ｉ／Ｆ７５は、ネットワーク１６を介して外部の装置と通信するためのインタフェースである。主制御部４０は、ネットワーク１６を介して各種機能の実行要求を受信する場合もある。
【００６０】
なお、本実施の形態では、主制御部４０は、前述したように、タッチパネルディスプレイ７４或いは通信Ｉ／Ｆ７５を介して機能の実行要求を受け付けるが、該受け付けた実行要求うち、機能実行部４４で行われる機能の実行要求については、機能実行部４４に転送する。
【００６１】
次に、本実施の形態の作用を説明する。
【００６２】
図７は、情報処理装置１４の機能実行部４４のＣＰＵ５２により実行される機能実行処理の流れを示すフローチャートである。また、図８は、回路情報生成装置１２のＣＰＵ２０により実行される生成制御処理の流れを示すフローチャートである。
【００６３】
まず、情報処理装置１４における機能実行処理について説明する。図７のステップ１００では、主制御部４０から機能Ｘ（Ｘは機能を識別する識別情報）の実行要求を受け付けるまで待機する。ステップ１００で、主制御部４０から機能Ｘの実行要求を受け付けた場合には、ステップ１０２に移行する。
【００６４】
ステップ１０２では、機能Ｘが以前に実行した機能と同じか否かを判断する。具体的には、記憶部４６の受信情報記憶領域６２に機能Ｘの回路情報が記憶されているか否かを確認し、記憶されていれば、機能Ｘは以前に実行した機能と同じであると判断し、記憶されていなければ、機能Ｘは以前実行した機能と異なると判断する。ここで、機能Ｘが以前に実行した機能でないと判断した場合には、ステップ１０４で、通信Ｉ／Ｆ５５を介して機能Ｘの回路情報を回路情報生成装置１２に要求する。
【００６５】
ステップ１０６では、回路情報生成装置１２からの転送準備完了通知の受信待ちを行う。転送準備完了通知を受信した場合には、ステップ１０８で、ＤＭＡＣ５１を起動する。起動したＤＭＡＣ５１は、通信Ｉ／Ｆ５５を介して回路情報生成装置１２から受信した回路情報を記憶部４６の受信情報記憶領域６２に転送して記憶する。
【００６６】
ステップ１１０では、機能Ｘを実行する。具体的には、機能Ｘの回路情報の記憶領域を指定して再構成制御回路５０を起動する。起動した再構成制御回路５０は、機能Ｘを構成する各基本機能を実行するための回路情報をその実行順に記憶部４６の受信情報記憶領域６２から読み出して、回路情報メモリ６０Ａ及び回路情報メモリ６０Ｂに交互に展開し、且つ前述したようにバンク切り替えを行って、予め定められた実行順に回路素子群６１上に実現する基本機能を切替えていく。これにより、例えば実行が要求された機能Ｘが図５に示す機能Ａの場合には、基本機能１、基本機能２、基本機能３、基本機能４の順に回路５７が再構成されて、各基本機能が実行される。
【００６７】
ステップ１１２では、主制御部４０に対して機能Ｘの実行が終了した旨の終了通知を送信する。
【００６８】
一方、ステップ１０２で、機能Ｘが以前に実行した機能であると判断した場合には、既に機能Ｘを実現するための回路情報は記憶部４６の受信情報記憶領域６２に記憶されているため、該記憶されている回路情報を用いて再度回路５７を再構成すればよい。従って、ステップ１１０に移行し、上記と同様に回路５７を再構成して機能Ｘを実行する。
【００６９】
次に、回路情報生成装置１２における生成制御処理について説明する。図８のステップ２００では、情報処理装置１４からの機能Ｘの回路情報要求の受信待ちを行う。ステップ２００で、情報処理装置１４から機能Ｘの回路情報要求を受信した場合には、ステップ２０２で、変数ｎに１をセットする。
【００７０】
ステップ２０４では、要求のあった機能Ｘの機能管理データを第１記憶部２６から読み出して取得し、ｎが、該機能管理データに格納されている基本機能数より大きいか否かを判断する。ｎが基本機能数以下の場合には、ステップ２０６で、機能Ｘの機能管理データの、第ｎ番目に実行される基本機能に対応する管理データアドレス８２が示す記憶領域に格納された基本機能管理データを読み出して取得し、該基本機能管理データの回路情報アドレス８４にＮＵＬＬが設定されているか否かを判断する。回路情報アドレス８４にＮＵＬＬが設定されていれば、該基本機能の回路情報は未生成であるため、ステップ２０８に移行する。
【００７１】
ステップ２０８では、回路情報生成プログラムを起動して実行し、回路情報を生成する。具体的には、上記読み出して取得した基本機能管理データの、プログラムアドレス８６が示す記憶領域から、該ｎ番目の基本機能に対応するソースプログラムを読出し、該読み出したソースプログラムに基づいて、該ｎ番目の基本機能を回路５７上に実現するための回路情報を生成して回路情報記憶領域３５の空き領域に格納する。
【００７２】
ステップ２１０では、上記基本機能の回路情報が記憶された記憶領域を示すアドレス値を、該基本機能に対応する基本機能管理データの回路情報アドレス８４として登録する。これによりＮＵＬＬが回路情報を記憶した記憶領域のアドレス値に変更される。
【００７３】
ステップ２１０の後は、ステップ２１２に移行し、上記第ｎ番目に実行される基本機能の回路情報が情報処理装置１４に転送されるよう、第ｎ番目の転送情報をＤＭＡ転送リストに登録する。具体的には、回路情報アドレス８４の値（転送元アドレス）、回路情報のデータサイズ（転送サイズ）、情報処理装置１４のアドレス（転送先アドレス）をＤＭＡ転送リストに登録する。
【００７４】
ステップ２１４では、ｎに１を加算し、ステップ２０４に戻る。
【００７５】
一方、ステップ２０６で、機能Ｘの機能管理データの、第ｎ番目に実行される基本機能に対応する管理データアドレス８２が示す記憶領域に格納された基本機能管理データの回路情報アドレス８４にＮＵＬＬが設定されていないと判断した場合には、既に回路情報は生成済であるため、ステップ２０８、ステップ２１０をスキップし、ステップ２１２に移行する。ステップ２１２では、第ｎ番目の転送情報として、該回路情報アドレス８４の値（転送元アドレス）、回路情報のデータサイズ（転送サイズ）、情報処理装置１４のアドレス（転送先アドレス）をＤＭＡ転送リストに登録し、ステップ２１４でｎに１を加算してステップ２０４に戻る。
【００７６】
ステップ２０４で、ｎが、機能Ｘの機能管理データに格納されている基本機能数より大きいと判断した場合には、ステップ２１６に移行する。
【００７７】
ステップ２１６では、転送準備完了通知を情報処理装置１４に送信する。ステップ２１８では、ＤＭＡ転送リストにしたがってＤＭＡ転送されるようＤＭＡＣ２３を起動する。起動したＤＭＡＣ２３は、ＤＭＡ転送リストにしたがって、情報処理装置１４に機能Ｘの回路情報を転送する。
【００７８】
ここで、具体例を挙げて説明する。情報処理装置１４において図５に示す機能Ａの後に機能Ｂの実行要求があった場合には、機能Ｂを構成する基本機能のうち機能Ａと共通する基本機能１〜３は既に生成済である。従って、この場合には、第１〜３番目の基本機能については、対応する回路情報アドレス８４にはＮＵＬＬではないアドレス値が既に設定されているため、ステップ２０６で肯定判断され、回路情報の生成は行われない。従って、機能Ｂについては、第４番目に実行される基本機能５の回路情報を生成するだけでよい。
【００７９】
なお、本実施の形態では、要求された機能が以前実行した機能か否かを機能実行部４４が判断し、以前実行していなければ、該機能を構成する全ての基本機能の回路情報を要求し、回路情報生成装置１２は、該機能を構成する全ての基本機能の回路情報を情報処理装置１４に送信する例について説明したが、これに限定されない。
【００８０】
例えば、回路情報生成装置１２は、回路情報の送信履歴を保存しておき、該送信履歴に基づいて、該機能を構成する全ての基本機能の回路情報を情報処理装置１４に送信するのではなく、送信済みの回路情報を除く回路情報を情報処理装置１４に送信し、以前送信したことがある回路情報は送信しないようにしてもよい。また、例えば、機能実行部４４が、要求された機能を構成する基本機能の各々について以前実行した基本機能か否か（回路情報が既に記憶部４６に記憶されているか否か）を判断し、回路情報生成装置１２に対して機能単位ではなく基本機能単位で回路情報を要求するように構成し、回路情報生成装置１２は、要求のあった基本機能の回路情報のみを生成して情報処理装置１４に送信するようにしてもよい。
【００８１】
このように、回路情報生成装置１２から情報処理装置１４に対して、機能単位ではなく基本機能単位で回路情報を送信する場合には、情報処理装置１４の記憶部４６には基本機能毎に回路情報が記憶されて管理され、同一の回路情報が重複して記憶されることはない。また、この場合には、機能実行部４４で、各機能を構成する基本機能及び実行順序を示す情報を保持する必要がある。なお、この情報を回路情報生成装置１２から情報処理装置１４に対して送信するようにしてもよい。機能実行部４４は、自ら保持している或いは回路情報生成装置１２から受信した、各機能を構成する基本機能及び実行順序を示す情報に基づいて順に回路を再構成して要求された機能を実行する。
【００８２】
また、本実施の形態では、回路情報生成装置１２のＤＭＡＣ２３及び情報処理装置１４のＤＭＡＣ５１により回路情報をＤＭＡ転送する例について説明したが、回路情報生成装置１２のＣＰＵ２０及び情報処理装置１４のＣＰＵ５２を介して回路情報の送受信を行うようにしてもよい。
【００８３】
また、本実施の形態では、回路情報を回路情報生成装置１２が必要に応じて生成して情報処理装置１４に送信する例について説明したが、回路情報生成装置１２での生成制御処理を主制御部４０が行うようにしてもよい。すなわち、主制御部４０が、上記第１記憶部２６に記憶されている各種データを有し、回路情報生成プログラム、生成制御処理プログラムを実行して、要求のあった機能の回路情報を必要に応じて生成して機能実行部４４に供給してもよい。
【００８４】
［第２の実施の形態］
【００８５】
本実施の形態では、要求された機能を構成する各基本機能から回路５７に代えてソースプログラムを実行形式に変換したプログラムを用いて実行する特定の基本機能を決定し、該特定の基本機能については、回路情報に代えてソースプログラムを情報処理装置１４に送信する例について説明する。
【００８６】
本実施の形態に係る回路情報生成装置１２の概略構成は、第１の実施の形態と同じである。ただし、図９に示すように、第１記憶部２６の基本機能管理データ記憶領域３４に記憶される基本機能管理データの構成が異なる。
【００８７】
本実施の形態に係る基本機能管理データは、基本機能を識別する識別情報８３、回路情報アドレス８４、及びプログラムアドレス８６に加え、基本機能を回路５７を用いて実行する場合に要する実行時間８５（以下、ＨＷ実行時間８５と呼称）、及び基本機能をソースプログラムを実行形式に変換したプログラムを用いて実行する場合に要する実行時間８７（以下、ＳＷ実行時間８７と呼称）を含んで構成される。
【００８８】
本実施の形態に係る情報処理装置１４の概略構成も、第１の実施の形態と同じである。ただし、記憶部４６の受信情報記憶領域６２には、回路情報だけでなく場合に応じてソースプログラムも受信され記憶される。機能実行部４４のＣＰＵ５２は、回路情報生成装置１２から受信したソースプログラムを実行形式のプログラムに変換し、該変換したプログラムを実行することにより基本機能を実行する。なお、ソースプログラムを実行形式のプログラムに変換するためのプログラムは予めＲＯＭ５３等に記憶されている。
【００８９】
なお、本実施の形態でも、受信情報記憶領域６２には、回路情報生成装置１２から受信した回路情報及びソースプログラムが機能毎に記憶され管理される。したがって、複数の機能が互いに共通する基本機能を有する場合でも、該共通する基本機能に対応する回路情報またはソースプログラムを該複数の機能毎に別々に記憶するようにしている。
【００９０】
図１０は、本実施の形態に係る回路情報生成装置１２のＣＰＵ２０により実行される生成制御処理の流れを示すフローチャートである。なお、ここでは、いずれの基本機能もＨＷ実行時間８５がＳＷ実行時間８７以下であるものとする。
【００９１】
ステップ３００では、情報処理装置１４から機能Ｘの回路情報の要求の受信待ちを行う。ステップ３００で、回路情報生成装置１２から機能Ｘの回路情報の要求を受信した場合には、ステップ３０２で、回路情報生成ルーチンを実行し、各基本機能の回路情報を必要に応じて生成する。
【００９２】
図１１は、ステップ３０２で行われる回路情報生成ルーチンの流れを示すフローチャートである。なお、図１１において、図８と同じステップには同一の符号を付し、ここでは異なるステップのみ説明する。
【００９３】
ステップ２０４ａでは、要求のあった機能Ｘの機能管理データを第１記憶部２６から読み出して取得し、ｎが、該機能管理データに格納されている基本機能数より大きいか否かを判断し、ｎが基本機能数以下の場合には、ステップ２０６に移行し、ｎが基本機能数を超えた場合には、本処理ルーチンを終了する。すなわち、図１１の回路情報生成ルーチンでは、図８に示すステップ２１６、２１８の処理は行われない。
【００９４】
ステップ３０２の回路情報生成ルーチン終了後は、ステップ３０４に移行する。
【００９５】
ステップ３０４では、機能Ｘの機能管理データの各基本機能の基本機能管理データを読み出して取得し、該基本機能管理データに基づいて、機能Ｘの各基本機能毎のＨＷ実行時間を合計した値を求めて変数Ｓにセットする。
【００９６】
ステップ３０６では、Ｓが予め定められた性能目標値未満であるか否かを判断する。ここでいう性能目標値とは、機能Ｘの実行時間の目標値である。性能目標値は、機能毎に予め設定しておくようにしてもよいし、主制御部４０のタッチパネルディスプレイ７４から使用者が指定するように構成し、該指定された性能目標値を、機能Ｘの回路情報の要求の際、情報処理装置１４から回路情報生成装置１２に送信するようにしてもよい。ここで、Ｓが性能目標値未満であると判断した場合には、ステップ３０８に移行する。
【００９７】
ステップ３０８では、変数ｎに１をセットする。
【００９８】
ステップ３１０では、ｎが、機能Ｘの機能管理データに格納されている基本機能数より大きいか否かを判断する。ｎが基本機能数以下の場合には、ステップ３１２で、機能Ｘの機能管理データの第ｎ番目の基本機能に対応する管理データアドレス８２が示す記憶領域に格納された基本機能管理データを読み出して取得し、第ｎ番目に実行される基本機能のＳＷ実行時間からＨＷ実行時間を差し引いた値を求めて、Ｓに加算する。
【００９９】
ステップ３１４では、Ｓが予め定められた性能目標値以下であるか否かを判断する。ここで、Ｓが性能目標値以下であると判断した場合には、ステップ３１６に移行する。ステップ３１６では、ＤＭＡ転送リストの第ｎ番目の基本機能の回路情報をＤＭＡ転送するための転送情報を、第ｎ番目の基本機能のソースプログラムをＤＭＡ転送するための転送情報に変更する。具体的には、第ｎ番目の転送情報のうち、転送元アドレスを第ｎ番目の基本機能管理データのプログラムアドレス８６が示すアドレスに変更し、転送サイズを該プログラムアドレス８６に記憶されているソースプログラムのサイズに変更する。
【０１００】
その後、ステップ３１８では、ｎに１を加算し、ステップ３１０に戻る。
【０１０１】
ステップ３０６でＳが性能目標値以上であると判断された場合、ステップ３１０でｎが基本機能数を超えていると判断された場合、及びステップ３１４で、Ｓが性能目標値を超えていると判断された場合には、ステップ３２０に移行する。
【０１０２】
ステップ３２０では、転送準備完了通知を情報処理装置１４に送信する。ステップ３２２では、ＤＭＡ転送リストにしたがってＤＭＡ転送対象の情報が情報処理装置１４に送信されるようＤＭＡＣ２３を起動する。起動したＤＭＡＣ２３は、ＤＭＡ転送リストにしたがって、ＤＭＡ転送を行う。
【０１０３】
なお、本実施の形態に係る機能実行部４４のＣＰＵ５２は、図７のフローチャートにしたがって機能実行処理を実行するが、ステップ１１０における処理が第１の実施の形態と異なる。
【０１０４】
ステップ１００からステップ１０８までの処理は第１の実施の形態と同じである。ステップ１１０では、回路情報生成装置１２から受信した回路情報及びソースプログラムを記憶部４６から順に読み出して機能Ｘを構成する各基本機能を順に実行する。すなわち、回路情報生成装置１２から受信して記憶したデータが回路情報である場合には、ＣＰＵ５２は、再構築制御部５０を起動して回路５７を再構成させ、基本機能を実行させる。また、回路情報生成装置１２から受信して記憶したデータがソースプログラムである場合には、ＣＰＵ５２は、ソースプログラムを実行形式に変換したプログラムを実行して基本機能を実行する。
【０１０５】
以下、ステップ１１０の処理について具体例を挙げて説明する。以下では、回路５７により基本機能を実行することをハードウェア処理といい、ＣＰＵ５２がソースプログラムを変換した実行形式のプログラムを実行することにより基本機能を実行することをソフトウェア処理という。
【０１０６】
例えば、機能実行部４４で図５に示す機能Ａについて、回路情報生成装置１２から、基本機能１のソースプログラム、基本機能２のソースプログラム、基本機能３の回路情報、及び基本機能４の回路情報を受信した場合には、基本機能１及び基本機能２については、ソフトウェア処理を行い、基本機能３及び基本機能４については、ハードウェア処理を行う。
【０１０７】
なお、機能Ａに続いて図５に示す機能Ｂが要求された場合であって、機能Ｂについて、回路情報生成装置１２から、基本機能１のソースプログラム、基本機能２のソースプログラム、基本機能３の回路情報、及び基本機能５の回路情報を受信した場合には、上記機能Ａと同様に基本機能１及び基本機能２については、ソフトウェア処理を行い、基本機能３及び基本機能５については、ハードウェア処理を順に行うが、ここで、機能Ｂが機能Ａの処理結果を用いずに独立に実行される機能である場合には、例えば、ＣＰＵ５２は、回路５７での機能Ａの基本機能３及び基本機能４を実行中に、機能Ｂの基本機能１及び基本機能２を実行する。
【０１０８】
ここで、図１２、及び図１３を用いて、ソフトウェアとハードウェアの使用効率について説明する。
【０１０９】
図１２は、機能Ｃと機能Ｄの各々を構成する各基本機能と、各基本機能毎のＳＷ実行時間及びＨＷ実行時間の一例を示した図である。各ＨＷ実行時間、ＳＷ実行時間を示す数字は時間を概念的に示したものであり、分や秒などを具体的に規定するものではない。機能Ｃは、基本機能１、基本機能２を順に実行することで実現する機能である。機能Ｄは基本機能３を実行することで実現する機能である。ここで、機能Ｃ及び機能Ｄは独立に実行される機能であり、一方の機能の処理結果を用いて他方の機能が実行される関係にはない。
【０１１０】
図示されるように、基本機能１のＳＷ実行時間は１０、ＨＷ実行時間は５である。基本機能２のＳＷ実行時間は５、ＨＷ実行時間は５である。基本機能３のＳＷ実行時間は２０、ＨＷ実行時間は５である。なお、ここで機能Ｃの性能目標値を１５とし、機能Ｄの性能目標値を１０とする。
【０１１１】
機能Ｄについては、性能目標値（１０）を満たすためには、基本機能３をハードウェア処理で行う必要があるが、機能Ｃについては、基本機能１及び基本機能２の双方をハードウェア処理とする場合、基本機能１はソフトウェア処理とし、基本機能２はハードウェア処理とする場合のいずれの場合でも、性能目標値（１５）は満たされる。
【０１１２】
ここで、機能Ｃ及び機能Ｄの各々の基本機能をハードウェア処理で行うパターン１、及び、機能Ｃの基本機能１をソフトウェア処理で行うと共に基本機能２をハードウェア処理で行い、機能Ｄの基本機能３をハードウェア処理で行うパターン２の２つのパターンを例に挙げる。なお、パターン１では、機能Ｄは機能Ｃが終了されるまで待たされるが、パターン２では、機能Ｃの終了を待たずに実行される。
【０１１３】
図１３に、パターン１及びパターン２のハードウェア及びソフトウェア使用率を示す。なお、ここでいうハードウェア使用率とは、機能全体の実行時間に対するＨＷ実行時間の合計の割合をいい、ソフトウェア使用率とは、機能全体の実行時間に対するＳＷ実行時間の合計の割合をいう。
【０１１４】
なお、パターン１の場合の、単位時間１５におけるハードウェア使用率及びソフトウェア使用率は以下の通りである。
・ハードウェア使用率＝１５／１５＝１００％
・ソフトウェア使用率＝０％
【０１１５】
パターン２の場合の、単位時間１５におけるハードウェア使用率及びソフトウェア使用率は以下の通りである。
・ハードウェア使用率＝１０／１５＝６６％
・ソフトウェア使用率＝１０／１５＝６６％
【０１１６】
なお、上記では図１０を用いて、回路情報を生成した後にソフトウェア処理を行う特定の基本機能を求める例について説明したが、回路情報を生成する前にソフトウェア処理を行う特定の基本機能を求めるようにしてもよい。
【０１１７】
図１４は、本実施の形態に係る回路情報生成装置１２のＣＰＵ２０により実行される生成制御処理の他の例を示すフローチャートである。なお、図１４において、図１０と同じステップには同一の符号を付し、ここでは、異なるステップのみ説明する。
【０１１８】
ステップ３００で肯定判断された場合には、ここでは回路情報生成ルーチンは行わず、ステップ３０４〜ステップ３１７の処理を行う。ステップ３１７では、ＤＭＡ転送リストに、第ｎ番目の基本機能のソースプログラムをＤＭＡ転送するための転送情報を登録する。
【０１１９】
ステップ３０６で、Ｓが性能目標値以上であると判断された場合、ステップ３１０で、ｎが基本機能数を超えていると判断された場合、及びステップ３１４で、Ｓが性能目標値を超えていると判断された場合には、ステップ３１９に移行する。
【０１２０】
ステップ３１９では、回路情報生成ルーチンを実行し、各基本機能の回路情報を必要に応じて生成する。
【０１２１】
図１５は、ステップ３１９で行われる回路情報生成ルーチンの流れを示すフローチャートである。なお、図１５において、図１１と同じステップには同一の符号を付し、ここでは異なるステップのみ説明する。
【０１２２】
ステップ２０４ａで、ｎが基本機能数以下であると判断した場合には、ステップ２０６の前に、ステップ２０５を行う。ステップ２０５では、ＤＭＡ転送リストのｎ番目の転送情報が存在するか否かを判断する。ＤＭＡ転送リストにｎ番目の転送情報が存在している場合には、ｎ番目の基本機能はソフトウェア処理が行われる基本機能であって、ソースプログラムを情報処理装置１４に対して転送するための転送情報が既にＤＭＡ転送リストに登録されていることを示している。したがって、この基本機能については回路情報を生成する必要がないため、ステップ２１４に移行し、ｎに１を加算してステップ２０４ａに戻る。一方、ｎ番目の転送情報が存在しない場合には、ｎ番目の基本機能はハードウェア処理が行われる基本機能であるため、回路情報が必要である。したがって、ステップ２０６以降の処理を行う。
【０１２３】
なお、上記では、図１０及び図１４において、基本機能をソフトウェア処理するか否かを基本機能の実行順に判断していったが、これに限定されず、例えば、実行順で最後の方から判断していくようにしてもよい。また、ＳＷ実行時間が短い或いは長い基本機能から順に判断していって、Ｓが性能目標値となる範囲内でソフトウェア処理に変更するようにしてもよい。
【０１２４】
また、上記では、要求された機能の実行時間が性能目標値以下となる範囲内で、各基本機能をハードウェア処理からソフトウェア処理に変更する例について説明したが、これに限定されず、例えば、要求された機能の実行において単位時間あたりに処理されるデータ量が予め定められた目標値以下となる範囲内で、各基本機能をハードウェア処理からソフトウェア処理に変更するようにしてもよい。例えば、基本機能管理データに、ソフトウェア処理における単位時間あたりに処理されるデータ量と、ハードウェア処理における単位時間あたりに処理されるデータ量とを各基本機能毎に登録しておくと共に、単位時間あたりに処理されるデータ量の目標値を性能目標値として予め設定しておく。そして、ステップ３０４では、変数Ｓに、各基本機能毎の単位時間あたりに処理されるデータ量の平均値をセットする。更に、ステップ３１２では、基本機能をソフトウェア処理に変更した場合の平均値を計算し、ステップ３１４で性能目標値と比較して、Ｓが性能目標値以下となる範囲内で基本機能をソフトウェア処理に変更するようにしてもよい。
【０１２５】
また、上記実施の形態では、Ｓが性能目標値以下となるように制御する例について説明したが、これに限定されず、性能目標値に代えて性能目標範囲（上限及び下限）を定めておき、Ｓがこの範囲内となるよう制御するようにしてもよい。
【０１２６】
また、各ＳＷ実行時間に基づいてソフトウェア処理を行う基本機能及びハードウェア処理を行う基本機能を決定してもよい。例えば、ＳＷ実行時間の合計に対する各基本機能のＳＷ実行時間の割合（以下、負荷の割合と呼称）を求め、この割合を用いて決定してもよいし、ＳＷ実行時間をそのまま用いて決定してもよい。
【０１２７】
例えば、図１６に示すように、機能Ｅが基本機能１、基本機能２、基本機能３を順に実行することにより実現される機能であって、これら各基本機能がソフトウェア処理される場合の各基本機能の負荷の割合が、
・基本機能１：１０％
・基本機能２：８０％
・基本機能３：１０％
であるとした場合、最も負荷の割合が高い基本機能２については、ハードウェア処理が行われるよう、回路情報を生成する。そして、それ以外の基本機能１，３については、ソフトウェア処理を行う基本機能と判断して、回路情報は生成せず、ソースプログラムを情報処理装置１４に送信するようにしてもよい。
【０１２８】
更に、図１７に示すように、負荷の割合が最も高い基本機能を示す情報８８（以下、負荷情報８８）を予め機能管理データに含めて記憶しておくようにしてもよい。本例では、基本機能２を示す負荷情報８８が機能管理データに記憶される。これにより、基本機能２については回路情報が生成されるが、ソフトウェア処理を行う基本機能１，３の回路情報については生成されない。もちろん、基本機能２についての回路情報が既に生成済みである場合には、既に生成済みの回路情報を使用すればよい。
【０１２９】
もちろん、図１７に示すように、ハードウェア処理を行う基本機能として、最も負荷の割合が高い基本機能を予め指定して回路情報の生成を制御する場合に限られず、動的に各基本機能管理データのＳＷ実行時間８７から、最も負荷の割合が高い基本機能を求めて、該求めた基本機能についてハードウェア処理が行われるように制御し、それ以外の基本機能はソフトウェア処理が行われるように制御してもよい。また、負荷の割合が予め定められた割合より高い基本機能あるいはＳＷ実行時間が予め定められた時間よりも長い基本機能については、ハードウェア処理が行われるようにし、それ以外の基本機能についてはソフトウェア処理が行われるように制御してもよい。
【０１３０】
また、上記実施の形態は一例であってこれに限定されない。例えば、回路情報生成装置１２が、回路情報及びソースプログラムの送信履歴を保存しておき、該送信履歴に基づいて、送信済みの回路情報及びソースプログラムを除く回路情報及びソースプログラムを情報処理装置１４に送信し、以前送信したことがある回路情報及びソースプログラムは送信しないようにしてもよい。
【０１３１】
このように、回路情報生成装置１２から情報処理装置１４に対して、機能単位ではなく基本機能単位で回路情報及びソースプログラムを送信する場合には、情報処理装置１４の記憶部４６には基本機能毎に回路情報及びソースプログラムが記憶されて管理され、同一の回路情報及びソースプログラムが重複して記憶されることはない。また、この場合には、機能実行部４４で、各機能を構成する基本機能及び実行順序を示す情報を保持する必要がある。なお、この情報を回路情報生成装置１２から情報処理装置１４に対して送信するようにしてもよい。機能実行部４４は、自ら保持している或いは回路情報生成装置１２から受信した、各機能を構成する基本機能及び実行順序を示す情報に基づいて順に回路を再構成して、或いはプログラムを実行することにより要求された機能を実行する。
【０１３２】
また、回路情報生成装置１２での生成制御を主制御部４０が行うようにしてもよい。すなわち、主制御部４０が、回路情報生成装置１２の第１記憶部２６に記憶されている各種データを有し、回路情報生成プログラム、生成制御処理プログラムを実行して、要求のあった機能の回路情報及びソースプログラムを機能実行部４４に供給してもよい。
【０１３３】
また、ソースプログラムを実行形式に変換して実行するＣＰＵは、機能実行部４４に設けられたＣＰＵ５２に限定されず、例えば、主制御部４０のＣＰＵ７０が実行するようにしてもよいし、ＣＰＵ５２及びＣＰＵ７０とは別にＣＰＵを設け、該ＣＰＵにより実行するようにしてもよい。
【０１３４】
また、本実施の形態では、基本機能毎のソースプログラムを情報処理装置１４に送信し、機能実行部４４のＣＰＵ５２がソースプログラムを実行形式のプログラムに変換して実行することによりソフトウェア処理を行う例について説明したが、回路情報生成装置１２でソースプログラムを実行形式に変換し、該変換済みのプログラムを回路情報生成装置１２から情報処理装置１４に送信するようにしてもよい。また、動的に変換して送信するのではなく、予め実行形式に変換済みのプログラムを回路情報生成装置１２に記憶しておき、該実行形式のプログラムを上記ソースプログラムに代えて情報処理装置１４に送信するようにしてもよい。
【０１３５】
［第３の実施の形態］
【０１３６】
第１及び第２の実施の形態では、主制御部４０から要求された機能を機能実行部４４が実行する例について説明したが、本実施の形態では、機能実行部４４だけでなく回路情報生成装置１２も、要求された機能を実行する機能実行装置として動作する場合を例に挙げて説明する。
【０１３７】
本実施の形態に係る回路情報生成装置１２及び情報処理装置１４の構成は第１の実施の形態と同じであるため、構成についての説明を省略する。
【０１３８】
図１８は、本実施の形態に係る情報処理装置１４の機能実行部４４のＣＰＵ５２により実行される機能実行処理の流れを示すフローチャートである。また、図１９は、本実施の形態に係る回路情報生成装置１２のＣＰＵ２０により実行される生成制御処理の流れを示すフローチャートである。
【０１３９】
まず、情報処理装置１４における機能実行処理について説明する。図１８のステップ４００では、主制御部４０から機能Ｘの実行要求を受け付けるまで待機する。主制御部４０から機能Ｘの実行要求を受け付けた場合には、ステップ４０２に移行する。
【０１４０】
ステップ４０２では、回路情報生成装置１２に機能Ｘの実行を依頼する実行依頼を送信する。
【０１４１】
ステップ４０４では、回路情報生成装置１２から機能Ｘで使用するデータ（例えば、画像データ記憶領域６３に記憶されている画像データ等）の要求があったか否かを判断し、ここで否定判断した場合には、ステップ４１２で、回路情報生成装置１２から機能Ｘの実行依頼を受信したか否かを判断する。ステップ４１２で回路情報生成装置１２から機能Ｘの実行依頼を受信していないと判断した場合には、ステップ４０４に戻る。
【０１４２】
また、ステップ４０４で、機能Ｘで使用するデータの要求があったと判断した場合には、ステップ４０６で、要求されたデータを回路情報生成装置１２に送信する。要求されたデータを全て送信した場合には、ステップ４０８で、データ送信終了通知を回路情報生成装置１２に送信する。
【０１４３】
ステップ４１０では、回路情報生成装置１２から、機能Ｘの実行結果の受信待ちを行う。ステップ４１０で、回路情報生成装置１２から機能Ｘの実行結果を受信した場合には、ステップ４２２で、主制御部４０に対して機能Ｘの実行が終了した旨の終了通知を送信する。
【０１４４】
一方、ステップ４０４で否定判断し、ステップ４１２で肯定判断した場合には、ステップ４１４で、機能Ｘが以前に実行した機能と同じか否かを判断する。機能Ｘが以前に実行した機能でなければ、ステップ４１６に移行する。ステップ４１６では、回路情報生成装置１２からの転送準備完了通知を受信するまで待機する。回路情報生成装置１２から転送準備完了通知を受信した場合には、ステップ４１８で、ＤＭＡＣ５１を起動する。起動したＤＭＡＣ５１は、通信Ｉ／Ｆ５５を介して回路情報生成装置１２から受信した回路情報を記憶部４６に転送して記憶する。
【０１４５】
ステップ４２０では、第１の実施の形態で説明したステップ１１０と同様に、受信した回路情報を用いて回路５７を再構成し、機能Ｘを実行する。そして、ステップ４２２で、主制御部４０に対して機能Ｘの実行が終了した旨の終了通知を送信する。
【０１４６】
一方、ステップ４１２で、機能Ｘが以前に実行した機能であると判断した場合には、すなわち、既に機能Ｘを実現するための回路情報が記憶部４６の受信情報記憶領域６２に記憶されている場合には、ステップ４２０で、既に記憶されている回路情報を用いて回路５７を再構成し、機能Ｘを実行する。
【０１４７】
次に、回路情報生成装置１２における生成制御処理について説明する。図１９のステップ５００では、情報処理装置１４から機能Ｘの実行依頼の受信待ちを行う。ステップ５００で、回路情報生成装置１２から機能Ｘの実行依頼を受信した場合には、ステップ５０２で、処理多重度が予め定められた閾値以上であるか否かを判断する。ここで処理多重度とは、回路情報生成装置１２で実行中及び実行待ちの機能の数をいい、回路情報生成装置１２の負荷を示す情報の１つである。
【０１４８】
ステップ５０２で、処理多重度が閾値以上であると判断した場合には、ステップ５１２で、機能Ｘの実行依頼を情報処理装置１４に送信する。
【０１４９】
ステップ５０６では、以前に機能Ｘの回路情報を情報処理装置１４に送信したことがあるか否かを判断する。例えば、回路情報生成装置１２は、各機能毎に回路情報の送信履歴を第１記憶部２６または第２記憶部２７等に保存しておき、該送信履歴に基づいて、判断してもよい。また、情報処理装置１４から、機能Ｘが以前情報処理装置１４で実行された機能と同じか否かを示す情報を受け取るようにしてもよい。ステップ５０６で、機能Ｘの回路情報はまだ送信されていないと判断した場合には、ステップ５０８で回路情報を生成する。ステップ５０８での回路情報の生成は、図１１に示した処理ルーチンと同じであるため説明を省略する。
【０１５０】
ステップ５１０では、転送準備完了通知を情報処理装置１４に送信する。ステップ５１２では、ＤＭＡ転送リストにしたがってＤＭＡ転送対象の情報（ここでは回路情報）が情報処理装置１４に送信されるようＤＭＡＣ２３を起動する。起動したＤＭＡＣ２３は、ＤＭＡ転送リストにしたがって、情報処理装置１４に回路情報を転送する。
【０１５１】
また、ステップ５０６で、以前に機能Ｘの回路情報を情報処理装置１４に送信したことがあると判断した場合には、ステップ５０８〜５１２の処理は行わず終了する。
【０１５２】
一方、ステップ５０２で、処理多重度が閾値未満であると判断した場合には、ステップ５１４で、情報処理装置１４に対して、機能Ｘにおいて使用するデータ（例えば画像処理対象の画像データ等）を要求する。ステップ５１６では、情報処理装置１４から、上記要求したデータを受信する。ステップ５１８では、情報処理装置１４から、要求したデータの送信終了通知を受信したか否かを判断する。ステップ５１８で、肯定判断した場合には、ステップ５２０で、機能Ｘを構成する各基本機能のソースプログラムを順次実行形式に変換して実行することにより、機能Ｘを実行する。
【０１５３】
ステップ５２２では、機能Ｘの実行結果を情報処理装置１４に送信する。
【０１５４】
なお、本実施の形態では、回路情報生成装置１２の負荷を示す情報として処理多重度を用いたが、これに限定されない。例えば、回路情報生成装置１２の現在のＣＰＵ利用率であってもよい。
【０１５５】
また、本実施の形態に、上記第２の実施の形態で説明した回路情報生成方法を適用してもよい。例えば、機能Ｘを情報処理装置１４の機能実行部４４で実行させる場合には、第２の実施の形態で説明したように、予め定められた条件に応じてソフトウェア処理を行う特定の基本機能を求め、該特定の基本機能については、回路情報に代えてソースプログラムを送信するようにし、それ以外の基本機能については回路情報を生成して送信するようにしてもよい。
【０１５６】
また、本実施の形態では、回路情報生成装置１２が、要求された機能を実行する機能実行装置として動作する場合を例に挙げて説明したが、例えば、ＣＰＵを含むコンピュータを備え、基本機能をソフトウエア処理することが可能な機能実行装置を回路情報生成装置１２及び情報処理装置１４とは別にネットワーク１６上に設け（図示省略）、回路情報生成装置１２に代えて、該機能実行装置の負荷を示す値が閾値未満であれば、該機能実行装置に要求された機能を実行させるように制御してもよい。すなわち、回路情報生成装置１２が該機能実行装置の負荷を示す値を該機能実行装置から取得して閾値未満か否かを判断し、該機能を構成する各基本機能のソースプログラムを該機能実行装置に送信して実行させる。
【０１５７】
また、実行要求される機能は、画像処理の機能に限るものではなく、回路情報に基づいて再構成される回路により実行される様々な機能に適用される。
【０１５８】
また、上記第１から第３の実施の形態では、機能実行部４４のＣＰＵ５２により回路情報生成装置１２に対して回路情報を要求する例について説明したが、例えば、主制御部４０のＣＰＵ７０により回路情報生成装置１２に対して回路情報を要求するように構成してもよい。
【０１５９】
また、上記第１から第３の実施の形態では、１台の情報処理装置１４がネットワーク１６に接続されている例について説明したが、情報処理装置１４は複数台ネットワーク１６に接続されていてもよい。回路情報生成装置１２は、複数の情報処理装置１４から、機能の回路情報の要求を受け付け、該受け付けた要求の各々に対して回路情報を（必要であれば生成して）送信する。
【符号の説明】
【０１６０】
１０ 機能実行システム
１２ 回路情報生成装置
１４ 情報処理装置
１６ ネットワーク
２０ ＣＰＵ
２１ ＲＯＭ
２２ ＲＡＭ
２６ 第１記憶部
２７ 第２記憶部
４０ 主制御部
４４ 機能実行部
４６ 記憶部
５０ 再構成制御回路
５２ ＣＰＵ
５３ ＲＯＭ
５４ ＲＡＭ
５７ 回路
【技術分野】
【０００１】
この発明は、回路情報生成装置、機能実行システム、及びプログラムに関するものである。
【背景技術】
【０００２】
特許文献１には、外部サーバーから画像処理用プログラムをダウンロードする受信手段と、前記プログラムを当該画像処理装置において実行する画像処理手段と、外部サーバーに画像データの処理を依頼する送信手段と、所定条件により、画像処理手段と外部サーバーのいずれで画像データの処理を行うかを切り換える切換手段とを備える画像処理装置が記載されている。
【０００３】
特許文献２には、ネットワーク上のマルチファンクションペリフェラルで使用する各種のプログラムをネットワーク上のファイルサーバに予め格納しておき、マルチファンクションペリフェラルは、ファイルサーバに格納されたプログラムをダウンロードして各種の機能に係る処理を実行するプログラム管理システムが記載されている。
【先行技術文献】
【特許文献】
【０００４】
【特許文献１】特開２００３−０３６４３５号公報
【特許文献２】特開２００１−２４３０７５号公報
【発明の概要】
【発明が解決しようとする課題】
【０００５】
本発明は、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮することができる回路情報生成装置、機能実行システム、及びプログラムを提供することを目的とする。
【課題を解決するための手段】
【０００６】
請求項１の発明の回路情報生成装置は、１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域と、要求された機能を構成する該機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能を実行する回路が再構成され、該再構成された回路により前記要求された機能が実行されるように制御する制御手段と、を有する。
【０００７】
請求項２の発明の回路情報生成装置は、１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域と、要求された機能を構成する該機能中の基本機能が、該要求された機能の実行に関する予め定められた条件に応じて、前記ソースプログラムを実行形式に変換したプログラムを用いて実行される特定の基本機能として定められた場合には、前記第１の記憶領域に記憶されているソースプログラムを実行形式に変換したプログラムを用いて該特定の基本機能が実行されるように制御する第１の制御と、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能中の基本機能を実行する回路が再構成され、該再構成された回路により前記特定の基本機能を除く基本機能が実行されるように制御する第２の制御とにより、前記要求された機能が実行されるように制御する制御手段と、を有する。
【０００８】
請求項３の発明の機能実行システムは、請求項１に記載の回路情報生成装置と、回路情報を用いて再構成され、前記要求された機能を実行する回路を備えた機能実行装置と、を備えている。
【０００９】
請求項４の発明の機能実行システムは、請求項２に記載の回路情報生成装置と、回路情報を用いて再構成され、前記要求された機能を実行する回路、及び前記ソースプログラムを実行形式に変換したプログラムを実行するコンピュータを有する前記機能実行装置と、を備えている。
【００１０】
請求項５の発明は、請求項３または請求項４に記載の機能実行システムにおいて、前記ソースプログラムを実行形式に変換したプログラムを実行するコンピュータを有する第２の機能実行装置を更に備え、前記回路情報生成装置に、前記第２の機能実行装置の負荷の状態を示す情報を取得し、該取得した負荷の状態を示す情報が予め定められた条件を満たす場合には、前記要求された機能が前記機能実行装置で実行されないよう前記制御手段の制御に代えて、前記第１の記憶領域に記憶されているソースプログラムを実行形式に変換したプログラムを用いて前記要求された機能が前記第２の機能実行装置で実行されるように制御する第２の制御手段を更に設けたものである。
【００１１】
請求項６の発明のプログラムは、１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域とに接続されたコンピュータを、要求された機能を構成する該機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能を実行する回路が再構成され、該再構成された回路により前記要求された機能が実行されるように制御する制御手段として機能させるためのプログラムである。
【００１２】
請求項７の発明のプログラムは、１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域とに接続されたコンピュータを、要求された機能を構成する該機能中の基本機能が、該要求された機能の実行に関する予め定められた条件に応じて、前記ソースプログラムを実行形式に変換したプログラムを用いて実行される特定の基本機能として定められた場合には、前記第１の記憶領域に記憶されているソースプログラムを実行形式に変換したプログラムを用いて該特定の基本機能が実行されるように制御する第１の制御と、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能中の基本機能を実行する回路が再構成され、該再構成された回路により前記特定の基本機能を除く基本機能が実行されるように制御する第２の制御とにより、前記要求された機能が実行されるように制御する制御手段として機能させるためのプログラムである。
【発明の効果】
【００１３】
請求項１の発明によれば、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮することができる。
【００１４】
請求項２の発明は、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮することができると共に、複数の機能を多重化して実行できる。
【００１５】
請求項３の発明は、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮でき、機能実行装置での機能の実行の開始を早めることができる。
【００１６】
請求項４の発明は、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮することができ、機能実行装置での機能の実行の開始を早めることができると共に、機能実行装置で複数の機能を多重化して実行できる。
【００１７】
請求項５の発明は、第２の機能実行装置の負荷を示す情報が予め定められた条件を満たす場合には、要求された機能を回路情報を生成せずに実行することができる。
【００１８】
請求項６の発明は、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮することができる。
【００１９】
請求項７の発明は、要求された機能を実行するための回路の再構成に用いられる回路情報を機能単位で生成する場合に比べて、回路情報の生成時間を短縮することができると共に、複数の機能を多重化して実行できる。
【図面の簡単な説明】
【００２０】
【図１】第１〜第３の実施の形態に係る機能実行システムの概略構成図である。
【図２】第１〜第３の実施の形態に係る回路情報生成装置の概略構成図である。
【図３】第１〜第３の実施の形態に係る情報処理装置の概略構成図である。
【図４】第１〜第３の実施の形態に係る主制御部の概略構成図である。
【図５】機能と基本機能との関係を説明する説明図である。
【図６Ａ】機能管理データ及び基本機能管理データの一例を示す図である。
【図６Ｂ】機能管理データ及び基本機能管理データの他の例を示す図である。
【図７】第１及び第２の実施の形態に係る情報処理装置の機能実行部のＣＰＵにより実行される機能実行処理の流れを示すフローチャートである。
【図８】第１の実施の形態に係る回路情報生成装置のＣＰＵにより実行される生成制御処理の流れを示すフローチャートである。
【図９】第２の実施の形態における基本機能管理データの一例を示す図である。
【図１０】第２の実施の形態に係る回路情報生成装置のＣＰＵにより実行される生成制御処理の流れを示すフローチャートである。
【図１１】図１０のステップ３０２で行われる回路情報生成ルーチンの流れを示すフローチャートである。
【図１２】機能Ｃと機能Ｄの各々を構成する各基本機能と、各基本機能毎のＳＷ実行時間及びＨＷ実行時間の一例を示した図である。
【図１３】機能Ｃ及び機能Ｄの各々の基本機能をハードウェア処理で行うパターン１と、機能Ｃの基本機能１をソフトウェア処理で行い、基本機能２をハードウェア処理で行い、機能Ｄの基本機能３をハードウェア処理で行うパターン２の各々のパターンにおけるハードウェア及びソフトウェア使用率の一例を示す図である。
【図１４】第２の実施の形態に係る回路情報生成装置のＣＰＵにより実行される生成制御処理の他の例を示すフローチャートである。
【図１５】図１４のステップ３１９で行われる回路情報生成ルーチンの流れを示すフローチャートである。
【図１６】機能Ｅを構成する各基本機能がソフトウェア処理される場合の各基本機能の負荷の割合の一例を示す図である。
【図１７】機能を構成する基本機能のうち、負荷の割合が最も高い基本機能を特定するための情報（負荷情報）を含む機能管理データと基本機能管理データの一例を示す図である。
【図１８】第３の実施の形態に係る情報処理装置の画像処理部のＣＰＵにより実行される機能実行処理の流れを示すフローチャートである。
【図１９】第３の実施の形態に係る回路情報生成装置のＣＰＵにより実行される生成制御処理の流れを示すフローチャートである。
【発明を実施するための形態】
【００２１】
［第１の実施の形態］
【００２２】
図１は、本実施の形態に係る機能実行システム１０の概略構成図である。機能実行システム１０は、回路情報生成装置１２及び情報処理装置１４を備えている。回路情報生成装置１２及び情報処理装置１４は、ネットワーク１６を介して相互に通信する。
【００２３】
図２は、回路情報生成装置１２の概略構成図である。回路情報生成装置１２は、ＣＰＵ（Central Processing Unit）２０、ＲＯＭ（Read Only Memory）２１、ＲＡＭ（Random Access Memory）２２、ＤＭＡ（Direct Memory Access）制御回路２３（以下、ＤＭＡＣ２３と呼称）、通信インタフェース（Ｉ／Ｆ）２４、第１記憶部２６、及び第２記憶部２７を含んで構成されており、それぞれバス２８を介して接続されている。
【００２４】
ＣＰＵ２０は、ＲＯＭ２１等に記憶されたプログラムを実行する。ＲＯＭ２１には、ＣＰＵ２０が実行するプログラムやプログラムの実行に必要な各種データ等が予め記憶されている。本実施の形態では、ＲＯＭ２１の生成制御プログラム記憶領域３０に、後述する回路５７を再構成するための回路情報の生成制御を行うための生成制御プログラムが記憶され、回路情報生成プログラム記憶領域３１に、回路情報を生成するための回路情報生成プログラムが記憶されている。
【００２５】
ＲＡＭ２２は、通信Ｉ／Ｆ２４を介して他の装置から受信したデータや新たに生成したデータ等を一時記憶するためのメモリとして利用される他、ＣＰＵ２０のプログラム実行時のワークメモリとしても利用される。
【００２６】
なお、ＣＰＵ２０が実行するプログラムが記憶される記憶媒体は、上記ＲＯＭ２１等に限定されず、例えば、図示は省略するが、ＣＤ−ＲＯＭ、ＤＶＤディスク、光磁気ディスク、ＩＣカードなどの可搬型記録媒体や回路情報生成装置１２の内部あるいは外部に備えられたＨＤＤ等の記憶装置等であってもよく、さらにまたネットワーク１６を介して接続されたデータベース、或いは他のコンピュータシステム並びにそのデータベースや、更に電気通信回線上の搬送波のような伝送媒体であってもよい。
【００２７】
ＤＭＡＣ２３は、ＣＰＵ２０を介さずにデータを転送（ＤＭＡ転送）する。具体的には、後述する第２記憶部２７のＤＭＡ転送リスト記憶領域３７に記憶されたＤＭＡ転送リストに基づいて、第１記憶部２６の回路情報記憶領域３５から回路情報を読み出して、通信Ｉ／Ｆ２４を介して情報処理装置１４に転送する。ＤＭＡ転送リストは、ＤＭＡ転送するときに用いられる転送情報が、転送順に登録されるリストである。転送情報には、ＤＭＡ転送する転送データの転送元アドレス、転送先アドレス（ここでは情報処理装置１４のアドレス）、及び転送サイズが含まれる。
【００２８】
第１記憶部２６は、機能管理データを記憶する機能管理データ記憶領域３３、基本機能管理データを記憶する基本機能管理データ記憶領域３４、及び生成した回路情報を記憶するための回路情報記憶領域３５、ＣＰＵを用いて基本機能を実行するためのプログラムのソースコード（ソースプログラムともいう）を記憶するソースプログラム記憶領域３６を有する。
【００２９】
機能管理データは、後述する情報処理装置１４の機能実行部４４で実行可能な機能を管理するためのデータである。ここで、本実施の形態における「機能」及び「基本機能」について説明する。機能実行部４４で実行される各種機能は１または複数の基本機能により構成される。一例を挙げると、複数ページを１枚の用紙にまとめて記録する場合の画像データの生成のために機能実行部４４で実行される機能は、画像縮小処理、画像回転処理、及びハーフトーン処理等々の基本機能から構成される。
【００３０】
ここで、機能及び基本機能について更に詳しく説明する。図５は、互いに異なる機能Ａと機能Ｂの構成を模式的に示す図である。機能Ａは、基本機能１、基本機能２、基本機能３、基本機能４の４つの基本機能を順に実行することにより実現される機能である。機能Ｂは、基本機能１、基本機能２、基本機能３、基本機能５の４つの基本機能を順に実行することにより実現される機能である。このように、互いに異なる機能には互いに共通する基本機能が含まれる場合もある。本実施の形態では、機能管理データにより、各機能に含まれる基本機能を特定し、該各基本機能の実行順序を規定する。
【００３１】
図６Ａの上段に機能管理データの一例を示す。この例では、機能管理データの各々は、各機能を識別するための識別情報８０と、機能を構成する基本機能の数を示す基本機能数８１と、機能を構成する各基本機能毎の基本機能管理データの記憶領域を示すアドレス８２（以下、管理データアドレス８２と呼称）とにより構成される。なお、管理データアドレス８２は、基本機能の実行順に配列されている。
【００３２】
基本機能管理データは、各機能を構成する基本機能の各々を管理するためのデータである。基本機能管理データの各々は、上記機能管理データの管理データアドレス８２が示す記憶領域の各々に記憶されている。図６Ａの中段に基本機能管理データの一例を示す。この例では、基本機能管理データの各々は、基本機能を識別する識別情報８３と、基本機能に対応する回路情報の記憶領域を示すアドレス８４（以下、回路情報アドレス８４と呼称）と、基本機能に対応するソースプログラムの記憶領域を示すアドレス８６（以下、プログラムアドレス８６と呼称）とにより構成される。
【００３３】
回路情報は必要に応じて、基本機能毎に、対応するソースプログラムに基づいて動的に生成されるが、生成前の段階では、回路情報アドレス８４には、ＮＵＬＬ値が設定されている。回路情報が生成され、図６Ａの下段に示すように、回路情報記憶領域３５に記憶されると、該記憶された領域を示すアドレスが、回路情報アドレス８４に設定される。
【００３４】
ソースプログラムは、回路情報と異なり、予めソースプログラム記憶領域３６に記憶されている。したがって、プログラムアドレス８６には、ソースプログラムが記憶されている記憶領域を示すアドレス値が予め設定されている。
【００３５】
なお、回路情報及びソースプログラムの管理方法は、上記に限定されず、例えば、図６Ｂに示すように、回路情報及びソースプログラムの各々に対して独立に、機能管理データ及び基本機能管理データを記憶して管理するようにしてもよい。
ただし、本実施の形態では、図６Ａに示すデータ管理を行うものとして説明する。
【００３６】
第２記憶部２７は、ＤＭＡ転送リスト記憶領域３７を備え、ＤＭＡ転送リスト記憶領域３７には、ＤＭＡＣ２３がＤＭＡ転送する際に参照するＤＭＡ転送リストが記憶される。
【００３７】
第１記憶部２６及び第２記憶部２７は、例えばハードディスクドライブ（ＨＤＤ）により構成されていてもよいし、ＥＥＰＲＯＭ（Electrically Erasable and Programmable Read Only Memory）等の書き換え可能なメモリ素子で構成されていてもよい。なお、ＣＰＵ２０が実行するプログラムが、第１記憶部２６や第２記憶部２７に記憶されていてもよい。また、第１記憶部２６及び第２記憶部２７は外付けの記憶装置であってもよい。
【００３８】
さらにまた、本実施の形態では、機能管理データ記憶領域３３、基本機能管理データ記憶領域３４、回路情報記憶領域３５、及びソースプログラム記憶領域３６を第１記憶部２６に、ＤＭＡ転送リスト記憶領域３７を第２記憶部２７に設けた例について説明したが、各記憶領域の場所はこれに限定されるものではない。例えば、ＤＭＡ転送リスト記憶領域３７を第１記憶部２６に設けても良いし、機能管理データ記憶領域３３、基本機能管理データ記憶領域３４、回路情報記憶領域３５、及びソースプログラム記憶領域３６を第２記憶部２７に設けても良い。また、機能管理データ記憶領域３３、基本機能管理データ記憶領域３４、回路情報記憶領域３５、及びソースプログラム記憶領域３６の各々を互いに異なる記憶媒体に設けてもよい。
【００３９】
通信Ｉ／Ｆ２４は、ネットワーク１６に接続されている。回路情報生成装置１２は、通信Ｉ／Ｆ２４を介して、ネットワーク１６に接続された情報処理装置１４と相互に情報をやりとりする。
【００４０】
図３は、情報処理装置１４の概略構成図である。本実施の形態では、情報処理装置１４として画像処理及び画像形成を行う装置を例に挙げて説明するが、これに限定されるものではない。
【００４１】
情報処理装置１４は、情報処理装置１４全体を制御する主制御部４０、与えられた画像データに基づいて画像を形成する画像形成部４２、各種機能を実行することにより画像データに対して画像処理を施す機能実行部４４、及び記憶部４６を含んで構成されており、それぞれバス４８を介して接続されている。
【００４２】
機能実行部４４は、再構成制御回路５０、ＤＭＡ制御回路５１（以下、ＤＭＡＣ５１）、ＣＰＵ（Central Processing Unit）５２、ＲＯＭ（Read Only Memory）５３、ＲＡＭ（Random Access Memory）５４、通信Ｉ／Ｆ５５、Ｉ／Ｆ５６、及び回路５７を備え、それぞれバス５８を介して接続されている。機能実行部４４は、Ｉ／Ｆ５６を介して記憶部４６と接続されている。また、Ｉ／Ｆ５６は、バス４８とも接続されている。
【００４３】
回路５７は、回路情報により再構成される回路である。回路５７は、回路情報を記憶するための回路情報メモリ６０Ａ及び回路情報メモリ６０Ｂと、複数の論理セル、配線領域、及び入出力端子を含んで構成された回路素子群６１とを備えている。
【００４４】
回路情報メモリ６０Ａ及び回路情報メモリ６０Ｂは、ＥＥＰＲＯＭ（Electrically Erasable and Programmable Read Only Memory）、ＳＲＡＭ（Static Random Access Memory）等の書き換え可能なメモリ素子で構成されている。回路素子群６１には、上記回路情報メモリ６０Ａ、６０Ｂの何れか一方が接続されるようになっている。回路情報には、各論理セルの接続関係の情報や入出力設定の情報等が含まれ、回路素子群６１に接続されている回路情報メモリ６０Ａまたは回路情報メモリ６０Ｂに展開された回路情報に基づいて、回路素子群６１の論理セル内の回路構成や、論理セルと入出力端子とを相互に接続する配線領域の接続状態等が再構成される。
【００４５】
再構成制御回路５０は、回路情報を用いて回路５７を再構成する。具体的には、Ｉ／Ｆ５６を介して回路情報を記憶部４６から読出して、回路情報メモリ６０Ａ、６０Ｂに展開することにより再構成する。このとき、回路素子群６１に接続する回路情報メモリ６０Ａ、６０Ｂを適時切り替えるバンク切り替えを実行することにより、回路素子群６１上に順次必要な機能を実行する回路構成を実現させる（再構成処理）。
【００４６】
ＤＭＡＣ５１は、ＣＰＵ５２を介さずに、回路情報生成装置１２のＤＭＡＣ２３との間でＤＭＡ転送を行う。具体的には、ＤＭＡＣ５１は、通信Ｉ／Ｆ５５を介して回路情報生成装置１２から受信した回路情報を順次記憶部４６に転送して記憶する。
【００４７】
ＣＰＵ５２は、ＲＯＭ５３に記憶されたプログラムを実行し、様々な処理（例えば、後述する機能実行処理）を行う。ＲＡＭ５４は、ワーキングメモリ等として用いられる。
【００４８】
なお、本実施の形態において、ＣＰＵ５２が実行するプログラムが記憶される記憶媒体は、上記ＲＯＭ５３等に限定されず、例えば記憶部４６であってもよい。
【００４９】
通信Ｉ／Ｆ５５は、ネットワーク１６を介して外部の装置と通信するためのインタフェースである。
【００５０】
機能実行部４４は、Ｉ／Ｆ５６を介して記憶部４６に接続されている。記憶部４６には、回路情報生成装置１２から受信した情報（本実施の形態では、回路情報）を記憶するための受信情報記憶領域６２と、機能実行部４４による画像処理の対象とされた画像データを一時的にバッファリングする画像データ記憶領域６３と、を備えている。なお、本実施の形態では、受信情報記憶領域６２には、回路情報生成装置１２から受信した各基本機能に対応する回路情報の各々が機能毎に記憶され管理される。したがって、複数の機能が互いに共通する基本機能を有する場合でも、該共通する基本機能に対応する回路情報を該複数の機能毎に別々に記憶するようにしている。
【００５１】
なお、記憶部４６は、ＥＥＰＲＯＭやＳＤＲＡＭ等の書換え可能なメモリ素子であってもよいし、ＨＤＤ等であってもよく、特に限定されない。
【００５２】
画像形成部４２は、電子写真方式の画像形成部であってもよいし、インクジェット方式の画像形成部であってもよく、その構成は特に限定されない。
【００５３】
次に、図４を参照しながら、主制御部４０の構成について説明する。
【００５４】
図４は、主制御部４０の概略構成図である。主制御部４０は、ＣＰＵ（Central Processing Unit）７０、ＲＯＭ（Read Only Memory）７１、ＲＡＭ（Random Access Memory）７２、入出力インタフェース（Ｉ／Ｆ）７３、通信Ｉ／Ｆ７５、及びＩ／Ｆ７６を備え、それぞれバス７７を介して接続されている。Ｉ／Ｆ７６は、バス４８とも接続されている。
【００５５】
ＣＰＵ７０は、ＲＯＭ７１に記憶されたプログラムを実行する。ＲＯＭ７１には、ＣＰＵ７０が実行するプログラムやプログラムの実行に必要な各種データ等が予め記憶されている。本実施の形態では、ＲＯＭ７１に、ＣＰＵ７０が実行する装置管理プログラムが記憶されており、ＣＰＵ７０の該装置管理プログラムの実行により、主制御部４０は、情報処理装置１４全体を管理し、制御する。
【００５６】
ＲＡＭ７２は、通信Ｉ／Ｆ７５を介して他の装置から受信した画像データ等の各種データや新たに生成した画像データ等々、様々なデータを一時記憶するためのフレームメモリとして利用される他、ＣＰＵ７０のプログラム実行時のワークメモリとしても利用される。
【００５７】
なお、ＣＰＵ７０が実行するプログラムが記憶される記憶媒体は、上記ＲＯＭ７１に限定されず、例えば、図示は省略するが、ＣＤ−ＲＯＭ、ＤＶＤディスク、光磁気ディスク、ＩＣカードなどの可搬型記録媒体や情報処理装置１４の内部または外部に備えられたＨＤＤ等の記憶装置等であってもよく、さらにまたネットワーク１６を介して接続されたデータベース、或いは他のコンピュータシステム並びにそのデータベースや、更に電気通信回線上の搬送波のような伝送媒体であってもよい。
【００５８】
入出力Ｉ／Ｆ７３は、液晶表示板からなる表示パネル上にタッチパネルが重ねられたユーザインタフェースとしてのタッチパネルディスプレイ７４に接続されている。タッチパネルディスプレイ７４は、ＣＰＵ７０の制御信号に応じて画像や各種メッセージ等の情報を表示する表示部としての機能と、該表示された画像上の任意の位置を利用者が指定することにより各種機能の実行要求や設定情報等を指示入力する指示部としての機能を兼ね備えている。なお、タッチパネルディスプレイに代えて、例えば、液晶ディスプレイ等の表示部と、操作者により操作される操作ボタン等の指示部とを個別に装備してもよい。
【００５９】
通信Ｉ／Ｆ７５は、ネットワーク１６を介して外部の装置と通信するためのインタフェースである。主制御部４０は、ネットワーク１６を介して各種機能の実行要求を受信する場合もある。
【００６０】
なお、本実施の形態では、主制御部４０は、前述したように、タッチパネルディスプレイ７４或いは通信Ｉ／Ｆ７５を介して機能の実行要求を受け付けるが、該受け付けた実行要求うち、機能実行部４４で行われる機能の実行要求については、機能実行部４４に転送する。
【００６１】
次に、本実施の形態の作用を説明する。
【００６２】
図７は、情報処理装置１４の機能実行部４４のＣＰＵ５２により実行される機能実行処理の流れを示すフローチャートである。また、図８は、回路情報生成装置１２のＣＰＵ２０により実行される生成制御処理の流れを示すフローチャートである。
【００６３】
まず、情報処理装置１４における機能実行処理について説明する。図７のステップ１００では、主制御部４０から機能Ｘ（Ｘは機能を識別する識別情報）の実行要求を受け付けるまで待機する。ステップ１００で、主制御部４０から機能Ｘの実行要求を受け付けた場合には、ステップ１０２に移行する。
【００６４】
ステップ１０２では、機能Ｘが以前に実行した機能と同じか否かを判断する。具体的には、記憶部４６の受信情報記憶領域６２に機能Ｘの回路情報が記憶されているか否かを確認し、記憶されていれば、機能Ｘは以前に実行した機能と同じであると判断し、記憶されていなければ、機能Ｘは以前実行した機能と異なると判断する。ここで、機能Ｘが以前に実行した機能でないと判断した場合には、ステップ１０４で、通信Ｉ／Ｆ５５を介して機能Ｘの回路情報を回路情報生成装置１２に要求する。
【００６５】
ステップ１０６では、回路情報生成装置１２からの転送準備完了通知の受信待ちを行う。転送準備完了通知を受信した場合には、ステップ１０８で、ＤＭＡＣ５１を起動する。起動したＤＭＡＣ５１は、通信Ｉ／Ｆ５５を介して回路情報生成装置１２から受信した回路情報を記憶部４６の受信情報記憶領域６２に転送して記憶する。
【００６６】
ステップ１１０では、機能Ｘを実行する。具体的には、機能Ｘの回路情報の記憶領域を指定して再構成制御回路５０を起動する。起動した再構成制御回路５０は、機能Ｘを構成する各基本機能を実行するための回路情報をその実行順に記憶部４６の受信情報記憶領域６２から読み出して、回路情報メモリ６０Ａ及び回路情報メモリ６０Ｂに交互に展開し、且つ前述したようにバンク切り替えを行って、予め定められた実行順に回路素子群６１上に実現する基本機能を切替えていく。これにより、例えば実行が要求された機能Ｘが図５に示す機能Ａの場合には、基本機能１、基本機能２、基本機能３、基本機能４の順に回路５７が再構成されて、各基本機能が実行される。
【００６７】
ステップ１１２では、主制御部４０に対して機能Ｘの実行が終了した旨の終了通知を送信する。
【００６８】
一方、ステップ１０２で、機能Ｘが以前に実行した機能であると判断した場合には、既に機能Ｘを実現するための回路情報は記憶部４６の受信情報記憶領域６２に記憶されているため、該記憶されている回路情報を用いて再度回路５７を再構成すればよい。従って、ステップ１１０に移行し、上記と同様に回路５７を再構成して機能Ｘを実行する。
【００６９】
次に、回路情報生成装置１２における生成制御処理について説明する。図８のステップ２００では、情報処理装置１４からの機能Ｘの回路情報要求の受信待ちを行う。ステップ２００で、情報処理装置１４から機能Ｘの回路情報要求を受信した場合には、ステップ２０２で、変数ｎに１をセットする。
【００７０】
ステップ２０４では、要求のあった機能Ｘの機能管理データを第１記憶部２６から読み出して取得し、ｎが、該機能管理データに格納されている基本機能数より大きいか否かを判断する。ｎが基本機能数以下の場合には、ステップ２０６で、機能Ｘの機能管理データの、第ｎ番目に実行される基本機能に対応する管理データアドレス８２が示す記憶領域に格納された基本機能管理データを読み出して取得し、該基本機能管理データの回路情報アドレス８４にＮＵＬＬが設定されているか否かを判断する。回路情報アドレス８４にＮＵＬＬが設定されていれば、該基本機能の回路情報は未生成であるため、ステップ２０８に移行する。
【００７１】
ステップ２０８では、回路情報生成プログラムを起動して実行し、回路情報を生成する。具体的には、上記読み出して取得した基本機能管理データの、プログラムアドレス８６が示す記憶領域から、該ｎ番目の基本機能に対応するソースプログラムを読出し、該読み出したソースプログラムに基づいて、該ｎ番目の基本機能を回路５７上に実現するための回路情報を生成して回路情報記憶領域３５の空き領域に格納する。
【００７２】
ステップ２１０では、上記基本機能の回路情報が記憶された記憶領域を示すアドレス値を、該基本機能に対応する基本機能管理データの回路情報アドレス８４として登録する。これによりＮＵＬＬが回路情報を記憶した記憶領域のアドレス値に変更される。
【００７３】
ステップ２１０の後は、ステップ２１２に移行し、上記第ｎ番目に実行される基本機能の回路情報が情報処理装置１４に転送されるよう、第ｎ番目の転送情報をＤＭＡ転送リストに登録する。具体的には、回路情報アドレス８４の値（転送元アドレス）、回路情報のデータサイズ（転送サイズ）、情報処理装置１４のアドレス（転送先アドレス）をＤＭＡ転送リストに登録する。
【００７４】
ステップ２１４では、ｎに１を加算し、ステップ２０４に戻る。
【００７５】
一方、ステップ２０６で、機能Ｘの機能管理データの、第ｎ番目に実行される基本機能に対応する管理データアドレス８２が示す記憶領域に格納された基本機能管理データの回路情報アドレス８４にＮＵＬＬが設定されていないと判断した場合には、既に回路情報は生成済であるため、ステップ２０８、ステップ２１０をスキップし、ステップ２１２に移行する。ステップ２１２では、第ｎ番目の転送情報として、該回路情報アドレス８４の値（転送元アドレス）、回路情報のデータサイズ（転送サイズ）、情報処理装置１４のアドレス（転送先アドレス）をＤＭＡ転送リストに登録し、ステップ２１４でｎに１を加算してステップ２０４に戻る。
【００７６】
ステップ２０４で、ｎが、機能Ｘの機能管理データに格納されている基本機能数より大きいと判断した場合には、ステップ２１６に移行する。
【００７７】
ステップ２１６では、転送準備完了通知を情報処理装置１４に送信する。ステップ２１８では、ＤＭＡ転送リストにしたがってＤＭＡ転送されるようＤＭＡＣ２３を起動する。起動したＤＭＡＣ２３は、ＤＭＡ転送リストにしたがって、情報処理装置１４に機能Ｘの回路情報を転送する。
【００７８】
ここで、具体例を挙げて説明する。情報処理装置１４において図５に示す機能Ａの後に機能Ｂの実行要求があった場合には、機能Ｂを構成する基本機能のうち機能Ａと共通する基本機能１〜３は既に生成済である。従って、この場合には、第１〜３番目の基本機能については、対応する回路情報アドレス８４にはＮＵＬＬではないアドレス値が既に設定されているため、ステップ２０６で肯定判断され、回路情報の生成は行われない。従って、機能Ｂについては、第４番目に実行される基本機能５の回路情報を生成するだけでよい。
【００７９】
なお、本実施の形態では、要求された機能が以前実行した機能か否かを機能実行部４４が判断し、以前実行していなければ、該機能を構成する全ての基本機能の回路情報を要求し、回路情報生成装置１２は、該機能を構成する全ての基本機能の回路情報を情報処理装置１４に送信する例について説明したが、これに限定されない。
【００８０】
例えば、回路情報生成装置１２は、回路情報の送信履歴を保存しておき、該送信履歴に基づいて、該機能を構成する全ての基本機能の回路情報を情報処理装置１４に送信するのではなく、送信済みの回路情報を除く回路情報を情報処理装置１４に送信し、以前送信したことがある回路情報は送信しないようにしてもよい。また、例えば、機能実行部４４が、要求された機能を構成する基本機能の各々について以前実行した基本機能か否か（回路情報が既に記憶部４６に記憶されているか否か）を判断し、回路情報生成装置１２に対して機能単位ではなく基本機能単位で回路情報を要求するように構成し、回路情報生成装置１２は、要求のあった基本機能の回路情報のみを生成して情報処理装置１４に送信するようにしてもよい。
【００８１】
このように、回路情報生成装置１２から情報処理装置１４に対して、機能単位ではなく基本機能単位で回路情報を送信する場合には、情報処理装置１４の記憶部４６には基本機能毎に回路情報が記憶されて管理され、同一の回路情報が重複して記憶されることはない。また、この場合には、機能実行部４４で、各機能を構成する基本機能及び実行順序を示す情報を保持する必要がある。なお、この情報を回路情報生成装置１２から情報処理装置１４に対して送信するようにしてもよい。機能実行部４４は、自ら保持している或いは回路情報生成装置１２から受信した、各機能を構成する基本機能及び実行順序を示す情報に基づいて順に回路を再構成して要求された機能を実行する。
【００８２】
また、本実施の形態では、回路情報生成装置１２のＤＭＡＣ２３及び情報処理装置１４のＤＭＡＣ５１により回路情報をＤＭＡ転送する例について説明したが、回路情報生成装置１２のＣＰＵ２０及び情報処理装置１４のＣＰＵ５２を介して回路情報の送受信を行うようにしてもよい。
【００８３】
また、本実施の形態では、回路情報を回路情報生成装置１２が必要に応じて生成して情報処理装置１４に送信する例について説明したが、回路情報生成装置１２での生成制御処理を主制御部４０が行うようにしてもよい。すなわち、主制御部４０が、上記第１記憶部２６に記憶されている各種データを有し、回路情報生成プログラム、生成制御処理プログラムを実行して、要求のあった機能の回路情報を必要に応じて生成して機能実行部４４に供給してもよい。
【００８４】
［第２の実施の形態］
【００８５】
本実施の形態では、要求された機能を構成する各基本機能から回路５７に代えてソースプログラムを実行形式に変換したプログラムを用いて実行する特定の基本機能を決定し、該特定の基本機能については、回路情報に代えてソースプログラムを情報処理装置１４に送信する例について説明する。
【００８６】
本実施の形態に係る回路情報生成装置１２の概略構成は、第１の実施の形態と同じである。ただし、図９に示すように、第１記憶部２６の基本機能管理データ記憶領域３４に記憶される基本機能管理データの構成が異なる。
【００８７】
本実施の形態に係る基本機能管理データは、基本機能を識別する識別情報８３、回路情報アドレス８４、及びプログラムアドレス８６に加え、基本機能を回路５７を用いて実行する場合に要する実行時間８５（以下、ＨＷ実行時間８５と呼称）、及び基本機能をソースプログラムを実行形式に変換したプログラムを用いて実行する場合に要する実行時間８７（以下、ＳＷ実行時間８７と呼称）を含んで構成される。
【００８８】
本実施の形態に係る情報処理装置１４の概略構成も、第１の実施の形態と同じである。ただし、記憶部４６の受信情報記憶領域６２には、回路情報だけでなく場合に応じてソースプログラムも受信され記憶される。機能実行部４４のＣＰＵ５２は、回路情報生成装置１２から受信したソースプログラムを実行形式のプログラムに変換し、該変換したプログラムを実行することにより基本機能を実行する。なお、ソースプログラムを実行形式のプログラムに変換するためのプログラムは予めＲＯＭ５３等に記憶されている。
【００８９】
なお、本実施の形態でも、受信情報記憶領域６２には、回路情報生成装置１２から受信した回路情報及びソースプログラムが機能毎に記憶され管理される。したがって、複数の機能が互いに共通する基本機能を有する場合でも、該共通する基本機能に対応する回路情報またはソースプログラムを該複数の機能毎に別々に記憶するようにしている。
【００９０】
図１０は、本実施の形態に係る回路情報生成装置１２のＣＰＵ２０により実行される生成制御処理の流れを示すフローチャートである。なお、ここでは、いずれの基本機能もＨＷ実行時間８５がＳＷ実行時間８７以下であるものとする。
【００９１】
ステップ３００では、情報処理装置１４から機能Ｘの回路情報の要求の受信待ちを行う。ステップ３００で、回路情報生成装置１２から機能Ｘの回路情報の要求を受信した場合には、ステップ３０２で、回路情報生成ルーチンを実行し、各基本機能の回路情報を必要に応じて生成する。
【００９２】
図１１は、ステップ３０２で行われる回路情報生成ルーチンの流れを示すフローチャートである。なお、図１１において、図８と同じステップには同一の符号を付し、ここでは異なるステップのみ説明する。
【００９３】
ステップ２０４ａでは、要求のあった機能Ｘの機能管理データを第１記憶部２６から読み出して取得し、ｎが、該機能管理データに格納されている基本機能数より大きいか否かを判断し、ｎが基本機能数以下の場合には、ステップ２０６に移行し、ｎが基本機能数を超えた場合には、本処理ルーチンを終了する。すなわち、図１１の回路情報生成ルーチンでは、図８に示すステップ２１６、２１８の処理は行われない。
【００９４】
ステップ３０２の回路情報生成ルーチン終了後は、ステップ３０４に移行する。
【００９５】
ステップ３０４では、機能Ｘの機能管理データの各基本機能の基本機能管理データを読み出して取得し、該基本機能管理データに基づいて、機能Ｘの各基本機能毎のＨＷ実行時間を合計した値を求めて変数Ｓにセットする。
【００９６】
ステップ３０６では、Ｓが予め定められた性能目標値未満であるか否かを判断する。ここでいう性能目標値とは、機能Ｘの実行時間の目標値である。性能目標値は、機能毎に予め設定しておくようにしてもよいし、主制御部４０のタッチパネルディスプレイ７４から使用者が指定するように構成し、該指定された性能目標値を、機能Ｘの回路情報の要求の際、情報処理装置１４から回路情報生成装置１２に送信するようにしてもよい。ここで、Ｓが性能目標値未満であると判断した場合には、ステップ３０８に移行する。
【００９７】
ステップ３０８では、変数ｎに１をセットする。
【００９８】
ステップ３１０では、ｎが、機能Ｘの機能管理データに格納されている基本機能数より大きいか否かを判断する。ｎが基本機能数以下の場合には、ステップ３１２で、機能Ｘの機能管理データの第ｎ番目の基本機能に対応する管理データアドレス８２が示す記憶領域に格納された基本機能管理データを読み出して取得し、第ｎ番目に実行される基本機能のＳＷ実行時間からＨＷ実行時間を差し引いた値を求めて、Ｓに加算する。
【００９９】
ステップ３１４では、Ｓが予め定められた性能目標値以下であるか否かを判断する。ここで、Ｓが性能目標値以下であると判断した場合には、ステップ３１６に移行する。ステップ３１６では、ＤＭＡ転送リストの第ｎ番目の基本機能の回路情報をＤＭＡ転送するための転送情報を、第ｎ番目の基本機能のソースプログラムをＤＭＡ転送するための転送情報に変更する。具体的には、第ｎ番目の転送情報のうち、転送元アドレスを第ｎ番目の基本機能管理データのプログラムアドレス８６が示すアドレスに変更し、転送サイズを該プログラムアドレス８６に記憶されているソースプログラムのサイズに変更する。
【０１００】
その後、ステップ３１８では、ｎに１を加算し、ステップ３１０に戻る。
【０１０１】
ステップ３０６でＳが性能目標値以上であると判断された場合、ステップ３１０でｎが基本機能数を超えていると判断された場合、及びステップ３１４で、Ｓが性能目標値を超えていると判断された場合には、ステップ３２０に移行する。
【０１０２】
ステップ３２０では、転送準備完了通知を情報処理装置１４に送信する。ステップ３２２では、ＤＭＡ転送リストにしたがってＤＭＡ転送対象の情報が情報処理装置１４に送信されるようＤＭＡＣ２３を起動する。起動したＤＭＡＣ２３は、ＤＭＡ転送リストにしたがって、ＤＭＡ転送を行う。
【０１０３】
なお、本実施の形態に係る機能実行部４４のＣＰＵ５２は、図７のフローチャートにしたがって機能実行処理を実行するが、ステップ１１０における処理が第１の実施の形態と異なる。
【０１０４】
ステップ１００からステップ１０８までの処理は第１の実施の形態と同じである。ステップ１１０では、回路情報生成装置１２から受信した回路情報及びソースプログラムを記憶部４６から順に読み出して機能Ｘを構成する各基本機能を順に実行する。すなわち、回路情報生成装置１２から受信して記憶したデータが回路情報である場合には、ＣＰＵ５２は、再構築制御部５０を起動して回路５７を再構成させ、基本機能を実行させる。また、回路情報生成装置１２から受信して記憶したデータがソースプログラムである場合には、ＣＰＵ５２は、ソースプログラムを実行形式に変換したプログラムを実行して基本機能を実行する。
【０１０５】
以下、ステップ１１０の処理について具体例を挙げて説明する。以下では、回路５７により基本機能を実行することをハードウェア処理といい、ＣＰＵ５２がソースプログラムを変換した実行形式のプログラムを実行することにより基本機能を実行することをソフトウェア処理という。
【０１０６】
例えば、機能実行部４４で図５に示す機能Ａについて、回路情報生成装置１２から、基本機能１のソースプログラム、基本機能２のソースプログラム、基本機能３の回路情報、及び基本機能４の回路情報を受信した場合には、基本機能１及び基本機能２については、ソフトウェア処理を行い、基本機能３及び基本機能４については、ハードウェア処理を行う。
【０１０７】
なお、機能Ａに続いて図５に示す機能Ｂが要求された場合であって、機能Ｂについて、回路情報生成装置１２から、基本機能１のソースプログラム、基本機能２のソースプログラム、基本機能３の回路情報、及び基本機能５の回路情報を受信した場合には、上記機能Ａと同様に基本機能１及び基本機能２については、ソフトウェア処理を行い、基本機能３及び基本機能５については、ハードウェア処理を順に行うが、ここで、機能Ｂが機能Ａの処理結果を用いずに独立に実行される機能である場合には、例えば、ＣＰＵ５２は、回路５７での機能Ａの基本機能３及び基本機能４を実行中に、機能Ｂの基本機能１及び基本機能２を実行する。
【０１０８】
ここで、図１２、及び図１３を用いて、ソフトウェアとハードウェアの使用効率について説明する。
【０１０９】
図１２は、機能Ｃと機能Ｄの各々を構成する各基本機能と、各基本機能毎のＳＷ実行時間及びＨＷ実行時間の一例を示した図である。各ＨＷ実行時間、ＳＷ実行時間を示す数字は時間を概念的に示したものであり、分や秒などを具体的に規定するものではない。機能Ｃは、基本機能１、基本機能２を順に実行することで実現する機能である。機能Ｄは基本機能３を実行することで実現する機能である。ここで、機能Ｃ及び機能Ｄは独立に実行される機能であり、一方の機能の処理結果を用いて他方の機能が実行される関係にはない。
【０１１０】
図示されるように、基本機能１のＳＷ実行時間は１０、ＨＷ実行時間は５である。基本機能２のＳＷ実行時間は５、ＨＷ実行時間は５である。基本機能３のＳＷ実行時間は２０、ＨＷ実行時間は５である。なお、ここで機能Ｃの性能目標値を１５とし、機能Ｄの性能目標値を１０とする。
【０１１１】
機能Ｄについては、性能目標値（１０）を満たすためには、基本機能３をハードウェア処理で行う必要があるが、機能Ｃについては、基本機能１及び基本機能２の双方をハードウェア処理とする場合、基本機能１はソフトウェア処理とし、基本機能２はハードウェア処理とする場合のいずれの場合でも、性能目標値（１５）は満たされる。
【０１１２】
ここで、機能Ｃ及び機能Ｄの各々の基本機能をハードウェア処理で行うパターン１、及び、機能Ｃの基本機能１をソフトウェア処理で行うと共に基本機能２をハードウェア処理で行い、機能Ｄの基本機能３をハードウェア処理で行うパターン２の２つのパターンを例に挙げる。なお、パターン１では、機能Ｄは機能Ｃが終了されるまで待たされるが、パターン２では、機能Ｃの終了を待たずに実行される。
【０１１３】
図１３に、パターン１及びパターン２のハードウェア及びソフトウェア使用率を示す。なお、ここでいうハードウェア使用率とは、機能全体の実行時間に対するＨＷ実行時間の合計の割合をいい、ソフトウェア使用率とは、機能全体の実行時間に対するＳＷ実行時間の合計の割合をいう。
【０１１４】
なお、パターン１の場合の、単位時間１５におけるハードウェア使用率及びソフトウェア使用率は以下の通りである。
・ハードウェア使用率＝１５／１５＝１００％
・ソフトウェア使用率＝０％
【０１１５】
パターン２の場合の、単位時間１５におけるハードウェア使用率及びソフトウェア使用率は以下の通りである。
・ハードウェア使用率＝１０／１５＝６６％
・ソフトウェア使用率＝１０／１５＝６６％
【０１１６】
なお、上記では図１０を用いて、回路情報を生成した後にソフトウェア処理を行う特定の基本機能を求める例について説明したが、回路情報を生成する前にソフトウェア処理を行う特定の基本機能を求めるようにしてもよい。
【０１１７】
図１４は、本実施の形態に係る回路情報生成装置１２のＣＰＵ２０により実行される生成制御処理の他の例を示すフローチャートである。なお、図１４において、図１０と同じステップには同一の符号を付し、ここでは、異なるステップのみ説明する。
【０１１８】
ステップ３００で肯定判断された場合には、ここでは回路情報生成ルーチンは行わず、ステップ３０４〜ステップ３１７の処理を行う。ステップ３１７では、ＤＭＡ転送リストに、第ｎ番目の基本機能のソースプログラムをＤＭＡ転送するための転送情報を登録する。
【０１１９】
ステップ３０６で、Ｓが性能目標値以上であると判断された場合、ステップ３１０で、ｎが基本機能数を超えていると判断された場合、及びステップ３１４で、Ｓが性能目標値を超えていると判断された場合には、ステップ３１９に移行する。
【０１２０】
ステップ３１９では、回路情報生成ルーチンを実行し、各基本機能の回路情報を必要に応じて生成する。
【０１２１】
図１５は、ステップ３１９で行われる回路情報生成ルーチンの流れを示すフローチャートである。なお、図１５において、図１１と同じステップには同一の符号を付し、ここでは異なるステップのみ説明する。
【０１２２】
ステップ２０４ａで、ｎが基本機能数以下であると判断した場合には、ステップ２０６の前に、ステップ２０５を行う。ステップ２０５では、ＤＭＡ転送リストのｎ番目の転送情報が存在するか否かを判断する。ＤＭＡ転送リストにｎ番目の転送情報が存在している場合には、ｎ番目の基本機能はソフトウェア処理が行われる基本機能であって、ソースプログラムを情報処理装置１４に対して転送するための転送情報が既にＤＭＡ転送リストに登録されていることを示している。したがって、この基本機能については回路情報を生成する必要がないため、ステップ２１４に移行し、ｎに１を加算してステップ２０４ａに戻る。一方、ｎ番目の転送情報が存在しない場合には、ｎ番目の基本機能はハードウェア処理が行われる基本機能であるため、回路情報が必要である。したがって、ステップ２０６以降の処理を行う。
【０１２３】
なお、上記では、図１０及び図１４において、基本機能をソフトウェア処理するか否かを基本機能の実行順に判断していったが、これに限定されず、例えば、実行順で最後の方から判断していくようにしてもよい。また、ＳＷ実行時間が短い或いは長い基本機能から順に判断していって、Ｓが性能目標値となる範囲内でソフトウェア処理に変更するようにしてもよい。
【０１２４】
また、上記では、要求された機能の実行時間が性能目標値以下となる範囲内で、各基本機能をハードウェア処理からソフトウェア処理に変更する例について説明したが、これに限定されず、例えば、要求された機能の実行において単位時間あたりに処理されるデータ量が予め定められた目標値以下となる範囲内で、各基本機能をハードウェア処理からソフトウェア処理に変更するようにしてもよい。例えば、基本機能管理データに、ソフトウェア処理における単位時間あたりに処理されるデータ量と、ハードウェア処理における単位時間あたりに処理されるデータ量とを各基本機能毎に登録しておくと共に、単位時間あたりに処理されるデータ量の目標値を性能目標値として予め設定しておく。そして、ステップ３０４では、変数Ｓに、各基本機能毎の単位時間あたりに処理されるデータ量の平均値をセットする。更に、ステップ３１２では、基本機能をソフトウェア処理に変更した場合の平均値を計算し、ステップ３１４で性能目標値と比較して、Ｓが性能目標値以下となる範囲内で基本機能をソフトウェア処理に変更するようにしてもよい。
【０１２５】
また、上記実施の形態では、Ｓが性能目標値以下となるように制御する例について説明したが、これに限定されず、性能目標値に代えて性能目標範囲（上限及び下限）を定めておき、Ｓがこの範囲内となるよう制御するようにしてもよい。
【０１２６】
また、各ＳＷ実行時間に基づいてソフトウェア処理を行う基本機能及びハードウェア処理を行う基本機能を決定してもよい。例えば、ＳＷ実行時間の合計に対する各基本機能のＳＷ実行時間の割合（以下、負荷の割合と呼称）を求め、この割合を用いて決定してもよいし、ＳＷ実行時間をそのまま用いて決定してもよい。
【０１２７】
例えば、図１６に示すように、機能Ｅが基本機能１、基本機能２、基本機能３を順に実行することにより実現される機能であって、これら各基本機能がソフトウェア処理される場合の各基本機能の負荷の割合が、
・基本機能１：１０％
・基本機能２：８０％
・基本機能３：１０％
であるとした場合、最も負荷の割合が高い基本機能２については、ハードウェア処理が行われるよう、回路情報を生成する。そして、それ以外の基本機能１，３については、ソフトウェア処理を行う基本機能と判断して、回路情報は生成せず、ソースプログラムを情報処理装置１４に送信するようにしてもよい。
【０１２８】
更に、図１７に示すように、負荷の割合が最も高い基本機能を示す情報８８（以下、負荷情報８８）を予め機能管理データに含めて記憶しておくようにしてもよい。本例では、基本機能２を示す負荷情報８８が機能管理データに記憶される。これにより、基本機能２については回路情報が生成されるが、ソフトウェア処理を行う基本機能１，３の回路情報については生成されない。もちろん、基本機能２についての回路情報が既に生成済みである場合には、既に生成済みの回路情報を使用すればよい。
【０１２９】
もちろん、図１７に示すように、ハードウェア処理を行う基本機能として、最も負荷の割合が高い基本機能を予め指定して回路情報の生成を制御する場合に限られず、動的に各基本機能管理データのＳＷ実行時間８７から、最も負荷の割合が高い基本機能を求めて、該求めた基本機能についてハードウェア処理が行われるように制御し、それ以外の基本機能はソフトウェア処理が行われるように制御してもよい。また、負荷の割合が予め定められた割合より高い基本機能あるいはＳＷ実行時間が予め定められた時間よりも長い基本機能については、ハードウェア処理が行われるようにし、それ以外の基本機能についてはソフトウェア処理が行われるように制御してもよい。
【０１３０】
また、上記実施の形態は一例であってこれに限定されない。例えば、回路情報生成装置１２が、回路情報及びソースプログラムの送信履歴を保存しておき、該送信履歴に基づいて、送信済みの回路情報及びソースプログラムを除く回路情報及びソースプログラムを情報処理装置１４に送信し、以前送信したことがある回路情報及びソースプログラムは送信しないようにしてもよい。
【０１３１】
このように、回路情報生成装置１２から情報処理装置１４に対して、機能単位ではなく基本機能単位で回路情報及びソースプログラムを送信する場合には、情報処理装置１４の記憶部４６には基本機能毎に回路情報及びソースプログラムが記憶されて管理され、同一の回路情報及びソースプログラムが重複して記憶されることはない。また、この場合には、機能実行部４４で、各機能を構成する基本機能及び実行順序を示す情報を保持する必要がある。なお、この情報を回路情報生成装置１２から情報処理装置１４に対して送信するようにしてもよい。機能実行部４４は、自ら保持している或いは回路情報生成装置１２から受信した、各機能を構成する基本機能及び実行順序を示す情報に基づいて順に回路を再構成して、或いはプログラムを実行することにより要求された機能を実行する。
【０１３２】
また、回路情報生成装置１２での生成制御を主制御部４０が行うようにしてもよい。すなわち、主制御部４０が、回路情報生成装置１２の第１記憶部２６に記憶されている各種データを有し、回路情報生成プログラム、生成制御処理プログラムを実行して、要求のあった機能の回路情報及びソースプログラムを機能実行部４４に供給してもよい。
【０１３３】
また、ソースプログラムを実行形式に変換して実行するＣＰＵは、機能実行部４４に設けられたＣＰＵ５２に限定されず、例えば、主制御部４０のＣＰＵ７０が実行するようにしてもよいし、ＣＰＵ５２及びＣＰＵ７０とは別にＣＰＵを設け、該ＣＰＵにより実行するようにしてもよい。
【０１３４】
また、本実施の形態では、基本機能毎のソースプログラムを情報処理装置１４に送信し、機能実行部４４のＣＰＵ５２がソースプログラムを実行形式のプログラムに変換して実行することによりソフトウェア処理を行う例について説明したが、回路情報生成装置１２でソースプログラムを実行形式に変換し、該変換済みのプログラムを回路情報生成装置１２から情報処理装置１４に送信するようにしてもよい。また、動的に変換して送信するのではなく、予め実行形式に変換済みのプログラムを回路情報生成装置１２に記憶しておき、該実行形式のプログラムを上記ソースプログラムに代えて情報処理装置１４に送信するようにしてもよい。
【０１３５】
［第３の実施の形態］
【０１３６】
第１及び第２の実施の形態では、主制御部４０から要求された機能を機能実行部４４が実行する例について説明したが、本実施の形態では、機能実行部４４だけでなく回路情報生成装置１２も、要求された機能を実行する機能実行装置として動作する場合を例に挙げて説明する。
【０１３７】
本実施の形態に係る回路情報生成装置１２及び情報処理装置１４の構成は第１の実施の形態と同じであるため、構成についての説明を省略する。
【０１３８】
図１８は、本実施の形態に係る情報処理装置１４の機能実行部４４のＣＰＵ５２により実行される機能実行処理の流れを示すフローチャートである。また、図１９は、本実施の形態に係る回路情報生成装置１２のＣＰＵ２０により実行される生成制御処理の流れを示すフローチャートである。
【０１３９】
まず、情報処理装置１４における機能実行処理について説明する。図１８のステップ４００では、主制御部４０から機能Ｘの実行要求を受け付けるまで待機する。主制御部４０から機能Ｘの実行要求を受け付けた場合には、ステップ４０２に移行する。
【０１４０】
ステップ４０２では、回路情報生成装置１２に機能Ｘの実行を依頼する実行依頼を送信する。
【０１４１】
ステップ４０４では、回路情報生成装置１２から機能Ｘで使用するデータ（例えば、画像データ記憶領域６３に記憶されている画像データ等）の要求があったか否かを判断し、ここで否定判断した場合には、ステップ４１２で、回路情報生成装置１２から機能Ｘの実行依頼を受信したか否かを判断する。ステップ４１２で回路情報生成装置１２から機能Ｘの実行依頼を受信していないと判断した場合には、ステップ４０４に戻る。
【０１４２】
また、ステップ４０４で、機能Ｘで使用するデータの要求があったと判断した場合には、ステップ４０６で、要求されたデータを回路情報生成装置１２に送信する。要求されたデータを全て送信した場合には、ステップ４０８で、データ送信終了通知を回路情報生成装置１２に送信する。
【０１４３】
ステップ４１０では、回路情報生成装置１２から、機能Ｘの実行結果の受信待ちを行う。ステップ４１０で、回路情報生成装置１２から機能Ｘの実行結果を受信した場合には、ステップ４２２で、主制御部４０に対して機能Ｘの実行が終了した旨の終了通知を送信する。
【０１４４】
一方、ステップ４０４で否定判断し、ステップ４１２で肯定判断した場合には、ステップ４１４で、機能Ｘが以前に実行した機能と同じか否かを判断する。機能Ｘが以前に実行した機能でなければ、ステップ４１６に移行する。ステップ４１６では、回路情報生成装置１２からの転送準備完了通知を受信するまで待機する。回路情報生成装置１２から転送準備完了通知を受信した場合には、ステップ４１８で、ＤＭＡＣ５１を起動する。起動したＤＭＡＣ５１は、通信Ｉ／Ｆ５５を介して回路情報生成装置１２から受信した回路情報を記憶部４６に転送して記憶する。
【０１４５】
ステップ４２０では、第１の実施の形態で説明したステップ１１０と同様に、受信した回路情報を用いて回路５７を再構成し、機能Ｘを実行する。そして、ステップ４２２で、主制御部４０に対して機能Ｘの実行が終了した旨の終了通知を送信する。
【０１４６】
一方、ステップ４１２で、機能Ｘが以前に実行した機能であると判断した場合には、すなわち、既に機能Ｘを実現するための回路情報が記憶部４６の受信情報記憶領域６２に記憶されている場合には、ステップ４２０で、既に記憶されている回路情報を用いて回路５７を再構成し、機能Ｘを実行する。
【０１４７】
次に、回路情報生成装置１２における生成制御処理について説明する。図１９のステップ５００では、情報処理装置１４から機能Ｘの実行依頼の受信待ちを行う。ステップ５００で、回路情報生成装置１２から機能Ｘの実行依頼を受信した場合には、ステップ５０２で、処理多重度が予め定められた閾値以上であるか否かを判断する。ここで処理多重度とは、回路情報生成装置１２で実行中及び実行待ちの機能の数をいい、回路情報生成装置１２の負荷を示す情報の１つである。
【０１４８】
ステップ５０２で、処理多重度が閾値以上であると判断した場合には、ステップ５１２で、機能Ｘの実行依頼を情報処理装置１４に送信する。
【０１４９】
ステップ５０６では、以前に機能Ｘの回路情報を情報処理装置１４に送信したことがあるか否かを判断する。例えば、回路情報生成装置１２は、各機能毎に回路情報の送信履歴を第１記憶部２６または第２記憶部２７等に保存しておき、該送信履歴に基づいて、判断してもよい。また、情報処理装置１４から、機能Ｘが以前情報処理装置１４で実行された機能と同じか否かを示す情報を受け取るようにしてもよい。ステップ５０６で、機能Ｘの回路情報はまだ送信されていないと判断した場合には、ステップ５０８で回路情報を生成する。ステップ５０８での回路情報の生成は、図１１に示した処理ルーチンと同じであるため説明を省略する。
【０１５０】
ステップ５１０では、転送準備完了通知を情報処理装置１４に送信する。ステップ５１２では、ＤＭＡ転送リストにしたがってＤＭＡ転送対象の情報（ここでは回路情報）が情報処理装置１４に送信されるようＤＭＡＣ２３を起動する。起動したＤＭＡＣ２３は、ＤＭＡ転送リストにしたがって、情報処理装置１４に回路情報を転送する。
【０１５１】
また、ステップ５０６で、以前に機能Ｘの回路情報を情報処理装置１４に送信したことがあると判断した場合には、ステップ５０８〜５１２の処理は行わず終了する。
【０１５２】
一方、ステップ５０２で、処理多重度が閾値未満であると判断した場合には、ステップ５１４で、情報処理装置１４に対して、機能Ｘにおいて使用するデータ（例えば画像処理対象の画像データ等）を要求する。ステップ５１６では、情報処理装置１４から、上記要求したデータを受信する。ステップ５１８では、情報処理装置１４から、要求したデータの送信終了通知を受信したか否かを判断する。ステップ５１８で、肯定判断した場合には、ステップ５２０で、機能Ｘを構成する各基本機能のソースプログラムを順次実行形式に変換して実行することにより、機能Ｘを実行する。
【０１５３】
ステップ５２２では、機能Ｘの実行結果を情報処理装置１４に送信する。
【０１５４】
なお、本実施の形態では、回路情報生成装置１２の負荷を示す情報として処理多重度を用いたが、これに限定されない。例えば、回路情報生成装置１２の現在のＣＰＵ利用率であってもよい。
【０１５５】
また、本実施の形態に、上記第２の実施の形態で説明した回路情報生成方法を適用してもよい。例えば、機能Ｘを情報処理装置１４の機能実行部４４で実行させる場合には、第２の実施の形態で説明したように、予め定められた条件に応じてソフトウェア処理を行う特定の基本機能を求め、該特定の基本機能については、回路情報に代えてソースプログラムを送信するようにし、それ以外の基本機能については回路情報を生成して送信するようにしてもよい。
【０１５６】
また、本実施の形態では、回路情報生成装置１２が、要求された機能を実行する機能実行装置として動作する場合を例に挙げて説明したが、例えば、ＣＰＵを含むコンピュータを備え、基本機能をソフトウエア処理することが可能な機能実行装置を回路情報生成装置１２及び情報処理装置１４とは別にネットワーク１６上に設け（図示省略）、回路情報生成装置１２に代えて、該機能実行装置の負荷を示す値が閾値未満であれば、該機能実行装置に要求された機能を実行させるように制御してもよい。すなわち、回路情報生成装置１２が該機能実行装置の負荷を示す値を該機能実行装置から取得して閾値未満か否かを判断し、該機能を構成する各基本機能のソースプログラムを該機能実行装置に送信して実行させる。
【０１５７】
また、実行要求される機能は、画像処理の機能に限るものではなく、回路情報に基づいて再構成される回路により実行される様々な機能に適用される。
【０１５８】
また、上記第１から第３の実施の形態では、機能実行部４４のＣＰＵ５２により回路情報生成装置１２に対して回路情報を要求する例について説明したが、例えば、主制御部４０のＣＰＵ７０により回路情報生成装置１２に対して回路情報を要求するように構成してもよい。
【０１５９】
また、上記第１から第３の実施の形態では、１台の情報処理装置１４がネットワーク１６に接続されている例について説明したが、情報処理装置１４は複数台ネットワーク１６に接続されていてもよい。回路情報生成装置１２は、複数の情報処理装置１４から、機能の回路情報の要求を受け付け、該受け付けた要求の各々に対して回路情報を（必要であれば生成して）送信する。
【符号の説明】
【０１６０】
１０ 機能実行システム
１２ 回路情報生成装置
１４ 情報処理装置
１６ ネットワーク
２０ ＣＰＵ
２１ ＲＯＭ
２２ ＲＡＭ
２６ 第１記憶部
２７ 第２記憶部
４０ 主制御部
４４ 機能実行部
４６ 記憶部
５０ 再構成制御回路
５２ ＣＰＵ
５３ ＲＯＭ
５４ ＲＡＭ
５７ 回路
【特許請求の範囲】
【請求項１】
１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、
回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域と、
要求された機能を構成する該機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能を実行する回路が再構成され、該再構成された回路により前記要求された機能が実行されるように制御する制御手段と、
を有する回路情報生成装置。
【請求項２】
１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、
回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域と、
要求された機能を構成する該機能中の基本機能が、該要求された機能の実行に関する予め定められた条件に応じて、前記ソースプログラムを実行形式に変換したプログラムを用いて実行される特定の基本機能として定められた場合には、前記第１の記憶領域に記憶されているソースプログラムを実行形式に変換したプログラムを用いて該特定の基本機能が実行されるように制御する第１の制御と、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能中の基本機能を実行する回路が再構成され、該再構成された回路により前記特定の基本機能を除く基本機能が実行されるように制御する第２の制御とにより、前記要求された機能が実行されるように制御する制御手段と、
を有する回路情報生成装置。
【請求項３】
請求項１に記載の回路情報生成装置と、
回路情報を用いて再構成され、前記要求された機能を実行する回路を備えた機能実行装置と、
を備えた機能実行システム。
【請求項４】
請求項２に記載の回路情報生成装置と、
回路情報を用いて再構成され、前記要求された機能を実行する回路、及び前記ソースプログラムを実行形式に変換したプログラムを実行するコンピュータを有する前記機能実行装置と、
を備えた機能実行システム。
【請求項５】
前記ソースプログラムを実行形式に変換したプログラムを実行するコンピュータを有する第２の機能実行装置を更に備え、
前記回路情報生成装置に、前記第２の機能実行装置の負荷の状態を示す情報を取得し、該取得した負荷の状態を示す情報が予め定められた条件を満たす場合には、前記要求された機能が前記機能実行装置で実行されないよう前記制御手段の制御に代えて、前記第１の記憶領域に記憶されているソースプログラムを実行形式に変換したプログラムを用いて前記要求された機能が前記第２の機能実行装置で実行されるように制御する第２の制御手段を更に設けた
請求項３または請求項４に記載の機能実行システム。
【請求項６】
１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域とに接続されたコンピュータを、
要求された機能を構成する該機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能を実行する回路が再構成され、該再構成された回路により前記要求された機能が実行されるように制御する制御手段として機能させるためのプログラム。
【請求項７】
１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域とに接続されたコンピュータを、
要求された機能を構成する該機能中の基本機能が、該要求された機能の実行に関する予め定められた条件に応じて、前記ソースプログラムを実行形式に変換したプログラムを用いて実行される特定の基本機能として定められた場合には、前記第１の記憶領域に記憶されているソースプログラムを実行形式に変換したプログラムを用いて該特定の基本機能が実行されるように制御する第１の制御と、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能中の基本機能を実行する回路が再構成され、該再構成された回路により前記特定の基本機能を除く基本機能が実行されるように制御する第２の制御とにより、前記要求された機能が実行されるように制御する制御手段として機能させるためのプログラム。
【請求項１】
１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、
回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域と、
要求された機能を構成する該機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能を実行する回路が再構成され、該再構成された回路により前記要求された機能が実行されるように制御する制御手段と、
を有する回路情報生成装置。
【請求項２】
１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、
回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域と、
要求された機能を構成する該機能中の基本機能が、該要求された機能の実行に関する予め定められた条件に応じて、前記ソースプログラムを実行形式に変換したプログラムを用いて実行される特定の基本機能として定められた場合には、前記第１の記憶領域に記憶されているソースプログラムを実行形式に変換したプログラムを用いて該特定の基本機能が実行されるように制御する第１の制御と、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能中の基本機能を実行する回路が再構成され、該再構成された回路により前記特定の基本機能を除く基本機能が実行されるように制御する第２の制御とにより、前記要求された機能が実行されるように制御する制御手段と、
を有する回路情報生成装置。
【請求項３】
請求項１に記載の回路情報生成装置と、
回路情報を用いて再構成され、前記要求された機能を実行する回路を備えた機能実行装置と、
を備えた機能実行システム。
【請求項４】
請求項２に記載の回路情報生成装置と、
回路情報を用いて再構成され、前記要求された機能を実行する回路、及び前記ソースプログラムを実行形式に変換したプログラムを実行するコンピュータを有する前記機能実行装置と、
を備えた機能実行システム。
【請求項５】
前記ソースプログラムを実行形式に変換したプログラムを実行するコンピュータを有する第２の機能実行装置を更に備え、
前記回路情報生成装置に、前記第２の機能実行装置の負荷の状態を示す情報を取得し、該取得した負荷の状態を示す情報が予め定められた条件を満たす場合には、前記要求された機能が前記機能実行装置で実行されないよう前記制御手段の制御に代えて、前記第１の記憶領域に記憶されているソースプログラムを実行形式に変換したプログラムを用いて前記要求された機能が前記第２の機能実行装置で実行されるように制御する第２の制御手段を更に設けた
請求項３または請求項４に記載の機能実行システム。
【請求項６】
１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域とに接続されたコンピュータを、
要求された機能を構成する該機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能に対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能を実行する回路が再構成され、該再構成された回路により前記要求された機能が実行されるように制御する制御手段として機能させるためのプログラム。
【請求項７】
１または複数の基本機能から構成される機能を構成する前記基本機能に対応するソースプログラムを記憶した第１の記憶領域と、回路を再構成するための回路情報を前記基本機能に対応させて記憶するための第２の記憶領域とに接続されたコンピュータを、
要求された機能を構成する該機能中の基本機能が、該要求された機能の実行に関する予め定められた条件に応じて、前記ソースプログラムを実行形式に変換したプログラムを用いて実行される特定の基本機能として定められた場合には、前記第１の記憶領域に記憶されているソースプログラムを実行形式に変換したプログラムを用いて該特定の基本機能が実行されるように制御する第１の制御と、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されている場合には、該記憶されている回路情報を用いると共に、前記機能中の基本機能が前記特定の基本機能以外の基本機能であって、対応する回路情報が前記第２の記憶領域に記憶されていない場合には、前記第１の記憶領域に記憶されている前記機能中の基本機能に対応するソースプログラムを用いて前記機能中の基本機能に対応する回路情報を生成して前記第２の記憶領域に記憶し、該生成した回路情報を用いて、前記要求された機能中の基本機能を実行する回路が再構成され、該再構成された回路により前記特定の基本機能を除く基本機能が実行されるように制御する第２の制御とにより、前記要求された機能が実行されるように制御する制御手段として機能させるためのプログラム。
【図１】
【図２】
【図３】
【図４】
【図５】
【図６Ａ】
【図６Ｂ】
【図７】
【図８】
【図９】
【図１０】
【図１１】
【図１２】
【図１３】
【図１４】
【図１５】
【図１６】
【図１７】
【図１８】
【図１９】
【図２】
【図３】
【図４】
【図５】
【図６Ａ】
【図６Ｂ】
【図７】
【図８】
【図９】
【図１０】
【図１１】
【図１２】
【図１３】
【図１４】
【図１５】
【図１６】
【図１７】
【図１８】
【図１９】
【公開番号】特開２０１１−２８３３３（Ｐ２０１１−２８３３３Ａ）
【公開日】平成２３年２月１０日（２０１１．２．１０）
【国際特許分類】
【出願番号】特願２００９−１７０４８０（Ｐ２００９−１７０４８０）
【出願日】平成２１年７月２１日（２００９．７．２１）
【出願人】（０００００５４９６）富士ゼロックス株式会社 (21,908)
【Ｆターム（参考）】
【公開日】平成２３年２月１０日（２０１１．２．１０）
【国際特許分類】
【出願日】平成２１年７月２１日（２００９．７．２１）
【出願人】（０００００５４９６）富士ゼロックス株式会社 (21,908)
【Ｆターム（参考）】
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