表示装置、電子機器、表示装置の駆動方法
【課題】駆動トランジスタの焼付き現象に伴う劣化を防止する。
【解決手段】有機ＥＬ素子を発光状態から消光状態に遷移させた後に駆動トランジスタの閾値補正を行なう前には、直前の表示輝度に拘わらず駆動トランジスタのゲート・ソース間電圧Ｖgsを同じ状態にした後に、ゲート・ソース間電圧Ｖgsを閾値電圧を上回るように設定する。たとえば、電源駆動パルスDSL を第１電位Ｖcc_Hから第３電位Ｖcc_Mにして消光し、映像信号Ｖsig のオフセット電位Ｖofs 期間に書込駆動パルスWSをＨレベルにしてサンプリングトランジスタをオンさせてオフセット電位Ｖofs を駆動トランジスタのゲートに供給する。駆動トランジスタの閾値補正の初期化処理を行なう前には、直前の表示輝度に拘わらず、駆動トランジスタのゲート・ソース間電圧Ｖgsを、本発明を適用しない場合よりも小さくでき、駆動トランジスタの劣化を抑制できる。
【解決手段】有機ＥＬ素子を発光状態から消光状態に遷移させた後に駆動トランジスタの閾値補正を行なう前には、直前の表示輝度に拘わらず駆動トランジスタのゲート・ソース間電圧Ｖgsを同じ状態にした後に、ゲート・ソース間電圧Ｖgsを閾値電圧を上回るように設定する。たとえば、電源駆動パルスDSL を第１電位Ｖcc_Hから第３電位Ｖcc_Mにして消光し、映像信号Ｖsig のオフセット電位Ｖofs 期間に書込駆動パルスWSをＨレベルにしてサンプリングトランジスタをオンさせてオフセット電位Ｖofs を駆動トランジスタのゲートに供給する。駆動トランジスタの閾値補正の初期化処理を行なう前には、直前の表示輝度に拘わらず、駆動トランジスタのゲート・ソース間電圧Ｖgsを、本発明を適用しない場合よりも小さくでき、駆動トランジスタの劣化を抑制できる。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、表示素子（電気光学素子とも称される）を具備する画素回路（画素とも称される）を有する表示装置、表示装置を具備する電子機器、表示装置の駆動方法に関する。より詳細には、表示素子の劣化防止技術に関する。
【背景技術】
【０００２】
画素の表示素子として、印加される電圧や流れる電流によって輝度が変化する電気光学素子を用いた表示装置がある。たとえば、印加される電圧によって輝度が変化する電気光学素子としては液晶表示素子が代表例であり、流れる電流によって輝度が変化する電気光学素子としては、有機エレクトロルミネッセンス（Organic Electro Luminescence, 有機ＥＬ, Organic Light Emitting Diode, OLED；以下、有機ＥＬと記す） 素子が代表例である。後者の有機ＥＬ素子を用いた有機ＥＬ表示装置は、画素の表示素子として、自発光素子である電気光学素子を用いたいわゆる自発光型の表示装置である。
【０００３】
ところで、電気光学素子を用いた表示装置においては、その駆動方式として、単純（パッシブ）マトリクス方式とアクティブマトリクス方式とを採ることができる。ただし、単純マトリクス方式の表示装置は、構造が単純であるもの、大型でかつ高精細の表示装置の実現が難しいなどの問題がある。
【０００４】
このため、近年、画素内部の発光素子に供給する画素信号を、同様に画素内部に設けた能動素子、たとえば絶縁ゲート型電界効果トランジスタ（一般には、薄膜トランジスタ(Thin Film Transistor ;ＴＦＴ)をスイッチングトランジスタとして使用して制御するアクティブマトリクス方式の開発が盛んに行なわれている。
【０００５】
電気光学素子で表示を行なう際には、映像信号線を介して供給される入力画像信号をスイッチングトランジスタ（サンプリングトランジスタと称する）で駆動トランジスタのゲート（制御入力端子）に設けられた保持容量（画素容量とも称する）に取り込み、取り込んだ入力画像信号に応じた駆動信号を電気光学素子に供給する。
【０００６】
電気光学素子として液晶表示素子を用いる液晶表示装置では、液晶表示素子が電圧駆動型の素子であることから、保持容量に取り込んだ入力画像信号に応じた電圧信号そのもので液晶表示素子を駆動する。これに対して、電気光学素子として有機ＥＬ素子などの電流駆動型の素子を用いる表示装置では、保持容量に取り込んだ入力画像信号に応じた駆動信号（電圧信号）を駆動トランジスタで電流信号に変換して、その駆動電流を有機ＥＬ素子などに供給する。
【０００７】
ここで、電気光学素子を駆動する能動素子（駆動トランジスタ）の閾値電圧や移動度あるいは電気光学素子の特性がプロセス変動や環境によってばらついてしまうことが知られている。このため、表示装置の画面全体に亘って表示輝度を均一に制御するため、各画素回路内で上述した駆動用の能動素子や電気光学素子の特性変動に起因する輝度変動を補正するための仕組み（駆動信号を一定に維持する駆動信号一定化処理技術）が種々検討されている（特許文献１を参照）。
【先行技術文献】
【特許文献】
【０００８】
【特許文献１】特開２００８−０３３１９３号公報
【発明の概要】
【発明が解決しようとする課題】
【０００９】
駆動信号一定化処理技術を適用した場合、画素回路の構成や駆動タイミングによっては、非表示時に、駆動トランジスタのドレイン・ソース間電圧がゼロのときに、ゲート・ソース間電圧が表示期間と同じ状態が維持されてしまう。白表示など相対的に高輝度での表示期間には、ゲート・ソース間電圧が相対的に大きく、その結果、高輝度での表示期間後の非表示時には、ゲート・ソース間電圧が大きくなり駆動トランジスタの劣化の要因となることが分かった。このような駆動トランジスタの劣化を「焼付き現象」と称する。
【００１０】
本発明は、上記事情に鑑みてなされたものであり、駆動トランジスタの焼付き現象に伴う劣化を防止することができる仕組みを提供することを目的とする。
【課題を解決するための手段】
【００１１】
本発明は先ず、駆動信号を生成する駆動トランジスタ、駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および信号振幅に応じた情報を保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された画素アレイ部を備える。
【００１２】
そして、本発明の第１の態様は、電気光学素子の非表示期間に駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定してから駆動トランジスタの閾値補正を行なうように画素回路を駆動する垂直駆動部を備える点に特徴がある。
【００１３】
本発明の第２の態様は、駆動トランジスタの電源供給端の電位を、電気光学素子の表示期間に第１の電位に設定し、駆動トランジスタの閾値補正を行なうための初期化期間に第２の電位に設定し、表示期間と初期化期間の間の期間に第１の電位と第２の電位の間の第３の電位に設定して電気光学素子を非表示にさせる垂直駆動部を備える点に特徴がある。
【００１４】
本発明の第３の態様は、駆動トランジスタの電源供給端と出力端との電位を等しくして電気光学素子を表示状態から非表示状態に遷移させて駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定した後に、駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定してから駆動トランジスタの閾値補正を行なうように画素回路を駆動する垂直駆動部を備える点に特徴がある。
【００１５】
本発明の第４の態様は、電気光学素子を表示状態から非表示状態に遷移させた後に駆動トランジスタの閾値補正を行なう前には、直前の表示輝度に拘わらず駆動トランジスタの制御入力端と出力端との間の電位差を同じ状態にした後に、駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定する垂直駆動部を備える点に特徴がある。
【００１６】
第１の態様は、駆動トランジスタの制御入力端と出力端の電圧差の側面から本発明を規定したものである。第２の態様は、駆動トランジスタの電源供給線の設定電圧の側面から本発明を規定したものである。第３および第４の態様は、駆動トランジスタの制御入力端と出力端の電圧差と閾値補正の初期化動作の側面から規定したものである。
【００１７】
第１〜第４の態様は、発明の観点が異なるが、何れも、電気光学素子を表示状態から非表示状態に遷移させたとき、駆動トランジスタの閾値補正の初期化処理を行なう前には、駆動トランジスタの制御入力端と出力端の電圧差を、本発明を適用しない場合よりも小さくしようとするものであり、第１〜第４の態様は共通する技術思想を有するものである。
【発明の効果】
【００１８】
本発明の一態様によれば、電気光学素子を表示状態から非表示状態に遷移させたときに、駆動トランジスタの閾値補正の初期化処理を行なう前には、直前の表示輝度に拘わらず、駆動トランジスタの制御入力端と出力端との間の電位差が、本発明を適用しない場合よりも小さくできる。そのため、本発明を採用しない場合と比較して、駆動トランジスタの劣化を抑制できる。
【図面の簡単な説明】
【００１９】
【図１】表示装置の一実施形態であるアクティブマトリクス型表示装置の構成の概略を示すブロック図である。
【図２】本実施形態の画素回路を説明する図である。
【図３】図２に示した画素回路に関する比較例の駆動タイミングを説明するタイミングチャートである。
【図４】駆動トランジスタの動作の詳細を説明する図である。
【図５】焼付け防止対策の原理を説明するタイミングチャートである。
【図６】本実施形態の対策手法を適用した場合と適用しない比較例を対比して示した図である。
【図７】３値駆動回路の第１例を説明する図（その１）である。
【図７Ａ】３値駆動回路の第１例を説明する図（その２）である。
【図８】３値駆動回路の第２例を説明する図である。
【図９】本実施形態が適用される電子機器の一例を示す図（その１）である。
【図９Ａ】本実施形態が適用される電子機器の一例を示す図（その２）である。
【図９Ｂ】本実施形態が適用される電子機器の一例を示す図（その３）である。
【発明を実施するための形態】
【００２０】
以下、図面を参照して本発明の実施形態について詳細に説明する。各機能要素を形態別に区別する際には、Ａ，Ｂなどのように大文字の英語の参照子を付して記載し、特に区別しないで説明する際にはこの参照子を割愛して記載する。図面においても同様である。
【００２１】
説明は以下の順序で行なう。
１．基本概念（表示装置の概要、画素駆動の基本、劣化防止駆動）
２．表示装置の全体概要
３．画素回路
４．画素回路の動作（比較例、焼付き現象の説明、焼付け防止対策の原理、対比、第３電位の適正範囲）
５．３値駆動回路（第１例、第２例）
６．電子機器
【００２２】
＜基本概念＞
［表示装置の概要］
先ず、電気光学素子を備えた表示装置の概要について説明する。表示装置は、複数の画素を備えている。各画素は、発光部を具備した発光素子（電気光学素子の一例）とその駆動回路を備える。発光部として、たとえば、有機エレクトロルミネッセンス発光部、無機エレクトロルミネッセンス発光部、ＬＥＤ発光部、半導体レーザー発光部などを用いることができる。
【００２３】
以下に説明する例にあっては、発光素子は、有機エレクトロルミネッセンス発光部を備えている。より具体的には、発光素子は、駆動回路に接続された有機エレクトロルミネッセンス発光部（発光部ＥＬＰ）が積層された構造を有する有機エレクトロルミネッセンス素子（有機ＥＬ素子）である。有機ＥＬ素子の発光部は、たとえば、アノード電極、正孔輸送層、発光層、電子輸送層、カソード電極などの周知の構成、構造を有する。
【００２４】
表示装置は、少なくとも、信号電位を画素回路Ｐに供給する水平駆動部（信号出力回路）、水平駆動部から供給された信号電位を駆動トランジスタのゲートに供給する走査を行なう書込走査部と、画素回路Ｐが配列される画素アレイ部を備える。
【００２５】
画素アレイ部は、第１の方向（たとえば水平方向）にＨ個、第１の方向とは異なる第２の方向（具体的には、第１の方向に直交する方向、たとえばは垂直方向）にＶ個、合計Ｈ×Ｖ個の２次元マトリクス状に配列された発光素子、書込走査部に接続され第１の方向に延びるＶ本の書込走査線、水平駆動部に接続され第２の方向に延びるＨ本の映像信号線（データ線）を備える。水平駆動部、書込走査部、画素アレイ部の構成、構造は、周知の構成、構造とすることができる。
【００２６】
発光部（発光素子）を駆動するための駆動回路（画素回路）として各種の回路がある。たとえば、公知のものとしては、５トランジスタ／１容量部から基本的に構成された駆動回路（５Ｔｒ／１Ｃ駆動回路）、４トランジスタ／１容量部から基本的に構成された駆動回路（４Ｔｒ／１Ｃ駆動回路）、３トランジスタ／１容量部から基本的に構成された駆動回路（３Ｔｒ／１Ｃ駆動回路）、２トランジスタ／１容量部から基本的に構成された駆動回路（２Ｔｒ／１Ｃ駆動回路）がある。
【００２７】
トランジスタとしては、最低限の構成として、発光素子を駆動する駆動トランジスタと書込走査部によりスイッチング駆動されるサンプリングトランジスタ（書き込みトランジスタ）を備える。本実施形態では、ブートストラップ機能を実現するべく、容量部は駆動トランジスタのゲートとソースの間に接続する。
【００２８】
駆動トランジスタのゲート、サンプリングトランジスタのソース／ドレイン領域、容量部の一方の端子の接続点を第１ノードとし、駆動トランジスタのソース、発光素子の一方の端子、容量部の他方の端子の接続点を第２ノードとする。
【００２９】
カラー表示対応とする場合、典型的には、１つの画素回路は、３つの副画素（赤色を発光する赤色発光副画素、緑色を発光する緑色発光副画素、青色を発光する青色発光副画素）で構成する。
【００３０】
［画素駆動の基本］
以下の説明において、各画素を構成する発光素子は、線順次駆動されるとし、表示フレームレートをＦＲ（回／秒）とする。すなわち、第ｖ行目（ただし、ｖ＝１，２，３，…，Ｖ）に配列された（Ｖ／３）個の画素、より具体的には、Ｖ個の副画素のそれぞれを構成する発光素子が同時に駆動される。換言すれば、１つの行を構成する各発光素子にあっては、その発光／非発光のタイミングは、それらが属する行単位で制御される。なお、１つの行を構成する各画素について映像信号を書き込む処理は、全ての画素について同時に映像信号を書き込む処理（以下、単に、同時書込み処理と記す場合がある）であってもよいし、画素ごとに順次映像信号を書き込む処理（以下、単に、順次書込み処理と記す場合がある）であってもよい。何れの書込み処理とするかは、駆動回路の構成に応じて適宜選択すればよい。
【００３１】
原則として、第ｖ行目、第ｈ列（ｈ＝１，２，３，…，Ｈ）に位置する発光素子に関する駆動、動作を説明するが、以下では第（ｈ，ｖ）番目の発光素子あるいは第（ｈ，ｖ）番目の副画素と記す。そして、第ｖ行目に配列された各発光素子の水平走査期間（第ｖ番目の水平走査期間）が終了するまでに、各種の処理（閾値電圧キャンセル処理、書込み処理、移動度補正処理）が行なわれる。書込み処理や移動度補正処理は、第ｖ番目の水平走査期間内に行なわれる必要がある。一方、駆動回路の種類によっては、閾値電圧キャンセル処理やこれに伴う前処理を第ｖ番目の水平走査期間より先行して行なうことができる。
【００３２】
そして、各種の処理が全て終了した後、第ｖ行目に配列された各発光素子を構成する発光部を発光させる。各種の処理が全て終了した後、直ちに発光部を発光させてもよいし、所定の期間（たとえば、所定の行数分の水平走査期間）が経過した後に発光部を発光させてもよい。この所定の期間は、表示装置の仕様や駆動回路の構成などに応じて、適宜設定することができる。以下の説明においては、説明の便宜のため、各種の処理終了後、直ちに発光部を発光させるものとする。そして、第ｖ行目に配列された各発光素子を構成する発光部の発光は、第（ｖ＋ｖ'）行目に配列された各発光素子の水平走査期間の開始直前まで継続される。
【００３３】
「ｖ」は、表示装置の設計仕様によって決定される。すなわち、ある表示フレームの第ｖ行目に配列された各発光素子を構成する発光部の発光は、第（ｖ＋ｖ'−１）番目の水平走査期間まで継続される。一方、第（ｖ＋ｖ'）番目の水平走査期間の始期から、次の表示フレームにおける第ｖ番目の水平走査期間内において書込み処理や移動度補正処理が完了するまで、第ｖ行目に配列された各発光素子を構成する発光部は、原則として非発光状態を維持する。非発光状態の期間（非発光期間）を設けることにより、アクティブマトリクス駆動に伴う残像ボケが低減され、動画品位をより優れたものとすることができる。
【００３４】
ただし、各副画素（発光素子）の発光状態／非発光状態は、以上に説明した状態に限定するものではない。また、水平走査期間の時間長は、（１／ＦＲ）×（１／Ｖ）秒未満の時間長である。（ｖ＋ｖ'）の値がＶを越える場合、越えた分の水平走査期間は、次の表示フレームにおいて処理される。
【００３５】
駆動回路の構成に拘わらず、発光部の駆動方法は、たとえば、以下の通りとする。
【００３６】
ａ）第１ノードと第２ノードとの間の電位差が、駆動トランジスタの閾値電圧を越え、かつ、第２ノードと発光部に備えられたカソード電極との間の電位差が、発光部の閾値電圧を越えないように、第１ノードに第１ノード初期化電圧を印加し、第２ノードに第２ノード初期化電圧を印加する前処理を行なう。この工程を前処理工程という。この前処理工程は、放電工程と初期化工程に区別することもある。
【００３７】
ｂ）第１ノードの電位を保った状態で、第１ノードの電位から駆動トランジスタ閾値電圧を減じた電位に向かって、第２ノードの電位を変化させる閾値電圧キャンセル処理を行なう。この工程を閾値電圧補正工程という。
【００３８】
ｃ）書込走査線からの信号によりオン状態とされたサンプリングトランジスタを介して、映像信号線から映像信号を第１ノードに印加する書込み処理を行なう。この工程を信号書込み工程という。
【００３９】
ｄ）書込走査線からの信号によりサンプリングトランジスタをオフ状態とすることにより第１ノードを浮遊状態とし、第１ノードと第２ノードとの間の電位差の値に応じた電流を駆動トランジスタにより発光部に流すことにより発光部を駆動する。この工程を発光工程という。
【００４０】
閾値電圧補正工程と信号書込み工程との間には、さらに移動度補正工程を追加する態様もあり、また、移動度補正工程を信号書込み工程と同時に行なう態様もある。
【００４１】
ここで、閾値電圧補正工程において、第１ノードの電位から駆動トランジスタの閾値電圧を減じた電位に向かって、第２ノードの電位を変化させる閾値電圧キャンセル処理を行なう。より具体的には、第１ノードの電位から駆動トランジスタの閾値電圧を減じた電位に向かって第２ノードの電位を変化させるために、前処理工程における第２ノードの電位に駆動トランジスタの閾値電圧を加えた電圧を超える電圧を、駆動トランジスタの一方のソース／ドレイン領域に印加する。
【００４２】
定性的には、閾値電圧キャンセル処理において、第１ノードと第２ノードとの間の電位差（換言すれば、駆動トランジスタのゲートとソースとの間の電位差）が駆動トランジスタの閾値電圧に近づく程度は、閾値電圧キャンセル処理の時間により左右される。したがって、たとえば閾値電圧キャンセル処理の時間を充分長く確保した形態にあっては、第２ノードの電位は第１ノードの電位から駆動トランジスタの閾値電圧を減じた電位に達する。そして、第１ノードと第２ノードとの間の電位差は駆動トランジスタの閾値電圧に達し、駆動トランジスタはオフ状態となる。一方、たとえば閾値電圧キャンセル処理の時間を短く設定せざるを得ない形態にあっては、第１ノードと第２ノードとの間の電位差が駆動トランジスタの閾値電圧より大きく、駆動トランジスタはオフ状態とはならない場合がある。閾値電圧キャンセル処理の結果として、必ずしも駆動トランジスタがオフ状態となることを要しない。
【００４３】
［劣化防止駆動］
本実施形態の画素駆動手法にあっては、前処理工程において、消光期間（非表示期間）に入ったら先ず、その直前の発光期間の表示レベルに拘わらず、駆動トランジスタのゲート・ソース間電圧を閾値電圧近傍（好ましくは閾値電圧以下、好適には０Ｖ程度）に設定してから、本来の前処理工程の動作に移行するようにする。
【００４４】
このような動作を必要とするのは、相対的に輝度の高い高輝度レベルでの表示（典型的には白表示）をした後の消光期間に、比較的大きなゲート・ソース間電圧が印加され続けることが、駆動トランジスタの劣化要因となることを防止するためである。特に、駆動トランジスタのドレイン側の電圧（電源電圧に相当）を、高電圧側の第１電位と低電圧側の第２電位とに切り替える駆動制御を行なう場合にこの問題が顕著に現われる。因みに、駆動トランジスタのドレインを低電圧側の第２電位に設定するのは、主に、閾値補正処理前の初期化のために行なわれる。
【００４５】
このような劣化防止駆動動作を実現するには、この動作用のスイッチングトランジスタを新たに設けることが考えられるが、それでは画素回路が大きくなる。そこで、本実施形態では、既存のトランジスタを制御することで、前記の動作を実現するようにする。既存の何れのトランジスタを利用するかは画素回路の構成次第である。以下では、最も簡易な構成である２Ｔｒ／１Ｃ駆動回路を例に、具体的に説明する。
【００４６】
＜表示装置の全体概要＞
図１は、表示装置の一実施形態であるアクティブマトリクス型表示装置の構成の概略を示すブロック図である。本実施形態では、たとえば画素の表示素子（電気光学素子）として有機ＥＬ素子を、能動素子として薄膜トランジスタ（ＴＦＴ；Thin Film Transistor）をそれぞれ用い、薄膜トランジスタを形成した半導体基板上に有機ＥＬ素子を形成してなるアクティブマトリクス型有機ＥＬディスプレイ（以下「有機ＥＬ表示装置」と称する）に適用した場合を例に説明する。このような有機ＥＬ表示装置は、半導体メモリやミニディスク（ＭＤ）やカセットテープなどの記録媒体を利用した携帯型の音楽プレイヤーやその他の電子機器の表示部に利用される。
【００４７】
なお、以下においては、画素の表示素子として有機ＥＬ素子を例に具体的に説明するが、これは一例であって、対象となる表示素子は有機ＥＬ素子に限らない。一般的に電流駆動で発光する表示素子の全てに、後述する実施形態が同様に適用できる。
【００４８】
図１に示すように、有機ＥＬ表示装置１は、表示パネル部１００と、駆動信号生成部２００と、映像信号処理部３００を備えている。表示パネル部１００は、複数の表示素子としての有機ＥＬ素子（図示せず）を持った画素回路Ｐ（画素とも称される）が表示アスペクト比である縦横比がＸ：Ｙ（たとえば９：１６）の有効映像領域を構成するように配置されている。駆動信号生成部２００は、表示パネル部１００を駆動制御する種々のパルス信号を発するパネル制御部の一例である。駆動信号生成部２００と映像信号処理部３００とは、１チップのＩＣ（Integrated Circuit；半導体集積回路）に内蔵されている。
【００４９】
たとえば、パネル型の表示装置では、ＴＦＴや電気光学素子などの画素回路を構成する素子を行列状に配置した画素アレイ部１０２と、画素アレイ部１０２の周辺に配置され、各画素回路Ｐを駆動するための走査線と接続された走査部（水平駆動部や垂直駆動部）を主要部とする制御部１０９と、制御部１０９を動作させるための各種の信号を生成する駆動信号生成部２００や映像信号処理部３００を備えて装置の全体が構成されるのが一般的である。
【００５０】
一方、製品形態としては、画素アレイ部１０２と制御部１０９を同一の支持基板１０１（ガラス基板）上に搭載した表示パネル部１００と駆動信号生成部２００や映像信号処理部３００を別体としつつ、図示のように、これら全てを備えたモジュール（複合部品）形態の有機ＥＬ表示装置１として提供されることに限らない。表示パネル部１００には画素アレイ部１０２を搭載し、この表示パネル部１００のみで有機ＥＬ表示装置１として提供することも可能である。この場合、表示パネル部１００のみで構成された有機ＥＬ表示装置１とは別基板（たとえばフレキシブル基板）上に制御部１０９や駆動信号生成部２００や映像信号処理部３００などの周辺回路を搭載する形態（周辺回路パネル外配置構成と称する）とする。
【００５１】
また、画素アレイ部１０２と制御部１０９とを同一の支持基板１０１上に搭載して表示パネル部１００を構成するパネル上配置構成の場合、画素アレイ部１０２のＴＦＴを生成する工程にて同時に制御部１０９（必要に応じて駆動信号生成部２００や映像信号処理部３００も）用の各ＴＦＴを生成する仕組み（ＴＦＴ一体構成と称する）と、ＣＯＧ（Chip On Glass ）実装技術により画素アレイ部１０２が搭載された支持基板１０１上に制御部１０９（必要に応じて駆動信号生成部２００や映像信号処理部３００も）用の半導体チップを直接実装する仕組み（ＣＯＧ搭載構成と称する）をとってもよい。
【００５２】
表示パネル部１００は、支持基板１０１の上に、画素回路Ｐがｎ行×ｍ列のマトリクス状に配列された画素アレイ部１０２と、画素回路Ｐを垂直方向に走査する垂直走査部の一例である垂直駆動部１０３と、画素回路Ｐを水平方向に走査する水平走査部の一例である水平駆動部（水平セレクタあるいはデータ線駆動部とも称される）１０６と、外部接続用の端子部（パッド部）１０８などが集積形成されている。すなわち、垂直駆動部１０３や水平駆動部１０６などの周辺駆動回路が、画素アレイ部１０２と同一の支持基板１０１上に形成された構成となっている。
【００５３】
垂直駆動部１０３としては、たとえば、書込走査部（ライトスキャナＷＳ；Write Scan）１０４や電源供給能力を有する電源スキャナとして機能する駆動走査部（ドライブスキャナＤＳ；Drive Scan）１０５を有する。垂直駆動部１０３と水平駆動部１０６とで、信号電位の保持容量への書込みや、閾値補正動作や、移動度補正動作や、ブートストラップ動作を制御する制御部１０９が構成される。
【００５４】
図示した垂直駆動部１０３および対応する走査線の構成は、画素回路Ｐが後述する本実施形態の２ＴＲ構成の場合に適合させて示したものであるが、画素回路Ｐの構成によっては、その他の走査部が設けられることもある。
【００５５】
画素アレイ部１０２は、一例として、図示する左右方向の一方側もしくは両側から書込走査部１０４および駆動走査部１０５で駆動され、かつ図示する上下方向の一方側もしくは両側から水平駆動部１０６で駆動されるようになっている。
【００５６】
端子部１０８には、有機ＥＬ表示装置１の外部に配された駆動信号生成部２００から、種々のパルス信号が供給されるようになっている。また同様に、映像信号処理部３００から映像信号Ｖsig が供給されるようになっている。カラー表示対応の場合には、色別（本例ではＲ（赤），Ｇ（緑），Ｂ（青）の３原色）の映像信号Ｖsig_Ｒ，Ｖsig_Ｇ，Ｖsig_Ｂが供給される。
【００５７】
一例としては、垂直駆動用のパルス信号として、垂直方向の書込み開始パルスの一例であるシフトスタートパルスSPDS，SPWSや垂直走査クロックCKDS，CKWSなど必要なパルス信号が供給される。また、水平駆動用のパルス信号として、水平方向の書込み開始パルスの一例である水平スタートパルスSPH や水平走査クロックCKH など必要なパルス信号が供給される。
【００５８】
端子部１０８の各端子は、配線１９９を介して、垂直駆動部１０３や水平駆動部１０６に接続されるようになっている。たとえば、端子部１０８に供給された各パルスは、必要に応じて図示を割愛したレベルシフタ部で電圧レベルを内部的に調整した後、バッファを介して垂直駆動部１０３の各部や水平駆動部１０６に供給される。
【００５９】
画素アレイ部１０２は、図示を割愛するが（詳細は後述する）、表示素子としての有機ＥＬ素子に対して画素トランジスタが設けられた画素回路Ｐが行列状に２次元配置され、この画素配列に対して行ごとに垂直走査線が配線されるとともに、列ごとに信号線（水平走査線の一例）が配線された構成となっている。
【００６０】
たとえば、画素アレイ部１０２には、垂直走査側の各走査線（垂直走査線：書込走査線１０４WSおよび電源供給線１０５DSL ）と水平走査側の走査線（水平走査線）である映像信号線（データ線）１０６HSが形成されている。垂直走査と水平走査の各走査線の交差部分には図示を割愛した有機ＥＬ素子とこれを駆動する薄膜トランジスタ（ＴＦＴ；Thin Film Transistor）が形成される。有機ＥＬ素子と薄膜トランジスタの組み合わせで画素回路Ｐを構成する。
【００６１】
具体的には、マトリクス状に配列された各画素回路Ｐに対しては、書込走査部１０４によって書込駆動パルスWSで駆動されるｎ行分の書込走査線１０４WS_1〜１０４WS_nおよび駆動走査部１０５によって電源駆動パルスDSL で駆動されるｎ行分の電源供給線１０５DSL_1 〜１０５DSL_n が画素行ごとに配線される。
【００６２】
書込走査部１０４および駆動走査部１０５は、駆動信号生成部２００から供給される垂直駆動系のパルス信号に基づき、書込走査線１０４WSおよび電源供給線１０５DSL を介して各画素回路Ｐを順次選択する。水平駆動部１０６は、駆動信号生成部２００から供給される水平駆動系のパルス信号に基づき、選択された画素回路Ｐに対し映像信号線１０６HSを介して映像信号Ｖsig の内の所定電位をサンプリングして保持容量に書き込ませる。
【００６３】
本実施形態の有機ＥＬ表示装置１においては、線順次駆動や面順次駆動あるいはその他の方式での駆動が可能になっており、たとえば、垂直駆動部１０３の書込走査部１０４および駆動走査部１０５は行単位で画素アレイ部１０２を走査するとともに、これに同期して水平駆動部１０６が、画像信号を、１水平ライン分を同時に、画素アレイ部１０２に書き込む。
【００６４】
水平駆動部１０６は、たとえば、全列の映像信号線１０６HS上に設けられた図示を割愛したスイッチを一斉にオンさせるドライバ回路を備えて構成され、映像信号処理部３００から入力される画素信号を、垂直駆動部１０３によって選択された行の１ライン分の全ての画素回路Ｐに同時に書き込むべく、全列の映像信号線１０６HS上に設けられた図示を割愛したスイッチを一斉にオンさせ、ドライバ回路を経由して水平走査線（映像信号線１０６HS）に映像信号Ｖsig （水平走査信号の一例）が供給される。
【００６５】
垂直駆動部１０３の各部は、論理ゲートの組合せ（ラッチも含む）とドライバ回路によって構成され、論理ゲートにより画素アレイ部１０２の各画素回路Ｐを行単位で選択し、ドライバ回路を経由して垂直走査線に垂直走査信号が供給される。なお、図１では、画素アレイ部１０２の一方側にのみ垂直駆動部１０３を配置する構成を示しているが、画素アレイ部１０２を挟んで左右両側に垂直駆動部１０３を配置する構成を採ることも可能である。同様に、図１では、画素アレイ部１０２の一方側にのみ水平駆動部１０６を配置する構成を示しているが、画素アレイ部１０２を挟んで上下両側に水平駆動部１０６を配置する構成を採ることも可能である。
【００６６】
＜画素回路＞
図２は、本実施形態の画素回路Ｐを説明する図である。画素回路Ｐは、ｎ型の駆動トランジスタ１２１を使用する。加えて、有機ＥＬ素子の経時変化による当該有機ＥＬ素子への駆動電流Ｉdsの変動を抑制するための回路、すなわち電気光学素子の一例である有機ＥＬ素子の電流−電圧特性の変化を補正して駆動電流Ｉdsを一定に維持する駆動信号一定化回路を備えた点に特徴を有する。さらに、有機ＥＬ素子の電流−電圧特性に経時変化があった場合でも駆動電流を一定にする機能を備えた点に特徴を有する。
【００６７】
すなわち、駆動トランジスタ１２１の他に走査用に１つのスイッチングトランジスタ（サンプリングトランジスタ１２５）を使用する２ＴＲ駆動の構成を採る。各スイッチングトランジスタを制御する電源駆動パルスDSL および書込駆動パルスWSのオン／オフタイミング（スイッチングタイミング）を後述する動作タイミングのように設定する。これにより、有機ＥＬ素子１２７の経時変化や駆動トランジスタ１２１の特性変動（たとえば閾値電圧や移動度などのばらつきや変動）による駆動電流Ｉdsに与える影響を防ぐ。２ＴＲ駆動の構成であり、素子数や配線数が少ないため、高精細化が可能である。
【００６８】
具体的には、画素回路Ｐは、保持容量１２０、ｎ型の駆動トランジスタ１２１、アクティブＨ（ハイ）の書込駆動パルスWSが供給されるｎ型トランジスタ１２５、電流が流れることで発光する電気光学素子（発光素子）の一例である有機ＥＬ素子１２７を有する。
【００６９】
駆動トランジスタ１２１のゲート（ノードＮＤ１２２）とソースとの間に保持容量１２０が接続され、駆動トランジスタ１２１のソースが直接に有機ＥＬ素子１２７のアノード端に接続されている。有機ＥＬ素子１２７のカソード端は、全画素共通のカソード共通配線１２７Ｋに接続され、カソード電位Ｖcath（たとえば接地電位GND ）が与えられる。
【００７０】
保持容量１２０は、ブートストラップ容量としても機能するようになっている。すなわち、画素回路Ｐは先ず、保持容量１２０の接続態様に特徴があり、有機ＥＬ素子１２７の経時変化による駆動電流変動を防ぐ回路として、駆動信号一定化回路の一例であるブートストラップ回路を構成する点にある。駆動トランジスタ１２１の特性変動（たとえば閾値電圧や移動度などのばらつきや変動）による駆動電流Ｉdsに与える影響を抑制する方法としては、各トランジスタ１２１，１２５の駆動タイミングを工夫することで対処する。
【００７１】
駆動トランジスタ１２１のドレインは、電源スキャナとして機能する駆動走査部１０５からの電源供給線１０５DSL に接続されている。電源供給線１０５DSL は、この電源供給線１０５DSL そのものが、駆動トランジスタ１２１に対しての電源供給能力を備える点に特徴を有する。
【００７２】
具体的には、駆動走査部１０５は、駆動トランジスタ１２１のドレインに対して、それぞれ電源電圧に相当する高電圧側の第１電位Ｖcc_Hと低電圧側の第２電位Ｖcc_Lとを切り替えて供給する電源電圧切替回路を具備している。
【００７３】
第２電位Ｖcc_Lとしては、映像信号線１０６HSにおける映像信号Ｖsig のオフセット電位Ｖofs （基準電位とも称する）より十分低い電位とする。具体的には、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgs（ゲート電位Ｖｇとソース電位Ｖｓの差）が駆動トランジスタ１２１の閾値電圧Ｖthより大きくなるように、電源供給線１０５DSL の低電位側の第２電位Ｖcc_Lを設定する。なお、オフセット電位Ｖofs は、閾値補正動作に先立つ初期化動作に利用するとともに映像信号線１０６HSを予めプリチャージにしておくためにも利用する。
【００７４】
サンプリングトランジスタ１２５は、ゲートが書込走査部１０４からの書込走査線１０４WSに接続され、ドレインが映像信号線１０６HSに接続され、ソースが駆動トランジスタ１２１のゲート（ノードＮＤ１２２）に接続されている。そのゲートには、書込走査部１０４からアクティブＨの書込駆動パルスWSが供給される。
【００７５】
サンプリングトランジスタ１２５は、ソースとドレインとを逆転させた接続態様とすることもできる。また、サンプリングトランジスタ１２５としては、ディプレション型およびエンハンスメント型の何れをも使用できる。
【００７６】
＜画素回路の動作＞
［比較例］
図３は、図２に示した画素回路Ｐに関する比較例の駆動タイミングを説明するタイミングチャートであり、線順次駆動の場合で示している。タイミングチャートにおいて、各期間を示す横軸の長さ（時間長）は模式的なものであり、各期間の時間長の割合を示すものではない。
【００７７】
図３においては、時間軸を共通にして、書込走査線１０４WSの電位変化、電源供給線１０５DSL の電位変化、および映像信号線１０６HSの電位変化を表してある。また、これらの電位変化と並行に、１行分（図では１行目）について駆動トランジスタ１２１のゲート電位Ｖｇおよびソース電位Ｖｓの変化も表してある。
【００７８】
なお、図３では、画素回路Ｐにおいて、閾値補正機能、移動度補正機能、ブートストラップ機能を実現するための基本例を示すもので、閾値補正機能、移動度補正機能、ブートストラップ機能を実現するための駆動タイミングは、図３に示す態様に限らず、様々な変形が可能である。これら様々な変形の駆動タイミングであっても、後述する各実施形態の仕組みを適用できる。
【００７９】
図３に示す駆動タイミングは、線順次駆動の場合であり、書込駆動パルスWS、電源駆動パルスDSL 、および映像信号Ｖsig は、１行分を１組として、各信号のタイミング（特に位相関係）が行単位で独立に制御され、行が代わると１Ｈ（Ｈは水平走査期間）分シフトされる。
【００８０】
以下では、説明や理解を容易にするため、特段の断りのない限り、書込みゲインが１（理想値）であると仮定して、保持容量１２０に信号振幅ΔＶinの情報を、書き込む、保持する、あるいはサンプリングするなどと簡潔に記して説明する。書込みゲインが１未満の場合、保持容量１２０には信号振幅ΔＶinの大きさそのものではなく、信号振幅ΔＶinの大きさに対応するゲイン倍された情報が保持されることになる。因みに、信号振幅ΔＶinに対応する保持容量１２０に書き込まれる情報の大きさの割合を、書込みゲインＧinput と称する。
【００８１】
また、説明や理解を容易にするため、特段の断りのない限り、ブートストラップゲインが１（理想値）であると仮定して簡潔に記して説明する。因みに、駆動トランジスタ１２１のゲート・ソース間に保持容量１２０が設けられている場合に、ソース電位Ｖｓの上昇に対するゲート電位Ｖｇの上昇率をブートストラップゲイン（ブートストラップ動作能力）Ｇbst と称する。
【００８２】
また、この駆動タイミングでは、映像信号Ｖsig が非有効期間であるオフセット電位Ｖofs にある期間を１水平期間の前半部とし、有効期間である信号電位Ｖin（＝Ｖofs ＋ΔＶin）にある期間を１水平期間の後半部とする。また、映像信号Ｖsig の有効期間と非有効期間を合わせた１水平期間ごとに、閾値補正動作を複数回（図では４回）に亘って繰り返すようにする。
【００８３】
有機ＥＬ素子１２７の発光期間Ｂ（表示期間）では、電源供給線１０５DSL が第１電位Ｖcc_Hであり、サンプリングトランジスタ１２５がオフした状態である。このとき、駆動トランジスタ１２１は飽和領域で動作するように設定されているため、有機ＥＬ素子１２７に流れる駆動電流Ｉdsは駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsに応じ応じて、式（１）に示される値をとる。
【００８４】
すなわち、駆動トランジスタ１２１はドレイン・ソース間電圧に関わらず駆動電流Ｉdsが一定となる飽和領域で駆動される。よって、飽和領域で動作するトランジスタのドレイン−ソース間に流れる電流をＩds、移動度をμ、チャネル幅（ゲート幅）をＷ、チャネル長（ゲート長）をＬ、ゲート容量（単位面積当たりのゲート酸化膜容量）をＣox、トランジスタの閾値電圧をＶthとすると、駆動トランジスタ１２１は下記の式（１）に示した値を持つ定電流源となっている。なお、“＾”はべき乗を示す。式（１）から明らかなように、飽和領域ではトランジスタのドレイン電流Ｉdsはゲート・ソース間電圧Ｖgsによって制御され定電流源として動作する。
【００８５】
【数１】
【００８６】
非発光期間（消光期間）に入ると、先ず放電期間Ｃでは、電源供給線１０５DSL を第２電位Ｖcc_Lに切り替える。このとき、第２電位Ｖcc_Lが有機ＥＬ素子１２７の閾値電圧ＶthELとカソード電位Ｖcathの和よりも小さいとき、つまり“Ｖcc_L＜ＶthEL＋Ｖcath”であれば、有機ＥＬ素子１２７は消光し、電源供給線１０５DSL が駆動トランジスタ１２１のソース側となる。このとき、有機ＥＬ素子１２７のアノードは第２電位Ｖcc_Lに充電される。つまり、駆動トランジスタ１２１のドレイン（電源供給端）とソース（出力端）との電位を等しくすることで、有機ＥＬ素子１２７を発光状態から消光状態に遷移させる。
【００８７】
さらに、初期化期間Ｄでは、映像信号線１０６HSがオフセット電位Ｖofs となったときにサンプリングトランジスタ１２５をオンして駆動トランジスタ１２１のゲート電位をオフセット電位Ｖofs とする。このとき、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは“Ｖofs −Ｖcc_L”という値をとる。この“Ｖofs −Ｖcc_L”が駆動トランジスタ１２１の閾値電圧Ｖthよりも大きくないと閾値補正動作を行なうことができないために、“Ｖofs −Ｖcc_L＞Ｖth”とする必要がある。
【００８８】
この後、第１閾値補正期間Ｅ１に入ると、電源供給線１０５DSL を再び第１電位Ｖcc_Hに切り替える。電源供給線１０５DSL （つまり駆動トランジスタ１２１への電源電圧）を第１電位Ｖcc_Hとすることで、有機ＥＬ素子１２７のアノードが駆動トランジスタ１２１のソースとなり駆動トランジスタ１２１から駆動電流Ｉdsが流れる。有機ＥＬ素子１２７の等価回路はダイオードと容量で表されるため、有機ＥＬ素子１２７のカソード電位Ｖcathに対するアノード電位をＶelとしたとき、“Ｖel≦Ｖcath＋ＶthEL”である限り、換言すれば、有機ＥＬ素子１２７のリーク電流が駆動トランジスタ１２１に流れる電流よりもかなり小さい限り、駆動トランジスタ１２１の駆動電流Ｉdsは保持容量１２０と有機ＥＬ素子１２７の寄生容量Ｃelを充電するために使われる。このとき、有機ＥＬ素子１２７のアノード電位Ｖelは時間とともに上昇してゆく。
【００８９】
一定時間経過後、サンプリングトランジスタ１２５をオフする。このとき、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsが閾値電圧Ｖthよりも大きいと（つまり閾値補正が完了していないと）、駆動トランジスタ１２１の駆動電流Ｉdsは保持容量１２０を受電するように流れ続け、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは上昇してゆく。このとき、有機ＥＬ素子１２７には逆バイアスがかかっているため、有機ＥＬ素子１２７が発光することはない。
【００９０】
第２閾値補正期間Ｅ２に入ると、再び映像信号線１０６HSがオフセット電位Ｖofs となったときにサンプリングトランジスタ１２５をオンして駆動トランジスタ１２１のゲート電位をオフセット電位Ｖofs として、再度閾値補正動作を開始する。この動作を繰り返すことで、最終的に、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは閾値電圧Ｖthという値をとる。このとき“Ｖel＝Ｖofs −Ｖth≦Ｖcath＋ＶthEL”となっている。
【００９１】
なお、この動作例では、閾値補正動作を繰り返し実行することで確実に駆動トランジスタ１２１の閾値電圧Ｖthに相当する電圧を保持容量１２０に保持させるために、１水平期間を処理サイクルとして、閾値補正動作を複数回に亘って繰り返すようにしているが、この繰返し動作は必須ではなく、１水平期間を処理サイクルとして、１回のみの閾値補正動作を実行するようにしてもよい。
【００９２】
閾値補正動作終了後（本例では第４閾値補正期間Ｅ４の後）は、サンプリングトランジスタ１２５をオフして書込み＆移動度補正準備期間Ｊに入る。映像信号線１０６HSが信号電位Ｖin（＝Ｖofs ＋ΔＶin）となったときに、サンプリングトランジスタ１２５を再度オンしてサンプリング期間＆移動度補正期間Ｋに入る。信号振幅ΔＶinは階調に応じた値である。サンプリングトランジスタ１２５のゲート電位はサンプリングトランジスタ１２５をオンしているために信号電位Ｖin（＝Ｖofs ＋ΔＶin）となるが、駆動トランジスタ１２１のドレインは第１電位Ｖcc_Hであり駆動電流Ｉdsが流れるためソース電位Ｖｓは時間とともに上昇してゆく。図では、この上昇分をΔＶで示している。
【００９３】
ソース電圧Ｖｓが有機ＥＬ素子１２７の閾値電圧ＶthELとカソード電位Ｖcathの和を越えなければ、換言すると、有機ＥＬ素子１２７のリーク電流が駆動トランジスタ１２１に流れる電流よりもかなり小さければ、駆動トランジスタ１２１の駆動電流Ｉdsは保持容量１２０と有機ＥＬ素子１２７の寄生容量とＣelを充電するのに使用される。
【００９４】
この時点では、駆動トランジスタ１２１の閾値補正動作は完了しているため、駆動トランジスタ１２１が流す電流は移動度μを反映したものとなる。具体的には、移動度μが大きいと、このときの電流量が大きく、ソースの上昇も早い。逆に移動度μが小さいと、電流量が小さく、ソースの上昇は遅くなる。これにより、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは移動度μを反映して小さくなり、一定時間経過後に完全に移動度μを補正するゲート・ソース間電圧Ｖgsとなる。
【００９５】
この後には、発光期間Ｌに入り、サンプリングトランジスタ１２５をオフして書込みを終了し、有機ＥＬ素子１２７を発光させる。保持容量１２０によるブートストラップ効果により、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは一定であるので、駆動トランジスタ１２１は一定電流（駆動電流Ｉds）を有機ＥＬ素子１２７に流し、有機ＥＬ素子１２７のアノード電位Ｖelは有機ＥＬ素子１２７に駆動電流Ｉdsという電流が流れる電圧Ｖｘまで上昇し、有機ＥＬ素子１２７は発光する。
【００９６】
画素回路Ｐにおいては、有機ＥＬ素子１２７は発光時間が長くなるとそのＩ−Ｖ特性は変化してしまう。そのため、ノードＮＤ１２１の電位（つまり駆動トランジスタ１２１のソース電位Ｖｓ）も変化する。しかしながら、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは保持容量１２０によるブートストラップ効果で一定値に保たれているので、有機ＥＬ素子１２７に流れる電流は変化しない。よって、有機ＥＬ素子１２７のＩ−Ｖ特性が劣化しても、有機ＥＬ素子１２７には一定電流（駆動電流Ｉds）が常に流れ続け、有機ＥＬ素子１２７の輝度が変化することはない。
【００９７】
ここで、駆動電流Ｉds対ゲート電圧Ｖgsの関係は、トランジスタ特性を表した式（１）のＶgsに“ΔＶin＋Ｖth−ΔＶ”を代入することで、式（２）のように表すことができる。式（２）において、ｋ＝（１／２）（Ｗ／Ｌ）Ｃoxである。
【００９８】
【数２】
【００９９】
この式（２）から、閾値電圧Ｖthの項がキャンセルされており、有機ＥＬ素子１２７に供給される駆動電流Ｉdsは駆動トランジスタ１２１の閾値電圧Ｖthに依存しないことが分かる。基本的に駆動電流Ｉdsは信号振幅ΔＶin（詳しくは信号振幅ΔＶinに対応して保持容量１２０に保持されるサンプリング電圧＝Ｖgs）によって決まる。換言すると、有機ＥＬ素子１２７は信号振幅ΔＶinに応じた輝度で発光することになる。
【０１００】
その際、保持容量１２０に保持される情報はソース電位Ｖｓの上昇分ΔＶで補正されている。上昇分ΔＶはちょうど式（２）の係数部に位置する移動度μの効果を打ち消すように働く。駆動トランジスタ１２１の移動度μに対する補正分ΔＶを保持容量１２０に書き込まれる信号に加えるのであるが、その方向は実際には負の方向であり、こう言った意味で、上昇分ΔＶは、移動度補正パラメータΔＶや負帰還量ΔＶとも称する。
【０１０１】
有機ＥＬ素子１２７に流れる駆動電流Ｉdsは、駆動トランジスタ１２１の閾値電圧Ｖthや移動度μの変動が相殺され、実質的に信号振幅ΔＶinのみに依存することになる。駆動電流Ｉdsは閾値電圧Ｖthや移動度μに依存しないので、閾値電圧Ｖthや移動度μが製造プロセスによりばらついていたり経時変化があったりしても、ドレイン・ソース間の駆動電流Ｉdsは変動せず、有機ＥＬ素子１２７の発光輝度も変動しない。
【０１０２】
駆動トランジスタ１２１のゲート・ソース間に保持容量１２０を接続することで、ｎ型の駆動トランジスタ１２１を使用する場合でも、駆動トランジスタ１２１のソースの電位Ｖｓの変動にゲートの電位Ｖｇが連動するようにするブートストラップ機能を実現する回路構成および駆動タイミングとしており、有機ＥＬ素子１２７の特性の経時変動による有機ＥＬ素子１２７のアノード電位変動（つまり駆動トランジスタ１２１のソース電位変動）があっても、その変動を相殺するようにゲート電位Ｖｇを変動させることができる。
【０１０３】
これにより、有機ＥＬ素子１２７の特性の経時変化の影響が緩和され、画面輝度の均一性を確保できる。駆動トランジスタ１２１のゲート・ソース間の保持容量１２０によるブートストラップ機能により、有機ＥＬ素子を代表とする電流駆動型の発光素子の経時変動補正能力を向上させることができる。もちろん、ブートストラップ機能は、発光開始時点で、有機ＥＬ素子１２７に発光電流Ｉelが流れ始め、それによってアノード・カソード間電圧Ｖelが安定となるまで上昇していく過程で、そのアノード・カソード間電圧Ｖelの変動に伴って駆動トランジスタ１２１のソース電位Ｖｓが変動する際にも機能する。
【０１０４】
このように、本例の画素回路Ｐおよびそれを駆動する制御部１０９による駆動タイミングによれば、駆動トランジスタ１２１や有機ＥＬ素子１２７の特性変動（ばらつきや経時変動）があった場合でも、それらの変動分を補正することで、表示画面上にはその影響が現われず、輝度変化のない高品質な画像表示が可能になる。
【０１０５】
ここで、有機ＥＬ素子１２７を駆動する駆動トランジスタ１２１自体は有機ＥＬ素子１２７の発光時に劣化してしまう。その劣化の程度（劣化量と称する）は、表示映像に依存するため、各画素の劣化量は異なってしまう。劣化の程度が画素で異なることは、表示品質を低下させることに繋がる。
【０１０６】
たとえば、図２に示した画素回路Ｐを図３に示した駆動タイミングのように制御すると、白表示時（最大輝度での発光時、信号振幅ΔＶin_max時）と黒表示時（最低輝度での発光時、信号振幅ΔＶin_min時、Ｖsig ＝Ｖofs 時 、事実上の非発光時）では駆動トランジスタ１２１の動作状態が大きく異なる。具体的には、白表示時と黒表示時では、駆動トランジスタ１２１に印加されるバイアス電位は、発光期間に異なることはやむを得ない（避け難い）が、発光期間以外にも異なっており、白表示が多くなされた画素は劣化の進行が速く、いわゆる「焼き付き」が発生し易い。以下、この現象とその対策手法の原理について説明する。
【０１０７】
［焼付き現象の説明］
図４は、駆動トランジスタ１２１の動作の詳細を説明する図である。ここで、図４（１）は、白表示をする際の、発光期間と消光期間のそれぞれにおける駆動トランジスタＴＲD の各端子電圧を説明する図である。図４（２）は、黒表示をする際の、発光期間と消光期間のそれぞれにおける駆動トランジスタＴＲD の各端子電圧を説明する図である。
【０１０８】
図４（１−１）には、白表示をする際の、発光期間（信号書込みが完了した後の安定時）と消光期間（電源駆動パルスDSL が第２電位Ｖcc_Lに遷移したとき）のそれぞれにおける駆動トランジスタ１２１の各端子電圧が駆動トランジスタ１２１の対応する端子の近傍に示されている。「／」を境に、前側が発光期間の端子電圧であり、後側が消光期間の端子電圧である。白表示時の映像信号Ｖsig の振幅ΔＶinはΔＶin_WH であり、黒表示時の映像信号Ｖsig の振幅ΔＶinはΔＶin_BK （＝０Ｖ）であるとする。
【０１０９】
図３の動作説明から理解されるように、白表示用の信号書込みが完了した後に発光期間に入った安定時には、トランジスタ１２１は、ソース電位が“Ｖofs −Ｖth＋ΔＶ＋Ｖel”、ゲート電位が“Ｖofs ＋ΔＶin_WH ＋Ｖel”、ドレイン電位が第１電位Ｖcc_Hであり、ゲート・ソース間電圧Ｖgsが“ΔＶin_WH ＋Ｖth−ΔＶ”である。また、電源駆動パルスDSL が第２電位Ｖcc_Lに遷移して消光期間に入ったときには、ゲート・ソース間電圧Ｖgsは保持容量１２０によるブートストラップ効果により消灯直前の“ΔＶin_WH ＋Ｖth−ΔＶ”が維持されるので、トランジスタ１２１は、ソース電位が第２電位Ｖcc_L、ゲート電位が“Ｖcc_L＋ΔＶin_WH ＋Ｖth−ΔＶ”、ドレイン電位が第２電位Ｖcc_Lである。
【０１１０】
図４（１−２）に示すように、白表示をする際の、発光期間には、ソース電位を基準（０Ｖ）にしたときの相対的なゲート電位は“ΔＶin_WH ＋Ｖth−ΔＶ”、相対的なドレイン電位は“Ｖcc_H−（Ｖofs −Ｖth＋ΔＶ＋Ｖel）”である。図４（１−３）に示すように、白表示をする際の、消光期間には、ソース電位を基準（０Ｖ）にしたときの相対的なゲート電位は“ΔＶin_WH ＋Ｖth−ΔＶ”、相対的なドレイン電位は０Ｖである。
【０１１１】
同様に、図４（２−１）には、黒表示をする際の、発光期間（信号書込みが完了した後の安定時）と消光期間（電源駆動パルスDSL が第２電位Ｖcc_Lに遷移したとき）のそれぞれにおける駆動トランジスタ１２１の各端子電圧が駆動トランジスタ１２１の対応する端子の近傍に示されている。
【０１１２】
黒表示をする際にはΔＶin_BK ＝０Ｖであるから、信号書込みが完了した後に発光期間に入った安定時には、トランジスタ１２１は、ソース電位が“Ｖofs −Ｖth＋ΔＶ＋Ｖel”、ゲート電位が“Ｖofs ＋Ｖel”、ドレイン電位が第１電位Ｖcc_Hであり、ゲート・ソース間電圧Ｖgsが“Ｖth−ΔＶ”である。実際には、ΔＶin_BK ＝０Ｖのときには、有機ＥＬ素子１２７に電流が流れず、Ｖel＝ΔＶ＝０と考えてよく、ゲート電位がＶofs 、ソース電位が“Ｖofs −Ｖth”で、ゲート・ソース間電圧ＶgsがＶthであると考えてよい。
【０１１３】
図４（２−２）に示すように、黒表示をする際の発光期間には、ソース電位を基準（０Ｖ）にしたときの相対的なゲート電位はＶth、相対的なドレイン電位は“Ｖcc_H−（Ｖofs −Ｖth）”である。図４（２−３）に示すように、黒表示をする際の消光期間には、ソース電位を基準（０Ｖ）にしたときの相対的なゲート電位はＶth、相対的なドレイン電位は０Ｖである。
【０１１４】
消光期間の駆動トランジスタ１２１のバイアス状態を比較すると、白表示と黒表示の何れもソース・ドレイン間電圧が０Ｖの状態であり、ゲート・ソース間電圧Ｖgsは、黒表示のときは閾値電圧Ｖthであるので問題ないが、白表示のときは“ΔＶin_WH ＋Ｖth−ΔＶ”であり劣化の原因となる。
【０１１５】
［焼付け防止対策の原理］
図５は、白表示の消光期間における劣化原因を解消する手法（焼付け防止対策）の原理を説明するタイミングチャートである。
【０１１６】
白表示のときの消光期間における劣化原因を解消するには、ゲート・ソース間電圧Ｖgsを閾値電圧Ｖthと同等レベルかそれ以下となるように設定し、その後に閾値補正動作を行なうように制御することが好適である。
【０１１７】
この対処のためにスイッチングトランジスタを追加することも考えられるが得策ではない。現実的には、画素回路Ｐの変更をせずに対応するには、サンプリングトランジスタ１２５のオン動作によりゲート電位をオフセット電位Ｖofs に設定することになる点を勘案すると、ソース電位Ｖｓが、オフセット電位Ｖofs 近傍（ただしオフセット電位Ｖofs 以下）となるように電源駆動パルスDSL の電位（第３電位Ｖcc_Mとする）を設定することになる。典型的には、第３電位Ｖcc_Mは、“Ｖofs −Ｖth”〜Ｖofs ”に設定すればよい。
【０１１８】
この動作は、少なくとも白表示のときに実行するのが有効であり、黒表示のときには本来は不要であるが、全体動作としては、区別なく実行するのが現実的である。こうすることで、発光期間以外では、駆動トランジスタ１２１にかかるバイアスを白表示と黒表示で差をなくすことができる。
【０１１９】
すなわち、図５に示すように、電源駆動パルスDSL の電位を、第１電位Ｖcc_Hと第２電位Ｖcc_Lと第３電位としての第３電位Ｖcc_M（第１電位Ｖcc_Hと第２電位Ｖcc_Lの間の電位）の３値にし、これらを切り替えて駆動トランジスタ１２１のドレインに供給するようにすればよい。
【０１２０】
そして、２値目の第３電位Ｖcc_Mで有機ＥＬ素子１２７を消光後に（消光処理期間Ｃ１）、書込駆動パルスWSをアクティブＨにしてサンプリングトランジスタ１２５をオンすることで駆動トランジスタのゲートにオフセット電位Ｖofs を書き込む（Ｖofs 書込み工程）。このときには、駆動トランジスタ１２１のソース電位は第３電位Ｖcc_Mにあるので、ゲート・ソース間電圧Ｖgsは“Ｖofs −Ｖ３”になる。
【０１２１】
こうすることで、消光中（詳しくは、消光処理後から初期化期間Ｄが開始するまでの間、「劣化防止処理期間Ｃ２」と称する）は、駆動トランジスタ１２１にかかるバイアスを閾値電圧Ｖth以下（好適にはほぼ０Ｖ）の状態にすることができる。本実施形態を適用しない場合の放電期間Ｃを消光処理期間Ｃ１と劣化防止処理期間Ｃ２に分けたものとなる。
【０１２２】
そのため、発光時以外は（詳しくは劣化防止処理期間Ｃ２から書込み＆移動度補正準備期間Ｊまでは）、駆動トランジスタ１２１にかかるバイアスを白表示および黒表示とも同一にでき、発光期間以外における駆動トランジスタ１２１の劣化を抑制することができる。駆動トランジスタ１２１に起因する焼き付きを防止できるようになる。
【０１２３】
なお、焼付け防止対策用のドレイン端（電源供給端）の電位を複数設定することで、電源駆動パルスDSL の電位を４値以上で切り替えることも考えられる。たとえば、第３電位Ｖcc_M1 で消光させ、第４電位Ｖcc_M2 のときにオフセット電位Ｖofs を書き込むことが考えられる。しかしながら、このような複雑な制御を行なわなくても十分である。
【０１２４】
［対比］
図６は、本実施形態の対策手法を適用した場合と適用しない場合（比較例）を対比して示した図である。
【０１２５】
前処理工程は、電源駆動パルスDSL を第２電位Ｖcc_Lにしてから書込駆動パルスWSをアクティブＨにするまでの放電期間Ｃと、映像信号Ｖsig がオフセット電位Ｖofs の期間に書込駆動パルスWSをアクティブＨにしてから電源駆動パルスDSL を第１電位Ｖcc_Hに設定するまでの初期化期間で構成されている。そして、この例では放電期間Ｃは大凡２Ｈ（水平走査期間）分存在している。
【０１２６】
図６（１）は、本実施形態の対策手法を適用しない比較例の場合を示している。放電期間Ｃに入ると有機ＥＬ素子１２７は消光するが、この放電期間Ｃでは、白表示と黒表示で、駆動トランジスタ１２１のバイアス状態が異なっている。つまり、発光期間に白表示と黒表示で、駆動トランジスタ１２１のバイアス状態が異なるのは当然であるが、発光期間以外でも白黒でバイアス状態に差がある。そして、放電期間Ｃ（特に劣化防止処理期間Ｃ２）の白表示のバイアス状態は、ドレイン・ソース間電圧Ｖdsが０Ｖの状態でゲート・ソース間電圧Ｖgsが“ΔＶin_WH ＋Ｖth−ΔＶ”という大きさにあり、駆動トランジスタ１２１の劣化要因となる。
【０１２７】
図６（２）は、本実施形態の対策手法を適用した場合を示している。放電期間Ｃに入ると、電源駆動パルスDSL を先ずオフセット電位Ｖofs 近傍（ただしオフセット電位Ｖofs 以下）の第３電位Ｖcc_Mに設定し、書込駆動パルスWSをアクティブＨにしてサンプリングトランジスタ１２５をオンさせる。これによって、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは、直前の表示が白であったのか黒であったのかに拘わらず、ほぼ閾値電圧Ｖthと等しいか、それ以下に設定される（図では略０Ｖ（≒０）で示している）。つまり、発光期間以外は、白黒でバイアス状態に差がなく、そのバイアス状態は、駆動トランジスタ１２１の劣化要因とならない。
【０１２８】
［第３電位の適正範囲］
ここで、劣化防止電位の一例である第３電位Ｖcc_Mは、通常の２値駆動におけるＨレベル（第１電位Ｖcc_H）とＬレベル（第２電位Ｖcc_L）とを除く範囲であればよく、第３電位Ｖcc_Mとしては、Ｈレベルを規定することになる第１電位Ｖcc_HとＬレベルを規定することになる第２電位Ｖcc_Lとを除いた電圧レベルであれば、基本的には本実施形態を適用しない場合よりも劣化防止効果が得られる。しかしながら、より好適な状態にするには、以下の点に留意して、第３電位Ｖcc_Mを設定するとよい。
【０１２９】
すなわち、第３電位Ｖcc_Mは、第２電位Ｖcc_Lに過度に近いと劣化防止対策効果が薄れるし、第１電位Ｖcc_Hに過度に近いと駆動トランジスタ１２１をオンさせて有機ＥＬ素子１２７を点灯駆動している状態に極めて近くなり有機ＥＬ素子１２７を消光できない。
【０１３０】
第３電位Ｖcc_Mを使用するのが高輝度点灯後の消光期間の駆動トランジスタ１２１のバイアス状態が駆動トランジスタ１２１の劣化要因となることの対策である点を加味すれば、第３電位Ｖcc_Mの最適な範囲は、有機ＥＬ素子１２７を確実に消光でき、かつ、駆動トランジスタ１２１のソース電位をゲート電位に近づけることができる程度であればよい。有機ＥＬ素子１２７を確実に消光させる点を加味すれば、第１電位Ｖcc_Hよりは遙かに低電圧（“ＶthEL＋Ｖcath”以下）であることが要求される。また、劣化防止処理期間Ｃ２に駆動トランジスタ１２１のゲートをオフセット電位Ｖofs に設定する点も加味すると、第３電位Ｖcc_Mはオフセット電位Ｖofs 以下で、オフセット電位Ｖofs に近い値であることが望ましいと考えられる。
【０１３１】
＜３値駆動回路＞
［第１例］
図７〜図７Ａは、本実施形態の駆動手法を適用するための３値駆動回路の第１例を説明する図である。第１例は、駆動走査部１０５内で第３電位Ｖcc_Mを生成し、電源駆動パルスDSL の電位を、第１電位Ｖcc_H、第２電位Ｖcc_L、第３電位Ｖcc_Mの３値の何れかに切り替えて、電源供給線１０５DSL に出力する態様である。この第１例は、既存の駆動走査部１０５に変更を加える必要があるが、実体的（外形的）な変更を加えずに、本実施形態の焼き付き防止の仕組みを実現できる利点がある。
【０１３２】
このような態様の回路構成としては種々のものが考えられるが、ここでは、一例として、既存の出力回路４００Ｘに対して、第３電位Ｖcc_Mの出力時には、第１電位Ｖcc_Hや第２電位Ｖcc_Lの出力を停止するように変更を加えた構成にしている。具体的には先ず、図示を割愛するが、駆動走査部１０５には、表示パネル部１００の外部に設けられ、その出力インピーダンスが十分に小さな電源回路から、第１電位Ｖcc_Hと第２電位Ｖcc_Lとが供給されるようになっている。
【０１３３】
図７（１）に示すように、既存（比較例）の出力回路４００Ｘは、一例として、ｐチャネル型のトランジスタ（ｐ型トランジスタ）４０２と、ｎチャネル型のトランジスタ（ｎ型トランジスタ）４０４とを、第１電位Ｖcc_H用の供給端４００Ｈと第２電位Ｖcc_L用の供給端４００Ｌとの間に直列に配置した構成となっている。
【０１３４】
ｐ型トランジスタ４０２のソース端Ｓは第１電位Ｖcc_H用の供給端４００Ｈに接続され、ｎ型トランジスタ４０４のソース端Ｓは第２電位Ｖcc_L用の供給端４００Ｌに接続されている。ｐ型トランジスタ４０２とｎ型トランジスタ４０４の各ドレインＤを共通に接続し、その接続点を電源供給線１０５DSL に接続している。全体としては、ＣＭＯＳインバータを構成している。ｐ型トランジスタ４０２とｎ型トランジスタ４０４の各ゲートＧを共通に接続し、その接続点にアクティブＬの電源走査パルスNDS を供給する。
【０１３５】
電源走査パルスNDS がアクティブＬのときにはｎ型トランジスタ４０４がオフするとともにｐ型トランジスタ４０２がオンするので第１電位Ｖcc_Hが電源供給線１０５DSL に供給される。一方、電源走査パルスNDS がインアクティブＨのときにはｐ型トランジスタ４０２がオフするとともにｎ型トランジスタ４０４がオンするので第２電位Ｖcc_Lが電源供給線１０５DSL に供給される。この動作から分かるように出力回路４００Ｘは電源電圧切替回路として機能している。
【０１３６】
図７（２）および図７Ａに示すように、第１例の有機ＥＬ表示装置１Ａは、電源駆動パルスDSL を３値駆動可能にするための第１例の出力回路４００Ａを駆動走査部１０５内に備えている。
【０１３７】
第１例の出力回路４００Ａは先ず、正電圧側の第１電位Ｖcc_Hと、負電圧側の第２電位Ｖcc_Lと、劣化防止電位としての第３電位Ｖcc_Mと言った３種類の電圧と、基準の接地電位GND が供給されるようになっている。出力回路４００Ａは、図示しない垂直デコーダから供給される２値の電源走査パルスNDS および劣化防止電位設定信号GMに基づいて、３値駆動用の電源駆動パルスDSL を生成可能に構成されている。
【０１３８】
出力回路４００Ａは、出力段に、ｐ型トランジスタ４０２とｎ型トランジスタ４０４の他に、第３電位Ｖcc_Mを電源供給線１０５DSL に出力するｎ型トランジスタ４０６を有する。ｎ型トランジスタ４０６はｐ型トランジスタ４０２と直列接続され、また、ｎ型トランジスタ４０６と概ね並列に配置されている。
【０１３９】
ｎ型トランジスタ４０６のソースは第３電位Ｖcc_Mに接続されている。ｐ型トランジスタ４０２とｎ型トランジスタ４０４とｎ型トランジスタ４０６の各ドレインを共通に接続し、その接続点を電源駆動パルスDSL 用の出力端に接続している。
【０１４０】
出力回路４００は、出力段の前段に、２入力型のＯＲゲート４１２、インバータ４１４、２入力型のＡＮＤゲート４１６を有する。ＯＲゲート４１２とＡＮＤゲート４１６の各一方の入力端には電源走査パルスNDS が共通に供給される。
【０１４１】
ＯＲゲート４１２の他方の入力端とインバータ４１４の入力端には、劣化防止電位設定信号GMが供給される。劣化防止電位設定信号GMは、第３電位Ｖcc_Mを電源供給線１０５DSL に供給する期間にのみアクティブＨとなる論理情報である。インバータ４１４の出力（反転劣化防止電位設定信号NGM ）がＡＮＤゲート４１６の他方の入力端に供給される。
【０１４２】
ＯＲゲート４１２は、電源走査パルスNDS と劣化防止電位設定信号GMとの論理和をとり、その論理和出力でｐ型トランジスタ４０２を駆動する。したがって、電源走査パルスNDS がＬで、かつ、劣化防止電位設定信号GMがＬの期間のみｐ型トランジスタ４０２がオンする。このときには、ｎ型トランジスタ４０４とｎ型トランジスタ４０６がオフであり、電源供給線１０５DSL には、第１電位Ｖcc_Hが供給される。
【０１４３】
ＡＮＤゲート４１６は、電源走査パルスNDS と反転劣化防止電位設定信号NGM との論理積をとり、その論理積出力でｎ型トランジスタ４０４を駆動する。したがって、電源走査パルスNDS がＨで、かつ、劣化防止電位設定信号GMがＬ（反転劣化防止電位設定信号NGM がＨ）の期間のみｎ型トランジスタ４０４がオンする。このときには、ｐ型トランジスタ４０２とｎ型トランジスタ４０６がオフであり、電源供給線１０５DSL には、第２電位Ｖcc_Lが供給される。
【０１４４】
劣化防止電位設定信号GMはｎ型トランジスタ４０６のゲートに供給されており、劣化防止電位設定信号GMでｎ型トランジスタ４０６が駆動される。したがって、電源走査パルスNDS がＬ，Ｈの何れであるかを問わず、劣化防止電位設定信号GMがＨの期間のみｎ型トランジスタ４０６がオンする。このときには、ｐ型トランジスタ４０２とｎ型トランジスタ４０４がオフであり、電源供給線１０５DSL には、第３電位Ｖcc_Mが供給される。
【０１４５】
出力回路４００Ａの３値駆動に対応する構成例は一例に過ぎず、様々な変形例を採ることができる。たとえば、原理的には、図７（２）に示した構成にすればよいのであるが、実際には、ゲート遅延の関係からｐ型トランジスタ４０２とｎ型トランジスタ４０４とｎ型トランジスタ４０６の何れか２つもしくは３つともが同時にオンすることによる貫通電流の発生を防止するべく、各トランジスタ４０２，４０４，４０６がともにオンする期間が生じないように遷移タイミングを少しずらす仕組みを講じることが考えられる。
【０１４６】
［第２例］
図８は、本実施形態の駆動手法を適用するための３値駆動回路の第２例を説明する図である。第２例は、垂直駆動部１０３外で第３電位Ｖcc_Mを生成し、駆動走査部１０５から出力される２値の電源駆動パルスDSLXと第３電位Ｖcc_Mを切り替えて電源供給線１０５DSL に供給する態様である。この第２例は、既存の駆動走査部１０５に変更を加えずに、本実施形態の焼き付き防止の仕組みを実現できる利点がある。
【０１４７】
第２例の有機ＥＬ表示装置１Ｂの垂直駆動部１０３Ｂは、駆動走査部１０５（出力回路４００Ｘ）と電源供給線１０５DSL との間に２入力−１出力型の電圧切替回路４２０を備えている。電圧切替回路４２０は、一方の入力端に駆動走査部１０５の出力回路４００Ｘから出力される２値（第１電位Ｖcc_Hと第２電位Ｖcc_L）の電源駆動パルスDSLXが供給され、他方の入力端に図示しない電圧生成部からの第３電位Ｖcc_Mが供給される。電圧切替回路４２０の制御入力端には劣化防止電位設定信号GMが供給される。
【０１４８】
劣化防止電位設定信号GMは、第１例と同様に、第３電位Ｖcc_Mを電源供給線１０５DSL に供給する期間にのみアクティブＨとなる論理情報である。劣化防止電位設定信号GMで電圧切替回路４２０の選択動作が制御され、出力回路４００Ｘから出力される電源駆動パルスDSLXがＬ，Ｈの何れであるかを問わず、劣化防止電位設定信号GMがＨの期間のみ第３電位Ｖcc_Mを選択して出力し、劣化防止電位設定信号GMがＬのときには出力回路４００Ｘから出力される電源駆動パルスDSLXを選択して出力する。
【０１４９】
＜電子機器＞
以上説明した本実施形態の有機ＥＬ表示装置１を始めとする本実施形態の焼付け防止対策手法を適用した表示装置は、電子機器に入力された映像信号、もしくは、電子機器内で生成した映像信号を、画像もしくは映像として表示するあらゆる分野の電子機器の表示装置に適用できる。一例として、図９〜図９Ｂに示す様々な電子機器、たとえば、デジタルカメラ、ノート型パーソナルコンピュータ、携帯電話などの携帯端末装置、ビデオカメラなどの表示装置に適用できる。
【０１５０】
なお、表示装置は、封止された構成のモジュール形状のものをも含むものとする。たとえば、画素アレイ部１０２に透明なガラスなどの対向部に貼り付けられて形成された表示モジュールが該当する。この透明な対向部には、カラーフィルタ、保護膜など、さらには、遮光膜が設けられてもよい。なお、表示モジュールには、外部から画素アレイ部への信号などを入出力するための回路部やＦＰＣ（フレキシブルプリントサーキット）などが設けられていてもよい。
【０１５１】
以下に、本実施形態の焼付け防止対策手法を適用した表示装置が搭載される電子機器の具体例について説明する。
【０１５２】
図９（１）は、本実施形態の焼付け防止対策手法を適用した表示装置が搭載されるテレビジョンセットの外観を示す斜視図である。本例のテレビジョンセットは、フロントパネル９０２やフィルターガラス９０３などから構成される映像表示画面部９０１を含み、映像表示画面部９０１として本実施形態による表示装置を用いることにより作製される。
【０１５３】
図９（２）は、本実施形態の焼付け防止対策手法を適用した表示装置が搭載されるデジタルカメラの外観を示す斜視図であり、図９（２−１）は表側から見た斜視図、図９（２−２）は裏側から見た斜視図である。本例のデジタルカメラは、フラッシュ用の発光部９１１、表示部９１２、メニュースイッチ９１３、シャッターボタン９１１４などを含み、その表示部９１２として本実施形態による表示装置を用いることにより作製される。
【０１５４】
図９Ａ（１）は、本実施形態の焼付け防止対策手法を適用した表示装置が搭載されるノート型パーソナルコンピュータの外観を示す斜視図である。本例のノート型パーソナルコンピュータは、本体９２１に、文字や図形などを入力するとき操作されるキーボード１２２、画像を表示する表示部９２３などを含み、その表示部９２３として本実施形態による表示装置を用いることにより作製される。
【０１５５】
図９Ａ（２）は、本実施形態の焼付け防止対策手法を適用した表示装置が搭載されるビデオカメラの外観を示す斜視図である。本例のビデオカメラは、本体部９３１、前方を向いた側面に被写体撮影用のレンズ９３２、撮影時のスタート／ストップスイッチ９３３、表示部９３４などを含み、その表示部９３４として本実施形態による表示装置を用いることにより作製される。
【０１５６】
図９Ｂは、本実施形態の焼付け防止対策手法を適用した表示装置が搭載される携帯電話機（携帯端末装置の一例）を示す外観図である。図９Ｂ（１）は開いた状態での正面図、図９Ｂ（２）はその側面図、図９Ｂ（３）は閉じた状態での正面図、図９Ｂ（４）は左側面図、図９Ｂ（５）は右側面図、図９Ｂ（６）は上面図、図９Ｂ（７）は下面図である。本例の携帯電話機は、上側筐体９４１、下側筐体９４２、連結部９４３（ここではヒンジ部）、ディスプレイ９４４、サブディスプレイ９４５、ピクチャーライト９４６、カメラ９４７などを含んでいる。そして、ディスプレイ９４４やサブディスプレイ９４５として本実施形態による表示装置を用いることにより本例の携帯電話機が作製される。
【０１５７】
以上、本発明について実施形態を用いて説明したが、本発明の技術的範囲は前記実施形態に記載の範囲には限定されない。発明の要旨を逸脱しない範囲で前記実施形態に多様な変更または改良を加えることができ、そのような変更または改良を加えた形態も本発明の技術的範囲に含まれる。
【０１５８】
また、前記の実施形態は、クレーム（請求項）に係る発明を限定するものではなく、また実施形態の中で説明されている特徴の組合せの全てが発明の解決手段に必須であるとは限らない。前述した実施形態には種々の段階の発明が含まれており、開示される複数の構成要件における適宜の組合せにより種々の発明を抽出できる。実施形態に示される全構成要件から幾つかの構成要件が削除されても、効果が得られる限りにおいて、この幾つかの構成要件が削除された構成が発明として抽出され得る。
【０１５９】
＜画素回路の変形例＞
たとえば、画素回路Ｐの側面からの変更が可能である。たとえば、回路理論上は「双対の理」が成立するので、画素回路Ｐに対しては、この観点からの変形を加えることができる。この場合、図示を割愛するが、先ず、前述の実施形態に示した画回路Ｐがｎ型の駆動トランジスタ１２１を用いて構成しているのに対し、ｐ型の駆動トランジスタ１２１を用いて画素回路Ｐを構成する。これに合わせて映像信号Ｖsig のオフセット電位Ｖofs に対する信号振幅ΔＶinの極性や電源電圧の大小関係を逆転させるなど、双対の理に従った変更を加える。
【０１６０】
このような双対の理を適用して駆動トランジスタ１２１をｐ型にした変形例の有機ＥＬ表示装置においても、ｎ型の駆動トランジスタ１２１にした有機ＥＬ表示装置と同様に、閾値補正動作、移動度補正動作、およびブートストラップ動作を実行することができるし、焼き付け防止対策を適用することができる。
【０１６１】
なお、ここで説明した画素回路Ｐの変形例は、前記実施形態に示した構成に対して「双対の理」に従った変更を加えたものであるが、回路変更の手法はこれに限定されるものではない。閾値補正動作を実行するに当たり、書込走査部１０４での走査に合わせて各水平周期内でオフセット電位Ｖofs と信号電位Ｖin（＝Ｖofs ＋ΔＶin）で切り替わる映像信号Ｖsig が映像信号線１０６HSに伝達されるように駆動を行ない、閾値補正の初期化動作のために駆動トランジスタ１２１のドレイン側（電源供給側）を第１電位と第２電位とでスイッチング駆動を行なうものである限り、画素回路Ｐを構成するトランジスタ数は問わない。さらに、表示後の非表示期間における駆動トランジスタのバイアス状態に伴う劣化要因という課題を持つ限り、画素回路Ｐを構成するトランジスタ数や保持容量数は不問であり、たとえばトランジスタ数が３個以上であってもよく、それらの全てに、前述の本実施形態の焼付け防止対策を適用することができる。
【０１６２】
また、閾値補正動作を実行するに当たり、オフセット電位Ｖofs と信号電位Ｖinを駆動トランジスタ１２１のゲートに供給する仕組みとしては、前記実施形態の２ＴＲ構成のように映像信号Ｖsig で対処することに限らず、たとえば、特開２００６−２１５２１３号公報に記載のように、別のトランジスタを介して供給する仕組みを採ることもできる。それらの変形例においても、高輝度表示後の消灯期間における駆動トランジスタのバイアス状態による劣化現象を解消する（焼付け防止対策を図る）という本実施形態の思想を適用することができる。
【符号の説明】
【０１６３】
１…有機ＥＬ表示装置、１００…表示パネル部、１０１…支持基板、１０２…画素アレイ部、１０３…垂直駆動部、１０４…書込走査部、１０４WS…書込走査線、１０５…駆動走査部、１０５DSL …電源供給線、１０６…水平駆動部、１０６HS…映像信号線、１０９…制御部、１２０…保持容量、１２１…駆動トランジスタ、１２５…サンプリングトランジスタ、１２７…有機ＥＬ素子、２００…駆動信号生成部、３００…映像信号処理部、４００…出力回路、４２０…電圧切替回路、Ｐ…画素回路
【技術分野】
【０００１】
本発明は、表示素子（電気光学素子とも称される）を具備する画素回路（画素とも称される）を有する表示装置、表示装置を具備する電子機器、表示装置の駆動方法に関する。より詳細には、表示素子の劣化防止技術に関する。
【背景技術】
【０００２】
画素の表示素子として、印加される電圧や流れる電流によって輝度が変化する電気光学素子を用いた表示装置がある。たとえば、印加される電圧によって輝度が変化する電気光学素子としては液晶表示素子が代表例であり、流れる電流によって輝度が変化する電気光学素子としては、有機エレクトロルミネッセンス（Organic Electro Luminescence, 有機ＥＬ, Organic Light Emitting Diode, OLED；以下、有機ＥＬと記す） 素子が代表例である。後者の有機ＥＬ素子を用いた有機ＥＬ表示装置は、画素の表示素子として、自発光素子である電気光学素子を用いたいわゆる自発光型の表示装置である。
【０００３】
ところで、電気光学素子を用いた表示装置においては、その駆動方式として、単純（パッシブ）マトリクス方式とアクティブマトリクス方式とを採ることができる。ただし、単純マトリクス方式の表示装置は、構造が単純であるもの、大型でかつ高精細の表示装置の実現が難しいなどの問題がある。
【０００４】
このため、近年、画素内部の発光素子に供給する画素信号を、同様に画素内部に設けた能動素子、たとえば絶縁ゲート型電界効果トランジスタ（一般には、薄膜トランジスタ(Thin Film Transistor ;ＴＦＴ)をスイッチングトランジスタとして使用して制御するアクティブマトリクス方式の開発が盛んに行なわれている。
【０００５】
電気光学素子で表示を行なう際には、映像信号線を介して供給される入力画像信号をスイッチングトランジスタ（サンプリングトランジスタと称する）で駆動トランジスタのゲート（制御入力端子）に設けられた保持容量（画素容量とも称する）に取り込み、取り込んだ入力画像信号に応じた駆動信号を電気光学素子に供給する。
【０００６】
電気光学素子として液晶表示素子を用いる液晶表示装置では、液晶表示素子が電圧駆動型の素子であることから、保持容量に取り込んだ入力画像信号に応じた電圧信号そのもので液晶表示素子を駆動する。これに対して、電気光学素子として有機ＥＬ素子などの電流駆動型の素子を用いる表示装置では、保持容量に取り込んだ入力画像信号に応じた駆動信号（電圧信号）を駆動トランジスタで電流信号に変換して、その駆動電流を有機ＥＬ素子などに供給する。
【０００７】
ここで、電気光学素子を駆動する能動素子（駆動トランジスタ）の閾値電圧や移動度あるいは電気光学素子の特性がプロセス変動や環境によってばらついてしまうことが知られている。このため、表示装置の画面全体に亘って表示輝度を均一に制御するため、各画素回路内で上述した駆動用の能動素子や電気光学素子の特性変動に起因する輝度変動を補正するための仕組み（駆動信号を一定に維持する駆動信号一定化処理技術）が種々検討されている（特許文献１を参照）。
【先行技術文献】
【特許文献】
【０００８】
【特許文献１】特開２００８−０３３１９３号公報
【発明の概要】
【発明が解決しようとする課題】
【０００９】
駆動信号一定化処理技術を適用した場合、画素回路の構成や駆動タイミングによっては、非表示時に、駆動トランジスタのドレイン・ソース間電圧がゼロのときに、ゲート・ソース間電圧が表示期間と同じ状態が維持されてしまう。白表示など相対的に高輝度での表示期間には、ゲート・ソース間電圧が相対的に大きく、その結果、高輝度での表示期間後の非表示時には、ゲート・ソース間電圧が大きくなり駆動トランジスタの劣化の要因となることが分かった。このような駆動トランジスタの劣化を「焼付き現象」と称する。
【００１０】
本発明は、上記事情に鑑みてなされたものであり、駆動トランジスタの焼付き現象に伴う劣化を防止することができる仕組みを提供することを目的とする。
【課題を解決するための手段】
【００１１】
本発明は先ず、駆動信号を生成する駆動トランジスタ、駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および信号振幅に応じた情報を保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された画素アレイ部を備える。
【００１２】
そして、本発明の第１の態様は、電気光学素子の非表示期間に駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定してから駆動トランジスタの閾値補正を行なうように画素回路を駆動する垂直駆動部を備える点に特徴がある。
【００１３】
本発明の第２の態様は、駆動トランジスタの電源供給端の電位を、電気光学素子の表示期間に第１の電位に設定し、駆動トランジスタの閾値補正を行なうための初期化期間に第２の電位に設定し、表示期間と初期化期間の間の期間に第１の電位と第２の電位の間の第３の電位に設定して電気光学素子を非表示にさせる垂直駆動部を備える点に特徴がある。
【００１４】
本発明の第３の態様は、駆動トランジスタの電源供給端と出力端との電位を等しくして電気光学素子を表示状態から非表示状態に遷移させて駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定した後に、駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定してから駆動トランジスタの閾値補正を行なうように画素回路を駆動する垂直駆動部を備える点に特徴がある。
【００１５】
本発明の第４の態様は、電気光学素子を表示状態から非表示状態に遷移させた後に駆動トランジスタの閾値補正を行なう前には、直前の表示輝度に拘わらず駆動トランジスタの制御入力端と出力端との間の電位差を同じ状態にした後に、駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定する垂直駆動部を備える点に特徴がある。
【００１６】
第１の態様は、駆動トランジスタの制御入力端と出力端の電圧差の側面から本発明を規定したものである。第２の態様は、駆動トランジスタの電源供給線の設定電圧の側面から本発明を規定したものである。第３および第４の態様は、駆動トランジスタの制御入力端と出力端の電圧差と閾値補正の初期化動作の側面から規定したものである。
【００１７】
第１〜第４の態様は、発明の観点が異なるが、何れも、電気光学素子を表示状態から非表示状態に遷移させたとき、駆動トランジスタの閾値補正の初期化処理を行なう前には、駆動トランジスタの制御入力端と出力端の電圧差を、本発明を適用しない場合よりも小さくしようとするものであり、第１〜第４の態様は共通する技術思想を有するものである。
【発明の効果】
【００１８】
本発明の一態様によれば、電気光学素子を表示状態から非表示状態に遷移させたときに、駆動トランジスタの閾値補正の初期化処理を行なう前には、直前の表示輝度に拘わらず、駆動トランジスタの制御入力端と出力端との間の電位差が、本発明を適用しない場合よりも小さくできる。そのため、本発明を採用しない場合と比較して、駆動トランジスタの劣化を抑制できる。
【図面の簡単な説明】
【００１９】
【図１】表示装置の一実施形態であるアクティブマトリクス型表示装置の構成の概略を示すブロック図である。
【図２】本実施形態の画素回路を説明する図である。
【図３】図２に示した画素回路に関する比較例の駆動タイミングを説明するタイミングチャートである。
【図４】駆動トランジスタの動作の詳細を説明する図である。
【図５】焼付け防止対策の原理を説明するタイミングチャートである。
【図６】本実施形態の対策手法を適用した場合と適用しない比較例を対比して示した図である。
【図７】３値駆動回路の第１例を説明する図（その１）である。
【図７Ａ】３値駆動回路の第１例を説明する図（その２）である。
【図８】３値駆動回路の第２例を説明する図である。
【図９】本実施形態が適用される電子機器の一例を示す図（その１）である。
【図９Ａ】本実施形態が適用される電子機器の一例を示す図（その２）である。
【図９Ｂ】本実施形態が適用される電子機器の一例を示す図（その３）である。
【発明を実施するための形態】
【００２０】
以下、図面を参照して本発明の実施形態について詳細に説明する。各機能要素を形態別に区別する際には、Ａ，Ｂなどのように大文字の英語の参照子を付して記載し、特に区別しないで説明する際にはこの参照子を割愛して記載する。図面においても同様である。
【００２１】
説明は以下の順序で行なう。
１．基本概念（表示装置の概要、画素駆動の基本、劣化防止駆動）
２．表示装置の全体概要
３．画素回路
４．画素回路の動作（比較例、焼付き現象の説明、焼付け防止対策の原理、対比、第３電位の適正範囲）
５．３値駆動回路（第１例、第２例）
６．電子機器
【００２２】
＜基本概念＞
［表示装置の概要］
先ず、電気光学素子を備えた表示装置の概要について説明する。表示装置は、複数の画素を備えている。各画素は、発光部を具備した発光素子（電気光学素子の一例）とその駆動回路を備える。発光部として、たとえば、有機エレクトロルミネッセンス発光部、無機エレクトロルミネッセンス発光部、ＬＥＤ発光部、半導体レーザー発光部などを用いることができる。
【００２３】
以下に説明する例にあっては、発光素子は、有機エレクトロルミネッセンス発光部を備えている。より具体的には、発光素子は、駆動回路に接続された有機エレクトロルミネッセンス発光部（発光部ＥＬＰ）が積層された構造を有する有機エレクトロルミネッセンス素子（有機ＥＬ素子）である。有機ＥＬ素子の発光部は、たとえば、アノード電極、正孔輸送層、発光層、電子輸送層、カソード電極などの周知の構成、構造を有する。
【００２４】
表示装置は、少なくとも、信号電位を画素回路Ｐに供給する水平駆動部（信号出力回路）、水平駆動部から供給された信号電位を駆動トランジスタのゲートに供給する走査を行なう書込走査部と、画素回路Ｐが配列される画素アレイ部を備える。
【００２５】
画素アレイ部は、第１の方向（たとえば水平方向）にＨ個、第１の方向とは異なる第２の方向（具体的には、第１の方向に直交する方向、たとえばは垂直方向）にＶ個、合計Ｈ×Ｖ個の２次元マトリクス状に配列された発光素子、書込走査部に接続され第１の方向に延びるＶ本の書込走査線、水平駆動部に接続され第２の方向に延びるＨ本の映像信号線（データ線）を備える。水平駆動部、書込走査部、画素アレイ部の構成、構造は、周知の構成、構造とすることができる。
【００２６】
発光部（発光素子）を駆動するための駆動回路（画素回路）として各種の回路がある。たとえば、公知のものとしては、５トランジスタ／１容量部から基本的に構成された駆動回路（５Ｔｒ／１Ｃ駆動回路）、４トランジスタ／１容量部から基本的に構成された駆動回路（４Ｔｒ／１Ｃ駆動回路）、３トランジスタ／１容量部から基本的に構成された駆動回路（３Ｔｒ／１Ｃ駆動回路）、２トランジスタ／１容量部から基本的に構成された駆動回路（２Ｔｒ／１Ｃ駆動回路）がある。
【００２７】
トランジスタとしては、最低限の構成として、発光素子を駆動する駆動トランジスタと書込走査部によりスイッチング駆動されるサンプリングトランジスタ（書き込みトランジスタ）を備える。本実施形態では、ブートストラップ機能を実現するべく、容量部は駆動トランジスタのゲートとソースの間に接続する。
【００２８】
駆動トランジスタのゲート、サンプリングトランジスタのソース／ドレイン領域、容量部の一方の端子の接続点を第１ノードとし、駆動トランジスタのソース、発光素子の一方の端子、容量部の他方の端子の接続点を第２ノードとする。
【００２９】
カラー表示対応とする場合、典型的には、１つの画素回路は、３つの副画素（赤色を発光する赤色発光副画素、緑色を発光する緑色発光副画素、青色を発光する青色発光副画素）で構成する。
【００３０】
［画素駆動の基本］
以下の説明において、各画素を構成する発光素子は、線順次駆動されるとし、表示フレームレートをＦＲ（回／秒）とする。すなわち、第ｖ行目（ただし、ｖ＝１，２，３，…，Ｖ）に配列された（Ｖ／３）個の画素、より具体的には、Ｖ個の副画素のそれぞれを構成する発光素子が同時に駆動される。換言すれば、１つの行を構成する各発光素子にあっては、その発光／非発光のタイミングは、それらが属する行単位で制御される。なお、１つの行を構成する各画素について映像信号を書き込む処理は、全ての画素について同時に映像信号を書き込む処理（以下、単に、同時書込み処理と記す場合がある）であってもよいし、画素ごとに順次映像信号を書き込む処理（以下、単に、順次書込み処理と記す場合がある）であってもよい。何れの書込み処理とするかは、駆動回路の構成に応じて適宜選択すればよい。
【００３１】
原則として、第ｖ行目、第ｈ列（ｈ＝１，２，３，…，Ｈ）に位置する発光素子に関する駆動、動作を説明するが、以下では第（ｈ，ｖ）番目の発光素子あるいは第（ｈ，ｖ）番目の副画素と記す。そして、第ｖ行目に配列された各発光素子の水平走査期間（第ｖ番目の水平走査期間）が終了するまでに、各種の処理（閾値電圧キャンセル処理、書込み処理、移動度補正処理）が行なわれる。書込み処理や移動度補正処理は、第ｖ番目の水平走査期間内に行なわれる必要がある。一方、駆動回路の種類によっては、閾値電圧キャンセル処理やこれに伴う前処理を第ｖ番目の水平走査期間より先行して行なうことができる。
【００３２】
そして、各種の処理が全て終了した後、第ｖ行目に配列された各発光素子を構成する発光部を発光させる。各種の処理が全て終了した後、直ちに発光部を発光させてもよいし、所定の期間（たとえば、所定の行数分の水平走査期間）が経過した後に発光部を発光させてもよい。この所定の期間は、表示装置の仕様や駆動回路の構成などに応じて、適宜設定することができる。以下の説明においては、説明の便宜のため、各種の処理終了後、直ちに発光部を発光させるものとする。そして、第ｖ行目に配列された各発光素子を構成する発光部の発光は、第（ｖ＋ｖ'）行目に配列された各発光素子の水平走査期間の開始直前まで継続される。
【００３３】
「ｖ」は、表示装置の設計仕様によって決定される。すなわち、ある表示フレームの第ｖ行目に配列された各発光素子を構成する発光部の発光は、第（ｖ＋ｖ'−１）番目の水平走査期間まで継続される。一方、第（ｖ＋ｖ'）番目の水平走査期間の始期から、次の表示フレームにおける第ｖ番目の水平走査期間内において書込み処理や移動度補正処理が完了するまで、第ｖ行目に配列された各発光素子を構成する発光部は、原則として非発光状態を維持する。非発光状態の期間（非発光期間）を設けることにより、アクティブマトリクス駆動に伴う残像ボケが低減され、動画品位をより優れたものとすることができる。
【００３４】
ただし、各副画素（発光素子）の発光状態／非発光状態は、以上に説明した状態に限定するものではない。また、水平走査期間の時間長は、（１／ＦＲ）×（１／Ｖ）秒未満の時間長である。（ｖ＋ｖ'）の値がＶを越える場合、越えた分の水平走査期間は、次の表示フレームにおいて処理される。
【００３５】
駆動回路の構成に拘わらず、発光部の駆動方法は、たとえば、以下の通りとする。
【００３６】
ａ）第１ノードと第２ノードとの間の電位差が、駆動トランジスタの閾値電圧を越え、かつ、第２ノードと発光部に備えられたカソード電極との間の電位差が、発光部の閾値電圧を越えないように、第１ノードに第１ノード初期化電圧を印加し、第２ノードに第２ノード初期化電圧を印加する前処理を行なう。この工程を前処理工程という。この前処理工程は、放電工程と初期化工程に区別することもある。
【００３７】
ｂ）第１ノードの電位を保った状態で、第１ノードの電位から駆動トランジスタ閾値電圧を減じた電位に向かって、第２ノードの電位を変化させる閾値電圧キャンセル処理を行なう。この工程を閾値電圧補正工程という。
【００３８】
ｃ）書込走査線からの信号によりオン状態とされたサンプリングトランジスタを介して、映像信号線から映像信号を第１ノードに印加する書込み処理を行なう。この工程を信号書込み工程という。
【００３９】
ｄ）書込走査線からの信号によりサンプリングトランジスタをオフ状態とすることにより第１ノードを浮遊状態とし、第１ノードと第２ノードとの間の電位差の値に応じた電流を駆動トランジスタにより発光部に流すことにより発光部を駆動する。この工程を発光工程という。
【００４０】
閾値電圧補正工程と信号書込み工程との間には、さらに移動度補正工程を追加する態様もあり、また、移動度補正工程を信号書込み工程と同時に行なう態様もある。
【００４１】
ここで、閾値電圧補正工程において、第１ノードの電位から駆動トランジスタの閾値電圧を減じた電位に向かって、第２ノードの電位を変化させる閾値電圧キャンセル処理を行なう。より具体的には、第１ノードの電位から駆動トランジスタの閾値電圧を減じた電位に向かって第２ノードの電位を変化させるために、前処理工程における第２ノードの電位に駆動トランジスタの閾値電圧を加えた電圧を超える電圧を、駆動トランジスタの一方のソース／ドレイン領域に印加する。
【００４２】
定性的には、閾値電圧キャンセル処理において、第１ノードと第２ノードとの間の電位差（換言すれば、駆動トランジスタのゲートとソースとの間の電位差）が駆動トランジスタの閾値電圧に近づく程度は、閾値電圧キャンセル処理の時間により左右される。したがって、たとえば閾値電圧キャンセル処理の時間を充分長く確保した形態にあっては、第２ノードの電位は第１ノードの電位から駆動トランジスタの閾値電圧を減じた電位に達する。そして、第１ノードと第２ノードとの間の電位差は駆動トランジスタの閾値電圧に達し、駆動トランジスタはオフ状態となる。一方、たとえば閾値電圧キャンセル処理の時間を短く設定せざるを得ない形態にあっては、第１ノードと第２ノードとの間の電位差が駆動トランジスタの閾値電圧より大きく、駆動トランジスタはオフ状態とはならない場合がある。閾値電圧キャンセル処理の結果として、必ずしも駆動トランジスタがオフ状態となることを要しない。
【００４３】
［劣化防止駆動］
本実施形態の画素駆動手法にあっては、前処理工程において、消光期間（非表示期間）に入ったら先ず、その直前の発光期間の表示レベルに拘わらず、駆動トランジスタのゲート・ソース間電圧を閾値電圧近傍（好ましくは閾値電圧以下、好適には０Ｖ程度）に設定してから、本来の前処理工程の動作に移行するようにする。
【００４４】
このような動作を必要とするのは、相対的に輝度の高い高輝度レベルでの表示（典型的には白表示）をした後の消光期間に、比較的大きなゲート・ソース間電圧が印加され続けることが、駆動トランジスタの劣化要因となることを防止するためである。特に、駆動トランジスタのドレイン側の電圧（電源電圧に相当）を、高電圧側の第１電位と低電圧側の第２電位とに切り替える駆動制御を行なう場合にこの問題が顕著に現われる。因みに、駆動トランジスタのドレインを低電圧側の第２電位に設定するのは、主に、閾値補正処理前の初期化のために行なわれる。
【００４５】
このような劣化防止駆動動作を実現するには、この動作用のスイッチングトランジスタを新たに設けることが考えられるが、それでは画素回路が大きくなる。そこで、本実施形態では、既存のトランジスタを制御することで、前記の動作を実現するようにする。既存の何れのトランジスタを利用するかは画素回路の構成次第である。以下では、最も簡易な構成である２Ｔｒ／１Ｃ駆動回路を例に、具体的に説明する。
【００４６】
＜表示装置の全体概要＞
図１は、表示装置の一実施形態であるアクティブマトリクス型表示装置の構成の概略を示すブロック図である。本実施形態では、たとえば画素の表示素子（電気光学素子）として有機ＥＬ素子を、能動素子として薄膜トランジスタ（ＴＦＴ；Thin Film Transistor）をそれぞれ用い、薄膜トランジスタを形成した半導体基板上に有機ＥＬ素子を形成してなるアクティブマトリクス型有機ＥＬディスプレイ（以下「有機ＥＬ表示装置」と称する）に適用した場合を例に説明する。このような有機ＥＬ表示装置は、半導体メモリやミニディスク（ＭＤ）やカセットテープなどの記録媒体を利用した携帯型の音楽プレイヤーやその他の電子機器の表示部に利用される。
【００４７】
なお、以下においては、画素の表示素子として有機ＥＬ素子を例に具体的に説明するが、これは一例であって、対象となる表示素子は有機ＥＬ素子に限らない。一般的に電流駆動で発光する表示素子の全てに、後述する実施形態が同様に適用できる。
【００４８】
図１に示すように、有機ＥＬ表示装置１は、表示パネル部１００と、駆動信号生成部２００と、映像信号処理部３００を備えている。表示パネル部１００は、複数の表示素子としての有機ＥＬ素子（図示せず）を持った画素回路Ｐ（画素とも称される）が表示アスペクト比である縦横比がＸ：Ｙ（たとえば９：１６）の有効映像領域を構成するように配置されている。駆動信号生成部２００は、表示パネル部１００を駆動制御する種々のパルス信号を発するパネル制御部の一例である。駆動信号生成部２００と映像信号処理部３００とは、１チップのＩＣ（Integrated Circuit；半導体集積回路）に内蔵されている。
【００４９】
たとえば、パネル型の表示装置では、ＴＦＴや電気光学素子などの画素回路を構成する素子を行列状に配置した画素アレイ部１０２と、画素アレイ部１０２の周辺に配置され、各画素回路Ｐを駆動するための走査線と接続された走査部（水平駆動部や垂直駆動部）を主要部とする制御部１０９と、制御部１０９を動作させるための各種の信号を生成する駆動信号生成部２００や映像信号処理部３００を備えて装置の全体が構成されるのが一般的である。
【００５０】
一方、製品形態としては、画素アレイ部１０２と制御部１０９を同一の支持基板１０１（ガラス基板）上に搭載した表示パネル部１００と駆動信号生成部２００や映像信号処理部３００を別体としつつ、図示のように、これら全てを備えたモジュール（複合部品）形態の有機ＥＬ表示装置１として提供されることに限らない。表示パネル部１００には画素アレイ部１０２を搭載し、この表示パネル部１００のみで有機ＥＬ表示装置１として提供することも可能である。この場合、表示パネル部１００のみで構成された有機ＥＬ表示装置１とは別基板（たとえばフレキシブル基板）上に制御部１０９や駆動信号生成部２００や映像信号処理部３００などの周辺回路を搭載する形態（周辺回路パネル外配置構成と称する）とする。
【００５１】
また、画素アレイ部１０２と制御部１０９とを同一の支持基板１０１上に搭載して表示パネル部１００を構成するパネル上配置構成の場合、画素アレイ部１０２のＴＦＴを生成する工程にて同時に制御部１０９（必要に応じて駆動信号生成部２００や映像信号処理部３００も）用の各ＴＦＴを生成する仕組み（ＴＦＴ一体構成と称する）と、ＣＯＧ（Chip On Glass ）実装技術により画素アレイ部１０２が搭載された支持基板１０１上に制御部１０９（必要に応じて駆動信号生成部２００や映像信号処理部３００も）用の半導体チップを直接実装する仕組み（ＣＯＧ搭載構成と称する）をとってもよい。
【００５２】
表示パネル部１００は、支持基板１０１の上に、画素回路Ｐがｎ行×ｍ列のマトリクス状に配列された画素アレイ部１０２と、画素回路Ｐを垂直方向に走査する垂直走査部の一例である垂直駆動部１０３と、画素回路Ｐを水平方向に走査する水平走査部の一例である水平駆動部（水平セレクタあるいはデータ線駆動部とも称される）１０６と、外部接続用の端子部（パッド部）１０８などが集積形成されている。すなわち、垂直駆動部１０３や水平駆動部１０６などの周辺駆動回路が、画素アレイ部１０２と同一の支持基板１０１上に形成された構成となっている。
【００５３】
垂直駆動部１０３としては、たとえば、書込走査部（ライトスキャナＷＳ；Write Scan）１０４や電源供給能力を有する電源スキャナとして機能する駆動走査部（ドライブスキャナＤＳ；Drive Scan）１０５を有する。垂直駆動部１０３と水平駆動部１０６とで、信号電位の保持容量への書込みや、閾値補正動作や、移動度補正動作や、ブートストラップ動作を制御する制御部１０９が構成される。
【００５４】
図示した垂直駆動部１０３および対応する走査線の構成は、画素回路Ｐが後述する本実施形態の２ＴＲ構成の場合に適合させて示したものであるが、画素回路Ｐの構成によっては、その他の走査部が設けられることもある。
【００５５】
画素アレイ部１０２は、一例として、図示する左右方向の一方側もしくは両側から書込走査部１０４および駆動走査部１０５で駆動され、かつ図示する上下方向の一方側もしくは両側から水平駆動部１０６で駆動されるようになっている。
【００５６】
端子部１０８には、有機ＥＬ表示装置１の外部に配された駆動信号生成部２００から、種々のパルス信号が供給されるようになっている。また同様に、映像信号処理部３００から映像信号Ｖsig が供給されるようになっている。カラー表示対応の場合には、色別（本例ではＲ（赤），Ｇ（緑），Ｂ（青）の３原色）の映像信号Ｖsig_Ｒ，Ｖsig_Ｇ，Ｖsig_Ｂが供給される。
【００５７】
一例としては、垂直駆動用のパルス信号として、垂直方向の書込み開始パルスの一例であるシフトスタートパルスSPDS，SPWSや垂直走査クロックCKDS，CKWSなど必要なパルス信号が供給される。また、水平駆動用のパルス信号として、水平方向の書込み開始パルスの一例である水平スタートパルスSPH や水平走査クロックCKH など必要なパルス信号が供給される。
【００５８】
端子部１０８の各端子は、配線１９９を介して、垂直駆動部１０３や水平駆動部１０６に接続されるようになっている。たとえば、端子部１０８に供給された各パルスは、必要に応じて図示を割愛したレベルシフタ部で電圧レベルを内部的に調整した後、バッファを介して垂直駆動部１０３の各部や水平駆動部１０６に供給される。
【００５９】
画素アレイ部１０２は、図示を割愛するが（詳細は後述する）、表示素子としての有機ＥＬ素子に対して画素トランジスタが設けられた画素回路Ｐが行列状に２次元配置され、この画素配列に対して行ごとに垂直走査線が配線されるとともに、列ごとに信号線（水平走査線の一例）が配線された構成となっている。
【００６０】
たとえば、画素アレイ部１０２には、垂直走査側の各走査線（垂直走査線：書込走査線１０４WSおよび電源供給線１０５DSL ）と水平走査側の走査線（水平走査線）である映像信号線（データ線）１０６HSが形成されている。垂直走査と水平走査の各走査線の交差部分には図示を割愛した有機ＥＬ素子とこれを駆動する薄膜トランジスタ（ＴＦＴ；Thin Film Transistor）が形成される。有機ＥＬ素子と薄膜トランジスタの組み合わせで画素回路Ｐを構成する。
【００６１】
具体的には、マトリクス状に配列された各画素回路Ｐに対しては、書込走査部１０４によって書込駆動パルスWSで駆動されるｎ行分の書込走査線１０４WS_1〜１０４WS_nおよび駆動走査部１０５によって電源駆動パルスDSL で駆動されるｎ行分の電源供給線１０５DSL_1 〜１０５DSL_n が画素行ごとに配線される。
【００６２】
書込走査部１０４および駆動走査部１０５は、駆動信号生成部２００から供給される垂直駆動系のパルス信号に基づき、書込走査線１０４WSおよび電源供給線１０５DSL を介して各画素回路Ｐを順次選択する。水平駆動部１０６は、駆動信号生成部２００から供給される水平駆動系のパルス信号に基づき、選択された画素回路Ｐに対し映像信号線１０６HSを介して映像信号Ｖsig の内の所定電位をサンプリングして保持容量に書き込ませる。
【００６３】
本実施形態の有機ＥＬ表示装置１においては、線順次駆動や面順次駆動あるいはその他の方式での駆動が可能になっており、たとえば、垂直駆動部１０３の書込走査部１０４および駆動走査部１０５は行単位で画素アレイ部１０２を走査するとともに、これに同期して水平駆動部１０６が、画像信号を、１水平ライン分を同時に、画素アレイ部１０２に書き込む。
【００６４】
水平駆動部１０６は、たとえば、全列の映像信号線１０６HS上に設けられた図示を割愛したスイッチを一斉にオンさせるドライバ回路を備えて構成され、映像信号処理部３００から入力される画素信号を、垂直駆動部１０３によって選択された行の１ライン分の全ての画素回路Ｐに同時に書き込むべく、全列の映像信号線１０６HS上に設けられた図示を割愛したスイッチを一斉にオンさせ、ドライバ回路を経由して水平走査線（映像信号線１０６HS）に映像信号Ｖsig （水平走査信号の一例）が供給される。
【００６５】
垂直駆動部１０３の各部は、論理ゲートの組合せ（ラッチも含む）とドライバ回路によって構成され、論理ゲートにより画素アレイ部１０２の各画素回路Ｐを行単位で選択し、ドライバ回路を経由して垂直走査線に垂直走査信号が供給される。なお、図１では、画素アレイ部１０２の一方側にのみ垂直駆動部１０３を配置する構成を示しているが、画素アレイ部１０２を挟んで左右両側に垂直駆動部１０３を配置する構成を採ることも可能である。同様に、図１では、画素アレイ部１０２の一方側にのみ水平駆動部１０６を配置する構成を示しているが、画素アレイ部１０２を挟んで上下両側に水平駆動部１０６を配置する構成を採ることも可能である。
【００６６】
＜画素回路＞
図２は、本実施形態の画素回路Ｐを説明する図である。画素回路Ｐは、ｎ型の駆動トランジスタ１２１を使用する。加えて、有機ＥＬ素子の経時変化による当該有機ＥＬ素子への駆動電流Ｉdsの変動を抑制するための回路、すなわち電気光学素子の一例である有機ＥＬ素子の電流−電圧特性の変化を補正して駆動電流Ｉdsを一定に維持する駆動信号一定化回路を備えた点に特徴を有する。さらに、有機ＥＬ素子の電流−電圧特性に経時変化があった場合でも駆動電流を一定にする機能を備えた点に特徴を有する。
【００６７】
すなわち、駆動トランジスタ１２１の他に走査用に１つのスイッチングトランジスタ（サンプリングトランジスタ１２５）を使用する２ＴＲ駆動の構成を採る。各スイッチングトランジスタを制御する電源駆動パルスDSL および書込駆動パルスWSのオン／オフタイミング（スイッチングタイミング）を後述する動作タイミングのように設定する。これにより、有機ＥＬ素子１２７の経時変化や駆動トランジスタ１２１の特性変動（たとえば閾値電圧や移動度などのばらつきや変動）による駆動電流Ｉdsに与える影響を防ぐ。２ＴＲ駆動の構成であり、素子数や配線数が少ないため、高精細化が可能である。
【００６８】
具体的には、画素回路Ｐは、保持容量１２０、ｎ型の駆動トランジスタ１２１、アクティブＨ（ハイ）の書込駆動パルスWSが供給されるｎ型トランジスタ１２５、電流が流れることで発光する電気光学素子（発光素子）の一例である有機ＥＬ素子１２７を有する。
【００６９】
駆動トランジスタ１２１のゲート（ノードＮＤ１２２）とソースとの間に保持容量１２０が接続され、駆動トランジスタ１２１のソースが直接に有機ＥＬ素子１２７のアノード端に接続されている。有機ＥＬ素子１２７のカソード端は、全画素共通のカソード共通配線１２７Ｋに接続され、カソード電位Ｖcath（たとえば接地電位GND ）が与えられる。
【００７０】
保持容量１２０は、ブートストラップ容量としても機能するようになっている。すなわち、画素回路Ｐは先ず、保持容量１２０の接続態様に特徴があり、有機ＥＬ素子１２７の経時変化による駆動電流変動を防ぐ回路として、駆動信号一定化回路の一例であるブートストラップ回路を構成する点にある。駆動トランジスタ１２１の特性変動（たとえば閾値電圧や移動度などのばらつきや変動）による駆動電流Ｉdsに与える影響を抑制する方法としては、各トランジスタ１２１，１２５の駆動タイミングを工夫することで対処する。
【００７１】
駆動トランジスタ１２１のドレインは、電源スキャナとして機能する駆動走査部１０５からの電源供給線１０５DSL に接続されている。電源供給線１０５DSL は、この電源供給線１０５DSL そのものが、駆動トランジスタ１２１に対しての電源供給能力を備える点に特徴を有する。
【００７２】
具体的には、駆動走査部１０５は、駆動トランジスタ１２１のドレインに対して、それぞれ電源電圧に相当する高電圧側の第１電位Ｖcc_Hと低電圧側の第２電位Ｖcc_Lとを切り替えて供給する電源電圧切替回路を具備している。
【００７３】
第２電位Ｖcc_Lとしては、映像信号線１０６HSにおける映像信号Ｖsig のオフセット電位Ｖofs （基準電位とも称する）より十分低い電位とする。具体的には、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgs（ゲート電位Ｖｇとソース電位Ｖｓの差）が駆動トランジスタ１２１の閾値電圧Ｖthより大きくなるように、電源供給線１０５DSL の低電位側の第２電位Ｖcc_Lを設定する。なお、オフセット電位Ｖofs は、閾値補正動作に先立つ初期化動作に利用するとともに映像信号線１０６HSを予めプリチャージにしておくためにも利用する。
【００７４】
サンプリングトランジスタ１２５は、ゲートが書込走査部１０４からの書込走査線１０４WSに接続され、ドレインが映像信号線１０６HSに接続され、ソースが駆動トランジスタ１２１のゲート（ノードＮＤ１２２）に接続されている。そのゲートには、書込走査部１０４からアクティブＨの書込駆動パルスWSが供給される。
【００７５】
サンプリングトランジスタ１２５は、ソースとドレインとを逆転させた接続態様とすることもできる。また、サンプリングトランジスタ１２５としては、ディプレション型およびエンハンスメント型の何れをも使用できる。
【００７６】
＜画素回路の動作＞
［比較例］
図３は、図２に示した画素回路Ｐに関する比較例の駆動タイミングを説明するタイミングチャートであり、線順次駆動の場合で示している。タイミングチャートにおいて、各期間を示す横軸の長さ（時間長）は模式的なものであり、各期間の時間長の割合を示すものではない。
【００７７】
図３においては、時間軸を共通にして、書込走査線１０４WSの電位変化、電源供給線１０５DSL の電位変化、および映像信号線１０６HSの電位変化を表してある。また、これらの電位変化と並行に、１行分（図では１行目）について駆動トランジスタ１２１のゲート電位Ｖｇおよびソース電位Ｖｓの変化も表してある。
【００７８】
なお、図３では、画素回路Ｐにおいて、閾値補正機能、移動度補正機能、ブートストラップ機能を実現するための基本例を示すもので、閾値補正機能、移動度補正機能、ブートストラップ機能を実現するための駆動タイミングは、図３に示す態様に限らず、様々な変形が可能である。これら様々な変形の駆動タイミングであっても、後述する各実施形態の仕組みを適用できる。
【００７９】
図３に示す駆動タイミングは、線順次駆動の場合であり、書込駆動パルスWS、電源駆動パルスDSL 、および映像信号Ｖsig は、１行分を１組として、各信号のタイミング（特に位相関係）が行単位で独立に制御され、行が代わると１Ｈ（Ｈは水平走査期間）分シフトされる。
【００８０】
以下では、説明や理解を容易にするため、特段の断りのない限り、書込みゲインが１（理想値）であると仮定して、保持容量１２０に信号振幅ΔＶinの情報を、書き込む、保持する、あるいはサンプリングするなどと簡潔に記して説明する。書込みゲインが１未満の場合、保持容量１２０には信号振幅ΔＶinの大きさそのものではなく、信号振幅ΔＶinの大きさに対応するゲイン倍された情報が保持されることになる。因みに、信号振幅ΔＶinに対応する保持容量１２０に書き込まれる情報の大きさの割合を、書込みゲインＧinput と称する。
【００８１】
また、説明や理解を容易にするため、特段の断りのない限り、ブートストラップゲインが１（理想値）であると仮定して簡潔に記して説明する。因みに、駆動トランジスタ１２１のゲート・ソース間に保持容量１２０が設けられている場合に、ソース電位Ｖｓの上昇に対するゲート電位Ｖｇの上昇率をブートストラップゲイン（ブートストラップ動作能力）Ｇbst と称する。
【００８２】
また、この駆動タイミングでは、映像信号Ｖsig が非有効期間であるオフセット電位Ｖofs にある期間を１水平期間の前半部とし、有効期間である信号電位Ｖin（＝Ｖofs ＋ΔＶin）にある期間を１水平期間の後半部とする。また、映像信号Ｖsig の有効期間と非有効期間を合わせた１水平期間ごとに、閾値補正動作を複数回（図では４回）に亘って繰り返すようにする。
【００８３】
有機ＥＬ素子１２７の発光期間Ｂ（表示期間）では、電源供給線１０５DSL が第１電位Ｖcc_Hであり、サンプリングトランジスタ１２５がオフした状態である。このとき、駆動トランジスタ１２１は飽和領域で動作するように設定されているため、有機ＥＬ素子１２７に流れる駆動電流Ｉdsは駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsに応じ応じて、式（１）に示される値をとる。
【００８４】
すなわち、駆動トランジスタ１２１はドレイン・ソース間電圧に関わらず駆動電流Ｉdsが一定となる飽和領域で駆動される。よって、飽和領域で動作するトランジスタのドレイン−ソース間に流れる電流をＩds、移動度をμ、チャネル幅（ゲート幅）をＷ、チャネル長（ゲート長）をＬ、ゲート容量（単位面積当たりのゲート酸化膜容量）をＣox、トランジスタの閾値電圧をＶthとすると、駆動トランジスタ１２１は下記の式（１）に示した値を持つ定電流源となっている。なお、“＾”はべき乗を示す。式（１）から明らかなように、飽和領域ではトランジスタのドレイン電流Ｉdsはゲート・ソース間電圧Ｖgsによって制御され定電流源として動作する。
【００８５】
【数１】
【００８６】
非発光期間（消光期間）に入ると、先ず放電期間Ｃでは、電源供給線１０５DSL を第２電位Ｖcc_Lに切り替える。このとき、第２電位Ｖcc_Lが有機ＥＬ素子１２７の閾値電圧ＶthELとカソード電位Ｖcathの和よりも小さいとき、つまり“Ｖcc_L＜ＶthEL＋Ｖcath”であれば、有機ＥＬ素子１２７は消光し、電源供給線１０５DSL が駆動トランジスタ１２１のソース側となる。このとき、有機ＥＬ素子１２７のアノードは第２電位Ｖcc_Lに充電される。つまり、駆動トランジスタ１２１のドレイン（電源供給端）とソース（出力端）との電位を等しくすることで、有機ＥＬ素子１２７を発光状態から消光状態に遷移させる。
【００８７】
さらに、初期化期間Ｄでは、映像信号線１０６HSがオフセット電位Ｖofs となったときにサンプリングトランジスタ１２５をオンして駆動トランジスタ１２１のゲート電位をオフセット電位Ｖofs とする。このとき、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは“Ｖofs −Ｖcc_L”という値をとる。この“Ｖofs −Ｖcc_L”が駆動トランジスタ１２１の閾値電圧Ｖthよりも大きくないと閾値補正動作を行なうことができないために、“Ｖofs −Ｖcc_L＞Ｖth”とする必要がある。
【００８８】
この後、第１閾値補正期間Ｅ１に入ると、電源供給線１０５DSL を再び第１電位Ｖcc_Hに切り替える。電源供給線１０５DSL （つまり駆動トランジスタ１２１への電源電圧）を第１電位Ｖcc_Hとすることで、有機ＥＬ素子１２７のアノードが駆動トランジスタ１２１のソースとなり駆動トランジスタ１２１から駆動電流Ｉdsが流れる。有機ＥＬ素子１２７の等価回路はダイオードと容量で表されるため、有機ＥＬ素子１２７のカソード電位Ｖcathに対するアノード電位をＶelとしたとき、“Ｖel≦Ｖcath＋ＶthEL”である限り、換言すれば、有機ＥＬ素子１２７のリーク電流が駆動トランジスタ１２１に流れる電流よりもかなり小さい限り、駆動トランジスタ１２１の駆動電流Ｉdsは保持容量１２０と有機ＥＬ素子１２７の寄生容量Ｃelを充電するために使われる。このとき、有機ＥＬ素子１２７のアノード電位Ｖelは時間とともに上昇してゆく。
【００８９】
一定時間経過後、サンプリングトランジスタ１２５をオフする。このとき、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsが閾値電圧Ｖthよりも大きいと（つまり閾値補正が完了していないと）、駆動トランジスタ１２１の駆動電流Ｉdsは保持容量１２０を受電するように流れ続け、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは上昇してゆく。このとき、有機ＥＬ素子１２７には逆バイアスがかかっているため、有機ＥＬ素子１２７が発光することはない。
【００９０】
第２閾値補正期間Ｅ２に入ると、再び映像信号線１０６HSがオフセット電位Ｖofs となったときにサンプリングトランジスタ１２５をオンして駆動トランジスタ１２１のゲート電位をオフセット電位Ｖofs として、再度閾値補正動作を開始する。この動作を繰り返すことで、最終的に、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは閾値電圧Ｖthという値をとる。このとき“Ｖel＝Ｖofs −Ｖth≦Ｖcath＋ＶthEL”となっている。
【００９１】
なお、この動作例では、閾値補正動作を繰り返し実行することで確実に駆動トランジスタ１２１の閾値電圧Ｖthに相当する電圧を保持容量１２０に保持させるために、１水平期間を処理サイクルとして、閾値補正動作を複数回に亘って繰り返すようにしているが、この繰返し動作は必須ではなく、１水平期間を処理サイクルとして、１回のみの閾値補正動作を実行するようにしてもよい。
【００９２】
閾値補正動作終了後（本例では第４閾値補正期間Ｅ４の後）は、サンプリングトランジスタ１２５をオフして書込み＆移動度補正準備期間Ｊに入る。映像信号線１０６HSが信号電位Ｖin（＝Ｖofs ＋ΔＶin）となったときに、サンプリングトランジスタ１２５を再度オンしてサンプリング期間＆移動度補正期間Ｋに入る。信号振幅ΔＶinは階調に応じた値である。サンプリングトランジスタ１２５のゲート電位はサンプリングトランジスタ１２５をオンしているために信号電位Ｖin（＝Ｖofs ＋ΔＶin）となるが、駆動トランジスタ１２１のドレインは第１電位Ｖcc_Hであり駆動電流Ｉdsが流れるためソース電位Ｖｓは時間とともに上昇してゆく。図では、この上昇分をΔＶで示している。
【００９３】
ソース電圧Ｖｓが有機ＥＬ素子１２７の閾値電圧ＶthELとカソード電位Ｖcathの和を越えなければ、換言すると、有機ＥＬ素子１２７のリーク電流が駆動トランジスタ１２１に流れる電流よりもかなり小さければ、駆動トランジスタ１２１の駆動電流Ｉdsは保持容量１２０と有機ＥＬ素子１２７の寄生容量とＣelを充電するのに使用される。
【００９４】
この時点では、駆動トランジスタ１２１の閾値補正動作は完了しているため、駆動トランジスタ１２１が流す電流は移動度μを反映したものとなる。具体的には、移動度μが大きいと、このときの電流量が大きく、ソースの上昇も早い。逆に移動度μが小さいと、電流量が小さく、ソースの上昇は遅くなる。これにより、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは移動度μを反映して小さくなり、一定時間経過後に完全に移動度μを補正するゲート・ソース間電圧Ｖgsとなる。
【００９５】
この後には、発光期間Ｌに入り、サンプリングトランジスタ１２５をオフして書込みを終了し、有機ＥＬ素子１２７を発光させる。保持容量１２０によるブートストラップ効果により、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは一定であるので、駆動トランジスタ１２１は一定電流（駆動電流Ｉds）を有機ＥＬ素子１２７に流し、有機ＥＬ素子１２７のアノード電位Ｖelは有機ＥＬ素子１２７に駆動電流Ｉdsという電流が流れる電圧Ｖｘまで上昇し、有機ＥＬ素子１２７は発光する。
【００９６】
画素回路Ｐにおいては、有機ＥＬ素子１２７は発光時間が長くなるとそのＩ−Ｖ特性は変化してしまう。そのため、ノードＮＤ１２１の電位（つまり駆動トランジスタ１２１のソース電位Ｖｓ）も変化する。しかしながら、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは保持容量１２０によるブートストラップ効果で一定値に保たれているので、有機ＥＬ素子１２７に流れる電流は変化しない。よって、有機ＥＬ素子１２７のＩ−Ｖ特性が劣化しても、有機ＥＬ素子１２７には一定電流（駆動電流Ｉds）が常に流れ続け、有機ＥＬ素子１２７の輝度が変化することはない。
【００９７】
ここで、駆動電流Ｉds対ゲート電圧Ｖgsの関係は、トランジスタ特性を表した式（１）のＶgsに“ΔＶin＋Ｖth−ΔＶ”を代入することで、式（２）のように表すことができる。式（２）において、ｋ＝（１／２）（Ｗ／Ｌ）Ｃoxである。
【００９８】
【数２】
【００９９】
この式（２）から、閾値電圧Ｖthの項がキャンセルされており、有機ＥＬ素子１２７に供給される駆動電流Ｉdsは駆動トランジスタ１２１の閾値電圧Ｖthに依存しないことが分かる。基本的に駆動電流Ｉdsは信号振幅ΔＶin（詳しくは信号振幅ΔＶinに対応して保持容量１２０に保持されるサンプリング電圧＝Ｖgs）によって決まる。換言すると、有機ＥＬ素子１２７は信号振幅ΔＶinに応じた輝度で発光することになる。
【０１００】
その際、保持容量１２０に保持される情報はソース電位Ｖｓの上昇分ΔＶで補正されている。上昇分ΔＶはちょうど式（２）の係数部に位置する移動度μの効果を打ち消すように働く。駆動トランジスタ１２１の移動度μに対する補正分ΔＶを保持容量１２０に書き込まれる信号に加えるのであるが、その方向は実際には負の方向であり、こう言った意味で、上昇分ΔＶは、移動度補正パラメータΔＶや負帰還量ΔＶとも称する。
【０１０１】
有機ＥＬ素子１２７に流れる駆動電流Ｉdsは、駆動トランジスタ１２１の閾値電圧Ｖthや移動度μの変動が相殺され、実質的に信号振幅ΔＶinのみに依存することになる。駆動電流Ｉdsは閾値電圧Ｖthや移動度μに依存しないので、閾値電圧Ｖthや移動度μが製造プロセスによりばらついていたり経時変化があったりしても、ドレイン・ソース間の駆動電流Ｉdsは変動せず、有機ＥＬ素子１２７の発光輝度も変動しない。
【０１０２】
駆動トランジスタ１２１のゲート・ソース間に保持容量１２０を接続することで、ｎ型の駆動トランジスタ１２１を使用する場合でも、駆動トランジスタ１２１のソースの電位Ｖｓの変動にゲートの電位Ｖｇが連動するようにするブートストラップ機能を実現する回路構成および駆動タイミングとしており、有機ＥＬ素子１２７の特性の経時変動による有機ＥＬ素子１２７のアノード電位変動（つまり駆動トランジスタ１２１のソース電位変動）があっても、その変動を相殺するようにゲート電位Ｖｇを変動させることができる。
【０１０３】
これにより、有機ＥＬ素子１２７の特性の経時変化の影響が緩和され、画面輝度の均一性を確保できる。駆動トランジスタ１２１のゲート・ソース間の保持容量１２０によるブートストラップ機能により、有機ＥＬ素子を代表とする電流駆動型の発光素子の経時変動補正能力を向上させることができる。もちろん、ブートストラップ機能は、発光開始時点で、有機ＥＬ素子１２７に発光電流Ｉelが流れ始め、それによってアノード・カソード間電圧Ｖelが安定となるまで上昇していく過程で、そのアノード・カソード間電圧Ｖelの変動に伴って駆動トランジスタ１２１のソース電位Ｖｓが変動する際にも機能する。
【０１０４】
このように、本例の画素回路Ｐおよびそれを駆動する制御部１０９による駆動タイミングによれば、駆動トランジスタ１２１や有機ＥＬ素子１２７の特性変動（ばらつきや経時変動）があった場合でも、それらの変動分を補正することで、表示画面上にはその影響が現われず、輝度変化のない高品質な画像表示が可能になる。
【０１０５】
ここで、有機ＥＬ素子１２７を駆動する駆動トランジスタ１２１自体は有機ＥＬ素子１２７の発光時に劣化してしまう。その劣化の程度（劣化量と称する）は、表示映像に依存するため、各画素の劣化量は異なってしまう。劣化の程度が画素で異なることは、表示品質を低下させることに繋がる。
【０１０６】
たとえば、図２に示した画素回路Ｐを図３に示した駆動タイミングのように制御すると、白表示時（最大輝度での発光時、信号振幅ΔＶin_max時）と黒表示時（最低輝度での発光時、信号振幅ΔＶin_min時、Ｖsig ＝Ｖofs 時 、事実上の非発光時）では駆動トランジスタ１２１の動作状態が大きく異なる。具体的には、白表示時と黒表示時では、駆動トランジスタ１２１に印加されるバイアス電位は、発光期間に異なることはやむを得ない（避け難い）が、発光期間以外にも異なっており、白表示が多くなされた画素は劣化の進行が速く、いわゆる「焼き付き」が発生し易い。以下、この現象とその対策手法の原理について説明する。
【０１０７】
［焼付き現象の説明］
図４は、駆動トランジスタ１２１の動作の詳細を説明する図である。ここで、図４（１）は、白表示をする際の、発光期間と消光期間のそれぞれにおける駆動トランジスタＴＲD の各端子電圧を説明する図である。図４（２）は、黒表示をする際の、発光期間と消光期間のそれぞれにおける駆動トランジスタＴＲD の各端子電圧を説明する図である。
【０１０８】
図４（１−１）には、白表示をする際の、発光期間（信号書込みが完了した後の安定時）と消光期間（電源駆動パルスDSL が第２電位Ｖcc_Lに遷移したとき）のそれぞれにおける駆動トランジスタ１２１の各端子電圧が駆動トランジスタ１２１の対応する端子の近傍に示されている。「／」を境に、前側が発光期間の端子電圧であり、後側が消光期間の端子電圧である。白表示時の映像信号Ｖsig の振幅ΔＶinはΔＶin_WH であり、黒表示時の映像信号Ｖsig の振幅ΔＶinはΔＶin_BK （＝０Ｖ）であるとする。
【０１０９】
図３の動作説明から理解されるように、白表示用の信号書込みが完了した後に発光期間に入った安定時には、トランジスタ１２１は、ソース電位が“Ｖofs −Ｖth＋ΔＶ＋Ｖel”、ゲート電位が“Ｖofs ＋ΔＶin_WH ＋Ｖel”、ドレイン電位が第１電位Ｖcc_Hであり、ゲート・ソース間電圧Ｖgsが“ΔＶin_WH ＋Ｖth−ΔＶ”である。また、電源駆動パルスDSL が第２電位Ｖcc_Lに遷移して消光期間に入ったときには、ゲート・ソース間電圧Ｖgsは保持容量１２０によるブートストラップ効果により消灯直前の“ΔＶin_WH ＋Ｖth−ΔＶ”が維持されるので、トランジスタ１２１は、ソース電位が第２電位Ｖcc_L、ゲート電位が“Ｖcc_L＋ΔＶin_WH ＋Ｖth−ΔＶ”、ドレイン電位が第２電位Ｖcc_Lである。
【０１１０】
図４（１−２）に示すように、白表示をする際の、発光期間には、ソース電位を基準（０Ｖ）にしたときの相対的なゲート電位は“ΔＶin_WH ＋Ｖth−ΔＶ”、相対的なドレイン電位は“Ｖcc_H−（Ｖofs −Ｖth＋ΔＶ＋Ｖel）”である。図４（１−３）に示すように、白表示をする際の、消光期間には、ソース電位を基準（０Ｖ）にしたときの相対的なゲート電位は“ΔＶin_WH ＋Ｖth−ΔＶ”、相対的なドレイン電位は０Ｖである。
【０１１１】
同様に、図４（２−１）には、黒表示をする際の、発光期間（信号書込みが完了した後の安定時）と消光期間（電源駆動パルスDSL が第２電位Ｖcc_Lに遷移したとき）のそれぞれにおける駆動トランジスタ１２１の各端子電圧が駆動トランジスタ１２１の対応する端子の近傍に示されている。
【０１１２】
黒表示をする際にはΔＶin_BK ＝０Ｖであるから、信号書込みが完了した後に発光期間に入った安定時には、トランジスタ１２１は、ソース電位が“Ｖofs −Ｖth＋ΔＶ＋Ｖel”、ゲート電位が“Ｖofs ＋Ｖel”、ドレイン電位が第１電位Ｖcc_Hであり、ゲート・ソース間電圧Ｖgsが“Ｖth−ΔＶ”である。実際には、ΔＶin_BK ＝０Ｖのときには、有機ＥＬ素子１２７に電流が流れず、Ｖel＝ΔＶ＝０と考えてよく、ゲート電位がＶofs 、ソース電位が“Ｖofs −Ｖth”で、ゲート・ソース間電圧ＶgsがＶthであると考えてよい。
【０１１３】
図４（２−２）に示すように、黒表示をする際の発光期間には、ソース電位を基準（０Ｖ）にしたときの相対的なゲート電位はＶth、相対的なドレイン電位は“Ｖcc_H−（Ｖofs −Ｖth）”である。図４（２−３）に示すように、黒表示をする際の消光期間には、ソース電位を基準（０Ｖ）にしたときの相対的なゲート電位はＶth、相対的なドレイン電位は０Ｖである。
【０１１４】
消光期間の駆動トランジスタ１２１のバイアス状態を比較すると、白表示と黒表示の何れもソース・ドレイン間電圧が０Ｖの状態であり、ゲート・ソース間電圧Ｖgsは、黒表示のときは閾値電圧Ｖthであるので問題ないが、白表示のときは“ΔＶin_WH ＋Ｖth−ΔＶ”であり劣化の原因となる。
【０１１５】
［焼付け防止対策の原理］
図５は、白表示の消光期間における劣化原因を解消する手法（焼付け防止対策）の原理を説明するタイミングチャートである。
【０１１６】
白表示のときの消光期間における劣化原因を解消するには、ゲート・ソース間電圧Ｖgsを閾値電圧Ｖthと同等レベルかそれ以下となるように設定し、その後に閾値補正動作を行なうように制御することが好適である。
【０１１７】
この対処のためにスイッチングトランジスタを追加することも考えられるが得策ではない。現実的には、画素回路Ｐの変更をせずに対応するには、サンプリングトランジスタ１２５のオン動作によりゲート電位をオフセット電位Ｖofs に設定することになる点を勘案すると、ソース電位Ｖｓが、オフセット電位Ｖofs 近傍（ただしオフセット電位Ｖofs 以下）となるように電源駆動パルスDSL の電位（第３電位Ｖcc_Mとする）を設定することになる。典型的には、第３電位Ｖcc_Mは、“Ｖofs −Ｖth”〜Ｖofs ”に設定すればよい。
【０１１８】
この動作は、少なくとも白表示のときに実行するのが有効であり、黒表示のときには本来は不要であるが、全体動作としては、区別なく実行するのが現実的である。こうすることで、発光期間以外では、駆動トランジスタ１２１にかかるバイアスを白表示と黒表示で差をなくすことができる。
【０１１９】
すなわち、図５に示すように、電源駆動パルスDSL の電位を、第１電位Ｖcc_Hと第２電位Ｖcc_Lと第３電位としての第３電位Ｖcc_M（第１電位Ｖcc_Hと第２電位Ｖcc_Lの間の電位）の３値にし、これらを切り替えて駆動トランジスタ１２１のドレインに供給するようにすればよい。
【０１２０】
そして、２値目の第３電位Ｖcc_Mで有機ＥＬ素子１２７を消光後に（消光処理期間Ｃ１）、書込駆動パルスWSをアクティブＨにしてサンプリングトランジスタ１２５をオンすることで駆動トランジスタのゲートにオフセット電位Ｖofs を書き込む（Ｖofs 書込み工程）。このときには、駆動トランジスタ１２１のソース電位は第３電位Ｖcc_Mにあるので、ゲート・ソース間電圧Ｖgsは“Ｖofs −Ｖ３”になる。
【０１２１】
こうすることで、消光中（詳しくは、消光処理後から初期化期間Ｄが開始するまでの間、「劣化防止処理期間Ｃ２」と称する）は、駆動トランジスタ１２１にかかるバイアスを閾値電圧Ｖth以下（好適にはほぼ０Ｖ）の状態にすることができる。本実施形態を適用しない場合の放電期間Ｃを消光処理期間Ｃ１と劣化防止処理期間Ｃ２に分けたものとなる。
【０１２２】
そのため、発光時以外は（詳しくは劣化防止処理期間Ｃ２から書込み＆移動度補正準備期間Ｊまでは）、駆動トランジスタ１２１にかかるバイアスを白表示および黒表示とも同一にでき、発光期間以外における駆動トランジスタ１２１の劣化を抑制することができる。駆動トランジスタ１２１に起因する焼き付きを防止できるようになる。
【０１２３】
なお、焼付け防止対策用のドレイン端（電源供給端）の電位を複数設定することで、電源駆動パルスDSL の電位を４値以上で切り替えることも考えられる。たとえば、第３電位Ｖcc_M1 で消光させ、第４電位Ｖcc_M2 のときにオフセット電位Ｖofs を書き込むことが考えられる。しかしながら、このような複雑な制御を行なわなくても十分である。
【０１２４】
［対比］
図６は、本実施形態の対策手法を適用した場合と適用しない場合（比較例）を対比して示した図である。
【０１２５】
前処理工程は、電源駆動パルスDSL を第２電位Ｖcc_Lにしてから書込駆動パルスWSをアクティブＨにするまでの放電期間Ｃと、映像信号Ｖsig がオフセット電位Ｖofs の期間に書込駆動パルスWSをアクティブＨにしてから電源駆動パルスDSL を第１電位Ｖcc_Hに設定するまでの初期化期間で構成されている。そして、この例では放電期間Ｃは大凡２Ｈ（水平走査期間）分存在している。
【０１２６】
図６（１）は、本実施形態の対策手法を適用しない比較例の場合を示している。放電期間Ｃに入ると有機ＥＬ素子１２７は消光するが、この放電期間Ｃでは、白表示と黒表示で、駆動トランジスタ１２１のバイアス状態が異なっている。つまり、発光期間に白表示と黒表示で、駆動トランジスタ１２１のバイアス状態が異なるのは当然であるが、発光期間以外でも白黒でバイアス状態に差がある。そして、放電期間Ｃ（特に劣化防止処理期間Ｃ２）の白表示のバイアス状態は、ドレイン・ソース間電圧Ｖdsが０Ｖの状態でゲート・ソース間電圧Ｖgsが“ΔＶin_WH ＋Ｖth−ΔＶ”という大きさにあり、駆動トランジスタ１２１の劣化要因となる。
【０１２７】
図６（２）は、本実施形態の対策手法を適用した場合を示している。放電期間Ｃに入ると、電源駆動パルスDSL を先ずオフセット電位Ｖofs 近傍（ただしオフセット電位Ｖofs 以下）の第３電位Ｖcc_Mに設定し、書込駆動パルスWSをアクティブＨにしてサンプリングトランジスタ１２５をオンさせる。これによって、駆動トランジスタ１２１のゲート・ソース間電圧Ｖgsは、直前の表示が白であったのか黒であったのかに拘わらず、ほぼ閾値電圧Ｖthと等しいか、それ以下に設定される（図では略０Ｖ（≒０）で示している）。つまり、発光期間以外は、白黒でバイアス状態に差がなく、そのバイアス状態は、駆動トランジスタ１２１の劣化要因とならない。
【０１２８】
［第３電位の適正範囲］
ここで、劣化防止電位の一例である第３電位Ｖcc_Mは、通常の２値駆動におけるＨレベル（第１電位Ｖcc_H）とＬレベル（第２電位Ｖcc_L）とを除く範囲であればよく、第３電位Ｖcc_Mとしては、Ｈレベルを規定することになる第１電位Ｖcc_HとＬレベルを規定することになる第２電位Ｖcc_Lとを除いた電圧レベルであれば、基本的には本実施形態を適用しない場合よりも劣化防止効果が得られる。しかしながら、より好適な状態にするには、以下の点に留意して、第３電位Ｖcc_Mを設定するとよい。
【０１２９】
すなわち、第３電位Ｖcc_Mは、第２電位Ｖcc_Lに過度に近いと劣化防止対策効果が薄れるし、第１電位Ｖcc_Hに過度に近いと駆動トランジスタ１２１をオンさせて有機ＥＬ素子１２７を点灯駆動している状態に極めて近くなり有機ＥＬ素子１２７を消光できない。
【０１３０】
第３電位Ｖcc_Mを使用するのが高輝度点灯後の消光期間の駆動トランジスタ１２１のバイアス状態が駆動トランジスタ１２１の劣化要因となることの対策である点を加味すれば、第３電位Ｖcc_Mの最適な範囲は、有機ＥＬ素子１２７を確実に消光でき、かつ、駆動トランジスタ１２１のソース電位をゲート電位に近づけることができる程度であればよい。有機ＥＬ素子１２７を確実に消光させる点を加味すれば、第１電位Ｖcc_Hよりは遙かに低電圧（“ＶthEL＋Ｖcath”以下）であることが要求される。また、劣化防止処理期間Ｃ２に駆動トランジスタ１２１のゲートをオフセット電位Ｖofs に設定する点も加味すると、第３電位Ｖcc_Mはオフセット電位Ｖofs 以下で、オフセット電位Ｖofs に近い値であることが望ましいと考えられる。
【０１３１】
＜３値駆動回路＞
［第１例］
図７〜図７Ａは、本実施形態の駆動手法を適用するための３値駆動回路の第１例を説明する図である。第１例は、駆動走査部１０５内で第３電位Ｖcc_Mを生成し、電源駆動パルスDSL の電位を、第１電位Ｖcc_H、第２電位Ｖcc_L、第３電位Ｖcc_Mの３値の何れかに切り替えて、電源供給線１０５DSL に出力する態様である。この第１例は、既存の駆動走査部１０５に変更を加える必要があるが、実体的（外形的）な変更を加えずに、本実施形態の焼き付き防止の仕組みを実現できる利点がある。
【０１３２】
このような態様の回路構成としては種々のものが考えられるが、ここでは、一例として、既存の出力回路４００Ｘに対して、第３電位Ｖcc_Mの出力時には、第１電位Ｖcc_Hや第２電位Ｖcc_Lの出力を停止するように変更を加えた構成にしている。具体的には先ず、図示を割愛するが、駆動走査部１０５には、表示パネル部１００の外部に設けられ、その出力インピーダンスが十分に小さな電源回路から、第１電位Ｖcc_Hと第２電位Ｖcc_Lとが供給されるようになっている。
【０１３３】
図７（１）に示すように、既存（比較例）の出力回路４００Ｘは、一例として、ｐチャネル型のトランジスタ（ｐ型トランジスタ）４０２と、ｎチャネル型のトランジスタ（ｎ型トランジスタ）４０４とを、第１電位Ｖcc_H用の供給端４００Ｈと第２電位Ｖcc_L用の供給端４００Ｌとの間に直列に配置した構成となっている。
【０１３４】
ｐ型トランジスタ４０２のソース端Ｓは第１電位Ｖcc_H用の供給端４００Ｈに接続され、ｎ型トランジスタ４０４のソース端Ｓは第２電位Ｖcc_L用の供給端４００Ｌに接続されている。ｐ型トランジスタ４０２とｎ型トランジスタ４０４の各ドレインＤを共通に接続し、その接続点を電源供給線１０５DSL に接続している。全体としては、ＣＭＯＳインバータを構成している。ｐ型トランジスタ４０２とｎ型トランジスタ４０４の各ゲートＧを共通に接続し、その接続点にアクティブＬの電源走査パルスNDS を供給する。
【０１３５】
電源走査パルスNDS がアクティブＬのときにはｎ型トランジスタ４０４がオフするとともにｐ型トランジスタ４０２がオンするので第１電位Ｖcc_Hが電源供給線１０５DSL に供給される。一方、電源走査パルスNDS がインアクティブＨのときにはｐ型トランジスタ４０２がオフするとともにｎ型トランジスタ４０４がオンするので第２電位Ｖcc_Lが電源供給線１０５DSL に供給される。この動作から分かるように出力回路４００Ｘは電源電圧切替回路として機能している。
【０１３６】
図７（２）および図７Ａに示すように、第１例の有機ＥＬ表示装置１Ａは、電源駆動パルスDSL を３値駆動可能にするための第１例の出力回路４００Ａを駆動走査部１０５内に備えている。
【０１３７】
第１例の出力回路４００Ａは先ず、正電圧側の第１電位Ｖcc_Hと、負電圧側の第２電位Ｖcc_Lと、劣化防止電位としての第３電位Ｖcc_Mと言った３種類の電圧と、基準の接地電位GND が供給されるようになっている。出力回路４００Ａは、図示しない垂直デコーダから供給される２値の電源走査パルスNDS および劣化防止電位設定信号GMに基づいて、３値駆動用の電源駆動パルスDSL を生成可能に構成されている。
【０１３８】
出力回路４００Ａは、出力段に、ｐ型トランジスタ４０２とｎ型トランジスタ４０４の他に、第３電位Ｖcc_Mを電源供給線１０５DSL に出力するｎ型トランジスタ４０６を有する。ｎ型トランジスタ４０６はｐ型トランジスタ４０２と直列接続され、また、ｎ型トランジスタ４０６と概ね並列に配置されている。
【０１３９】
ｎ型トランジスタ４０６のソースは第３電位Ｖcc_Mに接続されている。ｐ型トランジスタ４０２とｎ型トランジスタ４０４とｎ型トランジスタ４０６の各ドレインを共通に接続し、その接続点を電源駆動パルスDSL 用の出力端に接続している。
【０１４０】
出力回路４００は、出力段の前段に、２入力型のＯＲゲート４１２、インバータ４１４、２入力型のＡＮＤゲート４１６を有する。ＯＲゲート４１２とＡＮＤゲート４１６の各一方の入力端には電源走査パルスNDS が共通に供給される。
【０１４１】
ＯＲゲート４１２の他方の入力端とインバータ４１４の入力端には、劣化防止電位設定信号GMが供給される。劣化防止電位設定信号GMは、第３電位Ｖcc_Mを電源供給線１０５DSL に供給する期間にのみアクティブＨとなる論理情報である。インバータ４１４の出力（反転劣化防止電位設定信号NGM ）がＡＮＤゲート４１６の他方の入力端に供給される。
【０１４２】
ＯＲゲート４１２は、電源走査パルスNDS と劣化防止電位設定信号GMとの論理和をとり、その論理和出力でｐ型トランジスタ４０２を駆動する。したがって、電源走査パルスNDS がＬで、かつ、劣化防止電位設定信号GMがＬの期間のみｐ型トランジスタ４０２がオンする。このときには、ｎ型トランジスタ４０４とｎ型トランジスタ４０６がオフであり、電源供給線１０５DSL には、第１電位Ｖcc_Hが供給される。
【０１４３】
ＡＮＤゲート４１６は、電源走査パルスNDS と反転劣化防止電位設定信号NGM との論理積をとり、その論理積出力でｎ型トランジスタ４０４を駆動する。したがって、電源走査パルスNDS がＨで、かつ、劣化防止電位設定信号GMがＬ（反転劣化防止電位設定信号NGM がＨ）の期間のみｎ型トランジスタ４０４がオンする。このときには、ｐ型トランジスタ４０２とｎ型トランジスタ４０６がオフであり、電源供給線１０５DSL には、第２電位Ｖcc_Lが供給される。
【０１４４】
劣化防止電位設定信号GMはｎ型トランジスタ４０６のゲートに供給されており、劣化防止電位設定信号GMでｎ型トランジスタ４０６が駆動される。したがって、電源走査パルスNDS がＬ，Ｈの何れであるかを問わず、劣化防止電位設定信号GMがＨの期間のみｎ型トランジスタ４０６がオンする。このときには、ｐ型トランジスタ４０２とｎ型トランジスタ４０４がオフであり、電源供給線１０５DSL には、第３電位Ｖcc_Mが供給される。
【０１４５】
出力回路４００Ａの３値駆動に対応する構成例は一例に過ぎず、様々な変形例を採ることができる。たとえば、原理的には、図７（２）に示した構成にすればよいのであるが、実際には、ゲート遅延の関係からｐ型トランジスタ４０２とｎ型トランジスタ４０４とｎ型トランジスタ４０６の何れか２つもしくは３つともが同時にオンすることによる貫通電流の発生を防止するべく、各トランジスタ４０２，４０４，４０６がともにオンする期間が生じないように遷移タイミングを少しずらす仕組みを講じることが考えられる。
【０１４６】
［第２例］
図８は、本実施形態の駆動手法を適用するための３値駆動回路の第２例を説明する図である。第２例は、垂直駆動部１０３外で第３電位Ｖcc_Mを生成し、駆動走査部１０５から出力される２値の電源駆動パルスDSLXと第３電位Ｖcc_Mを切り替えて電源供給線１０５DSL に供給する態様である。この第２例は、既存の駆動走査部１０５に変更を加えずに、本実施形態の焼き付き防止の仕組みを実現できる利点がある。
【０１４７】
第２例の有機ＥＬ表示装置１Ｂの垂直駆動部１０３Ｂは、駆動走査部１０５（出力回路４００Ｘ）と電源供給線１０５DSL との間に２入力−１出力型の電圧切替回路４２０を備えている。電圧切替回路４２０は、一方の入力端に駆動走査部１０５の出力回路４００Ｘから出力される２値（第１電位Ｖcc_Hと第２電位Ｖcc_L）の電源駆動パルスDSLXが供給され、他方の入力端に図示しない電圧生成部からの第３電位Ｖcc_Mが供給される。電圧切替回路４２０の制御入力端には劣化防止電位設定信号GMが供給される。
【０１４８】
劣化防止電位設定信号GMは、第１例と同様に、第３電位Ｖcc_Mを電源供給線１０５DSL に供給する期間にのみアクティブＨとなる論理情報である。劣化防止電位設定信号GMで電圧切替回路４２０の選択動作が制御され、出力回路４００Ｘから出力される電源駆動パルスDSLXがＬ，Ｈの何れであるかを問わず、劣化防止電位設定信号GMがＨの期間のみ第３電位Ｖcc_Mを選択して出力し、劣化防止電位設定信号GMがＬのときには出力回路４００Ｘから出力される電源駆動パルスDSLXを選択して出力する。
【０１４９】
＜電子機器＞
以上説明した本実施形態の有機ＥＬ表示装置１を始めとする本実施形態の焼付け防止対策手法を適用した表示装置は、電子機器に入力された映像信号、もしくは、電子機器内で生成した映像信号を、画像もしくは映像として表示するあらゆる分野の電子機器の表示装置に適用できる。一例として、図９〜図９Ｂに示す様々な電子機器、たとえば、デジタルカメラ、ノート型パーソナルコンピュータ、携帯電話などの携帯端末装置、ビデオカメラなどの表示装置に適用できる。
【０１５０】
なお、表示装置は、封止された構成のモジュール形状のものをも含むものとする。たとえば、画素アレイ部１０２に透明なガラスなどの対向部に貼り付けられて形成された表示モジュールが該当する。この透明な対向部には、カラーフィルタ、保護膜など、さらには、遮光膜が設けられてもよい。なお、表示モジュールには、外部から画素アレイ部への信号などを入出力するための回路部やＦＰＣ（フレキシブルプリントサーキット）などが設けられていてもよい。
【０１５１】
以下に、本実施形態の焼付け防止対策手法を適用した表示装置が搭載される電子機器の具体例について説明する。
【０１５２】
図９（１）は、本実施形態の焼付け防止対策手法を適用した表示装置が搭載されるテレビジョンセットの外観を示す斜視図である。本例のテレビジョンセットは、フロントパネル９０２やフィルターガラス９０３などから構成される映像表示画面部９０１を含み、映像表示画面部９０１として本実施形態による表示装置を用いることにより作製される。
【０１５３】
図９（２）は、本実施形態の焼付け防止対策手法を適用した表示装置が搭載されるデジタルカメラの外観を示す斜視図であり、図９（２−１）は表側から見た斜視図、図９（２−２）は裏側から見た斜視図である。本例のデジタルカメラは、フラッシュ用の発光部９１１、表示部９１２、メニュースイッチ９１３、シャッターボタン９１１４などを含み、その表示部９１２として本実施形態による表示装置を用いることにより作製される。
【０１５４】
図９Ａ（１）は、本実施形態の焼付け防止対策手法を適用した表示装置が搭載されるノート型パーソナルコンピュータの外観を示す斜視図である。本例のノート型パーソナルコンピュータは、本体９２１に、文字や図形などを入力するとき操作されるキーボード１２２、画像を表示する表示部９２３などを含み、その表示部９２３として本実施形態による表示装置を用いることにより作製される。
【０１５５】
図９Ａ（２）は、本実施形態の焼付け防止対策手法を適用した表示装置が搭載されるビデオカメラの外観を示す斜視図である。本例のビデオカメラは、本体部９３１、前方を向いた側面に被写体撮影用のレンズ９３２、撮影時のスタート／ストップスイッチ９３３、表示部９３４などを含み、その表示部９３４として本実施形態による表示装置を用いることにより作製される。
【０１５６】
図９Ｂは、本実施形態の焼付け防止対策手法を適用した表示装置が搭載される携帯電話機（携帯端末装置の一例）を示す外観図である。図９Ｂ（１）は開いた状態での正面図、図９Ｂ（２）はその側面図、図９Ｂ（３）は閉じた状態での正面図、図９Ｂ（４）は左側面図、図９Ｂ（５）は右側面図、図９Ｂ（６）は上面図、図９Ｂ（７）は下面図である。本例の携帯電話機は、上側筐体９４１、下側筐体９４２、連結部９４３（ここではヒンジ部）、ディスプレイ９４４、サブディスプレイ９４５、ピクチャーライト９４６、カメラ９４７などを含んでいる。そして、ディスプレイ９４４やサブディスプレイ９４５として本実施形態による表示装置を用いることにより本例の携帯電話機が作製される。
【０１５７】
以上、本発明について実施形態を用いて説明したが、本発明の技術的範囲は前記実施形態に記載の範囲には限定されない。発明の要旨を逸脱しない範囲で前記実施形態に多様な変更または改良を加えることができ、そのような変更または改良を加えた形態も本発明の技術的範囲に含まれる。
【０１５８】
また、前記の実施形態は、クレーム（請求項）に係る発明を限定するものではなく、また実施形態の中で説明されている特徴の組合せの全てが発明の解決手段に必須であるとは限らない。前述した実施形態には種々の段階の発明が含まれており、開示される複数の構成要件における適宜の組合せにより種々の発明を抽出できる。実施形態に示される全構成要件から幾つかの構成要件が削除されても、効果が得られる限りにおいて、この幾つかの構成要件が削除された構成が発明として抽出され得る。
【０１５９】
＜画素回路の変形例＞
たとえば、画素回路Ｐの側面からの変更が可能である。たとえば、回路理論上は「双対の理」が成立するので、画素回路Ｐに対しては、この観点からの変形を加えることができる。この場合、図示を割愛するが、先ず、前述の実施形態に示した画回路Ｐがｎ型の駆動トランジスタ１２１を用いて構成しているのに対し、ｐ型の駆動トランジスタ１２１を用いて画素回路Ｐを構成する。これに合わせて映像信号Ｖsig のオフセット電位Ｖofs に対する信号振幅ΔＶinの極性や電源電圧の大小関係を逆転させるなど、双対の理に従った変更を加える。
【０１６０】
このような双対の理を適用して駆動トランジスタ１２１をｐ型にした変形例の有機ＥＬ表示装置においても、ｎ型の駆動トランジスタ１２１にした有機ＥＬ表示装置と同様に、閾値補正動作、移動度補正動作、およびブートストラップ動作を実行することができるし、焼き付け防止対策を適用することができる。
【０１６１】
なお、ここで説明した画素回路Ｐの変形例は、前記実施形態に示した構成に対して「双対の理」に従った変更を加えたものであるが、回路変更の手法はこれに限定されるものではない。閾値補正動作を実行するに当たり、書込走査部１０４での走査に合わせて各水平周期内でオフセット電位Ｖofs と信号電位Ｖin（＝Ｖofs ＋ΔＶin）で切り替わる映像信号Ｖsig が映像信号線１０６HSに伝達されるように駆動を行ない、閾値補正の初期化動作のために駆動トランジスタ１２１のドレイン側（電源供給側）を第１電位と第２電位とでスイッチング駆動を行なうものである限り、画素回路Ｐを構成するトランジスタ数は問わない。さらに、表示後の非表示期間における駆動トランジスタのバイアス状態に伴う劣化要因という課題を持つ限り、画素回路Ｐを構成するトランジスタ数や保持容量数は不問であり、たとえばトランジスタ数が３個以上であってもよく、それらの全てに、前述の本実施形態の焼付け防止対策を適用することができる。
【０１６２】
また、閾値補正動作を実行するに当たり、オフセット電位Ｖofs と信号電位Ｖinを駆動トランジスタ１２１のゲートに供給する仕組みとしては、前記実施形態の２ＴＲ構成のように映像信号Ｖsig で対処することに限らず、たとえば、特開２００６−２１５２１３号公報に記載のように、別のトランジスタを介して供給する仕組みを採ることもできる。それらの変形例においても、高輝度表示後の消灯期間における駆動トランジスタのバイアス状態による劣化現象を解消する（焼付け防止対策を図る）という本実施形態の思想を適用することができる。
【符号の説明】
【０１６３】
１…有機ＥＬ表示装置、１００…表示パネル部、１０１…支持基板、１０２…画素アレイ部、１０３…垂直駆動部、１０４…書込走査部、１０４WS…書込走査線、１０５…駆動走査部、１０５DSL …電源供給線、１０６…水平駆動部、１０６HS…映像信号線、１０９…制御部、１２０…保持容量、１２１…駆動トランジスタ、１２５…サンプリングトランジスタ、１２７…有機ＥＬ素子、２００…駆動信号生成部、３００…映像信号処理部、４００…出力回路、４２０…電圧切替回路、Ｐ…画素回路
【特許請求の範囲】
【請求項１】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置されており、
前記電気光学素子の非表示期間に前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定してから前記駆動トランジスタの閾値補正を行なうように前記画素回路を駆動する垂直駆動部を備えている
表示装置。
【請求項２】
前記垂直駆動部は、前記画素回路を垂直走査し前記保持容量に前記信号振幅に応じた情報を書き込むための書込走査パルスを生成する書込走査部を有し、
前記書込走査部は、前記電気光学素子の非表示期間において、前記書込走査パルスで前記サンプリングトランジスタをオンさせる
請求項１に記載の表示装置。
【請求項３】
前記垂直駆動部は、前記画素回路を垂直走査し前記保持容量に前記信号振幅に応じた情報を書き込むための書込走査パルスを生成する書込走査部を有し、
前記書込走査部は、前記駆動トランジスタの電源供給端の電位が前記電気光学素子の表示期間に設定される第１の電位と前記電気光学素子の非表示期間中の前記駆動トランジスタの閾値補正を行なうための期間に設定される第２の電位との間の第３の電位に設定されている期間に、前記書込走査パルスで前記サンプリングトランジスタをオンさせる
請求項１に記載の表示装置。
【請求項４】
前記書込走査部は、前記映像信号が基準電位あるときに、前記書込走査パルスで前記サンプリングトランジスタをオンさせる
請求項２または請求項３に記載の表示装置。
【請求項５】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置されており、
前記駆動トランジスタの電源供給端の電位を、前記電気光学素子の表示期間に第１の電位に設定し、前記駆動トランジスタの閾値補正を行なうための初期化期間に第２の電位に設定し、前記表示期間と前記初期化期間の間の期間に前記第１の電位と前記第２の電位の間の第３の電位に設定して前記電気光学素子を非表示にさせる垂直駆動部を備えている
表示装置。
【請求項６】
前記垂直駆動部は、前記前記表示期間と前記初期化期間の間の期間に前記書込走査パルスで前記サンプリングトランジスタをオンさせることにより前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定する
請求項５に記載の表示装置。
【請求項７】
前記垂直駆動部は、前記映像信号が基準電位あるときに、前記サンプリングトランジスタをオンさせる
請求項６に記載の表示装置。
【請求項８】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置されており、
前記駆動トランジスタの電源供給端と出力端との電位を等しくして前記電気光学素子を表示状態から非表示状態に遷移させて前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定した後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定してから前記駆動トランジスタの閾値補正を行なうように前記画素回路を駆動する垂直駆動部を備えている
表示装置。
【請求項９】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置されており、
前記電気光学素子を表示状態から非表示状態に遷移させた後に前記駆動トランジスタの閾値補正を行なう前には、直前の表示輝度に拘わらず前記駆動トランジスタの制御入力端と出力端との間の電位差を同じ状態にした後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定する垂直駆動部を備えている
表示装置。
【請求項１０】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された画素アレイ部、および、前記電気光学素子の非表示期間に前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定してから前記駆動トランジスタの閾値補正を行なうように前記画素回路を駆動する垂直駆動部を有する表示装置
を備えた電子機器。
【請求項１１】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された画素アレイ部、および、前記駆動トランジスタの電源供給端の電位を、前記電気光学素子の表示期間には第１の電位に設定し、前記駆動トランジスタの閾値補正を行なうための初期化期間には第２の電位に設定し、前記表示期間と前記初期化期間の間の期間には前記第１の電位と前記第２の電位の間の第３の電位に設定して前記電気光学素子を非表示にさせる垂直駆動部を有する表示装置
を備えた電子機器。
【請求項１２】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された画素アレイ部、および、前記駆動トランジスタの電源供給端と出力端との電位を等しくして前記電気光学素子を表示状態から非表示状態に遷移させて前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定した後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定してから前記駆動トランジスタの閾値補正を行なうように前記画素回路を駆動する垂直駆動部を有する表示装置
を備えた電子機器。
【請求項１３】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された画素アレイ部、および、前記電気光学素子を表示状態から非表示状態に遷移させた後に前記駆動トランジスタの閾値補正を行なう前には、直前の表示輝度に拘わらず前記駆動トランジスタの制御入力端と出力端との間の電位差を同じ状態にした後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定する垂直駆動部を有する表示装置
を備えた電子機器。
【請求項１４】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された表示装置の前記画素回路を駆動するに当たり、
前記電気光学素子の非表示期間に前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定してから前記駆動トランジスタの閾値補正を行なうように駆動する
表示装置の駆動方法。
【請求項１５】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された表示装置の前記画素回路を駆動するに当たり、
前記駆動トランジスタの電源供給端の電位を、
前記電気光学素子の表示期間には第１の電位に設定し、
前記駆動トランジスタの閾値補正を行なうための初期化期間には第２の電位に設定し、
前記表示期間と前記初期化期間の間の期間には前記第１の電位と前記第２の電位の間の第３の電位に設定して前記電気光学素子を非表示にさせる
表示装置の駆動方法。
【請求項１６】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された表示装置の前記画素回路を駆動するに当たり、
前記駆動トランジスタの電源供給端と出力端との電位を等しくして前記電気光学素子を表示状態から非表示状態に遷移させる非表示処理工程と、
前記非表示処理工程後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定する劣化防止工程と、
前記劣化防止工程後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定してから前記駆動トランジスタの閾値補正を行なう閾値補正工程と、
を有する表示装置の駆動方法。
【請求項１７】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された表示装置の前記画素回路を駆動するに当たり、
前記電気光学素子を表示状態から非表示状態に遷移させた後に前記駆動トランジスタの閾値補正を行なう前に、
直前の表示輝度に拘わらず前記駆動トランジスタの制御入力端と出力端との間の電位差を同じ状態にする劣化防止工程と、
前記劣化防止工程後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定する初期化工程と、
を有する表示装置の駆動方法。
【請求項１】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置されており、
前記電気光学素子の非表示期間に前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定してから前記駆動トランジスタの閾値補正を行なうように前記画素回路を駆動する垂直駆動部を備えている
表示装置。
【請求項２】
前記垂直駆動部は、前記画素回路を垂直走査し前記保持容量に前記信号振幅に応じた情報を書き込むための書込走査パルスを生成する書込走査部を有し、
前記書込走査部は、前記電気光学素子の非表示期間において、前記書込走査パルスで前記サンプリングトランジスタをオンさせる
請求項１に記載の表示装置。
【請求項３】
前記垂直駆動部は、前記画素回路を垂直走査し前記保持容量に前記信号振幅に応じた情報を書き込むための書込走査パルスを生成する書込走査部を有し、
前記書込走査部は、前記駆動トランジスタの電源供給端の電位が前記電気光学素子の表示期間に設定される第１の電位と前記電気光学素子の非表示期間中の前記駆動トランジスタの閾値補正を行なうための期間に設定される第２の電位との間の第３の電位に設定されている期間に、前記書込走査パルスで前記サンプリングトランジスタをオンさせる
請求項１に記載の表示装置。
【請求項４】
前記書込走査部は、前記映像信号が基準電位あるときに、前記書込走査パルスで前記サンプリングトランジスタをオンさせる
請求項２または請求項３に記載の表示装置。
【請求項５】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置されており、
前記駆動トランジスタの電源供給端の電位を、前記電気光学素子の表示期間に第１の電位に設定し、前記駆動トランジスタの閾値補正を行なうための初期化期間に第２の電位に設定し、前記表示期間と前記初期化期間の間の期間に前記第１の電位と前記第２の電位の間の第３の電位に設定して前記電気光学素子を非表示にさせる垂直駆動部を備えている
表示装置。
【請求項６】
前記垂直駆動部は、前記前記表示期間と前記初期化期間の間の期間に前記書込走査パルスで前記サンプリングトランジスタをオンさせることにより前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定する
請求項５に記載の表示装置。
【請求項７】
前記垂直駆動部は、前記映像信号が基準電位あるときに、前記サンプリングトランジスタをオンさせる
請求項６に記載の表示装置。
【請求項８】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置されており、
前記駆動トランジスタの電源供給端と出力端との電位を等しくして前記電気光学素子を表示状態から非表示状態に遷移させて前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定した後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定してから前記駆動トランジスタの閾値補正を行なうように前記画素回路を駆動する垂直駆動部を備えている
表示装置。
【請求項９】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置されており、
前記電気光学素子を表示状態から非表示状態に遷移させた後に前記駆動トランジスタの閾値補正を行なう前には、直前の表示輝度に拘わらず前記駆動トランジスタの制御入力端と出力端との間の電位差を同じ状態にした後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定する垂直駆動部を備えている
表示装置。
【請求項１０】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された画素アレイ部、および、前記電気光学素子の非表示期間に前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定してから前記駆動トランジスタの閾値補正を行なうように前記画素回路を駆動する垂直駆動部を有する表示装置
を備えた電子機器。
【請求項１１】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された画素アレイ部、および、前記駆動トランジスタの電源供給端の電位を、前記電気光学素子の表示期間には第１の電位に設定し、前記駆動トランジスタの閾値補正を行なうための初期化期間には第２の電位に設定し、前記表示期間と前記初期化期間の間の期間には前記第１の電位と前記第２の電位の間の第３の電位に設定して前記電気光学素子を非表示にさせる垂直駆動部を有する表示装置
を備えた電子機器。
【請求項１２】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された画素アレイ部、および、前記駆動トランジスタの電源供給端と出力端との電位を等しくして前記電気光学素子を表示状態から非表示状態に遷移させて前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定した後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定してから前記駆動トランジスタの閾値補正を行なうように前記画素回路を駆動する垂直駆動部を有する表示装置
を備えた電子機器。
【請求項１３】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された画素アレイ部、および、前記電気光学素子を表示状態から非表示状態に遷移させた後に前記駆動トランジスタの閾値補正を行なう前には、直前の表示輝度に拘わらず前記駆動トランジスタの制御入力端と出力端との間の電位差を同じ状態にした後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定する垂直駆動部を有する表示装置
を備えた電子機器。
【請求項１４】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された表示装置の前記画素回路を駆動するに当たり、
前記電気光学素子の非表示期間に前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定してから前記駆動トランジスタの閾値補正を行なうように駆動する
表示装置の駆動方法。
【請求項１５】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された表示装置の前記画素回路を駆動するに当たり、
前記駆動トランジスタの電源供給端の電位を、
前記電気光学素子の表示期間には第１の電位に設定し、
前記駆動トランジスタの閾値補正を行なうための初期化期間には第２の電位に設定し、
前記表示期間と前記初期化期間の間の期間には前記第１の電位と前記第２の電位の間の第３の電位に設定して前記電気光学素子を非表示にさせる
表示装置の駆動方法。
【請求項１６】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された表示装置の前記画素回路を駆動するに当たり、
前記駆動トランジスタの電源供給端と出力端との電位を等しくして前記電気光学素子を表示状態から非表示状態に遷移させる非表示処理工程と、
前記非表示処理工程後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧以下に設定する劣化防止工程と、
前記劣化防止工程後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定してから前記駆動トランジスタの閾値補正を行なう閾値補正工程と、
を有する表示装置の駆動方法。
【請求項１７】
駆動信号を生成する駆動トランジスタ、前記駆動トランジスタの出力端に接続された電気光学素子、映像信号の信号振幅に応じた情報を保持する保持容量、および前記信号振幅に応じた情報を前記保持容量に書き込むサンプリングトランジスタを具備する画素回路が行列状に配置された表示装置の前記画素回路を駆動するに当たり、
前記電気光学素子を表示状態から非表示状態に遷移させた後に前記駆動トランジスタの閾値補正を行なう前に、
直前の表示輝度に拘わらず前記駆動トランジスタの制御入力端と出力端との間の電位差を同じ状態にする劣化防止工程と、
前記劣化防止工程後に、前記駆動トランジスタの制御入力端と出力端との間の電位差を閾値電圧を上回るように設定する初期化工程と、
を有する表示装置の駆動方法。
【図１】
【図２】
【図３】
【図４】
【図５】
【図６】
【図７】
【図７Ａ】
【図８】
【図９】
【図９Ａ】
【図９Ｂ】
【図２】
【図３】
【図４】
【図５】
【図６】
【図７】
【図７Ａ】
【図８】
【図９】
【図９Ａ】
【図９Ｂ】
【公開番号】特開２０１１−２２１１６５（Ｐ２０１１−２２１１６５Ａ）
【公開日】平成２３年１１月４日（２０１１．１１．４）
【国際特許分類】
【出願番号】特願２０１０−８８４７４（Ｐ２０１０−８８４７４）
【出願日】平成２２年４月７日（２０１０．４．７）
【出願人】（０００００２１８５）ソニー株式会社 (34,172)
【Ｆターム（参考）】
【公開日】平成２３年１１月４日（２０１１．１１．４）
【国際特許分類】
【出願日】平成２２年４月７日（２０１０．４．７）
【出願人】（０００００２１８５）ソニー株式会社 (34,172)
【Ｆターム（参考）】
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