【課題】隣接する配線の間におけるリークを抑制することができる不揮発性半導体記憶装置を提供する。
【解決手段】不揮発性半導体記憶装置１は、シリコンを含む基板１１と、基板１１の上に設けられた複数のメモリセルと、複数のメモリセルの上方に設けられた配線７と、配線７の上に設けられたリーク抑制層８と、前記リーク抑制層８の上方に設けられた層間絶縁膜１０と、を備えている。そして、隣接するメモリセルの間、および、隣接する配線７の間には空隙１２が形成され、リーク抑制層８の幅寸法は、配線７の幅寸法よりも短いこと、および、隣接するリーク抑制層８の間の寸法は、隣接する配線７の間の寸法よりも長いこと、の少なくともいずれかである。 （もっと読む）

【課題】ＭＴＪ素子内における層間の短絡を抑制し、かつ、ＭＴＪ素子を構成する磁性層の劣化を抑制した半導体記憶装置およびその製造方法を提供する。
【解決手段】本実施形態による半導体記憶装置は半導体基板を備える。磁気トンネル接合素子は、２つの磁性層と該２つの磁性層間に設けられたトンネル絶縁膜とを含み、半導体基板の上方に設けられている。側壁膜は、磁気トンネル接合素子の側面の上部に設けられている。フェンス層は、導電性材料を含み、側壁膜の側面および磁気トンネル接合素子の側面の下部に設けられている。保護膜は、絶縁体からなりフェンス層の側面に設けられている。フェンス層の上面および保護膜の上面は、側壁膜の上面よりも低く、かつ、トンネル絶縁膜よりも高い位置にある。 （もっと読む）

【課題】素子特性の劣化なしにリデポ現象による電気的ショートを防止する。
【解決手段】実施形態に係わる磁気抵抗効果素子は、磁化方向が可変の記憶層１１と、記憶層１１上のトンネルバリア層１２と、トンネルバリア層１２上の磁化方向が不変の参照層１３と、参照層１３上のハードマスク層１４と、参照層１３及びハードマスク層１４の側壁上の側壁スペーサ層１７とを備える。記憶層１１及び参照層１３は、垂直磁化を有し、参照層１３の平面サイズは、記憶層１１の平面サイズよりも小さい。記憶層１１及び参照層１３のサイズ差は、２ｎｍ以下であり、側壁スペーサ層１７は、ダイアモンド、ＤＬＣ、ＢＮ、ＳｉＣ、Ｂ_４Ｃ、Ａｌ_２Ｏ_３及びＡｌＮのうちの１つを備える。 （もっと読む）

【課題】磁気抵抗効果素子間の磁気的な干渉作用を遮断し、安定した動作を可能にし、且つ、容易に製造することができる半導体記憶装置を提供する。
【解決手段】本発明の実施形態にかかる半導体記憶装置は、半導体基板上にマトリックス状に配列した複数の磁気抵抗効果素子を有し、各磁気抵抗効果素子は、半導体基板上に形成された第１の磁性層と、第１の磁性層上に形成された非磁性層と、非磁性層上に形成された第２の磁性層とからなる積層構造を有し、隣り合う各磁気抵抗効果素子の間には、金属、又は、磁性体材料が分散された絶縁膜が埋め込まれている。 （もっと読む）

【課題】ＴＭＲ素子間の特性のばらつきを低減でき、かつ製造歩留まりの高い不揮発性磁気メモリの製造方法およびその構造を提供する。
【解決手段】ＴＭＲ素子を含む磁気記憶装置の製造方法が、配線層が設けられた層間絶縁膜の上に、絶縁膜を形成する工程と、絶縁膜に、配線層が露出するように開口部を形成する開口工程と、開口部を埋めるように、絶縁膜上に金属層を形成する金属層形成工程と、ＣＭＰ法を用いて絶縁膜上の金属層を研磨除去し、開口部内に残った金属層を下部電極とするＣＭＰ工程と、下部電極上にＴＭＲ素子を形成する工程とを含む。 （もっと読む）

【課題】積層ハードマスクを部分的に残存させつつ、配線層用のビアプラグのアスペクト比を低減することが可能な半導体装置及びその製造方法を提供する。
【解決手段】基板上に第１の配線層１０２を形成し、第１の配線層１０２上に、半導体素子材料１０３、第１の絶縁膜１０４、及び第２の絶縁膜１０５を順に形成し、半導体素子材料１０３、第１の絶縁膜１０４、及び第２の絶縁膜１０５を含むピラー状の構造体を形成する。第１の配線層１０２上に、構造体の上面及び側面を覆うように、第３及び第４の絶縁膜１０９，１０６を形成し、第４の絶縁膜１０６を、第２の絶縁膜１０５が露出するように、部分的に除去する。第１及び第２の絶縁膜内に、半導体素子材料に接続された第１のビアプラグ１０７を形成し、第３及び第４の絶縁膜内に、第１の配線層１０２に接続された第２のビアプラグ１０８を形成し、第１及び第２のビアプラグ上に第２の配線層１１１を形成する。 （もっと読む）

【課題】ロジック混載ＭＲＡＭにおいて、ＬＳＩの多層配線形成プロセスがＭＲＡＭの特性変動を引き起こす不都合、また、ＭＲＡＭの形成プロセスが多層配線の特性変動を引き起こす不都合を軽減すること。
【解決手段】多層配線層に含まれる配線層Ａの中に、配線層Ｂに形成された第１の配線１０４ｂに接し、互いに絶縁している少なくとも２つの第１の磁化固定層５０ａ及び５０ｂと、２つの第１の磁化固定層５０ａ及び５０ｂと平面視で重なり、かつ、第１の磁化固定層５０ａ及び５０ｂと接続している磁化自由層１０と、磁化自由層１０の上に位置する非磁性層４０と、非磁性層４０の上に位置する第２の磁化固定層１０４ａと、を有するＭＲＡＭが形成されている半導体装置。 （もっと読む）

【課題】 書込み電流の低減のみならず、大きなＭＲ比を有するＭＴＪ素子の開発が望まれている。
【解決手段】 磁気トンネル接合素子が、磁化自由層と、磁化固定層と、磁化自由層と磁化固定層との間に配置されたトンネルバリア層とを有する。磁化自由層は、垂直磁化自由層、垂直磁化自由層とトンネルバリア層との間に配置された面内磁化自由層、及び垂直磁化自由層と面内磁化自由層との間に配置された非磁性中間層とを含む。垂直磁化自由層の磁化容易方向は膜面に対して垂直であり、面内磁化自由層の磁化容易方向は膜面に平行であり、垂直磁化自由層の磁化は、非磁性中間層を介して面内磁化自由層と交換結合することによって、面内方向を向いている。 （もっと読む）

【課題】 ＧＭＲ素子では、十分大きなＭＲ比を得ることが困難である。大きなＭＲ比を実現することが可能なＭＴＪ素子において、反転電流を低減させることが望まれている。
【解決手段】 下部電極の上に、磁化容易方向が厚さ方向を向く垂直磁気異方性膜が形成されている。垂直磁気異方性膜の上に、非磁性材料で形成されたスペーサ層が配置されている。スペーサ層の上に、アモルファスの導電材料からなる下地層が配置されている。下地層の上に、磁化容易方向が面内方向を向く磁化自由層が配置されている。磁化自由層の上にトンネルバリア層が配置されている。トンネルバリア層の上に、磁化方向が面内方向に固定された磁化固定層が配置されている。スペーサ層は、垂直磁気異方性膜と磁化自由層との間に交換相互作用が働かない厚さであり、かつスピン緩和長よりも薄い。 （もっと読む）

【課題】隣接するビット線同士の短絡が抑制されており、かつ層間絶縁膜が平坦に研磨された半導体装置を提供する。
【解決手段】磁気抵抗素子ＭＲＤが複数配置されたメモリセル領域と、平面視においてメモリセル領域の周囲に配置された周辺回路領域とを備える。磁気抵抗素子ＭＲＤは、磁化固定層と磁化自由層とトンネル絶縁層とを含んでいる。磁気抵抗素子ＭＲＤの上方には、主表面に沿った方向に向けて延びる複数の第１の配線ＢＬを有している。上記周辺回路領域には、第１の配線ＢＬと同一レイヤにより構成される第２の配線ＢＬ２と平面視において重なるように、磁化自由層と同一材質の層、トンネル絶縁層と同一材質の層および磁化固定層と同一材質の層が積層された積層構造ＤＭＭが配置されている。積層構造ＤＭＭは、周辺回路領域にて平面視において隣接する１対の第２の配線ＢＬ２の両方と重ならない。 （もっと読む）

【課題】磁気特性の低下の抑制を図る。
【解決手段】磁気抵抗素子の製造方法は、磁化の方向が不変の固定層４、コバルトまたは鉄を含み、磁化の方向が可変の自由層６、および前記固定層と前記自由層との間に挟まれる非磁性層５で構成される積層体を形成し、前記積層体上に、ハードマスク１１を形成し、前記ハードマスクをマスクとして塩素を含むガスで前記積層体をエッチングし、エッチングされた前記固定層および前記自由層の側面に、ボロンと窒素とを含む絶縁膜１４を形成する。 （もっと読む）

【課題】記録層における磁化容易軸が垂直方向を向いている垂直磁化型の不揮発性磁気メモリ装置において、記録層の磁化容易軸をより確実に垂直方向に向かせることを目的とする。
【解決手段】不揮発性磁気メモリ装置は、磁化容易軸が垂直方向を向いている記録層を有する積層構造体５０、第１の配線４１、及び、第２の配線４２から成る磁気抵抗効果素子を備えており、積層構造体５０の上、又は、積層構造体５０の下、又は、積層構造体５０の上及び下には、記録層５３を構成する材料のヤング率よりも低い値のヤング率を有する低ヤング率領域４８１が配置されており、積層構造体５０は磁化参照層５１を更に有し、低ヤング率領域４８１を配置することによって記録層５３及び磁化参照層５１において内部応力が発生し、記録層５３及び磁化参照層５１の垂直磁気異方性が増大される。 （もっと読む）

【課題】媒体を製造するシステムおよび方法を提供する。
【解決手段】媒体を製造する方法は、基板上に記録媒体を形成するステップを含む。記録媒体上の、基板と反対側に保護膜が成膜される。保護膜は第一の表面仕上げ層を有する。保護膜はエッチングされ、材料が取り除かれ、保護膜に、第一の表面仕上げより平滑な第二の表面仕上げ層が設けられる。成膜とエッチングは、ｉｎ−ｓｉｔｕドライ真空工程で逐次的に行われてもよい。第二の表面仕上げ層には、エッチング後に、保護膜をさらに平坦化するための機械加工を行わなくてもよい。 （もっと読む）

【課題】生産コストを抑えながら高いスループットが得られる半導体装置の製造方法と半導体装置とを提供する。
【解決手段】ヨークカバーとなる積層膜として、バリアメタル層、磁性体層およびバリアメタル層が順次形成される。次に、積層膜ＭＬに、四フッ化炭素（ＣＦ₄）ガスとアルゴン（Ａｒ）ガスとの混合ガスによる反応性イオンエッチング処理、一酸化炭素（ＣＯ）、アンモニア（ＮＨ₃）ガスおよびアルゴン（Ａｒ）ガスの混合ガスによる反応性イオンエッチング処理、四フッ化炭素（ＣＦ₄）ガスとアルゴン（Ａｒ）ガスとの混合ガスによる反応性イオンエッチング処理を施すことにより、ヨークカバーＹＣが形成される。 （もっと読む）

【課題】記憶素子の下にあるコンタクトプラグの上面の平坦性を改善し、信頼性の高い半導体記憶装置を提供する。
【解決手段】半導体記憶装置は、半導体基板と、半導体基板上に設けられた複数のスイッチングトランジスタと、隣接する２つのスイッチングトランジスタ間に埋め込まれ、該隣接する２つのスイッチングトランジスタの各ゲートから絶縁されかつ該隣接する２つのスイッチングトランジスタの拡散層に電気的に接続されたコンタクトプラグと、コンタクトプラグ上に形成され、上面がスイッチングトランジスタの上面よりも高い位置にある上部コネクタと、上部コネクタの上面上に設けられ、データを記憶する記憶素子と、記憶素子上に設けられた配線とを備えている。 （もっと読む）

【課題】外部からの磁場を遮蔽する磁気シールド効果が高い半導体装置を提供する。
【解決手段】半導体基板ＳＵＢの主表面上に形成されたスイッチング素子ＴＲを覆うように形成された層間絶縁膜ＩＩＩ１と、平板状の引出配線ＬＥＬと、引出配線ＬＥＬとスイッチング素子ＴＲとを接続する接続配線ＩＣＬと、磁化の向きが可変とされた磁化自由層ＭＦＬを含み、引出配線ＬＥＬ上に形成された磁気抵抗素子ＴＭＲとを備える。磁化自由層ＭＦＬの磁化状態を変化させることが可能な配線ＤＬと配線ＢＬとを備えている。磁気抵抗素子ＴＭＲが複数並んだメモリセル領域において、磁気抵抗素子ＴＭＲの上部に配置された第１の高透磁率膜ＣＬＡＤ２が、上記メモリセル領域から、メモリセル領域以外の領域である周辺領域にまで延在している。 （もっと読む）

【課題】絶縁膜の比誘電率を容易かつ十分に低下させる。
【解決手段】半導体装置の製造方法では、それぞれ環状ＳｉＯ構造を主骨格とし互いに構造が異なる２種類以上の有機シロキサン化合物原料を混合した後で気化する。又は、それら２種類以上の有機シロキサン化合物原料の混合と気化とを一度に行うことによって、気化ガスを生成する。そして、その気化ガスをキャリアガスとともに反応炉に輸送する。そして、反応炉にてその気化ガスを用いたプラズマＣＶＤ法又はプラズマ重合法によって多孔質絶縁膜を成膜する。 （もっと読む）

【課題】磁気抵抗素子への不純物の侵入や応力の負荷を抑制し、低い駆動電力で高精度に作動する半導体装置およびその製造方法を提供する。
【解決手段】本発明の半導体装置は、主表面を有する半導体基板ＳＵＢと、半導体基板ＳＵＢの主表面上に位置する磁気抵抗素子ＭＲＤとを備えている。その他、保護層ＩＩＩと、配線ＢＬと、第１上部電極ＵＥＬ１と、第２上部電極ＵＥＬ２とを備えている。保護層ＩＩＩは、磁気抵抗素子ＭＲＤの側面を覆うように配置されている。配線ＢＬは、上記磁気抵抗素子ＭＲＤの上部に位置する。第１上部電極ＵＥＬ１は、上記磁気抵抗素子ＭＲＤ上に、平面視における大きさが磁気抵抗素子ＭＲＤと実質的に同じであるものが配置されている。第２上部電極ＵＥＬ２は、上記第１上部電極ＵＥＬ１上にて、上記第１上部電極ＵＥＬ１と電気的に接続されており、平面視における大きさが第１上部電極ＵＥＬ１より大きい。 （もっと読む）

【課題】素子作製時の加熱や、電流注入によって生じる熱等による磁気抵抗効果素子の特性劣化を防止することができる磁気抵抗効果素子構造体、この磁気抵抗効果素子構造体を用いた磁気ランダムアクセスメモリ、この磁気抵抗効果素子構造体を用いた空間光変調器を提供する。
【解決手段】固定層１０１と、中間層１０２と、反転層１０３とが積層された磁気抵抗効果素子１０を有し、固定層１０１に、遷移金属と希土類金属との磁性合金、Ｍｎを含む磁性合金、または、磁性多層膜のうちのいずれかを用いた磁気抵抗効果素子構造体１であって、磁気抵抗効果素子１０の上面に設けられた上部電極１１および磁気抵抗効果素子１０の下面に設けられた下部電極１２の間に、当該電極間を絶縁するための絶縁材１３を備え、絶縁材１３は、ＭｇＦ_２誘電体材料１３ａであり、ＭｇＦ_２誘電体材料１３ａは、固定層１０１の側面に当接して設けられていることを特徴とする。 （もっと読む）

【課題】磁気抵抗素子の短絡不良等が軽減される半導体装置と、その製造方法とを提供する。
【解決手段】メモリセルが形成される層間絶縁膜３３において、磁気抵抗素子５１が形成されるメモリセル領域Ｍに位置する層間絶縁膜３３の部分の上面の位置が、周辺領域Ｐに位置する層間絶縁膜３３の部分の上面の位置よりも低く形成されている。磁気抵抗素子５１を覆うように、層間絶縁膜４０が形成されている。その層間絶縁膜４０に、磁気抵抗素子に電気的に接続されるビット線４１が形成されている。磁気抵抗素子５１の直下にディジット線３１が形成されている。 （もっと読む）