電源回路
【課題】フィードバック電圧を検知する検知回路において、出力電流が変化せず、出力電圧が変化しない検知回路を得ること、動作温度により出力電圧が変化しない検知回路を得ること、並びに、当該検知回路を有する電源回路を得る。
【解決手段】第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、出力電圧を出力する増幅回路と、当該増幅回路と電気的に接続され、当該検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、当該増幅回路及び当該制御回路に電気的に接続され、当該出力電圧を分圧したものをフィードバック電圧として当該第２の参照電圧発生回路に入力する分圧回路とを有し、当該第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、基準電圧回路である電源回路に関する。
【解決手段】第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、出力電圧を出力する増幅回路と、当該増幅回路と電気的に接続され、当該検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、当該増幅回路及び当該制御回路に電気的に接続され、当該出力電圧を分圧したものをフィードバック電圧として当該第２の参照電圧発生回路に入力する分圧回路とを有し、当該第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、基準電圧回路である電源回路に関する。
【発明の詳細な説明】
【技術分野】
【０００１】
開示される発明の一態様は、電源回路に関する。
【背景技術】
【０００２】
液晶装置、ＣＣＤ、デジタルカメラ等には、負電圧を入力することが必要な場合がある。このような負電圧を供給する回路として、反転型ＤＣＤＣコンバータ回路が知られている（特許文献１参照）。
【０００３】
特許文献１では、電源電圧ＶＤＤ及び接地電圧ＧＮＤ（０Ｖ）を用いて、負電圧であるフィードバック電圧ＶＦＢを生成している。
【０００４】
負電圧であるフィードバック電圧ＶＦＢは、正電圧化回路にて正電圧化される。これにより、正電圧化回路が負電圧であるフィードバック電圧ＶＦＢを検知する。
【先行技術文献】
【特許文献】
【０００５】
【特許文献１】特開２００９−３０３３１３号公報
【発明の概要】
【発明が解決しようとする課題】
【０００６】
特許文献１の電源回路において、負電圧であるフィードバック電圧を検知する正電圧化回路は、ＮチャネルＭＯＳトランジスタ及びＰチャネルＭＯＳトランジスタを用いて形成されている。
【０００７】
ＭＯＳトランジスタは、ソースに対して、ゲート、ドレイン、及びバックゲート電位により、出力電流が変化するという欠点を有する。そのため特許文献１の電源回路のように、正電圧化回路をＮチャネルＭＯＳトランジスタ及びＰチャネルＭＯＳトランジスタを用いて形成すると、ＭＯＳトランジスタの出力電流が変化し、正電圧化回路の出力電圧が変化する恐れがある。
【０００８】
またＭＯＳトランジスタは、動作温度により出力電流が変化するという欠点を有する。そのため特許文献１の電源回路のように、正電圧化回路をＮチャネルＭＯＳトランジスタ及びＰチャネルＭＯＳトランジスタを用いて形成すると、ＭＯＳトランジスタの出力電流が変化し、正電圧化回路の出力電圧が変化する恐れがある。
【０００９】
以上を鑑みて、開示される発明の一態様では、フィードバック電圧を検知する検知回路において、出力電流が変化せず、出力電圧が変化しない検知回路を得ることを課題の一とする。
【００１０】
また、開示される発明の一態様では、フィードバック電圧を検知する検知回路において、動作温度により出力電圧が変化しない検知回路を得ることを課題の一とする。
【００１１】
また、開示される発明の一態様では、上記の検知回路を有する電源回路を得ることを課題の一とする。
【課題を解決するための手段】
【００１２】
電源電圧ＶＤＤ、及び電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ（０Ｖ））との間に、出力電圧Ｖｒｅｆを出力する第１の参照電圧発生回路、及び電源電圧ＶＤＤ及びフィードバック電圧Ｖｆｂ間に、出力電圧（Ｖｒｅｆ−Ｖｆｂ）を出力する第２の参照電圧発生回路を配置する。
【００１３】
第１の参照電圧発生回路の出力電圧Ｖｒｅｆ及び第２の参照電圧発生回路の出力電圧（Ｖｒｅｆ−Ｖｆｂ）を、それぞれ入力信号調整回路に入力する。第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路によって、当該検知回路が構成される。入力信号調整回路は、第１の参照電圧発生回路からの出力電圧Ｖｒｅｆをそのまま出力する一方、第２の参照電圧発生回路からの出力電圧（Ｖｒｅｆ−Ｖｆｂ）を電圧Ｖｅｒｒ＿ｉｎに変換して出力する。
【００１４】
入力信号調整回路から出力される出力電圧Ｖｒｅｆ及び電圧Ｖｅｒｒ＿ｉｎは、誤差増幅回路に入力される。誤差増幅回路は、入力される電圧の値が等しくなるように機能する。よって、出力電圧Ｖｒｅｆと電圧Ｖｅｒｒ＿ｉｎの値が等しくなる。
【００１５】
すなわち、開示される発明の一態様では誤差増幅回路に入力される出力電圧Ｖｒｅｆと電圧Ｖｅｒｒ＿ｉｎの値が等しくなるような入力信号調整回路を提供する。
【００１６】
開示される発明の一態様において、出力電圧Ｖｒｅｆと電圧Ｖｅｒｒ＿ｉｎの値が等しくするには、第１の参照電圧発生回路からの出力電圧Ｖｒｅｆと、分圧回路からのフィードバック電圧Ｖｆｂの値が等しくする必要がある。よって開示される発明の一態様において、第１の参照電圧発生回路からの出力電圧Ｖｒｅｆと、分圧回路からのフィードバック電圧Ｖｆｂの値が等しくなるような第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を提供する。
【００１７】
以上により、開示される発明の一態様において、第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路によって構成される検知回路によって、負電圧であるフィードバック電圧Ｖｆｂを検知することができる。
【００１８】
開示される発明の一態様においては、第１の参照電圧発生回路及び第２の参照電圧発生回路は、ダイオード及び抵抗を有するバンドギャップリファレンスである。開示される発明の一態様における検知回路は、当該第１の参照電圧発生回路及び第２の参照電圧発生回路、並びに入力信号調整回路によって構成される。これにより、出力電圧電流によって出力電圧が変化せず、出力安定性がよい検知回路を得ることができる。
【００１９】
開示される発明の一態様においては、第１の参照電圧発生回路及び第２の参照電圧発生回路は、ダイオード及び抵抗を有するバンドギャップリファレンスである。開示される発明の一態様における検知回路は、当該第１の参照電圧発生回路及び第２の参照電圧発生回路、並びに入力信号調整回路によって構成される。これにより、動作温度によって出力電圧が変化せず、出力安定性がよい検知回路を得ることができる。
【００２０】
バンドギャップリファレンス（Ｂａｎｄ ｇａｐ Ｒｅｆｅｒｅｎｃｅ）は、バンドギャップを利用した基準電圧回路である。シリコンのバンドギャップエネルギーを利用したバンドギャップリファレンスは、出力電圧がほぼ１．２５Ｖとなる。
【００２１】
開示される発明の一態様において、当該ダイオードは、シリコン基板を用いたダイオード、或いは絶縁基板上に設けられたシリコン薄膜を有するダイオードを用いる。またダイオードに代えて、ダイオード接続したトランジスタを用いることも可能である。上記のダイオード及びダイオード接続したトランジスタを用いることにより、出力安定性がよい検知回路を得ることができる。
【００２２】
また開示される発明の一態様では、当該負電圧であるフィードバック電圧Ｖｆｂを検知する検知回路を有する電源回路を得ることができる。
【００２３】
開示される発明の一態様は、第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、出力電圧を出力する増幅回路と、当該増幅回路と電気的に接続され、当該検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、当該増幅回路及び当該制御回路に電気的に接続され、当該出力電圧を分圧したものをフィードバック電圧として当該第２の参照電圧発生回路に入力する分圧回路とを有し、当該第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、基準電圧回路であることを特徴とする電源回路に関する。
【００２４】
開示される発明の一態様は、第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、出力電圧を出力する増幅回路と、当該増幅回路と電気的に接続され、当該検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、当該増幅回路及び当該制御回路に電気的に接続され、当該出力電圧を分圧したものをフィードバック電圧として当該第２の参照電圧発生回路に入力する分圧回路とを有し、当該第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、ダイオード及び抵抗を含む基準電圧回路であることを特徴とする電源回路に関する。
【００２５】
開示される発明の一態様は、第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、出力電圧を出力する増幅回路と、当該増幅回路と電気的に接続され、当該検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、オペアンプ、第１の抵抗値を有する２つの抵抗、第２の抵抗値を有する２つの抵抗を有する当該入力信号調整回路と、当該増幅回路及び当該制御回路に電気的に接続され、当該出力電圧を分圧したものをフィードバック電圧として当該第２の参照電圧発生回路に入力する分圧回路とを有し、当該第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、基準電圧回路であることを特徴とする電源回路に関する。
【００２６】
開示される発明の一態様は、第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、出力電圧を出力する増幅回路と、当該増幅回路と電気的に接続され、当該検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、オペアンプ、第１の抵抗値を有する２つの抵抗、第２の抵抗値を有する２つの抵抗を有する当該入力信号調整回路と、当該増幅回路及び当該制御回路に電気的に接続され、当該出力電圧を分圧したものをフィードバック電圧として当該第２の参照電圧発生回路に入力する分圧回路とを有し、当該第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、ダイオード及び抵抗を含む基準電圧回路であることを特徴とする電源回路に関する。
【００２７】
開示される発明の一態様において、当該増幅回路は、ＤＣＤＣコンバータであることを特徴とする。
【００２８】
開示される発明の一態様において、当該増幅回路は、チュークコンバータであることを特徴とする。
【００２９】
開示される発明の一態様において、当該増幅回路は、フライバックコンバータであることを特徴とする。
【００３０】
開示される発明の一態様において、当該分圧回路と第２の参照電圧発生回路との間に、ボルテージフォロワが設けられていることを特徴とする。
【００３１】
開示される発明の一態様において、当該フィードバック電圧は、負電圧であることを特徴とする。
【発明の効果】
【００３２】
開示される発明の一態様により、フィードバック電圧を検知する検知回路において、出力電流が変化せず、出力電圧が変化しない検知回路を得ることができる。
【００３３】
また、開示される発明の一態様では、フィードバック電圧を検知する検知回路において、動作温度により出力電圧が変化しない検知回路を得ることができる。
【００３４】
また、開示される発明の一態様では、上記の検知回路を有する電源回路を得ることができる。
【図面の簡単な説明】
【００３５】
【図１】電源回路の回路図。
【図２】電源回路の回路図。
【図３】電源回路の回路図。
【図４】電源回路の回路図。
【図５】電源回路の回路図。
【図６】電源回路の回路図。
【図７】電源回路の回路図。
【図８】電源回路の一部の回路図。
【図９】電源回路の一部の回路図。
【図１０】電源回路の一部の回路図。
【図１１】電源回路の一部の回路図。
【発明を実施するための形態】
【００３６】
以下、本明細書に開示された発明の実施の態様について、図面を参照して説明する。但し、本明細書に開示された発明は多くの異なる態様で実施することが可能であり、本明細書に開示された発明の趣旨及びその範囲から逸脱することなくその形態及び詳細を様々に変更し得ることは当業者であれば容易に理解される。従って、本実施の形態の記載内容に限定して解釈されるものではない。なお、以下に示す図面において、同一部分又は同様な機能を有する部分には同一の符号を付し、その繰り返しの説明は省略する。
【００３７】
図１に、本実施の形態の電源回路を示す。図１に示す電源回路は、増幅回路１２１、増幅回路１２１に電気的に接続された分圧回路１３３、増幅回路１２１及び分圧回路１３３と電気的に接続された制御回路１０１、増幅回路１２１及び分圧回路１３３と電気的に接続された出力端子１３４を有する。なお図１の電源回路では、増幅回路１２１として昇降圧型ＤＣＤＣコンバータを用いている。
【００３８】
図１に示す増幅回路１２１は、コイル１２２、ダイオード１２３、トランジスタ１２４、及び容量１２５を有している。
【００３９】
トランジスタ１２４のソース又はドレインの一方は、電源電圧ＶＤＤが印加される入力端子１２６と電気的に接続されている。トランジスタ１２４のソース又はドレインの他方は、コイル１２２の一方の端子、及びダイオード１２３の出力端子に電気的に接続されている。トランジスタ１２４のゲートは、制御回路１０１のパルス幅変調ドライバ１０３（パルス幅変調：Ｐｕｌｓｅ Ｗｉｄｔｈ Ｍｏｄｕｌａｔｉｏｎ（ＰＷＭ））の出力端子に電気的に接続されている。
【００４０】
コイル１２２の一方の端子は、トランジスタ１２４のソース又はドレインの他方、及びダイオード１２３の出力端子と電気的に接続されている。コイル１２２の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００４１】
ダイオード１２３の出力端子は、トランジスタ１２４のソース又はドレインの他方、及びコイル１２２の一方の端子と電気的に接続されている。ダイオード１２３の入力端子は、容量１２５の一方の端子、出力電圧Ｖｏｕｔが出力される出力端子１３４、及び分圧回路１３３の抵抗１３１の一方の端子に電気的に接続されている。
【００４２】
容量１２５の一方の端子は、ダイオード１２３の入力端子、出力端子１３４、及び分圧回路１３３の抵抗１３１の一方の端子に電気的に接続されている。容量１２５の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００４３】
図１に示す制御回路１０１は、パルス幅変調ドライバ１０３、容量１０４、三角波発生回路１０５、誤差増幅回路１０６（誤差増幅回路：エラーアンプともいう）、及び検知回路１１９を有している、検知回路１１９は、入力信号調整回路１０２、及び参照電圧発生回路１１３、参照電圧発生回路１１４を有している。
【００４４】
パルス幅変調ドライバ１０３の非反転入力端子は、誤差増幅回路１０６の出力端子及び容量１０４の一方の端子に電気的に接続されている。パルス幅変調ドライバ１０３の反転入力端子は、三角波発生回路１０５に電気的に接続されている。パルス幅変調ドライバ１０３の出力端子は、増幅回路１２１のトランジスタ１２４のゲートに電気的に接続されている。
【００４５】
容量１０４の一方の端子は、パルス幅変調ドライバ１０３の非反転入力端子及び誤差増幅回路１０６の出力端子に電気的に接続されている。容量１０４の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００４６】
誤差増幅回路１０６の非反転入力端子は、参照電圧発生回路１１３の第１の端子及び入力信号調整回路１０２の抵抗１０７の一方の端子に電気的に接続されている。誤差増幅回路１０６の反転入力端子は、入力信号調整回路１０２のオペアンプ１０８の出力端子及び抵抗１０９の一方の端子に電気的に接続されている。誤差増幅回路１０６の出力端子は、パルス幅変調ドライバ１０３の非反転入力端子及び容量１０４の一方の端子に電気的に接続されている。
【００４７】
入力信号調整回路１０２は、抵抗１０７、オペアンプ１０８、抵抗１０９、抵抗１１１、及び抵抗１１２を有している。本実施の形態において、抵抗１１１及び抵抗１１２の抵抗値は等しい。また抵抗１０７及び抵抗１０９の抵抗値は等しい。抵抗１１１及び抵抗１１２の抵抗値をそれぞれ抵抗値Ｒ１とし、抵抗１０７及び抵抗１０９の抵抗値をそれぞれ抵抗値Ｒ２とする。
【００４８】
抵抗１０７の一方の端子は、誤差増幅回路１０６の非反転入力端子及び参照電圧発生回路１１３の第１の端子に電気的に接続されている。抵抗１０７の他方の端子は、オペアンプ１０８の非反転入力端子及び抵抗１１１の一方の端子に電気的に接続されている。
【００４９】
オペアンプ１０８の非反転入力端子は、抵抗１０７の他方の端子及び抵抗１１１の一方の端子に電気的に接続されている。オペアンプ１０８の反転入力端子は、抵抗１０９の他方の端子及び抵抗１１２の一方の端子に電気的に接続されている。オペアンプ１０８の出力端子は、誤差増幅回路１０６の反転入力端子及び抵抗１０９の一方の端子に電気的に接続されている。
【００５０】
抵抗１１１の一方の端子は、抵抗１０７の他方の端子及びオペアンプ１０８の非反転入力端子に電気的に接続されている。抵抗１１１の他方の端子は、参照電圧発生回路１１３の第２の端子に電気的に接続されており、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００５１】
抵抗１１２の一方の端子は、オペアンプ１０８の反転入力端子及び抵抗１０９の他方の端子に電気的に接続されている。抵抗１１２の他方の端子は、参照電圧発生回路１１４の第１の端子に電気的に接続されている。
【００５２】
第１の参照電圧発生回路である参照電圧発生回路１１３の第１の端子は、入力信号調整回路１０２の抵抗１０７の一方の端子及び誤差増幅回路１０６の非反転入力端子に電気的に接続されている。参照電圧発生回路１１３の第２の端子は、入力信号調整回路１０２の抵抗１１１の他方の端子に電気的に接続されており、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。参照電圧発生回路１１３の第３の端子は、電源電圧ＶＤＤが印加される入力端子１１５及び参照電圧発生回路１１４の第２の端子に電気的に接続されている。なお、参照電圧発生回路１１３及び参照電圧発生回路１１４の具体的な回路構成の例は、後述する。
【００５３】
第２の参照電圧発生回路である参照電圧発生回路１１４の第１の端子は、入力信号調整回路１０２の抵抗１１２の他方の端子に電気的に接続されている。参照電圧発生回路１１４の第２の端子は、参照電圧発生回路１１３の第３の端子及び入力端子１１５に電気的に接続されている。参照電圧発生回路１１４の第３の端子は、分圧回路１３３の抵抗１３１の他方の端子及び抵抗１３２の一方の端子に電気的に接続されている。また参照電圧発生回路１１４の第３の端子に、フィードバック電圧Ｖｆｂが入力される。
【００５４】
分圧回路１３３は、抵抗１３１及び抵抗１３２を有している。
【００５５】
抵抗１３１の一方の端子は、増幅回路１２１のダイオード１２３の入力端子、容量１２５の一方の端子、及び出力端子１３４に電気的に接続されている。抵抗１３１の他方の端子は、参照電圧発生回路１１４の第３の端子及び抵抗１３２の一方の端子に電気的に接続されている。
【００５６】
抵抗１３２の一方の端子は、抵抗１３１の他方の端子及び参照電圧発生回路１１４の第３の端子に電気的に接続されている。抵抗１３２の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００５７】
以下に図１に示す電源回路の動作について説明する。
【００５８】
増幅回路１２１の出力電圧Ｖｏｕｔは、分圧回路１３３の抵抗１３１及び抵抗１３２の比に応じて分圧される。分圧された出力電圧Ｖｏｕｔであるフィードバック電圧Ｖｆｂが、参照電圧発生回路１１４の第３の端子から入力される。
【００５９】
参照電圧発生回路１１３は、第３の端子から入力される電源電圧ＶＤＤに基づいて、出力電圧Ｖｒｅｆを出力する。
【００６０】
参照電圧発生回路１１４は、第２の端子から入力された電源電圧ＶＤＤ、及び第３の端子から入力されたフィードバック電圧Ｖｆｂに基づいて、出力電圧（Ｖｒｅｆ−Ｖｆｂ）を出力する。
【００６１】
ここで誤差増幅回路１０６に入力される電圧について述べる。誤差増幅回路１０６に入力される電圧は、参照電圧発生回路１１３の第１の端子から出力される出力電圧Ｖｒｅｆ、及びオペアンプ１０８の出力端子から出力される電圧Ｖｅｒｒ＿ｉｎである。電圧Ｖｅｒｒ＿ｉｎは、誤差増幅回路１０６から出力された電圧が、パルス幅変調ドライバ１０３、増幅回路１２１、分圧回路１３３、参照電圧発生回路１１４、及び入力信号調整回路１０２を介して負帰還した電圧である。
【００６２】
誤差増幅回路１０６は、入力される出力電圧Ｖｒｅｆ及び電圧Ｖｅｒｒ＿ｉｎが等しくなるように機能する。
【００６３】
また、入力信号調整回路１０２のオペアンプ１０８は、反転入力端子及び出力端子が抵抗１０９を介して接続されている。すなわちオペアンプ１０８において、出力の一部が入力側に負帰還している。オペアンプ１０８の出力の一部が入力側に負帰還しているため、オペアンプ１０８の反転入力端子及び非反転入力端子に入力される電圧は等しくなる。
【００６４】
参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、参照電圧発生回路１１４のフィードバック電圧Ｖｆｂ、抵抗１１１及び抵抗１１２の抵抗値Ｒ１、並びに、抵抗１０７及び抵抗１０９の抵抗値Ｒ２を用いると、オペアンプ１０８の非反転入力端子に入力される電圧は以下の数１となる。
【００６５】
【数１】
【００６６】
またオペアンプ１０８の反転入力端子に入力される電圧は以下の数２となる。
【数２】
【００６７】
オペアンプ１０８の反転入力端子及び非反転入力端子に入力される電圧は等しくなるので、数１及び数２は等しい。
【００６８】
【数３】
【００６９】
数３を解くと、数４が得られる。
【００７０】
【数４】
【００７１】
上述のように、誤差増幅回路１０６は、入力される出力電圧Ｖｒｅｆ及び電圧Ｖｅｒｒ＿ｉｎが等しくなるように機能する。
【００７２】
以上より、出力電圧Ｖｒｅｆとフィードバック電圧Ｖｆｂが等しいことが示される。
【００７３】
以上により、本実施の形態の電源回路において、参照電圧発生回路１１３、参照電圧発生回路１１４、及び入力信号調整回路１０２により構成される検知回路１１９により、負電圧であるフィードバック電圧Ｖｆｂを検知することができる。
【００７４】
図２に、バンドギャップリファレンスである、参照電圧発生回路１１３及び参照電圧発生回路１１４の具体的な回路構成の一例を示す。
【００７５】
図２の参照電圧発生回路１１３は、オペアンプ１４１、抵抗１４２、抵抗１４３、ダイオード１４４、抵抗１４５、ダイオード１４６を有している。
【００７６】
オペアンプ１４１の非反転入力端子は、抵抗１４５の一方の端子及びダイオード１４６の入力端子に電気的に接続されている。オペアンプ１４１の反転入力端子は、抵抗１４２の一方の端子及び抵抗１４３の一方の端子に電気的に接続されている。オペアンプ１４１の出力端子は、抵抗１４２の他方の端子及び抵抗１４５の他方の端子に電気的に接続されている。またオペアンプ１４１には、端子１６１から電源電圧ＶＤＤが入力される。
【００７７】
抵抗１４２の一方の端子は、オペアンプ１４１の反転入力端子及び抵抗１４３の一方の端子に電気的に接続されている。抵抗１４２の他方の端子は、オペアンプ１４１の出力端子及び抵抗１４５の他方の端子に電気的に接続されている。
【００７８】
抵抗１４３の一方の端子は、オペアンプ１４１の反転入力端子及び抵抗１４２の一方の端子に電気的に接続されている。抵抗１４３の他方の端子は、ダイオード１４４の入力端子に電気的に接続されている。
【００７９】
ダイオード１４４の入力端子は、抵抗１４３の他方の端子に電気的に接続されている。ダイオード１４４の出力端子は、ダイオード１４６の出力端子に電気的に接続されており、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００８０】
抵抗１４５の一方の端子は、オペアンプ１４１の非反転入力端子及びダイオード１４６の入力端子に電気的に接続されている。抵抗１４５の他方の端子は、オペアンプ１４１の出力端子及び抵抗１４２の他方の端子に電気的に接続されている。
【００８１】
ダイオード１４６の入力端子は、オペアンプ１４１の非反転入力端子及び抵抗１４５の一方の端子に電気的に接続されている。ダイオード１４６の出力端子は、ダイオード１４４の出力端子に電気的に接続されており、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００８２】
参照電圧発生回路１１４は、オペアンプ１５１、抵抗１５２、抵抗１５３、ダイオード１５４、抵抗１５５、ダイオード１５６を有している。
【００８３】
オペアンプ１５１の非反転入力端子は、抵抗１５５の一方の端子及びダイオード１５６の入力端子に電気的に接続されている。オペアンプ１５１の反転入力端子は、抵抗１５２の一方の端子及び抵抗１５３の一方の端子に電気的に接続されている。オペアンプ１５１の出力端子は、抵抗１５２の他方の端子及び抵抗１５５の他方の端子に電気的に接続されている。またオペアンプ１５１には、端子１６２から電源電圧ＶＤＤが入力される。
【００８４】
抵抗１５２の一方の端子は、オペアンプ１５１の反転入力端子及び抵抗１５３の一方の端子に電気的に接続されている。抵抗１５２の他方の端子は、オペアンプ１５１の出力端子及び抵抗１５５の他方の端子に電気的に接続されている。
【００８５】
抵抗１５３の一方の端子は、オペアンプ１５１の反転入力端子及び抵抗１５２の一方の端子に電気的に接続されている。抵抗１５３の他方の端子は、ダイオード１５４の入力端子に電気的に接続されている。
【００８６】
ダイオード１５４の入力端子は、抵抗１５３の他方の端子に電気的に接続されている。ダイオード１５４の出力端子は、ダイオード１５６の出力端子、分圧回路１３３の抵抗１３１の他方の端子、及び抵抗１３２の一方の端子に電気的に接続されている。
【００８７】
抵抗１５５の一方の端子は、オペアンプ１５１の非反転入力端子及びダイオード１５６の入力端子に電気的に接続されている。抵抗１５５の他方の端子は、オペアンプ１５１の出力端子及び抵抗１５２の他方の端子に電気的に接続されている。
【００８８】
ダイオード１５６の入力端子は、オペアンプ１５１の非反転入力端子及び抵抗１５５の一方の端子に電気的に接続されている。ダイオード１５６の出力端子は、ダイオード１５４の出力端子、分圧回路１３３の抵抗１３１の他方の端子、及び抵抗１３２の一方の端子に電気的に接続されている。
【００８９】
参照電圧発生回路１１３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４及びダイオード１４６）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１１４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４及びダイオード１５６）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【００９０】
また参照電圧発生回路１１３及び参照電圧発生回路１１４がバンドギャップリファレンスであるため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【００９１】
なお、参照電圧発生回路１１３のダイオード１４４及びダイオード１４６、並びに参照電圧発生回路１１４のダイオード１５４及びダイオード１５６をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【００９２】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【００９３】
図３に示す電源回路は、図２に示す電源回路において、フィードバック電圧Ｖｆｂの入力部にバッファ回路１６３を配置した電源回路である。図３のバッファ回路１６３は、オペアンプ１６４を用いたボルテージフォロワである。
【００９４】
ボルテージフォロワは、高入力インピーダンス、低出力インピーダンスであり、入出力の電圧が同じという特徴を有している。そのためボルテージフォロワを配置すると、ボルテージフォロワの前段と後段の干渉を低減することができる。そのため、ボルテージフォロワであるバッファ回路１６３の前段である分圧回路１３３の内部抵抗と後段である参照電圧発生回路１１４の入力抵抗を無視することができる。これにより、電源回路の安定化を図ることができる。
【００９５】
オペアンプ１６４の非反転入力端子は、分圧回路１３３の抵抗１３１の他方の端子及び抵抗１３２の一方の端子に電気的に接続されている。オペアンプ１６４の反転入力端子は、オペアンプ１６４の出力端子、参照電圧発生回路１１４のダイオード１５４の出力端子、及びダイオード１５６の出力端子に電気的に接続されている。オペアンプ１６４の出力端子は、オペアンプ１６４の反転入力端子、参照電圧発生回路１１４のダイオード１５４の出力端子、及びダイオード１５６の出力端子に電気的に接続されている。
【００９６】
図３に示す電源回路では、図２に示す電源回路と同様に、参照電圧発生回路１１３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４及びダイオード１４６）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１１４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４及びダイオード１５６）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【００９７】
また参照電圧発生回路１１３及び参照電圧発生回路１１４がバンドギャップリファレンスであるため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【００９８】
なお、参照電圧発生回路１１３のダイオード１４４及びダイオード１４６、並びに参照電圧発生回路１１４のダイオード１５４及びダイオード１５６をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【００９９】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１００】
図４に示す電源回路は、図２に示す電源回路において増幅回路１２１を増幅回路１７１に代えた電源回路である。図４に示す増幅回路１７１は、チュークコンバータ（ＣｕＫコンバータともいう）である。なお図４において、図２と同じものは同じ符号で示している。
【０１０１】
増幅回路１７１は、コイル１７２、容量１７３、トランジスタ１７４、ダイオード１７５、コイル１７６、容量１７７を有している。
【０１０２】
コイル１７２の一方の端子は、電源電圧ＶＤＤが印加される入力端子１２６に電気的に接続されている。コイル１７２の他方の端子は、トランジスタ１７４のソース又はドレインの一方及び容量１７３の一方の端子に電気的に接続されている。
【０１０３】
容量１７３の一方の端子は、コイル１７２の他方の端子及びトランジスタ１７４のソース又はドレインの一方に電気的に接続されている。容量１７３の他方の端子は、ダイオード１７５の入力端子及びコイル１７６の一方の端子に電気的に接続されている。
【０１０４】
トランジスタ１７４のソース又はドレインの一方は、コイル１７２の他方の端子及び容量１７３の一方の端子に電気的に接続されている。トランジスタ１７４のソース又はドレインの他方には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。トランジスタ１７４のゲートは、パルス幅変調ドライバ１０３の出力端子に電気的に接続されている。
【０１０５】
ダイオード１７５の入力端子は、容量１７３の他方の端子及びコイル１７６の一方の端子に電気的に接続されている。ダイオード１７５の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１０６】
コイル１７６の一方の端子は、容量１７３の他方の端子及びダイオード１７５の入力端子に電気的に接続されている。コイル１７６の他方の端子は、容量１７７の一方の端子、出力電圧Ｖｏｕｔが出力される出力端子１３４、及び分圧回路１３３の抵抗１３１の一方の端子に電気的に接続されている。
【０１０７】
容量１７７の一方の端子は、コイル１７６の他方の端子、出力端子１３４、及び分圧回路１３３の抵抗１３１の一方の端子に電気的に接続されている。容量１７７の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１０８】
図４に示す電源回路では、図２に示す電源回路と同様に、参照電圧発生回路１１３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４及びダイオード１４６）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１１４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４及びダイオード１５６）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０１０９】
また参照電圧発生回路１１３及び参照電圧発生回路１１４がバンドギャップリファレンスであるため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０１１０】
なお、参照電圧発生回路１１３のダイオード１４４及びダイオード１４６、並びに参照電圧発生回路１１４のダイオード１５４及びダイオード１５６をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０１１１】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１１２】
図５に示す電源回路は、図４に示す電源回路において、フィードバック電圧Ｖｆｂの入力部にバッファ回路１６３を配置した電源回路である。図５のバッファ回路１６３は、オペアンプ１６４を用いたボルテージフォロワである。
【０１１３】
ボルテージフォロワは、高入力インピーダンス、低出力インピーダンスであり、入出力の電圧が同じという特徴を有している。そのためボルテージフォロワを配置すると、ボルテージフォロワの前段と後段の干渉を低減することができる。そのため、ボルテージフォロワであるバッファ回路１６３の前段である分圧回路１３３の内部抵抗と後段である参照電圧発生回路１１４の入力抵抗を無視することができる。これにより、電源回路の安定化を図ることができる。
【０１１４】
オペアンプ１６４の非反転入力端子は、分圧回路１３３の抵抗１３１の他方の端子及び抵抗１３２の一方の端子に電気的に接続されている。オペアンプ１６４の反転入力端子は、オペアンプ１６４の出力端子、参照電圧発生回路１１４のダイオード１５４の出力端子、及びダイオード１５６の出力端子に電気的に接続されている。オペアンプ１６４の出力端子は、オペアンプ１６４の反転入力端子、参照電圧発生回路１１４のダイオード１５４の出力端子、及びダイオード１５６の出力端子に電気的に接続されている。
【０１１５】
図５に示す電源回路では、図２に示す電源回路と同様に、参照電圧発生回路１１３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４及びダイオード１４６）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１１４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４及びダイオード１５６）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０１１６】
また参照電圧発生回路１１３及び参照電圧発生回路１１４がバンドギャップリファレンスであるため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０１１７】
なお、参照電圧発生回路１１３のダイオード１４４及びダイオード１４６、並びに参照電圧発生回路１１４のダイオード１５４及びダイオード１５６をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０１１８】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１１９】
図６に示す電源回路は、図２に示す電源回路において増幅回路１２１を増幅回路１８１に代えた電源回路である。図６に示す増幅回路１８１は、フライバックコンバータである。なお図６において、図２と同じものは同じ符号で示している。
【０１２０】
増幅回路１８１は、コイル１８２及びコイル１８３を有するトランス１８４、トランジスタ１８５、ダイオード１８６、容量１８７を有している。
【０１２１】
コイル１８２の一方の端子は、電源電圧ＶＤＤが印加される入力端子１２６に電気的に接続されている。コイル１８２の他方の端子は、トランジスタ１８５のソース又はドレインの一方に接続されている。
【０１２２】
コイル１８３の一方の端子は、容量１８７の一方の端子、出力電圧Ｖｏｕｔが出力される出力端子１３４、及び、分圧回路１３３の抵抗１３１の一方の端子に電気的に接続されている。コイル１８３の他方の端子は、ダイオード１８６の入力端子に電気的に接続されている。
【０１２３】
トランジスタ１８５のソース又はドレインの一方は、コイル１８２の他方の端子に電気的に接続されている。トランジスタ１８５のソース又はドレインの他方には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。トランジスタ１８５のゲートは、パルス幅変調ドライバ１０３の出力端子に電気的に接続されている。
【０１２４】
ダイオード１８６の入力端子は、コイル１８３の他方の端子に電気的に接続されている。ダイオード１８６の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１２５】
容量１８７の一方の端子は、コイル１８３の一方の端子、出力端子１３４、及び、分圧回路１３３の抵抗１３１の一方の端子に電気的に接続されている。容量１８７の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１２６】
図６に示す電源回路では、図２に示す電源回路と同様に、参照電圧発生回路１１３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４及びダイオード１４６）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１１４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４及びダイオード１５６）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０１２７】
また参照電圧発生回路１１３及び参照電圧発生回路１１４がバンドギャップリファレンスであるため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０１２８】
なお、参照電圧発生回路１１３のダイオード１４４及びダイオード１４６、並びに参照電圧発生回路１１４のダイオード１５４及びダイオード１５６をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０１２９】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１３０】
図７に示す電源回路は、図６に示す電源回路において、フィードバック電圧Ｖｆｂの入力部にバッファ回路１６３を配置した電源回路である。図７のバッファ回路１６３は、オペアンプ１６４を用いたボルテージフォロワである。
【０１３１】
ボルテージフォロワは、高入力インピーダンス、低出力インピーダンスであり、入出力の電圧が同じという特徴を有している。そのためボルテージフォロワを配置すると、ボルテージフォロワの前段と後段の干渉を低減することができる。そのため、ボルテージフォロワであるバッファ回路１６３の前段である分圧回路１３３の内部抵抗と後段である参照電圧発生回路１１４の入力抵抗を無視することができる。これにより、電源回路の安定化を図ることができる。
【０１３２】
オペアンプ１６４の非反転入力端子は、分圧回路１３３の抵抗１３１の他方の端子及び抵抗１３２の一方の端子に電気的に接続されている。オペアンプ１６４の反転入力端子は、オペアンプ１６４の出力端子、参照電圧発生回路１１４のダイオード１５４の出力端子、及びダイオード１５６の出力端子に電気的に接続されている。オペアンプ１６４の出力端子は、オペアンプ１６４の反転入力端子、参照電圧発生回路１１４のダイオード１５４の出力端子、及びダイオード１５６の出力端子に電気的に接続されている。
【０１３３】
図７に示す電源回路では、図２に示す電源回路と同様に、参照電圧発生回路１１３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４及びダイオード１４６）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１１４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４及びダイオード１５６）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０１３４】
また参照電圧発生回路１１３及び参照電圧発生回路１１４がバンドギャップリファレンスであるため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０１３５】
なお、参照電圧発生回路１１３のダイオード１４４及びダイオード１４６、並びに参照電圧発生回路１１４のダイオード１５４及びダイオード１５６をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０１３６】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１３７】
図８に、図２〜図７に示す参照電圧発生回路１１３及び参照電圧発生回路１１４とは異なる回路構成を有する、参照電圧発生回路１９１及び参照電圧発生回路１９２の回路構成を示す。なお、図２〜図７の参照電圧発生回路１１３及び参照電圧発生回路１１４を、それぞれ参照電圧発生回路１９１及び参照電圧発生回路１９２に置き換えることが可能である。
【０１３８】
第１の参照電圧発生回路である参照電圧発生回路１９１は、オペアンプ１４１、抵抗１４２、抵抗１４３、ダイオード１４４、抵抗１４５、ダイオード１４６、ダイオード１４７、ダイオード１４８を有している。オペアンプ１４１、抵抗１４２、抵抗１４３、ダイオード１４４、抵抗１４５の接続については、図２と同様のため、図２の説明を援用する。
【０１３９】
ダイオード１４４の入力端子は、抵抗１４３の他方の端子に電気的に接続されている。ダイオード１４４の出力端子は、ダイオード１４７の入力端子に電気的に接続されている。
【０１４０】
ダイオード１４６の入力端子は、オペアンプ１４１の非反転入力端子及び抵抗１４５の一方の端子に電気的に接続されている。ダイオード１４６の出力端子は、ダイオード１４８の入力端子に電気的に接続されている。
【０１４１】
ダイオード１４７の入力端子は、ダイオード１４４の出力端子に電気的に接続されている。ダイオード１４７の出力端子は、ダイオード１４８の出力端子に電気的に接続されており、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１４２】
ダイオード１４８の入力端子は、ダイオードの１４６の出力端子に電気的に接続されている。ダイオード１４８の出力端子は、ダイオード１４７の出力端子に電気的に接続されており、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１４３】
第２の参照電圧発生回路である参照電圧発生回路１９２は、オペアンプ１５１、抵抗１５２、抵抗１５３、ダイオード１５４、抵抗１５５、ダイオード１５６、ダイオード１５７、ダイオード１５８を有している。オペアンプ１５１、抵抗１５２、抵抗１５３、ダイオード１５４、抵抗１５５の接続については、図２と同様のため、図２の説明を援用する。
【０１４４】
ダイオード１５４の入力端子は、抵抗１５３の他方の端子に電気的に接続されている。ダイオード１５４の出力端子は、ダイオード１５７の入力端子に電気的に接続されている。
【０１４５】
ダイオード１５６の入力端子は、オペアンプ１５１の非反転入力端子及び抵抗１５５の一方の端子に電気的に接続されている。ダイオード１５６の出力端子は、ダイオード１５８の入力端子に電気的に接続されている。
【０１４６】
ダイオード１５７の入力端子は、ダイオード１５４の出力端子に電気的に接続されている。ダイオード１５７の出力端子は、ダイオード１５８の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１４７】
ダイオード１５８の入力端子は、ダイオードの１５６の出力端子に電気的に接続されている。ダイオード１５８の出力端子は、ダイオード１５７の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１４８】
図８に示すように、参照電圧発生回路１９１では、ダイオード１４４及びダイオード１４７、並びにダイオード１４６及び１４８を直列に接続している。ダイオードを２つ直列にした場合は、出力電圧はバンドギャップ電圧（図２に示す参照電圧発生回路１１３の出力電圧）の２倍となる。また参照電圧発生回路１９２においても同様の原理で、出力電圧が図２に示す参照電圧発生回路１１４の出力電圧の２倍となる。
【０１４９】
図８に示す電源回路において、参照電圧発生回路１９１は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４、ダイオード１４６、ダイオード１４７、及びダイオード１４８）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１９２は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４、ダイオード１５６、ダイオード１５７、及びダイオード１５８）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１９１の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９２の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０１５０】
また参照電圧発生回路１９１及び参照電圧発生回路１９２がバンドギャップリファレンスであるため、参照電圧発生回路１９１の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９２の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０１５１】
なお、参照電圧発生回路１９１のダイオード１４４、ダイオード１４６、ダイオード１４７、及びダイオード１４８、並びに参照電圧発生回路１９２のダイオード１５４、ダイオード１５６、ダイオード１５７、及びダイオード１５８をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０１５２】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１５３】
図９に、図２〜図７に示す参照電圧発生回路１１３及び参照電圧発生回路１１４とは異なる回路構成を有する、参照電圧発生回路１９３及び参照電圧発生回路１９４の回路構成を示す。なお、図２〜図７の参照電圧発生回路１１３及び参照電圧発生回路１１４を、それぞれ参照電圧発生回路１９３及び参照電圧発生回路１９４に置き換えることが可能である。
【０１５４】
第１の参照電圧発生回路である参照電圧発生回路１９３は、端子２０１、ｐチャネル型トランジスタ２０２、抵抗２０３、オペアンプ２０４、端子２０８、ｐチャネル型トランジスタ２０９、抵抗２０５、抵抗２０６、ダイオード２０７、端子２１１、ｐチャネル型トランジスタ２１２、抵抗２１３、抵抗２１４、ダイオード２１５を有している。
【０１５５】
ｐチャネル型トランジスタ２０２のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２０１、ｐチャネル型トランジスタ２０２のゲート、オペアンプ２０４の出力端子、ｐチャネル型トランジスタ２０９のゲート、ｐチャネル型トランジスタ２０９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０８、ｐチャネル型トランジスタ２１２のゲート、ｐチャネル型トランジスタ２１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２１１に電気的に接続されている。ｐチャネル型トランジスタ２０２のソース又はドレインの他方は、入力信号調整回路１０２、抵抗２０３の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２０２のゲートは、ｐチャネル型トランジスタ２０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０１、オペアンプ２０４の出力端子、ｐチャネル型トランジスタ２０９のゲート、ｐチャネル型トランジスタ２０９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０８、ｐチャネル型トランジスタ２１２のゲート、ｐチャネル型トランジスタ２１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２１１に電気的に接続されている。
【０１５６】
抵抗２０３の一方の端子は、ｐチャネル型トランジスタ２０２のソース又はドレインの他方、入力信号調整回路１０２に電気的に接続されている。抵抗２０３の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１５７】
オペアンプ２０４の非反転入力端子は、ｐチャネル型トランジスタ２１２のソース又はドレインの他方、抵抗２１３の一方の端子、抵抗２１４の一方の端子に電気的に接続されている。オペアンプ２０４の反転入力端子は、ｐチャネル型トランジスタ２０９のソース又はドレインの他方、抵抗２０５の一方の端子、抵抗２０６の一方の端子に電気的に接続されている。オペアンプ２０４の出力端子は、ｐチャネル型トランジスタ２０２のゲート、ｐチャネル型トランジスタ２０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０１、ｐチャネル型トランジスタ２０９のゲート、ｐチャネル型トランジスタ２０９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０８、ｐチャネル型トランジスタ２１２のゲート、ｐチャネル型トランジスタ２１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２１１に電気的に接続されている。
【０１５８】
ｐチャネル型トランジスタ２０９のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２０８、ｐチャネル型トランジスタ２０９のゲート、ｐチャネル型トランジスタ２０２のゲート、ｐチャネル型トランジスタ２０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０１、オペアンプ２０４の出力端子、ｐチャネル型トランジスタ２１２のゲート、ｐチャネル型トランジスタ２１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２１１に電気的に接続されている。ｐチャネル型トランジスタ２０９のソース又はドレインの他方は、オペアンプ２０４の反転入力端子、抵抗２０５の一方の端子、抵抗２０６の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２０９のゲートは、ｐチャネル型トランジスタ２０９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０８、ｐチャネル型トランジスタ２０２のゲート、ｐチャネル型トランジスタ２０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０１、オペアンプ２０４の出力端子、ｐチャネル型トランジスタ２１２のゲート、ｐチャネル型トランジスタ２１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２１１に電気的に接続されている。
【０１５９】
抵抗２０５の一方の端子は、オペアンプ２０４の反転入力端子、ｐチャネル型トランジスタ２０９のソース又はドレインの他方、抵抗２０６の一方の端子に電気的に接続されている。抵抗２０５の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１６０】
抵抗２０６の一方の端子は、ｐチャネル型トランジスタ２０９のソース又はドレインの他方、オペアンプ２０４の反転入力端子、抵抗２０５の一方の端子に電気的に接続されている。抵抗２０６の他方の端子は、ダイオード２０７の入力端子に電気的に接続されている。
【０１６１】
ダイオード２０７の入力端子は、抵抗２０６の他方の端子に電気的に接続されている。ダイオード２０７の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１６２】
ｐチャネル型トランジスタ２１２のソース又はドレインの一方は、ｐチャネル型トランジスタ２１２のゲート、電源電圧ＶＤＤが印加される端子２１１、ｐチャネル型トランジスタ２０２のゲート、ｐチャネル型トランジスタ２０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０１、オペアンプ２０４の出力端子、ｐチャネル型トランジスタ２０９のゲート、ｐチャネル型トランジスタ２０９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０８に電気的に接続されている。ｐチャネル型トランジスタ２１２のソース又はドレインの他方は、オペアンプ２０４の非反転入力端子、抵抗２１３の一方の端子、抵抗２１４の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２１２のゲートは、ｐチャネル型トランジスタ２１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２１１、ｐチャネル型トランジスタ２０２のゲート、ｐチャネル型トランジスタ２０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０１、オペアンプ２０４の出力端子、ｐチャネル型トランジスタ２０９のゲート、ｐチャネル型トランジスタ２０９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０８に電気的に接続されている。
【０１６３】
抵抗２１３の一方の端子は、ｐチャネル型トランジスタ２１２のソース又はドレインの他方、オペアンプ２０４の非反転入力端子、抵抗２１４の一方の端子に電気的に接続されている。抵抗２１３の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１６４】
抵抗２１４の一方の端子は、ｐチャネル型トランジスタ２１２のソース又はドレインの他方、オペアンプ２０４の非反転入力端子、抵抗２１３の一方の端子に電気的に接続されている。抵抗２１４の他方の端子は、ダイオード２１５の入力端子に電気的に接続されている。
【０１６５】
ダイオード２１５の入力端子は、抵抗２１４の他方の端子に電気的に接続されている。ダイオード２１５の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１６６】
第２の参照電圧発生回路である参照電圧発生回路１９４は、端子２２１、ｐチャネル型トランジスタ２２２、抵抗２２３、オペアンプ２２４、端子２２８、ｐチャネル型トランジスタ２２９、抵抗２２５、抵抗２２６、ダイオード２２７、端子２３１、ｐチャネル型トランジスタ２３２、抵抗２３３、抵抗２３４、ダイオード２３５を有している。
【０１６７】
ｐチャネル型トランジスタ２２２のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２２１、ｐチャネル型トランジスタ２２２のゲート、オペアンプ２２４の出力端子、ｐチャネル型トランジスタ２２９のゲート、ｐチャネル型トランジスタ２２９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２８、ｐチャネル型トランジスタ２３２のゲート、ｐチャネル型トランジスタ２３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２３１に電気的に接続されている。ｐチャネル型トランジスタ２２２のソース又はドレインの他方は、入力信号調整回路１０２、抵抗２２３の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２２２のゲートは、ｐチャネル型トランジスタ２２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２１、オペアンプ２２４の出力端子、ｐチャネル型トランジスタ２２９のゲート、ｐチャネル型トランジスタ２２９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２８、ｐチャネル型トランジスタ２３２のゲート、ｐチャネル型トランジスタ２３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２３１に電気的に接続されている。
【０１６８】
抵抗２２３の一方の端子は、ｐチャネル型トランジスタ２２２のソース又はドレインの他方、入力信号調整回路１０２に電気的に接続されている。抵抗２２３の他方の端子は、抵抗２２５の他方の端子、ダイオード２２７の出力端子、抵抗２３３の他方の端子、ダイオード２３５の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１６９】
オペアンプ２２４の非反転入力端子は、ｐチャネル型トランジスタ２３２のソース又はドレインの他方、抵抗２３３の一方の端子、抵抗２３４の一方の端子に電気的に接続されている。オペアンプ２２４の反転入力端子は、ｐチャネル型トランジスタ２２９のソース又はドレインの他方、抵抗２２５の一方の端子、抵抗２２６の一方の端子に電気的に接続されている。オペアンプ２２４の出力端子は、ｐチャネル型トランジスタ２２２のゲート、ｐチャネル型トランジスタ２２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２１、ｐチャネル型トランジスタ２２９のゲート、ｐチャネル型トランジスタ２２９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２８、ｐチャネル型トランジスタ２３２のゲート、ｐチャネル型トランジスタ２３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２３１に電気的に接続されている。
【０１７０】
ｐチャネル型トランジスタ２２９のソース又はドレインの一方は、ｐチャネル型トランジスタ２２９のゲート、電源電圧ＶＤＤが印加される端子２２８、ｐチャネル型トランジスタ２２２のゲート、ｐチャネル型トランジスタ２２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２１、オペアンプ２２４の出力端子、ｐチャネル型トランジスタ２３２のゲート、ｐチャネル型トランジスタ２３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２３１に電気的に接続されている。ｐチャネル型トランジスタ２２９のソース又はドレインの他方は、オペアンプ２２４の反転入力端子、抵抗２２５の一方の端子、抵抗２２６の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２２９のゲートは、ｐチャネル型トランジスタ２２９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２８、ｐチャネル型トランジスタ２２２のゲート、ｐチャネル型トランジスタ２２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２１、オペアンプ２２４の出力端子、ｐチャネル型トランジスタ２３２のゲート、ｐチャネル型トランジスタ２３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２３１に電気的に接続されている。
【０１７１】
抵抗２２５の一方の端子は、オペアンプ２２４の反転入力端子、ｐチャネル型トランジスタ２２９のソース又はドレインの他方、抵抗２２６の一方の端子に電気的に接続されている。抵抗２２５の他方の端子は、抵抗２２３の他方の端子、ダイオード２２７の出力端子、抵抗２３３の他方の端子、ダイオード２３５の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１７２】
抵抗２２６の一方の端子は、ｐチャネル型トランジスタ２２９のソース又はドレインの他方、オペアンプ２２４の反転入力端子、抵抗２２５の一方の端子に電気的に接続されている。抵抗２２６の他方の端子は、ダイオード２２７の入力端子に電気的に接続されている。
【０１７３】
ダイオード２２７の入力端子は、抵抗２２６の他方の端子に電気的に接続されている。ダイオード２２７の出力端子は、抵抗２２３の他方の端子、抵抗２２５の他方の端子、抵抗２３３の他方の端子、ダイオード２３５の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１７４】
ｐチャネル型トランジスタ２３２のソース又はドレインの一方は、ｐチャネル型トランジスタ２３２のゲート、電源電圧ＶＤＤが印加される端子２３１、ｐチャネル型トランジスタ２２２のゲート、ｐチャネル型トランジスタ２２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２１、オペアンプ２２４の出力端子、ｐチャネル型トランジスタ２２９のゲート、ｐチャネル型トランジスタ２２９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２８に電気的に接続されている。ｐチャネル型トランジスタ２３２のソース又はドレインの他方は、オペアンプ２２４の非反転入力端子、抵抗２３３の一方の端子、抵抗２３４の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２３２のゲートは、ｐチャネル型トランジスタ２３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２３１、ｐチャネル型トランジスタ２２２のゲート、ｐチャネル型トランジスタ２２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２１、オペアンプ２２４の出力端子、ｐチャネル型トランジスタ２２９のゲート、ｐチャネル型トランジスタ２２９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２８に電気的に接続されている。
【０１７５】
抵抗２３３の一方の端子は、ｐチャネル型トランジスタ２３２のソース又はドレインの他方、オペアンプ２２４の非反転入力端子、抵抗２３４の一方の端子に電気的に接続されている。抵抗２３３の他方の端子は、抵抗２２３の他方の端子、抵抗２２５の他方の端子、ダイオード２２７の出力端子、ダイオード２３５の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１７６】
抵抗２３４の一方の端子は、ｐチャネル型トランジスタ２３２のソース又はドレインの他方、オペアンプ２２４の非反転入力端子、抵抗２３３の一方の端子に電気的に接続されている。抵抗２３４の他方の端子は、ダイオード２３５の入力端子に電気的に接続されている。
【０１７７】
ダイオード２３５の入力端子は、抵抗２３４の他方の端子に電気的に接続されている。ダイオード２３５の出力端子は、抵抗２２３の他方の端子、抵抗２２５の他方の端子、ダイオード２２７の出力端子、抵抗２３３の他方の端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１７８】
図９に示す電源回路において、参照電圧発生回路１９３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード２０７及びダイオード２１５）、及び抵抗（抵抗２０３、抵抗２０５、抵抗２０６、抵抗２１３、抵抗２１４）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１９４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード２２７及びダイオード２３５）、及び抵抗（抵抗２２３、抵抗２２５、抵抗２２６、抵抗２３３、抵抗２３４）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１９３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０１７９】
また参照電圧発生回路１９３及び参照電圧発生回路１９４がバンドギャップリファレンスであるため、参照電圧発生回路１９３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０１８０】
なお、参照電圧発生回路１９３のダイオード２０７及びダイオード２１５、並びに参照電圧発生回路１９４のダイオード２２７及びダイオード２３５をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０１８１】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１８２】
図１０に、図２〜図７に示す参照電圧発生回路１１３及び参照電圧発生回路１１４とは異なる回路構成を有する、参照電圧発生回路１９５及び参照電圧発生回路１９６の回路構成を示す。なお、図２〜図７の参照電圧発生回路１１３及び参照電圧発生回路１１４を、それぞれ参照電圧発生回路１９５及び参照電圧発生回路１９６に置き換えることが可能である。
【０１８３】
第１の参照電圧発生回路である参照電圧発生回路１９５は、端子２４１、ｐチャネル型トランジスタ２４２、抵抗２４３、ダイオード２４４、端子２４５、ｐチャネル型トランジスタ２４６、ｎチャネル型トランジスタ２４７、抵抗２４８、ダイオード２４９、端子２５１、ｐチャネル型トランジスタ２５２、ｎチャネル型トランジスタ２５３、ダイオード２５４を有している。
【０１８４】
ｐチャネル型トランジスタ２４２のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２４２のゲート、ｐチャネル型トランジスタ２４６のゲート、ｐチャネル型トランジスタ２４６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２５２のゲート、ｐチャネル型トランジスタ２５２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２５２のソース又はドレインの他方、ｎチャネル型トランジスタ２５３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ２４２のソース又はドレインの他方は、入力信号調整回路１０２、抵抗２４３の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２４２のゲートは、ｐチャネル型トランジスタ２４２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２４６のゲート、ｐチャネル型トランジスタ２４６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２５２のゲート、ｐチャネル型トランジスタ２５２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２５２のソース又はドレインの他方、ｎチャネル型トランジスタ２５３のソース又はドレインの一方に電気的に接続されている。
【０１８５】
抵抗２４３の一方の端子は、ｐチャネル型トランジスタ２４２のソース又はドレインの他方、入力信号調整回路１０２に電気的に接続されている。抵抗２４３の他方の端子は、ダイオード２４４の入力端子に電気的に接続されている。
【０１８６】
ダイオード２４４の入力端子は、抵抗２４３の他方の端子に電気的に接続されている。ダイオード２４４の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１８７】
ｐチャネル型トランジスタ２４６のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２４６のゲート、ｐチャネル型トランジスタ２４２のゲート、ｐチャネル型トランジスタ２４２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２５２のゲート、ｐチャネル型トランジスタ２５２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２５２のソース又はドレインの他方、ｎチャネル型トランジスタ２５３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ２４６のソース又はドレインの他方は、ｎチャネル型トランジスタ２４７のソース又はドレインの一方、ｎチャネル型トランジスタ２４７のゲート、ｎチャネル型トランジスタ２５３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｐチャネル型トランジスタ２４６のゲートは、ｐチャネル型トランジスタ２４６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２４２のゲート、ｐチャネル型トランジスタ２４２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２５２のゲート、ｐチャネル型トランジスタ２５２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２５２のソース又はドレインの他方、ｎチャネル型トランジスタ２５３のソース又はドレインの一方に電気的に接続されている。
【０１８８】
ｎチャネル型トランジスタ２４７のソース又はドレインの一方は、ｎチャネル型トランジスタ２４７のゲート、ｐチャネル型トランジスタ２４６のソース又はドレインの他方、ｎチャネル型トランジスタ２５３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｎチャネル型トランジスタ２４７のソース又はドレインの他方は、抵抗２４８の一方の端子に電気的に接続されている。ｎチャネル型トランジスタ２４７のゲートは、ｎチャネル型トランジスタ２４７のソース又はドレインの一方、ｐチャネル型トランジスタ２４６のソース又はドレインの他方、ｎチャネル型トランジスタ２５３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１８９】
抵抗２４８の一方の端子は、ｎチャネル型トランジスタ２４７のソース又はドレインの他方に電気的に接続されている。抵抗２４８の他方の端子は、ダイオード２４９の入力端子に電気的に接続されている。
【０１９０】
ダイオード２４９の入力端子は、抵抗２４８の他方の端子に電気的に接続されている。ダイオード２４９の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１９１】
ｐチャネル型トランジスタ２５２のソース又はドレインの一方は、ｐチャネル型トランジスタ２５２のゲート、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２５２のソース又はドレインの他方、ｐチャネル型トランジスタ２４２のゲート、ｐチャネル型トランジスタ２４２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２４６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２４６のゲート、ｎチャネル型トランジスタ２５３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ２５２のソース又はドレインの他方は、ｐチャネル型トランジスタ２５２のソース又はドレインの一方、ｐチャネル型トランジスタ２５２のゲート、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２４２のゲート、ｐチャネル型トランジスタ２４２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２４６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２４６のゲート、ｎチャネル型トランジスタ２５３のソース又はドレインの一方に電気的に接続されている。
【０１９２】
ｎチャネル型トランジスタ２５３のソース又はドレインの一方は、ｐチャネル型トランジスタ２４２のゲート、ｐチャネル型トランジスタ２４２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２４６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２４６のゲート、ｐチャネル型トランジスタ２５２のゲート、ｐチャネル型トランジスタ２５２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２５２のソース又はドレインの他方に電気的に接続されている。ｎチャネル型トランジスタ２５３のソース又はドレインの他方は、ダイオード２５４の入力端子に電気的に接続されている。ｎチャネル型トランジスタ２５３のゲートは、ｎチャネル型トランジスタ２４７のソース又はドレインの一方、ｎチャネル型トランジスタ２４７のゲート、ｐチャネル型トランジスタ２４６のソース又はドレインの他方に電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１９３】
ダイオード２５４の入力端子は、ｎチャネル型トランジスタ２５３のソース又はドレインの他方に電気的に接続されている。ダイオード２５４の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１９４】
第２の参照電圧発生回路である参照電圧発生回路１９６は、端子２６１、ｐチャネル型トランジスタ２６２、抵抗２６３、ダイオード２６４、端子２６５、ｐチャネル型トランジスタ２６６、ｎチャネル型トランジスタ２６７、抵抗２６８、ダイオード２６９、端子２７１、ｐチャネル型トランジスタ２７２、ｎチャネル型トランジスタ２７３、ダイオード２７４を有している。
【０１９５】
ｐチャネル型トランジスタ２６２のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２６２のゲート、ｐチャネル型トランジスタ２６６のゲート、ｐチャネル型トランジスタ２６６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６５、ｐチャネル型トランジスタ２７２のゲート、ｐチャネル型トランジスタ２７２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２７２のソース又はドレインの他方、ｎチャネル型トランジスタ２７３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ２６２のソース又はドレインの他方は、入力信号調整回路１０２、抵抗２６３の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２６２のゲートは、ｐチャネル型トランジスタ２６２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２６６のゲート、ｐチャネル型トランジスタ２６６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６５、ｐチャネル型トランジスタ２７２のゲート、ｐチャネル型トランジスタ２７２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２７２のソース又はドレインの他方、ｎチャネル型トランジスタ２７３のソース又はドレインの一方に電気的に接続されている。
【０１９６】
抵抗２６３の一方の端子は、ｐチャネル型トランジスタ２６２のソース又はドレインの他方、入力信号調整回路１０２に電気的に接続されている。抵抗２６３の他方の端子は、ダイオード２６４の入力端子に電気的に接続されている。
【０１９７】
ダイオード２６４の入力端子は、抵抗２６３の他方の端子に電気的に接続されている。ダイオード２６４の出力端子は、ダイオード２６９の出力端子、ダイオード２７４の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１９８】
ｐチャネル型トランジスタ２６６のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２６５、ｐチャネル型トランジスタ２６６のゲート、ｐチャネル型トランジスタ２６２のゲート、ｐチャネル型トランジスタ２６２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２７２のゲート、ｐチャネル型トランジスタ２７２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２７２のソース又はドレインの他方、ｎチャネル型トランジスタ２７３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ２６６のソース又はドレインの他方は、ｎチャネル型トランジスタ２６７のソース又はドレインの一方、ｎチャネル型トランジスタ２６７のゲート、ｎチャネル型トランジスタ２７３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｐチャネル型トランジスタ２６６のゲートは、ｐチャネル型トランジスタ２６６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６５、ｐチャネル型トランジスタ２６２のゲート、ｐチャネル型トランジスタ２６２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２７２のゲート、ｐチャネル型トランジスタ２７２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２７２のソース又はドレインの他方、ｎチャネル型トランジスタ２７３のソース又はドレインの一方に電気的に接続されている。
【０１９９】
ｎチャネル型トランジスタ２６７のソース又はドレインの一方は、ｎチャネル型トランジスタ２６７のゲート、ｐチャネル型トランジスタ２６６のソース又はドレインの他方、ｎチャネル型トランジスタ２７３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｎチャネル型トランジスタ２６７のソース又はドレインの他方は、抵抗２６８の一方の端子に電気的に接続されている。ｎチャネル型トランジスタ２６７のゲートは、ｎチャネル型トランジスタ２６７のソース又はドレインの一方、ｐチャネル型トランジスタ２６６のソース又はドレインの他方、ｎチャネル型トランジスタ２７３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２００】
抵抗２６８の一方の端子は、ｎチャネル型トランジスタ２６７のソース又はドレインの他方に電気的に接続されている。抵抗２６８の他方の端子は、ダイオード２６９の入力端子に電気的に接続されている。
【０２０１】
ダイオード２６９の入力端子は、抵抗２６８の他方の端子に電気的に接続されている。ダイオード２６９の出力端子は、ダイオード２６４の出力端子、ダイオード２７４の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２０２】
ｐチャネル型トランジスタ２７２のソース又はドレインの一方は、ｐチャネル型トランジスタ２７２のゲート、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２７２のソース又はドレインの他方、ｐチャネル型トランジスタ２６２のゲート、ｐチャネル型トランジスタ２６２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２６６のゲート、ｐチャネル型トランジスタ２６６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６５、ｎチャネル型トランジスタ２７３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ２７２のソース又はドレインの他方は、ｐチャネル型トランジスタ２７２のソース又はドレインの一方、ｐチャネル型トランジスタ２７２のゲート、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２６２のゲート、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２６２のソース又はドレインの一方、ｐチャネル型トランジスタ２６６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６５、ｐチャネル型トランジスタ２６６のゲート、ｎチャネル型トランジスタ２７３のソース又はドレインの一方に電気的に接続されている。
【０２０３】
ｎチャネル型トランジスタ２７３のソース又はドレインの一方は、ｐチャネル型トランジスタ２６２のゲート、ｐチャネル型トランジスタ２６２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２６６のゲート、ｐチャネル型トランジスタ２６６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６５、ｐチャネル型トランジスタ２７２のゲート、ｐチャネル型トランジスタ２７２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２７２のソース又はドレインの他方に電気的に接続されている。ｎチャネル型トランジスタ２７３のソース又はドレインの他方は、ダイオード２７４の入力端子に電気的に接続されている。ｎチャネル型トランジスタ２７３のゲートは、ｎチャネル型トランジスタ２６７のソース又はドレインの一方、ｎチャネル型トランジスタ２６７のゲート、ｐチャネル型トランジスタ２６６のソース又はドレインの他方に電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２０４】
ダイオード２７４の入力端子は、ｎチャネル型トランジスタ２７３のソース又はドレインの他方に電気的に接続されている。ダイオード２７４の出力端子は、ダイオード２６４の出力端子、ダイオード２６９の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２０５】
図１０に示す電源回路において、参照電圧発生回路１９５は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード２４４、ダイオード２４９、及びダイオード２５４）、及び抵抗（抵抗２４３及び抵抗２４８）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１９６は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード２６４、ダイオード２６９、及びダイオード２７４）、及び抵抗（抵抗２６３及び抵抗２６８）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１９５の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９６の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０２０６】
また参照電圧発生回路１９５及び参照電圧発生回路１９６がバンドギャップリファレンスであるため、参照電圧発生回路１９５の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９６の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０２０７】
なお、参照電圧発生回路１９５のダイオード２４４、ダイオード２４９、及びダイオード２５４、並びに参照電圧発生回路１９６のダイオード２６４、ダイオード２６９、及びダイオード２７４をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０２０８】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０２０９】
図１１に、図２〜図７に示す参照電圧発生回路１１３及び参照電圧発生回路１１４とは異なる回路構成を有する、参照電圧発生回路１９７及び参照電圧発生回路１９８の回路構成を示す。なお、図２〜図７の参照電圧発生回路１１３及び参照電圧発生回路１１４を、それぞれ参照電圧発生回路１９７及び参照電圧発生回路１９８に置き換えることが可能である。
【０２１０】
第１の参照電圧発生回路である参照電圧発生回路１９７は、端子３０１、ｐチャネル型トランジスタ３０２、抵抗３０３、端子３０４、ｐチャネル型トランジスタ３０５、ｎチャネル型トランジスタ３０６、抵抗３０７、抵抗３０８、ダイオード３０９、端子３１１、ｐチャネル型トランジスタ３１２、ｎチャネル型トランジスタ３１３、ダイオード３１４、抵抗３１５を有している。
【０２１１】
ｐチャネル型トランジスタ３０２のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０５のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０４、ｐチャネル型トランジスタ３１２のゲート、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３０２のソース又はドレインの他方は、入力信号調整回路１０２、抵抗３０３の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ３０２のゲートは、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３０５のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０４、ｐチャネル型トランジスタ３１２のゲート、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。
【０２１２】
抵抗３０３の一方の端子は、ｐチャネル型トランジスタ３０２のソース又はドレインの他方、入力信号調整回路１０２に電気的に接続されている。抵抗３０３の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２１３】
ｐチャネル型トランジスタ３０５のソース又はドレインの一方は、ｐチャネル型トランジスタ３０５のゲート、電源電圧ＶＤＤが印加される端子３０４、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３１２のゲート、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３０５のソース又はドレインの他方は、ｎチャネル型トランジスタ３０６のソース又はドレインの一方、ｎチャネル型トランジスタ３０６のゲート、ｎチャネル型トランジスタ３１３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｐチャネル型トランジスタ３０５のゲートは、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０４、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３１２のゲート、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。
【０２１４】
ｎチャネル型トランジスタ３０６のソース又はドレインの一方は、ｎチャネル型トランジスタ３０６のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの他方、ｎチャネル型トランジスタ３１３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｎチャネル型トランジスタ３０６のソース又はドレインの他方は、抵抗３０７の一方の端子、抵抗３０８の一方の端子に電気的に接続されている。ｎチャネル型トランジスタ３０６のゲートは、ｎチャネル型トランジスタ３０６のソース又はドレインの一方、ｐチャネル型トランジスタ３０５のソース又はドレインの他方、ｎチャネル型トランジスタ３１３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２１５】
抵抗３０７の一方の端子は、ｎチャネル型トランジスタ３０６のソース又はドレインの他方、抵抗３０８の一方の端子に電気的に接続されている。抵抗３０７の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２１６】
抵抗３０８の一方の端子は、ｎチャネル型トランジスタ３０６のソース又はドレインの他方、抵抗３０７の一方の端子に電気的に接続されている。抵抗３０８の他方の端子は、ダイオード３０９の入力端子に電気的に接続されている。
【０２１７】
ダイオード３０９の入力端子は、抵抗３０８の他方の端子に電気的に接続されている。ダイオード３０９の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２１８】
ｐチャネル型トランジスタ３１２のソース又はドレインの一方は、ｐチャネル型トランジスタ３１２のゲート、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３０５のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０４、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３１２のソース又はドレインの他方は、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、ｐチャネル型トランジスタ３１２のゲート、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、ｐチャネル型トランジスタ３０５のゲート、電源電圧ＶＤＤが印加される端子３０４、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３１２のゲートは、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３０５のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０４、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。
【０２１９】
ｎチャネル型トランジスタ３１３のソース又はドレインの一方は、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３０５のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０４、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｐチャネル型トランジスタ３１２のゲート、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３１１に電気的に接続されている。ｎチャネル型トランジスタ３１３のソース又はドレインの他方は、ダイオード３１４の入力端子、抵抗３１５の一方の端子に電気的に接続されている。ｎチャネル型トランジスタ３１３のゲートは、ｎチャネル型トランジスタ３０６のソース又はドレインの一方、ｎチャネル型トランジスタ３０６のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの他方に電気的に接続され、かつには、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２２０】
ダイオード３１４の入力端子は、ｎチャネル型トランジスタ３１３のソース又はドレインの他方、抵抗３１５の一方の端子に電気的に接続されている。ダイオード３１４の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２２１】
抵抗３１５の一方の端子は、ダイオード３１４の入力端子、ｎチャネル型トランジスタ３１３のソース又はドレインの他方に電気的に接続されている。抵抗３１５の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２２２】
第２の参照電圧発生回路である参照電圧発生回路１９８は、端子３２１、ｐチャネル型トランジスタ３２２、抵抗３２３、端子３２４、ｐチャネル型トランジスタ３２５、ｎチャネル型トランジスタ３２６、抵抗３２７、抵抗３２８、ダイオード３２９、端子３３１、ｐチャネル型トランジスタ３３２、ｎチャネル型トランジスタ３３３、ダイオード３３４、抵抗３３５を有している。
【０２２３】
ｐチャネル型トランジスタ３２２のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３２５のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｐチャネル型トランジスタ３３２のゲート、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３３２のソース又はドレインの他方、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３２２のソース又はドレインの他方は、入力信号調整回路１０２、抵抗３２３の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ３２２のゲートは、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３２５のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｐチャネル型トランジスタ３３２のゲート、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３３２のソース又はドレインの他方、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。
【０２２４】
抵抗３２３の一方の端子は、ｐチャネル型トランジスタ３２２のソース又はドレインの他方、入力信号調整回路１０２に電気的に接続されている。抵抗３２３の他方の端子は、抵抗３２７の他方の端子、ダイオード３２９の出力端子、ダイオード３３４の出力端子、抵抗３３５の他方の端子と電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２２５】
ｐチャネル型トランジスタ３２５のソース又はドレインの一方は、ｐチャネル型トランジスタ３２５のゲート、電源電圧ＶＤＤが印加される端子３２４、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３３２のゲート、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３３２のソース又はドレインの他方、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３２５のソース又はドレインの他方は、ｎチャネル型トランジスタ３２６のソース又はドレインの一方、ｎチャネル型トランジスタ３２６のゲート、ｎチャネル型トランジスタ３３３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｐチャネル型トランジスタ３２５のゲートは、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３３２のゲート、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３３２のソース又はドレインの他方、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。
【０２２６】
ｎチャネル型トランジスタ３２６のソース又はドレインの一方は、ｎチャネル型トランジスタ３２６のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの他方、ｎチャネル型トランジスタ３３３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｎチャネル型トランジスタ３２６のソース又はドレインの他方は、抵抗３２７の一方の端子、抵抗３２８の一方の端子に電気的に接続されている。ｎチャネル型トランジスタ３２６のゲートは、ｎチャネル型トランジスタ３２６のソース又はドレインの一方、ｐチャネル型トランジスタ３２５のソース又はドレインの他方、ｎチャネル型トランジスタ３３３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２２７】
抵抗３２７の一方の端子は、ｎチャネル型トランジスタ３２６のソース又はドレインの他方、抵抗３２８の一方の端子に電気的に接続されている。抵抗３２７の他方の端子は、抵抗３２３の他方の端子、ダイオード３２９の出力端子、ダイオード３３４の出力端子、抵抗３３５の他方の端子と電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２２８】
抵抗３２８の一方の端子は、ｎチャネル型トランジスタ３２６のソース又はドレインの他方、抵抗３２７の一方の端子に電気的に接続されている。抵抗３２８の他方の端子は、ダイオード３２９の入力端子に電気的に接続されている。
【０２２９】
ダイオード３２９の入力端子は、抵抗３２８の他方の端子に電気的に接続されている。ダイオード３２９の出力端子は、抵抗３２３の他方の端子、抵抗３２７の他方の端子、ダイオード３３４の出力端子、抵抗３３５の他方の端子と電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２３０】
ｐチャネル型トランジスタ３３２のソース又はドレインの一方は、ｐチャネル型トランジスタ３３２のゲート、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３３２のソース又はドレインの他方、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３２５のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３３２のソース又はドレインの他方は、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、ｐチャネル型トランジスタ３３２のゲート、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３２５のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３３２のゲートは、ｐチャネル型トランジスタ３３２のソース又はドレインの他方、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３２５のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。
【０２３１】
ｎチャネル型トランジスタ３３３のソース又はドレインの一方は、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３２５のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｐチャネル型トランジスタ３３２のゲート、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３３２のソース又はドレインの他方に電気的に接続されている。ｎチャネル型トランジスタ３３３のソース又はドレインの他方は、ダイオード３３４の入力端子、抵抗３３５の一方の端子に電気的に接続されている。ｎチャネル型トランジスタ３３３のゲートは、ｎチャネル型トランジスタ３２６のソース又はドレインの一方、ｎチャネル型トランジスタ３２６のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの他方に電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２３２】
ダイオード３３４の入力端子は、ｎチャネル型トランジスタ３３３のソース又はドレインの他方、抵抗３３５の一方の端子に電気的に接続されている。ダイオード３３４の出力端子は、抵抗３２３の他方の端子、抵抗３２７の他方の端子、ダイオード３２９の出力端子、抵抗３３５の他方の端子と電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２３３】
抵抗３３５の一方の端子は、ダイオード３３４の入力端子、ｎチャネル型トランジスタ３３３のソース又はドレインの他方に電気的に接続されている。抵抗３３５の他方の端子は、抵抗３２３の他方の端子、抵抗３２７の他方の端子、ダイオード３２９の出力端子、ダイオード３３４の出力端子と電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２３４】
図１１に示す電源回路において、参照電圧発生回路１９７は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード３０９及びダイオード３１４）、及び抵抗（抵抗３０３、抵抗３０７、抵抗３０８、及び抵抗３１５）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１９８は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード３２９及びダイオード３３４）、及び抵抗（抵抗３２３、抵抗３２７、抵抗３２８、及び抵抗３３５）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１９７の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９８の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０２３５】
また参照電圧発生回路１９７及び参照電圧発生回路１９８がバンドギャップリファレンスであるため、参照電圧発生回路１９７の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９８の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０２３６】
なお、参照電圧発生回路１９７のダイオード３０９及びダイオード３１４、並びに参照電圧発生回路１９８のダイオード３２９及びダイオード３３４をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０２３７】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０２３８】
以上、本実施の形態により、フィードバック電圧を検知する検知回路において、出力電流が変化せず、出力電圧が変化しない検知回路を得ることができる。
【０２３９】
また、本実施の形態では、フィードバック電圧を検知する検知回路において、動作温度により出力電圧が変化しない検知回路を得るができる。
【０２４０】
また、本実施の形態、上記の検知回路を有する電源回路を得ることができる。
【符号の説明】
【０２４１】
１０１ 制御回路
１０２ 入力信号調整回路
１０３ パルス幅変調ドライバ
１０４ 容量
１０５ 三角波発生回路
１０６ 誤差増幅回路
１０７ 抵抗
１０８ オペアンプ
１０９ 抵抗
１１１ 抵抗
１１２ 抵抗
１１３ 参照電圧発生回路
１１４ 参照電圧発生回路
１１５ 入力端子
１１９ 検知回路
１２１ 増幅回路
１２２ コイル
１２３ ダイオード
１２４ トランジスタ
１２５ 容量
１２６ 入力端子
１３１ 抵抗
１３２ 抵抗
１３３ 分圧回路
１３４ 出力端子
１４１ オペアンプ
１４２ 抵抗
１４３ 抵抗
１４４ ダイオード
１４５ 抵抗
１４６ ダイオード
１４７ ダイオード
１４８ ダイオード
１５１ オペアンプ
１５２ 抵抗
１５３ 抵抗
１５４ ダイオード
１５５ 抵抗
１５６ ダイオード
１５７ ダイオード
１５８ ダイオード
１６１ 端子
１６２ 端子
１６３ バッファ回路
１６４ オペアンプ
１７１ 増幅回路
１７２ コイル
１７３ 容量
１７４ トランジスタ
１７５ ダイオード
１７６ コイル
１７７ 容量
１８１ 増幅回路
１８２ コイル
１８３ コイル
１８４ トランス
１８５ トランジスタ
１８６ ダイオード
１８７ 容量
１９１ 参照電圧発生回路
１９２ 参照電圧発生回路
１９３ 参照電圧発生回路
１９４ 参照電圧発生回路
１９５ 参照電圧発生回路
１９６ 参照電圧発生回路
１９７ 参照電圧発生回路
１９８ 参照電圧発生回路
２０１ 端子
２０２ ｐチャネル型トランジスタ
２０３ 抵抗
２０４ オペアンプ
２０５ 抵抗
２０６ 抵抗
２０７ ダイオード
２０８ 端子
２０９ ｐチャネル型トランジスタ
２１１ 端子
２１２ ｐチャネル型トランジスタ
２１３ 抵抗
２１４ 抵抗
２１５ ダイオード
２２１ 端子
２２２ ｐチャネル型トランジスタ
２２３ 抵抗
２２４ オペアンプ
２２５ 抵抗
２２６ 抵抗
２２７ ダイオード
２２８ 端子
２２９ ｐチャネル型トランジスタ
２３１ 端子
２３２ ｐチャネル型トランジスタ
２３３ 抵抗
２３４ 抵抗
２３５ ダイオード
２４１ 端子
２４２ ｐチャネル型トランジスタ
２４３ 抵抗
２４４ ダイオード
２４５ 端子
２４６ ｐチャネル型トランジスタ
２４７ ｎチャネル型トランジスタ
２４８ 抵抗
２４９ ダイオード
２５１ 端子
２５２ ｐチャネル型トランジスタ
２５３ ｎチャネル型トランジスタ
２５４ ダイオード
２６１ 端子
２６２ ｐチャネル型トランジスタ
２６３ 抵抗
２６４ ダイオード
２６５ 端子
２６６ ｐチャネル型トランジスタ
２６７ ｎチャネル型トランジスタ
２６８ 抵抗
２６９ ダイオード
２７１ 端子
２７２ ｐチャネル型トランジスタ
２７３ ｎチャネル型トランジスタ
２７４ ダイオード
３０１ 端子
３０２ ｐチャネル型トランジスタ
３０３ 抵抗
３０４ 端子
３０５ ｐチャネル型トランジスタ
３０６ ｎチャネル型トランジスタ
３０７ 抵抗
３０８ 抵抗
３０９ ダイオード
３１１ 端子
３１２ ｐチャネル型トランジスタ
３１３ ｎチャネル型トランジスタ
３１４ ダイオード
３１５ 抵抗
３２１ 端子
３２２ ｐチャネル型トランジスタ
３２３ 抵抗
３２４ 端子
３２５ ｐチャネル型トランジスタ
３２６ ｎチャネル型トランジスタ
３２７ 抵抗
３２８ 抵抗
３２９ ダイオード
３３１ 端子
３３２ ｐチャネル型トランジスタ
３３３ ｎチャネル型トランジスタ
３３４ ダイオード
３３５ 抵抗
【技術分野】
【０００１】
開示される発明の一態様は、電源回路に関する。
【背景技術】
【０００２】
液晶装置、ＣＣＤ、デジタルカメラ等には、負電圧を入力することが必要な場合がある。このような負電圧を供給する回路として、反転型ＤＣＤＣコンバータ回路が知られている（特許文献１参照）。
【０００３】
特許文献１では、電源電圧ＶＤＤ及び接地電圧ＧＮＤ（０Ｖ）を用いて、負電圧であるフィードバック電圧ＶＦＢを生成している。
【０００４】
負電圧であるフィードバック電圧ＶＦＢは、正電圧化回路にて正電圧化される。これにより、正電圧化回路が負電圧であるフィードバック電圧ＶＦＢを検知する。
【先行技術文献】
【特許文献】
【０００５】
【特許文献１】特開２００９−３０３３１３号公報
【発明の概要】
【発明が解決しようとする課題】
【０００６】
特許文献１の電源回路において、負電圧であるフィードバック電圧を検知する正電圧化回路は、ＮチャネルＭＯＳトランジスタ及びＰチャネルＭＯＳトランジスタを用いて形成されている。
【０００７】
ＭＯＳトランジスタは、ソースに対して、ゲート、ドレイン、及びバックゲート電位により、出力電流が変化するという欠点を有する。そのため特許文献１の電源回路のように、正電圧化回路をＮチャネルＭＯＳトランジスタ及びＰチャネルＭＯＳトランジスタを用いて形成すると、ＭＯＳトランジスタの出力電流が変化し、正電圧化回路の出力電圧が変化する恐れがある。
【０００８】
またＭＯＳトランジスタは、動作温度により出力電流が変化するという欠点を有する。そのため特許文献１の電源回路のように、正電圧化回路をＮチャネルＭＯＳトランジスタ及びＰチャネルＭＯＳトランジスタを用いて形成すると、ＭＯＳトランジスタの出力電流が変化し、正電圧化回路の出力電圧が変化する恐れがある。
【０００９】
以上を鑑みて、開示される発明の一態様では、フィードバック電圧を検知する検知回路において、出力電流が変化せず、出力電圧が変化しない検知回路を得ることを課題の一とする。
【００１０】
また、開示される発明の一態様では、フィードバック電圧を検知する検知回路において、動作温度により出力電圧が変化しない検知回路を得ることを課題の一とする。
【００１１】
また、開示される発明の一態様では、上記の検知回路を有する電源回路を得ることを課題の一とする。
【課題を解決するための手段】
【００１２】
電源電圧ＶＤＤ、及び電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ（０Ｖ））との間に、出力電圧Ｖｒｅｆを出力する第１の参照電圧発生回路、及び電源電圧ＶＤＤ及びフィードバック電圧Ｖｆｂ間に、出力電圧（Ｖｒｅｆ−Ｖｆｂ）を出力する第２の参照電圧発生回路を配置する。
【００１３】
第１の参照電圧発生回路の出力電圧Ｖｒｅｆ及び第２の参照電圧発生回路の出力電圧（Ｖｒｅｆ−Ｖｆｂ）を、それぞれ入力信号調整回路に入力する。第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路によって、当該検知回路が構成される。入力信号調整回路は、第１の参照電圧発生回路からの出力電圧Ｖｒｅｆをそのまま出力する一方、第２の参照電圧発生回路からの出力電圧（Ｖｒｅｆ−Ｖｆｂ）を電圧Ｖｅｒｒ＿ｉｎに変換して出力する。
【００１４】
入力信号調整回路から出力される出力電圧Ｖｒｅｆ及び電圧Ｖｅｒｒ＿ｉｎは、誤差増幅回路に入力される。誤差増幅回路は、入力される電圧の値が等しくなるように機能する。よって、出力電圧Ｖｒｅｆと電圧Ｖｅｒｒ＿ｉｎの値が等しくなる。
【００１５】
すなわち、開示される発明の一態様では誤差増幅回路に入力される出力電圧Ｖｒｅｆと電圧Ｖｅｒｒ＿ｉｎの値が等しくなるような入力信号調整回路を提供する。
【００１６】
開示される発明の一態様において、出力電圧Ｖｒｅｆと電圧Ｖｅｒｒ＿ｉｎの値が等しくするには、第１の参照電圧発生回路からの出力電圧Ｖｒｅｆと、分圧回路からのフィードバック電圧Ｖｆｂの値が等しくする必要がある。よって開示される発明の一態様において、第１の参照電圧発生回路からの出力電圧Ｖｒｅｆと、分圧回路からのフィードバック電圧Ｖｆｂの値が等しくなるような第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を提供する。
【００１７】
以上により、開示される発明の一態様において、第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路によって構成される検知回路によって、負電圧であるフィードバック電圧Ｖｆｂを検知することができる。
【００１８】
開示される発明の一態様においては、第１の参照電圧発生回路及び第２の参照電圧発生回路は、ダイオード及び抵抗を有するバンドギャップリファレンスである。開示される発明の一態様における検知回路は、当該第１の参照電圧発生回路及び第２の参照電圧発生回路、並びに入力信号調整回路によって構成される。これにより、出力電圧電流によって出力電圧が変化せず、出力安定性がよい検知回路を得ることができる。
【００１９】
開示される発明の一態様においては、第１の参照電圧発生回路及び第２の参照電圧発生回路は、ダイオード及び抵抗を有するバンドギャップリファレンスである。開示される発明の一態様における検知回路は、当該第１の参照電圧発生回路及び第２の参照電圧発生回路、並びに入力信号調整回路によって構成される。これにより、動作温度によって出力電圧が変化せず、出力安定性がよい検知回路を得ることができる。
【００２０】
バンドギャップリファレンス（Ｂａｎｄ ｇａｐ Ｒｅｆｅｒｅｎｃｅ）は、バンドギャップを利用した基準電圧回路である。シリコンのバンドギャップエネルギーを利用したバンドギャップリファレンスは、出力電圧がほぼ１．２５Ｖとなる。
【００２１】
開示される発明の一態様において、当該ダイオードは、シリコン基板を用いたダイオード、或いは絶縁基板上に設けられたシリコン薄膜を有するダイオードを用いる。またダイオードに代えて、ダイオード接続したトランジスタを用いることも可能である。上記のダイオード及びダイオード接続したトランジスタを用いることにより、出力安定性がよい検知回路を得ることができる。
【００２２】
また開示される発明の一態様では、当該負電圧であるフィードバック電圧Ｖｆｂを検知する検知回路を有する電源回路を得ることができる。
【００２３】
開示される発明の一態様は、第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、出力電圧を出力する増幅回路と、当該増幅回路と電気的に接続され、当該検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、当該増幅回路及び当該制御回路に電気的に接続され、当該出力電圧を分圧したものをフィードバック電圧として当該第２の参照電圧発生回路に入力する分圧回路とを有し、当該第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、基準電圧回路であることを特徴とする電源回路に関する。
【００２４】
開示される発明の一態様は、第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、出力電圧を出力する増幅回路と、当該増幅回路と電気的に接続され、当該検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、当該増幅回路及び当該制御回路に電気的に接続され、当該出力電圧を分圧したものをフィードバック電圧として当該第２の参照電圧発生回路に入力する分圧回路とを有し、当該第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、ダイオード及び抵抗を含む基準電圧回路であることを特徴とする電源回路に関する。
【００２５】
開示される発明の一態様は、第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、出力電圧を出力する増幅回路と、当該増幅回路と電気的に接続され、当該検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、オペアンプ、第１の抵抗値を有する２つの抵抗、第２の抵抗値を有する２つの抵抗を有する当該入力信号調整回路と、当該増幅回路及び当該制御回路に電気的に接続され、当該出力電圧を分圧したものをフィードバック電圧として当該第２の参照電圧発生回路に入力する分圧回路とを有し、当該第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、基準電圧回路であることを特徴とする電源回路に関する。
【００２６】
開示される発明の一態様は、第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、出力電圧を出力する増幅回路と、当該増幅回路と電気的に接続され、当該検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、オペアンプ、第１の抵抗値を有する２つの抵抗、第２の抵抗値を有する２つの抵抗を有する当該入力信号調整回路と、当該増幅回路及び当該制御回路に電気的に接続され、当該出力電圧を分圧したものをフィードバック電圧として当該第２の参照電圧発生回路に入力する分圧回路とを有し、当該第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、ダイオード及び抵抗を含む基準電圧回路であることを特徴とする電源回路に関する。
【００２７】
開示される発明の一態様において、当該増幅回路は、ＤＣＤＣコンバータであることを特徴とする。
【００２８】
開示される発明の一態様において、当該増幅回路は、チュークコンバータであることを特徴とする。
【００２９】
開示される発明の一態様において、当該増幅回路は、フライバックコンバータであることを特徴とする。
【００３０】
開示される発明の一態様において、当該分圧回路と第２の参照電圧発生回路との間に、ボルテージフォロワが設けられていることを特徴とする。
【００３１】
開示される発明の一態様において、当該フィードバック電圧は、負電圧であることを特徴とする。
【発明の効果】
【００３２】
開示される発明の一態様により、フィードバック電圧を検知する検知回路において、出力電流が変化せず、出力電圧が変化しない検知回路を得ることができる。
【００３３】
また、開示される発明の一態様では、フィードバック電圧を検知する検知回路において、動作温度により出力電圧が変化しない検知回路を得ることができる。
【００３４】
また、開示される発明の一態様では、上記の検知回路を有する電源回路を得ることができる。
【図面の簡単な説明】
【００３５】
【図１】電源回路の回路図。
【図２】電源回路の回路図。
【図３】電源回路の回路図。
【図４】電源回路の回路図。
【図５】電源回路の回路図。
【図６】電源回路の回路図。
【図７】電源回路の回路図。
【図８】電源回路の一部の回路図。
【図９】電源回路の一部の回路図。
【図１０】電源回路の一部の回路図。
【図１１】電源回路の一部の回路図。
【発明を実施するための形態】
【００３６】
以下、本明細書に開示された発明の実施の態様について、図面を参照して説明する。但し、本明細書に開示された発明は多くの異なる態様で実施することが可能であり、本明細書に開示された発明の趣旨及びその範囲から逸脱することなくその形態及び詳細を様々に変更し得ることは当業者であれば容易に理解される。従って、本実施の形態の記載内容に限定して解釈されるものではない。なお、以下に示す図面において、同一部分又は同様な機能を有する部分には同一の符号を付し、その繰り返しの説明は省略する。
【００３７】
図１に、本実施の形態の電源回路を示す。図１に示す電源回路は、増幅回路１２１、増幅回路１２１に電気的に接続された分圧回路１３３、増幅回路１２１及び分圧回路１３３と電気的に接続された制御回路１０１、増幅回路１２１及び分圧回路１３３と電気的に接続された出力端子１３４を有する。なお図１の電源回路では、増幅回路１２１として昇降圧型ＤＣＤＣコンバータを用いている。
【００３８】
図１に示す増幅回路１２１は、コイル１２２、ダイオード１２３、トランジスタ１２４、及び容量１２５を有している。
【００３９】
トランジスタ１２４のソース又はドレインの一方は、電源電圧ＶＤＤが印加される入力端子１２６と電気的に接続されている。トランジスタ１２４のソース又はドレインの他方は、コイル１２２の一方の端子、及びダイオード１２３の出力端子に電気的に接続されている。トランジスタ１２４のゲートは、制御回路１０１のパルス幅変調ドライバ１０３（パルス幅変調：Ｐｕｌｓｅ Ｗｉｄｔｈ Ｍｏｄｕｌａｔｉｏｎ（ＰＷＭ））の出力端子に電気的に接続されている。
【００４０】
コイル１２２の一方の端子は、トランジスタ１２４のソース又はドレインの他方、及びダイオード１２３の出力端子と電気的に接続されている。コイル１２２の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００４１】
ダイオード１２３の出力端子は、トランジスタ１２４のソース又はドレインの他方、及びコイル１２２の一方の端子と電気的に接続されている。ダイオード１２３の入力端子は、容量１２５の一方の端子、出力電圧Ｖｏｕｔが出力される出力端子１３４、及び分圧回路１３３の抵抗１３１の一方の端子に電気的に接続されている。
【００４２】
容量１２５の一方の端子は、ダイオード１２３の入力端子、出力端子１３４、及び分圧回路１３３の抵抗１３１の一方の端子に電気的に接続されている。容量１２５の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００４３】
図１に示す制御回路１０１は、パルス幅変調ドライバ１０３、容量１０４、三角波発生回路１０５、誤差増幅回路１０６（誤差増幅回路：エラーアンプともいう）、及び検知回路１１９を有している、検知回路１１９は、入力信号調整回路１０２、及び参照電圧発生回路１１３、参照電圧発生回路１１４を有している。
【００４４】
パルス幅変調ドライバ１０３の非反転入力端子は、誤差増幅回路１０６の出力端子及び容量１０４の一方の端子に電気的に接続されている。パルス幅変調ドライバ１０３の反転入力端子は、三角波発生回路１０５に電気的に接続されている。パルス幅変調ドライバ１０３の出力端子は、増幅回路１２１のトランジスタ１２４のゲートに電気的に接続されている。
【００４５】
容量１０４の一方の端子は、パルス幅変調ドライバ１０３の非反転入力端子及び誤差増幅回路１０６の出力端子に電気的に接続されている。容量１０４の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００４６】
誤差増幅回路１０６の非反転入力端子は、参照電圧発生回路１１３の第１の端子及び入力信号調整回路１０２の抵抗１０７の一方の端子に電気的に接続されている。誤差増幅回路１０６の反転入力端子は、入力信号調整回路１０２のオペアンプ１０８の出力端子及び抵抗１０９の一方の端子に電気的に接続されている。誤差増幅回路１０６の出力端子は、パルス幅変調ドライバ１０３の非反転入力端子及び容量１０４の一方の端子に電気的に接続されている。
【００４７】
入力信号調整回路１０２は、抵抗１０７、オペアンプ１０８、抵抗１０９、抵抗１１１、及び抵抗１１２を有している。本実施の形態において、抵抗１１１及び抵抗１１２の抵抗値は等しい。また抵抗１０７及び抵抗１０９の抵抗値は等しい。抵抗１１１及び抵抗１１２の抵抗値をそれぞれ抵抗値Ｒ１とし、抵抗１０７及び抵抗１０９の抵抗値をそれぞれ抵抗値Ｒ２とする。
【００４８】
抵抗１０７の一方の端子は、誤差増幅回路１０６の非反転入力端子及び参照電圧発生回路１１３の第１の端子に電気的に接続されている。抵抗１０７の他方の端子は、オペアンプ１０８の非反転入力端子及び抵抗１１１の一方の端子に電気的に接続されている。
【００４９】
オペアンプ１０８の非反転入力端子は、抵抗１０７の他方の端子及び抵抗１１１の一方の端子に電気的に接続されている。オペアンプ１０８の反転入力端子は、抵抗１０９の他方の端子及び抵抗１１２の一方の端子に電気的に接続されている。オペアンプ１０８の出力端子は、誤差増幅回路１０６の反転入力端子及び抵抗１０９の一方の端子に電気的に接続されている。
【００５０】
抵抗１１１の一方の端子は、抵抗１０７の他方の端子及びオペアンプ１０８の非反転入力端子に電気的に接続されている。抵抗１１１の他方の端子は、参照電圧発生回路１１３の第２の端子に電気的に接続されており、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００５１】
抵抗１１２の一方の端子は、オペアンプ１０８の反転入力端子及び抵抗１０９の他方の端子に電気的に接続されている。抵抗１１２の他方の端子は、参照電圧発生回路１１４の第１の端子に電気的に接続されている。
【００５２】
第１の参照電圧発生回路である参照電圧発生回路１１３の第１の端子は、入力信号調整回路１０２の抵抗１０７の一方の端子及び誤差増幅回路１０６の非反転入力端子に電気的に接続されている。参照電圧発生回路１１３の第２の端子は、入力信号調整回路１０２の抵抗１１１の他方の端子に電気的に接続されており、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。参照電圧発生回路１１３の第３の端子は、電源電圧ＶＤＤが印加される入力端子１１５及び参照電圧発生回路１１４の第２の端子に電気的に接続されている。なお、参照電圧発生回路１１３及び参照電圧発生回路１１４の具体的な回路構成の例は、後述する。
【００５３】
第２の参照電圧発生回路である参照電圧発生回路１１４の第１の端子は、入力信号調整回路１０２の抵抗１１２の他方の端子に電気的に接続されている。参照電圧発生回路１１４の第２の端子は、参照電圧発生回路１１３の第３の端子及び入力端子１１５に電気的に接続されている。参照電圧発生回路１１４の第３の端子は、分圧回路１３３の抵抗１３１の他方の端子及び抵抗１３２の一方の端子に電気的に接続されている。また参照電圧発生回路１１４の第３の端子に、フィードバック電圧Ｖｆｂが入力される。
【００５４】
分圧回路１３３は、抵抗１３１及び抵抗１３２を有している。
【００５５】
抵抗１３１の一方の端子は、増幅回路１２１のダイオード１２３の入力端子、容量１２５の一方の端子、及び出力端子１３４に電気的に接続されている。抵抗１３１の他方の端子は、参照電圧発生回路１１４の第３の端子及び抵抗１３２の一方の端子に電気的に接続されている。
【００５６】
抵抗１３２の一方の端子は、抵抗１３１の他方の端子及び参照電圧発生回路１１４の第３の端子に電気的に接続されている。抵抗１３２の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００５７】
以下に図１に示す電源回路の動作について説明する。
【００５８】
増幅回路１２１の出力電圧Ｖｏｕｔは、分圧回路１３３の抵抗１３１及び抵抗１３２の比に応じて分圧される。分圧された出力電圧Ｖｏｕｔであるフィードバック電圧Ｖｆｂが、参照電圧発生回路１１４の第３の端子から入力される。
【００５９】
参照電圧発生回路１１３は、第３の端子から入力される電源電圧ＶＤＤに基づいて、出力電圧Ｖｒｅｆを出力する。
【００６０】
参照電圧発生回路１１４は、第２の端子から入力された電源電圧ＶＤＤ、及び第３の端子から入力されたフィードバック電圧Ｖｆｂに基づいて、出力電圧（Ｖｒｅｆ−Ｖｆｂ）を出力する。
【００６１】
ここで誤差増幅回路１０６に入力される電圧について述べる。誤差増幅回路１０６に入力される電圧は、参照電圧発生回路１１３の第１の端子から出力される出力電圧Ｖｒｅｆ、及びオペアンプ１０８の出力端子から出力される電圧Ｖｅｒｒ＿ｉｎである。電圧Ｖｅｒｒ＿ｉｎは、誤差増幅回路１０６から出力された電圧が、パルス幅変調ドライバ１０３、増幅回路１２１、分圧回路１３３、参照電圧発生回路１１４、及び入力信号調整回路１０２を介して負帰還した電圧である。
【００６２】
誤差増幅回路１０６は、入力される出力電圧Ｖｒｅｆ及び電圧Ｖｅｒｒ＿ｉｎが等しくなるように機能する。
【００６３】
また、入力信号調整回路１０２のオペアンプ１０８は、反転入力端子及び出力端子が抵抗１０９を介して接続されている。すなわちオペアンプ１０８において、出力の一部が入力側に負帰還している。オペアンプ１０８の出力の一部が入力側に負帰還しているため、オペアンプ１０８の反転入力端子及び非反転入力端子に入力される電圧は等しくなる。
【００６４】
参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、参照電圧発生回路１１４のフィードバック電圧Ｖｆｂ、抵抗１１１及び抵抗１１２の抵抗値Ｒ１、並びに、抵抗１０７及び抵抗１０９の抵抗値Ｒ２を用いると、オペアンプ１０８の非反転入力端子に入力される電圧は以下の数１となる。
【００６５】
【数１】
【００６６】
またオペアンプ１０８の反転入力端子に入力される電圧は以下の数２となる。
【数２】
【００６７】
オペアンプ１０８の反転入力端子及び非反転入力端子に入力される電圧は等しくなるので、数１及び数２は等しい。
【００６８】
【数３】
【００６９】
数３を解くと、数４が得られる。
【００７０】
【数４】
【００７１】
上述のように、誤差増幅回路１０６は、入力される出力電圧Ｖｒｅｆ及び電圧Ｖｅｒｒ＿ｉｎが等しくなるように機能する。
【００７２】
以上より、出力電圧Ｖｒｅｆとフィードバック電圧Ｖｆｂが等しいことが示される。
【００７３】
以上により、本実施の形態の電源回路において、参照電圧発生回路１１３、参照電圧発生回路１１４、及び入力信号調整回路１０２により構成される検知回路１１９により、負電圧であるフィードバック電圧Ｖｆｂを検知することができる。
【００７４】
図２に、バンドギャップリファレンスである、参照電圧発生回路１１３及び参照電圧発生回路１１４の具体的な回路構成の一例を示す。
【００７５】
図２の参照電圧発生回路１１３は、オペアンプ１４１、抵抗１４２、抵抗１４３、ダイオード１４４、抵抗１４５、ダイオード１４６を有している。
【００７６】
オペアンプ１４１の非反転入力端子は、抵抗１４５の一方の端子及びダイオード１４６の入力端子に電気的に接続されている。オペアンプ１４１の反転入力端子は、抵抗１４２の一方の端子及び抵抗１４３の一方の端子に電気的に接続されている。オペアンプ１４１の出力端子は、抵抗１４２の他方の端子及び抵抗１４５の他方の端子に電気的に接続されている。またオペアンプ１４１には、端子１６１から電源電圧ＶＤＤが入力される。
【００７７】
抵抗１４２の一方の端子は、オペアンプ１４１の反転入力端子及び抵抗１４３の一方の端子に電気的に接続されている。抵抗１４２の他方の端子は、オペアンプ１４１の出力端子及び抵抗１４５の他方の端子に電気的に接続されている。
【００７８】
抵抗１４３の一方の端子は、オペアンプ１４１の反転入力端子及び抵抗１４２の一方の端子に電気的に接続されている。抵抗１４３の他方の端子は、ダイオード１４４の入力端子に電気的に接続されている。
【００７９】
ダイオード１４４の入力端子は、抵抗１４３の他方の端子に電気的に接続されている。ダイオード１４４の出力端子は、ダイオード１４６の出力端子に電気的に接続されており、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００８０】
抵抗１４５の一方の端子は、オペアンプ１４１の非反転入力端子及びダイオード１４６の入力端子に電気的に接続されている。抵抗１４５の他方の端子は、オペアンプ１４１の出力端子及び抵抗１４２の他方の端子に電気的に接続されている。
【００８１】
ダイオード１４６の入力端子は、オペアンプ１４１の非反転入力端子及び抵抗１４５の一方の端子に電気的に接続されている。ダイオード１４６の出力端子は、ダイオード１４４の出力端子に電気的に接続されており、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【００８２】
参照電圧発生回路１１４は、オペアンプ１５１、抵抗１５２、抵抗１５３、ダイオード１５４、抵抗１５５、ダイオード１５６を有している。
【００８３】
オペアンプ１５１の非反転入力端子は、抵抗１５５の一方の端子及びダイオード１５６の入力端子に電気的に接続されている。オペアンプ１５１の反転入力端子は、抵抗１５２の一方の端子及び抵抗１５３の一方の端子に電気的に接続されている。オペアンプ１５１の出力端子は、抵抗１５２の他方の端子及び抵抗１５５の他方の端子に電気的に接続されている。またオペアンプ１５１には、端子１６２から電源電圧ＶＤＤが入力される。
【００８４】
抵抗１５２の一方の端子は、オペアンプ１５１の反転入力端子及び抵抗１５３の一方の端子に電気的に接続されている。抵抗１５２の他方の端子は、オペアンプ１５１の出力端子及び抵抗１５５の他方の端子に電気的に接続されている。
【００８５】
抵抗１５３の一方の端子は、オペアンプ１５１の反転入力端子及び抵抗１５２の一方の端子に電気的に接続されている。抵抗１５３の他方の端子は、ダイオード１５４の入力端子に電気的に接続されている。
【００８６】
ダイオード１５４の入力端子は、抵抗１５３の他方の端子に電気的に接続されている。ダイオード１５４の出力端子は、ダイオード１５６の出力端子、分圧回路１３３の抵抗１３１の他方の端子、及び抵抗１３２の一方の端子に電気的に接続されている。
【００８７】
抵抗１５５の一方の端子は、オペアンプ１５１の非反転入力端子及びダイオード１５６の入力端子に電気的に接続されている。抵抗１５５の他方の端子は、オペアンプ１５１の出力端子及び抵抗１５２の他方の端子に電気的に接続されている。
【００８８】
ダイオード１５６の入力端子は、オペアンプ１５１の非反転入力端子及び抵抗１５５の一方の端子に電気的に接続されている。ダイオード１５６の出力端子は、ダイオード１５４の出力端子、分圧回路１３３の抵抗１３１の他方の端子、及び抵抗１３２の一方の端子に電気的に接続されている。
【００８９】
参照電圧発生回路１１３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４及びダイオード１４６）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１１４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４及びダイオード１５６）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【００９０】
また参照電圧発生回路１１３及び参照電圧発生回路１１４がバンドギャップリファレンスであるため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【００９１】
なお、参照電圧発生回路１１３のダイオード１４４及びダイオード１４６、並びに参照電圧発生回路１１４のダイオード１５４及びダイオード１５６をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【００９２】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【００９３】
図３に示す電源回路は、図２に示す電源回路において、フィードバック電圧Ｖｆｂの入力部にバッファ回路１６３を配置した電源回路である。図３のバッファ回路１６３は、オペアンプ１６４を用いたボルテージフォロワである。
【００９４】
ボルテージフォロワは、高入力インピーダンス、低出力インピーダンスであり、入出力の電圧が同じという特徴を有している。そのためボルテージフォロワを配置すると、ボルテージフォロワの前段と後段の干渉を低減することができる。そのため、ボルテージフォロワであるバッファ回路１６３の前段である分圧回路１３３の内部抵抗と後段である参照電圧発生回路１１４の入力抵抗を無視することができる。これにより、電源回路の安定化を図ることができる。
【００９５】
オペアンプ１６４の非反転入力端子は、分圧回路１３３の抵抗１３１の他方の端子及び抵抗１３２の一方の端子に電気的に接続されている。オペアンプ１６４の反転入力端子は、オペアンプ１６４の出力端子、参照電圧発生回路１１４のダイオード１５４の出力端子、及びダイオード１５６の出力端子に電気的に接続されている。オペアンプ１６４の出力端子は、オペアンプ１６４の反転入力端子、参照電圧発生回路１１４のダイオード１５４の出力端子、及びダイオード１５６の出力端子に電気的に接続されている。
【００９６】
図３に示す電源回路では、図２に示す電源回路と同様に、参照電圧発生回路１１３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４及びダイオード１４６）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１１４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４及びダイオード１５６）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【００９７】
また参照電圧発生回路１１３及び参照電圧発生回路１１４がバンドギャップリファレンスであるため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【００９８】
なお、参照電圧発生回路１１３のダイオード１４４及びダイオード１４６、並びに参照電圧発生回路１１４のダイオード１５４及びダイオード１５６をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【００９９】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１００】
図４に示す電源回路は、図２に示す電源回路において増幅回路１２１を増幅回路１７１に代えた電源回路である。図４に示す増幅回路１７１は、チュークコンバータ（ＣｕＫコンバータともいう）である。なお図４において、図２と同じものは同じ符号で示している。
【０１０１】
増幅回路１７１は、コイル１７２、容量１７３、トランジスタ１７４、ダイオード１７５、コイル１７６、容量１７７を有している。
【０１０２】
コイル１７２の一方の端子は、電源電圧ＶＤＤが印加される入力端子１２６に電気的に接続されている。コイル１７２の他方の端子は、トランジスタ１７４のソース又はドレインの一方及び容量１７３の一方の端子に電気的に接続されている。
【０１０３】
容量１７３の一方の端子は、コイル１７２の他方の端子及びトランジスタ１７４のソース又はドレインの一方に電気的に接続されている。容量１７３の他方の端子は、ダイオード１７５の入力端子及びコイル１７６の一方の端子に電気的に接続されている。
【０１０４】
トランジスタ１７４のソース又はドレインの一方は、コイル１７２の他方の端子及び容量１７３の一方の端子に電気的に接続されている。トランジスタ１７４のソース又はドレインの他方には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。トランジスタ１７４のゲートは、パルス幅変調ドライバ１０３の出力端子に電気的に接続されている。
【０１０５】
ダイオード１７５の入力端子は、容量１７３の他方の端子及びコイル１７６の一方の端子に電気的に接続されている。ダイオード１７５の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１０６】
コイル１７６の一方の端子は、容量１７３の他方の端子及びダイオード１７５の入力端子に電気的に接続されている。コイル１７６の他方の端子は、容量１７７の一方の端子、出力電圧Ｖｏｕｔが出力される出力端子１３４、及び分圧回路１３３の抵抗１３１の一方の端子に電気的に接続されている。
【０１０７】
容量１７７の一方の端子は、コイル１７６の他方の端子、出力端子１３４、及び分圧回路１３３の抵抗１３１の一方の端子に電気的に接続されている。容量１７７の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１０８】
図４に示す電源回路では、図２に示す電源回路と同様に、参照電圧発生回路１１３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４及びダイオード１４６）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１１４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４及びダイオード１５６）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０１０９】
また参照電圧発生回路１１３及び参照電圧発生回路１１４がバンドギャップリファレンスであるため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０１１０】
なお、参照電圧発生回路１１３のダイオード１４４及びダイオード１４６、並びに参照電圧発生回路１１４のダイオード１５４及びダイオード１５６をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０１１１】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１１２】
図５に示す電源回路は、図４に示す電源回路において、フィードバック電圧Ｖｆｂの入力部にバッファ回路１６３を配置した電源回路である。図５のバッファ回路１６３は、オペアンプ１６４を用いたボルテージフォロワである。
【０１１３】
ボルテージフォロワは、高入力インピーダンス、低出力インピーダンスであり、入出力の電圧が同じという特徴を有している。そのためボルテージフォロワを配置すると、ボルテージフォロワの前段と後段の干渉を低減することができる。そのため、ボルテージフォロワであるバッファ回路１６３の前段である分圧回路１３３の内部抵抗と後段である参照電圧発生回路１１４の入力抵抗を無視することができる。これにより、電源回路の安定化を図ることができる。
【０１１４】
オペアンプ１６４の非反転入力端子は、分圧回路１３３の抵抗１３１の他方の端子及び抵抗１３２の一方の端子に電気的に接続されている。オペアンプ１６４の反転入力端子は、オペアンプ１６４の出力端子、参照電圧発生回路１１４のダイオード１５４の出力端子、及びダイオード１５６の出力端子に電気的に接続されている。オペアンプ１６４の出力端子は、オペアンプ１６４の反転入力端子、参照電圧発生回路１１４のダイオード１５４の出力端子、及びダイオード１５６の出力端子に電気的に接続されている。
【０１１５】
図５に示す電源回路では、図２に示す電源回路と同様に、参照電圧発生回路１１３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４及びダイオード１４６）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１１４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４及びダイオード１５６）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０１１６】
また参照電圧発生回路１１３及び参照電圧発生回路１１４がバンドギャップリファレンスであるため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０１１７】
なお、参照電圧発生回路１１３のダイオード１４４及びダイオード１４６、並びに参照電圧発生回路１１４のダイオード１５４及びダイオード１５６をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０１１８】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１１９】
図６に示す電源回路は、図２に示す電源回路において増幅回路１２１を増幅回路１８１に代えた電源回路である。図６に示す増幅回路１８１は、フライバックコンバータである。なお図６において、図２と同じものは同じ符号で示している。
【０１２０】
増幅回路１８１は、コイル１８２及びコイル１８３を有するトランス１８４、トランジスタ１８５、ダイオード１８６、容量１８７を有している。
【０１２１】
コイル１８２の一方の端子は、電源電圧ＶＤＤが印加される入力端子１２６に電気的に接続されている。コイル１８２の他方の端子は、トランジスタ１８５のソース又はドレインの一方に接続されている。
【０１２２】
コイル１８３の一方の端子は、容量１８７の一方の端子、出力電圧Ｖｏｕｔが出力される出力端子１３４、及び、分圧回路１３３の抵抗１３１の一方の端子に電気的に接続されている。コイル１８３の他方の端子は、ダイオード１８６の入力端子に電気的に接続されている。
【０１２３】
トランジスタ１８５のソース又はドレインの一方は、コイル１８２の他方の端子に電気的に接続されている。トランジスタ１８５のソース又はドレインの他方には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。トランジスタ１８５のゲートは、パルス幅変調ドライバ１０３の出力端子に電気的に接続されている。
【０１２４】
ダイオード１８６の入力端子は、コイル１８３の他方の端子に電気的に接続されている。ダイオード１８６の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１２５】
容量１８７の一方の端子は、コイル１８３の一方の端子、出力端子１３４、及び、分圧回路１３３の抵抗１３１の一方の端子に電気的に接続されている。容量１８７の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１２６】
図６に示す電源回路では、図２に示す電源回路と同様に、参照電圧発生回路１１３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４及びダイオード１４６）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１１４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４及びダイオード１５６）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０１２７】
また参照電圧発生回路１１３及び参照電圧発生回路１１４がバンドギャップリファレンスであるため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０１２８】
なお、参照電圧発生回路１１３のダイオード１４４及びダイオード１４６、並びに参照電圧発生回路１１４のダイオード１５４及びダイオード１５６をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０１２９】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１３０】
図７に示す電源回路は、図６に示す電源回路において、フィードバック電圧Ｖｆｂの入力部にバッファ回路１６３を配置した電源回路である。図７のバッファ回路１６３は、オペアンプ１６４を用いたボルテージフォロワである。
【０１３１】
ボルテージフォロワは、高入力インピーダンス、低出力インピーダンスであり、入出力の電圧が同じという特徴を有している。そのためボルテージフォロワを配置すると、ボルテージフォロワの前段と後段の干渉を低減することができる。そのため、ボルテージフォロワであるバッファ回路１６３の前段である分圧回路１３３の内部抵抗と後段である参照電圧発生回路１１４の入力抵抗を無視することができる。これにより、電源回路の安定化を図ることができる。
【０１３２】
オペアンプ１６４の非反転入力端子は、分圧回路１３３の抵抗１３１の他方の端子及び抵抗１３２の一方の端子に電気的に接続されている。オペアンプ１６４の反転入力端子は、オペアンプ１６４の出力端子、参照電圧発生回路１１４のダイオード１５４の出力端子、及びダイオード１５６の出力端子に電気的に接続されている。オペアンプ１６４の出力端子は、オペアンプ１６４の反転入力端子、参照電圧発生回路１１４のダイオード１５４の出力端子、及びダイオード１５６の出力端子に電気的に接続されている。
【０１３３】
図７に示す電源回路では、図２に示す電源回路と同様に、参照電圧発生回路１１３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４及びダイオード１４６）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１１４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４及びダイオード１５６）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０１３４】
また参照電圧発生回路１１３及び参照電圧発生回路１１４がバンドギャップリファレンスであるため、参照電圧発生回路１１３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１１４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０１３５】
なお、参照電圧発生回路１１３のダイオード１４４及びダイオード１４６、並びに参照電圧発生回路１１４のダイオード１５４及びダイオード１５６をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０１３６】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１３７】
図８に、図２〜図７に示す参照電圧発生回路１１３及び参照電圧発生回路１１４とは異なる回路構成を有する、参照電圧発生回路１９１及び参照電圧発生回路１９２の回路構成を示す。なお、図２〜図７の参照電圧発生回路１１３及び参照電圧発生回路１１４を、それぞれ参照電圧発生回路１９１及び参照電圧発生回路１９２に置き換えることが可能である。
【０１３８】
第１の参照電圧発生回路である参照電圧発生回路１９１は、オペアンプ１４１、抵抗１４２、抵抗１４３、ダイオード１４４、抵抗１４５、ダイオード１４６、ダイオード１４７、ダイオード１４８を有している。オペアンプ１４１、抵抗１４２、抵抗１４３、ダイオード１４４、抵抗１４５の接続については、図２と同様のため、図２の説明を援用する。
【０１３９】
ダイオード１４４の入力端子は、抵抗１４３の他方の端子に電気的に接続されている。ダイオード１４４の出力端子は、ダイオード１４７の入力端子に電気的に接続されている。
【０１４０】
ダイオード１４６の入力端子は、オペアンプ１４１の非反転入力端子及び抵抗１４５の一方の端子に電気的に接続されている。ダイオード１４６の出力端子は、ダイオード１４８の入力端子に電気的に接続されている。
【０１４１】
ダイオード１４７の入力端子は、ダイオード１４４の出力端子に電気的に接続されている。ダイオード１４７の出力端子は、ダイオード１４８の出力端子に電気的に接続されており、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１４２】
ダイオード１４８の入力端子は、ダイオードの１４６の出力端子に電気的に接続されている。ダイオード１４８の出力端子は、ダイオード１４７の出力端子に電気的に接続されており、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１４３】
第２の参照電圧発生回路である参照電圧発生回路１９２は、オペアンプ１５１、抵抗１５２、抵抗１５３、ダイオード１５４、抵抗１５５、ダイオード１５６、ダイオード１５７、ダイオード１５８を有している。オペアンプ１５１、抵抗１５２、抵抗１５３、ダイオード１５４、抵抗１５５の接続については、図２と同様のため、図２の説明を援用する。
【０１４４】
ダイオード１５４の入力端子は、抵抗１５３の他方の端子に電気的に接続されている。ダイオード１５４の出力端子は、ダイオード１５７の入力端子に電気的に接続されている。
【０１４５】
ダイオード１５６の入力端子は、オペアンプ１５１の非反転入力端子及び抵抗１５５の一方の端子に電気的に接続されている。ダイオード１５６の出力端子は、ダイオード１５８の入力端子に電気的に接続されている。
【０１４６】
ダイオード１５７の入力端子は、ダイオード１５４の出力端子に電気的に接続されている。ダイオード１５７の出力端子は、ダイオード１５８の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１４７】
ダイオード１５８の入力端子は、ダイオードの１５６の出力端子に電気的に接続されている。ダイオード１５８の出力端子は、ダイオード１５７の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１４８】
図８に示すように、参照電圧発生回路１９１では、ダイオード１４４及びダイオード１４７、並びにダイオード１４６及び１４８を直列に接続している。ダイオードを２つ直列にした場合は、出力電圧はバンドギャップ電圧（図２に示す参照電圧発生回路１１３の出力電圧）の２倍となる。また参照電圧発生回路１９２においても同様の原理で、出力電圧が図２に示す参照電圧発生回路１１４の出力電圧の２倍となる。
【０１４９】
図８に示す電源回路において、参照電圧発生回路１９１は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１４４、ダイオード１４６、ダイオード１４７、及びダイオード１４８）、及び抵抗（抵抗１４３）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１９２は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード１５４、ダイオード１５６、ダイオード１５７、及びダイオード１５８）、及び抵抗（抵抗１５３）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１９１の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９２の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０１５０】
また参照電圧発生回路１９１及び参照電圧発生回路１９２がバンドギャップリファレンスであるため、参照電圧発生回路１９１の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９２の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０１５１】
なお、参照電圧発生回路１９１のダイオード１４４、ダイオード１４６、ダイオード１４７、及びダイオード１４８、並びに参照電圧発生回路１９２のダイオード１５４、ダイオード１５６、ダイオード１５７、及びダイオード１５８をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０１５２】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１５３】
図９に、図２〜図７に示す参照電圧発生回路１１３及び参照電圧発生回路１１４とは異なる回路構成を有する、参照電圧発生回路１９３及び参照電圧発生回路１９４の回路構成を示す。なお、図２〜図７の参照電圧発生回路１１３及び参照電圧発生回路１１４を、それぞれ参照電圧発生回路１９３及び参照電圧発生回路１９４に置き換えることが可能である。
【０１５４】
第１の参照電圧発生回路である参照電圧発生回路１９３は、端子２０１、ｐチャネル型トランジスタ２０２、抵抗２０３、オペアンプ２０４、端子２０８、ｐチャネル型トランジスタ２０９、抵抗２０５、抵抗２０６、ダイオード２０７、端子２１１、ｐチャネル型トランジスタ２１２、抵抗２１３、抵抗２１４、ダイオード２１５を有している。
【０１５５】
ｐチャネル型トランジスタ２０２のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２０１、ｐチャネル型トランジスタ２０２のゲート、オペアンプ２０４の出力端子、ｐチャネル型トランジスタ２０９のゲート、ｐチャネル型トランジスタ２０９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０８、ｐチャネル型トランジスタ２１２のゲート、ｐチャネル型トランジスタ２１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２１１に電気的に接続されている。ｐチャネル型トランジスタ２０２のソース又はドレインの他方は、入力信号調整回路１０２、抵抗２０３の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２０２のゲートは、ｐチャネル型トランジスタ２０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０１、オペアンプ２０４の出力端子、ｐチャネル型トランジスタ２０９のゲート、ｐチャネル型トランジスタ２０９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０８、ｐチャネル型トランジスタ２１２のゲート、ｐチャネル型トランジスタ２１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２１１に電気的に接続されている。
【０１５６】
抵抗２０３の一方の端子は、ｐチャネル型トランジスタ２０２のソース又はドレインの他方、入力信号調整回路１０２に電気的に接続されている。抵抗２０３の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１５７】
オペアンプ２０４の非反転入力端子は、ｐチャネル型トランジスタ２１２のソース又はドレインの他方、抵抗２１３の一方の端子、抵抗２１４の一方の端子に電気的に接続されている。オペアンプ２０４の反転入力端子は、ｐチャネル型トランジスタ２０９のソース又はドレインの他方、抵抗２０５の一方の端子、抵抗２０６の一方の端子に電気的に接続されている。オペアンプ２０４の出力端子は、ｐチャネル型トランジスタ２０２のゲート、ｐチャネル型トランジスタ２０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０１、ｐチャネル型トランジスタ２０９のゲート、ｐチャネル型トランジスタ２０９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０８、ｐチャネル型トランジスタ２１２のゲート、ｐチャネル型トランジスタ２１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２１１に電気的に接続されている。
【０１５８】
ｐチャネル型トランジスタ２０９のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２０８、ｐチャネル型トランジスタ２０９のゲート、ｐチャネル型トランジスタ２０２のゲート、ｐチャネル型トランジスタ２０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０１、オペアンプ２０４の出力端子、ｐチャネル型トランジスタ２１２のゲート、ｐチャネル型トランジスタ２１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２１１に電気的に接続されている。ｐチャネル型トランジスタ２０９のソース又はドレインの他方は、オペアンプ２０４の反転入力端子、抵抗２０５の一方の端子、抵抗２０６の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２０９のゲートは、ｐチャネル型トランジスタ２０９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０８、ｐチャネル型トランジスタ２０２のゲート、ｐチャネル型トランジスタ２０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０１、オペアンプ２０４の出力端子、ｐチャネル型トランジスタ２１２のゲート、ｐチャネル型トランジスタ２１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２１１に電気的に接続されている。
【０１５９】
抵抗２０５の一方の端子は、オペアンプ２０４の反転入力端子、ｐチャネル型トランジスタ２０９のソース又はドレインの他方、抵抗２０６の一方の端子に電気的に接続されている。抵抗２０５の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１６０】
抵抗２０６の一方の端子は、ｐチャネル型トランジスタ２０９のソース又はドレインの他方、オペアンプ２０４の反転入力端子、抵抗２０５の一方の端子に電気的に接続されている。抵抗２０６の他方の端子は、ダイオード２０７の入力端子に電気的に接続されている。
【０１６１】
ダイオード２０７の入力端子は、抵抗２０６の他方の端子に電気的に接続されている。ダイオード２０７の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１６２】
ｐチャネル型トランジスタ２１２のソース又はドレインの一方は、ｐチャネル型トランジスタ２１２のゲート、電源電圧ＶＤＤが印加される端子２１１、ｐチャネル型トランジスタ２０２のゲート、ｐチャネル型トランジスタ２０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０１、オペアンプ２０４の出力端子、ｐチャネル型トランジスタ２０９のゲート、ｐチャネル型トランジスタ２０９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０８に電気的に接続されている。ｐチャネル型トランジスタ２１２のソース又はドレインの他方は、オペアンプ２０４の非反転入力端子、抵抗２１３の一方の端子、抵抗２１４の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２１２のゲートは、ｐチャネル型トランジスタ２１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２１１、ｐチャネル型トランジスタ２０２のゲート、ｐチャネル型トランジスタ２０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０１、オペアンプ２０４の出力端子、ｐチャネル型トランジスタ２０９のゲート、ｐチャネル型トランジスタ２０９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２０８に電気的に接続されている。
【０１６３】
抵抗２１３の一方の端子は、ｐチャネル型トランジスタ２１２のソース又はドレインの他方、オペアンプ２０４の非反転入力端子、抵抗２１４の一方の端子に電気的に接続されている。抵抗２１３の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１６４】
抵抗２１４の一方の端子は、ｐチャネル型トランジスタ２１２のソース又はドレインの他方、オペアンプ２０４の非反転入力端子、抵抗２１３の一方の端子に電気的に接続されている。抵抗２１４の他方の端子は、ダイオード２１５の入力端子に電気的に接続されている。
【０１６５】
ダイオード２１５の入力端子は、抵抗２１４の他方の端子に電気的に接続されている。ダイオード２１５の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１６６】
第２の参照電圧発生回路である参照電圧発生回路１９４は、端子２２１、ｐチャネル型トランジスタ２２２、抵抗２２３、オペアンプ２２４、端子２２８、ｐチャネル型トランジスタ２２９、抵抗２２５、抵抗２２６、ダイオード２２７、端子２３１、ｐチャネル型トランジスタ２３２、抵抗２３３、抵抗２３４、ダイオード２３５を有している。
【０１６７】
ｐチャネル型トランジスタ２２２のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２２１、ｐチャネル型トランジスタ２２２のゲート、オペアンプ２２４の出力端子、ｐチャネル型トランジスタ２２９のゲート、ｐチャネル型トランジスタ２２９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２８、ｐチャネル型トランジスタ２３２のゲート、ｐチャネル型トランジスタ２３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２３１に電気的に接続されている。ｐチャネル型トランジスタ２２２のソース又はドレインの他方は、入力信号調整回路１０２、抵抗２２３の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２２２のゲートは、ｐチャネル型トランジスタ２２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２１、オペアンプ２２４の出力端子、ｐチャネル型トランジスタ２２９のゲート、ｐチャネル型トランジスタ２２９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２８、ｐチャネル型トランジスタ２３２のゲート、ｐチャネル型トランジスタ２３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２３１に電気的に接続されている。
【０１６８】
抵抗２２３の一方の端子は、ｐチャネル型トランジスタ２２２のソース又はドレインの他方、入力信号調整回路１０２に電気的に接続されている。抵抗２２３の他方の端子は、抵抗２２５の他方の端子、ダイオード２２７の出力端子、抵抗２３３の他方の端子、ダイオード２３５の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１６９】
オペアンプ２２４の非反転入力端子は、ｐチャネル型トランジスタ２３２のソース又はドレインの他方、抵抗２３３の一方の端子、抵抗２３４の一方の端子に電気的に接続されている。オペアンプ２２４の反転入力端子は、ｐチャネル型トランジスタ２２９のソース又はドレインの他方、抵抗２２５の一方の端子、抵抗２２６の一方の端子に電気的に接続されている。オペアンプ２２４の出力端子は、ｐチャネル型トランジスタ２２２のゲート、ｐチャネル型トランジスタ２２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２１、ｐチャネル型トランジスタ２２９のゲート、ｐチャネル型トランジスタ２２９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２８、ｐチャネル型トランジスタ２３２のゲート、ｐチャネル型トランジスタ２３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２３１に電気的に接続されている。
【０１７０】
ｐチャネル型トランジスタ２２９のソース又はドレインの一方は、ｐチャネル型トランジスタ２２９のゲート、電源電圧ＶＤＤが印加される端子２２８、ｐチャネル型トランジスタ２２２のゲート、ｐチャネル型トランジスタ２２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２１、オペアンプ２２４の出力端子、ｐチャネル型トランジスタ２３２のゲート、ｐチャネル型トランジスタ２３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２３１に電気的に接続されている。ｐチャネル型トランジスタ２２９のソース又はドレインの他方は、オペアンプ２２４の反転入力端子、抵抗２２５の一方の端子、抵抗２２６の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２２９のゲートは、ｐチャネル型トランジスタ２２９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２８、ｐチャネル型トランジスタ２２２のゲート、ｐチャネル型トランジスタ２２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２１、オペアンプ２２４の出力端子、ｐチャネル型トランジスタ２３２のゲート、ｐチャネル型トランジスタ２３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２３１に電気的に接続されている。
【０１７１】
抵抗２２５の一方の端子は、オペアンプ２２４の反転入力端子、ｐチャネル型トランジスタ２２９のソース又はドレインの他方、抵抗２２６の一方の端子に電気的に接続されている。抵抗２２５の他方の端子は、抵抗２２３の他方の端子、ダイオード２２７の出力端子、抵抗２３３の他方の端子、ダイオード２３５の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１７２】
抵抗２２６の一方の端子は、ｐチャネル型トランジスタ２２９のソース又はドレインの他方、オペアンプ２２４の反転入力端子、抵抗２２５の一方の端子に電気的に接続されている。抵抗２２６の他方の端子は、ダイオード２２７の入力端子に電気的に接続されている。
【０１７３】
ダイオード２２７の入力端子は、抵抗２２６の他方の端子に電気的に接続されている。ダイオード２２７の出力端子は、抵抗２２３の他方の端子、抵抗２２５の他方の端子、抵抗２３３の他方の端子、ダイオード２３５の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１７４】
ｐチャネル型トランジスタ２３２のソース又はドレインの一方は、ｐチャネル型トランジスタ２３２のゲート、電源電圧ＶＤＤが印加される端子２３１、ｐチャネル型トランジスタ２２２のゲート、ｐチャネル型トランジスタ２２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２１、オペアンプ２２４の出力端子、ｐチャネル型トランジスタ２２９のゲート、ｐチャネル型トランジスタ２２９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２８に電気的に接続されている。ｐチャネル型トランジスタ２３２のソース又はドレインの他方は、オペアンプ２２４の非反転入力端子、抵抗２３３の一方の端子、抵抗２３４の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２３２のゲートは、ｐチャネル型トランジスタ２３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２３１、ｐチャネル型トランジスタ２２２のゲート、ｐチャネル型トランジスタ２２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２１、オペアンプ２２４の出力端子、ｐチャネル型トランジスタ２２９のゲート、ｐチャネル型トランジスタ２２９のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２２８に電気的に接続されている。
【０１７５】
抵抗２３３の一方の端子は、ｐチャネル型トランジスタ２３２のソース又はドレインの他方、オペアンプ２２４の非反転入力端子、抵抗２３４の一方の端子に電気的に接続されている。抵抗２３３の他方の端子は、抵抗２２３の他方の端子、抵抗２２５の他方の端子、ダイオード２２７の出力端子、ダイオード２３５の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１７６】
抵抗２３４の一方の端子は、ｐチャネル型トランジスタ２３２のソース又はドレインの他方、オペアンプ２２４の非反転入力端子、抵抗２３３の一方の端子に電気的に接続されている。抵抗２３４の他方の端子は、ダイオード２３５の入力端子に電気的に接続されている。
【０１７７】
ダイオード２３５の入力端子は、抵抗２３４の他方の端子に電気的に接続されている。ダイオード２３５の出力端子は、抵抗２２３の他方の端子、抵抗２２５の他方の端子、ダイオード２２７の出力端子、抵抗２３３の他方の端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１７８】
図９に示す電源回路において、参照電圧発生回路１９３は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード２０７及びダイオード２１５）、及び抵抗（抵抗２０３、抵抗２０５、抵抗２０６、抵抗２１３、抵抗２１４）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１９４は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード２２７及びダイオード２３５）、及び抵抗（抵抗２２３、抵抗２２５、抵抗２２６、抵抗２３３、抵抗２３４）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１９３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０１７９】
また参照電圧発生回路１９３及び参照電圧発生回路１９４がバンドギャップリファレンスであるため、参照電圧発生回路１９３の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９４の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０１８０】
なお、参照電圧発生回路１９３のダイオード２０７及びダイオード２１５、並びに参照電圧発生回路１９４のダイオード２２７及びダイオード２３５をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０１８１】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０１８２】
図１０に、図２〜図７に示す参照電圧発生回路１１３及び参照電圧発生回路１１４とは異なる回路構成を有する、参照電圧発生回路１９５及び参照電圧発生回路１９６の回路構成を示す。なお、図２〜図７の参照電圧発生回路１１３及び参照電圧発生回路１１４を、それぞれ参照電圧発生回路１９５及び参照電圧発生回路１９６に置き換えることが可能である。
【０１８３】
第１の参照電圧発生回路である参照電圧発生回路１９５は、端子２４１、ｐチャネル型トランジスタ２４２、抵抗２４３、ダイオード２４４、端子２４５、ｐチャネル型トランジスタ２４６、ｎチャネル型トランジスタ２４７、抵抗２４８、ダイオード２４９、端子２５１、ｐチャネル型トランジスタ２５２、ｎチャネル型トランジスタ２５３、ダイオード２５４を有している。
【０１８４】
ｐチャネル型トランジスタ２４２のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２４２のゲート、ｐチャネル型トランジスタ２４６のゲート、ｐチャネル型トランジスタ２４６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２５２のゲート、ｐチャネル型トランジスタ２５２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２５２のソース又はドレインの他方、ｎチャネル型トランジスタ２５３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ２４２のソース又はドレインの他方は、入力信号調整回路１０２、抵抗２４３の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２４２のゲートは、ｐチャネル型トランジスタ２４２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２４６のゲート、ｐチャネル型トランジスタ２４６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２５２のゲート、ｐチャネル型トランジスタ２５２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２５２のソース又はドレインの他方、ｎチャネル型トランジスタ２５３のソース又はドレインの一方に電気的に接続されている。
【０１８５】
抵抗２４３の一方の端子は、ｐチャネル型トランジスタ２４２のソース又はドレインの他方、入力信号調整回路１０２に電気的に接続されている。抵抗２４３の他方の端子は、ダイオード２４４の入力端子に電気的に接続されている。
【０１８６】
ダイオード２４４の入力端子は、抵抗２４３の他方の端子に電気的に接続されている。ダイオード２４４の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１８７】
ｐチャネル型トランジスタ２４６のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２４６のゲート、ｐチャネル型トランジスタ２４２のゲート、ｐチャネル型トランジスタ２４２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２５２のゲート、ｐチャネル型トランジスタ２５２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２５２のソース又はドレインの他方、ｎチャネル型トランジスタ２５３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ２４６のソース又はドレインの他方は、ｎチャネル型トランジスタ２４７のソース又はドレインの一方、ｎチャネル型トランジスタ２４７のゲート、ｎチャネル型トランジスタ２５３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｐチャネル型トランジスタ２４６のゲートは、ｐチャネル型トランジスタ２４６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２４２のゲート、ｐチャネル型トランジスタ２４２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２５２のゲート、ｐチャネル型トランジスタ２５２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２５２のソース又はドレインの他方、ｎチャネル型トランジスタ２５３のソース又はドレインの一方に電気的に接続されている。
【０１８８】
ｎチャネル型トランジスタ２４７のソース又はドレインの一方は、ｎチャネル型トランジスタ２４７のゲート、ｐチャネル型トランジスタ２４６のソース又はドレインの他方、ｎチャネル型トランジスタ２５３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｎチャネル型トランジスタ２４７のソース又はドレインの他方は、抵抗２４８の一方の端子に電気的に接続されている。ｎチャネル型トランジスタ２４７のゲートは、ｎチャネル型トランジスタ２４７のソース又はドレインの一方、ｐチャネル型トランジスタ２４６のソース又はドレインの他方、ｎチャネル型トランジスタ２５３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１８９】
抵抗２４８の一方の端子は、ｎチャネル型トランジスタ２４７のソース又はドレインの他方に電気的に接続されている。抵抗２４８の他方の端子は、ダイオード２４９の入力端子に電気的に接続されている。
【０１９０】
ダイオード２４９の入力端子は、抵抗２４８の他方の端子に電気的に接続されている。ダイオード２４９の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１９１】
ｐチャネル型トランジスタ２５２のソース又はドレインの一方は、ｐチャネル型トランジスタ２５２のゲート、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２５２のソース又はドレインの他方、ｐチャネル型トランジスタ２４２のゲート、ｐチャネル型トランジスタ２４２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２４６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２４６のゲート、ｎチャネル型トランジスタ２５３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ２５２のソース又はドレインの他方は、ｐチャネル型トランジスタ２５２のソース又はドレインの一方、ｐチャネル型トランジスタ２５２のゲート、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２４２のゲート、ｐチャネル型トランジスタ２４２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２４６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２４６のゲート、ｎチャネル型トランジスタ２５３のソース又はドレインの一方に電気的に接続されている。
【０１９２】
ｎチャネル型トランジスタ２５３のソース又はドレインの一方は、ｐチャネル型トランジスタ２４２のゲート、ｐチャネル型トランジスタ２４２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４１、ｐチャネル型トランジスタ２４６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２４５、ｐチャネル型トランジスタ２４６のゲート、ｐチャネル型トランジスタ２５２のゲート、ｐチャネル型トランジスタ２５２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２５１、ｐチャネル型トランジスタ２５２のソース又はドレインの他方に電気的に接続されている。ｎチャネル型トランジスタ２５３のソース又はドレインの他方は、ダイオード２５４の入力端子に電気的に接続されている。ｎチャネル型トランジスタ２５３のゲートは、ｎチャネル型トランジスタ２４７のソース又はドレインの一方、ｎチャネル型トランジスタ２４７のゲート、ｐチャネル型トランジスタ２４６のソース又はドレインの他方に電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１９３】
ダイオード２５４の入力端子は、ｎチャネル型トランジスタ２５３のソース又はドレインの他方に電気的に接続されている。ダイオード２５４の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０１９４】
第２の参照電圧発生回路である参照電圧発生回路１９６は、端子２６１、ｐチャネル型トランジスタ２６２、抵抗２６３、ダイオード２６４、端子２６５、ｐチャネル型トランジスタ２６６、ｎチャネル型トランジスタ２６７、抵抗２６８、ダイオード２６９、端子２７１、ｐチャネル型トランジスタ２７２、ｎチャネル型トランジスタ２７３、ダイオード２７４を有している。
【０１９５】
ｐチャネル型トランジスタ２６２のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２６２のゲート、ｐチャネル型トランジスタ２６６のゲート、ｐチャネル型トランジスタ２６６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６５、ｐチャネル型トランジスタ２７２のゲート、ｐチャネル型トランジスタ２７２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２７２のソース又はドレインの他方、ｎチャネル型トランジスタ２７３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ２６２のソース又はドレインの他方は、入力信号調整回路１０２、抵抗２６３の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ２６２のゲートは、ｐチャネル型トランジスタ２６２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２６６のゲート、ｐチャネル型トランジスタ２６６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６５、ｐチャネル型トランジスタ２７２のゲート、ｐチャネル型トランジスタ２７２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２７２のソース又はドレインの他方、ｎチャネル型トランジスタ２７３のソース又はドレインの一方に電気的に接続されている。
【０１９６】
抵抗２６３の一方の端子は、ｐチャネル型トランジスタ２６２のソース又はドレインの他方、入力信号調整回路１０２に電気的に接続されている。抵抗２６３の他方の端子は、ダイオード２６４の入力端子に電気的に接続されている。
【０１９７】
ダイオード２６４の入力端子は、抵抗２６３の他方の端子に電気的に接続されている。ダイオード２６４の出力端子は、ダイオード２６９の出力端子、ダイオード２７４の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０１９８】
ｐチャネル型トランジスタ２６６のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子２６５、ｐチャネル型トランジスタ２６６のゲート、ｐチャネル型トランジスタ２６２のゲート、ｐチャネル型トランジスタ２６２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２７２のゲート、ｐチャネル型トランジスタ２７２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２７２のソース又はドレインの他方、ｎチャネル型トランジスタ２７３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ２６６のソース又はドレインの他方は、ｎチャネル型トランジスタ２６７のソース又はドレインの一方、ｎチャネル型トランジスタ２６７のゲート、ｎチャネル型トランジスタ２７３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｐチャネル型トランジスタ２６６のゲートは、ｐチャネル型トランジスタ２６６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６５、ｐチャネル型トランジスタ２６２のゲート、ｐチャネル型トランジスタ２６２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２７２のゲート、ｐチャネル型トランジスタ２７２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２７２のソース又はドレインの他方、ｎチャネル型トランジスタ２７３のソース又はドレインの一方に電気的に接続されている。
【０１９９】
ｎチャネル型トランジスタ２６７のソース又はドレインの一方は、ｎチャネル型トランジスタ２６７のゲート、ｐチャネル型トランジスタ２６６のソース又はドレインの他方、ｎチャネル型トランジスタ２７３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｎチャネル型トランジスタ２６７のソース又はドレインの他方は、抵抗２６８の一方の端子に電気的に接続されている。ｎチャネル型トランジスタ２６７のゲートは、ｎチャネル型トランジスタ２６７のソース又はドレインの一方、ｐチャネル型トランジスタ２６６のソース又はドレインの他方、ｎチャネル型トランジスタ２７３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２００】
抵抗２６８の一方の端子は、ｎチャネル型トランジスタ２６７のソース又はドレインの他方に電気的に接続されている。抵抗２６８の他方の端子は、ダイオード２６９の入力端子に電気的に接続されている。
【０２０１】
ダイオード２６９の入力端子は、抵抗２６８の他方の端子に電気的に接続されている。ダイオード２６９の出力端子は、ダイオード２６４の出力端子、ダイオード２７４の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２０２】
ｐチャネル型トランジスタ２７２のソース又はドレインの一方は、ｐチャネル型トランジスタ２７２のゲート、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２７２のソース又はドレインの他方、ｐチャネル型トランジスタ２６２のゲート、ｐチャネル型トランジスタ２６２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２６６のゲート、ｐチャネル型トランジスタ２６６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６５、ｎチャネル型トランジスタ２７３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ２７２のソース又はドレインの他方は、ｐチャネル型トランジスタ２７２のソース又はドレインの一方、ｐチャネル型トランジスタ２７２のゲート、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２６２のゲート、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２６２のソース又はドレインの一方、ｐチャネル型トランジスタ２６６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６５、ｐチャネル型トランジスタ２６６のゲート、ｎチャネル型トランジスタ２７３のソース又はドレインの一方に電気的に接続されている。
【０２０３】
ｎチャネル型トランジスタ２７３のソース又はドレインの一方は、ｐチャネル型トランジスタ２６２のゲート、ｐチャネル型トランジスタ２６２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６１、ｐチャネル型トランジスタ２６６のゲート、ｐチャネル型トランジスタ２６６のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２６５、ｐチャネル型トランジスタ２７２のゲート、ｐチャネル型トランジスタ２７２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子２７１、ｐチャネル型トランジスタ２７２のソース又はドレインの他方に電気的に接続されている。ｎチャネル型トランジスタ２７３のソース又はドレインの他方は、ダイオード２７４の入力端子に電気的に接続されている。ｎチャネル型トランジスタ２７３のゲートは、ｎチャネル型トランジスタ２６７のソース又はドレインの一方、ｎチャネル型トランジスタ２６７のゲート、ｐチャネル型トランジスタ２６６のソース又はドレインの他方に電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２０４】
ダイオード２７４の入力端子は、ｎチャネル型トランジスタ２７３のソース又はドレインの他方に電気的に接続されている。ダイオード２７４の出力端子は、ダイオード２６４の出力端子、ダイオード２６９の出力端子に電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２０５】
図１０に示す電源回路において、参照電圧発生回路１９５は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード２４４、ダイオード２４９、及びダイオード２５４）、及び抵抗（抵抗２４３及び抵抗２４８）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１９６は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード２６４、ダイオード２６９、及びダイオード２７４）、及び抵抗（抵抗２６３及び抵抗２６８）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１９５の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９６の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０２０６】
また参照電圧発生回路１９５及び参照電圧発生回路１９６がバンドギャップリファレンスであるため、参照電圧発生回路１９５の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９６の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０２０７】
なお、参照電圧発生回路１９５のダイオード２４４、ダイオード２４９、及びダイオード２５４、並びに参照電圧発生回路１９６のダイオード２６４、ダイオード２６９、及びダイオード２７４をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０２０８】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０２０９】
図１１に、図２〜図７に示す参照電圧発生回路１１３及び参照電圧発生回路１１４とは異なる回路構成を有する、参照電圧発生回路１９７及び参照電圧発生回路１９８の回路構成を示す。なお、図２〜図７の参照電圧発生回路１１３及び参照電圧発生回路１１４を、それぞれ参照電圧発生回路１９７及び参照電圧発生回路１９８に置き換えることが可能である。
【０２１０】
第１の参照電圧発生回路である参照電圧発生回路１９７は、端子３０１、ｐチャネル型トランジスタ３０２、抵抗３０３、端子３０４、ｐチャネル型トランジスタ３０５、ｎチャネル型トランジスタ３０６、抵抗３０７、抵抗３０８、ダイオード３０９、端子３１１、ｐチャネル型トランジスタ３１２、ｎチャネル型トランジスタ３１３、ダイオード３１４、抵抗３１５を有している。
【０２１１】
ｐチャネル型トランジスタ３０２のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０５のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０４、ｐチャネル型トランジスタ３１２のゲート、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３０２のソース又はドレインの他方は、入力信号調整回路１０２、抵抗３０３の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ３０２のゲートは、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３０５のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０４、ｐチャネル型トランジスタ３１２のゲート、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。
【０２１２】
抵抗３０３の一方の端子は、ｐチャネル型トランジスタ３０２のソース又はドレインの他方、入力信号調整回路１０２に電気的に接続されている。抵抗３０３の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２１３】
ｐチャネル型トランジスタ３０５のソース又はドレインの一方は、ｐチャネル型トランジスタ３０５のゲート、電源電圧ＶＤＤが印加される端子３０４、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３１２のゲート、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３０５のソース又はドレインの他方は、ｎチャネル型トランジスタ３０６のソース又はドレインの一方、ｎチャネル型トランジスタ３０６のゲート、ｎチャネル型トランジスタ３１３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｐチャネル型トランジスタ３０５のゲートは、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０４、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３１２のゲート、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。
【０２１４】
ｎチャネル型トランジスタ３０６のソース又はドレインの一方は、ｎチャネル型トランジスタ３０６のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの他方、ｎチャネル型トランジスタ３１３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｎチャネル型トランジスタ３０６のソース又はドレインの他方は、抵抗３０７の一方の端子、抵抗３０８の一方の端子に電気的に接続されている。ｎチャネル型トランジスタ３０６のゲートは、ｎチャネル型トランジスタ３０６のソース又はドレインの一方、ｐチャネル型トランジスタ３０５のソース又はドレインの他方、ｎチャネル型トランジスタ３１３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２１５】
抵抗３０７の一方の端子は、ｎチャネル型トランジスタ３０６のソース又はドレインの他方、抵抗３０８の一方の端子に電気的に接続されている。抵抗３０７の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２１６】
抵抗３０８の一方の端子は、ｎチャネル型トランジスタ３０６のソース又はドレインの他方、抵抗３０７の一方の端子に電気的に接続されている。抵抗３０８の他方の端子は、ダイオード３０９の入力端子に電気的に接続されている。
【０２１７】
ダイオード３０９の入力端子は、抵抗３０８の他方の端子に電気的に接続されている。ダイオード３０９の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２１８】
ｐチャネル型トランジスタ３１２のソース又はドレインの一方は、ｐチャネル型トランジスタ３１２のゲート、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３０５のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０４、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３１２のソース又はドレインの他方は、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、ｐチャネル型トランジスタ３１２のゲート、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、ｐチャネル型トランジスタ３０５のゲート、電源電圧ＶＤＤが印加される端子３０４、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３１２のゲートは、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３１１、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３０５のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０４、ｎチャネル型トランジスタ３１３のソース又はドレインの一方に電気的に接続されている。
【０２１９】
ｎチャネル型トランジスタ３１３のソース又はドレインの一方は、ｐチャネル型トランジスタ３０２のゲート、ｐチャネル型トランジスタ３０２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０１、ｐチャネル型トランジスタ３０５のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３０４、ｐチャネル型トランジスタ３１２のソース又はドレインの他方、ｐチャネル型トランジスタ３１２のゲート、ｐチャネル型トランジスタ３１２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３１１に電気的に接続されている。ｎチャネル型トランジスタ３１３のソース又はドレインの他方は、ダイオード３１４の入力端子、抵抗３１５の一方の端子に電気的に接続されている。ｎチャネル型トランジスタ３１３のゲートは、ｎチャネル型トランジスタ３０６のソース又はドレインの一方、ｎチャネル型トランジスタ３０６のゲート、ｐチャネル型トランジスタ３０５のソース又はドレインの他方に電気的に接続され、かつには、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２２０】
ダイオード３１４の入力端子は、ｎチャネル型トランジスタ３１３のソース又はドレインの他方、抵抗３１５の一方の端子に電気的に接続されている。ダイオード３１４の出力端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２２１】
抵抗３１５の一方の端子は、ダイオード３１４の入力端子、ｎチャネル型トランジスタ３１３のソース又はドレインの他方に電気的に接続されている。抵抗３１５の他方の端子には、電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２２２】
第２の参照電圧発生回路である参照電圧発生回路１９８は、端子３２１、ｐチャネル型トランジスタ３２２、抵抗３２３、端子３２４、ｐチャネル型トランジスタ３２５、ｎチャネル型トランジスタ３２６、抵抗３２７、抵抗３２８、ダイオード３２９、端子３３１、ｐチャネル型トランジスタ３３２、ｎチャネル型トランジスタ３３３、ダイオード３３４、抵抗３３５を有している。
【０２２３】
ｐチャネル型トランジスタ３２２のソース又はドレインの一方は、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３２５のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｐチャネル型トランジスタ３３２のゲート、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３３２のソース又はドレインの他方、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３２２のソース又はドレインの他方は、入力信号調整回路１０２、抵抗３２３の一方の端子に電気的に接続されている。ｐチャネル型トランジスタ３２２のゲートは、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３２５のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｐチャネル型トランジスタ３３２のゲート、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３３２のソース又はドレインの他方、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。
【０２２４】
抵抗３２３の一方の端子は、ｐチャネル型トランジスタ３２２のソース又はドレインの他方、入力信号調整回路１０２に電気的に接続されている。抵抗３２３の他方の端子は、抵抗３２７の他方の端子、ダイオード３２９の出力端子、ダイオード３３４の出力端子、抵抗３３５の他方の端子と電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２２５】
ｐチャネル型トランジスタ３２５のソース又はドレインの一方は、ｐチャネル型トランジスタ３２５のゲート、電源電圧ＶＤＤが印加される端子３２４、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３３２のゲート、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３３２のソース又はドレインの他方、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３２５のソース又はドレインの他方は、ｎチャネル型トランジスタ３２６のソース又はドレインの一方、ｎチャネル型トランジスタ３２６のゲート、ｎチャネル型トランジスタ３３３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｐチャネル型トランジスタ３２５のゲートは、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３３２のゲート、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３３２のソース又はドレインの他方、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。
【０２２６】
ｎチャネル型トランジスタ３２６のソース又はドレインの一方は、ｎチャネル型トランジスタ３２６のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの他方、ｎチャネル型トランジスタ３３３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。ｎチャネル型トランジスタ３２６のソース又はドレインの他方は、抵抗３２７の一方の端子、抵抗３２８の一方の端子に電気的に接続されている。ｎチャネル型トランジスタ３２６のゲートは、ｎチャネル型トランジスタ３２６のソース又はドレインの一方、ｐチャネル型トランジスタ３２５のソース又はドレインの他方、ｎチャネル型トランジスタ３３３のゲートに電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２２７】
抵抗３２７の一方の端子は、ｎチャネル型トランジスタ３２６のソース又はドレインの他方、抵抗３２８の一方の端子に電気的に接続されている。抵抗３２７の他方の端子は、抵抗３２３の他方の端子、ダイオード３２９の出力端子、ダイオード３３４の出力端子、抵抗３３５の他方の端子と電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２２８】
抵抗３２８の一方の端子は、ｎチャネル型トランジスタ３２６のソース又はドレインの他方、抵抗３２７の一方の端子に電気的に接続されている。抵抗３２８の他方の端子は、ダイオード３２９の入力端子に電気的に接続されている。
【０２２９】
ダイオード３２９の入力端子は、抵抗３２８の他方の端子に電気的に接続されている。ダイオード３２９の出力端子は、抵抗３２３の他方の端子、抵抗３２７の他方の端子、ダイオード３３４の出力端子、抵抗３３５の他方の端子と電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２３０】
ｐチャネル型トランジスタ３３２のソース又はドレインの一方は、ｐチャネル型トランジスタ３３２のゲート、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３３２のソース又はドレインの他方、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３２５のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３３２のソース又はドレインの他方は、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、ｐチャネル型トランジスタ３３２のゲート、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３２５のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。ｐチャネル型トランジスタ３３２のゲートは、ｐチャネル型トランジスタ３３２のソース又はドレインの他方、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３２５のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｎチャネル型トランジスタ３３３のソース又はドレインの一方に電気的に接続されている。
【０２３１】
ｎチャネル型トランジスタ３３３のソース又はドレインの一方は、ｐチャネル型トランジスタ３２２のゲート、ｐチャネル型トランジスタ３２２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２１、ｐチャネル型トランジスタ３２５のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３２４、ｐチャネル型トランジスタ３３２のゲート、ｐチャネル型トランジスタ３３２のソース又はドレインの一方、電源電圧ＶＤＤが印加される端子３３１、ｐチャネル型トランジスタ３３２のソース又はドレインの他方に電気的に接続されている。ｎチャネル型トランジスタ３３３のソース又はドレインの他方は、ダイオード３３４の入力端子、抵抗３３５の一方の端子に電気的に接続されている。ｎチャネル型トランジスタ３３３のゲートは、ｎチャネル型トランジスタ３２６のソース又はドレインの一方、ｎチャネル型トランジスタ３２６のゲート、ｐチャネル型トランジスタ３２５のソース又はドレインの他方に電気的に接続され、かつ電源電圧ＶＤＤより低い電源電圧ＶＳＳ（例えば接地電圧ＧＮＤ）が印加されている。
【０２３２】
ダイオード３３４の入力端子は、ｎチャネル型トランジスタ３３３のソース又はドレインの他方、抵抗３３５の一方の端子に電気的に接続されている。ダイオード３３４の出力端子は、抵抗３２３の他方の端子、抵抗３２７の他方の端子、ダイオード３２９の出力端子、抵抗３３５の他方の端子と電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２３３】
抵抗３３５の一方の端子は、ダイオード３３４の入力端子、ｎチャネル型トランジスタ３３３のソース又はドレインの他方に電気的に接続されている。抵抗３３５の他方の端子は、抵抗３２３の他方の端子、抵抗３２７の他方の端子、ダイオード３２９の出力端子、ダイオード３３４の出力端子と電気的に接続されており、分圧回路１３３からのフィードバック電圧Ｖｆｂが入力される。
【０２３４】
図１１に示す電源回路において、参照電圧発生回路１９７は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード３０９及びダイオード３１４）、及び抵抗（抵抗３０３、抵抗３０７、抵抗３０８、及び抵抗３１５）を用いて形成されるバンドギャップリファレンスである。また、参照電圧発生回路１９８は、バンドギャップの電圧を利用する素子であるダイオード（ダイオード３２９及びダイオード３３４）、及び抵抗（抵抗３２３、抵抗３２７、抵抗３２８、及び抵抗３３５）を用いて形成されるバンドギャップリファレンスである。そのため、参照電圧発生回路１９７の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９８の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が電流によって変化せず、出力安定性がよい。
【０２３５】
また参照電圧発生回路１９７及び参照電圧発生回路１９８がバンドギャップリファレンスであるため、参照電圧発生回路１９７の出力電圧Ｖｒｅｆ、及び参照電圧発生回路１９８の出力電圧（Ｖｒｅｆ−Ｖｆｂ）が、動作温度によって変化せず、出力安定性がよい。
【０２３６】
なお、参照電圧発生回路１９７のダイオード３０９及びダイオード３１４、並びに参照電圧発生回路１９８のダイオード３２９及びダイオード３３４をそれぞれ、ベースとコレクタが電気的に接続されたＰＮＰバイポーラトランジスタに置き換えが可能である。上述のＰＮＰバイポーラトランジスタもバンドギャップの電圧を利用した素子である。そのため、上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が電流によって変化せず、出力安定性がよいという効果を得られる。
【０２３７】
また上述のＰＮＰバイポーラトランジスタを、当該ダイオードと置き換えた参照電圧発生回路は、出力電圧が動作温度によって変化せず、出力安定性がよいという効果を得られる。
【０２３８】
以上、本実施の形態により、フィードバック電圧を検知する検知回路において、出力電流が変化せず、出力電圧が変化しない検知回路を得ることができる。
【０２３９】
また、本実施の形態では、フィードバック電圧を検知する検知回路において、動作温度により出力電圧が変化しない検知回路を得るができる。
【０２４０】
また、本実施の形態、上記の検知回路を有する電源回路を得ることができる。
【符号の説明】
【０２４１】
１０１ 制御回路
１０２ 入力信号調整回路
１０３ パルス幅変調ドライバ
１０４ 容量
１０５ 三角波発生回路
１０６ 誤差増幅回路
１０７ 抵抗
１０８ オペアンプ
１０９ 抵抗
１１１ 抵抗
１１２ 抵抗
１１３ 参照電圧発生回路
１１４ 参照電圧発生回路
１１５ 入力端子
１１９ 検知回路
１２１ 増幅回路
１２２ コイル
１２３ ダイオード
１２４ トランジスタ
１２５ 容量
１２６ 入力端子
１３１ 抵抗
１３２ 抵抗
１３３ 分圧回路
１３４ 出力端子
１４１ オペアンプ
１４２ 抵抗
１４３ 抵抗
１４４ ダイオード
１４５ 抵抗
１４６ ダイオード
１４７ ダイオード
１４８ ダイオード
１５１ オペアンプ
１５２ 抵抗
１５３ 抵抗
１５４ ダイオード
１５５ 抵抗
１５６ ダイオード
１５７ ダイオード
１５８ ダイオード
１６１ 端子
１６２ 端子
１６３ バッファ回路
１６４ オペアンプ
１７１ 増幅回路
１７２ コイル
１７３ 容量
１７４ トランジスタ
１７５ ダイオード
１７６ コイル
１７７ 容量
１８１ 増幅回路
１８２ コイル
１８３ コイル
１８４ トランス
１８５ トランジスタ
１８６ ダイオード
１８７ 容量
１９１ 参照電圧発生回路
１９２ 参照電圧発生回路
１９３ 参照電圧発生回路
１９４ 参照電圧発生回路
１９５ 参照電圧発生回路
１９６ 参照電圧発生回路
１９７ 参照電圧発生回路
１９８ 参照電圧発生回路
２０１ 端子
２０２ ｐチャネル型トランジスタ
２０３ 抵抗
２０４ オペアンプ
２０５ 抵抗
２０６ 抵抗
２０７ ダイオード
２０８ 端子
２０９ ｐチャネル型トランジスタ
２１１ 端子
２１２ ｐチャネル型トランジスタ
２１３ 抵抗
２１４ 抵抗
２１５ ダイオード
２２１ 端子
２２２ ｐチャネル型トランジスタ
２２３ 抵抗
２２４ オペアンプ
２２５ 抵抗
２２６ 抵抗
２２７ ダイオード
２２８ 端子
２２９ ｐチャネル型トランジスタ
２３１ 端子
２３２ ｐチャネル型トランジスタ
２３３ 抵抗
２３４ 抵抗
２３５ ダイオード
２４１ 端子
２４２ ｐチャネル型トランジスタ
２４３ 抵抗
２４４ ダイオード
２４５ 端子
２４６ ｐチャネル型トランジスタ
２４７ ｎチャネル型トランジスタ
２４８ 抵抗
２４９ ダイオード
２５１ 端子
２５２ ｐチャネル型トランジスタ
２５３ ｎチャネル型トランジスタ
２５４ ダイオード
２６１ 端子
２６２ ｐチャネル型トランジスタ
２６３ 抵抗
２６４ ダイオード
２６５ 端子
２６６ ｐチャネル型トランジスタ
２６７ ｎチャネル型トランジスタ
２６８ 抵抗
２６９ ダイオード
２７１ 端子
２７２ ｐチャネル型トランジスタ
２７３ ｎチャネル型トランジスタ
２７４ ダイオード
３０１ 端子
３０２ ｐチャネル型トランジスタ
３０３ 抵抗
３０４ 端子
３０５ ｐチャネル型トランジスタ
３０６ ｎチャネル型トランジスタ
３０７ 抵抗
３０８ 抵抗
３０９ ダイオード
３１１ 端子
３１２ ｐチャネル型トランジスタ
３１３ ｎチャネル型トランジスタ
３１４ ダイオード
３１５ 抵抗
３２１ 端子
３２２ ｐチャネル型トランジスタ
３２３ 抵抗
３２４ 端子
３２５ ｐチャネル型トランジスタ
３２６ ｎチャネル型トランジスタ
３２７ 抵抗
３２８ 抵抗
３２９ ダイオード
３３１ 端子
３３２ ｐチャネル型トランジスタ
３３３ ｎチャネル型トランジスタ
３３４ ダイオード
３３５ 抵抗
【特許請求の範囲】
【請求項１】
第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、
出力電圧を出力する増幅回路と、
前記増幅回路と電気的に接続され、前記検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、
前記増幅回路及び前記制御回路に電気的に接続され、前記出力電圧を分圧したものをフィードバック電圧として前記第２の参照電圧発生回路に入力する分圧回路と、
を有し、
前記第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、基準電圧回路であることを特徴とする電源回路。
【請求項２】
第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、
出力電圧を出力する増幅回路と、
前記増幅回路と電気的に接続され、前記検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、
前記増幅回路及び前記制御回路に電気的に接続され、前記出力電圧を分圧したものをフィードバック電圧として前記第２の参照電圧発生回路に入力する分圧回路と、
を有し、
前記第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、ダイオード及び抵抗を含む基準電圧回路であることを特徴とする電源回路。
【請求項３】
第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、
出力電圧を出力する増幅回路と、
前記増幅回路と電気的に接続され、前記検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、
オペアンプ、第１の抵抗値を有する２つの抵抗、第２の抵抗値を有する２つの抵抗を有する前記入力信号調整回路と、
前記増幅回路及び前記制御回路に電気的に接続され、前記出力電圧を分圧したものをフィードバック電圧として前記第２の参照電圧発生回路に入力する分圧回路と、
を有し、
前記第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、基準電圧回路であることを特徴とする電源回路。
【請求項４】
第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、
出力電圧を出力する増幅回路と、
前記増幅回路と電気的に接続され、前記検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、
オペアンプ、第１の抵抗値を有する２つの抵抗、第２の抵抗値を有する２つの抵抗を有する前記入力信号調整回路と、
前記増幅回路及び前記制御回路に電気的に接続され、前記出力電圧を分圧したものをフィードバック電圧として前記第２の参照電圧発生回路に入力する分圧回路と、
を有し、
前記第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、ダイオード及び抵抗を含む基準電圧回路であることを特徴とする電源回路。
【請求項５】
請求項１乃至請求項４のいずれか一項において、
前記増幅回路は、ＤＣＤＣコンバータであることを特徴とする電源回路。
【請求項６】
請求項１乃至請求項４のいずれか一項において、
前記増幅回路は、チュークコンバータであることを特徴とする電源回路。
【請求項７】
請求項１乃至請求項４のいずれか一項において、
前記増幅回路は、フライバックコンバータであることを特徴とする電源回路。
【請求項８】
請求項１乃至請求項７のいずれか一項において、
前記分圧回路と第２の参照電圧発生回路との間に、ボルテージフォロワが設けられていることを特徴とする電源回路。
【請求項９】
請求項１乃至請求項８のいずれか一項において、
前記フィードバック電圧は、負電圧であることを特徴とする電源回路。
【請求項１】
第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、
出力電圧を出力する増幅回路と、
前記増幅回路と電気的に接続され、前記検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、
前記増幅回路及び前記制御回路に電気的に接続され、前記出力電圧を分圧したものをフィードバック電圧として前記第２の参照電圧発生回路に入力する分圧回路と、
を有し、
前記第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、基準電圧回路であることを特徴とする電源回路。
【請求項２】
第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、
出力電圧を出力する増幅回路と、
前記増幅回路と電気的に接続され、前記検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、
前記増幅回路及び前記制御回路に電気的に接続され、前記出力電圧を分圧したものをフィードバック電圧として前記第２の参照電圧発生回路に入力する分圧回路と、
を有し、
前記第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、ダイオード及び抵抗を含む基準電圧回路であることを特徴とする電源回路。
【請求項３】
第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、
出力電圧を出力する増幅回路と、
前記増幅回路と電気的に接続され、前記検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、
オペアンプ、第１の抵抗値を有する２つの抵抗、第２の抵抗値を有する２つの抵抗を有する前記入力信号調整回路と、
前記増幅回路及び前記制御回路に電気的に接続され、前記出力電圧を分圧したものをフィードバック電圧として前記第２の参照電圧発生回路に入力する分圧回路と、
を有し、
前記第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、基準電圧回路であることを特徴とする電源回路。
【請求項４】
第１の参照電圧発生回路、第２の参照電圧発生回路、及び入力信号調整回路を有する検知回路と、
出力電圧を出力する増幅回路と、
前記増幅回路と電気的に接続され、前記検知回路、誤差増幅回路、パルス幅変調ドライバ、三角波発生回路、及び容量を有する制御回路と、
オペアンプ、第１の抵抗値を有する２つの抵抗、第２の抵抗値を有する２つの抵抗を有する前記入力信号調整回路と、
前記増幅回路及び前記制御回路に電気的に接続され、前記出力電圧を分圧したものをフィードバック電圧として前記第２の参照電圧発生回路に入力する分圧回路と、
を有し、
前記第１の参照電圧発生回路及び第２の参照電圧発生回路のそれぞれが、ダイオード及び抵抗を含む基準電圧回路であることを特徴とする電源回路。
【請求項５】
請求項１乃至請求項４のいずれか一項において、
前記増幅回路は、ＤＣＤＣコンバータであることを特徴とする電源回路。
【請求項６】
請求項１乃至請求項４のいずれか一項において、
前記増幅回路は、チュークコンバータであることを特徴とする電源回路。
【請求項７】
請求項１乃至請求項４のいずれか一項において、
前記増幅回路は、フライバックコンバータであることを特徴とする電源回路。
【請求項８】
請求項１乃至請求項７のいずれか一項において、
前記分圧回路と第２の参照電圧発生回路との間に、ボルテージフォロワが設けられていることを特徴とする電源回路。
【請求項９】
請求項１乃至請求項８のいずれか一項において、
前記フィードバック電圧は、負電圧であることを特徴とする電源回路。
【図１】
【図２】
【図３】
【図４】
【図５】
【図６】
【図７】
【図８】
【図９】
【図１０】
【図１１】
【図２】
【図３】
【図４】
【図５】
【図６】
【図７】
【図８】
【図９】
【図１０】
【図１１】
【公開番号】特開２０１２−７５３０５（Ｐ２０１２−７５３０５Ａ）
【公開日】平成２４年４月１２日（２０１２．４．１２）
【国際特許分類】
【出願番号】特願２０１１−１８５６７２（Ｐ２０１１−１８５６７２）
【出願日】平成２３年８月２９日（２０１１．８．２９）
【出願人】（０００１５３８７８）株式会社半導体エネルギー研究所 (5,264)
【Ｆターム（参考）】
【公開日】平成２４年４月１２日（２０１２．４．１２）
【国際特許分類】
【出願日】平成２３年８月２９日（２０１１．８．２９）
【出願人】（０００１５３８７８）株式会社半導体エネルギー研究所 (5,264)
【Ｆターム（参考）】
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