画素ユニット回路及びOLED表示装置
【課題】OLED素子の劣化、TFT駆動トランジスタの閾値電圧の不均一性及びバックプレーン電源のIR Dropを効果的に補償し表示效果を向上するとともに、大きいサイズのパネルに適用できる画素ユニット回路及びOLED表示装置を提供する。
【解決手段】第一のサブ回路モジュール、第二のサブ回路モジュール、第一のコンデンサ及び有機発光表示ダイオードOLEDを備える画素ユニット回路において、第一のサブ回路モジュールの一方の入力端がデータラインに接続され、第一のサブ回路モジュールの他方の入力端が第二のサブ回路モジュールの出力端及びOLEDの一端に接続され、第一のサブ回路モジュールの出力端と第二のサブ回路モジュールの入出力端は第一のコンデンサによって接続され、第二のサブ回路モジュールの入力端とOLEDの他端との間にバックプレーンの正負電源の電圧差が印加される。
【解決手段】第一のサブ回路モジュール、第二のサブ回路モジュール、第一のコンデンサ及び有機発光表示ダイオードOLEDを備える画素ユニット回路において、第一のサブ回路モジュールの一方の入力端がデータラインに接続され、第一のサブ回路モジュールの他方の入力端が第二のサブ回路モジュールの出力端及びOLEDの一端に接続され、第一のサブ回路モジュールの出力端と第二のサブ回路モジュールの入出力端は第一のコンデンサによって接続され、第二のサブ回路モジュールの入力端とOLEDの他端との間にバックプレーンの正負電源の電圧差が印加される。
【発明の詳細な説明】
【技術分野】
【0001】
本発明は画素ユニット回路及び有機発光ダイオード(Organic Light−Emitting Diode、OLED)表示装置に関する。
【背景技術】
【0002】
電流型発光素子として、OLEDはますます高性能表示に応用されている。表示サイズの増大に伴い、従来のパッシブ・マトリクス有機発光ダイオード(Passive Matrix OLED、PMOLED)表示において、更なる短い1つの画素の駆動時間が要求されるので、瞬間電流を大きくして電力消費を増大する必要がある。それとともに、大きい電流の使用によってインジウムスズ酸化物(ITO)ラインに電圧降下が大きすぎるようになり、OLEDの作業電圧が高すぎるようになり、OLEDの效率が下降してしまう。アクティブマトリクス有機発光ダイオード(Active Matrix OLED、AMOLED)表示は、スイッチトランジスタによって入力されたOLED電流をラインずつにスキャンすることで、上記問題をうまく解決した。
【0003】
AMOLEDバックプレーンを設計するとき、一例として、まず、AMOLEDは、OLED素子に対応する電流を供給するよう低温多結晶シリコン薄膜トランジスタ(LTPS TFT)で画素回路を構成することが多い。LTPS TFTは、一般的な非結晶シリコン薄膜トランジスタ(amorphous−Si TFT)に比べ、より高い移動率及びより安定する特性を有するので、AMOLED表示により適合する。然し、結晶化技術の制限により、大面積のガラス基板に形成されるLTPS TFTは、例えば、閾値電圧、移動率等の電気学パラメータに常に不均一性を有する。この不均一性は、OLEDの電流差異及び輝度差異になってしまい、肉眼に感知される。即ち、ムラ(mura)現象が生じてしまう。
【0004】
第二に、大きいサイズの表示に、バックプレーン電源線にある程度電気抵抗を有し、且全ての画素の駆動電流がバックプレーン正電源(ARVDD)により供給されるので、バックプレーンにおいて、ARVDD電源の供電位置領域に近い電源電圧は供電位置から遠い領域の電源電圧より高い。このような現象はIR Dropと称する。ARVDDの電圧は電流に関わるので、IR Dropによって異なる領域の電流が異なるようになり、表示の時にムラ現象が生じてしまう。
【0005】
第三に、OLED素子が蒸着されるとき、膜厚の不均一によって電気学性能の非均一性ももたらす。図1はOLED輝度、OLED閾値電圧及びOLED作業時間の関係を示す概略図である。図1において、「
【数1】
」は輝度を示し、「
【数2】
」はOLEDの閾値電圧を示す。図1に示すように、長時間の作業を行った後、OLED内部の電気学性能の劣化によって閾値電圧VOLED_0が高くなり、発光效率が下降し、輝度が下降する。
【0006】
現在、OLED素子の劣化を補償することは1つの重要課題になった。OLEDの劣化によって、固定画面を長時間に表示する領域に画像残影(Image Sticking)が生じ、表示效果が影響される。
【0007】
図2はOLEDの輝度損失とOLEDの閾値電圧との関係を示す概略図である。図3はOLEDの輝度と電流密度の関係を示す概略図である。図3において、「
【数3】
」は赤い光のOLEDの輝度と電流密度の関係を示し、「
【数4】
」は緑色光のOLEDの輝度と電流密度の関係を示し、「
【数5】
」は青い光のOLEDと電流密度の関係を示す。図2及び図3に示すように、OLEDの閾値電圧の上昇は輝度損失とほぼリニア関係をなし、OLED電流密度と輝度の関係もリニア関係であるので、OLEDの劣化を補償するとき、OLEDの閾値電圧の増大に従って、OLEDの駆動電流をリニア増加させることで、輝度損失を補償することができる。
【0008】
AMOLEDはドライブのタイプによってデジタル型、電流型及び電圧型に分ける。デジタル型駆動法は、TFTをスイッチとして駆動時間を制御することでグレーレベル(grey level)を実現し、不均一性を補償する必要がないが、作業頻度が表示サイズの増大に伴って倍に上昇し、電力消費が大きくなり、一定の範囲内に設計が物理の極限になるので、大きいサイズの表示に適合ではない。電流型駆動法は、駆動トランジスタに大きさの異なる電流を直接に供給することでグレーレベルを実現し、TFT不均一性及びIR Dropを比較的によく補償できるが、低いグレーレベル信号を書き込みとき、小さい電流でデータラインにおけるより大きい寄生容量を充電することで、書き込み時間が長すぎるようになる。この問題は、大きいサイズ表示で特に厳しくて克服しがたい。電圧型駆動方法は従来のAMLCD駆動方法に類似し、駆動ICによって1つのグレーレベルを示す電圧信号を供給し、該電圧信号は画素回路内で駆動管の電流信号に変換し、OLEDを駆動して輝度グレーレベルを実現する。このような方法は、駆動速度が速く、簡単に実現できるメリットを有し、大きいサイズのパネルの駆動に適合するので、業界に広く採用されたが、余分のTFT及びコンデンサ素子を設計してTFT不均一性及びIR Dropを補償する必要がある。
【0009】
図4は従来技術において2つのTFTトランジスタ、1つのコンデンサ及び1つのOLEDからなる最も伝統的な電圧駆動型画素ユニット回路構造(2T1C)を示す概略図である。それにおいて、スイッチトランジスタT2はデータラインにおけるデータ電圧を駆動トランジスタT1のゲート電極に伝送し、駆動トランジスタT1はこのデータ電圧を対応する電流に転換してOLEDに供給する。正常に作業するとき、駆動トランジスタT1は飽和領域にあり、1つのラインのスキャン時間内に定電流を供給すべきである。その電流は下式で表す。即ち、
【数6】
それにおいて、μPはキャリヤー移動率であり、COXはゲート酸化層容量であり、W/Lはトランジスタの幅と長さの比であり、VDATAはデータ電圧であり、ARVDDはAMOLEDバックプレーンの電源であって全ての画素ユニットに共有され、VThはトランジスタの閾値電圧である。上式から分かるように、異なる画素ユニット間のVThが異なれば、電流が異なるようになる。また、OLED素子の劣化に従って、定電流を供給しても、OLEDの発光輝度が下降する。
【0010】
目前では、VTh均一性及びIR Dropを補償する画素ユニット構造は複数ある。然し、ある画素ユニット構造は駆動トランジスタのVTh不均一性を補償できるが、IR Drop及びOLEDの劣化による輝度損失を補償できない。ある画素ユニット回路は、駆動トランジスタのVTh不均一性及びIR Dropを補償できるが、OLEDの劣化による輝度損失を補償できない。ある画素ユニット回路はVTh不均一性、IR Drop及びOLEDの劣化による影響を補償できるが、電流型駆動であるので、大きいサイズのパネルに応用できない。ある画素ユニット回路は、OLED劣化による影響を補償できるが、VTh不均一性及びIR Dropを補償できない。従って、従来技術に係る画素回路は、TFT駆動トランジスタの閾値電圧VThの不均一性、バックプレーン電源のIR Drop及びOLED劣化による影響を効果的に補償するとともに、大きいサイズのパネルに適用することができない。
【発明の概要】
【課題を解決するための手段】
【0011】
本発明はTFT駆動管の閾値電圧の不均一性、バックプレーン電源のIR Drop及びOLED劣化による影響を効果的に補償できるとともに、大きいサイズのパネルに応用できる画素ユニット回路及びOLED表示装置である。
【0012】
本発明の1つの実施例は、第一のサブ回路モジュール、第二のサブ回路モジュール、第一のコンデンサ及び有機発光表示ダイオードOLEDを有する画素ユニット回路であって、
第一のサブ回路モジュールの一方の入力端がデータラインに接続され、
第一のサブ回路モジュールの他方の入力端が第二のサブ回路モジュールの出力端およびOLEDの第一端に接続され、
第一のサブ回路モジュール的出力端と第二のサブ回路モジュールの入出力端とが第一のコンデンサによって接続され、
第二のサブ回路モジュールの入力端とOLEDの第二端との間にバックプレーンの正負電源の電圧差が印加される。
【0013】
1つの例示では、前記第一のサブ回路モジュールは入力電圧を選択してコンデンサに出力するものであり、前記第二のサブ回路モジュールは入力電圧を電流に転換してOLEDに供給するものである。
【0014】
1つの例示では、前記OLEDの第一端はOLED(4)のアノードで、前記OLEDの第二端はOLED(4)のカソードであり、第一のサブ回路モジュール(1)は、前記他方の入力端がOLED(4)のアノードに接続され、出力端のNDスポットが第一のコンデンサ(3)の一端に接続される。第二のサブ回路モジュール(2)は、入力端がバックプレーンの正電源ARVDDに接続され、入出力端のNGスポットが第一のコンデンサ(3)の他端に接続され、出力端がOLED(4)のアノードに接続され、OLED(4)のカソードがバックプレーンの負電源ARVSSに接続される。
【0015】
好ましいのは、前記第一のサブ回路モジュール(1)は、ゲート電極に制御信号SCANが入力され、ソース電極がデータラインに接続され、ドレイン電極がNDスポットに対応する第一のトランジスタ(11)と、ゲート電極に制御信号EMBが入力され、ドレイン電極がNDスポットに対応し、ソース電極がOLED(4)のアノードに接続される第二のトランジスタ(12)とを備え、前記第一のトランジスタ(11)及び第二のトランジスタ(12)はP型TFTトランジスタである。
【0016】
好ましいのは、前記第二のサブ回路モジュール(2)は、ゲート電極がNGスポットに対応し、ドレイン電極がARVDDに接続7される第三のトランジスタ(21)と、ゲート電極に制御信号EMBが入力され、ドレイン電極がNGスポットに対応し、ソース電極が第三のトランジスタ(21)のソース電極に接続される第四のトランジスタ(22)と、ゲート電極に制御信号EMが入力され、ドレイン電極が第三のトランジスタ(21)のソース電極に接続され、ソース電極がOLED(4)のアノードに接続される第五のトランジスタ(23)と、一端がNGスポットに対応し、他端がARVDDに接続される第二のコンデンサ(24)と、を備え、前記第三のトランジスタ(21)、第四のトランジスタ(22)、第五のトランジスタ(23)はP型TFTトランジスタである。
【0017】
他の例示では、前記OLEDの第一端はOLED(4’)のカソードで、前記OLEDの第二端はOLED(4’)のアノードであり、第一のサブ回路モジュール(1’)は、前記他方の入力端がOLED(4’)のカソードに接続され、出力端のND’スポットが第一のコンデンサ(3’)の一端に接続され、第二のサブ回路モジュール(2’)は、入力端がARVSSに接続され、入出力端のNG’スポットが第一のコンデンサ(3’)の他端に接続され、出力端がOLED(4’)のカソードに接続され、OLED(4’)のアノードがARVDDに接続される。
【0018】
好ましいのは、前記第一のサブ回路モジュール(1’)は、ゲート電極に制御信号SCAN’が入力され、ソース電極がデータラインに接続され、ドレイン電極がND’スポットに対応する第一のトランジスタ(11’)と、ゲート電極に制御信号EMB’が入力され、ドレイン電極がND’スポットに対応し、ソース電極がOLED(4’)のカソードに接続される第二のトランジスタ(12’)と、を備え、前記第一のトランジスタ(11’)及び第二のトランジスタ(12’)はN型TFTトランジスタである。
【0019】
好ましいのは、前記第二のサブ回路モジュール(2’)は、ゲート電極がNG’スポットに対応し、ドレイン電極がARVSSに接続される第三のトランジスタ(21’)と、ゲート電極に制御信号EMB’が入力され、ドレイン電極がNG’スポットに対応し、ソース電極が第三のトランジスタ(21’)のソース電極に接続される第四のトランジスタ(22’)と、ゲート電極に制御信号EM’が入力され、ドレイン電極が第三のトランジスタ(21’)のソース電極に接続され、ソース電極がOLED(4’)のカソードに接続される第五のトランジスタ(23’)と、一端がNG’スポットに対応し、他端がARVSSに接続される第二のコンデンサ(24’)と、を備え、前記第三のトランジスタ(21’)、第四のトランジスタ(22’)及び第五のトランジスタ(23’)はN型TFTトランジスタである。
【0020】
1つの例示では、前記画素ユニット回路は、以下の順で操作される。即ち、第一段階は、SCANをハイレベルにして、EM及びEMBをローレベルにすることで、第二のトランジスタ(12)、第三のトランジスタ(21)、第四のトランジスタ(22)及び第五のトランジスタ(23)がオンされ、第一のトランジスタ(11)がオフされ、第一のコンデンサ(3)が放電され、第二段階は、SCANをハイレベルにして、EMBをローレベルにして、EMをハイレベルにすることで、EMが高くなる瞬間で、第二のトランジスタ(12)、第三のトランジスタ(21)及び第四のトランジスタ(22)がオンされ、第一のトランジスタ(11)及び第五のトランジスタ(23)がオフされ、第三のトランジスタ(21)がダイオード接続を形成し、NGスポット電圧がARVDDに充電されて段々上昇して第三のトランジスタ(21)をオフさせるとともに、NDスポットがOLED(4)に放電され、第三段階は、SCANをローレベルにして、EM及びEMBをハイレベルにすることで、第一のトランジスタ(11)及び第三のトランジスタ(21)がオンされ、第二のトランジスタ(12)、第四のトランジスタ(22)及び第五のトランジスタ(23)がオフされ、第四段階では、SCANをハイレベルにして、EMをローレベルにして、EMBをハイレベルにすることで、第三のトランジスタ(21)及び第五のトランジスタ(23)がオンされ、第一のトランジスタ(11)、第二のトランジスタ(12)及び第四のトランジスタ(22)がオフされ、OLED(4)が発光する。
【0021】
他の例示では、前記画素ユニット回路は以下の順で操作される。即ち、
第一段階は、SCAN’をローレベルにして、EM’及びEMB’をハイレベルにすることで、第二のトランジスタ(12’)、第三のトランジスタ(21’)、第四のトランジスタ(22’)及び第五のトランジスタ(23’)がオンされ、第一のトランジスタ(11’)がオフされ、第一のコンデンサ(3’)が放電され、第二段階は、SCAN’をローレベルにして、EMB’をハイレベルにして、EM’をローレベルにすることで、第二のトランジスタ(12’)、第三のトランジスタ(21’)及び第四のトランジスタ(22’)がオンされ、第一のトランジスタ(11’)及び第五のトランジスタ(23’)がオフされ、第三のトランジスタ(21’)がダイオード接続を形成し、NG’スポットの電圧が第三のトランジスタ(21’)を介してARVSSに放電して段々下降して第三のトランジスタ(21’)をオフさせるとともに、ND’スポットがARVDDに充電され、第三段階は、SCAN’をハイレベルにして、EM’及びEMB’をローレベルにすることで、第一のトランジスタ(11’)及び第三のトランジスタ(21’)がオンされ、第二のトランジスタ(12’)、第四のトランジスタ(22’)及び第五のトランジスタ(23’)がオフされ、第四段階は、SCAN’をローレベルにして、EM’をハイレベルにして、EMB’をローレベルにすることで、第三のトランジスタ(21’)及び第五のトランジスタ(23’)がオンされ、第一のトランジスタ(11’)、第二のトランジスタ(12’)及び第四のトランジスタ(22’)がオフされ、OLED(4’)が発光する。
【0022】
複数の直列する画素ユニット回路を有するOLED表示装置であって、各画素ユニット回路は、第一のサブ回路モジュール、第二のサブ回路モジュール、第一のコンデンサ及び有機発光表示ダイオードOLEDを有し、第一のサブ回路モジュールは、一方の入力端がデータラインに接続され、他方の入力端が第二のサブ回路モジュールの出力端およびOLEDの一端に接続され、第一のサブ回路モジュールの出力端と第二のサブ回路モジュールの入出力端とは第一のコンデンサによって接続され、第二のサブ回路モジュールの入力端とOLEDの他端との間にバックプレーンの正負電源の電圧差が印加される。
【0023】
本発明に係る画素ユニット回路は、従来の画素ユニット回路に比べて、OLED素子の劣化による影響、TFT駆動管の閾値電圧の不均一性及びバックプレーン電源のIR Dropを効果的に補償でき、表示效果を向上できる。さらに、本発明に係る画素ユニット回路は、電圧フイードバック技術に基づいて設計されるものであるので、大きいサイズのパネルに適用できる。
【図面の簡単な説明】
【0024】
【図1】OLED輝度、OLED閾値電圧及びOLED作業時間の関係を示す概略図である。
【図2】OLEDの輝度損失とOLEDの閾値電圧の関係を示す概略図である。
【図3】OLEDの輝度と電流密度の関係を示す概略図である。
【図4】従来技術における電圧駆動型画素ユニットの回路構造を示す概略図である。
【図5】本発明における画素ユニット回路の構造を示す概略図である。
【図6】本発明実施例における画素ユニット回路の詳細構造を示す概略図である。
【図7】本発明実施例におけるSCAN、EM及びEMBの制御信号波形を示す概略図である。
【図8】本発明実施例の第1段階の作業状況を示す概略図である。
【図9】本発明実施例の第2段階の作業状況を示す概略図である。
【図10】本発明実施例の第3段階の作業状況を示す概略図である。
【図11】本発明実施例の第4段階の作業状況を示す概略図である。
【図12】本発明実施例に係る画素ユニット回路で閾値電圧の不均一性を補償する模擬結果を示す概略図である。
【図13】本発明実施例に係る画素ユニット回路でIR Dropを補償する模擬結果を示す概略図である。
【図14】本発明実施例に係る画素ユニット回路でOLED劣化を補償する模擬結果を示す概略図である。
【図15】本発明実施例においてハイレベルでオンされるN型トランジスタによって実現される画素ユニット回路の構造全体を示す概略図である。
【図16】本発明実施例においてハイレベルでオンされるN型トランジスタによって実現される画素ユニット回路の具体的な構造を示す概略図である。
【図17】本発明実施例においてSCAN’、EM’及びEMB’の制御信号波形を示す概略図である。
【発明を実施するための形態】
【0025】
本発明は、第一のサブ回路モジュール、第二のサブ回路モジュール、コンデンサおよび有機発光表示ダイオードOLEDを備える画素ユニット回路において、
第一のサブ回路モジュールの一方の入力端はデータラインに接続され、
第一のサブ回路モジュールの他方の入力端は第二のサブ回路モジュールの出力端及びOLEDの一端に接続され、
第一のサブ回路モジュールの出力端と第二のサブ回路モジュールの入出力端はコンデンサによって接続され、
第二のサブ回路モジュールの入力端とOLEDの他端との間にバックプレーンの正負電源の電圧差が印加される。
【0026】
前記第一のサブ回路モジュールは入力電圧を選択してコンデンサに出力するものであり、前記第二のサブ回路モジュールは入力電圧を電流に転換してOLEDに供給するものである。
【0027】
図5は本発明実施例に係る画素ユニット回路の構造を示す概略図である。図5に示すように、該画素ユニット回路は、サブ回路モジュール1、サブ回路モジュール2、コンデンサ3及びOLED4を有し、サブ回路モジュール1はデータラインとOLED4のアノードにそれぞれ接続される2つの入力端と、コンデンサ3の一端に接続される1つの出力端とを有し、サブ回路モジュール2は、ARVDDに接続される1つの入力端と、コンデンサ3的他端に接続される1つの入出力端と、OLED4のアノードに接続される1つの出力端とを有する。該実施例では、サブ回路モジュール1の出力端もNDスポットと称し、サブ回路モジュール2の入出力端もNGスポットと称する。言い換えれば、該実施例の画素ユニット回路において、サブ回路モジュール1は、入力がデータ電圧VDATA及びOLEDアノードの電圧であり、出力がNDスポットであり。サブ回路モジュール2は、1つの入力信号がARVDDであり、1つの電圧入出力ポートがNGスポットであり、1つの電流出力ポートがOLED4のアノードに接続され、コンデンサ3がNDスポットとNGスポットとの間に接続され、OLED4のカソードがバックプレーンの負電源(ARVSS)に接続される。
【0028】
図5に示す画素ユニット回路において、サブ回路モジュール1は入力電圧(VDATA又はVOLED)を選択してNDに出力するものであり、サブ回路モジュール2は入力電圧を電流に転換してOLED供給するものであり、その出力をf(VNG,ARVDD,VTh)=IOLEDという式で表し、それは2つの段階によって作業を行う。即ち、第一段階は補償段階であり、この段階では、NDスポットの電圧がVOLED_0(VOLED_0がOLED閾値電圧である)に制御され、このとき、サブ回路モジュール2のNGスポットが出力ポートになり、NGスポットの電圧がARVDD+VThに制御され、VThは画素ユニット回路に用いられるトランジスタの閾値電圧である。第二段階は演算段階であり、該段階では、サブ回路モジュール1が出力するNDスポット電圧がVDATAに制御され、このとき、サブ回路モジュール2のNGスポットが入力ポートになり、コンデンサのブートストラップ効果によって、NGスポット電圧がk・(VDATA−VOLED_0)+ARVDD+VThになり、サブ回路モジュール2はこの入力電圧を電流に転化し、転化中に上述のNGスポット電圧を表す式におけるARVDDとVThの項を消去して、出力電流をARVDD、VThと無関係にさせ、つまり、閾値電圧の不均一性とIR Dropを補償するとともに、サブ回路モジュール2は出力電流をVOLED_0と正比例にして、即ち、VOLED_0が大きいほど出力電流が大きくなり、比例係数kによって両者の関係を調節して、OLEDの減衰による電流の下降、発光効率の低下による影響を補償する。該画素ユニット回路は従来の画素構造に比べてOLED素子の劣化及びTFT駆動管の閾値電圧の不均一性、バックプレーン電源のIR Dropを効果的に補償できる。
【0029】
図6は本発明実施例に係る画素ユニット回路の詳細構造を示す概略図である。図6に示すように、該画素ユニット回路は、5つのP型TFTトランジスタ、1つのOLED及び2つのコンデンサからなり、ARVDDはハイレベルの電源信号であり、ARVSSはローレベルの電源信号であり、回路全体は3つの制御信号SCAN、EM及びEMBに制御される。図7はSCAN、EM及びEMBの制御信号波形を示す。
【0030】
図5及び図6に示すように、サブ回路モジュール1はトランジスタ11及びトランジスタ12を備え、サブ回路モジュール2はトランジスタ21、トランジスタ22、トランジスタ23及びコンデンサ24を備え、
トランジスタ11はゲート電極に制御信号SCANが入力され、ソース電極がデータラインに接続され、ドレイン電極がNDスポットに対応し、
トランジスタ12はゲート電極に制御信号EMBが入力され、ドレイン電極がNDスポット(即ち、トランジスタ12のドレイン電極とトランジスタ11のドレイン電極とが接続される)に対応し、ソース電極がOLED4のアノードに接続され、
トランジスタ21はゲート電極がNGスポットに対応し、ドレイン電極にARVDDが入力され、
トランジスタ22はゲート電極に制御信号EMBが入力され、ドレイン電極がNGスポットに対応し、ソース電極がトランジスタ21のソース電極に接続され、
トランジスタ23はゲート電極に制御信号EMが入力され、ドレイン電極がトランジスタ21のソース電極に接続され、ソース電極がOLED4のアノードに接続され、
コンデンサ24は一端がNGスポットに対応し、他端がARVDDに接続される。
【0031】
これから分かるように、サブ回路モジュール1は、2つの入力端がそれぞれトランジスタ11及びトランジスタ12のソース電極に対応し、出力端がトランジスタ11またはトランジスタ12のドレイン電極に対応する。サブ回路モジュール2は、入力端がトランジスタ21のドレイン電極に対応し、入出力端がトランジスタ21のゲート電極に対応し、出力端がトランジスタ23のソース電極に対応する。
【0032】
図6に示す画素ユニット回路は、図7に示す制御信号波形に基づき、作業が以下の4つの段階に分ける。
第1段階はプレチャージ段階である。図8に示すように、この段階では、SCANがハイレベルであり、EM及びEMBがローレベルである。この時、トランジスタ21、トランジスタ22、トランジスタ12及びトランジスタ23がオンされ、トランジスタ11がオフされ、コンデンサ3が放電され、NGスポットの電位はARVDD+VThPより小さく、VThPがP型TFTトランジスタ21の閾値電圧(VThP<0)である。
第2段階は補償段階である。図9に示すように、この段階では、SCANがハイレベルであり、EMBがローレベルであり,EMがハイレベルである。EMが高くなる瞬間で、トランジスタ21、トランジスタ22及びトランジスタ12がオンされ、トランジスタ11、トランジスタ23がオフされる。トランジスタ21がダイオード接続を形成し、NGスポットの電圧がARVDDにより充電されて段々ARVDD+VThPまで上昇してトランジスタ21をオフさせるとともに、OLED4がオフされ電流が流れなくなるまでNDスポットがOLED4により放電される。この時、ND電圧がVOLED_0、即ち、OLED4の閾値電圧になる。
第3段階は演算段階である。図10に示すように、この段階では、SCANがローレベルであり、EM及びEMBがハイレベルである。トランジスタ21及びトランジスタ11がオンされ、トランジスタ22、トランジスタ12及びトランジスタ23がオフされる。この時、データラインの電圧がコンデンサ3のNDスポットに印加される。NGスポットには直流通路がないので、該スポットの電荷総量は、下式のように、段階2に対して不変すべきである。
【数7】
演算して、
【数8】
を得る。
第4段階は保持発光段階、図11に示すように、この段階では、SCANがハイレベルであり、EMがローレベルであり、EMBがハイレベルである。トランジスタ21及びトランジスタ23がオンされ、トランジスタ22、トランジスタ11及びトランジスタ12がオフされる。この時、NGスポットの電圧がコンデンサ24に保存され、トランジスタ23がオンされた後、電流がOLED4に供給されてそれを発光させる。この時、トランジスタ21を流れる電流は、
【数9】
上記の式から分かるように、トランジスタ21を流れる電流はトランジスタ閾値電圧及びARVDDに関係ないので、本実施例における画素ユニット回路は、トランジスタ閾値電圧の不均一性及びIR Dropの影響をほぼ除去した。
【0033】
図12は本発明実施例に係る画素ユニット回路でトランジスタ閾値電圧の不均一性を補償する模擬結果を示す概略図である。この図において、「
【数10】
」は従来構造の2T1Cでトランジスタ閾値電圧とIOLEDとの関係を示し、「
【数11】
」は本実施例の構造の5T2Cでトランジスタ閾値電圧とIOLEDとの関係を示す。図12に示すように、従来構造の2T1Cに基づき、トランジスタ閾値電圧が±0.6Vドリフトした場合に、その電流が最大1.8倍以上ドリフトする可能性がある。本実施例における5T2Cの構造に基づき、閾値電圧が±0.6Vドリフトした場合に、その電流の波動は2.5%より小さい。
【0034】
図13は本発明実施例に係る画素ユニット回路でIR Dropを補償する模擬結果を示す概略図である。この図において、「
【数12】
」は従来構造の2T1CでARVDD電圧降下とIOLEDとの関係を示し、「
【数13】
」は本実施例における5T2C構造でARVDD電圧降下とIOLEDとの関係を示す。図13に示すように、従来構造の2T1Cに基づき、ARVDD電圧降下のドリフトが±0.5Vであり、その電流の最大が81%ドリフトする。本実施例における5T2Cの構造に基づき、ARVDD電圧降下のドリフトが±0.5Vである場合に、その電流波動は3.5%以下である。
【0035】
それとともに、電流IOLEDはOLEDの閾値電圧VOLED_0に関連し、OLEDの劣化による輝度損失を補償できる。OLED素子が劣化するとき、VOLED_0は段々大きくなり、発光效率が下降するので、同じ輝度を維持するにはトランジスタ21を駆動してより大きい電流を提供する必要がある。実際の応用に、VDATA<0かつVDATA<VOLED_0にすれば、VOLED_0の増大に従い、|VDATA−VOLED_0|が大きくなり、IOLEDを増大させ、OLEDの輝度損失を補償する。
【0036】
テーラー(Taylor)展開から分かるように、OLED閾値電圧がドリフトすれば、ドリフト後の閾値電圧はV’OLED_0=VOLED_0+ΔVOLED_0ように表せるので、IOLEDはΔVOLED_0に対して一次元近似展開式が以下のとおりである。
【数14】
IOLEDとΔVOLED_0はリニア関係をなすので、具体的に実施するとき、OLED劣化の測定結果により、コンデンサ24とコンデンサ3の容量比例を調節することでそのVOLED_0の係数を調節し、輝度−ΔVOLED_0曲線と相補にさせ、OLEDの劣化による輝度損失をちょうど補償する。
【0037】
図14は本発明実施例に係る画素ユニット回路ではOLED劣化を補償する模擬結果を示す概略図である。この図において、「
【数15】
」は従来構造の2T1CでOLED閾値電圧とIOLEDとの関係を示し、「
【数16】
」は本実施例に係る5T2CでOLEDの閾値電圧とIOLEDとの関係を示す。図14に示すように、従来構造の2T1Cに基づき、OLED閾値電圧が0〜0.8Vドリフトしたとき、その電流は遅く減少する傾向があるので、表示輝度の下降が激しくなる。それに対して、本実施例の構造の5T2Cに基づき、電流はOLEDの閾値電圧の増大に従って同期リニアに増加し、OLEDの輝度損失を効果的に補償できる。コンデンサ24とコンデンサ3の容量比例を調節することは、電流の増加速度及び範囲を制御できる。
【0038】
エミュレーション比較により、本実施例に係る画素ユニット回路を用いることは、トランジスタ閾値電圧の不均一性及びIR Dropを効果的に補償でき、電流のドリフトをそれぞれ2.5%及び3.5%程度に制御でき、大きいサイズのパネル表示に適合である。特に、該実施例はOLEDの劣化による輝度損失を補償でき、製品の寿命を効果的に向上できる。
【0039】
また、本発明の画素ユニット回路は、ローレベルでオンされるP型トランジスタによって実現できるだけでなく(図6に示すように)、ハイレベルでオンされるN型トランジスタによっても実現できることに注意する必要がある。図15は、本発明の他の実施例に係るハイレベルでオンされるN型トランジスタの画素ユニット回路の構造全体を示し、図16はその具体的な構造を示し、図17は対応するSCAN’、EM’及びEMB’の制御信号波形を示す。
【0040】
図15に示すように、該実施例に係る画素ユニット回路は、サブ回路モジュール1’、サブ回路モジュール2’、コンデンサ3’及びOLED 4’を備え、サブ回路モジュール1’は、データライン及びOLEDカソードに接続される2つの入力端と、コンデンサ3’の一端に接続されND’スポットに対応する1つの出力端とを有し、サブ回路モジュール2’は、ARVSSに接続される1つの入力端と、コンデンサ3’の他端に接続されかつNG’スポットの他端に対応する1つの入出力端と、OLED 4’のカソードに接続される1つの出力端とを有し、OLED 4’のアノードはARVDDに接続される。
【0041】
図16に示すように、サブ回路モジュール1’は、トランジスタ11’及びトランジスタ12’を有し、前記トランジスタ11’及びトランジスタ12’はN型TFTトランジスタである。トランジスタ11’は、ゲート電極に制御信号SCAN’が入力され、ソース電極がデータラインに接続され、ドレイン電極がND’スポットに対応する。トランジスタ12’は、ゲート電極に制御信号EMB’が入力され、ドレイン電極がND’スポットに対応し、ソース電極がOLED4’のカソードに接続される。
【0042】
サブ回路モジュール2’はトランジスタ21’、トランジスタ22’、トランジスタ23’及びコンデンサ24’を備える。前記トランジスタ21’、トランジスタ22’及びトランジスタ23’はN型TFTトランジスタである。トランジスタ21’は、ゲート電極がNG’スポットに対応し、ドレイン電極がARVSSに接続される。トランジスタ22’は、ゲート電極に制御信号EMB’が入力され、ドレイン電極がNG’スポットに対応し、ソース電極がトランジスタ21’のソース電極に接続される。トランジスタ23’は、ゲート電極に制御信号EM’が入力され、ドレイン電極がトランジスタ21’のソース電極に接続され、ソース電極がOLED 4’のカソードに接続される。コンデンサ24’は、一端がNG’スポットに対応し、他端がARVSSに接続される。
【0043】
図15に示す画素ユニット回路の作業は、2つの段階に分ける。第一段階は補償段階である。該段階では、ND’スポット電圧がARVDD−VOLED_0に制御され、この時、サブ回路モジュール2のNG’スポットが出力ポートであり、NG’スポットの電圧がVThに制御され、VThは画素ユニット回路に用いられるトランジスタの閾値電圧である。第二段階は演算段階である。該段階では、サブ回路モジュール1が出力するND’スポット電圧がVDATAに制御され、この時、サブ回路モジュール2のNG’スポットは入力ポートであり、このとき、コンデンサのブートストラップ効果により、NG’スポット電圧をk・(VDATA− ARVDD−VOLED_0)+ VThに変更する。
【0044】
図16に示す画素ユニット回路は、図17に示す制御信号波形に基づき、作業が以下の4つの段階に分ける。
第一段階は、SCAN’がローレベルであり、EM’及びEMB’がハイレベルである。これによって、トランジスタ(21’)、トランジスタ(22’)、トランジスタ(12’)及びトランジスタ(23’)がオンされ、トランジスタ(11’)がオフされ、コンデンサ(3’)が放電される。
第二段階は、SCAN’がローレベルであり、EMB’がハイレベルであり、EM’がローレベルである。これによって、トランジスタ(21’)、トランジスタ(22’)及びトランジスタ(12’)がオンされ、トランジスタ(11’)及びトランジスタ(23’)がオフされ、トランジスタ(21’)がダイオード接続を形成し、NG’スポット電圧がトランジスタ(21’)によってARVSSへ放電されて段々下降してトランジスタ(21’)をオフさせるとともに、ND’スポットがARVDDにより充電される。
第三段階では、SCAN’がハイレベルであり、EM’、EMB’がローレベルである。これによって、トランジスタ(21’)及びトランジスタ(11’)がオンされ、トランジスタ(22’)、トランジスタ(12’)及びトランジスタ(23’)がオフされる。
第四段階では、SCAN’がローレベルであり、EM’がハイレベルであり、EMB’がローレベルである。これによって、トランジスタ(21’)及びトランジスタ(23’)がオンされ、トランジスタ(22’)、トランジスタ(11’)及びトランジスタ(12’)がオフされ、OLED(4’)が発光する。
前記トランジスタ(11’)、トランジスタ(12’)、トランジスタ(21’)、トランジスタ(22’)及びトランジスタ(23’)はN型TFTトランジスタである。
【0045】
本発明は、OLED表示装置をさらに提供する。該OLED表示装置は複数の直列する図5、図6、図15または図16に示す画素ユニット回路を有する。
【0046】
これで分かるように、本発明は、電圧フイードバック技術のAMOLED画素構造を用いることで、OLED素子の劣化及びTFT駆動トランジスタの閾値電圧の不均一性、バックプレーン電源のIR Dropを効果的に補償し、表示效果を向上できる。
【0047】
以上は、本発明のより優れる実施例のみであり、本発明の保護範囲を限定するものではない。
【符号の説明】
【0048】
1、2 サブ回路モジュール
3 コンデンサ
4 OLED
11、12、21、22、23 トランジスタ
24 コンデンサ
【技術分野】
【0001】
本発明は画素ユニット回路及び有機発光ダイオード(Organic Light−Emitting Diode、OLED)表示装置に関する。
【背景技術】
【0002】
電流型発光素子として、OLEDはますます高性能表示に応用されている。表示サイズの増大に伴い、従来のパッシブ・マトリクス有機発光ダイオード(Passive Matrix OLED、PMOLED)表示において、更なる短い1つの画素の駆動時間が要求されるので、瞬間電流を大きくして電力消費を増大する必要がある。それとともに、大きい電流の使用によってインジウムスズ酸化物(ITO)ラインに電圧降下が大きすぎるようになり、OLEDの作業電圧が高すぎるようになり、OLEDの效率が下降してしまう。アクティブマトリクス有機発光ダイオード(Active Matrix OLED、AMOLED)表示は、スイッチトランジスタによって入力されたOLED電流をラインずつにスキャンすることで、上記問題をうまく解決した。
【0003】
AMOLEDバックプレーンを設計するとき、一例として、まず、AMOLEDは、OLED素子に対応する電流を供給するよう低温多結晶シリコン薄膜トランジスタ(LTPS TFT)で画素回路を構成することが多い。LTPS TFTは、一般的な非結晶シリコン薄膜トランジスタ(amorphous−Si TFT)に比べ、より高い移動率及びより安定する特性を有するので、AMOLED表示により適合する。然し、結晶化技術の制限により、大面積のガラス基板に形成されるLTPS TFTは、例えば、閾値電圧、移動率等の電気学パラメータに常に不均一性を有する。この不均一性は、OLEDの電流差異及び輝度差異になってしまい、肉眼に感知される。即ち、ムラ(mura)現象が生じてしまう。
【0004】
第二に、大きいサイズの表示に、バックプレーン電源線にある程度電気抵抗を有し、且全ての画素の駆動電流がバックプレーン正電源(ARVDD)により供給されるので、バックプレーンにおいて、ARVDD電源の供電位置領域に近い電源電圧は供電位置から遠い領域の電源電圧より高い。このような現象はIR Dropと称する。ARVDDの電圧は電流に関わるので、IR Dropによって異なる領域の電流が異なるようになり、表示の時にムラ現象が生じてしまう。
【0005】
第三に、OLED素子が蒸着されるとき、膜厚の不均一によって電気学性能の非均一性ももたらす。図1はOLED輝度、OLED閾値電圧及びOLED作業時間の関係を示す概略図である。図1において、「
【数1】
」は輝度を示し、「
【数2】
」はOLEDの閾値電圧を示す。図1に示すように、長時間の作業を行った後、OLED内部の電気学性能の劣化によって閾値電圧VOLED_0が高くなり、発光效率が下降し、輝度が下降する。
【0006】
現在、OLED素子の劣化を補償することは1つの重要課題になった。OLEDの劣化によって、固定画面を長時間に表示する領域に画像残影(Image Sticking)が生じ、表示效果が影響される。
【0007】
図2はOLEDの輝度損失とOLEDの閾値電圧との関係を示す概略図である。図3はOLEDの輝度と電流密度の関係を示す概略図である。図3において、「
【数3】
」は赤い光のOLEDの輝度と電流密度の関係を示し、「
【数4】
」は緑色光のOLEDの輝度と電流密度の関係を示し、「
【数5】
」は青い光のOLEDと電流密度の関係を示す。図2及び図3に示すように、OLEDの閾値電圧の上昇は輝度損失とほぼリニア関係をなし、OLED電流密度と輝度の関係もリニア関係であるので、OLEDの劣化を補償するとき、OLEDの閾値電圧の増大に従って、OLEDの駆動電流をリニア増加させることで、輝度損失を補償することができる。
【0008】
AMOLEDはドライブのタイプによってデジタル型、電流型及び電圧型に分ける。デジタル型駆動法は、TFTをスイッチとして駆動時間を制御することでグレーレベル(grey level)を実現し、不均一性を補償する必要がないが、作業頻度が表示サイズの増大に伴って倍に上昇し、電力消費が大きくなり、一定の範囲内に設計が物理の極限になるので、大きいサイズの表示に適合ではない。電流型駆動法は、駆動トランジスタに大きさの異なる電流を直接に供給することでグレーレベルを実現し、TFT不均一性及びIR Dropを比較的によく補償できるが、低いグレーレベル信号を書き込みとき、小さい電流でデータラインにおけるより大きい寄生容量を充電することで、書き込み時間が長すぎるようになる。この問題は、大きいサイズ表示で特に厳しくて克服しがたい。電圧型駆動方法は従来のAMLCD駆動方法に類似し、駆動ICによって1つのグレーレベルを示す電圧信号を供給し、該電圧信号は画素回路内で駆動管の電流信号に変換し、OLEDを駆動して輝度グレーレベルを実現する。このような方法は、駆動速度が速く、簡単に実現できるメリットを有し、大きいサイズのパネルの駆動に適合するので、業界に広く採用されたが、余分のTFT及びコンデンサ素子を設計してTFT不均一性及びIR Dropを補償する必要がある。
【0009】
図4は従来技術において2つのTFTトランジスタ、1つのコンデンサ及び1つのOLEDからなる最も伝統的な電圧駆動型画素ユニット回路構造(2T1C)を示す概略図である。それにおいて、スイッチトランジスタT2はデータラインにおけるデータ電圧を駆動トランジスタT1のゲート電極に伝送し、駆動トランジスタT1はこのデータ電圧を対応する電流に転換してOLEDに供給する。正常に作業するとき、駆動トランジスタT1は飽和領域にあり、1つのラインのスキャン時間内に定電流を供給すべきである。その電流は下式で表す。即ち、
【数6】
それにおいて、μPはキャリヤー移動率であり、COXはゲート酸化層容量であり、W/Lはトランジスタの幅と長さの比であり、VDATAはデータ電圧であり、ARVDDはAMOLEDバックプレーンの電源であって全ての画素ユニットに共有され、VThはトランジスタの閾値電圧である。上式から分かるように、異なる画素ユニット間のVThが異なれば、電流が異なるようになる。また、OLED素子の劣化に従って、定電流を供給しても、OLEDの発光輝度が下降する。
【0010】
目前では、VTh均一性及びIR Dropを補償する画素ユニット構造は複数ある。然し、ある画素ユニット構造は駆動トランジスタのVTh不均一性を補償できるが、IR Drop及びOLEDの劣化による輝度損失を補償できない。ある画素ユニット回路は、駆動トランジスタのVTh不均一性及びIR Dropを補償できるが、OLEDの劣化による輝度損失を補償できない。ある画素ユニット回路はVTh不均一性、IR Drop及びOLEDの劣化による影響を補償できるが、電流型駆動であるので、大きいサイズのパネルに応用できない。ある画素ユニット回路は、OLED劣化による影響を補償できるが、VTh不均一性及びIR Dropを補償できない。従って、従来技術に係る画素回路は、TFT駆動トランジスタの閾値電圧VThの不均一性、バックプレーン電源のIR Drop及びOLED劣化による影響を効果的に補償するとともに、大きいサイズのパネルに適用することができない。
【発明の概要】
【課題を解決するための手段】
【0011】
本発明はTFT駆動管の閾値電圧の不均一性、バックプレーン電源のIR Drop及びOLED劣化による影響を効果的に補償できるとともに、大きいサイズのパネルに応用できる画素ユニット回路及びOLED表示装置である。
【0012】
本発明の1つの実施例は、第一のサブ回路モジュール、第二のサブ回路モジュール、第一のコンデンサ及び有機発光表示ダイオードOLEDを有する画素ユニット回路であって、
第一のサブ回路モジュールの一方の入力端がデータラインに接続され、
第一のサブ回路モジュールの他方の入力端が第二のサブ回路モジュールの出力端およびOLEDの第一端に接続され、
第一のサブ回路モジュール的出力端と第二のサブ回路モジュールの入出力端とが第一のコンデンサによって接続され、
第二のサブ回路モジュールの入力端とOLEDの第二端との間にバックプレーンの正負電源の電圧差が印加される。
【0013】
1つの例示では、前記第一のサブ回路モジュールは入力電圧を選択してコンデンサに出力するものであり、前記第二のサブ回路モジュールは入力電圧を電流に転換してOLEDに供給するものである。
【0014】
1つの例示では、前記OLEDの第一端はOLED(4)のアノードで、前記OLEDの第二端はOLED(4)のカソードであり、第一のサブ回路モジュール(1)は、前記他方の入力端がOLED(4)のアノードに接続され、出力端のNDスポットが第一のコンデンサ(3)の一端に接続される。第二のサブ回路モジュール(2)は、入力端がバックプレーンの正電源ARVDDに接続され、入出力端のNGスポットが第一のコンデンサ(3)の他端に接続され、出力端がOLED(4)のアノードに接続され、OLED(4)のカソードがバックプレーンの負電源ARVSSに接続される。
【0015】
好ましいのは、前記第一のサブ回路モジュール(1)は、ゲート電極に制御信号SCANが入力され、ソース電極がデータラインに接続され、ドレイン電極がNDスポットに対応する第一のトランジスタ(11)と、ゲート電極に制御信号EMBが入力され、ドレイン電極がNDスポットに対応し、ソース電極がOLED(4)のアノードに接続される第二のトランジスタ(12)とを備え、前記第一のトランジスタ(11)及び第二のトランジスタ(12)はP型TFTトランジスタである。
【0016】
好ましいのは、前記第二のサブ回路モジュール(2)は、ゲート電極がNGスポットに対応し、ドレイン電極がARVDDに接続7される第三のトランジスタ(21)と、ゲート電極に制御信号EMBが入力され、ドレイン電極がNGスポットに対応し、ソース電極が第三のトランジスタ(21)のソース電極に接続される第四のトランジスタ(22)と、ゲート電極に制御信号EMが入力され、ドレイン電極が第三のトランジスタ(21)のソース電極に接続され、ソース電極がOLED(4)のアノードに接続される第五のトランジスタ(23)と、一端がNGスポットに対応し、他端がARVDDに接続される第二のコンデンサ(24)と、を備え、前記第三のトランジスタ(21)、第四のトランジスタ(22)、第五のトランジスタ(23)はP型TFTトランジスタである。
【0017】
他の例示では、前記OLEDの第一端はOLED(4’)のカソードで、前記OLEDの第二端はOLED(4’)のアノードであり、第一のサブ回路モジュール(1’)は、前記他方の入力端がOLED(4’)のカソードに接続され、出力端のND’スポットが第一のコンデンサ(3’)の一端に接続され、第二のサブ回路モジュール(2’)は、入力端がARVSSに接続され、入出力端のNG’スポットが第一のコンデンサ(3’)の他端に接続され、出力端がOLED(4’)のカソードに接続され、OLED(4’)のアノードがARVDDに接続される。
【0018】
好ましいのは、前記第一のサブ回路モジュール(1’)は、ゲート電極に制御信号SCAN’が入力され、ソース電極がデータラインに接続され、ドレイン電極がND’スポットに対応する第一のトランジスタ(11’)と、ゲート電極に制御信号EMB’が入力され、ドレイン電極がND’スポットに対応し、ソース電極がOLED(4’)のカソードに接続される第二のトランジスタ(12’)と、を備え、前記第一のトランジスタ(11’)及び第二のトランジスタ(12’)はN型TFTトランジスタである。
【0019】
好ましいのは、前記第二のサブ回路モジュール(2’)は、ゲート電極がNG’スポットに対応し、ドレイン電極がARVSSに接続される第三のトランジスタ(21’)と、ゲート電極に制御信号EMB’が入力され、ドレイン電極がNG’スポットに対応し、ソース電極が第三のトランジスタ(21’)のソース電極に接続される第四のトランジスタ(22’)と、ゲート電極に制御信号EM’が入力され、ドレイン電極が第三のトランジスタ(21’)のソース電極に接続され、ソース電極がOLED(4’)のカソードに接続される第五のトランジスタ(23’)と、一端がNG’スポットに対応し、他端がARVSSに接続される第二のコンデンサ(24’)と、を備え、前記第三のトランジスタ(21’)、第四のトランジスタ(22’)及び第五のトランジスタ(23’)はN型TFTトランジスタである。
【0020】
1つの例示では、前記画素ユニット回路は、以下の順で操作される。即ち、第一段階は、SCANをハイレベルにして、EM及びEMBをローレベルにすることで、第二のトランジスタ(12)、第三のトランジスタ(21)、第四のトランジスタ(22)及び第五のトランジスタ(23)がオンされ、第一のトランジスタ(11)がオフされ、第一のコンデンサ(3)が放電され、第二段階は、SCANをハイレベルにして、EMBをローレベルにして、EMをハイレベルにすることで、EMが高くなる瞬間で、第二のトランジスタ(12)、第三のトランジスタ(21)及び第四のトランジスタ(22)がオンされ、第一のトランジスタ(11)及び第五のトランジスタ(23)がオフされ、第三のトランジスタ(21)がダイオード接続を形成し、NGスポット電圧がARVDDに充電されて段々上昇して第三のトランジスタ(21)をオフさせるとともに、NDスポットがOLED(4)に放電され、第三段階は、SCANをローレベルにして、EM及びEMBをハイレベルにすることで、第一のトランジスタ(11)及び第三のトランジスタ(21)がオンされ、第二のトランジスタ(12)、第四のトランジスタ(22)及び第五のトランジスタ(23)がオフされ、第四段階では、SCANをハイレベルにして、EMをローレベルにして、EMBをハイレベルにすることで、第三のトランジスタ(21)及び第五のトランジスタ(23)がオンされ、第一のトランジスタ(11)、第二のトランジスタ(12)及び第四のトランジスタ(22)がオフされ、OLED(4)が発光する。
【0021】
他の例示では、前記画素ユニット回路は以下の順で操作される。即ち、
第一段階は、SCAN’をローレベルにして、EM’及びEMB’をハイレベルにすることで、第二のトランジスタ(12’)、第三のトランジスタ(21’)、第四のトランジスタ(22’)及び第五のトランジスタ(23’)がオンされ、第一のトランジスタ(11’)がオフされ、第一のコンデンサ(3’)が放電され、第二段階は、SCAN’をローレベルにして、EMB’をハイレベルにして、EM’をローレベルにすることで、第二のトランジスタ(12’)、第三のトランジスタ(21’)及び第四のトランジスタ(22’)がオンされ、第一のトランジスタ(11’)及び第五のトランジスタ(23’)がオフされ、第三のトランジスタ(21’)がダイオード接続を形成し、NG’スポットの電圧が第三のトランジスタ(21’)を介してARVSSに放電して段々下降して第三のトランジスタ(21’)をオフさせるとともに、ND’スポットがARVDDに充電され、第三段階は、SCAN’をハイレベルにして、EM’及びEMB’をローレベルにすることで、第一のトランジスタ(11’)及び第三のトランジスタ(21’)がオンされ、第二のトランジスタ(12’)、第四のトランジスタ(22’)及び第五のトランジスタ(23’)がオフされ、第四段階は、SCAN’をローレベルにして、EM’をハイレベルにして、EMB’をローレベルにすることで、第三のトランジスタ(21’)及び第五のトランジスタ(23’)がオンされ、第一のトランジスタ(11’)、第二のトランジスタ(12’)及び第四のトランジスタ(22’)がオフされ、OLED(4’)が発光する。
【0022】
複数の直列する画素ユニット回路を有するOLED表示装置であって、各画素ユニット回路は、第一のサブ回路モジュール、第二のサブ回路モジュール、第一のコンデンサ及び有機発光表示ダイオードOLEDを有し、第一のサブ回路モジュールは、一方の入力端がデータラインに接続され、他方の入力端が第二のサブ回路モジュールの出力端およびOLEDの一端に接続され、第一のサブ回路モジュールの出力端と第二のサブ回路モジュールの入出力端とは第一のコンデンサによって接続され、第二のサブ回路モジュールの入力端とOLEDの他端との間にバックプレーンの正負電源の電圧差が印加される。
【0023】
本発明に係る画素ユニット回路は、従来の画素ユニット回路に比べて、OLED素子の劣化による影響、TFT駆動管の閾値電圧の不均一性及びバックプレーン電源のIR Dropを効果的に補償でき、表示效果を向上できる。さらに、本発明に係る画素ユニット回路は、電圧フイードバック技術に基づいて設計されるものであるので、大きいサイズのパネルに適用できる。
【図面の簡単な説明】
【0024】
【図1】OLED輝度、OLED閾値電圧及びOLED作業時間の関係を示す概略図である。
【図2】OLEDの輝度損失とOLEDの閾値電圧の関係を示す概略図である。
【図3】OLEDの輝度と電流密度の関係を示す概略図である。
【図4】従来技術における電圧駆動型画素ユニットの回路構造を示す概略図である。
【図5】本発明における画素ユニット回路の構造を示す概略図である。
【図6】本発明実施例における画素ユニット回路の詳細構造を示す概略図である。
【図7】本発明実施例におけるSCAN、EM及びEMBの制御信号波形を示す概略図である。
【図8】本発明実施例の第1段階の作業状況を示す概略図である。
【図9】本発明実施例の第2段階の作業状況を示す概略図である。
【図10】本発明実施例の第3段階の作業状況を示す概略図である。
【図11】本発明実施例の第4段階の作業状況を示す概略図である。
【図12】本発明実施例に係る画素ユニット回路で閾値電圧の不均一性を補償する模擬結果を示す概略図である。
【図13】本発明実施例に係る画素ユニット回路でIR Dropを補償する模擬結果を示す概略図である。
【図14】本発明実施例に係る画素ユニット回路でOLED劣化を補償する模擬結果を示す概略図である。
【図15】本発明実施例においてハイレベルでオンされるN型トランジスタによって実現される画素ユニット回路の構造全体を示す概略図である。
【図16】本発明実施例においてハイレベルでオンされるN型トランジスタによって実現される画素ユニット回路の具体的な構造を示す概略図である。
【図17】本発明実施例においてSCAN’、EM’及びEMB’の制御信号波形を示す概略図である。
【発明を実施するための形態】
【0025】
本発明は、第一のサブ回路モジュール、第二のサブ回路モジュール、コンデンサおよび有機発光表示ダイオードOLEDを備える画素ユニット回路において、
第一のサブ回路モジュールの一方の入力端はデータラインに接続され、
第一のサブ回路モジュールの他方の入力端は第二のサブ回路モジュールの出力端及びOLEDの一端に接続され、
第一のサブ回路モジュールの出力端と第二のサブ回路モジュールの入出力端はコンデンサによって接続され、
第二のサブ回路モジュールの入力端とOLEDの他端との間にバックプレーンの正負電源の電圧差が印加される。
【0026】
前記第一のサブ回路モジュールは入力電圧を選択してコンデンサに出力するものであり、前記第二のサブ回路モジュールは入力電圧を電流に転換してOLEDに供給するものである。
【0027】
図5は本発明実施例に係る画素ユニット回路の構造を示す概略図である。図5に示すように、該画素ユニット回路は、サブ回路モジュール1、サブ回路モジュール2、コンデンサ3及びOLED4を有し、サブ回路モジュール1はデータラインとOLED4のアノードにそれぞれ接続される2つの入力端と、コンデンサ3の一端に接続される1つの出力端とを有し、サブ回路モジュール2は、ARVDDに接続される1つの入力端と、コンデンサ3的他端に接続される1つの入出力端と、OLED4のアノードに接続される1つの出力端とを有する。該実施例では、サブ回路モジュール1の出力端もNDスポットと称し、サブ回路モジュール2の入出力端もNGスポットと称する。言い換えれば、該実施例の画素ユニット回路において、サブ回路モジュール1は、入力がデータ電圧VDATA及びOLEDアノードの電圧であり、出力がNDスポットであり。サブ回路モジュール2は、1つの入力信号がARVDDであり、1つの電圧入出力ポートがNGスポットであり、1つの電流出力ポートがOLED4のアノードに接続され、コンデンサ3がNDスポットとNGスポットとの間に接続され、OLED4のカソードがバックプレーンの負電源(ARVSS)に接続される。
【0028】
図5に示す画素ユニット回路において、サブ回路モジュール1は入力電圧(VDATA又はVOLED)を選択してNDに出力するものであり、サブ回路モジュール2は入力電圧を電流に転換してOLED供給するものであり、その出力をf(VNG,ARVDD,VTh)=IOLEDという式で表し、それは2つの段階によって作業を行う。即ち、第一段階は補償段階であり、この段階では、NDスポットの電圧がVOLED_0(VOLED_0がOLED閾値電圧である)に制御され、このとき、サブ回路モジュール2のNGスポットが出力ポートになり、NGスポットの電圧がARVDD+VThに制御され、VThは画素ユニット回路に用いられるトランジスタの閾値電圧である。第二段階は演算段階であり、該段階では、サブ回路モジュール1が出力するNDスポット電圧がVDATAに制御され、このとき、サブ回路モジュール2のNGスポットが入力ポートになり、コンデンサのブートストラップ効果によって、NGスポット電圧がk・(VDATA−VOLED_0)+ARVDD+VThになり、サブ回路モジュール2はこの入力電圧を電流に転化し、転化中に上述のNGスポット電圧を表す式におけるARVDDとVThの項を消去して、出力電流をARVDD、VThと無関係にさせ、つまり、閾値電圧の不均一性とIR Dropを補償するとともに、サブ回路モジュール2は出力電流をVOLED_0と正比例にして、即ち、VOLED_0が大きいほど出力電流が大きくなり、比例係数kによって両者の関係を調節して、OLEDの減衰による電流の下降、発光効率の低下による影響を補償する。該画素ユニット回路は従来の画素構造に比べてOLED素子の劣化及びTFT駆動管の閾値電圧の不均一性、バックプレーン電源のIR Dropを効果的に補償できる。
【0029】
図6は本発明実施例に係る画素ユニット回路の詳細構造を示す概略図である。図6に示すように、該画素ユニット回路は、5つのP型TFTトランジスタ、1つのOLED及び2つのコンデンサからなり、ARVDDはハイレベルの電源信号であり、ARVSSはローレベルの電源信号であり、回路全体は3つの制御信号SCAN、EM及びEMBに制御される。図7はSCAN、EM及びEMBの制御信号波形を示す。
【0030】
図5及び図6に示すように、サブ回路モジュール1はトランジスタ11及びトランジスタ12を備え、サブ回路モジュール2はトランジスタ21、トランジスタ22、トランジスタ23及びコンデンサ24を備え、
トランジスタ11はゲート電極に制御信号SCANが入力され、ソース電極がデータラインに接続され、ドレイン電極がNDスポットに対応し、
トランジスタ12はゲート電極に制御信号EMBが入力され、ドレイン電極がNDスポット(即ち、トランジスタ12のドレイン電極とトランジスタ11のドレイン電極とが接続される)に対応し、ソース電極がOLED4のアノードに接続され、
トランジスタ21はゲート電極がNGスポットに対応し、ドレイン電極にARVDDが入力され、
トランジスタ22はゲート電極に制御信号EMBが入力され、ドレイン電極がNGスポットに対応し、ソース電極がトランジスタ21のソース電極に接続され、
トランジスタ23はゲート電極に制御信号EMが入力され、ドレイン電極がトランジスタ21のソース電極に接続され、ソース電極がOLED4のアノードに接続され、
コンデンサ24は一端がNGスポットに対応し、他端がARVDDに接続される。
【0031】
これから分かるように、サブ回路モジュール1は、2つの入力端がそれぞれトランジスタ11及びトランジスタ12のソース電極に対応し、出力端がトランジスタ11またはトランジスタ12のドレイン電極に対応する。サブ回路モジュール2は、入力端がトランジスタ21のドレイン電極に対応し、入出力端がトランジスタ21のゲート電極に対応し、出力端がトランジスタ23のソース電極に対応する。
【0032】
図6に示す画素ユニット回路は、図7に示す制御信号波形に基づき、作業が以下の4つの段階に分ける。
第1段階はプレチャージ段階である。図8に示すように、この段階では、SCANがハイレベルであり、EM及びEMBがローレベルである。この時、トランジスタ21、トランジスタ22、トランジスタ12及びトランジスタ23がオンされ、トランジスタ11がオフされ、コンデンサ3が放電され、NGスポットの電位はARVDD+VThPより小さく、VThPがP型TFTトランジスタ21の閾値電圧(VThP<0)である。
第2段階は補償段階である。図9に示すように、この段階では、SCANがハイレベルであり、EMBがローレベルであり,EMがハイレベルである。EMが高くなる瞬間で、トランジスタ21、トランジスタ22及びトランジスタ12がオンされ、トランジスタ11、トランジスタ23がオフされる。トランジスタ21がダイオード接続を形成し、NGスポットの電圧がARVDDにより充電されて段々ARVDD+VThPまで上昇してトランジスタ21をオフさせるとともに、OLED4がオフされ電流が流れなくなるまでNDスポットがOLED4により放電される。この時、ND電圧がVOLED_0、即ち、OLED4の閾値電圧になる。
第3段階は演算段階である。図10に示すように、この段階では、SCANがローレベルであり、EM及びEMBがハイレベルである。トランジスタ21及びトランジスタ11がオンされ、トランジスタ22、トランジスタ12及びトランジスタ23がオフされる。この時、データラインの電圧がコンデンサ3のNDスポットに印加される。NGスポットには直流通路がないので、該スポットの電荷総量は、下式のように、段階2に対して不変すべきである。
【数7】
演算して、
【数8】
を得る。
第4段階は保持発光段階、図11に示すように、この段階では、SCANがハイレベルであり、EMがローレベルであり、EMBがハイレベルである。トランジスタ21及びトランジスタ23がオンされ、トランジスタ22、トランジスタ11及びトランジスタ12がオフされる。この時、NGスポットの電圧がコンデンサ24に保存され、トランジスタ23がオンされた後、電流がOLED4に供給されてそれを発光させる。この時、トランジスタ21を流れる電流は、
【数9】
上記の式から分かるように、トランジスタ21を流れる電流はトランジスタ閾値電圧及びARVDDに関係ないので、本実施例における画素ユニット回路は、トランジスタ閾値電圧の不均一性及びIR Dropの影響をほぼ除去した。
【0033】
図12は本発明実施例に係る画素ユニット回路でトランジスタ閾値電圧の不均一性を補償する模擬結果を示す概略図である。この図において、「
【数10】
」は従来構造の2T1Cでトランジスタ閾値電圧とIOLEDとの関係を示し、「
【数11】
」は本実施例の構造の5T2Cでトランジスタ閾値電圧とIOLEDとの関係を示す。図12に示すように、従来構造の2T1Cに基づき、トランジスタ閾値電圧が±0.6Vドリフトした場合に、その電流が最大1.8倍以上ドリフトする可能性がある。本実施例における5T2Cの構造に基づき、閾値電圧が±0.6Vドリフトした場合に、その電流の波動は2.5%より小さい。
【0034】
図13は本発明実施例に係る画素ユニット回路でIR Dropを補償する模擬結果を示す概略図である。この図において、「
【数12】
」は従来構造の2T1CでARVDD電圧降下とIOLEDとの関係を示し、「
【数13】
」は本実施例における5T2C構造でARVDD電圧降下とIOLEDとの関係を示す。図13に示すように、従来構造の2T1Cに基づき、ARVDD電圧降下のドリフトが±0.5Vであり、その電流の最大が81%ドリフトする。本実施例における5T2Cの構造に基づき、ARVDD電圧降下のドリフトが±0.5Vである場合に、その電流波動は3.5%以下である。
【0035】
それとともに、電流IOLEDはOLEDの閾値電圧VOLED_0に関連し、OLEDの劣化による輝度損失を補償できる。OLED素子が劣化するとき、VOLED_0は段々大きくなり、発光效率が下降するので、同じ輝度を維持するにはトランジスタ21を駆動してより大きい電流を提供する必要がある。実際の応用に、VDATA<0かつVDATA<VOLED_0にすれば、VOLED_0の増大に従い、|VDATA−VOLED_0|が大きくなり、IOLEDを増大させ、OLEDの輝度損失を補償する。
【0036】
テーラー(Taylor)展開から分かるように、OLED閾値電圧がドリフトすれば、ドリフト後の閾値電圧はV’OLED_0=VOLED_0+ΔVOLED_0ように表せるので、IOLEDはΔVOLED_0に対して一次元近似展開式が以下のとおりである。
【数14】
IOLEDとΔVOLED_0はリニア関係をなすので、具体的に実施するとき、OLED劣化の測定結果により、コンデンサ24とコンデンサ3の容量比例を調節することでそのVOLED_0の係数を調節し、輝度−ΔVOLED_0曲線と相補にさせ、OLEDの劣化による輝度損失をちょうど補償する。
【0037】
図14は本発明実施例に係る画素ユニット回路ではOLED劣化を補償する模擬結果を示す概略図である。この図において、「
【数15】
」は従来構造の2T1CでOLED閾値電圧とIOLEDとの関係を示し、「
【数16】
」は本実施例に係る5T2CでOLEDの閾値電圧とIOLEDとの関係を示す。図14に示すように、従来構造の2T1Cに基づき、OLED閾値電圧が0〜0.8Vドリフトしたとき、その電流は遅く減少する傾向があるので、表示輝度の下降が激しくなる。それに対して、本実施例の構造の5T2Cに基づき、電流はOLEDの閾値電圧の増大に従って同期リニアに増加し、OLEDの輝度損失を効果的に補償できる。コンデンサ24とコンデンサ3の容量比例を調節することは、電流の増加速度及び範囲を制御できる。
【0038】
エミュレーション比較により、本実施例に係る画素ユニット回路を用いることは、トランジスタ閾値電圧の不均一性及びIR Dropを効果的に補償でき、電流のドリフトをそれぞれ2.5%及び3.5%程度に制御でき、大きいサイズのパネル表示に適合である。特に、該実施例はOLEDの劣化による輝度損失を補償でき、製品の寿命を効果的に向上できる。
【0039】
また、本発明の画素ユニット回路は、ローレベルでオンされるP型トランジスタによって実現できるだけでなく(図6に示すように)、ハイレベルでオンされるN型トランジスタによっても実現できることに注意する必要がある。図15は、本発明の他の実施例に係るハイレベルでオンされるN型トランジスタの画素ユニット回路の構造全体を示し、図16はその具体的な構造を示し、図17は対応するSCAN’、EM’及びEMB’の制御信号波形を示す。
【0040】
図15に示すように、該実施例に係る画素ユニット回路は、サブ回路モジュール1’、サブ回路モジュール2’、コンデンサ3’及びOLED 4’を備え、サブ回路モジュール1’は、データライン及びOLEDカソードに接続される2つの入力端と、コンデンサ3’の一端に接続されND’スポットに対応する1つの出力端とを有し、サブ回路モジュール2’は、ARVSSに接続される1つの入力端と、コンデンサ3’の他端に接続されかつNG’スポットの他端に対応する1つの入出力端と、OLED 4’のカソードに接続される1つの出力端とを有し、OLED 4’のアノードはARVDDに接続される。
【0041】
図16に示すように、サブ回路モジュール1’は、トランジスタ11’及びトランジスタ12’を有し、前記トランジスタ11’及びトランジスタ12’はN型TFTトランジスタである。トランジスタ11’は、ゲート電極に制御信号SCAN’が入力され、ソース電極がデータラインに接続され、ドレイン電極がND’スポットに対応する。トランジスタ12’は、ゲート電極に制御信号EMB’が入力され、ドレイン電極がND’スポットに対応し、ソース電極がOLED4’のカソードに接続される。
【0042】
サブ回路モジュール2’はトランジスタ21’、トランジスタ22’、トランジスタ23’及びコンデンサ24’を備える。前記トランジスタ21’、トランジスタ22’及びトランジスタ23’はN型TFTトランジスタである。トランジスタ21’は、ゲート電極がNG’スポットに対応し、ドレイン電極がARVSSに接続される。トランジスタ22’は、ゲート電極に制御信号EMB’が入力され、ドレイン電極がNG’スポットに対応し、ソース電極がトランジスタ21’のソース電極に接続される。トランジスタ23’は、ゲート電極に制御信号EM’が入力され、ドレイン電極がトランジスタ21’のソース電極に接続され、ソース電極がOLED 4’のカソードに接続される。コンデンサ24’は、一端がNG’スポットに対応し、他端がARVSSに接続される。
【0043】
図15に示す画素ユニット回路の作業は、2つの段階に分ける。第一段階は補償段階である。該段階では、ND’スポット電圧がARVDD−VOLED_0に制御され、この時、サブ回路モジュール2のNG’スポットが出力ポートであり、NG’スポットの電圧がVThに制御され、VThは画素ユニット回路に用いられるトランジスタの閾値電圧である。第二段階は演算段階である。該段階では、サブ回路モジュール1が出力するND’スポット電圧がVDATAに制御され、この時、サブ回路モジュール2のNG’スポットは入力ポートであり、このとき、コンデンサのブートストラップ効果により、NG’スポット電圧をk・(VDATA− ARVDD−VOLED_0)+ VThに変更する。
【0044】
図16に示す画素ユニット回路は、図17に示す制御信号波形に基づき、作業が以下の4つの段階に分ける。
第一段階は、SCAN’がローレベルであり、EM’及びEMB’がハイレベルである。これによって、トランジスタ(21’)、トランジスタ(22’)、トランジスタ(12’)及びトランジスタ(23’)がオンされ、トランジスタ(11’)がオフされ、コンデンサ(3’)が放電される。
第二段階は、SCAN’がローレベルであり、EMB’がハイレベルであり、EM’がローレベルである。これによって、トランジスタ(21’)、トランジスタ(22’)及びトランジスタ(12’)がオンされ、トランジスタ(11’)及びトランジスタ(23’)がオフされ、トランジスタ(21’)がダイオード接続を形成し、NG’スポット電圧がトランジスタ(21’)によってARVSSへ放電されて段々下降してトランジスタ(21’)をオフさせるとともに、ND’スポットがARVDDにより充電される。
第三段階では、SCAN’がハイレベルであり、EM’、EMB’がローレベルである。これによって、トランジスタ(21’)及びトランジスタ(11’)がオンされ、トランジスタ(22’)、トランジスタ(12’)及びトランジスタ(23’)がオフされる。
第四段階では、SCAN’がローレベルであり、EM’がハイレベルであり、EMB’がローレベルである。これによって、トランジスタ(21’)及びトランジスタ(23’)がオンされ、トランジスタ(22’)、トランジスタ(11’)及びトランジスタ(12’)がオフされ、OLED(4’)が発光する。
前記トランジスタ(11’)、トランジスタ(12’)、トランジスタ(21’)、トランジスタ(22’)及びトランジスタ(23’)はN型TFTトランジスタである。
【0045】
本発明は、OLED表示装置をさらに提供する。該OLED表示装置は複数の直列する図5、図6、図15または図16に示す画素ユニット回路を有する。
【0046】
これで分かるように、本発明は、電圧フイードバック技術のAMOLED画素構造を用いることで、OLED素子の劣化及びTFT駆動トランジスタの閾値電圧の不均一性、バックプレーン電源のIR Dropを効果的に補償し、表示效果を向上できる。
【0047】
以上は、本発明のより優れる実施例のみであり、本発明の保護範囲を限定するものではない。
【符号の説明】
【0048】
1、2 サブ回路モジュール
3 コンデンサ
4 OLED
11、12、21、22、23 トランジスタ
24 コンデンサ
【特許請求の範囲】
【請求項1】
第一のサブ回路モジュール、第二のサブ回路モジュール、第一のコンデンサ及び有機発光表示ダイオードOLEDを備える画素ユニット回路において、
第一のサブ回路モジュールの一方の入力端がデータラインに接続され、
第一のサブ回路モジュールの他方の入力端が第二のサブ回路モジュールの出力端及びOLEDの第一端に接続され、
第一のサブ回路モジュールの出力端と第二のサブ回路モジュールの入出力端は第一のコンデンサによって接続され、
第二のサブ回路モジュールの入力端とOLEDの第二端との間にバックプレーンの正負電源の電圧差が印加される画素ユニット回路。
【請求項2】
前記第一のサブ回路モジュールは入力電圧を選択して第一のコンデンサに出力するものであり、
前記第二のサブ回路モジュールは入力電圧を電流に変換してOLEDに供給するものである請求項1に記載の画素ユニット回路。
【請求項3】
前記OLEDの第一端はOLED(4)のアノードで、前記OLEDの第二端はOLED(4)のカソードであり、
第一のサブ回路モジュール(1)は、前記他方の入力端がOLED(4)のアノードに接続され、出力端のNDスポットが第一のコンデンサ(3)の一端に接続され、
第二のサブ回路モジュール(2)は、入力端がバックプレーンの正電源ARVDDに接続され、入出力端のNGスポットが第一のコンデンサ(3)の他端に接続され、出力端がOLED(4)のアノードに接続され、
OLED(4)は、カソードがバックプレーンの負電源ARVSSに接続される請求項1に記載の画素ユニット回路。
【請求項4】
前記第一のサブ回路モジュール(1)は、ゲート電極に制御信号SCANが入力され、ソース電極にデータラインが接続され、ドレイン電極がNDスポットに対応する第一のトランジスタ(11)と、
ゲート電極に制御信号EMBが入力し、ドレイン電極がNDスポットに対応し、ソース電極にOLED(4)のアノードが接続される第二のトランジスタ(12)と、を備え、
前記第一のトランジスタ(11)及び第二のトランジスタ(12)はP型TFTトランジスタである請求項3に記載の画素ユニット回路。
【請求項5】
前記第二のサブ回路モジュール(2)は、ゲート電極がNGスポットに対応し、ドレイン電極がARVDDに接続される第三のトランジスタ(21)と、
ゲート電極に制御信号EMBが入力され、ドレイン電極がNGスポットに対応し、ソース電極が第三のトランジスタ(21)のソース電極に接続される第四のトランジスタ(22)と、
ゲート電極に制御信号EMが入力され、ドレイン電極が第三のトランジスタ(21)のソース電極に接続され、ソース電極がOLED(4)のアノードに接続される第五のトランジスタ(23)と、
一端がNGスポットに対応し、他端がARVDDに接続される第二のコンデンサ(24)と、を備え、
前記第三のトランジスタ(21)、第四のトランジスタ(22)及び第五のトランジスタ(23)はP型TFTトランジスタである請求項4に記載の画素ユニット回路。
【請求項6】
前記OLEDの第一端はOLED(4’)のカソードで、前記OLEDの第二端はOLED(4’)のアノードであり、
第一のサブ回路モジュール(1’)は、前記他方の入力端がOLED(4’)のカソードに接続され、出力端のND’スポットが第一のコンデンサ(3’)の一端に接続され、
第二のサブ回路モジュール(2’)は、入力端がARVSSに接続され、入出力端のNG’スポットが第一のコンデンサ(3’)の他端に接続され、出力端がOLED(4’)のカソードに接続され、
OLED(4’)はアノードがARVDDに接続される請求項1に記載の画素ユニット回路。
【請求項7】
前記第一のサブ回路モジュール(1’)は、ゲート電極に制御信号SCAN’が入力され、ソース電極がデータラインに接続され、ドレイン電極がND’スポットに対応する第一のトランジスタ(11’)と、
ゲート電極に制御信号EMB’が入力され、ドレイン電極がND’スポットに対応し、ソース電極がOLED(4’)のカソードに接続される第二のトランジスタ(12’)と、を有し、
前記第一のトランジスタ(11’)及び第二のトランジスタ(12’)はN型TFTトランジスタである請求項6に記載の画素ユニット回路。
【請求項8】
前記第二のサブ回路モジュール(2’)は、ゲート電極がNG’スポットに対応し、ドレイン電極がARVSSに接続される第三のトランジスタ(21’)と、
ゲート電極に制御信号EMB’が入力され、ドレイン電極がNG’スポットに対応し、ソース電極が第三のトランジスタ(21’)のソース電極に接続される第四のトランジスタ(22’)と、
ゲート電極に制御信号EM’が入力され、ドレイン電極が第三のトランジスタ(21’)のソース電極に接続され、ソース電極がOLED(4’)のカソードに接続される第五のトランジスタ(23’)と、
一端がNG’スポットに対応し、他端がARVSSに接続される第二のコンデンサ(24’)と、を備え、
前記第三のトランジスタ(21’)、第四のトランジスタ(22’)及び第五のトランジスタ(23’)はN型TFTトランジスタである請求項7に記載の画素ユニット回路。
【請求項9】
前記画素ユニット回路は、
SCANをハイレベルにして、EM及びEMBをローレベルにすることで、第二のトランジスタ(12)、第三のトランジスタ(21)、第四のトランジスタ(22)及び第五のトランジスタ(23)がオンされ、第一のトランジスタ(11)がオフされ、第一のコンデンサ(3)が放電される第一段階と、
SCANをハイレベルにして、EMBをローレベルにして、EMをハイレベルにすることで、EMが高くなる瞬間で、第二のトランジスタ(12)、第三のトランジスタ(21)及び第四のトランジスタ(22)がオンされ、第一のトランジスタ(11)及び第五のトランジスタ(23)がオフされ、第三のトランジスタ(21)がダイオード接続を形成し、NGスポットの電圧がARVDDに充電されて段々上昇して第三のトランジスタ(21)をオフさせるとともに、NDスポットがOLED(4)に放電される第二段階と、
SCANをローレベルにして、EM及びEMBをハイレベルにすることで、第一のトランジスタ(11)及び第三のトランジスタ(21)がオンされ、第二のトランジスタ(12)、第四のトランジスタ(22)及び第五のトランジスタ(23)がオフされる第三段階と、
SCANをハイレベルにして、EMをローレベルにして、EMBをハイレベルにすることで、第三のトランジスタ(21)及び第五のトランジスタ(23)がオンされ、第一のトランジスタ(11)、第二のトランジスタ(12)及び第四のトランジスタ(22)がオフされ、OLED(4)が発光する第四段階という順で操作される請求項5に記載の画素ユニット回路。
【請求項10】
前記画素ユニット回路は、
SCAN’をローレベルにして、EM’及びEMB’をハイレベルにすることで、第二のトランジスタ(12’)、第三のトランジスタ(21’)、第四のトランジスタ(22’)及び第五のトランジスタ(23’)がオンされ、第一のトランジスタ(11’)がオフされ、第一のコンデンサ(3’)が放電される第一段階と、
SCAN’をローレベルにして、EMB’をハイレベルにして、EM’をローレベルにすることで、第二のトランジスタ(12’)、第三のトランジスタ(21’)及び第四のトランジスタ(22’)がオンされ、第一のトランジスタ(11’)及び第五のトランジスタ(23’)がオフされ、第三のトランジスタ(21’)がダイオード接続を形成し、NG’スポット電圧が第三のトランジスタ(21’)によってARVSSに放電して段々下降して第三のトランジスタ(21’)をオフさせるとともに、ND’スポットがARVDDに充電される第二段階と、
SCAN’をハイレベルにして、EM’及びEMB’をローレベルにすることで、第一のトランジスタ(11’)及び第三のトランジスタ(21’)がオンされ、第二のトランジスタ(12’)、第四のトランジスタ(22’)及び第五のトランジスタ(23’)がオフされる第三段階と、
SCAN’をローレベルにして、EM’をハイレベルにして、EMB’をローレベルにすることで、第三のトランジスタ(21’)及び第五のトランジスタ(23’)がオンされ、第一のトランジスタ(11’)、第二のトランジスタ(12’)及び第四のトランジスタ(22’)がオフされ、OLED(4’)が発光する第四段階という順で操作される請求項8に記載の画素ユニット回路。
【請求項11】
複数の直列する請求項1〜10のいずれか1項に記載の画素ユニット回路を有することを特徴とするOLED表示装置。
【請求項1】
第一のサブ回路モジュール、第二のサブ回路モジュール、第一のコンデンサ及び有機発光表示ダイオードOLEDを備える画素ユニット回路において、
第一のサブ回路モジュールの一方の入力端がデータラインに接続され、
第一のサブ回路モジュールの他方の入力端が第二のサブ回路モジュールの出力端及びOLEDの第一端に接続され、
第一のサブ回路モジュールの出力端と第二のサブ回路モジュールの入出力端は第一のコンデンサによって接続され、
第二のサブ回路モジュールの入力端とOLEDの第二端との間にバックプレーンの正負電源の電圧差が印加される画素ユニット回路。
【請求項2】
前記第一のサブ回路モジュールは入力電圧を選択して第一のコンデンサに出力するものであり、
前記第二のサブ回路モジュールは入力電圧を電流に変換してOLEDに供給するものである請求項1に記載の画素ユニット回路。
【請求項3】
前記OLEDの第一端はOLED(4)のアノードで、前記OLEDの第二端はOLED(4)のカソードであり、
第一のサブ回路モジュール(1)は、前記他方の入力端がOLED(4)のアノードに接続され、出力端のNDスポットが第一のコンデンサ(3)の一端に接続され、
第二のサブ回路モジュール(2)は、入力端がバックプレーンの正電源ARVDDに接続され、入出力端のNGスポットが第一のコンデンサ(3)の他端に接続され、出力端がOLED(4)のアノードに接続され、
OLED(4)は、カソードがバックプレーンの負電源ARVSSに接続される請求項1に記載の画素ユニット回路。
【請求項4】
前記第一のサブ回路モジュール(1)は、ゲート電極に制御信号SCANが入力され、ソース電極にデータラインが接続され、ドレイン電極がNDスポットに対応する第一のトランジスタ(11)と、
ゲート電極に制御信号EMBが入力し、ドレイン電極がNDスポットに対応し、ソース電極にOLED(4)のアノードが接続される第二のトランジスタ(12)と、を備え、
前記第一のトランジスタ(11)及び第二のトランジスタ(12)はP型TFTトランジスタである請求項3に記載の画素ユニット回路。
【請求項5】
前記第二のサブ回路モジュール(2)は、ゲート電極がNGスポットに対応し、ドレイン電極がARVDDに接続される第三のトランジスタ(21)と、
ゲート電極に制御信号EMBが入力され、ドレイン電極がNGスポットに対応し、ソース電極が第三のトランジスタ(21)のソース電極に接続される第四のトランジスタ(22)と、
ゲート電極に制御信号EMが入力され、ドレイン電極が第三のトランジスタ(21)のソース電極に接続され、ソース電極がOLED(4)のアノードに接続される第五のトランジスタ(23)と、
一端がNGスポットに対応し、他端がARVDDに接続される第二のコンデンサ(24)と、を備え、
前記第三のトランジスタ(21)、第四のトランジスタ(22)及び第五のトランジスタ(23)はP型TFTトランジスタである請求項4に記載の画素ユニット回路。
【請求項6】
前記OLEDの第一端はOLED(4’)のカソードで、前記OLEDの第二端はOLED(4’)のアノードであり、
第一のサブ回路モジュール(1’)は、前記他方の入力端がOLED(4’)のカソードに接続され、出力端のND’スポットが第一のコンデンサ(3’)の一端に接続され、
第二のサブ回路モジュール(2’)は、入力端がARVSSに接続され、入出力端のNG’スポットが第一のコンデンサ(3’)の他端に接続され、出力端がOLED(4’)のカソードに接続され、
OLED(4’)はアノードがARVDDに接続される請求項1に記載の画素ユニット回路。
【請求項7】
前記第一のサブ回路モジュール(1’)は、ゲート電極に制御信号SCAN’が入力され、ソース電極がデータラインに接続され、ドレイン電極がND’スポットに対応する第一のトランジスタ(11’)と、
ゲート電極に制御信号EMB’が入力され、ドレイン電極がND’スポットに対応し、ソース電極がOLED(4’)のカソードに接続される第二のトランジスタ(12’)と、を有し、
前記第一のトランジスタ(11’)及び第二のトランジスタ(12’)はN型TFTトランジスタである請求項6に記載の画素ユニット回路。
【請求項8】
前記第二のサブ回路モジュール(2’)は、ゲート電極がNG’スポットに対応し、ドレイン電極がARVSSに接続される第三のトランジスタ(21’)と、
ゲート電極に制御信号EMB’が入力され、ドレイン電極がNG’スポットに対応し、ソース電極が第三のトランジスタ(21’)のソース電極に接続される第四のトランジスタ(22’)と、
ゲート電極に制御信号EM’が入力され、ドレイン電極が第三のトランジスタ(21’)のソース電極に接続され、ソース電極がOLED(4’)のカソードに接続される第五のトランジスタ(23’)と、
一端がNG’スポットに対応し、他端がARVSSに接続される第二のコンデンサ(24’)と、を備え、
前記第三のトランジスタ(21’)、第四のトランジスタ(22’)及び第五のトランジスタ(23’)はN型TFTトランジスタである請求項7に記載の画素ユニット回路。
【請求項9】
前記画素ユニット回路は、
SCANをハイレベルにして、EM及びEMBをローレベルにすることで、第二のトランジスタ(12)、第三のトランジスタ(21)、第四のトランジスタ(22)及び第五のトランジスタ(23)がオンされ、第一のトランジスタ(11)がオフされ、第一のコンデンサ(3)が放電される第一段階と、
SCANをハイレベルにして、EMBをローレベルにして、EMをハイレベルにすることで、EMが高くなる瞬間で、第二のトランジスタ(12)、第三のトランジスタ(21)及び第四のトランジスタ(22)がオンされ、第一のトランジスタ(11)及び第五のトランジスタ(23)がオフされ、第三のトランジスタ(21)がダイオード接続を形成し、NGスポットの電圧がARVDDに充電されて段々上昇して第三のトランジスタ(21)をオフさせるとともに、NDスポットがOLED(4)に放電される第二段階と、
SCANをローレベルにして、EM及びEMBをハイレベルにすることで、第一のトランジスタ(11)及び第三のトランジスタ(21)がオンされ、第二のトランジスタ(12)、第四のトランジスタ(22)及び第五のトランジスタ(23)がオフされる第三段階と、
SCANをハイレベルにして、EMをローレベルにして、EMBをハイレベルにすることで、第三のトランジスタ(21)及び第五のトランジスタ(23)がオンされ、第一のトランジスタ(11)、第二のトランジスタ(12)及び第四のトランジスタ(22)がオフされ、OLED(4)が発光する第四段階という順で操作される請求項5に記載の画素ユニット回路。
【請求項10】
前記画素ユニット回路は、
SCAN’をローレベルにして、EM’及びEMB’をハイレベルにすることで、第二のトランジスタ(12’)、第三のトランジスタ(21’)、第四のトランジスタ(22’)及び第五のトランジスタ(23’)がオンされ、第一のトランジスタ(11’)がオフされ、第一のコンデンサ(3’)が放電される第一段階と、
SCAN’をローレベルにして、EMB’をハイレベルにして、EM’をローレベルにすることで、第二のトランジスタ(12’)、第三のトランジスタ(21’)及び第四のトランジスタ(22’)がオンされ、第一のトランジスタ(11’)及び第五のトランジスタ(23’)がオフされ、第三のトランジスタ(21’)がダイオード接続を形成し、NG’スポット電圧が第三のトランジスタ(21’)によってARVSSに放電して段々下降して第三のトランジスタ(21’)をオフさせるとともに、ND’スポットがARVDDに充電される第二段階と、
SCAN’をハイレベルにして、EM’及びEMB’をローレベルにすることで、第一のトランジスタ(11’)及び第三のトランジスタ(21’)がオンされ、第二のトランジスタ(12’)、第四のトランジスタ(22’)及び第五のトランジスタ(23’)がオフされる第三段階と、
SCAN’をローレベルにして、EM’をハイレベルにして、EMB’をローレベルにすることで、第三のトランジスタ(21’)及び第五のトランジスタ(23’)がオンされ、第一のトランジスタ(11’)、第二のトランジスタ(12’)及び第四のトランジスタ(22’)がオフされ、OLED(4’)が発光する第四段階という順で操作される請求項8に記載の画素ユニット回路。
【請求項11】
複数の直列する請求項1〜10のいずれか1項に記載の画素ユニット回路を有することを特徴とするOLED表示装置。
【図1】
【図2】
【図4】
【図5】
【図6】
【図7】
【図8】
【図9】
【図10】
【図11】
【図12】
【図13】
【図14】
【図15】
【図16】
【図17】
【図3】
【図2】
【図4】
【図5】
【図6】
【図7】
【図8】
【図9】
【図10】
【図11】
【図12】
【図13】
【図14】
【図15】
【図16】
【図17】
【図3】
【公開番号】特開2012−242838(P2012−242838A)
【公開日】平成24年12月10日(2012.12.10)
【国際特許分類】
【出願番号】特願2012−114306(P2012−114306)
【出願日】平成24年5月18日(2012.5.18)
【出願人】(510280589)京東方科技集團股▲ふん▼有限公司 (35)
【Fターム(参考)】
【公開日】平成24年12月10日(2012.12.10)
【国際特許分類】
【出願日】平成24年5月18日(2012.5.18)
【出願人】(510280589)京東方科技集團股▲ふん▼有限公司 (35)
【Fターム(参考)】
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