【課題】薄層化された自立性のシリコン単結晶膜を提供し、また、剥離時の熱処理温度を格段に低減することができる新たなシリコン単結晶膜の形成方法を提供する。
【解決手段】シリコン単結晶膜６は、Ｓｉの含有率が、９０原子％以上であり、厚みが、５０μｍ以下であり、自立性がある。 （もっと読む）

【課題】 本発明は、ＳＯＩ層の膜厚の面内均一性の良好なＳＯＩウェーハを製造する方法を提供することを目的とする。
【解決手段】 イオン注入層が形成されたボンドウェーハのイオン注入された側の表面とベースウェーハの表面とを絶縁膜を介して貼り合わせた後、前記ボンドウェーハの一部を前記イオン注入層で剥離して、貼り合わせＳＯＩウェーハを作製し、その後、平坦化処理を行う貼り合わせＳＯＩウェーハの製造方法であって、
前記剥離後の貼り合わせＳＯＩウェーハに対し、前記ＳＯＩ層表面の周辺部の自然酸化膜が除去され、中央部の自然酸化膜が残存するように、水素ガスを含む雰囲気でＲＴＡ処理を行い、前記中央部に自然酸化膜が残存した貼り合わせＳＯＩウェーハに対し、前記ＳＯＩ層の面内膜厚レンジが１．５ｎｍ以下となるように前記平坦化処理を行うことを特徴とする貼り合わせＳＯＩウェーハの製造方法。 （もっと読む）

【課題】支持基板と酸化物膜との接合強度および酸化物膜とＩＩＩ族窒化物層との接合強度が高いＩＩＩ族窒化物複合基板を提供する。
【解決手段】本ＩＩＩ族窒化物複合基板１は、支持基板１０と酸化物膜２０とＩＩＩ族窒化物層３０ａとを含み、支持基板１０は多結晶で形成され、ＩＩＩ族窒化物層３０ａは少なくともｃ軸方向に配向しているＩＩＩ族窒化物結晶で形成され、酸化物膜２０は不純物が添加され、不純物の濃度は、酸化物膜２０において支持基板１０側の第１主面２０ｓからＩＩＩ族窒化物層３０ａ側の第２主面２０ｔにかけて膜厚方向で変化し、第１主面２０ｓにおける不純物の濃度は第２主面２０ｔにおける不純物の濃度よりも高い。 （もっと読む）

【課題】複数のトランジスタが高集積化された素子の少なくとも一のトランジスタに、作製工程数を増加させることなくバックゲートを設ける半導体装置を提供する。
【解決手段】複数のトランジスタが上下に積層されて設けられた素子において、少なくとも上部のトランジスタ１０２は、半導体特性を示す金属酸化物により設けられ、下部のトランジスタ１００が有するゲート電極層を上部のトランジスタのチャネル形成領域と重畳するように配して、ゲート電極層と同一の層の一部を上部のトランジスタ１０２のバックゲートＢＧとして機能させる。下部のトランジスタ１００は、絶縁層で覆われた状態で平坦化処理が施され、ゲート電極が露出され、上部のトランジスタ１０２のソース電極及びドレイン電極となる層に接続されている。 （もっと読む）

【課題】半導体基板の再生に適した方法を提供する。
【解決手段】損傷半導体領域と絶縁層とを含む凸部が周縁部に存在する半導体基板に対し、絶縁層を除去するエッチング処理と、硝酸、硝酸によって酸化された半導体基板を構成する半導体材料を溶解する物質、半導体材料の酸化速度及び酸化された半導体材料の溶解速度を制御する物質、及び亜硝酸を含み、亜硝酸の濃度が１０ｍｇ／ｌ以上１０００ｍｇ／ｌ以下である混合液を用いて、未損傷の半導体領域に対して損傷半導体領域を選択的に除去するエッチング処理と、を行うことで半導体基板を再生する。 （もっと読む）

【課題】ＩＩＩ族窒化物とは化学組成の異なる異組成基板とＩＩＩ族窒化物層とが貼り合わされた複合基板であっても、反りおよびクラックを発生させることなくその複合基板上にＩＩＩ族窒化物エピタキシャル層を形成することができる複合基板およびその製造方法を提供する。
【解決手段】本複合基板２Ｄは、ＩＩＩ族窒化物以外の化学組成を有する異組成基板１０と、異組成基板１０に貼り合わされたＩＩＩ族窒化物層２１と、含み、ＩＩＩ族窒化物層２１は、平面充填が可能な少なくとも１種類の平面形状を有する複数のＩＩＩ族窒化物タイル２１ｐに分離している。 （もっと読む）

【課題】電力が供給されない状況でも記憶内容の保持が可能で、かつ、書き込み回数にも制限が無い、新たな構造の半導体装置を提供する。
【解決手段】酸化物半導体を用いた書き込み用トランジスタ１６２、トランジスタ１６２と異なる半導体材料を用いた読み出し用トランジスタ１６０及び容量素子１６４を含む不揮発性のメモリセルにおいて、メモリセルへの書き込みは、書き込み用トランジスタ１６２をオン状態とすることにより、書き込み用トランジスタ１６２のソース電極（またはドレイン電極）と、容量素子１６４の電極の一方と、読み出し用トランジスタ１６０のゲート電極とが電気的に接続されたノードに電位を供給した後、書き込み用トランジスタ１６２をオフ状態とすることにより、ノードに所定量の電荷を保持させることで行う。また、読み出し用トランジスタ１６０として、ｐチャネル型トランジスタを用いて、読み出し電位を正の電位とする。 （もっと読む）

【課題】電力が供給されない状況でも記憶内容の保持が可能で、かつ、書き込み回数にも制限が無い、新たな構造の半導体装置を提供する。
【解決手段】ワイドギャップ半導体、例えば酸化物半導体を含むメモリセルを用いて構成された半導体装置であって、メモリセルからの読み出しのために基準電位より低い電位を出力する機能を有する電位切り替え回路を備えた半導体装置とする。ワイドギャップ半導体を用いることで、メモリセルを構成するトランジスタのオフ電流を十分に小さくすることができ、長期間にわたって情報を保持することが可能な半導体装置を提供することができる。 （もっと読む）

【課題】バッファリーク電流およびゲートリーク電流が抑制された高性能のＨＥＭＴを提供する。
【解決手段】本ＧａＮ薄膜貼り合わせ基板の製造方法は、ＧａＮバルク結晶１０の主表面から０．１μｍ以上１００μｍ以下の深さの面１０ｉへの平均注入量が１×１０¹⁴ｃｍ^-2以上３×１０¹⁷ｃｍ^-2以下の水素イオン注入工程と、水素イオン注入されたＧａＮバルク結晶１０の上記主表面へのＧａＮと化学組成が異なる異組成基板２０の貼り合わせ工程と、ＧａＮバルク結晶１０の熱処理によりＧａＮバルク結晶１０を水素イオンが注入された深さの面１０ｉにおいて分離することによる異組成基板２０上に貼り合わされたＧａＮ薄膜１０ａの形成工程と、を含む。ＧａＮ系ＨＥＭＴの製造方法は、上記ＧａＮ薄膜貼り合わせ基板１のＧａＮ薄膜１０ａ上への少なくとも１層のＧａＮ系半導体層３０の成長工程を含む。 （もっと読む）

【課題】ワイドバンドギャップ材料内に、接合温度低下、動作中の高電力密度化、及び定格電力密度における信頼性向上を達成する高電力デバイスを形成する。
【解決手段】ＳｉＣ層１０にＳｉＯ_２層を形成し、次いで、熱伝導率を高めるためにダイアモンド層１１を形成する。そして、ＳｉＣ層１０の厚さを低減し、ダイアモンド層１１及びＳｉＣ層１０の向きを逆にしてダイアモンド１１を基板とする。次いで、ＳｉＣ層１０上に、バッファ層１６、ヘテロ構造層１４及び１５を形成する。 （もっと読む）

【課題】半導体デバイスを効率よく製造するために、基体の種類の如何を問わずに効率よく半導体ウエハを製造することができる半導体ウエハの製造方法、ならびにかかる製造方法に好適に用いられる複合基体および複合基板を提供する。
【解決手段】本半導体ウエハの製造方法は、基体１０上に、表面のＲＭＳ粗さが１０ｎｍ以下の基体表面平坦化層１２を形成して複合基体１を得る工程と、複合基体１の基体表面平坦化層１２側に半導体結晶層２０ａを貼り合わせて複合基板３Ａ，３Ｂ，３Ｃを得る工程と、複合基板３Ａ，３Ｂ，３Ｃの半導体結晶層２０ａ上に少なくとも１層の半導体層３０を成長させる工程と、基体表面平坦化層１２をウェットエッチングで除去することにより、基体１０から半導体結晶層２０ａを分離して、半導体結晶層２０ａおよび半導体層３０を含む半導体ウエハ５を得る工程と、を含む。 （もっと読む）

【課題】焼結基体と半導体結晶層とが貼り合わせられた複合基板およびかかる複合基板に好適に用いられる複合基体を提供する。
【解決手段】本複合基体１は、焼結基体１０と、焼結基体１０上に配置された基体表面平坦化層１２と、を含み、基体表面平坦化層１２の表面のＲＭＳ粗さが１０ｎｍ以下である。本複合基板は、複合基体１と、複合基体１の基体表面平坦化層１２側に配置された半導体結晶層と、を含み、焼結基体１０の熱膨張係数と半導体結晶層の熱膨張係数との差が４．５×１０^-6Ｋ^-1以下である。 （もっと読む）

【課題】単結晶シリコン膜などの半導体膜が、支持基板から剥がれることを防止するＳＯＩ基板の作製方法を提供する。また、当該方法を用いることで、ＳＯＩ基板作製における歩留まりを向上させ、生産コストを削減する。
【解決手段】半導体基板に絶縁膜を形成し、加速されたイオンを半導体基板に照射することにより、半導体基板中に脆化領域を形成し、半導体基板と支持基板とを、絶縁膜を介して貼り合わせ、脆化領域において、半導体基板を分離して、支持基板上に絶縁膜を介して半導体膜を形成し、半導体膜上にマスクを形成し、半導体膜の一部及び絶縁膜の一部をエッチングすることにより、半導体膜の周端部が、絶縁膜の周端部の内側に位置するように、半導体膜及び絶縁膜を形成する、ＳＯＩ基板の作製方法である。 （もっと読む）

【課題】欠陥の少ない半導体層を得ること、及び信頼性の高い半導体装置を得る。
【解決手段】半導体基板中に、Ｈ_２Ｏ^＋が水素イオン（Ｈ_３^＋）に対して３％以下、好ましくは０．３％以下であるイオンビームを照射することにより、前記半導体基板中に脆化領域を形成し、前記半導体基板の表面及びベース基板の表面を対向させ、接触させることにより、前記半導体基板及び前記ベース基板を貼り合わせ、貼り合わせた前記半導体基板及び前記ベース基板を加熱し、前記脆化領域において分離させることにより、前記ベース基板上に半導体層を形成するＳＯＩ基板の作製に関する。 （もっと読む）

【課題】照射された水素イオンの単結晶半導体基板からの脱離を抑制する。
【解決手段】半導体基板中に炭素イオンを照射し、当該炭素イオンが照射された半導体基板中に、水素イオンを照射することにより、当該半導体基板中に脆化領域を形成し、当該半導体基板の表面及びベース基板の表面を対向させ、接触させることにより、当該半導体基板及び当該ベース基板を貼り合わせ、貼り合わせた当該半導体基板及び当該ベース基板を加熱し、当該脆化領域において分離させることにより、当該ベース基板上に半導体層を形成するＳＯＩ基板の作製に関する。 （もっと読む）

【課題】膜厚の均一な半導体層を有するＳＯＩ基板を得る。
【解決手段】半導体基板の第１の面を研磨して、当該第１の面を平坦化し、当該半導体基板の当該第１の面と反対側の面である第２の面にイオンを照射することにより、当該半導体基板中に脆化領域を形成し、当該半導体基板の第２の面及びベース基板の表面を対向させ、接触させることにより、当該半導体基板及び当該ベース基板を貼り合わせ、貼り合わせた当該半導体基板及び当該ベース基板を加熱し、当該脆化領域において分離させることにより、当該ベース基板上に半導体層を形成するＳＯＩ基板の作製に関する。当該ＳＯＩ基板の作製においては、当該半導体層の膜厚の標準偏差をσとし、３σが１．５ｎｍ以下である。 （もっと読む）

【課題】イオン注入剥法により作製されたテラス部にシリコン酸化膜のないＳＯＩウェーハに、渓谷状の段差を発生させることなくエピタキシャル成長を行い、所望のＳＯＩ層厚を有するＳＯＩウェーハを製造できる方法を提供することを目的とする
【解決手段】ＳＯＩウェーハのＳＯＩ層の外周端が、埋め込み酸化膜の外周端よりも外側に位置した構造となるように、該埋め込み酸化膜の外周部を除去する処理を行い、その後、ＳＯＩウェーハに水素を含む還元性雰囲気もしくは塩化水素ガスを含む雰囲気で熱処理を行った後、ＳＯＩ層の表面にエピタキシャル層を形成するＳＯＩウェーハの製造方法。 （もっと読む）

【課題】 イオン注入剥離法を用いて作製した貼り合わせウエーハのＳＯＩ層の表面上にエピタキシャル成長を行った場合に該エピタキシャル層の欠陥密度が少ない貼り合わせＳＯＩウエーハの製造方法を提供すること。
【解決手段】 貼り合わせＳＯＩウエーハの製造方法であって、
前記結合熱処理として、９５０℃未満の温度で前記ＳＯＩ層表面に酸化膜を形成するための酸化熱処理を行った後に、５％以下の酸素を含む不活性ガス雰囲気で１０００℃以上の温度で熱処理を行い、
該酸化膜を除去した後、前記ＳＯＩ層の減厚を伴う平坦化処理を行い、
その後、該平坦化処理を行った前記ＳＯＩ層の表面にエピタキシャル成長を行うことを特徴とする貼り合わせＳＯＩウエーハの製造方法。 （もっと読む）