【課題】絶縁素子を介した信号伝達に誤動作を生じさせ得る異常を検出して制御対象に停止信号をすることが可能な半導体集積回路を提供すること。
【解決手段】本発明にかかる半導体集積回路は、外部から供給される送信データＶＩＮに応じた送信信号を生成し出力する送信回路Ｔｘ１と、受信信号に基づいて送信データＶＩＮを再生する受信回路Ｒｘ１と、送信回路Ｔｘ１と受信回路Ｒｘ１とを絶縁するとともに、送信信号を受信信号として伝達する絶縁素子ＩＳＯ１と、絶縁素子ＩＳＯ１を介した信号伝達に誤動作を生じさせ得る異常を検出する異常検出部ＤＴ１と、異常検出部ＤＴ１により異常が検出された場合には、外部から送信回路Ｔｘ１に供給される送信データＶＩＮに関わらず停止信号を出力する制御部ＣＴ１と、を備える。 （もっと読む）

【課題】スイッチポート切替時間が短く、かつ低消費電力、低面積を同時に満たす高周波スイッチモジュールを提供する。
【解決手段】デコーダ３は、前記スイッチポートを切替える制御信号ＣＮＴに応答し、スイッチ７を制御するためのスイッチ制御信号ＳＷＣＮＴを生成して、スイッチ切替タイミング検出器は、スイッチ制御信号ＳＷＣＮＴに応答し、スイッチ切替え検出信号ｔ＿ｓｗを生成し、周波数制御信号生成器は、スイッチ切替え検出信号ｔ＿ｓｗに応答し、周波数制御信号ＩＣＯＮＴ、ＣＣＯＮＴを生成し、負電圧発生回路は、周波数制御信号ＩＣＯＮＴ、ＣＣＯＮＴに応答し、前記負電圧発生回路内で生成したクロック信号の周波数を２つ以上のそれぞれ異なる周波数に切替つつ、負電圧出力信号ＮＶＧ＿ＯＵＴを生成し、スイッチ７は、スイッチ制御信号ＳＷＣＮＴと前記負電圧出力信号ＮＶＧ＿ＯＵＴに応答し、複数の高周波信号ポート間の経路を切替える。 （もっと読む）

【課題】端子切替時の歪みの増加を抑制した半導体スイッチ及び無線機器を提供する。
【解決手段】実施形態によれば、電源回路と、駆動回路と、スイッチ部と、補正回路と、を備えた半導体スイッチが供給される。前記電源回路は、電源電位と異なる第１の電位を生成する。前記駆動回路は、前記第１の電位と異なる第２の電位と前記第１の電位とが供給され、端子切替信号に基づいて前記第１の電位及び前記第２の電位の少なくとも一方を出力する。前記スイッチ部は、前記駆動回路の出力に応じて共通端子と高周波端子との接続を切り替える。前記補正回路は、前記端子切替信号の変化を検出し、前記第１の電位の極性と等しい極性の電荷を前記駆動回路に供給して前記第１の電位を補正する。 （もっと読む）

【課題】通信周波数を微小変動させる技術よりも、ノイズレベルの低減を更に図ることができるＰＷＭ制御のデューティ決定方法を提供する。
【解決手段】制御ＩＣ６３が、駆動回路に出力するＰＷＭ信号のデューティを、指令値を中心に、所定期間内における平均が前記指令値に一致するように微小変動させる場合、ＰＣ６８のデータベース６９に、実際にＰＷＭ信号を駆動回路に与えることで発生したノイズ成分のレベル測定結果を反映したデータを、そのデューティの変動態様と共に記憶する。そして、データベース６９に記憶されているデータを参照し、与えられた動作環境や動作条件等に応じて抑圧対象となる周波数帯のノイズレベルを低減するように、制御ＩＣ６３によるＰＷＭデューティの変動態様を決定する。 （もっと読む）

【課題】モータの実回転方向が回転方向指令と逆になった場合に、フリーホイールダイオードにおいて発生する損失を軽減できるモータ制御装置を提供する。
【解決手段】制御回路６０は、外部より指令として与えられるモータ４の目標回転方向Ｄｔと、回転角センサＳＵ，ＳＶ，ＳＷが出力するセンサ信号に基づき信号生成ブロック７２により検出されるモータ４の実回転方向Ｄｒとが相違する方向不一致状態を検出すると、１２０度通電方式から１８０度通電方式に切り替えてインバータ部７６を構成する上段スイッチング素子ＦＵ，ＦＶ，ＦＷのオン期間を進み位相側に拡げるように制御し、還流電流を上段スイッチング素子ＦＵ，ＦＶ，ＦＷを介して流す。 （もっと読む）

【課題】半導体装置側において自動的にキャリブレーション動作を行う。
【解決手段】出力バッファ７１のインピーダンスを調整するキャリブレーション回路１００と、オートリフレッシュコマンドＡＲが所定回数発行されたことに応答してキャリブレーション回路１００を活性化させるキャリブレーション起動回路２００とを備える。本発明によれば、コントローラ側からキャリブレーションコマンドを発行することなく、半導体装置側にて自動的にキャリブレーション動作を行うことが可能となる。しかも、オートリフレッシュコマンドＡＲが所定回数発行されたことに応答してキャリブレーション動作を行っていることから、定期的なキャリブレーション動作が確保されるとともに、キャリブレーション動作中にコントローラからリード動作やライト動作を要求されることもない。 （もっと読む）

【課題】ディスクリート部品を用いることなく、パルス時間が長く、しかも、電圧変動が大きいノイズを確実に除去可能とする。
【解決手段】
入力信号の立ち上がり、立ち下がりを検出し、エッジ検出信号を出力するエッジ検出回路１０１と、入力信号を所定シフト時間ｔ１シフトして出力するシフトレジスタ回路１０６と、エッジ検出回路１０１のエッジ検出信号の入力時点から所定入力時間ｔ２経過後にカウントアップ信号を出力するカウンタ回路１０２と、シフトレジスタ回路１０６の出力信号を、カウンタ回路１０２のカウントアップ信号に同期して出力するＤＦＦ回路１０３と、ＤＦＦ回路１０３の出力信号を外部へ出力する出力回路１０４と、シフトレジスタ回路１０６とカウンタ回路１０１のクロック信号を生成、出力する発振回路１０５とを具備してなり、所定入力時間ｔ２に満たない入力信号が出力されないようになっている。 （もっと読む）

【課題】 部品点数が少なく、簡単な回路で構成でき、複数の楽音信号を１本の信号経路で送信又は受信できる楽音信号送信装置及び楽音信号受信装置を提供する。
【解決手段】 １ビットＡ／Ｄ変換部１Ｌ及び１Ｒにより、電子楽器などから入力された複数のアナログ楽音信号は各々１ビットデジタル信号に変換され、重み付け部２Ｌ及び２Ｒによりこれらの各１ビットデジタル信号は重み付け加算されて、出力部３により出力されることになると共に、受信部４により受信された重み付け加算信号は、分離部５により各１ビットデジタル信号に分離変換され、さらにＤ／Ａ変換部６により、アナログ信号に復調されることになる。 （もっと読む）

【課題】対象となる回路の制約を受けずに適用可能なゲーテッドクロック回路を提供すること。
【解決手段】入力回路３０への動作クロックＣＬＫ２の入力を制限するゲーテッドクロック回路１０であって、入力回路３０に入力される非同期信号ＡＳＹＮＣと次クロックにおいて入力回路３０に入力される次信号ＤＡＴＡとの排他的論理和の信号を出力するＸＯＲ１０１と、ＸＯＲ１０１の出力信号を、ＣＬＫ２に応じて出力するＬＡＴ１０２及びＣＧＦＦ１０３と、ＣＧＦＦ１０３の出力とＣＬＫ２の論理積であるゲーテッドクロック信号ＧＣＬＫを出力するＡＮＤ１０４を含む。 （もっと読む）

【課題】外部配線と複数の論理セルを含む論理セル群とを相互に接続する相互接続構造、および相互接続構造を有する論理回路装置に関し、論理のファンクション表現の柔軟性を低下させることなく配線リソースのオーバヘッドを低減させることを目的とする。
【解決手段】論理回路装置における相互接続部１が、外部配線と論理セル群２の入力線と相互接続関係を規定する接続規定手段を有し、論理セル群の複数の論理セルの中で対象となるファンクションを考慮して、論理のファンクション表現に関する柔軟性を保ちつつ、相互接続部の入力線の数が相互接続部の出力線の数より少ない構成、および、接続規定手段により規定される組み合わせ数が相互接続部の入出力の全ての組み合わせ数より少ない構成の少なくとも一方が実現されるように構成される。複数の論理回路装置のクラスタ化により形成されるクラスタ構造を有する論理回路装置も提供される。 （もっと読む）

【課題】ハイサイドドライバ用の費用効率の良い保護回路であって、必要コンポーネント数を最小限化し、ソフトウェア介入を必要としない保護回路の提供。
【解決手段】ハイサイドドライバ用保護回路は、第１の入力および第２の入力を受信し、該入力の各々を分析し、該入力の分析に応じて出力を伝送するように構成される排他的ＯＲゲートであって、第１の入力はハイサイドドライバの電力出力を表し、第２の入力は前記ハイサイドドライバの作動のための制御信号を表す、排他的ＯＲゲートと、排他的ＯＲゲートの出力に応答してハイサイドドライバの電気出力を制御するよう構成されるスイッチングデバイスとを含む。 （もっと読む）

【課題】ＰＬＬ回路において、アナログ回路のデジタル化によって生じる量子化雑音を抑制することができる技術を提供する。
【解決手段】基準信号ＲＥＦと分周後の信号ＤＩＶとの位相及び周波数を比較してデジタル値に変換するデジタル位相周波数比較器（ＤＰＦＤ）１０１と、デジタル位相周波数比較器１０１の出力から高周波雑音成分を除去するデジタルループフィルタ（ＤＬＦ）１０２と、デジタルループフィルタ１０２の出力のデジタル値をアナログ値に変換するデジタルアナログ変換器（ＤＡＣ）１０５と、デジタルアナログ変換器１０５の出力から高周波雑音成分を除去するアナログフィルタ（ＡｎＦ）１０６と、アナログフィルタ１０６の出力に基づいて周波数が制御される電圧制御発振器（ＶＣＯ）１０３と、電圧制御発振器１０３の出力を分周し、分周後の信号ＤＩＶを出力する分周器（ＤＩＶ）１０４とを備える。 （もっと読む）

【課題】本発明は、コストアップを抑制でき、かつ、異常履歴を得ることができる半導体集積回路装置を提供することを目的とする。
【解決手段】発振を行って発振信号を出力すると共に発振停止を検出したとき発振停止検出信号を出力し発振を再開する発振回路と、発振回路が出力する発振停止検出信号をエラーフラグとして保持するレジスタと、発振回路が出力する発振停止検出信号からリセット信号を生成して機能モジュールをリセットするリセット制御部と、機能モジュールのリセット後、レジスタからエラーフラグを読み出して不揮発性メモリに記憶する記憶制御手段を有する。 （もっと読む）

【課題】送信コイルにシングルパルスの電流信号を流し、誘導結合する受信コイルに発生するダブルパルスの電圧信号を非同期に受信できる低電力で高速な非同期誘導結合送受信技術を提供する。
【解決手段】非接触近接通信を行うための送信回路（１）には送信データの論理値の変化毎に前記第１コイル（１０）に第１方向の電流(Ｉ_Ｔ)を流す構成を採用する。前記第１コイルに誘導結合する第２コイル（２０）に接続された受信回路（２１）には、前記第１方向の電流によって第２コイルに誘起されるダブルパルスの誘導電圧（Ｖ_Ｒ）を判定して単極性のシングルパルス信号（Ｂ）を出力する比較器（２２）を採用し、比較器が出力する前記シングルパルス信号を入力する毎に出力を順序回路（２３）で反転させて受信データの再生を行う。 （もっと読む）

【課題】 異常が発生した際に速やかに異常状態を知らせることができる負荷駆動回路を提供する。
【解決手段】 電源１とリレースイッチ２との間に設けられリレースイッチ２に印加される電源１の電圧をオン／オフするスイッチ手段３と、スイッチ手段３を駆動する制御手段６とを備えた負荷駆動回路であって、制御手段６は、スイッチ手段３と制御手段６とを接続する配線における第１の電圧レベルと、スイッチ手段３とリレースイッチ２とを接続する配線における第２の電圧レベルとの間に論理差が生じた場合には異常状態であるとして、異常状態を伝達するように促す制御信号を出力する。 （もっと読む）

【課題】高速信号を符号間干渉なく信号を受信することができる信号処理回路（コンパレータ回路）を提供することを課題とする。
【解決手段】入力信号から出力信号への信号伝達特性がクロック信号により変化するように入力信号を処理して出力信号を出力する入力回路（３１１１）と、クロック信号により活性化状態になった期間に入力回路の出力信号を増幅する増幅回路（３１０２）とを有する信号処理回路が提供される。 （もっと読む）

【課題】データ信号の最適な読取タイミングを自動的に設定できるようにする。
【解決手段】入力データ信号を２つのフリップフロップ２１_１、２１_２に共通に入力し、入力データ信号のクロック周期の２倍の周期で且つクロック周期ずつ位相がずれた読取クロックＣ１、Ｃ２をフリップフロップ２１_１、２１_２にそれぞれ与える１対２のデマルチプレクサにおいて、入力データ信号に対する読取クロックＣ１、Ｃ２の位相を相対的に可変するための移相器２４と、読取処理が連続する二つのフリップフロップ２１_１、２１_２の読取データ信号同士の排他的論理和を求める第１の排他的論理和回路２６と、その出力から直流成分を抽出する第１のフィルタ２７と、読取クロックＣ１、Ｃ２の位相をクロック周期以上連続的に変化させ、第１のフィルタ２７の出力値が変化したときの移相量に基づいて最適な移相量を求め移相器２４に設定する位相設定手段４０とを備えた。 （もっと読む）

【課題】制御出力信号が制御入力信号を忠実に復元しているか否かを検出、監視する自己診断機能を備えたパワー半導体の駆動回路装置および信号伝達回路装置を提供する。
【課題を解決するための手段】
パワー半導体の駆動回路装置３０は、制御入力信号Ｓｉｎを生成する電子制御装置３２と、主経路３４と自己診断機能３８を有する信号伝達回路装置３００と、信号伝達回路装置３００からの制御出力信号Ｓｏｕｔで駆動されるパワー半導体４０とを備える。自己診断機能３８は帰還パルス送信回路３６０、第２信号伝達回路３７０および第２受信回路３８０を有する。第２受信回路３８０では制御出力信号Ｓｏｕｔが制御入力信号Ｓｉｎに一致しているか、または不一致であるかを比較し、比較した結果を比較信号出力端子３９０に出力する。比較信号出力端子３９０に出力された信号は電子制御装置３２に伝達される。 （もっと読む）

【課題】デジタル回路により電源投入を検出することができる電源投入検出回路及びマイクロコントローラを提供することを課題とする。
【解決手段】電源投入時に不定値を記憶し、複数ビットのデータを出力するフリップフロップ回路（１０１）と、前記フリップフロップ回路により出力される複数ビットのデータと複数ビットの固定値とを比較し、その比較の結果に応じた電源投入検出フラグを出力する比較器（１０２）とを有することを特徴とする電源投入検出回路が提供される。 （もっと読む）