半導体装置
【課題】 低オン抵抗のパワートランジスタを提供する。
【解決手段】 半導体チップの裏面とヘッダの上面とが対向するように前記半導体チップが前記ヘッダの上面に搭載されていることにより、前記半導体チップのドレイン電極と前記ヘッダとは電気的に接続されており、
平面視において、前記半導体チップのソース電極の一部が前記半導体チップのゲート電極とソースリードとの間に位置するように前記ソース電極は前記半導体チップの表面に配置されており、
前記ゲート電極と第１導電ワイヤとが接続している部分は、前記ソース電極と第２導電ワイヤとが接続している部分よりも前記ソースリードから遠い位置にある。
【解決手段】 半導体チップの裏面とヘッダの上面とが対向するように前記半導体チップが前記ヘッダの上面に搭載されていることにより、前記半導体チップのドレイン電極と前記ヘッダとは電気的に接続されており、
平面視において、前記半導体チップのソース電極の一部が前記半導体チップのゲート電極とソースリードとの間に位置するように前記ソース電極は前記半導体チップの表面に配置されており、
前記ゲート電極と第１導電ワイヤとが接続している部分は、前記ソース電極と第２導電ワイヤとが接続している部分よりも前記ソースリードから遠い位置にある。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は半導体装置に係わり、特にパワーＭＯＳＦＥＴ，ＩＧＢＴ（Insulated Gate Bipolar Transistor），バイポーラパワートランジスタ等の電源用トランジスタチップを封止した半導体装置に適用して有効な技術に関する。上記半導体装置は、携帯機器、レーザビームプリンタ、自動車電装機器等で使用されている。
【背景技術】
【０００２】
携帯電話，ビデオカメラなどの充電器，オフィスオートメーション（ＯＡ）機器等の電源回路，自動車電装機器等に使用される電源用トランジスタとして、低電圧駆動用パワートランジスタが知られている（例えば、特許文献１）。
【０００３】
また、工業規格パッケージ外形がＴＯ２２０型やＴＯ２４７型となるハイパワーＭＯＳＦＥＴも提案されている（例えば、特許文献２）。
【先行技術文献】
【特許文献】
【０００４】
【特許文献１】特開２０００−４９１８４号公報
【特許文献２】特開２０００−７７５８８号公報
【発明の概要】
【発明が解決しようとする課題】
【０００５】
ＴＯ２２０型の半導体装置（パッケージ）９０は、図２３及び図２４に示すような外観形状をしている。図２３はパッケージの平面図であり、図２４はパッケージの側面図である。ヘッダと呼称される金属製の支持基板９１の上面側は絶縁性樹脂からなる封止体９２によって被われ、この封止体９２の一端から三本のリード９３〜９５が平行に突出している。リード９３〜９５はゲート（Ｇ）リード，ドレイン（Ｄ）リード，ソース（Ｓ）リードとなっている。また、中央のリード９４は封止体９２の内部でオフセットされ、ヘッダ９１と一体に形成されている。図示はしないが、ヘッダ９１の上面にはＭＯＳＦＥＴが形成された半導体チップが固定されている。半導体チップの裏面はドレイン電極となり、ヘッダ９１と電気的に接続されている。また、半導体チップの上面にはゲート電極パッド及びソース電極パッドが設けられている。これらゲート電極パッド及びソース電極パッドと、ゲートリード９３，ソースリード９５のワイヤ接続部（リードポスト）は導電性のワイヤで各々接続されている。
【０００６】
図２５及び図２６は本発明に先立って検討したＴＯ２２０型の半導体装置である。図２５は樹脂封止体を取り除いた場合の模式的平面図、図２６は図２５に対応する断面図である。図２５及び図２６において、各部の符号は図２３及び図２４と共通な構成は、その参照番号をそのまま使用する。
【０００７】
ヘッダ９１はパッケージ９０を実装基板に固定するため使用する取付孔９６を有する。半導体チップ９７は矩形リング状に形成されたＶ溝枠９８の内側の領域に接着材を介して固定されている。
【０００８】
半導体チップ９７の上面（第１主面）には、ゲート電極パッド９９及びソース電極パッド１００が設けられている。ゲート電極パッド９９とゲートリード９３のワイヤ接続部（リードポスト）９３ａは導電性のワイヤ１０１で接続され、ソース電極パッド１００とソースリード９５のワイヤ接続部９５ａは導電性のワイヤ１０２で接続されている。オン抵抗を低減するため、ソース電極パッド１００とソースリード９５を接続するワイヤ１０２は２本使用される。このワイヤ１０２はゲート電極パッド９９とゲートリード９３を接続するワイヤ１０１（例えば、直径１２５μｍのアルミニウム線）に比較して、各々が太く（例えば直径３００〜５００μｍのアルミニウム）形成される。
【０００９】
半導体チップ９７の上面には絶縁性の保護膜が形成されているが、この保護膜を部分的に除去した開口部の底にそれぞれ電極が露出し、この露出部分がゲート電極パッド９９、ソース電極パッド１００となる。ソース電極パッド１００は２本のワイヤを接続するため幅広に形成されている。即ち、リードの延在方向に直交する方向に長く形成されている。ソース電極パッド１００は半導体チップ９７の略中央に形成されている。ゲート電極パッド９９は細いワイヤを接続することから、ソース電極パッド１００に比較して充分小さい。また、特許文献２にも示されているように、ゲート電極パッド９９は、半導体チップ９７の隅（コーナ）で、かつゲートリード９３の先端のリードポスト９３ａに近接した位置に設けられている。即ち、ゲート電極パッド９９はソース電極パッド１００よりもリード９３，９５のリードポスト９３ａ，９５ａ側に近接している。換言するならば、ゲートリードポスト９３ａとソース電極パッド１００との間にゲート電極パッド９９が位置している。
【００１０】
しかし、このようにゲート電極パッド９９がリードポストに近い半導体チップ９７のコーナ側に配置される構成の場合、半導体チップのチップサイズが大きくなると、ゲート電極パッド９９とリードポスト９３ａが更に近接することになる。このため、パッケージの製造工程におけるワイヤボンディング時、リード段差部にボンディングツールが接触し、ボンディングが困難になる。即ち、ワイヤボンディングはウエッジボンディングツールを用いた超音波ボンディングであるため、第１ボンディングとしてゲート電極パッド９９にワイヤの一端を接続する際、ワイヤを保持するボンディングツール（キャピラリ）がゲートリードポスト９３ａに接触し、超音波振動をワイヤ接合部に効果的に加えられなくなり、信頼性の高いワイヤボンディングが困難になる。
【００１１】
また、ソースリード９５は、パッケージの外側に配置され、一方、ソース電極パッド１００は、パッケージの中央側に配置されているため、ソース用ワイヤ１０２は、リードの延びる方向に対して交差する方向に延びる。
【００１２】
従って、ソース用ワイヤ１０２をリードの延びる方向に延ばして形成した場合に比べて、ソース用ワイヤ１０２間のピッチを広く設定する必要があり、多数本のソース用ワイヤ１０２の形成が困難になる。
【００１３】
更に、ソース電極パッド１００に接続するワイヤ１０２は、前述のように３００〜５００μｍ直径の太いワイヤが使用されることから、ソース電極パッド及びリードポスト９５ａに接続するワイヤの本数も制限され、パッケージの低ＯＮ抵抗化にも限度がある。
【００１４】
本発明の一つの目的は、低オン抵抗の半導体装置を提供することにある。
本発明の一つの目的は、支持基板上により大きいサイズの半導体チップを固定できる半導体装置を提供することにある。
本発明の一つの目的は、電気的信頼性の高い半導体装置の製造方法を提供することにある。
【００１５】
本発明の前記ならびにそのほかの目的と新規な特徴は、本明細書の記述および添付図面からあきらかになるであろう。
【課題を解決するための手段】
【００１６】
本願において開示される発明のうち代表的なものの概要を簡単に説明すれば、下記のとおりである。
【００１７】
（１）本発明の半導体装置は、絶縁性樹脂からなる封止体によって少なくとも一部が被われ下面が前記封止体から露出しかつ第１電極になる金属製の支持基板と、前記支持基板に連なり前記封止体の一側面から突出する第１電極リードと、前記封止体の前記一側面から突出し、前記第１電極リードと並んで延在する第２電極リード及び制御電極リードと、前記封止体に被われるとともに下面に第１電極を有し上面に第２電極パッドと制御電極パッドを有し下面が導電性の接合材を介して前記支持基板に固定される半導体チップと、前記封止体内に位置し前記第２電極パッドと前記第２電極リードを電気的に接続する接続手段と、前記封止体内に位置し前記制御電極パッドと前記制御電極リードを電気的に接続する接続手段とを有し、前記制御電極リード及び前記第２電極リードに対して、前記第２電極パッドは近い位置にあり、前記制御電極パッドは遠い位置にあることを特徴とする。
【００１８】
前記半導体チップには電界効果トランジスタが組み込まれ、前記第１電極リードはドレインリード、前記制御電極リードはゲートリード、前記第２電極リードはソースリードである。四角形からなる半導体チップの１辺がゲートリード及びソースリードのリードポストに対面し、対面した辺の反対側の辺に連なる半導体チップの１コーナ部分にゲート電極パッドが位置している。
【００１９】
ゲート電極パッドとゲートリードは１本のワイヤで接続され、ソース電極パッドとソースリードは複数本のワイヤで接続され、該複数本のワイヤはゲート電極パッドとゲートリードを接続するワイヤよりも太くかつ短い。
【００２０】
（２）前記手段（１）の構成において、ソース電極パッド及びソースリードは幅が広くなり、ソース電極パッドとソースリードは、可撓性のリボン・ストラップや所定形状に成形された金属板からなる幅広の導体板で接続されている。
【発明の効果】
【００２１】
本願において開示される発明のうち代表的なものによって得られる効果を簡単に説明すれば、下記のとおりである。
（１）低オン抵抗の半導体装置を提供することができる。
（２）支持基板上により大きいサイズの半導体チップを固定できる半導体装置を提供することができ、高出力の半導体装置を提供することができる。
【図面の簡単な説明】
【００２２】
【図１】本発明の一実施形態（実施形態１）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図２】本実施形態１の半導体装置の断面図である。
【図３】本実施形態１の半導体装置に組み込まれる半導体チップの模式的平面図である。
【図４】図３のＡ−Ａ線に沿う断面図である。
【図５】ゲートパッドをチップのコーナに配置した状態を示すチップの一部を示す平面図である。
【図６】ゲートパッドをチップの辺の途中に配置した状態を示すチップの一部を示す平面図である。
【図７】本実施形態１の半導体装置の製造において、チップを固定したリードフレームを示す平面図である。
【図８】本実施形態１の半導体装置の製造において、ワイヤを接続したリードフレームを示す平面図である。
【図９】本発明の他の実施形態（実施形態２）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図１０】本実施形態２の半導体装置の断面図である。
【図１１】本発明の他の実施形態（実施形態３）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図１２】本実施形態３の半導体装置の断面図である。
【図１３】本発明の他の実施形態（実施形態４）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図１４】本発明の他の実施形態（実施形態５）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図１５】本実施形態５の半導体装置の断面図である。
【図１６】本実施形態５の半導体装置の製造で使用するリードフレームの平面図である。
【図１７】本発明の他の実施形態（実施形態６）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図１８】本実施形態６の半導体装置の断面図である。
【図１９】本発明の他の実施形態（実施形態７）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図２０】本実施形態７の半導体装置の断面図である。
【図２１】本発明の他の実施形態（実施形態８）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図２２】本発明の他の実施形態（実施形態９）である半導体装置の模式的断面図である。
【図２３】従来の半導体装置の模式的平面図である。
【図２４】図２３に示す半導体装置の側面図である。
【図２５】本発明に先立って検討した半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図２６】図２５に示す半導体装置の断面図である。
【発明を実施するための形態】
【００２３】
以下、図面を参照して本発明の実施の形態を詳細に説明する。なお、発明の実施の形態を説明するための全図において、同一機能を有するものは同一符号を付け、その繰り返しの説明は省略する。
（実施形態１）
図１乃至図８は本発明の一実施形態（実施形態１）である半導体装置に係わる図である。図１は樹脂封止体を取り除いた半導体装置の模式的平面図、図２は半導体装置の断面図、図３は半導体装置に組み込まれる半導体チップの模式的平面図、図４は図３のＡ−Ａ線に沿う断面図、図５はゲート電極パッドをチップのコーナに配置した状態を示すチップの一部を示す平面図、図６はゲート電極パッドをチップの辺の途中に配置した状態を示すチップの一部を示す平面図である。
本実施形態１では、本発明を縦型パワートランジスタ（半導体装置）１に適用した例について説明する。即ち、第１電極としてドレイン（Ｄ）電極、第２電極としてソース（Ｓ）電極、制御電極としてゲート（Ｇ）電極となる電界効果トランジスタを組み込んだ半導体チップが、半導体装置１に組み込まれている。
【００２４】
パワートランジスタ１は、図１および図２に示すように、絶縁性樹脂からなる封止体２と、前記封止体２によって少なくとも一部が被われ下面が前記封止体２から露出しかつ第１電極になる金属製の支持基板（ヘッダ）３と、前記支持基板３に連なり前記封止体２の一端面から突出しかつ途中で一段階段状に屈曲する第１電極リード（ドレインリード）４と、前記封止体２の前記一端面から並んで突出する第２電極リード（ソースリード）５および制御電極リード（ゲートリード）６を有している。ソースリード５及びゲートリード６はドレインリード４と同じ高さになっている。支持基板３は厚く、リードは薄くなり、これらは部分的に厚さが異なる異型材から製造される。
【００２５】
また、前記封止体（パッケージ）２内には半導体チップ７が配置されている。この半導体チップ７には、図４に示すように縦型パワーＭＯＳＦＥＴが形成され下面に第１電極（ドレイン電極）１０を有し、図３及び図１に示すように、主面（上面）には第２電極（ソース電極）パッド１１と制御電極（ゲート電極）パッド１２を有した構造になっている。ドレイン電極はＴｉ・Ｎｉ・Ａｕによって形成されている。また、ソース電極パッド１１及びゲート電極パッド１２はＡｌで形成されている。
【００２６】
半導体チップ７は、図２に示すように、図示しない下面のドレイン電極が導電性の接合材（図示せず）を介して前記支持基板（ヘッダ）３に固定されている。また、前記封止体２内に延在するソースリード５及びゲートリード６の先端は幅広になるリードポスト５ａ，６ａとなっている。これらリードポスト５ａ，６ａは、ワイヤ１４，１５を介して半導体チップ７のソース電極パッド１１及びゲート電極パッド１２にそれぞれ接続されている。
【００２７】
ゲートリード６のリードポスト６ａとゲート電極パッド１２を接続するワイヤ１５は直径が、例えば、１２５μｍと細いＡｌ線である。ソースリード５のリードポスト５ａとソース電極パッド１１は複数本のワイヤ１４で接続されている。図では２本になっているが、オン抵抗を低減するためにさらに多くてもよい。このワイヤ１４は直径が３００〜５００μｍ程度、例えば５００μｍとなり、ワイヤ１５に比較して太い。このワイヤ１５もＡｌ線である。また、オン抵抗の低減を図るため、ワイヤ１４の接続長さは５ｍｍ以内となっている。また、いずれのワイヤも超音波によくこすり付けによって接続される。従って、半導体チップ７の主面の電極パッドにワイヤボンディングを行うときは、ワイヤを保持するボンディングツールが一段高い位置にあるリードポストに接触しないようにして行う必要がある。
【００２８】
本実施形態１では、図１に示すように、ゲート電極パッド１２はリードポストから遠い位置にあり、ソース電極パッド１１は大きく、ワイヤ１４はこのソース電極パッド１１の中心線に沿う位置にそれぞれボンディングされることから、ボンディングツールがリードポストに接触することがなく、確実なワイヤボンディングが可能になる。
【００２９】
ここで、簡単に半導体チップ７について説明する。半導体チップ７は図３に示すように、平面的に見て四角形である。ソース電極パッド１１は幅広（長方形）となるとともに、チップの一方の辺側に偏った位置に設けられている。ソース電極パッド１１に近接する辺（図３では下縁になる辺）が、支持基板３に固定されるときリードポストに対面する辺である。そして、この対面する辺の反対側の辺（図３では上縁になる辺）に連なるチップの１コーナ部分（図３では左側のコーナ）にゲート電極パッド１２が位置している。図１に示すように、ソース電極パッド１１の中心線からゲート電極パッド１２は距離ｅずれている。
【００３０】
半導体チップ７は、特に限定はされないが、１辺が８〜９ｍｍの大きさである。そして、ゲート電極パッド１２はワイヤ１５の太さが１２５μｍ直径であることから、その大きさは一辺が０．３〜０．５ｍｍ程度となる正方形である。これに対して、ソース電極パッド１１は、例えば、ソース電極パッド１１の中心線に沿って複数本のワイヤ１４を接続することから、例えば、縦４ｍｍ、横（幅）７ｍｍ程度である。
【００３１】
図４は図３のＡ−Ａ線に沿う一部の拡大断面図である。半導体チップ７は、主面にｎ−型のエピタキシャル層２１を有するｎ＋型のシリコン半導体基板２０を基に形成されている。パワートランジスタ１は縦型ＭＯＳＦＥＴであり、平面的に見て多数のセル（トランジスタ）が整列配置されている。この例では、各トランジスタセルはトレンチ構成になっている。エピタキシャル層２１の所定領域には、ｐ−型のチャネル（ｃｈ）層２２が形成されるとともに、その外周にはガードリングとなるｐ−型のウエル層２３が形成されている。
【００３２】
また、チャネル（ｃｈ）層２２を貫通するようにセル形成領域には多数のトレンチ（溝）２５が形成される。このトレンチ２５はウエル層２３にも設けられる。ウエル層２３に設けられるトレンチと、その内側の最外周に位置するセルを構成するトレンチとの間の領域は、セルとして使用されない無効領域ｆとなる。この無効領域ｆは、図３では二点鎖線で示される２本線に挟まれた領域である。無効領域ｆで囲まれた領域はセルが形成される有効領域ｈになる。この有効領域ｈが広い程セルの数を多くでき、パワートランジスタ１の出力増大を図ることができる。
【００３３】
本実施形態１では、ゲート電極パッド１２は半導体チップ７の１隅（コーナ）に設けられ、無効領域ｆで囲まれる領域（有効領域ｈ）の外側に位置している。図６に示すように、リードポストに対面したチップの辺に連なりかつこの対面した辺に直交するチップの辺の途中部分にゲート電極パッド１２を位置させることも可能である。ゲートリード６のリードポスト６ａに対応するため、ゲート電極パッド１２はチップの左側の辺の途中に配置してある。
【００３４】
ゲート電極パッド１２をチップの一辺の途中部分に設けると、図６に示すように、無効領域ｆはゲート電極パッド１２の三辺に沿って現れるが、ゲート電極パッド１２を半導体チップ７のコーナに配置すると、図５に示すように、無効領域ｆはゲート電極パッド１２の二辺に現れるだけである。従って、ゲート電極パッド１２をコーナに設ければ、無効領域ｆの面積を減らすことができ、その減らした分だけ有効領域ｈの面積が増大することから、セル数の増大を図ることができる。本実施形態１の場合、例えば、セルの大きさは一辺が３〜５μｍとなる正方形状である。ゲート電極パッド１２の一辺は３００〜５００μｍであることから、ゲート電極パッド１２をコーナに設けることによってより多くのセルを形成することができる。
【００３５】
トレンチ２５内にはゲート電極となるポリシリコンゲート層２６が設けられ、この層の下にはゲート絶縁膜２７が設けられている。そして、トレンチに囲まれたチャネル層２２の中央表層部分にはｐ＋領域２８が形成されている。セル部分のチャネル層２２においては、ｐ＋領域２８の外側からトレンチに到る領域に亘ってｎ＋型からなるソース領域２９が設けられている。トレンチ部分、即ち、ゲート絶縁膜２７及びポリシリコンゲート層２６は絶縁膜３２で被われ、この絶縁膜３２上にはソース電極３３が形成されている。このソース電極３３は絶縁膜３２が設けられない開口部分でｐ＋領域２８及びソース領域２９と電気的に接続されている。
【００３６】
無効領域ｆの外側に位置するトレンチ２５部分では、ゲート絶縁膜２７に連なって厚い絶縁膜（ＬＯＣＯＳ）３４が設けられている。この厚い絶縁膜３４はウエル層２３の外周を超えて延在している。無効領域ｆの外側に位置するトレンチ２５に埋め込まれたポリシリコンゲート層２６は厚い絶縁膜３４上の途中部分にまで延在して周辺ゲート配線３５を形成している。また、この周辺ゲート配線３５及び厚い絶縁膜３４も絶縁膜３２で被われている。この絶縁膜３２部分上にはゲート電極配線３６が設けられている。このゲート電極配線３６は絶縁膜３２に部分的に設けられた開口を通してポリシリコンゲート層２６に電気的に接続されている。
【００３７】
図４に示すように、絶縁膜３２は半導体チップ７の周縁まで到達しない状態となっている。また、絶縁膜３２から外れたエピタキシャル層２１の表面はわずかにエッチングされて一段低くなっている。そしてこの低くなった部分において、絶縁膜３２の周縁はドレイン電極と同電位となるガードリング３７で被われている。ガードリング３７の下のエピタキシャル層２１の表層には、ｐ＋型からなるガードリングコンタクト層（ＨＣＮＴ）３８が設けられている。このガードリングコンタクト層（ＨＣＮＴ）３８は半導体チップ７の縁にまで延在している。また、ガードリング３７の内側のエピタキシャル層２１の表層部分には、ｎ＋型からなるチャネルストッパ層（Ｓ）３９が設けられている。ガードリングコンタクト層（ＨＣＮＴ）３８はガードリングの電位をとるためで、チャネルストッパ層（Ｓ）３９は、空乏層の進行をガードする効果がある。
【００３８】
半導体チップ７の主面は、図４に示すように、絶縁膜４０で被われて保護されている。また、この絶縁膜４０は選択的に開口されている。この開口部分が、図３及び図１に示すソース電極パッド１１及びゲート電極パッド１２になる。
【００３９】
一方、半導体チップ７から外れる封止体２の中央部分には、パワートランジスタ１を実装基板等に取り付ける際利用する取付用孔８が設けられている。この取付用孔８が設けられる支持基板３には、この取付用孔８と同心円からなるとともに、取付用孔８よりも大きな孔９が設けられている。また、支持基板３の主面には四角枠状にＶ溝が形成されている。このＶ溝枠４１のＶ溝内にも封止体２を形成する樹脂が充填される。このＶ溝枠４１の存在によって、支持基板３と封止体２との界面における水分の浸入もし難くなる。また、支持基板３の両側はそれぞれ２箇所に亘って押し潰し部分４２が設けられている。この押し潰し部分４２の上下には封止体２を形成する樹脂が位置し、支持基板３から封止体２が剥離し難くなっている。これによりパワートランジスタ１の耐湿性が向上する。
【００４０】
つぎに、本実施形態１の半導体装置（パワートランジスタ１）の製造方法について、図７及び図８を参照しながら説明する。図７はパワートランジスタの製造において、チップを固定したリードフレームを示す平面図であり、図８はワイヤを接続したリードフレームを示す平面図である。
【００４１】
パワートランジスタ１の製造においては、図７に示すようにリードフレーム４５が用意される。このリードフレーム４５は複数個のパワートランジスタ１を製造するように、１個のパワートランジスタ１を製造する単位リードフレーム４６が、並列に複数繋がる短冊形状になっている。
【００４２】
単位リードフレーム４６は、図１で説明した３本のリード６，４，５を所定長さ長く延在させるパターンになるとともに、これら３本のリード６，４，５を支持するようにリードに直交する方向に延在する細いダム４７と、３本のリード６，４，５の先端部分を接続する枠片４８とを有する。ダム４７は封止体２に近接した位置に設けられている。
【００４３】
単位リードフレーム４６は、これらダム４７及び枠片４８によって繋がっている。また、支持基板（ヘッダ）３の先端側部も隣接するヘッダに連結部５０で繋がる構造になっている。単位リードフレーム４６を３個並列にした状態が図７である。また、支持基板３は各リードよりも一段低くなる（図２参照）。枠片４８にはガイド孔４９が設けられている。ガイド孔４９はリードフレーム４５を移送したり、リードフレーム４５の位置決め時に使用される。リードフレーム４５は、一側が所定の幅で厚くなる帯状の銅合金等からなる金属板（異形材）を精密プレスで打ち抜いてパターニングするとともに、薄い一部で屈曲させて薄い部分を厚い部分よりも一段高くした構造（段差は１．８ｍｍ）になっている。厚い部分が前記支持基板３であり１．２６ｍｍの厚さになり、薄い部分がゲートリード６，ドレインリード４，ソースリード５であり０．６ｍｍの厚さになっている。ソースリード５及びゲートリード６の先端は幅広のリードポスト５ａ，６ａになっている。
【００４４】
このようなリードフレーム４５の各支持基板３上の所定位置に半導体チップ７を接着材を介して固定する。この際、リードポスト５ａ，６ａに近い位置にソース電極パッド１１が位置し、リードポスト５ａ，６ａから遠い位置にゲート電極パッド１２が位置する状態で半導体チップ７の固定を行う（図７参照）。
【００４５】
つぎに、図８に示すように、ソース電極パッド１１とソースリード５のリードポスト５ａを、５００μｍ直径のＡｌワイヤで電気的に接続する。ソース電極パッド１１とソースリード５は２本のワイヤ１４で接続する。ワイヤ１４は超音波ワイヤボンディングによって接続される。
【００４６】
つぎに、ゲート電極パッド１２とゲートリード６のリードポスト６ａを、１２５μｍのＡｌワイヤ１５で接続する。ワイヤ１５は超音波ワイヤボンディングによって接続される。ゲート電極パッド１２にワイヤ１５の先端を超音波ボンディングしても、ゲート電極パッド１２がリードポスト６ａから遠い位置にあることから、ボンディングツールがリードポスト６ａに接触することがなく、確実なワイヤボンディングができる。このため、半導体チップ７をリードポスト５ａ，６ａに近づけるようにして支持基板３に固定することができる。これは、支持基板３の長さを短くしたり、あるいは固定する半導体チップ７のサイズの大型化が図れることになり、パワートランジスタ１の小型化やチップ大型化による出力増大が可能になる。
【００４７】
つぎに、図８の点線で示すように、トランスファモールディング等によって絶縁性樹脂によって封止体２を形成する。つぎに、各リード間のダム４７及び連結部５０を切断除去し、ついで各リードを切断して図１及び図２に示すパワートランジスタ１を複数製造する。
【００４８】
つぎに、必要に応じて封止体２から突出するリード表面に半田メッキ処理を行い、リードや支持基板３の所定箇所に図示しない実装用の半田メッキ膜を形成する。
【００４９】
本実施形態１のパワートランジスタ１は、例えば、自動車の制御系のスイッチとしても使用できる。例えば、出力は１０〜１５Ｗ（電源電圧が１０〜２０Ｖ）のものである。
本実施形態１によれば、以下の効果を奏する。
【００５０】
（１）ゲート電極パッド１２がゲートリード６のリードポスト６ａから遠い位置にあることから、ワイヤボンディング時、ワイヤを保持するボンディングツールがゲートリード６のリードポスト６ａに接触しなくなる。この結果、支持基板（ヘッダ）３に固定する半導体チップ７をゲートリード６のリードポスト６ａ側に近接させて配置することができるため、その分支持基板３を小さくでき、パワートランジスタ（半導体装置）１の小型化が可能になる。
【００５１】
（２）上記（１）により、支持基板３に固定する半導体チップ７をゲートリード６のリードポスト６ａ側に近接させて配置することができるため、支持基板３により大きいサイズの半導体チップ７を固定することができる。この結果、パワートランジスタ１の出力増大を図ることができる。
【００５２】
（３）ソース電極パッド１１をソースリード５に近づけることができるため、ソース電極パッド１１とソースリード５を接続するワイヤ１４の長さを短くでき、オン抵抗の低減を図ることができる。
【００５３】
（実施形態２）
図９は本発明の他の実施形態（実施形態２）である半導体装置の樹脂封止体を取り除いた模式的平面図、図１０は半導体装置の断面図である。
【００５４】
本実施形態２は実施形態１のパワートランジスタ１において、ソース電極パッド１１とソースリード５を導体板５２で接続した例である。この実施形態では、導体板５２として、厚さ１５０〜２５０μｍ程度の可撓性のＡｌ箔からなるリボン・ストラップ５３を使用する。
【００５５】
本実施形態では、導体板５２による接続がしやすいようにするため、図９に示すように、ソースリード５が中央に位置させている。ソースリード５の左側にゲートリード６が位置し、右側にドレインリード４が位置している。ソースリード５のリードポスト５ａは、導体板５２を接続できるように他のリードの幅よりも広くなり、例えば、ソース電極パッド１１と略同じ幅となっている。このため、幅広いリボン・ストラップを接続することができる。リボン・ストラップ５３は可撓性のＡｌ箔からなり、超音波ボンディングによってソース電極パッド１１やソースリード５のリードポスト５ａに接続される。
【００５６】
即ち、パワートランジスタ１の製造においては、最初に、図７に示すようなリードフレーム４５が用意される。このリードフレーム４５は、パターニングされかつ一部で１段屈曲させた一枚の金属板からなり、第１電極（ドレイン電極）を構成するとともに半導体チップが固定される支持基板と、支持基板を先端に支持する第１電極リード（ドレインリード４）と、第１電極リードと並んで延在する第２電極リード（ソースリード５）及び制御電極リード（ゲートリード６）を有する。
【００５７】
また、下面に第１電極（ドレイン電極）を有し上面に第２電極パッド（ソース電極パッド１１）と制御電極パッド（ゲート電極パッド１２）を有する四角形の半導体チップ７が用意される。
【００５８】
つぎに、半導体チップ７をその第１電極部分（ドレイン電極）で導電性の接合材を介して支持基板３上に固定する。
【００５９】
つぎに、半導体チップ７のソース電極パッド１１とソース電極パッド１１を接続手段で電気的に接続するとともに、半導体チップ７のゲート電極パッド１２とゲートリード６を接続手段で電気的に接続する。ゲート電極パッド１２とゲートリード６は直径１２５μｍのＡｌワイヤ１５で接続するが、ソース電極パッド１１とソース電極パッド１１は前述のリボン・ストラップ５３で接続する。この場合、図９に示すように、ワイヤ１５はリボン・ストラップ５３の角部を横切るため、リボン・ストラップ５３の接続が終了した後、ゲート電極パッド１２とゲートリード６のリードポスト６ａをワイヤ１５で接続する必要がある。
【００６０】
つぎに、半導体チップ７，接続手段であるワイヤ１５及びリボン・ストラップ５３，ソースリード５及びゲートリード６の一部を絶縁性樹脂で封止して封止体２で被う。
【００６１】
つぎに、実施形態１と同様にリードフレーム４５の不要部分を切断除去するとともにリードを所定長さで切断する。
【００６２】
本実施形態によれば、幅広いのリボン・ストラップ５３を用いることから、さらにオン抵抗の低減が可能になる。本実施形態２のパワートランジスタ１も実施形態１のパワートランジスタ１と同様の効果を有する。
【００６３】
（実施形態３）
図１１は本発明の他の実施形態（実施形態３）である半導体装置の樹脂封止体を取り除いた模式的平面図、図１２は半導体装置の断面図である。
【００６４】
本実施形態では、実施形態２と同様にソース電極パッド１１とソースリード５を導体板５２で接続するが、本例では、導体板５２として、所定形状に成形した金属板５４を使用する。金属板５４は、例えば銅板からなっている。図１１に示すように、成形された金属板５４は、ソース電極パッド１１及びソースリード５のリードポスト５ａに接着材５５によって電気的に接続される。接着材５５は導電性樹脂や半田等を使用する。ただし、この場合、ソース電極パッド１１の表面にアンダーバリアメタル加工が必要である。これは、Ａｌ表面酸化膜によって導通阻害を防止するためである。アンダーバリアメタル層は、例えば、Ａｌパッド表面にＮｉ層を形成し、最上部はＮｉの酸化を防止するＡｕまたはＡｇからなっている。
【００６５】
本実施形態３においてもオン抵抗の低減が図れる。また、接着材５５を用いて金属板５４を接続することから，作業が容易になる。本実施形態３のパワートランジスタ１も実施形態２のパワートランジスタ１と同様の効果を有する。
【００６６】
（実施形態４）
図１３は本発明の他の実施形態（実施形態４）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【００６７】
本実施形態４は、実施形態１のパワートランジスタ１におけるソース電極パッド１１を、ソース電極パッド１１ａ，ｂの２本で構成し、それぞれのソース電極パッド１１ａ，ｂとソースリード５のリードポスト５ａをそれぞれワイヤ１４で接続したものである。そして、この例においても、リードポスト５ａ，６ａに近いソース電極パッド１１ａの中心線から距離ｇ程ゲート電極パッド１２はリードポスト５ａ，６ａから遠ざかる構造になっている。図１３においては、封止体２は省略してある。
【００６８】
本実施形態４のパワートランジスタ１も実施形態１と同様にゲート電極パッド１２がゲートリード６のリードポスト６ａから遠い位置にあることから、ワイヤボンディングに支障を来さない。また、ソース電極パッド１１ａの中心線部分は、半導体チップ７のソースリード５のリードポスト５ａ寄りの辺から、例えば、２ｍｍ程度となり、かつこの部分に第１ボンディングとしてワイヤ１４が接続されるため、ボンディングツールがリードポスト５ａに接触することもなく良好なワイヤボンディングが可能になる。このようにワイヤボンディングを支障を来さない位置となるならば、ソース電極パッド１１を３本，４本と多くしても問題はない。
【００６９】
本実施形態４の構成では、ソース電極パッド１１を複数本としたことから、ワイヤを接続する場所が多くなり、さらに多い本数のワイヤボンディングが可能になり、オン抵抗の低減が可能になる。本実施形態４のパワートランジスタ１も実施形態１のパワートランジスタ１と同様の効果を有する。
【００７０】
（実施形態５）
図１４は本発明の他の実施形態（実施形態５）である半導体装置の樹脂封止体を取り除いた模式的平面図、図１５は半導体装置の断面図、図１６は半導体装置の製造で使用するリードフレームの平面図である。
【００７１】
本実施形態５は、実施形態４と同様にソース電極パッド１１を複数設け、かつ各ソース電極パッド１１とソースリード５をワイヤ等の接続手段で電気的に接続する技術思想のものである。
【００７２】
本実施形態５では、図１４に示すように、ソース電極パッド１１をゲート電極パッド１２と同じ大きさの四角形とし、各リードの延在方向に交差する方向に（支持基板３の幅方向）沿って千鳥足跡状に複数設けた構造になっている。そして、ワイヤボンディングを効果的に行うため、ソースリード５を中央に配列させている。
【００７３】
図１６は本実施形態５のパワートランジスタ１を製造する際用いるリードフレーム４５ａである。このリードフレーム４５ａは、実施形態１のリードフレーム４５において、リードの配列が異なる。また、ソースリード５のリードポスト５ａの幅（長さ）が他のリード、即ち、ゲートリード６よりも広い点等においても異なる。
【００７４】
即ち、本実施形態１のパワートランジスタ１は、図１４に示すように、ソースリード５を中央に位置させ、ソースリード５の一側（左側）にゲートリード６を位置させ、ソースリード５の他側（右側）にドレインリード４を位置させている。そして、ソースリード５の幅、即ち、ソースリード５のリードポスト５ａの幅を、他のリードの幅（ゲートリード６のリードポスト６ａの幅）よりも広く形成している。即ち、千鳥足跡状に配列した各ソース電極パッド１１に接続するワイヤ１４の全てに接続するに充分な幅（長さ）になっている。そして、図１５にも示すように、各ソース電極パッド１１とソースリード５のリードポスト５ａはワイヤ１４によって接続されている。
【００７５】
本実施形態５においても、千鳥足跡状配列のソース電極パッド１１よりも遠い位置にゲート電極パッド１２が配置され、ゲート電極パッド１２へのワイヤボンディング時、ボンディングツールがリードポスト５ａに接触しないようになっている。千鳥足跡状配列のソース電極パッド１１においてもソースリード５のリードポスト５ａから充分離れていることから、ソース電極パッド１１へのワイヤボンディング時、ボンディングツールがソースリード５のリードポスト５ａに接触することもなく、確実なワイヤボンディングが可能になる。
【００７６】
本実施形態５のパワートランジスタ１においても、６本と多数のワイヤ１４でソース電極パッド１１とソースリード５を接続するため、オン抵抗の低減を図ることができる。本実施形態５のパワートランジスタ１も実施形態４のパワートランジスタ１と同様の効果を有する。
【００７７】
（実施形態６）
図１７は本発明の他の実施形態（実施形態６）である半導体装置の樹脂封止体を取り除いた模式的平面図、図１８は半導体装置の断面図である。
【００７８】
本実施形態６は実施形態５において、ソース電極パッド１１を千鳥足跡状配列とせず、実施形態４のように、平行に延在する２本の長いソース電極パッド１１ａ，１１ｂとしたものである。そして、複数のワイヤ１４のうちの各ワイヤは、図１８に示すように、ソース電極パッド１１ａ，１１ｂとソースリード５のリードポスト５ａに接続されるものである。
【００７９】
本実施形態６におけるワイヤボンディングにおいては、ボンディングツールで保持したワイヤの先端を、第１ボンディング点として半導体チップ７のリードポスト５ａから遠い位置にあるソース電極パッド１１ａに接続し、その後ボンディングツールでワイヤを引き回し、その途中部分を半導体チップ７のソース電極パッド１１ｂに接続し、さらにソースリード５のリードポスト５ａに接続し、その後リードポスト５ａの接続部分近傍でワイヤを切断して１張りのワイヤボンディングを終了する。即ち、本実施形態６ではステッチボンディングによってワイヤ１４の接続を行うものである。このステッチボンディングによってソース電極パッド１１ａ，１１ｂとソースリード５のリードポスト５ａを複数のワイヤ１４で接続する。図１９には７本のワイヤ１４が使用された例が示されている。
【００８０】
本実施形態６の場合においても、ソース電極パッド１１ａ，１１ｂとソースリード５を接続する複数のワイヤ１４のうち、ゲート電極パッド１２とゲートリード６を接続するワイヤ１５に近い側のワイヤ１４のワイヤボンディング時、ワイヤ１５と接触してショート不良を発生させることも考えられるので、ソース電極パッド１１ａ，１１ｂとソースリード５のワイヤボンディングを終了した後にゲート電極パッド１２とゲートリード６とのワイヤボンディングを行う必要がある。
【００８１】
本実施形態６においても、ソース電極パッド１１ａ，１１ｂよりも遠い位置にゲート電極パッド１２が配置され、ゲート電極パッド１２へのワイヤボンディング時、ボンディングツールがリードポスト５ａに接触しないようになっている。また、ソース電極パッド１１ａ，１１ｂとソースリード５とのワイヤボンディングにおいては、ソースリード５が中央に位置し、ソースリード５のリードポスト５ａとソース電極パッド１１ａ，１１ｂは同じ幅で対面していることから、ワイヤボンディングは他のリードポスト等に接触することもなく、良好なワイヤボンディングが可能になる。この結果、大きな半導体チップ７を支持基板３に固定することも可能になる。
【００８２】
本実施形態６のパワートランジスタ１においても、７本と多数のワイヤ１４でソース電極パッド１１とソースリード５を接続するため、オン抵抗の低減を図ることができる。本実施形態６のパワートランジスタ１も実施形態５のパワートランジスタ１と同様の効果を有する。
【００８３】
（実施形態７）
図１９は本発明の他の実施形態（実施形態７）である半導体装置の樹脂封止体を取り除いた模式的平面図、図２０は半導体装置の断面図である。
【００８４】
本実施形態７は、実施形態６において、中央のソースリード５を太くしたものである。ソースリード５のリードポスト５ａは多数のワイヤ１４を接続するため当然にして幅広であるが、リードポスト５ａから外れた封止体２から外部に突出する部分をも含み全体を他のリード（ドレインリード４，ゲートリード６）よりも幅広としてある。これにより、封止体２内の半導体チップ７で発生する熱を多数のワイヤ１４を介在させて太いソースリード５から外部に放散することができ、パワートランジスタ１の安定動作が可能になる。本実施形態７のパワートランジスタ１も実施形態６のパワートランジスタ１と同様の効果を有する。
【００８５】
（実施形態８）
図２１は本発明の他の実施形態（実施形態８）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【００８６】
本実施形態８は、実施形態１等と同様に制御電極リード（ゲートリード）及び第２電極リード（ソースリード）のリードポストに対して、第２電極パッド（ソース電極パッド）は近い位置にあり、制御電極パッド（ゲート電極パッド）は遠い位置にあるという技術思想のものである。
【００８７】
そして、さらに第２電極パッドを複数設けた場合、複数の第２電極パッドにおいて、リードポスト寄りの第２電極パッドは、リードポストに対して、制御電極パッドよりも近い位置にあるという技術思想のものである。
【００８８】
本実施形態８のパワートランジスタ１は、実施形態４のパワートランジスタ１において、ゲート電極パッド１２を四角形からなる半導体チップ７の左側の辺の途中部分に配置したものである。辺の途中にゲート電極パッド１２を設けるため、並列配置されるソース電極パッド１１ａ，１１ｂはその分短くなっている。
【００８９】
換言するならば、四角形からなる半導体チップ７の１辺はゲートリード６及びソースリード５の先端のリードポスト５ａ，６ａに対面している。そこで、この対面した辺に連なりかつ前記対面した辺に直交する左辺の途中部分にゲート電極パッド１２を位置させる。図２１に示すように、リードポスト５ａ，６ａに近いソース電極パッド１１ａの中心線からゲート電極パッド１２は距離ｍ程遠い位置に配置されている。しかし、この例では、リードポスト５ａ，６ａから遠い位置にあるソース電極パッド１１ｂに比較して、ゲート電極パッド１２はリードポスト５ａ，６ａに近くなっている。これにより、本実施形態８のパワートランジスタ１も実施形態１のパワートランジスタ１と同様の効果を有する。
【００９０】
（実施形態９）
図２２は本発明の他の実施形態（実施形態９）である半導体装置の模式的断面図である。本実施形態９は、実施形態１のパワートランジスタ１において、封止体２の端面から突出するドレインリード４，ソースリード５，ゲートリード６の３本のリードを、途中で折れ曲がるように成形し、先端は支持基板３の下面と略同じ高さに位置させて延在させた構造になっている。この先端の延在部分６０は、パワートランジスタ１を実装基板等に支持基板３を固定する際、３本のリードの先端の延在部分６０は実装基板に設けた配線との接続部分になる。実施形態９のパワートランジスタ１は面実装構造になっている。なお、ドレインリード４は支持基板３と同じ電位になることから、封止体２から突出する付け根部分で切断して実装基板には接続しない構造としてもよい。本実施形態８のパワートランジスタ１も実施形態１のパワートランジスタ１と同様の効果を有する。
【００９１】
以上本発明者によってなされた発明を実施形態に基づき具体的に説明したが、本発明は上記実施形態に限定されるものではなく、その要旨を逸脱しない範囲で種々変更可能であることはいうまでもない。実施形態では、第１電極，第２電極，制御電極をそれぞれ電極とするパワーＭＯＳＦＥＴを半導体チップに組み込んだ例を示したが、組み込む素子としてはパワーバイポーラトランジスタ，ＩＧＢＴ等のトランジスタ、あるいはトランジスタを含むＩＣでもよい。本発明は少なくともＴＯ−２２０構造の半導体装置には適用できる。
【符号の説明】
【００９２】
１…半導体装置（パワートランジスタ）、２…封止体（パッケージ）、３…支持基板（ヘッダ）、４…第１電極リード（ドレインリード）、５…第２電極リード（ソースリード）、５ａ，６ａ…リードポスト、６…制御電極リード（ゲートリード）、７…半導体チップ、８…取付用孔、９…孔、１０…第１電極（ドレイン電極）、１１…第２電極（ソース電極）パッド、１２…制御電極（ゲート電極）パッド、１４，１５…ワイヤ、２０…シリコン半導体基板、２１…エピタキシャル層、２２…チャネル（ｃｈ）層、２３…ウエル層、２５…トレンチ（溝）、２６…ポリシリコンゲート層、２７…ゲート絶縁膜、２８…ｐ＋領域、２９…ソース領域、３２…絶縁膜、３３…ソース電極、３４…厚い絶縁膜、３５…周辺ゲート配線、３６…ゲート電極配線、３７…ガードリング、３８…ガードリングコンタクト、３９…チャネルストッパ、４０…絶縁膜、４１…Ｖ溝枠、４２…押し潰し部分、４５…リードフレーム、４６…単位リードフレーム、４７…ダム、４８…枠片、４９…ガイド孔、５０…連結部、５２…導体板、５３…リボン・ストラップ、５４…金属板、５５…接着材、６０…延在部分、９０…半導体装置（パッケージ）、９１…支持基板（ヘッダ）、９２…封止体、９３…ゲートリード、９４…ドレインリード、９５…ソースリード、９６…取付孔、９７…半導体チップ、９８…Ｖ溝枠、９９…ゲート電極パッド、１００…ソース電極パッド、１０１，１０２…ワイヤ。
【技術分野】
【０００１】
本発明は半導体装置に係わり、特にパワーＭＯＳＦＥＴ，ＩＧＢＴ（Insulated Gate Bipolar Transistor），バイポーラパワートランジスタ等の電源用トランジスタチップを封止した半導体装置に適用して有効な技術に関する。上記半導体装置は、携帯機器、レーザビームプリンタ、自動車電装機器等で使用されている。
【背景技術】
【０００２】
携帯電話，ビデオカメラなどの充電器，オフィスオートメーション（ＯＡ）機器等の電源回路，自動車電装機器等に使用される電源用トランジスタとして、低電圧駆動用パワートランジスタが知られている（例えば、特許文献１）。
【０００３】
また、工業規格パッケージ外形がＴＯ２２０型やＴＯ２４７型となるハイパワーＭＯＳＦＥＴも提案されている（例えば、特許文献２）。
【先行技術文献】
【特許文献】
【０００４】
【特許文献１】特開２０００−４９１８４号公報
【特許文献２】特開２０００−７７５８８号公報
【発明の概要】
【発明が解決しようとする課題】
【０００５】
ＴＯ２２０型の半導体装置（パッケージ）９０は、図２３及び図２４に示すような外観形状をしている。図２３はパッケージの平面図であり、図２４はパッケージの側面図である。ヘッダと呼称される金属製の支持基板９１の上面側は絶縁性樹脂からなる封止体９２によって被われ、この封止体９２の一端から三本のリード９３〜９５が平行に突出している。リード９３〜９５はゲート（Ｇ）リード，ドレイン（Ｄ）リード，ソース（Ｓ）リードとなっている。また、中央のリード９４は封止体９２の内部でオフセットされ、ヘッダ９１と一体に形成されている。図示はしないが、ヘッダ９１の上面にはＭＯＳＦＥＴが形成された半導体チップが固定されている。半導体チップの裏面はドレイン電極となり、ヘッダ９１と電気的に接続されている。また、半導体チップの上面にはゲート電極パッド及びソース電極パッドが設けられている。これらゲート電極パッド及びソース電極パッドと、ゲートリード９３，ソースリード９５のワイヤ接続部（リードポスト）は導電性のワイヤで各々接続されている。
【０００６】
図２５及び図２６は本発明に先立って検討したＴＯ２２０型の半導体装置である。図２５は樹脂封止体を取り除いた場合の模式的平面図、図２６は図２５に対応する断面図である。図２５及び図２６において、各部の符号は図２３及び図２４と共通な構成は、その参照番号をそのまま使用する。
【０００７】
ヘッダ９１はパッケージ９０を実装基板に固定するため使用する取付孔９６を有する。半導体チップ９７は矩形リング状に形成されたＶ溝枠９８の内側の領域に接着材を介して固定されている。
【０００８】
半導体チップ９７の上面（第１主面）には、ゲート電極パッド９９及びソース電極パッド１００が設けられている。ゲート電極パッド９９とゲートリード９３のワイヤ接続部（リードポスト）９３ａは導電性のワイヤ１０１で接続され、ソース電極パッド１００とソースリード９５のワイヤ接続部９５ａは導電性のワイヤ１０２で接続されている。オン抵抗を低減するため、ソース電極パッド１００とソースリード９５を接続するワイヤ１０２は２本使用される。このワイヤ１０２はゲート電極パッド９９とゲートリード９３を接続するワイヤ１０１（例えば、直径１２５μｍのアルミニウム線）に比較して、各々が太く（例えば直径３００〜５００μｍのアルミニウム）形成される。
【０００９】
半導体チップ９７の上面には絶縁性の保護膜が形成されているが、この保護膜を部分的に除去した開口部の底にそれぞれ電極が露出し、この露出部分がゲート電極パッド９９、ソース電極パッド１００となる。ソース電極パッド１００は２本のワイヤを接続するため幅広に形成されている。即ち、リードの延在方向に直交する方向に長く形成されている。ソース電極パッド１００は半導体チップ９７の略中央に形成されている。ゲート電極パッド９９は細いワイヤを接続することから、ソース電極パッド１００に比較して充分小さい。また、特許文献２にも示されているように、ゲート電極パッド９９は、半導体チップ９７の隅（コーナ）で、かつゲートリード９３の先端のリードポスト９３ａに近接した位置に設けられている。即ち、ゲート電極パッド９９はソース電極パッド１００よりもリード９３，９５のリードポスト９３ａ，９５ａ側に近接している。換言するならば、ゲートリードポスト９３ａとソース電極パッド１００との間にゲート電極パッド９９が位置している。
【００１０】
しかし、このようにゲート電極パッド９９がリードポストに近い半導体チップ９７のコーナ側に配置される構成の場合、半導体チップのチップサイズが大きくなると、ゲート電極パッド９９とリードポスト９３ａが更に近接することになる。このため、パッケージの製造工程におけるワイヤボンディング時、リード段差部にボンディングツールが接触し、ボンディングが困難になる。即ち、ワイヤボンディングはウエッジボンディングツールを用いた超音波ボンディングであるため、第１ボンディングとしてゲート電極パッド９９にワイヤの一端を接続する際、ワイヤを保持するボンディングツール（キャピラリ）がゲートリードポスト９３ａに接触し、超音波振動をワイヤ接合部に効果的に加えられなくなり、信頼性の高いワイヤボンディングが困難になる。
【００１１】
また、ソースリード９５は、パッケージの外側に配置され、一方、ソース電極パッド１００は、パッケージの中央側に配置されているため、ソース用ワイヤ１０２は、リードの延びる方向に対して交差する方向に延びる。
【００１２】
従って、ソース用ワイヤ１０２をリードの延びる方向に延ばして形成した場合に比べて、ソース用ワイヤ１０２間のピッチを広く設定する必要があり、多数本のソース用ワイヤ１０２の形成が困難になる。
【００１３】
更に、ソース電極パッド１００に接続するワイヤ１０２は、前述のように３００〜５００μｍ直径の太いワイヤが使用されることから、ソース電極パッド及びリードポスト９５ａに接続するワイヤの本数も制限され、パッケージの低ＯＮ抵抗化にも限度がある。
【００１４】
本発明の一つの目的は、低オン抵抗の半導体装置を提供することにある。
本発明の一つの目的は、支持基板上により大きいサイズの半導体チップを固定できる半導体装置を提供することにある。
本発明の一つの目的は、電気的信頼性の高い半導体装置の製造方法を提供することにある。
【００１５】
本発明の前記ならびにそのほかの目的と新規な特徴は、本明細書の記述および添付図面からあきらかになるであろう。
【課題を解決するための手段】
【００１６】
本願において開示される発明のうち代表的なものの概要を簡単に説明すれば、下記のとおりである。
【００１７】
（１）本発明の半導体装置は、絶縁性樹脂からなる封止体によって少なくとも一部が被われ下面が前記封止体から露出しかつ第１電極になる金属製の支持基板と、前記支持基板に連なり前記封止体の一側面から突出する第１電極リードと、前記封止体の前記一側面から突出し、前記第１電極リードと並んで延在する第２電極リード及び制御電極リードと、前記封止体に被われるとともに下面に第１電極を有し上面に第２電極パッドと制御電極パッドを有し下面が導電性の接合材を介して前記支持基板に固定される半導体チップと、前記封止体内に位置し前記第２電極パッドと前記第２電極リードを電気的に接続する接続手段と、前記封止体内に位置し前記制御電極パッドと前記制御電極リードを電気的に接続する接続手段とを有し、前記制御電極リード及び前記第２電極リードに対して、前記第２電極パッドは近い位置にあり、前記制御電極パッドは遠い位置にあることを特徴とする。
【００１８】
前記半導体チップには電界効果トランジスタが組み込まれ、前記第１電極リードはドレインリード、前記制御電極リードはゲートリード、前記第２電極リードはソースリードである。四角形からなる半導体チップの１辺がゲートリード及びソースリードのリードポストに対面し、対面した辺の反対側の辺に連なる半導体チップの１コーナ部分にゲート電極パッドが位置している。
【００１９】
ゲート電極パッドとゲートリードは１本のワイヤで接続され、ソース電極パッドとソースリードは複数本のワイヤで接続され、該複数本のワイヤはゲート電極パッドとゲートリードを接続するワイヤよりも太くかつ短い。
【００２０】
（２）前記手段（１）の構成において、ソース電極パッド及びソースリードは幅が広くなり、ソース電極パッドとソースリードは、可撓性のリボン・ストラップや所定形状に成形された金属板からなる幅広の導体板で接続されている。
【発明の効果】
【００２１】
本願において開示される発明のうち代表的なものによって得られる効果を簡単に説明すれば、下記のとおりである。
（１）低オン抵抗の半導体装置を提供することができる。
（２）支持基板上により大きいサイズの半導体チップを固定できる半導体装置を提供することができ、高出力の半導体装置を提供することができる。
【図面の簡単な説明】
【００２２】
【図１】本発明の一実施形態（実施形態１）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図２】本実施形態１の半導体装置の断面図である。
【図３】本実施形態１の半導体装置に組み込まれる半導体チップの模式的平面図である。
【図４】図３のＡ−Ａ線に沿う断面図である。
【図５】ゲートパッドをチップのコーナに配置した状態を示すチップの一部を示す平面図である。
【図６】ゲートパッドをチップの辺の途中に配置した状態を示すチップの一部を示す平面図である。
【図７】本実施形態１の半導体装置の製造において、チップを固定したリードフレームを示す平面図である。
【図８】本実施形態１の半導体装置の製造において、ワイヤを接続したリードフレームを示す平面図である。
【図９】本発明の他の実施形態（実施形態２）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図１０】本実施形態２の半導体装置の断面図である。
【図１１】本発明の他の実施形態（実施形態３）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図１２】本実施形態３の半導体装置の断面図である。
【図１３】本発明の他の実施形態（実施形態４）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図１４】本発明の他の実施形態（実施形態５）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図１５】本実施形態５の半導体装置の断面図である。
【図１６】本実施形態５の半導体装置の製造で使用するリードフレームの平面図である。
【図１７】本発明の他の実施形態（実施形態６）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図１８】本実施形態６の半導体装置の断面図である。
【図１９】本発明の他の実施形態（実施形態７）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図２０】本実施形態７の半導体装置の断面図である。
【図２１】本発明の他の実施形態（実施形態８）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図２２】本発明の他の実施形態（実施形態９）である半導体装置の模式的断面図である。
【図２３】従来の半導体装置の模式的平面図である。
【図２４】図２３に示す半導体装置の側面図である。
【図２５】本発明に先立って検討した半導体装置の樹脂封止体を取り除いた模式的平面図である。
【図２６】図２５に示す半導体装置の断面図である。
【発明を実施するための形態】
【００２３】
以下、図面を参照して本発明の実施の形態を詳細に説明する。なお、発明の実施の形態を説明するための全図において、同一機能を有するものは同一符号を付け、その繰り返しの説明は省略する。
（実施形態１）
図１乃至図８は本発明の一実施形態（実施形態１）である半導体装置に係わる図である。図１は樹脂封止体を取り除いた半導体装置の模式的平面図、図２は半導体装置の断面図、図３は半導体装置に組み込まれる半導体チップの模式的平面図、図４は図３のＡ−Ａ線に沿う断面図、図５はゲート電極パッドをチップのコーナに配置した状態を示すチップの一部を示す平面図、図６はゲート電極パッドをチップの辺の途中に配置した状態を示すチップの一部を示す平面図である。
本実施形態１では、本発明を縦型パワートランジスタ（半導体装置）１に適用した例について説明する。即ち、第１電極としてドレイン（Ｄ）電極、第２電極としてソース（Ｓ）電極、制御電極としてゲート（Ｇ）電極となる電界効果トランジスタを組み込んだ半導体チップが、半導体装置１に組み込まれている。
【００２４】
パワートランジスタ１は、図１および図２に示すように、絶縁性樹脂からなる封止体２と、前記封止体２によって少なくとも一部が被われ下面が前記封止体２から露出しかつ第１電極になる金属製の支持基板（ヘッダ）３と、前記支持基板３に連なり前記封止体２の一端面から突出しかつ途中で一段階段状に屈曲する第１電極リード（ドレインリード）４と、前記封止体２の前記一端面から並んで突出する第２電極リード（ソースリード）５および制御電極リード（ゲートリード）６を有している。ソースリード５及びゲートリード６はドレインリード４と同じ高さになっている。支持基板３は厚く、リードは薄くなり、これらは部分的に厚さが異なる異型材から製造される。
【００２５】
また、前記封止体（パッケージ）２内には半導体チップ７が配置されている。この半導体チップ７には、図４に示すように縦型パワーＭＯＳＦＥＴが形成され下面に第１電極（ドレイン電極）１０を有し、図３及び図１に示すように、主面（上面）には第２電極（ソース電極）パッド１１と制御電極（ゲート電極）パッド１２を有した構造になっている。ドレイン電極はＴｉ・Ｎｉ・Ａｕによって形成されている。また、ソース電極パッド１１及びゲート電極パッド１２はＡｌで形成されている。
【００２６】
半導体チップ７は、図２に示すように、図示しない下面のドレイン電極が導電性の接合材（図示せず）を介して前記支持基板（ヘッダ）３に固定されている。また、前記封止体２内に延在するソースリード５及びゲートリード６の先端は幅広になるリードポスト５ａ，６ａとなっている。これらリードポスト５ａ，６ａは、ワイヤ１４，１５を介して半導体チップ７のソース電極パッド１１及びゲート電極パッド１２にそれぞれ接続されている。
【００２７】
ゲートリード６のリードポスト６ａとゲート電極パッド１２を接続するワイヤ１５は直径が、例えば、１２５μｍと細いＡｌ線である。ソースリード５のリードポスト５ａとソース電極パッド１１は複数本のワイヤ１４で接続されている。図では２本になっているが、オン抵抗を低減するためにさらに多くてもよい。このワイヤ１４は直径が３００〜５００μｍ程度、例えば５００μｍとなり、ワイヤ１５に比較して太い。このワイヤ１５もＡｌ線である。また、オン抵抗の低減を図るため、ワイヤ１４の接続長さは５ｍｍ以内となっている。また、いずれのワイヤも超音波によくこすり付けによって接続される。従って、半導体チップ７の主面の電極パッドにワイヤボンディングを行うときは、ワイヤを保持するボンディングツールが一段高い位置にあるリードポストに接触しないようにして行う必要がある。
【００２８】
本実施形態１では、図１に示すように、ゲート電極パッド１２はリードポストから遠い位置にあり、ソース電極パッド１１は大きく、ワイヤ１４はこのソース電極パッド１１の中心線に沿う位置にそれぞれボンディングされることから、ボンディングツールがリードポストに接触することがなく、確実なワイヤボンディングが可能になる。
【００２９】
ここで、簡単に半導体チップ７について説明する。半導体チップ７は図３に示すように、平面的に見て四角形である。ソース電極パッド１１は幅広（長方形）となるとともに、チップの一方の辺側に偏った位置に設けられている。ソース電極パッド１１に近接する辺（図３では下縁になる辺）が、支持基板３に固定されるときリードポストに対面する辺である。そして、この対面する辺の反対側の辺（図３では上縁になる辺）に連なるチップの１コーナ部分（図３では左側のコーナ）にゲート電極パッド１２が位置している。図１に示すように、ソース電極パッド１１の中心線からゲート電極パッド１２は距離ｅずれている。
【００３０】
半導体チップ７は、特に限定はされないが、１辺が８〜９ｍｍの大きさである。そして、ゲート電極パッド１２はワイヤ１５の太さが１２５μｍ直径であることから、その大きさは一辺が０．３〜０．５ｍｍ程度となる正方形である。これに対して、ソース電極パッド１１は、例えば、ソース電極パッド１１の中心線に沿って複数本のワイヤ１４を接続することから、例えば、縦４ｍｍ、横（幅）７ｍｍ程度である。
【００３１】
図４は図３のＡ−Ａ線に沿う一部の拡大断面図である。半導体チップ７は、主面にｎ−型のエピタキシャル層２１を有するｎ＋型のシリコン半導体基板２０を基に形成されている。パワートランジスタ１は縦型ＭＯＳＦＥＴであり、平面的に見て多数のセル（トランジスタ）が整列配置されている。この例では、各トランジスタセルはトレンチ構成になっている。エピタキシャル層２１の所定領域には、ｐ−型のチャネル（ｃｈ）層２２が形成されるとともに、その外周にはガードリングとなるｐ−型のウエル層２３が形成されている。
【００３２】
また、チャネル（ｃｈ）層２２を貫通するようにセル形成領域には多数のトレンチ（溝）２５が形成される。このトレンチ２５はウエル層２３にも設けられる。ウエル層２３に設けられるトレンチと、その内側の最外周に位置するセルを構成するトレンチとの間の領域は、セルとして使用されない無効領域ｆとなる。この無効領域ｆは、図３では二点鎖線で示される２本線に挟まれた領域である。無効領域ｆで囲まれた領域はセルが形成される有効領域ｈになる。この有効領域ｈが広い程セルの数を多くでき、パワートランジスタ１の出力増大を図ることができる。
【００３３】
本実施形態１では、ゲート電極パッド１２は半導体チップ７の１隅（コーナ）に設けられ、無効領域ｆで囲まれる領域（有効領域ｈ）の外側に位置している。図６に示すように、リードポストに対面したチップの辺に連なりかつこの対面した辺に直交するチップの辺の途中部分にゲート電極パッド１２を位置させることも可能である。ゲートリード６のリードポスト６ａに対応するため、ゲート電極パッド１２はチップの左側の辺の途中に配置してある。
【００３４】
ゲート電極パッド１２をチップの一辺の途中部分に設けると、図６に示すように、無効領域ｆはゲート電極パッド１２の三辺に沿って現れるが、ゲート電極パッド１２を半導体チップ７のコーナに配置すると、図５に示すように、無効領域ｆはゲート電極パッド１２の二辺に現れるだけである。従って、ゲート電極パッド１２をコーナに設ければ、無効領域ｆの面積を減らすことができ、その減らした分だけ有効領域ｈの面積が増大することから、セル数の増大を図ることができる。本実施形態１の場合、例えば、セルの大きさは一辺が３〜５μｍとなる正方形状である。ゲート電極パッド１２の一辺は３００〜５００μｍであることから、ゲート電極パッド１２をコーナに設けることによってより多くのセルを形成することができる。
【００３５】
トレンチ２５内にはゲート電極となるポリシリコンゲート層２６が設けられ、この層の下にはゲート絶縁膜２７が設けられている。そして、トレンチに囲まれたチャネル層２２の中央表層部分にはｐ＋領域２８が形成されている。セル部分のチャネル層２２においては、ｐ＋領域２８の外側からトレンチに到る領域に亘ってｎ＋型からなるソース領域２９が設けられている。トレンチ部分、即ち、ゲート絶縁膜２７及びポリシリコンゲート層２６は絶縁膜３２で被われ、この絶縁膜３２上にはソース電極３３が形成されている。このソース電極３３は絶縁膜３２が設けられない開口部分でｐ＋領域２８及びソース領域２９と電気的に接続されている。
【００３６】
無効領域ｆの外側に位置するトレンチ２５部分では、ゲート絶縁膜２７に連なって厚い絶縁膜（ＬＯＣＯＳ）３４が設けられている。この厚い絶縁膜３４はウエル層２３の外周を超えて延在している。無効領域ｆの外側に位置するトレンチ２５に埋め込まれたポリシリコンゲート層２６は厚い絶縁膜３４上の途中部分にまで延在して周辺ゲート配線３５を形成している。また、この周辺ゲート配線３５及び厚い絶縁膜３４も絶縁膜３２で被われている。この絶縁膜３２部分上にはゲート電極配線３６が設けられている。このゲート電極配線３６は絶縁膜３２に部分的に設けられた開口を通してポリシリコンゲート層２６に電気的に接続されている。
【００３７】
図４に示すように、絶縁膜３２は半導体チップ７の周縁まで到達しない状態となっている。また、絶縁膜３２から外れたエピタキシャル層２１の表面はわずかにエッチングされて一段低くなっている。そしてこの低くなった部分において、絶縁膜３２の周縁はドレイン電極と同電位となるガードリング３７で被われている。ガードリング３７の下のエピタキシャル層２１の表層には、ｐ＋型からなるガードリングコンタクト層（ＨＣＮＴ）３８が設けられている。このガードリングコンタクト層（ＨＣＮＴ）３８は半導体チップ７の縁にまで延在している。また、ガードリング３７の内側のエピタキシャル層２１の表層部分には、ｎ＋型からなるチャネルストッパ層（Ｓ）３９が設けられている。ガードリングコンタクト層（ＨＣＮＴ）３８はガードリングの電位をとるためで、チャネルストッパ層（Ｓ）３９は、空乏層の進行をガードする効果がある。
【００３８】
半導体チップ７の主面は、図４に示すように、絶縁膜４０で被われて保護されている。また、この絶縁膜４０は選択的に開口されている。この開口部分が、図３及び図１に示すソース電極パッド１１及びゲート電極パッド１２になる。
【００３９】
一方、半導体チップ７から外れる封止体２の中央部分には、パワートランジスタ１を実装基板等に取り付ける際利用する取付用孔８が設けられている。この取付用孔８が設けられる支持基板３には、この取付用孔８と同心円からなるとともに、取付用孔８よりも大きな孔９が設けられている。また、支持基板３の主面には四角枠状にＶ溝が形成されている。このＶ溝枠４１のＶ溝内にも封止体２を形成する樹脂が充填される。このＶ溝枠４１の存在によって、支持基板３と封止体２との界面における水分の浸入もし難くなる。また、支持基板３の両側はそれぞれ２箇所に亘って押し潰し部分４２が設けられている。この押し潰し部分４２の上下には封止体２を形成する樹脂が位置し、支持基板３から封止体２が剥離し難くなっている。これによりパワートランジスタ１の耐湿性が向上する。
【００４０】
つぎに、本実施形態１の半導体装置（パワートランジスタ１）の製造方法について、図７及び図８を参照しながら説明する。図７はパワートランジスタの製造において、チップを固定したリードフレームを示す平面図であり、図８はワイヤを接続したリードフレームを示す平面図である。
【００４１】
パワートランジスタ１の製造においては、図７に示すようにリードフレーム４５が用意される。このリードフレーム４５は複数個のパワートランジスタ１を製造するように、１個のパワートランジスタ１を製造する単位リードフレーム４６が、並列に複数繋がる短冊形状になっている。
【００４２】
単位リードフレーム４６は、図１で説明した３本のリード６，４，５を所定長さ長く延在させるパターンになるとともに、これら３本のリード６，４，５を支持するようにリードに直交する方向に延在する細いダム４７と、３本のリード６，４，５の先端部分を接続する枠片４８とを有する。ダム４７は封止体２に近接した位置に設けられている。
【００４３】
単位リードフレーム４６は、これらダム４７及び枠片４８によって繋がっている。また、支持基板（ヘッダ）３の先端側部も隣接するヘッダに連結部５０で繋がる構造になっている。単位リードフレーム４６を３個並列にした状態が図７である。また、支持基板３は各リードよりも一段低くなる（図２参照）。枠片４８にはガイド孔４９が設けられている。ガイド孔４９はリードフレーム４５を移送したり、リードフレーム４５の位置決め時に使用される。リードフレーム４５は、一側が所定の幅で厚くなる帯状の銅合金等からなる金属板（異形材）を精密プレスで打ち抜いてパターニングするとともに、薄い一部で屈曲させて薄い部分を厚い部分よりも一段高くした構造（段差は１．８ｍｍ）になっている。厚い部分が前記支持基板３であり１．２６ｍｍの厚さになり、薄い部分がゲートリード６，ドレインリード４，ソースリード５であり０．６ｍｍの厚さになっている。ソースリード５及びゲートリード６の先端は幅広のリードポスト５ａ，６ａになっている。
【００４４】
このようなリードフレーム４５の各支持基板３上の所定位置に半導体チップ７を接着材を介して固定する。この際、リードポスト５ａ，６ａに近い位置にソース電極パッド１１が位置し、リードポスト５ａ，６ａから遠い位置にゲート電極パッド１２が位置する状態で半導体チップ７の固定を行う（図７参照）。
【００４５】
つぎに、図８に示すように、ソース電極パッド１１とソースリード５のリードポスト５ａを、５００μｍ直径のＡｌワイヤで電気的に接続する。ソース電極パッド１１とソースリード５は２本のワイヤ１４で接続する。ワイヤ１４は超音波ワイヤボンディングによって接続される。
【００４６】
つぎに、ゲート電極パッド１２とゲートリード６のリードポスト６ａを、１２５μｍのＡｌワイヤ１５で接続する。ワイヤ１５は超音波ワイヤボンディングによって接続される。ゲート電極パッド１２にワイヤ１５の先端を超音波ボンディングしても、ゲート電極パッド１２がリードポスト６ａから遠い位置にあることから、ボンディングツールがリードポスト６ａに接触することがなく、確実なワイヤボンディングができる。このため、半導体チップ７をリードポスト５ａ，６ａに近づけるようにして支持基板３に固定することができる。これは、支持基板３の長さを短くしたり、あるいは固定する半導体チップ７のサイズの大型化が図れることになり、パワートランジスタ１の小型化やチップ大型化による出力増大が可能になる。
【００４７】
つぎに、図８の点線で示すように、トランスファモールディング等によって絶縁性樹脂によって封止体２を形成する。つぎに、各リード間のダム４７及び連結部５０を切断除去し、ついで各リードを切断して図１及び図２に示すパワートランジスタ１を複数製造する。
【００４８】
つぎに、必要に応じて封止体２から突出するリード表面に半田メッキ処理を行い、リードや支持基板３の所定箇所に図示しない実装用の半田メッキ膜を形成する。
【００４９】
本実施形態１のパワートランジスタ１は、例えば、自動車の制御系のスイッチとしても使用できる。例えば、出力は１０〜１５Ｗ（電源電圧が１０〜２０Ｖ）のものである。
本実施形態１によれば、以下の効果を奏する。
【００５０】
（１）ゲート電極パッド１２がゲートリード６のリードポスト６ａから遠い位置にあることから、ワイヤボンディング時、ワイヤを保持するボンディングツールがゲートリード６のリードポスト６ａに接触しなくなる。この結果、支持基板（ヘッダ）３に固定する半導体チップ７をゲートリード６のリードポスト６ａ側に近接させて配置することができるため、その分支持基板３を小さくでき、パワートランジスタ（半導体装置）１の小型化が可能になる。
【００５１】
（２）上記（１）により、支持基板３に固定する半導体チップ７をゲートリード６のリードポスト６ａ側に近接させて配置することができるため、支持基板３により大きいサイズの半導体チップ７を固定することができる。この結果、パワートランジスタ１の出力増大を図ることができる。
【００５２】
（３）ソース電極パッド１１をソースリード５に近づけることができるため、ソース電極パッド１１とソースリード５を接続するワイヤ１４の長さを短くでき、オン抵抗の低減を図ることができる。
【００５３】
（実施形態２）
図９は本発明の他の実施形態（実施形態２）である半導体装置の樹脂封止体を取り除いた模式的平面図、図１０は半導体装置の断面図である。
【００５４】
本実施形態２は実施形態１のパワートランジスタ１において、ソース電極パッド１１とソースリード５を導体板５２で接続した例である。この実施形態では、導体板５２として、厚さ１５０〜２５０μｍ程度の可撓性のＡｌ箔からなるリボン・ストラップ５３を使用する。
【００５５】
本実施形態では、導体板５２による接続がしやすいようにするため、図９に示すように、ソースリード５が中央に位置させている。ソースリード５の左側にゲートリード６が位置し、右側にドレインリード４が位置している。ソースリード５のリードポスト５ａは、導体板５２を接続できるように他のリードの幅よりも広くなり、例えば、ソース電極パッド１１と略同じ幅となっている。このため、幅広いリボン・ストラップを接続することができる。リボン・ストラップ５３は可撓性のＡｌ箔からなり、超音波ボンディングによってソース電極パッド１１やソースリード５のリードポスト５ａに接続される。
【００５６】
即ち、パワートランジスタ１の製造においては、最初に、図７に示すようなリードフレーム４５が用意される。このリードフレーム４５は、パターニングされかつ一部で１段屈曲させた一枚の金属板からなり、第１電極（ドレイン電極）を構成するとともに半導体チップが固定される支持基板と、支持基板を先端に支持する第１電極リード（ドレインリード４）と、第１電極リードと並んで延在する第２電極リード（ソースリード５）及び制御電極リード（ゲートリード６）を有する。
【００５７】
また、下面に第１電極（ドレイン電極）を有し上面に第２電極パッド（ソース電極パッド１１）と制御電極パッド（ゲート電極パッド１２）を有する四角形の半導体チップ７が用意される。
【００５８】
つぎに、半導体チップ７をその第１電極部分（ドレイン電極）で導電性の接合材を介して支持基板３上に固定する。
【００５９】
つぎに、半導体チップ７のソース電極パッド１１とソース電極パッド１１を接続手段で電気的に接続するとともに、半導体チップ７のゲート電極パッド１２とゲートリード６を接続手段で電気的に接続する。ゲート電極パッド１２とゲートリード６は直径１２５μｍのＡｌワイヤ１５で接続するが、ソース電極パッド１１とソース電極パッド１１は前述のリボン・ストラップ５３で接続する。この場合、図９に示すように、ワイヤ１５はリボン・ストラップ５３の角部を横切るため、リボン・ストラップ５３の接続が終了した後、ゲート電極パッド１２とゲートリード６のリードポスト６ａをワイヤ１５で接続する必要がある。
【００６０】
つぎに、半導体チップ７，接続手段であるワイヤ１５及びリボン・ストラップ５３，ソースリード５及びゲートリード６の一部を絶縁性樹脂で封止して封止体２で被う。
【００６１】
つぎに、実施形態１と同様にリードフレーム４５の不要部分を切断除去するとともにリードを所定長さで切断する。
【００６２】
本実施形態によれば、幅広いのリボン・ストラップ５３を用いることから、さらにオン抵抗の低減が可能になる。本実施形態２のパワートランジスタ１も実施形態１のパワートランジスタ１と同様の効果を有する。
【００６３】
（実施形態３）
図１１は本発明の他の実施形態（実施形態３）である半導体装置の樹脂封止体を取り除いた模式的平面図、図１２は半導体装置の断面図である。
【００６４】
本実施形態では、実施形態２と同様にソース電極パッド１１とソースリード５を導体板５２で接続するが、本例では、導体板５２として、所定形状に成形した金属板５４を使用する。金属板５４は、例えば銅板からなっている。図１１に示すように、成形された金属板５４は、ソース電極パッド１１及びソースリード５のリードポスト５ａに接着材５５によって電気的に接続される。接着材５５は導電性樹脂や半田等を使用する。ただし、この場合、ソース電極パッド１１の表面にアンダーバリアメタル加工が必要である。これは、Ａｌ表面酸化膜によって導通阻害を防止するためである。アンダーバリアメタル層は、例えば、Ａｌパッド表面にＮｉ層を形成し、最上部はＮｉの酸化を防止するＡｕまたはＡｇからなっている。
【００６５】
本実施形態３においてもオン抵抗の低減が図れる。また、接着材５５を用いて金属板５４を接続することから，作業が容易になる。本実施形態３のパワートランジスタ１も実施形態２のパワートランジスタ１と同様の効果を有する。
【００６６】
（実施形態４）
図１３は本発明の他の実施形態（実施形態４）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【００６７】
本実施形態４は、実施形態１のパワートランジスタ１におけるソース電極パッド１１を、ソース電極パッド１１ａ，ｂの２本で構成し、それぞれのソース電極パッド１１ａ，ｂとソースリード５のリードポスト５ａをそれぞれワイヤ１４で接続したものである。そして、この例においても、リードポスト５ａ，６ａに近いソース電極パッド１１ａの中心線から距離ｇ程ゲート電極パッド１２はリードポスト５ａ，６ａから遠ざかる構造になっている。図１３においては、封止体２は省略してある。
【００６８】
本実施形態４のパワートランジスタ１も実施形態１と同様にゲート電極パッド１２がゲートリード６のリードポスト６ａから遠い位置にあることから、ワイヤボンディングに支障を来さない。また、ソース電極パッド１１ａの中心線部分は、半導体チップ７のソースリード５のリードポスト５ａ寄りの辺から、例えば、２ｍｍ程度となり、かつこの部分に第１ボンディングとしてワイヤ１４が接続されるため、ボンディングツールがリードポスト５ａに接触することもなく良好なワイヤボンディングが可能になる。このようにワイヤボンディングを支障を来さない位置となるならば、ソース電極パッド１１を３本，４本と多くしても問題はない。
【００６９】
本実施形態４の構成では、ソース電極パッド１１を複数本としたことから、ワイヤを接続する場所が多くなり、さらに多い本数のワイヤボンディングが可能になり、オン抵抗の低減が可能になる。本実施形態４のパワートランジスタ１も実施形態１のパワートランジスタ１と同様の効果を有する。
【００７０】
（実施形態５）
図１４は本発明の他の実施形態（実施形態５）である半導体装置の樹脂封止体を取り除いた模式的平面図、図１５は半導体装置の断面図、図１６は半導体装置の製造で使用するリードフレームの平面図である。
【００７１】
本実施形態５は、実施形態４と同様にソース電極パッド１１を複数設け、かつ各ソース電極パッド１１とソースリード５をワイヤ等の接続手段で電気的に接続する技術思想のものである。
【００７２】
本実施形態５では、図１４に示すように、ソース電極パッド１１をゲート電極パッド１２と同じ大きさの四角形とし、各リードの延在方向に交差する方向に（支持基板３の幅方向）沿って千鳥足跡状に複数設けた構造になっている。そして、ワイヤボンディングを効果的に行うため、ソースリード５を中央に配列させている。
【００７３】
図１６は本実施形態５のパワートランジスタ１を製造する際用いるリードフレーム４５ａである。このリードフレーム４５ａは、実施形態１のリードフレーム４５において、リードの配列が異なる。また、ソースリード５のリードポスト５ａの幅（長さ）が他のリード、即ち、ゲートリード６よりも広い点等においても異なる。
【００７４】
即ち、本実施形態１のパワートランジスタ１は、図１４に示すように、ソースリード５を中央に位置させ、ソースリード５の一側（左側）にゲートリード６を位置させ、ソースリード５の他側（右側）にドレインリード４を位置させている。そして、ソースリード５の幅、即ち、ソースリード５のリードポスト５ａの幅を、他のリードの幅（ゲートリード６のリードポスト６ａの幅）よりも広く形成している。即ち、千鳥足跡状に配列した各ソース電極パッド１１に接続するワイヤ１４の全てに接続するに充分な幅（長さ）になっている。そして、図１５にも示すように、各ソース電極パッド１１とソースリード５のリードポスト５ａはワイヤ１４によって接続されている。
【００７５】
本実施形態５においても、千鳥足跡状配列のソース電極パッド１１よりも遠い位置にゲート電極パッド１２が配置され、ゲート電極パッド１２へのワイヤボンディング時、ボンディングツールがリードポスト５ａに接触しないようになっている。千鳥足跡状配列のソース電極パッド１１においてもソースリード５のリードポスト５ａから充分離れていることから、ソース電極パッド１１へのワイヤボンディング時、ボンディングツールがソースリード５のリードポスト５ａに接触することもなく、確実なワイヤボンディングが可能になる。
【００７６】
本実施形態５のパワートランジスタ１においても、６本と多数のワイヤ１４でソース電極パッド１１とソースリード５を接続するため、オン抵抗の低減を図ることができる。本実施形態５のパワートランジスタ１も実施形態４のパワートランジスタ１と同様の効果を有する。
【００７７】
（実施形態６）
図１７は本発明の他の実施形態（実施形態６）である半導体装置の樹脂封止体を取り除いた模式的平面図、図１８は半導体装置の断面図である。
【００７８】
本実施形態６は実施形態５において、ソース電極パッド１１を千鳥足跡状配列とせず、実施形態４のように、平行に延在する２本の長いソース電極パッド１１ａ，１１ｂとしたものである。そして、複数のワイヤ１４のうちの各ワイヤは、図１８に示すように、ソース電極パッド１１ａ，１１ｂとソースリード５のリードポスト５ａに接続されるものである。
【００７９】
本実施形態６におけるワイヤボンディングにおいては、ボンディングツールで保持したワイヤの先端を、第１ボンディング点として半導体チップ７のリードポスト５ａから遠い位置にあるソース電極パッド１１ａに接続し、その後ボンディングツールでワイヤを引き回し、その途中部分を半導体チップ７のソース電極パッド１１ｂに接続し、さらにソースリード５のリードポスト５ａに接続し、その後リードポスト５ａの接続部分近傍でワイヤを切断して１張りのワイヤボンディングを終了する。即ち、本実施形態６ではステッチボンディングによってワイヤ１４の接続を行うものである。このステッチボンディングによってソース電極パッド１１ａ，１１ｂとソースリード５のリードポスト５ａを複数のワイヤ１４で接続する。図１９には７本のワイヤ１４が使用された例が示されている。
【００８０】
本実施形態６の場合においても、ソース電極パッド１１ａ，１１ｂとソースリード５を接続する複数のワイヤ１４のうち、ゲート電極パッド１２とゲートリード６を接続するワイヤ１５に近い側のワイヤ１４のワイヤボンディング時、ワイヤ１５と接触してショート不良を発生させることも考えられるので、ソース電極パッド１１ａ，１１ｂとソースリード５のワイヤボンディングを終了した後にゲート電極パッド１２とゲートリード６とのワイヤボンディングを行う必要がある。
【００８１】
本実施形態６においても、ソース電極パッド１１ａ，１１ｂよりも遠い位置にゲート電極パッド１２が配置され、ゲート電極パッド１２へのワイヤボンディング時、ボンディングツールがリードポスト５ａに接触しないようになっている。また、ソース電極パッド１１ａ，１１ｂとソースリード５とのワイヤボンディングにおいては、ソースリード５が中央に位置し、ソースリード５のリードポスト５ａとソース電極パッド１１ａ，１１ｂは同じ幅で対面していることから、ワイヤボンディングは他のリードポスト等に接触することもなく、良好なワイヤボンディングが可能になる。この結果、大きな半導体チップ７を支持基板３に固定することも可能になる。
【００８２】
本実施形態６のパワートランジスタ１においても、７本と多数のワイヤ１４でソース電極パッド１１とソースリード５を接続するため、オン抵抗の低減を図ることができる。本実施形態６のパワートランジスタ１も実施形態５のパワートランジスタ１と同様の効果を有する。
【００８３】
（実施形態７）
図１９は本発明の他の実施形態（実施形態７）である半導体装置の樹脂封止体を取り除いた模式的平面図、図２０は半導体装置の断面図である。
【００８４】
本実施形態７は、実施形態６において、中央のソースリード５を太くしたものである。ソースリード５のリードポスト５ａは多数のワイヤ１４を接続するため当然にして幅広であるが、リードポスト５ａから外れた封止体２から外部に突出する部分をも含み全体を他のリード（ドレインリード４，ゲートリード６）よりも幅広としてある。これにより、封止体２内の半導体チップ７で発生する熱を多数のワイヤ１４を介在させて太いソースリード５から外部に放散することができ、パワートランジスタ１の安定動作が可能になる。本実施形態７のパワートランジスタ１も実施形態６のパワートランジスタ１と同様の効果を有する。
【００８５】
（実施形態８）
図２１は本発明の他の実施形態（実施形態８）である半導体装置の樹脂封止体を取り除いた模式的平面図である。
【００８６】
本実施形態８は、実施形態１等と同様に制御電極リード（ゲートリード）及び第２電極リード（ソースリード）のリードポストに対して、第２電極パッド（ソース電極パッド）は近い位置にあり、制御電極パッド（ゲート電極パッド）は遠い位置にあるという技術思想のものである。
【００８７】
そして、さらに第２電極パッドを複数設けた場合、複数の第２電極パッドにおいて、リードポスト寄りの第２電極パッドは、リードポストに対して、制御電極パッドよりも近い位置にあるという技術思想のものである。
【００８８】
本実施形態８のパワートランジスタ１は、実施形態４のパワートランジスタ１において、ゲート電極パッド１２を四角形からなる半導体チップ７の左側の辺の途中部分に配置したものである。辺の途中にゲート電極パッド１２を設けるため、並列配置されるソース電極パッド１１ａ，１１ｂはその分短くなっている。
【００８９】
換言するならば、四角形からなる半導体チップ７の１辺はゲートリード６及びソースリード５の先端のリードポスト５ａ，６ａに対面している。そこで、この対面した辺に連なりかつ前記対面した辺に直交する左辺の途中部分にゲート電極パッド１２を位置させる。図２１に示すように、リードポスト５ａ，６ａに近いソース電極パッド１１ａの中心線からゲート電極パッド１２は距離ｍ程遠い位置に配置されている。しかし、この例では、リードポスト５ａ，６ａから遠い位置にあるソース電極パッド１１ｂに比較して、ゲート電極パッド１２はリードポスト５ａ，６ａに近くなっている。これにより、本実施形態８のパワートランジスタ１も実施形態１のパワートランジスタ１と同様の効果を有する。
【００９０】
（実施形態９）
図２２は本発明の他の実施形態（実施形態９）である半導体装置の模式的断面図である。本実施形態９は、実施形態１のパワートランジスタ１において、封止体２の端面から突出するドレインリード４，ソースリード５，ゲートリード６の３本のリードを、途中で折れ曲がるように成形し、先端は支持基板３の下面と略同じ高さに位置させて延在させた構造になっている。この先端の延在部分６０は、パワートランジスタ１を実装基板等に支持基板３を固定する際、３本のリードの先端の延在部分６０は実装基板に設けた配線との接続部分になる。実施形態９のパワートランジスタ１は面実装構造になっている。なお、ドレインリード４は支持基板３と同じ電位になることから、封止体２から突出する付け根部分で切断して実装基板には接続しない構造としてもよい。本実施形態８のパワートランジスタ１も実施形態１のパワートランジスタ１と同様の効果を有する。
【００９１】
以上本発明者によってなされた発明を実施形態に基づき具体的に説明したが、本発明は上記実施形態に限定されるものではなく、その要旨を逸脱しない範囲で種々変更可能であることはいうまでもない。実施形態では、第１電極，第２電極，制御電極をそれぞれ電極とするパワーＭＯＳＦＥＴを半導体チップに組み込んだ例を示したが、組み込む素子としてはパワーバイポーラトランジスタ，ＩＧＢＴ等のトランジスタ、あるいはトランジスタを含むＩＣでもよい。本発明は少なくともＴＯ−２２０構造の半導体装置には適用できる。
【符号の説明】
【００９２】
１…半導体装置（パワートランジスタ）、２…封止体（パッケージ）、３…支持基板（ヘッダ）、４…第１電極リード（ドレインリード）、５…第２電極リード（ソースリード）、５ａ，６ａ…リードポスト、６…制御電極リード（ゲートリード）、７…半導体チップ、８…取付用孔、９…孔、１０…第１電極（ドレイン電極）、１１…第２電極（ソース電極）パッド、１２…制御電極（ゲート電極）パッド、１４，１５…ワイヤ、２０…シリコン半導体基板、２１…エピタキシャル層、２２…チャネル（ｃｈ）層、２３…ウエル層、２５…トレンチ（溝）、２６…ポリシリコンゲート層、２７…ゲート絶縁膜、２８…ｐ＋領域、２９…ソース領域、３２…絶縁膜、３３…ソース電極、３４…厚い絶縁膜、３５…周辺ゲート配線、３６…ゲート電極配線、３７…ガードリング、３８…ガードリングコンタクト、３９…チャネルストッパ、４０…絶縁膜、４１…Ｖ溝枠、４２…押し潰し部分、４５…リードフレーム、４６…単位リードフレーム、４７…ダム、４８…枠片、４９…ガイド孔、５０…連結部、５２…導体板、５３…リボン・ストラップ、５４…金属板、５５…接着材、６０…延在部分、９０…半導体装置（パッケージ）、９１…支持基板（ヘッダ）、９２…封止体、９３…ゲートリード、９４…ドレインリード、９５…ソースリード、９６…取付孔、９７…半導体チップ、９８…Ｖ溝枠、９９…ゲート電極パッド、１００…ソース電極パッド、１０１，１０２…ワイヤ。
【特許請求の範囲】
【請求項１】
ＭＯＳＦＥＴを含み、前記ＭＯＳＦＥＴのゲート電極およびソース電極が形成された表面と、前記表面とは反対側に位置し、前記ＭＯＳＦＥＴのドレイン電極が形成された裏面と、を有する半導体チップと、
前記半導体チップが搭載された上面と、前記上面とは反対側に位置する下面と、を有するヘッダと、
前記ヘッダと電気的に接続されたドレインリードと、
前記半導体チップの前記ゲート電極と電気的に接続されたゲートリードと、
前記半導体チップの前記ソース電極と電気的に接続されたソースリードと、
前記半導体チップの前記ゲート電極と前記ゲートリードとを電気的に接続する第１導電性ワイヤと、
前記半導体チップの前記ソース電極と前記ソースリードとを電気的に接続する第２導電性ワイヤと、
前記半導体チップ、前記ヘッダの一部、前記ドレインリードの一部、前記ゲートリードの一部、前記ソースリードの一部、第１導電性ワイヤ、および第２導電性ワイヤを封止する封止体と、を有し、
前記半導体チップの裏面と前記ヘッダの上面とが対向するように前記半導体チップが前記ヘッダの上面に搭載されていることにより、前記半導体チップの前記ドレイン電極と前記ヘッダとは電気的に接続されており、
平面視において、前記ソース電極の一部が前記ゲート電極と前記ソースリードとの間に位置するように前記ソース電極は前記半導体チップの表面に配置されており、
前記ゲート電極と前記第１導電ワイヤとが接続している部分は、前記ソース電極と前記第２導電ワイヤとが接続している部分よりも前記ソースリードから遠い位置にあることを特徴とする半導体装置。
【請求項２】
請求項１に記載の半導体装置において、
前記第２導電性ワイヤは複数本であることを特徴とする半導体装置。
【請求項３】
請求項２に記載の半導体装置において、
前記複数の第２導電性ワイヤは、第１ワイヤと第２ワイヤとを含み、
平面視において、前記ソース電極と前記第１ワイヤとが接続している部分は、前記ソース電極と前記第２ワイヤとが接続している部分よりも前記ゲート電極と前記第１導電ワイヤとが接続している部分に近い位置にあることを特徴とする半導体装置。
【請求項４】
請求項１に記載の半導体装置において、
前記ソースリードは、前記ゲートリードと前記ドレインリードとの間に配置されていることを特徴とする半導体装置。
【請求項５】
請求項１に記載の半導体装置において、
前記ドレインリードは、前記ゲートリードと前記ソースリードとの間に配置されていることを特徴とする半導体装置。
【請求項６】
請求項１に記載の半導体装置において、
前記半導体チップの表面の一部には絶縁膜が形成され、平面視において前記ゲートおよびソース電極上に位置する部分がそれぞれ開口されており、前記第１および第２導電性ワイヤは、前記絶縁膜の前記開口している部分を介して前記ゲートおよびソース電極にそれぞれ電気的に接続されていることを特徴とする半導体装置。
【請求項７】
請求項１に記載の半導体装置において、
前記半導体チップは矩形状であって、
前記ゲート電極は、前記半導体チップの中心よりも角部に近くなるように配置されていることを特徴とする半導体装置。
【請求項８】
請求項７に記載の半導体装置において、
前記角部は、前記ソースリードから最も遠い位置にある角部であることを特徴とする半導体装置。
【請求項９】
請求項１に記載の半導体装置において、
前記ゲートリードは、前記第１導電性ワイヤが接続されるゲートリードポスト部を有し、
前記ソースリードは、前記第２導電性ワイヤが接続されるソースリードポスト部を有し、
前記ソースリードポスト部の前記ソースリードが延びる方向と直交する方向の幅は、前記ゲートリードポスト部の前記ゲートリードが延びる方向と直交する方向の幅よりも広いことを特徴とする半導体装置。
【請求項１０】
ＭＯＳＦＥＴを含み、前記ＭＯＳＦＥＴのゲート電極およびソース電極が形成された表面と、前記表面とは反対側に位置し、前記ＭＯＳＦＥＴのドレイン電極が形成された裏面と、を有する半導体チップと、
前記半導体チップが搭載された上面と、前記上面とは反対側に位置する下面と、を有するヘッダと、
前記ヘッダと電気的に接続されたドレインリードと、
前記半導体チップの前記ゲート電極と電気的に接続されたゲートリードと、
前記半導体チップの前記ソース電極と電気的に接続されたソースリードと、
前記半導体チップの前記ゲート電極と前記ゲートリードとを電気的に接続する導電性ワイヤと、
前記半導体チップの前記ソース電極と前記ソースリードとを電気的に接続する金属板と、
前記半導体チップ、前記ヘッダの一部、前記ドレインリードの一部、前記ゲートリードの一部、前記ソースリードの一部、導電性ワイヤ、および金属板を封止する封止体と、を有し、
前記半導体チップの裏面と前記ヘッダの上面とが対向するように前記半導体チップが前記ヘッダの上面に搭載されていることにより、前記半導体チップの前記ドレイン電極と前記ヘッダとは電気的に接続されており、
平面視において、前記ソース電極の一部が前記ゲート電極と前記ソースリードとの間に位置するように前記ソース電極は前記半導体チップの表面に配置されており、
前記ゲート電極と前記導電ワイヤとが接続している部分は、前記ソース電極と前記金属板とが接続している部分よりも前記ソースリードから遠い位置にあることを特徴とする半導体装置。
【請求項１１】
ＭＯＳＦＥＴを含み、前記ＭＯＳＦＥＴのゲート電極およびソース電極が形成された表面と、前記表面とは反対側に位置し、前記ＭＯＳＦＥＴのドレイン電極が形成された裏面と、を有する半導体チップと、
前記半導体チップが搭載された上面と、前記上面とは反対側に位置する下面と、を有するヘッダと、
前記ヘッダと電気的に接続されたドレインリードと、
前記半導体チップの前記ゲート電極と電気的に接続されたゲートリードと、
前記半導体チップの前記ソース電極と電気的に接続されたソースリードと、
前記半導体チップの前記ゲート電極と前記ゲートリードとを電気的に接続する第１導電性ワイヤと、
前記半導体チップの前記ソース電極と前記ソースリードとを電気的に接続する第２導電性ワイヤと、
前記半導体チップ、前記ヘッダの一部、前記ドレインリードの一部、前記ゲートリードの一部、前記ソースリードの一部、第１導電性ワイヤ、および第２導電性ワイヤを封止する封止体と、を有し、
前記半導体チップの裏面と前記ヘッダの上面とが対向するように前記半導体チップが前記ヘッダの上面に搭載されていることにより、前記半導体チップの前記ドレイン電極と前記ヘッダとは電気的に接続されていることを特徴とする半導体装置。
【請求項１】
ＭＯＳＦＥＴを含み、前記ＭＯＳＦＥＴのゲート電極およびソース電極が形成された表面と、前記表面とは反対側に位置し、前記ＭＯＳＦＥＴのドレイン電極が形成された裏面と、を有する半導体チップと、
前記半導体チップが搭載された上面と、前記上面とは反対側に位置する下面と、を有するヘッダと、
前記ヘッダと電気的に接続されたドレインリードと、
前記半導体チップの前記ゲート電極と電気的に接続されたゲートリードと、
前記半導体チップの前記ソース電極と電気的に接続されたソースリードと、
前記半導体チップの前記ゲート電極と前記ゲートリードとを電気的に接続する第１導電性ワイヤと、
前記半導体チップの前記ソース電極と前記ソースリードとを電気的に接続する第２導電性ワイヤと、
前記半導体チップ、前記ヘッダの一部、前記ドレインリードの一部、前記ゲートリードの一部、前記ソースリードの一部、第１導電性ワイヤ、および第２導電性ワイヤを封止する封止体と、を有し、
前記半導体チップの裏面と前記ヘッダの上面とが対向するように前記半導体チップが前記ヘッダの上面に搭載されていることにより、前記半導体チップの前記ドレイン電極と前記ヘッダとは電気的に接続されており、
平面視において、前記ソース電極の一部が前記ゲート電極と前記ソースリードとの間に位置するように前記ソース電極は前記半導体チップの表面に配置されており、
前記ゲート電極と前記第１導電ワイヤとが接続している部分は、前記ソース電極と前記第２導電ワイヤとが接続している部分よりも前記ソースリードから遠い位置にあることを特徴とする半導体装置。
【請求項２】
請求項１に記載の半導体装置において、
前記第２導電性ワイヤは複数本であることを特徴とする半導体装置。
【請求項３】
請求項２に記載の半導体装置において、
前記複数の第２導電性ワイヤは、第１ワイヤと第２ワイヤとを含み、
平面視において、前記ソース電極と前記第１ワイヤとが接続している部分は、前記ソース電極と前記第２ワイヤとが接続している部分よりも前記ゲート電極と前記第１導電ワイヤとが接続している部分に近い位置にあることを特徴とする半導体装置。
【請求項４】
請求項１に記載の半導体装置において、
前記ソースリードは、前記ゲートリードと前記ドレインリードとの間に配置されていることを特徴とする半導体装置。
【請求項５】
請求項１に記載の半導体装置において、
前記ドレインリードは、前記ゲートリードと前記ソースリードとの間に配置されていることを特徴とする半導体装置。
【請求項６】
請求項１に記載の半導体装置において、
前記半導体チップの表面の一部には絶縁膜が形成され、平面視において前記ゲートおよびソース電極上に位置する部分がそれぞれ開口されており、前記第１および第２導電性ワイヤは、前記絶縁膜の前記開口している部分を介して前記ゲートおよびソース電極にそれぞれ電気的に接続されていることを特徴とする半導体装置。
【請求項７】
請求項１に記載の半導体装置において、
前記半導体チップは矩形状であって、
前記ゲート電極は、前記半導体チップの中心よりも角部に近くなるように配置されていることを特徴とする半導体装置。
【請求項８】
請求項７に記載の半導体装置において、
前記角部は、前記ソースリードから最も遠い位置にある角部であることを特徴とする半導体装置。
【請求項９】
請求項１に記載の半導体装置において、
前記ゲートリードは、前記第１導電性ワイヤが接続されるゲートリードポスト部を有し、
前記ソースリードは、前記第２導電性ワイヤが接続されるソースリードポスト部を有し、
前記ソースリードポスト部の前記ソースリードが延びる方向と直交する方向の幅は、前記ゲートリードポスト部の前記ゲートリードが延びる方向と直交する方向の幅よりも広いことを特徴とする半導体装置。
【請求項１０】
ＭＯＳＦＥＴを含み、前記ＭＯＳＦＥＴのゲート電極およびソース電極が形成された表面と、前記表面とは反対側に位置し、前記ＭＯＳＦＥＴのドレイン電極が形成された裏面と、を有する半導体チップと、
前記半導体チップが搭載された上面と、前記上面とは反対側に位置する下面と、を有するヘッダと、
前記ヘッダと電気的に接続されたドレインリードと、
前記半導体チップの前記ゲート電極と電気的に接続されたゲートリードと、
前記半導体チップの前記ソース電極と電気的に接続されたソースリードと、
前記半導体チップの前記ゲート電極と前記ゲートリードとを電気的に接続する導電性ワイヤと、
前記半導体チップの前記ソース電極と前記ソースリードとを電気的に接続する金属板と、
前記半導体チップ、前記ヘッダの一部、前記ドレインリードの一部、前記ゲートリードの一部、前記ソースリードの一部、導電性ワイヤ、および金属板を封止する封止体と、を有し、
前記半導体チップの裏面と前記ヘッダの上面とが対向するように前記半導体チップが前記ヘッダの上面に搭載されていることにより、前記半導体チップの前記ドレイン電極と前記ヘッダとは電気的に接続されており、
平面視において、前記ソース電極の一部が前記ゲート電極と前記ソースリードとの間に位置するように前記ソース電極は前記半導体チップの表面に配置されており、
前記ゲート電極と前記導電ワイヤとが接続している部分は、前記ソース電極と前記金属板とが接続している部分よりも前記ソースリードから遠い位置にあることを特徴とする半導体装置。
【請求項１１】
ＭＯＳＦＥＴを含み、前記ＭＯＳＦＥＴのゲート電極およびソース電極が形成された表面と、前記表面とは反対側に位置し、前記ＭＯＳＦＥＴのドレイン電極が形成された裏面と、を有する半導体チップと、
前記半導体チップが搭載された上面と、前記上面とは反対側に位置する下面と、を有するヘッダと、
前記ヘッダと電気的に接続されたドレインリードと、
前記半導体チップの前記ゲート電極と電気的に接続されたゲートリードと、
前記半導体チップの前記ソース電極と電気的に接続されたソースリードと、
前記半導体チップの前記ゲート電極と前記ゲートリードとを電気的に接続する第１導電性ワイヤと、
前記半導体チップの前記ソース電極と前記ソースリードとを電気的に接続する第２導電性ワイヤと、
前記半導体チップ、前記ヘッダの一部、前記ドレインリードの一部、前記ゲートリードの一部、前記ソースリードの一部、第１導電性ワイヤ、および第２導電性ワイヤを封止する封止体と、を有し、
前記半導体チップの裏面と前記ヘッダの上面とが対向するように前記半導体チップが前記ヘッダの上面に搭載されていることにより、前記半導体チップの前記ドレイン電極と前記ヘッダとは電気的に接続されていることを特徴とする半導体装置。
【図１】
【図２】
【図３】
【図４】
【図５】
【図６】
【図７】
【図８】
【図９】
【図１０】
【図１１】
【図１２】
【図１３】
【図１４】
【図１５】
【図１６】
【図１７】
【図１８】
【図１９】
【図２０】
【図２１】
【図２２】
【図２３】
【図２４】
【図２５】
【図２６】
【図２】
【図３】
【図４】
【図５】
【図６】
【図７】
【図８】
【図９】
【図１０】
【図１１】
【図１２】
【図１３】
【図１４】
【図１５】
【図１６】
【図１７】
【図１８】
【図１９】
【図２０】
【図２１】
【図２２】
【図２３】
【図２４】
【図２５】
【図２６】
【公開番号】特開２０１１−１３５１１５（Ｐ２０１１−１３５１１５Ａ）
【公開日】平成２３年７月７日（２０１１．７．７）
【国際特許分類】
【出願番号】特願２０１１−８６２０１（Ｐ２０１１−８６２０１）
【出願日】平成２３年４月８日（２０１１．４．８）
【分割の表示】特願２００８−３０４５８（Ｐ２００８−３０４５８）の分割
【原出願日】平成１５年６月３０日（２００３．６．３０）
【出願人】（３０２０６２９３１）ルネサスエレクトロニクス株式会社 (8,021)
【出願人】（０００２３３５２７）株式会社ルネサス東日本セミコンダクタ (40)
【Ｆターム（参考）】
【公開日】平成２３年７月７日（２０１１．７．７）
【国際特許分類】
【出願日】平成２３年４月８日（２０１１．４．８）
【分割の表示】特願２００８−３０４５８（Ｐ２００８−３０４５８）の分割
【原出願日】平成１５年６月３０日（２００３．６．３０）
【出願人】（３０２０６２９３１）ルネサスエレクトロニクス株式会社 (8,021)
【出願人】（０００２３３５２７）株式会社ルネサス東日本セミコンダクタ (40)
【Ｆターム（参考）】
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