【課題】ラインパターン構造物の形成方法を提供すること。
【解決手段】ラインパターン構造物及びその形成方法において、ラインパターン構造物は切断部位を含むライン形状を有する少なくとも１つの第１ラインパターンを含む。最外郭に位置する前記第１ラインパターンと隣り合って前記第１ラインパターンと平行した延在ラインと、前記第１ラインパターンの切断部位と隣接する領域で前記第１ラインパターン方向へ向かうように前記延在ラインから突出された少なくとも１つの突出パターンを含む２つの第２ラインパターンを含む。前記ラインパターン構造物は不良が減少し、簡単な工程を通じて形成されてもよい。 （もっと読む）

【課題】リークパスを確実に防止することができる、半導体装置及び半導体装置の製造方法を提供する。
【解決手段】半導体装置は、ゲート絶縁膜を介して半導体基板上に設けられたゲート電極と、前記ゲート電極の側部に設けられた側壁絶縁膜と、前記半導体基板内における前記ゲート絶縁膜を挟むような位置に形成され、前記側壁絶縁膜により覆われた被覆領域と前記側壁絶縁膜により覆われていない露出領域とを有する、ソース又はドレイン領域と、前記ゲート電極及び前記側壁絶縁膜を覆うように形成された、エッチングストッパ膜と、前記半導体基板上に、前記エッチングストッパ膜を埋め込むように設けられた、層間絶縁膜と、前記層間絶縁膜を貫通するように設けられ、前記露出領域に接続される、第１セルコンタクトプラグとを具備する。前記エッチングストッパ膜は、前記被覆領域と前記露出領域との境界部分が完全に覆われるように、前記露出領域の一部を覆っている。 （もっと読む）

【課題】従来の蓚酸系エッチング液のような界面活性剤配合に伴う泡や蓚酸に由来する残渣の発生を生じることなく、界面活性剤を一切使用しなくても、濡れ性、泡切れ性が優れ、高精度で透明導電膜をエッチングすることができるエッチング液およびエッチング方法を提供すること。
【解決手段】少なくとも蓚酸を主成分とする導電膜用エッチング剤（Ａ）と、（Ｂ）群および（Ｃ）群から選ばれる少なくとも１種とを含有し、界面活性剤を一切含有しないことを特徴とする導電膜用エッチング液。 （もっと読む）

【課題】 ビアホール上にオーミック電極が形成された半導体装置において、装置の小型化を図ること。
【解決手段】 本半導体装置は、基板１０と、基板１０上に形成された半導体層１２と、半導体層上１２に形成されたソースまたはドレイン電極を構成するオーミック電極２０と、を備え、基板１０及び半導体層１２には、基板１０及び半導体層１２を貫通するビアホール３０が形成され、ビアホール３０は、少なくとも半導体層を貫通する第１ビアホール３２と、第１ビアホール３２下の基板１０に形成された、第１ビアホール３２より開口断面積が大きい第２ビアホール３４と、を含み、オーミック電極２０は、第１ビアホール３２の上に設けられている。 （もっと読む）

【課題】接続孔の内壁に絶縁膜を形成することにより、接続孔の径を小さくする場合において、接続孔内に導電膜を十分に埋め込むことができるようにする。
【解決手段】接続孔２１０，２２０の内壁上に絶縁性の第１膜３００を形成し、接続孔２１０，２２０の径を細らせる。次いで、第１膜３００が形成された接続孔２１０，２２０内に、第２膜５０を埋め込む。次いで、絶縁膜２００の表層を、ＣＭＰ法を用いて除去する。次いで、接続孔２１０，２２０から第２膜５０を除去する。次いで、接続孔２１０，２２０の第１膜３００上および接続孔２１０，２２０の底面上にバリアメタル膜３３０を形成し、さらに接続孔２１０，２２０内に導電膜からなるコンタクト３１０，３２０を埋め込む。 （もっと読む）

【課題】配線間の実効的な容量の増加を抑制する。
【解決手段】半導体装置１００は、６員環構造の環状シロキサンを原料とする絶縁膜１１と、絶縁膜１１に形成された配線溝１２と、配線溝１２に金属膜（配線メタル）１５が埋め込まれて構成される配線１０と、を有する。半導体装置１００では、配線溝１２の底面において、絶縁膜１１の内部よりも単位体積あたりの炭素原子数、又は／及び、窒素原子数が多い改質層１３が形成されている。 （もっと読む）

【課題】本発明は、パターンの製造方法に関し、特に、レーザーを用いてパターンを製造する方法に関する。
【解決手段】パターンの製造方法は、基板上に金属有機インク層（20）を形成する第1の段階；前記金属有機インク層（20）を半固体状態に硬化させる第2の段階；前記半固体状態の金属有機インク層（20）にレーザー光を照射し、照射された部分が固体状態に硬化されてパターンが形成される第3の段階、および、前記半固体状態の金属有機インク層（20）を除去して、前記パターンだけを残す第4の段階を含む。 （もっと読む）

【課題】複数の段差を備えた微細な３次元構造パターンの製造に好適なパターン製造方法を提供すること。
【解決手段】ハードマスク層１２の１段目の段差部１５’’のパターン位置から所望の距離をずらした位置のレジスト膜１３を露光させレジストパターン１４’を形成し、レジストパターン１４’をマスクとしてハードマスク層１２をエッチングすることで、所望の位置に３次元構造の２段目の段差部１９を形成出来る。また、ハードマスク層１２は基板１１に対してエッチング選択比が高い材料であるため、形成する３次元構造パターンに対応する２段目の段差部１９の段差は、所望する３次元構造パターンよりも、深さを小さく出来る。また、ハードマスク層１２に２段目の段差部１９を形成するにあたり、ハードマスク層１２を基板１１の表面を覆うように残存させることにより、複数段のパターン形成において、基板１１の帯電（チャージアップ）を抑制出来る。 （もっと読む）

【課題】低電位領域と高電位の配線が交差することの無い優れた耐圧性能を示す半導体装置を提供することを課題とする。
【解決手段】本発明の半導体装置は、ロジック回路（５０１）と、ロジック回路からの制御信号に従い低電位側パワー素子を駆動する低電位側駆動回路（５０２）と、ロジック回路からの制御信号がレベルシフト回路を介して入力され、高電位側パワー素子（５０６）を駆動する高電位側駆動回路（５０５）と、複数に重なったトレンチ分離領域により、前記高電位側パワー素子を含む高電位島を分離する多重トレンチ分離領域（５０８）と、を有する。 （もっと読む）

【課題】周期的に配列された複数本の配線と導電部材が設けられ、導電部材に配線よりも高い電圧を印加することができる半導体装置及びその製造方法を提供する。
【解決手段】実施形態に係る半導体装置は、一方向に延び、周期的に配列された複数本の第１配線と、前記複数本の第１配線からなる群の外側に配置され、前記一方向に延びる第２配線と、前記群と前記第２配線との間に設けられた第３配線と、前記第２配線から見て前記群の反対側に配置された複数の導電部材と、を備える。そして、前記第１配線と前記第３配線との最短距離、及び前記第３配線と前記第２配線との最短距離は、前記第１配線間の最短距離と等しく、前記第２配線と前記導電部材との最短距離は、前記第１配線間の最短距離よりも長い。 （もっと読む）

【課題】ケイ素含有誘電体材料の層の誘電率の修復
【解決手段】第１の誘電率および少なくとも１つの表面を有するケイ素含有誘電体材料の層の誘電率の修復方法であって、ケイ素含有誘電体材料の層の第１の誘電率が第２の誘電率まで増加しており、該方法は、ケイ素含有誘電体材料の層の少なくとも１つの表面と、ケイ素含有流体とを接触させるステップ、そしてケイ素含有誘電体材料の層の少なくとも１つの表面を、紫外線照射、熱、および電子ビームからなる群から選択されるエネルギー源に曝すステップ、の各ステップを含み、ケイ素含有誘電体材料の層は、ケイ素含有誘電体材料の層をエネルギー源に曝した後の第２の誘電率より低い第３の誘電率を有する、方法。 （もっと読む）

【課題】半導体素子及びその製造方法を提供する。
【解決手段】基板上で第１方向に延在するラインパターンと、ラインパターンの端部から、第１方向と異なる方向に延在する分岐ラインパターンとをそれぞれ含む第１導電ライン；第２導電ライン；第３導電ラインとを含む半導体素子であり、中間に位置する導電ラインの分岐ラインパターンは、他の導電ラインの分岐ラインパターン間に位置し、長さもさらに短い。これにより、コンタクト・パッドが、導電ラインの分岐ラインパターンと一体に形成されうる。 （もっと読む）

【課題】チップ面積の削減が可能な側壁加工プロセスを用いた半導体装置の製造方法を提供すること。
【解決手段】実施形態の半導体装置の製造方法は、基板301上に被加工膜302を形成し、被加工膜の上に芯材膜304を形成し、芯材膜の一部であって被加工膜の加工時まで残存させる残存部分とそれ以外の芯材膜である除去予定部分との間が所定距離の間隙となるように芯材膜をパターニングする。パターニングの後に芯材膜の側面に側壁305を形成して除去予定部分および残存部分の側面を側壁で覆うとともに残存部分と除去予定部分との間の所定距離の間隙を側壁で閉塞する。さらに、側面が側壁で覆われた残存部分の上面を覆うようにレジスト306を形成し、レジストの形成後にウェットエッチングを行うことにより除去予定部分を除去し、ウェットエッチングの後にレジストを除去する。レジストを除去した後に側壁および残存部分をマスクとして被加工膜を加工する。 （もっと読む）

【課題】所望のパターンが形成でき、製造工程の迅速化を図ることが可能なパターン形成方法を提供する。
【解決手段】本実施形態のパターン形成方法は、下地１０の上に第１の膜１１を選択的に形成する工程と、前記第１の膜１１および前記第１の膜に覆われていない前記下地１０の上に、第２の膜１３を形成する工程と、前記第２の膜１３の平均結晶粒径を前記第２の膜１３の膜厚以上に調整する工程と、前記第１の膜１１のエッチャントを前記第２の膜１３の表面に晒し、前記第１の膜１１の上に形成された前記第２の膜１３を前記下地上から選択的に除去する工程と、を備える。 （もっと読む）

【課題】プロセスマージンを大きく取れる配線配置構造を提供する。
【解決手段】基板上に形成された複数の第１配線６を含む第１配線層と、第１配線層上に形成され、第１配線６に接続された複数のビアコンタクト１０を含むコンタクト層と、コンタクト層上に形成され、ビアコンタクト１０に接続された複数の第２配線１４を含む第２配線層とを備える半導体装置において、コンタクトピッチは、第１配線６の最小配線ピッチ、又は、第２配線１４の最小配線ピッチ、よりも大きくなるようにする。 （もっと読む）

【課題】配線層で、配線密度の高い領域では隣接する配線間のショートを防ぎ、配線密度の低い領域では所望の平坦度が得られるとともに所望の配線抵抗が得られるように配線高さを制御できる配線形成方法を提供する。
【解決手段】まず、基板上に第１の絶縁膜１１１と、第１の絶縁膜１１１に比してＣＭＰ研磨レートの小さい所定の厚さの第２の絶縁膜１１２を順に積層させて層間絶縁膜１１を形成し、ついで、層間絶縁膜１１の第１の領域に第１の配線密度となり、第２の領域に第１の配線密度よりも低い第２の配線密度となるように、第２の絶縁膜１１２を貫通し、底部が第１の絶縁膜１１１に至る配線形成用溝２１を形成した後、配線形成用溝２１を形成した層間絶縁膜１１上に導電性材料膜１４を形成し、そして、ＣＭＰ法によって、少なくとも第１の領域で第１の絶縁膜１１１が露出、後退するように層間絶縁膜１１と導電性材料膜１４を研磨する。 （もっと読む）

【課題】 配線の特性の劣化を生じさせることなく、額縁面積を削減することが可能な回路基板、及び、該回路基板を備える表示装置を提供することを目的とする。
【解決手段】 支持基板上にトランジスタ及び外部接続端子が載置されたトランジスタ基板と、該トランジスタ基板上に取り付けられた外付け部材とを含んで構成される回路基板であって、上記外付け部材は、導電部材を介して外部接続端子と電気的かつ物理的に接続されており、上記トランジスタは、外部接続端子と横並びに配置されている回路基板である。 （もっと読む）

【課題】少ない層間接続プロセス工程数で、コンタクト部分の面積を小さくすることのできる半導体装置及び製造方法を提供する。
【解決手段】多層導体配線１０は、スルーホール１５は、導体１３の一部は、ひさし部１３Ｃとしてスルーホール１５の内側に露出する。そして、スルーホール１５のスルーホール用孔の内側に埋め込まれた埋め込み金属１６とひさし部１３Ｃとで、側面コンタクト構造を形成することができる。 （もっと読む）

【課題】微細化に伴うＬＥＲやＬＷＲに起因する配線の抵抗率の増大を抑制し得る手法を提供する。
【解決手段】半導体装置は、基板１０１と、基板上において同一の配線層内に形成された複数の配線１１１と、配線間に埋め込まれるよう形成された複数の絶縁膜１１２とを備える。そして、これら複数の配線は、両側面のＬＥＲ（Line Edge Roughness）の相関係数が正である配線が、連続して２^N本（Ｎは４以上の整数）以上並んだ配線群を含む。 （もっと読む）

【課題】 表面ラフネスの精度をさらに改善でき、進展するコンタクトホールやラインなどの微細化に対応可能なアモルファスシリコンの成膜方法を提供すること。
【解決手段】 下地２を加熱し、加熱した下地２にアミノシラン系ガスを流し、下地２の表面にシード層３を形成する工程と、下地２を加熱し、加熱した下地２の表面のシード層３にアミノ基を含まないシラン系ガスを供給し、アミノ基を含まないシラン系ガスを熱分解させることで、シード層３上にアモルファスシリコン膜を形成する工程と、を備える。 （もっと読む）