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国際特許分類[G06F11/10]の内容

物理学 (1,541,580) | 計算;計数 (381,677) | 電気的デジタルデータ処理 (228,215) | エラー検出;エラー訂正;監視 (10,741) | 故障の発生への応答,例.耐故障性 (1,764) | データの表現形態に冗長性をもたせることによるエラー検出またはエラー訂正,例.チェック・コードを用いることによるもの (355) | 符号化された情報に特別のビットまたは記号を付加したもの,例.パリティチェック,9または11のキャスティングアウト (297)

国際特許分類[G06F11/10]に分類される特許

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【課題】訂正前データと訂正後データを記憶するメモリの規模を小さくでき、オーバーフローの発生を未然に防止することができるエラー訂正方法を提供することにある。
【解決手段】所定時間においてエラー訂正処理を行い、そのエラー訂正処理の間に、エラー訂正処理にかかる負荷を検出し、検出した負荷が大きいほど、所定時間に対するエラー訂正処理の割合を大きくする。 (もっと読む)


【課題】複数のデータ処理回路を備える半導体集積回路の不具合箇所を特定することができる判定装置を提供すること。
【解決手段】本発明の一態様に係る判定装置は、第1OSDプレーン23A及び第2OSDプレーン23B、ビデオプレーン23Cを備えるLSI20Aの良否判定を行うものである。入力されるテストパターンに応じて複数の画像処理回路が形成する1フレームの画像において、第1OSDプレーン23Aからの出力に対応する領域Aと、第2OSDプレーン23Bからの出力に対応する領域BとをCRC演算する領域として設定する。CRC演算回路15は、領域A、領域BのCRC演算を行ってそれぞれの演算結果を算出し、それぞれの領域に対応する期待値と演算結果とをそれぞれ比較して、複数のデータ処理回路の良否判定を行うCPU22に出力する。 (もっと読む)


【課題】 簡易な構成でエラー検出・訂正符号付きデータを生成することが課題である。
【解決手段】 各バイトがnビットを有するmバイトの情報部分とmバイトの情報部分に設けられるmビットのエラー検出用ビットの冗長部分とを含むエラー検出用ビット付きデータのmバイトの情報部分の排他的論理和演算を行い、エラー検出・訂正符号付きデータの冗長部分のうち、log(n+1)ビットの一の部分を生成し、生成した一の部分とエラー検出用ビットとを入力してmビットの他の部分を生成する。 (もっと読む)


【課題】冗長ビットのビット長を抑制しつつ誤り訂正・検出の精度を向上させる。
【解決手段】誤り検出・誤り訂正を行う誤り制御を実現するための情報処理装置は、情報ビット列を取得する情報ビット列取得部と、情報ビット列に基づき、所定の符号を用いた符号化により、情報ビット列全体の誤り制御を実行可能な冗長ビット列を生成して、情報ビット列と冗長ビット列とを含む符号語を生成する符号化部とを備える。符号化部は、冗長ビット列に含まれる少なくとも1つのビットのそれぞれが、情報ビット列を複数に分割したビット列であって情報ビット列における連続した複数のビットにより構成されるビット列である分割情報ビット列の1つに対するパリティビットとしても機能するように、冗長ビット列を生成する。 (もっと読む)


nウェイディスク故障に対する保護を提供するようにエンコードされたストレージアレイのパリティグループにおける最大n個までの記憶装置(例えばディスク)故障の復旧を可能にするnウェイパリティ保護技術。ストレージアレイは、まず、m個のデータディスクを有するアレイを構成し、ここで、m=p−1であり、pは素数であり、その後、n−1個の対角パリティディスクをアレイに追加することによって形成される。各対角パリティセット(すなわち、対角)は、対角に含まれるアレイのデータブロック及び行パリティブロックを定義する傾斜に関連する。1つのパリティグループ内で共通の傾斜に関連する全ての対角は、対角パリティクラスとして編成される。各対角パリティクラスについて、対角パリティを記憶するために、対角パリティストレージディスクが設けられる。
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【課題】パリティエラー信号を強制的に発生させることができるパリティチェック回路を提供する。
【解決手段】レジスタ131aに入力されるデータのパリティビットを算出する第1パリティ算出回路133aと、レジスタ131aから出力されるデータのパリティビットを算出する第2パリティ算出回路136aと、第1パリティ算出回路133aが算出したパリティビットと第2パリティ算出回路136aが算出したパリティビットとを比較し、双方のパリティビットが互いに異なる場合、パリティエラー信号を出力するEXOR回路137aと、を備えるパリティチェック回路132aにおいて、自パリティチェック回路外部から入力されるパリティエラー信号発生指令に基づいて第1パリティ算出回路133aが算出したパリティビットを反転するEXOR回路134aをさらに備える。 (もっと読む)


【課題】アドレス比較回路等を不要にしてフォワーディング回路の規模を小さくして、半導体チップ上のフォワーディング回路の占める面積の小さいプロセッサを提供する。
【解決手段】プロセッサ1は、ALU11と、ロード/ストアユニット13と、タイマ13aと、ECC計算器13bと、複数のECCレジスタ13cと、を有する。ロード/ストアユニット13は、主メモリ14にデータを書き込む時に、書き込みデータとタイマ13aのカウント値とを主メモリ14に書き込むと共に、その書き込みデータについてのECCが正しくないことを示すECC状態フラグデータを主メモリ14にセットし、そのセット後、ECC計算器13bに書き込みデータについてのECCを計算させ、ECCが計算して得られた後、その計算して得られたECC主メモリ14に書き込むと共に、ECC状態フラグデータをリセットする。 (もっと読む)


【課題】安全性が要求される鉄道保安システムにおいても安全性を維持して誤り訂正符号を導入して情報を伝送してシステムの稼働率は向上させる。
【解決手段】地上装置1の送信機5は、入力した送信データに誤り訂正符号を付加して送信語を生成して通信路8に送信する。車上装置3の受信機6は、通信路8から受信した受信語に対してシンドロームを計算し、計算したシンドロームを用いて受信語の誤り訂正処理を行う。また、計算したシンドロームを用いて誤り訂正の状況を評価し、誤り訂正の状況があらかじめ設定された基準状態より良好な場合に誤り訂正処理をした受信データの出力を許可し、誤り訂正の状況があらかじめ設定された基準状態より悪くなっているとき誤り訂正処理をした受信データの出力を禁止する。 (もっと読む)


エラーデータを追跡するシステムおよび方法を開示する。この方法が、第1のエラー訂正コード演算のエラー場所に関連づけられた第1のチェックサムを受信するステップと、第2のエラー訂正コード演算のエラー場所に関連づけられた第2のチェックサムを受信するステップとを含む。第1のチェックサムは、第2のチェックサムと比較され、その比較結果に基づいてメモリアレイの領域に動作が開始される。
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