【課題】酸化物半導体膜を用いたＴＦＴでは、ソース・ドレイン電極のプラズマエッチング後に酸化物半導体膜の表面領域に酸素欠損が生成されオフ電流が高くなってしまうという課題があった。
【解決手段】ＴＦＴ１０１は、絶縁性基板１０上のゲート電極１１、ゲート電極１１上のゲート絶縁膜１２、ゲート絶縁膜１２上のインジウムを含む酸化物半導体膜１３、及び、酸化物半導体膜１３上のソース・ドレイン電極１４を有する。そして、酸化物半導体膜１３のソース・ドレイン電極１４が重ならない部分の表面層１５におけるＸＰＳスペクトルのインジウム３ｄ軌道起因のピーク位置が、表面層１５の下部に存在する酸化物半導体領域におけるＸＰＳスペクトルのインジウム３ｄ軌道起因のピーク位置よりも、高エネルギ側にシフトしている。 （もっと読む）

【課題】Ｃｕ合金層と半導体層との間に通常設けられるバリアメタル層を省略しても優れた低接触抵抗を発揮し得、さらに半導体層との密着性に優れており、且つ電気抵抗率が低減された配線構造を提供すること。
【解決手段】本発明の配線構造は、基板の上に、基板側から順に、半導体層と、Ｃｕ合金層とを備えた配線構造であって、前記Ｃｕ合金層は、基板側から順に、合金成分としてＭｎと、Ｘ（Ｘは、Ａｇ、Ａｕ、Ｃ、Ｗ、Ｃａ、Ｍｇ、Ａｌ、ＳｎおよびＮｉよりなる群から選択される少なくとも一種）を含有する第一層と、純Ｃｕ、またはＣｕを主成分とするＣｕ合金であって前記第一層よりも電気抵抗率の低いＣｕ合金からなる第二層、とを含む積層構造である。 （もっと読む）

【課題】樹脂基板上に設けたボトムゲート型薄膜トランジスタにおいて、製造プロセスを簡略化することにより、高品質で低コストの薄膜トランジスタとその製造方法及び画像表示装置を提供することを目的とする。
【解決手段】ボトムゲート型の薄膜トランジスタは、樹脂基板と、樹脂基板の同一面上に設けられたゲート電極と絶縁性密着層と、ゲート電極と絶縁性密着層との上に設けられたゲート絶縁層とを、少なくとも備える。また、ゲート電極は、金属を含む。また、絶縁性密着層は、ゲート電極に含まれる金属のオキシ水酸化物を含むことを特徴とする。また、金属は、Ａｌを含む金属であり、ゲート電極の膜厚は、１０ｎｍ以上１００ｎｍ以下である。 （もっと読む）

【課題】Ｃｕ配線層に含まれるＣｕの周囲への拡散を抑制すると共に密着性および動作特性に優れた半導体装置およびその製造方法、並びに、その半導体装置の製造に用いるスパッタリングターゲットを提供する。
【解決手段】実施の形態に係るスパッタリングターゲットは、１．５原子％以上５．０原子％以下のＭｎと、（Ｍｇの原子％）／（Ｍｎの原子％）で示される比率が０．３以上２．１以下となるＭｇと、１０ｗｔｐｐｍ以下のＣと、２ｗｔｐｐｍ以下のＯ_２と、を含むＣｕ合金を用いて形成される。 （もっと読む）

【課題】 本発明は、以上の点に鑑み、異種金属からなる導電層間に介在されるような場合でも十分なバリア性能を発揮し得るバリア層を生産性よく形成することができるバリア層の形成方法を提供する。
【解決手段】 バリア層ＢＭは、処理対象物Ｗを一方の導電層ＣＬ１を有するものとし、この処理対象物と、例えばＴｉ製のターゲット２とを真空処理室１ａ内に配置し、真空処理室内に希ガスを導入してプラズマ雰囲気を形成し、ターゲットをスパッタリングして一方の導電層表面に第１金属層を形成し、真空処理室内に酸素ガス及び窒素ガスを含むガスを導入してプラズマ雰囲気を形成し、第１金属層の表面を酸窒化処理すると共に、ターゲットをもプラズマ雰囲気に曝して当該ターゲット表面を酸窒化し、真空処理室内に希ガスを更に導入してプラズマ雰囲気を形成し、ターゲットをスパッタリングして酸窒化処理された表面に第２金属層を形成してなる。 （もっと読む）

【課題】金属半導体化合物電極の界面抵抗を低減する半導体装置の製造方法を提供する。
【解決手段】実施の形態によればｎ型半導体上に硫黄を含有する硫黄含有膜を堆積し、硫黄含有膜上に第１の金属を含有する第１の金属膜を堆積し、熱処理によりｎ型半導体と第１の金属膜を反応させて金属半導体化合物膜を形成するとともに、ｎ型半導体と金属半導体化合物膜との界面に硫黄を導入することを特徴とする半導体装置の製造方法である。 （もっと読む）

【課題】バリアメタル層を有する半導体装置を製造するに際し、パーティクルの発生を抑制可能な製造方法、及びこの製造方法を用いる半導体装置の製造装置を提供する。
【解決手段】
２つの金属層の間に金属化合物層が挟まれてなるバリアメタル層を有する半導体装置を製造するに際し、チタン及びタンタルのいずれか一方の金属元素から構成されるターゲットを希ガスの雰囲気でスパッタして、複数の金属層を下地配線上に積層する過程において最下層となる第１金属層に酸化処理を施す。次いで、最下層となる第１金属層の表面に第１金属酸化物層を形成した後に、層間において構成元素が異なるように、一つ以上の金属層を含む下地の表面に対して酸化処理、窒化処理、及び酸窒化処理のいずれかの処理を施す。こうした処理より第２金属化合物層を形成する。上記金属化合物層は、金属酸化物層の他、金属窒化物層や金属酸窒化物層であってもよい。 （もっと読む）

集積回路に使用する銅線のための集積回路用相互接続構造およびこれを作る方法が提供される。Ｍｎ、Ｃｒ、またはＶ含有層が、線からの銅の拡散に対しバリアを形成し、それにより、絶縁体の早期絶縁破壊を防ぎ、銅によるトランジスタの劣化を保護する。また、Ｍｎ、Ｃｒ、またはＶ含有層は、銅と絶縁体の間の強い接着を促進し、その結果、製造と使用中のデバイスの機械的健全性を保ち、さらに、デバイスの使用中の銅のエレクトロマイグレーションによる故障を防ぎ、また、環境からの酸素または水による銅の腐食を防ぐ。このような集積回路の形成に関しては、本発明の特定の実施形態により、Ｍｎ、Ｃｒ、Ｖ、またはＣｏを銅表面上に選択的に堆積させ、一方で、絶縁体表面上のＭｎ、Ｃｒ、Ｖ、またはＣｏの堆積を減らす、または防ぎさえもする方法が提供される。また、Ｍｎ、Ｃｒ、またはＶ含有前駆物質およびヨウ素または臭素含有前駆物質を使った銅の触媒堆積も提供される。 （もっと読む）

【課題】発光装置の信頼性を向上することを課題の一とする。
【解決手段】同一基板上に駆動回路用トランジスタを含む駆動回路部と、画素用トランジスタを含む画素部とを有する発光装置であり、駆動回路用トランジスタ及び画素用トランジスタは、酸化物絶縁層と一部接する酸化物半導体層を含む逆スタガ型のトランジスタである。画素部において酸化物絶縁層上にカラーフィルタ層と発光素子が設けられ、駆動回路用トランジスタにおいて、酸化物絶縁層上にゲート電極層及び酸化物半導体層と重なる導電層が設けられる。なお、ゲート電極層、ソース電極層及びドレイン電極層は金属導電膜を用いる。 （もっと読む）

【課題】高誘電体絶縁膜及びメタルゲート電極を有する半導体装置において、高仕事関数を得ると共にＮＢＴＩ信頼性劣化を低減する。
【解決手段】半導体装置１００において、基板１０１上に、高誘電体ゲート絶縁膜１０９を介してメタルゲート電極１１０が形成されている。高誘電体ゲート絶縁膜１０９とメタルゲート電極１１０との界面におけるメタルゲート電極１１０の側に、ハロゲン元素が偏析している。 （もっと読む）

【課題】Ｒｕ含有膜の表面に形成される金属含有膜の成膜性を向上させることができる半導体装置の製造方法を提供する。
【解決手段】半導体装置の製造方法は、以下の工程を含むものである。基板（半導体素子や層間膜が形成された半導体基板など）にＲｕ含有膜を形成する工程（Ｓ１００）、Ｒｕ含有膜の表面と接するように、Ｒｕより酸化還元電位が低い金属を含有する膜を形成する工程（Ｓ１０２）、基板をめっき液に浸漬させて、当該膜にめっき液を接触させる工程（Ｓ１０４）、基板をめっき液に浸漬させた状態で、当該膜を電気分解により除去してＲｕ含有膜を露出させるとともに、露出したＲｕ含有膜の表面に金属含有膜を電解めっきにより形成する工程（Ｓ１０６）。 （もっと読む）

【課題】ＰＭＩＳトランジスタのソースドレイン電極に高濃度のゲルマニウムを含むシリコンゲルマニウム層を用いても、シリコンゲルマニウム層に格子緩和を生じさせることなく、ソースドレイン電極の上部にシリコン層又は金属シリサイド層を形成できるようにする。
【解決手段】半導体装置は、ｎ型半導体領域１００の上にゲート絶縁膜１０１を介在させて形成されたゲート電極１０２と、その両側方に形成されたｐ型のソースドレイン電極１５０とを有している。ソースドレイン電極１５０は、ｎ型半導体領域１００に設けられた各リセス部１００ａに、その底部から少なくともチャネル領域の深さにまで形成されたシリコンゲルマニウム層１１１と、その上に形成され、炭素とシリコンゲルマニウム層のゲルマニウム濃度よりも低いゲルマニウムとを含むカーボンドープドシリコンゲルマニウム層１１２と、その上に形成された金属シリサイド層１１５とから構成される。 （もっと読む）

【課題】閾値電圧以外の電流特性に大きな影響を与えることなく、選択的に閾値電圧を制御できる有機薄膜トランジスタを提供する。
【解決手段】本発明の有機薄膜トランジスタ１００は、基板１上に、ゲート電極２と、ゲート絶縁膜３と、ソース電極４と、ドレイン電極５と、有機半導体層７とが形成されており、さらに、ソース電極４表面に、ベンゼンチオール化合物からなるチオール化合物層８が形成され、ドレイン電極５の表面に、ベンゼンチオール化合物からなるチオール化合物層９が形成されている。 （もっと読む）

【課題】バリア膜とドレイン電極膜およびソース電極膜が高い密着強度を有する薄膜トランジスターを提供する。
【解決手段】上記酸化ケイ素膜のバリア膜と、上記純銅膜のドレイン電極膜およびソース電極膜の間に、水素プラズマ処理後の厚さ方向断面組織が、（ａ）上記純銅膜のドレイン電極膜およびソース電極膜側に形成された純銅化帯域と、（ｂ）上記酸化ケイ素膜のバリア膜との界面部に形成され、構成成分がＣｕとＣａと酸素とＳｉからなる成分凝集帯域、の２帯域で構成され、上記成分凝集帯域の厚さ方向に形成されたＣａおよび酸素の含有ピークの最高含有量が、それぞれＣａ：５〜２０原子％、酸素：３０〜５０原子％、であり、かつ、１０〜１００ｎｍの目標膜厚を有する密着強化膜を介在させる。 （もっと読む）

【課題】純ＡｌまたはＡｌ合金のＡｌ系合金配線と半導体層との間のバリアメタル層を省略することが可能なダイレクトコンタクト技術であって、幅広いプロセスマージンの範囲においてＡｌ系合金配線を半導体層に直接かつ確実に接続することができる技術を提供する。
【解決手段】本発明の配線構造は、基板の上に、基板側から順に、半導体層と、純ＡｌまたはＡｌ合金のＡｌ系合金膜とを備えた配線構造であって、前記半導体層と前記Ａｌ系合金膜との間に、基板側から順に、窒素、炭素、およびフッ素よりなる群から選択される少なくとも一種の元素を含有する（Ｎ、Ｃ、Ｆ）層と、ＡｌおよびＳｉを含むＡｌ−Ｓｉ拡散層との積層構造を含んでおり、且つ、前記（Ｎ、Ｃ、Ｆ）層を構成する窒素、炭素、およびフッ素のいずれかの元素は、前記半導体層のＳｉと結合している。 （もっと読む）

【課題】半導体基板上において、下方に浮遊ゲートを有するとともに上方に制御ゲートを有するメモリセルトランジスタの、前記制御ゲートを完全にシリサイド化するとともに、前記半導体基板上において形成した選択ゲートトランジスタなどの制御トランジスタの、シリサイド化の過度の進行を抑制し、書き込み速度の遅延や閾値などの変動を抑制したスタックゲート型不揮発性半導体メモリを提供する。
【解決手段】メモリセルトランジスタの制御ゲートは、酸化層を含まないシリサイドから構成し、制御トランジスタは、層間絶縁膜を貫通するようにして半導体層及びシリサイド層を電気的に接続する追加のシリサイド層を有し、前記追加のシリサイド層は、底面及び側面において、前記半導体層及び前記シリサイド層と、シリサイド化進行防止層で離隔するようにして構成する。 （もっと読む）

【課題】電極材料の材料選択性が広く、キャリア注入効率の高い薄膜トランジスタおよびその製造方法を提供することを課題とする。
【解決方法】絶縁基板上に少なくとも、ゲート電極、ゲート絶縁膜が順次積層され、且つ前記ゲート絶縁膜上にソース電極とドレイン電極が設けられ、且つ半導体膜が前記ソース電極と前記ドレイン電極との間の前記ゲート絶縁膜上に設けられた薄膜トランジスタであって、前記ソース電極と前記ドレイン電極が電子吸引性の官能基を有する化合物で表面処理されていることを特徴とする薄膜トランジスタ。 （もっと読む）

ゲート絶縁膜に高誘電率膜を用いるＭＯＳＦＥＴにおいて、基板−高誘電率膜間の低誘電率層（シリコン酸化膜）を増大させないようにするために、基板（１）上に高誘電率膜（３）、拡散バリア層（４）を堆積した後、高誘電率膜（３）の膜質改善のための熱処理を行う。次に、ゲート電極材料膜を堆積し、これをパターニングしてゲート電極（６）を形成する。このエッチング工程において、高誘電率膜３）はその側面がプラズマに曝されることにより、電荷が注入されまたダメージを受ける。この電荷を逃がしダメージを修復するために拡散バリア層（８）でゲート部を含む全面を被覆して熱処理を行う。その後、ソース・ドレイン領域となる不純物拡散層を形成する。
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