【課題】深いレベルのドーパントがほとんど存在しない半絶縁性のＳｉＣ基板上にＭＥＳＦＥＴを形成することにより、バックゲート効果が減少された、ＳｉＣのＭＥＳＦＥＴを提供する。
【解決手段】半絶縁性の基板上１０に選択的にドープされたＰ型の炭化珪素の層１３、及びＮ型のエピタキシャル層１４を積層し、背面ゲート効果を減少させる。また２つの凹部を有するゲート構造体も備える。これにより、出力コンダクタンスを１／３に減少することができ、また電力のゲインを３ｄｂ増加することができる。クロム４２をショットキーゲート接点として利用することもでき、酸化物−窒化物−酸化物（ＯＮＯ）の保護層６０を利用して、ＭＥＳＦＥＴ内の表面効果を減少させる。また、ソース及びドレインのオーム接点をｎ型チャネル層上に直接形成して、これにより、ｎ⁺領域を製造する必要がなくなる。 （もっと読む）

【課題】より高い破壊電圧およびより低いオン抵抗を含み、高周波数において十分に機能
するパワースイッチングデバイスを提供する。
【解決手段】多重フィールドプレートトランジスタが、活性領域、ならびにソース、ドレ
イン、およびゲートを含む。第１のスペーサ層が、活性領域の上方でソースとゲートの間
にあり、第２のスペーサ層が、活性領域の上方でドレインとゲートの間にある。第１のス
ペーサ層上の第１のフィールドプレート、及び第２のスペーサ層上の第２のフィールドプ
レートが、ゲートに接続される。第３のスペーサ層が、第１のスペーサ層、第２のスペー
サ層、第１のフィールドプレート、ゲート、および第２のフィールドプレート上にあり、
第３のフィールドプレートが、第３のスペーサ層上にあり、ソースに接続される。 （もっと読む）

【課題】より高い破壊電圧およびより低いオン抵抗を含み、高周波数において十分に機能
するパワースイッチングデバイスを提供する。
【解決手段】多重フィールドプレートトランジスタが、活性領域、ならびにソース、ドレ
イン、およびゲートを含む。第１のスペーサ層が、活性領域の上方でソースとゲートの間
にあり、第２のスペーサ層が、活性領域の上方でドレインとゲートの間にある。第１のス
ペーサ層上の第１のフィールドプレート、及び第２のスペーサ層上の第２のフィールドプ
レートが、ゲートに接続される。第３のスペーサ層が、第１のスペーサ層、第２のスペー
サ層、第１のフィールドプレート、ゲート、および第２のフィールドプレート上にあり、
第３のフィールドプレートが、第３のスペーサ層上にあり、ソースに接続される。 （もっと読む）

【課題】 チャネルの高い移動度を得ながら、かつ、縦方向耐圧およびゲート電極端における耐圧の両方の耐圧性能を確実に得ることができる、半導体装置およびその製造方法を提供する。
【解決手段】 ｎ型ドリフト層および該ｎ型ドリフト層上に位置するｐ型層を含むＧａＮ系積層体に、開口部が設けられ、開口部を覆うように位置する、チャネルを含む再成長層と、再成長層に沿って該再成長層上に位置するゲート電極とを備え、開口部はｎ型ドリフト層に届いており、ゲート電極の端は、平面的に見てｐ型層から外れた部分がないように位置していることを特徴とする。 （もっと読む）

【課題】電界集中を緩和させることにより、高耐圧、高信頼性を得ることが可能な半導体装置とその製造方法を提供する。
【解決手段】本発明の実施形態は、半導体基板と、半導体基板上に設けられるゲート電極と、ゲート電極を挟んで半導体基板上に設けられるソース電極及びドレイン電極と、ゲート電極の少なくともドレイン電極側のエッジの下部に設けられるリセスと、を備える。 （もっと読む）

【課題】化合物半導体層のクラックをより一層低減することができる化合物半導体装置及びその製造方法を提供する。
【解決手段】基材１と、基材１の上方に形成された初期層２と、初期層２上に形成され、III−V族化合物半導体を含むコア層３と、が設けられている。初期層３として、コア層３に含まれるIII-V族化合物半導体のIII族原子の層が形成されている。 （もっと読む）

【課題】材料の熱膨張係数の差に起因する反り等を抑制しつつ良好な結晶性の電子走行層及び電子供給層を得ることができる化合物半導体装置及びその製造方法を提供する。
【解決手段】基板１と、基板１上方に形成された電子走行層３と、電子走行層３上方に形成された電子供給層４と、基板１と電子走行層３との間に形成され、Ａｌ_xＧａ_1-xＮ（０≦ｘ≦１）を含むバッファ層２と、が設けられている。ｘの値は、バッファ層２の厚さ方向で複数の極大及び複数の極小を示し、バッファ層２中の厚さが１ｎｍの任意の領域内では、ｘの値の変化量が０．５以下となっている。 （もっと読む）

【課題】ＧａＮ基板上に結晶成長する各半導体層の平坦性向上した半導体基板を実現し、この半導体基板を基礎として、特性の高性能化された半導体発光素子を提供する。
【解決手段】ｐ型電極３２と、ｎ型電極３１と、ｐ型電極３２に接続され、複数のｐ型窒化物系III−Ｖ族化合物半導体からなるｐ型積層構造（１６〜２０）と、ｎ型電極３１に接続され、複数のｎ型窒化物系III−Ｖ族化合物半導体であるｎ型積層構造（１１〜１４）と、ｐ型積層構造（１６〜２０）とｎ型積層構造（１１〜１４）との間に形成された窒化物系III−Ｖ族化合物半導体からなる活性層１５とを備え、ｎ型積層構造（１１〜１４）がＳｉを５ｘ１０17ｃｍ-3以上２ｘ１０19ｃｍ-3以下の濃度で含有し、厚さが０．３ｎｍ以上２００ｎｍ以下のドープ層１０と、ドープ層１０よりも活性層１５側に設けられた超格子層１３とを含む。 （もっと読む）

【課題】等価回路により電圧の累積効果を達成することが可能であって、ハイブレークダウン電圧の特性を有する高電子移動度トランジスターデバイスを提供する。
【解決手段】本発明は、製造プロセスで高電子移動度トランジスターを定義し、内部接続の方法で前記高電子移動度トランジスターを直列接続させた直列接続式の高電子移動度トランジスターデバイス及びその製造方法。 （もっと読む）

【課題】 ゲート電極からソース及びドレインまでの領域を覆う絶縁膜が、寄生容量増大の要因になっている。
【解決手段】 半導体層を有する基板の上にゲート電極が形成されている。半導体層の上に、ゲート電極から相互に反対側に離れて、ソース電極及びドレイン電極が形成されている。ソース電極とドレイン電極との間の半導体層の上に、ソース電極及びドレイン電極から離れて配置されたゲート横絶縁膜が形成されている。ゲート横絶縁膜には、ゲート電極の下端が充填されたゲート用開口が設けられている。 （もっと読む）

【課題】絶縁膜上に保護膜を形成した構造において、絶縁耐圧の低下を防ぐ。
【解決手段】基板上に形成された第１の半導体層と、前記第１の半導体層上に形成された第２の半導体層と、前記第２の半導体層上に形成されたソース電極及びドレイン電極と、前記第２の半導体層上に形成された絶縁膜と、前記絶縁膜上に形成されたゲート電極と、前記絶縁膜を覆うように形成された保護膜と、を有し、前記保護膜は、熱ＣＶＤ、熱ＡＬＤ、真空蒸着のいずれかにより形成されたものであることを特徴とする半導体装置により上記課題を解決する。 （もっと読む）

【課題】窒化ガリウム材料デバイスおよびその形成方法を提供する。
【解決手段】該デバイスは、電極規定層２４を包含する。電極規定層は典型的にはその内部に形成されたビア２６を有し、該ビア内に電極１８が（少なくとも部分的に）形成される。したがって、ビアは、電極の寸法を（少なくとも部分的に）規定する。いくつかの場合において、電極規定層は、窒化ガリウム材料領域上に形成された不動態化層である。 （もっと読む）

【課題】
本発明は、ソース電極およびドレイン電極の熱耐久性を向上させて、かつ製造過程においてオーミック性に与える不安定要因を取り除き信頼性および量産性の高いＧａＮ系ＨＥＭＴを提供する。
【解決手段】
化合物半導体装置は、基板と、前記基板上に形成された窒化ガリウム系半導体と、前記窒化ガリウム系半導体上に形成された窒化ガリウム系保護層と、前記窒化ガリウム系保護層上にタンタルとアルミニウムが任意の順に積層されてなるオーミック電極とを備え、前記オーミック電極が形成された箇所の前記窒化ガリウム系保護層の膜厚は、前記オーミック電極が形成されていない箇所の前記窒化ガリウム系保護層の膜厚よりも薄い。 （もっと読む）

【課題】窒化物ベースの半導体チャネル層上に窒化物ベースの半導体バリア層を形成すること、および窒化物ベースの半導体バリア層のゲート領域上に保護層を形成することによって、トランジスタが製作される。
【解決手段】パターニングされたオーム性接触金属領域が、バリア層上に形成され、第１および第２のオーム性接触を形成するためにアニールされる。アニールは、保護層をゲート領域上に載せたままで実施される。バリア層のゲート領域上に、ゲート接点も形成される。ゲート領域内に保護層を有するトランジスタも形成され、バリア層の成長させたままのシート抵抗と実質的に同じシート抵抗をもつバリア層を有するトランジスタも同様である。 （もっと読む）

【課題】本発明は、金属半導体電界効果トランジスタ（ＭＥＳＦＥＴ）を提供する。
【解決手段】このＭＥＳＦＥＴは、ソース（１３）とドレイン（１７）とゲート（２４）とを備えている。このゲート（２４）を、ソース（１３）とドレイン（１７）の間及びｎ導電型チャネル層（１８）上に設ける。ドレイン（１７）に向かって延びている端部を備えるｐ導電型領域（１４）をソースの下に設ける。このｐ導電型領域（１４）をｎ導電型チャネル領域（１８）から隔ててソース（１３）に電気的に結合させる。 （もっと読む）

【課題】所望のレジストパターンが形成可能な、インジウムおよび／またはアルミニウムを含む第１の層からなるフィールド領域を有する半導体装置の製造方法を提供する。
【解決手段】インジウムおよび／またはアルミニウムを含む第１の層からなるフィールド領域と、第１の層および第１の層とは異なる半導体層からなるメサ領域と、を備える半導体基板を用いた半導体装置の製造方法であって、フィールド領域表面に、半導体基板表面から半導体基板上に形成する電子ビーム露光用レジストへのインジウムおよびアルミニウムを含む成分の拡散を抑制する被覆層を形成する工程と、フィールド領域表面に被覆層が形成された半導体基板上に電子ビーム露光用レジストを塗布し、メサ領域の一部に電子ビームを露光し、現像することでメサ領域に開口部を有するレジストパターンを形成する工程と、メサ領域に開口部を有するレジストパターンを用いて半導体基板を修飾する工程とを有する製造方法。 （もっと読む）

【課題】絶縁ゲート型（ＭＩＳ型）のＰ−ＨＥＭＴ構造において、チャネル層のキャリア移動度を向上し、界面準位の影響を低減した、良好なトランジスタ性能を実現できる技術を提供する。
【解決手段】ベース基板と、第１結晶層と、絶縁層とを有し、前記ベース基板、前記第１結晶層および前記絶縁層が、前記ベース基板、前記第１結晶層、前記絶縁層の順に位置し、前記第１結晶層が、ＧａＡｓまたはＡｌＧａＡｓに擬格子整合できるＩｎ_ｘＧａ_１−ｘＡｓ（０．３５≦ｘ≦０．４３）からなる半導体基板を提供する。前記第１結晶層は、電界効果トランジスタのチャネル層に適用できる層であってもよく、前記絶縁層は、前記電界効果トランジスタのゲート絶縁層に適用できる層であってもよい。前記第１結晶層の７７Ｋにおけるフォトルミネッセンス発光のピーク波長が、１０７０ｎｍより大きいものであってもよい。 （もっと読む）

【課題】絶縁ゲート型Ｐ−ＨＥＭＴ構造において、良好なトランジスタ性能を実現する。
【解決手段】ベース基板、第１結晶層、第２結晶層および絶縁層をこの順に有し、第１結晶層と第２結晶層との間、または、ベース基板と第１結晶層との間に位置する第３結晶層をさらに有し、第２結晶層が、第１結晶層を構成する結晶に格子整合または擬格子整合し、かつ第１結晶層を構成する結晶よりも禁制帯幅が大きい結晶からなり、第３結晶層が、第１結晶層を構成する結晶に格子整合または擬格子整合し、かつ第１結晶層を構成する結晶よりも禁制帯幅が大きい結晶からなり、第３結晶層は、ドナーまたはアクセプタとなる第１原子を含み、第３結晶層がドナーとなる第１原子を含む場合、第２結晶層が、アクセプタとなる第２原子を含み、第３結晶層がアクセプタとなる第１原子を含む場合、第２結晶層が、ドナーとなる第２原子を含む半導体基板。 （もっと読む）

【課題】ゲートのリーク電流を少なくする。
【解決手段】サファイアからなる基板１１上に膜厚が３０ｎｍのＧａＮからなる核形成層１２を形成し、核形成層１２上に膜厚が２μｍのＧａＮからなるバッファ層１３を形成し、バッファ層１３上に膜厚が２０ｎｍでありかつＩｎ組成が０．２５のＩｎＡｌＮからなるバリア層１６の第１の層１４を形成し、第１の層１４上に膜厚が２０ｎｍでありかつＩｎ組成が０．１５のＩｎＡｌＮからなるバリア層１６の第２の層１５を形成し、第２の層１５上にＡｌ／ＴｉまたはＴｉ／Ａｕからなるソース電極１７、ドレイン電極１８をオーミック接合により形成し、第２の層１５が除去された部分にＮｉ／Ａｕからなるゲート電極１９を形成する。 （もっと読む）

【課題】ＧａＡｓデバイスにおいて、空洞上に浮遊するＧａＡｓ層に素子形成を行うことにより、浮遊容量を抑え、高速化・低電力化を図ることが可能な半導体装置とその製造方法を提供する。
【解決手段】本発明の実施形態は、半導体基板１１上に形成される空洞１４と、空洞１４上に形成されるＧａＡｓエピタキシャル層１３と、ＧａＡｓエピタキシャル層１３上に形成されるゲート電極１５と、それぞれＧａＡｓエピタキシャル層１３上に形成され、隣接するゲート電極１５を挟むように形成される一対のソース電極１６及びドレイン電極１７と、を備える。 （もっと読む）