【課題】トランジスタのオン電流を十分に確保することが可能な信頼性の高い半導体装置を提供する。
【解決手段】活性領域６を分断する２つの埋め込みゲート用の溝部８ａ，８ｂにゲート絶縁膜９を介して埋め込まれたゲート電極７ａ，７ｂと、２つの埋め込みゲート用の溝部８ａ，８ｂによって分断された３つの活性領域６ａ，６ｂ，６ｃのうち、中央部に位置する活性領域６ｂを分断するビットコンタクト用の溝部１１の両側面に、埋め込みゲート用の溝部８ａ，８ｂの底面と同程度の深さで不純物を拡散させることによって形成された第１の不純物拡散層１３ａ，１３ｂと、中央部を挟んだ両側に位置する活性領域６ａ，６ｃに、ゲート電極７ａ，７ｂの上面と同程度の深さで不純物を拡散させることによって形成された第２の不純物拡散層１４ａ，１４ｂとを備える。 （もっと読む）

【課題】基体に形成されたトレンチ内に酸化シリコンを埋め込むために使用するのに好適なトレンチ埋め込み用樹脂組成物を提供すること。
【解決手段】本発明に係るトレンチ埋め込み用樹脂組成物は、酸化シリコン粒子をトレンチ埋め込み用樹脂組成物全体に対して０．３５重量％以上２．２０重量％以下で、並びに、一般式（１）〜（３）で表される化合物の合計に対して、一般式（１）：Ｓｉ（ＯＲ^１）_４で表されるテトラアルキシキシラン化合物を４５ｍｏｌ％以上８７ｍｏｌ％以下で、一般式（２）：Ｒ^２Ｓｉ（ＯＲ^１）_３で表されるトリアルコキシシラン化合物を１０ｍｏｌ％以上５０ｍｏｌ％以下で、そして一般式（３）：Ｒ^２_２Ｓｉ（ＯＲ^１）_２で表されるジアルコキシシラン化合物を１．５ｍｏｌ％以上３．６ｍｏｌ％以下で含有する。 （もっと読む）

【課題】シリコンエピタキシャル層の支えの喪失を防止した、局所ＳＯＩ構造の形成方法の提供。
【解決手段】ＳｉＧｅ混晶層３１ＳＧ１〜３１ＳＧ４とシリコンエピタキシャル層３１ＥＳ１，３１ＥＳ２，３１ＥＳ３および３１ＥＳ４が積層された構造において、
それぞれ、Ｎウェル３１ＮＷ及びＰウェル３１ＰＷがＳｉＧｅ混晶層３１ＳＧ１〜３１ＳＧ４側に突き出る構造を形成し、ＳｉＧｅ混晶層３１ＳＧ１〜３１ＳＧ４をエッチングにより除去する際に、支えとなるようにする。 （もっと読む）

【課題】第１のトランジスタと第２のトランジスタが、ぞれぞれのドレイン領域とソース領域を共有して同一の半導体基板上に形成される構成の半導体装置の製造において、それぞれのトランジスタのソース領域およびドレイン領域の直下に埋め込み絶縁膜を効率的に形成できる製造方法を提供する。
【解決手段】半導体基板上にそれぞれのトランジスタのソース領域およびドレイン領域に対応してトレンチを形成し、前記トレンチをＳｉＧｅ混晶層と半導体層を順次形成することにより充填し、さらに第１のトランジスタのソース領域および第２のトランジスタのドレイン領域直下のＳｉＧｅ混晶層を、素子分離溝を介して選択エッチングにより除去し、第１のトランジスタのドレイン領域および第２のトランジスタのソース領域として共有される拡散領域直下のＳｉＧｅ混晶層を、前記拡散領域に形成した孔を介して選択エッチングし、除去する。 （もっと読む）

【課題】塗布法により幅の広いトレンチに埋め込みを行った場合にも、ディンプルが生じず、はがれやにごりなどなく、均質で、平坦な表面を有する硬化膜を形成することができる硬化性組成物を提供する。
【解決手段】以下の（Ａ）成分〜（Ｃ）成分を含有することを特徴とする硬化性組成物。（Ａ）成分：脱離基を有するエポキシ基含有ポリシロキサンであり、該ポリシロキサン中に含まれる全Ｓｉ原子の数を１００ｍｏｌ％とするとき、前記脱離基の含有割合が３５ｍｏｌ％以下であるエポキシ基含有ポリシロキサン。（Ｂ）成分：シリコーン系界面活性剤。（Ｃ）成分：溶剤。 （もっと読む）

【課題】均一で高い充填密度を有し、かつ欠陥が少ない絶縁膜を形成することができる方法の提供。
【解決手段】基板表面に、二酸化ケイ素微粒子と、ポリマーと、界面活性剤と、分散媒とを含む二酸化ケイ素分散液を塗布し、次いでポリシラザン組成物を塗布した後、加熱して絶縁膜を形成させる、絶縁膜の形成方法。 （もっと読む）

【課題】塗布法を用いて形成される酸化膜を溝の内部に充填した溝型の素子分離部を有する半導体装置において、溝の内部におけるボイドの発生を抑制して、埋め込み不良を低減することのできる技術を提供する。
【解決手段】０．２μｍ以下の溝幅を有する溝４Ｓの内部に埋まるポリシラザン膜の上面がパッド絶縁膜３の上面よりも高く、かつ１．０μｍ以上の溝幅を有する溝４Ｌの内部に埋まるポリシラザン膜の上面がパッド絶縁膜３の上面よりも低くなるように、半導体基板１の主面上にポリシラザン膜を形成し、続いて、３００℃以上の熱処理を行うことにより、ポリシラザン膜を酸化シリコン（ＳｉＯ_２）からなる第１埋め込み膜８へ転化すると同時に、溝４Ｓの上部に局所的に生じたボイドを消滅させる。 （もっと読む）

【課題】デバイス特性に優れた半導体装置およびその製造方法を提供する。
【解決手段】実施の一形態の半導体装置は、第１および第２の領域を有する機能膜と、前記基板の前記第１の領域に設けられ、第１の幅を有する第１の溝と、前記基板の前記第２の領域に設けられ、第１の幅よりも広い第２の幅を有する第２の溝と、前記第１の溝を埋めるように高分子材料を前駆体として形成された第１の絶縁膜と、前記第１の幅を上回る直径を有し、前記第２の溝を埋める微粒子と、前記第２の溝内で前記微粒子間および前記微粒子と前記第２の溝との間隙を埋める前記高分子材料とを前駆体として形成された第２の絶縁膜とを持つ。 （もっと読む）

【課題】ポットライフが長く、焼成してシリコン酸化物としたときの硬化収縮率が小さく、更にクラック耐性に優れかつ耐電圧のばらつきが小さい絶縁膜を形成できる縮合反応物溶液の提供。
【解決手段】（Ｉ）（ｉ）下記一般式（１）：Ｒ¹_nＳｉＸ¹_4-n （１）｛式中、ｎは０〜３の整数であり、Ｒ¹は水素原子又は炭素数１〜１０の炭化水素基であり、Ｘ¹はハロゲン原子、炭素数１〜６のアルコキシ基又はアセトキシ基である｝で表されるシラン化合物に由来するポリシロキサン化合物と、（ｉｉ）シリカ粒子と、を少なくとも含有する縮合成分を縮合反応させて得られる縮合反応物、及び（ＩＩ）溶媒を含み、該一般式（１）で表されるシラン化合物が４官能シラン化合物及び３官能シラン化合物を少なくとも含有し、該シリカ粒子中の炭素量が０．０５質量％以上０．６５質量％未満である、縮合反応物溶液。 （もっと読む）

【課題】高アスペクト比のトレンチ内に埋め込んだ際に、クラック、及びボイドが生じにくく、かつ高密度に埋め込むことができるトレンチ埋め込み方法。
【解決手段】（１）トレンチ２を有する基体１上に、シロキサン系重合体、空孔形成剤、及び有機溶媒を含むトレンチ埋め込み用組成物を、少なくとも該組成物が前記トレンチ内に充填されるように塗布し、塗膜３を形成する工程、及び、（２）工程（１）で得られた塗膜３に加熱処理および光処理の少なくともいずれか一方を行う工程、を含むトレンチ埋め込み方法。 （もっと読む）

【課題】記憶及び論理回路を含む半導体基材、例えば、１つ又は複数の集積回路構造をその上に有するシリコンウェハにおいて用いられるシャロートレンチアイソレーションのための高アスペクト比の特徴のギャップを充填するための酸化条件下で二酸化ケイ素含有膜をスピンオン堆積させる方法を提供する。
【解決手段】高アスペクト比の特徴を有する半導体基材を用意する工程、該半導体基材を低分子量のアミノシランを含む液体配合物と接触させる工程、該半導体基材上に該液体配合物を塗布することにより膜を形成する工程、及び該膜を酸化条件下において高温で加熱する工程を含む方法が提供される。この方法のための組成物もまた記載される。 （もっと読む）

【課題】収縮率および引っ張り応力の低いアイソレーション構造の形成方法の提供。
【解決手段】基板表面に多孔質化剤を含む第１のポリシラザン組成物を塗布および焼成して、屈折率が１．３以下の多孔質シリカ質膜を形成させ、次いでその膜の表面に第２のポリシラザン組成物を含浸させ、焼成することにより、屈折率１．４以上のシリカ質膜からなるアイソレーション構造を形成させる。 （もっと読む）

【課題】チャネル領域となるＳＯＩ構造を有する半導体線条突出部の形状のばらつきを抑制し、トランジスタ特性のばらつきを減少することができる半導体装置を提供する。
【解決手段】半導体基板１の素子分離用の溝に埋込み絶縁膜が埋め込まれてなる素子分離領域２と、素子分離領域２によって区画されてなり、素子分離用の溝を区画する側壁面と半導体基板の１一面とを有し、かつ側壁面には埋込み絶縁膜に向けて突出した半導体線条突出部１aが素子分離用の溝に沿って設けられてなる活性領域Ｔと、半導体線条突出部１aを残して活性領域Ｔを分断するように設けられたゲート電極用のゲート溝３と、ゲート溝３の内面に形成されたゲート絶縁膜４と、ゲート溝３に埋め込まれたゲート電極５と、ゲート電極５のゲート長方向両側の活性領域Ｔにそれぞれ形成され、半導体線条突出部１aによって連結される不純物拡散領域７と、を具備してなることを特徴とする。 （もっと読む）

【課題】絶縁破壊電圧の高い素子分離層を形成することができる素子分離材料用塗布液等を提供する。
【解決手段】素子分離材料用塗布液は、一般式（Ｉ）で表される構造単位からなる骨格を有するポリシラザン等と、酸化物を形成できる金属元素を含む化合物と、溶媒とを備えている。金属元素は、チタン、ジルコニウム、ハフニウム、又は、タンタルであり、ポリシラザン等のＳｉのモル数に対し、０．５ｍｏｌ％〜１９ｍｏｌ％となるように添加されている。
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【課題】導体層におけるソース電極とドレイン電極との電極間のチャネル領域が結晶相であり、且つ該半導体層における該チャネル領域以外の第２の領域が非結晶相である構成ではない場合に比べて、半導体素子間の電気的な分離が実現された有機トランジスタを提供する。
【解決手段】有機トランジスタ１０は、基板１２上に、ゲート電極１４Ｇ、ゲート絶縁膜１６、ソース電極１８Ｓ及びドレイン電極１８Ｄ、及び半導体層２０が設けられている。半導体層２０における、ソース電極１８Ｓ及びドレイン電極１８Ｄとの電極間の領域であるチャネル領域２０Ａは、結晶相とされている。また、半導体層２０における、このチャネル領域２０Ａ以外の第２の領域２０Ｂは、非結晶相とされている。 （もっと読む）

【課題】新規なＦｉｎＦＥＴ構造及びその製造方法を提供する。
【解決手段】シングルゲートフィンＦＥＴ構造１００は、２つの拡大された頭部、及び当該拡大された頭部と下層の超薄型ボディとを連結する２つの徐々に細くなる首部を有するアクティブフィン構造を含む。２つのソース／ドレイン領域１０２，１０４が、２つの拡大された頭部にそれぞれドープされる。絶縁領域２６が、２つのソース／ドレイン領域の間に挿入される。溝分離構造２４が、音叉形状のフィン構造の一方の側に配置される。片面サイドウォールゲート電極１２ｂが、アクティブフィン構造における、溝分離構造とは反対側の垂直なサイドウォールに配置される。 （もっと読む）

【課題】基板表面上のナノメートルレベルの開口幅を有し、アスペクト比が大きいトレンチ（溝）への埋め込み性に優れ、ボイドなどの欠陥の発生が抑制され、電気的絶縁性に優れたアイソレーション構造を製造するのに好適なトレンチ埋め込み用組成物、および該組成物を用いたトレンチ・アイソレーション構造の製造方法の提供。
【解決手段】アルキルトリアルコキシシランを５０モル％以上含むアルコキシシラン原料を加水分解、縮合して得られる加水分解縮合物を含有し、該加水分解縮合物の重量平均分子量が１０００〜５００００であり、該加水分解縮合物の含有量が組成物全量に対して１４質量％超３０質量％以下であるトレンチ埋め込み用組成物の塗膜１４により、基板１０表面上に形成されたトレンチ１２を埋め込む。 （もっと読む）

【課題】基板に形成された開口幅が狭く高アスペクトなトレンチ内に埋め込むために好適な縮合反応物溶液であって、ポットライフが長く、トレンチ埋め込み用として使用した場合のトレンチ内への埋め込み性が良好で、焼成して酸化シリコンとしたときの硬化収縮率が小さく、クラック耐性及びＨＦ耐性に優れる縮合反応物溶液を用いる絶縁膜の形成方法を提供する。
【解決手段】半導体素子に形成されたトレンチ埋め込み用絶縁膜の形成方法であって、特定構造のシラン化合物に由来するポリシロキサン化合物と、シリカ粒子とを含有する縮合成分から得られる縮合反応物、及び溶媒を含み、該シラン化合物が４官能シラン化合物及び３官能シラン化合物を含有する縮合反応物溶液を、基板上に塗布して塗布基板を得る塗布工程と、該塗布工程で得た塗布基板を加熱する焼成工程とを含むトレンチ埋め込み用絶縁膜の形成方法。 （もっと読む）

【課題】工程マークやアライメントマーク等を形成するトレンチ内のＳＯＧ膜にクラックが発生した場合に、そのクラックが素子形成領域に到達するのを防止する。
【解決手段】半導体基板１０の素子形成領域１０Ｔの外側において、工程マーク３０Ｃは、トレンチ３１のパターンで形成されている。素子形成領域１０Ｔと、その外側のトレンチ３１は層間絶縁膜２１に覆われており、層間絶縁膜２１は、トレンチ３１内を埋めるＳＯＧ膜２２に覆われている。さらに、半導体基板１０の表面上には、トレンチ３１及びトレンチ３１上のＳＯＧ膜２２を囲む環状ポリシリコン膜１８が形成されている。 （もっと読む）

【課題】基板と素子分離層との剥離やクラックが発生し難く、凹状の溝を有する基板上に平坦な素子分離層を形成することができる素子分離材料用塗布液の作製方法等を提供する。
【解決手段】半導体装置のシャロートレンチアイソレーション構造の素子分離層の形成に用いられる素子分離材料用塗布液の作製方法は、混合液作製工程と絶縁膜形成前駆体作製工程と塗布液作製工程とを備えている。混合液作製工程では、炭素数２〜６個のアルコキシル基を有するアルコキシシラン化合物と第１の溶媒との混合液を作製する。絶縁膜形成前駆体作製工程では、この混合液に加水分解触媒及び水を添加し、加水分解、縮合して絶縁膜形成前駆体を作製する。水の添加量は、アルコキシシラン化合物中の全アルコキシル基１モルに対して０．３〜０．８倍モルの範囲とする。塗布液作製工程では、作製された絶縁膜形成前駆体に第２の溶媒を加え、素子分離材料用塗布液を作製する。 （もっと読む）