【課題】窒化シリコン膜と電極パッドとの界面から水分が浸入することを抑制し、半導体装置の信頼性を向上させること。
【解決手段】半導体層２と、半導体層２上に設けられたＡｕからなる電極パッド１０と、電極パッド１０上にその端部が位置するように、半導体層２上及び電極パッド１０上に設けられた窒化シリコン膜６と、電極パッド１０の上面の一部及び窒化シリコン膜６の端部に接し、かつ電極パッド１０の上面の他部が露出するように設けられたＴｉ、Ｔａ及びＰｔのいずれかからなる金属層１４と、を具備する半導体装置。 （もっと読む）

【課題】 冷却機構を有する接合型半導体基板を形成するための構造体、設計構造体、及びその形成方法を提供すること。
【解決手段】 ２つの半導体基板を備える接合型基板が提供される。各々の半導体基板は、半導体デバイスを含む。少なくとも１つの基板貫通ビアが２つの半導体基板の間に設けられ、それらの間に単一の経路を提供する。２つの半導体基板の底側は、冷却機構を含む少なくとも１つの接合材料層によって接合される。１つの実施形態において、冷却機構は冷却チャネルであり、その中を通って冷却流体が流動し、接合型基板内の半導体デバイスの動作中に接合型半導体基板を冷却する。別の実施形態において、冷却機構は、２つの端部とそれらの間の連続した経路を備えた導電性冷却フィンである。冷却フィンはヒートシンクに接続され、接合型基板内の半導体デバイスの動作中に接合型半導体基板を冷却する。 （もっと読む）

【課題】水分の浸入による半導体装置の信頼性低下を抑制した装置の提供。
【解決手段】ＧａＡｓ系半導体、ＩｎＰ系半導体、及びＧａＮ系半導体のいずれかからなる半導体層２と、半導体層２上に設けられ、端部４ａが半導体層２上に位置する第１窒化シリコン膜４と、第１窒化シリコン膜４の端部４ａを覆うように、半導体層２上及び第１窒化シリコン膜４上に設けられたポリイミドまたはベンゾシクロブテンのいずれかからなる保護膜１２と、半導体層２の上面及び第１窒化シリコン膜４の端部４ａに接するように、半導体層２と保護膜１２との間から第１窒化シリコン膜４の端部４ａと保護膜１２との間にかけて連続的に設けられた第１Ｔｉ層１４と、を具備することを特徴とする半導体装置。 （もっと読む）

【課題】 相互接続構造内にガウジング・フィーチャを導入することなくエレクトロマイグレーション耐性を向上させる相互接続構造を提供する。
【解決手段】 この構造は、バイア開口の底部に存在する金属界面層（または金属合金層）を含む。バイア開口は、第１の導電材料が埋め込まれた第１の誘電材料の上に位置する第２の誘電材料内に位置する。バイア開口の底部に存在する金属界面層（または金属合金層）は、第１の誘電体内に埋め込まれた下にある第１の導電材料と第２の誘電材料内に埋め込まれた第２の導電材料との間に位置する。また、エレクトロマイグレーション耐性が向上した相互接続構造を製造する方法も提供する。 （もっと読む）

【課題】トランジスタのリーク電流の低減。
【解決手段】半導体材料の表面に沿って互いに隣接する、シリサイド化される金属を含有する複数の電気素子要素と、複数の電気素子要素を覆い、電気素子要素に含まれる金属が実質的にシリサイド化しない温度で薄膜形成したシリコンを含む保護絶縁膜と、を備える半導体装置が提供される。上記半導体装置において、保護絶縁膜は、シリコンおよび窒素を含有できる。保護絶縁膜は、２６０℃以下の温度で薄膜形成した窒化シリコン膜であってよく、好ましくは１００℃以下の温度で薄膜形成した窒化シリコン膜である。 （もっと読む）

【課題】トランジスタのリーク電流の低減。
【解決手段】半導体材料の表面に沿って互いに隣接する複数の電気素子要素と、複数の電気素子要素を覆う、シリコンを含まない下層保護絶縁膜と、下層保護絶縁膜の上に配置され、シリコンを含む上層保護絶縁膜と、を備える半導体装置が提供される。上記半導体装置において、複数の電気素子要素の少なくとも一つは、シリサイド化される金属を含有でき、下層保護絶縁膜は、電気素子要素に含有される金属と上層保護絶縁膜に含有されるシリコンとの接触を阻害できる。下層保護絶縁膜は、比誘電率が１０以上の高誘電体層を有してよい。上層保護絶縁膜は、シリコンおよび窒素を含有することができる。 （もっと読む）

【課題】本発明は、メタルマスクを用いて、簡易な方法により半導体基板に先細状ビア孔を形成するエッチング方法を提供することを目的とする。
【解決手段】半導体基板上に金属導電層を形成する工程と、該金属導電層上に第１の開口を有する第１メッキ層を形成する工程と、該第１メッキ層の側壁に該第1の開口より幅の狭い第２の開口を有する第２メッキ層を形成する工程と、該第２メッキ層をマスクとして第1のドライエッチングを行い該半導体基板をエッチングする工程と、該第1のドライエッチングの後に該第1メッキ層を残す選択的ウェットエッチングを行い該第２メッキ層をエッチングする工程と、該第２メッキ層をエッチングした後に該第1メッキ層をマスクとして第２のドライエッチングを行い該半導体基板をさらにエッチングする工程とを備えることを特徴とする。 （もっと読む）

【課題】ｐ電極にＴＣＯ膜を用いたＧａＮ系ＬＥＤ素子に関して、その高出力化および信頼性向上の少なくともいずれかを実現すること。
【解決手段】ｎ型ＧａＮ系半導体層の上にＧａＮ系半導体からなる活性層とｐ型ＧａＮ系半導体層とを順次積層してなり、前記ｐ型ＧａＮ系半導体層の前記活性層側の主面とは反対側の主面上に形成されたＴＣＯ膜と該ＴＣＯ膜に接続されたｐ側ボンディングパッドとを含むｐ電極と、前記ＴＣＯ膜の前記ｐ型ＧａＮ系半導体層側とは反対側の主面上の一部に形成された抵抗制御膜と、前記ｐ型ＧａＮ系半導体層と前記ＴＣＯ膜との界面に形成されて前記抵抗制御膜の下方の領域において前記活性層を流れる電流を減少させる抵抗増加領域と、前記ｎ型層に接続されたｎ側ボンディングパッドと、を有するＧａＮ系ＬＥＤ素子。 （もっと読む）

【課題】 ギャップ充填信頼性を改良し及び容量を減少させるためのデュアル金属インターコネクトを提供する。
【解決手段】 本発明のインターコネクト形成方法は；パターン化された金属層の上に誘電層を堆積し、前記誘電層をエッチングしてトレンチ及び下置金属表面を露出するために開口部を形成し、前記前処理された開口部に、及び前記下置金属表面に直接隣接した高融点インターコネクトを形成し、前記トレンチと前記高融点インターコネクト上にバリア層とシード層を堆積し、及び前記シード層上に低抵抗金属を形成することを含む、方法である。
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【課題】電極パッドのダメージを低減し、高信頼性の貫通電極を提供することを目的とする。
【解決手段】工程（ａ）〜（ｃ）では、基板（１）の他方の面から電極パッド（５）に達する孔（１ａｂ）を形成し、工程（ｄ）では、孔（１ａｂ）の内側に一端が電極パッド（５）に接触し他端が基板（１）の他方の面に達する導電経路（２）を形成し、工程（ｅ）では、基板（１）をエッチングして導電経路（２）の周囲に凹部（１ｃ）を形成し、更に凹部（１ｃ）の内側で導電経路（２）の周面に絶縁膜を形成する。 （もっと読む）

【課題】柱状半導体層が微細化されて高集積化されても、コンタクト抵抗の増加を抑制する構造の半導体装置を提供する。
【解決手段】半導体装置は、基板（半導体基板１）と、半導体基板１上に設けられた、半導体柱状部（柱状半導体層３）と、の天面に接するように設けられた、柱状半導体層３と同径以下のコンタクト柱状部（コンタクト層７）と、この天面に設けられた凹部をと備えるものである。 （もっと読む）

【課題】成膜時に生じる反りを緩和しうる電子デバイスの製造方法を提供する。
【解決手段】まず、４Ｈ−ＳｉＣ基板１０の第１面１０ａの上に、第１タングステン膜１１を堆積する。堆積は、基板温度を４００℃〜６００℃に保持した状態で、スパッタによって行われる。スパッタ後に室温まで冷却すると、基板全体が上方に凹になるように反る。その後、４Ｈ−ＳｉＣ基板１０の第２面１０ｂの上に、同じ材質、厚さの第２タングステン膜１２を堆積する。４Ｈ−ＳｉＣ基板１０に対する，第１，第２タングステン膜１１，１２の収縮による応力が互いに釣り合い、反りがなくなる。その後、平坦な基板上にレジスト膜Ｒｅを形成して、第１タングステン膜１１から注入マスク１１ａを形成する。正確な注入マスク１１ａを用いて、高い精度で不純物拡散領域１５を形成する。 （もっと読む）

【課題】孔のないキャリア（支持基板）を用いても、キャリアの取り外し時の半導体チップの散乱を防止することができる半導体装置の製造方法を提供する。
【解決手段】半導体素子が形成された素子形成基板の表面に、接着剤１１を用いてキャリア（支持基板）１２を貼り付ける。その後、素子形成基板の裏面から、素子形成基板の途中まで延びる複数のスルーホール１ｂを互いに離間して形成する。次に、裏面の処理として、裏面の研磨及びＡｕ層２３の形成等を行う。次に、複数のスルーホール１ｂを接着剤１１まで到達させる。そして、複数のスルーホール１ｂから接着剤１１の溶解液を接着剤１１まで浸透させて、接着剤１１を溶解させる。 （もっと読む）

【課題】貫通電極のショート不良を引き起こすことなく、貫通電極とパッド電極との密着性を向上させる。
【解決手段】開口部２２が設けられたパッド電極２１ｂ上にエッチストッパ膜２３を積層し、半導体基板１１に形成された貫通孔４１に貫通電極４５を埋め込む際に、貫通電極４５の先端が、開口部２２を介してパッド電極２１ｂの一部を突き抜け、エッチストッパ膜２３で止められるように構成する。 （もっと読む）

【課題】ビア電極を効果的に配しうるマイクロ電子構造体、マルチチップモジュール、メモリカード及び集積回路素子の製造方法を提供する。
【解決手段】基板１１０と、前記基板上に提供され、貫通して延長される第１及び第２開口を含む導電性パッド１３０と、前記導電性パッド上に提供され、前記導電性パッド内の前記第１開口を貫通して前記基板内に延長される第１導電性ビア電極１５０と、前記導電性パッド上に前記第１導電性ビア電極に隣接するように提供され、前記導電性パッド内の前記第２開口を貫通して前記基板内に延長される第２導電性ビア電極１６０とを有する。 （もっと読む）

パターンが形成された基板上に金属を堆積させる方法および装置を提供する。金属層が，第１のエネルギーを有する物理蒸着工程で形成される。第２のエネルギーを用いて金属層上に第２の物理蒸着工程が行われ、ここで、堆積層は、脆性および塑性表面修正工程の相互作用を受け、基板上にほぼ同形の金属層が形成される。
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【課題】ガラス基板を使用したＳＯＩ基板上に形成しても、ゲート電極を形成する導電膜を成膜する際に該導電膜の加える応力により、ガラス基板上の絶縁膜及び半導体膜がはがれないような半導体装置の作製方法の提供を課題の一つとする。
【解決手段】ボンド基板上に第１の絶縁膜を形成し、ボンド基板の表面からイオンを添加することによって脆化層を形成し、ボンド基板を、第１の絶縁膜を介してガラス基板と貼り合わせ、ボンド基板を脆化層において分離してガラス基板上に第１の絶縁膜を介して半導体膜を形成し、第１の絶縁膜及び半導体膜の周辺領域を除去してガラス基板の一部を露出させ、半導体膜、第１の絶縁膜及びガラス基板上に接してゲート絶縁膜を形成し、ゲート絶縁膜上に接して２層構造の積層導電膜を形成し、２層構造の積層導電膜として、上層に引っ張り応力を有する導電膜、下層に圧縮応力を有する導電膜を用いて半導体装置を作製する。 （もっと読む）

【課題】開口部の間口部分の拡大を抑制しつつ、開口部内に埋め込み導体を埋め込みやすくする。
【解決手段】半導体ウェハＷ１の中心から左側に離れたチップ領域Ｃ１ａ、Ｃ１ｂでは、開口部１３ａ、１３ｂ内の左右の壁面のうち右側の壁面にのみ深さ方向に沿って傾斜面を設け、半導体ウェハＷ１の中心から右側に離れたチップ領域Ｃ１ｄ、Ｃ１ｅでは、開口部１３ｄ、１３ｅ内の左右の壁面のうち左側の壁面にのみ深さ方向に沿って傾斜面を設け、半導体ウェハＷ１の中心の近傍のチップ領域Ｃ１ｃでは、開口部１３ｃ内の左右の壁面には傾斜面を設けないようにする。 （もっと読む）

【課題】加工精度を改善し、かつ厚い配線を得るための半導体装置の製造方法を提供することを課題とする。
【解決手段】絶縁性基板上に形成された導電性膜上に配線形成領域を覆う第１のフォトレジストパターンを形成する工程と、前記第１のフォトレジストパターンをマスクとする異方性エッチングにより前記導電性膜の上部を除去することで第１溝を形成する工程と、前記第１のフォトレジストパターンを除去した後、前記第１溝の底部の少なくとも一部が露出した開口を有する第２のフォトレジストパターンを形成する工程と、前記第２のフォトレジストパターンをマスクとする異方性エッチングにより前記第１溝の底部に露出する前記導電性膜の下部を少なくとも除去することで第２溝を形成する工程を備えることで、前記第１溝と第２溝に由来する配線分離溝と、前記配線分離溝により分離された配線とを形成することを特徴とする半導体装置の製造方法により上記課題を解決する。 （もっと読む）

【課題】耐熱性に優れ、不均一動作が抑制される高周波高出力半導体装置を提供する。
【解決手段】半導体基板上に形成される複数の電界効果トランジスタが並列接続される単位セルを、さらに複数並列接続する半導体装置において、この単位セルを構成する電界効果トランジスタの複数のゲート電極同士を接続するゲートバス配線に接続され、複数の導電層が積層した構造を有するゲートパッド電極と、隣接するゲートパッド電極間同士を接続し、ゲートパッド電極外周部の少なくとも一辺に沿って形成され、ゲートパッド電極を構成する複数の導電層の少なくとも一つの導電層で形成される抵抗体とを有することを特徴とする半導体装置。 （もっと読む）