【課題】良好なノーマリ・オフ動作を可能とすることに加え、アバランシェ耐量が大きく、外部のダイオードを接続することを要せず、確実に安定動作を得ることができる信頼性の高い高耐圧のＨＥＭＴを得る。
【解決手段】化合物半導体積層構造２に形成された電極用リセス２Ｃを、ゲート絶縁膜６を介して電極材料で埋め込むようにゲート電極７を形成すると共に、化合物半導体積層構造２に形成された電極用リセス２Ｄを、少なくとも電極用リセス２Ｄの底面で化合物半導体積層構造２と直接的に接するように電極材料で埋め込み、化合物半導体積層構造２とショットキー接触するフィールドプレート電極８を形成する。 （もっと読む）

【課題】ベース面の反りの少ないパッケージを提供する。
【解決手段】導体ベースプレート２００と、導体ベースプレート上に配置された半導体装置と、半導体装置を内在し、導体ベースプレート上に配置され、導体ベースプレートとは異なる材料からなる金属壁１６とを備え、導体ベースプレートは、対抗する1対の端面１００a・１００bが緩やかな弧を有し、金属壁も緩やかな弧を有しているので、接合時や基板実装時、キャップ半田付け時の反りの発生を抑制できる。 （もっと読む）

【課題】ＧａＮ系の材料により形成されるＨＥＭＴの信頼性を高める。
【解決手段】基板１０の上方に形成された窒化物半導体からなる半導体層２１〜２４と、半導体層２１〜２４の上方に、金を含む材料により形成された電極４１と、電極４１の上方に形成されたバリア膜６１と、半導体層２１〜２４の上方に、シリコンの酸化膜、窒化膜、酸窒化物のいずれかを含む材料により形成された保護膜５０と、を有する。 （もっと読む）

【課題】歩留りが高く信頼性の高いパッケージングされた半導体装置を提供する。
【解決手段】電極が形成された半導体チップと、前記電極に対応するリードと、前記電極と前記リードとを接続する金属配線と、前記金属配線と前記電極との接続部分及び前記金属配線と前記リードとの接続部分を覆う第１の樹脂部と、前記金属配線、前記第１の樹脂部及び前記半導体チップを覆う第２の樹脂部と、を有することを特徴とする半導体装置により上記課題を解決する。 （もっと読む）

【課題】回路基板、リードフレームのステージなどの支持板上に半導体チップを実装する際に、半導体チップが移動や回転等の位置ずれを生じないようにする。
【解決手段】半導体装置の製造方法において、支持板２の半導体チップ実装領域２Ａに、少なくとも外表面に金属を有する繊維状材料からなるシート５を載せ、半導体チップ実装領域２Ａに、溶融金属を含む接合層３を形成し、半導体チップ実装領域２Ａに、半導体チップ１を載せ、加熱することによって、溶融金属を含む接合層３によって半導体チップ１を半導体チップ実装領域２Ａに接合する。 （もっと読む）

【課題】チャネル領域の低抵抗化を図りながら、ノーマリオフを実現する。
【解決手段】半導体装置を、キャリア走行層３及びキャリア供給層５を含む窒化物半導体積層構造と、窒化物半導体積層構造の上方に設けられ、活性化領域１０と不活性領域１０Ａとを有するｐ型窒化物半導体層６と、ｐ型窒化物半導体層の不活性領域上に設けられたｎ型窒化物半導体層７と、ｐ型窒化物半導体層の活性化領域の上方に設けられたゲート電極１３とを備えるものとする。 （もっと読む）

【課題】低コストでしきい値電圧のバラツキの少ないノーマリーオフ化されたＨＥＭＴを提供する。
【解決手段】基板１０の上方に半導体層２１〜２４を形成する工程と、半導体層２３〜２４にフッ素成分を含むガスを用いたドライエッチングによりリセス５１となる開口部を形成する工程と、半導体層を加熱することによりリセス５１の側面及び底面に付着しているフッ素を半導体層２２〜２４に拡散させフッ素を含む領域を形成する工程と、リセス５１の内面及び半導体層２２〜２４上に絶縁膜３０を形成する工程と、リセス５１が形成されている領域に絶縁膜３０を介し電極４１を形成する工程と、を有する。 （もっと読む）

【課題】回路基板やリードフレームのステージなどの支持板上に半導体チップを実装する際に、半導体チップが移動や回転等の位置ずれを生じないようにする。
【解決手段】半導体装置の製造方法であって、支持板２の半導体チップ実装領域２Ａ及び半導体チップ１の裏面の一方に、第１金属を含む層５及び第２金属を含む層６の一方を形成し、半導体チップ実装領域及び半導体チップの裏面の他方の、第１金属を含む層及び第２金属を含む層の一方が形成された領域の一部に相当する領域に、第１金属を含む層及び第２金属を含む層の他方を形成し、半導体チップ実装領域に半導体チップを位置合わせし、第１金属及び第２金属を含む合金を含む層９を形成して、半導体チップを半導体チップ実装領域に接合する。 （もっと読む）

【課題】絶縁膜を有する窒化物半導体を低コストで製造する。
【解決手段】基板１０の上方に形成された半導体層２２，２３，２４と、前記半導体層の一部を酸化することにより形成された絶縁膜３０と、前記絶縁膜上に形成された電極４１と、を有し、前記絶縁膜は、酸化ガリウムを含むもの、または、酸化ガリウム及び酸化インジウムを含むものにより形成されているものであることを特徴とする半導体装置。 （もっと読む）

【課題】半導体装置に形成される絶縁膜の付着力を高め歩留りを向上させる。
【解決手段】基板１０の上方に形成された半導体層２０〜２３と、前記半導体層２０〜２３上に形成された絶縁膜３１，３２と、前記絶縁膜上３１，３２に形成された電極４１と、を有し、前記絶縁膜３１，３２は、前記電極４１の側における膜応力よりも、前記半導体層２０〜２３の側における膜応力が低いことを特徴とする半導体装置により上記課題を解決する。 （もっと読む）

【課題】耐湿性及び耐電圧性を確保しながら、デバイス特性が劣化しないようにする。
【解決手段】半導体装置を、キャリア走行層及びキャリア供給層を含む窒化物半導体積層構造を備える半導体チップ１と、半導体チップの表面を覆い、カップリング剤を含有する第１樹脂層５と、第１樹脂層の表面を覆い、界面活性剤を含有する第２樹脂層６と、第１樹脂層及び第２樹脂層で覆われた半導体チップを封止する封止樹脂層７とを備えるものとする。 （もっと読む）

【課題】素子温度の上昇を抑制する半導体装置を提供する。
【解決手段】動作周波数ｆで動作可能な半導体装置であって、熱拡散率Ｄの基板と、基板上に形成され、ワイドギャップ半導体素子で横型素子の第１のトランジスタで構成される第１の素子ユニット１２と、基板上に第１の素子ユニット１２に隣接して形成され、第１のトランジスタと異なるタイミングで動作するワイドギャップ半導体素子で横型素子の第２のトランジスタで構成される第２の素子ユニット１４とを備え、第１の素子ユニット１２の重心と、第２の素子ユニット１４の重心との距離が熱拡散長（Ｄ／πｆ）^１／２の２倍以下であることを特徴とする半導体装置。 （もっと読む）

【課題】導体ベースプレートと金属外壁との熱膨張係数が異なることに伴う、銀ロウ付けする際の導体ベースプレートの反りを抑制したパッケージを提供する。
【解決手段】導体ベースプレートと、導体ベースプレート上に配置された半導体装置と、半導体装置を内在し、導体ベースプレート上に配置され、導体ベースプレートと接する面に複数の開放部を有する金属壁と、開放部を充填するブロックとを備えるパッケージ。 （もっと読む）

【課題】導体ベースプレート上に実装するＳｉＣやダイヤモンドを基板とする高周波半導体チップの割れを防止する。
【解決手段】導体ベースプレートと、導体ベースプレート上に配置された高周波半導体チップとを備え、高周波半導体チップは、四隅が面取りされている半導体装置。 （もっと読む）

【課題】 チャネルの高い移動度を得ながら、かつ、縦方向耐圧およびゲート電極端における耐圧の両方の耐圧性能を確実に得ることができる、半導体装置およびその製造方法を提供する。
【解決手段】 ｎ型ドリフト層および該ｎ型ドリフト層上に位置するｐ型層を含むＧａＮ系積層体に、開口部が設けられ、開口部を覆うように位置する、チャネルを含む再成長層と、再成長層に沿って該再成長層上に位置するゲート電極とを備え、開口部はｎ型ドリフト層に届いており、ゲート電極の端は、平面的に見てｐ型層から外れた部分がないように位置していることを特徴とする。 （もっと読む）

【課題】半導体装置において、セルフターンオンが発生しないようにし、安定した動作を実現する。
【解決手段】半導体装置を、基板１と、基板の上方に設けられ、電子走行層６及び電子供給層７を含む半導体積層構造２と、半導体積層構造の上方に設けられたゲート電極３、ソース電極４及びドレイン電極５と、ゲート電極、ソース電極及びドレイン電極の上方に設けられ、ゲート電極、ソース電極及びドレイン電極のそれぞれに接続されたゲートパッド１０、ソースパッド１１及びドレインパッド１２と、ゲートパッド、ソースパッド及びドレインパッドの下方に設けられた導電層１とを備えるものとし、ゲートパッドとソースパッドとの間の距離を、ゲートパッドとドレインパッドとの間の距離よりも小さくする。 （もっと読む）

【課題】最小ループと２セルループのオッドモード発振を共に抑制する高周波回路を提供する。
【解決手段】半導体基板上に並列に配列された複数のトランジスタと、第１の絶縁基板上に配置され、複数のトランジスタのゲート端子電極にそれぞれ接続された複数の入力整合回路と、第１の絶縁基板上に配置され、入力整合回路に隣接して配置された入力側第４発振抑制抵抗と、入力側第４発振抑制抵抗に直列接続された入力側第１キャパシタと、隣接する入力整合回路間を繋ぐ伝送線路上の点と入力側第１キャパシタ間に接続された入力側第１インダクタとを有する入力側発振抑制回路とを備え、入力側第１インダクタのインダクタンス値をＬ１、入力側第１キャパシタのキャパシタンス値をＣ１とすると、１／{２π（Ｌ１×Ｃ１）^1/2}で表される入力側第１インダクタと入力側第１キャパシタの共振周波数が、２セルループの発振周波数fosc2に等しい高周波回路。 （もっと読む）

【課題】ＧａＮ電子走行層の厚さを広い範囲で選択することができ、デバイス設計の自由度を高めることができる窒化物半導体素子、および耐圧および信頼性に優れる窒化物半導体素子パッケージを提供すること。
【解決手段】基板４１上に、ＡｌＮ層４７、第１ＡｌＧａＮ層４８（平均Ａｌ組成５０％）および第２ＡｌＧａＮ層４９（平均Ａｌ組成２０％）からなるバッファ層４４を形成する。バッファ層４４上には、ＧａＮ電子走行層４５およびＡｌＧａＮ電子供給層４６からなる素子動作層を形成する。これにより、ＨＥＭＴ素子３を構成する。 （もっと読む）

【課題】ゲート電極から染み出した金属がドレイン電極に到達することを抑制して、ドレイン−ゲート間の絶縁破壊を抑制する窒化物半導体装置を提供する。
【解決手段】ゲート電極５の直下に位置するＡｌＧａＮ層２２と、このＡｌＧａＮ層２２の直上に位置する絶縁膜３０との間の界面Ｓに、ゲート電極５とドレイン電極１との間に位置するように、溝５０を設けている。ゲート電極５から界面Ｓを伝ってドレイン電極１側へ染み出した金属を、溝５０によって、堰き止めることができる。 （もっと読む）

【課題】トランジスタ動作のオフ時におけるリーク電流を低減することができる窒化物半導体素子、およびリーク電流が少なく、信頼性に優れる窒化物半導体素子パッケージを提供すること。
【解決手段】基板４１上に、ＡｌＮ層４７、第１ＡｌＧａＮ層４８（平均Ａｌ組成５０％）および第２ＡｌＧａＮ層４９（平均Ａｌ組成２０％）からなるバッファ層４４を形成する。バッファ層４４上には、ＧａＮ電子走行層４５およびＡｌＧａＮ電子供給層４６からなる素子動作層を形成する。これにより、ＨＥＭＴ素子３を構成する。このＨＥＭＴ素子３において、ＧａＮ電子走行層４５の厚さ方向途中部に、ＢＮとＧａＮとの混晶からなるＢＧａＮ部５０を形成する。 （もっと読む）