【課題】バイアス信号を切りかえに伴う動作特性の悪化を低減した半導体集積回路を提供する。
【解決手段】半導体集積回路１０は、入力電流Ｉｉｎを受け、それに応じた出力電流Ｉｏｕｔ１を別の回路に供給する。第１可変抵抗Ｒ１の第１端子は、入力端子Ｐ１と接続される。第１トランジスタＭ１および第２トランジスタＭ２は、電源端子と第１可変抵抗Ｒ１の第２端子の間に順に直列に設けられる。第３トランジスタＭ３および第４トランジスタＭ４は、電源端子と出力端子Ｐ２との間に順に直列に設けられる。第１トランジスタＭ１および第３トランジスタＭ３それぞれのゲートは第１可変抵抗Ｒ１の第２端子に接続される。第２トランジスタＭ２および第４トランジスタＭ４それぞれのゲートは入力端子Ｐ１に接続されている。第１可変抵抗Ｒ１は、その抵抗値が入力電流Ｉｉｎに応じて切りかえ可能に構成される。 （もっと読む）

【課題】第１のアンプと、第１のアンプの出力が入力される第２のアンプとを含むアンプにおいて、ツノが発生せず、安定した動作が行なえるアンプを提供する。
【解決手段】第１のアンプは、ゲートに基準電圧が入力されるトランジスタＭ１と、トランジスタＭ１のドレインと電源電圧との間に接続されたトランジスタＭ４と、トランジスタＭ１のソースと接地電圧との間に接続された定電流源とから構成されて、トランジスタＭ１のドレインとトランジスタＭ４との接続部から出力し、第２のアンプは電源電圧と接地電圧との間で直列に接続されトランジスタＭ６と少なくとも１つ以上の抵抗から構成されて、トランジスタＭ６のゲートに第１のアンプの出力が入力されると共に、トランジスタＭ６と抵抗との接続部から出力電圧を出力し、第１のアンプの出力と電源電圧の間に、ゲートに基準電圧が入力されるトランジスタＭ７でなるスイッチが設けられている。 （もっと読む）

【課題】差動対が線形領域で高精度に動作する差動増幅回路、増幅回路及びこの差動増幅回路を用いた液晶ディスプレイドライバを提供する。
【解決手段】差動増幅回路は、入力電圧Ｖ１がゲート端子に与えられるトランジスタＭ１及びＭ２と、トランジスタＭ１、Ｍ２のソース端子に出力端が接続される差動対Ｄ１、Ｄ２と、差動対Ｄ１内のトランジスタＭ３、Ｍ４の共通ソース端子に電流を供給する可変電流源Ｉ１と、差動対Ｄ２内のトランジスタＭ５、Ｍ６の共通ソース端子に電流を供給する可変電流源Ｉ２と、を備え、トランジスタＭ３のゲート端子には入力電圧Ｖ２、トランジスタＭ５のゲート端子には入力電圧Ｖ１、トランジスタＭ４及びＭ６のゲート端子には入力電圧Ｖ３が与えられる。 （もっと読む）

【課題】線形領域で高精度に動作する差動増幅回路及びこの差動増幅回路を用いた液晶ディスプレイドライバを提供する。
【解決手段】差動増幅回路は、入力電圧Ｖ１がゲート端子に与えられるトランジスタＭ１及びＭ２と、トランジスタＭ１のソース端子にドレイン端子が接続されるトランジスタＭ３、トランジスタＭ３のゲート端子に入力電圧Ｖ１を与えるか否か切り替えるスイッチＳ１、トランジスタＭ３のゲート端子に入力電圧Ｖ２を与えるか否か切り替えるスイッチＳ２、及びトランジスタＭ２のソース端子にドレイン端子が接続され、ゲート端子に入力電圧Ｖ３が与えられ、ソース端子がトランジスタＭ３のソース端子と接続されるトランジスタＭ４をそれぞれ有する複数の差動対Ｄ１〜Ｄ４と、差動対Ｄ１〜Ｄ４のトランジスタＭ３、Ｍ４のソース端子に電流を供給する電流源Ｉ１と、を備える。 （もっと読む）

【課題】高スルーレートの差動増幅器を提供する。
【解決手段】差動増幅器は、差動入力信号を受ける差動対トランジスタ（ＴＮ１２／ＴＮ１３、ＴＰ１２／ＴＰ１３）と、定電流源（ＩＣＳ１１、ＩＣＳ１２）と、スイッチ（ＴＮ１１、ＴＰ１１）とを具備する。定電流源（ＩＣＳ１１、ＩＣＳ１２）は、差動対トランジスタ（ＴＮ１２／ＴＮ１３、ＴＰ１２／ＴＰ１３）に流れる電流を制御する。スイッチ（ＴＮ１１、ＴＰ１１）は、定電流源（ＩＣＳ１１、ＩＣＳ１２）と並列に配置され、差動入力信号の反転動作に同期して差動入力信号の反転動作の遷移時間より短い時間だけ差動対トランジスタＴＮ１２／ＴＮ１３、ＴＰ１２／ＴＰ１３）に流れる電流を増加する。 （もっと読む）

例えば、通信受信機中で使用するための非常に差動なシングルエンド／差動変換器を設計するための技術。例示的な実施形態では、ｃａｓｃｏｍｐトランジスタを含む補助電流経路が、入力トランジスタ及びカスコードトランジスタを含む主電流経路に結合される。トランジスタは、補助電流経路によって生成された混近変調ひずみ結果物が主電流経路によって生成された混近変調ひずみ結果物を打ち消すように、バイアスされる。別の例示的な実施形態では、主電流経路の電流源トランジスタは、受信した入力信号のレベルに応じて適応的にバイアスされる。例示的な実施形態では、上記技術は、シングルエンド低雑音増幅器（ＬＮＡ）出力電圧を、通信受信機の差動混合器入力にインタフェースするための変換器を設計するために適用されることができる。
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【課題】補償回路とプリドライバを組み込んでおり、プロセス変動に対して補償されるスルーレートを有する出力バッファを提供する。
【解決手段】補償回路３７０は、演算増幅器２５０と、増幅器の出力に結合されたゲートを有する第２のＮＦＥＴ２４０、第３のＮＦＥＴ３７１、及び実行抵抗３８１から構成される。出力バッファ３００は、ＩＣチップのコア１５０がプリドライバ３１０に制御信号をアサートする。これに応答して、プリドライバ３１０は、第１のＮＦＥＴ３２０にバッファリングされた制御信号をアサートし、第１のＮＦＥＴ３２０をオンにし、ＶＳＳレベルの出力信号をパット２３０にアサートする。 （もっと読む）

【目的】位相変動を抑制させて安定した動作が可能な演算増幅器を提供することを目的とする。
【構成】第１及び第２入力信号各々に対応した電流を送出する入力段に対して電流を供給する第１トランジスタ、及び、入力段から送出された電流に応じた電位レベルを有する出力信号を生成する出力段に対して電流を供給する第２トランジスタに、夫々バイアス電圧を供給するにあたり、第１トランジスタにバイアス電圧を供給する為の配線と、第２トランジスタにバイアス電圧を供給する為の配線とを互いに電気的に絶縁する。 （もっと読む）

【課題】オペアンプ及びＣＣＩＩの双方として機能する単一のアナログ構成要素を実現する。
【解決手段】増幅器１００は、差動増幅回路１０２、非反転出力ステージ１０４で構成され、差動増幅回路１０２は、２つの電圧入力を受け取る入力ステージ１０６と、電流出力を提供する出力ステージ１０８とを有する。２つの電流出力I_OUT1及びI_OUT2が一体に結合されたときに、第１のモードであるオペレーショナル増幅器として機能し、第２の電流出力I_OUT2が第２の電圧入力V_Nに結合されるときに、第２のモードであるタイプ２の電流搬送器（ＣＣＩＩ）として機能する。 （もっと読む）

【課題】高精度且つ広範囲なオフセット調整を可能にする。
【解決手段】差動対に発生するオフセットを調整するために能動負荷を変化させるオフセット調整回路を有する差動増幅回路１であって、同一のトランジスタサイズを有する複数のトランジスタ３１ａ，３１ｂ，３３ａ，３３ｂを備えて構成される微調整用セル部２１，２２と、前記微調整用セル部２１，２２のトランジスタ３１ａ，３１ｂ，３３ａ，３３ｂよりも大きいトランジスタサイズを有するトランジスタ３５ａ，３５ｂ，３７ａ，３７ｂを備えて構成されるシフト用セル部２３，２４とを有して構成される。 （もっと読む）

【課題】フォールデッドカスコード接続の差動増幅段を有するコンパレータにおいて、オフセットの温度依存性を減らし検出精度を向上させる。
【解決手段】ソース共通接続された一対の差動ＭＯＳトランジスタを有する差動入力段（１１）と、差動ＭＯＳトランジスタのドレイン端子にフォールデッドカスコード接続されたカスコード段（１２）と、差動入力段とカスコード段に共通に接続された電流回路（Mn11〜Mn13,Mn21〜Mn23）と、カスコード段の出力ノードに接続された出力段（１３）とを備えたコンパレータ回路において、前記電流回路は、カスコード段のＭＯＳトランジスタのキャリア移動度の温度特性に起因する動作点の変動をキャンセルするような温度特性を付与された電流を流すように構成した。 （もっと読む）

【課題】トランジスタの製造ばらつき等があっても、低電源電圧で動作し、広範囲の入力電圧に対してプッシュプル動作の出力電流が得られる差動増幅器を提供する。
【解決手段】差動増幅器１は、第１の導電型のトランジスタで構成され、入力信号を受けて第１の差動電流Ｉ１１、Ｉ１２を出力する第１の差動対１０と、第１の差動電流Ｉ１１、Ｉ１２に基づき、第１の吐き出し側出力電流Ｉ１８及び第１の吸い込み側出力電流Ｉ１６をそれぞれ第１の出力端子ＯＰ及び第２の出力端子ＯＮに対して出力する第１の電流増幅部１１と、第２の導電型のトランジスタで構成され、入力信号を受けて第２の差動電流Ｉ１Ｃ、Ｉ１Ｄを出力する第２の差動対２０と、第２の差動電流Ｉ１Ｃ、Ｉ１Ｄに基づき、第２の吐き出し側出力電流Ｉ１Ｋ及び第２の吸い込み側出力電流Ｉ１Ｉをそれぞれ第１の出力端子ＯＰ及び第２の出力端子ＯＮに対して出力する第２の電流増幅部２１と、を有する。 （もっと読む）

低雑音トランスコンダクタンス増幅を提供するためのデバイスが提示される。前記デバイスは、差動ＲＦ入力信号を受信するように構成されたＰＭＯＳトランスコンダクタンス部と、前記ＰＭＯＳトランスコンダクタンス部に結合されたＰＭＯＳカスコード部と、前記ＲＦ差動入力信号を受信するように構成されたＮＭＯＳトランスコンダクタンス部と、前記ＮＭＯＳトランスコンダクタンス部に結合されたＮＭＯＳカスコード部と、を含み、前記ＰＭＯＳカスコード部及びＮＭＯＳカスコード部は、差動直交出力信号及び差動同相出力信号を提供する。ＲＦ信号を増幅するための方法も提示される。前記方法は、差動ＲＦ入力信号を受信することと、前記差動ＲＦ入力信号を電流信号に変換することと、前記電流信号をバッファリングして差動直交出力信号及び差動同相出力信号を提供すること、とを含む。
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【課題】ＣＭＯＳオペアンプ回路において、パワーダウン状態の解除後に定常状態に安定するまでの動作速度を高速化することができるオペアンプ回路及びオペアンプ回路の制御方法を提供する。
【解決手段】パワーダウン時はＳＷ１により電圧ＶＤＤ２をノードＮ１に印加し、出力端ＯＵＴ１から電圧ＶＤＤ２が出力されるため、位相補償用コンデンサＣ１の両電極に電位差が生じ、電荷が蓄積され、定常状態に切り替わると蓄積されていた電荷が放電され、Ｎチャネル型ＭＯＳトランジスタＴＮ３のゲートがＯＮするため、瞬時に出力端ＯＵＴ２の出力値が引き下げられた後、安定状態に落ち着く。 （もっと読む）

【課題】プロセス変動等によるサンプルごとのしきい値のばらつきを低減させることができ、高速動作を行うことができる、入力検出及び／又は切断検出を行う検出回路を得る。
【解決手段】１対のシリアルデータ信号が対応する入力端に入力される差動増幅回路で構成された第１検出用レシーバ２と、１対のシリアルデータ信号が対応する入力端に入力される差動増幅回路で構成された第２検出用レシーバ３と、対応する入力端に入力された各基準電圧Ｖｒｐ及びＶｒｍにそれぞれオフセットを加えて出力する差動増幅回路で構成されたリファレンスレシーバ７の各差動増幅回路は、前記各シリアルデータ信号が対応してゲートに入力されるＭＯＳトランジスタからなる１対の入力トランジスタを有し、該各入力トランジスタのサブストレートゲートに電圧差を設けてそれぞれオフセットが設けられるようにした。 （もっと読む）

【課題】差動増幅回路のオフセット電圧を小さくする。
【解決手段】本発明の差動増幅回路は、差動入力信号を受け取るＮＭＯＳトランジスタ対を備えるＮ型入力段２と、Ｎ型入力段２に接続された出力段４と、前記差動入力信号を受け取るＰＭＯＳトランジスタ対を備えるＰ型入力段３と、Ｐ型入力段３に接続された出力段５と、出力端子ＯＵＴとを備えている。出力段５は、出力段４に含まれるＮＭＯＳトランジスタをＰＭＯＳトランジスタに置き換え、ＰＭＯＳトランジスタをＮＭＯＳトランジスタに置き換え、接地端子を電源端子に置き換え、電源端子を接地端子に置き換えた構成を有している。出力端子ＯＵＴは、出力段４の出力と出力段５の出力に共通に接続されている。 （もっと読む）

【課題】データパターンに関わらず、低消費電流を図ることができる出力装置を提供する。
【解決手段】外部から入力されたデータ信号を差動信号に変換して出力するドライバ回路９からの差動信号を出力する出力装置であって、ドライバ回路９から入力された差動信号を低振幅で差動出力する中継バッファ部１１と、中継バッファ部１１から出力される差動信号が入力され、振幅を増幅して出力する増幅アンプ部１２と、ドライバ回路９に比べて高い駆動力で差動出力をするデータ出力部１３とを備える。 （もっと読む）

【課題】大きいＧＢ積を得ることができる演算増幅器を提供する。
【解決手段】増幅段２０は、カレントミラー回路１２と差動対１１との一方の接続点がゲートに接続される第１のＰＭＯＳトランジスタＭ６と、カレントミラー回路１２と差動対１１と他方の接続点がゲートに接続されるＰＭＯＳトランジスタＭ８と、ＰＭＯＳトランジスタＭ６を駆動させる電流源２１と、ＰＭＯＳトランジスタＭ６と電流源２１との接続点がゲートに接続されるＮＭＯＳトランジスタＭ９とを有し、ＮＭＯＳトランジスタＭ９とＰＭＯＳトランジスタＭ８とでプッシュプル出力段を構成する。 （もっと読む）

【課題】動作電源電圧マージンを損なう事無く、チップ面積を増大させずに、入力オフセット電圧を小さくすることができる差動増幅回路を提供する。
【解決手段】１対のNチャネルMOSトランジスタM1、M2からなる差動トランジスタ対１と、差動トランジスタ対１のソースに接続された定電流源回路２と、１対のPチャネルMOSトランジスタM3、M4からなるカレントミラー負荷回路３と、カレントミラー負荷回路３の各ドレインの一方の電位と他方の電位を等しくするように、ゲートバイアスおよびドレインバイアスを発生するバイアス発生回路４とを備えている。 （もっと読む）

【課題】帰還回路内のスイッチを用いずに電圧増幅度を切り替え可能な増幅回路を提供する。
【解決手段】本発明による増幅回路３ｂは、差動入力部８１Ａ及び８１Ｂと、該差動入力部８１Ａ及び８１Ｂのうちのいずれか一方を選択するスイッチ７９Ａ及び７９Ｂと、を備え、該スイッチ７９Ａ及び７９Ｂにより選択された差動入力部を用いた増幅処理を行うオペアンプ７０ｂと、オペアンプ７０ｂの出力端と差動入力部８１Ａの入力端との間に設けられ、所定抵抗値の抵抗を有する第１の帰還回路と、オペアンプ７０ｂの出力端と差動入力部８１Ｂの入力端との間に設けられ、上記所定抵抗値とは異なる抵抗値の抵抗を有する第２の帰還回路と、を備えることを特徴とする。差動入力部の選択により電圧増幅度を切り替え可能であるので、帰還回路内のスイッチを用いずに電圧増幅度を切り替え可能となっている。 （もっと読む）