【課題】電流容量が高く、かつ生じる応力が低減されてクラックの発生が抑制され、信頼性の高いパッケージを提供する。
【解決手段】パッケージ外壁１６と、パッケージ外壁１６を貫通する貫通孔と、貫通孔にはめ込まれた凸状フィードスルー２５と、凸状フィードスルー２５に固定され端子電極２１ｂとを備え、端子電極２１ｂは、相対的に線熱膨張率は低いが抵抗率が高い第１の金属層９０と、相対的に線熱膨張率は高いが抵抗率が低い第２の金属層８０ａ，８０ｂとを備える。 （もっと読む）

【課題】ベース面の反りの少ないパッケージを提供する。
【解決手段】導体ベースプレート２００と、導体ベースプレート上に配置された半導体装置と、半導体装置を内在し、導体ベースプレート上に配置され、導体ベースプレートとは異なる材料からなる金属壁１６とを備え、導体ベースプレートは、対抗する1対の端面１００a・１００bが緩やかな弧を有し、金属壁も緩やかな弧を有しているので、接合時や基板実装時、キャップ半田付け時の反りの発生を抑制できる。 （もっと読む）

【課題】より高い破壊電圧およびより低いオン抵抗を含み、高周波数において十分に機能するパワースイッチングデバイスを提供する。
【解決手段】多重フィールドプレートトランジスタが、活性領域、ならびにソース１８、ドレイン２０、およびゲート２２を含む。第１のスペーサ層２６が、活性領域の上方でソースとゲートの間にあり、第２のスペーサ層２８が、活性領域の上方でドレインとゲートの間にある。第１のスペーサ層上の第１のフィールドプレート３０、及び第２のスペーサ層上の第２のフィールドプレート３２が、ゲートに接続される。第３のスペーサ層３４が、第１のスペーサ層、第２のスペーサ層、第１のフィールドプレート、ゲート、および第２のフィールドプレート上にあり、第３のフィールドプレート３６が、第３のスペーサ層上にあり、ソースに接続される。 （もっと読む）

【課題】バッファ層の結晶成長時に高抵抗化の不純物をドーピングすることなく上層の化合物半導体の結晶品質を保持するも、バッファ層を高抵抗化してオフリーク電流を確実に抑制し、信頼性の高い高耐圧の化合物半導体装置を実現する。
【解決手段】化合物半導体積層構造２の裏面から、化合物半導体積層構造２の少なくともバッファ層２ａに不純物、例えばＦｅ，Ｃ，Ｂ，Ｔｉ，Ｃｒのうちから選ばれた少なくとも１種類を導入し、バッファ層２ａの抵抗値を高くする。 （もっと読む）

【課題】電子トラッピングによる、ＤＣ特性とＲＦ特性の差を低減する。
【解決手段】トランジスタ１０は、チャネル層を有する活性領域を含み、この活性領域と接触してソースおよびドレイン電極２０，２２が形成され、このソース電極とドレイン電極との間にあって活性領域と接触したゲート２４が形成される。ゲートとドレイン電極との間およびゲートとソース電極との間の複数の活性領域の表面の少なくとも一部分上にスペーサ層２８がある。このスペーサ層上にはフィールドプレート３２があり、活性領域の上のスペーサ上をドレイン電極に向かって延びる。このフィールドプレートはさらに、活性領域の上のスペーサ層上をソース電極に向かって延びる。少なくとも１つの導電性経路３４，３６が、フィールドプレートをソース電極またはゲートに電気的に接続する。 （もっと読む）

【課題】低コストでしきい値電圧のバラツキの少ないノーマリーオフ化されたＨＥＭＴを提供する。
【解決手段】基板１０の上方に半導体層２１〜２４を形成する工程と、半導体層２３〜２４にフッ素成分を含むガスを用いたドライエッチングによりリセス５１となる開口部を形成する工程と、半導体層を加熱することによりリセス５１の側面及び底面に付着しているフッ素を半導体層２２〜２４に拡散させフッ素を含む領域を形成する工程と、リセス５１の内面及び半導体層２２〜２４上に絶縁膜３０を形成する工程と、リセス５１が形成されている領域に絶縁膜３０を介し電極４１を形成する工程と、を有する。 （もっと読む）

【課題】歩留りが高く信頼性の高いパッケージングされた半導体装置を提供する。
【解決手段】電極が形成された半導体チップと、前記電極に対応するリードと、前記電極と前記リードとを接続する金属配線と、前記金属配線と前記電極との接続部分及び前記金属配線と前記リードとの接続部分を覆う第１の樹脂部と、前記金属配線、前記第１の樹脂部及び前記半導体チップを覆う第２の樹脂部と、を有することを特徴とする半導体装置により上記課題を解決する。 （もっと読む）

【課題】ゲート動作に関与する結晶表面における表面電荷蓄積を大幅に低減し、ピンチオフ特性が得られる、高性能のＩｎＮ系ＦＥＴを提供すること。
【解決手段】チャネル層としてＩｎＮ系半導体を含む電界効果トランジスタである半導体装置であって、ＩｎＮ系半導体でなるチャネル層２の表面（ｃ面）に、段差を形成して窒化物半導体の六方晶結晶のａ面もしくはｍ面でなる側壁面２ａを形成し、この側壁面２ａにゲート電極６が配置され、ゲート電極６を挟むようにソース電極３とドレイン電極４がｃ面上に形成されている。 （もっと読む）

【課題】ノーマリ・オフ動作に適したＭＩＳ型を採用するも、電流コラプス特性を大幅に向上させて、デバイス効率及び耐圧に優れた信頼性の高い化合物半導体装置を実現する。
【解決手段】化合物半導体積層構造２と、化合物半導体積層構造２上に形成されたゲート絶縁膜６と、ゲート電極７とを含み、ゲート電極７は、ゲート絶縁膜６上に形成されたゲート基部７ａと、ゲート基部７ａ上に形成されたゲート傘部７ｂとを有しており、ゲート傘部７ｂの下面が化合物半導体積層構造２とショットキー接触する。 （もっと読む）

【課題】半導体層とゲート電極との間に絶縁膜が形成された半導体装置の信頼性を高める。
【解決手段】基板の上方に形成された半導体層と、前記半導体層上に形成された絶縁膜と、前記絶縁膜上に形成された電極と、を有し、前記絶縁膜は炭素を主成分とするアモルファス膜を含むものであることを特徴とする半導体装置により上記課題を解決する。 （もっと読む）

【課題】窒化物半導体を用いた電界効果トランジスタで、トランジスタの特性を低下させることなく高い密度のドレイン電流が実現できるようにする。
【解決手段】主表面を（０００１）面とした第１窒化物半導体からなるチャネル層１０１と、チャネル層１０１の上に形成された第１窒化物半導体より大きなバンドギャップエネルギーの窒化物半導体からなる第１障壁層１０２と、ゲート電極１０４が形成されたゲート形成領域１２１を挟んだソース形成領域１２２およびドレイン形成領域１２３の第１障壁層１０２の上に形成され、第２窒化物半導体より大きなバンドギャップエネルギーの第３窒化物半導体からなる第２障壁層１０５および第３障壁層１０６と、第２障壁層１０５および第３障壁層１０６の上に形成された第２窒化物半導体からなる第４障壁層１０７および第５障壁層１０８とを備える。 （もっと読む）

【課題】半導体装置に形成される絶縁膜の付着力を高め歩留りを向上させる。
【解決手段】基板１０の上方に形成された半導体層２０〜２３と、前記半導体層２０〜２３上に形成された絶縁膜３１，３２と、前記絶縁膜上３１，３２に形成された電極４１と、を有し、前記絶縁膜３１，３２は、前記電極４１の側における膜応力よりも、前記半導体層２０〜２３の側における膜応力が低いことを特徴とする半導体装置により上記課題を解決する。 （もっと読む）

【課題】耐湿性及び耐電圧性を確保しながら、デバイス特性が劣化しないようにする。
【解決手段】半導体装置を、キャリア走行層及びキャリア供給層を含む窒化物半導体積層構造を備える半導体チップ１と、半導体チップの表面を覆い、カップリング剤を含有する第１樹脂層５と、第１樹脂層の表面を覆い、界面活性剤を含有する第２樹脂層６と、第１樹脂層及び第２樹脂層で覆われた半導体チップを封止する封止樹脂層７とを備えるものとする。 （もっと読む）

【課題】特性の安定化を達成できる窒化物半導体装置及びその製造方法を提供する。
【解決手段】窒化物半導体装置１１０は、第１半導体層３、第２半導体層４、第３半導体層５、第４半導体層６、第１電極１０、第２電極８及び第３電極９を備える。第１半導体層３、第２半導体層４、第３半導体層５及び第４半導体層６は、窒化物半導体を含む。第２半導体層４は、第１半導体層３の禁制帯幅以上の禁制帯幅を有する。第３半導体層５は、ＧａＮである。第４半導体層６は、第３半導体層５の上において一部に隙間を有して設けられ、第２半導体層４の禁制帯幅以上の禁制帯幅を有する。第１電極１０は、第３半導体層５の上において第４半導体層６が設けられていない部分に設けられる。第２電極８及び第３電極９は、第４半導体層６の上において、第１電極１０の一方側及び他方側にそれぞれ設けられ、第４半導体層６とオーミック接合している。 （もっと読む）

【課題】ＧａＮを有する窒化物の上にマイクロ波プラズマを用いてゲート絶縁膜を形成する半導体装置の製造方法を提供する。
【解決手段】ＧａＮ層１３，ＡｌＧａＮ層１４ａが積層されたＦＥＴ構造と、フィールド酸化膜１５とゲート電極２０との間にかけて、形成されたゲート絶縁膜１９ｂを備える。ゲート絶縁膜１９ｂは、アルミナ２４ａとシリコン酸化膜２４ｂから構成される二層構造とする。 （もっと読む）

【課題】ゲート電圧が閾値近傍に近づくときに発生する過剰なドレイン電流を抑制する。
【解決手段】トレンチ６の先端部に形成されたｎ^-型チャネル層７がトレンチ６の長辺に位置する部分よりも膜厚が厚くなるため、そのトレンチ６の先端部においてＪＦＥＴ構造が構成されないようにする。例えば、トレンチ６の先端部をｐ⁺型領域２０にて埋め尽くすようにする。これにより、トレンチ６の先端部のＪＦＥＴ構造の閾値がトレンチ６の長辺に位置する部分のＪＦＥＴ構造の閾値からずれることによる影響を受けることがない。したがって、ゲート電圧が閾値近傍に近づくときに発生する過剰なドレイン電流を抑制できる構造のＳｉＣ半導体装置とすることが可能となる。 （もっと読む）

【課題】より高い破壊電圧およびより低いオン抵抗を含み、高周波数において十分に機能
するパワースイッチングデバイスを提供する。
【解決手段】多重フィールドプレートトランジスタが、活性領域、ならびにソース、ドレ
イン、およびゲートを含む。第１のスペーサ層が、活性領域の上方でソースとゲートの間
にあり、第２のスペーサ層が、活性領域の上方でドレインとゲートの間にある。第１のス
ペーサ層上の第１のフィールドプレート、及び第２のスペーサ層上の第２のフィールドプ
レートが、ゲートに接続される。第３のスペーサ層が、第１のスペーサ層、第２のスペー
サ層、第１のフィールドプレート、ゲート、および第２のフィールドプレート上にあり、
第３のフィールドプレートが、第３のスペーサ層上にあり、ソースに接続される。 （もっと読む）

【課題】より高い破壊電圧およびより低いオン抵抗を含み、高周波数において十分に機能
するパワースイッチングデバイスを提供する。
【解決手段】多重フィールドプレートトランジスタが、活性領域、ならびにソース、ドレ
イン、およびゲートを含む。第１のスペーサ層が、活性領域の上方でソースとゲートの間
にあり、第２のスペーサ層が、活性領域の上方でドレインとゲートの間にある。第１のス
ペーサ層上の第１のフィールドプレート、及び第２のスペーサ層上の第２のフィールドプ
レートが、ゲートに接続される。第３のスペーサ層が、第１のスペーサ層、第２のスペー
サ層、第１のフィールドプレート、ゲート、および第２のフィールドプレート上にあり、
第３のフィールドプレートが、第３のスペーサ層上にあり、ソースに接続される。 （もっと読む）

【課題】導体ベースプレート上に実装するＳｉＣやダイヤモンドを基板とする高周波半導体チップの割れを防止する。
【解決手段】導体ベースプレートと、導体ベースプレート上に配置された高周波半導体チップとを備え、高周波半導体チップは、四隅が面取りされている半導体装置。 （もっと読む）

【課題】電子輸送性に優れたｎ型半導体として利用可能であり、しかも溶剤への溶解性にも優れる共役系化合物の提供。
【解決手段】式（Ｉ）で表される共役系化合物。［式中、Ｒ^０１及びＲ^０２はアルカン骨格を含む１価の基。Ｒ^１１、Ｒ^１２、Ｒ^２１及びＲ^２２は水素原子、ハロゲン原子又は１価の基。Ｘ^１１、Ｘ^１２、Ｘ^２１及びＸ^２２は＝Ｏ，＝Ｓ又は＝ＣＡ_２（Ａは水素原子、ハロゲン原子又は１価の基を示すが、その少なくとも１つは電子吸引性の基。）を示す。Ｚ^１及びＺ^２は−Ｏ−，−Ｓ−，−Ｓｅ−，−Ｔｅ−，−ＳＯ−等のいずれかの基を示す。Ａｒ^０、Ａｒ^１及びＡｒ^２は芳香族炭化水素基又は複素環基を示す。ｒは１〜６の整数、ｓ及びｔは０〜６の整数を示す。］
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