【課題】材料の選択幅が広く、生産性が高いＴＦＴ、アクティブマトリクス基板、およびそれらの製造方法を提供すること。
【解決手段】本発明にかかる薄膜トランジスタは、ゲート電極２と、半導体層５と、半導体層５の上に設けられ、半導体層５と電気的に接続されたソース電極７、及びドレイン電極８と、を備えた薄膜トランジスタであって、半導体層５が、透光性半導体膜５ａと、透光性半導体膜５ａ上に配置され、透光性半導体膜５ａよりも光透過率の低いオーミック導電膜５ｂと、を有し、オーミック導電膜５ｂが、透光性半導体膜５ａからはみ出さないように形成され、オーミック導電膜５ｂが、ソース電極７とドレイン電極８の間のチャネル部９を挟むように分離して形成され、ソース電極７、及びドレイン電極８が、オーミック導電膜ｂを介して、透光性半導体膜５ａに接続されているものである。 （もっと読む）

【課題】Ｃｕ配線層に含まれるＣｕの周囲への拡散を抑制すると共に密着性および動作特性に優れた半導体装置およびその製造方法、並びに、その半導体装置の製造に用いるスパッタリングターゲットを提供する。
【解決手段】実施の形態に係るスパッタリングターゲットは、１．５原子％以上５．０原子％以下のＭｎと、（Ｍｇの原子％）／（Ｍｎの原子％）で示される比率が０．３以上２．１以下となるＭｇと、１０ｗｔｐｐｍ以下のＣと、２ｗｔｐｐｍ以下のＯ_２と、を含むＣｕ合金を用いて形成される。 （もっと読む）

【課題】本発明はＴＦＴ−ＬＣＤアレイ基板及びその製造方法に関する。
【解決手段】本発明はＴＦＴ−ＬＣＤアレイ基板及びその製造方法に関し、アレイ基板はベース基板と、ベース基板上に形成され画素領域を限定するゲートライン及びデータラインを含み、前記画素領域内には画素電極、薄膜トランジスタと共通電極が形成される。また、導電性薄膜材料により製造されるブラックマトリクスを含み、前記ブラックマトリクスは前記共通電極と接続される。 （もっと読む）

【課題】配線抵抗の上昇を防ぎつつ、配線間の寄生容量を低減できる表示装置を提供する。また、表示品質を向上させた表示装置を提供する。また、消費電力を低減できる表示装置を提供する。
【解決手段】液晶表示装置の画素において、信号線と、該信号線と交差する走査線と、信号線から突出する第１の電極と、該第１の電極と対向する第２の電極と、該第２の電極と接続する画素電極とを有する。また、走査線の一部はループ形状であり、第１の電極の一部は、走査線の開口部と重畳する領域に位置する。即ち、第１の電極の一部は、走査線と重畳しない。 （もっと読む）

【課題】チャネル形成時のひずみ緩和の抑制を可能にすると共に、更にひずみを印加することを可能にする。
【解決手段】基板１と、基板上に形成されひずみを有する第１半導体層３と、第１半導体層３上に離間して設けられ、第１半導体層３と格子定数が異なる第２および第３半導体層８と、第２半導体層と第３半導体層８との間の第１半導体層３上に設けられたゲート絶縁膜４と、ゲート絶縁膜４上に設けられたゲート電極５と、を備え、第２半導体層および第３半導体層８直下の第１半導体層３の外表面領域をシリサイド３ａ、８ａとする。 （もっと読む）

【課題】本発明の目的は、比較的低温において効率的に半導体シリコン膜を製造する方法を提供することである。また、本発明の目的は、基材がポリマー材料を有する半導体積層体を提供することである。
【解決手段】半導体積層体（１１０）を製造する本発明の方法は、（ａ）基材上にシリコン粒子分散体膜を形成する工程、（ｂ）シリコン粒子分散体膜を乾燥して、未焼結半導体シリコン膜を形成する工程、及び（ｃ）未焼結半導体シリコン膜に光を照射して、半導体シリコン膜を形成する工程を含む。また、本発明の半導体積層体（１１０）は、基材（１１２）及び半導体シリコン膜（１１８）を有し、基材が、ポリマー材料を有し、半導体シリコン膜が、互いに焼結されている複数のシリコン粒子から作られており、且つ半導体シリコン膜のキャリア移動度が、１．０ｃｍ^２／Ｖ・ｓ以上である。 （もっと読む）

【課題】光電変換素子を含む表示装置において、生産性および利便性に優れた表示装置を提供する。
【解決手段】複数の画素がマトリクス状に配列された表示部と、表示部に画像情報を伝送する駆動部と表示部に設けられ、且つレーザ光を検出する受光部と、受光部で検出するレーザ光の位置を解析し、位置に基づいて画像情報を操作し、操作に基づいた画像情報とは異なる画像情報を駆動部に伝送する情報処理部を有し、表示部の複数の画素はそれぞれ薄膜トランジスタを有し、受光部は複数の光電変換素子、走査回路、リセット回路および読み出し回路を有し、薄膜トランジスタおよび複数の光電変換素子は、同一の基板に設けられている表示装置である。 （もっと読む）

【課題】赤外光及び可視光に対する感度の高い光電変換素子を提供する。
【解決手段】第１のゲート電極と、第１のゲート電極を覆う第１のゲート絶縁層と、第１のゲート絶縁層上の結晶性半導体層と、結晶性半導体層上の非晶質半導体層と、非晶質半導体層上の不純物半導体層と、不純物半導体層に接するソース電極及びドレイン電極と、少なくともソース電極及びドレイン電極の間を覆う第２のゲート絶縁層と、第２のゲート絶縁層上の第２のゲート電極と、を有し、少なくともソース電極とドレイン電極の間に受光部が設けられ、第１のゲート電極は遮光性材料により結晶性半導体層及び非晶質半導体層のすべてと重畳し、第２のゲート電極は透光性材料により受光部と重畳し、第１のゲート電極は、ソース電極またはドレイン電極に電気的に接続されている光電変換素子を提供する。 （もっと読む）

【課題】少なくともフォトマスクの枚数を増加させることなく、積層構造の下部の導電層が露出するように該導電層上の絶縁膜に対する開口部の形成方法を提供する。
【解決手段】開口部が設けられる部分の積層構造の下部の導電層を、該開口部を形成するフォトマスクと同一のフォトマスクを用いて形成されたエッチングマスクにより予め露出させ、その後保護絶縁膜を形成し、前記積層構造の上部の導電層が開口部において露出されないように、保護絶縁膜に開口部を形成する。このような開口部の形成方法は、半導体装置の作製方法に適用することができる。 （もっと読む）

【課題】アモルファスシリコン膜と微結晶シリコン膜とのエッチングレートの差を大きくしたエッチング方法を提供する。
【解決手段】絶縁膜上に微結晶シリコン膜を形成し、前記微結晶シリコン膜上にアモルファスシリコン膜を形成し、前記アモルファスシリコン膜に１０００Ｐａより高圧力のＨ_２とＡｒの混合ガス雰囲気中でプラズマ処理を行うことにより前記微結晶シリコン膜を露出させてエッチングを行う。該エッチングは、アモルファスシリコン膜と微結晶シリコン膜とのエッチングレートの差が大きい。 （もっと読む）

【課題】大きな順方向−逆方向電流比を有するスイッチングデバイスを提供する。
【解決手段】トランジスタは、ソースと、ドレインと、ゲート領域と、ソースバリヤと、ドレインバリヤとを含む。ゲート領域は、ゲートと、アイランドと、ゲート酸化物とを含み、ゲート酸化物は、ゲートとアイランドとの間に配置される。ゲートおよびアイランドは、互いに、同時活性的に結合される。ソースバリヤはゲート領域からソースを分離し、ドレインバリヤはゲート領域からドレインを分離する。 （もっと読む）

【課題】アクティブマトリクス型の液晶表示装置に代表される電気光学装置ならびに半導体装置において、ＴＦＴを作製する工程数を削減して製造コストの低減および歩留まりの向上を実現することを目的としている。
【解決手段】基板上に逆スタガ型のＴＦＴ上に無機材料から成る第１の層間絶縁層と、第１の層間絶縁膜上に形成された有機材料から成る第２の層間絶縁層と、前記第2の層間絶縁層に接して形成された画素電極とを設け、前記基板の端部に他の基板の配線と電気的に接続する入力端子部とを有し、該入力端子部は、ゲート電極と同じ材料から成る第1の層と、画素電極と同じ材料から成る第２の層とから形成されていることを特徴としている。このような構成とすることで、フォトリソグラフィー技術で使用するフォトマスクの数を５枚とすることができる。 （もっと読む）

【課題】安定した電流駆動能力を発揮させる。
【解決手段】アレイ基板２０の製造方法は、基板上にゲート電極２４ａを形成するゲート電極形成工程と、ゲート電極２４ａ上に不純物を含有するゲート絶縁膜２４ｂ、半導体膜ＳＭ、導電膜ＣＯの順で成膜する成膜工程と、導電膜ＣＯ上にレジストＲＳを塗布し、そのレジストＲＳに対してフォトマスクを介して露光を行った後に現像を行うことでレジストＲＳをパターニングするレジストパターニング工程と、パターニングされたレジストＲＳをマスクとして導電膜ＣＯをエッチングすることで開口領域ＯＰを挟んで配されるソース電極２４ｄ及びドレイン電極２４ｅを形成する導電膜パターニング工程と、開口領域ＯＰから半導体膜ＳＭを介してゲート絶縁膜２４ｂに含有される不純物を脱離させる不純物脱離工程とを含む。 （もっと読む）

【課題】Ｉ/Ｏ用バルク部とコアロジック用ＳＯＩ部が混載されたバルク＆ＳＯＩハイブリッド型ＣＭＩＳデバイスでは、閾値電圧制御の最適化のため多数のゲートスタックを用いる必要があり、プロセス及び構造が複雑になるという問題がある。
【解決手段】本願発明は、Ｈｉｇｈ−ｋゲート絶縁膜およびメタルゲート電極を有するＳＯＩ型半導体ＣＭＩＳＦＥＴ集積回路装置において、いずれかのバックゲート半導体領域に不純物を導入することにより、対応する部分のＭＩＳＦＥＴの閾値電圧を調整するものである。 （もっと読む）

【課題】半導体特性に影響を与えることなく、印刷法により形成される半導体の形状再現性に優れた電界効果型トランジスタの製造方法を提供すること。
【解決手段】基材上に、少なくともゲート電極、ソース電極、ドレイン電極と、半導体層およびゲート絶縁膜とが形成されてなる電界効果型トランジスタの製造方法であって、少なくともゲート絶縁膜上に半導体層を形成する工程を有し、該ゲート絶縁膜は露光によりシランカップリング剤と反応可能な官能基を生成し得る材料で形成されており、該工程の前に、ゲート絶縁膜上の半導体を形成する領域の周囲を露光する工程及び露光部においてフッ化アルキル基を有するシランカップリング剤と該官能基とを反応させる工程を有することを特徴とする。 （もっと読む）

【課題】Ｉ/Ｏ用バルク部とコアロジック用ＳＯＩ部が混載されたバルク＆ＳＯＩハイブリッド型ＣＭＩＳデバイスでは、閾値電圧制御の最適化のため多数のゲートスタックを用いる必要があり、プロセス及び構造が複雑になるという問題がある。
【解決手段】本願発明は、Ｈｉｇｈ−ｋゲート絶縁膜およびメタルゲート電極を有するＳＯＩ型半導体ＣＭＩＳＦＥＴ集積回路装置において、いずれかのバックゲート半導体領域に不純物を導入することにより、対応する部分のＭＩＳＦＥＴの閾値電圧を調整するものである。 （もっと読む）

【課題】 フローティングゲートメモリやＭＮＯＳメモリのような極薄膜の絶縁層を必要とせず、印刷、塗布でメモリ素子が製造可能となる簡便で、注入電荷量の制御が容易な帯電体、並びにこの帯電体をゲート絶縁膜に用いてＦＥＴを作製することにより、閾値電圧制御が可能で、長時間制御された閾値電圧状態を保持可能なＦＥＴ及びメモリ素子を提供する。
【解決手段】 電荷注入が生じる電界強度（以降、電荷注入耐圧）および絶縁耐圧がそれぞれＥ_ＣＩ，ＨおよびＥ_ＢＨである絶縁体(以下，高電荷注入耐圧材料)と、その電荷注入耐圧Ｅ_ＣＩ，ＬがＥ_ＣＩ，Ｌ ＜ Ｅ_Ｃｌ，Ｈの関係にある絶縁体（以下、低電荷注入耐圧材料）の二種類の絶縁体を積層した絶縁物で、高電荷注入耐圧材料と低電荷注入耐圧材料のそれぞれに接し離れた２枚の電極にＥ_ＣＩ，Ｌ ＜ ｜Ｅ｜ ＜ Ｅ_ＢＨ の電界強度で電圧を印加して低電荷注入耐圧材料側から電荷を絶縁体内に注入して帯電させる帯電体。 （もっと読む）

【課題】高い表示品質を実現することができるＴＦＴ、アクティブマトリクス基板及びそれらの製造方法を提供すること。
【解決手段】本発明にかかる薄膜トランジスタは、ゲート電極２ａと、ゲート電極２ａを覆うように設けられたゲート絶縁膜３と、ゲート絶縁膜３の上に設けられ、ゲート電極の上方に配置された半導体膜５と、半導体膜５の上に設けられ、半導体膜５と電気的に接続されたソース電極７と、半導体膜５の上に設けられ、半導体膜５と電気的に接続されたドレイン電極９と、ソース電極７又はドレイン電極９の少なくとも一方とゲート絶縁膜３との間に設けられ、半導体膜５と分離して配置された低反射膜６と、を備え、低反射膜６が、平面視におけるゲート電極２ａの外側において、ソース電極７、ドレイン電極９のパターンと略同一形状、又は、はみ出しているものである。 （もっと読む）

【課題】微細化しても高い性能を実現可能な半導体装置を提供する。
【解決手段】実施の形態の半導体装置は、半導体基板と、半導体基板上に形成されたゲート絶縁膜と、ゲート絶縁膜上に形成されたゲート電極と、ゲート電極の両側に形成された第１のゲート側壁と、半導体基板上に形成され、ゲート電極との間に第１のゲート側壁を挟むソース・ドレイン半導体層と、を備える。さらに、ゲート電極の両側に、第１のゲート側壁上およびソース・ドレイン半導体層上に形成され、第１のゲート側壁との境界がゲート電極の側面で終端し、第１のゲート側壁よりもヤング率が小さく、かつ、低誘電率の第２のゲート側壁、を備える。 （もっと読む）

【課題】基板上に形成されたモリブデン系導電性薄膜、または、モリブデン系導電性薄膜とアルミニウム系導電性薄膜とが積層された積層導電性薄膜を、効率よく、側面が良好な順テーパー形状となるようなエッチングを行うことが可能なエッチング液、および、該エッチング液を用いたエッチング方法を提供することを目的とする。
【解決手段】(ａ)リン酸３０〜８０重量％と、(ｂ)硝酸０．１〜２０重量％と、(ｃ)有機酸塩０．１〜２０重量％と、(ｄ)水とを含有するエッチング液を用いてエッチングを行う。
また、上記エッチング液を用いて、アルミニウム系導電性薄膜と、モリブデン系導電性薄膜とを備えてなる２層構造の積層導電性薄膜、または、アルミニウム系導電性薄膜と、アルミニウム系導電性薄膜を挟み込むようにその両主面側に配設された第１のモリブデン系導電性薄膜および第２のモリブデン系導電性薄膜を備えてなる３層構造の積層導電性薄膜をエッチングする。 （もっと読む）