【課題】ＰＬＬ回路におけるＰＬＬ応答特性を、参照電圧に応じた所望の特性にする。
【解決手段】ＰＬＬ回路は、入力された電圧に応じた周波数で発振することにより、内部信号を生成する発振部と、前記内部信号を分周して分周信号を生成する分周部と、外部から入力された基準信号の位相と前記分周部から受けた前記分周信号の位相とを比較し、比較結果に応じた位相誤差信号を出力する位相比較部と、前記位相誤差信号に基づいて制御電圧を生成する生成部と、を有するＰＬＬ回路であって、前記生成部から出力された前記制御電圧が前記発振部へ入力される第１の状態と、参照電圧が前記発振部へ入力される第２の状態とを切り替える切り替え部と、前記第２の状態において、前記生成部から出力された前記制御電圧と前記参照電圧とを比較し、前記生成部から出力される制御電圧が前記参照電圧に等しくなるように、前記発振部に入力された電圧に対する前記発振部における発振する周波数を補正する補正部とを備える。 （もっと読む）

【課題】位相同期ループクロック発生器等に好適に使用できるオシレータ及びオシレーティング信号を生成する方法を提供する。
【解決手段】オシレータであって、第１スターブドインバータ（ｃｕｒｒｅｎｔ−ｓｔａｒｖｅｄ ｉｎｖｅｒｔｅｒ）と、前記第１スターブドインバータの内部インバータとクロスカップルされる内部インバータを含む第２スターブドインバータと、前記第１スターブドインバータの内部インバータの出力と接続される第１インバータと、前記第２スターブドインバータの内部インバータの出力と接続される第２インバータとを具備し、前記第１インバータの出力は、前記第２スターブドインバータの外部インバータの入力に供給され、前記第２インバータの出力は、前記第１スターブドインバータの外部インバータの入力に供給されることを特徴とする。 （もっと読む）

【課題】スプリアス特性の向上が実現可能なＰＬＬ回路およびそれを搭載した通信用半導体集積回路装置を提供する。
【解決手段】例えば、ＰＬＬ回路を含む高周波ＩＣチップＲＦ＿ＣＰ３において、ＰＬＬ回路内に複数の電圧制御発振回路ブロックＶＣＯ＿ＢＫ１〜ＶＣＯ＿ＢＫ３を設ける。そして、ループフィルタの一部となる２次のループフィルタＦＬＴ＿Ａを位相検出等を行うシンセサイザブロックＳＹＮに配置し、他の一部となる１次のループフィルタＦＬＴ＿ＢをＶＣＯ＿ＢＫ１〜ＶＣＯ＿ＢＫ３のそれぞれに配置する。さらに、ＶＣＯ＿ＢＫ１〜ＶＣＯ＿ＢＫ３のそれぞれにおいては、インダクタＬ１，Ｌ２をＲＦ＿ＣＰ３の内側でなく外側（外周の一辺）に近くなるような向きにレイアウトする。 （もっと読む）

【課題】出力周波数レンジの広いＰＬＬ回路を提供すること。
【解決手段】本発明の一態様は、入力パルス信号と出力側からフィードバックされたフィードバックパルス信号との位相差に基づいて生成された電圧を、制御電流Ｉｃへ変換する電圧電流変換回路１０４と、制御電流Ｉｃに応じた周波数のパルス信号を生成する電流制御発振器１０５と、制御電流Ｉｃを検出する電流検出部１０８と、検出された前記制御電流に基づいて、電流制御発振器１０５から発振される出力パルス信号の周波数レンジを切り替える周波数レンジ切替回路１０６と、を備えた位相同期ループ回路である。 （もっと読む）

【課題】周波数の安定性およびジッタの要件を満たしつつ、ＣＭＯＳ技術における既存の最適化プロセスの手順に依拠した集積化の解決手法を利用した、温度に対して非依存型のＬＣ型発振器を提供する。
【解決手段】実質的に温度に非依存のＬＣ型発振器は、温度ヌル位相に実質的に等しい位相でタンク発振を生成するＬＣ発振器タンク１０を用いて達成される。該温度ヌル位相は、ＬＣ型発振器の出力発振の周波数の温度変化に伴う変動が最小化されるときの、ＬＣ発振器タンク１０の位相である。該ＬＣ型発振器はさらに、該ＬＣ発振器タンク１０に接続されて、該温度ヌル位相に実質的に等しい位相で該ＬＣ発振器タンク１０を発振させる周波数安定化回路を含む。 （もっと読む）

【課題】ノイズの少ないＦＭ受信装置を提供する。
【解決手段】アンテナと、発振回路と、位相比較回路と、チャージポンプ回路と、ループフィルタと、ＶＣＯと、ＶＣＯ発振信号を所定の周波数ごとに分周し分周発振信号を生成する第１の分周回路と、ＶＣＯ発振信号を所定の周波数ごとに分周し局部発振信号を生成する第２の分周回路とを備え、ＶＣＯはＬＣ共振回路を含まない構成のものであり、分周発振信号を位相比較回路の入力信号とするものであって、局部発振信号と電波の信号より、複数の中間周波数信号を生成するミキサと、中間周波数信号をＡ／Ｄ変換するＡ／Ｄ変換器と、Ａ／Ｄ変換器より出力された信号のうち、複数の中間周波数信号に対応するいずれか一つを選択し復調するデジタル復調器と、を備えたことを特徴とするＦＭ受信装置を提供することにより上記課題を解決する。 （もっと読む）

【課題】ＰＬＬの出力において所望のデューティサイクルを達成するための方法および装置を提供する。
【解決手段】本方法は、制限差動増幅器２１４を使用して、差動コモンモードクロック信号からデューティサイクルを有するシングルエンドクロック信号を発生させるステップと、シングルエンドクロック信号２１３のデューティサイクルに応じて差動バイアス電流信号２２９、２３０を発生させるステップと、差動バイアス電流信号を制限差動増幅器に与えることによって、シングルエンドクロック信号のデューティサイクルを所望のデューティサイクルに修正するステップとを含む。ＣＭＬ−ＣＭＯＳ変換器回路は、制限差動増幅器２１４と、シングルエンドクロック信号のデューティサイクルの測定値を発生するための低域フィルタと、（ｉ）測定値を基準電圧と比較し、（ｉｉ）比較に応じて差動バイアス電流信号を発生するための第２の差動増幅器とを含む。 （もっと読む）

【課題】外部環境による精度低下への影響を低下させ、且つ、ユーザに必要以上の手間を掛けることなく、安定して高精度な基準周波数信号を継続的に出力し続ける。
【解決手段】制御部１０は、位相差の平均が、監視閾値未満であるかどうかによって、較正の有無を判定する。ここで、監視閾値は、当該基準周波数信号発生装置１が搭載される通信機器に求められる精度の仕様を満たすとともに、この仕様の限界に対して所定の余裕を持てるような値に設定されている。監視閾値未満の場合、制御部１０は、自身で生成した維持用制御電圧信号を電圧制御発振器１４へ与え、監視閾値に達する場合、ループフィルタ１２からの制御電圧信号を電圧制御発振器１４に与え、電圧制御発振器１４はこの制御電圧信号に基づいて較正を行う。 （もっと読む）

【課題】クロスカップル構造を有する複数のバッファを備えて発振し、ＣＭＬレベルのクロック信号を生成することのできるリング発振器を提供し、また、基準位相クロック信号を補正して希望の周波数、及び互いに予め定められた位相差を有するマルチ位相クロック信号を生成することのできるマルチ位相クロック補正回路を提供する。
【解決手段】 本発明のリング発振器は、各々クロスカップル構造を有し、予め定められた電圧レベルのバイアス電圧が印加されて複数のクロック信号を生成するための複数のバッファ手段を備え、前記複数のクロック信号が、前記バイアス電圧に対応するスイング幅を有する。 （もっと読む）

【課題】ＶＣＯ１０１の変調感度のばらつきを低減し、高速、高精度に所望の出力振幅を得ることができるＰＬＬ方式発振回路を提供する。
【解決手段】振幅検出器１０３は、ＶＣＯ１０１の出力振幅を検出する。振幅制御部１０５は、振幅検出器１０３が検出したＶＣＯ１０１の出力振幅が所望の振幅になるように可変電流源１０９の電流値を制御する。ＬＰＦ１０８は、振幅制御部１０５と可変電流源１０９との間に接続される。スイッチ１０７は、ＬＰＦ１０８を振幅制御部１０５と可変電流源１０９との間に接続するか否かを切り替える。振幅制御部１０５は、ＬＰＦ１０８又は切り替えスイッチ１０７のいずれか一方を介して、可変電流源１０９と接続される。 （もっと読む）

【課題】入力データ論理判定用クロックとして、周波数の安定したクロックを得ることができ、しかも、消費電力を低減することができるＣＤＲ回路を提供する。
【解決手段】入力データの論理判定に使用する内部クロックＲＣＫの発生源として電圧制御発振器１５を設ける。電圧制御発振器１５は、ＣＭＯＳインバータをリング接続して構成し、常に電流を消費することがないものとする。両エッジ検出部１３は、ＰＬＬ１２内の電圧制御発振器２１の出力クロックＶＣＯ＿ＣＫの遷移タイミングを検出し、電圧制御発振器１５の発振周波数がＰＬＬ１２内の電圧制御発振器２１の発振周波数と同一となるように電圧制御発振器１５を制御する。 （もっと読む）

【課題】光情報の検出精度の劣化を抑えながら、ガスセルの温度制御を量子レベルで制御する原子発振器およびその制御方法を提供する。
【解決手段】本実施形態の原子発振器の光学系の要部である物理部５０は、ガス状の金属原子を封入したガスセル１０およびそれを保持するガスセル保持部材２１からなるセルユニット２０、ガスセル１０を所定の温度に加熱するヒータ１５、ガスセル１０中の金属原子を励起するコヒーレント光の光源である光源３０、ガスセル１０を透過した励起光を検出するフォトセンサ４０、フォトセンサ４０により検出された励起光の強度に基づいてヒータ１５を制御する温度制御手段、を有する。ガスセル１０は、円筒部１１と、該円筒部１１の両端の開口部をそれぞれ封鎖して励起光の光路の入射面および出射面を形成する窓部１２と、を有し、ヒータ１５が、窓部１２の前記光路と異なる領域に設けられている。 （もっと読む）

【課題】Ｃ結型の可変容量回路と直結型の可変容量回路とを上手く混在させて構成し、発振周波数の線形性及び可変範囲のバランスがとれた電圧制御発振器を提供する。
【解決手段】本発明の電圧制御発振器は、並列接続されたインダクタ回路１１０、Ｃ結型可変容量回路１２０及び１４０、直結型可変容量回路１３０、及び負性抵抗回路１６０と、基準電位Ｖｒｅｆ１及びＶｒｅｆ２を生成する基準電位発生部１８０とを備える。各可変容量回路１２０、１３０、及び１４０の可変容量素子１２１、１２２、１３１、１３２、１４１、及び１４２のバックゲート端子には、発振周波数をフィードバック制御するための制御電位Ｖｔが印加される。Ｃ結型可変容量回路１２０及び１４０の可変容量素子１２１、１２２、１４１及び１４２のゲート端子には、基準電位Ｖｒｅｆ１及びＶｒｅｆ２がそれぞれ印加される。 （もっと読む）

【課題】高いＣ／Ｎ及び周波数安定度を確保できると共に、周波数可変幅を広くしても帯域外の不要信号の漏れ出しを抑制でき、かつ同時にインピーダンスマッチングもとることができるようにすること。
【解決手段】この電圧制御発振装置は、制御電圧信号に応じて発振周波数が制御される電圧制御発振回路１と、電圧制御発振回路に供給する制御電圧信号を生成するＰＬＬ回路２と、電圧制御発振回路１の出力する発振信号を逓倍する逓倍回路３と、逓倍回路３の出力する逓倍信号のうち所定逓倍数の信号を通過させる通過帯域と逓倍回路３に入力した発振信号と同一周波数をトラップするトラップ周波数とが設定された帯域通過フィルタ兼トラップ回路４とを備える。制御電圧信号を分岐して段間結合兼トラップ回路１５へ入力し、発振周波数に同期させて段間結合兼トラップ回路１５の通過帯域及びトラップ周波数を可変させると共に段間結合量を調整する。 （もっと読む）

【課題】ＰＶＴに依存せずに安定した周波数を出力する。
【解決手段】出力する第１の出力信号Ｖｆ１の周波数を第１の制御電圧ＶＣ１で制御する第１の電圧制御発振器１１と、第１の出力信号Ｖｆ１及び基準信号ＣＬＫに基づき第１の出力信号Ｖｆ１の周波数を一定に維持する第１の制御電圧ＶＣ１を生成する制御電圧生成部１３と、を含む位相同期回路１０と、出力する第２の出力信号Ｖｆ２の周波数を第２の制御電圧ＶＣ２で制御する第２の電圧制御発振器２０と、第１の制御電圧ＶＣ１に基づき第２の出力信号Ｖｆ２の周波数を一定に維持する第２の制御電圧ＶＣ２を生成する制御電圧変換部３０と、を含むパルス発生回路１。 （もっと読む）

【課題】本発明は、基準発振部から出力される基準信号を用いて、演算部の設定で無線通信の送受信周波数を生成する無線通信機器において、基準発振部の温度特性を補正するためのデータを効率的かつ、高精度な補正を実現する構成を提供することを目的とする。
【解決手段】本発明の無線通信機器３００は、送信処理を行う際に、温度検出部３０５で基準発振部３０３の雰囲気温度を検出し、該当の温度に対する第１補正データを外部記憶部３０４より読み出した上で、演算設定部３１１で、内部記憶部３１２に記憶されている第２補正データ、基準チャネル設定データを用い送信周波数を演算し、高周波部３０１から、あらかじめ決められたデータを変調し送信をおこなう。 （もっと読む）

【課題】可変容量素子の容量可変域に応じた広い周波数可変域を確保することができる電圧制御型可変周波数発振回路を提供する。
【解決手段】コイルＬ１，Ｌ２および可変容量素子１１１，１１２を有する共振回路１０１と、負性抵抗回路１０２とを含む発振回路部１０３を備える電圧制御型可変周波数発振回路である。発振回路部１０３と電源電位ＶＤＤとの間に第１の抵抗３０１を設ける。また、発振回路部と接地電位端との間には第２の抵抗３０２を接続するとよい。 （もっと読む）

電圧制御発振器（ＶＣＯ）周波数に対する温度変化の影響を補償するための技法が、開示される。一実施形態においては、補助バラクタが、ＶＣＯのＬＣタンクに結合される。補助バラクタは、温度に伴ってＶＣＯ周波数の全体の変化を最小にする、温度依存制御電圧（Ｖａｕｘ）によって制御されるキャパシタンスを有する。デジタル手段とアナログ手段とを使用して制御電圧を生成するための技法が、さらに開示される。補助バラクタ（Ｃａｕｘ）は、ＬＣタンクの電圧制御キャパシタ（Ｃ）と直列に、または並列にのいずれかで結合されることができる。一実施形態においては、制御電圧は、絶対温度に比例した第１の電流と、温度にわたって一定の第２の電流、例えば、バンドギャップ電流、との間の差を得ることによって生成される。
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【課題】 ＰＬＬおよびＶＣＯの発振特性を改善できる容量切り換え回路を提供する。
【解決手段】 端子Ｐ1と端子Ｐ2との間に、コンデンサＣ1k（ｋ＝０〜ｎ）と、ＦＥＴ（Ｑ1k）と、コンデンサＣ2kとを直列接続する。ＦＥＴ（Ｑ1k）のソースにＦＥＴ（Ｑ3k）のドレインを接続する。ＦＥＴ（Ｑ1k）のドレインにＦＥＴ（Ｑ4k）のドレインを接続する。ＦＥＴ（Ｑ3k、Ｑ4k）のゲートは互いに接続し、それらのソースも互いに接続する。ＦＥＴ（Ｑ1k）のゲートに、このＦＥＴ（Ｑ1k）をオンオフ制御する制御データｂkを供給する。ＦＥＴ（Ｑ4k）のソースに、少なくともＦＥＴ（Ｑ1k）がオフのときには、ＦＥＴ（Ｑ3k、Ｑ4k）をオフにするソースバイアス電圧ＶSkを供給する。 （もっと読む）

【課題】クロックに関する設定を簡単に行う。
【解決手段】ＶＣＸＯと、基準周波数とこの基準周波数のクロックをＶＣＸＯに発生させる電圧のレベルである基準レベルとを記憶するメモリと、必要な周波数のクロックを、メモリに記憶されている基準周波数および基準レベルを基準に求められる電圧をＶＣＸＯに与えて発生させるＤ／Ａコンバータ制御部およびＤ／Ａコンバータと、を有する装置において、下記の処理を行う。試験時レベルを適宜変化させながら、各試験時レベルに応じた電圧をＶＣＸＯに与えて試験用クロックを発生させる。試験用クロックを周波数カウンタに出力する。試験用クロックの周波数と目標周波数との差が所定の範囲内であることが周波数カウンタによって確認できたら、メモリに、この試験用クロックがＶＣＸＯによって発生された際の試験時レベルを基準レベルとして記憶させ、この試験用クロックの周波数を基準周波数として記憶させる。 （もっと読む）