システム監視回路を備えた計算機
【課題】システムの障害発生時に、障害の発生原因の特定に寄与する情報を収集し、迅速な障害解析を行う。
【解決手段】ＣＰＵ１０１、複数のＩ／Ｏバス１０８を有する入出力制御回路１０７、およびこれらに動作用の電力を供給する電源装置１１３、前記ＣＰＵ、メモリ制御回路及び入出力制御回路を接続するバス１０２，１０６等を備えた計算機において、前記システム監視回路は、前記入出力制御回路が前記電源の開閉を制御する信号として出力する電源制御信号１１２および前記電源装置が該装置の状態を表す信号として出力する電源状態信号１１７を監視し、前記電源状態信号が電源制御信号に適合したレベルにないとき入出力制御回路あるいは電源装置に異常があると判断し、また、前記Ｉ／Ｏバス上の信号を監視し、Ｉ／Ｏバス上に所定期間に渡って信号が検出されないとき前記Ｉ／Ｏバスに異常があると判断する。
【解決手段】ＣＰＵ１０１、複数のＩ／Ｏバス１０８を有する入出力制御回路１０７、およびこれらに動作用の電力を供給する電源装置１１３、前記ＣＰＵ、メモリ制御回路及び入出力制御回路を接続するバス１０２，１０６等を備えた計算機において、前記システム監視回路は、前記入出力制御回路が前記電源の開閉を制御する信号として出力する電源制御信号１１２および前記電源装置が該装置の状態を表す信号として出力する電源状態信号１１７を監視し、前記電源状態信号が電源制御信号に適合したレベルにないとき入出力制御回路あるいは電源装置に異常があると判断し、また、前記Ｉ／Ｏバス上の信号を監視し、Ｉ／Ｏバス上に所定期間に渡って信号が検出されないとき前記Ｉ／Ｏバスに異常があると判断する。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、システム監視回路を備えた計算機に係り、特に障害の発生原因を特定する情報を迅速に収集することのできる計算機に関する。
【背景技術】
【０００２】
計算機において、バスマスタによる転送が可能な共通バスの使用状態を、監視回路により監視し、一定時間以上、共通バスが使用されていない場合にハングアップが発生したとして障害検出を行い、さらにハングアップ発生要因となったデバイスの情報を表示し、記録した後、計算機の強制再起動を行う技術が知られている。
【０００３】
この技術は、監視対象を共通バスに限定しているため、バスロックによるハングアップしか検出することができない。また、障害発生時にハングアップ発生要因となったデバイスの情報を記録する手段を備えているが、記録された情報を入手するためには直接計算機を操作しなければならない。
【特許文献１】特開２００３−３４５６７３号公報
【発明の開示】
【発明が解決しようとする課題】
【０００４】
計算機を実運用するに際しては、計算機の電源が遮断状態となる、電源がリセットされる、あるいは電源供給以外の機能が停止する等の障害が発生することがある。
【０００５】
これらの障害が発生した場合、障害を再現し、さらに障害発生の原因を特定する等の障害解析には長時間を要する。
【０００６】
高度の信頼性を要求される計算機においては、前記障害発生の原因を早期に解析して問題を解決することは非常に重要であり、このためには、障害発生時における装置情報を収集し、記録しておくことが重要である。
【０００７】
本発明は、これらの問題点に鑑みてなされたもので、障害発生時に障害の発生原因の特定に寄与する情報を収集し迅速な障害解析のできるシステム監視回路を備えた計算機を提供するものである。
【課題を解決するための手段】
【０００８】
本発明は上記課題を解決するため、次のような手段を採用した。
【０００９】
ＣＰＵ、該ＣＰＵと接続されＣＰＵが使用するデータを記憶したメモリを制御するメモリ制御回路、複数のＩ／Ｏバスを有する入出力制御回路、およびこれらに動作用の電力を供給する電源装置、前記ＣＰＵ、メモリ制御回路及び入出力制御回路を接続するバス、並びに前記複数のＩ／Ｏバスの状態を監視するシステム監視回路を備えた計算機において、
前記システム監視回路は、前記入出力制御回路が前記電源の開閉を制御する信号として出力する電源制御信号および前記電源装置が該装置の状態を表す信号として出力する電源状態信号を監視し、前記電源状態信号が電源制御信号に適合したレベルにないとき入出力制御回路あるいは電源装置に異常があると判断し、また、前記Ｉ／Ｏバス上の信号を監視し、Ｉ／Ｏバス上に所定期間に渡って信号が検出されないとき前記Ｉ／Ｏバスに異常があると判断する。
【発明の効果】
【００１０】
本発明は、以上の構成を備えるため、システムの障害発生時に、障害の発生原因の特定に寄与する情報を収集し、迅速な障害解析を行うことができる。
【発明を実施するための最良の形態】
【００１１】
以下、最良の実施形態を添付図面を参照しながら説明する。図１は、本実施形態にかかるシステム監視回路を備えた計算機を説明する図である。
【００１２】
図１に示すように、システム監視回路１１１を備えた計算機１００は、ＣＰＵ１０１、ＣＰＵバス１０２，メモリ制御回路１０３、メモリデバイス１０５、入出力制御回路１０７、Ｉ／Ｏバス１０８、電源装置１１３を備える。なお、電源装置１１３はＣＰＵ１０１、メモリ制御回路１０３、メモリデバイス１０５、入出力制御回路１０７に動作用の電源を供給する主電源と該主電源とは独立して電源を供給するサブ電源を有している。
【００１３】
ＣＰＵ１０１およびメモリデバイス１０５は、それぞれＣＰＵバス１０２、メモリバス１０４を介してメモリ制御回路１０３と接続されている。また、メモリ制御回路１０３と入出力制御回路１０７はシステムバス１０６を介して接続されている。また、複数のデバイス１０９およびＢＩＯＳは、Ｉ／Ｏバス１０８に接続されている。計算機１００を起動する際には、ＣＰＵ１０１はＢＩＯＳ１１０に記録された手順にしたがって計算機１００に接続されている各種デバイスおよび回路を初期化する。
【００１４】
システム監視回路１１１にはＩ／Ｏバス１０８、入出力制御回路１０７および電源装置１１３が接続される。これにより、システム監視回路１１１はＩ／Ｏバス１０８の使用状況、入出力制御回路１０７が前記電源の開閉を制御する信号として出力する電源制御信号１１２および前記電源装置１１３が該装置の状態を表す信号として出力する電源状態信号１１７を監視することができる。
【００１５】
また、システム監視回路１１１は、例えば記憶媒体が取り外し可能な記憶装置１１５と接続される。また、記憶装置１１５はシステム監視回路を介して外部の装置と接続可能な外部接続端子１１４と接続されている。
【００１６】
システム監視回路１１１および取り外し可能な記憶装置１１５は、前記電源装置１１３とは独立したサブ電源装置と接続され、該サブ電源装置を介して、前記主電源の障害発生時においても停電することなく前記システム監視回路１１１および取り外し可能な記憶装置１１５に給電することができる。サブ電源装置は、例えば、直流５Ｖの電源であり、この電源を供給することにより、システム監視回路１１１および記憶装置１１５は電源装置全体が故障などにより電源供給不能とならない限り、計算機１００の動作状態に依存することなく動作可能となる。
【００１７】
計算機１００が正常に動作している場合には、入出力制御回路１０７からシステム監視回路１１１に、例えば電源をオンにするための電源制御信号１１２が送信され、また、電源装置１１３からシステム監視回路１１１に、例えば電源装置１１３が正常（出力が所定レベル）であることを表す電源状態信号１１７が送信されている。
【００１８】
システム監視回路１１１は、電源制御信号１１２および電源状態信号１１３を監視し、例えば、前記電源状態信号１１２が主電源をオンにするためための電源制御信号を出力しているにもかかわらず、電源状態信号１１７が電源出力が正常レベルであることを表す信号でないとき、システム監視回路１１１と電源装置１１３を結ぶラインあるいは電源装置１１３に異常があると判断する。このように、電源状態信号が電源制御信号に適合した値にないとき入出力制御回路あるいは電源装置に異常があると判断することができる。
【００１９】
また、電源制御信号１１２および電源状態信号の何れかの信号が途絶えた場合、途絶えた装置（入出力制御回路１０７あるいは電源装置１１３）に障害があったと判断することができる。また、障害発生を検知したとき、障害発生部位、障害発生日時等の障害情報を記憶装置１１５に記録する。
【００２０】
システム監視回路１１１は接続されたＩ／Ｏバス１０８（本実施形態では３本）の監視を行う。バスマスタによる転送が可能なＩ／Ｏバスの場合、デバイス１０９から入出力制御回路１０７に対してバスマスタ転送の許可を求める信号が送られる。また、バスマスタ転送を許可する場合には入出力制御回路１０７からデバイス１０９に対して、使用許可の信号が送られる。したがって、これらの信号を監視することで、現在バスを使用しているデバイス１０９の特定を行うことができる。また、Ｉ／Ｏバス１０８の使用状況を監視し、信号途絶などの障害が発生したときには障害発生パス名、発生日時、直前まで当該バスを使用していたデバイスＩＤ等の障害情報を記憶装置１１５に記録する。
【００２１】
また、外部接続端子１１４に外部端末を接続することにより、システム監視回路１１１に接続された記憶装置１１５に記録された情報を読み出すことができる。また、システム監視回路１１１に接続されたＩ／Ｏバス１０８の中で障害発生後使用可能なものを経由して、入出力制御回路１０７や使用可能なバスに接続されたデバイス１０９の持つレジスタの内容を読み出すことができる。さらに、システム監視回路１１１で監視は行わないが、使用可能であればシステムバス１０６やメモリバス１０４、ＣＰＵバス１０２を経由することでそれらに接続されているＣＰＵやメモリデバイス、メモリ制御回路の持つ情報を収集することも可能である。
【００２２】
図２は、障害発生時の処理を説明する図である。システム監視回路１１１に接続されているＩ／Ｏバス１０８の信号、電源制御信号１１２および電源状態信号１１７が正常である場合、システム監視回路１１１はシステム監視回路内の図示しないバッファ領域に対して、最新のＩ／Ｏバス１０８の信号、電源制御信号１１２および電源状態信号１１７を出力し、該信号の状態を記録し続ける（ステップＳ２００，２０１）。
【００２３】
入出力制御回路１０７あるいは電源装置１１３に障害が発生し、電源状態信号が電源制御信号に適合したレベルにないとき、前記バッファ領域に記録された障害発生直前におけるデータを記憶装置１１５に転送して記憶する（ステップＳ２０２、２０４，２０５）。また、Ｉ／Ｏバス１０８の信号の異常を検知すると、前記バッファ領域に記録された障害発生直前におけるデータを記憶装置１１５に転送して記憶する（ステップＳ２０３，２０４，２０５）。
【００２４】
以上説明したように、本実施形態によれば、システム監視回路１１１は、システム監視回路１１１に接続されているＩ／Ｏバス１０８の信号、電源制御信号１１２および電源状態信号１１７が正常である場合、最新のＩ／Ｏバス１０８の信号、電源制御信号１１２および電源状態信号１１７をバッファメモリに記録し続け、前記Ｉ／Ｏバス１０８の信号の異常、あるいは電源状態信号が電源制御信号に適合した値にないことを検知すると前記バッファメモリの内容を記憶装置１１５に転送して記憶する。このため、記憶装置１１５の記憶内容を解析することにより、障害発生時における障害発生箇所の特定、障害解析等を迅速に行うことができる。また、前記記憶装置１１５は記憶装置に記憶された情報を前記Ｉ／Ｏバスとは独立して出力するための外部接続端子１１４を備えるため、外部からの接続により計算機内の情報を収集することができる。
【図面の簡単な説明】
【００２５】
【図１】実施形態にかかるシステム監視回路を備えた計算機を説明する図である。
【図２】障害発生時の処理を説明する図である。
【符号の説明】
【００２６】
１００ 計算機
１０１ ＣＰＵ
１０２ ＣＰＵバス
１０３ メモリ制御回路
１０４ メモリバス
１０５ メモリデバイス
１０６ システムバス
１０７ 入出力制御回路
１０８ Ｉ／Ｏバス
１０９ デバイス
１１０ ＢＩＯＳ
ｌｌｌ システム監視回路
１１２ 電源制御信号
１１３ 電源装置
１１４ 外部接続端子
１１５ 記憶装置
１１６ サブ電源装置
１１７ 電源状態信号
【技術分野】
【０００１】
本発明は、システム監視回路を備えた計算機に係り、特に障害の発生原因を特定する情報を迅速に収集することのできる計算機に関する。
【背景技術】
【０００２】
計算機において、バスマスタによる転送が可能な共通バスの使用状態を、監視回路により監視し、一定時間以上、共通バスが使用されていない場合にハングアップが発生したとして障害検出を行い、さらにハングアップ発生要因となったデバイスの情報を表示し、記録した後、計算機の強制再起動を行う技術が知られている。
【０００３】
この技術は、監視対象を共通バスに限定しているため、バスロックによるハングアップしか検出することができない。また、障害発生時にハングアップ発生要因となったデバイスの情報を記録する手段を備えているが、記録された情報を入手するためには直接計算機を操作しなければならない。
【特許文献１】特開２００３−３４５６７３号公報
【発明の開示】
【発明が解決しようとする課題】
【０００４】
計算機を実運用するに際しては、計算機の電源が遮断状態となる、電源がリセットされる、あるいは電源供給以外の機能が停止する等の障害が発生することがある。
【０００５】
これらの障害が発生した場合、障害を再現し、さらに障害発生の原因を特定する等の障害解析には長時間を要する。
【０００６】
高度の信頼性を要求される計算機においては、前記障害発生の原因を早期に解析して問題を解決することは非常に重要であり、このためには、障害発生時における装置情報を収集し、記録しておくことが重要である。
【０００７】
本発明は、これらの問題点に鑑みてなされたもので、障害発生時に障害の発生原因の特定に寄与する情報を収集し迅速な障害解析のできるシステム監視回路を備えた計算機を提供するものである。
【課題を解決するための手段】
【０００８】
本発明は上記課題を解決するため、次のような手段を採用した。
【０００９】
ＣＰＵ、該ＣＰＵと接続されＣＰＵが使用するデータを記憶したメモリを制御するメモリ制御回路、複数のＩ／Ｏバスを有する入出力制御回路、およびこれらに動作用の電力を供給する電源装置、前記ＣＰＵ、メモリ制御回路及び入出力制御回路を接続するバス、並びに前記複数のＩ／Ｏバスの状態を監視するシステム監視回路を備えた計算機において、
前記システム監視回路は、前記入出力制御回路が前記電源の開閉を制御する信号として出力する電源制御信号および前記電源装置が該装置の状態を表す信号として出力する電源状態信号を監視し、前記電源状態信号が電源制御信号に適合したレベルにないとき入出力制御回路あるいは電源装置に異常があると判断し、また、前記Ｉ／Ｏバス上の信号を監視し、Ｉ／Ｏバス上に所定期間に渡って信号が検出されないとき前記Ｉ／Ｏバスに異常があると判断する。
【発明の効果】
【００１０】
本発明は、以上の構成を備えるため、システムの障害発生時に、障害の発生原因の特定に寄与する情報を収集し、迅速な障害解析を行うことができる。
【発明を実施するための最良の形態】
【００１１】
以下、最良の実施形態を添付図面を参照しながら説明する。図１は、本実施形態にかかるシステム監視回路を備えた計算機を説明する図である。
【００１２】
図１に示すように、システム監視回路１１１を備えた計算機１００は、ＣＰＵ１０１、ＣＰＵバス１０２，メモリ制御回路１０３、メモリデバイス１０５、入出力制御回路１０７、Ｉ／Ｏバス１０８、電源装置１１３を備える。なお、電源装置１１３はＣＰＵ１０１、メモリ制御回路１０３、メモリデバイス１０５、入出力制御回路１０７に動作用の電源を供給する主電源と該主電源とは独立して電源を供給するサブ電源を有している。
【００１３】
ＣＰＵ１０１およびメモリデバイス１０５は、それぞれＣＰＵバス１０２、メモリバス１０４を介してメモリ制御回路１０３と接続されている。また、メモリ制御回路１０３と入出力制御回路１０７はシステムバス１０６を介して接続されている。また、複数のデバイス１０９およびＢＩＯＳは、Ｉ／Ｏバス１０８に接続されている。計算機１００を起動する際には、ＣＰＵ１０１はＢＩＯＳ１１０に記録された手順にしたがって計算機１００に接続されている各種デバイスおよび回路を初期化する。
【００１４】
システム監視回路１１１にはＩ／Ｏバス１０８、入出力制御回路１０７および電源装置１１３が接続される。これにより、システム監視回路１１１はＩ／Ｏバス１０８の使用状況、入出力制御回路１０７が前記電源の開閉を制御する信号として出力する電源制御信号１１２および前記電源装置１１３が該装置の状態を表す信号として出力する電源状態信号１１７を監視することができる。
【００１５】
また、システム監視回路１１１は、例えば記憶媒体が取り外し可能な記憶装置１１５と接続される。また、記憶装置１１５はシステム監視回路を介して外部の装置と接続可能な外部接続端子１１４と接続されている。
【００１６】
システム監視回路１１１および取り外し可能な記憶装置１１５は、前記電源装置１１３とは独立したサブ電源装置と接続され、該サブ電源装置を介して、前記主電源の障害発生時においても停電することなく前記システム監視回路１１１および取り外し可能な記憶装置１１５に給電することができる。サブ電源装置は、例えば、直流５Ｖの電源であり、この電源を供給することにより、システム監視回路１１１および記憶装置１１５は電源装置全体が故障などにより電源供給不能とならない限り、計算機１００の動作状態に依存することなく動作可能となる。
【００１７】
計算機１００が正常に動作している場合には、入出力制御回路１０７からシステム監視回路１１１に、例えば電源をオンにするための電源制御信号１１２が送信され、また、電源装置１１３からシステム監視回路１１１に、例えば電源装置１１３が正常（出力が所定レベル）であることを表す電源状態信号１１７が送信されている。
【００１８】
システム監視回路１１１は、電源制御信号１１２および電源状態信号１１３を監視し、例えば、前記電源状態信号１１２が主電源をオンにするためための電源制御信号を出力しているにもかかわらず、電源状態信号１１７が電源出力が正常レベルであることを表す信号でないとき、システム監視回路１１１と電源装置１１３を結ぶラインあるいは電源装置１１３に異常があると判断する。このように、電源状態信号が電源制御信号に適合した値にないとき入出力制御回路あるいは電源装置に異常があると判断することができる。
【００１９】
また、電源制御信号１１２および電源状態信号の何れかの信号が途絶えた場合、途絶えた装置（入出力制御回路１０７あるいは電源装置１１３）に障害があったと判断することができる。また、障害発生を検知したとき、障害発生部位、障害発生日時等の障害情報を記憶装置１１５に記録する。
【００２０】
システム監視回路１１１は接続されたＩ／Ｏバス１０８（本実施形態では３本）の監視を行う。バスマスタによる転送が可能なＩ／Ｏバスの場合、デバイス１０９から入出力制御回路１０７に対してバスマスタ転送の許可を求める信号が送られる。また、バスマスタ転送を許可する場合には入出力制御回路１０７からデバイス１０９に対して、使用許可の信号が送られる。したがって、これらの信号を監視することで、現在バスを使用しているデバイス１０９の特定を行うことができる。また、Ｉ／Ｏバス１０８の使用状況を監視し、信号途絶などの障害が発生したときには障害発生パス名、発生日時、直前まで当該バスを使用していたデバイスＩＤ等の障害情報を記憶装置１１５に記録する。
【００２１】
また、外部接続端子１１４に外部端末を接続することにより、システム監視回路１１１に接続された記憶装置１１５に記録された情報を読み出すことができる。また、システム監視回路１１１に接続されたＩ／Ｏバス１０８の中で障害発生後使用可能なものを経由して、入出力制御回路１０７や使用可能なバスに接続されたデバイス１０９の持つレジスタの内容を読み出すことができる。さらに、システム監視回路１１１で監視は行わないが、使用可能であればシステムバス１０６やメモリバス１０４、ＣＰＵバス１０２を経由することでそれらに接続されているＣＰＵやメモリデバイス、メモリ制御回路の持つ情報を収集することも可能である。
【００２２】
図２は、障害発生時の処理を説明する図である。システム監視回路１１１に接続されているＩ／Ｏバス１０８の信号、電源制御信号１１２および電源状態信号１１７が正常である場合、システム監視回路１１１はシステム監視回路内の図示しないバッファ領域に対して、最新のＩ／Ｏバス１０８の信号、電源制御信号１１２および電源状態信号１１７を出力し、該信号の状態を記録し続ける（ステップＳ２００，２０１）。
【００２３】
入出力制御回路１０７あるいは電源装置１１３に障害が発生し、電源状態信号が電源制御信号に適合したレベルにないとき、前記バッファ領域に記録された障害発生直前におけるデータを記憶装置１１５に転送して記憶する（ステップＳ２０２、２０４，２０５）。また、Ｉ／Ｏバス１０８の信号の異常を検知すると、前記バッファ領域に記録された障害発生直前におけるデータを記憶装置１１５に転送して記憶する（ステップＳ２０３，２０４，２０５）。
【００２４】
以上説明したように、本実施形態によれば、システム監視回路１１１は、システム監視回路１１１に接続されているＩ／Ｏバス１０８の信号、電源制御信号１１２および電源状態信号１１７が正常である場合、最新のＩ／Ｏバス１０８の信号、電源制御信号１１２および電源状態信号１１７をバッファメモリに記録し続け、前記Ｉ／Ｏバス１０８の信号の異常、あるいは電源状態信号が電源制御信号に適合した値にないことを検知すると前記バッファメモリの内容を記憶装置１１５に転送して記憶する。このため、記憶装置１１５の記憶内容を解析することにより、障害発生時における障害発生箇所の特定、障害解析等を迅速に行うことができる。また、前記記憶装置１１５は記憶装置に記憶された情報を前記Ｉ／Ｏバスとは独立して出力するための外部接続端子１１４を備えるため、外部からの接続により計算機内の情報を収集することができる。
【図面の簡単な説明】
【００２５】
【図１】実施形態にかかるシステム監視回路を備えた計算機を説明する図である。
【図２】障害発生時の処理を説明する図である。
【符号の説明】
【００２６】
１００ 計算機
１０１ ＣＰＵ
１０２ ＣＰＵバス
１０３ メモリ制御回路
１０４ メモリバス
１０５ メモリデバイス
１０６ システムバス
１０７ 入出力制御回路
１０８ Ｉ／Ｏバス
１０９ デバイス
１１０ ＢＩＯＳ
ｌｌｌ システム監視回路
１１２ 電源制御信号
１１３ 電源装置
１１４ 外部接続端子
１１５ 記憶装置
１１６ サブ電源装置
１１７ 電源状態信号
【特許請求の範囲】
【請求項１】
ＣＰＵ、該ＣＰＵと接続されＣＰＵが使用するデータを記憶したメモリを制御するメモリ制御回路、複数のＩ／Ｏバスを有する入出力制御回路、およびこれらに動作用の電力を供給する電源装置、前記ＣＰＵ、メモリ制御回路及び入出力制御回路を接続するバス、並びに前記複数のＩ／Ｏバスの状態を監視するシステム監視回路を備えた計算機において、
前記システム監視回路は、前記入出力制御回路が前記電源の開閉を制御する信号として出力する電源制御信号および前記電源装置が該装置の状態を表す信号として出力する電源状態信号を監視し、前記電源状態信号が電源制御信号に適合したレベルにないとき入出力制御回路あるいは電源装置に異常があると判断し、
また、前記Ｉ／Ｏバス上の信号を監視し、Ｉ／Ｏバス上に所定期間に渡って信号が検出されないとき前記Ｉ／Ｏバスに異常があると判断することを特徴とするシステム監視回路を備えた計算機。
【請求項２】
請求項１記載の計算機において、
前記システム監視回路は、取り外し可能な記憶装置を備え、前記電源状態信号が電源制御信号に適合したレベルにないとき、およびＩ／Ｏバスに異常があると判断したとき異常発生箇所のデータを前記記憶装置に記憶させることを特徴とするシステム監視回路を備えた計算機。
【請求項３】
請求項２記載の計算機において、
前記システム監視回路および取り外し可能な記憶装置は前記電源装置とは独立したサブ電源装置を備え、該電源装置を介して、前記電源の異常時にも給電可能であることを特徴とするシステム監視回路を備えた計算機。
【請求項４】
ＣＰＵ、該ＣＰＵと接続されＣＰＵが使用するデータを記憶したメモリを制御するメモリ制御回路、複数のＩ／Ｏバスを有する入出力制御回路、およびこれらに動作用の電力を供給する電源装置、前記ＣＰＵ、メモリ制御回路及び入出力制御回路を接続するバス、並びに前記複数のＩ／Ｏバスの状態を監視するシステム監視回路を備えた計算機において、
前記システム監視回路は取り外し可能な記憶装置並びに前記システム監視回路および記憶装置に前記電源装置とは独立して電源を供給するサブ電源装置を備え、
前記システム監視回路は、前記入出力制御回路が前記電源の開閉を制御する信号として出力する電源制御信号および前記電源装置が該装置の状態を表す信号として出力する電源状態信号を監視し、前記電源状態信号が電源制御信号に適合したレベルにないとき入出力制御回路あるいは電源装置に異常があると判断し、
また、前記Ｉ／Ｏバス上の信号を監視し、Ｉ／Ｏバス上に所定期間に渡って信号が検出されないとき前記Ｉ／Ｏバスに異常があると判断して、異常を表す情報を前記取り外し可能な記憶装置に記憶するとともに、前記記憶装置は記憶装置に記憶された情報を前記Ｉ／Ｏバスとは独立して前記システム監視回路を介して出力するための外部接続端子を備えたことを特徴とするシステム監視回路を備えた計算機。
【請求項１】
ＣＰＵ、該ＣＰＵと接続されＣＰＵが使用するデータを記憶したメモリを制御するメモリ制御回路、複数のＩ／Ｏバスを有する入出力制御回路、およびこれらに動作用の電力を供給する電源装置、前記ＣＰＵ、メモリ制御回路及び入出力制御回路を接続するバス、並びに前記複数のＩ／Ｏバスの状態を監視するシステム監視回路を備えた計算機において、
前記システム監視回路は、前記入出力制御回路が前記電源の開閉を制御する信号として出力する電源制御信号および前記電源装置が該装置の状態を表す信号として出力する電源状態信号を監視し、前記電源状態信号が電源制御信号に適合したレベルにないとき入出力制御回路あるいは電源装置に異常があると判断し、
また、前記Ｉ／Ｏバス上の信号を監視し、Ｉ／Ｏバス上に所定期間に渡って信号が検出されないとき前記Ｉ／Ｏバスに異常があると判断することを特徴とするシステム監視回路を備えた計算機。
【請求項２】
請求項１記載の計算機において、
前記システム監視回路は、取り外し可能な記憶装置を備え、前記電源状態信号が電源制御信号に適合したレベルにないとき、およびＩ／Ｏバスに異常があると判断したとき異常発生箇所のデータを前記記憶装置に記憶させることを特徴とするシステム監視回路を備えた計算機。
【請求項３】
請求項２記載の計算機において、
前記システム監視回路および取り外し可能な記憶装置は前記電源装置とは独立したサブ電源装置を備え、該電源装置を介して、前記電源の異常時にも給電可能であることを特徴とするシステム監視回路を備えた計算機。
【請求項４】
ＣＰＵ、該ＣＰＵと接続されＣＰＵが使用するデータを記憶したメモリを制御するメモリ制御回路、複数のＩ／Ｏバスを有する入出力制御回路、およびこれらに動作用の電力を供給する電源装置、前記ＣＰＵ、メモリ制御回路及び入出力制御回路を接続するバス、並びに前記複数のＩ／Ｏバスの状態を監視するシステム監視回路を備えた計算機において、
前記システム監視回路は取り外し可能な記憶装置並びに前記システム監視回路および記憶装置に前記電源装置とは独立して電源を供給するサブ電源装置を備え、
前記システム監視回路は、前記入出力制御回路が前記電源の開閉を制御する信号として出力する電源制御信号および前記電源装置が該装置の状態を表す信号として出力する電源状態信号を監視し、前記電源状態信号が電源制御信号に適合したレベルにないとき入出力制御回路あるいは電源装置に異常があると判断し、
また、前記Ｉ／Ｏバス上の信号を監視し、Ｉ／Ｏバス上に所定期間に渡って信号が検出されないとき前記Ｉ／Ｏバスに異常があると判断して、異常を表す情報を前記取り外し可能な記憶装置に記憶するとともに、前記記憶装置は記憶装置に記憶された情報を前記Ｉ／Ｏバスとは独立して前記システム監視回路を介して出力するための外部接続端子を備えたことを特徴とするシステム監視回路を備えた計算機。
【図１】
【図２】
【図２】
【公開番号】特開２００９−１９９３３６（Ｐ２００９−１９９３３６Ａ）
【公開日】平成２１年９月３日（２００９．９．３）
【国際特許分類】
【出願番号】特願２００８−４０２７１（Ｐ２００８−４０２７１）
【出願日】平成２０年２月２１日（２００８．２．２１）
【出願人】（０００００５１０８）株式会社日立製作所 (27,607)
【Ｆターム（参考）】
【公開日】平成２１年９月３日（２００９．９．３）
【国際特許分類】
【出願日】平成２０年２月２１日（２００８．２．２１）
【出願人】（０００００５１０８）株式会社日立製作所 (27,607)
【Ｆターム（参考）】
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