【課題】ゲート誘電体の上に複数のシリサイド金属ゲートが作製される相補型金属酸化物半導体集積化プロセスを提供する。
【解決手段】形成されるシリサイド金属ゲート相の変化を生じさせるポリＳｉゲートスタック高さの変化という欠点のないＣＭＯＳシリサイド金属ゲート集積化手法が提供される。集積化手法は、プロセスの複雑さ最小限に保ち、それによって、ＣＭＯＳトランジスタの製造コストを増加させない。 （もっと読む）

【課題】酸化物半導体を用いたトランジスタの電気的特性のばらつき及び電気的特性の劣化は、半導体装置の信頼性を著しく低下させる。
【解決手段】基板上に形成される酸化物半導体層と、酸化物半導体層と電気的に接続する、端部がテーパー角を有し、かつ上端部が曲面形状を有するソース電極及びドレイン電極と、酸化物半導体層の一部と接し、かつ酸化物半導体層、ソース電極及びドレイン電極を覆うゲート絶縁層と、酸化物半導体層と重畳する、ゲート絶縁層上のゲート電極と、を有する。 （もっと読む）

【課題】信頼性を向上させることができる半導体装置を得る。
【解決手段】半導体素子１０のエミッタ電極１２の一部の領域上に多層メタル２０が形成されている。多層メタル２０に外部電極２２が半田２４を介して接続されている。半導体素子１０はモールド樹脂３６に覆われている。多層メタル２０の終端部の直下に第１のセル３８ａが存在し、多層メタル２０の終端部の直下以外に第２のセル３８ｂが存在する。第２のセル３８ｂにはＩＧＢＴが形成され、第１のセル３８ａにはＩＧＢＴが形成されていない。 （もっと読む）

【課題】酸化物半導体を用いた半導体装置は、可視光や紫外光を照射することで電気的特性が変化する。このような問題に鑑み、酸化物半導体膜を用いた半導体装置に安定した電気的特性を付与し、信頼性の高い半導体装置を作製することを課題の一とする。
【解決手段】酸化物絶縁層上に膜厚が１ｎｍ以上１０ｎｍ以下の第１の酸化物半導体層を形成し、加熱処理により結晶化させ、第１の結晶性酸化物半導体層を形成し、その上に第１の結晶性酸化物半導体層よりも厚い第２の結晶性酸化物半導体層を形成する。 （もっと読む）

【課題】低仕事関数金属の使用や不純物ドーピングなしで伝導特性を制御し得る電子デバイスを提供することを目的とする。
【解決手段】本発明による電子デバイスは、電極層と半導体層とが吸着した吸着部を有する電子デバイスであって、前記吸着部において、前記電極層の原子表面と前記半導体層の原子表面との距離は、前記電極層の前記原子表面と前記半導体層の前記原子表面とが安定して吸着する安定吸着距離より短い。前記吸着部への加重によって、前記距離を前記安定吸着距離より短くする加重部を有する。 （もっと読む）

【課題】簡易な方法で、所定の形状のタンタルと炭素との固相拡散接合を可能とし更に、タンタルと炭素の固相拡散接合を行う場所以外のタンタル表面に炭化物を形成する方法を提供する。
【解決手段】タンタル若しくはタンタル合金をチューブ状の形状に加工し、チューブの中に炭素粉末を圧入し、その後、チューブをコイル形状に加工した後に真空熱処理炉内に設置し、タンタル若しくはタンタル合金表面に形成されている自然酸化膜であるＴａ₂Ｏ₅を除去した後、タンタル若しくはタンタル合金チューブ内面と前記炭素粉末ＰＩＴを固相拡散結合で分子接合させるとともに、前記真空熱処理炉内に炭素源を導入してタンタル若しくはタンタル合金チューブの外表面に炭素を侵入させてＴａＣを形成する。 （もっと読む）

【課題】不良を抑制しつつ微細化を達成する半導体装置の作製方法を提供することを目的の一とする。
【解決手段】絶縁表面上に、酸化物半導体層と、酸化物半導体層と接するソース電極およびドレイン電極と、を形成し、ソース電極上およびドレイン電極上にそれぞれ絶縁層を形成し、酸化物半導体層、ソース電極、ドレイン電極および絶縁層上にゲート絶縁層を形成し、ゲート絶縁層上に導電層を形成し、導電層を覆うように絶縁膜を形成し、導電層におけるソース電極またはドレイン電極と重畳する領域の少なくとも一部が露出するように絶縁膜を加工し、導電層の露出した領域をエッチングして、ソース電極とドレイン電極に挟まれた領域の少なくとも一部と重畳するゲート電極を自己整合的に形成する半導体装置の作製方法である。 （もっと読む）

【課題】基板やゲート絶縁膜の露出表面と、ソース電極およびドレイン電極の露出表面とに、良好で均一な膜質の半導体薄膜を設けることが可能な薄膜トランジスタを提供する。
【解決手段】薄膜トランジスタ１ａは、有機材料または酸化物材料またはシリコン系材料からなるゲート絶縁膜（絶縁層）１５上に、導電性酸化物材料からなる酸化物材料層１７-aとこの上部の金属材料層１７-bとからなるソース電極およびドレイン電極が設けられたものである。そしてゲート絶縁膜（絶縁層）１５とソース電極１７ｓおよびドレイン電極１７ｄとにおける酸化物材料層１７-aとの露出面が、自己組織化膜１９で覆われており、この自己組織化膜１９で覆われた上部のソース電極１７ｓ−ドレイン電極１７ｄ間にわたって半導体薄膜２１が設けられている。 （もっと読む）

【課題】低温の熱処理で形成することができ、所望の特性を得ることができるＳｉＣショットキーバリアダイオードとその製造方法を提供する。
【解決手段】第１の導電型のシリコンカーバイド層３表面にショットキー電極５を備え、ショットキー電極５の周囲に一部が重畳するように形成されたガードリング層４を備えたシリコンカーバイドショットキーバリアダイオードであって、Ｎ型のシリコンカーバイド層３のガードリング層形成予定領域に、Ｐ型の不純物イオンを注入し、その後、イオン注入領域を再結晶化すると共に、注入された不純物イオンの一部を活性化する温度範囲で熱処理してガードリング層４を形成する。 （もっと読む）

【課題】本発明は、外部ノイズ等の過大電流に起因するＨＥＭＴの損傷、破壊若しくは発火を防止することができる半導体装置を提供する。
【解決手段】半導体装置１は、第１の半導体層３１と、第２の半導体層３２と、二次元キャリアガス層３３と、ソース電極４１と、ドレイン電極４２と、ゲート電極５と、二次元キャリアガス層３３上においてゲート電極５とドレイン電極４２との間に配設された補助電極６と、を備え、二次元キャリアガス層３３のゲート電極５とソース電極６との間のチャネル抵抗Ｒ１に比べて、二次元キャリアガス層３３のゲート電極５と補助電極６との間のチャネル抵抗Ｒ２が高く設定されている。 （もっと読む）

【課題】電圧−電流特性を改善した整流素子を用いたメモリセルを有する不揮発性半導体記憶装置を提供する。
【解決手段】不揮発性半導体記憶装置は、第１の配線と、前記第１の配線に交差する第２の配線と、前記第１及び第２の配線に設けられ、抵抗状態の変化に応じてデータを記憶するメモリ素子及び非オーミック素子を直列接続してなるメモリセルとを備え、前記非オーミック素子は、メタル層と、前記メタル層に接合された真性半導体層と、前記真性半導体層に接合された第１の不純物を含む不純物半導体層とを有することを特徴とする。 （もっと読む）

【課題】電流コラプスを抑制し、且つゲートリーク電流を低減するヘテロ接合電界効果トランジスタとその製造方法の提供を目的とする。
【解決手段】本発明に係るヘテロ接合電界効果トランジスタは、バリア層４０及びバリア層４０上に形成されたキャップ層５０を含む窒化物半導体層と、前記窒化物半導体層に下部を埋没するようにして前記窒化物半導体層上に設けられたゲート電極９０と、前記窒化物半導体層上に形成されたＳｉを含まない絶縁膜からなる表面保護膜１００とを備える。 （もっと読む）

【課題】炭化珪素ＭＯＳＦＥＴにおいて、炭化珪素層とゲート絶縁膜との界面に発生する界面準位を十分に低減できず、キャリアの移動度が低下する場合があった。
【解決手段】この発明に係る炭化珪素半導体装置は、炭化珪素層を有し炭化珪素層上にゲート絶縁膜を形成した基板を炉の中に導入する基板導入工程と、基板を導入した炉を加熱して一酸化窒素と窒素とを導入する加熱工程とを備え、加熱工程は、窒素を反応させてゲート絶縁膜と炭化珪素層との界面を窒化する。 （もっと読む）

【課題】III-V族窒化物半導体を有する半導体装置において、熱による出力低下を低減する。
【解決手段】半導体装置は、基板１０１上に設けられ、III-V族窒化物半導体からなるバッファ層１０２と、バッファ層１０２上に設けられ、III-V族窒化物半導体からなる第１の半導体層１０３と、第１の半導体層１０３上に設けられ、III-V族窒化物半導体からなる第２の半導体層１０４と、基板１０１の裏面上に設けられ、接地に接続された裏面電極１１１と、第２の半導体層１０４上に互いに離間して設けられたソース電極１３２及びドレイン電極１３４と、第２の半導体層１０４上に設けられたゲート電極１３６とと、第２の半導体層１０４、第１の半導体層１０３、及びバッファ層１０２を貫通し、少なくとも基板１０１に達し、ソース電極１３２と裏面電極１１１とを電気的に接続させるプラグ１０９とを備えている。 （もっと読む）

【課題】トレンチ構造のトランジスタセルがマトリクス状に多数個形成され、そのゲート電極に金属膜からなるゲート配線がコンタクトされる半導体装置でも、ゲート耐圧を充分に高くすることができる構造の半導体装置を提供する。
【解決手段】半導体層１に凹溝１１が形成され、その凹溝１１内にゲート酸化膜４が形成され、その凹溝１１内にポリシリコンなどからなるゲート電極５が設けられるトレンチ構造のトランジスタセルがマトリクス状に配列されたセル領域１０を有している。そして、金属膜からなるゲート配線９とコンタクトするため、ゲート電極５と連続してゲートパッド部５ａが設けられるが、そのゲートパッド部５ａが凹溝１１と同時に設けられる凹部１２内に形成されている。 （もっと読む）

【課題】特性が良好なトランジスタを提供する。
【解決手段】例えば、ボトムゲート・ボトムコンタクト構造のトランジスタを作製するに際して、ソースとドレインを構成する導電層を３層の積層構造とし、２段階のエッチングを行う。すなわち、第１のエッチング工程には、少なくとも第２の膜及び第３の膜に対するエッチングレートが高いエッチング方法を採用し、第１のエッチング工程は少なくとも第１の膜を露出するまで行う。第２のエッチング工程には、第１の膜に対するエッチングレートが第１のエッチング工程よりも高く、「第１の膜の下に接して設けられている層」に対するエッチングレートが第１のエッチング工程よりも低いエッチング方法を採用する。第２のエッチング工程後にレジストマスクをレジスト剥離液により剥離するに際し、第２の膜の側壁が少し削られる。 （もっと読む）

【課題】酸化物半導体層のチャネル領域の、水素拡散による低抵抗化を抑制するトップゲート型酸化物半導体ＴＦＴ及びこれを備えた表示装置を提供する。
【解決手段】基板の上に、ソース電極層と、ドレイン電極層と、酸化物半導体層と、ゲート絶縁層と、Ｉｎ、Ｇａ、Ｚｎ、Ｓｎの少なくとも１種類の元素を含むアモルファス酸化物半導体からなるゲート電極層と、水素を含む保護層と、を有し、ゲート絶縁層は酸化物半導体層のチャネル領域の上に形成され、ゲート電極層はゲート絶縁層の上に形成され、保護層はゲート電極層の上に形成されていることを特徴とするトップゲート型薄膜トランジスタ。 （もっと読む）

【課題】 ビアホール上にオーミック電極が形成された半導体装置において、装置の小型化を図ること。
【解決手段】 本半導体装置は、基板１０と、基板１０上に形成された半導体層１２と、半導体層上１２に形成されたソースまたはドレイン電極を構成するオーミック電極２０と、を備え、基板１０及び半導体層１２には、基板１０及び半導体層１２を貫通するビアホール３０が形成され、ビアホール３０は、少なくとも半導体層を貫通する第１ビアホール３２と、第１ビアホール３２下の基板１０に形成された、第１ビアホール３２より開口断面積が大きい第２ビアホール３４と、を含み、オーミック電極２０は、第１ビアホール３２の上に設けられている。 （もっと読む）

【課題】酸化物半導体を用いた半導体装置において、電界効果移動度が大きい酸化物半導体層を用いた半導体装置の作製方法を提供することを課題の一つとする。また、高速動作可能な半導体装置の作製方法を提供することを課題の一つとする。
【解決手段】酸化物半導体層をハロゲン元素により終端化させて、酸化物半導体層と、酸化物半導体層と接する導電層のコンタクト抵抗の増大を抑制することで、酸化物半導体層と導電層のコンタクト抵抗が良好になり、電界効果移動度が高いトランジスタを作製することができる。 （もっと読む）

【課題】製造工程において半導体膜の膜質を低下させることなくその性能を維持し、少ない工程数によって、かつ、製造上の歩留まり及びスループットの優れた構造を有する薄膜トランジスタ及びその製造方法等を提供する。
【解決手段】薄膜トランジスタ１００は、酸化物半導体膜１２０を有し、当該酸化物半導体膜１２０は、各薄膜半導体毎に、ゲート電極１６０下及び隣接された薄膜トランジスタ間とにそれぞれ形成された第１領域１２１及び１２２と、ソース電極１４０及びドレイン電極１５０下であって第１領域１２１の前記水平方向におけるそれぞれの両端に並設されており、ソース電極１４０及びドレイン電極１５０にそれぞれ電気的に接続され、かつ、非駆動時に前記第１領域１２１及び１２２より低抵抗である第２領域１２３及び１２４と、を有している。 （もっと読む）