【課題】 ビアホール上にオーミック電極が形成された半導体装置において、装置の小型化を図ること。
【解決手段】 本半導体装置は、基板１０と、基板１０上に形成された半導体層１２と、半導体層上１２に形成されたソースまたはドレイン電極を構成するオーミック電極２０と、を備え、基板１０及び半導体層１２には、基板１０及び半導体層１２を貫通するビアホール３０が形成され、ビアホール３０は、少なくとも半導体層を貫通する第１ビアホール３２と、第１ビアホール３２下の基板１０に形成された、第１ビアホール３２より開口断面積が大きい第２ビアホール３４と、を含み、オーミック電極２０は、第１ビアホール３２の上に設けられている。 （もっと読む）

【課題】半導体チップに安定した電源電流を供給したり、電源から信号系へ混入する雑音を低くするための、半導体デバイスの電源流入及び電源流出端子の端子数の低減と、前記半導体チップを搭載した実装面積の低減を可能とする半導体モジュールを提供する。
【解決手段】半導体チップ２０の両面に電源系と信号系の電気的接続端子を振り分けて配置する。大電流が流れる流路の許容電流値を大きくする構成により、少ない端子数でも安定な電源供給が可能、信号系への雑音混入を低減、ピン数の低減による実装面積の低減、放熱効果の増大などが可能となる。また、この半導体チップ２０を搭載した半導体モジュールにより、大電流が流れる高速動作でも安定した特性を実現できる。 （もっと読む）

【課題】配線回路基板において、コンタクト抵抗の上昇を抑制し、熱応力による断線を防止することのできるコンタクト構造を提供する。
【解決手段】 配線回路基板は、第１配線層（５）、第２配線層（７）、及び前記第１配線層と前記第２配線層を電気的に接続するコンタクト配線（６）を有する。前記コンタクト配線は、前記第１配線層のコンタクト面を被覆する第１被覆部（６ａ）と、前記第２配線層のコンタクト面を被覆する第２被覆部（６ｃ）と、前記第１被覆部と前記第２被覆部の間に延びるプラグ部（６ｂ）を有する。前記第１被覆部、前記プラグ部、及び前記第２被覆部は、同一の導電性材料で一体的に形成された内部に界面のないコンタクト配線である。 （もっと読む）

【課題】貫通電極の形成に時間を要さず、貫通電極内でのボイドの発生を抑制できる半導体装置、およびこの半導体装置の製造方法を提供すること。
【解決手段】半導体装置１は、孔１１１が形成された絶縁性あるいは半導体の層１１と、層１１の孔１１１内に設けられた貫通電極１２と、を備える。貫通電極１２は、シード層１２１と、めっき層１２２と、を備える。シード層１２１は、孔１１１の底面１１１Ａを覆う。また、シード層１２１は、孔１１１の側面１１１Ｂのうち、孔１１１の開口から、孔１１１の開口と孔１１１の底面１１１Ａとの間の所定の位置までの第１の領域を未被覆とし、この第１の領域（未被覆領域）１１１Ｂ１を除いた第二の領域を被覆している。めっき層１２２は、シード層１２１と、未被覆領域１１１Ｂ１の少なくとも一部を覆う。 （もっと読む）

【課題】本発明ではフォトリソグラフィー技術解像限界付近のパターン形成を安定して形成すると共に、コンタクトプラグなどの構造物における目合わせずれや接触面積の縮小による接触電気抵抗の増大や接続不良を解決する。
【解決手段】半導体基板上に形成された絶縁材料層１００に、第１の方向に延在し、底部の幅Ｗ１より上部の幅Ｗ２が広い第１の溝１０１を形成する工程と、第１の溝１０１内に、溝の上端より低い位置まで埋め込み層１０２を形成する工程と、埋め込み層１０２上に露出している第１の溝１０１の側壁を覆うサイドウォール１０３を形成する工程と、サイドウォール１０３をマスクとして埋め込み層１０２をエッチングして第１の方向に分離する工程と、
を含むことを特徴とする。 （もっと読む）

【課題】任意の方向に傾斜した開口部を形成可能な基板の製造方法、半導体装置の製造方法、およびこれを適用した半導体装置を備えた電気光学装置を提供すること。
【解決手段】本適用例の素子基板１０１の製造方法は、素子基板１０１上に設けられた半導体装置としてのＴＦＴ１１０を覆うと共に第１開口部としての孔１０４ａが設けられた第２絶縁膜としての層間絶縁膜１０４をマスクとして、素子基板１０１の面法線１０１ａと交差する一の方向からドライエッチングを第１絶縁膜としてのゲート絶縁膜１０３に施して、孔１０４ａに連通すると共にＴＦＴ１１０のドレイン電極１１０ｄに開口する第２開口部としての孔１０３ａを形成する。 （もっと読む）

【課題】チップ面積が小さく、製造コストが低い集積回路装置及びその製造方法を提供する。
【解決手段】集積回路装置の製造方法において、複数の第１絶縁層及び複数の第２絶縁層を１層ずつ交互に積層させて積層体を形成すると共に、少なくとも２層の前記第２絶縁層内に少なくとも２本の配線を形成する工程と、前記積層体における前記積層体の積層方向から見て前記配線から離隔した位置に、前記積層方向に延びるコンタクトホールを形成する工程と、前記第２絶縁層における前記コンタクトホールと前記配線との間の部分を除去する工程と、前記第２絶縁層が除去された部分及び前記コンタクトホールの内部に導電材料を埋め込む工程と、を実施する。 （もっと読む）

【課題】４５０〜６００℃程度の高温下に曝されてもヒロックが発生せず高温耐熱性に優れており、膜自体の電気抵抗（配線抵抗）も低く、アルカリ環境下の耐食性にも優れた表示装置用Ａｌ合金膜を提供する。
【解決手段】Ｔａ、Ｎｂ、Ｒｅ、Ｚｒ、Ｗ、Ｍｏ、Ｖ、Ｈｆ、Ｔｉ、ＣｒおよびＰｔよりなる群（Ｘ群）から選択される少なくとも一種の元素と、希土類元素の少なくとも一種とを含み、４５０〜６００℃の加熱処理を行なったとき、下記（１）の要件を満足する表示装置用Ａｌ合金膜である。
（１）Ａｌと、Ｘ群から選択される少なくとも一種の元素と、希土類元素の少なくとも一種とを含む第１の析出物について、円相当直径２０ｎｍ以上の析出物が５００，０００個／ｍｍ²以上の密度で存在する。 （もっと読む）

【課題】小型化が可能な半導体装置を提供する。
【解決手段】半導体装置において、第１の導電性材料からなる第１のコンタクトと、第２の導電性材料からなり、下端部が第１のコンタクトの上端部に接続された第２のコンタクトと、第３の導電性材料からなり、下面が第１のコンタクトの下面よりも上方に位置し、上面が第２のコンタクトの上面よりも下方に位置し、第１及び第２のコンタクトから離隔した中間配線と、を設ける。そして、第２の導電性材料に対する第１の導電性材料の拡散係数は、第２の導電性材料に対する第３の導電性材料の拡散係数よりも小さい。 （もっと読む）

【課題】配線とコンタクトプラグの短絡を効果的に防止する。
【解決手段】半導体装置の製造方法は、隣り合う配線の間に位置する層間絶縁膜内に、配線が露出した第１のコンタクトホールを含む複数のコンタクトホールを形成する。次に、（ｉ）配線の露出した側面が、第１のコンタクトホールの第１の絶縁膜から構成される内壁側面と実質的に同一面となるか、又は（ｉｉ）第１のコンタクトホールの内壁側面において配線の露出した側面が窪んだ凹形状が形成されるように、露出した前記配線の一部を除去する。この後、コンタクトホールの内壁側面上にサイドウォール膜を形成後、コンタクトホール内に導電材料を充填することによりコンタクトプラグを形成する。 （もっと読む）

集積回路デバイス（１００）が、基板パッド（１０２）を含む上面を有する基板（１１０）、及び能動回路を含む上部半導体表面（１０７）と（底面）１０６とを含む半導体基板（１０５）を含む複数の基板貫通ビア（１１５）ダイを含む。上部半導体表面（１０７）は、基板の上面上の基板パッドに結合されるボンドコネクタ１０９を含む。複数の基板貫通ビア（ＴＳＶ）が、底面から外に延びる突出するＴＳＶティップ（１２１）に上側半導体表面から延びる内部金属コア（１２５）を含む。複数のＴＳＶの少なくとも１つが、そこへの如何なる電気的接続もない、突出するＴＳＶティップを有し、ＴＳＶダイの底面からの熱消散を可能にするための付加的な表面領域を提供するダミーＴＳＶ（１２０）である。

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【課題】上層の電極のコンタクトホール内でのカバレージを向上させること。
【解決手段】本発明の実施形態に係る半導体装置の製造方法において、第１エッチング工程で形成されるコンタクトホール３００ａの上部領域３００Ｕａの中心部分からずれた位置に、第２エッチング工程で形成されるコンタクトホールの下部領域３００Ｄａが形成される。これにより、上部領域３００Ｕａの下底部分に水平領域が存在し、その近くにおいては、第２電極３０のオーバハング３０ｈが生じにくくなり、カバレージが向上する。 （もっと読む）

【課題】本発明は、半導体基板とコンタクト部材との接触抵抗をより低減可能な半導体装置を提供する。
【解決手段】
第１の方向に延在し第１の方向と直交する第２の方向に所定の間隔で設けられた活性領域ＡＡと、前記活性領域ＡＡを分離する素子分離絶縁膜１１とが設けられた半導体基板２１ａと、前記半導体基板２１ａの主表面上に形成された第２の層間絶縁膜２４と、前記第２の層間絶縁膜２４内に設けられ、前記半導体基板２１ａ上方の配線と電気的に接続された第１の部分及び、前記第１の部分と接続され、上面視すると前記第１の部分から、はみ出した形状である第２の部分を有するコンタクト部材２２とを備え、前記第１の方向における前記第２の部分最大幅は、前記第１の方向における前記第１の部分の幅よりも広く、前記第２の部分は、前記第１の部分を包囲する前記第２の層間絶縁膜２４に接触していることを特徴とする半導体装置。 （もっと読む）

【課題】 貫通電極と配線層との間における電気抵抗の増加を抑制できる配線基板及び半導体装置を提供する。
【解決手段】 半導体基板と、半導体基板の少なくとも上面に形成され、導体層及び第１絶縁層を有する配線層と、半導体基板及び配線層の第１絶縁層を貫通する貫通電極と、半導体基板と貫通電極との間に形成された第２絶縁層と、を備える配線基板であって、貫通電極は、配線層の第１絶縁層を貫通する第１導電部と、半導体基板を貫通し、第１導電部と電気的に接続し、第１導電部の断面積よりも大きい断面積を有し、且つ導体層と電気的に接続する段差面を含む第２導電部と、を有する。 （もっと読む）

【課題】ゲート電極と拡散層に接続する共通コンタクトにおけるリークを防ぐ。
【解決手段】半導体装置は、拡散層が形成された基板と、基板上に形成されたゲート電極と、基板上にゲート電極よりも高い位置まで形成された第１絶縁層と、拡散層に電気的に接続され、第１絶縁層を貫通する第１コンタクトと、ゲート電極と電気的に接続された第２コンタクトと、第１絶縁層の上に形成された第２絶縁層とを備える。第１コンタクトと第２コンタクトとは第１絶縁層の上面以上の高さにおいて電気的に接続する。ゲート電極上と拡散層上は異なるコンタクトで形成されているため、ゲート電極のサイドウォールが減少することなく、リークを防ぐことができる。 （もっと読む）

【課題】放熱性に優れ、製造歩留まりの向上を図ることができる半導体装置及びその製造方法を提供することを目的とする。
【解決手段】
半導体装置は、基板１の上方に設けられた化合物半導体層２，３，４と、化合物半導体層２，３，４の上方に設けられた複数のソース電極７及び複数のドレイン電極９と、化合物半導体層２，３，４を貫通し、複数のソース電極７のそれぞれに接続される複数のビア配線２２と、化合物半導体層２，３，４を貫通し、複数のドレイン電極９のそれぞれに接続される複数のビア配線２３と、複数のビア配線２２に接続され、基板１に埋め込まれたソース共通配線１８と、複数のビア配線２３に接続され、基板１に埋め込まれたドレイン共通配線２０とを有する。 （もっと読む）

【課題】配線及び半導体素子等を自由に配置できない領域を減少させる。
【解決手段】半導体装置は、半導体素子３が形成されている第１面及び第１面とは反対側の第２面を有する半導体基板１と、半導体基板１の上に形成され、且つ、第１のビア７を有する層間絶縁膜と、半導体基板１内に形成され、且つ、第１のビア７と接続する第２のビア１３とを有し、第１のビア７の径は、第２のビア１３の径よりも小さいことを特徴とする。 （もっと読む）

【課題】他の物体によって損傷、剥離、または亀裂を生じることなく、より粗野な処理、運送、および使用を可能にするよりよい緩衝を、半導体デバイスの金属化層に配置された低k誘電体層、ELK誘電体層、および／またはULK誘電体層の半導体ダイのコンタクトを形成するシステム、方法を提供する。
【解決手段】複数の誘電体層および導電層を含む基板１０１、複数の導電層の最上層１１５の１つと電気的に接続し、約１５，０００Åより大きい厚さを有する金属コンタクト１０５、および金属コンタクトと電気的に接続したコネクタを含む半導体デバイス。 （もっと読む）

【課題】貫通電極の基板からの抜け落ちを防止する。
【解決手段】半導体装置は、基板８０と、基板８０に設けられた１又は複数のビアホール９１と、１又は複数のビアホール９１内にそれぞれ設けられた貫通電極ＴＳＶとをそれぞれ有する複数のコアチップと、貫通電極ＴＳＶを通じて各コアチップと電気的に接続するインターフェースチップとを備え、ビアホール９１は、両端部の径ｒ１，ｒ３に比べて中央部ｒ２の径が大きいボーイング形状部分９１ａを有する。 （もっと読む）

【課題】基板の内部であって、活性領域と素子分離領域との境界領域にコンタクトホールが形成された場合に、基板に流れるリーク電流を抑制できるようにする。
【解決手段】半導体基板１０の上部に形成された素子分離領域１０ａ及び活性領域１０ｂと、半導体基板１０の上に形成された絶縁膜１２と、絶縁膜１２に少なくとも活性領域１０ｂを露出するように形成され、且つ、素子分離領域１０ａにおける活性領域１０ｂとの境界領域を含む領域に形成されたコンタクトホール１３と、コンタクトホール１３における、活性領域１０ｂの上に位置する第１の底面の上に形成された第１のバリアメタル膜１４と、コンタクトホール１３における、最下端に位置する第２の底面と第１の底面とをつなぐ壁面上に形成された第２のバリアメタル膜１７とを備える。第２のバリアメタル膜１７は、第１のバリアメタル膜１４よりも比抵抗が高いことを特徴とする。 （もっと読む）