【課題】回路面積を大きくすることなく、遅延ロックループ回路を提供すること
【解決手段】逓倍ＰＬＬ１０７は、基準クロックを逓倍して出力する。ＤＬＬ２１１は、逓倍ＰＬＬ１０７から出力されたクロックと、逓倍ＰＬＬ１０７から出力されたクロックを遅延させたクロックと、を比較し、比較結果に基づいて所定の遅延量を持つ遅延信号を生成する。遅延制御信号演算回路１０８は、ＤＬＬ２１１が生成した遅延信号に基づき、所望の遅延制御信号を生成する。第１の遅延回路１０２は、遅延制御信号演算回路１０８が生成した遅延制御信号に基づいて、入力信号を遅延させる。 （もっと読む）

【課題】プロセスモニタに必要な回路面積を増加させることなく、高精度なプロセスキャリブレーションを短時間で行う。
【解決手段】ディジタル制御発振器３８が任意の発振バンドを選択した後、制御部２５はＴＤＣ４１の信号がプロセスモニタ制御部４０に入力されるようにスイッチ４４を切り換える。ＴＤＣ４１は、信号ＶＲＥＦの立ち上がりエッジと最も近い信号ＶＰＲＥの立ち上がりエッジの期間をディジタル値に、信号ＶＲＥＦの立ち上がりエッジと２番目に近い信号ＶＰＲＥの立ち上がりエッジの期間をディジタル値に変換し、その差を算出する。プロセスモニタ制御部４０は、ルックアップテーブルを参照し、算出した値と予め設定されている期待値とを比較し、プロセス値を決定する。そのプロセス値は、プロセス信号として調整制御部２６にそれぞれ出力され、プロセスキャリブレーションが行われる。 （もっと読む）

【課題】受信信号と局部発振信号とに位相差があっても復調できるようにする。
【解決手段】復調器１は、変調器２で送信された受信信号Ｄ３をアンテナ１１で受信し、この受信した受信信号Ｄ３をＶＣＯ１３に注入して、自走発振周波数を有する局部発振信号Ｄ６を発振する。この発振した局部発振信号Ｄ６を９０度移相器で９０度移相する（局部発振信号Ｄ７になる）。アンテナ１１で受信した受信信号Ｄ３の位相と９０度移相器で９０度移相した局部発振信号Ｄ７の位相とを位相比較器１５で比較して、局部発振信号Ｄ６の位相を調整するための位相調整信号Ｖｃｔを生成する。この生成した位相調整信号Ｖｃｔに基づいて、受信信号Ｄ３と局部発振信号Ｄ６とをＶＣＯ１３で同期させ、該同期させたものである局部発振信号Ｄ８をミキサ１７に入力する。注入同期後の局部発振信号Ｄ８と受信信号Ｄ３とをミキサ１７で演算して当該受信信号Ｄ３を復調する。 （もっと読む）

【課題】低消費電力化と小型化とが両立されたＰＬＬ回路を提供する。
【解決手段】ＰＬＬ回路の位相比較器２は、カウンタ１６と時間デジタル変換器１３とを含む。カウンタ１６は、参照クロック信号ＲＥＦと、デジタル制御発振器の出力を分周した低周波クロック信号ＣＬＫＡおよび高周波クロック信号ＣＬＫＢとを受ける。カウンタ１６は、高周波クロック信号ＣＬＫＢのクロック数をカウントすることによって参照クロック信号ＲＥＦと低周波クロック信号ＣＬＫＡとの位相差を検出する。時間デジタル変換器１３は、参照クロック信号ＲＥＦと低周波クロック信号ＣＬＫＡとを受ける。時間デジタル変換器１３は、カウンタ１６の出力が所定範囲になってから、参照クロック信号ＲＥＦと低周波クロック信号ＣＬＫＡとの位相差を、高周波クロック信号ＣＬＫＢの周期よりも短い時間の精度で検出する。 （もっと読む）

【課題】ループフィルタの回路面積を削減すると共に、電圧制御発振器の動作の安定化やノイズ感度の低減が可能なＰＬＬ回路を提供することである。
【解決手段】本発明のＰＬＬ回路は、位相比較器３の出力信号に応じて出力電圧を制御する第１及び第２のチャージポンプ回路４、５と、第１のチャージポンプ回路４の出力に基づく信号から所定の周波数成分が除去された第１の電圧信号を出力する第１のフィルタ６と、第２のチャージポンプ回路５からの電流を入力し、所定の一定電圧を第２の電圧信号として出力する第２のフィルタ７と、第１のフィルタ６からの第１の電圧信号と基準電圧との比較結果に基づき第３の電圧信号を出力する電圧制御部３０と、第１及び第２の電圧信号を低ゲイン入力、第３の電圧信号を高ゲイン入力とし、当該第１乃至第３の電圧信号に基づき発振周波数を生成する電圧制御発振器１０を備える。 （もっと読む）

【課題】時間遅延量の最適値制御が行える時間デジタル変換器を提供すること。
【解決手段】入力されるクロック信号を多段に遅延する複数の遅延段を有し、該複数の遅延段の少なくとも１つが可変遅延段である遅延回路と、前記遅延回路の遅延段と同数個設けられ、参照信号の入力に応答して並列に対応する遅延段の出力を取り込む複数のフリップフロップと、前記複数のフリップフロップの各出力の立ち上がりと立ち下がりの一方または両方を検出するエッジ検出回路と、前記エッジ検出回路が検出したエッジ数をカウントするカウンタ回路と、前記カウンタ回路がカウントしたエッジ数に応じて前記可変遅延段の遅延量を制御する制御回路とを備える。 （もっと読む）

【課題】ＰＬＬ回路を用いずにクロックを同期させることを課題とする。
【解決手段】デシリアライザ部１は、ＰＬＬ回路の代わりに、発振器２とクロック同期部１０とを備える。クロック同期部１０は、入力されたシリアルデータを段階的に遅延させることで異なる位相のデータを複数生成する。次に、クロック同期部１０は、複数のシリアルデータそれぞれの位相と、発振器２によって発振されたクロックの位相とを比較する。そして、クロック同期部１０は、比較結果に基づいて、発振器２によって発振されたクロックとの同期に適したシリアルデータを選択する。 （もっと読む）

【課題】ダブルオーブン型ＯＣＸＯを用いる場合と同等の周波数安定度を維持しつつ、ダブルオーブン型ＯＣＸＯを用いる場合よりもサイズ及びコストを低減可能な電子機器を提供する。
【解決手段】基地局本体部１００は、電子部品（パワーアンプユニット１０１、デジタルユニット１０２、又は電源ユニット１０３）と、シングルオーブン型ＯＣＸＯ１１と、シングルオーブン型ＯＣＸＯ１１と電子部品とを収納する筐体１１０とを備える。筐体１１０には、電子部品が発する熱が伝達される。シングルオーブン型ＯＣＸＯ１１は、筐体１１０に接触した状態で配設される。 （もっと読む）

【課題】通信装置、位相同期ループ、移動体および通信方法を提供すること。
【解決手段】受信信号の同期保持を行うための位相同期ループ２５４を備え、前記位相同期ループは、ｎ次の位相同期ループ用の回路構成ｎを包含する、ｍ次の位相同期ループ用の回路構成ｍ（ｍ＞ｎ）、を有するループフィルタ１０９と、前記ループフィルタにおいて有効化される回路構成を、前記回路構成ｎと前記回路構成ｍとで切替える切替部と、を含む、通信装置。 （もっと読む）

【課題】簡素な回路構成で低消費電力の量子周波数標準器。
【解決手段】化学結合している原子核間のスピン−スピン相互作用によって複数に分裂したエネルギー準位を有する物質１１０を含む容器１２０と、容器１２０に磁場を与える磁場発生源ＭＧと、容器１２０に電磁波を照射する発振器１５０と、を含む核磁気共鳴部１００と、核磁気共鳴部１００から出力される共鳴信号ＲＳからエネルギー準位の核磁気共鳴周波数ｆ１を検出し第１検出信号ＳＤ１として出力する第１検出部２００と、共鳴信号ＲＳから隣り合うエネルギー準位間のエネルギー差であるスピン結合定数Ｊを検出し第２検出信号ＳＤ２として出力する第２検出部３００と、第１検出信号ＳＤ１と第２検出信号ＳＤ２に基づき核磁気共鳴部１００を駆動する駆動信号ＤＳを生成する駆動信号生成部４００と、を含み、第２検出部３００は、第２検出信号ＳＤ２に基づき標準周波数信号ＳＯを出力する。 （もっと読む）

【課題】レイアウトの大きさを増大させず、速やかに位相を固定させることができる遅延固定ループ及び遅延固定ループにおけるクロック遅延固定方法を提供すること。
【解決手段】遅延ライン部は、第１の遅延時間ｄ１を各々有する複数の第１の単位遅延セルを有し、クロック信号ｃｌｋを遅延する第１遅延ラインと、第２の遅延時間ｄ２を各々有する複数の第２の単位遅延セルを有し、第１遅延ラインにおいて遅延固定動作が達成されない場合に、クロック信号ｃｌｋを遅延する第２遅延ラインと、第３の遅延時間ｄ３を各々有する複数の第３の単位遅延セルを有し、第２遅延ラインにおいて遅延固定動作が達成されない場合に、クロック信号ｃｌｋを遅延する第３遅延ラインとを備え、第１の遅延時間ｄ１が第２の遅延時間ｄ２より短く、第２の遅延時間ｄ２が第３の遅延時間ｄ３より短い。 （もっと読む）

【課題】ドップラー拡がりによる光共鳴波長分布を持つ原子集団に対しＥＩＴ現象を効率
よく発生させる原子発振器を提供する。
【解決手段】各共鳴光を出射するＬＤ２と、ＬＤ２の中心波長を発生する中心波長発生手
段１と、二つの異なる基底状態のエネルギー差（ΔＥ１２）に相当する周波数の１／２の
周波数を発振する発振器９と、ドップラー拡がりに対して十分小さい周波数を発振する発
振器１０と、電気信号によりＬＤ２から出射された共鳴光１１に周波数変調を与えるＥＯ
Ｍ（電気光学変調素子）３、４と、ＥＯＭ４により変調された光１２の波長により光の吸
収量を変化させる、気体状アルカリ金属（セシウム）原子を封入したガスセル５と、ガス
セル５から透過する光１３を検出する光検出器（光検出手段）６と、光検出器６の出力に
基づきガスセル５のＥＩＴ状態を検出して出力電圧を制御する周波数制御手段７と、を備
えて構成されている。 （もっと読む）

【課題】周波数基準を実現させると共に、光源駆動制御回路系を簡略化して装置を小型化
し、且つ安価な光源を利用することでコストを低減することができる原子発振器を提供す
る。
【解決手段】この原子発振器５０は、アルカリ金属の一種であるＣｓ原子の異なる遷移エ
ネルギーに対応する二種類の周波数の励起光対を発生させる光源１と、少なくとも気体状
のＣｓ原子を封入したＣｓセル２と、光検出器３と、光検出器３により検出した光強度の
変化に応じてその出力値（電圧等）を制御する周波数制御手段４と、周波数制御手段４の
出力値によりその出力周波数を制御可能な基準発振源５と、基準発振源５の出力周波数を
光源１が発生する二種類の励起光対の周波数差の周波数に逓倍する逓倍手段６と、逓倍手
段６で発生した周波数差の二種類の励起光対を光源１から発生させる光源駆動電流の変調
手段７と、を備えて構成されている。 （もっと読む）

【課題】位相ロックループ（ＰＬＬ）を用いた電子部品に電力を供給するためのパルス幅変調（ＰＷＭ）コントローラを提供する。
【解決手段】ＰＷＭコントローラは、基準信号を受信する入力ノードと、位相ロックループ（ＰＬＬ３００）とを備えている。このＰＬＬ３００は、誤り訂正信号を受信し且つ前記誤り訂正信号に関係する周波数を有する発振器信号を生成する発振器３１２と、前記発振器３１２に結合され、前記基準信号３４１を受信し、且つ前記基準信号３４１と、フィードバック信号３４２との間の位相差に基づいて誤り訂正信号を生成させる位相周波数検出器（ＰＦＤ３０２）と、前記ＰＦＤ３０２に結合され、周期的にＰＦＤ３０２が誤り訂正信号を生成することができるようにする抑制回路３２１とを備えている。 （もっと読む）

【課題】動作回路の通信タイミングを考慮すると共に、分周時に出力クロック信号の位相調整が可能なクロック分周回路、及びクロック分周方法を提供することである。
【解決手段】本発明にかかるクロック分周回路１００は、入力クロック信号（クロックＳ）のクロックパルスと、通信タイミング信号２６と、位相調整信号６０に応じて生成されたリセット値８１と、に基づき、入力クロック信号に対する通信タイミングの相対的な位相を示すカウント値５５を生成し、カウント値５５に基づき入力クロック信号のＭ個のクロックパルスのうち通信タイミング以外のクロックパルスに対してクロックパルスをマスクするマスク信号２５を生成するマスク制御回路２０を有する。更に、マスク信号２５に応じて入力クロック信号のクロックパルスをマスクするマスク回路１０を有する。 （もっと読む）

【課題】外部磁場の変動によっても発振周波数の安定した小型の原子発振器および発振周
波数を安定化する方法を提供すること。
【解決手段】ガスセル２に封入されたアルカリ金属元素に、磁場発生手段４によって磁場
を印加することにより、アルカリ金属元素の基底準位がゼーマン分裂を起こす。印加され
る磁場は、逆回転の２つの円偏光に変換されたレーザー光に対し、ゼーマン分裂後の基底
準位間のエネルギー差△Ｅ１２が略一定値となるような領域の磁場である。したがって、
磁場の変動に対してエネルギー差△Ｅ１２の変動を少なくできる。磁場による変動の少な
い準位間のエネルギー差△Ｅ１２を利用して、基準周波数８を制御しているので、磁気シ
ールド等が不要で、発振周波数の安定した小型の原子発振器１０およびその周波数安定化
方法を得ることができる。 （もっと読む）

【課題】 構成を簡易にし、同期クロックのずれを小さくしたタイミングリカバリー回路を提供する。
【解決手段】 クロック入力信号に対するデータ入力信号の位相差を検出して位相差信号を出力すると共に異常時に異常信号を出力し、データ入力信号に特定期間変化がない場合に擬似信号を供給する位相比較器１００と、ＶＣＸＯ１０９の制御電圧の中間値若しくはその付近の値の電圧が定電圧として供給され、平滑化された位相差信号と定電圧とを比較し、両信号の差分によりクロック入力信号に対するデータ入力信号の位相が進んでいる場合は位相を遅らせる制御電圧を、位相が遅れている場合は位相を進める制御電圧をＶＣＸＯ１０９に出力するオペアンプ１０５と、オペアンプ１０５の位相差信号の入力端子とＶＣＸＯ１０９の入力端子との接続を、異常信号によりオンにするスイッチ１０４とを有するタイミングリカバリー回路である。 （もっと読む）

【解決手段】自己注入同期電圧制御発振器の配置（１）では、一組の結合する第１及び第２電圧制御発振器（２１，２２）がチップ（２）上に配置され、増幅器（２３）が同一の反射型チップ（２）上に配置され、オフチップ遅延線路（１０）が、前記結合された第１及び第２電圧制御発振器（２１，２２）の外部端子に接続される一端子であって前記外部端子からの信号を反射するように適合された一端子で配列され、低位相雑音及び小型化を示すＶＣＯの配置（１）を提供するために、増幅器（２３）は、前記外部端子からの注入信号を増幅するため及び増幅された注入信号を前記第１及び第２電圧制御発振器（２１，２２）の一つに供給するために配置される。 （もっと読む）

【課題】遅延装置の回路規模を抑制する。
【解決手段】ＤＬＬ回路１２０は、遅延素子１２２に入力された基準クロックが遅延素子１２２により１周期分遅延されるように遅延素子１２２を制御する第１の制御信号ＣＴＲ１を生成する。遅延素子１４０は、遅延素子１２２と同一の構成を有し、外部からのストローブ信号Ｓ１を、第２の制御信号ＣＴＲ２に応じた遅延量の分だけ遅延させる。ストローブ遅延制御回路１３０は、第１の制御信号ＣＴＲ１と、遅延素子１４０による遅延量の期待値とから、遅延素子１４０に出力する第２の制御信号ＣＴＲ２を生成する。クロック供給回路１１０は、遅延素子１４０に入力されるストローブ信号Ｓ１の周波数より高い周波数を有する基準クロックをＤＬＬ回路に供する。 （もっと読む）

【課題】ガスセルの加熱効率の低下および光源の過熱を防止し、出力周波数が安定するとともに長寿命で信頼性の高い小型の原子発振器を提供する。
【解決手段】原子発振器の物理部５０は、ガスセル１０の一方の窓部２の外側にヒータ２５、光学素子層１５、ペルチェ素子２１、傾斜部材３５がこの順に重ねられ、傾斜部材３５の傾斜の頂部から両側に形成された傾斜面にＶＣＳＥＬ３０およびフォトセンサ４０が配置されている。また、ガスセル１０の他方の窓部３の外側には光反射膜４５が形成されている。すなわち、ペルチェ素子２１の低温となる面側にＶＣＳＥＬ３０およびフォトセンサ４０が配置され、ペルチェ素子２１の高温となる面側にヒータ２５が配置されている。また、光透過性を有さない傾斜部材３５、ペルチェ素子２１、ヒータ２５の励起光の光路となる領域には貫通孔３５ａ，３５ｂ，２１ａ，２１ｂ，２５ａ，２５ｂが設けられている。 （もっと読む）