【課題】実効誘電率を低減させて、高速かつ消費電力の低い半導体装置を実現する。
【解決手段】本発明の半導体装置は、基板と、基板上に形成された層間絶縁膜５１、５２と、層間絶縁膜５１、５２に埋め込まれたＣｕ配線１と、Ｃｕ配線１上に形成された第二のバリア絶縁膜４と、を有する。第二のバリア絶縁膜４は、炭素二重結合、アモルファスカーボン構造及び窒素を含む有機シリカ膜である。 （もっと読む）

【課題】６００℃〜７００℃の高温であっても高い耐酸化性と低抵抗を両立し、かつ低コストで形成可能な配線材料を提供する。
【解決手段】基板上に形成される銅配線と、銅配線上に５０ｎｍ以上２００ｎｍ以下の膜厚で形成される５０重量％以上のアルミニウムを含有する銅合金薄膜と、を具備する配線部材を用いる。上記銅配線の膜厚は、１μｍ以上５０μｍ以下である。基板と銅配線の間には下地層が配置されている。配線部材の電気抵抗率は、４×１０^-6Ωcm以下である。 （もっと読む）

【課題】ビシクロ［２．２．１］ヘプタ−２，５−ジエンを安定化する方法を提供する。
【解決手段】安定化剤として、キノン類、およびニトロオキサイド類を添加した安定化されたビシクロ［２．２．１］ヘプタ−２，５−ジエン組成物、およびこれの使用。 （もっと読む）

【課題】ライナ／銅界面のボイド生成部位の排除により、高い信頼性および生産歩留まりが得られる半導体デバイス製造方法を提供する。
【解決手段】半導体デバイス製造に用いる拡散バリアを形成する方法は、物理蒸着（ＰＶＤ）工程によって、パターン形成された中間誘電体（ＩＬＤ）層の上に、イリジウム・ドープされたタンタル・ベースのバリア層を堆積するステップを含み、該バリア層は、原子量で少なくとも６０％のイリジウム濃度で、バリア層が結果としてアモルファス構造を有するように堆積される。 （もっと読む）

【課題】製造プロセスを増加させずに、信頼性が高く、かつ反射特性に優れる電子デバイスを提供する。
【解決手段】本発明に係る電子デバイス２００は、基板１と、基板１上に形成され、少なくともＭｏ系膜４１と、その上層に形成されたＡｌ系膜４２とからなる導電性反射膜４０とを備える。そして、導電性反射膜４０のＭｏ系膜４１の表面荒さＲａが５ｎｍ以下であり、Ａｌ系膜４２の波長３５０ｎｍ〜５５０ｎｍにおける反射率が８５％以上である。 （もっと読む）

【課題】貫通シリコンビア形成時におけるビア内側壁の銅シード層のカバレッジが良好で均一な銅配線層を有するめっき物を提供することを目的とする。
【解決手段】基材上にバリア層として形成された、タングステン及びタングステンと合金化した際に銅に対するバリア性を有する金属（Ａ）との合金薄膜、その上に無電解置換銅めっきにより銅シード層、さらに前記無電解置換銅めっきを実施したのと同一のめっき液を用いた電気銅めっきにより銅配線層がこの順番で形成されてなる、貫通シリコンビアを有するめっき物。 （もっと読む）

【課題】高解像度であり、焦点深度（ＤＯＦ）が広く、得られるパターン形状が良好であり、且つ低比誘電率な硬化パターンを形成することができるネガ型感放射線性組成物、並びに、それを用いてなる硬化パターン及びその形成方法を提供する。
【解決手段】ポリシロキサン（Ａ）と、感放射線性酸発生剤（Ｂ）と、下記一般式（１）で表される構造単位（ｃ１）を含む重合体（Ｃ）と、溶剤（Ｄ）と、を含有するネガ型感放射線性組成物。
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【課題】半導体装置の外部からの水分がパッド上の開口部に浸入した場合でも、開口部の側面に露出している窒化チタン膜が酸化チタン膜に変化することを抑制することができ、半導体装置の信頼性を向上できる技術を提供する。また、パッドの表面保護膜にクラックが発生することを抑制し、半導体装置の信頼性を向上できる技術を提供する。
【解決手段】開口部ＯＰ２の径を開口部ＯＰ１の径よりも小さくし、かつ、開口部ＯＰ２を開口部ＯＰ１に内包されるように形成する。これにより、開口部ＯＰ１の側面に露出する反射防止膜ＡＲの側面を、開口部ＯＰ２を形成している表面保護膜ＰＡＳ２で覆うことができる。この結果、反射防止膜ＡＲの側面を露出することなく、パッドＰＤを形成することができる。 （もっと読む）

【課題】パワーＭＯＳＦＥＴにおいては、アルミニウム系ソース電極下のアルミニウム拡散バリア・メタル膜として、チタンおよび窒化チタンからなるチタン系バリア・メタル膜が広く使用されている。しかし、本願発明者らが検討したところによると、チタン系バリア・メタル膜を使用すると、ウエハの反りが増大して、ウエハ・ハンドリングが困難となり、ウエハ割れやウエハ欠け等の問題が不可避となることが明らかとなった。この傾向は、最小寸法が０．３５マクロ・メートル以下の製品において特に顕著である。
【解決手段】本願発明は、アルミニウム系メタル層と下層のシリコン系半導体層の間のバリア・メタル層として、タングステン系バリア・メタル膜（ＴｉＷ等のタングステンを主要な成分とする合金膜）をスパッタリング成膜によって形成する際、スパッタリング成膜チャンバの気圧を１．２パスカル以下とするものである。 （もっと読む）

【課題】現行のバリア誘電体膜に匹敵するかそれよりも低い誘電率を有する誘電体膜を得る方法を提供する。
【解決手段】集積回路基板の誘電体膜と金属相互接続との間に、炭窒化ケイ素バリア誘電体膜を形成する方法であって、誘電体膜を有する集積回路基板を提供すること、この基板をＲ_ｘＲ’_ｙ（ＮＲ”Ｒ”’）_ｚＳｉを含むバリア誘電体膜の前駆物質と接触させること（Ｒ、Ｒ’、Ｒ”及びＲ”’はそれぞれ個々に、水素、直鎖若しくは分岐の飽和若しくは不飽和アルキル、又は芳香族から選択され；ｘ＋ｙ＋ｚ＝４；ｚ＝１〜３であるが、Ｒ及びＲ’の両方が同時に水素にはならない）；及び集積回路基板上でＣ／Ｓｉ比０．８超かつＮ／Ｓｉ比０．２超の炭窒化ケイ素バリア誘電体膜を形成することを含む方法。 （もっと読む）

【課題】低抵抗の電極や配線を有する半導体装置を実現する。
【解決手段】本実施形態による配線は、ｐ型不純物が導入されたｐ型不純物層部分と、ｎ型不純物が導入されたｎ型不純物層部分と、ｐ型及びｎ型不純物が導入された（ｐ＋ｎ）型不純物層部分と、を含む半導体層と、少なくとも（ｐ＋ｎ）型不純物層部分上に形成されたシリサイド層と、を備え、（ｐ＋ｎ）型不純物層部分に含まれるｐ型不純物とｎ型不純物の総濃度は、５Ｅ２０ｃｍ^−３未満である。 （もっと読む）

【課題】多孔質シリカ膜で構成される低誘電率絶縁膜の疎水性を改善すると共に、空孔径を所定の範囲に制御することによって、比誘電率の低減、リーク電流の低減、および機械的強度の向上を図る。
【解決手段】基板上に多孔質シリカ膜形成用原料を塗布する工程と、多孔質シリカ膜形成用原料が塗布された基板を水を添加しない有機アミン蒸気雰囲気中に暴露する気相処理工程と、を含む多孔質シリカ膜からなる低誘電率絶縁膜の作製方法。 （もっと読む）

【課題】 特定の金属を含有する透明導電材料を画素電極、透明電極に使用することにより、バリヤーメタル等を堆積するための工程が不要な簡略化されたＴＦＴ（薄膜トランジスタ）基板の製造方法を提供することである。
【解決手段】 酸化インジウムを主成分とし、Ｗ、Ｍｏ、Ｎｂ、Ｎｉ、Ｐｔ、Ｐｄからなる第１金属群Ｍ１から選ばれた１種又は２種以上の金属又はその金属の酸化物と、ランタノイド系金属からなる第２金属群Ｍ２から選ばれた１種又は２種以上の金属の酸化物と、を含むスパッタリングターゲットを利用して、透明導電膜を作製する。この透明導電膜を画素電極として利用することによって、ソース電極７等との接触抵抗を小さく抑えることができる。更に、バリヤーメタル等を用いる必要がなくなったため、バリヤーメタル等を堆積する工程をなくすことができ、ＴＦＴ基板の製造工程が簡略化される。 （もっと読む）

【課題】低温での熱処理を適用した場合でも十分に低い電気抵抗を示すと共に、直接接続された透明画素電極とのコンタクト抵抗が十分に低減され、かつ現像液耐性に優れた表示装置用Ａｌ合金膜を提供する。
【解決手段】表示装置の基板上で透明導電膜と直接接続されるＡｌ合金膜であって、上記Ａｌ合金膜は、グループＡに属するＮｉおよび／またはＣｏの元素を２．０原子％以下（０原子％を含まない）、並びにグループＢに属する少なくとも一種の元素を０．０５〜２．５原子％含み、上記グループＢの元素はＧｄ、Ｎｄ、Ｌａ、Ｙ、Ｓｃ、Ｐｒ、Ｄｙ、Ｃｅ、Ｈｏ、Ｅｒ、Ｔｂ、Ｐｍ、Ｔｍ、Ｙｂ、Ｌｕ、Ｈｆ、Ｚｒ、Ｚｎ、Ｍｇ、Ｔｉ、Ｍｎ、およびＧｅから構成されている。 （もっと読む）

【課題】スパッタリングターゲット及びこれを利用して製造される半導体素子を提供する。
【解決手段】重量％で０．０１％以上から１％未満のＮｉ、及び残部としてＷ及びその他の不回避な不純物で構成されるスパッタリングターゲットであり、また、バリア層と、バリア層上のシード層と、シード層上の導電層と、を備え、導電層は、重量％で０．０１％以上から１％未満のＮｉ、及び残部としてＷ及びその他の不回避な不純物で構成される、タングステンとニッケルとの合金薄膜を備える半導体素子である。 （もっと読む）

【課題】アルミニウム合金膜と透明電極が直接コンタクトすることを可能とし、バリアメタルの省略を可能にするアルミニウム合金膜を用いた表示デバイスとその製造技術を提供する。
【解決手段】基板上に配置された薄膜トランジスタと、透明電極によって形成された透明導電膜、および、これら薄膜トランジスタと透明導電膜を電気的に接続するアルミニウム合金膜を有し、該アルミニウム合金膜と前記透明導電膜の界面には該アルミニウム合金の酸化皮膜が形成されており、該酸化皮膜の膜厚が１〜１０ｎｍで、該酸化皮膜中の酸素含有量が４４原子％以下である表示デバイスとその製法を開示する。 （もっと読む）

【課題】Ｃｕ系材料の特徴である低電気抵抗を維持しつつ、ガラス基板との密着性に優れると共に、エッチング時にアンダーカットを生じることなく良好にテーパ状にエッチングできるＣｕ合金膜を提供する。
【解決手段】ガラス基板と直接接触する表示装置用Ｃｕ合金膜であって、該Ｃｕ合金膜は、該基板と直接接触する第一層と該第一層上に形成される第二層とを含み、前記第一層が、窒素を０．４原子％以上５．０原子％未満含むと共に、Ｎｉ、Ａｌ、Ｚｎ、ＭｎおよびＦｅよりなる群から選択される１種以上の元素（Ｘ元素）を０．１原子％以上０．５原子％以下、および／または、Ｇｅ、Ｈｆ、Ｎｂ、ＭｏおよびＷよりなる群から選択される１種以上の元素（Ｚ元素）を０．１原子％以上０．３原子％以下含むものであり、かつ前記第一層の膜厚が２ｎｍ以上１００ｎｍ以下であることを特徴とする表示装置用Ｃｕ合金膜。 （もっと読む）

【課題】 平面表示装置等の配線膜のプロセス温度域での低抵抗化が可能であるとともに、ガラス基板やＳｉ層、ＳｉＮ_Ｘ保護膜層との密着性に優れる酸素含有Ｃｕ合金膜の製造方法を提供する。
【解決手段】 添加元素としてＢを０．１〜１．０原子％、さらにＢと化合物を発現する元素の少なくとも１種類以上を０．１〜２．０原子％含み、残部Ｃｕおよび不可避的不純物からなるＣｕ合金ターゲットを用いてＡｒおよび酸素ガスを導入した雰囲気中でスパッタリングし、酸素含有Ｃｕ合金膜を得ることを特徴とする酸素含有Ｃｕ合金膜の製造方法である。 （もっと読む）

【課題】製造コストが低い配線構造の製造方法、及び配線構造を提供する。
【解決手段】本発明に係る配線構造の製造方法は、基板１０を準備する基板準備工程と、基板１０上に半導体層を形成する半導体層形成工程と、半導体層上にドーパントを含むドーパント含有半導体層を形成するドーパント含有半導体層形成工程と、ドーパント含有半導体層の表面を、水分子を含ませた酸化性ガス雰囲気中で加熱することにより、ドーパント含有半導体層の表面に酸化層を形成する酸化層形成工程と、酸化層上に合金層を形成する合金層形成工程と、合金層上に配線層を形成する配線層形成工程とを備える。 （もっと読む）

【課題】低温プロセスで製造でき、リーク電流が抑制された電子素子を提供する。
【解決手段】基板１０上に、端部断面のテーパー角度が６０°以下である下部電極２２と、前記下部電極２２上に配置され、水素原子の含有率が３原子％以下であり、波長６５０ｎｍにおける屈折率ｎが１．４７５以下であるＳｉＯ_２膜２４と、前記ＳｉＯ_２膜２４上に配置され、前記下部電極２２と重なり部を有する上部電極２６と、を有する電子素子である。 （もっと読む）