【課題】高密度のカーボンナノチューブを容易に配線に用いることができる半導体装置の製造方法を提供する。
【解決手段】絶縁膜７にビアホール９を形成し、ビアホール９内及び絶縁膜７上に触媒部１２を形成する。絶縁膜７上の触媒部１２を不活化し、ビアホール９内の触媒部１２を起点としてビアホール９内にカーボンナノチューブを成長させる。 （もっと読む）

【課題】パターニングされた段階化キャップ層の表面上に配される少なくとも１つのパターニングされ且つ硬化されたｌｏｗ−ｋ物質を含む配線構造を提供する。
【解決手段】少なくとも１つの硬化され且つパターニングされたｌｏｗ−ｋ物質およびパターニングされた段階化キャップ層は、その中に組み込まれる導電的充填領域を各々有する。パターニングされ且つ硬化されたｌｏｗ−ｋ物質は、１つ以上の酸感受性イメージング可能基を有する機能性ポリマー、コポリマー、あるいは少なくとも２種の任意の組み合わせのポリマー類もしくはコポリマー類またはその両方を含むブレンドの硬化生成物であり、段階化キャップ層はバリア領域として機能する下部領域および恒久的な反射防止膜の反射防止特性を有する上部領域を含む。 （もっと読む）

【課題】保護膜の亀裂や膜剥がれを防止する。
【解決手段】化合物半導体基板１上に少なくとも一層からなる下層配線２を形成し、化合物半導体基板１上に有機材料からなる層間膜３を堆積し、層間膜３上に金からなる上層配線５を形成し、層間膜３中に下層配線２と上層配線５とを接続するヴィア４を形成し、上層配線５の表面および層間膜３の表面の上にシリコン窒化膜からなる密着性向上用膜６を形成し、密着性向上用膜６上にシリコン酸化膜からなる熱膨張抑制膜７を形成し、熱膨張抑制膜７上にシリコン窒化膜からなる保護膜８を形成する。 （もっと読む）

【課題】欠陥を内在する炭化珪素半導体を用いても、大面積半導体装置の高歩留りを安定して実現可能な半導体装置の製造方法を提供する。
【解決手段】炭化珪素半導体基板上に炭化珪素半導体層をエピタキシャル成長する工程と、炭化珪素半導体層表面を研磨する工程と、研磨する工程の後に、炭化珪素半導体層に不純物をイオン注入する工程と、不純物を活性化するための熱処理をする工程と、熱処理をする工程の後に、炭化珪素半導体層表面に第１の熱酸化膜を形成する工程と、第１の熱酸化膜を化学的に除去する工程と、炭化珪素半導体層上に電極層を形成する工程と、を有することを特徴とする半導体装置の製造方法。 （もっと読む）

【課題】 広範囲にわたって全導電性領域に、断切れ及び上層配線層との間のリーク電流の発生のない、均一な膜厚の銅配線層を形成することが可能な半導体装置の製造方法を提供すること。
【解決手段】 ガラス基板上に薄膜トランジスタ及び配線を有する半導体装置を製造する方法において、ガラス基板上に下地絶縁層を形成する工程と、前記下地絶縁層上に下地バリア層を形成する工程と、前記下地バリア層上にシード層を形成する工程と、前記シード層を前記配線に対応する形状にパターニングしてシード層パターンを形成する工程と、前記シード層パターンの表面に銅配線層を無電解めっき法で形成する工程と、前記銅配線層マスクとして前記下地バリア層をパターニングする工程と、前記銅配線層を被覆するように絶縁層を形成する工程とを備えたことを特徴する半導体装置の製造方法。 （もっと読む）

集積回路編集のための銅の集束イオンビームエッチング用のエッチング促進剤はイオンビームによる隣接する誘電体の損失を防ぎ、隣接面上のスパッタされ再堆積した銅を非導電性にして電気的短絡を回避する。促進剤は分子中にＮ−Ｎ結合を有し、約７０〜２２０℃の沸点を有し、ヒドラジン及び水の溶液と、ヒドラジン誘導体と、メチル、エチル、プロピル及びブチルから選択された２つの炭化水素基によって飽和したニトロソアミン誘導体と、ニトロソアミン関連化合物と、四酸化窒素とを含み、好適にはヒドラジン一水和物（ＨＭＨ）、ヒドロキシエチルヒドラジン（ＨＥＨ）、ＣＥＨ、ＢｏｃＭＨ、ＢｏｃＭＥＨ、ＮＤＭＡ、ＮＤＥＡ、ＮＭＥＡ、ＮＭＰＡ、ＮＥＰＡ、ＮＤＰＡ、ＮＭＢＡ、ＮＥＢＡ、ＮＰＹＲ、ＮＰＩＰ、ＮＭＯＲ及びカルムスチン単独、又は四酸化窒素との組合せである。促進剤は高アスペクト比（深さ）の孔の銅をエッチングするのに有効である。
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【課題】高い反射率および低い接触抵抗を有しており、しかも、ヒロックなどの欠陥を生じることのない耐熱性にも優れた反射電極を提供する。
【解決手段】基板１上に形成される表示デバイス用の反射電極２であって、前記反射電極は、０．０５〜２原子％のＮｉ及び／又はＣｏ、並びに０．１〜２原子％のＮｄを含有する第１のＡｌ−（Ｎｉ／Ｃｏ）−Ｎｄ合金層２ａとＡｌとＯ（酸素）を含有する第２のＡｌ酸化物層２ｂと、を有している。上記Ａｌ酸化物層は透明画素電極３と直接接続しており、前記Ａｌ酸化物層中のＯ原子数とＡｌ原子数との比である［Ｏ］／［Ａｌ］が、０．３０以下であり、前記Ａｌ酸化物層の最も薄い部分の厚みが、１０ｎｍ以下である。上記反射電極は、前記Ａｌ酸化物層と前記透明画素電極とが直接接続する領域において、前記透明画素電極と前記基板との間に形成されている。 （もっと読む）

【課題】 半導体装置及びその製造方法に関し、埋込導体構造の密着性とＣｕ拡散防止能を両立する。
【解決手段】 半導体基板上に設けた絶縁膜に設けた埋込導体用の凹部内に埋め込まれたＣｕまたはＣｕを最大成分とする合金からなるＣｕ系埋込導体層と、前記凹部に露出する前記絶縁膜との間にＣｏを最大成分とするとともに、少なくともＭｎ、Ｏ及びＣを含むＣｏＭｎ系合金層を設ける。 （もっと読む）

【課題】表示装置の高精細化に伴い、画素数が増加し、ゲート線数、及び信号線数が増加する。ゲート線数、及び信号線数が増加すると、それらを駆動するための駆動回路を有するＩＣチップをボンディング等により実装することが困難となり、製造コストが増大するという問題がある。
【解決手段】同一基板上に画素部と、画素部を駆動する駆動回路とを有し、画素部に酸化物半導体を用いた薄膜トランジスタを用い、さらに駆動回路の少なくとも一部の回路も酸化物半導体を用いた薄膜トランジスタで構成する。同一基板上に画素部に加え、駆動回路を設けることによって製造コストを低減する。 （もっと読む）

【課題】 ビア開口部の底部にガウジング構造部を含む相互接続構造体、及びその形成方法を提供する。
【解決手段】 本発明の方法は、ビア開口部の上に配置されるライン開口部内の堆積されたトレンチ拡散バリアの被覆率に影響を与えず、及び／又は、ビア開口部及びライン開口部を含む相互接続誘電体材料内にスパッタリングを行なうことによりビア開口部の底部にガウジング構造部を生成することに起因する損傷を生じさせない。こうした相互接続構造体は、最初に相互接続誘電体内にライン開口部を形成し、その後、ビア開口部、次いでガウジング構造部を形成することによって、ビア開口部の底部内にガウジング構造部を提供することにより達成される。 （もっと読む）

【課題】良質な配線構造、及びその形成方法を提供する。
【解決手段】第１の導電材及び第１の絶縁層を有する第１の配線層と、前記第１の絶縁層上の第２の配線層とを備え、前記第２の配線層は第２の絶縁層と、ヴィア及びトレンチを有する開口部とを有し、前記開口部は、第２の導電材と、前記第２の導電材と、前記第２の絶縁層との間の２層以上のバリア層とを有し、前記第２の導電材は、前記第１の導電材と電気的に接続され、前記２層以上のバリア層は、前記開口内の前記第２の絶縁層と第１のバリア層とが接触し、且つ前記第１のバリア層とＭｎＯ_ｘ含有バリア層とが接触する領域と、前記第２の絶縁層と前記ＭｎＯ_ｘ含有バリア層が接触する領域とを有する。 （もっと読む）

【課題】半導体基板の表面側で、Ａｌ電極膜表面にボイドが形成され難くすることのできる半導体装置の製造方法を提供すること。
【解決手段】半導体基板１の一方の主面側に半導体機能領域と所要のコンタクトホール８を含む層間絶縁膜７パターンを形成した後、該半導体基板１の前記一方の主面側の全面に、厚膜のアルミニウム膜またはアルミニウム合金膜を成膜して前記コンタクトホール８の底面を含む半導体基板１表面に導電接触させて所要の電極膜９を形成する際に、前記アルミニウムの成膜工程を膜厚に関して複数回に分け、複数回の前記アルミニウム成膜工程の間に、直前のアルミニウム膜表面の凹凸を等方性エッチングにより平坦化する工程を設ける半導体装置の製造方法とする。 （もっと読む）

【課題】Ｃｕ配線層上にＣｕワイヤを実装可能とする半導体装置を提供すること。
【解決手段】本発明の半導体装置は、シリコン基板１上に形成される保護層６と、前記保護層６に形成され、前記シリコン基板１に形成される半導体素子と電気的に接続するＣｕ配線層９と、前記Ｃｕ配線層９を被覆し、前記保護層６上に形成される樹脂膜１０と、前記樹脂膜１０に形成される開口領域１１を介して前記Ｃｕ配線層９と接続するパッド電極１２と、前記パッド電極１２上にワイヤボンディングされるＣｕワイヤ１３とを有することを特徴とする。 （もっと読む）

【課題】本発明は、表面エネルギーの低い薄膜に、ダメージなくパターニングを行う薄膜のパターニング方法、デバイス及びその製造方法を提供することを目的とする。
【解決手段】薄膜２０上に、蒸着膜３０を積層する工程と、
前記蒸着膜上に、フォトレジスト層４０を積層する工程と、
フォトリソグラフィにより、前記フォトレジスト層をパターニングし、パターニングされた前記フォトレジスト層を用いて前記蒸着膜をエッチングしてパターニングする工程と、
パターニングされた前記蒸着膜をパターンマスクとして、前記薄膜をエッチングしてパターニングを行う工程と、を含むことを特徴とする。 （もっと読む）

【課題】ライナ／銅界面のボイド生成部位の排除により、高い信頼性および生産歩留まりが得られる半導体デバイス製造方法を提供する。
【解決手段】半導体デバイス製造に用いる拡散バリアを形成する方法は、物理蒸着（ＰＶＤ）工程によって、パターン形成された中間誘電体（ＩＬＤ）層の上に、イリジウム・ドープされたタンタル・ベースのバリア層を堆積するステップを含み、該バリア層は、原子量で少なくとも６０％のイリジウム濃度で、バリア層が結果としてアモルファス構造を有するように堆積される。 （もっと読む）

【課題】アスペクト比の高いホール内に、被覆性の良好な、コンタクト抵抗の低いバリア層を形成する半導体装置の製造方法を提供する。
【解決手段】タンタルまたはタンタルナイトライド等のライナー材料をホール内にスパッタ堆積する。ロングスロースパッタリング、自己イオン化プラズマ（ＳＩＰ）スパッタリング、誘導結合プラズマ（ＩＣＰ）再スパッタリング及びコイルスパッタリングを１つのチャンバ内で組み合わせたリアクタ１５０を使う。ロングスローＳＩＰスパッタリングは、ホール被覆を促進する。ＩＣＰ再スパッタリングは、ホール底部のライナー膜の厚さを低減して、第１のメタル層との接触抵抗を低減する。ＩＣＰコイルスパッタリングは、ＩＣＰ再スパッタリングの間、再スパッタリングによる薄膜化は好ましくないホール開口部に隣接しているような領域上に、保護層を堆積する。 （もっと読む）

【課題】バリアメタルの被覆性を向上させる。
【解決手段】本発明の半導体装置は、キャップ絶縁膜１ｄ上に形成された絶縁膜と、絶縁膜に形成された配線溝と、配線溝の底面に形成されたビア孔と、少なくともビア孔の側壁を覆うバリアメタル膜と、を有する。ビア孔は、径が異なる複数の孔から構成されており、複数の孔は、下に向けて径が小さくなるように深さ方向に接続し、複数の孔の接続部にキャップ絶縁膜に対してほぼ平行な面を有する。 （もっと読む）

【課題】パワーＭＯＳＦＥＴにおいては、アルミニウム系ソース電極下のアルミニウム拡散バリア・メタル膜として、チタンおよび窒化チタンからなるチタン系バリア・メタル膜が広く使用されている。しかし、本願発明者らが検討したところによると、チタン系バリア・メタル膜を使用すると、ウエハの反りが増大して、ウエハ・ハンドリングが困難となり、ウエハ割れやウエハ欠け等の問題が不可避となることが明らかとなった。この傾向は、最小寸法が０．３５マクロ・メートル以下の製品において特に顕著である。
【解決手段】本願発明は、アルミニウム系メタル層と下層のシリコン系半導体層の間のバリア・メタル層として、タングステン系バリア・メタル膜（ＴｉＷ等のタングステンを主要な成分とする合金膜）をスパッタリング成膜によって形成する際、スパッタリング成膜チャンバの気圧を１．２パスカル以下とするものである。 （もっと読む）

【課題】保護素子としてＳＢＤを搭載したＭＯＳＦＥＴにおいては、ＳＢＤの特性を確保するためアルミニウム・ソース電極下のアルミニウム拡散バリア・メタル膜として、ＴｉＷ（タングステンを主要な成分とする合金）膜が使用される。しかし、本願発明者らが検討したところによると、タングステン系バリア・メタル膜はＴｉＮ等のチタン系バリア・メタル膜と比べて、バリア性が低い柱状粒塊を呈するため、比較的容易にシリコン基板中にアルミニウム・スパイクが発生することが明らかとなった。
【解決手段】本願発明は、アルミニウム系メタル層と下層のシリコン系半導体層の間のバリア・メタル層として、タングステン系バリア・メタル膜をスパッタリング成膜によって形成する際、その下層をウエハ側にバイアスを印加したイオン化スパッタにより成膜し、上層をウエハ側にバイアスを印加しないスパッタにより成膜するものである。 （もっと読む）

【課題】配線の微細構造の維持、ＴＤＤＢ寿命の確保および低抵抗を実現する。
【解決手段】半導体装置１００は、基板１０２と、基板１０２上に形成された層間絶縁膜１０４と、層間絶縁膜１０４中に形成された配線１２０と、を含み、配線１２０は、断面視において、最上面から下方にかけて幅が広くなる領域を有する。 （もっと読む）