２ポイント変調をサポートするデジタル位相同期ループ（ＤＰＬＬ）が説明される。１つの設計において、ＤＰＬＬは、位相デジタル変換器、ループ内で動作するループフィルタ、ローパス変調パスのための第１の処理ユニットおよびハイパス変調パスのための第２の処理ユニットを含む。第１の処理ユニットは、入力変調信号を受信し、位相デジタル変換器の後でループフィルタより前のループの内部の第１のポイントに対して第１の変調信号を供給する。第２の処理ユニットは、入力変調信号を受信し、ループフィルタより後のループの内部の第２のポイントに対して第２の変調信号を供給する。第１の処理ユニットは、周波数を位相に変換するために入力変調信号を累算するアキュムレータを含み得る。第２の処理ユニットは、可変利得で入力変調信号をスケールするスケーリングユニットを含み得る。 （もっと読む）

【課題】電圧制御発振器のための補償回路を提供する。
【解決手段】電圧制御発振器（ＶＣＯ）の電圧を制御するために使用され得る回路は、第１の比較器、第２の比較器、アキュムレータ、及び出力装置を備え得る。第１の比較器は、制御電圧が高電位側しきい値電圧より高い場合に第１のパルス信号を出力する。第２の比較器は、制御電圧が低電位側しきい値電圧より低い場合に第２のパルス信号を出力する。アキュムレータは、もし第１のパルス信号が受信されるならばスイッチ制御信号の値を増加させ、もし第２のパルス信号が受信されるならばスイッチ制御信号の値を減少させる。出力装置は、スイッチ制御信号の値に応じてＶＣＯの制御電圧を補償する補償電圧を生成する。 （もっと読む）

【課題】効率的に且つ比較的低消費電力で目的の信号との位相を調整するのに好適な位相調整装置及び無線受信装置を提供する。
【解決手段】位相調整装置１００を、遅延量を可変可能なインバーター回路ＩＶ１〜ＩＶＮをループ構成に接続してなる遅延段回路１０と、遅延段回路１０の遅延量を一定に保持する位相同期用回路２０と、遅延段回路１０の各接続部に入力端子が電気的に接続された接続切替回路ＳＷ１〜ＳＷＭを含む接続切替回路群３０と、切替制御回路４０と、信号出力回路５０とを含む構成とし、切替制御回路４０は、遅延段回路１０における各インバーター回路に対応する接続切替回路を１つずつ且つ周回して選択し、選択した接続切替回路ＳＷからのみ遅延信号を出力するように制御すると共に、偶数番目に選択された接続切替回路ＳＷからの遅延信号を反転して後段の回路に供給するように信号出力回路５０を制御する。 （もっと読む）

【課題】通信装置、位相同期ループ、移動体および通信方法を提供すること。
【解決手段】受信信号の同期保持を行うための位相同期ループ２５４を備え、前記位相同期ループは、ｎ次の位相同期ループ用の回路構成ｎを包含する、ｍ次の位相同期ループ用の回路構成ｍ（ｍ＞ｎ）、を有するループフィルタ１０９と、前記ループフィルタにおいて有効化される回路構成を、前記回路構成ｎと前記回路構成ｍとで切替える切替部と、を含む、通信装置。 （もっと読む）

【課題】効率的に且つ低消費電力で目的の信号との位相を調整するのに好適な位相調整装置及び無線受信装置を提供する。
【解決手段】位相調整装置１００を、制御電圧によって遅延量を可変可能なインバーター回路ＩＶ１〜ＩＶＮをループ構成に接続してなる遅延段回路１０と、遅延段回路１０の遅延量を一定に保持する位相同期用回路２０と、遅延段回路１０の各接続部に入力端子が電気的に接続された接続切替回路ＳＷ１〜ＳＷＭを含む接続切替回路群３０と、切替制御回路４０とを含む構成とし、切替制御回路４０は、遅延段回路１０における１つおきに且つ周回して順に並ぶ各インバーター回路に対応する接続切替回路を１つずつ選択し、選択した接続切替回路が、遅延信号を後段の回路に供給するように、その他の接続切替回路が遅延信号を後段の回路に供給しないようにする切替制御信号を生成し、これを各接続切替回路に供給する。 （もっと読む）

【課題】位相誤差および周波数精度等の性能に優れ、かつ低価格で、広い制御電圧入力範囲を持つ電圧制御発振器を利用したＰＬＬ回路を提供する。
【解決手段】位相比較器１１とチャージポンプ１２は、低電圧トランジスタで構成され、電源電圧ＶＬの可変電圧源１６と電源電圧ＶＤＣ（＝ＶＬ＋ＶＣＣ１）の可変電圧源１７から与えられる差の電圧ＶＣＣ１（例えば、５Ｖ）で動作する。チャージポンプ１２の出力電流をループフィルタ１４で積分して生成された制御電圧ＶＣは、０〜ＶＣＣ２（例えば、１６Ｖ）を制御電圧入力範囲とする電圧制御発振器１５に与えられる。このとき、制御電圧ＶＣの変化範囲は５Ｖ以下となるが、可変電圧源１６，１７の出力電圧ＶＬ，ＶＤＣを制御することで変化範囲を０〜１６Ｖに拡大し、電圧制御発振器１５から所望の周波数の出力信号ＯＵＴを出力させることができる。 （もっと読む）

【課題】出力電圧が変化したときでも、電流値の変化を抑制できるチャージポンプを提供する。
【解決手段】電流源１０１は、出力端子１５７に向けて電流を流し、電流源１０２は、出力端子１５７から電流を引き抜く。電流調整回路１０８は、電流源１０１及び１０２の電流を制御する。電流調整回路１０８は、電流源１０２を所定の電流が流れるように制御しつつ電流源１０１を電流源１０２を流れる電流とバランスするように制御する第１のモードと、電流源１０１を所定の電流が流れるように制御しつつ電流源１０２を電流源１０１を流れる電流とバランスするように制御する第２のモードとを切り替え可能である。判定回路１０５は、出力端子１５７の電圧に応じて、第１のモードと第２のモードとを切り替える。 （もっと読む）

【課題】LC型発振器において、高調波歪みによる位相雑音の劣化が小さく、かつ発振振幅の増大化を図り、これにより良好な低位相雑音特性を有する発振器及びそれを用いた通信システムを提供する。
【解決手段】トランジスタからなる少なくとも１つ以上の電圧-電流変換部と、１対の容量性素子と誘導性素子からなるLCタンクを２つ有している共振器とを具備して成り、前記の電圧-電流変換部の出力端子は、前記の共振器に接続され電流-電圧変換されたのちに、前記電圧-電流変換部の入力端子に接続されることにより、帰還ループが構成されて成り、前記共振器を構成している２つのLCタンクを構成する誘導性素子が相互誘導結合されており、前記相互結合係数がおおよそ-０．６であることを特徴とする。 （もっと読む）

【課題】ＬＰＦ出力の変化に対するロック周波数の変化量のゲイン設定のばらつきの抑制でジッタ精度をより向上できるＤＬＬ回路の提供。
【解決手段】遅延クロックを生成する遅延回路１０１と、遅延クロックと入力クロックの位相差信号を出力する位相比較回路１０と、位相差信号対応の位相差電圧を出力するチャージポンプ回路２０と、チャージポンプ回路出力の高周波成分を除去するローパスフィルタ回路３０と、ローパスフィルタ回路の出力電圧を電流に変換する第１電圧−電流変換回路４０及び基準電圧Ｖｒｅｆを電流に変換する第２電圧−電流変換回路５０を含み、第１電圧−電流変換回路の出力電流から第２電圧−電流変換回路の出力電流を減算した結果を変換した電圧とオフセット電流Ｉｄを変換した電圧とを含み、位相差電圧が基準電圧より小の場合、オフセット電流を変換した電圧を制御電圧Ｖｃｏｎｔとして遅延回路に出力する遅延制御回路１０２と、を備える。 （もっと読む）

【課題】原子セルに入射するレーザー光の光量依存性を抑えた高精度の原子発振器を提供すること。
【解決手段】レーザー光源１０から射出されるレーザー光の発光強度が変化しても、レーザー光源１０と原子セル２０との間に位置した透過光量可変手段４０およびそれを制御する透過光量制御回路４１によって原子セル２０に入射するレーザー光の強度を一定にできる。したがって、基準発振周波数制御手段６０によって、ＶＣＸＯ５０の基準周波数をレーザー光検出器３０で検出された射出光の強度に基づいて制御する際に、レーザー光の発光強度の変化に影響されることがなく、高精度な原子発振器１００を得ることができる。 （もっと読む）

【課題】運用系および待機系システムクロックの位相を、バックボード間の配線遅延量、温度変化および電圧変動に起因するバッファ遅延の変化量を含め一致させたシステムクロック供給装置を提供する。
【解決手段】システムクロック１に位相同期した運用系および待機系システムクロック６を出力する冗長構成とされた運用系および待機系システムクロック供給部２００と運用系および待機系システムクロックを装置内各部へ分配するためのバックボード８を有する。システムクロック１に位相同期したクロック２２を生成するＰＬＬ２１０は、運用系システムクロックを基準とし、待機系システムクロックの位相を制御する位相差調整部２１１を含んだ構成とする。 （もっと読む）

【課題】簡単な構成でＰＬＬ回路がロック時にオフリーク電流が生じるのを低減することが可能なチャージポンプ回路及びそのチャージポンプ回路を用いたＰＬＬ回路を提供することを課題とする。
【解決手段】Ｐ型トランジスタＭＰ１及びＮ型トランジスタＭＮ１と並列に常にオフにしたＰ型トランジスタＭＰ２及びＮ型トランジスタＭＮ２を設ける。Ｐ型トランジスタＭＰ１とＮ型トランジスタＭＮ２が共にＯＦＦのときオフリーク電流はＰ型トランジスタＭＰ２及びＮ型トランジスタＭＮ２を介して逃げる。また常にオフにしたＰ型トランジスタＭＰ２及びＮ型トランジスタＭＮ２の代りに動的にオン／オフを切替えるＰ型トランジスタやＮ型トランジスタを設けたり、Ｐ型トランジスタＭＰ１及びＮ型トランジスタＭＮ１のオフ抵抗と同じ抵抗値の抵抗器を設けても良い。 （もっと読む）

【課題】 位相雑音特性の良好な電圧制御発振器、並びにそれを用いた無線通信システム及び位相同期回路を提供することを目的とする。
【解決手段】
電圧制御発振器１０は、共振器Ｒｅｓと、共振器Ｒｅｓに入力側が接続された増幅器ＡＭＰ１と、増幅器ＡＭＰ１の出力側と共振器Ｒｅｓとの間に接続されたキャパシタＣ１ａと、増幅器ＡＭＰ１の入力側と出力側の間に、互いに直列になるように接続されたキャパシタＣ１ｂとインダクタＬ１を備える。さらに、共振器Ｒｅｓに入力側が接続された増幅器ＡＭＰ２と、増幅器ＡＭＰ２の出力側と共振器Ｒｅｓとの間に接続されたキャパシタＣ２ａと、増幅器ＡＭＰ２の入力側と出力側の間に、互いに直列になるように接続されたキャパシタＣ２ｂとインダクタＬ２とを備える。 （もっと読む）

【解決手段】望ましい周波数範囲にわたって、正確な非重複時間及びクロックフェーズ遅延時間を生成する技術が提供される。一構成において、装置はそれに結合されるクロック生成回路への制御電圧を順に生成する遅延ロックループ（ＤＬＬ）回路を含む非重複クロック生成回路を備えている。制御電圧はクロック生成回路によって生成される非重複遅延クロック信号の正確なタイミング関係を維持するように動作する。一態様において、ＤＬＬ回路は知られたデューティサイクルによる入力クロックを受信し、入力クロックサイクルの特定の部分へのユニット遅延をフィックスする出力制御電圧を得る。更なる態様において、クロック生成回路は製造プロセス変化とは関係ない非重複時間（ｔｎｌｐ）でクロック信号の第１のセットから遅延されたクロック信号の第２のセット及びクロック信号の第１のセットを生成するＤＬＬ回路に結合される複数の電圧制御遅延セルを備えている。 （もっと読む）

【課題】ＶＣＯのＶＴ端子側から見えるバラクタダイオード数を減少させることによりリファレンスリークを低減するＰＬＬ回路を提供する。
【解決手段】ＰＬＬ回路を構成するループフィルタから出力されるＶＣＯ制御電圧とＶＣＯを予め関連付けて設定し、ループフィルタのＶＣＯ制御電圧に基づいて対応するＶＣＯを選択し、該ＶＣＯの電圧制御発振器制御電圧端子とループフィルタの出力端子との接続を制御する切替信号を生成するＶＣＯ切替回路と、切替信号に基づいて、選択されたＶＣＯのみの電圧制御発振器制御電圧端子とループフィルタの出力端子を接続し、他のＶＣＯの電圧制御発振器制御電圧端子とループフィルタの出力端子との接続を解除するＶＴ選択回路と、を備えるＶＣＯの制御電圧端子にバラクタダイオードが接続された、発振周波数帯域の異なる複数のＶＣＯを備えるＰＬＬ回路である。 （もっと読む）

【課題】リード動作時における位相調整精度を低下させることなく、ＤＬＬ回路の消費電力を低減する。
【解決手段】ＯＤＴ機能を有するデータ入出力回路８０と、データ入出力回路８０の動作タイミングを規定する内部クロックＬＣＬＫを生成するＤＬＬ回路１００とを備える。ＤＬＬ回路１００は、内部クロックＬＣＬＫを高精度に位相制御する第１のモードと、低消費電力で動作する第２のモードとを有し、データ入出力回路８０がＯＤＴ動作を行っていない場合には第１のモードで動作し、データ入出力回路８０がＯＤＴ動作を行っている場合には第２のモードで動作する。このように、ＯＤＴ動作の有無によってＤＬＬ回路１００の動作モードを切り替えていることから、厳密な位相制御が不要なＯＤＴ動作時における消費電力を低減することが可能となる。 （もっと読む）

【課題】 温度によるクロックの変動を抑える。
【解決手段】 クロックを用いて信号を生成する信号処理部と、外部からの入力信号と前記信号処理部から出力された信号との位相差を検出し、前記位相差を示す信号を出力すると共に前記入力信号が無くなるとその直前の位相差の信号を出力する位相差検出部と、温度補償型の発振器からの出力信号に応じて前記位相差検出部からの出力に応じた値をカウントし、前記カウント値に基づいて基準信号を生成するデジタル発振器と、前記デジタル発振器からの基準信号と前記クロックを分周した信号との位相差に応じて前記クロックを生成するクロック生成部とを備える。 （もっと読む）

【課題】バースト光信号が入力された場合のロックアップ動作を高速に行うデータ再生回路を得ること。
【解決手段】本発明にかかるデータ再生回路は、ＶＣＯ４で生成したクロックと入力データとを比較し、比較結果に基づいてＶＣＯ４への入力電圧を調整するＰＬＬ回路（周波数・位相比較器１，フィルタ処理回路２，ＶＣＯ４）と、ＶＣＯ４で生成されたクロックを利用して入力データを識別再生する識別回路６と、各子局装置からの送信スケジュールに基づいて、データ入力区間を特定する受信タイミング生成回路８と、を備え、ＰＬＬ回路は、第１のデータ入力区間が終了後、その次の第２のデータ入力区間が開始するまでの区間では、第１のデータ入力区間に含まれるＥＯＢ区間でＶＣＯ４への入力としていた電圧信号を、ＶＣＯ４へ継続して入力させる。 （もっと読む）

【課題】本発明の課題は、ＰＬＬ回路のリファレンスリークと位相雑音を低減することである。
【解決手段】チャージポンプ回路１４は、ロック状態監視回路１９から出力される、ＰＬＬ回路１１がロック状態か否かを示す信号に基づいてチャージポンプ電流を切り換える。ＰＬＬ回路１１がアンロック状態のときには、第１及び第２の電流供給回路からチャージポンプ電流を供給し、ロック状態となると、第２の電流供給回路からのみチャージポンプ電流を供給する。 （もっと読む）

【課題】レイアウトの大きさを増大させず、速やかに位相を固定させることができる遅延固定ループ及び遅延固定ループにおけるクロック遅延固定方法を提供すること。
【解決手段】遅延ライン部は、第１の遅延時間ｄ１を各々有する複数の第１の単位遅延セルを有し、クロック信号ｃｌｋを遅延する第１遅延ラインと、第２の遅延時間ｄ２を各々有する複数の第２の単位遅延セルを有し、第１遅延ラインにおいて遅延固定動作が達成されない場合に、クロック信号ｃｌｋを遅延する第２遅延ラインと、第３の遅延時間ｄ３を各々有する複数の第３の単位遅延セルを有し、第２遅延ラインにおいて遅延固定動作が達成されない場合に、クロック信号ｃｌｋを遅延する第３遅延ラインとを備え、第１の遅延時間ｄ１が第２の遅延時間ｄ２より短く、第２の遅延時間ｄ２が第３の遅延時間ｄ３より短い。 （もっと読む）