【課題】分周器の発振を防止する分周回路を提供する。
【解決手段】クロック信号Ｖｃを所定の分周比にて分周する分周器２０を備え、分周器の発振を防止する分周回路１であって、クロック信号のピーク電圧Ｖｃｐを検出してピーク値を保持するピーク検出器３０と、分周器が正常動作するために必要なクロック信号の振幅ｖｐに対応した参照電圧Ｖｒｅｆを出力する参照電圧発生器４０と、ピーク検出器により検出されたピーク値と参照電圧とを比較する比較器５０と、を備え、分周器に分周開始を指示する制御信号を入力する制御端子を備え、制御端子に比較器の出力信号Ｖｅを接続し、ピーク値が参照電圧を超えたときに、比較器は、分周器の制御端子に分周開始を指示する制御信号を出力する （もっと読む）

【課題】内部回路の内部クロックと内部回路の入力信号との位相関係により内部回路の出力が変動する場合であっても、安定した回路動作とすることができる信号処理回路を得る。
【解決手段】入力信号と位相制御信号とを受け、前記入力信号及び前記位相制御信号の位相差に基づき位相比較信号を出力する位相比較手段と、前記位相比較信号を受け、前記位相比較信号に基づく周波数で発振する発振信号を出力する発振手段と、前記発振信号を受け、前記位相制御信号を出力する位相制御信号発生手段とを備え、同時に前記位相制御信号を出力信号とし、該位相制御信号を内部クロックとして供給することを特徴とする位相差制御回路である信号処理回路等を提供する。 （もっと読む）

【課題】ＴＤＣ（Ｔｉｍｅ−ｔｏ−ＤｉｇｉｔａｌＣｏｎｖｅｒｔｅｒ）の回路規模を拡張することなく、デスキュー用途に用いることが可能であるＡＤＰＬＬの構成の提供。
【解決手段】ＤＣＯ１９と、ＦＲＥＦを分周するＭＤＩＶ１１と、ＤＣＯの出力ＦＯを分周するＰＤＩＶ２０と、ＰＤＩＶの出力ＦＯＵＴを分周するＮＤＩＶ１２と、ＭＤＩＶの出力信号ＦＲとＤＣＯの出力ＦＯの位相差を測定するＴＤＣ１３と、ＮＤＩＶの出力ＦＤとＦＯの位相差を測定するＴＤＣ１４と、ＦＲでＦＯをサンプルするＦＦ１５と、ＦＲとＦＤのうち位相が先行するパルスと次のパルスのエッジの期間、ＦＯをカウントするＣＯＮＴ１７と、ＴＤＣ１３、１４、ＦＦ１５の出力を入力し、カウンタの出力を受け、ＦＲとＦＤの位相差を演算するＰＥＲＲ１６と、ＰＥＲＲの出力を入力し、フィルタ処理した信号をＤＣＯに供給するＤＦＩＬ１８を備える。 （もっと読む）

【課題】２点変調を採用するフェーズロックドループを用いた通信システムを提供する。
【解決手段】フェーズロックドループは、位相検出器１０６の第１の入力に動作可能に接続された出力を有する主発振器１００、位相検出器１０６の第２の入力に動作可能に接続された出力を有する従発振器１０２、及び位相検出器１０６の生誤り端末に動作可能に接続されたフォワード利得適応モジュールを含む。フォワード利得適応モジュールは、位相検出器１０６の生誤り端末と動作可能に接続された、フォワード利得適応モジュールの可変利得増幅器２００と、前記フォワード利得適応モジュールの可変利得増幅器２００と前記従発振器１０２とに動作可能に接続された、フォワード利得適応モジュールの積分器２０２とを具備する。 （もっと読む）

【課題】必要な特性を満たしつつ、回路構成を簡素化し、省面積化を可能とするデジタルＰＬＬの提供。
【解決手段】リファレンスクロック信号ＦＲと分周クロック信号ＦＤの位相差を検出するＴＤＣ１０１、ＦＤとＦＲの進み遅れを出力するＦＦ１０３、位相誤差演算器１０２、位相誤差（ＰＥＲＲ）を平滑化するデジタルフィルタ１０４、出力クロック信号ＦＯを出力するＤＣＯ１０５、ＦＯを分周したＦＤを出力するＮ分周器１０６、Ｎ分周器１０６内のカウンタ値をＦＲに応答してサンプルするレジスタ１０７を備え、ＴＤＣ１０１は、位相差検出測定範囲がＦＯの１周期以内とされ、ＦＲとＦＤの位相差をＦＯの１周期に換算した小数で出力し、位相誤差演算器１０２は、ＦＤとＦＲの位相差が、ＦＯの周期の整数倍以上のときは、レジスタ１０７出力と符号情報ｓｉｇｎから、ＦＯの１周期内のときは、ＴＤＣの出力と符号情報ｓｉｇｎからＰＥＲＲを演算出力する。 （もっと読む）

【課題】温度補償ループフィルタのキャパシタの容量値を小さくする。
【解決手段】ＰＬＬシンセサイザは，位相比較器ＰＤと，ループフィルタＬＦと，電圧制御発振器ＶＣＯとを有する。さらに，温度補償ループとして，周波数制御電圧が制御電圧範囲から外れたときに比較信号３０を出力する比較器ＣＭＰと，比較信号３０を積分してＭビットの第１のデジタル信号３２を生成するデジタルフィルタＤＦと，第１のデジタル信号３２を入力し，前記Ｍビットより少ないＮビットで、前記第１のデジタル信号３２に対応する第２のデジタル信号３４を生成するΣΔ変調器１２、１０と，第２のデジタル信号３４を電流信号３６に変換する温度補償チャージポンプＣＰｔと，前記電流信号３６を温度補償制御電圧に変換する温度補償ループフィルタＴＦとを有し，電圧制御発振器ＶＣＯは温度補償制御電圧ｆｔに基づいて出力クロックＣＫｏｕｔの周波数を制御する。 （もっと読む）

【課題】周波数補正ミスをなくせ、電圧対周波数変換利得Ｋvcoを低く抑えることが可能で、ＰＬＬ位相ノイズ設計を緩和できる位相同期回路および無線通信装置を提供する。
【解決手段】キャリブレーション部１９０は、電圧制御発振器１８４の出力発振信号の周波数をカウントするカウンタ回路１９１と、カウンタ回路のカウント結果を保持しておくための第１および第２の記憶回路１９３，１９４と、カウンタ回路とターゲット周波数を比較し大小を判定する比較回路１９５と、比較回路の結果を受けカウンタ回路のカウント結果と第１の記憶回路の保持結果を比較し、電圧制御発振器の容量バンクを制御する制御回路１０６と、電圧制御発振器にキャリブレーション電圧を生成し与える電圧生成回路１９７と、カウンタ回路のカウント結果と第１および第２の記憶回路の結果より演算を行い、演算結果に応じて電圧生成回路を制御する処理回路１９８と、を含む。 （もっと読む）

【課題】簡易な構成で、データおよびクロック間のタイミングスキューの制約をなくすとともに、データの周波数可変範囲を広くとることができるＣＤＲ回路を提供する。
【解決手段】ＣＤＲ回路は、基準クロック信号を用いてクロック信号を所望の周波数にロックするＬＴモードと、クロック信号をデータ信号に位相同期させる通常動作モードとを有する。ＣＤＲ回路は、ＶＣＯと、入力信号を平滑化して制御電圧を生成してＶＣＯに出力するＬＰＦと、ＬＴモード時に、基準クロック信号とクロック信号との周波数比較を行ない、該比較結果に応じた信号をＬＰＦに出力する周波数ループと、通常動作モード時に、データ信号とクロック信号との位相比較を行ない、該比較結果に応じた信号をＬＰＦに出力する位相ループと、基準クロック信号の周波数カウント値に応じてＶＣＯに設定する周波数レンジを調整する周波数検出回路とを備える。 （もっと読む）

【課題】チップサイズの大型化を防止することができる半導体集積回路。
【解決手段】同一のリセット信号が入力されることにより、互いに同期が取られる複数の送信ブロックを備える半導体集積回路。各送信ブロックは、基準クロック信号とフィードバッククロック信号との位相差に応じた制御電圧に基づいて周期Ｔの第１のクロック信号を発振する電圧制御発振器と、第１のクロック信号がＮ（Ｎは自然数）分周された第２のクロック信号が入力され、当該第２のクロック信号から、第１の送信用クロック信号と当該第１の送信用クロック信号よりも周波数の低い第２の送信用クロック信号とを生成し、リセット信号に応じて少なくとも第２の送信用クロック信号を出力するリセット機能付き分周器と、第１及び第２の送信用クロック信号が分配される複数の送信機と、を備える。 （もっと読む）

【課題】２つの結合されたＬＣＶＣＯにおいて生じる多相クロック信号の位相誤差を改善し、制御可能な位相オフセットでクロック信号を生成する方法を提供する。
【解決手段】方法は、ＬＣＶＣＯによって第１のＬＣタンクの共振周波数に基づく第１の位相を有する第１の周期信号を生成するステップと、第２のＬＣＶＣＯによって第２のＬＣタンクの共振周波数に基づく第２の位相を有する第２の周期信号を生成するステップと、第１及び第２の周期信号に基づいて第１及び第２のＬＣタンクの間の位相オフセットを決定するステップと、決定された位相オフセットに基づいて第１及び第２の出力信号を生成するステップと、所定の位相オフセットと略等しくなるよう位相オフセットを調整するステップとを有する。調整ステップは、第１の出力信号に基づいて第１のＬＣタンクの第１のインピーダンスを変調するステップ、及び／又は、第２の出力信号に基づいて第２のＬＣタンクの第２のインピーダンスを変調するステップを有する。 （もっと読む）

【課題】安価な構成とするとともに、性能を向上させることができるＰＬＬ周波数シンセサイザ、無線通信装置およびＰＬＬ周波数シンセサイザの制御方法を提供する。
【解決手段】ＰＬＬ周波数シンセサイザは、基準周波数信号と分周信号との位相を比較する位相比較部１０１からの信号と位相誤差補償信号とに応じて、電流パルス信号を生成するＣＰＤＡＣ１０２と、電流パルス信号を電圧信号に変換するループフィルタ１０３と、電圧信号に応じた発振周波数の信号を出力するＶＣＯ１０４と、ＶＣＯ１０４からの出力を分周して分周信号として出力する分周器１０５と、分数分周のための分周比のデータに基づいて、分周比制御信号を生成するデルタシグマ変調器１０７および加算器１０６と、分周比のデータから少なくとも２つの位相誤差補償用のデータを生成し、生成したデータを異なるタイミングで利用して、位相誤差補償信号を生成する制御部１０８とを備える。 （もっと読む）

【課題】発振器のウォームアップの完了を容易に判定できるようにする。
【解決手段】クロック供給装置１は、通信装置内の処理に用いられるクロック信号を供給する。発振器１ａは、クロック信号を生成する。測定部１ｂは、通信装置に接続された伝送路から抽出されたリファレンスクロック信号を取得し、クロック信号とリファレンスクロック信号との周波数ずれを測定する。判定部１ｃは、周波数ずれの測定結果と電力供給の状況とに基づいて、発振器１ａのウォームアップが完了したか否か判定する。 （もっと読む）

【課題】簡素な回路構成で、電圧制御発振回路の入力部でのリークに起因する定常位相誤差を防止できる位相ロックループ回路を提供する。
【解決手段】リファレンスクロック信号とフィードバッククロック信号の位相差を検出する位相比較回路１と、検出された位相差に応じた電流を容量に出力するチャージポンプ回路２と、容量に蓄積されている電荷に基づく制御電圧に応じた発振周波数の出力クロック信号を生成する電圧制御発振回路４とを有する位相ロックループ回路にて、制御電圧がロック状態時の電圧であった場合に電圧制御発振回路４の入力部に流れるリーク電流に等しい電流を生成し、生成された電流に応じた補正電流をカレントミラー回路を介して容量に出力するようにして、リーク電流による制御電圧の変動を抑制する。 （もっと読む）

【課題】周波数差の変化を正しくＤＣＯに伝達し、且つグリッチノイズを低減する。
【解決手段】一つの実施形態の全デジタル位相ロックループ９０には、デジタル周波数比較器１、グリッチ発生期間検出回路２、グリッチ補正回路３、累積器４、ループフィルタ５、及びＤＣＯ６が設けられる。デジタル周波数比較器１には、整数部周波数差生成回路１１、小数部周波数差生成回路１２、及び加算器１３が設けられる。グリッチ発生期間検出回路２は、小数部周波数差生成回路１２から出力されるＴＤＣ出力信号Ｓｔｄｃｏが入力され、グリッチ発生期間信号Ｓｇｃｔｉｍを生成する。グリッチ補正回路３は、加算器１３から出力される周波数差信号Ｓｆｄｉｆ及びグリッチ発生期間信号Ｓｇｃｔｉｍが入力され、グリッチ発生期間信号Ｓｇｃｔｉｍがイネーブル状態のときに周波数差信号Ｓｆｄｉｆに含まれるグリッチノイズを低減処理する。 （もっと読む）

【課題】２つの変調経路を有する周波数シンセサイザ装置において、ＤＡＣから電圧制御発振器に出力される制御電圧の振幅を適切に調整することができる。
【解決手段】周波数シンセサイザ装置１０は、入力電圧に応じた発振周波数で発振する電圧制御発振器１４、電圧制御発振器１４からの信号を分周するプログラマブル分周器２０、分周信号と基準クロックとの位相差を電圧制御発振器１４に出力する周波数位相比較器２２、送信データに応じて目標周波数変位分周波数を変位させる場合の調整電圧を電圧制御発振器１４に出力するＤＡＣ１２、調整電圧の校正時に、電圧制御発振器１４を基準電圧電源に接続するスイッチ３２、任意の送信データをＤＡＣ１２に出力して発振させた状態で分周信号の周波数をカウントしたカウント値に基づいて、目標周波数変位に対応する調整電圧に対応した調整データを設定する変調周波数変位校正回路３０を備える。 （もっと読む）

【課題】従来のノイズ除去手段にはノイズ原因となる一定の高調波成分を有するパルス信号を一旦生成してから、ノイズ除去のための変調をかける為、ノイズ除去のための変調をかける前の信号がノイズの原因となる。
【解決手段】電圧制御発振回路１０を、車両に設置された電子機器に供給する交流電圧を出力する電圧制御発振回路１０であって、電圧制御発振回路１０は入力信号の電圧に応じた周波数の交流電圧を出力し入力信号は三角波かまたは正弦波であることを特徴とするものとする。 （もっと読む）

【課題】リファレンスリークを低減することができ、位相ノイズを抑制することができるＰＬＬ回路を提供する。
【解決手段】切り替え機能付き周波数位相比較器は、入力されるロック検出信号に基づいて、入力される２つの信号の立ち上がりエッジを検出することにより当該２つの信号の位相差を検出する周波数比較と、入力される２つの信号の電圧レベルを検出することにより当該２つの信号の位相差を検出する位相比較とを切り替えて行う。 （もっと読む）

【課題】従来のこの種の装置では不可能な伝送路長の大きな変化による位相変動を調整できると同時に、検出精度を高める。
【解決手段】高周波信号である原信号を発生する原発振器１と、制御信号に基づいて原信号の通過時間を調整する移相器２と、原信号が伝送される伝送路３と、位相検出用信号を発生する位相検出用発振器４と、位相検出用信号の周波数を切り替える信号を発生する周波数切替信号発生器５と、位相検出用信号を２つに分岐して、基準信号と変調信号として出力する方向性結合器６と、方向性結合器６により分岐した変調信号が伝送される伝送路７，８と、方向性結合器６により分岐した基準信号と方向性結合器６により分岐して伝送路７，８を伝播した変調信号との位相を比較し、比較結果に応じて、原信号の通過時間を調整する制御信号を生成し移相器２に出力する位相検出器９とを備えた位相制御装置である。 （もっと読む）

【課題】基準タイミング信号に自装置の内部タイミング信号を正確に同期させるタイミング同期装置を提供する。
【解決手段】所定の時間間隔を示す基準タイミング信号と基準タイミング信号に対応する基準時刻を示す基準時刻情報とを取得する取得部と、クロック周波数を有する内部クロック信号を生成するクロック生成部と、内部クロック信号に基づいて、所定の時間間隔を示す内部タイミング信号と内部タイミング信号に対応する時刻を示す内部時刻情報とを生成する時刻情報生成部と、基準タイミング信号と内部タイミング信号、及び、基準時刻情報と内部時刻情報を比較することにより、基準タイミング信号に対する内部タイミング信号の進み又は遅れを検出し、且つ、基準タイミング信号に対する内部タイミング信号の位相の進み量又は遅れ量を検出する検出部と、位相の進み量又は遅れ量に応じてクロック周波数を調整する調整部と、を備えるタイミング同期装置。 （もっと読む）

【課題】光検出器で吸収される光のレベルを高めてＳ／Ｎを改善した原子発振器を提供す
る。
【解決手段】この原子発振器５０は大きく分けると、アルカリ金属原子と該アルカリ金属
原子の同位体とを混合した気体を封入したセル２と、可干渉性（コヒーレント性）を有し
、１つの中心周波数に対して２つの異なる周波数成分を有する第１の共鳴光対と第２の共
鳴光対を含む複数の光を気体に照射する光源（ＬＤ）１と、気体を透過した光の強度に応
じた検出信号を生成する光検出部（ＰＤ）３と、検出信号の強度に基づいて、アルカリ金
属原子に電磁誘起透過現象（以下、ＥＩＴ現象と呼ぶ）を生起させるように第１の共鳴光
対の周波数を制御すると共に、アルカリ金属原子の同位体にＥＩＴ現象を生起させるよう
に、第２の共鳴光対の周波数を制御する周波数制御部１２と、を備えて構成されている。 （もっと読む）