表示装置
【課題】消費電力を削減した表示装置を提供する。
【解決手段】行方向と列方向に対応してマトリクス状に複数の画素が配置された画素部と、ビデオ信号を信号線に入力する信号線駆動回路と、ビデオ信号を書き込む画素の行を選択する走査線駆動回路とを有し、走査線駆動回路はシフトレジスタを備え、シフトレジスタは複数のフリップフロップ回路と複数のスイッチで構成され、フリップフロップ回路の1つはフリップフロップ回路の他と接続され、フリップフロップ回路の1つの出力部分にスイッチの1つの一端が接続され、スイッチの1つの他端に第1の配線が接続され、複数のスイッチの他端は、第1の配線により電気的に接続され、第1の配線は、前記フリップフロップ回路の入出力信号のHigh信号またはLow信号が保持され、スイッチの1つの制御を第2の配線からの信号で行う表示装置。
【解決手段】行方向と列方向に対応してマトリクス状に複数の画素が配置された画素部と、ビデオ信号を信号線に入力する信号線駆動回路と、ビデオ信号を書き込む画素の行を選択する走査線駆動回路とを有し、走査線駆動回路はシフトレジスタを備え、シフトレジスタは複数のフリップフロップ回路と複数のスイッチで構成され、フリップフロップ回路の1つはフリップフロップ回路の他と接続され、フリップフロップ回路の1つの出力部分にスイッチの1つの一端が接続され、スイッチの1つの他端に第1の配線が接続され、複数のスイッチの他端は、第1の配線により電気的に接続され、第1の配線は、前記フリップフロップ回路の入出力信号のHigh信号またはLow信号が保持され、スイッチの1つの制御を第2の配線からの信号で行う表示装置。
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【特許請求の範囲】
【請求項1】
行方向と列方向に対応してマトリクス状に複数の画素が配置された画素部と、
ビデオ信号を信号線に入力する信号線駆動回路と、
前記ビデオ信号を書き込む画素の行を選択する走査線駆動回路とを有し、
前記走査線駆動回路はシフトレジスタを備え、
前記シフトレジスタは複数のフリップフロップ回路と複数のスイッチで構成され、
前記フリップフロップ回路の1つは前記フリップフロップ回路の他と接続され、
前記フリップフロップ回路の1つの出力部分に前記スイッチの1つの一端が接続され、
前記スイッチの1つの他端に第1の配線が接続され、
前記複数のスイッチの他端は、前記第1の配線により電気的に接続され、
前記第1の配線は、前記フリップフロップ回路の入出力信号のHigh信号またはLow信号が保持され、
前記スイッチの1つの制御を第2の配線からの信号で行っていることを特徴とする表示装置。
【請求項2】
行方向と列方向に対応してマトリクス状に複数の画素が配置された画素部と、
ビデオ信号を信号線に入力する信号線駆動回路と、
前記ビデオ信号を書き込む画素の行を選択する走査線駆動回路とを有し、
前記走査線駆動回路はシフトレジスタを備え、
前記シフトレジスタは複数のフリップフロップ回路と複数のスイッチで構成され、
前記フリップフロップ回路の1つは前記フリップフロップ回路の他と接続され、
前記フリップフロップ回路の1つの出力部分に前記スイッチの1つの一端が接続され、
前記スイッチの1つの他端に第1の配線が接続され、
前記複数のスイッチの他端は、前記第1の配線により電気的に接続され、
前記第1の配線は、前記フリップフロップ回路の入出力信号のHigh信号またはLow信号が保持され、
前記スイッチの1つの制御を第2の配線からの信号で行っており、
前記走査線駆動回路に選択される行の画素に書き込むビデオ信号と前記選択される行の後の全ての行列の画素に新たに書き込もうとするビデオ信号とが等しいとき、前記選択される行の直後の前記スイッチをオンにすることを特徴とする表示装置。
【請求項3】
請求項1または請求項2において、
前記走査線駆動回路はバッファ回路を有することを特徴とする表示装置。
【請求項1】
行方向と列方向に対応してマトリクス状に複数の画素が配置された画素部と、
ビデオ信号を信号線に入力する信号線駆動回路と、
前記ビデオ信号を書き込む画素の行を選択する走査線駆動回路とを有し、
前記走査線駆動回路はシフトレジスタを備え、
前記シフトレジスタは複数のフリップフロップ回路と複数のスイッチで構成され、
前記フリップフロップ回路の1つは前記フリップフロップ回路の他と接続され、
前記フリップフロップ回路の1つの出力部分に前記スイッチの1つの一端が接続され、
前記スイッチの1つの他端に第1の配線が接続され、
前記複数のスイッチの他端は、前記第1の配線により電気的に接続され、
前記第1の配線は、前記フリップフロップ回路の入出力信号のHigh信号またはLow信号が保持され、
前記スイッチの1つの制御を第2の配線からの信号で行っていることを特徴とする表示装置。
【請求項2】
行方向と列方向に対応してマトリクス状に複数の画素が配置された画素部と、
ビデオ信号を信号線に入力する信号線駆動回路と、
前記ビデオ信号を書き込む画素の行を選択する走査線駆動回路とを有し、
前記走査線駆動回路はシフトレジスタを備え、
前記シフトレジスタは複数のフリップフロップ回路と複数のスイッチで構成され、
前記フリップフロップ回路の1つは前記フリップフロップ回路の他と接続され、
前記フリップフロップ回路の1つの出力部分に前記スイッチの1つの一端が接続され、
前記スイッチの1つの他端に第1の配線が接続され、
前記複数のスイッチの他端は、前記第1の配線により電気的に接続され、
前記第1の配線は、前記フリップフロップ回路の入出力信号のHigh信号またはLow信号が保持され、
前記スイッチの1つの制御を第2の配線からの信号で行っており、
前記走査線駆動回路に選択される行の画素に書き込むビデオ信号と前記選択される行の後の全ての行列の画素に新たに書き込もうとするビデオ信号とが等しいとき、前記選択される行の直後の前記スイッチをオンにすることを特徴とする表示装置。
【請求項3】
請求項1または請求項2において、
前記走査線駆動回路はバッファ回路を有することを特徴とする表示装置。
【図1】
【図2】
【図3】
【図4】
【図5】
【図6】
【図7】
【図8】
【図9】
【図10】
【図11】
【図12】
【図13】
【図14】
【図15】
【図16】
【図17】
【図18】
【図19】
【図20】
【図21】
【図22】
【図23】
【図24】
【図25】
【図26】
【図27】
【図28】
【図29】
【図30】
【図31】
【図32】
【図33】
【図34】
【図35】
【図36】
【図37】
【図38】
【図39】
【図40】
【図41】
【図42】
【図43】
【図44】
【図45】
【図46】
【図47】
【図48】
【図49】
【図50】
【図51】
【図52】
【図53】
【図54】
【図55】
【図56】
【図57】
【図58】
【図59】
【図60】
【図61】
【図62】
【図63】
【図64】
【図65】
【図66】
【図67】
【図68】
【図69】
【図70】
【図71】
【図72】
【図73】
【図74】
【図75】
【図76】
【図77】
【図78】
【図2】
【図3】
【図4】
【図5】
【図6】
【図7】
【図8】
【図9】
【図10】
【図11】
【図12】
【図13】
【図14】
【図15】
【図16】
【図17】
【図18】
【図19】
【図20】
【図21】
【図22】
【図23】
【図24】
【図25】
【図26】
【図27】
【図28】
【図29】
【図30】
【図31】
【図32】
【図33】
【図34】
【図35】
【図36】
【図37】
【図38】
【図39】
【図40】
【図41】
【図42】
【図43】
【図44】
【図45】
【図46】
【図47】
【図48】
【図49】
【図50】
【図51】
【図52】
【図53】
【図54】
【図55】
【図56】
【図57】
【図58】
【図59】
【図60】
【図61】
【図62】
【図63】
【図64】
【図65】
【図66】
【図67】
【図68】
【図69】
【図70】
【図71】
【図72】
【図73】
【図74】
【図75】
【図76】
【図77】
【図78】
【公開番号】特開2011−81398(P2011−81398A)
【公開日】平成23年4月21日(2011.4.21)
【国際特許分類】
【出願番号】特願2010−251043(P2010−251043)
【出願日】平成22年11月9日(2010.11.9)
【分割の表示】特願2006−323149(P2006−323149)の分割
【原出願日】平成18年11月30日(2006.11.30)
【出願人】(000153878)株式会社半導体エネルギー研究所 (5,264)
【Fターム(参考)】
【公開日】平成23年4月21日(2011.4.21)
【国際特許分類】
【出願日】平成22年11月9日(2010.11.9)
【分割の表示】特願2006−323149(P2006−323149)の分割
【原出願日】平成18年11月30日(2006.11.30)
【出願人】(000153878)株式会社半導体エネルギー研究所 (5,264)
【Fターム(参考)】
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