Fターム[2G132AL00]の内容
電子回路の試験 (32,879) | 目的、その他 (6,788)
Fターム[2G132AL00]の下位に属するFターム
被試験体の識別、存在の検知 (22)
接続の確実化 (517)
接続の確認、誤接続の検出 (109)
接続線の本数の減少(端子数の減少) (295)
多品種への対応(汎用性のあるもの) (130)
試験時間の短縮 (1,339)
試験精度の向上 (1,554)
不良箇所、原因の特定等 (520)
試験装置の調整 (288)
インピーダンスマッチ (76)
温度調整 (87)
レベル変換 (8)
複数の被試験体の試験 (254)
母線(バス等)に接続した状態での試験 (19)
異常時の処理、保護 (119)
低機能装置で高機能素子を試験 (203)
試験装置の構成要素の配置改善 (287)
試験装置の動作試験 (78)
試験方法としては一般的なもの (13)
Fターム[2G132AL00]に分類される特許
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スキャンフリップフロップ回路、スキャンテスト回路及びその制御方法
【課題】ホールドフリーの小規模なテスト回路であり、且つ実動作周波数でのテスト可能なスキャンフリップフロップを提供する。
【解決手段】PosタイプF/F100は、クロックの立ち上りエッジ同期し、データ又はスキャンテストデータが選択的に入力されるマスタラッチ(Lowレベルラッチ)110と、マスタラッチ110からのデータが入力されるスレーブラッチ(Hiレベルラッチ)111とを有する。そして、スキャンシフト時には、マスタラッチ110は、スキャンシフトデータ入力SINをスキャンシフトクロックSCLK1のLow期間で取り込むと共にスレーブラッチ111へ出力する。スレーブラッチ111はSCLK1とはエッジ位置が異なるスキャンシフトクロックSCLK2のHi期間でマスターラッチ110の出力を取り込むと共にQに出力する。
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半導体装置の検査方法および検査装置
【課題】半導体ウエハ上に形成された半導体装置の特性不良を精度よく検出することができる半導体装置の検査方法および検査装置を提供すること。
【解決手段】実施形態によれば、第1ウエハ検査工程と、2ウエハ検査工程と、判定工程とを含む半導体装置の検査方法が提供される。第1ウエハ検査工程は、複数個の半導体装置に同時にプローブ針を接触させるプローブカードを用いて半導体ウエハ上に形成された半導体装置の特性を検査する。第2ウエハ検査工程は、第1ウエハ検査工程によって特性不良と判定された半導体装置の半導体ウエハ上の分布に基づいて、プローブカードの半導体ウエハに対する位置を第1ウエハ検査工程の位置からずらして、半導体装置の特性を再検査する。判定工程は、第2ウエハ検査工程による再検査の結果に基づいて、半導体装置の特性不良のうち、複数個の半導体装置単位で行われる製造処理において生じる特性不良を判定する。
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電磁ノイズ分布検出装置
【課題】 供試機器内で発生する電磁ノイズの影響が低減された、注入された電磁ノイズの伝搬経路分布を得ることを目的とする。
【解決手段】 本発明にかかる電磁ノイズ分布検出装置は、電磁ノイズを供試機器に注入する信号注入手段と、前記供試機器における複数の測定箇所から電磁界強度を検出する電磁界強度検出手段と、検出された前記電磁界強度を最大値検波により測定する最大値検波手段と、前記供試機器における任意の測定箇所から得られた電磁界強度について、複数回の最大値検波による測定から得られた測定値のうち、最小値を保持する最小値保持手段と、前記最小値保持手段に保持された最小値に基づき、前記供試機器上の前記電磁ノイズの伝搬経路分布を検出するノイズ分布検出手段と、を備える。
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半導体集積回路およびその設計方法
【課題】IRドロップ問題を緩和することのできる半導体集積回路およびその設計方法を提供する。
【解決手段】本発明の一実施形態による半導体集積回路は、データをシリアルに転送するシリアル動作を行う直列接続された複数のフリップフロップを分割して構成された複数のF/Fグループと、前記F/Fグループに含まれるフリップフロップの出力が一致する場合に第1の信号を出力し、そうでない場合に第2の信号を出力する連続信号判定回路とを備えるとともに、前記F/Fグループの先頭以外のフリップフロップに対し、前記第1の信号を受信する場合にはクロック信号を供給せず、前記第2の信号を受信する場合にはクロック信号を供給するクロックゲーティング回路を備える。
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集積回路装置および集積回路装置の試験方法
【課題】メモリへの連続アクセス回数を増やしても使用するスキャンチェーン数を増加させることなく試験を行うことができる集積回路装置の提供を図る。
【解決手段】メモリMEMと、該メモリに接続される複数のロジック回路Lと、前記メモリおよび前記ロジック回路の試験を行うスキャンチェーンSCI,SCIIと、を含む集積回路装置であって、前記メモリの前段の第1スキャンチェーンSCIにおいて、前記メモリに対して出力端子が繋がっている少なくとも2つの第1および第2フリップフロップFF107,FF108を有し、前記第2フリップフロップFF108の前記出力端子と、前記第1フリップフロップFF107のスキャン入力端子の間に、少なくとも1つの第1挿入フリップフロップFF105,FF101を挿入して、前記スキャンチェーンの接続を規定する。
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半導体集積回路のスキャンテスト回路の設計方法、スキャンテスト回路、およびスキャンテスト方法
【課題】半導体集積回路にスキャンパスを組み込んでスキャンテストを行う際に、シングルサイクルパスとマルチサイクルパスが混在している論理回路において、シングルサイクルパスの実動作速度によるテストを可能にすること。
【解決手段】実動作モードでタイミング解析を行い、マルチサイクルパスを抽出する。次に、シングルサイクルパスとマルチサイクルパスの分岐点と、シングルサイクルパスとマルチサイクルパスの合流点を抽出する。そして、上記分岐点から出力側のマルチサイクルパス側の経路上と、上記合流点から入力側のマルチサイクルパス側の経路上に、出力固定回路を挿入する。但し、出力固定回路は、マルチサイクルテスト時には、入力と同じ信号を出力し、シングルサイクルテスト時には、任意の固定値を出力する回路である。
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入出力回路およびその故障検出方法
【課題】入力回路および出力回路の故障または両回路間にある信号線の断線状態を検査する信号のノイズによる影響を軽減し故障診断の精度を上げることができる入出力回路を提供すること。
【解決手段】通電または非通電の二信号を伝送する信号線と、信号線の両端に接続された出力回路70および入力回路とを備え、ハイレベル信号とローレベル信号のいずれか一方を通常信号とし他方を検査信号とし、出力回路70は、単位時間当たりの検査信号の送信回数を任意に変更できる検査用信号出力条件設定部(回数変更手段)71を備えている。
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半導体装置
【課題】複数の半導体チップの各々の信号端子が共通の外部端子に接続される場合であっても、半導体装置のオープン不良を検出する。
【解決手段】半導体装置は、複数の半導体チップと、外部と接続される電源端子、第1及び第2の外部端子と、を備え、複数の半導体チップのそれぞれは、第1の信号端子(第1の信号パッドT1)に供給される信号に基づくクロック信号によって計数を行うカウンタ部42と、複数の半導体チップの中で自己の半導体チップを固定的に識別し、識別情報を出力する識別情報認識部と、カウンタ部42の出力と識別情報を比較し、比較した比較結果に基づいて、第2の信号端子(第2の信号パッドT2)と電源端子との導通/非導通状態を制御する比較回路43と、を有し、複数の半導体チップの各々の第1の信号端子は、共通の第1の外部端子に接続され、複数の半導体チップの各々の第2の信号端子は、共通の第2の外部端子に接続される。
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試験装置
【課題】高速モード時において自由度の高いパターンデータを生成する。
【解決手段】予め定められた試験レートに同期してそれぞれ入力される入力パターンに応じたパターンデータを出力する複数のパターン出力部を備え、それぞれのパターン出力部は、通常モードおよび高速モードの2つの動作モードを有し、高速モードにおいて、それぞれのパターン出力部は、自己のパターン出力部に入力される入力パターンに対応するパターンデータ、および、他のパターン出力部に入力される入力パターンに対応するパターンデータのそれぞれを、複数の分割レートに対するパターンデータのうちの少なくとも一つとして出力する試験装置を提供する。
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半導体集積回路及び故障検出方法
【課題】電源分離回路への電源供給を制御する複数の電源スイッチから、不良スイッチを特定する。
【解決手段】電源スイッチ群21は、第1電源101と複数の電源供給端子103〜105との間の接続を制御する複数の電源スイッチ120〜122を備える。電源分離回路11は、複数の電源供給端子103〜105の各々に対応して接続される複数の内部回路140〜142を備える。スイッチング素子131、132は、通常動作モードにおいて、複数の電源供給端子103〜105のそれぞれの間を短絡し、テストモードにおいて、複数の電源供給端子103〜105のそれぞれの間を分離する。複数の電源供給端子103〜105における電圧VSDは、複数のモニタ端子161〜163に監視可能に出力される。
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データ作成装置、基板検査装置およびデータ作成方法
【課題】部品実装基板に対して行う電気的検査において用いる検査用データを作成する際の入力作業を効率よくかつ正確に行う。
【解決手段】回路基板に電気部品(抵抗器R1,R2,R6,R7)が実装された部品実装基板に対して行う電気的検査において電気信号の入出力を行うための部品実装基板における検査ポイントを示すポイント情報を含む検査用データを作成する処理部と、ポイント情報を入力する操作が可能な操作部と、ポイント情報の入力時に参照させる図であって回路基板の配線(W1〜W3,W6,W7)および電気部品の配置を示す配置図Fを表示部12に表示させる表示制御部とを備え、操作部は、配置図F内に図示されている配線を選択する選択操作が可能に構成され、処理部は、選択操作によって選択された配線を示す情報をポイント情報として検査用データを作成する。
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データ作成装置、基板検査装置およびデータ作成方法
【課題】検査ポイントや判定用の基準値を正確かつ効率的に設定する。
【解決手段】回路基板に電気部品が実装された部品実装基板に対して行う電気的検査において電気信号の入出力を行うための部品実装基板における検査ポイントを示すポイント情報を含む検査用データを作成可能に構成され、検査用データの作成時に参照させる図であって回路基板の配線および電気部品の配置を示す配置図F2を表示部12に表示させる表示制御部を備え、表示制御部は、配置図F2を表示させる際に、予め設定された条件を満たす電気部品の図示を省略して表示させる第1表示処理を実行可能に構成されている。
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データ作成装置、基板検査装置およびデータ作成方法
【課題】部品実装基板に対して行う電気的検査において用いる検査用データを作成する際の入力作業の効率を向上させる。
【解決手段】回路基板に電気部品(抵抗器R1〜R8)が実装された部品実装基板における基板の配線(W1〜W7)上に規定されている規定ポイント(P1a〜P7b)の中から選択されて部品実装基板に対して行う電気的検査において電気信号の入出力を行うための検査ポイントを示すポイント情報を含む検査用データを作成する処理部と、配線および電気部品の配置を示す第1配置図を表示部12に表示させる表示制御部とを備え、表示制御部は、第1配置図内に図示されている配線を選択する第1選択操作が行われたときに規定ポイントの配置を示す第2配置図Fbを表示部12に表示させ、その際に、第1選択操作によって選択された配線上に規定されている規定ポイントを他の規定ポイントと識別可能に図示させる。
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測定装置
【課題】被測定物の送信器と受信器を接続する試験を測定装置により行う。
【解決手段】送信部202と受信部204を有する被測定物200に接続される測定装置100は、送信部202に接続される入力ポート102と、受信部204に接続される出力ポート104と、出力信号を出力する信号出力部132、134と、入力信号の電力を測定する電力測定部145、155と、入力ポートが接続される部分を、出力ポート104および電力測定部145、155の一方または双方とすることができ、しかも、出力ポート104が接続される部分を、入力ポート102および信号出力部132、134の一方または双方とすることができる接続部(カプラ110、スイッチ120〜128)と、入力ポート102と出力ポート104とが接続される際に、出力ポート104から出力される出力ポート信号の電力を調整する電力調整部183、185とを備える。
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半導体装置及びそのテスト方法
【課題】従来の半導体装置では、電源電圧変動を抑制するために回路規模が大きくなる問題があった。
【解決手段】本発明の半導体装置は、テスト対象回路11〜13と、スキャンモード制御信号SMCと、ノイズ制御信号CNTと、クロック信号CLKと、テストパターンSINとが入力され、テスト対象回路12に対するテストを行うテスト回路20と、を有し、テスト回路20は、ノイズ制御信号CNTがイネーブルであるダミーノイズ生成期間にテスト回路20において保持されているテストパターンSINに基づくテスト値を維持し、ダミーノイズ生成期間にクロック信号CLKの周期に応じて変動するダミー電源ノイズを生成し、ダミーノイズ生成期間の終了後にテストパターンによりテスト対象回路12をテストする。
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スキャンチェーン回路、スキャンチェーン構築方法及び試験装置
【課題】スキャンF/Fの遷移する回数を抑えて消費電力を削減することができるスキャンチェーン回路及びスキャンチェーン構築方法を提供すること
【解決手段】本発明にかかるスキャンチェーン回路は、複数のフリップフロップ21〜26を有し、複数のフリップフロップ21〜26のうち、それぞれのフリップフロップが保持しているデータを先頭方向から後尾方向に対してシフトするスキャンチェーン回路であって、複数のフリップフロップ21〜26は、スキャンチェーン回路の先頭方向から後尾方向に対して、保持しているデータの遷移回数が少ない方から昇順となるように配置されるものである。
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カレントプローブモデル化方法、カレントプローブモデル作成装置、シミュレーション方法、シミュレーション装置、及びプログラム
【課題】BCI試験のシミュレーションをより短時間に行えるようにする技術を提供する。
【解決手段】BCI試験で伝送線にバルク電流の注入に用いるカレントプローブは、伝送線にバルク電流を直接、注入する電圧源と見なし、モデル化する。それにより、カレントプローブは電圧源モデル20で模擬する。カレントプローブは電圧の印加により信号線に電流を注入する。そのようにして注入される電流は、周波数と電圧振幅値のテーブルデータ25に格納された周波数と電圧振幅値の組み合わせにより制御する。このために、周波数と組み合わせる電圧振幅値は、その周波数で実際に注入される電流の電流振幅値と、電圧源モデル20と伝送線を含む測定用回路のシミュレーションにより得られるその電流振幅値とが一致するように選択される。
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半導体装置
【課題】テストパターンの内容、あるいは回路規模によらず、動作試験が短時間且つ高効率で行える半導体装置の実現。
【解決手段】フリップフロップ回路37と、試験モード時に、フリップフロップ回路に所定の値を設定すると共にフリップフロップ回路の保持する値を読み出すスキャンチェーンと、通常モード時に非動作で、試験モード時には、フリップフロップ回路の値が変化する場合に動作状態となり、前記フリップフロップ回路の値が変化するタイミングで非動作状態になる電流消費回路37A,37Bと、を有する半導体装置。
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信号発生装置および試験装置
【課題】エッジの位相を固定して、信号のデューティ比を変更する。
【解決手段】指定されたデューティ比の出力信号を出力する信号発生装置であって、入力信号と出力信号との位相差を検出する位相検出器と、位相検出器により検出された位相差をフィルタリングして、発振器に供給するループフィルタと、位相差に応じた周波数の発振信号を出力する発振器と、指定値に応じて発振信号のデューティ比を変更して出力信号として出力するとともに位相検出器に供給するデューティ変更部と、を備える信号発生装置を提供する。
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半導体試験装置
【課題】半導体試験装置のシステム周波数よりも高い周波数の論理信号を低コストで生成出力することができ、リアルタイムにエッジや周波数を変更でき、高精度のタイミング精度が得られる半導体試験装置を提供すること。
【解決手段】半導体試験装置に内蔵されている信号発生部から出力される複数系統の論理信号を加算する加算器とこの加算器の出力をリタイミングクロックにしたがって取り込むラッチとこのラッチ出力を選択的に出力するスイッチとで構成された複数のパターン信号発生ユニットと、これら複数のパターン信号発生ユニットからスイッチを介して出力される出力信号間のスキューを補正する校正経路が設けられた半導体試験装置において、
前記リタイミングクロックは少なくとも2系統の論理信号を加算することにより生成され、前記校正経路は、前記各パターン信号発生ユニットのスイッチに連動して駆動され択一的に所定の出力信号を選択するロジックゲートを含むことを特徴とするもの。
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