【課題】ウェハハンドリングが容易であり、高精度の位置合わせを必要とせず、ビアホールとして機能する開口部を浅く形成でき、さらに開口部を埋め込む第１電極と基板との界面の割れを防止できる電極構造、及びその製造方法を提供することにある。
【解決手段】基板に、第１主表面側から、深さが基板の厚さよりも小さい開口部３３を形成する。次に、開口部を埋め込む第１電極３５を形成する。次に、第１主表面と対向する基板を第２主表面側から薄層化して、開口部の深さよりも大きい厚さとする。次に、第２主表面側１１１ｂから開口部の底面３３ｂへ向けて、基板１１１に切り込みを入れる３９ことによって、第２主表面側から第１電極を露出させる。次に、切り込みを埋め込む第２電極４４を形成する。 （もっと読む）

【課題】新規な電極構造を有する、横電界方式の液晶表示装置とその作製方法の提案。
【解決手段】絶縁表面を有する第１基板と、絶縁表面上の第１導電膜及び第２導電膜と、第１導電膜上の第１絶縁膜と、第２導電膜上の第２絶縁膜と、第１基板と対峙する第２基板と、第１基板と第２基板の間に位置する液晶層と、を有し、第１導電膜の一部は第１絶縁膜の側部にも位置し、なおかつ、第２導電膜の一部は第２絶縁膜の側部にも位置し、液晶層は、ブルー相を示す液晶を含んでいる液晶表示装置。 （もっと読む）

【課題】電気的接続の信頼性を損なうことなく電気抵抗率を従来よりも低減できる埋め込み配線を有する半導体装置用基板および半導体装置を提供する。
【解決手段】本発明は、上記目的を達成するため、埋め込み配線を有する半導体装置用基板であって、前記埋め込み配線は、金属多結晶体からなり、平均結晶粒径が異なる少なくとも２層の領域を前記基板の厚さ方向に有し、前記埋め込み配線の開口面を含む層の平均結晶粒径が、前記埋め込み配線の他の層の平均結晶粒径よりも小さいことを特徴とする半導体装置用基板を提供する。また、本発明は、上記半導体装置用基板を用いたことを特徴とする半導体装置を提供する。 （もっと読む）

【課題】半導体基体同士が張り合わされた構成を有する半導体装において、接合精度の向上を可能とする。
【解決手段】第１半導体基体３１と、第２半導体基体４５とを備え、第１半導体基体３１の第１主面３１Ａ側と、第２半導体基体４５の第１主面４５Ａ側が接合されている。そして、第１半導体基体３１の第１主面３１Ａ側、第２半導体基体４５の第１主面４５Ａ側、第１半導体基体３１の第２主面３１Ｂ側、及び、第２半導体基体４５の第２主面４５Ｂ側から選ばれる少なくとも１つ以上に形成されている反り補正層１３，１４を備える半導体装置７９を構成する。 （もっと読む）

【課題】安定した性能と高い生産性とを実現する不揮発性半導体記憶装置及びその製造方法を提供する。
【解決手段】実施形態によれば、メモリセルアレイ部と、第１平面内においてメモリセルアレイ部と並置されたコンタクト部と、を備えた不揮発性半導体記憶装置が提供される。メモリセルアレイ部は、積層体、半導体層、メモリ膜を含む。積層体は、第１平面に対して垂直な第１軸に沿って積層された複数の電極膜とそれらの間の電極間絶縁膜とを含む。半導体層は電極膜の側面に対向する。メモリ膜は電極膜と半導体層との間に設けられ電荷保持層を含む。コンタクト部は、コンタクト部絶縁層と複数のコンタクト電極とを含む。コンタクト部絶縁層は、コンタクト部絶縁膜と粒子とを含む。コンタクト電極はコンタクト部絶縁層を第１軸に沿って貫通する。コンタクト電極は電極膜に接続される。 （もっと読む）

【課題】銅配線の導電性を向上させるとともに、経時変化による劣化を抑制することができる銅配線の形成方法、配線基板の製造方法および配線基板を提供することを目的とする。
【解決手段】粒子径が１００ｎｍ以上の第１の銅粒子１４を分散させた第１の分散液１２を塗布し、基板１０上に配線パターンを形成するパターン形成工程と、配線パターンを１５０℃未満の温度で乾燥を行う乾燥工程と、乾燥工程後の配線パターンと同じ位置に、第１の銅粒子１４より粒子径の小さい第２の銅粒子１８を分散させた第２の分散液１６を塗布する塗布工程と、塗布工程後の配線パターンの第１の銅粒子１４および第２の銅粒子１６間の空隙を埋める緻密化工程と、緻密化工程後の配線パターンを加熱する加熱工程と、加熱工程後の配線パターンを還元処理する還元処理工程と、を有することを特徴とする銅配線の形成方法、配線基板の製造方法および配線基板である。 （もっと読む）

【課題】低誘電率膜のダメージ回復処理を行う際に、比誘電率やリーク電流値を低く維持しつつ内部の水分を除去することができる処理方法を提供すること。
【解決手段】被処理基板に形成された、表面部分にダメージ層を有する低誘電率膜に回復処理を施すにあたり、その分子が、低誘電率膜のダメージ層の内部に浸透できる程度に小さく、ダメージ層内の水分を除去することが可能な第１処理ガスと、ダメージ層の表面に疎水性で緻密な改質層を形成する第２処理ガスとを低誘電率膜のダメージ層に作用させる。 （もっと読む）

【課題】隣接する画素の間に設ける絶縁膜は、バンク、隔壁、障壁、土手などとも呼ばれ
、薄膜トランジスタのソース配線や、薄膜トランジスタのドレイン配線や、電源供給線の
上方に設けられる。特に、異なる層に設けられたこれらの配線の交差部は、他の箇所に比
べて大きな段差が形成される。隣接する画素の間に設ける絶縁膜を塗布法で形成した場合
においても、この段差の影響を受けて、部分的に薄くなる箇所が形成され、その箇所の耐
圧が低下されるという問題がある。
【解決手段】段差が大きい凸部近傍、特に配線交差部周辺にダミー部材を配置し、その上
に形成される絶縁膜の凹凸形状を緩和する。また、上方配線の端部と下方配線の端部とが
一致しないように、上方配線と下方配線の位置をずらして配置する。 （もっと読む）

【課題】機械強度が十分であり、低誘電性に優れ、シリコンウエハー及びＰ−ＴＥＯＳ等のＳｉＯ_２膜の両方への接着性に優れたシリカ系被膜を提供する。
【解決手段】実質的にＯＨ基の含有量が大幅に減少されてなる高い緻密性を備えた微細孔を有するシリカ系被膜。（ａ）一般式（１）で表せられる化合物を加水分解縮合して得られるシロキサン樹脂、(化１)Ｒ１ｎＳｉＸ４−ｎ（１）（式中、Ｒ１は、Ｈ若しくはＦ又はＢ、Ｎ、Ａｌ、Ｐ、Ｓｉ、Ｇｅ若しくはＴｉを含む基又は炭素数１〜２０の有機基を示し、Ｘは、加水分解性基を示すし、ｎは０又は１の整数である）（ｂ）下記一般式（２）で表せられるイオン性化合物並びに(化２)（Ｒ２４Ｎ＋）ｎＹｎ−（２）（式中、Ｒ２は、水素原子又は炭素数１〜２０の有機基を示し、Ｙは、陰イオンを示し、ｎは陰イオンの価数である）（ｃ）前記（ａ）成分及び（ｂ）成分を溶解可能な溶媒を含むシリカ系被膜形成用組成物。 （もっと読む）

【課題】高抵抗・高精度の抵抗素子からなる抵抗回路を提供する。
【解決手段】５００Å以下に薄膜化した薄膜材料からなる抵抗素子の上にシリコン窒化膜などの絶縁膜を形成する。この窒化膜により抵抗素子に対するコンタクトホールの突き抜けを防止する。 （もっと読む）

【課題】本発明は、製造コストの増大を抑制しつつ、簡易な構成で、絶縁膜とさらに上部に形成された絶縁膜との界面の電荷を低減することができる半導体装置の製造方法の提供を目的とする。
【解決手段】本発明にかかる半導体装置の製造方法は、（ａ）ＳｉＣ半導体を用いた基板を用意する工程と、（ｂ）前記基板の表層部において、前記基板の素子領域を囲むように、リセス構造と前記リセス構造の下部にガードリング層とを形成する工程と、（ｃ）前記ガードリング層を覆って、第１絶縁膜を形成する工程と、（ｄ）前記第１絶縁膜を覆って、前記第１絶縁膜とは異なる材質の第２絶縁膜を形成する工程と、（ｅ）前記第１絶縁膜上に蓄積する電荷とは逆電荷のイオンを、前記工程（ｄ）の前、又は、前記工程（ｄ）中、又は前記工程（ｄ）の後に照射する工程とを備える。 （もっと読む）

【課題】コンタクトホール内にめっき層から成るコンタクト層を埋め込んで上下層の電気的接続を行うときの、コンタクト層の埋め込み性を良好にする構造の半導体装置を提供する。
【解決手段】配線層１２，１６と、少なくとも底部において、三角形の平面形状であるコンタクトホール１４と、めっき層から成り、コンタクトホール１４の内部を埋めて形成され、配線層１２，１６に接続されたコンタクト層１５とを含む、半導体装置を構成する。 （もっと読む）

【課題】有機導電性材料を含む塗布組成物をプラスチック基板上に形成した後、高い電気電導度の配線を形成することができる配線の形成方法および形成装置を提供すること。
【解決手段】プラスチック基板上に有機導電性材料を含む塗布組成物が塗布されて配線パターンが形成された部材を準備し、少なくとも前記配線パターンに電磁波を照射してアニールし、有機導電性材料からなる配線を形成する。 （もっと読む）

【課題】ＳＯＧで平坦化した半導体装置であっても水分による閾値変動を抑制した半導体装置を提供する。
【解決手段】ＳＯＧ平坦化後にＳＯＧを除去したＭＯＳトランジスタ領域を単層配線とし、ＳＯＧを残した非ＭＯＳトランジスタ領域を多層配線とすることで、ＳＯＧを介したＭＯＳトランジスタへの水分の影響が無くなり、ＭＯＳトランジスタの閾値変動を抑制できる。 （もっと読む）

【課題】半導体装置の信頼性を確保する。
【解決手段】基板と、基板に埋め込まれ、複数の開口部を有する絶縁膜と、複数の開口部内に位置する基板に設けられた複数のダミー拡散層２０と、抵抗素子形成領域４０において、平面視でダミー拡散層２０と重ならないように絶縁膜上に設けられ、かつ第１方向に延伸する複数の抵抗素子１０と、抵抗素子形成領域４０において、絶縁膜上およびダミー拡散層２０上に設けられ、かつ第１方向に延伸する複数のダミー抵抗素子１２と、を備え、ダミー抵抗素子１２は、平面視で、第１方向と基板に水平な面内において垂直な第２方向に並ぶ少なくとも二つのダミー拡散層２０と重なっている。 （もっと読む）

【課題】ピラーを確実に配置することが可能な半導体装置、及びその製造方法を提供する。
【解決手段】本発明の一態様にかかる半導体装置３０は、内部回路領域２０と、内部回路領域２０の外側に設けられたＩ／Ｏ領域１０と、を備える半導体チップ１と、半導体チップ１とフリップチップ接続されたパッケージ基板６と、半導体チップ１とパッケージ基板６との間に配置され、半導体チップ１の最上層配線層１２に含まれる２本以上の接地配線１２ａ上に形成されて、２本以上の接地配線１２ａを接続する導電性のピラー４と、を備えるものである。 （もっと読む）

【課題】外からの圧力を用いることなく、低温または室温でウエーハーを貼り合わせる。
【解決手段】貼り合わされたデバイス構造であって、デバイスまたは回路に接続された第１の組の金属ボンディングパッドおよび第１の基板１０上の金属ボンディングパッドに隣接する第１の非金属領域を有する第１の基板、デバイスまたは回路に接続された第１の組の金属ボンディングパッドに隣接する第２の組の金属ボンディングパッド、および第２の基板１３上の金属ボンディングパッドに隣接する第２の非金属領域を有する第２の基板、および第２の非金属領域に対して第１の非金属領域を接触ボンディングさせることにより形成される第１と第２の組の金属ボンディングパッドの間の接触ボンディングされた界面を含むボンディングされたデバイス構造。第１と第２の基板の少なくとも一方は弾性的に変形され得る。 （もっと読む）

【課題】コンタクトプラグ同士のショートや、コンタクトプラグ間の耐圧の低下を抑制する。
【解決手段】半導体記憶装置は、基板と、前記基板内において、前記基板の主面に平行な第１方向に延びるように区画された複数の素子領域と、前記第１方向に垂直な第２方向に延びるように形成された複数の選択ゲートＳＧと、前記基板上において前記選択ゲート間に設けられており、個々の前記素子領域上に形成された複数のコンタクトプラグＣＷを含むコンタクト領域とを備え、前記コンタクト領域は、Ｎ個（Ｎは２以上の整数）の前記コンタクトプラグが、連続するＮ本の前記素子領域上に、前記第１及び第２方向に非平行な直線上に並ぶように形成された部分領域を複数有し、前記Ｎの値は、前記部分領域ごとに異なる値に設定され、前記コンタクトプラグの各々は、楕円形又は長方形の平面形状を有し、前記第１方向に対し、長辺が傾けられて配置されている。 （もっと読む）

【課題】配線及びビア間接続の信頼性を向上させた半導体装置を提供する。
【解決手段】実施形態に係る半導体装置は、半導体基板と、前記半導体基板上の異なる高さに配置され、配線が形成された複数の配線層と、前記配線層の積層方向に延びる柱状に形成され、異なる複数の前記配線層の配線間を電気的に接続するビアとを備える。前記配線の一部は、前記ビアの中間部において前記ビアに接触する中間配線であり、所定の前記配線層の中間配線は、前記ビアを前記積層方向に直交する方向で貫通し、且つ、上面、下面及び両側面において前記ビアと接触していることを特徴とする。 （もっと読む）

【課題】隣接する２つのトランジスタ同士が接続された構成を有し、省スペースと電流集中による信頼性の低下の抑制とを両立させた半導体装置を実現できるようにする。
【解決手段】半導体装置は、第１のトランジスタ１０１と接続された第１のバス１１１、第２のトランジスタ１０２と接続された第２のバス１１２と、第１のバス１１１と第２のバス１１２との間に形成され、第１のバス１１１と第２のバス１１２とを接続するバス間配線１２１とを備えている。バス間配線１２１は、第１のバス１１１における第２のバス１１２と対向する辺の一部及び第２のバス１１２における第１のバス１１１と対向する辺の一部と接続されている。第１のコンタクトパッド１３１は、第１のバス１１１の一部と接続され、第２のコンタクトパッド１３２は、第２のバス１１２の一部と接続されている。 （もっと読む）