薄膜トランジスタ、その製造方法及びそれを含む有機電界発光表示装置
【課題】薄膜トランジスタ、その製造方法及びこれを含む有機電界発光表示装置を提供する。
【解決手段】基板と、前記基板上に位置するバッファ層と、前記バッファ層上に位置する第１半導体層及び第２半導体層と、前記第１半導体層及び第２半導体層と絶縁されるゲート電極と、前記第１半導体層及び第２半導体層と前記ゲート電極とを絶縁するゲート絶縁膜と、前記ゲート電極と絶縁され、前記第２半導体層と一部が接続するソース／ドレインである電極とを含み、前記第１半導体層は前記第２半導体層の下部に位置し、前記第１半導体層の面積は第２半導体層の面積よりも小さいことを特徴とする薄膜トランジスタ及びその製造方法に関する。また、前記薄膜トランジスタを含む有機電界発光表示装置とその製造方法に関する。
【解決手段】基板と、前記基板上に位置するバッファ層と、前記バッファ層上に位置する第１半導体層及び第２半導体層と、前記第１半導体層及び第２半導体層と絶縁されるゲート電極と、前記第１半導体層及び第２半導体層と前記ゲート電極とを絶縁するゲート絶縁膜と、前記ゲート電極と絶縁され、前記第２半導体層と一部が接続するソース／ドレインである電極とを含み、前記第１半導体層は前記第２半導体層の下部に位置し、前記第１半導体層の面積は第２半導体層の面積よりも小さいことを特徴とする薄膜トランジスタ及びその製造方法に関する。また、前記薄膜トランジスタを含む有機電界発光表示装置とその製造方法に関する。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、多結晶シリコンの製造方法、薄膜トランジスタ、その製造方法及びこれを含む有機電界発光表示装置（ｆａｂｒｉｃａｔｉｎｇ ｍｅｔｈｏｄ ｏｆ ｐｏｌｙ ｓｉｌｉｃｏｎ， ｔｈｉｎ ｆｉｌｍ ｔｒａｎｓｉｓｔｏｒ， ｆａｂｒｉｃａｔｉｎｇ ｍｅｔｈｏｄ ｏｆ ｔｈｅ ｔｈｉｎ ｆｉｌｍ ｔｒａｎｓｉｓｔｏｒ， ａｎｄ ｏｒｇａｎｉｃ ｌｉｇｈｔｉｎｇ ｅｍｉｔｔｉｎｇ ｄｉｏｄｅ ｄｉｓｐｌａｙ ｄｅｖｉｃｅ ｃｏｍｐｒｉｓｉｎｇ ｔｈｅ ｓａｍｅ）に関し、より詳しくは、金属触媒を用いて結晶化される半導体層の金属触媒の濃度を調節して電気的特性が優れる薄膜トランジスタ、その製造方法、及びこれを含む有機電界発光表示装置に関する。
【背景技術】
【０００２】
一般に、多結晶シリコン層は、高い電界効果移動度と高速動作回路への適用が可能であり、ＣＭＯＳ回路構成が可能であるという長所を有し、薄膜トランジスタ用半導体層の用途によく用いられる。このような多結晶シリコン層を用いた薄膜トランジスタは、主にアクティブマトリクス液晶ディスプレイ装置（ＡＭＬＣＤ）の能動素子と有機電界発光素子（ＯＬＥＤ）のスイッチング素子及び駆動素子に用いられる。
【０００３】
前記非晶質シリコンを多結晶シリコンに結晶化する方法には、固相結晶化法（Ｓｏｌｉｄ Ｐｈａｓｅ Ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）、エキシマレーザ結晶化法（Ｅｘｃｉｍｅｒ Ｌａｓｅｒ Ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）、金属誘導結晶化法（ＭＩＣ，Ｍｅｔａｌ Ｉｎｄｕｃｅｄ Ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）及び金属誘導側面結晶化法（ＭＩＬＣ，Ｍｅｔａｌ Ｉｎｄｕｃｅｄ Ｌａｔｅｒａｌ Ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）などがある。そこで、固相結晶化法は、非晶質シリコン層を、薄膜トランジスタを用いるディスプレイ素子基板を形成する物質であるガラスの変形温度である約７００℃以下で数時間〜数十時間にかけてアニーリングする方法であり、エキシマレーザ結晶化法は、エキシマレーザを、非晶質シリコン層に走査して最短時間の間に局所的に高い温度で加熱して結晶化する方法であり、金属誘導結晶化法は、ニッケル、パラジウム、金、アルミニウムなどの金属を、非晶質シリコン層に接触させるか、または注入して前記金属によって非晶質シリコン層が多結晶シリコン層に相変化を誘導する現象を利用する方法であり、金属誘導側面結晶化法は、金属とシリコンとが反応して生成したシリサイドが側面に継続的に伝播されながら順に非晶質シリコン層の結晶化を誘導する方法を利用する結晶化方法である。
【０００４】
しかし、前記の固相結晶化法は、工程時間が長く高温で長時間熱処理することになるので、基板が変形しやすいという短所を有し、エキシマレーザ結晶化法は、高価なレーザ装置が必要であるとともに、多結晶化した表面に突起（ｐｒｏｔｒｕｓｉｏｎ）が発生するため、半導体層とゲート絶縁膜との界面特性が悪くなるという短所がある。
【０００５】
現在において、金属を用いて非晶質シリコン層を結晶化する方法は、固相結晶化方法よりも低い温度で早期時間内に結晶化することのできる長所を有しているため、多く研究されている。金属を利用した結晶化方法は、金属誘導結晶化（ＭＩＣ）方法、金属誘導側面結晶化（ＭＩＬＣ）方法及びＳＧＳ結晶化方法などがある。
【０００６】
薄膜トランジスタの特性を決定する主要素の１つが漏洩電流であって、特に、前記の金属触媒を用いて結晶化した半導体層では、前記金属触媒がチャンネル領域に残留して漏洩電流が増加される。したがって、チャンネル領域での残留金属触媒の濃度を制御しないと、薄膜トランジスタの漏洩電流が増加して電気的特性が低下するという問題がある。
【先行技術文献】
【特許文献】
【０００７】
【特許文献１】大韓民国出願第２００６−００５８７７４号明細書
【発明の概要】
【発明が解決しようとする課題】
【０００８】
本発明は、上記の従来技術の問題点を解決するためのものであって、金属触媒を用いて結晶化した半導体層を用いる薄膜トランジスタにおいて、前記半導体層に残留する残留金属触媒を最小化し、特性が向上された薄膜トランジスタとその製造方法及び前記薄膜トランジスタを含む有機電界発光表示装置とその製造方法を提供することに目的がある。
【課題を解決するための手段】
【０００９】
本発明は薄膜トランジスタ、その製造方法及びそれを含む有機電界発光表示装置に関し、基板と、前記基板上に位置するバッファ層と、前記バッファ層上に位置する第１半導体層及び第２半導体層と、前記第１半導体層及び第２半導体層と絶縁されるゲート電極と、前記第１半導体層及び第２半導体層と前記ゲート電極とを絶縁するゲート絶縁膜と、前記ゲート電極と絶縁され、前記第２半導体層と一部が接続するソース／ドレインである電極とを含み、前記第２半導体層は前記第１半導体層の下部に位置し、前記第１半導体層の面積は第２半導体層の面積よりも小さいことを特徴とする薄膜トランジスタ及びその製造方法を提供する。
【００１０】
また、基板と、前記基板上に位置するバッファ層と、前記バッファ層上に位置する第１半導体層と、前記第１半導体層上に位置する第２半導体層と、前記第１半導体層及び第２半導体層と絶縁されているゲート電極と、前記第１半導体層及び第２半導体層と前記ゲート電極とを絶縁するゲート絶縁膜と、前記ゲート電極と絶縁され、前記第２半導体層と一部が接続するソース／ドレイン電極と、前記ソース／ドレイン電極上に位置する絶縁膜と、前記絶縁膜上に位置して前記ソース／ドレイン電極と電気的に接続する第１電極、有機膜層及び第２電極とを含み、前記第２半導体層は前記第１半導体層の下部に位置し、前記第１半導体層の面積は第２半導体層の面積よりも小さいことを特徴とする有機電界発光表示装置を提供する。
【発明の効果】
【００１１】
本発明によれば、金属触媒を用いて結晶化した半導体層を含む薄膜トランジスタ及びその製造方法とそれを含む有機電界発光表示装置を提供することによって、従来の金属触媒を用いて結晶化した半導体層よりも結晶粒が大きくて残留金属が少ない優れた半導体層を形成する方法を提供することができ、スレッショルド電圧、Ｉｏｆｆ特性が向上された薄膜トランジスタ及びその製造方法とそれを含む有機電界発光表示装置を提供することができ、特性が向上された素子を生産することができる。
【図面の簡単な説明】
【００１２】
【図１Ａ】本発明に係る多結晶シリコン層の製造方法を示す図である。
【図１Ｂ】本発明に係る多結晶シリコン層の製造方法を示す図である。
【図１Ｃ】本発明に係る多結晶シリコン層の製造方法を示す図である。
【図１Ｄ】本発明に係る多結晶シリコン層の製造方法を示す図である。
【図１Ｅ】本発明に係る多結晶シリコン層の製造方法を示す図である。
【図１Ｆ】本発明に係る多結晶シリコン層の製造方法を示す図である。
【図１Ｇ】本発明に係る第１金属触媒結晶化領域を示す写真である。
【図１Ｈ】本発明に係る第２金属触媒結晶化領域を示す写真である。
【図２Ａ】本発明に係るトップゲート薄膜トランジスタを示す図である。
【図２Ｂ】本発明に係るトップゲート薄膜トランジスタを示す図である。
【図２Ｃ】本発明に係るトップゲート薄膜トランジスタを示す図である。
【図３Ａ】本発明に係るボトムゲート薄膜トランジスタを示す図である。
【図３Ｂ】本発明に係るボトムゲート薄膜トランジスタを示す図である。
【図３Ｃ】本発明に係るボトムゲート薄膜トランジスタを示す図である。
【図３Ｄ】本発明に係るボトムゲート薄膜トランジスタを示す図である。
【図４】本発明に係る有機電界発光表示装置を示す図である。
【発明を実施するための形態】
【００１３】
以上、添付図面を参照しながら本発明の好適な実施形態について詳細に説明したが、本発明はかかる例に限定されない。本発明の属する技術の分野における通常の知識を有する者であれば、特許請求の範囲に記載された技術的思想の範囲内において、各種の変更例または修正例に想到し得ることは明らかであり、これらについても、当然に本発明の技術的範囲に属するものと理解される。
【００１４】
図１Ａ及び図１Ｅは、本発明の第１実施例に係る結晶化工程の断面図である。
図１Ａに示すように、ガラスまたはプラスチックの基板１００上にバッファ層１１０を形成する。前記バッファ層１１０は、化学気相蒸着（Ｃｈｅｍｉｃａｌ Ｖａｐｏｒ Ｄｅｐｏｓｉｔｉｏｎ）法または物理気相蒸着（Ｐｈｙｓｉｃａｌ Ｖａｐｏｒ Ｄｅｐｏｓｉｔｉｏｎ）法を利用してシリコン酸化膜、シリコン窒化膜のような絶縁膜を用いて断層またはその積層構造で形成される。このとき、前記バッファ層１１０は、前記基板１００から発生する水分や不純物の拡散を防止する、または結晶化時に熱伝達速度を調節することによって、非晶質シリコン層の結晶化が好ましく行えるような役割をする。
【００１５】
続いて、前記バッファ層１１０上に、第１非晶質シリコン層１２０を形成する。このとき、前記非晶質シリコン層１２０は化学気相蒸着法または物理気相蒸着法を利用することができる。また、前記第１非晶質シリコン層１２０を形成する際、または、形成した後に脱水素処理して水素の濃度を低くする工程を行うことができる。
【００１６】
次に、前記第１非晶質シリコン層１２０を多結晶シリコン層に結晶化する。本発明では、ＭＩＣ（Ｍｅｔａｌ Ｉｎｄｕｃｅｄ Ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）法、ＭＩＬＣ（Ｍｅｔａｌ Ｉｎｄｕｃｅｄ Ｌａｔｅｒａｌ Ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）法またはＳＧＳ（Ｓｕｐｅｒ Ｇｒａｉｎ Ｓｉｌｉｃｏｎ）法などのような金属触媒を利用した結晶化方法を用いて前記第１非晶質シリコン層を多結晶シリコン層に結晶化する。このとき、結晶化された多結晶シリコン層領域を第１金属触媒結晶化領域として定義する。
【００１７】
以下、本発明では、前記結晶化法の中で好ましい実施形態であるＳＧＳ結晶化法について説明する。
【００１８】
前記ＳＧＳ法は、非晶質シリコン層に拡散する金属触媒の濃度を低濃度に調節して結晶粒の大きさを数μｍないし数百μｍまで調節できる結晶化方法である。前記非晶質シリコン層に拡散する金属触媒の濃度を低濃度に調節するための一実施例として、前記非晶質シリコン層上に拡散層を形成し、前記拡散層上に金属触媒層を形成した後に熱処理して金属触媒を拡散することができ、工程によっては拡散層を形成しないで金属触媒層を低濃度で形成するなどで、拡散する金属触媒の濃度を低濃度に調節することもできる。図１Ｂは、前記第１非晶質シリコン層上に拡散層と金属触媒層を形成する工程の断面図である。
【００１９】
図１Ｂに示すように、前記第１非晶質シリコン１２０上に拡散層１３０が形成される。このとき、前記拡散層１３０は、後工程から形成される金属触媒が熱処理工程を介して拡散できるシリコン窒化膜で形成することが好ましく、シリコン窒化膜とシリコン酸化膜との複層を用いることができる。前記拡散層１３０は、化学気相蒸着法または物理気相蒸着法などのような方法で形成される。このとき、前記拡散層１３０の厚さは１〜２０００Åで形成される。前記拡散層１３０の厚さが１Å未満である場合は、前記拡散層１３０が拡散される金属触媒の量を阻止することが困難で、２０００Åを超える場合は前記非晶質シリコン層１２０に拡散される金属触媒の量が少なくて多結晶シリコン層に結晶化することが困難となる。
【００２０】
続いて、前記拡散層１３０上に金属触媒を蒸着して金属触媒層１４０を形成する。このとき、前記金属触媒は、Ｎｉ、Ｐｄ、Ａｇ、Ａｕ、Ａｌ、Ｓｎ、Ｓｂ、Ｃｕ、Ｔｒ、及びＣｄからなる群から選択されるいずれか１つを用いることができるが、好ましくは、ニッケル（Ｎｉ）を用いる。このとき、前記金属触媒層１４０は、前記拡散層１３０上に１０１１〜１０１５ａｔｏｍｓ／ｃｍ２の面密度に形成されるが、前記金属触媒が１０１１ａｔｏｍｓ／ｃｍ２の面密度よりも少なく形成した場合は結晶化の核であるシードの量が少なく前記第１非晶質シリコン層がＳＧＳ法による多結晶シリコン層に結晶化することが困難であって、前記金属触媒が１０１５ａｔｏｍｓ／ｃｍ２の面密度よりも多く形成された場合は第１非晶質シリコン層に拡散する金属触媒の量が多くて多結晶シリコン層の結晶粒が小さくなり、また、残留する金属触媒量が多くなって、前記多結晶シリコン層をパターニングして形成する半導体層の特性が低下されることになる。
【００２１】
図１Ｃは、前記基板を熱処理して金属触媒を、拡散層を介して拡散させ、第１非晶質シリコン層の界面に移動させる工程の断面図である。
【００２２】
図１Ｃに示すように、前記バッファ層１１０、第１非晶質シリコン層１２０、拡散層１３０及び金属触媒層１４０が形成された前記基板１００を熱処理１５０し、前記金属触媒層１４０の金属触媒のうちの一部を前記第１非晶質シリコン層１２０の表面に移動させる。すなわち、前記熱処理１５０により前記拡散層１３０を通過して拡散する金属触媒１４０ａ、１４０ｂのうち、微量の金属触媒１４０ｂだけが前記第１非晶質シリコン層１２０の表面に拡散し、殆どの金属触媒１４０ａは前記非晶質シリコン層１２０に到達しないか、または前記拡散層１３０を通過することができない。
【００２３】
したがって、前記拡散層１３０の拡散阻止能力により前記第１非晶質シリコン層１２０の表面に到達する金属触媒量が決定されるが、前記拡散層１３０の拡散阻止能力は前記拡散層１３０の厚さと密接な関係がある。すなわち、前記拡散層１３０の厚さが厚いほど拡散する量は小さいので結晶粒の大きさは大きくなり、厚さが薄いほど拡散する量は多くなるので結晶粒の大きさは小さくなる。
【００２４】
このとき、前記熱処理１５０の工程は、２００〜９００℃、好ましくは３５０〜５００℃の温度範囲で数秒ないし数時間の間行って前記金属触媒を拡散することになるが、この温度及び時間で行った場合には過度な熱処理工程による基板の変形などを防止することができ、製造コストや収率の観点から好ましい。前記熱処理１５０工程は、炉（ｆｕｒｎａｃｅ）工程、ＲＴＡ（Ｒａｐｉｄ Ｔｈｅｒｍａｌ Ａｎｎｅａｌｉｎｇ）工程、ＵＶ工程またはレーザ（Ｌａｓｅｒ）工程のうちいずれか１つの工程を用いることができる。
【００２５】
図１Ｄは、拡散する金属触媒により第１非晶質シリコン層が多結晶シリコン層に結晶化する工程の断面図である。
【００２６】
図１Ｄに示すように、前記拡散層１３０を通過して前記第１非晶質シリコン層１２０の表面に拡散する金属触媒１４０ｂにより前記第１非晶質シリコン層１２０が第１金属触媒結晶化領域１６０Ａに結晶化される。すなわち、前記拡散する金属触媒１４０ｂが非晶質シリコン層のシリコンと結合して金属シリサイドを形成し、前記金属シリサイドが結晶化核であるシードを形成し、非晶質シリコン層が多結晶シリコン層に結晶化されて第１金属触媒結晶化領域を形成し、第１金属触媒結晶化領域を第１ＳＧＳ結晶化領域として定義する。
【００２７】
一方、図１Ｄでは、前記拡散層１３０と金属触媒層１４０とを除去せず、前記熱処理１５０工程を行ったが、金属触媒を前記第１非晶質シリコン層１２０上に拡散させて結晶化核である金属シリサイドを形成した後、前記拡散層１３０と金属触媒層１４０とを除去して熱処理することによって多結晶シリコン層を形成させてもよい。
【００２８】
図１Ｅに示すように、第１ＳＧＳ結晶化領域である第１金属触媒結晶化領域１６０Ａをパターニングして島状に形成した後、基板１００全面に第２晶質シリコン層を形成した後、前記第１金属触媒結晶化領域１６０Ａを形成する場合と同じく熱処理１５０’して第２金属触媒結晶化領域１７０Ａに結晶化する。
【００２９】
このような熱処理によって前記第２非晶質シリコン層は結晶化されて、第２金属触媒結晶化領域１７０Ａを活性化することで、前記第２金属触媒結晶化領域１７０Ａは前記第１金属触媒結晶化領域１６０Ａに残留している残留金属触媒により結晶化されたもので、残留金属触媒量は第２金属触媒結晶化領域１７０Ａの量が第１金属触媒結晶化領域１６０Ａの量よりも少ない。前記第２金属触媒結晶化領域１７０Ａは第２ＳＧＳ結晶化領域に定義し、前記第２ＳＧＳ結晶化領域は前記第１ＳＧＳ結晶化領域からの残留金属触媒が拡散されて結晶化された領域である。
【００３０】
また、前記第２ＳＧＳ結晶化領域である第２金属触媒結晶化領域１７０Ａの結晶粒は、第１ＳＧＳ結晶化領域である第１金属触媒結晶化領域１６０Ａの結晶粒大きさの３〜４倍程度の大きさを有する特徴がある。そして、前記結晶化領域の表面をエッチングして観察すると、第１金属触媒結晶化領域１６０Ａの表面にはシードが存在する一方、第２金属触媒結晶化領域１７０Ａには下部にシードが形成して上部に成長するためシードが表面から見えなく結晶粒境界が不鮮明で不明確である。したがって、第２金属触媒結晶化領域は第１金属触媒結晶化領域よりも結晶粒境界が少なく含まれ、また、少なく含まれるため電荷移動に対するベリアが少なく含まれるので電気的特性が優れる。
【００３１】
図１Ｇは前記第１金属触媒結晶化領域１６０Ａの表面を撮影した写真であり、図１Ｈは前記第２金属触媒結晶化領域１７０Ａの表面を撮影した写真である。
【００３２】
図１Ｇ及び図１Ｈに示すように、図１Ｇは前記第１金属触媒結晶化領域の表面であって、前述したように、結晶粒内のシードを目で確認することができ、グレインバウンダリ（ｇｒａｉｎ ｂｏｕｎｄａｒｙ）が明確である。しかし、第１金属触媒結晶化領域内の残留金属触媒により結晶化された第２金属触媒結晶化領域を詳細に観察すると、結晶粒の境界が明確でなくてグレインバウンダリが不鮮明であり、シードも存在しない。前記第２金属触媒結晶化領域は、下部の第１金属触媒結晶化領域と第２金属触媒結晶化領域とが付き合っている部分にシードが存在し、その部分から結晶が成長するためシリコン層を複数回エッチングすることによって第２金属触媒結晶化領域の下部にシードが存在することを分かる。そして、前記第２金属触媒結晶化領域は、第１金属触媒結晶化領域の残留金属触媒により結晶化されるので、第２金属触媒結晶化領域の残留金属触媒量が第１金属触媒結晶化領域の残留金属触媒量よりも少ない。
【００３３】
よって、上記の相違点から第１ＳＧＳ結晶化領域である第１金属触媒結晶化領域と第２ＳＧＳ結晶化領域である第２金属触媒結晶化領域とを判別することができる。
【００３４】
図２Ａないし図２Ｃでは、本発明の第１実施例に係る多結晶シリコン層の製造方法を用いてトップゲート薄膜トランジスタを製造する工程を示す断面図である。
【００３５】
図２Ａに示すように、図１Ｇの前記第１金属触媒結晶化領域１６０Ａ及び第２金属触媒結晶化領域１７０Ａを含む基板１００を用意する。このとき、前記第１金属触媒結晶化領域１６０Ａは島状にパターニングされた後に第２金属触媒結晶化領域１７０Ａを結晶化し、前記パターニングされた第１金属触媒結晶化領域は第１半導体層１６０に定義される。
【００３６】
前記第２金属触媒結晶化領域１７０Ａをパターニングして第２半導体層１７０として形成する。このとき、第２半導体層１７０は第１半導体層よりも面積が広くパターニングし、好ましくは第１半導体層１６０が前記第２半導体層１７０のチャンネル領域下部に位置し、第２半導体層１７０のチャンネル領域の面積と同一であるか、または小さく形成される。その理由は、第１半導体層１６０が第２半導体層１７０よりも面積が小さい場合が、第１半導体層１６０が第２半導体層１７０の面積と同一である場合よりも第１半導体層１６０内部に残留する金属触媒が第２半導体層１７０によく拡散されて結晶化に最も効果的であるためである。また、第１半導体層１６０が第２半導体層１７０のチャンネル領域の下部に対応するように形成した場合が、第２半導体層１７０のチャンネル領域の結晶化がより効果的であるからである。
【００３７】
前記第１半導体層１６０上部の第２半導体層１７０の表面は、触媒金属と直接接続しないので、表面をきれいに均一な状態に維持することができ、第１半導体層から触媒金属が均一に拡散するため結晶性も優れており、結晶化後の触媒金属は、第２半導体層１７０として構成した領域のみに移動するので、金属汚染による漏洩電流も改善することができる。このとき、前記第１半導体層１６０は第１ＳＧＳ結晶化領域であって、前記第２半導体層１７０は第２ＳＧＳ結晶化領域である。
【００３８】
図２Ｂに示すように、前記第１半導体層１６０及び第２半導体層１７０を含む基板１００全面にわたってゲート絶縁膜１８０を形成する。前記ゲート絶縁膜１８０は、シリコン酸化膜、シリコン窒化膜またはその二重層とすることができる。
【００３９】
続いて、前記ゲート絶縁膜１８０上に、アルミニウム（Ａｌ）またはアルミニウム−ネオジム（Ａｌ−Ｎｄ）のようなアルミニウム合金の単一層やクロム（Ｃｒ）またはモリブデン（Ｍｏ）合金の上にアルミニウム合金が積層された多重層をゲート電極用金属層（図示せず）として形成し、フォトエッチング工程により前記ゲート電極用金属層をエッチングして前記第１半導体層１７０のチャンネル領域に対応する部分にゲート電極１８５を形成する。
【００４０】
そして、前記ゲート電極１８５を含む基板１００全面にわたって層間絶縁膜１９０を形成する。ここで、前記層間絶縁膜１９０は、シリコン窒化膜、シリコン酸化膜またはその多重層とすることができる。
【００４１】
続いて、図２Ｃに示すように、前記層間絶縁膜１９０及び前記ゲート絶縁膜１８０をエッチングして前記第２半導体層１７０のソース／ドレイン領域を露出するコンタクトホールを形成する。前記コンタクトホールを介して前記ソース／ドレイン領域と接続するソース／ドレイン電極２００ａ、２００ｂを形成する。ここで、前記ソース／ドレイン電極２００ａ、２００ｂは、モリブデン（Ｍｏ）、クロム（Ｃｒ）、タングステン（Ｗ）、モリブデンタングステン（ＭｏＷ）、アルミニウム（Ａｌ）、アルミニウム−ネオジム（Ａｌ−Ｎｄ）、チタン（Ｔｉ）、窒化チタン（ＴｉＮ）、銅（Ｃｕ）、モリブデン合金（Ｍｏ ａｌｌｏｙ）、アルミニウム合金（Ａｌ ａｌｌｏｙ）、及び銅合金（Ｃｕ ａｌｌｏｙ）のうちから選択されるいずれか１つで形成することができる。これによって、前記半導体層１７０、前記ゲート電極１８５及び前記ソース／ドレイン電極２００ａ、２００ｂを含む薄膜トランジスタが完成される。
【００４２】
表１は、本発明の実施例に係る第２ＳＧＳ結晶化領域と従来の第１ＳＧＳ結晶化領域に形成した半導体層との特性を比較したものである。
【００４３】
【表１】
【００４４】
実施例は、上述したように、半導体層を、金属触媒を用いて第１金属触媒結晶化領域を形成し、前記第１金属触媒結晶化領域上に残留する金属触媒で２次的な結晶化を行って形成する第２金属触媒結晶化領域を形成し、半導体層として形成した第２ＳＧＳ結晶化領域で構成された半導体層である。そして比較例は、一般の金属触媒により第１金属触媒結晶化領域を形成した後にそれを半導体層として形成した第１ＳＧＳ結晶化領域で構成された半導体層である。
【００４５】
表１に示すように、第１金属触媒結晶化領域からのシード拡散により結晶化された第２ＳＧＳ結晶化領域の第２金属触媒結晶化領域で構成された半導体層は、第１ＳＧＳ結晶化領域の第１金属触媒結晶化領域で構成された半導体層よりもスレッショルド電圧が低く、かつ電子移動度が良好で、かつＳファクタも小さい。さらに、第２ＳＧＳ結晶化領域を有する実施例の第２金属触媒結晶化領域の場合、優れたオフ電流特性を有する。
【００４６】
図３Ａないし図３Ｃは、本発明の第１実施例に係る多結晶シリコン層の製造方法を用いて形成したボトムゲート薄膜トランジスタを製造する工程の断面図である。以下、特に言及した場合を除いては、前記実施例の説明を参照されたい。
【００４７】
図３Ａに示すように、基板３００上にバッファ層３１０を形成する。前記バッファ層３１０上にゲート電極用金属層（図示せず）を形成し、フォトエッチング工程で前記ゲート電極用金属層をエッチングしてゲート電極３２０を形成する。続いて、前記ゲート電極３２０を形成した前記基板３００上にゲート絶縁膜３３０を形成する。
【００４８】
その後、前記ゲート絶縁膜３３０上に第１非晶質シリコン層を形成し、図１の実施例のように金属触媒を用いて前記非晶質シリコン層を結晶化して第１ＳＧＳ結晶化領域の第１金属触媒結晶化領域３４０Ａを形成する。
【００４９】
続いて、図３Ｂに示すように、前記第１金属触媒結晶化領域３４０Ａをパターニングして前記ゲート電極３２０に対応するようにパターニングして第１半導体層３４０を形成する。前記第１半導体層３４０上に第２非晶質シリコン層を形成した後、第２非晶質シリコン層を第１実施例と同一方法で第１金属触媒結晶化領域内の残留金属触媒の拡散による第２金属触媒結晶化領域３５０Ａを形成する。
【００５０】
続いて、図３Ｃに示すように、前記第２金属触媒結晶化領域１７０Ａをパターニングして第２半導体層３５０を形成する。このとき、第２半導体層３５０は第１半導体層よりも面積が広くパターニングされ、第１半導体層３４０は第１実施例と同じく前記第２半導体層１７０のチャンネル領域下部に位置し、第２半導体層１７０のチャンネル領域の面積と同じであるか、または小さく形成する。前記第１半導体層３４０は第１ＳＧＳ結晶化領域であり、第２半導体層３５０は第２ＳＧＳ結晶化領域である。
【００５１】
続いて、図３Ｄに示すように、前記基板３００上にソース／ドレイン導電膜を形成してパターニングし、ソース／ドレイン電極３６０、３６１を形成する。ここで、前記ソース／ドレイン電極３６０、３６１は、モリブデン（Ｍｏ）、クロム（Ｃｒ）、タングステン（Ｗ）、モリブデンタングステン（ＭｏＷ）、アルミニウム（Ａｌ）、アルミニウム−ネオジム（Ａｌ−Ｎｄ）、チタン（Ｔｉ）、窒化チタン（ＴｉＮ）、銅（Ｃｕ）、モリブデン合金（Ｍｏ ａｌｌｏｙ）、アルミニウム合金（Ａｌ ａｌｌｏｙ）、及び銅合金（Ｃｕ ａｌｌｏｙ）のうちから選択されるいずれか１つで形成することができる。これにより、前記第１半導体層３４０、第２半導体層３５０、前記ゲート電極３２０及び前記ソース／ドレイン電極３６０、３６１を含むボトムゲート薄膜トランジスタが完成される。
【００５２】
図４は、本発明の第１実施例を用いて形成したトップゲート薄膜トランジスタを含む有機電界発光表示装置の断面図である。
【００５３】
図４に示すように、前記本発明の図２Ｃの実施例に係る薄膜トランジスタを含む前記基板１００全面に絶縁膜２１０を形成する。前記絶縁膜２１０は、無機膜であるシリコン酸化膜、シリコン窒化膜またはＳＯＧのうちから選択されるいずれか１つまたは有機膜であるポリイミド（ｐｏｌｙｉｍｉｄｅ）、ベンゾサイクロブテン系樹脂（ｂｅｎｚｏｃｙｃｌｏｂｕｔｅｎｅ ｓｅｒｉｅｓ ｒｅｓｉｎ）またはアクリレート（ａｃｒｙｌａｔｅ）のうちから選択されるいずれか１つで形成することができる。また前記無機膜と前記有機膜の積層構造に形成されることもできる。
【００５４】
前記絶縁膜２１０をエッチングして前記ソースまたはドレイン電極２００ａ、２００ｂを露出するビアホールを形成する。前記ビアホールを介して前記ソースまたはドレイン電極２００ａ、２００ｂのうちいずれか１つと接続する第１電極２２０を形成する。前記第１電極２２０はアノードまたはカソードに形成することができる。前記第１電極２２０がアノードの場合、前記アノードはＩＴＯ、ＩＺＯまたはＩＴＺＯのうちいずれか１つからなる透明導電膜で形成することができ、カソードの場合に前記カソードは、Ｍｇ、Ｃａ、Ａｌ、Ａｇ、Ｂａまたはその合金を用いて形成することができる。
【００５５】
続いて、前記第１電極２２０上に、前記第１電極２２０の表面一部を露出する開口部を有する画素定義膜２３０を形成し、前記露出した第１電極２２０上に発光層を含む有機膜層２４０を形成する。前記有機膜層２４０には正孔注入層、正孔輸送層、正孔抑制層、電子抑制層、電子注入層及び電子輸送層からなる群から選択される１つまたは複数の層をさらに含むことができる。続いて、前記有機膜層２４０上に第２電極２５０を形成する。これにより、本発明の一実施例に係る有機電界発光表示装置が完成される。
【００５６】
よって、本発明は、本発明の実施例に係る多結晶シリコン製造方法を用いる薄膜トランジスタ及び有機電界発光表示装置の半導体層は、従来のＳＧＳ法による半導体層よりも特性が向上された優れた素子であって、ディスプレイ用として最も効果的である。
【符号の説明】
【００５７】
１００ 基板
１１０ バッファ層
１２０ 第１非晶質シリコン層
１３０ 拡散層
１４０ 金属触媒層
１４０ａ、１４０ｂ 金属触媒
１５０、１５０’ 熱処理
１６０Ａ 第１金属触媒結晶化領域
１７０Ａ 第２金属触媒結晶化領域
【技術分野】
【０００１】
本発明は、多結晶シリコンの製造方法、薄膜トランジスタ、その製造方法及びこれを含む有機電界発光表示装置（ｆａｂｒｉｃａｔｉｎｇ ｍｅｔｈｏｄ ｏｆ ｐｏｌｙ ｓｉｌｉｃｏｎ， ｔｈｉｎ ｆｉｌｍ ｔｒａｎｓｉｓｔｏｒ， ｆａｂｒｉｃａｔｉｎｇ ｍｅｔｈｏｄ ｏｆ ｔｈｅ ｔｈｉｎ ｆｉｌｍ ｔｒａｎｓｉｓｔｏｒ， ａｎｄ ｏｒｇａｎｉｃ ｌｉｇｈｔｉｎｇ ｅｍｉｔｔｉｎｇ ｄｉｏｄｅ ｄｉｓｐｌａｙ ｄｅｖｉｃｅ ｃｏｍｐｒｉｓｉｎｇ ｔｈｅ ｓａｍｅ）に関し、より詳しくは、金属触媒を用いて結晶化される半導体層の金属触媒の濃度を調節して電気的特性が優れる薄膜トランジスタ、その製造方法、及びこれを含む有機電界発光表示装置に関する。
【背景技術】
【０００２】
一般に、多結晶シリコン層は、高い電界効果移動度と高速動作回路への適用が可能であり、ＣＭＯＳ回路構成が可能であるという長所を有し、薄膜トランジスタ用半導体層の用途によく用いられる。このような多結晶シリコン層を用いた薄膜トランジスタは、主にアクティブマトリクス液晶ディスプレイ装置（ＡＭＬＣＤ）の能動素子と有機電界発光素子（ＯＬＥＤ）のスイッチング素子及び駆動素子に用いられる。
【０００３】
前記非晶質シリコンを多結晶シリコンに結晶化する方法には、固相結晶化法（Ｓｏｌｉｄ Ｐｈａｓｅ Ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）、エキシマレーザ結晶化法（Ｅｘｃｉｍｅｒ Ｌａｓｅｒ Ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）、金属誘導結晶化法（ＭＩＣ，Ｍｅｔａｌ Ｉｎｄｕｃｅｄ Ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）及び金属誘導側面結晶化法（ＭＩＬＣ，Ｍｅｔａｌ Ｉｎｄｕｃｅｄ Ｌａｔｅｒａｌ Ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）などがある。そこで、固相結晶化法は、非晶質シリコン層を、薄膜トランジスタを用いるディスプレイ素子基板を形成する物質であるガラスの変形温度である約７００℃以下で数時間〜数十時間にかけてアニーリングする方法であり、エキシマレーザ結晶化法は、エキシマレーザを、非晶質シリコン層に走査して最短時間の間に局所的に高い温度で加熱して結晶化する方法であり、金属誘導結晶化法は、ニッケル、パラジウム、金、アルミニウムなどの金属を、非晶質シリコン層に接触させるか、または注入して前記金属によって非晶質シリコン層が多結晶シリコン層に相変化を誘導する現象を利用する方法であり、金属誘導側面結晶化法は、金属とシリコンとが反応して生成したシリサイドが側面に継続的に伝播されながら順に非晶質シリコン層の結晶化を誘導する方法を利用する結晶化方法である。
【０００４】
しかし、前記の固相結晶化法は、工程時間が長く高温で長時間熱処理することになるので、基板が変形しやすいという短所を有し、エキシマレーザ結晶化法は、高価なレーザ装置が必要であるとともに、多結晶化した表面に突起（ｐｒｏｔｒｕｓｉｏｎ）が発生するため、半導体層とゲート絶縁膜との界面特性が悪くなるという短所がある。
【０００５】
現在において、金属を用いて非晶質シリコン層を結晶化する方法は、固相結晶化方法よりも低い温度で早期時間内に結晶化することのできる長所を有しているため、多く研究されている。金属を利用した結晶化方法は、金属誘導結晶化（ＭＩＣ）方法、金属誘導側面結晶化（ＭＩＬＣ）方法及びＳＧＳ結晶化方法などがある。
【０００６】
薄膜トランジスタの特性を決定する主要素の１つが漏洩電流であって、特に、前記の金属触媒を用いて結晶化した半導体層では、前記金属触媒がチャンネル領域に残留して漏洩電流が増加される。したがって、チャンネル領域での残留金属触媒の濃度を制御しないと、薄膜トランジスタの漏洩電流が増加して電気的特性が低下するという問題がある。
【先行技術文献】
【特許文献】
【０００７】
【特許文献１】大韓民国出願第２００６−００５８７７４号明細書
【発明の概要】
【発明が解決しようとする課題】
【０００８】
本発明は、上記の従来技術の問題点を解決するためのものであって、金属触媒を用いて結晶化した半導体層を用いる薄膜トランジスタにおいて、前記半導体層に残留する残留金属触媒を最小化し、特性が向上された薄膜トランジスタとその製造方法及び前記薄膜トランジスタを含む有機電界発光表示装置とその製造方法を提供することに目的がある。
【課題を解決するための手段】
【０００９】
本発明は薄膜トランジスタ、その製造方法及びそれを含む有機電界発光表示装置に関し、基板と、前記基板上に位置するバッファ層と、前記バッファ層上に位置する第１半導体層及び第２半導体層と、前記第１半導体層及び第２半導体層と絶縁されるゲート電極と、前記第１半導体層及び第２半導体層と前記ゲート電極とを絶縁するゲート絶縁膜と、前記ゲート電極と絶縁され、前記第２半導体層と一部が接続するソース／ドレインである電極とを含み、前記第２半導体層は前記第１半導体層の下部に位置し、前記第１半導体層の面積は第２半導体層の面積よりも小さいことを特徴とする薄膜トランジスタ及びその製造方法を提供する。
【００１０】
また、基板と、前記基板上に位置するバッファ層と、前記バッファ層上に位置する第１半導体層と、前記第１半導体層上に位置する第２半導体層と、前記第１半導体層及び第２半導体層と絶縁されているゲート電極と、前記第１半導体層及び第２半導体層と前記ゲート電極とを絶縁するゲート絶縁膜と、前記ゲート電極と絶縁され、前記第２半導体層と一部が接続するソース／ドレイン電極と、前記ソース／ドレイン電極上に位置する絶縁膜と、前記絶縁膜上に位置して前記ソース／ドレイン電極と電気的に接続する第１電極、有機膜層及び第２電極とを含み、前記第２半導体層は前記第１半導体層の下部に位置し、前記第１半導体層の面積は第２半導体層の面積よりも小さいことを特徴とする有機電界発光表示装置を提供する。
【発明の効果】
【００１１】
本発明によれば、金属触媒を用いて結晶化した半導体層を含む薄膜トランジスタ及びその製造方法とそれを含む有機電界発光表示装置を提供することによって、従来の金属触媒を用いて結晶化した半導体層よりも結晶粒が大きくて残留金属が少ない優れた半導体層を形成する方法を提供することができ、スレッショルド電圧、Ｉｏｆｆ特性が向上された薄膜トランジスタ及びその製造方法とそれを含む有機電界発光表示装置を提供することができ、特性が向上された素子を生産することができる。
【図面の簡単な説明】
【００１２】
【図１Ａ】本発明に係る多結晶シリコン層の製造方法を示す図である。
【図１Ｂ】本発明に係る多結晶シリコン層の製造方法を示す図である。
【図１Ｃ】本発明に係る多結晶シリコン層の製造方法を示す図である。
【図１Ｄ】本発明に係る多結晶シリコン層の製造方法を示す図である。
【図１Ｅ】本発明に係る多結晶シリコン層の製造方法を示す図である。
【図１Ｆ】本発明に係る多結晶シリコン層の製造方法を示す図である。
【図１Ｇ】本発明に係る第１金属触媒結晶化領域を示す写真である。
【図１Ｈ】本発明に係る第２金属触媒結晶化領域を示す写真である。
【図２Ａ】本発明に係るトップゲート薄膜トランジスタを示す図である。
【図２Ｂ】本発明に係るトップゲート薄膜トランジスタを示す図である。
【図２Ｃ】本発明に係るトップゲート薄膜トランジスタを示す図である。
【図３Ａ】本発明に係るボトムゲート薄膜トランジスタを示す図である。
【図３Ｂ】本発明に係るボトムゲート薄膜トランジスタを示す図である。
【図３Ｃ】本発明に係るボトムゲート薄膜トランジスタを示す図である。
【図３Ｄ】本発明に係るボトムゲート薄膜トランジスタを示す図である。
【図４】本発明に係る有機電界発光表示装置を示す図である。
【発明を実施するための形態】
【００１３】
以上、添付図面を参照しながら本発明の好適な実施形態について詳細に説明したが、本発明はかかる例に限定されない。本発明の属する技術の分野における通常の知識を有する者であれば、特許請求の範囲に記載された技術的思想の範囲内において、各種の変更例または修正例に想到し得ることは明らかであり、これらについても、当然に本発明の技術的範囲に属するものと理解される。
【００１４】
図１Ａ及び図１Ｅは、本発明の第１実施例に係る結晶化工程の断面図である。
図１Ａに示すように、ガラスまたはプラスチックの基板１００上にバッファ層１１０を形成する。前記バッファ層１１０は、化学気相蒸着（Ｃｈｅｍｉｃａｌ Ｖａｐｏｒ Ｄｅｐｏｓｉｔｉｏｎ）法または物理気相蒸着（Ｐｈｙｓｉｃａｌ Ｖａｐｏｒ Ｄｅｐｏｓｉｔｉｏｎ）法を利用してシリコン酸化膜、シリコン窒化膜のような絶縁膜を用いて断層またはその積層構造で形成される。このとき、前記バッファ層１１０は、前記基板１００から発生する水分や不純物の拡散を防止する、または結晶化時に熱伝達速度を調節することによって、非晶質シリコン層の結晶化が好ましく行えるような役割をする。
【００１５】
続いて、前記バッファ層１１０上に、第１非晶質シリコン層１２０を形成する。このとき、前記非晶質シリコン層１２０は化学気相蒸着法または物理気相蒸着法を利用することができる。また、前記第１非晶質シリコン層１２０を形成する際、または、形成した後に脱水素処理して水素の濃度を低くする工程を行うことができる。
【００１６】
次に、前記第１非晶質シリコン層１２０を多結晶シリコン層に結晶化する。本発明では、ＭＩＣ（Ｍｅｔａｌ Ｉｎｄｕｃｅｄ Ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）法、ＭＩＬＣ（Ｍｅｔａｌ Ｉｎｄｕｃｅｄ Ｌａｔｅｒａｌ Ｃｒｙｓｔａｌｌｉｚａｔｉｏｎ）法またはＳＧＳ（Ｓｕｐｅｒ Ｇｒａｉｎ Ｓｉｌｉｃｏｎ）法などのような金属触媒を利用した結晶化方法を用いて前記第１非晶質シリコン層を多結晶シリコン層に結晶化する。このとき、結晶化された多結晶シリコン層領域を第１金属触媒結晶化領域として定義する。
【００１７】
以下、本発明では、前記結晶化法の中で好ましい実施形態であるＳＧＳ結晶化法について説明する。
【００１８】
前記ＳＧＳ法は、非晶質シリコン層に拡散する金属触媒の濃度を低濃度に調節して結晶粒の大きさを数μｍないし数百μｍまで調節できる結晶化方法である。前記非晶質シリコン層に拡散する金属触媒の濃度を低濃度に調節するための一実施例として、前記非晶質シリコン層上に拡散層を形成し、前記拡散層上に金属触媒層を形成した後に熱処理して金属触媒を拡散することができ、工程によっては拡散層を形成しないで金属触媒層を低濃度で形成するなどで、拡散する金属触媒の濃度を低濃度に調節することもできる。図１Ｂは、前記第１非晶質シリコン層上に拡散層と金属触媒層を形成する工程の断面図である。
【００１９】
図１Ｂに示すように、前記第１非晶質シリコン１２０上に拡散層１３０が形成される。このとき、前記拡散層１３０は、後工程から形成される金属触媒が熱処理工程を介して拡散できるシリコン窒化膜で形成することが好ましく、シリコン窒化膜とシリコン酸化膜との複層を用いることができる。前記拡散層１３０は、化学気相蒸着法または物理気相蒸着法などのような方法で形成される。このとき、前記拡散層１３０の厚さは１〜２０００Åで形成される。前記拡散層１３０の厚さが１Å未満である場合は、前記拡散層１３０が拡散される金属触媒の量を阻止することが困難で、２０００Åを超える場合は前記非晶質シリコン層１２０に拡散される金属触媒の量が少なくて多結晶シリコン層に結晶化することが困難となる。
【００２０】
続いて、前記拡散層１３０上に金属触媒を蒸着して金属触媒層１４０を形成する。このとき、前記金属触媒は、Ｎｉ、Ｐｄ、Ａｇ、Ａｕ、Ａｌ、Ｓｎ、Ｓｂ、Ｃｕ、Ｔｒ、及びＣｄからなる群から選択されるいずれか１つを用いることができるが、好ましくは、ニッケル（Ｎｉ）を用いる。このとき、前記金属触媒層１４０は、前記拡散層１３０上に１０１１〜１０１５ａｔｏｍｓ／ｃｍ２の面密度に形成されるが、前記金属触媒が１０１１ａｔｏｍｓ／ｃｍ２の面密度よりも少なく形成した場合は結晶化の核であるシードの量が少なく前記第１非晶質シリコン層がＳＧＳ法による多結晶シリコン層に結晶化することが困難であって、前記金属触媒が１０１５ａｔｏｍｓ／ｃｍ２の面密度よりも多く形成された場合は第１非晶質シリコン層に拡散する金属触媒の量が多くて多結晶シリコン層の結晶粒が小さくなり、また、残留する金属触媒量が多くなって、前記多結晶シリコン層をパターニングして形成する半導体層の特性が低下されることになる。
【００２１】
図１Ｃは、前記基板を熱処理して金属触媒を、拡散層を介して拡散させ、第１非晶質シリコン層の界面に移動させる工程の断面図である。
【００２２】
図１Ｃに示すように、前記バッファ層１１０、第１非晶質シリコン層１２０、拡散層１３０及び金属触媒層１４０が形成された前記基板１００を熱処理１５０し、前記金属触媒層１４０の金属触媒のうちの一部を前記第１非晶質シリコン層１２０の表面に移動させる。すなわち、前記熱処理１５０により前記拡散層１３０を通過して拡散する金属触媒１４０ａ、１４０ｂのうち、微量の金属触媒１４０ｂだけが前記第１非晶質シリコン層１２０の表面に拡散し、殆どの金属触媒１４０ａは前記非晶質シリコン層１２０に到達しないか、または前記拡散層１３０を通過することができない。
【００２３】
したがって、前記拡散層１３０の拡散阻止能力により前記第１非晶質シリコン層１２０の表面に到達する金属触媒量が決定されるが、前記拡散層１３０の拡散阻止能力は前記拡散層１３０の厚さと密接な関係がある。すなわち、前記拡散層１３０の厚さが厚いほど拡散する量は小さいので結晶粒の大きさは大きくなり、厚さが薄いほど拡散する量は多くなるので結晶粒の大きさは小さくなる。
【００２４】
このとき、前記熱処理１５０の工程は、２００〜９００℃、好ましくは３５０〜５００℃の温度範囲で数秒ないし数時間の間行って前記金属触媒を拡散することになるが、この温度及び時間で行った場合には過度な熱処理工程による基板の変形などを防止することができ、製造コストや収率の観点から好ましい。前記熱処理１５０工程は、炉（ｆｕｒｎａｃｅ）工程、ＲＴＡ（Ｒａｐｉｄ Ｔｈｅｒｍａｌ Ａｎｎｅａｌｉｎｇ）工程、ＵＶ工程またはレーザ（Ｌａｓｅｒ）工程のうちいずれか１つの工程を用いることができる。
【００２５】
図１Ｄは、拡散する金属触媒により第１非晶質シリコン層が多結晶シリコン層に結晶化する工程の断面図である。
【００２６】
図１Ｄに示すように、前記拡散層１３０を通過して前記第１非晶質シリコン層１２０の表面に拡散する金属触媒１４０ｂにより前記第１非晶質シリコン層１２０が第１金属触媒結晶化領域１６０Ａに結晶化される。すなわち、前記拡散する金属触媒１４０ｂが非晶質シリコン層のシリコンと結合して金属シリサイドを形成し、前記金属シリサイドが結晶化核であるシードを形成し、非晶質シリコン層が多結晶シリコン層に結晶化されて第１金属触媒結晶化領域を形成し、第１金属触媒結晶化領域を第１ＳＧＳ結晶化領域として定義する。
【００２７】
一方、図１Ｄでは、前記拡散層１３０と金属触媒層１４０とを除去せず、前記熱処理１５０工程を行ったが、金属触媒を前記第１非晶質シリコン層１２０上に拡散させて結晶化核である金属シリサイドを形成した後、前記拡散層１３０と金属触媒層１４０とを除去して熱処理することによって多結晶シリコン層を形成させてもよい。
【００２８】
図１Ｅに示すように、第１ＳＧＳ結晶化領域である第１金属触媒結晶化領域１６０Ａをパターニングして島状に形成した後、基板１００全面に第２晶質シリコン層を形成した後、前記第１金属触媒結晶化領域１６０Ａを形成する場合と同じく熱処理１５０’して第２金属触媒結晶化領域１７０Ａに結晶化する。
【００２９】
このような熱処理によって前記第２非晶質シリコン層は結晶化されて、第２金属触媒結晶化領域１７０Ａを活性化することで、前記第２金属触媒結晶化領域１７０Ａは前記第１金属触媒結晶化領域１６０Ａに残留している残留金属触媒により結晶化されたもので、残留金属触媒量は第２金属触媒結晶化領域１７０Ａの量が第１金属触媒結晶化領域１６０Ａの量よりも少ない。前記第２金属触媒結晶化領域１７０Ａは第２ＳＧＳ結晶化領域に定義し、前記第２ＳＧＳ結晶化領域は前記第１ＳＧＳ結晶化領域からの残留金属触媒が拡散されて結晶化された領域である。
【００３０】
また、前記第２ＳＧＳ結晶化領域である第２金属触媒結晶化領域１７０Ａの結晶粒は、第１ＳＧＳ結晶化領域である第１金属触媒結晶化領域１６０Ａの結晶粒大きさの３〜４倍程度の大きさを有する特徴がある。そして、前記結晶化領域の表面をエッチングして観察すると、第１金属触媒結晶化領域１６０Ａの表面にはシードが存在する一方、第２金属触媒結晶化領域１７０Ａには下部にシードが形成して上部に成長するためシードが表面から見えなく結晶粒境界が不鮮明で不明確である。したがって、第２金属触媒結晶化領域は第１金属触媒結晶化領域よりも結晶粒境界が少なく含まれ、また、少なく含まれるため電荷移動に対するベリアが少なく含まれるので電気的特性が優れる。
【００３１】
図１Ｇは前記第１金属触媒結晶化領域１６０Ａの表面を撮影した写真であり、図１Ｈは前記第２金属触媒結晶化領域１７０Ａの表面を撮影した写真である。
【００３２】
図１Ｇ及び図１Ｈに示すように、図１Ｇは前記第１金属触媒結晶化領域の表面であって、前述したように、結晶粒内のシードを目で確認することができ、グレインバウンダリ（ｇｒａｉｎ ｂｏｕｎｄａｒｙ）が明確である。しかし、第１金属触媒結晶化領域内の残留金属触媒により結晶化された第２金属触媒結晶化領域を詳細に観察すると、結晶粒の境界が明確でなくてグレインバウンダリが不鮮明であり、シードも存在しない。前記第２金属触媒結晶化領域は、下部の第１金属触媒結晶化領域と第２金属触媒結晶化領域とが付き合っている部分にシードが存在し、その部分から結晶が成長するためシリコン層を複数回エッチングすることによって第２金属触媒結晶化領域の下部にシードが存在することを分かる。そして、前記第２金属触媒結晶化領域は、第１金属触媒結晶化領域の残留金属触媒により結晶化されるので、第２金属触媒結晶化領域の残留金属触媒量が第１金属触媒結晶化領域の残留金属触媒量よりも少ない。
【００３３】
よって、上記の相違点から第１ＳＧＳ結晶化領域である第１金属触媒結晶化領域と第２ＳＧＳ結晶化領域である第２金属触媒結晶化領域とを判別することができる。
【００３４】
図２Ａないし図２Ｃでは、本発明の第１実施例に係る多結晶シリコン層の製造方法を用いてトップゲート薄膜トランジスタを製造する工程を示す断面図である。
【００３５】
図２Ａに示すように、図１Ｇの前記第１金属触媒結晶化領域１６０Ａ及び第２金属触媒結晶化領域１７０Ａを含む基板１００を用意する。このとき、前記第１金属触媒結晶化領域１６０Ａは島状にパターニングされた後に第２金属触媒結晶化領域１７０Ａを結晶化し、前記パターニングされた第１金属触媒結晶化領域は第１半導体層１６０に定義される。
【００３６】
前記第２金属触媒結晶化領域１７０Ａをパターニングして第２半導体層１７０として形成する。このとき、第２半導体層１７０は第１半導体層よりも面積が広くパターニングし、好ましくは第１半導体層１６０が前記第２半導体層１７０のチャンネル領域下部に位置し、第２半導体層１７０のチャンネル領域の面積と同一であるか、または小さく形成される。その理由は、第１半導体層１６０が第２半導体層１７０よりも面積が小さい場合が、第１半導体層１６０が第２半導体層１７０の面積と同一である場合よりも第１半導体層１６０内部に残留する金属触媒が第２半導体層１７０によく拡散されて結晶化に最も効果的であるためである。また、第１半導体層１６０が第２半導体層１７０のチャンネル領域の下部に対応するように形成した場合が、第２半導体層１７０のチャンネル領域の結晶化がより効果的であるからである。
【００３７】
前記第１半導体層１６０上部の第２半導体層１７０の表面は、触媒金属と直接接続しないので、表面をきれいに均一な状態に維持することができ、第１半導体層から触媒金属が均一に拡散するため結晶性も優れており、結晶化後の触媒金属は、第２半導体層１７０として構成した領域のみに移動するので、金属汚染による漏洩電流も改善することができる。このとき、前記第１半導体層１６０は第１ＳＧＳ結晶化領域であって、前記第２半導体層１７０は第２ＳＧＳ結晶化領域である。
【００３８】
図２Ｂに示すように、前記第１半導体層１６０及び第２半導体層１７０を含む基板１００全面にわたってゲート絶縁膜１８０を形成する。前記ゲート絶縁膜１８０は、シリコン酸化膜、シリコン窒化膜またはその二重層とすることができる。
【００３９】
続いて、前記ゲート絶縁膜１８０上に、アルミニウム（Ａｌ）またはアルミニウム−ネオジム（Ａｌ−Ｎｄ）のようなアルミニウム合金の単一層やクロム（Ｃｒ）またはモリブデン（Ｍｏ）合金の上にアルミニウム合金が積層された多重層をゲート電極用金属層（図示せず）として形成し、フォトエッチング工程により前記ゲート電極用金属層をエッチングして前記第１半導体層１７０のチャンネル領域に対応する部分にゲート電極１８５を形成する。
【００４０】
そして、前記ゲート電極１８５を含む基板１００全面にわたって層間絶縁膜１９０を形成する。ここで、前記層間絶縁膜１９０は、シリコン窒化膜、シリコン酸化膜またはその多重層とすることができる。
【００４１】
続いて、図２Ｃに示すように、前記層間絶縁膜１９０及び前記ゲート絶縁膜１８０をエッチングして前記第２半導体層１７０のソース／ドレイン領域を露出するコンタクトホールを形成する。前記コンタクトホールを介して前記ソース／ドレイン領域と接続するソース／ドレイン電極２００ａ、２００ｂを形成する。ここで、前記ソース／ドレイン電極２００ａ、２００ｂは、モリブデン（Ｍｏ）、クロム（Ｃｒ）、タングステン（Ｗ）、モリブデンタングステン（ＭｏＷ）、アルミニウム（Ａｌ）、アルミニウム−ネオジム（Ａｌ−Ｎｄ）、チタン（Ｔｉ）、窒化チタン（ＴｉＮ）、銅（Ｃｕ）、モリブデン合金（Ｍｏ ａｌｌｏｙ）、アルミニウム合金（Ａｌ ａｌｌｏｙ）、及び銅合金（Ｃｕ ａｌｌｏｙ）のうちから選択されるいずれか１つで形成することができる。これによって、前記半導体層１７０、前記ゲート電極１８５及び前記ソース／ドレイン電極２００ａ、２００ｂを含む薄膜トランジスタが完成される。
【００４２】
表１は、本発明の実施例に係る第２ＳＧＳ結晶化領域と従来の第１ＳＧＳ結晶化領域に形成した半導体層との特性を比較したものである。
【００４３】
【表１】
【００４４】
実施例は、上述したように、半導体層を、金属触媒を用いて第１金属触媒結晶化領域を形成し、前記第１金属触媒結晶化領域上に残留する金属触媒で２次的な結晶化を行って形成する第２金属触媒結晶化領域を形成し、半導体層として形成した第２ＳＧＳ結晶化領域で構成された半導体層である。そして比較例は、一般の金属触媒により第１金属触媒結晶化領域を形成した後にそれを半導体層として形成した第１ＳＧＳ結晶化領域で構成された半導体層である。
【００４５】
表１に示すように、第１金属触媒結晶化領域からのシード拡散により結晶化された第２ＳＧＳ結晶化領域の第２金属触媒結晶化領域で構成された半導体層は、第１ＳＧＳ結晶化領域の第１金属触媒結晶化領域で構成された半導体層よりもスレッショルド電圧が低く、かつ電子移動度が良好で、かつＳファクタも小さい。さらに、第２ＳＧＳ結晶化領域を有する実施例の第２金属触媒結晶化領域の場合、優れたオフ電流特性を有する。
【００４６】
図３Ａないし図３Ｃは、本発明の第１実施例に係る多結晶シリコン層の製造方法を用いて形成したボトムゲート薄膜トランジスタを製造する工程の断面図である。以下、特に言及した場合を除いては、前記実施例の説明を参照されたい。
【００４７】
図３Ａに示すように、基板３００上にバッファ層３１０を形成する。前記バッファ層３１０上にゲート電極用金属層（図示せず）を形成し、フォトエッチング工程で前記ゲート電極用金属層をエッチングしてゲート電極３２０を形成する。続いて、前記ゲート電極３２０を形成した前記基板３００上にゲート絶縁膜３３０を形成する。
【００４８】
その後、前記ゲート絶縁膜３３０上に第１非晶質シリコン層を形成し、図１の実施例のように金属触媒を用いて前記非晶質シリコン層を結晶化して第１ＳＧＳ結晶化領域の第１金属触媒結晶化領域３４０Ａを形成する。
【００４９】
続いて、図３Ｂに示すように、前記第１金属触媒結晶化領域３４０Ａをパターニングして前記ゲート電極３２０に対応するようにパターニングして第１半導体層３４０を形成する。前記第１半導体層３４０上に第２非晶質シリコン層を形成した後、第２非晶質シリコン層を第１実施例と同一方法で第１金属触媒結晶化領域内の残留金属触媒の拡散による第２金属触媒結晶化領域３５０Ａを形成する。
【００５０】
続いて、図３Ｃに示すように、前記第２金属触媒結晶化領域１７０Ａをパターニングして第２半導体層３５０を形成する。このとき、第２半導体層３５０は第１半導体層よりも面積が広くパターニングされ、第１半導体層３４０は第１実施例と同じく前記第２半導体層１７０のチャンネル領域下部に位置し、第２半導体層１７０のチャンネル領域の面積と同じであるか、または小さく形成する。前記第１半導体層３４０は第１ＳＧＳ結晶化領域であり、第２半導体層３５０は第２ＳＧＳ結晶化領域である。
【００５１】
続いて、図３Ｄに示すように、前記基板３００上にソース／ドレイン導電膜を形成してパターニングし、ソース／ドレイン電極３６０、３６１を形成する。ここで、前記ソース／ドレイン電極３６０、３６１は、モリブデン（Ｍｏ）、クロム（Ｃｒ）、タングステン（Ｗ）、モリブデンタングステン（ＭｏＷ）、アルミニウム（Ａｌ）、アルミニウム−ネオジム（Ａｌ−Ｎｄ）、チタン（Ｔｉ）、窒化チタン（ＴｉＮ）、銅（Ｃｕ）、モリブデン合金（Ｍｏ ａｌｌｏｙ）、アルミニウム合金（Ａｌ ａｌｌｏｙ）、及び銅合金（Ｃｕ ａｌｌｏｙ）のうちから選択されるいずれか１つで形成することができる。これにより、前記第１半導体層３４０、第２半導体層３５０、前記ゲート電極３２０及び前記ソース／ドレイン電極３６０、３６１を含むボトムゲート薄膜トランジスタが完成される。
【００５２】
図４は、本発明の第１実施例を用いて形成したトップゲート薄膜トランジスタを含む有機電界発光表示装置の断面図である。
【００５３】
図４に示すように、前記本発明の図２Ｃの実施例に係る薄膜トランジスタを含む前記基板１００全面に絶縁膜２１０を形成する。前記絶縁膜２１０は、無機膜であるシリコン酸化膜、シリコン窒化膜またはＳＯＧのうちから選択されるいずれか１つまたは有機膜であるポリイミド（ｐｏｌｙｉｍｉｄｅ）、ベンゾサイクロブテン系樹脂（ｂｅｎｚｏｃｙｃｌｏｂｕｔｅｎｅ ｓｅｒｉｅｓ ｒｅｓｉｎ）またはアクリレート（ａｃｒｙｌａｔｅ）のうちから選択されるいずれか１つで形成することができる。また前記無機膜と前記有機膜の積層構造に形成されることもできる。
【００５４】
前記絶縁膜２１０をエッチングして前記ソースまたはドレイン電極２００ａ、２００ｂを露出するビアホールを形成する。前記ビアホールを介して前記ソースまたはドレイン電極２００ａ、２００ｂのうちいずれか１つと接続する第１電極２２０を形成する。前記第１電極２２０はアノードまたはカソードに形成することができる。前記第１電極２２０がアノードの場合、前記アノードはＩＴＯ、ＩＺＯまたはＩＴＺＯのうちいずれか１つからなる透明導電膜で形成することができ、カソードの場合に前記カソードは、Ｍｇ、Ｃａ、Ａｌ、Ａｇ、Ｂａまたはその合金を用いて形成することができる。
【００５５】
続いて、前記第１電極２２０上に、前記第１電極２２０の表面一部を露出する開口部を有する画素定義膜２３０を形成し、前記露出した第１電極２２０上に発光層を含む有機膜層２４０を形成する。前記有機膜層２４０には正孔注入層、正孔輸送層、正孔抑制層、電子抑制層、電子注入層及び電子輸送層からなる群から選択される１つまたは複数の層をさらに含むことができる。続いて、前記有機膜層２４０上に第２電極２５０を形成する。これにより、本発明の一実施例に係る有機電界発光表示装置が完成される。
【００５６】
よって、本発明は、本発明の実施例に係る多結晶シリコン製造方法を用いる薄膜トランジスタ及び有機電界発光表示装置の半導体層は、従来のＳＧＳ法による半導体層よりも特性が向上された優れた素子であって、ディスプレイ用として最も効果的である。
【符号の説明】
【００５７】
１００ 基板
１１０ バッファ層
１２０ 第１非晶質シリコン層
１３０ 拡散層
１４０ 金属触媒層
１４０ａ、１４０ｂ 金属触媒
１５０、１５０’ 熱処理
１６０Ａ 第１金属触媒結晶化領域
１７０Ａ 第２金属触媒結晶化領域
【特許請求の範囲】
【請求項１】
基板と、
前記基板上に位置するバッファ層と、
前記バッファ層上に位置する第１半導体層及び第２半導体層と、
前記第１半導体層及び第２半導体層と絶縁されるゲート電極と、
前記第１半導体層及び第２半導体層と前記ゲート電極とを絶縁させるゲート絶縁膜と、
前記ゲート電極と絶縁され、前記第２半導体層と一部が接続するソース／ドレイン電極をと、を含み、
前記第１半導体層は前記第２半導体層の下部に位置し、前記第１半導体層の面積は第２半導体層の面積よりも小さいことを特徴とする薄膜トランジスタ。
【請求項２】
前記第１半導体層及び第２半導体層は、金属触媒による多結晶シリコン層であることを特徴とする請求項１に記載の薄膜トランジスタ。
【請求項３】
前記第１半導体層は第１ＳＧＳ結晶化領域であり、前記第２半導体層は第２ＳＧＳ結晶化領域であることを特徴とする請求項１に記載の薄膜トランジスタ。
【請求項４】
前記第１半導体層は、前記第２半導体層のチャンネル領域の下部に位置することを特徴とする請求項１に記載の薄膜トランジスタ。
【請求項５】
前記第２半導体層の結晶粒の大きさは、前記第１半導体層の結晶粒の大きさよりも大きいことを特徴とする請求項１に記載の薄膜トランジスタ。
【請求項６】
基板と、
前記基板上に位置するバッファ層と、
前記バッファ層上に位置する第１半導体層及び第２半導体層と、
前記基板全面にわたって位置するゲート絶縁膜と、
前記ゲート絶縁膜上に位置する第１半導体層及び第２半導体層と、
前記第２半導体層と一部が接続するソース／ドレイン電極と、を含み、
前記第１半導体層上部に第２半導体層が位置することを特徴とする請求項１に記載の薄膜トランジスタ。
【請求項７】
基板と、
前記基板上に位置するバッファ層と、
前記バッファ層上に位置するゲート電極と、
前記ゲート電極を含む基板全面にわたって位置するゲート絶縁膜と、
前記ゲート絶縁膜上に位置し、前記ゲート電極に対応されるように位置する第１半導体層及び第２半導体層と、
前記第２半導体層と一部が接続するソース／ドレイン電極と、を含み、
前記第１半導体層上部に第２半導体層が位置することを特徴とする請求項１に記載の薄膜トランジスタ。
【請求項８】
基板を用意する工程と、
前記基板上に位置するバッファ層を形成する工程と、
前記バッファ層上に第１半導体層を形成する工程と、
前記第１半導体層上に第２半導体層を形成する工程と、
前記基板全面にわたってゲート絶縁膜を形成する工程と、
前記ゲート絶縁膜上にゲート電極を形成する工程と、
前記ゲート電極と絶縁され、前記第２半導体層と一部が接続するソース／ドレイン電極を形成する工程と、を含み、
前記第１半導体層及び第２半導体層は金属触媒に結晶化された多結晶シリコン層であり、前記第２半導体層は前記第１半導体層内の金属触媒で結晶化することを含み、前記第１半導体層の面積は前記第２半導体層の面積よりも小さく形成することを特徴とする薄膜トランジスタの製造方法。
【請求項９】
前記バッファ層上に第１半導体層を形成する工程と、前記第１半導体層上に第２半導体層を形成する工程とは、
前記バッファ層上に第１非晶質シリコン層を形成する工程と、
前記第１非晶質シリコン層上に金属触媒層を形成する工程と、
前記基板を熱処理して前記第１非晶質シリコン層を第１金属触媒結晶化領域に結晶化する工程と、
前記金属触媒層を除去する工程と、
前記第１金属触媒結晶化領域をパターニングして第１半導体層で形成する工程と、
前記第１半導体層上に第２非晶質シリコン層を形成する工程と、
前記第２非晶質シリコン層を熱処理して第２金属触媒結晶化領域に形成する工程と、
前記第２金属触媒結晶化領域をパターニングして第２半導体層に形成する工程と、
を含むことを特徴とする請求項８に記載の薄膜トランジスタの製造方法。
【請求項１０】
前記第１非晶質シリコン層と前記金属触媒層との間には、拡散層をさらに含めた後に結晶化を行うことを特徴とする請求項９に記載の薄膜トランジスタの製造方法。
【請求項１１】
前記熱処理は、３５０〜５００℃で行うことを特徴とする請求項９に記載の薄膜トランジスタの製造方法。
【請求項１２】
前記金属触媒層は、Ｎｉ、Ｐｄ、Ａｇ、Ａｕ、Ａｌ、Ｓｎ、Ｓｂ、Ｃｕ、Ｔｒ、及びＣｄからなる群から選択されるいずれか１つから形成することを特徴とする請求項９に記載の薄膜トランジスタの製造方法。
【請求項１３】
基板を用意する工程と、
前記基板上に位置するバッファ層を形成する工程と、
前記バッファ層上にゲート電極を形成する工程と、
前記基板全面にわたってゲート絶縁膜を形成する工程と、
前記ゲート絶縁膜上に前記ゲート電極と対応するように第１半導体層を形成する工程と、
前記第１半導体層上に第２半導体層を形成する工程と、
前記第２半導体層の一部を開口し、前記第２半導体層と接続するソース／ドレイン電極を形成する工程と、を含み、
前記第１半導体層及び第２半導体層は金属触媒に結晶化した多結晶シリコン層であり、前記第２半導体層は前記第１半導体層内の金属触媒で結晶化することを含み、前記第１半導体層の面積は前記第２半導体層の面積よりも小さく形成することを特徴とする薄膜トランジスタの製造方法。
【請求項１４】
前記ゲート絶縁膜上に前記ゲート電極と対応するように第１半導体層を形成する工程と、前記第２半導体層を形成する工程とは、
前記ゲート絶縁膜上に第１非晶質シリコン層を形成する工程と、
前記第１非晶質シリコン層上に金属触媒層を形成する工程と、
前記基板を熱処理して前記第１非晶質シリコン層を第１金属触媒結晶化領域に結晶化する工程と、
前記第１金属触媒結晶化領域をパターニングして第１半導体層に形成する工程と、
前記第１半導体層上に第２非晶質シリコン層を形成する工程と、
前記第２非晶質シリコン層を熱処理して第２金属触媒結晶化領域に形成する工程と、
前記第２金属触媒結晶化領域をパターニングして第２半導体層に形成する工程と、含むことを特徴とする請求項１３に記載の薄膜トランジスタの製造方法。
【請求項１５】
前記第１非晶質シリコン層と前記金属触媒層との間には、拡散層をさらに含めた後に結晶化を行うことを特徴とする請求項１４に記載の薄膜トランジスタの製造方法。
【請求項１６】
前記熱処理は、３５０〜５００℃で行うことを特徴とする請求項１４に記載の薄膜トランジスタの製造方法。
【請求項１７】
前記金属触媒層は、Ｎｉ、Ｐｄ、Ａｇ、Ａｕ、Ａｌ、Ｓｎ、Ｓｂ、Ｃｕ、Ｔｒ、及びＣｄからなる群から選択されるいずれか１つから形成することを特徴とする請求項１４に記載の薄膜トランジスタの製造方法。
【請求項１８】
基板と、
前記基板上に位置するバッファ層と、
前記バッファ層上に位置する第１半導体層と、
前記第１半導体層上に位置する第２半導体層と、
前記第１半導体層及び第２半導体層と絶縁されるゲート電極と、
前記第１半導体層及び第２半導体層と前記ゲート電極とを絶縁させるゲート絶縁膜と、
前記ゲート電極と絶縁され、前記第２半導体層と一部が接続するソース／ドレイン電極と、
前記ソース／ドレイン電極上に位置する絶縁膜と、
前記絶縁膜上に位置して前記ソース／ドレイン電極と電気的に接続する第１電極、有機膜層及び第２電極と、を含み、
前記第１半導体層は前記第２半導体層の下部に位置し、前記第１半導体層の面積は第２半導体層の面積よりも小さいことを特徴とする有機電界発光表示装置。
【請求項１９】
前記第１半導体層及び第２半導体層は、金属触媒による多結晶シリコン層であることを特徴とする請求項１８に記載の有機電界発光表示装置。
【請求項２０】
前記第１半導体層は第１ＳＧＳ結晶化領域であり、前記第２半導体層は第２ＳＧＳ結晶化領域であることを特徴とする請求項１８に記載の有機電界発光表示装置。
【請求項２１】
前記第１半導体層は、前記第２半導体層のチャンネル領域の下部に位置することを特徴とする請求項１８に記載の有機電界発光表示装置。
【請求項２２】
前記第２半導体層の結晶粒の大きさは、前記第１半導体層の結晶粒の大きさよりも大きいことを特徴とする請求項１８に記載の有機電界発光表示装置。
【請求項２３】
基板と、
前記基板上に位置するバッファ層と、
前記バッファ層上に位置する第１半導体層及び第２半導体層と、
前記基板全面にわたって位置するゲート絶縁膜と、
前記ゲート絶縁膜上に位置する第１半導体層及び第２半導体層と、
前記第２半導体層と一部が接続するソース／ドレイン電極と、を含み、
前記第１半導体層上部に第２半導体層が位置することをさらに含むことを特徴とする請求項１８に記載の有機電界発光表示装置。
【請求項２４】
基板と、
前記基板上に位置するバッファ層と、
前記バッファ層上に位置するゲート電極と、
前記ゲート電極を含む基板全面にわたって位置するゲート絶縁膜と、
前記ゲート絶縁膜上に位置し、前記ゲート電極に対応するように位置する第１半導体層及び第２半導体層と、
前記第２半導体層と一部が接続するソース／ドレイン電極と、を含み、
前記第１半導体層上部に第２半導体層が位置することをさらに含むことを特徴とする請求項１８に記載の有機電界発光表示装置。
【請求項１】
基板と、
前記基板上に位置するバッファ層と、
前記バッファ層上に位置する第１半導体層及び第２半導体層と、
前記第１半導体層及び第２半導体層と絶縁されるゲート電極と、
前記第１半導体層及び第２半導体層と前記ゲート電極とを絶縁させるゲート絶縁膜と、
前記ゲート電極と絶縁され、前記第２半導体層と一部が接続するソース／ドレイン電極をと、を含み、
前記第１半導体層は前記第２半導体層の下部に位置し、前記第１半導体層の面積は第２半導体層の面積よりも小さいことを特徴とする薄膜トランジスタ。
【請求項２】
前記第１半導体層及び第２半導体層は、金属触媒による多結晶シリコン層であることを特徴とする請求項１に記載の薄膜トランジスタ。
【請求項３】
前記第１半導体層は第１ＳＧＳ結晶化領域であり、前記第２半導体層は第２ＳＧＳ結晶化領域であることを特徴とする請求項１に記載の薄膜トランジスタ。
【請求項４】
前記第１半導体層は、前記第２半導体層のチャンネル領域の下部に位置することを特徴とする請求項１に記載の薄膜トランジスタ。
【請求項５】
前記第２半導体層の結晶粒の大きさは、前記第１半導体層の結晶粒の大きさよりも大きいことを特徴とする請求項１に記載の薄膜トランジスタ。
【請求項６】
基板と、
前記基板上に位置するバッファ層と、
前記バッファ層上に位置する第１半導体層及び第２半導体層と、
前記基板全面にわたって位置するゲート絶縁膜と、
前記ゲート絶縁膜上に位置する第１半導体層及び第２半導体層と、
前記第２半導体層と一部が接続するソース／ドレイン電極と、を含み、
前記第１半導体層上部に第２半導体層が位置することを特徴とする請求項１に記載の薄膜トランジスタ。
【請求項７】
基板と、
前記基板上に位置するバッファ層と、
前記バッファ層上に位置するゲート電極と、
前記ゲート電極を含む基板全面にわたって位置するゲート絶縁膜と、
前記ゲート絶縁膜上に位置し、前記ゲート電極に対応されるように位置する第１半導体層及び第２半導体層と、
前記第２半導体層と一部が接続するソース／ドレイン電極と、を含み、
前記第１半導体層上部に第２半導体層が位置することを特徴とする請求項１に記載の薄膜トランジスタ。
【請求項８】
基板を用意する工程と、
前記基板上に位置するバッファ層を形成する工程と、
前記バッファ層上に第１半導体層を形成する工程と、
前記第１半導体層上に第２半導体層を形成する工程と、
前記基板全面にわたってゲート絶縁膜を形成する工程と、
前記ゲート絶縁膜上にゲート電極を形成する工程と、
前記ゲート電極と絶縁され、前記第２半導体層と一部が接続するソース／ドレイン電極を形成する工程と、を含み、
前記第１半導体層及び第２半導体層は金属触媒に結晶化された多結晶シリコン層であり、前記第２半導体層は前記第１半導体層内の金属触媒で結晶化することを含み、前記第１半導体層の面積は前記第２半導体層の面積よりも小さく形成することを特徴とする薄膜トランジスタの製造方法。
【請求項９】
前記バッファ層上に第１半導体層を形成する工程と、前記第１半導体層上に第２半導体層を形成する工程とは、
前記バッファ層上に第１非晶質シリコン層を形成する工程と、
前記第１非晶質シリコン層上に金属触媒層を形成する工程と、
前記基板を熱処理して前記第１非晶質シリコン層を第１金属触媒結晶化領域に結晶化する工程と、
前記金属触媒層を除去する工程と、
前記第１金属触媒結晶化領域をパターニングして第１半導体層で形成する工程と、
前記第１半導体層上に第２非晶質シリコン層を形成する工程と、
前記第２非晶質シリコン層を熱処理して第２金属触媒結晶化領域に形成する工程と、
前記第２金属触媒結晶化領域をパターニングして第２半導体層に形成する工程と、
を含むことを特徴とする請求項８に記載の薄膜トランジスタの製造方法。
【請求項１０】
前記第１非晶質シリコン層と前記金属触媒層との間には、拡散層をさらに含めた後に結晶化を行うことを特徴とする請求項９に記載の薄膜トランジスタの製造方法。
【請求項１１】
前記熱処理は、３５０〜５００℃で行うことを特徴とする請求項９に記載の薄膜トランジスタの製造方法。
【請求項１２】
前記金属触媒層は、Ｎｉ、Ｐｄ、Ａｇ、Ａｕ、Ａｌ、Ｓｎ、Ｓｂ、Ｃｕ、Ｔｒ、及びＣｄからなる群から選択されるいずれか１つから形成することを特徴とする請求項９に記載の薄膜トランジスタの製造方法。
【請求項１３】
基板を用意する工程と、
前記基板上に位置するバッファ層を形成する工程と、
前記バッファ層上にゲート電極を形成する工程と、
前記基板全面にわたってゲート絶縁膜を形成する工程と、
前記ゲート絶縁膜上に前記ゲート電極と対応するように第１半導体層を形成する工程と、
前記第１半導体層上に第２半導体層を形成する工程と、
前記第２半導体層の一部を開口し、前記第２半導体層と接続するソース／ドレイン電極を形成する工程と、を含み、
前記第１半導体層及び第２半導体層は金属触媒に結晶化した多結晶シリコン層であり、前記第２半導体層は前記第１半導体層内の金属触媒で結晶化することを含み、前記第１半導体層の面積は前記第２半導体層の面積よりも小さく形成することを特徴とする薄膜トランジスタの製造方法。
【請求項１４】
前記ゲート絶縁膜上に前記ゲート電極と対応するように第１半導体層を形成する工程と、前記第２半導体層を形成する工程とは、
前記ゲート絶縁膜上に第１非晶質シリコン層を形成する工程と、
前記第１非晶質シリコン層上に金属触媒層を形成する工程と、
前記基板を熱処理して前記第１非晶質シリコン層を第１金属触媒結晶化領域に結晶化する工程と、
前記第１金属触媒結晶化領域をパターニングして第１半導体層に形成する工程と、
前記第１半導体層上に第２非晶質シリコン層を形成する工程と、
前記第２非晶質シリコン層を熱処理して第２金属触媒結晶化領域に形成する工程と、
前記第２金属触媒結晶化領域をパターニングして第２半導体層に形成する工程と、含むことを特徴とする請求項１３に記載の薄膜トランジスタの製造方法。
【請求項１５】
前記第１非晶質シリコン層と前記金属触媒層との間には、拡散層をさらに含めた後に結晶化を行うことを特徴とする請求項１４に記載の薄膜トランジスタの製造方法。
【請求項１６】
前記熱処理は、３５０〜５００℃で行うことを特徴とする請求項１４に記載の薄膜トランジスタの製造方法。
【請求項１７】
前記金属触媒層は、Ｎｉ、Ｐｄ、Ａｇ、Ａｕ、Ａｌ、Ｓｎ、Ｓｂ、Ｃｕ、Ｔｒ、及びＣｄからなる群から選択されるいずれか１つから形成することを特徴とする請求項１４に記載の薄膜トランジスタの製造方法。
【請求項１８】
基板と、
前記基板上に位置するバッファ層と、
前記バッファ層上に位置する第１半導体層と、
前記第１半導体層上に位置する第２半導体層と、
前記第１半導体層及び第２半導体層と絶縁されるゲート電極と、
前記第１半導体層及び第２半導体層と前記ゲート電極とを絶縁させるゲート絶縁膜と、
前記ゲート電極と絶縁され、前記第２半導体層と一部が接続するソース／ドレイン電極と、
前記ソース／ドレイン電極上に位置する絶縁膜と、
前記絶縁膜上に位置して前記ソース／ドレイン電極と電気的に接続する第１電極、有機膜層及び第２電極と、を含み、
前記第１半導体層は前記第２半導体層の下部に位置し、前記第１半導体層の面積は第２半導体層の面積よりも小さいことを特徴とする有機電界発光表示装置。
【請求項１９】
前記第１半導体層及び第２半導体層は、金属触媒による多結晶シリコン層であることを特徴とする請求項１８に記載の有機電界発光表示装置。
【請求項２０】
前記第１半導体層は第１ＳＧＳ結晶化領域であり、前記第２半導体層は第２ＳＧＳ結晶化領域であることを特徴とする請求項１８に記載の有機電界発光表示装置。
【請求項２１】
前記第１半導体層は、前記第２半導体層のチャンネル領域の下部に位置することを特徴とする請求項１８に記載の有機電界発光表示装置。
【請求項２２】
前記第２半導体層の結晶粒の大きさは、前記第１半導体層の結晶粒の大きさよりも大きいことを特徴とする請求項１８に記載の有機電界発光表示装置。
【請求項２３】
基板と、
前記基板上に位置するバッファ層と、
前記バッファ層上に位置する第１半導体層及び第２半導体層と、
前記基板全面にわたって位置するゲート絶縁膜と、
前記ゲート絶縁膜上に位置する第１半導体層及び第２半導体層と、
前記第２半導体層と一部が接続するソース／ドレイン電極と、を含み、
前記第１半導体層上部に第２半導体層が位置することをさらに含むことを特徴とする請求項１８に記載の有機電界発光表示装置。
【請求項２４】
基板と、
前記基板上に位置するバッファ層と、
前記バッファ層上に位置するゲート電極と、
前記ゲート電極を含む基板全面にわたって位置するゲート絶縁膜と、
前記ゲート絶縁膜上に位置し、前記ゲート電極に対応するように位置する第１半導体層及び第２半導体層と、
前記第２半導体層と一部が接続するソース／ドレイン電極と、を含み、
前記第１半導体層上部に第２半導体層が位置することをさらに含むことを特徴とする請求項１８に記載の有機電界発光表示装置。
【図１Ａ】
【図１Ｂ】
【図１Ｃ】
【図１Ｄ】
【図１Ｅ】
【図１Ｆ】
【図２Ａ】
【図２Ｂ】
【図２Ｃ】
【図３Ａ】
【図３Ｂ】
【図３Ｃ】
【図３Ｄ】
【図４】
【図１Ｇ】
【図１Ｈ】
【図１Ｂ】
【図１Ｃ】
【図１Ｄ】
【図１Ｅ】
【図１Ｆ】
【図２Ａ】
【図２Ｂ】
【図２Ｃ】
【図３Ａ】
【図３Ｂ】
【図３Ｃ】
【図３Ｄ】
【図４】
【図１Ｇ】
【図１Ｈ】
【公開番号】特開２０１０−１５７６７４（Ｐ２０１０−１５７６７４Ａ）
【公開日】平成２２年７月１５日（２０１０．７．１５）
【国際特許分類】
【出願番号】特願２００９−８５２６５（Ｐ２００９−８５２６５）
【出願日】平成２１年３月３１日（２００９．３．３１）
【出願人】（３０８０４０３５１）三星モバイルディスプレイ株式會社 (764)
【Ｆターム（参考）】
【公開日】平成２２年７月１５日（２０１０．７．１５）
【国際特許分類】
【出願日】平成２１年３月３１日（２００９．３．３１）
【出願人】（３０８０４０３５１）三星モバイルディスプレイ株式會社 (764)
【Ｆターム（参考）】
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