電界効果半導体装置
【課題】ノーマリオフのHEMTを得ることが困難であった。
【解決手段】本発明に従うHEMTは、電子走行層４と、この上を覆う電子供給層５と、電子供給層５と、ソース電極６と、ドレイン電極７と、ゲート電極８と、第１及び第２の絶縁膜９，１０と、圧電体層１１とを有している。第１の絶縁膜９は電子走行層４と電子供給層５とのヘテロ接合面に沿って生じる２ＤＥＧ層１３を分断する働きを有する。圧電体層１１はゲート電極８の電圧に応答して第１の絶縁膜９の応力を打ち消す働きを有する。これにより、ノーマリオフ特性を有し且つオン抵抗が小さいHEMTを得ることができる。
【解決手段】本発明に従うHEMTは、電子走行層４と、この上を覆う電子供給層５と、電子供給層５と、ソース電極６と、ドレイン電極７と、ゲート電極８と、第１及び第２の絶縁膜９，１０と、圧電体層１１とを有している。第１の絶縁膜９は電子走行層４と電子供給層５とのヘテロ接合面に沿って生じる２ＤＥＧ層１３を分断する働きを有する。圧電体層１１はゲート電極８の電圧に応答して第１の絶縁膜９の応力を打ち消す働きを有する。これにより、ノーマリオフ特性を有し且つオン抵抗が小さいHEMTを得ることができる。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、高電子移動度トランジスタ即ちＨＥＭＴ( High Electron Mobility Transistor)又はこれに類似の電界効果半導体装置に関する。
【背景技術】
【０００２】
典型的な従来のＨＥＭＴは、シリコン、サファイア等の基板の上にバッファ層を介して形成されたアンドープＧａＮから成る電子走行層と、ｎ型不純物がドープされた又はアンドープのＡｌＧａＮから成る電子供給層又はバリア層と、電子供給層の上に形成されたソース電極とドレイン電極とゲート電極（ショットキー電極）とを有している。ＡｌＧａＮから成る電子供給層のバンドギャプはＧａＮから成る電子走行層のバンドギャプよりも大きく、ＡｌＧａＮから成る電子供給層の格子定数はＧａＮから成る電子走行層の格子定数よりも小さい。電子走行層の上にこれよりも格子定数が小さい電子供給層を配置すると、電子供給層に伸張性歪み即ち引っ張り応力が生じ、ピエゾ分極する。ＡｌＧａＮから成る電子供給層は自発分極もするので、ピエゾ分極と自発分極とに基づく電界の作用で電子走行層のヘテロ接合面の近傍部分に周知の２次元電子ガス層即ち２ＤＥＧ層が生じる。２ＤＥＧ層は周知のようにドレイン電極とソース電極との間の電流通路（チャネル）として利用され、この電流通路を流れる電流はゲート電極に印加されるバイアス電圧で制御される。
【０００３】
ところで、一般的な構成のＨＥＭＴは、ゲート電極に電圧を印加しない状態（ノーマリ状態）でソース電極とドレイン電極との間に電流が流れる特性即ちノーマリオン特性を有する。ノーマリオン特性のＨＥＭＴをオフ状態に保つためにはゲート電極を負電位にするための負電源が必要になり、電気回路が必然的に高価になる。従って、従来のノーマリオン特性のＨＥＭＴの使い勝手は良くない。
【０００４】
そこで、ＡｌＧａＮから成る電子供給層を薄く形成することによってノーマリオフ特性、即ちゲート電極に電圧を印加しない状態（ノーマリ状態）でソース電極とドレイン電極との間に電流が流れない特性を得ることが試みられている。ＡｌＧａＮから成る電子供給層を薄く形成すると、電子供給層のピエゾ分極及び自発分極による電界が弱くなり、２ＤＥＧ層の電子濃度が減少する。電子濃度が低下した２ＤＥＧ層に対して電子供給層とここにショットキー接触しているゲート電極との間にビルトインポテンシャル（built−in potential）即ちバイアス電圧が無い状態での電位差に基づく電界が作用すると、ゲート電極の直下の２ＤＥＧ層が消失する。このため、ゲート電極にバイアス電圧を加えない状態においてドレイン・ソース間がオフ状態になる。
【０００５】
上述のように電子供給層を薄くすることによってノーマリオフのＨＥＭＴを提供することができる。しかし、電子供給層を薄くすると、ゲート電極の直下以外の２ＤＥＧ層においても電子濃度の低下が生じ、ドレイン・ソース間のオン抵抗が増大する。この問題を解決するために例えば特開２００５−１８３７３３号公報（特許文献１）に開示されているように電子供給層のゲート電極の下の部分に凹部（リセス）を形成し、電子供給層のゲート電極の下の部分のみを薄くしてノーマリオフ特性を得ることが知られている。しかし、この方法を採用して電子供給層を極端に薄くすると、選択的エッチングによって電子供給層を薄くする時に電子走行層及び電子供給層の半導体結晶にダメージが生じ、ＨＥＭＴの電気的特性が劣化する。また、選択的エッチングした時のエッチング深さのばらつきがＨＥＭＴの閾値電圧のばらつきとなるため、高い歩留りで生産できないという問題がある。このため、現在、ノーマリオフのＨＥＭＴが実用化されていない。
【０００６】
ノーマリオフ特性を有するＨＥＭＴを得るための別な方法として、電子供給層（バリア層）の格子定数を電子走行層の格子定数よりも大きくすることによってノーマリ状態でソース電極とドレイン電極との間をオフ状態に保つこと、及び電子供給層（バリア層）の上のソース電極とドレイン電極との間の全部にピエゾ効果を有する層（圧電体層）を配置し、この圧電体層の上にゲート電極を配置することが特開２００６−１５６８１６号公報（特許文献２）に開示されている。しかし、この場合には、ゲート電極に電圧を印加することによって電子供給層（バリア層）と電子走行層とのヘテロ接合面の全部に２ＤＥＧ層を発生させなければならない。このため電子供給層（バリア層）の表面のソース電極とドレイン電極との間の全部に圧電体層を配置し、ゲート電極をできるだけ広い面積に形成することが必要になる。この結果、ゲート電極とソース電極及びドレイン電極との間隔をさほど大きくすることができず、ゲート・ソース間耐圧、及びゲート・ドレイン間耐圧をさほど大きくすることができない。また、耐圧を考慮してゲート電極を小さく形成すると、ヘテロ接合面の全部に２ＤＥＧ層を良好に形成することができず、オン抵抗が大きくなる。
【特許文献１】特開２００５−１８３７３３号公報
【特許文献２】特開２００６−１００８２０号公報
【発明の開示】
【発明が解決しようとする課題】
【０００７】
従って、本発明が解決しようとする課題は、ノーマリオフ特性を有し且つ小さいオン抵抗を有する電界効果半導体装置が要求されていることであり、本発明の目的は上記要求に応えることができる電界効果半導体装置を提供することである。
【課題を解決するための手段】
【０００８】
上記課題を解決するための本発明は、
第１の半導体層と、前記第１の半導体層にヘテロ接合され且つ前記ヘテロ接合に基づいて２次元キャリアガス層を形成することができる材料から成る第２の半導体層とを備えている主半導体領域と、
前記主半導体領域の一方の主面上に配置されたソース電極と、
前記主半導体領域の一方の主面上に前記ソース電極から離間して配置されたドレイン電極と、
前記ソース電極と前記ドレイン電極との間の電流通路を制御するために前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間に配置されたゲート電極と、
前記ゲート電極と前記主半導体領域の一方の主面との間に配置され且つ平面的に見て前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間の一部のみに配置され且つ前記２次元キャリアガス層のキャリア濃度を低減させる方向の応力を発生する材料で形成された絶縁膜と、
前記ゲート電極と前記絶縁膜との間に配置され且つ前記ゲート電極に印加された電圧に応答して前記絶縁膜の前記応力を打ち消す方向の歪みを発生する材料、即ち電界を印加することで前記絶縁膜の前記応力を打ち消す方向の歪みを発生する材料から成る圧電体層と
を備えていることを特徴とする電界効果半導体装置に係わるものである。
【０００９】
なお、請求項２に示すように、前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間の前記絶縁膜が配置されていない部分の上に２次元キャリアガス層のキャリア濃度を高める方向の応力を発生する材料から成る別の絶縁膜が配置されていることが望ましい。
また、請求項３に示すように、前記圧電体層は前記別の絶縁膜の上に延在している延在部分を有し、前記ゲート電極は前記圧電体層の前記延在部分の上に延在している部分を有していることが望ましい。
また、請求項４に示すように、前記圧電体層は前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間の前記絶縁膜が配置されていない部分の上に延在している延在部分を有し、前記ゲート電極は前記圧電体層の前記延在部分の上に延在している部分を有していることが望ましい。
また、請求項５に示すように、前記２次元キャリアガス層のキャリア濃度を低減させる方向の応力を発生する材料から成る絶縁膜はシリコン窒化物（例えばＳｉＮ）から成ることが望ましい。
また、請求項６に示すように、２次元キャリアガス層のキャリア濃度を高める方向の応力を発生する材料から成る別の絶縁膜はシリコン酸化膜から成ることが望ましい。
また、請求項７に示すように、前記圧電体層は、遷移金属又はＬｉ（リチウム）が添加されたＺｎＯ（酸化亜鉛）、Ｐｂ（鉛）とＺｒ（ジルコニウム）とＴｉ（チタン）とを主成分とする酸化物、及びＬａ（ランタン）とＴｉ（チタン）とを主成分とする酸化物から選択されたものであるであることが望ましい。
また、請求項８に示すように、前記主半導体領域は、更に、前記第１の半導体層と前記第２の半導体層との間に配置されたスペーサー層を有することが望ましい。
また、請求項９に示すように、前記第２の半導体層は前記ゲート電極に対向する部分に凹部を有していることが望ましい。
また、請求項１０に示すように、電界効果半導体装置を、
第１の半導体層と、前記第１の半導体層にヘテロ接合され且つ前記ヘテロ接合に基づいて２次元キャリアガス層を形成することができる材料から第２の半導体層とを備え、且つ第２の半導体層を第１の部分と第２の部分とに分割する溝を有している主半導体領域と、
前記第２の半導体層の第１の部分の上に配置されたソース電極と、
前記第２の半導体層の第２の部分の上に配置されたドレイン電極と、
前記溝の中及び平面的に見て前記第２の半導体層の前記ソース電極と前記ドレイン電極との間の少なくとも一部の上に配置され且つ印加された電界に応答して前記２次元キャリアガス層におけるキャリア濃度を高めることができる方向の応力を生じる圧電特性を有し且つ絶縁性を有する材料で形成された圧電体層と、
前記ソース電極と前記ドレイン電極との間の電流通路を制御するために前記圧電体層の上に配置されたゲート電極とで構成することができる。
【発明の効果】
【００１０】
本願の請求項１〜９の発明に従う電界効果半導体装置は次の効果を有する。
（１）２次元キャリアガス層のキャリア濃度を低減させる方向の応力を発生する材料から成る絶縁膜は、ゲート電極と主半導体領域の一方の主面との間に配置されている。この絶縁膜の応力は第２の半導体層の本来の応力（２次元キャリアガス層を発生させる方向の応力）を打ち消す方向性を有する。この結果、ゲート電極に電圧が印加されていない状態（ノーマリ状態）において、第１の半導体層と第２の半導体層とのヘテロ接合面の絶縁膜に対応する部分の近傍に２次元キャリアガス層が発生しなくなる。これにより、２次元キャリアガス層の分断が生じ、ノーマリ状態においてオフ状態になる。一方、ゲート電極に電圧が印加されると、圧電体層が絶縁膜の応力を打ち消す方向の歪（応力）を発生する。このため、絶縁膜による２次元キャリアガス層の分断が解除され、ソース電極とドレイン電極との間がオン状態になる。この結果、ノーマリオフ特性を有する電界効果半導体装置を提供することができる。更に、絶縁膜は平面的に見て主半導体領域の一方の主面上におけるソース電極とドレイン電極との間の一部のみに配置されている。従って、平面的に見て主半導体領域の一方の主面上におけるソース電極とドレイン電極との間の絶縁膜が配置されていない部分においては絶縁膜による２次元キャリアガス層のキャリア濃度の低減が発生しない。このため、ソース電極とドレイン電極との間のオン抵抗が比較的小さい電界効果半導体装置を提供することができる。要するに、本発明によればノーマリオフ特性を有するにも拘らずオン抵抗が比較的小さい電界効果半導体装置を提供することができる。
（２）ゲート電極と主半導体領域の一方の主面との間に絶縁膜が配置されているので、ゲートリーク電流を低減できる。
請求項１０の発明に従う電界効果半導体装置においては、請求項１〜９の発明の電界効果半導体装置における絶縁膜が省かれ、圧電体層が第１の半導体層に接触し且つ第２の半導体層の上に延在している。請求項１０の発明における圧電体層はゲート電極に印加された電圧に基づく電界に応答して歪み、２次元キャリアガス層のキャリア濃度を高めることができる方向の応力を第１の半導体層に与える。これにより、２次元キャリアガス層の抵抗即ちオン抵抗が低減する。なお、ゲート電極に電圧が印加されると、圧電体層がゲート絶縁膜として機能して周知の電界効果作用によって第１の半導体層の表面部分にチャネルが生じ、ソース電極とドレイン電極との間がオン状態になる。
【発明を実施するための最良の形態】
【００１１】
次に、図面を参照して本発明の実施形態に係わる電界効果半導体装置を説明する。
【実施例１】
【００１２】
図１に示す本発明の実施例１に従う電界効果半導体装置は、単結晶シリコン半導体から成る基板１と、この基板１の一方の主面１ａの上にバッファ層２を介して順次に配置された電子走行層（第１の半導体層）４と電子供給層（第２の半導体層）５とから成る主半導体領域３と、主半導体領域３の上に配置されたソース電極６、ドレイン電極７及びゲート電極８と、第１及び第２の絶縁膜９，１０と、圧電体層１１と、補助電極としての背面電極１２とを備えている。この電界効果半導体装置は典型的なＨＥＭＴと異なるゲート構造を有するが、典型的なＨＥＭＴと同様な原理で動作するので、ＨＥＭＴ又はＨＥＭＴ型半導体装置と呼ぶこともできる。以下、図１の各部を詳しく説明する。
【００１３】
基板１は、一方の主面１ａとこれに対向する他方の主面１ｂとを有し、且つバッファ層２及び主半導体領域３のための半導体材料をエピタキシャル成長させるための成長基板の機能と、これ等を機械的に支持するための支持基板の機能と、背面電極１２を設けるための導電性基板の機能とを有する。本実施例では、コストの低減を図るために基板１がシリコンで形成されている。しかし、基板１をシリコン以外のシリコンカーバイト（ＳｉＣ）、ＧａＮ等の半導体、又はサファイア、セラミック等の絶縁体で形成することもできる。
【００１４】
基板１の一方の主面１ａ上のバッファ層２は、周知のＭＯＣＶＤ法等のエピタキシャル成長法で形成されている。図１では、図示を簡略化するためにバッファ層２が１つの層で示されているが、実際には複数の層で形成されている。即ち、このバッファ層２は、ＡｌＮ（窒化アルミニウム）から成る第１のサブレイヤ−（第１の副層）とＧａＮ（窒化ガリウム）から成る第２のサブレイヤー（第２の副層）とが交互に積層された多層構造バッファである。このバッファ層２はＨＥＭＴの動作に直接に関係していないので、これを省くこともできる。また、バッファ層２の半導体材料をＡｌＮ、ＧａＮ以外の３−５族化合物半導体に置き換えること、又は単層構造のバッファ層にすることもできる。
【００１５】
主半導体領域３における第１の半導体層としての電子走行層４は、バッファ層２の上に周知のＭＯＣＶＤ法等のエピタキシャル成長法で形成されている。このの電子走行層４は、この上の電子供給層５とのヘテロ接合面の近傍に電流通路（チャネル）としての２ＤＥＧ層１３（点線で示す）を得るためのものであって、不純物が添加されていないアンドープＧａＮ（窒化ガリウム）を例えば１〜５μｍの厚さにエピタキシャル成長させたものである。なお、電子走行層４は、ＧａＮ以外の例えば
ＡｌaＧａ1-aＮ，
ここで、ａは０≦ａ＜１を満足する数値、
等の窒化物半導体、又は別の化合物半導体で形成することもできる。
【００１６】
電子走行層４の上に周知のＭＯＣＶＤ法等のエピタキシャル成長法で形成された電子供給層５は、Ａｌ0.3Ｇａ0.7Ｎから成り、電子走行層４よりも薄い５〜５０ｎｍの厚みを有し、且つ２ＤＥＧ層１３を得るために電子走行層４よりも大きいバンドギャプを有し且つ電子走行層４よりも小さい格子定数を有する。なお、電子供給層５をＡｌ0.3Ｇａ0.7Ｎ以外の例えば次式で示す窒化物半導体で形成することもできる。
ＡｌxＧａ1-XＮ，
ここで、ｘは０＜ｘ＜１、及びａ＜ｘを満足する数値であり、好ましくは０．２〜０．４である。
なお、電子供給層５を、アンドープのＡｌxＧａ1-xＮで形成する代りに、ｎ型（第１導電型）の不純物を添加したＡｌxＧａ1-xＮから成る窒化物半導体、又は別の組成の窒化物半導体、又は別の化合物半導体で形成することもできる。
【００１７】
ソース電極６及びドレイン電極７は、主半導体領域３の一方の主面１４即ち電子供給層５の一方の主面に例えばチタン（Ｔｉ）を所望の厚み（例えば２５ｎｍ）に蒸着し、続いてアルミニウム（Ａｌ）を所望の厚み（例えば５００ｎｍ）に蒸着し、その後フォトリソグラフイ技術で所望のパターンにすることによってそれぞれ形成されている。この実施例のソース電極６及びドレイン電極７は、チタン（Ｔｉ）とアルミニウム（Ａｌ）との積層体でそれぞれ形成されているが、これ以外の低抵抗性接触（オーミック接触）可能な金属で形成することもできる。なお、主半導体領域３の電子供給層５は極めて薄いので、この厚み方向の抵抗は無視できるほど小さい。従って、ソース電極６及びドレイン電極７は、２ＤＥＧ層１３に電気的に結合されている。
【００１８】
主半導体領域３の一方の主面１４即ち電子供給層５の一方の主面とゲート電極８との間に配置され且つ平面的に見て（主半導体領域３の一方の主面１４に対して垂直な方向から見て）主半導体領域３の一方の主面上におけるソース電極６とドレイン電極７との間の一部のみに配置された第１の絶縁膜９は、電子供給層５と電子走行層４とのヘテロ接合面の近傍に形成される２次元電子ガス層（２ＤＥＧ層）のキャリア濃度（例えば電子濃度）を低減させることができる方向の応力を発生する材料から成る。この第１の絶縁膜９の好ましい材料はシリコン窒化物即ちＳｉＮである。例えばプラズマＣＶＤ（化学気相成長法）で形成されたシリコン窒化物即ちＳｉＮから成る第１の絶縁膜９は、図１において矢印１５で示すように主半導体領域３の一方の主面１４が延びる方向（面方向）において引っ張り応力即ち伸張性歪み（例えば−６．１４×１０9ｄｙｎ／ｃｍ2）を発生する。この第１の絶縁膜９の応力は２次元キャリアガス層の発生を抑制する方向即ちキャリア濃度を低減する方向の応力、即ち電子供給層５と電子走行層４とのヘテロ接合に基づいて電子供給層５に生じる引張り応力（伸張性歪み）を打ち消す方向の応力である。ゲート電極８に電圧が印加されていない状態（ノーマリ状態）において、第１の絶縁膜９の引っ張り応力がＡｌＧａＮから成る電子供給層５に作用すると、第１の絶縁膜９の下の電子供給層５に圧縮性応力（矢印１５と反対方向の応力）が生じ、これにより電子供給層５と電子走行層４とのヘテロ接合に基づいて電子供給層５に生じた引張り応力（伸張性歪み）が打ち消される。この結果、ヘテロ接合面の第１の絶縁膜９に対向する部分に沿って２ＤＥＧ層が形成されない。ヘテロ接合面の第１の絶縁膜９に対向する部分において２ＤＥＧ層１３の分断が生じると、ソース電極６とドレイン電極７との間はオフ状態になる。これは電界効果半導体装置がノーマリオフ特性を有することを意味する。第１の絶縁膜９の引っ張り応力に基づいてノーマリオフ特性を得るためには、上述から明らかのように、電子供給層５と電子走行層４とのヘテロ接合に基づいて電子供給層５に生じる引っ張り応力即ち伸張性歪みを打ち消すことができる圧縮性応力を電子供給層５に生じさせなければならない。これを可能にするために第１の絶縁膜９の厚みを電子供給層５よりも厚くすることが必要であり、例えば５０〜１０００ｎｍにする。
【００１９】
本実施例では主半導体領域３の一方の主面１４即ち電子供給層５の一方の主面上の第１の絶縁膜９が形成されていない部分の上に２次元キャリアガス層１３のキャリア濃度を高める方向の応力を発生する材料から成る第２の絶縁膜１０が形成されている。第２の絶縁膜１０の好ましい材料はシリコン酸化物、即ちＳｉＯX（ここで、ｘは１〜２の数値を示し、好ましくは２である。）である。第２の絶縁膜１０は、好ましくはプラズマＣＶＤ（化学気相成長法）で例えば３００〜８００ｎｍ（好ましくは５００ｎｍ）の厚みに形成され、図１で矢印１６で示す方向の圧縮応力即ち圧縮性歪み（例えば４．００×１０9ｄｙｎ／ｃｍ2）を発生する性質を有する。なお、第２の絶縁膜１０を電子供給層５よりも厚く形成することが望ましい。シリコン酸化物から成る第２の絶縁膜１０の下にはＡｌＧａＮから成る電子供給層５が配置されているので、第２の絶縁膜１０の圧縮応力が電子供給層５に作用すると、この反作用で電子供給層５に伸張性歪み即ち引張り応力が生じ、電子供給層５のピエゾ分極が強められ、２次元電子ガス層即ち２ＤＥＧ層１３における電子濃度が増大する。この電子濃度の増大は電界効果半導体装置のオン時におけるソース電極６とドレイン電極７との間の抵抗の低減に寄与する。
【００２０】
ゲート電極８と第１の絶縁膜９との間に配置された圧電体層１１は、ゲート電極８に印加された電圧に応答して第１の絶縁膜９の応力を打ち消す方向の歪みを発生する材料から成る。即ち圧電体層１１は、電界を印加することで絶縁膜９の応力を打ち消す方向の歪みを発生する材料から成る。この圧電体層１１の好ましい材料は、リチウム（Ｌｉ）やＮｉ（ニッケル）などの遷移金属が５重量％以下、例えば１〜２重量％添加されたＺｎＯ（酸化亜鉛）である。なお、リチウム（Ｌｉ）やＮｉ（ニッケル）などの遷移金属は半導体としてのＺｎＯの高抵抗化のために添加されている。従って、圧電体層１１に高抵抗化が要求されない場合はリチウム（Ｌｉ）やＮｉ（ニッケル）などの遷移金属をＺｎＯに添加しなくとも良い。ＺｎＯから成る圧電体層１１は周知のスパッタリングで形成することができる。圧電体層１１はＺｎＯ以外のＰＺＴと呼ばれているＰｂ（鉛）とＺｒ（ジルコニウム）とＴｉ（チタン）とを主成分とする酸化物、例えば、ＰｂＺｒＯ3（鉛ジルコニウム酸化物）−ＰｂＴｉＯ3（鉛チタン酸化物）の混合物、又はＬＴＯと呼ばれているＬａ（ランタン）とＴｉ（チタン）とを主成分とする酸化物、例えば、（Ｌａ，Ｔｉ）Ｏ3、又はＡｌＮの多結晶等の圧電体で形成することもできる。なお、圧電体層１１を電子供給層５よりも厚い例えば５０〜１０００ｎｍに形成することが望ましい。
圧電体層１１はゲート電極８に印加された制御電圧に応答して図１で矢印１７で示す方向の圧縮性歪み（圧縮応力）を発生する。この圧電体層１１の圧縮性歪み（圧縮応力）は第１の絶縁膜９の伸張性歪み（伸張性応力）を打ち消す方向性を有する。圧電体層１１の圧縮性歪み（圧縮応力）によって第１の絶縁膜９の伸張性歪み（伸張性応力）が打ち消されると、電子供給層５と電子走行層４とのヘテロ接合面の近傍に２ＤＥＧ層が生じ、第１の絶縁膜９による２ＤＥＧ層１３の分断作用が消失し、ソース電極６とドレイン電極７との間がオン状態になる。
【００２１】
ゲート電極８は圧電体層１１の上に被着された金属層から成る。なお、ゲート電極８を金属層で形成する代りに、導電性を有するポリシリコン等で形成することもできる。
基板１に形成れた背面電極１２は図示されていない導体によってソース電極６に接続され、ＨＥＭＴの安定化に寄与する。
【００２２】
図１の電界効果半導体装置において、ゲート電極８に電圧が印加されていない時には、たとえドレイン電極７の電位がソース電極６の電位よりも高くても、前述した第１の絶縁膜９の働きによって２ＤＥＧ層１３の分断が生じているので、電子がソース電極６からドレイン電極７に向って流れず、ソース電極６とドレイン電極７との間はオフ状態になる。
【００２３】
ドレイン電極７の電位がソース電極６の電位よりも高い状態で、ゲート電極８とソース電極６との間に所定の閾値よりも高い電圧を印加すると、圧電体層１１に圧縮性歪み（圧縮性応力）が発生し、これにより第１の絶縁膜９の伸張性歪み（伸張性応力）が打ち消され、第１の絶縁膜９から電子供給層５に伸張性応力が作用しなくなり、電子供給層５のゲート電極８に対向している部分がこれ以外の部分と同様にピエゾ分極し、ゲート電極８の下にも２ＤＥＧ層１３が生じ、電子走行層４と電子供給層５とのヘテロ接合面の全部に沿って２ＤＥＧ層１３が生じ、ソース電極６とドレイン電極７との間がオン状態になる。このオン状態の時には、電子がソース電極６、電子供給層５、２ＤＥＧ層１３、電子供給層５、及びドレイン電極７の経路で流れる。なお、電子供給層５は極く薄いので、この厚み方向に電流を流すことができる。
圧電体層１１の圧縮性歪み（圧縮性応力）によって第１の絶縁膜９の伸張性歪み（伸張性応力）を打ち消すことができる電圧よりも高い電圧をゲート電極８に印加すると、ゲート電極８の下の２ＤＥＧ層１３の電子濃度が更に高くなる。
【００２４】
図１の実施例１の電界効果半導体装置は次の効果を有する。
（１）ゲート電極８に電圧を印加しないノーマリ状態において、ソース電極６とドレイン電極７との間の一部のみに設けた第１の絶縁膜９の応力に基づいて２ＤＥＧ層１３が分断され、ソース電極６とドレイン電極７との間がオフ状態になる。これにより、ノーマリオフ特性を有する電界効果半導体装置を提供することができる。
（２）第１の絶縁膜９、圧電体層１１及びゲート電極８を平面的に見て主半導体領域３の一方の主面１４のソース電極６とドレイン電極７との間の一部のみに設けられ、残りの部分には設けられていない。従って、残りの部分の２ＤＥＧ層１３の電子濃度は第１の絶縁膜９に基づいて低減しない。この結果、ノーマリオフ特性を有しているにも拘わらず、オン抵抗の小さい電界効果半導体装置を提供することができる。
（３）上述のように第１の絶縁膜９、圧電体層１１及びゲート電極８は平面的に見て主半導体領域３の一方の主面１４のソース電極６とドレイン電極７との間の一部のみに設けられている。この結果、ゲート電極８を幅広に形成することが不要になり、ゲート電極８をソース電極６及びドレイン電極７から十分離間させることができ、ゲート・ソース間耐圧、及びゲート・ドレイン間耐圧が大きく設定することができる。
（４）シリコン酸化物から成る第２の絶縁膜１０が２ＤＥＧ層１３における電子濃度の増大に寄与するので、ソース電極６とドレイン電極７との間のオン抵抗が低減する。
（５）電子供給層５を特別に薄くしてノーマリオフ特性を得る従来のＨＥＭＴに比べて２ＤＥＧ層１３における電子濃度を増大させることができ、オン抵抗の低減を図ることができる。
（６）ゲート電極８と主半導体領域３の一方の主面１４との間に第１の絶縁膜９が配置されているので、ゲートリーク電流を低減できる。
【実施例２】
【００２５】
次に、図２に示す実施例２に従う電界効果半導体装置即ちＨＥＭＴを説明する。但し、図２及び後述する図３〜図５において図１と実質的に同一の部分には同一の参照符号を付してその説明を省略する。
【００２６】
図２に示す電界効果半導体装置の主半導体領域３ａは変形された電子供給層５ａを有する他は、図１の主半導体領域３と同一に形成されている。電子供給層５ａの凹部（リセス）１８は第１の絶縁膜９と圧電体層１１とゲート電極８との下に形成されている。図２の電子供給層５ａの凹部１８を有さない部分は凹部１８を有する部分よりも厚く形成されている。電子供給層５ａの凹部１８を有する部分の厚みを図１の電子供給層５の厚みと同一に設定した場合には、電子供給層５ａの凹部１８を有さない部分の厚みが図１の電子供給層５よりも厚くなるので、電子供給層５のピエゾ分極及び自発分極による電界が図１よりも強くなり、２ＤＥＧ層１３の電子濃度が高くなり、オン抵抗が低減する。また、電子供給層５ａの凹部１８を有する部分の厚みを図１の電子供給層５の厚みよりも薄く設定した場合には、電子供給層５のピエゾ分極及び自発分極による電界が図１よりも弱くなり、第１の絶縁膜９の伸張性歪みを図１よりも小さく設定しても２ＤＥＧ層１３を消滅（分断）させることができる。
【００２７】
図２の実施例２の電界効果半導体装置即ちＨＥＭＴの基本構成は図１と同一であるので、図２の実施例２によっても図１の実施例１と同様な効果を得ることができる。
【実施例３】
【００２８】
図３の実施例３の電界効果半導体装置即ちＨＥＭＴは、図１の圧電体層１１とゲート電極８の横方向の寸法を大きくしたものに相当する圧電体層１１ａとゲート電極８ａを設け、この他は図１と同一に形成したものである。図３の圧電体層１１ａとゲート電極８ａは第１の絶縁膜９よりも幅広に形成されており、第２の絶縁膜１０の上に延在している。
【００２９】
図３の電界効果半導体装置のゲート電極８ａに電圧を印加しない時（ノーマリ状態）には、第１の絶縁膜９の働きで、図１の電界効果半導体装置と同様にソース電極６とドレイン電極７との間がオフ状態になる。
ゲート電極８ａに電圧を印加した時には、圧電体層１１ａに働きで電子供給層５と電子走行層４とのヘテロ接合の第１の絶縁膜９に対向する部分の近傍に図１の電界効果半導体装置と同様に２ＤＥＧ層が形成され、ソース電極６とドレイン電極７との間がオン状態になる。これと共に、圧電体層１１ａの圧縮性歪み（圧縮性応力）が第２の絶縁膜１０を介して電子供給層５に作用し、電子供給層５のピエゾ分極が強められ、２ＤＥＧ層１３の電子濃度が高くなり、ソース電極６とドレイン電極７との間のオン抵抗が低減する。これにより、ノーマリオフ特性を有しているにも拘わらず、オン抵抗が小さい電界効果半導体装置即ちＨＥＭＴを提供することが可能になる。また、図３の圧電体層１１ａとゲート電極８ａは第１の絶縁膜９よりも幅広に形成されており、第２の絶縁膜１０の上に延在しているので、第１の絶縁膜９の下に生じる２ＤＥＧ層と第２の絶縁膜９の下に生じる２ＤＥＧ層との連続性（つながり）が良くなる。なお、図３の実施例３の電界効果半導体装置は、図１の実施例１と同一の基本構成を有するので、図１の実施例１と同一の効果を得ることができる。但し、図３の実施例３の電界効果半導体装置のゲート・ソース間耐圧、及びゲート・ドレイン間耐圧は図１の実施例１よりも劣る。
【実施例４】
【００３０】
図４の実施例４の電界効果半導体装置即ちＨＥＭＴは、図３の電界効果半導体装置から第１の絶縁膜９を省き、且つ変形された主半導体領域３ｂを設け、この他はこの他は図３と同一に形成したものである。変形された主半導体領域３ｂの電子供給層５ｂは溝１８ａを有する。この溝１８ａは、電子走行層４の一方の主面から他方の主面に貫通するように形成されている。圧電体層１１ｂは溝１８ａを介して電子走行層４に接触するように変形されている。ゲート電極８ｂは圧電体層１１ｂに適合するように変形されている。実施例１〜３で示す絶縁膜９上ではなく、電子走行層４等の主半導体領域３ｂ上に圧電体層１１ｂを直接形成すると、高い結晶性を有する圧電体層１１ｂを得ることができ、圧電体層１１ｂを設ける効果を高めることができる。
【００３１】
ゲート電極８ｂに電圧が印加されないノーマリ状態では、電子供給層５の溝１８ａの底面に露出する電子走行層４には２ＤＥＧ層が形成されない。ゲート電極８ｂに電圧が印加された時には、圧電体層１１ｂがゲート絶縁膜として機能し、周知の電界効果に基づいて電子走行層４の表面に沿ってチャネル（電流通路）が形成され、ソース電極６とドレイン電極７との間がオン状態になる。
【００３２】
図４の実施例４の電界効果半導体装置は図１〜図３と同一の基本構成を有するので、図１〜図３の実施例１〜３と同様の効果を得ることができる。また、図４の圧電体層１１ｂとゲート電極８ｂは図３と同様にＳｉＯXから成る第２の絶縁膜１０の上に延在しているので、図４の実施例４によっても図３の実施例３と同様にオン抵抗の低減効果を得ることができる。
なお、溝１８ａを図４で点線１９で示す深さに変形し、溝１８ａの底部に電子供給層５ｂを残存させることができる。周知のように電子供給層５ｂが薄い場合には目的とする２ＤＥＧ層が得られず、ノーマリ状態においてソース電極６とドレイン電極７との間がオフ状態になる。
【実施例５】
【００３３】
図５の実施例５の電界効果半導体装置即ちＨＥＭＴは、変形された主半導体領域３ｃを有する他は、図１と同一に形成されている。図５の主半導体領域３ｃはｎ型不純物を含むＡｌxＧａ1-xＮから成る電子供給層５ｃを設け、このｎ型の電子供給層５ｃとＧａＮから成る電子走行層４との間にアンドープAlNから成る周知のスペーサー層２０を配置し、主半導体領域３ｃのソース電極６及びドレイン電極７との下に斜線を付けて示すｎ型不純物注入領域から成るコンタクト層２１，２２を設け、この他は図１に示されている実施例１の電界効果半導体装置と実質的に同一に形成したものである。スペーサー層２０は、電子供給層５ｃの不純物又は元素が電子走行層４に拡散することを防ぎ、２ＤＥＧ層１７における電子の移動度の低下を抑制する。コンタクト層２１，２２は、ソース電極６及びドレイン電極７の接触抵抗の低減に寄与する。図５の電界効果半導体装置は図１と同様な基本構成を有するので、図１の実施例と同様な効果を有する。
【００３４】
図５に示すスペーサー層２０に相当するものを図２〜図４の電界効果半導体装置に設けることができる。また、図５に示すコンタクト層２１，２２に相当するものを図２〜図４の電界効果半導体装置に設けることができる。また、図１〜図４の電子供給層５，５ａ、５ｂに図５の電子供給層５ｃと同様にｎ型不純物を添加することができる。
【００３５】
本発明は、上述の実施例に限定されるものでなく、例えば、次の変形が可能なものである。
（１）主半導体領域３，３a、３ｂ、３ｃを、ＧａＮ、AｌＧａＮ以外のIｎＧａＮ、ＡｌｌｎＧａＮ、ＡｌＮ、ＩｎＡｌＮ、ＡｌＰ、ＧａＰ、ＡｌｌｎＰ、ＧａｌｎＰ、ＡｌＧａＰ、ＡｌＧａＡｓ、ＧａＡｓ、ＡｌＡｓ、ＩｎＡｓ、ＩｎＰ，ＩｎＮ、ＧａＡｓＰ等の別の３−５族化合物半導体、又はＺｎＯ等の２−６族化合物半導体、又は更に別の化合物半導体で形成することができる。
（２） 各実施例の電子供給層５〜５ｃをｐ型半導体から成る正孔供給層に置き換えることができる。この場合には、２ＤＥＧ層１３に対応する領域に２次元キャリアガス層として２次元正孔ガス層が生じる。
（３）図２の圧電体層１１及びゲート電極８を鎖線で示すように横方向に延長させることができる。これにより図３の圧電体層１１ａ及びゲート電極８ａに基づくオン抵抗低減効果と同様な効果を得ることができる。
（４）図４の圧電体層１１ｂと電子走行層４との間に絶縁膜を介在させてゲートリーク電流の低減を図ることができる。
（５）周知のゲートフィールドプレート、ソースフィールドプレート、ドレインフィールドプレートの内の１つ又は複数を設けることができる。
（６）主半導体領域３〜３ｃの最も上に、表面電荷のコントロールのため等の目的で例えばアンドープＧａＮ等から成るキャップ層を設けることができる。
（７）図１〜図５にそれぞれ１つのソース電極６、ドレイン電極７及びのゲート電極８が示されているが、それぞれ複数個設けることができる。
（８）実施例１〜４において、電子供給層（５，５ａ〜５ｂ）のソース電極６及びドレイン電極７の下の部分を除去し、ソース電極６及びドレイン電極７を電子走行層４に直接に接続することができる。
（９）第１の絶縁膜９を、ＳｉＮ以外のＳｉＮｘ（ｘはＳｉに対するＮの割合を示す任意の数値）、Ｓｉ2Ｎ3，Ｓｉ3Ｎ4等の別のシリコン窒化物、又は主半導体領域３の一方の主面１４が延びる方向（面方向）において引っ張り応力即ち伸張性歪みを発生する別の絶縁材料で形成することができる。
（１０）第２の絶縁膜１０を、ＳｉＯX以外の圧縮応力即ち圧縮性歪みを発生する別の絶縁材料で形成することができる。
【図面の簡単な説明】
【００３６】
【図１】本発明の実施例１の電界効果半導体装置を示す断面図である。
【図２】本発明の実施例２の電界効果半導体装置を示す断面図である。
【図３】本発明の実施例３の電界効果半導体装置を示す断面図である。
【図４】本発明の実施例４の電界効果半導体装置を示す断面図である。
【図５】本発明の実施例５の電界効果半導体装置を示す断面図である。
【符号の説明】
【００３７】
１ 基板
２ バッファ層
３ 主半導体領域
４ 電子走行層（第１の半導体層）
５ 電子供給層（第２の半導体層）
６ ソース電極
７ ドレイン電極
８ ゲート電極
９ 第１の絶縁膜
１０ 第２の絶縁膜
１１ 圧電体層
【技術分野】
【０００１】
本発明は、高電子移動度トランジスタ即ちＨＥＭＴ( High Electron Mobility Transistor)又はこれに類似の電界効果半導体装置に関する。
【背景技術】
【０００２】
典型的な従来のＨＥＭＴは、シリコン、サファイア等の基板の上にバッファ層を介して形成されたアンドープＧａＮから成る電子走行層と、ｎ型不純物がドープされた又はアンドープのＡｌＧａＮから成る電子供給層又はバリア層と、電子供給層の上に形成されたソース電極とドレイン電極とゲート電極（ショットキー電極）とを有している。ＡｌＧａＮから成る電子供給層のバンドギャプはＧａＮから成る電子走行層のバンドギャプよりも大きく、ＡｌＧａＮから成る電子供給層の格子定数はＧａＮから成る電子走行層の格子定数よりも小さい。電子走行層の上にこれよりも格子定数が小さい電子供給層を配置すると、電子供給層に伸張性歪み即ち引っ張り応力が生じ、ピエゾ分極する。ＡｌＧａＮから成る電子供給層は自発分極もするので、ピエゾ分極と自発分極とに基づく電界の作用で電子走行層のヘテロ接合面の近傍部分に周知の２次元電子ガス層即ち２ＤＥＧ層が生じる。２ＤＥＧ層は周知のようにドレイン電極とソース電極との間の電流通路（チャネル）として利用され、この電流通路を流れる電流はゲート電極に印加されるバイアス電圧で制御される。
【０００３】
ところで、一般的な構成のＨＥＭＴは、ゲート電極に電圧を印加しない状態（ノーマリ状態）でソース電極とドレイン電極との間に電流が流れる特性即ちノーマリオン特性を有する。ノーマリオン特性のＨＥＭＴをオフ状態に保つためにはゲート電極を負電位にするための負電源が必要になり、電気回路が必然的に高価になる。従って、従来のノーマリオン特性のＨＥＭＴの使い勝手は良くない。
【０００４】
そこで、ＡｌＧａＮから成る電子供給層を薄く形成することによってノーマリオフ特性、即ちゲート電極に電圧を印加しない状態（ノーマリ状態）でソース電極とドレイン電極との間に電流が流れない特性を得ることが試みられている。ＡｌＧａＮから成る電子供給層を薄く形成すると、電子供給層のピエゾ分極及び自発分極による電界が弱くなり、２ＤＥＧ層の電子濃度が減少する。電子濃度が低下した２ＤＥＧ層に対して電子供給層とここにショットキー接触しているゲート電極との間にビルトインポテンシャル（built−in potential）即ちバイアス電圧が無い状態での電位差に基づく電界が作用すると、ゲート電極の直下の２ＤＥＧ層が消失する。このため、ゲート電極にバイアス電圧を加えない状態においてドレイン・ソース間がオフ状態になる。
【０００５】
上述のように電子供給層を薄くすることによってノーマリオフのＨＥＭＴを提供することができる。しかし、電子供給層を薄くすると、ゲート電極の直下以外の２ＤＥＧ層においても電子濃度の低下が生じ、ドレイン・ソース間のオン抵抗が増大する。この問題を解決するために例えば特開２００５−１８３７３３号公報（特許文献１）に開示されているように電子供給層のゲート電極の下の部分に凹部（リセス）を形成し、電子供給層のゲート電極の下の部分のみを薄くしてノーマリオフ特性を得ることが知られている。しかし、この方法を採用して電子供給層を極端に薄くすると、選択的エッチングによって電子供給層を薄くする時に電子走行層及び電子供給層の半導体結晶にダメージが生じ、ＨＥＭＴの電気的特性が劣化する。また、選択的エッチングした時のエッチング深さのばらつきがＨＥＭＴの閾値電圧のばらつきとなるため、高い歩留りで生産できないという問題がある。このため、現在、ノーマリオフのＨＥＭＴが実用化されていない。
【０００６】
ノーマリオフ特性を有するＨＥＭＴを得るための別な方法として、電子供給層（バリア層）の格子定数を電子走行層の格子定数よりも大きくすることによってノーマリ状態でソース電極とドレイン電極との間をオフ状態に保つこと、及び電子供給層（バリア層）の上のソース電極とドレイン電極との間の全部にピエゾ効果を有する層（圧電体層）を配置し、この圧電体層の上にゲート電極を配置することが特開２００６−１５６８１６号公報（特許文献２）に開示されている。しかし、この場合には、ゲート電極に電圧を印加することによって電子供給層（バリア層）と電子走行層とのヘテロ接合面の全部に２ＤＥＧ層を発生させなければならない。このため電子供給層（バリア層）の表面のソース電極とドレイン電極との間の全部に圧電体層を配置し、ゲート電極をできるだけ広い面積に形成することが必要になる。この結果、ゲート電極とソース電極及びドレイン電極との間隔をさほど大きくすることができず、ゲート・ソース間耐圧、及びゲート・ドレイン間耐圧をさほど大きくすることができない。また、耐圧を考慮してゲート電極を小さく形成すると、ヘテロ接合面の全部に２ＤＥＧ層を良好に形成することができず、オン抵抗が大きくなる。
【特許文献１】特開２００５−１８３７３３号公報
【特許文献２】特開２００６−１００８２０号公報
【発明の開示】
【発明が解決しようとする課題】
【０００７】
従って、本発明が解決しようとする課題は、ノーマリオフ特性を有し且つ小さいオン抵抗を有する電界効果半導体装置が要求されていることであり、本発明の目的は上記要求に応えることができる電界効果半導体装置を提供することである。
【課題を解決するための手段】
【０００８】
上記課題を解決するための本発明は、
第１の半導体層と、前記第１の半導体層にヘテロ接合され且つ前記ヘテロ接合に基づいて２次元キャリアガス層を形成することができる材料から成る第２の半導体層とを備えている主半導体領域と、
前記主半導体領域の一方の主面上に配置されたソース電極と、
前記主半導体領域の一方の主面上に前記ソース電極から離間して配置されたドレイン電極と、
前記ソース電極と前記ドレイン電極との間の電流通路を制御するために前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間に配置されたゲート電極と、
前記ゲート電極と前記主半導体領域の一方の主面との間に配置され且つ平面的に見て前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間の一部のみに配置され且つ前記２次元キャリアガス層のキャリア濃度を低減させる方向の応力を発生する材料で形成された絶縁膜と、
前記ゲート電極と前記絶縁膜との間に配置され且つ前記ゲート電極に印加された電圧に応答して前記絶縁膜の前記応力を打ち消す方向の歪みを発生する材料、即ち電界を印加することで前記絶縁膜の前記応力を打ち消す方向の歪みを発生する材料から成る圧電体層と
を備えていることを特徴とする電界効果半導体装置に係わるものである。
【０００９】
なお、請求項２に示すように、前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間の前記絶縁膜が配置されていない部分の上に２次元キャリアガス層のキャリア濃度を高める方向の応力を発生する材料から成る別の絶縁膜が配置されていることが望ましい。
また、請求項３に示すように、前記圧電体層は前記別の絶縁膜の上に延在している延在部分を有し、前記ゲート電極は前記圧電体層の前記延在部分の上に延在している部分を有していることが望ましい。
また、請求項４に示すように、前記圧電体層は前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間の前記絶縁膜が配置されていない部分の上に延在している延在部分を有し、前記ゲート電極は前記圧電体層の前記延在部分の上に延在している部分を有していることが望ましい。
また、請求項５に示すように、前記２次元キャリアガス層のキャリア濃度を低減させる方向の応力を発生する材料から成る絶縁膜はシリコン窒化物（例えばＳｉＮ）から成ることが望ましい。
また、請求項６に示すように、２次元キャリアガス層のキャリア濃度を高める方向の応力を発生する材料から成る別の絶縁膜はシリコン酸化膜から成ることが望ましい。
また、請求項７に示すように、前記圧電体層は、遷移金属又はＬｉ（リチウム）が添加されたＺｎＯ（酸化亜鉛）、Ｐｂ（鉛）とＺｒ（ジルコニウム）とＴｉ（チタン）とを主成分とする酸化物、及びＬａ（ランタン）とＴｉ（チタン）とを主成分とする酸化物から選択されたものであるであることが望ましい。
また、請求項８に示すように、前記主半導体領域は、更に、前記第１の半導体層と前記第２の半導体層との間に配置されたスペーサー層を有することが望ましい。
また、請求項９に示すように、前記第２の半導体層は前記ゲート電極に対向する部分に凹部を有していることが望ましい。
また、請求項１０に示すように、電界効果半導体装置を、
第１の半導体層と、前記第１の半導体層にヘテロ接合され且つ前記ヘテロ接合に基づいて２次元キャリアガス層を形成することができる材料から第２の半導体層とを備え、且つ第２の半導体層を第１の部分と第２の部分とに分割する溝を有している主半導体領域と、
前記第２の半導体層の第１の部分の上に配置されたソース電極と、
前記第２の半導体層の第２の部分の上に配置されたドレイン電極と、
前記溝の中及び平面的に見て前記第２の半導体層の前記ソース電極と前記ドレイン電極との間の少なくとも一部の上に配置され且つ印加された電界に応答して前記２次元キャリアガス層におけるキャリア濃度を高めることができる方向の応力を生じる圧電特性を有し且つ絶縁性を有する材料で形成された圧電体層と、
前記ソース電極と前記ドレイン電極との間の電流通路を制御するために前記圧電体層の上に配置されたゲート電極とで構成することができる。
【発明の効果】
【００１０】
本願の請求項１〜９の発明に従う電界効果半導体装置は次の効果を有する。
（１）２次元キャリアガス層のキャリア濃度を低減させる方向の応力を発生する材料から成る絶縁膜は、ゲート電極と主半導体領域の一方の主面との間に配置されている。この絶縁膜の応力は第２の半導体層の本来の応力（２次元キャリアガス層を発生させる方向の応力）を打ち消す方向性を有する。この結果、ゲート電極に電圧が印加されていない状態（ノーマリ状態）において、第１の半導体層と第２の半導体層とのヘテロ接合面の絶縁膜に対応する部分の近傍に２次元キャリアガス層が発生しなくなる。これにより、２次元キャリアガス層の分断が生じ、ノーマリ状態においてオフ状態になる。一方、ゲート電極に電圧が印加されると、圧電体層が絶縁膜の応力を打ち消す方向の歪（応力）を発生する。このため、絶縁膜による２次元キャリアガス層の分断が解除され、ソース電極とドレイン電極との間がオン状態になる。この結果、ノーマリオフ特性を有する電界効果半導体装置を提供することができる。更に、絶縁膜は平面的に見て主半導体領域の一方の主面上におけるソース電極とドレイン電極との間の一部のみに配置されている。従って、平面的に見て主半導体領域の一方の主面上におけるソース電極とドレイン電極との間の絶縁膜が配置されていない部分においては絶縁膜による２次元キャリアガス層のキャリア濃度の低減が発生しない。このため、ソース電極とドレイン電極との間のオン抵抗が比較的小さい電界効果半導体装置を提供することができる。要するに、本発明によればノーマリオフ特性を有するにも拘らずオン抵抗が比較的小さい電界効果半導体装置を提供することができる。
（２）ゲート電極と主半導体領域の一方の主面との間に絶縁膜が配置されているので、ゲートリーク電流を低減できる。
請求項１０の発明に従う電界効果半導体装置においては、請求項１〜９の発明の電界効果半導体装置における絶縁膜が省かれ、圧電体層が第１の半導体層に接触し且つ第２の半導体層の上に延在している。請求項１０の発明における圧電体層はゲート電極に印加された電圧に基づく電界に応答して歪み、２次元キャリアガス層のキャリア濃度を高めることができる方向の応力を第１の半導体層に与える。これにより、２次元キャリアガス層の抵抗即ちオン抵抗が低減する。なお、ゲート電極に電圧が印加されると、圧電体層がゲート絶縁膜として機能して周知の電界効果作用によって第１の半導体層の表面部分にチャネルが生じ、ソース電極とドレイン電極との間がオン状態になる。
【発明を実施するための最良の形態】
【００１１】
次に、図面を参照して本発明の実施形態に係わる電界効果半導体装置を説明する。
【実施例１】
【００１２】
図１に示す本発明の実施例１に従う電界効果半導体装置は、単結晶シリコン半導体から成る基板１と、この基板１の一方の主面１ａの上にバッファ層２を介して順次に配置された電子走行層（第１の半導体層）４と電子供給層（第２の半導体層）５とから成る主半導体領域３と、主半導体領域３の上に配置されたソース電極６、ドレイン電極７及びゲート電極８と、第１及び第２の絶縁膜９，１０と、圧電体層１１と、補助電極としての背面電極１２とを備えている。この電界効果半導体装置は典型的なＨＥＭＴと異なるゲート構造を有するが、典型的なＨＥＭＴと同様な原理で動作するので、ＨＥＭＴ又はＨＥＭＴ型半導体装置と呼ぶこともできる。以下、図１の各部を詳しく説明する。
【００１３】
基板１は、一方の主面１ａとこれに対向する他方の主面１ｂとを有し、且つバッファ層２及び主半導体領域３のための半導体材料をエピタキシャル成長させるための成長基板の機能と、これ等を機械的に支持するための支持基板の機能と、背面電極１２を設けるための導電性基板の機能とを有する。本実施例では、コストの低減を図るために基板１がシリコンで形成されている。しかし、基板１をシリコン以外のシリコンカーバイト（ＳｉＣ）、ＧａＮ等の半導体、又はサファイア、セラミック等の絶縁体で形成することもできる。
【００１４】
基板１の一方の主面１ａ上のバッファ層２は、周知のＭＯＣＶＤ法等のエピタキシャル成長法で形成されている。図１では、図示を簡略化するためにバッファ層２が１つの層で示されているが、実際には複数の層で形成されている。即ち、このバッファ層２は、ＡｌＮ（窒化アルミニウム）から成る第１のサブレイヤ−（第１の副層）とＧａＮ（窒化ガリウム）から成る第２のサブレイヤー（第２の副層）とが交互に積層された多層構造バッファである。このバッファ層２はＨＥＭＴの動作に直接に関係していないので、これを省くこともできる。また、バッファ層２の半導体材料をＡｌＮ、ＧａＮ以外の３−５族化合物半導体に置き換えること、又は単層構造のバッファ層にすることもできる。
【００１５】
主半導体領域３における第１の半導体層としての電子走行層４は、バッファ層２の上に周知のＭＯＣＶＤ法等のエピタキシャル成長法で形成されている。このの電子走行層４は、この上の電子供給層５とのヘテロ接合面の近傍に電流通路（チャネル）としての２ＤＥＧ層１３（点線で示す）を得るためのものであって、不純物が添加されていないアンドープＧａＮ（窒化ガリウム）を例えば１〜５μｍの厚さにエピタキシャル成長させたものである。なお、電子走行層４は、ＧａＮ以外の例えば
ＡｌaＧａ1-aＮ，
ここで、ａは０≦ａ＜１を満足する数値、
等の窒化物半導体、又は別の化合物半導体で形成することもできる。
【００１６】
電子走行層４の上に周知のＭＯＣＶＤ法等のエピタキシャル成長法で形成された電子供給層５は、Ａｌ0.3Ｇａ0.7Ｎから成り、電子走行層４よりも薄い５〜５０ｎｍの厚みを有し、且つ２ＤＥＧ層１３を得るために電子走行層４よりも大きいバンドギャプを有し且つ電子走行層４よりも小さい格子定数を有する。なお、電子供給層５をＡｌ0.3Ｇａ0.7Ｎ以外の例えば次式で示す窒化物半導体で形成することもできる。
ＡｌxＧａ1-XＮ，
ここで、ｘは０＜ｘ＜１、及びａ＜ｘを満足する数値であり、好ましくは０．２〜０．４である。
なお、電子供給層５を、アンドープのＡｌxＧａ1-xＮで形成する代りに、ｎ型（第１導電型）の不純物を添加したＡｌxＧａ1-xＮから成る窒化物半導体、又は別の組成の窒化物半導体、又は別の化合物半導体で形成することもできる。
【００１７】
ソース電極６及びドレイン電極７は、主半導体領域３の一方の主面１４即ち電子供給層５の一方の主面に例えばチタン（Ｔｉ）を所望の厚み（例えば２５ｎｍ）に蒸着し、続いてアルミニウム（Ａｌ）を所望の厚み（例えば５００ｎｍ）に蒸着し、その後フォトリソグラフイ技術で所望のパターンにすることによってそれぞれ形成されている。この実施例のソース電極６及びドレイン電極７は、チタン（Ｔｉ）とアルミニウム（Ａｌ）との積層体でそれぞれ形成されているが、これ以外の低抵抗性接触（オーミック接触）可能な金属で形成することもできる。なお、主半導体領域３の電子供給層５は極めて薄いので、この厚み方向の抵抗は無視できるほど小さい。従って、ソース電極６及びドレイン電極７は、２ＤＥＧ層１３に電気的に結合されている。
【００１８】
主半導体領域３の一方の主面１４即ち電子供給層５の一方の主面とゲート電極８との間に配置され且つ平面的に見て（主半導体領域３の一方の主面１４に対して垂直な方向から見て）主半導体領域３の一方の主面上におけるソース電極６とドレイン電極７との間の一部のみに配置された第１の絶縁膜９は、電子供給層５と電子走行層４とのヘテロ接合面の近傍に形成される２次元電子ガス層（２ＤＥＧ層）のキャリア濃度（例えば電子濃度）を低減させることができる方向の応力を発生する材料から成る。この第１の絶縁膜９の好ましい材料はシリコン窒化物即ちＳｉＮである。例えばプラズマＣＶＤ（化学気相成長法）で形成されたシリコン窒化物即ちＳｉＮから成る第１の絶縁膜９は、図１において矢印１５で示すように主半導体領域３の一方の主面１４が延びる方向（面方向）において引っ張り応力即ち伸張性歪み（例えば−６．１４×１０9ｄｙｎ／ｃｍ2）を発生する。この第１の絶縁膜９の応力は２次元キャリアガス層の発生を抑制する方向即ちキャリア濃度を低減する方向の応力、即ち電子供給層５と電子走行層４とのヘテロ接合に基づいて電子供給層５に生じる引張り応力（伸張性歪み）を打ち消す方向の応力である。ゲート電極８に電圧が印加されていない状態（ノーマリ状態）において、第１の絶縁膜９の引っ張り応力がＡｌＧａＮから成る電子供給層５に作用すると、第１の絶縁膜９の下の電子供給層５に圧縮性応力（矢印１５と反対方向の応力）が生じ、これにより電子供給層５と電子走行層４とのヘテロ接合に基づいて電子供給層５に生じた引張り応力（伸張性歪み）が打ち消される。この結果、ヘテロ接合面の第１の絶縁膜９に対向する部分に沿って２ＤＥＧ層が形成されない。ヘテロ接合面の第１の絶縁膜９に対向する部分において２ＤＥＧ層１３の分断が生じると、ソース電極６とドレイン電極７との間はオフ状態になる。これは電界効果半導体装置がノーマリオフ特性を有することを意味する。第１の絶縁膜９の引っ張り応力に基づいてノーマリオフ特性を得るためには、上述から明らかのように、電子供給層５と電子走行層４とのヘテロ接合に基づいて電子供給層５に生じる引っ張り応力即ち伸張性歪みを打ち消すことができる圧縮性応力を電子供給層５に生じさせなければならない。これを可能にするために第１の絶縁膜９の厚みを電子供給層５よりも厚くすることが必要であり、例えば５０〜１０００ｎｍにする。
【００１９】
本実施例では主半導体領域３の一方の主面１４即ち電子供給層５の一方の主面上の第１の絶縁膜９が形成されていない部分の上に２次元キャリアガス層１３のキャリア濃度を高める方向の応力を発生する材料から成る第２の絶縁膜１０が形成されている。第２の絶縁膜１０の好ましい材料はシリコン酸化物、即ちＳｉＯX（ここで、ｘは１〜２の数値を示し、好ましくは２である。）である。第２の絶縁膜１０は、好ましくはプラズマＣＶＤ（化学気相成長法）で例えば３００〜８００ｎｍ（好ましくは５００ｎｍ）の厚みに形成され、図１で矢印１６で示す方向の圧縮応力即ち圧縮性歪み（例えば４．００×１０9ｄｙｎ／ｃｍ2）を発生する性質を有する。なお、第２の絶縁膜１０を電子供給層５よりも厚く形成することが望ましい。シリコン酸化物から成る第２の絶縁膜１０の下にはＡｌＧａＮから成る電子供給層５が配置されているので、第２の絶縁膜１０の圧縮応力が電子供給層５に作用すると、この反作用で電子供給層５に伸張性歪み即ち引張り応力が生じ、電子供給層５のピエゾ分極が強められ、２次元電子ガス層即ち２ＤＥＧ層１３における電子濃度が増大する。この電子濃度の増大は電界効果半導体装置のオン時におけるソース電極６とドレイン電極７との間の抵抗の低減に寄与する。
【００２０】
ゲート電極８と第１の絶縁膜９との間に配置された圧電体層１１は、ゲート電極８に印加された電圧に応答して第１の絶縁膜９の応力を打ち消す方向の歪みを発生する材料から成る。即ち圧電体層１１は、電界を印加することで絶縁膜９の応力を打ち消す方向の歪みを発生する材料から成る。この圧電体層１１の好ましい材料は、リチウム（Ｌｉ）やＮｉ（ニッケル）などの遷移金属が５重量％以下、例えば１〜２重量％添加されたＺｎＯ（酸化亜鉛）である。なお、リチウム（Ｌｉ）やＮｉ（ニッケル）などの遷移金属は半導体としてのＺｎＯの高抵抗化のために添加されている。従って、圧電体層１１に高抵抗化が要求されない場合はリチウム（Ｌｉ）やＮｉ（ニッケル）などの遷移金属をＺｎＯに添加しなくとも良い。ＺｎＯから成る圧電体層１１は周知のスパッタリングで形成することができる。圧電体層１１はＺｎＯ以外のＰＺＴと呼ばれているＰｂ（鉛）とＺｒ（ジルコニウム）とＴｉ（チタン）とを主成分とする酸化物、例えば、ＰｂＺｒＯ3（鉛ジルコニウム酸化物）−ＰｂＴｉＯ3（鉛チタン酸化物）の混合物、又はＬＴＯと呼ばれているＬａ（ランタン）とＴｉ（チタン）とを主成分とする酸化物、例えば、（Ｌａ，Ｔｉ）Ｏ3、又はＡｌＮの多結晶等の圧電体で形成することもできる。なお、圧電体層１１を電子供給層５よりも厚い例えば５０〜１０００ｎｍに形成することが望ましい。
圧電体層１１はゲート電極８に印加された制御電圧に応答して図１で矢印１７で示す方向の圧縮性歪み（圧縮応力）を発生する。この圧電体層１１の圧縮性歪み（圧縮応力）は第１の絶縁膜９の伸張性歪み（伸張性応力）を打ち消す方向性を有する。圧電体層１１の圧縮性歪み（圧縮応力）によって第１の絶縁膜９の伸張性歪み（伸張性応力）が打ち消されると、電子供給層５と電子走行層４とのヘテロ接合面の近傍に２ＤＥＧ層が生じ、第１の絶縁膜９による２ＤＥＧ層１３の分断作用が消失し、ソース電極６とドレイン電極７との間がオン状態になる。
【００２１】
ゲート電極８は圧電体層１１の上に被着された金属層から成る。なお、ゲート電極８を金属層で形成する代りに、導電性を有するポリシリコン等で形成することもできる。
基板１に形成れた背面電極１２は図示されていない導体によってソース電極６に接続され、ＨＥＭＴの安定化に寄与する。
【００２２】
図１の電界効果半導体装置において、ゲート電極８に電圧が印加されていない時には、たとえドレイン電極７の電位がソース電極６の電位よりも高くても、前述した第１の絶縁膜９の働きによって２ＤＥＧ層１３の分断が生じているので、電子がソース電極６からドレイン電極７に向って流れず、ソース電極６とドレイン電極７との間はオフ状態になる。
【００２３】
ドレイン電極７の電位がソース電極６の電位よりも高い状態で、ゲート電極８とソース電極６との間に所定の閾値よりも高い電圧を印加すると、圧電体層１１に圧縮性歪み（圧縮性応力）が発生し、これにより第１の絶縁膜９の伸張性歪み（伸張性応力）が打ち消され、第１の絶縁膜９から電子供給層５に伸張性応力が作用しなくなり、電子供給層５のゲート電極８に対向している部分がこれ以外の部分と同様にピエゾ分極し、ゲート電極８の下にも２ＤＥＧ層１３が生じ、電子走行層４と電子供給層５とのヘテロ接合面の全部に沿って２ＤＥＧ層１３が生じ、ソース電極６とドレイン電極７との間がオン状態になる。このオン状態の時には、電子がソース電極６、電子供給層５、２ＤＥＧ層１３、電子供給層５、及びドレイン電極７の経路で流れる。なお、電子供給層５は極く薄いので、この厚み方向に電流を流すことができる。
圧電体層１１の圧縮性歪み（圧縮性応力）によって第１の絶縁膜９の伸張性歪み（伸張性応力）を打ち消すことができる電圧よりも高い電圧をゲート電極８に印加すると、ゲート電極８の下の２ＤＥＧ層１３の電子濃度が更に高くなる。
【００２４】
図１の実施例１の電界効果半導体装置は次の効果を有する。
（１）ゲート電極８に電圧を印加しないノーマリ状態において、ソース電極６とドレイン電極７との間の一部のみに設けた第１の絶縁膜９の応力に基づいて２ＤＥＧ層１３が分断され、ソース電極６とドレイン電極７との間がオフ状態になる。これにより、ノーマリオフ特性を有する電界効果半導体装置を提供することができる。
（２）第１の絶縁膜９、圧電体層１１及びゲート電極８を平面的に見て主半導体領域３の一方の主面１４のソース電極６とドレイン電極７との間の一部のみに設けられ、残りの部分には設けられていない。従って、残りの部分の２ＤＥＧ層１３の電子濃度は第１の絶縁膜９に基づいて低減しない。この結果、ノーマリオフ特性を有しているにも拘わらず、オン抵抗の小さい電界効果半導体装置を提供することができる。
（３）上述のように第１の絶縁膜９、圧電体層１１及びゲート電極８は平面的に見て主半導体領域３の一方の主面１４のソース電極６とドレイン電極７との間の一部のみに設けられている。この結果、ゲート電極８を幅広に形成することが不要になり、ゲート電極８をソース電極６及びドレイン電極７から十分離間させることができ、ゲート・ソース間耐圧、及びゲート・ドレイン間耐圧が大きく設定することができる。
（４）シリコン酸化物から成る第２の絶縁膜１０が２ＤＥＧ層１３における電子濃度の増大に寄与するので、ソース電極６とドレイン電極７との間のオン抵抗が低減する。
（５）電子供給層５を特別に薄くしてノーマリオフ特性を得る従来のＨＥＭＴに比べて２ＤＥＧ層１３における電子濃度を増大させることができ、オン抵抗の低減を図ることができる。
（６）ゲート電極８と主半導体領域３の一方の主面１４との間に第１の絶縁膜９が配置されているので、ゲートリーク電流を低減できる。
【実施例２】
【００２５】
次に、図２に示す実施例２に従う電界効果半導体装置即ちＨＥＭＴを説明する。但し、図２及び後述する図３〜図５において図１と実質的に同一の部分には同一の参照符号を付してその説明を省略する。
【００２６】
図２に示す電界効果半導体装置の主半導体領域３ａは変形された電子供給層５ａを有する他は、図１の主半導体領域３と同一に形成されている。電子供給層５ａの凹部（リセス）１８は第１の絶縁膜９と圧電体層１１とゲート電極８との下に形成されている。図２の電子供給層５ａの凹部１８を有さない部分は凹部１８を有する部分よりも厚く形成されている。電子供給層５ａの凹部１８を有する部分の厚みを図１の電子供給層５の厚みと同一に設定した場合には、電子供給層５ａの凹部１８を有さない部分の厚みが図１の電子供給層５よりも厚くなるので、電子供給層５のピエゾ分極及び自発分極による電界が図１よりも強くなり、２ＤＥＧ層１３の電子濃度が高くなり、オン抵抗が低減する。また、電子供給層５ａの凹部１８を有する部分の厚みを図１の電子供給層５の厚みよりも薄く設定した場合には、電子供給層５のピエゾ分極及び自発分極による電界が図１よりも弱くなり、第１の絶縁膜９の伸張性歪みを図１よりも小さく設定しても２ＤＥＧ層１３を消滅（分断）させることができる。
【００２７】
図２の実施例２の電界効果半導体装置即ちＨＥＭＴの基本構成は図１と同一であるので、図２の実施例２によっても図１の実施例１と同様な効果を得ることができる。
【実施例３】
【００２８】
図３の実施例３の電界効果半導体装置即ちＨＥＭＴは、図１の圧電体層１１とゲート電極８の横方向の寸法を大きくしたものに相当する圧電体層１１ａとゲート電極８ａを設け、この他は図１と同一に形成したものである。図３の圧電体層１１ａとゲート電極８ａは第１の絶縁膜９よりも幅広に形成されており、第２の絶縁膜１０の上に延在している。
【００２９】
図３の電界効果半導体装置のゲート電極８ａに電圧を印加しない時（ノーマリ状態）には、第１の絶縁膜９の働きで、図１の電界効果半導体装置と同様にソース電極６とドレイン電極７との間がオフ状態になる。
ゲート電極８ａに電圧を印加した時には、圧電体層１１ａに働きで電子供給層５と電子走行層４とのヘテロ接合の第１の絶縁膜９に対向する部分の近傍に図１の電界効果半導体装置と同様に２ＤＥＧ層が形成され、ソース電極６とドレイン電極７との間がオン状態になる。これと共に、圧電体層１１ａの圧縮性歪み（圧縮性応力）が第２の絶縁膜１０を介して電子供給層５に作用し、電子供給層５のピエゾ分極が強められ、２ＤＥＧ層１３の電子濃度が高くなり、ソース電極６とドレイン電極７との間のオン抵抗が低減する。これにより、ノーマリオフ特性を有しているにも拘わらず、オン抵抗が小さい電界効果半導体装置即ちＨＥＭＴを提供することが可能になる。また、図３の圧電体層１１ａとゲート電極８ａは第１の絶縁膜９よりも幅広に形成されており、第２の絶縁膜１０の上に延在しているので、第１の絶縁膜９の下に生じる２ＤＥＧ層と第２の絶縁膜９の下に生じる２ＤＥＧ層との連続性（つながり）が良くなる。なお、図３の実施例３の電界効果半導体装置は、図１の実施例１と同一の基本構成を有するので、図１の実施例１と同一の効果を得ることができる。但し、図３の実施例３の電界効果半導体装置のゲート・ソース間耐圧、及びゲート・ドレイン間耐圧は図１の実施例１よりも劣る。
【実施例４】
【００３０】
図４の実施例４の電界効果半導体装置即ちＨＥＭＴは、図３の電界効果半導体装置から第１の絶縁膜９を省き、且つ変形された主半導体領域３ｂを設け、この他はこの他は図３と同一に形成したものである。変形された主半導体領域３ｂの電子供給層５ｂは溝１８ａを有する。この溝１８ａは、電子走行層４の一方の主面から他方の主面に貫通するように形成されている。圧電体層１１ｂは溝１８ａを介して電子走行層４に接触するように変形されている。ゲート電極８ｂは圧電体層１１ｂに適合するように変形されている。実施例１〜３で示す絶縁膜９上ではなく、電子走行層４等の主半導体領域３ｂ上に圧電体層１１ｂを直接形成すると、高い結晶性を有する圧電体層１１ｂを得ることができ、圧電体層１１ｂを設ける効果を高めることができる。
【００３１】
ゲート電極８ｂに電圧が印加されないノーマリ状態では、電子供給層５の溝１８ａの底面に露出する電子走行層４には２ＤＥＧ層が形成されない。ゲート電極８ｂに電圧が印加された時には、圧電体層１１ｂがゲート絶縁膜として機能し、周知の電界効果に基づいて電子走行層４の表面に沿ってチャネル（電流通路）が形成され、ソース電極６とドレイン電極７との間がオン状態になる。
【００３２】
図４の実施例４の電界効果半導体装置は図１〜図３と同一の基本構成を有するので、図１〜図３の実施例１〜３と同様の効果を得ることができる。また、図４の圧電体層１１ｂとゲート電極８ｂは図３と同様にＳｉＯXから成る第２の絶縁膜１０の上に延在しているので、図４の実施例４によっても図３の実施例３と同様にオン抵抗の低減効果を得ることができる。
なお、溝１８ａを図４で点線１９で示す深さに変形し、溝１８ａの底部に電子供給層５ｂを残存させることができる。周知のように電子供給層５ｂが薄い場合には目的とする２ＤＥＧ層が得られず、ノーマリ状態においてソース電極６とドレイン電極７との間がオフ状態になる。
【実施例５】
【００３３】
図５の実施例５の電界効果半導体装置即ちＨＥＭＴは、変形された主半導体領域３ｃを有する他は、図１と同一に形成されている。図５の主半導体領域３ｃはｎ型不純物を含むＡｌxＧａ1-xＮから成る電子供給層５ｃを設け、このｎ型の電子供給層５ｃとＧａＮから成る電子走行層４との間にアンドープAlNから成る周知のスペーサー層２０を配置し、主半導体領域３ｃのソース電極６及びドレイン電極７との下に斜線を付けて示すｎ型不純物注入領域から成るコンタクト層２１，２２を設け、この他は図１に示されている実施例１の電界効果半導体装置と実質的に同一に形成したものである。スペーサー層２０は、電子供給層５ｃの不純物又は元素が電子走行層４に拡散することを防ぎ、２ＤＥＧ層１７における電子の移動度の低下を抑制する。コンタクト層２１，２２は、ソース電極６及びドレイン電極７の接触抵抗の低減に寄与する。図５の電界効果半導体装置は図１と同様な基本構成を有するので、図１の実施例と同様な効果を有する。
【００３４】
図５に示すスペーサー層２０に相当するものを図２〜図４の電界効果半導体装置に設けることができる。また、図５に示すコンタクト層２１，２２に相当するものを図２〜図４の電界効果半導体装置に設けることができる。また、図１〜図４の電子供給層５，５ａ、５ｂに図５の電子供給層５ｃと同様にｎ型不純物を添加することができる。
【００３５】
本発明は、上述の実施例に限定されるものでなく、例えば、次の変形が可能なものである。
（１）主半導体領域３，３a、３ｂ、３ｃを、ＧａＮ、AｌＧａＮ以外のIｎＧａＮ、ＡｌｌｎＧａＮ、ＡｌＮ、ＩｎＡｌＮ、ＡｌＰ、ＧａＰ、ＡｌｌｎＰ、ＧａｌｎＰ、ＡｌＧａＰ、ＡｌＧａＡｓ、ＧａＡｓ、ＡｌＡｓ、ＩｎＡｓ、ＩｎＰ，ＩｎＮ、ＧａＡｓＰ等の別の３−５族化合物半導体、又はＺｎＯ等の２−６族化合物半導体、又は更に別の化合物半導体で形成することができる。
（２） 各実施例の電子供給層５〜５ｃをｐ型半導体から成る正孔供給層に置き換えることができる。この場合には、２ＤＥＧ層１３に対応する領域に２次元キャリアガス層として２次元正孔ガス層が生じる。
（３）図２の圧電体層１１及びゲート電極８を鎖線で示すように横方向に延長させることができる。これにより図３の圧電体層１１ａ及びゲート電極８ａに基づくオン抵抗低減効果と同様な効果を得ることができる。
（４）図４の圧電体層１１ｂと電子走行層４との間に絶縁膜を介在させてゲートリーク電流の低減を図ることができる。
（５）周知のゲートフィールドプレート、ソースフィールドプレート、ドレインフィールドプレートの内の１つ又は複数を設けることができる。
（６）主半導体領域３〜３ｃの最も上に、表面電荷のコントロールのため等の目的で例えばアンドープＧａＮ等から成るキャップ層を設けることができる。
（７）図１〜図５にそれぞれ１つのソース電極６、ドレイン電極７及びのゲート電極８が示されているが、それぞれ複数個設けることができる。
（８）実施例１〜４において、電子供給層（５，５ａ〜５ｂ）のソース電極６及びドレイン電極７の下の部分を除去し、ソース電極６及びドレイン電極７を電子走行層４に直接に接続することができる。
（９）第１の絶縁膜９を、ＳｉＮ以外のＳｉＮｘ（ｘはＳｉに対するＮの割合を示す任意の数値）、Ｓｉ2Ｎ3，Ｓｉ3Ｎ4等の別のシリコン窒化物、又は主半導体領域３の一方の主面１４が延びる方向（面方向）において引っ張り応力即ち伸張性歪みを発生する別の絶縁材料で形成することができる。
（１０）第２の絶縁膜１０を、ＳｉＯX以外の圧縮応力即ち圧縮性歪みを発生する別の絶縁材料で形成することができる。
【図面の簡単な説明】
【００３６】
【図１】本発明の実施例１の電界効果半導体装置を示す断面図である。
【図２】本発明の実施例２の電界効果半導体装置を示す断面図である。
【図３】本発明の実施例３の電界効果半導体装置を示す断面図である。
【図４】本発明の実施例４の電界効果半導体装置を示す断面図である。
【図５】本発明の実施例５の電界効果半導体装置を示す断面図である。
【符号の説明】
【００３７】
１ 基板
２ バッファ層
３ 主半導体領域
４ 電子走行層（第１の半導体層）
５ 電子供給層（第２の半導体層）
６ ソース電極
７ ドレイン電極
８ ゲート電極
９ 第１の絶縁膜
１０ 第２の絶縁膜
１１ 圧電体層
【特許請求の範囲】
【請求項１】
第１の半導体層と、前記第１の半導体層にヘテロ接合され且つ前記ヘテロ接合に基づいて２次元キャリアガス層を形成することができる材料から成る第２の半導体層とを備えている主半導体領域と、
前記主半導体領域の一方の主面上に配置されたソース電極と、
前記主半導体領域の一方の主面上に前記ソース電極から離間して配置されたドレイン電極と、
前記ソース電極と前記ドレイン電極との間の電流通路を制御するために前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間に配置されたゲート電極と、
前記ゲート電極と前記主半導体領域の一方の主面との間に配置され且つ平面的に見て前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間の一部のみに配置され且つ前記２次元キャリアガス層のキャリア濃度を低減させる方向の応力を発生する材料で形成された絶縁膜と、
前記ゲート電極と前記絶縁膜との間に配置され且つ前記ゲート電極に印加された電圧に応答して前記絶縁膜の前記応力を打ち消す方向の歪みを発生する材料から成る圧電体層と
を備えていることを特徴とする電界効果半導体装置。
【請求項２】
前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間の前記絶縁膜が配置されていない部分の上に前記２次元キャリアガス層のキャリア濃度を高める方向の応力を発生する材料から成る別の絶縁膜が配置されていることを特徴とする請求項１記載の電界効果半導体装置。
【請求項３】
前記圧電体層は前記別の絶縁膜の上に延在している延在部分を有し、前記ゲート電極は前記圧電体層の前記延在部分の上に延在している部分を有していることを特徴とする請求項２記載の電界効果半導体装置。
【請求項４】
前記圧電体層は前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間の前記絶縁膜が配置されていない部分の上に延在している延在部分を有し、前記ゲート電極は前記圧電体層の前記延在部分の上に延在している部分を有していることを特徴とする請求項１記載の電界効果半導体装置。
【請求項５】
前記２次元キャリアガス層のキャリア濃度を低減する方向の応力を発生する材料から成る絶縁膜はシリコン窒化物から成ることを特徴とする請求項１乃至４のいずれか１つに記載の電界効果半導体装置。
【請求項６】
前記２次元キャリアガス層のキャリア濃度を高める方向の応力を発生する材料から成る別の絶縁膜はシリコン酸化膜から成ることを特徴とする請求項２又は３記載の電界効果半導体装置。
【請求項７】
前記圧電体層は、遷移金属又はリチウム（Ｌｉ）が添加されたＺｎＯ（酸化亜鉛）、Ｐｂ（鉛）とＺｒ（ジルコニウム）とＴｉ（チタン）とを主成分とする酸化物、及びＬａ（ランタン）とＴｉ（チタン）とを主成分とする酸化物から選択されたものであるであることを特徴とする請求項１乃至６のいずれか１つに記載の電界効果半導体装置。
【請求項８】
前記主半導体領域は、更に、前記第１の半導体層と前記第２の半導体層との間に配置されたスペーサー層を有することを特徴とする請求項１乃至７のいずれか１つに記載の電界効果半導体装置。
【請求項９】
前記第２の半導体層は前記ゲート電極に対向する部分に凹部を有していることを特徴とする請求項１乃至８のいずれか１つに記載の電界効果半導体装置。
【請求項１０】
第１の半導体層と、前記第１の半導体層にヘテロ接合され且つ前記ヘテロ接合に基づいて２次元キャリアガス層を形成することができる材料から第２の半導体層とを備え、且つ第２の半導体層を第１の部分と第２の部分とに分割する溝を有している主半導体領域と、
前記第２の半導体層の第１の部分の上に配置されたソース電極と、
前記第２の半導体層の第２の部分の上に配置されたドレイン電極と、
前記溝の中及び平面的に見て前記第２の半導体層の前記ソース電極と前記ドレイン電極との間の少なくとも一部の上に配置され且つ印加された電界に応答して前記２次元キャリアガス層におけるキャリア濃度を高めることができる方向の応力を生じる圧電特性を有し且つ絶縁性を有する材料で形成された圧電体層と、
前記ソース電極と前記ドレイン電極との間の電流通路を制御するために前記圧電体層の上に配置されたゲート電極と
を備えていることを特徴とする電界効果半導体装置。
【請求項１】
第１の半導体層と、前記第１の半導体層にヘテロ接合され且つ前記ヘテロ接合に基づいて２次元キャリアガス層を形成することができる材料から成る第２の半導体層とを備えている主半導体領域と、
前記主半導体領域の一方の主面上に配置されたソース電極と、
前記主半導体領域の一方の主面上に前記ソース電極から離間して配置されたドレイン電極と、
前記ソース電極と前記ドレイン電極との間の電流通路を制御するために前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間に配置されたゲート電極と、
前記ゲート電極と前記主半導体領域の一方の主面との間に配置され且つ平面的に見て前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間の一部のみに配置され且つ前記２次元キャリアガス層のキャリア濃度を低減させる方向の応力を発生する材料で形成された絶縁膜と、
前記ゲート電極と前記絶縁膜との間に配置され且つ前記ゲート電極に印加された電圧に応答して前記絶縁膜の前記応力を打ち消す方向の歪みを発生する材料から成る圧電体層と
を備えていることを特徴とする電界効果半導体装置。
【請求項２】
前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間の前記絶縁膜が配置されていない部分の上に前記２次元キャリアガス層のキャリア濃度を高める方向の応力を発生する材料から成る別の絶縁膜が配置されていることを特徴とする請求項１記載の電界効果半導体装置。
【請求項３】
前記圧電体層は前記別の絶縁膜の上に延在している延在部分を有し、前記ゲート電極は前記圧電体層の前記延在部分の上に延在している部分を有していることを特徴とする請求項２記載の電界効果半導体装置。
【請求項４】
前記圧電体層は前記主半導体領域の一方の主面上における前記ソース電極と前記ドレイン電極との間の前記絶縁膜が配置されていない部分の上に延在している延在部分を有し、前記ゲート電極は前記圧電体層の前記延在部分の上に延在している部分を有していることを特徴とする請求項１記載の電界効果半導体装置。
【請求項５】
前記２次元キャリアガス層のキャリア濃度を低減する方向の応力を発生する材料から成る絶縁膜はシリコン窒化物から成ることを特徴とする請求項１乃至４のいずれか１つに記載の電界効果半導体装置。
【請求項６】
前記２次元キャリアガス層のキャリア濃度を高める方向の応力を発生する材料から成る別の絶縁膜はシリコン酸化膜から成ることを特徴とする請求項２又は３記載の電界効果半導体装置。
【請求項７】
前記圧電体層は、遷移金属又はリチウム（Ｌｉ）が添加されたＺｎＯ（酸化亜鉛）、Ｐｂ（鉛）とＺｒ（ジルコニウム）とＴｉ（チタン）とを主成分とする酸化物、及びＬａ（ランタン）とＴｉ（チタン）とを主成分とする酸化物から選択されたものであるであることを特徴とする請求項１乃至６のいずれか１つに記載の電界効果半導体装置。
【請求項８】
前記主半導体領域は、更に、前記第１の半導体層と前記第２の半導体層との間に配置されたスペーサー層を有することを特徴とする請求項１乃至７のいずれか１つに記載の電界効果半導体装置。
【請求項９】
前記第２の半導体層は前記ゲート電極に対向する部分に凹部を有していることを特徴とする請求項１乃至８のいずれか１つに記載の電界効果半導体装置。
【請求項１０】
第１の半導体層と、前記第１の半導体層にヘテロ接合され且つ前記ヘテロ接合に基づいて２次元キャリアガス層を形成することができる材料から第２の半導体層とを備え、且つ第２の半導体層を第１の部分と第２の部分とに分割する溝を有している主半導体領域と、
前記第２の半導体層の第１の部分の上に配置されたソース電極と、
前記第２の半導体層の第２の部分の上に配置されたドレイン電極と、
前記溝の中及び平面的に見て前記第２の半導体層の前記ソース電極と前記ドレイン電極との間の少なくとも一部の上に配置され且つ印加された電界に応答して前記２次元キャリアガス層におけるキャリア濃度を高めることができる方向の応力を生じる圧電特性を有し且つ絶縁性を有する材料で形成された圧電体層と、
前記ソース電極と前記ドレイン電極との間の電流通路を制御するために前記圧電体層の上に配置されたゲート電極と
を備えていることを特徴とする電界効果半導体装置。
【図１】
【図２】
【図３】
【図４】
【図５】
【図２】
【図３】
【図４】
【図５】
【公開番号】特開２００９−４７４３（Ｐ２００９−４７４３Ａ）
【公開日】平成２１年１月８日（２００９．１．８）
【国際特許分類】
【出願番号】特願２００８−１０８９０２（Ｐ２００８−１０８９０２）
【出願日】平成２０年４月１８日（２００８．４．１８）
【出願人】（０００１０６２７６）サンケン電気株式会社 (982)
【Ｆターム（参考）】
【公開日】平成２１年１月８日（２００９．１．８）
【国際特許分類】
【出願日】平成２０年４月１８日（２００８．４．１８）
【出願人】（０００１０６２７６）サンケン電気株式会社 (982)
【Ｆターム（参考）】
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