【課題】量産性の高い新たな半導体材料を用いた大電力向けの半導体装置の作製方法を提供する。
【解決手段】ＧＲＴＡ装置を用いて、第１の酸化物半導体膜に熱を加え、熱が加えられた第１の酸化物半導体膜に、酸素を添加して第２の酸化物半導体膜とし、ＧＲＴＡ装置を用いて、酸素が添加された第２の酸化物半導体膜に熱を加える。ＧＲＴＡ装置は、高温のガスを用いて加熱処理を行う装置であって、当該ＧＲＴＡ装置を用いると短時間での高温加熱処理が可能となる。

【発明の詳細な説明】
【技術分野】
【０００１】
酸化物半導体を用いる半導体装置及びその作製方法に関する。
【背景技術】
【０００２】
絶縁表面上に形成される半導体膜を用いたトランジスタは、半導体装置にとって必要不可
欠な半導体素子である。トランジスタの製造には基板の耐熱温度という制約があるため、
比較的低温での成膜が可能なアモルファスシリコン、レーザ光または触媒元素を用いた結
晶化により得られるポリシリコンなどを活性層に有するトランジスタが、半導体表示装置
に用いられるトランジスタの主流となっている。
【０００３】
近年では、ポリシリコンによって得られる高い移動度と、アモルファスシリコンによって
得られる均一な素子特性とを兼ね備えた新たな半導体材料として、酸化物半導体と呼ばれ
る、半導体特性を示す金属酸化物に注目が集まっている。金属酸化物は様々な用途に用い
られており、例えば、よく知られた金属酸化物である酸化インジウムは、液晶表示装置な
どで透明電極材料として用いられている。半導体特性を示す金属酸化物としては、例えば
、酸化タングステン、酸化錫、酸化インジウム、酸化亜鉛などがあり、このような半導体
特性を示す金属酸化物をチャネル形成領域に用いるトランジスタが、既に知られている（
特許文献１及び特許文献２）。
【先行技術文献】
【特許文献】
【０００４】
【特許文献１】特開２００７−１２３８６１号公報
【特許文献２】特開２００７−９６０５５号公報
【発明の概要】
【発明が解決しようとする課題】
【０００５】
半導体装置に用いられるトランジスタは、経時劣化による閾値電圧のばらつきが小さいこ
と、また、オフ電流が低いことなどが望まれる。経時劣化による閾値電圧のばらつきが小
さいトランジスタを用いることで、半導体装置の信頼性を高めることができる。また、オ
フ電流が低いトランジスタを用いることで、半導体装置の消費電力を抑えることができる
。
【０００６】
本発明は、信頼性の高い半導体装置の作製方法の提供を目的の一とする。或いは、本発明
は、消費電力が低い半導体装置の作製方法の提供を目的の一とする。或いは、本発明は、
信頼性の高い半導体装置の提供を目的の一とする。或いは、本発明は、消費電力が低い半
導体装置の提供を目的の一とする。
【０００７】
また、高耐圧であって、且つ大電流を制御するためのパワーデバイスと呼ばれる半導体装
置では、現状、半導体材料として主にシリコンが用いられている。しかし、シリコンを用
いた半導体素子では、その物理的な特性が理論値の限界にきていると言われており、さら
なる高耐圧と大電流の制御が可能なパワーデバイスを実現するためには、特性の向上が可
能な新たな半導体材料が求められている。高耐圧、高変換効率、高速スイッチングなどの
諸特性を向上させる可能性がある半導体材料として、例えば、炭化シリコンや窒化ガリウ
ムなどの化合物半導体を挙げることができる。炭化シリコンのバンドギャップは３．２６
ｅＶ、窒化ガリウムのバンドギャップは３．３９ｅＶと、ともにシリコンの約３倍程度の
大きなバンドギャップを有しており、半導体装置の耐圧向上、電力損失の低減などに有利
であることが知られている。
【０００８】
ところが、炭化シリコンや窒化ガリウムなどの化合物半導体は、プロセス温度が高いとい
う問題があった。炭化シリコンのプロセス温度は約１５００℃、窒化ガリウムのプロセス
温度は約１１００℃と、いずれも耐熱温度の低いガラス基板上への成膜は不可能である。
よって、安価なガラス基板を利用できない上に、基板の大型化には対応できないため、炭
化シリコンや窒化ガリウムなどの化合物半導体を用いた半導体装置は量産性が低く、その
ことが実用化の足かせとなっている。
【０００９】
上述した問題に鑑み、量産性の高い新たな半導体材料を用いた大電力向けの半導体装置を
提供することを目的の一とする。
【課題を解決するための手段】
【００１０】
本発明者らは、酸化物半導体膜中に存在する水素、水などの不純物が、閾値電圧のシフト
などの経時劣化をトランジスタにもたらす要因であることに着目した。スパッタ等で成膜
された酸化物半導体膜中には、不純物としての水素または水が多量に含まれていることが
判明している。そこで、本発明の一態様では、酸化物半導体膜中の水分または水素などの
不純物を低減するために、酸化物半導体膜を形成した後、酸化物半導体膜が露出した状態
で、減圧雰囲気下、窒素や希ガスなどの不活性ガス雰囲気下、酸素ガス雰囲気下、又は超
乾燥エア（ＣＲＤＳ（キャビティリングダウンレーザー分光法）方式の露点計を用いて測
定した場合の水分量が２０ｐｐｍ（露点換算で−５５℃）以下、好ましくは１ｐｐｍ以下
、好ましくは１０ｐｐｂ以下の空気）雰囲気下で第１の加熱処理を行う。次いで、酸化物
半導体膜中の水分、または水素などの不純物をさらに低減するために、イオン注入法また
はイオンドーピング法などを用いて、酸化物半導体膜に酸素を添加した後、再び、酸化物
半導体膜が露出した状態で、減圧雰囲気下、窒素や希ガスなどの不活性ガス雰囲気下、酸
素ガス雰囲気下、又は超乾燥エア（ＣＲＤＳ（キャビティリングダウンレーザー分光法）
方式の露点計を用いて測定した場合の水分量が２０ｐｐｍ（露点換算で−５５℃）以下、
好ましくは１ｐｐｍ以下、好ましくは１０ｐｐｂ以下の空気）雰囲気下で第２の加熱処理
を行う。
【００１１】
第１の加熱処理により、酸化物半導体膜中の水分または水素などの不純物は低減されるが
、完全には取り除かれてはおらず、改善の余地が残されている。これは、酸化物半導体を
構成している金属と結合している水素または水酸基が原因であると考えられる。本発明で
は、イオン注入法またはイオンドーピング法などを用いて、酸化物半導体膜に酸素を添加
することで、酸化物半導体を構成している金属と水素の間の結合、或いは該金属と水酸基
の間の結合を切断するとともに、これら水素または水酸基を酸素と反応させて、水を生成
する。そして、酸素の添加後に第２の加熱処理を行うことで、強固に残存していた水素ま
たは水酸基などの不純物を、水として、脱離させやすくすることができる。
【００１２】
水分、水素などの不純物の脱離により、ｉ型（真性半導体）又はｉ型に限りなく近い酸化
物半導体を得ることができれば、上記不純物により閾値電圧がシフトするなどのトランジ
スタの特性の劣化が促進されるのを防ぎ、オフ電流を低減させることができる。具体的に
、酸化物半導体に含まれる水素若しくは水などの不純物を除去し、二次イオン質量分析法
（ＳＩＭＳ：Ｓｅｃｏｎｄａｒｙ Ｉｏｎ Ｍａｓｓ Ｓｐｅｃｔｒｏｓｃｏｐｙ）によ
る酸化物半導体に含まれる水素濃度の測定値が、５×１０^１９／ｃｍ^３以下、好ましくは
５×１０^１８／ｃｍ^３以下、より好ましくは５×１０^１７／ｃｍ^３以下、さらに好ましく
は１×１０^１６／ｃｍ^３未満とする。また、ホール効果測定により測定できる酸化物半導
体膜のキャリア密度は、１×１０^１４ｃｍ^−３未満、好ましくは１×１０^１２ｃｍ^−３未
満、さらに好ましくは測定限界以下の１×１０^１１ｃｍ^−３未満とする。即ち、酸化物半
導体膜のキャリア密度は、限りなくゼロに近い。また、バンドギャップは２ｅＶ以上、好
ましくは２．５ｅＶ以上、より好ましくは３ｅＶ以上である。水素濃度が十分に低減され
て高純度化された酸化物半導体膜を用いることにより、トランジスタのオフ電流を下げる
ことができる。
【００１３】
上記２回の加熱処理は、３００℃以上８５０℃以下（若しくはガラス基板の歪点以下）の
温度範囲で行うのが望ましい。なお、この加熱処理は、用いる基板の耐熱温度を超えない
ものとする。水または水素の加熱処理による脱離の効果については、ＴＤＳ（Ｔｈｅｒｍ
ａｌ Ｄｅｓｏｒｐｔｉｏｎ Ｓｐｅｃｔｒｏｓｃｏｐｙ；昇温脱離ガス分析）により確
認済みである。
【００１４】
加熱処理は、炉での熱処理、またはラピッドサーマルアニール法（ＲＴＡ法）を用いる。
ＲＴＡ法は、ランプ光源を用いる方法と、加熱されたガス中に基板を移動させて短時間の
熱処理を行う方法がある。ＲＴＡ法を用いると熱処理に要する時間を０．１時間よりも短
時間とすることもできる。
【００１５】
具体的に、上述したように高純度化された酸化物半導体膜を用いたトランジスタは、例え
ば、チャネル幅Ｗが１×１０^４μｍでチャネル長Ｌが３μｍの素子であっても、オフ電流
が１０^−１３Ａ以下、サブスレッショルドスイング値（Ｓ値）が０．１Ｖ／ｄｅｃ．程度
（ゲート絶縁膜厚１００ｎｍ）の特性が得られる。従って、ゲート電極とソース電極間の
電圧が０以下の状態におけるオフ電流、すなわちリーク電流が、結晶性を有するシリコン
を用いたトランジスタに比べて著しく低い。
【００１６】
また、高純度化された酸化物半導体（ｐｕｒｉｆｉｅｄ ＯＳ）を用いたトランジスタは
、オフ電流の温度依存性がほとんど現れない。これは、酸化物半導体中で電子供与体（ド
ナー）となる不純物を除去して、酸化物半導体が高純度化することによって、導電型が限
りなく真性型に近づき、フェルミ準位が禁制帯の中央に位置するためと言える。また、こ
れは、酸化物半導体のエネルギーギャップが３ｅＶ以上であり、熱励起キャリアが極めて
少ないことにも起因する。また、ソース電極及びドレイン電極が縮退した状態にあること
も、温度依存性が現れない要因となっている。トランジスタの動作は、縮退したソース電
極から酸化物半導体に注入されたキャリアによるものがほとんどであり、キャリア密度の
温度依存性がないことから上記特性（オフ電流の温度依存性無し）を説明することができ
る。
【００１７】
酸化物半導体は、四元系金属酸化物であるＩｎ−Ｓｎ−Ｇａ−Ｚｎ−Ｏ系酸化物半導体や
、三元系金属酸化物であるＩｎ−Ｇａ−Ｚｎ−Ｏ系酸化物半導体、Ｉｎ−Ｓｎ−Ｚｎ−Ｏ
系酸化物半導体、Ｉｎ−Ａｌ−Ｚｎ−Ｏ系酸化物半導体、Ｓｎ−Ｇａ−Ｚｎ−Ｏ系酸化物
半導体、Ａｌ−Ｇａ−Ｚｎ−Ｏ系酸化物半導体、Ｓｎ−Ａｌ−Ｚｎ−Ｏ系酸化物半導体や
、二元系金属酸化物であるＩｎ−Ｚｎ−Ｏ系酸化物半導体、Ｓｎ−Ｚｎ−Ｏ系酸化物半導
体、Ａｌ−Ｚｎ−Ｏ系酸化物半導体、Ｚｎ−Ｍｇ−Ｏ系酸化物半導体、Ｓｎ−Ｍｇ−Ｏ系
酸化物半導体、Ｉｎ−Ｍｇ−Ｏ系酸化物半導体、Ｉｎ−Ｇａ−Ｏ系酸化物半導体や、Ｉｎ
−Ｏ系酸化物半導体、Ｓｎ−Ｏ系酸化物半導体、Ｚｎ−Ｏ系酸化物半導体などを用いるこ
とができる。なお、本明細書においては、例えば、Ｉｎ−Ｓｎ−Ｇａ−Ｚｎ−Ｏ系酸化物
半導体とは、インジウム（Ｉｎ）、錫（Ｓｎ）、ガリウム（Ｇａ）、亜鉛（Ｚｎ）を有す
る金属酸化物、という意味であり、その化学量論的組成比は特に問わない。また、上記酸
化物半導体は、珪素を含んでいてもよい。
【００１８】
或いは、酸化物半導体は、化学式ＩｎＭＯ_３（ＺｎＯ）_ｍ（ｍ＞０）で表記することがで
きる。ここで、Ｍは、Ｇａ、Ａｌ、Ｍｎ及びＣｏから選ばれた一又は複数の金属元素を示
す。
【００１９】
ここで、酸化物半導体膜中及び導電膜中の、水素濃度の分析について触れておく。酸化物
半導体膜中及び導電膜中の水素濃度測定は、二次イオン質量分析法（ＳＩＭＳ：Ｓｅｃｏ
ｎｄａｒｙ Ｉｏｎ Ｍａｓｓ Ｓｐｅｃｔｒｏｓｃｏｐｙ）で行う。ＳＩＭＳ分析は、
その原理上、試料表面近傍や、材質が異なる膜との積層界面近傍のデータを正確に得るこ
とが困難であることが知られている。そこで、膜中における水素濃度の厚さ方向の分布を
、ＳＩＭＳで分析する場合、対象となる膜が存在する範囲において、値に極端な変動がな
く、ほぼ一定の値が得られる領域における平均値を、水素濃度として採用する。また、測
定の対象となる膜の厚さが薄い場合、隣接する膜内の水素濃度の影響を受けて、ほぼ一定
の値が得られる領域を見いだせない場合がある。この場合、当該膜が存在する領域におけ
る、水素濃度の極大値又は極小値を、当該膜中の水素濃度として採用する。更に、当該膜
が存在する領域において、極大値を有する山型のピーク、極小値を有する谷型のピークが
存在しない場合、変曲点の値を水素濃度として採用する。
【００２０】
トランジスタは、ボトムゲート型であっても良いし、トップゲート型であっても良いし、
ボトムコンタクト型であっても良い。ボトムゲート型トランジスタは、絶縁表面上のゲー
ト電極と、ゲート電極上のゲート絶縁膜と、ゲート絶縁膜上においてゲート電極と重なる
酸化物半導体膜と、酸化物半導体膜上のソース電極、ドレイン電極と、ソース電極、ドレ
イン電極及び酸化物半導体膜上の絶縁膜とを有する。トップゲート型トランジスタは、絶
縁表面上の酸化物半導体膜と、酸化物半導体膜上のゲート絶縁膜と、ゲート絶縁膜上にお
いて酸化物半導体膜と重なり、なおかつ導電膜として機能するゲート電極と、ソース電極
と、ドレイン電極と、ソース電極、ドレイン電極及び酸化物半導体膜上の絶縁膜とを有す
る。ボトムコンタクト型トランジスタは、絶縁表面上のゲート電極と、ゲート電極上のゲ
ート絶縁膜と、ゲート絶縁膜上のソース電極、ドレイン電極と、ソース電極、ドレイン電
極上にあり、なおかつゲート絶縁膜上においてゲート電極と重なる酸化物半導体膜と、ソ
ース電極、ドレイン電極及び酸化物半導体膜上の絶縁膜とを有する。
【００２１】
また、酸化物半導体膜は、スパッタ等による成膜時のみならず、成膜後においても酸化物
半導体膜の周囲に存在する水素または水を膜中に取り込みやすい。水または水素はドナー
準位を形成しやすいため、酸化物半導体自体にとっては不純物である。よって、本発明の
一態様では、ソース電極とドレイン電極を形成した後は、ソース電極、ドレイン電極及び
酸化物半導体膜を覆うように、バリア性の高い絶縁材料を用いた絶縁膜を形成しても良い
。上記絶縁膜には、バリア性の高い絶縁材料を用いるのが望ましい。例えば、バリア性の
高い絶縁膜として、窒化珪素膜、窒化酸化珪素膜、窒化アルミニウム膜、または窒化酸化
アルミニウム膜などを用いることができる。複数の積層された絶縁膜を用いる場合、上記
バリア性の高い絶縁膜よりも、含まれる窒素の比率が低い酸化珪素膜、酸化窒化珪素膜な
どの絶縁膜を、酸化物半導体膜に近い側に形成する。そして、窒素の比率が低い絶縁膜を
間に挟んで、ソース電極、ドレイン電極及び酸化物半導体膜と重なるように、バリア性を
有する絶縁膜を形成する。バリア性を有する絶縁膜を用いることで、酸化物半導体膜内、
ゲート絶縁膜内、或いは、酸化物半導体膜と他の絶縁膜の界面とその近傍に、水分、また
は水素などの不純物が入り込むのを防ぐことができる。
【００２２】
また、ゲート電極と酸化物半導体膜の間に、バリア性の高い材料を用いた絶縁膜と、含ま
れる窒素の比率が低い酸化珪素膜、酸化窒化珪素膜などの絶縁膜とを積層させた構造を有
するゲート絶縁膜を、形成しておいても良い。酸化珪素膜、酸化窒化珪素膜などの絶縁膜
は、バリア性を有する絶縁膜と酸化物半導体膜の間に形成する。バリア性を有する絶縁膜
を用いることで、水分、または水素などの雰囲気中の不純物、或いは基板内に含まれるア
ルカリ金属、重金属などの不純物が、酸化物半導体膜内、ゲート絶縁膜内、或いは、酸化
物半導体膜と他の絶縁膜の界面とその近傍に入り込むのを防ぐことができる。
【発明の効果】
【００２３】
信頼性の高い半導体装置の作製方法を提供することができる。また、消費電力が低い半導
体装置の作製方法を提供することができる。また、信頼性の高い半導体装置を提供するこ
とができる。また、消費電力が低い半導体装置を提供することができる。
【００２４】
また、低い成膜温度で高耐圧の半導体素子を作製することができるので、量産性の高い大
電力向けの半導体装置を提供することができる。
【図面の簡単な説明】
【００２５】
【図１】半導体装置の作製方法を示す図。
【図２】半導体装置の作製方法を示す図。
【図３】半導体装置の作製方法を示す図。
【図４】半導体装置の作製方法を示す図。
【図５】半導体装置の作製方法を示す図。
【図６】半導体装置の作製方法を示す図。
【図７】半導体装置の上面図。
【図８】半導体装置の作製方法を示す図。
【図９】半導体装置の上面図。
【図１０】半導体装置の作製方法を示す図。
【図１１】電子ペーパーの上面図及び断面図。
【図１２】半導体表示装置のブロック図。
【図１３】信号線駆動回路の構成を説明する図。
【図１４】シフトレジスタの構成を示す回路図。
【図１５】シフトレジスタの一態様を示す図、及びその動作を説明するタイミングチャート。
【図１６】液晶表示装置の断面図。
【図１７】液晶表示装置のモジュールの構成を示す図。
【図１８】発光装置の断面図。
【図１９】半導体装置を用いた電子機器の図。
【図２０】酸化物半導体を用いた逆スタガ型のトランジスタの縦断面図。
【図２１】図２０に示すＡ−Ａ’断面におけるエネルギーバンド図（模式図）。
【図２２】（Ａ）ゲート電極（ＧＥ）に正の電圧（ＶＧ＞０）が印加された状態を示し、（Ｂ）ゲート電極（ＧＥ）に負の電圧（ＶＧ＜０）が印加された状態を示す図。
【図２３】真空準位と金属の仕事関数（φ_Ｍ）、酸化物半導体の電子親和力（χ）の関係を示す図。
【発明を実施するための形態】
【００２６】
以下では、本発明の実施の形態について図面を用いて詳細に説明する。ただし、本発明は
以下の説明に限定されず、本発明の趣旨及びその範囲から逸脱することなくその形態及び
詳細を様々に変更し得ることは、当業者であれば容易に理解される。したがって、本発明
は、以下に示す実施の形態の記載内容に限定して解釈されるものではない。
【００２７】
なお本発明は、マイクロプロセッサ、画像処理回路などの集積回路や、ＲＦタグ、半導体
表示装置等、ありとあらゆる半導体装置の作製に用いることができる。半導体装置とは、
半導体特性を利用することで機能しうる装置全般を意味し、半導体表示装置、半導体回路
および電子機器は全て半導体装置である。半導体表示装置は、液晶表示装置、有機発光素
子（ＯＬＥＤ）に代表される発光素子を各画素に備えた発光装置、電子ペーパー、ＤＭＤ
（Ｄｉｇｉｔａｌ Ｍｉｃｒｏｍｉｒｒｏｒ Ｄｅｖｉｃｅ）、ＰＤＰ（Ｐｌａｓｍａ
Ｄｉｓｐｌａｙ Ｐａｎｅｌ）、ＦＥＤ（Ｆｉｅｌｄ Ｅｍｉｓｓｉｏｎ Ｄｉｓｐｌａ
ｙ）等や、半導体膜を用いた回路素子を駆動回路に有しているその他の半導体表示装置が
その範疇に含まれる。
【００２８】
（実施の形態１）
チャネルエッチ構造のボトムゲート型のトランジスタを例に挙げ、本発明の一態様に係る
半導体装置が有する、トランジスタの構造とその作製方法について説明する。
【００２９】
図１（Ａ）に示すように、基板１００上にゲート電極１０１を形成する。
【００３０】
絶縁表面を有する基板１００として使用することができる基板に大きな制限はないが、少
なくとも、後の加熱処理に耐えうる程度の耐熱性を有していることが必要となる。例えば
、フュージョン法やフロート法で作製されるガラス基板を用いることができる。ガラス基
板としては、後の加熱処理の温度が高い場合には、歪み点が７３０℃以上のものを用いる
と良い。また、ガラス基板には、例えば、アルミノシリケートガラス、アルミノホウケイ
酸ガラス、バリウムホウケイ酸ガラスなどのガラス材料が用いられている。なお、一般に
、酸化ホウ素と比較して酸化バリウム（ＢａＯ）を多く含ませることで、より実用的な耐
熱ガラスが得られる。このため、Ｂ_２Ｏ_３よりＢａＯを多く含むガラス基板を用いること
が好ましい。
【００３１】
なお、上記のガラス基板に代えて、セラミック基板、石英基板、サファイア基板などの絶
縁体でなる基板を用いても良い。他にも、結晶化ガラスなどを用いることができる。ステ
ンレス合金などの金属基板の表面に絶縁膜を設けた基板を適用しても良い。
【００３２】
また、プラスチック等の可撓性を有する合成樹脂からなる基板は、耐熱温度が一般的に低
い傾向にあるが、後の作製工程における処理温度に耐え得るのであれば、基板１００とし
て用いることが可能である。プラスチック基板として、ポリエチレンテレフタレート（Ｐ
ＥＴ）に代表されるポリエステル、ポリエーテルスルホン（ＰＥＳ）、ポリエチレンナフ
タレート（ＰＥＮ）、ポリカーボネート（ＰＣ）、ポリエーテルエーテルケトン（ＰＥＥ
Ｋ）、ポリスルホン（ＰＳＦ）、ポリエーテルイミド（ＰＥＩ）、ポリアリレート（ＰＡ
Ｒ）、ポリブチレンテレフタレート（ＰＢＴ）、ポリイミド、アクリロニトリルブタジエ
ンスチレン樹脂、ポリ塩化ビニル、ポリプロピレン、ポリ酢酸ビニル、アクリル樹脂など
が挙げられる。
【００３３】
基板１００とゲート電極１０１の間に、下地膜となる絶縁膜を形成しておいても良い。下
地膜として、例えば、酸化珪素膜、酸化窒化珪素膜、窒化珪素膜、窒化酸化珪素膜、窒化
アルミニウム膜、または窒化酸化アルミニウム膜のいずれか１つを単層で、或いは複数を
積層させて用いることができる。特に、下地膜に、バリア性の高い絶縁膜、例えば窒化珪
素膜、窒化酸化珪素膜、窒化アルミニウム膜、または窒化酸化アルミニウム膜などを用い
ることで、水分、または水素などの雰囲気中の不純物、或いは基板１００内に含まれるア
ルカリ金属、重金属などの不純物が、酸化物半導体膜内、ゲート絶縁膜内、或いは、酸化
物半導体膜と他の絶縁膜の界面とその近傍に入り込むのを防ぐことができる。
【００３４】
なお、本明細書において酸化窒化物とは、その組成として、窒素よりも酸素の含有量が多
い物質であり、また、窒化酸化物とは、その組成として、酸素よりも窒素の含有量が多い
物質をいう。
【００３５】
ゲート電極１０１の材料は、モリブデン、チタン、クロム、タンタル、タングステン、ネ
オジム、スカンジウム等の金属材料、これら金属材料を主成分とする合金材料を用いた導
電膜、或いはこれら金属の窒化物を、単層で又は積層で用いることができる。なお、後の
工程において行われる加熱処理の温度に耐えうるのであれば、上記金属材料としてアルミ
ニウム、銅を用いることも出来る。アルミニウムまたは銅は、耐熱性や腐食性の問題を回
避するために、高融点金属材料と組み合わせて用いると良い。高融点金属材料としては、
モリブデン、チタン、クロム、タンタル、タングステン、ネオジム、スカンジウム等を用
いることができる。
【００３６】
例えば、二層の積層構造を有するゲート電極１０１として、アルミニウム膜上にモリブデ
ン膜が積層された二層の積層構造、または銅膜上にモリブデン膜を積層した二層構造、ま
たは銅膜上に窒化チタン膜若しくは窒化タンタル膜を積層した二層構造、窒化チタン膜と
モリブデン膜とを積層した二層構造とすることが好ましい。３層の積層構造を有するゲー
ト電極１０１としては、アルミニウム膜、アルミニウムとシリコンの合金膜、アルミニウ
ムとチタンの合金膜またはアルミニウムとネオジムの合金膜を中間層とし、タングステン
膜、窒化タングステン膜、窒化チタン膜またはチタン膜を上下層として積層した構造とす
ることが好ましい。
【００３７】
また、ゲート電極１０１に酸化インジウム、酸化インジウム酸化スズ合金、酸化インジウ
ム酸化亜鉛合金、酸化亜鉛、酸化亜鉛アルミニウム、酸窒化亜鉛アルミニウム、または酸
化亜鉛ガリウム等の透光性を有する酸化物導電膜を用いることで、画素部の開口率を向上
させることができる。
【００３８】
ゲート電極１０１の膜厚は、１０ｎｍ〜４００ｎｍ、好ましくは１００ｎｍ〜２００ｎｍ
とする。本実施の形態では、タングステンターゲットを用いたスパッタ法により１５０ｎ
ｍのゲート電極用の導電膜を形成した後、該導電膜をエッチングにより所望の形状に加工
（パターニング）することで、ゲート電極１０１を形成する。なお、形成されたゲート電
極の端部がテーパ形状であると、上に積層するゲート絶縁膜の被覆性が向上するため好ま
しい。なお、レジストマスクをインクジェット法で形成してもよい。レジストマスクをイ
ンクジェット法で形成するとフォトマスクを使用しないため、製造コストを低減できる。
【００３９】
次いで、ゲート電極１０１上に、ゲート絶縁膜１０２を形成する。ゲート絶縁膜１０２は
、プラズマＣＶＤ法又はスパッタリング法等を用いて、酸化珪素膜、窒化珪素膜、酸化窒
化珪素膜、窒化酸化珪素膜、酸化アルミニウム膜、窒化アルミニウム膜、酸化窒化アルミ
ニウム膜、窒化酸化アルミニウム膜、酸化ハフニウム膜または酸化タンタル膜を単層で又
は積層させて形成することができる。ゲート絶縁膜１０２は、水分や、水素などの不純物
を極力含まないことが望ましい。スパッタリング法により酸化珪素膜を成膜する場合には
、ターゲットとしてシリコンターゲット又は石英ターゲットを用い、スパッタガスとして
酸素又は、酸素及びアルゴンの混合ガスを用いて行う。
【００４０】
不純物を除去することによりｉ型化又は実質的にｉ型化された酸化物半導体（高純度化さ
れた酸化物半導体）は界面準位、界面電荷に対して極めて敏感であるため、ゲート絶縁膜
１０２との界面は重要である。そのため高純度化された酸化物半導体に接するゲート絶縁
膜（ＧＩ）は、高品質化が要求される。
【００４１】
例えば、μ波（２．４５ＧＨｚ）を用いた高密度プラズマＣＶＤは、緻密で絶縁耐圧の高
い高品質な絶縁膜を形成できるので好ましい。高純度化された酸化物半導体と高品質ゲー
ト絶縁膜とが密接することにより、界面準位を低減して界面特性を良好なものとすること
ができるからである。
【００４２】
もちろん、ゲート絶縁膜として良質な絶縁膜を形成できるものであれば、スパッタリング
法やプラズマＣＶＤ法など他の成膜方法を適用することができる。また、成膜後の熱処理
によってゲート絶縁膜の膜質、酸化物半導体との界面特性が改質される絶縁膜であっても
良い。いずれにしても、ゲート絶縁膜としての膜質が良好であることは勿論のこと、酸化
物半導体との界面準位密度を低減し、良好な界面を形成できるものであれば良い。
【００４３】
バリア性の高い材料を用いた絶縁膜と、含まれる窒素の比率が低い酸化珪素膜、酸化窒化
珪素膜などの絶縁膜とを積層させた構造を有するゲート絶縁膜１０２を形成しても良い。
この場合、酸化珪素膜、酸化窒化珪素膜などの絶縁膜は、バリア性を有する絶縁膜と酸化
物半導体膜の間に形成する。バリア性の高い絶縁膜として、例えば窒化珪素膜、窒化酸化
珪素膜、窒化アルミニウム膜、または窒化酸化アルミニウム膜などが挙げられる。バリア
性を有する絶縁膜を用いることで、水分または水素などの雰囲気中の不純物、或いは基板
内に含まれるアルカリ金属、重金属などの不純物が、酸化物半導体膜内、ゲート絶縁膜１
０２内、或いは、酸化物半導体膜と他の絶縁膜の界面とその近傍に入り込むのを防ぐこと
ができる。また、酸化物半導体膜に接するように窒素の比率が低い酸化珪素膜、酸化窒化
珪素膜などの絶縁膜を形成することで、バリア性の高い材料を用いた絶縁膜が直接酸化物
半導体膜に接するのを防ぐことができる。
【００４４】
例えば、第１のゲート絶縁膜としてスパッタリング法により膜厚５０ｎｍ以上２００ｎｍ
以下の窒化珪素膜（ＳｉＮ_ｙ（ｙ＞０））を形成し、第１のゲート絶縁膜上に第２のゲー
ト絶縁膜として膜厚５ｎｍ以上３００ｎｍ以下の酸化珪素膜（ＳｉＯ_ｘ（ｘ＞０））を積
層して、膜厚１００ｎｍのゲート絶縁膜１０２としても良い。ゲート絶縁膜１０２の膜厚
は、トランジスタに要求される特性によって適宜設定すればよく３５０ｎｍ乃至４００ｎ
ｍ程度でもよい。
【００４５】
本実施の形態では、スパッタ法で形成された膜厚５０ｎｍの窒化珪素膜上に、スパッタ法
で形成された膜厚１００ｎｍの酸化珪素膜を積層させた構造を有する、ゲート絶縁膜１０
２を形成する。
【００４６】
なお、ゲート絶縁膜１０２に水素、水酸基及び水分がなるべく含まれないようにするため
に、成膜の前処理として、スパッタリング装置の予備加熱室でゲート電極１０１が形成さ
れた基板１００を予備加熱し、基板１００に吸着した水素、水分などの不純物を脱離し排
気することが好ましい。なお、予備加熱の温度としては、１００℃以上４００℃以下好ま
しくは１５０℃以上３００℃以下である。なお、予備加熱室に設ける排気手段はクライオ
ポンプが好ましい。なお、この予備加熱の処理は省略することもできる。
【００４７】
次いで、ゲート絶縁膜１０２上に膜厚２ｎｍ以上２００ｎｍ以下、好ましくは膜厚３ｎｍ
以上５０ｎｍ以下、さらに好ましくは膜厚３ｎｍ以上２０ｎｍ以下の酸化物半導体膜１０
３を形成する。酸化物半導体膜１０３は、酸化物半導体をターゲットとして用い、スパッ
タ法により成膜する。また、酸化物半導体膜１０３は、希ガス（例えばアルゴン）雰囲気
下、酸素雰囲気下、又は希ガス（例えばアルゴン）及び酸素雰囲気下においてスパッタ法
により形成することができる。
【００４８】
なお、酸化物半導体膜１０３をスパッタ法により成膜する前に、アルゴンガスを導入して
プラズマを発生させる逆スパッタを行い、ゲート絶縁膜１０２の表面に付着している塵埃
を除去することが好ましい。逆スパッタとは、ターゲット側に電圧を印加せずに、アルゴ
ン雰囲気下で基板側にＲＦ電源を用いて電圧を印加して基板近傍にプラズマを形成して表
面を改質する方法である。なお、アルゴン雰囲気に代えて窒素、ヘリウムなどを用いても
よい。また、アルゴン雰囲気に酸素、亜酸化窒素などを加えた雰囲気で行ってもよい。ま
た、アルゴン雰囲気に塩素、四フッ化炭素などを加えた雰囲気で行ってもよい。
【００４９】
酸化物半導体膜１０３は、上述したような酸化物半導体を用いることができる。
【００５０】
本実施の形態では、Ｉｎ（インジウム）、Ｇａ（ガリウム）、及びＺｎ（亜鉛）を含む酸
化物半導体ターゲットを用いたスパッタ法により得られる膜厚３０ｎｍのＩｎ−Ｇａ−Ｚ
ｎ−Ｏ系非単結晶膜を、酸化物半導体膜１０３として用いる。上記ターゲットとして、例
えば、各金属の原子比がＩｎ：Ｇａ：Ｚｎ＝１：１：０．５、Ｉｎ：Ｇａ：Ｚｎ＝１：１
：１、またはＩｎ：Ｇａ：Ｚｎ＝１：１：２の組成比を有する酸化物半導体ターゲットを
用いることができる。また、酸化物半導体膜１０３は、希ガス（代表的にはアルゴン）雰
囲気下、酸素雰囲気下、又は希ガス（代表的にはアルゴン）及び酸素雰囲気下においてス
パッタリング法により形成することができる。また、スパッタリング法を用いる場合、Ｓ
ｉＯ_２を２重量％以上１０重量％以下含むターゲットを用いて成膜を行ってもよい。また
、Ｉｎ、Ｇａ、及びＺｎを含む酸化物半導体ターゲットの充填率は９０％以上１００％以
下、好ましくは９５％以上９９．９％以下である。充填率の高い酸化物半導体ターゲット
を用いることにより、成膜した酸化物半導体膜は緻密な膜となる。
【００５１】
減圧状態に保持された処理室内に基板を保持し、処理室内の残留水分を除去しつつ水素及
び水分が除去されたスパッタガスを導入し、金属酸化物をターゲットとして基板１００上
に酸化物半導体膜１０３を成膜する。成膜時に、基板温度を１００℃以上６００℃以下好
ましくは２００℃以上４００℃以下としても良い。基板を加熱しながら成膜することによ
り、成膜した酸化物半導体膜に含まれる不純物濃度を低減することができる。また、スパ
ッタリングによる損傷が軽減される。処理室内の残留水分を除去するためには、吸着型の
真空ポンプを用いることが好ましい。例えば、クライオポンプ、イオンポンプ、チタンサ
ブリメーションポンプを用いることが好ましい。また、排気手段としては、ターボポンプ
にコールドトラップを加えたものであってもよい。クライオポンプを用いて排気した成膜
室は、例えば、水素原子、水（Ｈ_２Ｏ）など水素原子を含む化合物（より好ましくは炭素
原子を含む化合物も）等が排気されるため、当該成膜室で成膜した酸化物半導体膜に含ま
れる不純物の濃度を低減できる。
【００５２】
成膜条件の一例としては、基板とターゲットの間との距離を１００ｍｍ、圧力０．６Ｐａ
、直流（ＤＣ）電源０．５ｋＷ、酸素（酸素流量比率１００％）雰囲気下の条件が適用さ
れる。なお、パルス直流（ＤＣ）電源を用いると、成膜時に発生するパーティクルと呼ば
れる塵埃が軽減でき、膜厚分布も均一となるために好ましい。酸化物半導体膜は好ましく
は５ｎｍ以上３０ｎｍ以下とする。なお、適用する酸化物半導体材料により適切な厚みは
異なり、材料に応じて適宜厚みを選択すればよい。
【００５３】
なお、酸化物半導体膜１０３に水素、水酸基及び水分がなるべく含まれないようにするた
めに、成膜の前処理として、スパッタリング装置の予備加熱室でゲート絶縁膜１０２まで
が形成された基板１００を予備加熱し、基板１００に吸着した水素、水分などの不純物を
脱離し排気することが好ましい。なお、予備加熱の温度としては、１００℃以上４００℃
以下好ましくは１５０℃以上３００℃以下である。なお、予備加熱室に設ける排気手段は
クライオポンプが好ましい。なお、この予備加熱の処理は省略することもできる。またこ
の予備加熱は、絶縁膜１１３の成膜前に、ソース電極１１１及びドレイン電極１１２まで
形成した基板１００にも同様に行ってもよい。
【００５４】
スパッタリング法にはスパッタ用電源に高周波電源を用いるＲＦスパッタリング法と、Ｄ
Ｃスパッタリング法があり、さらにパルス的にバイアスを与えるパルスＤＣスパッタリン
グ法もある。ＲＦスパッタリング法は主に絶縁膜を成膜する場合に用いられ、ＤＣスパッ
タリング法は主に金属膜を成膜する場合に用いられる。
【００５５】
また、材料の異なるターゲットを複数設置できる多元スパッタ装置もある。多元スパッタ
装置は、同一チャンバーで異なる材料膜を積層成膜することも、同一チャンバーで複数種
類の材料を同時に放電させて成膜することもできる。
【００５６】
また、チャンバー内部に磁石機構を備えたマグネトロンスパッタリング法を用いるスパッ
タ装置や、グロー放電を使わずマイクロ波を用いて発生させたプラズマを用いるＥＣＲス
パッタリング法を用いるスパッタ装置がある。
【００５７】
また、スパッタリング法を用いる成膜方法として、成膜中にターゲット物質とスパッタガ
ス成分とを化学反応させてそれらの化合物薄膜を形成するリアクティブスパッタリング法
や、成膜中に基板にも電圧をかけるバイアススパッタリング法もある。
【００５８】
ゲート絶縁膜１０２、及び酸化物半導体膜１０３を大気に触れさせることなく連続的に形
成してもよい。大気に触れさせることなく連続成膜することで、界面が、水やハイドロカ
ーボンなどの、大気成分や大気中に浮遊する不純物元素に汚染されることなく各積層界面
を形成することができるので、トランジスタ特性のばらつきを低減することができる。
【００５９】
次いで、図１（Ｂ）に示すように、酸化物半導体膜１０３をエッチングなどにより所望の
形状に加工（パターニング）し、ゲート電極１０１と重なる位置において、ゲート絶縁膜
１０２上に島状の酸化物半導体膜１０４を形成する。
【００６０】
島状の酸化物半導体膜１０４を形成するためのレジストマスクをインクジェット法で形成
してもよい。レジストマスクをインクジェット法で形成するとフォトマスクを使用しない
ため、製造コストを低減できる。
【００６１】
また、ゲート絶縁膜１０２にコンタクトホールを形成する場合、その工程は島状の酸化物
半導体膜１０４の形成時に行うことができる。
【００６２】
なお、島状の酸化物半導体膜１０４を形成するためのエッチングは、ドライエッチングで
もウェットエッチングでもよく、両方を用いてもよい。ドライエッチングに用いるエッチ
ングガスとしては、塩素を含むガス（塩素系ガス、例えば塩素（Ｃｌ_２）、三塩化硼素（
ＢＣｌ_３）、四塩化珪素（ＳｉＣｌ_４）、四塩化炭素（ＣＣｌ_４）など）が好ましい。ま
た、フッ素を含むガス（フッ素系ガス、例えば四弗化炭素（ＣＦ_４）、六弗化硫黄（ＳＦ
_６）、三弗化窒素（ＮＦ_３）、トリフルオロメタン（ＣＨＦ_３）など）、臭化水素（ＨＢ
ｒ）、酸素（Ｏ_２）、これらのガスにヘリウム（Ｈｅ）やアルゴン（Ａｒ）などの希ガス
を添加したガス、などを用いることができる。
【００６３】
ドライエッチング法としては、平行平板型ＲＩＥ（Ｒｅａｃｔｉｖｅ Ｉｏｎ Ｅｔｃｈ
ｉｎｇ）法や、ＩＣＰ（Ｉｎｄｕｃｔｉｖｅｌｙ Ｃｏｕｐｌｅｄ Ｐｌａｓｍａ：誘導
結合型プラズマ）エッチング法を用いることができる。所望の加工形状にエッチングでき
るように、エッチング条件（コイル型の電極に印加される電力量、基板側の電極に印加さ
れる電力量、基板側の電極温度等）を適宜調節する。
【００６４】
ウェットエッチングに用いるエッチング液としては、燐酸と酢酸と硝酸を混ぜた溶液、ク
エン酸やシュウ酸などの有機酸などを用いることができる。また、ＩＴＯ−０７Ｎ（関東
化学社製）を用いてもよい。また、ウェットエッチング後のエッチング液はエッチングさ
れた材料とともに洗浄によって除去される。その除去された材料を含むエッチング液の廃
液を精製し、含まれる材料を再利用してもよい。当該エッチング後の廃液から酸化物半導
体膜に含まれるインジウム等の材料を回収して再利用することにより、資源を有効活用し
低コスト化することができる。
【００６５】
なお、次工程の導電膜を形成する前に逆スパッタを行い、島状の酸化物半導体膜１０４及
びゲート絶縁膜１０２の表面に付着しているレジスト残渣などを除去することが好ましい
。
【００６６】
次いで、減圧雰囲気下、窒素や希ガスなどの不活性ガス雰囲気下、酸素ガス雰囲気下、又
は超乾燥エア（ＣＲＤＳ（キャビティリングダウンレーザー分光法）方式の露点計を用い
て測定した場合の水分量が２０ｐｐｍ（露点換算で−５５℃）以下、好ましくは１ｐｐｍ
以下、さらに好ましくは１０ｐｐｂ以下の空気）雰囲気下において、酸化物半導体膜１０
４に第１の加熱処理を施す。酸化物半導体膜１０４に加熱処理を施すことで、図１（Ｃ）
に示すように、水分、水素が脱離した酸化物半導体膜１０５が形成される。具体的には、
３００℃以上８５０℃以下（若しくはガラス基板の歪点以下の温度）で加熱処理を行えば
良い。ＲＴＡ法を用いれば、短時間に脱水化または脱水素化が行えるため、ガラス基板の
歪点を超える温度でも処理することができる。本実施の形態では、加熱処理装置の一つで
ある電気炉を用い、酸化物半導体膜１０４に対して、窒素雰囲気下において、基板温度が
４５０℃に達した状態で１時間、加熱処理を行った後、大気に触れることなく、水や水素
の再混入を防ぎ、酸化物半導体膜１０５を得る。
【００６７】
なお、加熱処理装置は電気炉に限られず、抵抗発熱体などの発熱体からの熱伝導または熱
輻射によって、被処理物を加熱する装置を備えていてもよい。例えば、ＧＲＴＡ（Ｇａｓ
Ｒａｐｉｄ Ｔｈｅｒｍａｌ Ａｎｎｅａｌ）装置、ＬＲＴＡ（Ｌａｍｐ Ｒａｐｉｄ
Ｔｈｅｒｍａｌ Ａｎｎｅａｌ）装置等のＲＴＡ（Ｒａｐｉｄ Ｔｈｅｒｍａｌ Ａｎ
ｎｅａｌ）装置を用いることができる。ＬＲＴＡ装置は、ハロゲンランプ、メタルハライ
ドランプ、キセノンアークランプ、カーボンアークランプ、高圧ナトリウムランプ、高圧
水銀ランプなどのランプから発する光（電磁波）の輻射により、被処理物を加熱する装置
である。ＧＲＴＡ装置は、高温のガスを用いて加熱処理を行う装置である。
【００６８】
例えば、第１の加熱処理として、６５０℃〜７００℃の高温に加熱したガス中に基板を移
動させて入れ、数分間加熱した後、基板を移動させて高温に加熱したガス中から出すＧＲ
ＴＡを行ってもよい。ＧＲＴＡを用いると短時間での高温加熱処理が可能となる。
【００６９】
なお、加熱処理においては、窒素、またはヘリウム、ネオン、アルゴン等の希ガスに、水
分、水素などが含まれないことが好ましい。または、加熱処理装置に導入する窒素、また
はヘリウム、ネオン、アルゴン等の希ガスの純度を、６Ｎ（９９．９９９９％）以上、好
ましくは７Ｎ（９９．９９９９９％）以上、（即ち不純物濃度を１ｐｐｍ以下、好ましく
は０．１ｐｐｍ以下）とすることが好ましい。
【００７０】
次いで、図１（Ｄ）に示すように、酸化物半導体膜に、イオン注入法またはイオンドーピ
ング法を用いて、酸素を添加する。イオン注入法またはイオンドーピング法などを用いて
、酸化物半導体膜１０５に酸素を添加することで、酸素が過剰に添加された酸化物半導体
膜１０７が形成される。酸素の添加により、酸化物半導体を構成している金属と水素の間
の結合、或いは該金属と水酸基の間の結合を切断するとともに、これら水素、または水酸
基が、酸素と反応することで水を生成する。よって、後に行われる第２の加熱処理により
、不純物である水素、または水酸基を、水として、脱離させやすくすることができる。
【００７１】
イオン注入法は、ソースガスをプラズマ化し、このプラズマに含まれるイオン種を引き出
し、質量分離して、所定の質量を有するイオン種を加速して、イオンビームとして、被処
理物に注入する方法である。また、イオンドーピング法は、ソースガスをプラズマ化し、
所定の電界の作用によりプラズマからイオン種を引き出し、引き出したイオン種を質量分
離せずに加速して、イオンビームとして被処理物に注入する方法である。質量分離を伴う
イオン注入法を用いて酸素の添加を行うことで、金属元素等の不純物が酸素と共に酸化物
半導体膜に添加されてしまうのを防ぐことができる。また、イオンドーピング法はイオン
注入法に比べてイオンビームの照射される面積を大きくすることができるので、イオンド
ーピング法を用いて酸素の添加を行うことで、タクトタイムを短縮することができる。
【００７２】
酸素ガスを用いて、イオン注入法で酸素の添加を行う場合、加速電圧を５ｋＶ以上１００
ｋＶ以下、ドーズ量を１×１０^１３ｉｏｎｓ／ｃｍ^２以上１×１０^１６ｉｏｎｓ／ｃｍ^２
以下とすれば良い。
【００７３】
なお、イオン注入法で酸化物半導体膜１０５への酸素の添加を行うのと並行して、酸化物
半導体膜１０５が形成された基板に対して、３００℃以上８５０℃以下（若しくはガラス
基板の歪点以下の温度）の範囲で、加熱処理を行うようにしても良い。
【００７４】
次いで、第２の加熱処理を行う。第２の加熱処理は、第１の加熱処理と同様の条件で行う
ことができる。具体的には、減圧雰囲気下、窒素や希ガスなどの不活性ガス雰囲気下、酸
素ガス雰囲気下、又は超乾燥エア（ＣＲＤＳ（キャビティリングダウンレーザー分光法）
方式の露点計を用いて測定した場合の水分量が２０ｐｐｍ（露点換算で−５５℃）以下、
好ましくは１ｐｐｍ以下、さらに好ましくは１０ｐｐｂ以下の空気）雰囲気下において、
３００℃以上８５０℃以下（若しくはガラス基板の歪点以下の温度）で加熱処理を行えば
よい。ＲＴＡ法を用いれば、短時間に脱水化または脱水素化が行えるため、ガラス基板の
歪点を超える温度でも処理することができる。本実施の形態では、加熱処理装置の一つで
ある電気炉を用い、窒素雰囲気下において、基板温度が４５０℃に達した状態で１時間、
加熱処理を行った後、大気に触れることなく、水や水素の再混入を防ぐことで、図１（Ｅ
）に示すように酸化物半導体膜１０８を得る。なお、上記加熱処理は、島状の酸化物半導
体膜１０８形成後に複数回行っても良い。
【００７５】
本発明の一態様では、酸化物半導体膜１０５への酸素の添加により、酸化物半導体を構成
している金属と水素の間の結合、或いは該金属と水酸基の間の結合を切断するとともに、
これら水素または水酸基を酸素と反応させて、水を生成する。そのため、酸素の添加後に
第２の加熱処理を行うことで、強固に残存していた水素または水酸基などの不純物を、水
として、脱離させやすくすることができる。よって、上記加熱処理によって形成された島
状の酸化物半導体膜１０８は、第１の加熱処理によってもなお取り除かれなかった水分ま
たは水素などの不純物が、除去されるので、第１の加熱処理後の酸化物半導体膜１０５よ
りも、さらに、ｉ型（真性半導体）又はｉ型に限りなく近くなる。水分、水素などの不純
物が脱離し、ｉ型（真性半導体）又はｉ型に限りなく近くなるため、上記不純物により閾
値電圧がシフトするなどのトランジスタの特性の劣化が促進されるのを防ぎ、オフ電流を
低減させることができる。
【００７６】
また、８５℃、２×１０^６Ｖ／ｃｍ、１２時間のゲートバイアス・熱ストレス試験（ＢＴ
試験）においては、不純物が酸化物半導体に添加されていると、不純物と酸化物半導体の
主成分との結合手が、強電界（Ｂ：バイアス）と高温（Ｔ：温度）により切断され、生成
された不対結合手がしきい値電圧（Ｖｔｈ）のドリフトを誘発することとなる。しかし、
上述したように、ゲート絶縁膜と酸化物半導体膜との界面特性を良好にし、なおかつ、酸
化物半導体膜中の不純物、特に水素や水等を極力除去することにより、ＢＴ試験に対して
も安定なトランジスタが得られる。
【００７７】
なお、加熱処理装置は電気炉に限られず、抵抗発熱体などの発熱体からの熱伝導または熱
輻射によって、被処理物を加熱する装置を備えていてもよい。例えば、ＧＲＴＡ（Ｇａｓ
Ｒａｐｉｄ Ｔｈｅｒｍａｌ Ａｎｎｅａｌ）装置、ＬＲＴＡ（Ｌａｍｐ Ｒａｐｉｄ
Ｔｈｅｒｍａｌ Ａｎｎｅａｌ）装置等のＲＴＡ（Ｒａｐｉｄ Ｔｈｅｒｍａｌ Ａｎ
ｎｅａｌ）装置を用いることができる。ＬＲＴＡ装置は、ハロゲンランプ、メタルハライ
ドランプ、キセノンアークランプ、カーボンアークランプ、高圧ナトリウムランプ、高圧
水銀ランプなどのランプから発する光（電磁波）の輻射により、被処理物を加熱する装置
である。ＧＲＴＡ装置は、高温のガスを用いて加熱処理を行う装置である。
【００７８】
例えば、第２の加熱処理として、６５０℃〜７００℃の高温に加熱したガス中に基板を移
動させて入れ、数分間加熱した後、基板を移動させて高温に加熱したガス中から出すＧＲ
ＴＡを行ってもよい。ＧＲＴＡを用いると短時間での高温加熱処理が可能となる。
【００７９】
なお、加熱処理においては、窒素、またはヘリウム、ネオン、アルゴン等の希ガスに、水
分、水素などが含まれないことが好ましい。または、加熱処理装置に導入する窒素、また
はヘリウム、ネオン、アルゴン等の希ガスの純度を、６Ｎ（９９．９９９９％）以上、好
ましくは７Ｎ（９９．９９９９９％）以上、（即ち不純物濃度を１ｐｐｍ以下、好ましく
は０．１ｐｐｍ以下）とすることが好ましい。
【００８０】
以上の工程により酸化物半導体膜中の水素の濃度を低減し、高純度化することができる。
それにより酸化物半導体膜の安定化を図ることができる。また、ガラス転移温度以下の加
熱処理で、キャリア密度が極端に少なく、バンドギャップの広い酸化物半導体膜を形成す
ることができる。このため、大面積基板を用いてトランジスタを作製することができるた
め、量産性を高めることができる。また、当該水素濃度が低減され高純度化された酸化物
半導体膜を用いることで、耐圧性が高く、ショートチャネル効果が低く、オンオフ比の高
いトランジスタを作製することができる。
【００８１】
次いで、図２（Ａ）に示すように、ゲート絶縁膜１０２、及び酸化物半導体膜１０８上に
、ソース電極及びドレイン電極（これと同じ層で形成される配線を含む）となる導電膜を
形成した後、該導電膜をパターニングすることで、ソース電極１１１、ドレイン電極１１
２を形成する。導電膜をスパッタ法や真空蒸着法で形成すればよい。ソース電極及びドレ
イン電極（これと同じ層で形成される配線を含む）となる導電膜の材料としては、Ａｌ、
Ｃｒ、Ｃｕ、Ｔａ、Ｔｉ、Ｍｏ、Ｗからから選ばれた元素、または上述した元素を成分と
する合金か、上述した元素を組み合わせた合金膜等が挙げられる。また、Ａｌ、Ｃｕなど
の金属膜の下側もしくは上側にＣｒ、Ｔａ、Ｔｉ、Ｍｏ、Ｗなどの高融点金属膜を積層さ
せた構成としても良い。また、Ｓｉ、Ｔｉ、Ｔａ、Ｗ、Ｍｏ、Ｃｒ、Ｎｄ、Ｓｃ、Ｙなど
Ａｌ膜に生ずるヒロックやウィスカーの発生を防止する元素が添加されているＡｌ材料を
用いることで耐熱性を向上させることが可能となる。
【００８２】
また、導電膜は、単層構造でも、２層以上の積層構造としてもよい。例えば、シリコンを
含むアルミニウム膜の単層構造、アルミニウム膜上にチタン膜を積層する２層構造、Ｔｉ
膜と、そのＴｉ膜上に重ねてアルミニウム膜を積層し、さらにその上にＴｉ膜を成膜する
３層構造などが挙げられる。
【００８３】
また、ソース電極及びドレイン電極（これと同じ層で形成される配線を含む）となる導電
膜としては導電性の金属酸化物で形成しても良い。導電性の金属酸化物としては酸化イン
ジウム（Ｉｎ_２Ｏ_３）、酸化スズ（ＳｎＯ_２）、酸化亜鉛（ＺｎＯ）、酸化インジウム酸
化スズ合金（Ｉｎ_２Ｏ_３―ＳｎＯ_２、ＩＴＯと略記する）、酸化インジウム酸化亜鉛合金
（Ｉｎ_２Ｏ_３―ＺｎＯ）または前記金属酸化物材料にシリコン若しくは酸化シリコンを含
ませたものを用いることができる。
【００８４】
導電膜形成後に加熱処理を行う場合には、この加熱処理に耐える耐熱性を導電膜に持たせ
ることが好ましい。
【００８５】
そして、導電膜上にレジストマスクを形成し、選択的にエッチングを行ってソース電極１
１１、ドレイン電極１１２を形成した後、レジストマスクを除去する。
【００８６】
フォトリソグラフィ工程でのレジストマスク形成時の露光には、紫外線やＫｒＦレーザ光
やＡｒＦレーザ光を用いる。酸化物半導体膜１０８上で隣り合うソース電極の下端部とド
レイン電極の下端部との間隔幅によって後に形成されるトランジスタのチャネル長Ｌが決
定される。なお、チャネル長Ｌ＝２５ｎｍ未満の露光を行う場合には、数ｎｍ〜数１０ｎ
ｍと極めて波長が短い超紫外線（Ｅｘｔｒｅｍｅ Ｕｌｔｒａｖｉｏｌｅｔ）を用いてフ
ォトリソグラフィ工程でのレジストマスク形成時の露光を行う。超紫外線による露光は、
解像度が高く焦点深度も大きい。従って、後に形成されるトランジスタのチャネル長Ｌを
１０ｎｍ以上１０００ｎｍ以下とすることも可能であり、回路の動作速度を高速化でき、
さらにオフ電流値が極めて小さいため、低消費電力化も図ることができる。
【００８７】
なお、導電膜のエッチングの際に、酸化物半導体膜１０８がなるべく除去されないように
それぞれの材料及びエッチング条件を適宜調節する。
【００８８】
本実施の形態では、導電膜にチタン膜を用い、アンモニアと過酸化水素水を含む溶液（ア
ンモニア過水）を用いて、導電膜をウェットエッチングすることで、ソース電極１１１、
ドレイン電極１１２を形成する。アンモニア過水を含む溶液は、具体的には、３１重量％
の過酸化水素水と、２８重量％のアンモニア水と水とを、体積比５：２：２で混合した水
溶液を用いる。或いは、塩素（Ｃｌ_２）、塩化硼素（ＢＣｌ_３）などを含むガスを用いて
、導電膜をドライエッチングしても良い。
【００８９】
上記パターニングによりソース電極１１１とドレイン電極１１２を形成する際に、島状の
酸化物半導体膜１０８の露出した部分が一部エッチングされることで、島状の酸化物半導
体膜１０８に溝部（凹部）が形成されることもある。また、ソース電極１１１、ドレイン
電極１１２を形成するためのレジストマスクをインクジェット法で形成してもよい。レジ
ストマスクをインクジェット法で形成するとフォトマスクを使用しないため、製造コスト
を低減できる。
【００９０】
また、フォトリソグラフィ工程で用いるフォトマスク数及び工程数を削減するため、透過
した光に多段階の強度をもたせる多階調マスクによって形成されたレジストマスクを用い
てエッチング工程を行ってもよい。多階調マスクを用いて形成したレジストマスクは複数
の膜厚を有する形状となり、エッチングを行うことでさらに形状を変形することができる
ため、異なるパターンに加工する複数のエッチング工程に用いることができる。よって、
一枚の多階調マスクによって、少なくとも二種類以上の異なるパターンに対応するレジス
トマスクを形成することができる。よって露光マスク数を削減することができ、対応する
フォトリソグラフィ工程も削減できるため、工程の簡略化が可能となる。
【００９１】
次いで、Ｎ_２Ｏ、Ｎ_２、またはＡｒなどのガスを用いたプラズマ処理を行う。このプラズ
マ処理によって露出している酸化物半導体膜の表面に付着した吸着水などを除去する。ま
た、酸素とアルゴンの混合ガスを用いてプラズマ処理を行ってもよい。
【００９２】
なお、プラズマ処理を行った後、図２（Ｂ）に示すように、ソース電極１１１、ドレイン
電極１１２及び酸化物半導体膜１０８を覆うように絶縁膜１１３を形成する。絶縁膜１１
３は、水分や、水素などの不純物を極力含まないことが望ましく、単層の絶縁膜であって
も良いし、積層された複数の絶縁膜で構成されていても良い。絶縁膜１１３に水素が含ま
れると、その水素の酸化物半導体膜への侵入、又は水素が酸化物半導体膜中の酸素の引き
抜きが生じ、酸化物半導体膜のバックチャネル部が低抵抗化（ｎ型化）してしまい、寄生
チャネルが形成されるおそれがある。よって、絶縁膜１１３はできるだけ水素を含まない
膜になるように、成膜方法に水素を用いないことが重要である。上記絶縁膜１１３には、
バリア性の高い材料を用いるのが望ましい。例えば、バリア性の高い絶縁膜として、窒化
珪素膜、窒化酸化珪素膜、窒化アルミニウム膜、または窒化酸化アルミニウム膜などを用
いることができる。複数の積層された絶縁膜を用いる場合、上記バリア性の高い絶縁膜よ
りも、窒素の比率が低い酸化珪素膜、酸化窒化珪素膜などの絶縁膜を、酸化物半導体膜１
０８に近い側に形成する。そして、窒素の比率が低い絶縁膜を間に挟んで、ソース電極１
１１、ドレイン電極１１２及び酸化物半導体膜１０８と重なるように、バリア性を有する
絶縁膜を形成する。バリア性を有する絶縁膜を用いることで、酸化物半導体膜１０８内、
ゲート絶縁膜１０２内、或いは、酸化物半導体膜１０８と他の絶縁膜の界面とその近傍に
、水分または水素などの不純物が入り込むのを防ぐことができる。また、酸化物半導体膜
１０８に接するように窒素の比率が低い酸化珪素膜、酸化窒化珪素膜などの絶縁膜を形成
することで、バリア性の高い材料を用いた絶縁膜が直接酸化物半導体膜１０８に接するの
を防ぐことができる。
【００９３】
本実施の形態では、スパッタ法で形成された膜厚２００ｎｍの酸化珪素膜上に、スパッタ
法で形成された膜厚１００ｎｍの窒化珪素膜を積層させた構造を有する、絶縁膜１１３を
形成する。成膜時の基板温度は、室温以上３００℃以下とすればよく、本実施の形態では
１００℃とする。
【００９４】
なお、絶縁膜１１３を形成した後に、加熱処理を施しても良い。加熱処理は窒素または希
ガス（アルゴン、ヘリウムなど）の雰囲気下において、好ましくは２００℃以上４００℃
以下、例えば２５０℃以上３５０℃以下で行う。本実施の形態では、例えば、窒素雰囲気
下で２５０℃、１時間の加熱処理を行う。または、ソース電極１１１、ドレイン電極１１
２を形成する前に、酸化物半導体膜に対して行った先の加熱処理と同様に、高温短時間の
ＲＴＡ処理を行っても良い。ソース電極１１１又はドレイン電極１１２の間に設けられた
酸化物半導体膜１０８の露出領域と、酸素を含む絶縁膜１１３とが接して設けられた後に
、加熱処理が施されることによって、酸化物半導体膜１０８に酸素が供与されるため、酸
化物半導体膜１０８の絶縁膜１１３と接する領域を選択的に酸素過剰な状態とすることが
できる。その結果、化学量論的組成比を満たす構成とすることが可能であり、ゲート電極
１０１と重なるチャネル形成領域はＩ型となり、トランジスタの電気特性の向上および、
電気特性のばらつきを軽減することができる。この加熱処理を行うタイミングは、絶縁膜
１１３の形成後であれば特に限定されず、他の工程、例えば樹脂膜形成時の加熱処理や、
透明導電膜を低抵抗化させるための加熱処理と兼ねることで、工程数を増やすことなく行
うことができる。
【００９５】
以上の工程でトランジスタ１１４が形成される。
【００９６】
図２（Ｃ）に、図２（Ｂ）に示すトランジスタ１１４の上面図を示す。なお、図２（Ｃ）
の破線Ａ１−Ａ２における断面図が、図２（Ｂ）に相当する。
【００９７】
トランジスタ１１４は、絶縁表面を有する基板１００上に形成されたゲート電極１０１と
、ゲート電極１０１上のゲート絶縁膜１０２と、ゲート絶縁膜１０２上においてゲート電
極１０１と重なっている酸化物半導体膜１０８と、酸化物半導体膜１０８上に形成された
一対のソース電極１１１またはドレイン電極１１２とを有する。さらに、トランジスタ１
１４は、酸化物半導体膜１０８上に形成された絶縁膜１１３を、その構成要素に含めても
良い。図２（Ｃ）に示すトランジスタ１１４は、ソース電極１１１とドレイン電極１１２
の間において、酸化物半導体膜１０８の一部がエッチングされたチャネルエッチ構造であ
る。
【００９８】
また、トランジスタ１１４はシングルゲート構造のトランジスタを用いて説明したが、必
要に応じて、チャネル形成領域を複数有するマルチゲート構造のトランジスタも形成する
ことができる。
【００９９】
次いで、絶縁膜１１３上に導電膜を形成した後、該導電膜をパターニングすることで、図
３（Ａ）に示すように、酸化物半導体膜１０８と重なる位置にバックゲート電極１１５を
形成しても良い。バックゲート電極１１５は、ゲート電極１０１、或いはソース電極１１
１及びドレイン電極１１２と同様の材料、構造を用いて形成することが可能である。
【０１００】
バックゲート電極１１５の膜厚は、１０ｎｍ〜４００ｎｍ、好ましくは１００ｎｍ〜２０
０ｎｍとする。本実施の形態では、チタン膜、アルミニウム膜、チタン膜が積層された構
造を有する導電膜を形成する。そして、フォトリソグラフィ法によりレジストマスクを形
成し、エッチングにより不要な部分を除去して、該導電膜を所望の形状に加工（パターニ
ング）することで、バックゲート電極１１５を形成する。
【０１０１】
次いで、図３（Ｂ）に示すように、バックゲート電極１１５を覆うように絶縁膜１１６を
形成する。絶縁膜１１６は、雰囲気中の水分、水素、酸素などがトランジスタ１１４の特
性に影響を与えるのを防ぐことができる、バリア性の高い材料を用いるのが望ましい。例
えば、バリア性の高い絶縁膜として、窒化珪素膜、窒化酸化珪素膜、窒化アルミニウム膜
、または窒化酸化アルミニウム膜などを、プラズマＣＶＤ法又はスパッタリング法等によ
り単層で又は積層させて形成することができる。バリア性の効果を得るには、絶縁膜１１
６は、例えば厚さ１５ｎｍ〜４００ｎｍの膜厚で形成することが好ましい。
【０１０２】
本実施の形態では、プラズマＣＶＤ法により３００ｎｍの絶縁膜を形成する。成膜条件は
、シランガスの流量４ｓｃｃｍとし、亜酸化窒素の流量８００ｓｃｃｍとし、基板温度４
００℃とする。
【０１０３】
図３（Ｃ）に、図３（Ｂ）に示す半導体装置の上面図を示す。図３（Ｂ）は、図３（Ｃ）
の破線Ａ１−Ａ２における断面図に相当する。
【０１０４】
なお、図３（Ｂ）では、バックゲート電極１１５が酸化物半導体膜１０８全体を覆ってい
る場合を例示しているが、本発明はこの構成に限定されない。バックゲート電極１１５は
、酸化物半導体膜１０８が有するチャネル形成領域の一部と少なくとも重なっていれば良
い。
【０１０５】
バックゲート電極１１５は、電気的に絶縁しているフローティングの状態であっても良い
し、電位が与えられる状態であっても良い。後者の場合、バックゲート電極１１５には、
ゲート電極１０１と同じ高さの電位が与えられていても良いし、グラウンドなどの固定電
位が与えられていても良い。バックゲート電極１１５に与える電位の高さを制御すること
で、トランジスタ１１４の閾値電圧を制御することができる。
【０１０６】
本実施の形態のように酸化物半導体膜中に含まれる水素、水などの不純物を極力除去し、
酸化物半導体膜を高純度化することが、トランジスタの特性にどのように影響を与えるか
を以下に説明する。
【０１０７】
図２０は、酸化物半導体を用いたトランジスタの断面図である。ゲート電極（ＧＥ）上に
ゲート絶縁膜（ＧＩ）を介して酸化物半導体膜（ＯＳ）が設けられ、その上にソース電極
（Ｓ）及びドレイン電極（Ｄ）が設けられ、ソース電極（Ｓ）及びドレイン電極（Ｄ）上
に絶縁膜が設けられている。
【０１０８】
図２１に、図２０に示すＡ−Ａ’断面におけるエネルギーバンド図（模式図）を示す。ま
た、図２１において黒丸（●）は電子を示し、白丸（○）は正孔を示し、それぞれは電荷
−ｑ、電荷＋ｑを有している。ドレイン電極（Ｄ）に正の電圧（ＶＤ＞０）を印加した上
で、破線はゲート電極（ＧＥ）に電圧を印加しない場合（ＶＧ＝０）、実線はゲート電極
（ＧＥ）に正の電圧（ＶＧ＞０）を印加する場合を示す。ゲート電極（ＧＥ）に電圧を印
加しない場合は、高いポテンシャル障壁のためにソース電極（Ｓ）から酸化物半導体膜（
ＯＳ）側へキャリア（電子）が注入されず、電流を流さないオフ状態を示す。一方、ゲー
ト電極（ＧＥ）に正の電圧を印加するとポテンシャル障壁が低下し、酸化物半導体膜（Ｏ
Ｓ）に電流を流すオン状態を示す。
【０１０９】
図２２は、図２０におけるＢ−Ｂ’の断面におけるエネルギーバンド図（模式図）である
。図２２（Ａ）はゲート電極（ＧＥ）に正の電圧（ＶＧ＞０）が印加された状態であり、
ソース電極とドレイン電極間にキャリア（電子）が流れるオン状態を示している。また、
図２２（Ｂ）は、ゲート電極（ＧＥ）に負の電圧（ＶＧ＜０）が印加された状態であり、
オフ状態（少数キャリアは流れない）である場合を示す。
【０１１０】
図２３は、真空準位と金属の仕事関数（φ_Ｍ）、酸化物半導体の電子親和力（χ）の関係
を示す。
【０１１１】
常温において金属中の電子は縮退しており、フェルミ準位は伝導帯内に位置する。一方、
従来の酸化物半導体は一般にｎ型であり、その場合のフェルミ準位（Ｅｆ）は、バンドギ
ャップ中央に位置する真性フェルミ準位（Ｅｉ）から離れて、伝導帯（Ｅｃ）寄りに位置
している。なお、酸化物半導体において水素の一部はドナーとなり、酸化物半導体がｎ型
化する一つの要因であることが知られている。また、酸素欠損もｎ型化する一つの要因で
あることが知られている。
【０１１２】
これに対して、本発明に係る酸化物半導体は、ｎ型不純物である水素を酸化物半導体から
除去して酸化物半導体の主成分以外の不純物が極力含まれないように高純度化し、かつ、
酸素欠損を除去することにより、酸化物半導体を真性（ｉ型）、または限りなく真性に近
づけたものである。すなわち、不純物を添加して酸化物半導体をｉ型化するのでなく、水
素や水等の不純物や酸素欠損を極力除去して高純度化することにより、ｉ型（真性半導体
）又はｉ型（真性半導体）に限りなく近い酸化物半導体を得ることを特徴としている。上
記構成により、矢印で示すように、フェルミ準位（Ｅｆ）は真性フェルミ準位（Ｅｉ）と
同じレベルに限りなく近づけることができる。
【０１１３】
酸化物半導体のバンドギャップ（Ｅｇ）は３．１５ｅＶで、電子親和力（χ）は４．３Ｖ
と言われている。ソース電極及びドレイン電極を構成するチタン（Ｔｉ）の仕事関数は、
酸化物半導体の電子親和力（χ）とほぼ等しい。この場合、金属−酸化物半導体界面にお
いて、電子に対してショットキー型の障壁は形成されない。
【０１１４】
このとき電子は、図２２（Ａ）で示すようにゲート絶縁膜と高純度化された酸化物半導体
との界面における、酸化物半導体側のエネルギー的に安定な最低部を移動する。
【０１１５】
また、図２２（Ｂ）において、ゲート電極（ＧＥ）に負の電圧が印加されると、少数キャ
リアであるホールは実質的にゼロであるため、電流は限りなくゼロに近い値となる。
【０１１６】
例えば、トランジスタのチャネル幅（Ｗ）が１×１０^４μｍでチャネル長（Ｌ）が３μｍ
の素子であっても、オフ電流が１０^−１３Ａ以下であり、サブスレッショルドスイング値
（Ｓ値）が０．１Ｖ／ｄｅｃ．（ゲート絶縁膜厚１００ｎｍ）が得られる。
【０１１７】
このように、酸化物半導体の主成分以外の水、水素などの不純物が極力含まれないように
、酸化物半導体膜を高純度化することにより、トランジスタの動作を良好なものとするこ
とができる。
【０１１８】
なお、本実施の形態では、酸化物半導体膜１０３を所望の形状に加工して島状の酸化物半
導体膜１０４を形成した後に、第１の加熱処理、酸素の添加、第２の加熱処理を行う作製
方法について説明したが、本発明はこの構成に限定されない。島状の酸化物半導体膜１０
４を形成する前の酸化物半導体膜１０３に対して、第１の加熱処理、酸素の添加、第２の
加熱処理を行った後、酸化物半導体膜の形状を加工して島状の酸化物半導体膜を形成して
も良い。或いは、酸化物半導体膜１０３に対して、第１の加熱処理を行った後に酸化物半
導体膜の形状を加工して島状の酸化物半導体膜を形成し、次いで当該島状の酸化物半導体
膜に対して酸素の添加、第２の加熱処理を行うようにしても良い。或いは、酸化物半導体
膜１０３に対して、第１の加熱処理、酸素の添加を行った後に、酸化物半導体膜の形状を
加工して島状の酸化物半導体膜を形成し、次いで当該島状の酸化物半導体膜に対して第２
の加熱処理を行うようにしても良い。
【０１１９】
図４を用いて、酸化物半導体膜１０３に対して、第１の加熱処理、酸素の添加、第２の加
熱処理を行った後、酸化物半導体膜の形状を加工して島状の酸化物半導体膜を形成する場
合の、作製方法について説明する。
【０１２０】
まず、上述した作製工程に従って、基板１００上にゲート電極１０１を形成した後、ゲー
ト電極１０１上にゲート絶縁膜１０２、酸化物半導体膜１０３を順に積層するように形成
することで、図１（Ａ）に示す状態、すなわち図４（Ａ）に示す状態まで作製する。次い
で、図４（Ｂ）に示すように、酸化物半導体膜１０３に第１の加熱処理を施すことで、水
分、水素が脱離した酸化物半導体膜１５０を形成する。第１の加熱処理の条件に付いては
既に述べたので、ここでは説明を省略する。
【０１２１】
次いで、図４（Ｃ）に示すように、酸化物半導体膜１５０に、イオンドーピング法または
イオン注入法などを用いて酸素を添加することで、酸素が過剰に添加された酸化物半導体
膜１５１が形成される。具体的な酸素の添加の方法については既に述べたので、ここでは
説明を省略する。酸素の添加により、酸化物半導体を構成している金属と水素の間の結合
、或いは該金属と水酸基の間の結合を切断するとともに、これら水素、または水酸基が、
酸素と反応することで水を生成する。よって、後に行われる第２の加熱処理により、不純
物である水素、または水酸基を、水として、脱離させやすくすることができる。イオン注
入法で酸化物半導体膜１５０への酸素の添加を行うのと並行して、酸化物半導体膜１５０
が形成された基板に対して、３００℃以上８５０℃以下（若しくはガラス基板の歪点以下
の温度）の範囲で、加熱処理を行うようにしても良い。
【０１２２】
次いで、第２の加熱処理を行う。第２の加熱処理は、第１の加熱処理と同様の条件で行う
ことができる。第２の加熱処理を行うことで、図４（Ｄ）に示すように酸化物半導体膜１
５２を得る。酸化物半導体膜１５０への酸素の添加により、酸化物半導体を構成している
金属と水素の間の結合、或いは該金属と水酸基の間の結合を切断するとともに、これら水
素または水酸基を酸素と反応させて、水を生成する。そのため、酸素の添加後に第２の加
熱処理を行うことで、強固に残存していた水素または水酸基などの不純物を、水として、
脱離させやすくすることができる。よって、上記加熱処理によって形成された島状の酸化
物半導体膜１５２は、第１の加熱処理によってもなお取り除かれなかった水分または水素
などの不純物が、除去されるので、第１の加熱処理後の酸化物半導体膜１５０よりも、さ
らに、ｉ型（真性半導体）又はｉ型に限りなく近くなる。水分、水素などの不純物が脱離
し、ｉ型（真性半導体）又はｉ型に限りなく近くなるため、上記不純物により閾値電圧が
シフトするなどのトランジスタの特性の劣化が促進されるのを防ぎ、オフ電流を低減させ
ることができる。
【０１２３】
次いで、図４（Ｅ）に示すように、酸化物半導体膜１５２をエッチングなどにより所望の
形状に加工（パターニング）し、ゲート電極１０１と重なる位置において、ゲート絶縁膜
１０２上に島状の酸化物半導体膜１５３を形成する。具体的なエッチングの方法について
は既に述べたので、ここでは説明を省略する。
【０１２４】
なお、次いで行われる図２（Ａ）に示したソース電極とドレイン電極を形成する工程の前
に、逆スパッタを行い、島状の酸化物半導体膜１５３及びゲート絶縁膜１０２の表面に付
着しているレジスト残渣などを除去することが好ましい。
【０１２５】
以上の工程により酸化物半導体膜中の水素の濃度を低減し、高純度化することができる。
それにより酸化物半導体膜の安定化を図ることができる。また、ガラス転移温度以下の加
熱処理で、キャリア密度が極端に少なく、バンドギャップの広い酸化物半導体膜を形成す
ることができる。このため、大面積基板を用いてトランジスタを作製することができるた
め、量産性を高めることができる。また、当該水素濃度が低減され高純度化された酸化物
半導体膜を用いることで、耐圧性が高く、ショートチャネル効果が低く、オンオフ比の高
いトランジスタを作製することができる。
【０１２６】
（実施の形態２）
本実施の形態では、さらに高電圧または大電流の制御が可能な、パワーデバイス向きであ
るトランジスタの構造及び作製方法について、説明する。なお、実施の形態１と同一部分
又は同様な機能を有する部分、及び工程は、実施の形態１と同様に行うことができるため
、繰り返しの説明は省略する。
【０１２７】
図５（Ａ）に示すように、基板２００上に下地膜となる絶縁膜２０１を形成した後、第１
の電極２０２を形成する。
【０１２８】
基板２００に用いられる基板については、実施の形態１に示した基板１００についての記
載を参照すれば良い。また、絶縁膜２０１の材料、構造及び膜厚については、実施の形態
１に示した下地膜についての記載を参照すれば良い。
【０１２９】
第１の電極２０２は、アルミニウム、クロム、銅、タンタル、チタン、モリブデン、タン
グステン、イットリウムから選ばれた金属元素、または上述した金属元素を成分とする合
金、上述した金属元素を組み合わせた合金などで形成する。また、マンガン、マグネシウ
ム、ジルコニウム、ベリリウム、トリウムのいずれか一または複数から選択された金属元
素を用いることができる。また、第１の電極２０２は、単層構造、または二層以上の積層
構造とすることができる。例えば、シリコンを含むアルミニウム膜の単層構造、アルミニ
ウム膜上にチタン膜を積層する二層構造、タングステン膜上にチタン膜を積層する二層構
造、チタン膜と、そのチタン膜上に重ねてアルミニウム膜を積層し、さらにその上にチタ
ン膜を形成する三層構造などが挙げられる。また、アルミニウムに、チタン、タンタル、
タングステン、モリブデン、クロム、ネオジム、スカンジウムから選ばれた元素を単数、
または複数組み合わせた膜、合金膜、もしくは窒化膜を用いてもよい。
【０１３０】
また、第１の電極２０２として、インジウム錫酸化物、酸化タングステンを含むインジウ
ム酸化物、酸化タングステンを含むインジウム亜鉛酸化物、酸化チタンを含むインジウム
酸化物、酸化チタンを含むインジウム錫酸化物、インジウム亜鉛酸化物、酸化ケイ素を添
加したインジウム錫酸化物などの透光性を有する導電性材料を適用することもできる。ま
た、上記透光性を有する導電性材料と、上記金属元素の積層構造とすることもできる。
【０１３１】
第１の電極２０２は、基板２００上に導電膜をスパッタリング法、ＣＶＤ法、または真空
蒸着法で形成し、当該導電膜上にフォトリソグラフィ工程によりレジストマスクを形成し
、当該レジストマスクを用いて導電膜をエッチングして、形成することができる。または
、フォトリソグラフィ工程を用いず、印刷法、インクジェット法で第１の電極２０２を形
成することで、工程数を削減することができる。なお、第１の電極２０２の端部をテーパ
形状とすると、後に形成されるゲート絶縁膜の被覆性が向上するため好ましい。第１の電
極２０２の端部と絶縁膜２０１のなす角の角度を３０°以上６０°以下、好ましくは４０
°以上５０°以下とすることで、後に形成されるゲート絶縁膜の被覆性を向上させること
ができる。
【０１３２】
本実施の形態では、第１の電極２０２となる導電膜として、スパッタリング法により膜厚
５０ｎｍのチタン膜を形成し、厚さ１００ｎｍのアルミニウム膜を形成し、厚さ５０ｎｍ
のチタン膜を形成する。次に、フォトリソグラフィ工程により形成したレジストマスクを
用いてエッチングして、第１の電極２０２を形成する。なお、フォトリソグラフィ工程に
より形成したレジストマスクの代わりに、インクジェット法を用いてレジストマスクを作
製することで、工程数を削減することができる。
【０１３３】
次いで、第１の電極２０２上に島状の酸化物半導体膜２０３を形成する。酸化物半導体膜
２０３は、スパッタリング法、塗布法、印刷法等により形成することができる。本実施の
形態では、スパッタリング法により第１の電極２０２上に酸化物半導体膜を形成した後、
エッチング等により当該酸化物半導体膜を所望の形状に加工することで、島状の酸化物半
導体膜２０３を形成する。また、酸化物半導体膜は、希ガス（例えばアルゴン）雰囲気下
、酸素雰囲気下、又は希ガス（例えばアルゴン）及び酸素雰囲気下においてスパッタ法に
より形成することができる。
【０１３４】
なお、島状の酸化物半導体膜２０３を形成するためのエッチングは、実施の形態１に示し
た島状の酸化物半導体膜を形成するためのエッチングについての記載を参照して実施すれ
ば良い。ただし、エッチングにより形成される島状の酸化物半導体膜２０３の端部と、第
１の電極２０２のなす角の角度を３０°以上６０°以下、好ましくは４０°以上５０°以
下とすることで、後に形成されるゲート絶縁膜の被覆性を向上させることができるため好
ましい。
【０１３５】
なお、酸化物半導体膜をスパッタ法により成膜する前に、アルゴンガスを導入してプラズ
マを発生させる逆スパッタを行い、第１の電極２０２の表面に付着している塵埃を除去す
ることが好ましい。逆スパッタとは、ターゲット側に電圧を印加せずに、アルゴン雰囲気
下で基板側にＲＦ電源を用いて電圧を印加して基板近傍にプラズマを形成して表面を改質
する方法である。なお、アルゴン雰囲気に代えて窒素、ヘリウムなどを用いてもよい。ま
た、アルゴン雰囲気に酸素、亜酸化窒素などを加えた雰囲気で行ってもよい。また、アル
ゴン雰囲気に塩素、四フッ化炭素などを加えた雰囲気で行ってもよい。
【０１３６】
酸化物半導体膜２０３は、上述したような酸化物半導体を用いることができる。
【０１３７】
本実施の形態では、Ｉｎ（インジウム）、Ｇａ（ガリウム）、及びＺｎ（亜鉛）を含む酸
化物半導体ターゲットを用いたスパッタ法により得られる膜厚３０ｎｍのＩｎ−Ｇａ−Ｚ
ｎ−Ｏ系非単結晶膜を、酸化物半導体膜２０３として用いる。上記ターゲットとして、例
えば、各金属の原子比がＩｎ：Ｇａ：Ｚｎ＝１：１：０．５、Ｉｎ：Ｇａ：Ｚｎ＝１：１
：１、またはＩｎ：Ｇａ：Ｚｎ＝１：１：２の組成比を有する酸化物半導体ターゲットを
用いることができる。また、酸化物半導体膜は、希ガス（代表的にはアルゴン）雰囲気下
、酸素雰囲気下、又は希ガス（代表的にはアルゴン）及び酸素雰囲気下においてスパッタ
リング法により形成することができる。また、スパッタリング法を用いる場合、ＳｉＯ_２
を２重量％以上１０重量％以下含むターゲットを用いて成膜を行ってもよい。また、Ｉｎ
、Ｇａ、及びＺｎを含む酸化物半導体ターゲットの充填率は９０％以上１００％以下、好
ましくは９５％以上９９．９％以下である。充填率の高い酸化物半導体ターゲットを用い
ることにより、成膜した酸化物半導体膜は緻密な膜となる。
【０１３８】
減圧状態に保持された処理室内に基板を保持し、処理室内の残留水分を除去しつつ水素及
び水分が除去されたスパッタガスを導入し、金属酸化物をターゲットとして基板２００上
に酸化物半導体膜２０３を成膜する。成膜時に、基板温度を１００℃以上６００℃以下好
ましくは２００℃以上４００℃以下としても良い。基板を加熱しながら成膜することによ
り、成膜した酸化物半導体膜に含まれる不純物濃度を低減することができる。また、スパ
ッタリングによる損傷が軽減される。処理室内の残留水分を除去するためには、吸着型の
真空ポンプを用いることが好ましい。例えば、クライオポンプ、イオンポンプ、チタンサ
ブリメーションポンプを用いることが好ましい。また、排気手段としては、ターボポンプ
にコールドトラップを加えたものであってもよい。クライオポンプを用いて排気した成膜
室は、例えば、水素原子、水（Ｈ_２Ｏ）など水素原子を含む化合物（より好ましくは炭素
原子を含む化合物も）等が排気されるため、当該成膜室で成膜した酸化物半導体膜に含ま
れる不純物の濃度を低減できる。
【０１３９】
本実施の形態では、酸化物半導体膜の成膜条件の一例として、基板温度室温、基板とター
ゲットの間との距離を１１０ｍｍ、圧力０．４Ｐａ、直流（ＤＣ）電源０．５ｋＷ、酸素
及びアルゴン（酸素流量１５ｓｃｃｍ：アルゴン流量３０ｓｃｃｍ）雰囲気下の条件が適
用される。なお、パルス直流（ＤＣ）電源を用いると、成膜時に発生するパーティクルと
呼ばれる塵埃が軽減でき、膜厚分布も均一となるために好ましい。酸化物半導体膜の厚さ
は、１μｍ以上、好ましくは３μｍ以上、さらに好ましくは１０μｍ以上とする。なお、
適用する酸化物半導体膜材料により適切な厚みは異なり、材料に応じて適宜厚みを選択す
ればよい。
【０１４０】
なお、酸化物半導体膜２０３に水素、水酸基及び水分がなるべく含まれないようにするた
めに、成膜の前処理として、スパッタリング装置の予備加熱室で第１の電極２０２までが
形成された基板２００を予備加熱し、基板２００に吸着した水素、水分などの不純物を脱
離し排気することが好ましい。なお、予備加熱の温度としては、１００℃以上４００℃以
下好ましくは１５０℃以上３００℃以下である。なお、予備加熱室に設ける排気手段はク
ライオポンプが好ましい。なお、この予備加熱の処理は省略することもできる。またこの
予備加熱は、絶縁膜の成膜前に、ゲート電極まで形成した基板２００にも同様に行っても
よい。
【０１４１】
スパッタリング法にはスパッタ用電源に高周波電源を用いるＲＦスパッタリング法と、Ｄ
Ｃスパッタリング法があり、さらにパルス的にバイアスを与えるパルスＤＣスパッタリン
グ法もある。ＲＦスパッタリング法は主に絶縁膜を成膜する場合に用いられ、ＤＣスパッ
タリング法は主に金属膜を成膜する場合に用いられる。
【０１４２】
また、材料の異なるターゲットを複数設置できる多元スパッタ装置もある。多元スパッタ
装置は、同一チャンバーで異なる材料膜を積層成膜することも、同一チャンバーで複数種
類の材料を同時に放電させて成膜することもできる。
【０１４３】
また、チャンバー内部に磁石機構を備えたマグネトロンスパッタリング法を用いるスパッ
タ装置や、グロー放電を使わずマイクロ波を用いて発生させたプラズマを用いるＥＣＲス
パッタリング法を用いるスパッタ装置がある。
【０１４４】
また、スパッタリング法を用いる成膜方法として、成膜中にターゲット物質とスパッタガ
ス成分とを化学反応させてそれらの化合物薄膜を形成するリアクティブスパッタリング法
や、成膜中に基板にも電圧をかけるバイアススパッタリング法もある。
【０１４５】
次いで、減圧雰囲気下、窒素や希ガスなどの不活性ガス雰囲気下、酸素ガス雰囲気下、又
は超乾燥エア（ＣＲＤＳ（キャビティリングダウンレーザー分光法）方式の露点計を用い
て測定した場合の水分量が２０ｐｐｍ（露点換算で−５５℃）以下、好ましくは１ｐｐｍ
以下、好ましくは１０ｐｐｂ以下の空気）雰囲気下において、酸化物半導体膜２０３に第
１の加熱処理を施す。酸化物半導体膜２０３に加熱処理を施すことで、図５（Ｂ）に示す
ように、水分、水素が脱離した酸化物半導体膜２０５が形成される。具体的には、３００
℃以上８５０℃以下（若しくはガラス基板の歪点以下の温度）で加熱処理を行えば良い。
ＲＴＡ法を用いれば、短時間に脱水化または脱水素化が行えるため、ガラス基板の歪点を
超える温度でも処理することができる。本実施の形態では、加熱処理装置の一つである電
気炉を用い、酸化物半導体膜２０３に対して、窒素雰囲気下において、基板温度が４５０
℃に達した状態で１時間、加熱処理を行った後、大気に触れることなく、水や水素の再混
入を防ぎ、酸化物半導体膜２０５を得る。
【０１４６】
なお、第１の加熱処理に用いられる加熱処理装置についての詳しい説明については、実施
の形態１に既に述べたので、ここでは省略する。
【０１４７】
また、加熱処理においては、窒素、またはヘリウム、ネオン、アルゴン等の希ガスに、水
分、水素などが含まれないことが好ましい。または、加熱処理装置に導入する窒素、また
はヘリウム、ネオン、アルゴン等の希ガスの純度を、６Ｎ（９９．９９９９％）以上、好
ましくは７Ｎ（９９．９９９９９％）以上、（即ち不純物濃度を１ｐｐｍ以下、好ましく
は０．１ｐｐｍ以下）とすることが好ましい。
【０１４８】
次いで、図５（Ｃ）に示すように、酸化物半導体膜２０５に、イオン注入法またはイオン
ドーピング法を用いて、酸素を添加する。イオン注入法またはイオンドーピング法などを
用いて、酸化物半導体膜２０５に酸素を添加することで、酸素が過剰に添加された酸化物
半導体膜２０７が形成される。酸素の添加により、酸化物半導体を構成している金属と水
素の間の結合、或いは該金属と水酸基の間の結合を切断するとともに、これら水素または
水酸基が、酸素と反応することで水を生成する。よって、後に行われる第２の加熱処理に
より、不純物である水素、または水酸基を、水として脱離させやすくすることができる。
【０１４９】
酸素ガスを用いて、イオン注入法で酸素の添加を行う場合、加速電圧を５ｋＶ以上１００
ｋＶ以下、ドーズ量を１×１０^１３ｉｏｎｓ／ｃｍ^２以上１×１０^１６ｉｏｎｓ／ｃｍ^２
以下とすれば良い。
【０１５０】
なお、イオン注入法で酸化物半導体膜２０５への酸素の添加を行うのと並行して、酸化物
半導体膜２０５が形成された基板に対して、３００℃以上８５０℃以下（若しくはガラス
基板の歪点以下の温度）の範囲で、加熱処理を行うようにしても良い。
【０１５１】
次いで、第２の加熱処理を行う。第２の加熱処理は、第１の加熱処理と同様の条件で行う
ことができる。具体的には、減圧雰囲気下、窒素や希ガスなどの不活性ガス雰囲気下、酸
素ガス雰囲気下、又は超乾燥エア（ＣＲＤＳ（キャビティリングダウンレーザー分光法）
方式の露点計を用いて測定した場合の水分量が２０ｐｐｍ（露点換算で−５５℃）以下、
好ましくは１ｐｐｍ以下、好ましくは１０ｐｐｂ以下の空気）雰囲気下において、３００
℃以上８５０℃以下（若しくはガラス基板の歪点以下の温度）で加熱処理を行えばよい。
ＲＴＡ法を用いれば、短時間に脱水化または脱水素化が行えるため、ガラス基板の歪点を
超える温度でも処理することができる。本実施の形態では、加熱処理装置の一つである電
気炉を用い、窒素雰囲気下において、基板温度が４５０℃に達した状態で１時間、加熱処
理を行った後、大気に触れることなく、水や水素の再混入を防ぎ、酸化物半導体膜２０８
を得る。なお、上記加熱処理は、島状の酸化物半導体膜２０８形成後に複数回行っても良
い。
【０１５２】
本発明の一態様では、酸化物半導体膜２０５への酸素の添加により、酸化物半導体を構成
している金属と水素の間の結合、或いは該金属と水酸基の間の結合を切断するとともに、
これら水素または水酸基を酸素と反応させて、水を生成する。そのため、酸素の添加後に
第２の加熱処理を行うことで、強固に残存していた水素または水酸基などの不純物を、水
として、脱離させやすくすることができる。よって、上記加熱処理によって形成された島
状の酸化物半導体膜２０８は、第１の加熱処理によってもなお取り除かれなかった水分ま
たは水素などの不純物が、除去されるので、第１の加熱処理後の酸化物半導体膜２０５よ
りも、さらに、ｉ型（真性半導体）又はｉ型に限りなく近くなる。水分、水素などの不純
物が脱離し、ｉ型（真性半導体）又はｉ型に限りなく近くなるため、上記不純物により閾
値電圧がシフトするなどのトランジスタの特性の劣化が促進されるのを防ぎ、オフ電流を
低減させることができる。
【０１５３】
また、８５℃、２×１０^６Ｖ／ｃｍ、１２時間のゲートバイアス・熱ストレス試験（ＢＴ
試験）においては、不純物が酸化物半導体に添加されていると、不純物と酸化物半導体の
主成分との結合手が、強電界（Ｂ：バイアス）と高温（Ｔ：温度）により切断され、生成
された不対結合手がしきい値電圧（Ｖｔｈ）のドリフトを誘発することとなる。しかし、
上述したように、ゲート絶縁膜と酸化物半導体膜との界面特性を良好にし、なおかつ、酸
化物半導体膜中の不純物、特に水素や水等を極力除去することにより、ＢＴ試験に対して
も安定なトランジスタが得られる。
【０１５４】
なお、第２の加熱処理に用いられる加熱処理装置についての詳しい説明については、実施
の形態１に既に述べたので、ここでは省略する。
【０１５５】
なお、加熱処理においては、窒素、またはヘリウム、ネオン、アルゴン等の希ガスに、水
分、水素などが含まれないことが好ましい。または、加熱処理装置に導入する窒素、また
はヘリウム、ネオン、アルゴン等の希ガスの純度を、６Ｎ（９９．９９９９％）以上、好
ましくは７Ｎ（９９．９９９９９％）以上、（即ち不純物濃度を１ｐｐｍ以下、好ましく
は０．１ｐｐｍ以下）とすることが好ましい。
【０１５６】
以上の工程により酸化物半導体膜中の水素の濃度を低減し、高純度化することができる。
それにより酸化物半導体膜の安定化を図ることができる。また、ガラス転移温度以下の加
熱処理で、キャリア密度が極端に少なく、バンドギャップの広い酸化物半導体膜を形成す
ることができる。このため、大面積基板を用いてトランジスタを作製することができるた
め、量産性を高めることができる。また、当該水素濃度が低減され高純度化された酸化物
半導体膜を用いることで、耐圧性が高く、ショートチャネル効果が低く、オンオフ比の高
いトランジスタを作製することができる。
【０１５７】
次いで、図５（Ｅ）に示すように、酸化物半導体膜２０８上に、第２の電極２１１を形成
する。第２の電極２１１に用いられる導電膜の材料、構造については、第１の電極２０２
と同様の形態を採用することができる。また、第２の電極２１１の作製方法については、
第１の電極２０２と同様に実施することができる。
【０１５８】
本実施の形態では、フォトリソグラフィ工程により第２の電極２１１となる導電膜上にレ
ジストマスクを形成し、当該レジストマスクを用いて導電膜をエッチングして、第２の電
極２１１を形成する。ここでは、第２の電極２１１となる導電膜として、厚さ５０ｎｍの
チタン膜、厚さ１００ｎｍのアルミニウム膜、及び厚さ５０ｎｍのチタン膜を順に積層す
る。第２の電極２１１の端部と、酸化物半導体膜２０８のなす角の角度を３０°以上６０
°以下、好ましくは４０°以上５０°以下とすることで、後に形成されるゲート絶縁膜の
被覆性を向上させることができるため好ましい。そして、第２の電極２１１は、第１の電
極２０２から離隔した位置において、第１の電極２０２と接することなく形成される。
【０１５９】
第１の電極２０２と第２の電極２１１は、いずれか一方がトランジスタのソース電極、他
方がドレイン電極として機能する。
【０１６０】
第２の電極２１１を形成した後、加熱処理を施しても良い。加熱処理の温度は、４００℃
以上８５０℃以下、好ましくは４００℃以上基板の歪み点未満とする。本実施の形態では
、加熱処理装置の一つである電気炉に基板を導入し、酸化物半導体膜２０８に対して窒素
、希ガスなどの不活性ガス雰囲気下において４５０℃において１時間の加熱処理を行った
後、大気に触れさせないことで、酸化物半導体膜への水素、水、水酸基または水素化物な
どの再侵入を防ぐことで、水素濃度がさらに低減され高純度化され、ｉ型化または実質的
にｉ型化された酸化物半導体膜を得ることができる。
【０１６１】
なお、上記加熱処理においては、窒素、またはヘリウム、ネオン、アルゴンなどの希ガス
に、水素、水、水酸基または水素化物などが含まれないことが好ましい。または、加熱処
理装置に導入する窒素、またはヘリウム、ネオン、アルゴンなどの希ガスの純度を、６Ｎ
（９９．９９９９％）以上、好ましくは７Ｎ（９９．９９９９９％）以上、（即ち不純物
濃度を１ｐｐｍ以下、好ましくは０．１ｐｐｍ以下）とすることが好ましい。
【０１６２】
図７（Ａ）に、図５（Ｅ）の第１の電極２０２、酸化物半導体膜２０８、第２の電極２１
１の上面図を示す。なお、図７（Ａ）の破線Ｂ１−Ｂ２における断面図が、図５（Ｅ）に
相当する。
【０１６３】
次いで、図６（Ａ）に示すように、第１の電極２０２、酸化物半導体膜２０８、第２の電
極２１１を覆うように、ゲート絶縁膜２１２を形成し、ゲート絶縁膜２１２上にゲート電
極２１３を形成する。ゲート絶縁膜２１２は、プラズマＣＶＤ法又はスパッタリング法等
を用いて、酸化珪素膜、窒化珪素膜、酸化窒化珪素膜、窒化酸化珪素膜、酸化アルミニウ
ム膜、窒化アルミニウム膜、酸化窒化アルミニウム膜、窒化酸化アルミニウム膜、酸化ハ
フニウム膜または酸化タンタル膜を単層で又は積層させて形成することができる。
【０１６４】
また、ゲート絶縁膜２１２として、ハフニウムシリケート（ＨｆＳｉＯ_ｘ）、Ｎが添加さ
れたＨｆＳｉ_ｘＯ_ｙ、窒素が添加されたハフニウムアルミネート（ＨｆＡｌＯ_ｘ）、酸化
ハフニウム、酸化イットリウムなどのｈｉｇｈ−ｋ材料を用いることでゲートリークを低
減できる。さらには、ｈｉｇｈ−ｋ材料と、酸化シリコン膜、窒化シリコン膜、酸化窒化
シリコン膜、窒化酸化シリコン膜、または酸化アルミニウム膜のいずれか一以上との積層
構造とすることができる。ゲート絶縁膜２１２の厚さは、５０ｎｍ以上５００ｎｍ以下と
するとよい。ゲート絶縁膜２１２の厚さを厚くすることで、ゲートリーク電流を低減する
ことができる。
【０１６５】
ゲート絶縁膜２１２は、水分や、水素などの不純物を極力含まないことが望ましい。スパ
ッタリング法により酸化珪素膜を成膜する場合には、ターゲットとしてシリコンターゲッ
ト又は石英ターゲットを用い、スパッタガスとして酸素又は、酸素及びアルゴンの混合ガ
スを用いて行う。
【０１６６】
不純物を除去することによりｉ型化又は実質的にｉ型化された酸化物半導体（高純度化さ
れた酸化物半導体）は界面準位、界面電荷に対して極めて敏感であるため、ゲート絶縁膜
２１２との界面は重要である。そのため高純度化された酸化物半導体に接するゲート絶縁
膜（ＧＩ）は、高品質化が要求される。
【０１６７】
例えば、μ波（２．４５ＧＨｚ）を用いた高密度プラズマＣＶＤは、緻密で絶縁耐圧の高
い高品質な絶縁膜を形成できるので好ましい。高純度化された酸化物半導体と高品質ゲー
ト絶縁膜とが密接することにより、界面準位を低減して界面特性を良好なものとすること
ができるからである。
【０１６８】
もちろん、ゲート絶縁膜２１２として良質な絶縁膜を形成できるものであれば、スパッタ
リング法やプラズマＣＶＤ法など他の成膜方法を適用することができる。また、成膜後の
熱処理によってゲート絶縁膜２１２の膜質、酸化物半導体との界面特性が改質される絶縁
膜であっても良い。いずれにしても、ゲート絶縁膜としての膜質が良好であることは勿論
のこと、酸化物半導体との界面準位密度を低減し、良好な界面を形成できるものであれば
良い。
【０１６９】
バリア性の高い材料を用いた絶縁膜と、含まれる窒素の比率が低い酸化珪素膜、酸化窒化
珪素膜などの絶縁膜とを積層させた構造を有するゲート絶縁膜２１２を形成しても良い。
この場合、酸化珪素膜、酸化窒化珪素膜などの絶縁膜は、バリア性を有する絶縁膜と酸化
物半導体膜の間に形成する。バリア性の高い絶縁膜として、例えば窒化珪素膜、窒化酸化
珪素膜、窒化アルミニウム膜、または窒化酸化アルミニウム膜などが挙げられる。バリア
性を有する絶縁膜を用いることで、水分または水素などの雰囲気中の不純物、或いは基板
内に含まれるアルカリ金属、重金属などの不純物が、酸化物半導体膜内、ゲート絶縁膜２
１２内、或いは、酸化物半導体膜と他の絶縁膜の界面とその近傍に入り込むのを防ぐこと
ができる。また、酸化物半導体膜に接するように窒素の比率が低い酸化珪素膜、酸化窒化
珪素膜などの絶縁膜を形成することで、バリア性の高い材料を用いた絶縁膜が直接酸化物
半導体膜に接するのを防ぐことができる。
【０１７０】
例えば、第１のゲート絶縁膜として膜厚５ｎｍ以上３００ｎｍ以下の酸化シリコン膜（Ｓ
ｉＯ_ｘ（ｘ＞０））を形成し、第１のゲート絶縁膜上に第２のゲート絶縁膜としてスパッ
タリング法により膜厚５０ｎｍ以上２００ｎｍ以下の窒化シリコン膜（ＳｉＮ_ｙ（ｙ＞０
））を積層して、膜厚１００ｎｍのゲート絶縁膜としてもよい。本実施の形態では、圧力
０．４Ｐａ、高周波電源１．５ｋＷ、酸素及びアルゴン（酸素流量２５ｓｃｃｍ：アルゴ
ン流量２５ｓｃｃｍ＝１：１）雰囲気下でＲＦスパッタリング法により膜厚１００ｎｍの
酸化シリコン膜を形成する。
【０１７１】
なお、ゲート絶縁膜２１２に水素、水酸基及び水分がなるべく含まれないようにするため
に、成膜の前処理として、スパッタリング装置の予備加熱室で第１の電極２０２、酸化物
半導体膜２０８及び第２の電極２１１が形成された基板２００を予備加熱し、基板２００
に吸着した水素、水分などの不純物を脱離し排気することが好ましい。なお、予備加熱の
温度としては、１００℃以上４００℃以下好ましくは１５０℃以上３００℃以下である。
なお、予備加熱室に設ける排気手段はクライオポンプが好ましい。なお、この予備加熱の
処理は省略することもできる。
【０１７２】
なお、ゲート絶縁膜２１２を形成した後に、加熱処理を施しても良い。加熱処理は大気雰
囲気下、又は不活性ガス雰囲気（窒素、またはヘリウム、ネオン、アルゴン等）下におい
て、好ましくは２００℃以上４００℃以下、例えば２５０℃以上３５０℃以下で行う。本
実施の形態では、例えば、窒素雰囲気下で２５０℃、１時間の加熱処理を行う。上記加熱
処理を行うと、酸化物半導体膜２０８がゲート絶縁膜２１２を構成する酸化珪素と接した
状態で加熱されることになり、第２の加熱処理で酸素欠損が発生していたとしても、酸化
珪素から酸素が供給されることで、ドナーとなる酸素欠損を低減し、化学量論的組成比を
満たす構成とすることが可能であり、酸化物半導体膜２０８をｉ型化または実質的にｉ型
化にすることができる。この加熱処理を行うタイミングは、ゲート絶縁膜２１２の形成後
であれば特に限定されず、他の工程、例えば後に形成されるゲート電極２１３、絶縁膜２
１４、または配線２１５、配線２１６、配線２１７のいずれかを形成した後に行ってもよ
い。また、透明導電膜を低抵抗化させるための加熱処理などの、他の加熱処理と兼ねるこ
とで、工程数を増やすことなく行うことができる。
【０１７３】
ゲート電極２１３の材料は、モリブデン、チタン、クロム、タンタル、タングステン、ネ
オジム、スカンジウム等の金属材料、これら金属材料を主成分とする合金材料を用いた導
電膜、或いはこれら金属の窒化物を、単層で又は積層で用いることができる。なお、後の
工程において行われる加熱処理の温度に耐えうるのであれば、上記金属材料としてアルミ
ニウム、銅を用いることも出来る。アルミニウムまたは銅は、耐熱性や腐食性の問題を回
避するために、高融点金属材料と組み合わせて用いると良い。高融点金属材料としては、
モリブデン、チタン、クロム、タンタル、タングステン、ネオジム、スカンジウム等を用
いることができる。
【０１７４】
例えば、二層の積層構造を有するゲート電極２１３として、アルミニウム膜上にモリブデ
ン膜が積層された二層の積層構造、または銅膜上にモリブデン膜を積層した二層構造、ま
たは銅膜上に窒化チタン膜若しくは窒化タンタル膜を積層した二層構造、窒化チタン膜と
モリブデン膜とを積層した二層構造とすることが好ましい。３層の積層構造を有するゲー
ト電極２１３としては、アルミニウム膜、アルミニウムとシリコンの合金膜、アルミニウ
ムとチタンの合金膜またはアルミニウムとネオジムの合金膜を中間層とし、タングステン
膜、窒化タングステン膜、窒化チタン膜またはチタン膜を上下層として積層した構造とす
ることが好ましい。
【０１７５】
また、ゲート電極２１３に酸化インジウム、酸化インジウム酸化スズ合金、酸化インジウ
ム酸化亜鉛合金、酸化亜鉛、酸化亜鉛アルミニウム、酸窒化亜鉛アルミニウム、または酸
化亜鉛ガリウム等の透光性を有する酸化物導電膜をゲート電極２１３に用いることで、画
素部の開口率を向上させることができる。
【０１７６】
ゲート電極２１３の膜厚は、１０ｎｍ〜４００ｎｍ、好ましくは１００ｎｍ〜２００ｎｍ
とする。本実施の形態では、タングステンターゲットを用いたスパッタ法により１５０ｎ
ｍのゲート電極用の導電膜を形成した後、該導電膜をエッチングにより所望の形状に加工
（パターニング）することで、ゲート電極２１３を形成する。ゲート電極２１３は、少な
くとも、ゲート絶縁膜２１２を間に挟んで、酸化物半導体膜２０８の端部と重なる位置に
形成されていれば良い。酸化物半導体膜２０８の端部では、このゲート絶縁膜２１２を間
に挟んでゲート電極２１３と重なる部分２１８において、チャネル形成領域が形成される
。なお、形成されたゲート電極２１３の端部がテーパ形状であると、上に積層する絶縁膜
２１４の被覆性が向上するため好ましい。なお、レジストマスクをインクジェット法で形
成してもよい。レジストマスクをインクジェット法で形成するとフォトマスクを使用しな
いため、製造コストを低減できる。
【０１７７】
次いで、図６（Ｂ）に示すように、第１の電極２０２、酸化物半導体膜２０８、第２の電
極２１１、ゲート絶縁膜２１２及びゲート電極２１３を覆うように、絶縁膜２１４を形成
した後、コンタクトホール２２１、コンタクトホール２２２、コンタクトホール２２３を
形成する。絶縁膜２１４は、水分や、水素などの不純物を極力含まないことが望ましく、
単層の絶縁膜であっても良いし、積層された複数の絶縁膜で構成されていても良い。絶縁
膜２１４は、例えば、酸化珪素膜、酸化窒化珪素膜、酸化アルミニウム膜、または酸化窒
化アルミニウム膜などの酸化物絶縁膜、窒化珪素膜、窒化酸化珪素膜、窒化アルミニウム
膜、または窒化酸化アルミニウム膜などの窒化物絶縁膜を用いる。または、酸化物絶縁膜
及び窒化物絶縁膜の積層とすることもできる。上記絶縁膜２１４に、バリア性の高い絶縁
膜、例えば、窒化珪素膜、窒化酸化珪素膜、窒化アルミニウム膜、または窒化酸化アルミ
ニウム膜などを用いることで、酸化物半導体膜２０８内、ゲート絶縁膜２１２内、或いは
、酸化物半導体膜２０８と他の絶縁膜の界面とその近傍に、水分または水素などの不純物
が入り込むのを防ぐことができる。
【０１７８】
本実施の形態では、スパッタ法で形成された膜厚２００ｎｍの酸化珪素膜上に、スパッタ
法で形成された膜厚１００ｎｍの窒化珪素膜を積層させた構造を有する、絶縁膜２１４を
形成する。なお、スパッタリング法で絶縁膜２１４を形成する場合、基板２００を１００
℃〜４００℃の温度に加熱し、水素、水、水酸基または水素化物などが除去された高純度
窒素を含むスパッタガスを導入しシリコン半導体のターゲットを用いて絶縁膜２１４を形
成してもよい。この場合においても、処理室内に残留する水素、水、水酸基または水素化
物などを除去しつつ絶縁膜を形成することが好ましい。
【０１７９】
なお、絶縁膜２１４を形成した後に、加熱処理を施しても良い。加熱処理は、不活性ガス
雰囲気（窒素、またはヘリウム、ネオン、アルゴン等）下において、好ましくは２００℃
以上４００℃以下、例えば２５０℃以上３５０℃以下で行う。
【０１８０】
コンタクトホール２２１、コンタクトホール２２２、コンタクトホール２２３は、フォト
リソグラフィ工程によりレジストマスクを形成し、ゲート絶縁膜２１２及び絶縁膜２１４
の一部をエッチングにより選択的に除去することで形成できる。コンタクトホール２２１
により、ゲート電極２１３の一部が露出される。コンタクトホール２２２により、第２の
電極２１１の一部が露出される。コンタクトホール２２３により、ゲート電極２１３の一
部が露出される。また、これらコンタクトホールの形成時に、第１の電極２０２のゲート
電極２１３に覆われていない領域において、第１の電極２０２が露出するようなコンタク
トホールを形成しても良い。
【０１８１】
次に、図６（Ｃ）に示すように、コンタクトホール２２１、コンタクトホール２２２、コ
ンタクトホール２２３を覆うように、絶縁膜２１４上に導電膜を形成した後、エッチング
等により、当該導電膜を所望の形状に加工して、配線２１５、配線２１６、配線２１７を
形成する。なお、エッチングに用いるレジストマスクをインクジェット法で形成してもよ
い。レジストマスクをインクジェット法で形成するとフォトマスクを使用しないため、製
造コストを削減できる。
【０１８２】
配線２１５は、コンタクトホール２２１を介してゲート電極２１３に接続されている。配
線２１６は、コンタクトホール２２２を介して第２の電極２１１に接続されている。配線
２１７は、コンタクトホール２２３を介してゲート電極２１３に接続されている。なお、
これら配線の形成時に、コンタクトホールを介して第１の電極２０２に接続される配線を
形成しても良い。
【０１８３】
配線２１５、配線２１６、配線２１７は、第１の電極２０２と同様の構造、材料を有する
導電膜を用いて、同様の作製方法にて形成することができる。
【０１８４】
以上の工程でトランジスタ２２０が形成される。
【０１８５】
図７（Ｂ）に、図６（Ｃ）に示すトランジスタ２２０の上面図を示す。なお、図７（Ｂ）
の破線Ｂ１−Ｂ２における断面図が、図６（Ｃ）に相当する。図７（Ｂ）において、配線
２３０は、配線２１５、配線２１６、配線２１７と同時に形成される配線であり、コンタ
クトホール２３１を介して第１の電極２０２に接続されている。
【０１８６】
上記のように酸化物半導体膜中の水素の濃度を低減し、高純度化することができる。それ
により酸化物半導体膜の安定化を図ることができる。また、ガラス転移温度以下の加熱処
理で、キャリア密度が極端に少なく、バンドギャップの広い酸化物半導体膜を形成するこ
とができる。このため、大面積基板を用いてトランジスタを作製することができるため、
量産性を高めることができる。また、当該水素濃度が低減され高純度化された酸化物半導
体膜を用いることで、耐圧性が高く、ショートチャネル効果が低く、オンオフ比の高いト
ランジスタを作製することができる。
【０１８７】
なお、本実施の形態では、酸化物半導体膜２０８のうち、第２の電極２１１とは異なる領
域に形成されている部分全てが、ゲート電極２１３に覆われているが、本発明はこの構成
に限定されない。酸化物半導体膜２０８のうち、第２の電極２１１とは異なる領域に形成
されている部分の少なくとも一部が、ゲート電極２１３により覆われていれば良い。また
、第１の電極２０２と第２の電極２１１のうち、ドレイン電極として機能する電極が、ゲ
ート電極２１３に接続されていても良い。ドレイン電極として機能する電極がゲート電極
２１３に接続されていることで、当該トランジスタをダイオードとして機能させることが
できる。
【０１８８】
なお、トランジスタが有するソース電極とドレイン電極は、トランジスタの極性及び各電
極に与えられる電位の高低差によって、その呼び方が入れ替わる。一般的に、ｎチャネル
型トランジスタでは、低い電位の与えられる電極がソース電極と呼ばれ、高い電位の与え
られる電極がドレイン電極と呼ばれる。また、ｐチャネル型トランジスタでは、低い電位
の与えられる電極がドレイン電極と呼ばれ、高い電位の与えられる電極がソース電極と呼
ばれる。本明細書では、便宜上、ソース電極とドレイン電極とが固定されているものと仮
定して、トランジスタの接続関係を説明しているが、実際には上記電位の関係に従ってソ
ース電極とドレイン電極の呼び方が入れ替わる。
【０１８９】
また、本明細書において接続とは電気的な接続を意味しており、電流または電圧が伝送可
能な状態に相当する。
【０１９０】
ここで、本実施の形態で示したトランジスタのドレイン耐圧について説明する。
【０１９１】
半導体中の電界があるしきい値に達すると、衝突イオン化が生じ、空乏層内で高電界によ
り加速されたキャリアが結晶格子に衝突し、電子と正孔の対を生成する。さらに電界が高
くなると、衝突イオン化により発生した電子と正孔の対もさらに電界によって加速され、
衝突イオン化を繰り返し、電流が指数関数的に増加するアバランシェ降伏が生じる。衝突
イオン化は、キャリア（電子、正孔）が半導体のバンドギャップ以上の運動エネルギーを
有することにより発生する。このため、バンドギャップが大きいほど、衝突イオン化を発
生させる電界が高くなる。
【０１９２】
酸化物半導体のバンドギャップは、３．１５ｅＶであり、シリコンのバンドギャップの１
．７４ｅＶとくらべて大きいため、アバランシェ降伏が起こりにくい。このため、酸化物
半導体を用いたトランジスタはドレイン耐圧が高くなり、高電界が印加されてもオン電流
の指数関数的急上昇が生じにくい。
【０１９３】
次に、酸化物半導体を用いたトランジスタのホットキャリア劣化について説明する。
【０１９４】
ホットキャリア劣化とは、高速に加速された電子がチャネル中のドレイン近傍でゲート絶
縁膜中に注入されて固定電荷となる、或いは、ゲート絶縁膜界面にトラップ準位を形成す
ることにより、閾値電圧の変動やゲートリーク等のトランジスタ特性の劣化が生じること
であり、ホットキャリア劣化の要因としては、チャネルホットエレクトロン注入（ＣＨＥ
注入）とドレインアバランシェホットキャリア注入（ＤＡＨＣ注入）がある。
【０１９５】
シリコンはバンドギャップが狭いため、アバランシェ降伏によって雪崩的に電子が発生し
やすく、ゲート絶縁膜への障壁を越えられるほど高速に加速される電子数が増加する。し
かしながら、本実施の形態で示す酸化物半導体は、バンドギャップが広いため、アバラン
シェ降伏が生じにくく、シリコンと比べてホットキャリア劣化の耐性が高い。なお、高耐
圧材料の一つであるシリコンカーバイドのバンドキャップと酸化物半導体のバンドギャッ
プは同等であるが、酸化物半導体の方が、移動度が２桁程小さいため、電子が加速されに
くく、シリコンカーバイドよりホットキャリア劣化が生じにくく、ドレイン耐圧が高いと
いえる。
【０１９６】
以上のことから、酸化物半導体を用いたトランジスタはドレイン耐圧が高く、具体的には
１００Ｖ以上、好ましくは５００Ｖ、より好ましくは１ｋＶ以上のドレイン耐圧を有する
ことが可能である。
【０１９７】
ここで、トランジスタの代表例であるシリコンカーバイドと酸化物半導体の比較について
以下に示す。ここでは、シリコンカーバイドとして、４Ｈ−ＳｉＣを用いる。
【０１９８】
酸化物半導体と４Ｈ−ＳｉＣはいくつかの共通点を有している。真性キャリア密度はその
一例である。フェルミ・ディラック分布に従えば、酸化物半導体の真性キャリア密度は１
０^−７ｃｍ^−３程度と見積もられるが、これは、４Ｈ−ＳｉＣにおける６．７×１０^−１
１ｃｍ^−３と同様、極めて低い値である。
【０１９９】
また、酸化物半導体のエネルギーバンドギャップは３．０ｅＶ〜３．５ｅＶであり、４Ｈ
−ＳｉＣのエネルギーバンドギャップは３．２６ｅＶであるから、ワイドギャップ半導体
という点においても、酸化物半導体とシリコンカーバイドとは共通している。
【０２００】
しかしながら、酸化物半導体及びシリコンカーバイドにおいて、製造温度が大きく異なる
。シリコンカーバイドは一般に１５００℃〜２０００℃の熱処理を必要とする。一方、酸
化物半導体は、３００℃〜５００℃（ガラス転移温度以下、最大でも７００℃程度）の熱
処理で作製することが可能であり、大面積基板上にトランジスタを作製することができる
。また、スループットを高めることができる。
【０２０１】
また、シリコンカーバイドを用いたトランジスタはＰＮ接合を用いるため、ドナーまたは
アクセプターとなりうる不純物（リン、ボロン等）のドーピング工程が必要であるため、
製造工程数が増大する。一方、酸化物半導体を用いたトランジスタは、ＰＮ接合を設けず
ともよいため、製造工程の削減、スループットの向上が可能であり、更には大面積基板を
用いることが可能である。
【０２０２】
なお、酸化物半導体において、バンドギャップ内のＤＯＳ（ｄｅｎｓｉｔｙ ｏｆ ｓｔ
ａｔｅ）等の物性研究は多くなされているが、これらの研究は、ＤＯＳそのものを十分に
減らすという思想を含まない。本実施の形態では、ＤＯＳの原因たり得る水や水素を酸化
物半導体中より除去することで、高純度化した酸化物半導体を作製する。これは、ＤＯＳ
そのものを十分に減らすという思想に基づくものである。そして、これによって極めて優
れた工業製品の製造を可能とするものである。
【０２０３】
さらに、酸素欠乏により発生する金属の不対結合手に対して酸素を供給し、酸素欠陥によ
るＤＯＳを減少させることにより、いっそう高純度化された（ｉ型の）酸化物半導体とす
ることも可能である。たとえば、チャネル形成領域に密接して酸素過剰の酸化膜を形成し
、当該酸化膜から酸素を供給して、酸素欠陥によるＤＯＳを減少させることが可能である
。
【０２０４】
酸化物半導体の欠陥は、過剰な水素による伝導帯下０．１〜０．２ｅＶの浅い準位や、酸
素の不足による深い準位、などに起因するものとされている。これらの欠陥を無くすため
に、水素を徹底的に除去し、酸素を十分に供給する、という技術思想は正しいものであろ
う。
【０２０５】
また、酸化物半導体は一般にｎ型とされているが、本実施の形態では、不純物、特に水や
水素を除去することによりｉ型化を実現する。この点、シリコンなどのように不純物を添
加してのｉ型化ではなく、従来にない技術思想を含むものといえる。
【０２０６】
また、酸化物半導体をｉ型化することにより、トランジスタの温度特性が良好であり、代
表的には、−２５℃から１５０℃までの温度範囲において、トランジスタの電流電圧特性
において、オン電流、オフ電流、電界効果移動度、Ｓ値、及びしきい値電圧の変動がほと
んどなく、温度による電流電圧特性の劣化がほとんどない。
【０２０７】
なお、本実施の形態で示す酸化物半導体を用いたトランジスタは、シリコンカーバイドを
用いたトランジスタと比較して、移動度が２桁ほど低いが、ドレイン電圧を高くする、チ
ャネル幅（Ｗ）を大きくすることで、トランジスタの電流値を高め、デバイス特性を向上
させることができる。
【０２０８】
本実施の形態の技術思想は、酸化物半導体中に、不純物をさらに加えることをせずに、逆
に不本意に存在する水、水素という不純物を意図的に除去することにより、酸化物半導体
自体を高純度化することである。すなわち、ドナー準位を構成する水または水素を除去し
、さらに酸素欠損を低減し、酸化物半導体を構成する主成分材料の酸素を十分に供給する
ことにより、酸化物半導体を高純度化することである。
【０２０９】
酸化物半導体を成膜することで１０^２０ｃｍ^−３のレベルの水素がＳＩＭＳ（二次イオン
質量分析）で測定される。このドナー準位の原因となる水または水素を意図的に除去し、
さらに水または水素の除去に伴い同時に減少してしまう酸素（酸化物半導体の成分の一つ
）を酸化物半導体に加えることにより、酸化物半導体を高純度化し、電気的にｉ型（真性
）半導体とする。
【０２１０】
また、本実施の形態においては、酸化物半導体中の水、水素の量は少なければ少ないほど
好ましく、キャリアも少なければ少ないほど良い。すなわち、キャリア密度は１×１０^１
４ｃｍ^−３未満、好ましくは１×１０^１２ｃｍ^−３未満、さらに好ましくは測定限界以下
の１×１０^１１ｃｍ^−３未満が求められる。更には本実施の形態の技術思想的には、ゼロ
に近いまたはゼロが理想である。酸化物半導体のキャリアを低減し、好ましくは無くして
しまうことで、トランジスタにおいて酸化物半導体はキャリアを通過させる通路（パス）
として機能させる。その結果、酸化物半導体は高純度化したｉ型（真性）半導体であり、
キャリアがない、または極めて少なくせしめることにより、トランジスタのオフ状態では
Ｉｏｆｆを極めて低くできるというのが本実施の形態の技術思想である。
【０２１１】
また、酸化物半導体は通路（パス）として機能し、酸化物半導体自体がキャリアを有さな
い、または極めて少ないように高純度化したｉ型（真性）とすると、キャリアはソース電
極、ドレイン電極により供給される。
【０２１２】
なお、本実施の形態で示した構造を有するトランジスタは、実施の形態１に示したような
、チャネルが基板と概略平行に形成される横型のトランジスタに比べて基板表面における
占有面積を低減することができる。この結果、トランジスタの微細化が可能である。
【０２１３】
このように、酸化物半導体膜の主成分以外の不純物、代表的には水素、水、水酸基または
水素化物などが極力含まれないように高純度化することにより、トランジスタの動作を良
好なものとすることができる。特に、耐圧性を高め、ショートチャネル効果を低減し、オ
ンオフ比を高めることができる。
【０２１４】
本実施の形態は、上記実施の形態と適宜組み合わせて実施することが可能である。
【０２１５】
（実施の形態３）
本実施の形態では、チャネル保護構造のボトムゲート型のトランジスタを例に挙げ、半導
体装置の構造及び作製方法について説明する。なお、実施の形態１と同一部分又は同様な
機能を有する部分、及び工程は、実施の形態１と同様に行うことができるため、繰り返し
の説明は省略する。
【０２１６】
実施の形態１の図１（Ｅ）に示すように、第２の加熱処理の工程まで、同様に行う。次い
で、図８（Ａ）に示すように、酸化物半導体膜１０８内のゲート電極１０１と重なる領域
、すなわちチャネル形成領域と重なるように、酸化物半導体膜１０８上にチャネル保護膜
１３０を形成する。チャネル保護膜１３０を設けることによって、酸化物半導体膜１０８
のチャネル形成領域となる部分に対する、後の工程時におけるダメージ（エッチング時の
プラズマやエッチング剤による膜減りなど）を防ぐことができる。従ってトランジスタの
信頼性を向上させることができる。
【０２１７】
チャネル保護膜１３０には、酸素を含む無機材料（酸化珪素、酸化窒化珪素、窒化酸化珪
素など）を用いることができる。チャネル保護膜１３０は、プラズマＣＶＤ法や熱ＣＶＤ
法などの気相成長法やスパッタリング法を用いて形成することができる。チャネル保護膜
１３０は成膜後にエッチングにより形状を加工する。ここでは、スパッタ法により酸化珪
素膜を形成し、フォトリソグラフィによるマスクを用いてエッチング加工することでチャ
ネル保護膜１３０を形成する。
【０２１８】
なお、チャネル保護膜１３０を形成した後に、加熱処理を施しても良い。加熱処理は、不
活性ガス雰囲気（窒素、またはヘリウム、ネオン、アルゴン等）下において、好ましくは
２００℃以上４００℃以下、例えば２５０℃以上３５０℃以下で行う。本実施の形態では
、例えば、窒素雰囲気下で２５０℃、１時間の加熱処理を行う。酸化物半導体膜１０８の
チャネル形成領域となる部分と、酸素を含む絶縁膜であるチャネル保護膜１３０とが接し
て設けられた後に、加熱処理が施されることによって、酸化物半導体膜１０８に酸素が供
与されるため、酸化物半導体膜１０８のチャネル保護膜１３０と接する領域を選択的に酸
素過剰な状態とすることができる。その結果、酸化物半導体膜１０８の少なくともチャネ
ル保護膜１３０と接する領域において、第２の加熱処理により酸素欠損が発生していたと
しても、ドナーとなる酸素欠損を低減して化学量論的組成比を満たす構成とすることが可
能であり、ゲート電極１０１と重なるチャネル形成領域はｉ型化または実質的にｉ型化と
なり、トランジスタの電気特性の向上および、電気特性のばらつきを軽減することができ
る。この加熱処理を行うタイミングは、チャネル保護膜１３０の形成後であれば特に限定
されず、他の工程、例えば樹脂膜形成時の加熱処理や、透明導電膜を低抵抗化させるため
の加熱処理と兼ねることで、工程数を増やすことなく行うことができる。
【０２１９】
次いで、図８（Ｂ）に示すように、酸化物半導体膜１０８上に、ソース電極及びドレイン
電極（これと同じ層で形成される配線を含む）となる導電膜を形成した後、該導電膜をエ
ッチング等により所望の形状に加工することで、ソース電極１３１、ドレイン電極１３２
を形成する。ソース電極１３１、ドレイン電極１３２の材料、膜厚及び構造と、作製方法
については、実施の形態１に示したソース電極１１１、ドレイン電極１１２についての記
載を参照すれば良い。
【０２２０】
次いで、Ｎ_２Ｏ、Ｎ_２、またはＡｒなどのガスを用いたプラズマ処理を行う。このプラズ
マ処理によって露出している酸化物半導体膜の表面に付着した吸着水などを除去する。ま
た、酸素とアルゴンの混合ガスを用いてプラズマ処理を行ってもよい。
【０２２１】
なお、プラズマ処理を行った後、図８（Ｃ）に示すように、ソース電極１３１、ドレイン
電極１３２、チャネル保護膜１３０及び酸化物半導体膜１０８を覆うように、絶縁膜１３
３を形成する。絶縁膜１３３の材料、膜厚及び構造と、作製方法については、実施の形態
１に示した絶縁膜１１３についての記載を参照すれば良い。
【０２２２】
なお、絶縁膜１３３を形成した後に、加熱処理を施しても良い。加熱処理は、不活性ガス
雰囲気（窒素、またはヘリウム、ネオン、アルゴン等）下において、好ましくは２００℃
以上４００℃以下、例えば２５０℃以上３５０℃以下で行う。本実施の形態では、例えば
、窒素雰囲気下で２５０℃、１時間の加熱処理を行う。
【０２２３】
以上の工程でトランジスタ１４０が形成される。
【０２２４】
図９に、図８（Ｃ）に示すトランジスタ１４０の上面図を、それぞれ示す。なお、図９の
破線Ｃ１−Ｃ２における断面図が、図８（Ｃ）に相当する。
【０２２５】
上記作製方法に従って形成されたトランジスタ１４０は、ゲート電極１０１と、ゲート電
極１０１上のゲート絶縁膜１０２と、ゲート絶縁膜１０２上の酸化物半導体膜１０８と、
酸化物半導体膜１０８上のチャネル保護膜１３０と、酸化物半導体膜１０８上のソース電
極１３１及びドレイン電極１３２とを有する。トランジスタ１４０は、さらに、酸化物半
導体膜１０８、ソース電極１３１、ドレイン電極１３２及びチャネル保護膜１３０上の絶
縁膜１３３を有していても良い。
【０２２６】
また、トランジスタ１４０はシングルゲート構造のトランジスタを用いて説明したが、必
要に応じて、チャネル形成領域を複数有するマルチゲート構造のトランジスタも形成する
ことができる。
【０２２７】
次いで、絶縁膜１３３上に導電膜を形成した後、該導電膜をパターニングすることで、図
１０（Ａ）に示すように、酸化物半導体膜１０８と重なる位置にバックゲート電極１４５
を形成しても良い。バックゲート電極１４５は、ゲート電極１０１、或いはソース電極１
３１及びドレイン電極１３２と同様の材料、構造を用いて形成することが可能である。
【０２２８】
バックゲート電極１４５の膜厚は、１０ｎｍ〜４００ｎｍ、好ましくは１００ｎｍ〜２０
０ｎｍとする。本実施の形態では、チタン膜、アルミニウム膜、チタン膜が積層された構
造を有する導電膜を形成する。そして、フォトリソグラフィ法によりレジストマスクを形
成し、エッチングにより不要な部分を除去して、該導電膜を所望の形状に加工（パターニ
ング）することで、バックゲート電極１４５を形成する。
【０２２９】
次いで、図１０（Ｂ）に示すように、バックゲート電極１４５を覆うように絶縁膜１４６
を形成する。絶縁膜１４６は、雰囲気中の水分、水素、酸素などがトランジスタ１４０の
特性に影響を与えるのを防ぐことができる、バリア性の高い材料を用いるのが望ましい。
例えば、バリア性の高い絶縁膜として、窒化珪素膜、窒化酸化珪素膜、窒化アルミニウム
膜、または窒化酸化アルミニウム膜などを、プラズマＣＶＤ法又はスパッタリング法等に
より単層で又は積層させて形成することができる。バリア性の効果を得るには、絶縁膜１
４６は、例えば厚さ１５ｎｍ〜４００ｎｍの膜厚で形成することが好ましい。
【０２３０】
本実施の形態では、プラズマＣＶＤ法により３００ｎｍの絶縁膜を形成する。成膜条件は
、シランガスの流量４ｓｃｃｍとし、一酸化二窒素（Ｎ_２Ｏ）の流量８００ｓｃｃｍとし
、基板温度４００℃とする。
【０２３１】
図１０（Ｃ）に、図１０（Ｂ）に示す半導体装置の上面図を示す。図１０（Ｂ）は、図１
０（Ｃ）の破線Ｃ１−Ｃ２における断面図に相当する。
【０２３２】
なお、図１０（Ｂ）では、バックゲート電極１４５が酸化物半導体膜１０８全体を覆って
いる場合を例示しているが、本発明はこの構成に限定されない。バックゲート電極１４５
は、酸化物半導体膜１０８が有するチャネル形成領域の一部と少なくとも重なっていれば
良い。
【０２３３】
バックゲート電極１４５は、電気的に絶縁しているフローティングの状態であっても良い
し、電位が与えられる状態であっても良い。後者の場合、バックゲート電極１４５には、
ゲート電極１０１と同じ高さの電位が与えられていても良いし、グラウンドなどの固定電
位が与えられていても良い。バックゲート電極１４５に与える電位の高さを制御すること
で、トランジスタ１４０の閾値電圧を制御することができる。
【０２３４】
本実施の形態は、上記実施の形態と適宜組み合わせて実施することが可能である。
【０２３５】
（実施の形態４）
本実施の形態では、本発明の作製方法を用いて形成される半導体表示装置の一つである、
電子ペーパー或いはデジタルペーパーと呼ばれる半導体表示装置の構成について説明する
。
【０２３６】
電子ペーパーは、電圧の印加により階調を制御することができ、なおかつメモリ性を有す
る表示素子を用いる。具体的に、電子ペーパーに用いられる表示素子には、非水系電気泳
動型の表示素子、２つの電極間の高分子材料中に液晶のドロップレットを分散させたＰＤ
ＬＣ（ｐｏｌｙｍｅｒ ｄｉｓｐｅｒｓｅｄ ｌｉｑｕｉｄ ｃｒｙｓｔａｌ）方式の表
示素子、２つの電極間にカイラルネマチック液晶またはコレステリック液晶を有する表示
素子、２つの電極間に帯電した微粒子を有し、該微粒子を電界により粉体中で移動させる
粉体移動方式の表示素子などを用いることができる。また非水系電気泳動型の表示素子に
は、２つの電極間に帯電した微粒子を分散させた分散液を挟み込んだ表示素子、帯電した
微粒子を分散させた分散液を、絶縁膜を間に挟んだ２つの電極上に有する表示素子、それ
ぞれ異なる電荷に帯電する二色の半球を有するツイスティングボールを、２つの電極間に
おいて溶媒中に分散させた表示素子、溶液中に帯電した微粒子が複数分散されているマイ
クロカプセルを２つの電極間に有する表示素子などが含まれる。
【０２３７】
図１１（Ａ）に、電子ペーパーの画素部７００と、信号線駆動回路７０１と、走査線駆動
回路７０２の上面図を示す。
【０２３８】
画素部７００は複数の画素７０３を有している。また、信号線駆動回路７０１から複数の
信号線７０７が、画素部７００内まで引き回されている。走査線駆動回路７０２から複数
の走査線７０８が、画素部７００内まで引き回されている。
【０２３９】
各画素７０３はトランジスタ７０４と、表示素子７０５と、保持容量７０６とを有してい
る。トランジスタ７０４のゲート電極は、走査線７０８の一つに接続されている。またト
ランジスタ７０４のソース電極とドレイン電極は、一方が信号線７０７の一つに、他方が
表示素子７０５の画素電極に接続されている。
【０２４０】
なお図１１（Ａ）では、表示素子７０５の画素電極と対向電極の間に印加された電圧を保
持するために、表示素子７０５と並列に保持容量７０６が接続されているが、表示素子７
０５のメモリ性の高さが表示を維持するのに十分な程度に高いのであれば、保持容量７０
６を必ずしも設ける必要はない。
【０２４１】
なお、図１１（Ａ）では、各画素にスイッチング素子として機能するトランジスタを一つ
設けたアクティブマトリクス型の画素部の構成について説明したが、本発明の一態様に係
る電子ペーパーは、この構成に限定されない。画素に設けるトランジスタの数は複数であ
っても良いし、トランジスタ以外に容量、抵抗、コイルなどの素子が接続されていても良
い。
【０２４２】
図１１（Ｂ）に、マイクロカプセルを有する電気泳動型の電子ペーパーを例に挙げ、各画
素７０３に設けられた表示素子７０５の断面図を示す。
【０２４３】
表示素子７０５は、画素電極７１０と、対向電極７１１と、画素電極７１０及び対向電極
７１１によって電圧が印加されるマイクロカプセル７１２とを有する。トランジスタ７０
４のソース電極またはドレイン電極７１３の一方は、画素電極７１０に接続されている。
【０２４４】
マイクロカプセル７１２内には、酸化チタンなどのプラスに帯電した白色顔料と、カーボ
ンブラックなどのマイナスに帯電した黒色顔料とが、オイルなどの分散媒と共に封入され
ている。画素電極７１０に印加されるビデオ信号の電圧に従って、画素電極と対向電極の
間に電圧を印加し、正の電極側に黒色顔料を、負の電極側に白色顔料を引き寄せることで
、階調の表示を行うことができる。
【０２４５】
また、図１１（Ｂ）では、マイクロカプセル７１２が、画素電極７１０と対向電極７１１
の間において透光性を有する樹脂７１４により固定されている。しかし、本発明はこの構
成に限定されず、マイクロカプセル７１２、画素電極７１０、対向電極７１１によって形
成される空間には、空気、不活性ガスなどの気体が充填されていても良い。ただし、この
場合、マイクロカプセル７１２は、接着剤などにより画素電極７１０と対向電極７１１の
両方、或いはいずれか一方に、固定しておくことが望ましい。
【０２４６】
また、表示素子７０５が有するマイクロカプセル７１２の数は、図１１（Ｂ）に示すよう
に複数であるとは限らない。１つの表示素子７０５が複数のマイクロカプセル７１２を有
していても良いし、複数の表示素子７０５が１つのマイクロカプセル７１２を有していて
も良い。例えば２つの表示素子７０５が１つのマイクロカプセル７１２を共有し、一方の
表示素子７０５が有する画素電極７１０にプラスの電圧が、他方の表示素子７０５が有す
る画素電極７１０にマイナスの電圧が印加されていたとする。この場合、プラスの電圧が
印加された画素電極７１０と重なる領域において、マイクロカプセル７１２内では黒色顔
料が画素電極７１０側に引き寄せられ、白色顔料が対向電極７１１側に引き寄せられる。
逆に、マイナスの電圧が印加された画素電極７１０と重なる領域において、マイクロカプ
セル７１２内では白色顔料が画素電極７１０側に引き寄せられ、黒色顔料が対向電極７１
１側に引き寄せられる。
【０２４７】
次に、電子ペーパーの具体的な駆動方法について、上述した電気泳動型の電子ペーパーを
例に挙げて説明する。
【０２４８】
電子ペーパーの動作は、初期化期間と、書込期間と、保持期間とに分けて説明することが
出来る。
【０２４９】
表示する画像を切り替える前に、まず初期化期間において画素部内の各画素の階調を一旦
統一することで、表示素子を初期化する。表示素子を初期化することで、残像が残るのを
防ぐことが出来る。具体的に、電気泳動型では、各画素の表示が白または黒となるように
、表示素子７０５が有するマイクロカプセル７１２によって表示される階調を調整する。
【０２５０】
本実施の形態では、黒を表示するような初期化用ビデオ信号を画素に入力した後、白を表
示するような初期化用ビデオ信号を画素に入力する場合の、初期化の動作について説明す
る。例えば、画像の表示を対向電極７１１側に向かって行う電気泳動型の電子ペーパーの
場合、まず、マイクロカプセル７１２内の黒色顔料が対向電極７１１側に、白色顔料が画
素電極７１０側に向くように、表示素子７０５に電圧を印加する。次いで、マイクロカプ
セル７１２内の白色顔料が対向電極７１１側に、黒色顔料が画素電極７１０側に向くよう
に、表示素子７０５に電圧を印加する。
【０２５１】
また、画素への初期化用ビデオ信号の入力が１回のみだと、初期化期間の前に表示されて
いた階調によっては、マイクロカプセル７１２内の白色顔料と黒色顔料の移動が中途半端
に終わってしまい、初期化期間が終了した後においても画素間において表示される階調に
差が生じてしまう可能性もある。そのため、共通電圧Ｖｃｏｍに対してマイナスの電圧−
Ｖｐを、複数回、画素電極７１０に印加することで黒を表示し、共通電圧Ｖｃｏｍに対し
てプラスの電圧Ｖｐを、複数回、画素電極７１０に印加することで白を表示することが望
ましい。
【０２５２】
なお、初期化期間前に各画素の表示素子によって表示されていた階調が異なると、初期化
用ビデオ信号を入力する必要最低限の回数も異なってくる。よって、初期化期間前に表示
されていた階調に合わせて、画素間で、初期化用ビデオ信号を入力する回数を変えるよう
にしても良い。この場合、初期化用ビデオ信号を入力する必要がなくなった画素には、共
通電圧Ｖｃｏｍを入力しておくと良い。
【０２５３】
なお、画素電極７１０に初期化用ビデオ信号の電圧Ｖｐまたは電圧−Ｖｐを複数回印加す
るためには、選択信号のパルスが各走査線に与えられている期間において、当該走査線を
有するラインの画素に、初期化用ビデオ信号を入力するという一連の動作を、複数回行う
。初期化用ビデオ信号の電圧Ｖｐまたは電圧−Ｖｐを画素電極７１０に複数回印加するこ
とで、マイクロカプセル７１２内における白色顔料と黒色顔料の移動を収束させて画素間
に階調の差が生じるのを防ぎ、画素部の画素を初期化することができる。
【０２５４】
なお、初期化期間では、各画素において黒を表示した後に白を表示するのではなく、白を
表示した後に黒を表示するようにしても良い。或いは、初期化期間では、各画素において
白を表示した後に黒を表示し、更にその後、白を表示しするようにしても良い。
【０２５５】
また、初期化期間の開始されるタイミングは、画素部内の全ての画素において同じである
必要はない。例えば、画素ごと、或いは同じラインに属する画素ごと、といったように、
初期化期間の開始されるタイミングを異ならせるようにしても良い。
【０２５６】
次に、書込期間では、画素に画像情報を有するビデオ信号を入力する。
【０２５７】
画素部全体で画像の表示を行う場合は、１フレーム期間において、全ての走査線に順に電
圧のパルスがシフトしている選択信号が入力される。そして、選択信号にパルスが出現し
ている１ライン期間内において、全ての信号線に画像情報を有するビデオ信号が入力され
る。
【０２５８】
画素電極７１０に印加されるビデオ信号の電圧に従って、マイクロカプセル７１２内の白
色顔料と黒色顔料が画素電極７１０側または対向電極７１１側に移動することで、表示素
子７０５は階調を表示する。
【０２５９】
なお、書込期間でも、初期化期間と同様に、画素電極７１０にビデオ信号の電圧を複数回
印加することが望ましい。よって、選択信号のパルスが各走査線に与えられている期間に
おいて、当該走査線を有するラインの画素にビデオ信号を入力するという一連の動作を、
複数回行う。
【０２６０】
次に、保持期間では、全ての画素に信号線を介して共通電圧Ｖｃｏｍを入力した後、走査
線への選択信号の入力または信号線へのビデオ信号の入力は行わない。よって、表示素子
７０５が有するマイクロカプセル７１２内の白色顔料と黒色顔料は、画素電極７１０と対
向電極７１１の間にプラスまたはマイナスの電圧が印加されない限りその配置は保持され
るので、表示素子７０５の表示する階調は保たれる。よって、書込期間において書き込ま
れた画像は、保持期間においても表示が維持される。
【０２６１】
なお、電子ペーパーに用いられる表示素子は、階調を変化させるのに必要な電圧が、液晶
表示装置に用いられる液晶素子や、発光装置に用いられる有機発光素子などの発光素子に
比べて高い傾向にある。そのため、スイッチング素子として用いられる画素のトランジス
タ７０４は、書込期間において、そのソース電極とドレイン電極間の電位差が大きくなる
ため、オフ電流が高くなり、そのために画素電極７１０の電位が変動して表示に乱れが生
じやすい。しかし、本発明の一態様では、不純物濃度が極めて低い酸化物半導体膜を、ト
ランジスタ７０４の活性層に用いている。よって、トランジスタ７０４は、ゲート電極と
ソース電極間の電圧がほぼ０の状態におけるオフ電流、すなわちリーク電流が著しく低い
。そのため、書込期間において、トランジスタ７０４のソース電極とドレイン電極間の電
位差が大きくなっても、オフ電流を抑え、画素電極７１０の電位の変動に起因する表示の
乱れが発生するのを防ぐことができる。また、スイッチング素子として用いられる画素の
トランジスタ７０４は、書込期間において、そのソース電極とドレイン電極間の電位差が
大きくなるため、劣化しやすい。しかし、本発明の一態様では、トランジスタ７０４の経
時劣化による閾値電圧のばらつきを小さく抑えることができるので、電子ペーパーの信頼
性を高めることができる。
【０２６２】
本実施の形態は、上記実施の形態と組み合わせて実施することが可能である。
【０２６３】
（実施の形態５）
アクティブマトリクス型の半導体表示装置のブロック図の一例を図１２（Ａ）に示す。表
示装置の基板５３００上には、画素部５３０１、第１の走査線駆動回路５３０２、第２の
走査線駆動回路５３０３、信号線駆動回路５３０４を有する。画素部５３０１には、複数
の信号線が信号線駆動回路５３０４から延伸して配置され、複数の走査線が第１の走査線
駆動回路５３０２、及び第２の走査線駆動回路５３０３から延伸して配置されている。な
お走査線と信号線との交差領域には、各々、表示素子を有する画素がマトリクス状に配置
されている。また、表示装置の基板５３００はＦＰＣ（Ｆｌｅｘｉｂｌｅ Ｐｒｉｎｔｅ
ｄ Ｃｉｒｃｕｉｔ）等の接続部を介して、タイミング制御回路５３０５（コントローラ
、制御ＩＣともいう）に接続されている。
【０２６４】
図１２（Ａ）では、第１の走査線駆動回路５３０２、第２の走査線駆動回路５３０３、信
号線駆動回路５３０４は、画素部５３０１と共に一つの基板５３００上に形成される。そ
のため、外部に設ける駆動回路等の部品の数が減るので、表示装置の小型化のみならず、
組立工程や検査工程の削減によるコストダウンを図ることができる。また、基板５３００
外部に駆動回路を設けた場合、配線を延伸させる必要が生じ、配線間の接続数が増える。
同じ基板５３００上に駆動回路を設けた場合、その配線間の接続数を減らすことができる
。よって、駆動回路と画素部の接続不良に起因する歩留まり低下を防ぎ、接続箇所におけ
る機械的強度の低さにより信頼性が低下するのを防ぐことができる。
【０２６５】
なお、タイミング制御回路５３０５は、第１の走査線駆動回路５３０２に対し、一例とし
て、第１の走査線駆動回路用スタート信号（ＧＳＰ１）、走査線駆動回路用クロック信号
（ＧＣＫ１）を供給する。また、タイミング制御回路５３０５は、第２の走査線駆動回路
５３０３に対し、一例として、第２の走査線駆動回路用スタート信号（ＧＳＰ２）（スタ
ートパルスともいう）、走査線駆動回路用クロック信号（ＧＣＫ２）を供給する。信号線
駆動回路５３０４に、信号線駆動回路用スタート信号（ＳＳＰ）、信号線駆動回路用クロ
ック信号（ＳＣＫ）、ビデオ信号用データ（ＤＡＴＡ）（単にビデオ信号ともいう）、ラ
ッチ信号（ＬＡＴ）を供給するものとする。なお、第１の走査線駆動回路５３０２と第２
の走査線駆動回路５３０３との一方を省略することが可能である。
【０２６６】
図１２（Ｂ）では、駆動周波数が低い回路（例えば、第１の走査線駆動回路５３０２、第
２の走査線駆動回路５３０３）を、画素部５３０１と共に一つの基板５３００上に形成し
、信号線駆動回路５３０４を画素部５３０１とは別の基板上に形成する構成について示し
ている。また、信号線駆動回路５３０４のうち、サンプリング回路に用いられているアナ
ログスイッチなどの駆動周波数の低い回路を、部分的に、画素部５３０１と共に一つの基
板５３００上に形成することも可能である。このように、部分的にシステムオンパネルを
採用することで、上述した接続不良に起因する歩留まり低下、接続箇所における機械的強
度の低さなどを回避する、組立工程や検査工程の削減によるコストダウン、といったシス
テムオンパネルのメリットをある程度享受できる。さらに、画素部５３０１、走査線駆動
回路５３０２、走査線駆動回路５３０３及び信号線駆動回路５３０４を全て一基板上に形
成するシステムオンパネルに比べて、駆動周波数が高い回路の性能をより高めることがで
き、なおかつ、単結晶半導体を用いた場合は実現することが難しい、面積の広い画素部を
形成することができる。
【０２６７】
次に、ｎチャネル型トランジスタを用いた信号線駆動回路の構成について説明する。
【０２６８】
図１３（Ａ）に示す信号線駆動回路は、シフトレジスタ５６０１、及びサンプリング回路
５６０２を有する。サンプリング回路５６０２は、複数のスイッチング回路５６０２＿１
〜５６０２＿Ｎ（Ｎは自然数）を有する。スイッチング回路５６０２＿１〜５６０２＿Ｎ
は、各々、複数のｎチャネル型トランジスタ５６０３＿１〜５６０３＿ｋ（ｋは自然数）
を有する。
【０２６９】
信号線駆動回路の接続関係について、スイッチング回路５６０２＿１を例に挙げて説明す
る。なお、トランジスタが有するソース電極とドレイン電極のうち、いずれか一方を第１
端子、他方を第２端子として、以下、記述する。
【０２７０】
トランジスタ５６０３＿１〜５６０３＿ｋの第１端子は、各々、配線５６０４＿１〜５６
０４＿ｋと接続されている。配線５６０４＿１〜５６０４＿ｋには、各々、ビデオ信号が
入力される。トランジスタ５６０３＿１〜５６０３＿ｋの第２端子は、各々、信号線Ｓ１
〜Ｓｋと接続されている。トランジスタ５６０３＿１〜５６０３＿ｋのゲート電極は、シ
フトレジスタ５６０１と接続される。
【０２７１】
シフトレジスタ５６０１は、配線５６０５＿１〜５６０５＿Ｎの順番に高いレベルの電圧
（Ｈレベル）を有するタイミング信号を出力し、スイッチング回路５６０２＿１〜５６０
２＿Ｎを順番に選択する機能を有する。
【０２７２】
スイッチング回路５６０２＿１は、トランジスタ５６０３＿１〜５６０３＿ｋのスイッチ
ングにより、配線５６０４＿１〜５６０４＿ｋと信号線Ｓ１〜Ｓｋとの導通状態（第１端
子と第２端子との間の導通）を制御する機能、即ち配線５６０４＿１〜５６０４＿ｋの電
位を信号線Ｓ１〜Ｓｋに供給するか否かを制御する機能を有する。
【０２７３】
次に、図１３（Ａ）の信号線駆動回路の動作について、図１３（Ｂ）のタイミングチャー
トを参照して説明する。図１３（Ｂ）には、シフトレジスタ５６０１から配線５６０５＿
１〜５６０５＿Ｎにそれぞれ入力されるタイミング信号Ｓｏｕｔ＿１〜Ｓｏｕｔ＿Ｎと、
配線５６０４＿１〜５６０４＿ｋにそれぞれ入力されるビデオ信号Ｖｄａｔａ＿１〜Ｖｄ
ａｔａ＿ｋのタイミングチャートを一例として示す。
【０２７４】
なお、信号線駆動回路の１動作期間は、表示装置における１ライン期間に相当する。図１
３（Ｂ）では、１ライン期間を期間Ｔ１〜期間ＴＮに分割する場合を例示している。期間
Ｔ１〜ＴＮは、各々、選択された行に属する一画素に、ビデオ信号を書き込むための期間
である。
【０２７５】
期間Ｔ１〜期間ＴＮにおいて、シフトレジスタ５６０１は、Ｈレベルのタイミング信号を
配線５６０５＿１〜５６０５＿Ｎに順番に出力する。例えば、期間Ｔ１において、シフト
レジスタ５６０１は、Ｈレベルの信号を配線５６０５＿１に出力する。すると、スイッチ
ング回路５６０２＿１が有するトランジスタ５６０３＿１〜５６０３＿ｋはオンになるの
で、配線５６０４＿１〜５６０４＿ｋと、信号線Ｓ１〜Ｓｋとが導通状態になる。このと
き、配線５６０４＿１〜５６０４＿ｋには、Ｄａｔａ（Ｓ１）〜Ｄａｔａ（Ｓｋ）が入力
される。Ｄａｔａ（Ｓ１）〜Ｄａｔａ（Ｓｋ）は、各々、トランジスタ５６０３＿１〜５
６０３＿ｋを介して、選択される行に属する画素のうち、１列目〜ｋ列目の画素に書き込
まれる。こうして、期間Ｔ１〜ＴＮにおいて、選択された行に属する画素に、ｋ列ずつ順
番にビデオ信号が書き込まれる。
【０２７６】
以上のように、ビデオ信号が複数の列ずつ画素に書き込まれることによって、ビデオ信号
の数、又は配線の数を減らすことができる。よって、コントローラなどの外部回路との接
続数を減らすことができる。また、ビデオ信号が複数の列ずつ画素に書き込まれることに
よって、書き込み時間を長くすることができ、ビデオ信号の書き込み不足を防止すること
ができる。
【０２７７】
次に、信号線駆動回路または走査線駆動回路に用いるシフトレジスタの一形態について図
１４及び図１５を用いて説明する。
【０２７８】
シフトレジスタは、第１のパルス出力回路１０＿１乃至第Ｎのパルス出力回路１０＿Ｎ（
Ｎは３以上の自然数）を有している（図１４（Ａ）参照）。第１のパルス出力回路１０＿
１乃至第Ｎのパルス出力回路１０＿Ｎには、第１の配線１１より第１のクロック信号ＣＫ
１、第２の配線１２より第２のクロック信号ＣＫ２、第３の配線１３より第３のクロック
信号ＣＫ３、第４の配線１４より第４のクロック信号ＣＫ４が供給される。また第１のパ
ルス出力回路１０＿１では、第５の配線１５からのスタートパルスＳＰ１（第１のスター
トパルス）が入力される。また２段目以降の第ｎのパルス出力回路１０＿ｎ（ｎは、２以
上Ｎ以下の自然数）では、一段前段のパルス出力回路１０＿ｎ−１からの信号（前段信号
ＯＵＴ（ｎ−１）という）が入力される。また第１のパルス出力回路１０＿１では、２段
後段の第３のパルス出力回路１０＿３からの信号が入力される。同様に、２段目以降の第
ｎのパルス出力回路１０＿ｎでは、２段後段の第（ｎ＋２）のパルス出力回路１０＿（ｎ
＋２）からの信号（後段信号ＯＵＴ（ｎ＋２）という）が入力される。従って、各段のパ
ルス出力回路からは、後段及び／または二つ前段のパルス出力回路に入力するための第１
の出力信号（ＯＵＴ（１）（ＳＲ）〜ＯＵＴ（Ｎ）（ＳＲ））、及び別の回路等に入力さ
れる第２の出力信号（ＯＵＴ（１）〜ＯＵＴ（Ｎ））が出力される。なお、図１４（Ａ）
に示すように、シフトレジスタの最終段の２つの段には、後段信号ＯＵＴ（ｎ＋２）が入
力されないため、一例としては、別途第２のスタートパルスＳＰ２、第３のスタートパル
スＳＰ３をそれぞれ入力する構成とすればよい。
【０２７９】
なお、クロック信号（ＣＫ）は、一定の間隔でＨレベルとＬレベル（低いレベルの電圧）
を繰り返す信号である。ここで、第１のクロック信号（ＣＫ１）〜第４のクロック信号（
ＣＫ４）は、順に１／４周期分遅延している。本実施の形態では、第１のクロック信号（
ＣＫ１）〜第４のクロック信号（ＣＫ４）を利用して、パルス出力回路の駆動の制御等を
行う。
【０２８０】
第１の入力端子２１、第２の入力端子２２及び第３の入力端子２３は、第１の配線１１〜
第４の配線１４のいずれかと電気的に接続されている。例えば、図１４（Ａ）において、
第１のパルス出力回路１０＿１は、第１の入力端子２１が第１の配線１１と電気的に接続
され、第２の入力端子２２が第２の配線１２と電気的に接続され、第３の入力端子２３が
第３の配線１３と電気的に接続されている。また、第２のパルス出力回路１０＿２は、第
１の入力端子２１が第２の配線１２と電気的に接続され、第２の入力端子２２が第３の配
線１３と電気的に接続され、第３の入力端子２３が第４の配線１４と電気的に接続されて
いる。
【０２８１】
第１のパルス出力回路１０＿１〜第Ｎのパルス出力回路１０＿Ｎの各々は、第１の入力端
子２１、第２の入力端子２２、第３の入力端子２３、第４の入力端子２４、第５の入力端
子２５、第１の出力端子２６、第２の出力端子２７を有しているとする（図１４（Ｂ）参
照）。第１のパルス出力回路１０＿１において、第１の入力端子２１に第１のクロック信
号ＣＫ１が入力され、第２の入力端子２２に第２のクロック信号ＣＫ２が入力され、第３
の入力端子２３に第３のクロック信号ＣＫ３が入力され、第４の入力端子２４にスタート
パルスが入力され、第５の入力端子２５に後段信号ＯＵＴ（３）が入力され、第１の出力
端子２６より第１の出力信号ＯＵＴ（１）（ＳＲ）が出力され、第２の出力端子２７より
第２の出力信号ＯＵＴ（１）が出力されていることとなる。
【０２８２】
次に、パルス出力回路の具体的な回路構成の一例を、図１５（Ａ）に示す。
【０２８３】
各パルス出力回路は、第１のトランジスタ３１〜第１３のトランジスタ４３を有している
（図１５（Ａ）参照）。また、上述した第１の入力端子２１〜第５の入力端子２５、及び
第１の出力端子２６、第２の出力端子２７に加え、第１の高電源電位ＶＤＤが供給される
電源線５１、第２の高電源電位ＶＣＣが供給される電源線５２、低電源電位ＶＳＳが供給
される電源線５３から、第１のトランジスタ３１〜第１３のトランジスタ４３に信号、ま
たは電源電位が供給される。ここで図１５（Ａ）の各電源線の電源電位の高さの関係は、
第１の電源電位ＶＤＤは第２の電源電位ＶＣＣ以上の電位とし、第２の電源電位ＶＣＣは
第３の電源電位ＶＳＳより大きい電位とする。なお、第１のクロック信号（ＣＫ１）〜第
４のクロック信号（ＣＫ４）は、一定の間隔でＨレベルとＬレベルを繰り返す信号である
が、ＨレベルのときＶＤＤ、ＬレベルのときＶＳＳであるとする。なお電源線５１の電位
ＶＤＤを、電源線５２の電位ＶＣＣより高くすることにより、動作に影響を与えることな
く、トランジスタのゲート電極に印加される電位を低く抑えることができ、トランジスタ
のしきい値電圧のシフトを低減し、劣化を抑制することができる。
【０２８４】
図１５（Ａ）において第１のトランジスタ３１は、第１端子が電源線５１に電気的に接続
され、第２端子が第９のトランジスタ３９の第１端子に電気的に接続され、ゲート電極が
第４の入力端子２４に電気的に接続されている。第２のトランジスタ３２は、第１端子が
電源線５３に電気的に接続され、第２端子が第９のトランジスタ３９の第１端子に電気的
に接続され、ゲート電極が第４のトランジスタ３４のゲート電極に電気的に接続されてい
る。第３のトランジスタ３３は、第１端子が第１の入力端子２１に電気的に接続され、第
２端子が第１の出力端子２６に電気的に接続されている。第４のトランジスタ３４は、第
１端子が電源線５３に電気的に接続され、第２端子が第１の出力端子２６に電気的に接続
されている。第５のトランジスタ３５は、第１端子が電源線５３に電気的に接続され、第
２端子が第２のトランジスタ３２のゲート電極及び第４のトランジスタ３４のゲート電極
に電気的に接続され、ゲート電極が第４の入力端子２４に電気的に接続されている。第６
のトランジスタ３６は、第１端子が電源線５２に電気的に接続され、第２端子が第２のト
ランジスタ３２のゲート電極及び第４のトランジスタ３４のゲート電極に電気的に接続さ
れ、ゲート電極が第５の入力端子２５に電気的に接続されている。第７のトランジスタ３
７は、第１端子が電源線５２に電気的に接続され、第２端子が第８のトランジスタ３８の
第２端子に電気的に接続され、ゲート電極が第３の入力端子２３に電気的に接続されてい
る。第８のトランジスタ３８は、第１端子が第２のトランジスタ３２のゲート電極及び第
４のトランジスタ３４のゲート電極に電気的に接続され、ゲート電極が第２の入力端子２
２に電気的に接続されている。第９のトランジスタ３９は、第１端子が第１のトランジス
タ３１の第２端子及び第２のトランジスタ３２の第２端子に電気的に接続され、第２端子
が第３のトランジスタ３３のゲート電極及び第１０のトランジスタ４０のゲート電極に電
気的に接続され、ゲート電極が電源線５２に電気的に接続されている。第１０のトランジ
スタ４０は、第１端子が第１の入力端子２１に電気的に接続され、第２端子が第２の出力
端子２７に電気的に接続され、ゲート電極が第９のトランジスタ３９の第２端子に電気的
に接続されている。第１１のトランジスタ４１は、第１端子が電源線５３に電気的に接続
され、第２端子が第２の出力端子２７に電気的に接続され、ゲート電極が第２のトランジ
スタ３２のゲート電極及び第４のトランジスタ３４のゲート電極に電気的に接続されてい
る。第１２のトランジスタ４２は、第１端子が電源線５３に電気的に接続され、第２端子
が第２の出力端子２７に電気的に接続され、ゲート電極が第７のトランジスタ３７のゲー
ト電極に電気的に接続されている。第１３のトランジスタ４３は、第１端子が電源線５３
に電気的に接続され、第２端子が第１の出力端子２６に電気的に接続され、ゲート電極が
第７のトランジスタ３７のゲート電極に電気的に接続されている。
【０２８５】
図１５（Ａ）において、第３のトランジスタ３３のゲート電極、第１０のトランジスタ４
０のゲート電極、及び第９のトランジスタ３９の第２端子の接続箇所をノードＡとする。
また、第２のトランジスタ３２のゲート電極、第４のトランジスタ３４のゲート電極、第
５のトランジスタ３５の第２端子、第６のトランジスタ３６の第２端子、第８のトランジ
スタ３８の第１端子、及び第１１のトランジスタ４１のゲート電極の接続箇所をノードＢ
とする（図１５（Ａ）参照）。
【０２８６】
図１５（Ａ）に示したパルス出力回路を複数具備するシフトレジスタのタイミングチャー
トについて、図１５（Ｂ）に示す。
【０２８７】
なお、図１５（Ａ）に示すように、ゲート電極に第２の電源電位ＶＣＣが印加される第９
のトランジスタ３９を設けておくことにより、ブートストラップ動作の前後において、以
下のような利点がある。
【０２８８】
ゲート電極に第２の電位ＶＣＣが印加される第９のトランジスタ３９がない場合、ブート
ストラップ動作によりノードＡの電位が上昇すると、第１のトランジスタ３１の第２端子
であるソース電極の電位が上昇していき、第１の電源電位ＶＤＤより高くなる。そして、
第１のトランジスタ３１のソース電極が第１端子側、即ち電源線５１側に切り替わる。そ
のため、第１のトランジスタ３１においては、ゲート電極とソース電極の間、ゲート電極
とドレイン電極の間ともに、大きなバイアス電圧が印加されるために大きなストレスがか
かり、トランジスタの劣化の要因となりうる。そこで、ゲート電極に第２の電源電位ＶＣ
Ｃが印加される第９のトランジスタ３９を設けておくことにより、ブートストラップ動作
によりノードＡの電位は上昇するものの、第１のトランジスタ３１の第２端子の電位の上
昇を生じないようにすることができる。つまり、第９のトランジスタ３９を設けることに
より、第１のトランジスタ３１のゲート電極とソース電極の間に印加される負のバイアス
電圧の値を小さくすることができる。よって、本実施の形態の回路構成とすることにより
、第１のトランジスタ３１のゲート電極とソース電極の間に印加される負のバイアス電圧
も小さくできるため、ストレスによる第１のトランジスタ３１の劣化を抑制することがで
きる。
【０２８９】
なお、第９のトランジスタ３９を設ける箇所については、第１のトランジスタ３１の第２
端子と第３のトランジスタ３３のゲート電極との間に第１端子と第２端子を介して接続さ
れるように設ける構成であればよい。なお、本実施形態でのパルス出力回路を複数具備す
るシフトレジスタの場合、走査線駆動回路より段数の多い信号線駆動回路では、第９のト
ランジスタ３９を省略してもよく、トランジスタ数を削減できるという利点がある。
【０２９０】
なお第１のトランジスタ３１乃至第１３のトランジスタ４３の活性層として、酸化物半導
体を用いることにより、トランジスタのオフ電流を低減すると共に、オン電流及び電界効
果移動度を高めることができ、さらに劣化の度合いを低減することが出来るため、回路内
の誤動作を低減することができる。また酸化物半導体を用いたトランジスタは、アモルフ
ァスシリコンを用いたトランジスタに比べ、ゲート電極に高電位が印加されることによる
トランジスタの劣化の程度が小さい。そのため、第２の電源電位ＶＣＣを供給する電源線
に、第１の電源電位ＶＤＤを供給しても同様の動作が得られ、且つ回路間を引き回す電源
線の数を低減することができるため、回路の小型化を図ることが出来る。
【０２９１】
なお、第７のトランジスタ３７のゲート電極に第３の入力端子２３によって供給されるク
ロック信号、第８のトランジスタ３８のゲート電極に第２の入力端子２２によって供給さ
れるクロック信号は、第７のトランジスタのゲート電極に第２の入力端子２２によって供
給されるクロック信号、第８のゲート電極に第３の入力端子２３によって供給されるクロ
ック信号となるように、結線関係を入れ替えても同様の作用を奏する。このとき、図１５
（Ａ）に示すシフトレジスタにおいて、第７のトランジスタ３７及び第８のトランジスタ
３８が共にオンの状態から、第７のトランジスタ３７がオフ、第８のトランジスタ３８が
オンの状態、次いで第７のトランジスタ３７がオフ、第８のトランジスタ３８がオフの状
態とすることによって、第２の入力端子２２及び第３の入力端子２３の電位が低下するこ
とで生じる、ノードＢの電位の低下が第７のトランジスタ３７のゲート電極の電位の低下
、及び第８のトランジスタ３８のゲート電極の電位の低下に起因して２回生じることとな
る。一方、図１５（Ａ）において、第７のトランジスタ３７及び第８のトランジスタ３８
が共にオンの状態から、第７のトランジスタ３７がオン、第８のトランジスタ３８がオフ
の状態、次いで、第７のトランジスタ３７がオフ、第８のトランジスタ３８がオフの状態
とすることによって、第２の入力端子２２及び第３の入力端子２３の電位が低下すること
で生じるノードＢの電位の低下を、第８のトランジスタ３８のゲート電極の電位の低下に
よる一回に低減することができる。そのため、第７のトランジスタ３７のゲート電極に第
３の入力端子２３からクロック信号ＣＫ３が供給され、第８のトランジスタ３８のゲート
電極に第２の入力端子２２からクロック信号ＣＫ２が供給される結線関係とすることが好
適である。なぜなら、ノードＢの電位の変動回数が低減され、またノイズを低減すること
が出来るからである。
【０２９２】
このように、第１の出力端子２６及び第２の出力端子２７の電位をＬレベルに保持する期
間に、ノードＢに定期的にＨレベルの信号が供給される構成とすることにより、パルス出
力回路の誤動作を抑制することができる。
【０２９３】
本実施の形態は、上記実施の形態と組み合わせて実施することが可能である。
【０２９４】
（実施の形態６）
本発明の一態様に係る液晶表示装置は、オフ電流が低く、なおかつ信頼性の高いトランジ
スタを用いているため、視認性が高く、信頼性も高い。本実施の形態では、本発明の一態
様に係る液晶表示装置の構成について説明する。
【０２９５】
図１６に、本発明の一態様に係る液晶表示装置の、画素の断面図を一例として示す。図１
６に示すトランジスタ１４０１は、絶縁表面上に形成されたゲート電極１４０２と、ゲー
ト電極１４０２上のゲート絶縁膜１４０３と、ゲート絶縁膜１４０３上においてゲート電
極１４０２と重なっている酸化物半導体膜１４０４と、酸化物半導体膜１４０４上に順に
積層するように形成され、ソース電極またはドレイン電極として機能する導電膜１４０６
ａ及び導電膜１４０６ｂとを有する。さらに、トランジスタ１４０１は、酸化物半導体膜
１４０４上に形成された絶縁膜１４０７を、その構成要素に含めても良い。絶縁膜１４０
７は、ゲート電極１４０２と、ゲート絶縁膜１４０３と、酸化物半導体膜１４０４と、導
電膜１４０６ａ及び導電膜１４０６ｂとを覆うように形成されている。
【０２９６】
絶縁膜１４０７上には絶縁膜１４０８が形成されている。絶縁膜１４０７、絶縁膜１４０
８の一部には開口部が設けられており、該開口部において導電膜１４０６ｂと接するよう
に、画素電極１４１０が形成されている。
【０２９７】
また、絶縁膜１４０８上には、液晶素子のセルギャップを制御するためのスペーサ１４１
７が形成されている。スペーサ１４１７は絶縁膜を所望の形状にエッチングすることで形
成することが可能であるが、フィラーを絶縁膜１４０８上に分散させることでセルギャッ
プを制御するようにしても良い。
【０２９８】
そして、画素電極１４１０上には、配向膜１４１１が形成されている。また画素電極１４
１０と対峙する位置には、対向電極１４１３が設けられており、対向電極１４１３の画素
電極１４１０に近い側には配向膜１４１４が形成されている。配向膜１４１１、配向膜１
４１４は、ポリイミド、ポリビニルアルコールなどの有機樹脂を用いて形成することがで
き、その表面には、ラビングなどの、液晶分子を一定方向に配列させるための配向処理が
施されている。ラビングは、配向膜に圧力をかけながら、ナイロンなどの布を巻いたロー
ラーを回転させて、上記配向膜の表面を一定方向に擦ることで、行うことが出来る。なお
、酸化珪素などの無機材料を用い、配向処理を施すことなく、蒸着法で配向特性を有する
配向膜１４１１、配向膜１４１４を直接形成することも可能である。
【０２９９】
そして、画素電極１４１０と、対向電極１４１３の間においてシール材１４１６に囲まれ
た領域には、液晶１４１５が設けられている。液晶１４１５の注入は、ディスペンサ式（
滴下式）を用いても良いし、ディップ式（汲み上げ式）を用いていても良い。なお、シー
ル材１４１６にはフィラーが混入されていても良い。
【０３００】
また、画素電極１４１０と、対向電極１４１３と、液晶１４１５とで形成される液晶素子
は、特定の波長領域の光を通すことができるカラーフィルタと重なっていても良い。カラ
ーフィルタは、対向電極１４１３が形成されている基板（対向基板）１４２０上に形成す
れば良い。カラーフィルタは、顔料を分散させたアクリル系樹脂などの有機樹脂を基板１
４２０上に塗布した後、フォトリソグラフィを用いて選択的に形成することができる。ま
た、顔料を分散させたポリイミド系樹脂を基板１４２０上に塗布した後、エッチングを用
いて選択的に形成することもできる。或いは、インクジェットなどの液滴吐出法を用いる
ことで、選択的にカラーフィルタを形成することもできる。
【０３０１】
また、画素間における液晶１４１５の配向の乱れに起因するディスクリネーションが視認
されるのを防ぐために、画素間に、光を遮蔽することが出来る遮蔽膜を形成しても良い。
遮蔽膜には、カーボンブラック、低次酸化チタンなどの黒色顔料を含む有機樹脂を用いる
ことができる。または、クロムを用いた膜で、遮蔽膜を形成することも可能である。
【０３０２】
画素電極１４１０と対向電極１４１３は、例えば酸化珪素を含む酸化インジウムスズ（Ｉ
ＴＳＯ）、酸化インジウムスズ（ＩＴＯ）、酸化亜鉛（ＺｎＯ）、酸化インジウム亜鉛（
ＩＺＯ）、ガリウムを添加した酸化亜鉛（ＧＺＯ）などの透明導電材料を用いることがで
きる。なお、本実施の形態では、画素電極１４１０及び対向電極１４１３に光を透過する
導電膜を用い、透過型の液晶素子を作製する例を示すが、本発明はこの構成に限定されな
い。本発明の一態様に係る液晶表示装置は、半透過型または反射型であっても良い。
【０３０３】
なお、本実施の形態では、液晶表示装置として、ＴＮ（Ｔｗｉｓｔｅｄ Ｎｅｍａｔｉｃ
）型を示したが、ＶＡ（Ｖｅｒｔｉｃａｌ Ａｌｉｇｎｍｅｎｔ）型、ＯＣＢ（Ｏｐｔｉ
ｃａｌｌｙ Ｃｏｍｐｅｎｓａｔｅｄ Ｂｉｒｅｆｒｉｎｇｅｎｃｅ）型、ＩＰＳ（Ｉｎ
−Ｐｌａｎｅ Ｓｗｉｔｃｈｉｎｇ）型等の、その他の液晶表示装置にも、本発明のトラ
ンジスタを用いることができる。
【０３０４】
また、配向膜を用いないブルー相を示す液晶を用いてもよい。ブルー相は液晶相の一つで
あり、コレステリック液晶を昇温していくと、コレステリック相から等方相へ転移する直
前に発現する相である。ブルー相は狭い温度範囲でしか発現しないため、温度範囲を改善
するために５重量％以上のカイラル剤を混合させた液晶組成物を用いて液晶１４１５に用
いる。ブルー相を示す液晶とカイラル剤とを含む液晶組成物は、応答速度が１０μｓｅｃ
．以上１００μｓｅｃ．以下と短く、光学的等方性であるため配向処理が不要であり、視
野角依存性が小さい。
【０３０５】
図１７は、本発明の液晶表示装置の構造を示す斜視図の一例である。図１７に示す液晶表
示装置は、一対の基板間に液晶素子が形成された液晶パネル１６０１と、第１の拡散板１
６０２と、プリズムシート１６０３と、第２の拡散板１６０４と、導光板１６０５と、反
射板１６０６と、光源１６０７と、回路基板１６０８とを有している。
【０３０６】
液晶パネル１６０１と、第１の拡散板１６０２と、プリズムシート１６０３と、第２の拡
散板１６０４と、導光板１６０５と、反射板１６０６とは、順に積層されている。光源１
６０７は導光板１６０５の端部に設けられており、導光板１６０５内部に拡散された光源
１６０７からの光は、第１の拡散板１６０２、プリズムシート１６０３及び第２の拡散板
１６０４によって、均一に液晶パネル１６０１に照射される。
【０３０７】
なお、本実施の形態では、第１の拡散板１６０２と第２の拡散板１６０４とを用いている
が、拡散板の数はこれに限定されず、単数であっても３以上であっても良い。そして、拡
散板は導光板１６０５と液晶パネル１６０１の間に設けられていれば良い。よって、プリ
ズムシート１６０３よりも液晶パネル１６０１に近い側にのみ拡散板が設けられていても
良いし、プリズムシート１６０３よりも導光板１６０５に近い側にのみ拡散板が設けられ
ていても良い。
【０３０８】
またプリズムシート１６０３は、図１７に示した断面が鋸歯状の形状に限定されず、導光
板１６０５からの光を液晶パネル１６０１側に集光できる形状を有していれば良い。
【０３０９】
回路基板１６０８には、液晶パネル１６０１に入力される各種信号を生成する回路、また
はこれら信号に処理を施す回路などが設けられている。そして図１７では、回路基板１６
０８と液晶パネル１６０１とが、ＦＰＣ（Ｆｌｅｘｉｂｌｅ Ｐｒｉｎｔｅｄ Ｃｉｒｃ
ｕｉｔ）１６０９を介して接続されている。なお、上記回路は、ＣＯＧ（Ｃｈｉｐ ＯＮ
Ｇｌａｓｓ）法を用いて液晶パネル１６０１に接続されていても良いし、上記回路の一
部がＦＰＣ１６０９にＣＯＦ（Ｃｈｉｐ ＯＮ Ｆｉｌｍ）法を用いて接続されていても
良い。
【０３１０】
図１７では、光源１６０７の駆動を制御する制御系の回路が回路基板１６０８に設けられ
ており、該制御系の回路と光源１６０７とがＦＰＣ１６１０を介して接続されている例を
示している。ただし、上記制御系の回路は液晶パネル１６０１に形成されていても良く、
この場合は液晶パネル１６０１と光源１６０７とがＦＰＣなどにより接続されるようにす
る。
【０３１１】
なお、図１７は、液晶パネル１６０１の端に光源１６０７を配置するエッジライト型の光
源を例示しているが、本発明の液晶表示装置は光源１６０７が液晶パネル１６０１の直下
に配置される直下型であっても良い。
【０３１２】
本実施の形態は、上記実施の形態と適宜組み合わせて実施することができる。
【０３１３】
（実施の形態７）
本実施の形態では、本発明の一態様に係るトランジスタを画素に用いた、発光装置の構成
について説明する。本実施の形態では、発光素子を駆動させるためのトランジスタがｎ型
の場合における、画素の断面構造について、図１８を用いて説明する。なお図１８では、
第１の電極が陰極、第２の電極が陽極の場合について説明するが、第１の電極が陽極、第
２の電極が陰極であっても良い。
【０３１４】
図１８（Ａ）に、トランジスタ６０３１がｎ型で、発光素子６０３３から発せられる光を
第１の電極６０３４側から取り出す場合の、画素の断面図を示す。トランジスタ６０３１
は絶縁膜６０３７で覆われており、絶縁膜６０３７上には開口部を有する隔壁６０３８が
形成されている。隔壁６０３８の開口部において第１の電極６０３４が一部露出しており
、該開口部において第１の電極６０３４、電界発光層６０３５、第２の電極６０３６が順
に積層されている。
【０３１５】
第１の電極６０３４は、光を透過する材料または膜厚で形成し、なおかつ仕事関数の小さ
い金属、合金、電気伝導性化合物、およびこれらの混合物などで形成することができる。
具体的には、ＬｉやＣｓ等のアルカリ金属、およびＭｇ、Ｃａ、Ｓｒ等のアルカリ土類金
属、これらを含む合金（Ｍｇ：Ａｇ、Ａｌ：Ｌｉ、Ｍｇ：Ｉｎなど）、およびこれらの化
合物（フッ化カルシウム、窒化カルシウム）の他、ＹｂやＥｒ等の希土類金属を用いるこ
とができる。また電子注入層を設ける場合、アルミニウムなどの他の導電膜を用いること
も可能である。そして第１の電極６０３４を、光が透過する程度の膜厚（好ましくは、５
ｎｍ〜３０ｎｍ程度）で形成する。さらに、光が透過する程度の膜厚を有する上記導電膜
の上または下に接するように、透光性酸化物導電材料を用いて透光性を有する導電膜を形
成し、第１の電極６０３４のシート抵抗を抑えるようにしても良い。なお、インジウム錫
酸化物（ＩＴＯ）、酸化亜鉛（ＺｎＯ）、酸化インジウム亜鉛（ＩＺＯ）、ガリウムを添
加した酸化亜鉛（ＧＺＯ）などその他の透光性酸化物導電材料を用いた導電膜だけを用い
ることも可能である。またＩＴＳＯや、酸化珪素を含んだ酸化インジウムに、さらに２〜
２０％の酸化亜鉛（ＺｎＯ）を混合したものを用いても良い。透光性酸化物導電材料を用
いる場合、電界発光層６０３５に電子注入層を設けるのが望ましい。
【０３１６】
また第２の電極６０３６は、光を反射もしくは遮蔽する材料及び膜厚で形成し、なおかつ
陽極として用いるのに適する材料で形成する。例えば、窒化チタン、窒化ジルコニウム、
チタン、タングステン、ニッケル、白金、クロム、銀、アルミニウム等の１つまたは複数
からなる単層膜の他、窒化チタンとアルミニウムを主成分とする膜との積層、窒化チタン
膜とアルミニウムを主成分とする膜と窒化チタン膜との三層構造等を第２の電極６０３６
に用いることができる。
【０３１７】
電界発光層６０３５は、単数または複数の層で構成されている。複数の層で構成されてい
る場合、これらの層は、キャリア輸送特性の観点から正孔注入層、正孔輸送層、発光層、
電子輸送層、電子注入層などに分類することができる。電界発光層６０３５が発光層の他
に、正孔注入層、正孔輸送層、電子輸送層、電子注入層のいずれかを有している場合、第
１の電極６０３４から、電子注入層、電子輸送層、発光層、正孔輸送層、正孔注入層の順
に積層する。なお各層の境目は必ずしも明確である必要はなく、互いの層を構成している
材料が一部混合し、界面が不明瞭になっている場合もある。各層には、有機系の材料、無
機系の材料を用いることが可能である。有機系の材料として、高分子系、中分子系、低分
子系のいずれの材料も用いることが可能である。なお中分子系の材料とは、構造単位の繰
返しの数（重合度）が２から２０程度の低重合体に相当する。正孔注入層と正孔輸送層と
の区別は必ずしも厳密なものではなく、これらは正孔輸送性（正孔移動度）が特に重要な
特性である意味において同じである。便宜上正孔注入層は陽極に接する側の層であり、正
孔注入層に接する層を正孔輸送層と呼んで区別する。電子輸送層、電子注入層についても
同様であり、陰極に接する層を電子注入層と呼び、電子注入層に接する層を電子輸送層と
呼んでいる。発光層は電子輸送層を兼ねる場合もあり、発光性電子輸送層とも呼ばれる。
【０３１８】
図１８（Ａ）に示した画素の場合、発光素子６０３３から発せられる光を、白抜きの矢印
で示すように第１の電極６０３４側から取り出すことができる。
【０３１９】
次に図１８（Ｂ）に、トランジスタ６０４１がｎ型で、発光素子６０４３から発せられる
光を第２の電極６０４６側から取り出す場合の、画素の断面図を示す。トランジスタ６０
４１は絶縁膜６０４７で覆われており、絶縁膜６０４７上には開口部を有する隔壁６０４
８が形成されている。隔壁６０４８の開口部において第１の電極６０４４が一部露出して
おり、該開口部において第１の電極６０４４、電界発光層６０４５、第２の電極６０４６
が順に積層されている。
【０３２０】
第１の電極６０４４は、光を反射もしくは遮蔽する材料及び膜厚で形成し、なおかつ仕事
関数の小さい金属、合金、電気伝導性化合物、およびこれらの混合物などで形成すること
ができる。具体的には、ＬｉやＣｓ等のアルカリ金属、およびＭｇ、Ｃａ、Ｓｒ等のアル
カリ土類金属、これらを含む合金（Ｍｇ：Ａｇ、Ａｌ：Ｌｉ、Ｍｇ：Ｉｎなど）、および
これらの化合物（フッ化カルシウム、窒化カルシウム）の他、ＹｂやＥｒ等の希土類金属
を用いることができる。また電子注入層を設ける場合、アルミニウムなどの他の導電膜を
用いることも可能である。
【０３２１】
また第２の電極６０４６は、光を透過する材料または膜厚で形成し、なおかつ陽極として
用いるのに適する材料で形成する。例えば、インジウム錫酸化物（ＩＴＯ）、酸化亜鉛（
ＺｎＯ）、酸化インジウム亜鉛（ＩＺＯ）、ガリウムを添加した酸化亜鉛（ＧＺＯ）など
その他の透光性酸化物導電材料を第２の電極６０４６に用いることが可能である。またＩ
ＴＳＯや、酸化珪素を含んだ酸化インジウムに、さらに２〜２０％の酸化亜鉛（ＺｎＯ）
を混合したものを第２の電極６０４６に用いても良い。また上記透光性酸化物導電材料の
他に、例えば窒化チタン、窒化ジルコニウム、チタン、タングステン、ニッケル、白金、
クロム、銀、アルミニウム等の１つまたは複数からなる単層膜の他、窒化チタンとアルミ
ニウムを主成分とする膜との積層、窒化チタン膜とアルミニウムを主成分とする膜と窒化
チタン膜との三層構造等を第２の電極６０４６に用いることもできる。ただし透光性酸化
物導電材料以外の材料を用いる場合、光が透過する程度の膜厚（好ましくは、５ｎｍ〜３
０ｎｍ程度）で第２の電極６０４６を形成する。
【０３２２】
電界発光層６０４５は、図１８（Ａ）の電界発光層６０３５と同様に形成することができ
る。
【０３２３】
図１８（Ｂ）に示した画素の場合、発光素子６０４３から発せられる光を、白抜きの矢印
で示すように第２の電極６０４６側から取り出すことができる。
【０３２４】
次に図１８（Ｃ）に、トランジスタ６０５１がｎ型で、発光素子６０５３から発せられる
光を第１の電極６０５４側及び第２の電極６０５６側から取り出す場合の、画素の断面図
を示す。トランジスタ６０５１は絶縁膜６０５７で覆われており、絶縁膜６０５７上には
開口部を有する隔壁６０５８が形成されている。隔壁６０５８の開口部において第１の電
極６０５４が一部露出しており、該開口部において第１の電極６０５４、電界発光層６０
５５、第２の電極６０５６が順に積層されている。
【０３２５】
第１の電極６０５４は、図１８（Ａ）の第１の電極６０３４と同様に形成することができ
る。また第２の電極６０５６は、図１８（Ｂ）の第２の電極６０４６と同様に形成するこ
とができる。電界発光層６０５５は、図１８（Ａ）の電界発光層６０３５と同様に形成す
ることができる。
【０３２６】
図１８（Ｃ）に示した画素の場合、発光素子６０５３から発せられる光を、白抜きの矢印
で示すように第１の電極６０５４側及び第２の電極６０５６側から取り出すことができる
。
【０３２７】
本実施の形態は、他の実施の形態と適宜組み合わせて実施することが出来る。
【実施例１】
【０３２８】
本発明の一態様に係る半導体装置を用いることで、信頼性が高い電子機器、消費電力の低
い電子機器を提供することが可能である。また、本発明の一態様に係る半導体表示装置を
用いることで、信頼性が高い電子機器、視認性が高い電子機器、消費電力の低い電子機器
を提供することが可能である。特に電力の供給を常時受けることが困難な携帯用の電子機
器の場合、本発明の一態様に係る消費電力の低い半導体装置または半導体表示装置をその
構成要素に追加することにより、連続使用時間が長くなるといったメリットが得られる。
また、オフ電流が低いトランジスタを用いることで、オフ電流の高さをカバーするための
冗長な回路設計が不要となるため、半導体装置に用いられている集積回路の集積度を高め
ることができ、半導体装置を高機能化させることが出来る。
【０３２９】
また、本発明の半導体装置では、作製工程における加熱処理の温度を抑えることができる
ので、ガラスよりも耐熱性の劣る、プラスチック等の可撓性を有する合成樹脂からなる基
板上においても、特性が優れており、信頼性が高いトランジスタを作製することが可能で
ある。従って、本発明の一態様に係る作製方法を用いることで、信頼性が高く、軽量かつ
フレキシブルな半導体装置を提供することが可能である。プラスチック基板として、ポリ
エチレンテレフタレート（ＰＥＴ）に代表されるポリエステル、ポリエーテルスルホン（
ＰＥＳ）、ポリエチレンナフタレート（ＰＥＮ）、ポリカーボネート（ＰＣ）、ポリエー
テルエーテルケトン（ＰＥＥＫ）、ポリスルホン（ＰＳＦ）、ポリエーテルイミド（ＰＥ
Ｉ）、ポリアリレート（ＰＡＲ）、ポリブチレンテレフタレート（ＰＢＴ）、ポリイミド
、アクリロニトリルブタジエンスチレン樹脂、ポリ塩化ビニル、ポリプロピレン、ポリ酢
酸ビニル、アクリル樹脂などが挙げられる。
【０３３０】
本発明の一態様に係る半導体装置は、表示装置、ノート型パーソナルコンピュータ、記録
媒体を備えた画像再生装置（代表的にはＤＶＤ：Ｄｉｇｉｔａｌ Ｖｅｒｓａｔｉｌｅ
Ｄｉｓｃ等の記録媒体を再生し、その画像を表示しうるディスプレイを有する装置）に用
いることができる。その他に、本発明の一態様に係る半導体装置を用いることができる電
子機器として、携帯電話、携帯型ゲーム機、携帯情報端末、電子書籍、ビデオカメラ、デ
ジタルスチルカメラ、ゴーグル型ディスプレイ（ヘッドマウントディスプレイ）、ナビゲ
ーションシステム、音響再生装置（カーオーディオ、デジタルオーディオプレイヤー等）
、複写機、ファクシミリ、プリンター、プリンター複合機、現金自動預け入れ払い機（Ａ
ＴＭ）、自動販売機などが挙げられる。これら電子機器の具体例を図１９に示す。
【０３３１】
図１９（Ａ）は電子書籍であり、筐体７００１、表示部７００２等を有する。本発明の一
態様に係る半導体表示装置は、表示部７００２に用いることができる。表示部７００２に
本発明の一態様に係る半導体表示装置を用いることで、信頼性が高い電子書籍、視認性が
高い表示が可能な電子書籍、消費電力の低い電子書籍を提供することができる。また、本
発明の一態様に係る半導体装置は、電子書籍の駆動を制御するための集積回路に用いるこ
とができる。電子書籍の駆動を制御するための集積回路に本発明の一態様に係る半導体装
置を用いることで、信頼性が高い電子書籍、消費電力の低い電子書籍、高機能の電子書籍
を提供することができる。また、可撓性を有する基板を用いることで、半導体装置、半導
体表示装置に可撓性を持たせることができるので、フレキシブルかつ軽くて使い勝手の良
い電子書籍を提供することができる。
【０３３２】
図１９（Ｂ）は表示装置であり、筐体７０１１、表示部７０１２、支持台７０１３等を有
する。本発明の一態様に係る半導体表示装置は、表示部７０１２に用いることができる。
表示部７０１２に本発明の一態様に係る半導体表示装置を用いることで、信頼性が高い表
示装置、視認性が高い表示が可能な表示装置、消費電力の低い表示装置を提供することが
できる。また、本発明の一態様に係る半導体装置は、表示装置の駆動を制御するための集
積回路に用いることができる。表示装置の駆動を制御するための集積回路に本発明の一態
様に係る半導体装置を用いることで、信頼性が高い表示装置、消費電力の低い表示装置、
高機能の表示装置を提供することができる。なお、表示装置には、パーソナルコンピュー
タ用、ＴＶ放送受信用、広告表示用などの全ての情報表示用表示装置が含まれる。
【０３３３】
図１９（Ｃ）は表示装置であり、筐体７０２１、表示部７０２２等を有する。本発明の一
態様に係る半導体表示装置は、表示部７０２２に用いることができる。表示部７０２２に
本発明の一態様に係る半導体表示装置を用いることで、信頼性が高い表示装置、視認性が
高い表示が可能な表示装置、消費電力の低い表示装置を提供することができる。また、本
発明の一態様に係る半導体装置は、表示装置の駆動を制御するための集積回路に用いるこ
とができる。表示装置の駆動を制御するための集積回路に本発明の一態様に係る半導体装
置を用いることで、信頼性が高い表示装置、消費電力の低い表示装置、高機能の表示装置
を提供することができる。また、可撓性を有する基板を用いることで、半導体装置、半導
体表示装置に可撓性を持たせることができるので、フレキシブルかつ軽くて使い勝手の良
い表示装置を提供することができる。よって、図１９（Ｃ）に示すように、布地などに固
定させて表示装置を使用することができ、表示装置の応用の幅が格段に広がる。
【０３３４】
図１９（Ｄ）は携帯型ゲーム機であり、筐体７０３１、筐体７０３２、表示部７０３３、
表示部７０３４、マイクロホン７０３５、スピーカー７０３６、操作キー７０３７、スタ
イラス７０３８等を有する。本発明の一態様に係る半導体表示装置は、表示部７０３３、
表示部７０３４に用いることができる。表示部７０３３、表示部７０３４に本発明の一態
様に係る半導体表示装置を用いることで、信頼性が高い携帯型ゲーム機、視認性が高い表
示が可能な携帯型ゲーム機、消費電力の低い携帯型ゲーム機を提供することができる。ま
た、本発明の一態様に係る半導体装置は、携帯型ゲーム機の駆動を制御するための集積回
路に用いることができる。携帯型ゲーム機の駆動を制御するための集積回路に本発明の一
態様に係る半導体装置を用いることで、信頼性が高い携帯型ゲーム機、消費電力の低い携
帯型ゲーム機、高機能の携帯型ゲーム機を提供することができる。なお、図１９（Ｄ）に
示した携帯型ゲーム機は、２つの表示部７０３３と表示部７０３４とを有しているが、携
帯型ゲーム機が有する表示部の数は、これに限定されない。
【０３３５】
図１９（Ｅ）は携帯電話であり、筐体７０４１、表示部７０４２、音声入力部７０４３、
音声出力部７０４４、操作キー７０４５、受光部７０４６等を有する。受光部７０４６に
おいて受信した光を電気信号に変換することで、外部の画像を取り込むことができる。本
発明の一態様に係る半導体表示装置は、表示部７０４２に用いることができる。表示部７
０４２に本発明の一態様に係る半導体表示装置を用いることで、信頼性が高い携帯電話、
視認性が高い表示が可能な携帯電話、消費電力の低い携帯電話を提供することができる。
また、本発明の一態様に係る半導体装置は、携帯電話の駆動を制御するための集積回路に
用いることができる。携帯電話の駆動を制御するための集積回路に本発明の一態様に係る
半導体装置を用いることで、信頼性が高い携帯電話、消費電力の低い携帯電話、高機能の
携帯電話を提供することができる。
【０３３６】
図１９（Ｆ）は携帯情報端末であり、筐体７０５１、表示部７０５２、操作キー７０５３
等を有する。図１９（Ｆ）に示す携帯情報端末は、モデムが筐体７０５１に内蔵されてい
ても良い。本発明の一態様に係る半導体表示装置は、表示部７０５２に用いることができ
る。表示部７０５２に本発明の一態様に係る半導体表示装置を用いることで、信頼性が高
い携帯情報端末、視認性が高い表示が可能な携帯情報端末、消費電力の低い携帯情報端末
を提供することができる。また、本発明の一態様に係る半導体装置は、携帯情報端末の駆
動を制御するための集積回路に用いることができる。携帯情報端末の駆動を制御するため
の集積回路に本発明の一態様に係る半導体装置を用いることで、信頼性が高い携帯情報端
末、消費電力の低い携帯情報端末、高機能の携帯情報端末を提供することができる。
【０３３７】
本実施例は、上記実施の形態と適宜組み合わせて実施することが可能である。
【符号の説明】
【０３３８】
１０ パルス出力回路
１１ 配線
１２ 配線
１３ 配線
１４ 配線
１５ 配線
２１ 入力端子
２２ 入力端子
２３ 入力端子
２４ 入力端子
２５ 入力端子
２６ 出力端子
２７ 出力端子
３１ トランジスタ
３２ トランジスタ
３３ トランジスタ
３４ トランジスタ
３５ トランジスタ
３６ トランジスタ
３７ トランジスタ
３８ トランジスタ
３９ トランジスタ
４０ トランジスタ
４１ トランジスタ
４２ トランジスタ
４３ トランジスタ
５１ 電源線
５２ 電源線
５３ 電源線
１００ 基板
１０１ ゲート電極
１０２ ゲート絶縁膜
１０３ 酸化物半導体膜
１０４ 酸化物半導体膜
１０５ 酸化物半導体膜
１０７ 酸化物半導体膜
１０８ 酸化物半導体膜
１１１ ソース電極
１１２ ドレイン電極
１１３ 絶縁膜
１１４ トランジスタ
１１５ バックゲート電極
１１６ 絶縁膜
１３０ チャネル保護膜
１３１ ソース電極
１３２ ドレイン電極
１３３ 絶縁膜
１４０ トランジスタ
１４５ バックゲート電極
１４６ 絶縁膜
１５０ 酸化物半導体膜
１５１ 酸化物半導体膜
１５２ 酸化物半導体膜
１５３ 酸化物半導体膜
２００ 基板
２０１ 絶縁膜
２０２ 電極
２０３ 酸化物半導体膜
２０５ 酸化物半導体膜
２０７ 酸化物半導体膜
２０８ 酸化物半導体膜
２１１ 電極
２１２ ゲート絶縁膜
２１３ ゲート電極
２１４ 絶縁膜
２１５ 配線
２１６ 配線
２１７ 配線
２１８ 部分
２２０ トランジスタ
２２１ コンタクトホール
２２２ コンタクトホール
２２３ コンタクトホール
２３０ 配線
２３１ コンタクトホール
７００ 画素部
７０１ 信号線駆動回路
７０２ 走査線駆動回路
７０３ 画素
７０４ トランジスタ
７０５ 表示素子
７０６ 保持容量
７０７ 信号線
７０８ 走査線
７１０ 画素電極
７１１ 対向電極
７１２ マイクロカプセル
７１３ ドレイン電極
７１４ 樹脂
１４０１ トランジスタ
１４０２ ゲート電極
１４０３ ゲート絶縁膜
１４０４ 酸化物半導体膜
１４０６ａ 導電膜
１４０６ｂ 導電膜
１４０７ 絶縁膜
１４０８ 絶縁膜
１４１０ 画素電極
１４１１ 配向膜
１４１３ 対向電極
１４１４ 配向膜
１４１５ 液晶
１４１６ シール材
１４１７ スペーサ
１４２０ 基板
１６０１ 液晶パネル
１６０２ 拡散板
１６０３ プリズムシート
１６０４ 拡散板
１６０５ 導光板
１６０６ 反射板
１６０７ 光源
１６０８ 回路基板
１６０９ ＦＰＣ
１６１０ ＦＰＣ
５３００ 基板
５３０１ 画素部
５３０２ 走査線駆動回路
５３０３ 走査線駆動回路
５３０４ 信号線駆動回路
５３０５ タイミング制御回路
５６０１ シフトレジスタ
５６０２ サンプリング回路
５６０３ トランジスタ
５６０４ 配線
５６０５ 配線
６０３１ トランジスタ
６０３３ 発光素子
６０３４ 電極
６０３５ 電界発光層
６０３６ 電極
６０３７ 絶縁膜
６０３８ 隔壁
６０４１ トランジスタ
６０４３ 発光素子
６０４４ 電極
６０４５ 電界発光層
６０４６ 電極
６０４７ 絶縁膜
６０４８ 隔壁
６０５１ トランジスタ
６０５３ 発光素子
６０５４ 電極
６０５５ 電界発光層
６０５６ 電極
６０５７ 絶縁膜
６０５８ 隔壁
７００１ 筐体
７００２ 表示部
７０１１ 筐体
７０１２ 表示部
７０１３ 支持台
７０２１ 筐体
７０２２ 表示部
７０３１ 筐体
７０３２ 筐体
７０３３ 表示部
７０３４ 表示部
７０３５ マイクロホン
７０３６ スピーカー
７０３７ 操作キー
７０３８ スタイラス
７０４１ 筐体
７０４２ 表示部
７０４３ 音声入力部
７０４４ 音声出力部
７０４５ 操作キー
７０４６ 受光部
７０５１ 筐体
７０５２ 表示部
７０５３ 操作キー

【特許請求の範囲】
【請求項１】
ＧＲＴＡ装置を用いて、第１の酸化物半導体膜に熱を加え、
前記熱が加えられた第１の酸化物半導体膜に、酸素を添加して第２の酸化物半導体膜を形成し、
ＧＲＴＡ装置を用いて、前記酸素が添加された第２の酸化物半導体膜に熱を加えることを特徴とする半導体装置の作製方法。
【請求項２】
ＧＲＴＡ装置を用いて、第１の酸化物半導体膜に熱を加え、
前記熱が加えられた第１の酸化物半導体膜に、酸素を添加して第２の酸化物半導体膜を形成し、
前記酸素が添加された第２の酸化物半導体膜に熱を加えることを特徴とする半導体装置の作製方法。
【請求項３】
第１の酸化物半導体膜に熱を加え、
前記熱が加えられた第１の酸化物半導体膜に、酸素を添加して第２の酸化物半導体膜を形成し、
ＧＲＴＡ装置を用いて、前記酸素が添加された第２の酸化物半導体膜に熱を加えることを特徴とする半導体装置の作製方法。

【図１】

【図２】

【図３】

【図４】

【図５】

【図６】

【図７】

【図８】

【図９】

【図１０】

【図１１】

【図１２】

【図１３】

【図１４】

【図１５】

【図１６】

【図１７】

【図１８】

【図１９】

【図２０】

【図２１】

【図２２】

【図２３】

【公開番号】特開２０１３−１０２１９１（Ｐ２０１３−１０２１９１Ａ）
【公開日】平成２５年５月２３日（２０１３．５．２３）
【国際特許分類】
【出願番号】特願２０１３−２４３６（Ｐ２０１３−２４３６）
【出願日】平成２５年１月１０日（２０１３．１．１０）
【分割の表示】特願２０１２−１６７０１０（Ｐ２０１２−１６７０１０）の分割
【原出願日】平成２２年１２月１日（２０１０．１２．１）
【出願人】（０００１５３８７８）株式会社半導体エネルギー研究所 (5,264)
【Ｆターム（参考）】