半導体装置及び半導体装置の作製方法
【課題】半導体装置の開口率を向上させる。
【解決手段】同一基板上に第1の薄膜トランジスタを有する駆動回路及び第2の薄膜トランジスタを有する画素を有し、前記第1の薄膜トランジスタは、第1のゲート電極層と、ゲート絶縁層と、第1の酸化物半導体層と、第1の酸化物導電層及び第2の酸化物導電層と、前記第1の酸化物半導体層の一部に接し、且つ前記第1の酸化物導電層及び前記第2の酸化物導電層の周縁及び側面に接する酸化物絶縁層と、第1のソース電極層と、第1のドレイン電極層と、を有し、前記第2の薄膜トランジスタは、第2のゲート電極層と、第2の酸化物半導体層と、透光性を有する材料により構成された第2のソース電極層及び第2のドレイン電極層と、を有する。
【解決手段】同一基板上に第1の薄膜トランジスタを有する駆動回路及び第2の薄膜トランジスタを有する画素を有し、前記第1の薄膜トランジスタは、第1のゲート電極層と、ゲート絶縁層と、第1の酸化物半導体層と、第1の酸化物導電層及び第2の酸化物導電層と、前記第1の酸化物半導体層の一部に接し、且つ前記第1の酸化物導電層及び前記第2の酸化物導電層の周縁及び側面に接する酸化物絶縁層と、第1のソース電極層と、第1のドレイン電極層と、を有し、前記第2の薄膜トランジスタは、第2のゲート電極層と、第2の酸化物半導体層と、透光性を有する材料により構成された第2のソース電極層及び第2のドレイン電極層と、を有する。
Notice: Undefined index: DEJ in /mnt/www/gzt_disp.php on line 298
【特許請求の範囲】
【請求項1】
同一基板上に第1の薄膜トランジスタを有する駆動回路及び第2の薄膜トランジスタを有する画素を有し、
前記第1の薄膜トランジスタは、
第1のゲート電極層と、
前記第1のゲート電極層の上に設けられたゲート絶縁層と、
前記ゲート絶縁層を挟んで前記第1のゲート電極層の上に設けられ、第1のチャネル形成領域を有する第1の酸化物半導体層と、
前記第1の酸化物半導体層の上に設けられた第1の酸化物導電層及び第2の酸化物導電層と、
前記酸化物半導体層の一部に接し、且つ前記第1の酸化物導電層及び前記第2の酸化物導電層の周縁及び側面に接する酸化物絶縁層と、
前記第1の酸化物導電層に接する第1のソース電極層と、
前記第2の酸化物導電層に接する第1のドレイン電極層と、を有し、
前記第2の薄膜トランジスタは、
透光性を有する材料により構成された第2のゲート電極層と、
前記ゲート絶縁層を挟んで前記第2のゲート電極層の上に設けられ、第2のチャネル形成領域を有する第2の酸化物半導体層と、
前記第2の酸化物半導体層の上に設けられ、透光性を有する材料により構成された第2のソース電極層及び第2のドレイン電極層と、を有する半導体装置。
【請求項2】
請求項1において、
前記第1の薄膜トランジスタの前記第1のソース電極層及びドレイン電極層は、Al、Cr、Cu、Ta、Ti、Mo、Wから選ばれた元素を主成分とする導電層、若しくはそれらの合金とを組み合わせた積層からなる半導体装置。
【請求項3】
請求項1または請求項2において、
前記第2の薄膜トランジスタの前記第2のソース電極層、ドレイン電極層は、酸化インジウム、酸化インジウム酸化スズ合金、酸化インジウム酸化亜鉛合金、又は酸化亜鉛である半導体装置。
【請求項4】
請求項1乃至3のいずれか一項において、
前記第1の薄膜トランジスタ及び前記第2の薄膜トランジスタと同一基板上に容量部を有し、
前記容量部は、容量配線及び該容量配線と重なる容量電極を有し、
前記容量配線及び前記容量電極は、透光性を有する半導体装置。
【請求項5】
請求項1乃至4のいずれか一項において、
前記第1の薄膜トランジスタの前記酸化物絶縁層の上に前記第1の酸化物半導体層のチャネル形成領域と重なる導電層を有する半導体装置。
【請求項6】
請求項1乃至5のいずれか一項において、
前記第1の酸化物導電層及び前記第2の酸化物導電層は、前記第2の薄膜トランジスタの前記第2のソース電極層及び前記第2のドレイン電極層と同じ材料により構成される半導体装置。
【請求項7】
同一基板上に第1の薄膜トランジスタを有する駆動回路と第2の薄膜トランジスタを有する画素と、を有する半導体装置の作製方法であって、
第1のゲート電極層及び第2のゲート電極層を形成し、
前記第1のゲート電極層及び前記第2のゲート電極層の上にゲート絶縁層を形成し、
前記ゲート絶縁層を挟んで前記第1のゲート電極層の上に第1の酸化物半導体層を形成し、且つ前記ゲート絶縁層を挟んで前記第2のゲート電極層の上に第2の酸化物半導体層を形成し、
前記第1の酸化物半導体層及び前記第2の酸化物半導体層を脱水化または脱水素化した後、前記第1の酸化物半導体層及び前記第2の酸化物半導体層の上に酸化物導電膜を形成し、前記酸化物導電膜の一部を除去することにより前記第1の酸化物半導体層の上に第1の酸化物導電層及び第2の酸化物導電層を形成し、且つ前記第2の酸化物半導体層の上に第2のソース電極層及び第2のドレイン電極層を形成し、
前記第1の酸化物導電層及び前記第2の酸化物導電層、並びに前記第2のソース電極層及び前記第2のドレイン電極層の上に酸化物絶縁層を形成し、
前記酸化物絶縁層の一部を除去し、前記第1の酸化物導電層の一部及び前記第2の酸化物導電層の一部を露出させ、
露出した前記第1の酸化物導電層に接する第1のソース電極層を形成し、且つ露出した前記第2の酸化物導電層に接する第1のドレイン電極層を形成することを特徴とする半導体装置の作製方法。
【請求項8】
請求項7において、
多階調マスクを用いてレジストマスクを形成し、前記レジストマスクを用いてエッチングを行うことにより、前記第1の酸化物半導体層、前記第2の酸化物半導体層、前記第1の酸化物導電層、前記第2の酸化物導電層、前記第2のソース電極層、及び前記第2のドレイン電極層を形成することを特徴とする半導体装置の作製方法。
【請求項1】
同一基板上に第1の薄膜トランジスタを有する駆動回路及び第2の薄膜トランジスタを有する画素を有し、
前記第1の薄膜トランジスタは、
第1のゲート電極層と、
前記第1のゲート電極層の上に設けられたゲート絶縁層と、
前記ゲート絶縁層を挟んで前記第1のゲート電極層の上に設けられ、第1のチャネル形成領域を有する第1の酸化物半導体層と、
前記第1の酸化物半導体層の上に設けられた第1の酸化物導電層及び第2の酸化物導電層と、
前記酸化物半導体層の一部に接し、且つ前記第1の酸化物導電層及び前記第2の酸化物導電層の周縁及び側面に接する酸化物絶縁層と、
前記第1の酸化物導電層に接する第1のソース電極層と、
前記第2の酸化物導電層に接する第1のドレイン電極層と、を有し、
前記第2の薄膜トランジスタは、
透光性を有する材料により構成された第2のゲート電極層と、
前記ゲート絶縁層を挟んで前記第2のゲート電極層の上に設けられ、第2のチャネル形成領域を有する第2の酸化物半導体層と、
前記第2の酸化物半導体層の上に設けられ、透光性を有する材料により構成された第2のソース電極層及び第2のドレイン電極層と、を有する半導体装置。
【請求項2】
請求項1において、
前記第1の薄膜トランジスタの前記第1のソース電極層及びドレイン電極層は、Al、Cr、Cu、Ta、Ti、Mo、Wから選ばれた元素を主成分とする導電層、若しくはそれらの合金とを組み合わせた積層からなる半導体装置。
【請求項3】
請求項1または請求項2において、
前記第2の薄膜トランジスタの前記第2のソース電極層、ドレイン電極層は、酸化インジウム、酸化インジウム酸化スズ合金、酸化インジウム酸化亜鉛合金、又は酸化亜鉛である半導体装置。
【請求項4】
請求項1乃至3のいずれか一項において、
前記第1の薄膜トランジスタ及び前記第2の薄膜トランジスタと同一基板上に容量部を有し、
前記容量部は、容量配線及び該容量配線と重なる容量電極を有し、
前記容量配線及び前記容量電極は、透光性を有する半導体装置。
【請求項5】
請求項1乃至4のいずれか一項において、
前記第1の薄膜トランジスタの前記酸化物絶縁層の上に前記第1の酸化物半導体層のチャネル形成領域と重なる導電層を有する半導体装置。
【請求項6】
請求項1乃至5のいずれか一項において、
前記第1の酸化物導電層及び前記第2の酸化物導電層は、前記第2の薄膜トランジスタの前記第2のソース電極層及び前記第2のドレイン電極層と同じ材料により構成される半導体装置。
【請求項7】
同一基板上に第1の薄膜トランジスタを有する駆動回路と第2の薄膜トランジスタを有する画素と、を有する半導体装置の作製方法であって、
第1のゲート電極層及び第2のゲート電極層を形成し、
前記第1のゲート電極層及び前記第2のゲート電極層の上にゲート絶縁層を形成し、
前記ゲート絶縁層を挟んで前記第1のゲート電極層の上に第1の酸化物半導体層を形成し、且つ前記ゲート絶縁層を挟んで前記第2のゲート電極層の上に第2の酸化物半導体層を形成し、
前記第1の酸化物半導体層及び前記第2の酸化物半導体層を脱水化または脱水素化した後、前記第1の酸化物半導体層及び前記第2の酸化物半導体層の上に酸化物導電膜を形成し、前記酸化物導電膜の一部を除去することにより前記第1の酸化物半導体層の上に第1の酸化物導電層及び第2の酸化物導電層を形成し、且つ前記第2の酸化物半導体層の上に第2のソース電極層及び第2のドレイン電極層を形成し、
前記第1の酸化物導電層及び前記第2の酸化物導電層、並びに前記第2のソース電極層及び前記第2のドレイン電極層の上に酸化物絶縁層を形成し、
前記酸化物絶縁層の一部を除去し、前記第1の酸化物導電層の一部及び前記第2の酸化物導電層の一部を露出させ、
露出した前記第1の酸化物導電層に接する第1のソース電極層を形成し、且つ露出した前記第2の酸化物導電層に接する第1のドレイン電極層を形成することを特徴とする半導体装置の作製方法。
【請求項8】
請求項7において、
多階調マスクを用いてレジストマスクを形成し、前記レジストマスクを用いてエッチングを行うことにより、前記第1の酸化物半導体層、前記第2の酸化物半導体層、前記第1の酸化物導電層、前記第2の酸化物導電層、前記第2のソース電極層、及び前記第2のドレイン電極層を形成することを特徴とする半導体装置の作製方法。
【図1】
【図2】
【図3】
【図4】
【図5】
【図6】
【図7】
【図8】
【図9】
【図10】
【図11】
【図12】
【図13】
【図14】
【図15】
【図16】
【図17】
【図18】
【図19】
【図20】
【図21】
【図22】
【図23】
【図24】
【図25】
【図26】
【図27】
【図28】
【図29】
【図30】
【図31】
【図32】
【図33】
【図34】
【図35】
【図36】
【図37】
【図38】
【図39】
【図40】
【図41】
【図42】
【図43】
【図44】
【図45】
【図46】
【図47】
【図2】
【図3】
【図4】
【図5】
【図6】
【図7】
【図8】
【図9】
【図10】
【図11】
【図12】
【図13】
【図14】
【図15】
【図16】
【図17】
【図18】
【図19】
【図20】
【図21】
【図22】
【図23】
【図24】
【図25】
【図26】
【図27】
【図28】
【図29】
【図30】
【図31】
【図32】
【図33】
【図34】
【図35】
【図36】
【図37】
【図38】
【図39】
【図40】
【図41】
【図42】
【図43】
【図44】
【図45】
【図46】
【図47】
【公開番号】特開2011−54949(P2011−54949A)
【公開日】平成23年3月17日(2011.3.17)
【国際特許分類】
【出願番号】特願2010−175003(P2010−175003)
【出願日】平成22年8月4日(2010.8.4)
【出願人】(000153878)株式会社半導体エネルギー研究所 (5,264)
【Fターム(参考)】
【公開日】平成23年3月17日(2011.3.17)
【国際特許分類】
【出願日】平成22年8月4日(2010.8.4)
【出願人】(000153878)株式会社半導体エネルギー研究所 (5,264)
【Fターム(参考)】
[ Back to top ]